JP2008236755A - データ変換器を改良するためのシステムおよび方法 - Google Patents
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Abstract
【課題】データ変換器の効率を改良するシステムおよび方法を提供する。
【解決手段】例示の方法では、ノイズ信号を発生させ、ノイズ信号のスペクトルを、関連するデータ変換器の動作に基づいて変更し、スペクトルの変更されたノイズ信号を、関連するデータ変換器へ供給する。データ変換器は、デジタル−アナログ変換器またはアナログ−デジタル変換器である。スペクトルの変更されたノイズ信号は、対象とする周波数でノッチが付けられる。スペクトルは、乱数発生器により発生された信号を遅延デバイスへ送り、遅延デバイスの出力を乱数発生器の出力に加算することにより、変更される。また、スペクトルは、第1および第2の同一の乱数発生器にシードを与え、第1の乱数発生器の動作を遅延させ、遅延した第1の乱数発生器の出力を第2の乱数発生器に加算することにより、変更される。
【選択図】図2
【解決手段】例示の方法では、ノイズ信号を発生させ、ノイズ信号のスペクトルを、関連するデータ変換器の動作に基づいて変更し、スペクトルの変更されたノイズ信号を、関連するデータ変換器へ供給する。データ変換器は、デジタル−アナログ変換器またはアナログ−デジタル変換器である。スペクトルの変更されたノイズ信号は、対象とする周波数でノッチが付けられる。スペクトルは、乱数発生器により発生された信号を遅延デバイスへ送り、遅延デバイスの出力を乱数発生器の出力に加算することにより、変更される。また、スペクトルは、第1および第2の同一の乱数発生器にシードを与え、第1の乱数発生器の動作を遅延させ、遅延した第1の乱数発生器の出力を第2の乱数発生器に加算することにより、変更される。
【選択図】図2
Description
本発明は、データ変換器に関する。
アナログ−デジタル変換器(ADC)またはデジタル−アナログ変換器(DAC)および復調器を使用する高性能システム(図1)は、高分解能の変換器を必要とする。このシステムの性能は、含まれる変換器の分解能(ビット数)により制限されることがある。1つの解決策は、変換器のビット数を増やして、変換器の分解能を改良することである。しかし、こうするとコスト、消費電力、およびサイズが増加し、結果として処理速度が遅くなる。
変換器の分解能および微分直線性(differential linearity)を改良するための他の解決策は、ノイズを加算して平均処理を行うことである。しかしながら、変換器へノイズを注入すると、システム/センサの出力で望ましくないノイズが増大する。
従って、コストや消費電力を著しく増加させず、かつ変換器の速度を低下させずに、変換器の分解能を改良する必要がある。
本発明は、データ変換器の効率を改良するシステムおよび方法を提供する。1つの例示の方法では、ノイズ信号を発生させ、関連するデータ変換器の動作に基づいてノイズ信号のスペクトルを変更し、スペクトルの変更されたノイズ信号を、関連するデータ変換器へ供給する。
データ変換器は、デジタル−アナログ変換器、またはアナログ−デジタル変換器である。スペクトルの変更されたノイズ信号は、ノッチが付けられる。ノッチは、関心の(対象とする)周波数で生じる。
本発明の一態様では、乱数発生器により発生された信号を遅延デバイスへ送り、遅延デバイスの出力を乱数発生器の出力に加算することにより、スペクトルが変更される。
本発明の別の態様では、第1および第2の同一の乱数発生器へシードを与え、第1の乱数発生器の動作を遅延させ、遅延した第1の乱数発生器の出力を第2の乱数発生器に加算することにより、スペクトルが変更される。
本発明の好ましいまたは代替の実施形態は、図を参照して以下で詳細に説明する。
図2は、本発明の実施形態に従って構成された例示的なセンサ・システム20を示す。システム20は、アナログ・センサ24、アナログ−デジタル変換器(ADC)26、デジタル信号プロセッサ28、デジタル−アナログ変換器(DAC)30、および駆動回路32を含む。センサ24は、幾つかの異なるタイプのセンサのうちの何れのものでもよく、例えば、光ファイバ・センサおよびジャイロ(例えば、光ファイバ・ジャイロ(FOG)とすることができる。光ファイバ・ジャイロなどの多くのセンサは、特定の周波数の正弦波または矩形波の変調信号を使用して、検知されるパラメータを示す特定の周波数の出力信号を発生させる。変調の1つの利点は、低周波ドリフト・エラーおよび1/fノイズから離れて、ドリフト・エラーがなく低ノイズの周波数へと測定をシフトすることである。更に、変調は、ノイズから非常に弱い信号を抽出する手段を提供するロックイン増幅器などのような、同期復調の使用も可能にする。
センサ24は、1つの特定の周波数または複数の特定の周波数のアナログ信号を発生させ、そのアナログ信号がADC26によりデジタルに変換され、次いでデジタル信号プロセッサ28により処理される。デジタル信号プロセッサ28は、同期復調を行い、検知信号をベースバンドへとダウンコンバートする。デジタル信号プロセッサ28は、検知値ならびに駆動信号を出力し、駆動信号はDAC30によりアナログに変換される。DAC30の出力は駆動信号の増幅のために駆動回路32へ送信され、その駆動信号はセンサ24へ送られてシステム20の閉ループ動作を完成させる。本発明は、開ループ・システムに実装されてもよい。
デジタル信号プロセッサ28は、変換器26および30の動作効率を向上させるために、ノイズを発生させ、その発生されたノイズを変換器26および30の何れかへ適用するための構成要素を含む。DSP28により発生されたノイズは、データ変換器30についてはベースバンド周波数および同期復調周波数の偶数調波で最小であり、データ変換器26については同期変調周波数およびその奇数調波で最小である。従って、発生されたノイズは、変換器26および30の動作を妨げない。
図3は、図2に示したシステム20で実行される例示の処理40の流れ図を示す。はじめに、ブロック42で、プロセッサ28によりデジタル・ノイズが発生される。次に、ブロック44で、発生されたデジタル・ノイズのスペクトルが、変換器26または30のベースバンド動作に相当する予め定められたベースバンドにあるノイズ量を減らすために、変更される。ブロック46で、変更されたノイズが、変換器26または30の何れかにより受信される信号に加算され、次いでブロック48で、その結み合わされた信号がそれぞれの変換器へ送られる。
ノイズ(例えば、ガウス雑音)は、周知の技術を用いてデジタル的に発生される。ノイズのスペクトルは、幾つかの異なる方法の何れかによl
変更される。スペクトルを変更するための2つの異なる方法の例が、図6および図7に示されている。
変更される。スペクトルを変更するための2つの異なる方法の例が、図6および図7に示されている。
図4は、DAC30に適用される第1の実施形態の例を示す。プロセッサ28は、ADC26により発生されたデジタル信号を受信する矩形波復調器60を含む。アキュムレータ62は、復調器60の出力を受信する。加算器64で、アキュムレータ62の出力は、ノイズ発生器72で発生されたノイズと結み合わされる。ブロック66で加算器64の出力に対して切り捨てが行われ(truncated)、次いでDAC30へ出力される。ゼロに近い周波数と、アナログ・フィードバック・ドライブ上にある矩形波復調周波数の偶数調波とのノイズが、測定ノイズに寄与する。従って、ノイズ発生器72は、これらの周波数でのノイズを減少させたノイズ・スペクトルを発生させる。
図5に示すように、システム80は、ADC26へノイズを適用する。システム80は、従来技術に従って動作する矩形波復調器98と、アキュムレータ100と、切り捨てエレメント102とを含むプロセッサ88を含む。ノイズ発生器72は、別のDAC92へ送られるノイズを発生させる。DAC92はアナログ信号を加算増幅器84へ出力し、加算増幅器84は、そのノイズのアナログ・バージョンを、センサ24からのアナログ信号へ加算し、それをADC26へ供給する。矩形波復調周波数およびその奇数調波のノイズが、測定ノイズに寄与する。従って、この場合のノイズ発生器72は、これらの周波数でのノイズを減少させたノイズ・スペクトルを発生させる。
図6に示すように、ノイズ発生器72aは、乱数発生器110、遅延デバイス112、および加算コンポーネント114を含む。乱数発生器110は、乱数を発生させるデジタル乱数発生器であり、乱数は、次いで遅延デバイス112および加算コンポーネント114へ送信される。遅延デバイス112は、受信したデジタル信号の時間遅延を実行する複数の遅延レジスタを含む。加算コンポーネント114は、遅延デバイス112の最後のレジスタの出力を受信し、それを、乱数発生器110により出力される乱数に加える。遅延は、所望のノッチ周波数でフーリエ成分の180度の位相のずれを生じさせるので、2つの信号を加算すると、所望のノッチ周波数でフーリエ成分の減算が行われることになる。
加算コンポーネント114の例示の出力のノイズ・スペクトルが、図8のチャート240に示されている。チャート240に示されるように、遅延デバイス112により引き起こされる遅延の量が、周波数領域内でのノイズの低いポイント(ノッチ)が発生するところを指図する。一実施形態では、偶数調波(2F、4F、6F)でノッチが発生し、それにより、変換器の近似の動作周波数での、ノイズ発生器に発生される低ノイズ情況を提供する。ノッチは、設計者の好みに基づいて他の周波数で発生させてもよい。
ノイズのノッチ周波数は、変調/復調周波数と関連する。FOGの場合、最適の変調/復調周波数は、感知コイルの長さにより決定される。この周波数は、固有振動数または固有周波数と呼ばれる。様々なFOG回転感知エラーは、固有周波数で動作することにより減少または解消される。共振方式光ファイバ・ジャイロ(RFOG:resonator fiber optic gyro)などの他のセンサは、最適の性能をもたらす或る変調/復調周波数を有する。
図7は、本発明の代替の実施形態に従って構成されたノイズ発生器72bを示す。発生器72bは、スタート・パルス224を、第1の乱数発生器228および遅延デバイス226で同時に受信する。遅延デバイス226は、スタート・パルス224が第2の乱数発生器230へ到着するのを遅延させる。第1の乱数発生器228および第2の乱数発生器230は、シード・コンポーネント232により提供される同じシードを有する同じ乱数発生器である。次いで、第1の乱数発生器228および第2の乱数発生器230の出力は加算エレメント236へ供給され、加算エレメント236は、第2の乱数発生器230の出力を第1の乱数発生器228に加算して、図8に示されるようなノッチが付けられたノイズ信号を生成する。
Claims (4)
- データ変換器の効率を向上させる方法であって、
ノイズ信号を発生させるステップと、
前記ノイズ信号のスペクトルを、関連するデータ変換器の動作に基づいて変更するステップと、
スペクトルの変更された前記ノイズ信号を、前記関連するデータ変換器へ供給するステップと
を備え、
前記スペクトルを変更する前記変更するステップが、乱数発生器により発生された信号を遅延デバイスへ送るステップと、前記遅延デバイスの出力を前記乱数発生器の出力に加算するステップとを含む、
方法。 - 請求項1に記載の方法であって、前記データ変換器がデジタル−アナログ変換器またはアナログ−デジタル変換器であり、スペクトルの変更された前記ノイズ信号に、関心対象の周波数に基づいてノッチを発生させ、前記スペクトルを変更する前記変更するステップが、
同じである第1および第2の乱数発生器へ、シードを供給するステップと、
前記第1の乱数発生器の動作を遅延させるステップと、
遅延した前記第1の乱数発生器の出力を前記第2の乱数発生器に加算するステップと
を含む、
方法。 - データ変換器の効率を向上させるシステムであって、
ノイズ信号を発生させるように構成された発生器(110、230)と、
前記ノイズ信号のスペクトルを、関連するセンサの動作に基づいて変更するように構成されたコンポーネント(112、226、230)と、
スペクトルの変更された前記ノイズ信号を、前記データ変換器により受信される信号に加算するように構成された加算デバイス(114、236)と
を備え、
前記発生器が、乱数を発生させるように構成された同じである第1および第2の乱数発生器(228、230)を含み、前記コンポーネントが、同じである前記第1および第2の乱数発生器へシードを供給するように構成されたシード・コンポーネント(232)と、前記第1の乱数発生器の動作を遅延させるように構成された遅延コンポーネント(226)と、前記遅延コンポーネントの出力を前記第2の乱数発生器の出力に加算するように構成された加算コンポーネント(236)とを含む、
システム。 - 請求項3に記載のシステムであって、スペクトルの変更された前記ノイズ信号に、関心対象の周波数に基づいてノッチを発生させるものであり、前記発生器は、乱数発生器(110)を含み、前記コンポーネントは、遅延デバイス(112)と、前記遅延デバイスの出力を前記乱数発生器の出力に加算するように構成された加算コンポーネント(114)とを含む、システム。
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