JP2008216878A - プラズマディスプレイパネルの駆動方法 - Google Patents

Abstract

【課題】本発明は、かかる問題を解決すべく為されたものであり、低輝度画像を表示する際にも輝度ムラを抑制させた良好な画像表示が可能となるプラズマディスプレイパネルの駆動方法を提供することを目的とする。
【解決手段】プラズマディスプレイパネルの行電極対にサスティンパルスを印加することにより点灯モードの状態にある放電セルのみをサスティン放電させるにあたり、かかるサスティンパルスと共に、プラズマディスプレイパネルの列電極に補助パルスを印加することにより、行電極間の電界強度を高める。
【選択図】図８

Description

本発明は、プラズマディスプレイパネルを駆動する駆動方法に関する。

現在、薄型表示装置として、ＡＣ型(交流放電型)のプラズマディスプレイパネルが製品化されてきている。プラズマディスプレイパネル内には、２枚の基板、すなわち前面ガラス基板及び背面ガラス基板が所定間隙を介して対向配置されている。表示面としての上記前面ガラス基板の内面（背面ガラス基板と対向する面）には、互いに対をなして平行に伸長する行電極対の複数がサスティン電極対として形成されている。背面ガラス基板には、行電極対と交差するように複数の列電極がアドレス電極として伸長形成され、さらに蛍光体が塗布されている。上記表示面側から見た場合、行電極対と列電極との交叉部に、画素に対応した表示セルが形成されている。このようなプラズマディスプレイパネルに対して、入力映像信号に対応した中間調の表示輝度を得るべく、サブフィールド法を用いた階調駆動を実施する。

サブフィールド法に基づく階調駆動では、発光を実施すべき回数（又は期間）が夫々に割り当てられている複数のサブフィールド各々にて、１フィールド分の映像信号に対する表示駆動を実施する。各サブフィールドでは、アドレス行程と、サスティン行程とを順次実行する。アドレス行程では、入力映像信号に応じて、選択的に各表示セル内の行電極及び列電極間で選択放電を生起させて所定量の壁電荷を形成（又は消去）させる。サスティン行程では、サスティンパルスを繰り返し全表示セルに印加することにより、所定量の壁電荷が形成されている表示セルのみを繰り返しサスティン放電させてその放電に伴う発光状態を維持する。更に、少なくとも先頭のサブフィールドにおいて上記アドレス行程に先立ち、初期化行程を実行する。かかる初期化行程では、全ての表示セル内において、対を為す行電極間にリセット放電を生起させることにより全表示セル内に残留する壁電荷の量を初期化する初期化行程を実行する。

ここで、サスティン行程において、多数の表示セルで同時にサスティン放電が生起されると、瞬間的に多量の電流が流れ、サスティンパルスの電圧波形に歪みが生じる。その結果、１画面内においてサスティン放電が生起される表示セルの数が多い場合と少ない場合とで、その放電時に印加される電圧値が異なることになり、放電強度にバラツキが生じる。よって、この際、放電強度のバラツキに伴う輝度ムラが生じる恐れがあった。

そこで、各サスティン行程において、第２番目に印加されるサスティンパルスの立ち上がり期間を、それ以降に印加されるサスティンパルスの立ち上がり期間よりも長く設定するようにした駆動方法が提案された（例えば、特許文献１参照）。かかる駆動方法によれば、第２番目に印加されるサスティンパルスに応じて、先ず、そのパルスの立ち上がり期間において第１回目の放電が生起され、引き続き、パルスのピーク期間において第２回目の放電が生起される。よって、これら２回分の連続放電（以下、二叉放電と称する）により、同時に放電が生起される表示セルの数が多い場合と、少ない場合とで、その放電に伴って視覚される輝度レベルが略同一となり、輝度ムラが改善される（例えば、特許文献１の図１９参照））。

ところが、低輝度な画像を表示する際には各フィールド内で生起させるサスティン放電の合計回数が少なくなり、表示セル内に残留する荷電粒子の量が少なくなるので、放電遅れが生じるようになる。この際、上述した如く第２番目に印加されるサスティンパルスの立ち上がり期間を長くしてしまうと、パルスの立ち上がり期間において第１回目の放電が生起されなくなる場合があり、輝度ムラの改善効果が発揮されないという問題があった。
特開２００６−３３０６０３号公報

本発明は、かかる問題を解決すべく為されたものであり、低輝度画像を表示する際にも輝度ムラを抑制させた良好な画像表示が可能となるプラズマディスプレイパネルの駆動方法を提供することを目的とする。

請求項１記載によるプラズマディスプレイパネルの駆動方法は、放電ガスが封入された放電空間を挟んで前面基板及び背面基板が対向配置されており、前記前面基板及び前記背面基板間に配置されている複数の行電極対と当該行電極対に交叉して配置されている複数の列電極との各交叉部に蛍光体層を備えた放電セルが形成されているプラズマディスプレイパネルを、入力映像信号における単位表示期間毎に複数のサブフィールドによって階調駆動するプラズマディスプレイパネルの駆動方法であって、前記サブフィールド各々において、前記入力映像信号に対応した画素データに応じて前記放電セル各々を選択的にアドレス放電せしめて点灯モード及び消灯モードの内の一方の状態に設定するアドレス行程と、前記行電極対の一方の行電極と他方の行電極に交互にサスティンパルスを印加することによって前記点灯モード状態の放電セルに対してのみに前記サブフィールドの輝度重みに対応した回数だけ繰り返しサスティン放電を生起せしめるサスティン行程とを実行し、前記サスティン行程では、少なくとも前記サスティンパルスの前縁部の期間中の一部の期間に亘りパルスのピーク電位を維持する補助パルスを前記列電極に印加する。

プラズマディスプレイパネルの行電極対にサスティンパルスを印加することにより点灯モードの状態にある放電セルのみをサスティン放電させるにあたり、かかるサスティンパルスと共に、プラズマディスプレイパネルの列電極に補助パルスを印加することにより、行電極間の電界強度を高める。これにより、放電セル内に残留する荷電粒子の量が放電を生起させる際に必要となる量に満たない状態で、輝度ムラを解消すべくパルスの前縁部区間を長くしたサスティンパルスを印加した場合にも、確実にサスティン放電を生起させることが可能となる。よって、サスティン放電の実施回数が少なくなるが故に放電セル内に残留する荷電粒子の量が不足する低輝度表示を実施する際にも、輝度ムラを抑制させた良好が画像表示が為されるようになる。

又、上記補助パルスの印加を、各サスティン行程の最先頭部、或いは輝度重みが所定値よりも小なるサブフィールドの直後のサブフィールドのサスティン行程のみで実行することにより電力消費量を低減させる。

図１は、本発明の第１の実施例による駆動方法に従ってプラズマディスプレイパネルを駆動するプラズマディスプレイ装置の概略構成を示す図である。

図１に示す如く、かかるプラズマディスプレイ装置は、プラズマディスプレイパネルとしてのＰＤＰ５０、Ｘ電極ドライバ５１、Ｙ電極ドライバ５３、アドレスドライバ５５、及び駆動制御回路５６から構成される。

ＰＤＰ５０には、２次元表示画面の縦方向（垂直方向）に夫々伸張して配列された列電極Ｄ₁〜Ｄ_m、横方向（水平方向）に夫々伸張して配列された行電極Ｘ₁〜Ｘ_n及び行電極Ｙ₁〜Ｙ_nが形成されている。この際、互いに隣接するもの同士で対を為す行電極対（Ｙ₁，Ｘ₁）、（Ｙ₂，Ｘ₂）、（Ｙ₃，Ｘ₃）、・・・、（Ｙ_n，Ｘ_n）が夫々、ＰＤＰ５０における第１表示ライン〜第ｎ表示ラインを担う。各表示ラインと列電極Ｄ₁〜Ｄ_m各々との各交叉部(図１中の一点鎖線にて囲まれた領域)には、画素を担う放電セル（表示セル）ＰＣが形成されている。すなわち、ＰＤＰ５０には、第１表示ラインに属する放電セルＰＣ_1,1〜ＰＣ_1,m、第２表示ラインに属する放電セルＰＣ_2,1〜ＰＣ_2,m、・・・・、第ｎ表示ラインに属する放電セルＰＣ_n,1〜ＰＣ_n,mの各々がマトリクス状に配列されているのである。

図２は、表示面側から眺めたＰＤＰ５０の内部構造を模式的に示す正面図である。尚、図２においては、夫々隣接する３つの列電極Ｄと、互いに隣接する２つの表示ラインとの各交叉部を抜粋して示すものである。又、図３は、図２のＶ−Ｖ線におけるＰＤＰ５０の断面を示す図であり、図４は、図２のＷ−Ｗ線におけるＰＤＰ５０の断面を示す図である。

図２に示すように、各行電極Ｘは、２次元表示画面の水平方向に伸張するバス電極Ｘｂと、かかるバス電極Ｘｂ上の各放電セルＰＣに対応した位置に夫々接触して設けられたＴ字形状の透明電極Ｘａと、から構成される。各行電極Ｙは、２次元表示画面の水平方向に伸張するバス電極Ｙｂと、かかるバス電極Ｙｂ上の各放電セルＰＣに対応した位置に夫々接触して設けられたＴ字形状の透明電極Ｙａと、から構成される。透明電極Ｘａ及びＹａは例えばＩＴＯ等の透明導電膜からなり、バス電極Ｘｂ及びＹｂは例えば金属膜からなる。透明電極Ｘａ及バス電極Ｘｂからなる行電極Ｘ、並びに透明電極Ｙａ及バス電極Ｙｂからなる行電極Ｙは、図３に示す如く、その前面側がＰＤＰ５０の表示面となる前面透明基板１０の背面側に形成されている。この際、各行電極対（Ｘ、Ｙ）における透明電極Ｘａ及びＹａは、互いに対となる相手の行電極側に伸張しており、その幅広部の頂辺同士が所定幅の放電ギャップｇ１を介して互いに対向している。又、前面透明基板１０の背面側には、行電極対（Ｘ、Ｙ）とこの行電極対に隣接する行電極対（Ｘ、Ｙ）との間に、２次元表示画面の水平方向に伸張する黒色または暗色の光吸収層（遮光層）１１が形成されている。さらに、前面透明基板１０の背面側には、行電極対（Ｘ，Ｙ）を被覆するように誘電体層１２が形成されている。この誘電体層１２の背面側（行電極対が接触する面とは反対側の面）には、図３に示す如く、光吸収層１１とこの光吸収層１１に隣接するバス電極Ｘｂ及びＹｂとが形成されている領域に対応した部分に、嵩上げ誘電体層１２Ａが形成されている。

誘電体層１２及び嵩上げ誘電体層１２Ａの表面上には、酸化マグネシウム層１３が形成されている。尚、酸化マグネシウム層１３は、電子線の照射によって励起されて波長２００〜３００ｎｍ内、特に、２３０〜２５０ｎｍ内にピークを有するＣＬ（カソードルミネッセンス）発光を行う二次電子放出材としての酸化マグネシウム結晶体（以下、ＣＬ発光ＭｇＯ結晶体と称する）を含むものである。このＣＬ発光ＭｇＯ結晶体は、マグネシウムを加熱して発生するマグネシウム蒸気を気相酸化して得られるものであり、例えば立方体の結晶体が互いに嵌り込んだ多重結晶構造、あるいは立方体の単結晶構造を有する。ＣＬ発光ＭｇＯ結晶体の平均粒径は、２０００オングストローム以上（ＢＥＴ法による測定結果）である。

平均粒径が２０００オングストローム以上の大きな粒径の気相法酸化マグネシウム単結晶体を形成しようとする場合には、マグネシウム蒸気を発生させる際の加熱温度を高くする必要がある。このため、マグネシウムと酸素が反応する火炎の長さが長くなり、この火炎と周囲との温度差が大きくなることによって、粒径の大きい気相法酸化マグネシウム単結晶体ほど、上述した如きＣＬ発光のピーク波長（例えば、２３５ｎｍ付近、２３０〜２５０ｎｍ内）に対応したエネルギー準位を有するものが多く形成されることになる。

また、一般的な気相酸化法に比べ、単位時間当たりに蒸発させるマグネシウムの量を増加させてマグネシウムと酸素との反応領域をより増大させ、より多くの酸素と反応することによって生成された気相法酸化マグネシウム単結晶体は、上述したＣＬ発光のピーク波長に対応したエネルギー準位を有するものとなる。

このようなＣＬ発光ＭｇＯ結晶体を、スプレー法や静電塗布法等によって、誘電体層１２の表面に付着させることにより酸化マグネシウム層１３が形成されている。尚、誘電体層１２の表面に蒸着又はスパッタ法により薄膜酸化マグネシウム層を形成し、その上にＣＬ発光ＭｇＯ結晶体を付着させて酸化マグネシウム層１３を形成するようにしても良い。

一方、前面透明基板１０と平行に配置された背面基板１４上には、各行電極対（Ｘ，Ｙ）における透明電極Ｘａ及びＹａに対向する位置において、列電極Ｄの各々が行電極対（Ｘ，Ｙ）と直交する方向に伸張して形成されている。背面基板１４上には、更に列電極Ｄを被覆する白色の列電極保護層１５が形成されている。この列電極保護層１５上には隔壁１６が形成されている。隔壁１６は、各行電極対（Ｘ，Ｙ）のバス電極Ｘｂ及びＹｂに対応した位置において夫々２次元表示画面の横方向に伸張している横壁１６Ａと、互いに隣接する列電極Ｄ間の各中間位置において２次元表示画面の縦方向に伸張している縦壁１６Ｂとによって梯子形状に形成されている。更に、図２に示す如き梯子形状の隔壁１６がＰＤＰ５０の各表示ライン毎に形成されている。互いに隣接する隔壁１６の間には、図２に示す如き隙間ＳＬが存在する。又、梯子状の隔壁１６により、夫々独立した放電空間Ｓ、透明電極Ｘａ及びＹａを含む放電セルＰＣが区画されている。放電空間Ｓ内には、キセノンガスを含む放電ガスが封入されている。各放電セルＰＣ内における横壁１６Ａの側面、縦壁１６Ｂの側面、及び列電極保護層１５の表面には、これらの面を全て覆うように蛍光体層１７が形成されている。この蛍光体層１７は、実際には、赤色発光を為す蛍光体、緑色発光を為す蛍光体、及び青色発光を為す蛍光体の３種類からなる。

尚、蛍光体層１７内には、例えば図５に示す如き形態にて、二次電子放出材としてのＭｇＯ結晶体（ＣＬ発光ＭｇＯ結晶体を含む）が含まれている。この際、 蛍光体層１７の表面上における放電空間Ｓを覆う面上、つまり放電空間Ｓと接する面上には、放電ガスと接触するようにＭｇＯ結晶体が蛍光体層１７から露出している。

ここで、各放電セルＰＣの放電空間Ｓと隙間ＳＬとの間は、図３に示す如く酸化マグネシウム層１３が横壁１６Ａに当接されることによって互いに閉じられている。又、図４に示す如く、縦壁１６Ｂは酸化マグネシウム層１３に当接されていないので、その間に隙間ｒが存在する。すなわち、２次元表示画面の横方向において互いに隣接する放電セルＰＣ各々の放電空間Ｓは、この隙間ｒを介して互いに連通しているのである。

駆動制御回路５６は、先ず、入力映像信号を各画素毎にその全ての輝度レベルを２５６階調にて表現する８ビットの画素データに変換し、この画素データに対して誤差拡散処理及びディザ処理からなる多階調化処理を施す。すなわち、先ず、誤差拡散処理では、上記画素データの上位６ビット分を表示データ、残りの下位２ビット分を誤差データとし、周辺画素各々に対応した画素データにおける誤差データを重み付け加算したものを、上記表示データに反映させることにより６ビットの誤差拡散処理画素データを得る。かかる誤差拡散処理によれば、原画素における下位２ビット分の輝度が周辺画素によって擬似的に表現され、それ故に８ビットよりも少ない６ビット分の表示データにて、上記８ビット分の画素データと同等の輝度階調表現が可能になる。次に、駆動制御回路５６は、この誤差拡散処理によって得られた６ビットの誤差拡散処理画素データに対してディザ処理を施す。ディザ処理では、互いに隣接する複数の画素を１画素単位とし、この１画素単位内の各画素に対応した上記誤差拡散処理画素データに夫々、互いに異なる係数値からなるディザ係数を夫々割り当てて加算することによりディザ加算画素データを得る。かかるディザ係数の加算によれば、上記の如き画素単位で眺めた場合には、ディザ加算画素データの上位４ビット分だけでも８ビットに相当する輝度を表現することが可能となる。そこで、駆動制御回路５６は、上記ディザ加算画素データの上位４ビット分を、図６に示す如き、全輝度レベルを１５階調にて表す４ビットの多階調化画素データＰＤ_Sに変換する。そして、駆動制御回路５６は、多階調化画素データＰＤ_Sを図６に示す如きデータ変換テーブルに従って１４ビットの画素駆動データＧＤに変換する。駆動制御回路５６は、かかる画素駆動データＧＤにおける第１〜第１４ビットを夫々サブフィールドＳＦ１〜ＳＦ１４（後述する）の各々に対応させ、そのサブフィールドＳＦに対応したビット桁を画素駆動データビットとして１表示ライン分（ｍ個）ずつアドレスドライバ５５に供給する。

更に、駆動制御回路５６は、図７に示す如き発光駆動シーケンスに従って上記構造を有するＰＤＰ５０を駆動させるべき各種制御信号を、Ｘ電極ドライバ５１、Ｙ電極ドライバ５３及びアドレスドライバ５５からなるパネルドライバに供給する。すなわち、駆動制御回路５６は、図７に示す如き１フィールド（１フレーム）表示期間内の先頭のサブフィールドＳＦ１では、リセット行程Ｒ、選択書込アドレス行程Ｗ_W及びサスティン行程Ｉ各々に従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。又、サブフィールドＳＦ２〜ＳＦ１４各々では、選択消去アドレス行程Ｗ_D及びサスティン行程Ｉ各々に従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。尚、１フィールド表示期間内の最後尾のサブフィールドＳＦ１４に限り、サスティン行程Ｉの実行後、駆動制御回路５６は、消去行程Ｅに従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。

パネルドライバ、すなわち、Ｘ電極ドライバ５１、Ｙ電極ドライバ５３及びアドレスドライバ５５は、駆動制御回路５６から供給された各種制御信号に応じて、図８に示す如き各種駆動パルスを生成してＰＤＰ５０の列電極Ｄ、行電極Ｘ及びＹに供給する。

図８においては、図７に示されるサブフィールドＳＦ１〜ＳＦ１４の内の、先頭のサブフィールドＳＦ１と、それに続くサブフィールドＳＦ２、並びに最後尾のサブフィールドＳＦ１４での動作のみを抜粋して示すものである。

先ず、サブフィールドＳＦ１のリセット行程Ｒの前半部では、Ｙ電極ドライバ５３が、後述するサスティンパルスに比して時間経過に伴う前縁部での電位推移が緩やかな波形を有する正極性のリセットパルスＲＰ_Y1を全ての行電極Ｙ₁〜Ｙ_nに印加する。尚、リセットパルスＲＰ_Y1のピーク電位は、サスティンパルスのピーク電位よりも高電位である。又、この間、アドレスドライバ５５は、列電極Ｄ₁〜Ｄ_mを接地電位（０ボルト）の状態に設定する。上記リセットパルスＲＰ_Y1の印加に応じて、全ての放電セルＰＣ各々内の行電極Ｙ及び列電極Ｄ間において第１リセット放電が生起される。すなわち、リセット行程Ｒの前半部では、行電極Ｙが陽極側、列電極Ｄが陰極側となるように両電極間に電圧を印加することにより、行電極Ｙから列電極Ｄに向けて電流が流れる放電（以下、列側陰極放電と称する）を上記第１リセット放電として生起させるのである。かかる第１リセット放電に応じて、全ての放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が形成される。

更に、リセット行程Ｒの前半部では、Ｘ電極ドライバ５１が、かかるリセットパルスＲＰ_Y1と同一極性であり、且つ、上記リセットパルスＲＰ_Y1の印加に伴う行電極Ｘ及びＹ間での面放電を防止し得るピーク電位を有するリセットパルスＲＰ_Xを全ての行電極Ｘ₁〜Ｘ_n各々に印加する。

そして、サブフィールドＳＦ１のリセット行程Ｒの後半部では、Ｙ電極ドライバ５３が、時間経過に伴う前縁部での電位推移が緩やかな負極性のリセットパルスＲＰ_Y2を発生し、これを全ての行電極Ｙ₁〜Ｙ_nに印加する。又、リセット行程Ｒの後半部では、Ｘ電極ドライバ５１が、図８に示す如き正極性のピーク電位を有するベースパルスＢＰ⁺を行電極Ｘ₁〜Ｘ_n各々に印加する。これら負極性のリセットパルスＲＰ_Y2及び正極性のベースパルスＢＰ⁺の印加に応じて、全ての放電セルＰＣ内の行電極Ｘ及びＹ間において第２リセット放電が生起される。かかる第２リセット放電により、全放電セルＰＣ内の行電極Ｘ及びＹ各々の近傍に形成されていた壁電荷の大半が消去される。これにより全放電セルＰＣは、行電極Ｘ近傍には負極性の壁電荷、行電極Ｙ近傍には正極性の壁電荷が夫々残留した状態、つまり消灯モードに初期化される。更に、上記リセットパルスＲＰ_Y2の印加に応じて、全放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間においても微弱な放電が生起され、列電極Ｄ近傍に形成されていた正極性の壁電荷の一部が消去される。これにより、全放電セルＰＣの列電極Ｄ近傍に残留する壁電荷量が、後述する選択書込アドレス行程Ｗ_Wにおいて正しく選択書込アドレス放電を生起させることが可能な量に調整される。

尚、リセットパルスＲＰ_Y2及びベースパルスＢＰ⁺によって行電極Ｘ及びＹ間に印加される電圧は、上記第１リセット放電に応じて行電極Ｘ及びＹ各々の近傍に形成された壁電荷を考慮した上で、行電極Ｘ及びＹ間で確実に上記第２リセット放電を生起させることができる電圧である。又、リセットパルスＲＰ_Y2における負のピーク電位は、後述する負極性の書込走査パルスＳＰ_Wのピーク電位よりも高い電位、つまり０ボルトに近い電位に設定されている。すなわち、リセットパルスＲＰ_Y2のピーク電位を書込走査パルスＳＰ_Wのピーク電位よりも低くしてしまうと、行電極Ｙ及び列電極Ｄ間において強い放電が生起され、列電極Ｄ近傍に形成されていた壁電荷が大幅に消去されてしまい、選択書込アドレス行程Ｗ_Wでのアドレス放電が不安定となるからである。

次に、サブフィールドＳＦ１の選択書込アドレス行程Ｗ_Wでは、Ｙ電極ドライバ５３が、図８に示す如き負極性のピーク電位有するベースパルスＢＰ^-を行電極Ｙ₁〜Ｙ_nに同時に印加しつつ、負極性のピーク電位を有する書込走査パルスＳＰ_Wを行電極Ｙ₁〜Ｙ_n各々に順次択一的に印加して行く。Ｘ電極ドライバ５１は、この間、正極性のピーク電位を有するベースパルスＢＰ⁺を行電極Ｘ₁〜Ｘ_nに印加し続ける。この際、ベースパルスＢＰ⁺及びベースパルスＢＰ^-によって行電極Ｘ及びＹ間に印加される電圧は、放電セルＰＣの放電開始電圧よりも低い。

更に、この選択書込アドレス行程Ｗ_Wでは、アドレスドライバ５５が、先ず、サブフィールドＳＦ１に対応した画素駆動データビットをその論理レベルに応じたパルス電圧を有する画素データパルスＤＰに変換する。例えば、アドレスドライバ５５は、放電セルＰＣを点灯モードに設定させるべき論理レベル１の画素駆動データビットが供給された場合にはこれを正極性のピーク電位を有する画素データパルスＤＰに変換する。一方、放電セルＰＣを消灯モードに設定させるべき論理レベル０の画素駆動データビットに対してはこれを低電圧(０ボルト)の画素データパルスＤＰに変換する。そして、アドレスドライバ５５は、かかる画素データパルスＤＰを１表示ライン分(ｍ個)ずつ、各書込走査パルスＳＰ_Wの印加タイミングに同期して列電極Ｄ₁〜Ｄ_mに印加して行く。この際、上記書込走査パルスＳＰ_Wと同時に、点灯モードに設定させるべき高電圧の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には選択書込アドレス放電が生起される。更に、かかる選択書込アドレス放電の直後、この放電セルＰＣ内の行電極Ｘ及びＹ間にも微弱な放電が生起される。つまり、書込走査パルスＳＰ_Wが印加された後、行電極Ｘ及びＹ間には上記ベースパルスＢＰ^-及びベースパルスＢＰ⁺に応じた電圧が印加されるが、この電圧は各放電セルＰＣの放電開始電圧よりも低い電圧に設定されている為、かかる電圧の印加だけでは放電セルＰＣ内で放電が生起されることはない。ところが、上記選択書込アドレス放電が生起されると、この選択書込アドレス放電に誘発されて、ベースパルスＢＰ^-及びベースパルスＢＰ⁺による電圧印加だけで、行電極Ｘ及びＹ間に放電が生起されるのである。かかる放電並びに上記選択書込アドレス放電により、この放電セルＰＣは、その行電極Ｙ近傍に正極性の壁電荷、行電極Ｘ近傍に負極性の壁電荷、列電極Ｄ近傍に負極性の壁電荷が夫々形成された状態、すなわち、点灯モードに設定される。一方、上記書込走査パルスＳＰ_Wと同時に、消灯モードに設定させるべき低電圧（０ボルト）の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には上述した如き選択書込アドレス放電は生起されず、それ故に行電極Ｘ及びＹ間に放電が生じることはない。よって、この放電セルＰＣは、その直前までの状態、すなわち、リセット行程Ｒにおいて初期化された消灯モードの状態を維持する。

次に、サブフィールドＳＦ１のサスティン行程Ｉにおいて、Ｙ電極ドライバ５３は、正極性のピーク電位を有するサスティンパルスＩＰを１パルス分だけ発生しこれを行電極Ｙ₁〜Ｙ_n各々に同時に印加する。この間、Ｘ電極ドライバ５３は、行電極Ｘ₁〜Ｘ_nを接地電位（０ボルト）の状態に設定する。又、サブフィールドＳＦ１のサスティン行程Ｉでは、アドレスドライバ５５が、このサスティンパルスＩＰの前縁部及びピーク電位部の区間に亘り正極性ピーク電位を維持するパルス波形を有する補助パルスＨＰを発生して列電極Ｄ₁〜Ｄ_m各々に印加する。尚、補助パルスＨＰのピーク電位は画素データパルスのピーク電位と同一である。

サブフィールドＳＦ１のサスティン行程Ｉでは、上記サスティンパルスＩＰ及び補助パルスＨＰの印加に応じて、点灯モード状態にある放電セルＰＣ内の行電極Ｘ及びＹ間においてサスティン放電が生起される。かかるサスティン放電に伴って蛍光体層１７から照射される光が前面透明基板１０を介して外部に照射されることにより、このサブフィールドＳＦ１の輝度重みに対応した表示発光が為される。又、かかるサスティンパルスＩＰの印加に応じて、点灯モード状態にある放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間においても放電が生起される。かかる放電並びに上記サスティン放電により、放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、行電極Ｘ及び列電極Ｄ各々の近傍には夫々正極性の壁電荷が形成される。

そして、かかるサスティンパルスＩＰの印加後、Ｙ電極ドライバ５３は、図８に示す如く時間経過に伴う前縁部での電位推移が緩やかな負極性のピーク電位を有する壁電荷調整パルスＣＰを行電極Ｙ₁〜Ｙ_nに印加する。かかる壁電荷調整パルスＣＰの印加に応じて、上記の如きサスティン放電の生起された放電セルＰＣ内で微弱な消去放電が生起され、その内部に形成されていた壁電荷の一部が消去される。これにより、放電セルＰＣ内の壁電荷の量が、次の選択消去アドレス行程Ｗ_Dにおいて正しく選択消去アドレス放電を生起させ得る量に調整される。

次に、サブフィールドＳＦ２〜ＳＦ１４各々の選択消去アドレス行程Ｗ_Oでは、Ｙ電極ドライバ５３が、正極性の所定のピーク電位を有するベースパルスＢＰ⁺を行電極Ｙ₁〜Ｙ_n各々に印加しつつ、図８に示す如き負極性のピーク電位を有する消去走査パルスＳＰ_Dを行電極Ｙ₁〜Ｙ_n各々に順次択一的に印加して行く。尚、ベースパルスＢＰ⁺の電位は、この選択消去アドレス行程Ｗ_Oの実行期間中に亘り、行電極Ｘ及びＹ間での誤った放電を防止し得る電位に設定されている。又、選択消去アドレス行程Ｗ_Oの実行期間中に亘り、Ｘ電極ドライバ５１は、行電極Ｘ₁〜Ｘ_n各々を接地電位（０ボルト）に設定する。又、この選択消去アドレス行程Ｗ_Dにおいて、アドレスドライバ５５は、先ず、そのサブフィールドＳＦに対応した画素駆動データビットをその論理レベルに応じたパルス電圧を有する画素データパルスＤＰに変換する。例えば、アドレスドライバ５５は、放電セルＰＣを点灯モードから消灯モードに遷移させるべき論理レベル１の画素駆動データビットが供給された場合にはこれを正極性のピーク電位を有する画素データパルスＤＰに変換する。一方、放電セルＰＣの現状態を維持させるべき論理レベル０の画素駆動データビットが供給された場合にはこれを低電圧(０ボルト)の画素データパルスＤＰに変換する。そして、アドレスドライバ５５は、かかる画素データパルスＤＰを１表示ライン分(ｍ個)ずつ、各消去走査パルスＳＰ_Dの印加タイミングに同期して列電極Ｄ₁〜Ｄ_mに印加して行く。この際、上記消去走査パルスＳＰ_Dと同時に、高電圧で正極性の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間に選択消去アドレス放電が生起される。かかる選択消去アドレス放電により、この放電セルＰＣは、その行電極Ｙ及びＸ各々の近傍に正極性の壁電荷、列電極Ｄ近傍に負極性の壁電荷が夫々形成された状態、すなわち、消灯モードに設定される。一方、上記消去走査パルスＳＰ_Dと同時に、低電圧（０ボルト）の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には上述した如き選択消去アドレス放電は生起されない。よって、この放電セルＰＣは、その直前までの状態（点灯モード、消灯モード）を維持する。

次に、サブフィールドＳＦ２〜ＳＦ１４各々のサスティン行程Ｉでは、Ｘ電極ドライバ５１及びＹ電極ドライバ５３が、そのサブフィールドの輝度重みに対応した回数（偶数回数）分だけ繰り返し、正極性のピーク電位を有するサスティンパルスＩＰを図８に示す如く行電極Ｘ及びＹ各々に交互に印加する。尚、サブフィールドＳＦ２〜ＳＦ１４各々の内で輝度重みが所定値よりも小なるＳＦの直後のＳＦのサスティン行程Ｉでは、アドレスドライバ５５が、最初に印加されるサスティンパルＩＰと略同時に正極性の補助パルスＨＰを発生し、これを列電極Ｄ₁〜Ｄ_m各々に印加する。例えば、アドレスドライバ５５は、サスティンパルスの印加回数の割当てが１０回以下となるＳＦの直後のＳＦ（図８ではＳＦ２）のサスティン行程Ｉにて、図８に示す如く最初に印加されるサスティンパルＩＰの前縁部及びピーク電位部の区間に亘り正極性ピーク電位を維持する補助パルスＨＰを列電極Ｄに印加する。尚、補助パルスＨＰのピーク電位は画素データパルスのピーク電位と同一である。

サブフィールドＳＦ２〜ＳＦ１４各々のサスティン行程Ｉでは、図８に示す如きサスティンパルスＩＰが印加される度に、点灯モードに設定されている放電セルＰＣ内の行電極Ｘ及びＹ間においてサスティン放電が生起される。この際、かかるサスティン放電に伴って蛍光体層１７から照射される光が前面透明基板１０を介して外部に照射されることにより、そのサブフィールドＳＦの輝度重みに対応した回数分の表示発光が為される。

ここで、サブフィールドＳＦ２〜ＳＦ１４各々のサスティン行程Ｉにおいて、最終のサスティンパルスＩＰに応じてサスティン放電が生起された放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、行電極Ｘ及び列電極Ｄ各々の近傍には正極性の壁電荷が形成される。かかる最終サスティンパルスＩＰの印加後、Ｙ電極ドライバ５３は、図８に示す如く時間経過に伴う前縁部での電位推移が緩やかな負極性のピーク電位を有する壁電荷調整パルスＣＰを行電極Ｙ₁〜Ｙ_nに印加する。かかる壁電荷調整パルスＣＰの印加に応じて、上記の如きサスティン放電の生起された放電セルＰＣ内で微弱な消去放電が生起され、その内部に形成されていた壁電荷の一部が消去される。これにより、放電セルＰＣ内の壁電荷の量が、次の選択消去アドレス行程Ｗ_Dにおいて正しく選択消去アドレス放電を生起させ得る量に調整される。

そして、最終のサブフィールドＳＦ１４の最後尾において、Ｙ電極ドライバ５３は、負極性のピーク電位を有する消去パルスＥＰを全ての行電極Ｙ₁〜Ｙ_nに印加する。かかる消去パルスＥＰの印加に応じて、点灯モード状態にある放電セルＰＣのみに消去放電が生起される。かかる消去放電によって点灯モード状態にあった放電セルＰＣは消灯モードの状態に遷移する。

以上の如き駆動を、図６に示す如き１５通りの画素駆動データＧＤに基づいて実行する。かかる駆動によると、図６に示すように、輝度レベル０を表現する場合（第１階調）を除き、先ず、先頭のサブフィールドＳＦ１において各放電セルＰＣ内で書込アドレス放電が生起され（二重丸にて示す）、この放電セルＰＣは点灯モードに設定される。その後、サブフィールドＳＦ２〜ＳＦ１４各々の内の１のサブフィールドの選択消去アドレス行程Ｗ_Oのみで選択消去アドレス放電が生起され（黒丸にて示す）、その後、放電セルＰＣは消灯モードに設定される。つまり、各放電セルＰＣは、表現すべき中間輝度に対応した分だけ連続したサブフィールド各々で点灯モードに設定され、これらサブフィールドの各々に割り当てられている回数分だけサスティン放電に伴う発光を繰り返し生起する（白丸にて示す）。この際、１フィールド（又は１フレーム）表示期間内において生起されたサスティン放電の総数に対応した輝度が視覚される。よって、図６に示す如き第１〜第１５階調駆動による１５種類の発光パターンによれば、白丸にて示すサブフィールド各々で生起されたサスティン放電の合計回数に対応した１５階調分の中間輝度が表現される。かかる駆動によれば、１フィールド表示期間内において、その発光パターン（点灯状態、消灯状態）が互いに反転する領域が１画面内に混在することは無いので、このような状態で生じる疑似輪郭が防止される。

又、図８に示す如き駆動では、サブフィールドＳＦ２〜ＳＦ１４各々のサスティン行程Ｉにおいて印加すべきサスティンパルスＩＰの回数を偶数としている。よって、各サスティン行程Ｉの終了直後は、行電極Ｙ近傍に負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が形成された状態となるので、各サスティン行程Ｉに引き続き実施される選択消去アドレス行程Ｗ_Dでは、列電極Ｄ及び行電極Ｙ間において列電極Ｄを陽極側とした放電（以降、列側陽極放電と称する）が可能となる。従って、列電極Ｄに対しては正極性のパルスが印加されるだけとなり、アドレスドライバ５５の高コスト化を防げる。

尚、図７及び図８に示す駆動では、先頭サブフィールドＳＦ１にて、先ず全放電セルＰＣをリセット放電させることにより消灯モードに初期化し、黒表示（輝度レベル０）を行う場合を除き、各放電セルＰＣに対して書込アドレス放電を生起させてこれを点灯モードに遷移させるようにしている。この際、かかる駆動によって黒表示を行う場合、１フィールド表示期間を通して生起される放電は、先頭サブフィールドＳＦ１でのリセット放電だけとなる。よって、全放電セルをリセット放電させて点灯モードの状態に初期化してから、これを消灯モード状態に遷移させるべき選択消去アドレス放電を生起させる駆動を採用する場合に比して、１フィールド表示期間内で生起される放電回数が少なくなる。従って、かかる駆動によれば、暗い画像を表示する際のコントラスト、いわゆる暗コントラストを向上させることが可能となる。

又、図７及び図８に示す駆動では、先頭のサブフィールドＳＦ１のリセット行程Ｒにて列電極Ｄを陰極側、行電極Ｙを陽極側とした電圧を両電極間に印加することにより、行電極Ｙから列電極Ｄに向けて電流が流れる列側陰極放電を第１リセット放電として生起させるようにしている。よって、かかる第１リセット放電時には、放電ガス内の陽イオンが列電極Ｄへ向かう際に、図５に示す如き蛍光体層１７内に含まれている二次電子放出材料としてのＭｇＯ結晶体に衝突して、このＭｇＯ結晶体から二次電子を放出させる。特に、図１に示されるプラズマディスプレイ装置のＰＤＰ５０では、ＭｇＯ結晶体を図５に示す如く放電空間に露出させることにより、陽イオンとの衝突の確率を高め、二次電子を効率よく放電空間に放出させるようにしている。すると、かかる二次電子によるプライミング作用により放電セルＰＣの放電開始電圧が低くなるので、比較的弱いリセット放電を生起させることが可能となる。よって、リセット放電の微弱化によりその放電に伴う発光輝度が低下するので、暗コントラストを向上させた表示が可能となる。

又、図８に示される駆動では、上記第１リセット放電を、図３に示す如き前面透明基板１０側に形成されている行電極Ｙ、及び背面基板１４側に形成されている列電極Ｄ間で生起させるようにしている。よって、共に前面透明基板１０側に形成されている行電極Ｘ及びＹ間でリセット放電を生起させる場合に比して、前面透明基板１０側から外部に放出される放電光が少なくなるので、更なる暗コントラストの向上を図ることができる。

又、図８に示される駆動では、輝度重みが最も小なるサブフィールドＳＦ１のサスティン行程Ｉでは、サスティンパルスＩＰを１回だけ印加することにより、サスティン放電の回数を１回だけにして、低輝度画像に対する表示再現性を高めている。尚、この１回分のサスティンパルスＩＰに応じて生起されたサスティン放電の終息後、行電極Ｙ近傍には負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が夫々形成された状態となる。これにより、図８に示される駆動を実施する際には、サブフィールドＳＦ２の選択消去アドレス行程Ｗ_Dにおいて、列側陽極放電を選択消去アドレス放電として生起させることが可能となる。

又、図１に示されるＰＤＰ５０は、各放電セルＰＣ内の前面透明基板１０側に形成されている酸化マグネシウム層１３内のみならず、背面基板１４側に形成されている蛍光体層１７内にも、二次電子放出材料としてのＣＬ発光ＭｇＯ結晶体を含ませるようにしている。

以下に、かかる構成を採用したことによる作用効果について図９及び図１０を参照しつつ説明する。

尚、図９は、上述した如き酸化マグネシウム層１３及び蛍光体層１７各々の内の酸化マグネシウム層１３のみにＣＬ発光ＭｇＯ結晶体を含ませた、いわゆる従来のＰＤＰに図８に示す如きリセットパルスＲＰ_Y1を印加した際に生起される列側陰極放電における放電強度の推移を表す図である。

一方、図１０は、酸化マグネシウム層１３及び蛍光体層１７の双方にＣＬ発光ＭｇＯ結晶体を含ませたＰＤＰ５０に対して、リセットパルスＲＰ_Y1を印加した際に生起される列側陰極放電における放電強度の推移を表す図である。

図９に示されるように、従来のＰＤＰによると、リセットパルスＲＰ_Y1の印加に応じて比較的強い列側陰極放電が１［ｍｓ］以上に亘って継続してしまうが、本実施例によるＰＤＰ５０によると、図１０に示す如く列側陰極放電が約0.04［ｍｓ］以内に終息する。すなわち、従来のＰＤＰに比して列側陰極放電における放電遅れ時間を大幅に短縮できるのである。

従って、図８に示す如き、パルスの前縁部での電位推移が緩やかな波形を有するリセットパルスＲＰ_Y1をＰＤＰ５０の行電極Ｙに印加することによって列側陰極放電を生起させると、リセットパルスＲＰ_Y1の電位がピーク電位に到る前にその放電が終息する。よって、行電極及び列電極間に印加される電圧が低い段階で、列側陰極放電が終息することになるので、図１０に示す如く、その放電強度も大幅に低下する。

すなわち、パルスの前縁部での電位推移が緩やかな波形を有する例えば図８に示す如きリセットパルスＲＰ_Y1を、酸化マグネシウム層１３のみならず蛍光体層１７にもＣＬ発光ＭｇＯ結晶体が含まれているＰＤＰ５０に印加することにより、更に放電強度を弱めた列側陰極放電を生起させるようにしたのである。従って、このように放電強度が極めて弱い列側陰極放電をリセット放電として生起させることができるので、画像のコントラスト、特に暗い画像を表示する際の暗コントラストを高めることが可能となる。

ここで、図８に示す駆動においては、各サブフィールドＳＦの内で輝度重みが小なるＳＦの直後のＳＦのサスティン行程Ｉでは、その先頭部のみで１回だけ、最初に印加されるサスティンパルスＩＰと略同時に、このＩＰと同一極性のピーク電位を有する補助パルスＨＰを全列電極Ｄに印加するようにしている。

図１１は、サスティンパルスＩＰに対する補助パルスＨＰの印加タイミングと、放電が生起されるタイミングとを表す図である。

アドレスドライバ５５は、例えば図１１の（Ａ）に示す如きタイミングにて、補助パルスＨＰを全列電極Ｄに印加する。つまり、サスティンパルスＩＰの印加直前の時点ｔ２から補助パルスＨＰを全列電極Ｄに印加開始する。この際、補助パルスＨＰは、その正極性のピーク電位の状態を、かかる時点ｔ２から、所定マージン期間ＴＰ、サスティンパルスＩＰの前縁部区間Ｔ１及びピーク電位区間Ｔ２に亘り維持する。尚、前縁部区間Ｔ１とは、サスティンパルスＩＰの電位が時点ｔ３において０ボルトの状態から時間経過と共に緩やかに上昇してピーク電位ＶＰに到るまでの区間である。又、ピーク電位区間Ｔ２とは、サスティンパルスＩＰにおいてピーク電位ＶＰの状態が維持されている区間である。すなわち、補助パルスＨＰは、サスティンパルスＩＰの前縁部区間Ｔ１の開始時点としての時点ｔ３よりも所定マージン期間ＴＰ前の時点ｔ２から、サスティンパルスＩＰにおけるピーク電位区間Ｔ２の終了時点までの間に亘り、正極性のピーク電位を維持する。

ここで、サスティンパルスＩＰが行電極（Ｘ又はＹ）に印加されると共に補助パルスＨＰが列電極Ｄに印加されると、先ず、図１１に示す如く、サスティンパルスＩＰの前縁部区間Ｔ１の時点ｔ４にて、点灯モード状態にある放電セルＰＣの行電極Ｘ及びＹ間で第１回目の放電（ｄｃ１）が生起される。この際、かかる放電ｄｃ１に伴って行電極Ｘ及びＹ間に流れる電流により、図１１に示す如くサスティンパルスＩＰの電位が一時的に降下する。ところが、その後の時点ｔ５において、行電極（Ｘ、Ｙ）上の電位はサスティンパルスＩＰのピーク電位ＶＰにクランプされるので、再び、ピーク電位ＶＰに向けてサスティンパルスＩＰの電位が上昇する。その後、図１１に示す如き時点ｔ１にてサスティンパルスＩＰの電位がピーク電位ＶＰに到達すると、上記点灯モード状態にある放電セルＰＣの行電極Ｘ及びＹ間で第２回目の放電（ｄｃ２）が生起される。

このように、サスティンパルスＩＰと共に補助パルスＨＰが印加されると、先ず、このサスティンパルスＩＰの前縁部において第１回目の放電が生起され、引き続きサスティンパルスＩＰの電位がピーク電位に到達した時点で第２回目の放電が生起される。

以下に、図１１に示す如き駆動を実施した場合の作用効果について説明する。

正極性のピーク電位を有するサスティンパルスＩＰが行電極Ｙ（又はＸ）に印加されると、行電極Ｘ及びＹ間と、行電極Ｙ（又はＸ）及び列電極Ｄ間とにおいて夫々電界が生じる。ところが、この間、サスティンパルスＩＰのピーク電位と同一極性のピーク電位を有する補助パルスＨＰを列電極Ｄに印加すると、行電極Ｙ（又はＸ）及び列電極Ｄ間での電界が弱くなる。すると、行電極Ｙ（又はＸ）及び列電極Ｄ間での電界が弱くなった分だけ、行電極Ｘ及びＹ間の電界が強くなり、行電極Ｘ及びＹ間で放電が生起され易くなる。

よって、その直前の段階で放電セルＰＣ内に残留する荷電粒子が少ないが故に放電遅れが生じる場合においても、サスティンパルスＩＰの前縁部区間Ｔ１を必要以上に長くすることなく、図１１に示す如き連続した２回分の放電（ｄｃ１、ｄｃ２）をサスティン放電として生起させることが可能となる。この際、これら２回分の放電に伴って照射される表示光の輝度レベルは全放電セルＰＣにおいてほぼ同一となるので輝度ムラが解消される。

尚、補助パルスＨＰの印加により図１１に示す如き連続した２回分の放電（ｄｃ１、ｄｃ２）が生起されれば良いので、アドレスドライバ５５は、図１１の（Ａ）に代わり図１１の（Ｂ）に示す如きタイミングで、補助パルスＨＰを全列電極Ｄに印加するようにしても良い。つまり、サスティンパルスＩＰの前縁部区間Ｔ１の開始時点ｔ３以降に、第１回目の放電（ｄｃ１）が生起される時点ｔ４及びこの前縁部区間Ｔ１におけるサスティンパルスのピーク電位に到る時点ｔ１を含む期間に亘り正極性のピーク電位の状態を維持する補助パルスＨＰを印加すれば良いのである。

ところで、１フレーム表示期間内で印加される全てのサスティンパルスＩＰ各々と同時に補助パルスＨＰを印加することにより、全サスティン放電を図１１に示す如き２回分の放電（ｄｃ１、ｄｃ２）としてしまうと、消費電力が大になるという問題が生じる。

そこで、低消費電力化をはかるべく、放電遅れが顕著に表れる時点のみで、サスティンパルスＩＰと同時に補助パルスＨＰを印加する。ここで、放電遅れが顕著に表れる時点、つまりサスティン放電に伴って放電セルＰＣ内に形成される荷電粒子の量が少なくなる時点は、
・先頭サブフィールドのサスティン行程の実施時点
・各サブフィールドのサスティン行程の最先頭部の時点
・サスティンパルスの割り当て回数が比較的少ないサブフィールドの直 後のサブフィールドでのサスティン行程の実施時点
である。

この際、図８に示される駆動では、先頭サブフィールドＳＦ１、並びにサスティンパルスの割り当て回数が所定数以下のサブフィールドの直後のサブフィールドのサスティン行程での最先頭部（最初のサスティンパルスＩＰが印加される時点）のみで、サスティンパルスＩＰと同時に補助パルスＨＰを印加している。

よって、図８に示される駆動によれば、消費電力を増大させることなく、低輝度な画像を表示する際の輝度ムラを解消させることが可能となる。

尚、かかる補助パルスＨＰを印加する箇所としては、１フレーム表示期間内の全てのサブフィールド各々のサスティン行程の最先頭部でも良い。或いは、割り当てられているサスティンパルスの印加回数が所定数以下のサブフィールドの直後のサブフィールドのサスティン行程において繰り返し印加されるサスティンパルスＩＰ各々と同時に補助パルスＨＰを印加するようにしても良い。

又、輝度ムラを解消する為に、上記補助パルスＨＰの印加と共に、下記の如きサスティンパルスの波形制御を実行するようにしても良い。

つまり、各サスティン行程Ｉにおいて同時に多数の放電セルＰＣでサスティン放電が生起されると、放電セル各々の放電に伴う電流を合わせた大電流が瞬間的に行電極（Ｘ、Ｙ）に流れ込むことになり、サスティンパルスの波形に歪みが生じる場合がある。よって、各放電セル毎にそのサスティン放電時に印加されるサスティンパルスの電位が一定とはならず、放電に伴う発光時の輝度レベルが不均一となり輝度ムラが視覚されるという問題が生じる。

そこで、サスティン行程の最先頭部で印加されるサスティンパルスＩＰに対して図１１の（Ａ）又は（Ｂ）に示す如きタイミングで補助パルスＨＰを印加すると共に、サスティンパルスＩＰ各々の前縁部区間Ｔ１の長さを、放電セルＰＣ_1,1〜ＰＣ_n,mの内で点灯モードに設定されている放電セルの数に応じて変更するのである。

すなわち、駆動制御回路５６０は、先ず、図６に示す如き画素駆動データＧＤに基づき各サブフィールド毎に、そのサブフィールドで点灯モードの状態に設定される放電セルＰＣの総数を計数する。次に、駆動制御回路５６０は、点灯モード状態にある放電セルＰＣの総数が多いほど、図１１に示す如きサスティンパルスＩＰの前縁部区間Ｔ１の期間を長くすべく、Ｘ電極ドライバ５１及びＹ電極ドライバ５３を制御する。かかる制御によれば、点灯モード状態にある放電セルＰＣの総数が多いほど、サスティンパルスＩＰの前縁部区間Ｔ１の期間、つまり、電位０ボルトの状態からピーク電位ＶＰに到るまでの時間が長くなる。ここで、製造上のバラツキ等により各放電セルの放電開始電圧にはバラツキが生じているので、サスティンパルスＩＰの前縁部区間Ｔ１が長くなるほど、各放電セルの放電タイミングが時間的に分散するようになる。これにより、各放電時点において行電極（Ｘ、Ｙ）に瞬間的に流れる電流量は少なくなり、サスティンパルスの波形歪みが抑制される。その結果、輝度ムラが解消されることになる。

又、図８に示される実施例では、リセットパルスＲＰ_Y1の前縁部での時間経過に伴う電位変化率（傾き）を一定としているが、例えば図１２に示す如く、時間経過に伴い徐々に傾きが変化するような波形であっても良い。

又、図８に示されるリセット行程Ｒでは、全ての画素セルに対して一斉にリセット放電を生起させるようにしているが、夫々が複数の画素セルからなる画素セルブロック毎に、リセット放電を時間的に分散させて実施するようにしても良い。

又、図５に示す実施例においては、ＰＤＰ５０の背面基板１４側に設けられている蛍光体層１７内にＭｇＯ結晶体を含ませるようにしているが、図１３に示す如く、蛍光体粒子からなる蛍光体粒子層１７ａと、二次電子放出材からなる二次電子放出層１８とを積層したもので蛍光体層１７を形成するようにしても良い。この際、二次電子放出層１８としては、蛍光体粒子層１７ａの表面上に、二次電子放出材からなる結晶（例えば、ＣＬ発光ＭｇＯ結晶体を含んだＭｇＯ結晶）を敷き詰めて形成するようにしてもよく、或いは二次電子放出材を薄膜成膜して形成させるようにしても良い。

図１４は、本発明の第２の実施例による駆動方法に従ってプラズマディスプレイパネルを駆動するプラズマディスプレイ装置の概略構成を示す図である。

尚、図１４に示されるプラズマディスプレイ装置のＰＤＰ５０は、図１に示されるプラズマディスプレイ装置のＰＤＰ５０と同一、つまり図２〜図５、図１３に示す如き構造を有するものである。更に、図１４に示されるプラズマディスプレイ装置のＸ電極ドライバ５１、Ｙ電極ドライバ５３、アドレスドライバ５５各々も、図１に示されるものと同一動作を為すものである。ただし、図１４に示されるプラズマディスプレイ装置では、駆動制御回路５６０によって為されるＰＤＰ５０の駆動方法が図１に示されるものとは異なる。

すなわち、図１４に示される駆動制御回路５６０は、各画素毎の８ビットの画素データに対して前述した如き誤差拡散処理及びディザ処理を施して得られた４ビットの多階調化画素データＰＤ_Sを、図１５に示す如きデータ変換テーブルに従って１４ビットの画素駆動データＧＤに変換する。駆動制御回路５６０は、かかる画素駆動データＧＤにおける第１〜第１４ビットを夫々サブフィールドＳＦ１〜ＳＦ１４各々に対応させ、そのサブフィールドＳＦに対応したビット桁を画素駆動データビットとして１表示ライン分（ｍ個）ずつアドレスドライバ５５に供給する。

更に、駆動制御回路５６０は、上記構造を有するＰＤＰ５０を図１６に示す如き発光駆動シーケンスに従って駆動させるべき各種制御信号を、Ｘ電極ドライバ５１、Ｙ電極ドライバ５３、及びアドレスドライバ５５の各々に供給する。すなわち、駆動制御回路５６０は、１フィールド（１フレーム）表示期間内の先頭のサブフィールドＳＦ１では、第１リセット行程Ｒ１、第１選択書込アドレス行程Ｗ１_W及び微小発光行程ＬＬ各々に従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。かかるサブフィールドＳＦ１に後続するＳＦ２では、第２リセット行程Ｒ２、第２選択書込アドレス行程Ｗ２_W及びサスティン行程Ｉ各々に従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。又、サブフィールドＳＦ３〜ＳＦ１４各々では、選択消去アドレス行程Ｗ_D及びサスティン行程Ｉ各々に従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。尚、１フィールド表示期間内の最後尾のサブフィールドＳＦ１４に限り、サスティン行程Ｉの実行後、駆動制御回路５６０は、消去行程Ｅに従った駆動を順次実施させるべき各種制御信号をパネルドライバに供給する。

パネルドライバ、すなわち、Ｘ電極ドライバ５１、Ｙ電極ドライバ５３及びアドレスドライバ５５は、駆動制御回路５６から供給された各種制御信号に応じて、図１７に示す如き各種駆動パルスを生成してＰＤＰ５０の列電極Ｄ、行電極Ｘ及びＹに供給する。

尚、図１７においては、図１６に示されるサブフィールドＳＦ１〜ＳＦ１４の内のＳＦ１〜ＳＦ３、並びに最後尾のサブフィールドＳＦ１４での動作のみを抜粋して示すものである。

先ず、サブフィールドＳＦ１の第１リセット行程Ｒ１の前半部では、Ｙ電極ドライバ５３が、サスティンパルスに比して時間経過に伴う前縁部での電位推移が緩やかな波形を有する正極性のリセットパルスＲＰ１_Y1を全ての行電極Ｙ₁〜Ｙ_nに印加する。尚、図１７に示す如く、リセットパルスＲＰ１_Y1におけるピーク電位は、サスティンパルスのピーク電位よりも高い。又、この間、アドレスドライバ５５は、列電極Ｄ₁〜Ｄ_mを接地電位（０ボルト）の状態に設定する。上記リセットパルスＲＰ１_Y1の印加に応じて、全ての放電セルＰＣ各々内の行電極Ｙ及び列電極Ｄ間において第１リセット放電が生起される。すなわち、第１リセット行程Ｒ１の前半部では、行電極Ｙが陽極側、列電極Ｄが陰極側となるように両電極間に電圧を印加することにより、行電極Ｙから列電極Ｄに向けて電流が流れる放電（以下、列側陰極放電と称する）を上記第１リセット放電として生起させるのである。かかる第１リセット放電に応じて、全ての放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が形成される。

又、第１リセット行程Ｒ１の前半部では、Ｘ電極ドライバ５１が、かかるリセットパルスＲＰ１_Y1と同一極性であり、且つ、このリセットパルスＲＰ１_Y1の印加に伴う行電極Ｘ及びＹ間での面放電を防止し得るピーク電位を有するリセットパルスＲＰ_Xを全ての行電極Ｘ₁〜Ｘ_n各々に印加する。

そして、サブフィールドＳＦ１の第１リセット行程Ｒ１の後半部では、Ｙ電極ドライバ５３が、図１７に示す如く時間経過に伴い緩やかに電位が下降して負極性のピーク電位に到るパルス波形を有するリセットパルスＲＰ１_Y2を発生し、これを全ての行電極Ｙ₁〜Ｙ_nに印加する。この際、かかるリセットパルスＲＰ１_Y2の印加に応じて、全ての放電セルＰＣ内の行電極Ｘ及びＹ間において第２リセット放電が生起される。尚、リセットパルスＲＰ１_Y2のピーク電位は、上記第１リセット放電に応じて行電極Ｘ及びＹ各々の近傍に形成された壁電荷を考慮した上で、行電極Ｘ及びＹ間において確実に上記第２リセット放電を生起させることができる最低の電位である。又、リセットパルスＲＰ１_Y2のピーク電位は、後述する負極性の書込走査パルスＳＰ_Wのピーク電位よりも高い電位、つまり０ボルトに近い電位に設定されている。すなわち、リセットパルスＲＰ１_Y2のピーク電位を書込走査パルスＳＰ_Wのピーク電位よりも低くしてしまうと、行電極Ｙ及び列電極Ｄ間において強い放電が生起され、列電極Ｄ近傍に形成されていた壁電荷が大幅に消去されてしまい、後述する第１選択書込アドレス行程Ｗ１_Wでのアドレス放電が不安定となるからである。第１リセット行程Ｒ１の後半部において生起された第２リセット放電により、各放電セルＰＣ内の行電極Ｘ及びＹ各々の近傍に形成されていた壁電荷が消去され、全ての放電セルＰＣが消灯モードに初期化される。更に、上記リセットパルスＲＰ１_Y2の印加に応じて、全ての放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間においても微弱な放電が生起され、かかる放電により、列電極Ｄ近傍に形成されていた正極性の壁電荷の一部が消去され、第１選択書込アドレス行程Ｗ１_Wにおいて正しく選択書込アドレス放電を生起させ得る量に調整される。

次に、サブフィールドＳＦ１の第１選択書込アドレス行程Ｗ１_Wでは、Ｙ電極ドライバ５３が、図１７に示す如き負極性の所定のピーク電位を有するベースパルスＢＰ^-を行電極Ｙ₁〜Ｙ_nに同時に印加しつつ、負極性のピーク電位を有する書込走査パルスＳＰ_Wを行電極Ｙ₁〜Ｙ_n各々に順次択一的に印加して行く。この間、Ｘ電極ドライバ５１は、０ボルトの電圧を行電極Ｘ₁〜Ｘ_n各々に印加する。更に、第１選択書込アドレス行程Ｗ１_Wでは、アドレスドライバ５５が、先ず、サブフィールドＳＦ１に対応した画素駆動データビットの論理レベルに応じた画素データパルスＤＰを生成する。例えば、アドレスドライバ５５は、放電セルＰＣを点灯モードに設定させるべき論理レベル１の画素駆動データビットが供給された場合には正極性のピーク電位を有する画素データパルスＤＰを生成する。一方、放電セルＰＣを消灯モードに設定させるべき論理レベル０の画素駆動データビットに応じて、低電圧(０ボルト)の画素データパルスＤＰを生成する。そして、アドレスドライバ５５は、かかる画素データパルスＤＰを１表示ライン分(ｍ個)ずつ、各書込走査パルスＳＰ_Wの印加タイミングに同期して列電極Ｄ₁〜Ｄ_mに印加して行く。この際、上記書込走査パルスＳＰ_Wと同時に、点灯モードに設定させるべき高電圧の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には選択書込アドレス放電が生起される。更に、かかる選択書込アドレス放電の直後、この放電セルＰＣ内の行電極Ｘ及びＹ間にも微弱な放電が生起される。つまり、書込走査パルスＳＰ_Wが印加された後、行電極Ｘ及びＹ間にはベースパルスＢＰ^-に応じた電圧が印加されるが、この電圧は各放電セルＰＣの放電開始電圧よりも低い電圧に設定されている為、かかる電圧の印加だけでは放電セルＰＣ内で放電が生起されることはない。ところが、上記選択書込アドレス放電が生起されると、この選択書込アドレス放電に誘発されて、ベースパルスＢＰ^-による電圧印加だけで、行電極Ｘ及びＹ間に放電が生起されるのである。かかる放電並びに上記選択書込アドレス放電により、この放電セルＰＣは、その行電極Ｙ近傍に正極性の壁電荷、行電極Ｘ近傍に負極性の壁電荷、列電極Ｄ近傍に負極性の壁電荷が夫々形成された状態、すなわち、点灯モードに設定される。一方、上記書込走査パルスＳＰ_Wと同時に、消灯モードに設定させるべき低電圧（０ボルト）の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には上述した如き選択書込アドレス放電は生起されず、それ故に行電極Ｘ及びＹ間にも放電が生じることはない。よって、この放電セルＰＣは、その直前までの状態、すなわち、リセット行程Ｒにおいて初期化された消灯モードの状態を維持する。

次に、サブフィールドＳＦ１の微小発光行程ＬＬでは、Ｙ電極ドライバ５３が、図１７に示す如き正極性の所定のピーク電位を有する微小発光パルスＬＰを行電極Ｙ₁〜Ｙ_nに同時に印加する。かかる微小発光パルスＬＰの印加に応じて、点灯モードに設定されている放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間において放電（以下、微小発光放電と称する）が生起される。つまり、微小発光行程ＬＬでは、放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間では放電が生起されるものの、行電極Ｘ及びＹ間には放電が生起させることのない電位を行電極Ｙに印加することにより、点灯モードに設定されている放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間のみで微小発光放電を生起させるのである。この際、微小発光パルスＬＰのピーク電位は、後述するサブフィールドＳＦ２以降のサスティン行程Ｉにて印加するサスティンパルスＩＰのピーク電位よりも低い電位であり、例えば、後述する選択消去アドレス行程Ｗ_Dにおいて行電極Ｙに印加される電位と同一である。又、図１７に示す如く、微小発光パルスＬＰにおける電位の立ち上がり区間での時間経過に伴う変化率は、リセットパルス（ＲＰ１_Y1，ＲＰ２_Y1）における立ち上がり区間での変化率よりも高い。つまり、微小発光パルスＬＰの前縁部における電位推移をリセットパルスの前縁部における電位推移よりも急峻にすることにより、第１リセット行程Ｒ１で生起される第１リセット放電よりも強い放電を生起させるのである。ここで、かかる放電は、前述した如き列側陰極放電であり且つ、サスティンパルスＩＰよりもそのピーク電位が低い微小発光パルスＬＰによって生起された放電である為、行電極Ｘ及びＹ間で生起されるサスティン放電（後述する）よりもその放電に伴う発光輝度が低い。すなわち、微小発光行程ＬＬでは、第１リセット放電よりも高い輝度レベルの発光を伴う放電であるものの、サスティン放電よりもその放電に伴う輝度レベルが低い放電、つまり表示用に利用できる程度の微小な発光を伴う放電を微小発光放電として生起させるのである。この際、微小発光行程ＬＬの直前において実施される第１選択書込アドレス行程Ｗ１_Wでは、放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間で選択書込アドレス放電が生起される。よって、サブフィールドＳＦ１では、かかる選択書込アドレス放電に伴う発光と上記微小発光放電に伴う発光とによって、輝度レベル０よりも１段階だけ高輝度な階調に対応した輝度が表現されるのである。

尚、上記微小発光放電後、行電極Ｙ近傍には負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が夫々形成される。

次に、サブフィールドＳＦ２の第２リセット行程Ｒ２の前半部では、Ｙ電極ドライバ５３が、後述するサスティンパルスに比して時間経過に伴う前縁部での電位推移が緩やかな波形を有する正極性のリセットパルスＲＰ２_Y1を全ての行電極Ｙ₁〜Ｙ_nに印加する。尚、図１７に示す如く、リセットパルスＲＰ２_Y1のピーク電位は、リセットパルスＲＰ１_Y1のピーク電位よりも高い。又、この間、アドレスドライバ５５は、列電極Ｄ₁〜Ｄ_mを接地電位（０ボルト）の状態に設定し、Ｘ電極ドライバ５１は、上記リセットパルスＲＰ２_Y1の印加に伴う行電極Ｘ及びＹ間での面放電を防止し得るピーク電位を有する正極性のリセットパルスＲＰ２_Xを全ての行電極Ｘ₁〜Ｘ_n各々に印加する。尚、行電極Ｘ及びＹ間で面放電が生じないのであれば、Ｘ電極ドライバ５１は、上記リセットパルスＲＰ２_Xを印加する代わりに、全ての行電極Ｘ₁〜Ｘ_nを接地電位（０ボルト）に設定するようにしても良い。上記リセットパルスＲＰ２_Y1の印加に応じて、放電セルＰＣ各々の内で上記微小発光行程ＬＬにて列側陰極放電が生起されなかった放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間において、かかる微小発光行程ＬＬでの列側陰極放電よりも弱い第１リセット放電が生起される。すなわち、第２リセット行程Ｒ２の前半部では、行電極Ｙが陽極側、列電極Ｄが陰極側となるように両電極間に電圧を印加することにより、行電極Ｙから列電極Ｄに向けて電流が流れる列側陰極放電を上記第１リセット放電として生起させるのである。一方、上記微小発光行程ＬＬにおいて既に微小発光放電が生起された放電セルＰＣ内では、上記リセットパルスＲＰ２_Y1の印加が為されても放電は生起されない。従って、第２リセット行程Ｒ２の前半部の終了直後、全ての放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が形成された状態となる。

そして、サブフィールドＳＦ２の第２リセット行程Ｒ２の後半部では、Ｙ電極ドライバ５３が、図１７に示す如く時間経過に伴い緩やかに電位が下降して負極性のピーク電位に到るパルス波形を有するリセットパルスＲＰ２_Y2を行電極Ｙ₁〜Ｙ_nに印加する。更に、第２リセット行程Ｒ２の後半部では、Ｘ電極ドライバ５１が、上記リセットパルスＲＰ２_Y2が行電極Ｙに印加されている間に亘り、正極性のピーク電位を有するベースパルスＢＰ⁺を行電極Ｘ₁〜Ｘ_n各々に印加する。これら負極性のリセットパルスＲＰ２_Y2及び正極性のベースパルスＢＰ⁺の印加に応じて、全ての放電セルＰＣ内の行電極Ｘ及びＹ間において第２リセット放電が生起される。かかる第２リセット放電により、全放電セルＰＣ内の行電極Ｘ及びＹ各々の近傍に形成されていた壁電荷の大半が消去される。これにより全放電セルＰＣは、行電極Ｘ近傍には微量な負極性の壁電荷、行電極Ｙ近傍には微量な正極性の壁電荷が夫々残留した状態、つまり消灯モードに初期化される。更に、上記リセットパルスＲＰ２_Y2の印加に応じて、全放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間においても微弱な放電が生起され、列電極Ｄ近傍に形成されていた正極性の壁電荷の一部が消去される。これにより、全放電セルＰＣの列電極Ｄ近傍に残留する壁電荷量が、第２選択書込アドレス行程Ｗ２_Wにおいて正しく選択書込アドレス放電を生起させることが可能な量に調整される。

尚、リセットパルスＲＰ２_Y2及びベースパルスＢＰ⁺によって行電極Ｘ及びＹ間に印加される電圧は、上記第１リセット放電に応じて行電極Ｘ及びＹ各々の近傍に形成された壁電荷を考慮した上で、行電極Ｘ及びＹ間で確実に上記第２リセット放電を生起させることができる電圧である。又、リセットパルスＲＰ２_Y2における負のピーク電位は、後述する負極性の書込走査パルスＳＰ_Wのピーク電位よりも高い電位、つまり０ボルトに近い電位に設定されている。すなわち、リセットパルスＲＰ２_Y2のピーク電位を書込走査パルスＳＰ_Wのピーク電位よりも低くしてしまうと、行電極Ｙ及び列電極Ｄ間において強い放電が生起され、列電極Ｄ近傍に形成されていた壁電荷が大幅に消去されてしまい、第２選択書込アドレス行程Ｗ２_Wでのアドレス放電が不安定となるからである。

次に、サブフィールドＳＦ２の第２選択書込アドレス行程Ｗ２_Wでは、Ｙ電極ドライバ５３が、図１７に示す如き負極性の所定のピーク電位を有するベースパルスＢＰ^-を行電極Ｙ₁〜Ｙ_nに同時に印加しつつ、負極性のピーク電位を有する書込走査パルスＳＰ_Wを行電極Ｙ₁〜Ｙ_n各々に順次択一的に印加して行く。この間、Ｘ電極ドライバ５１は、正極性のピーク電位を有するベースパルスＢＰ⁺を行電極Ｘ₁〜Ｘ_nに印加し続ける。これらベースパルスＢＰ⁺及びＢＰ^-によって行電極Ｘ及びＹ間に印加される電圧は、放電セルＰＣの放電開始電圧よりも低い。更に、第２選択書込アドレス行程Ｗ２_Wでは、アドレスドライバ５５が、先ず、サブフィールドＳＦ２に対応した画素駆動データビットの論理レベルに応じたピーク電位を有する画素データパルスＤＰを生成する。例えば、アドレスドライバ５５は、放電セルＰＣを点灯モードに設定させるべき論理レベル１の画素駆動データビットが供給された場合には正極性のピーク電位を有する画素データパルスＤＰを生成する。一方、放電セルＰＣを消灯モードに設定させるべき論理レベル０の画素駆動データビットに応じて、低電圧(０ボルト)の画素データパルスＤＰを生成する。そして、アドレスドライバ５５は、かかる画素データパルスＤＰを１表示ライン分(ｍ個)ずつ、各書込走査パルスＳＰ_Wの印加タイミングに同期して列電極Ｄ₁〜Ｄ_mに印加して行く。この際、上記書込走査パルスＳＰ_Wと同時に、点灯モードに設定させるべき高電圧の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には選択書込アドレス放電が生起される。更に、かかる選択書込アドレス放電の直後、この放電セルＰＣ内の行電極Ｘ及びＹ間にも微弱な放電が生起される。つまり、書込走査パルスＳＰ_Wが印加された後、行電極Ｘ及びＹ間には上記ベースパルスＢＰ^-及びＢＰ⁺に応じた電圧が印加されるが、この電圧は各放電セルＰＣの放電開始電圧よりも低い電圧に設定されている為、かかる電圧の印加だけでは放電セルＰＣ内で放電が生起されることはない。ところが、上記選択書込アドレス放電が生起されると、この選択書込アドレス放電に誘発されて、ベースパルスＢＰ^-及びベースパルスＢＰ⁺による電圧印加だけで、行電極Ｘ及びＹ間に放電が生起されるのである。かかる放電並びに上記選択書込アドレス放電により、この放電セルＰＣは、その行電極Ｙ近傍に正極性の壁電荷、行電極Ｘ近傍に負極性の壁電荷、列電極Ｄ近傍に負極性の壁電荷が夫々形成された状態、すなわち、点灯モードに設定される。一方、上記書込走査パルスＳＰ_Wと同時に、消灯モードに設定させるべき低電圧（０ボルト）の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には上述した如き選択書込アドレス放電は生起されず、それ故に行電極Ｘ及びＹ間にでの放電も生じることはない。よって、この放電セルＰＣは、その直前までの状態、すなわち、第２リセット行程Ｒ２において初期化された消灯モードの状態を維持する。

次に、サブフィールドＳＦ２のサスティン行程Ｉでは、Ｙ電極ドライバ５３が、正極性のピーク電位を有するサスティンパルスＩＰを１パルス分だけ発生しこれを行電極Ｙ₁〜Ｙ_n各々に同時に印加する。この間、Ｘ電極ドライバ５３は、行電極Ｘ₁〜Ｘ_nを接地電位（０ボルト）の状態に設定する。又、サブフィールドＳＦ２のサスティン行程Ｉでは、アドレスドライバ５５が、このサスティンパルスＩＰの前縁部及びピーク電位部の区間に亘り正極性ピーク電位を維持するパルス波形を有する補助パルスＨＰを発生して列電極Ｄ₁〜Ｄ_m各々に印加する。尚、補助パルスＨＰのピーク電位は画素データパルスのピーク電位と同一である。

サブフィールドＳＦ２のサスティン行程Ｉでは、上記サスティンパルスＩＰ及び補助パルスＨＰの印加に応じて、点灯モード状態にある放電セルＰＣ内の行電極Ｘ及びＹ間においてサスティン放電が生起される。かかるサスティン放電に伴って蛍光体層１７から照射される光が前面透明基板１０を介して外部に照射されることにより、このサブフィールドＳＦ１の輝度重みに対応した表示発光が為される。又、かかるサスティンパルスＩＰの印加に応じて、点灯モード状態にある放電セルＰＣ内の行電極Ｙ及び列電極Ｄ間においても放電が生起される。かかる放電並びに上記サスティン放電により、放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、行電極Ｘ及び列電極Ｄ各々の近傍には夫々正極性の壁電荷が形成される。

そして、かかるサスティンパルスＩＰの印加後、Ｙ電極ドライバ５３は、図１７に示す如く時間経過に伴う前縁部での電位推移が緩やかな負極性のピーク電位を有する壁電荷調整パルスＣＰを行電極Ｙ₁〜Ｙ_nに印加する。かかる壁電荷調整パルスＣＰの印加に応じて、上記の如きサスティン放電の生起された放電セルＰＣ内で微弱な消去放電が生起され、その内部に形成されていた壁電荷の一部が消去される。これにより、放電セルＰＣ内の壁電荷の量が、次の選択消去アドレス行程Ｗ_Dにおいて正しく選択消去アドレス放電を生起させ得る量に調整される。

次に、サブフィールドＳＦ３〜ＳＦ１４各々の選択消去アドレス行程Ｗ_Oでは、Ｙ電極ドライバ５３が、正極性の所定のピーク電位を有するベースパルスＢＰ⁺を行電極Ｙ₁〜Ｙ_n各々に印加しつつ、図１７に示す如き負極性のピーク電位を有する消去走査パルスＳＰ_Dを行電極Ｙ₁〜Ｙ_n各々に順次択一的に印加して行く。尚、ベースパルスＢＰ⁺の電位は、この選択消去アドレス行程Ｗ_Oの実行期間中に亘り、行電極Ｘ及びＹ間での誤った放電を防止し得る電位に設定されている。又、選択消去アドレス行程Ｗ_Oの実行期間中に亘り、Ｘ電極ドライバ５１は、行電極Ｘ₁〜Ｘ_n各々を接地電位（０ボルト）に設定する。又、この選択消去アドレス行程Ｗ_Dにおいて、アドレスドライバ５５は、先ず、そのサブフィールドＳＦに対応した画素駆動データビットをその論理レベルに応じたパルス電圧を有する画素データパルスＤＰに変換する。例えば、アドレスドライバ５５は、放電セルＰＣを点灯モードから消灯モードに遷移させるべき論理レベル１の画素駆動データビットが供給された場合にはこれを正極性のピーク電位を有する画素データパルスＤＰに変換する。一方、放電セルＰＣの現状態を維持させるべき論理レベル０の画素駆動データビットが供給された場合にはこれを低電圧(０ボルト)の画素データパルスＤＰに変換する。そして、アドレスドライバ５５は、かかる画素データパルスＤＰを１表示ライン分(ｍ個)ずつ、各消去走査パルスＳＰ_Dの印加タイミングに同期して列電極Ｄ₁〜Ｄ_mに印加して行く。この際、上記消去走査パルスＳＰ_Dと同時に、高電圧で正極性の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間に選択消去アドレス放電が生起される。かかる選択消去アドレス放電により、この放電セルＰＣは、その行電極Ｙ及びＸ各々の近傍に正極性の壁電荷、列電極Ｄ近傍に負極性の壁電荷が夫々形成された状態、すなわち、消灯モードに設定される。一方、上記消去走査パルスＳＰ_Dと同時に、低電圧（０ボルト）の画素データパルスＤＰが印加された放電セルＰＣ内の列電極Ｄ及び行電極Ｙ間には上述した如き選択消去アドレス放電は生起されない。よって、この放電セルＰＣは、その直前までの状態（点灯モード、消灯モード）を維持する。

次に、サブフィールドＳＦ３〜ＳＦ１４各々のサスティン行程Ｉでは、Ｘ電極ドライバ５１及びＹ電極ドライバ５３が、そのサブフィールドの輝度重みに対応した回数（偶数回数）分だけ繰り返し、正極性のピーク電位を有するサスティンパルスＩＰを図１７に示す如く行電極Ｘ及びＹ各々に交互に印加する。尚、サブフィールドＳＦ３〜ＳＦ１４各々の内で輝度重みが所定値よりも小なるＳＦの直後のＳＦのサスティン行程Ｉでは、アドレスドライバ５５が、最初に印加されるサスティンパルＩＰと略同時に正極性の補助パルスＨＰを発生し、これを列電極Ｄ₁〜Ｄ_m各々に印加する。例えば、アドレスドライバ５５は、サスティンパルスの印加回数の割当てが１０回以下となるＳＦの直後のＳＦ（図１７ではＳＦ３）のサスティン行程Ｉにて、図１７に示す如く最初に印加されるサスティンパルＩＰの前縁部及びピーク電位部の区間に亘り正極性ピーク電位を維持する補助パルスＨＰを列電極Ｄに印加する。尚、補助パルスＨＰのピーク電位は画素データパルスのピーク電位と同一である。

サブフィールドＳＦ３〜ＳＦ１４各々のサスティン行程Ｉでは、図１７に示す如きサスティンパルスＩＰが印加される度に、点灯モードに設定されている放電セルＰＣ内の行電極Ｘ及びＹ間においてサスティン放電が生起される。この際、かかるサスティン放電に伴って蛍光体層１７から照射される光が前面透明基板１０を介して外部に照射されることにより、そのサブフィールドＳＦの輝度重みに対応した回数分の表示発光が為される。

ここで、サブフィールドＳＦ３〜ＳＦ１４各々のサスティン行程Ｉにおいて、最終のサスティンパルスＩＰに応じてサスティン放電が生起された放電セルＰＣ内の行電極Ｙ近傍には負極性の壁電荷、行電極Ｘ及び列電極Ｄ各々の近傍には正極性の壁電荷が形成される。かかる最終サスティンパルスＩＰの印加後、Ｙ電極ドライバ５３は、図１７に示す如く時間経過に伴う前縁部での電位推移が緩やかな負極性のピーク電位を有する壁電荷調整パルスＣＰを行電極Ｙ₁〜Ｙ_nに印加する。かかる壁電荷調整パルスＣＰの印加に応じて、上記の如きサスティン放電の生起された放電セルＰＣ内で微弱な消去放電が生起され、その内部に形成されていた壁電荷の一部が消去される。これにより、放電セルＰＣ内の壁電荷の量が、次の選択消去アドレス行程Ｗ_Dにおいて正しく選択消去アドレス放電を生起させ得る量に調整される。

そして、最終のサブフィールドＳＦ１４の最後尾において、Ｙ電極ドライバ５３は、負極性のピーク電位を有する消去パルスＥＰを全ての行電極Ｙ₁〜Ｙ_nに印加する。かかる消去パルスＥＰの印加に応じて、点灯モード状態にある放電セルＰＣのみに消去放電が生起される。かかる消去放電によって点灯モード状態にあった放電セルＰＣは消灯モードの状態に遷移する。

以上の如き駆動を、図１５に示す如き１６通りの画素駆動データＧＤに基づいて実行する。

先ず、黒表示（輝度レベル０）を表現する第１階調よりも１段階だけ高輝度を表す第２階調では、図１５に示す如く、サブフィールドＳＦ１〜ＳＦ１４の内のＳＦ１のみで放電セルＰＣを点灯モードに設定させる為の選択書込アドレス放電を生起させ、この点灯モードに設定された放電セルＰＣを微小発光放電させる（□にて示す）。この際、これら選択書込アドレス放電及び微小発光放電に伴う発光時の輝度レベルは、１回分のサスティン放電に伴う発光時の輝度レベルよりも低い。よって、サスティン放電によって視覚される輝度レベルを「１」とした場合、第２階調では、輝度レベル「１」よりも低い輝度レベル「α」に対応した輝度が表現される。

次に、かかる第２階調よりも１段階だけ高輝度を表す第３階調では、サブフィールドＳＦ１〜ＳＦ１４の内のＳＦ２のみで放電セルＰＣを点灯モードに設定させる為の選択書込アドレス放電を生起させ（二重丸にて示す）、次のサブフィールドＳＦ３で放電セルＰＣを消灯モードに遷移させる為の選択消去アドレス放電を生起させる（黒丸にて示す）。よって、第３階調では、サブフィールドＳＦ１〜ＳＦ１４の内のＳＦ２のサスティン行程Ｉのみで１回分のサスティン放電に伴う発光が為され、輝度レベル「１」に対応した輝度が表現される。

次に、かかる第３階調よりも１段階だけ高輝度を表す第４階調では、先ず、サブフィールドＳＦ１において、放電セルＰＣを点灯モードに設定させる為の選択書込アドレス放電を生起させ、この点灯モードに設定された放電セルＰＣを微小発光放電させる（□にて示す）。更に、かかる第４階調では、サブフィールドＳＦ１〜ＳＦ１４の内のＳＦ２のみで放電セルＰＣを点灯モードに設定させる為の選択書込アドレス放電を生起させ（二重丸にて示す）、次のサブフィールドＳＦ３で放電セルＰＣを消灯モードに遷移させる為の選択消去アドレス放電を生起させる（黒丸にて示す）。よって、第４階調では、サブフィールドＳＦ１にて輝度レベル「α」の発光が為され、ＳＦ２にて輝度レベル「１」の発光を伴うサスティン放電が１回分だけ実施されるので、輝度レベル「α」＋「１」に対応した輝度が表現される。

又、第５階調〜第１６階調各々では、サブフィールドＳＦ１において放電セルＰＣを点灯モードに設定させる選択書込アドレス放電を生起させ、この点灯モードに設定された放電セルＰＣを微小発光放電させる（□にて示す）。そして、その階調に対応した１のサブフィールドのみで放電セルＰＣを消灯モードに遷移させる為の選択消去アドレス放電を生起させる（黒丸にて示す）。よって、第５階調〜第１６階調各々では、サブフィールドＳＦ１にて上記微小発光放電が生起され、ＳＦ２にて１回分のサスティン放電を生起された後、その階調に対応した数だけ連続したサブフィールド各々（白丸にて示す）でそのサブフィールドに割り当てられている回数分だけサスティン放電が生起される。これにより、第５階調〜第１６階調各々では、輝度レベル「α」＋「１フィールド（又は１フレーム）表示期間内において生起されたサスティン放電の総数」に対応した輝度が視覚される。従って、図１５〜図１７に示される駆動によれば、輝度レベル「０」〜「２５５＋α」なる輝度範囲を図１５に示す如き１６段階にて表すことが可能となるのである。

この際、図１５〜図１７に示される駆動では、最も輝度重みが小なるサブフィールドＳＦ１において表示画像に寄与する放電として、サスティン放電ではなく微小発光放電を生起させるようにしている。かかる微小発光放電は、列電極Ｄ及び行電極Ｙ間で生起される放電である為、行電極Ｘ及びＹ間で生起されるサスティン放電に比べてその放電に伴う発光時の輝度レベルが低い。よって、かかる微小発光放電によって黒表示（輝度レベル０）よりも１段階だけ高輝度を表す（第２階調）場合には、サスティン放電によってこれを表す場合に比して輝度レベル０との輝度差が小となる。従って、低輝度画像を表現する際の階調表現能力が高まる。又、第２階調においては、サブフィールドＳＦ１に後続するＳＦ２の第２リセット行程Ｒ２ではリセット放電が生起されないので、このリセット放電に伴う暗コントラストの低下が抑制される。尚、図１５に示される駆動では、第４階調以降の各階調においてもサブフィールドＳＦ１において輝度レベルαの発光を伴う微小発光放電を生起させるようにしているが、第３階調以降の階調では、この微小発光放電を生起させないようにしても良い。要するに、微小発光放電に伴う発光は極めて低輝度（輝度レベルα）である為、これよりも高輝度な発光を伴うサスティン放電との併用が為される第４階調以降の階調では、輝度レベルαの輝度増加分を視覚することができなくなる場合があり、この際、微小発光放電を生起させる意義がなくなるからである。

ここで、図１７に示される駆動では、先頭のサブフィールドＳＦ１の第１リセット行程Ｒ１において、列電極Ｄを陰極側、行電極Ｙを陽極側とした電圧を両電極間に印加することにより、行電極Ｙから列電極Ｄに向けて電流が流れる列側陰極放電を第１リセット放電として生起させるようにしている。よって、かかる第１リセット放電時には、放電ガス内の陽イオンが列電極Ｄへ向かう際に、図５に示す如き蛍光体層１７内に含まれている二次電子放出材料としてのＭｇＯ結晶体に衝突して、このＭｇＯ結晶体から二次電子を放出させる。特に、ＰＤＰ５０では、ＭｇＯ結晶体を図５に示す如く放電空間に露出させることにより、陽イオンとの衝突の確率を高め、二次電子を効率よく放電空間に放出させるようにしている。すると、かかる二次電子によるプライミング作用により放電セルＰＣの放電開始電圧が低くなるので、比較的弱いリセット放電を生起させることが可能となる。よって、リセット放電の微弱化によりその放電に伴う発光輝度が低下するので、暗コントラストを向上させた表示が可能となる。

又、図１７に示される駆動では、図３に示す如き前面透明基板１０側に形成されている行電極Ｙ、及び背面基板１４側に形成されている列電極Ｄ間でリセット放電を生起させている。よって、共に前面透明基板１０側に形成されている行電極Ｘ及びＹ間でリセット放電を生起させる場合に比して、前面透明基板１０側から外部に放出される放電光が少なくなるので、更なる暗コントラストの向上を図ることができる。

又、プラズマディスプレイパネルとしてのＰＤＰ５０には、各放電セルＰＣ内の前面透明基板１０側に形成されている酸化マグネシウム層１３内のみならず、背面基板１４側に形成されている蛍光体層１７内にも、図５又は図１３に示す如く、二次電子放出材料としてＣＬ発光ＭｇＯ結晶体を含ませるようにしている。

よって、酸化マグネシウム層１３のみにＣＬ発光ＭｇＯ結晶体を含ませた放電セルでの列側陰極放電（図９に示す）に比して、弱い放電を短期間内に終息させることが可能となる（図１０に示す）。従って、放電強度が極めて弱い列側陰極放電をリセット放電として生起させることができるので、画像のコントラスト、特に暗い画像を表示する際の暗コントラストを高めることが可能となる。

又、図１７に示される駆動では、サブフィールドＳＦ２のサスティン行程Ｉでは、サスティンパルスＩＰを１回だけ印加することにより、サスティン放電の回数を１回だけにして、低輝度画像に対する表示再現性を高めている。尚、この１回分のサスティンパルスＩＰに応じて生起されたサスティン放電の終息後、行電極Ｙ近傍には負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が夫々形成された状態となる。これにより、図１７に示すように、サブフィールドＳＦ３の選択消去アドレス行程Ｗ_Dにおいて、列側陽極放電を選択消去アドレス放電として生起させることが可能となる。この際、図１７に示される駆動では、サブフィールドＳＦ３〜ＳＦ１４各々のサスティン行程Ｉでは、サスティンパルスＩＰの印加回数を偶数としている。よって、各サスティン行程Ｉの終了直後は、行電極Ｙ近傍に負極性の壁電荷、列電極Ｄ近傍には正極性の壁電荷が形成された状態となるので、各サスティン行程Ｉに引き続き実施される選択消去アドレス行程Ｗ_Dでは、列側陽極放電が可能となる。従って、列電極Ｄに対しては正極性のパルスが印加されるだけとなり、アドレスドライバ５５の高コスト化を防げる。

ここで、図１７に示す駆動においては、各サブフィールドＳＦの内で輝度重みが小なるＳＦの直後のＳＦのサスティン行程Ｉでは、その先頭部のみで１回だけ、最初に印加されるサスティンパルスＩＰと略同時に、補助パルスＨＰを全列電極Ｄに印加するようにしている。

すなわち、アドレスドライバ５５は、例えば図１１の（Ａ）に示す如きタイミングにて、補助パルスＨＰを全列電極Ｄに印加する。つまり、サスティンパルスＩＰの印加直前の時点ｔ２から補助パルスＨＰを全列電極Ｄに印加開始する。この際、補助パルスＨＰは、その正極性のピーク電位の状態を、かかる時点ｔ２から、所定マージン期間ＴＰ、サスティンパルスＩＰの前縁部区間Ｔ１及びピーク電位区間Ｔ２に亘り維持する。尚、前縁部区間Ｔ１とは、サスティンパルスＩＰの電位が時点ｔ３において０ボルトの状態から時間経過と共に緩やかに上昇してピーク電位ＶＰに到るまでの区間である。又、ピーク電位区間Ｔ２とは、サスティンパルスＩＰにおいてピーク電位ＶＰの状態が維持されている区間である。すなわち、補助パルスＨＰは、サスティンパルスＩＰの前縁部区間Ｔ１の開始時点としての時点ｔ３よりも所定マージン期間ＴＰ前の時点ｔ２から、サスティンパルスＩＰにおけるピーク電位区間Ｔ２の終了時点までの間に亘り、正極性のピーク電位を維持する。

ここで、サスティンパルスＩＰが行電極（Ｘ又はＹ）に印加されると共に補助パルスＨＰが列電極Ｄに印加されると、先ず、図１１に示す如く、サスティンパルスＩＰの前縁部区間Ｔ１の時点ｔ４にて、点灯モード状態にある放電セルＰＣの行電極Ｘ及びＹ間で第１回目の放電（ｄｃ１）が生起される。この際、かかる放電ｄｃ１に伴って行電極Ｘ及びＹ間に流れる電流により、図１１に示す如くサスティンパルスＩＰの電位が一時的に降下する。ところが、その後の時点ｔ５において、行電極（Ｘ、Ｙ）上の電位はサスティンパルスＩＰのピーク電位ＶＰにクランプされるので、再び、ピーク電位ＶＰに向けてサスティンパルスＩＰの電位が上昇する。その後、図１１に示す如き時点ｔ１にてサスティンパルスＩＰの電位がピーク電位ＶＰに到達すると、上記点灯モード状態にある放電セルＰＣの行電極Ｘ及びＹ間で第２回目の放電（ｄｃ２）が生起される。

このように、サスティンパルスＩＰと共に補助パルスＨＰが印加されると、先ず、このサスティンパルスＩＰの前縁部において第１回目の放電が生起され、引き続きサスティンパルスＩＰの電位がピーク電位に到達した時点で第２回目の放電が生起される。

以下に、図１１に示す如き駆動を実施した場合の作用効果について説明する。

正極性のピーク電位を有するサスティンパルスＩＰが行電極Ｙ（又はＸ）に印加されると、行電極Ｘ及びＹ間と、行電極Ｙ（又はＸ）及び列電極Ｄ間とにおいて夫々電界が生じる。ところが、この間、サスティンパルスＩＰのピーク電位と同一極性のピーク電位を有する補助パルスＨＰを列電極Ｄに印加すると、行電極Ｙ（又はＸ）及び列電極Ｄ間での電界が弱くなる。すると、行電極Ｙ（又はＸ）及び列電極Ｄ間での電界が弱くなった分だけ、行電極Ｘ及びＹ間の電界が強くなり、行電極Ｘ及びＹ間で放電が生起され易くなる。

よって、その直前の段階で放電セルＰＣ内に残留する荷電粒子が少ないが故に放電遅れが生じる場合においても、サスティンパルスＩＰの前縁部区間Ｔ１を必要以上に長くすることなく、図１１に示す如き連続した２回分の放電（ｄｃ１、ｄｃ２）をサスティン放電として生起させることが可能となる。この際、これら２回分の放電に伴って照射される表示光の輝度レベルは全放電セルＰＣにおいてほぼ同一となるので輝度ムラが解消される。

尚、補助パルスＨＰの印加により図１１に示す如き連続した２回分の放電（ｄｃ１、ｄｃ２）が生起されれば良いので、アドレスドライバ５５は、図１１の（Ａ）に代わり図１１の（Ｂ）に示す如きタイミングで、補助パルスＨＰを全列電極Ｄに印加するようにしても良い。つまり、サスティンパルスＩＰの前縁部区間Ｔ１の開始時点ｔ３以降に、第１回目の放電（ｄｃ１）が生起される時点ｔ４及びこの前縁部区間Ｔ１におけるサスティンパルスのピーク電位に到る時点ｔ１を含む期間に亘り正極性のピーク電位の状態を維持する補助パルスＨＰを印加すれば良いのである。

ところで、１フレーム表示期間内で印加される全てのサスティンパルスＩＰ各々と同時に補助パルスＨＰを印加することにより、全サスティン放電を図１１に示す如き２回分の放電（ｄｃ１、ｄｃ２）としてしまうと、消費電力が大になるという問題が生じる。

そこで、低消費電力化をはかるべく、放電遅れが顕著に表れる時点のみで、サスティンパルスＩＰと同時に補助パルスＨＰを印加する。ここで、放電遅れが顕著に表れる時点、つまりサスティン放電に伴って放電セルＰＣ内に形成される荷電粒子の量が少なくなる時点は、
・先頭サブフィールドのサスティン行程の実施時点
・各サブフィールドのサスティン行程の最先頭部の時点
・サスティンパルスの割り当て回数が比較的少ないサブフィールドの直 後のサブフィールドでのサスティン行程の実施時点
である。

この際、図１７に示される駆動では、サスティンパルスの割り当て回数が所定数以下のサブフィールドの直後のサブフィールドのサスティン行程での最先頭部（最初のサスティンパルスＩＰが印加される時点）のみで、サスティンパルスＩＰと同時に補助パルスＨＰを印加している。

よって、図１７に示される駆動によれば、消費電力を増大させることなく、低輝度な画像を表示する際の輝度ムラを解消させることが可能となる。

尚、かかる補助パルスＨＰを印加する箇所としては、１フレーム表示期間内の全てのサブフィールド各々のサスティン行程の最先頭部でも良い。或いは、割り当てられているサスティンパルスの印加回数が所定数以下のサブフィールドの直後のサブフィールドのサスティン行程において繰り返し印加されるサスティンパルスＩＰ各々と同時に補助パルスＨＰを印加するようにしても良い。

又、輝度ムラを解消する為に、上記補助パルスＨＰの印加と共に、下記の如きサスティンパルスの波形制御を実行するようにしても良い。

つまり、各サスティン行程Ｉにおいて同時に多数の放電セルＰＣでサスティン放電が生起されると、放電セル各々の放電に伴う電流を合わせた大電流が瞬間的に行電極（Ｘ、Ｙ）に流れ込むことになり、サスティンパルスの波形に歪みが生じる場合がある。よって、各放電セル毎にそのサスティン放電時に印加されるサスティンパルスの電位が一定とはならず、放電に伴う発光時の輝度レベルが不均一となり輝度ムラが視覚されるという問題が生じる。

そこで、サスティン行程の最先頭部で印加されるサスティンパルスＩＰに対して図１１に示す如きタイミングで補助パルスＨＰを印加すると共に、サスティンパルスＩＰ各々の前縁部区間Ｔ１の長さを、放電セルＰＣ_1,1〜ＰＣ_n,mの内で点灯モードに設定されている放電セルの数に応じて変更するのである。

すなわち、駆動制御回路５６０は、先ず、図１５に示す如き画素駆動データＧＤに基づき各サブフィールド毎に、そのサブフィールドで点灯モードの状態に設定される放電セルＰＣの総数を計数する。次に、駆動制御回路５６０は、点灯モード状態にある放電セルＰＣの総数が多いほど、図１１に示す如きサスティンパルスＩＰの前縁部区間Ｔ１の期間を長くすべく、Ｘ電極ドライバ５１及びＹ電極ドライバ５３を制御する。かかる制御によれば、点灯モード状態にある放電セルＰＣの総数が多いほど、サスティンパルスＩＰの前縁部区間Ｔ１の期間、つまり、電位０ボルトの状態からピーク電位ＶＰに到るまでの時間が長くなる。ここで、製造上のバラツキ等により各放電セルの放電開始電圧にはバラツキが生じているので、サスティンパルスＩＰの前縁部区間Ｔ１が長くなるほど、各放電セルの放電タイミングが時間的に分散するようになる。これにより、各放電時点において行電極（Ｘ、Ｙ）に瞬間的に流れる電流量は少なくなり、サスティンパルスの波形歪みが抑制される。その結果、輝度ムラが解消されることになる。

又、図１７に示される実施例では、リセットパルスＲＰ１_Y1（ＲＰ２_Y1）の前縁部での時間経過に伴う電位変化率（傾き）を一定としているが、例えば図１２に示す如く、時間経過に伴い徐々に傾きが変化するような波形であっても良い。

又、図１７に示される第１リセット行程Ｒ１及び第２リセット行程Ｒ２では、全ての画素セルに対して一斉にリセット放電を生起させるようにしているが、夫々が複数の画素セルからなる画素セルブロック毎に、リセット放電を時間的に分散させて実施するようにしても良い。

又、図１７に示される第１リセット行程Ｒ１では、その前半部においてリセットパルスＲＰ１_Y1を行電極Ｙ₁〜Ｙ_nへ印加することにより列側陰極放電として、第１リセット放電を生起させるようにしているが、これを省略しても良い。

例えば、図１８に示す如く、第１リセット行程Ｒ１の前半部では行電極Ｙ₁〜Ｙ_nを接地電位に固定する。

すなわち、第１リセット行程Ｒ１の前半部における、行電極Ｙから列電極Ｄへの列側陰極放電の目的は、第１選択書込アドレス行程Ｗ１_Wでの書込放電を安定化させる為の荷電粒子を放出されることになる。しかしながら、例えば図５や図１３に記載の様なＣＬ発光ＭｇＯ結晶を含むＭｇＯ結晶体を蛍光体層内に含ませる構成を採用した場合には、このような構成を採用しない場合に比べて書込放電が安定化する。従って、第１リセット行程Ｒ１の前半部では行電極Ｙ及び列電極Ｄ共に接地電位として列側陰極放電を生起させない構成を採用することが可能となる。この場合には行電極Ｘについても図１８の如く接地電位レベルとする。なお、この場合にも、第１リセット行程Ｒ１の終了後、その直前のフィールドの消去行程Ｅでの消去パルスＥＰによる放電及びリセットパルスＲＰ１_Y2の印加による放電によって全放電セルは消灯モード状態になる。この際、図１８に示される第２リセット行程Ｒ２の前半部におけるリセットパルスＲＰ２_Y1の印加による列側陰極放電に関しては、このリセット放電によって放出される荷電粒子は主に第２選択書込アドレス行程Ｗ２_Wでの書込放電を安定化させる為に作用する。よって、第２リセット行程Ｒ２の前半部においてリセットパルスＲＰ２_Y1の印加による列側陰極放電を省略すると、第２選択書込アドレス行程Ｗ２_Wで書込ミスが発生した場合には、サブフィールドＳＦ２以降の全サブフィールドにおいてサスティン放電を生起させることができなくなる。そこで、第２リセット行程Ｒ２の前半部については、リセットパルスＲＰ２_Y1の印加による列側陰極放電を実施する方が好ましい。

本発明の第１の実施例による駆動方法に従ってプラズマディスプレイパネルを駆動するプラズマディスプレイ装置の概略構成を示す図である。 表示面側から眺めたＰＤＰ５０の内部構造を模式的に示す正面図である。 図２に示されるＶ−Ｖ線上での断面を示す図である。 図２に示されるＷ−Ｗ線上での断面を示す図である。 蛍光体層１７内に含まれるＭｇＯ結晶体を模式的に表す図である。 図１に示されるプラズマディスプレイ装置における各階調毎の発光パターンの一例を示す図である。 図１に示されるプラズマディスプレイ装置において採用される発光駆動シーケンスの一例を示す図である。 図７に示される発光駆動シーケンスに従ってＰＤＰ５０に印加される各種駆動パルスを示す図である。 酸化マグネシウム層１３のみにＣＬ発光ＭｇＯ結晶体を含ませた従来のＰＤＰに対してリセットパルスＲＰ_Y1を印加した際に生起される列側陰極放電における放電強度の推移を表す図である。 酸化マグネシウム層１３及び蛍光体層１７の双方にＣＬ発光ＭｇＯ結晶体を含ませたＰＤＰ５０に対してリセットパルスＲＰ_Y1を印加した際に生起される列側陰極放電における放電強度の推移を表す図である。 サスティンパルスＩＰに対する補助パルスＨＰの印加タイミングと、放電が生起されるタイミングとを表す図である。 リセットパルスＲＰの他の波形を表す図である。 蛍光体粒子層１７ａの表面に二次電子放出層１８を積層して蛍光体層１７を構築させた場合の形態を模式的に表す図である。 本発明の第２の実施例による駆動方法に従ってプラズマディスプレイパネルを駆動するプラズマディスプレイ装置の概略構成を示す図である。 図１４に示されるプラズマディスプレイ装置における各階調毎の発光パターンの一例を示す図である。 図１４に示されるプラズマディスプレイ装置において採用される発光駆動シーケンスの一例を示す図である。 図１６に示される発光駆動シーケンスに従ってＰＤＰ５０に印加される各種駆動パルスを示す図である。 図１６に示される発光駆動シーケンスに従ってＰＤＰ５０に印加される各種駆動パルスの一例を示す図である。

符号の説明

１３ 酸化マグネシウム層
１７ 蛍光体層
５０ ＰＤＰ
５１ Ｘ電極ドライバ
５３ Ｙ電極ドライバ
５５ アドレスドライバ
５６，５６０ 駆動制御回路

Claims (20)

1. 放電ガスが封入された放電空間を挟んで前面基板及び背面基板が対向配置されており、前記前面基板及び前記背面基板間に配置されている複数の行電極対と当該行電極対に交叉して配置されている複数の列電極との各交叉部に蛍光体層を備えた放電セルが形成されているプラズマディスプレイパネルを、入力映像信号における単位表示期間毎に複数のサブフィールドによって階調駆動するプラズマディスプレイパネルの駆動方法であって、
   前記サブフィールド各々において、前記入力映像信号に対応した画素データに応じて前記放電セル各々を選択的にアドレス放電せしめて点灯モード及び消灯モードの内の一方の状態に設定するアドレス行程と、前記行電極対の一方の行電極と他方の行電極に交互にサスティンパルスを印加することによって前記点灯モード状態の放電セルに対してのみに前記サブフィールドの輝度重みに対応した回数だけ繰り返しサスティン放電を生起せしめるサスティン行程とを実行し、
   前記サスティン行程では、少なくとも前記サスティンパルスの前縁部の期間中の一部の期間に亘りパルスのピーク電位を維持する補助パルスを前記列電極に印加することを特徴とするプラズマディスプレイパネルの駆動方法。
2. 前記サスティン行程では、前記サスティンパルスの前縁部における当該サスティンパルスのピーク電位に到る時点よりも前の時点から当該サスティンパルスのピーク電位に到る時点までの間に亘り前記補助パルスを前記列電極に印加することを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
3. 前記補助パルスは、前記前縁部の開始時点よりも所定のマージン期間だけ前の時点から印加開始されることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
4. 前記補助パルスは、前記前縁部の開始時点以降に印加開始されることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
5. 前記補助パルスは前記サスティンパルスの前縁部及びピーク電位区間に亘り印加されることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
6. 前記サスティンパルスは前記サスティン行程において最初に印加されるサスティンパルスであることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
7. 前記単位表示期間内のサブフィールド各々の前記サスティン行程の内で前記輝度重み値が所定値よりも小なるサブフィールドの前記サスティン行程のみで前記補助パルスの印加を行うことを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
8. 前記単位表示期間内のサブフィールド各々の内の１のサブフィールドでは、前記アドレス行程の直前に前記放電セル各々を点灯モード及び消灯モードの内の一方の状態に初期化するリセット行程を実行し、
   前記リセット行程では、前記行電極対の一方の行電極を陽極側、前記列電極を陰極側とした電圧を前記一方の行電極及び前記列電極間に印加することにより前記一方の行電極及び前記列電極間においてリセット放電を生起させることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
9. 前記１のサブフィールドは、前記単位表示期間内の先頭に設けられたサブフィールドであり、
   前記単位表示期間内のサブフィールド各々の内で前記１のサブフィールドにおいてのみで、前記リセット行程が実行されることを特徴とする請求項８に記載のプラズマディスプレイパネルの駆動方法。
10. 前記１のサブフィールドは前記単位表示期間内の先頭に設けられたサブフィールドの直後のサブフィールドであり、
    前記先頭に設けられたサブフィールドでは、前記放電セル各々を点灯モード及び消灯モードの内の一方の状態に初期化するリセット行程を実行することを特徴とする請求項８に記載のプラズマディスプレイパネルの駆動方法。
11. 前記リセット行程では、前記行電極対の一方の行電極を陽極側、前記列電極を陰極側とした電圧を前記一方の行電極及び前記列電極間に印加して前記一方の行電極及び前記列電極間においてリセット放電を生起させることを特徴とする請求項１０に記載のプラズマディスプレイパネルの駆動方法。
12. 前記単位表示期間内の先頭に設けられたサブフィールド及び前記１のサブフィールドにおいてのみで前記リセット行程を実行することを特徴とする請求項１０に記載のプラズマディスプレイパネルの駆動方法。
13. 前記先頭に設けられたサブフィールドにおける前記アドレス行程の直後において、前記行電極対の一方の行電極を陽極側、前記列電極を陰極側とした電圧を前記一方の行電極及び前記列電極間に印加することにより、前記先頭に設けられたサブフィールドの前記アドレス行程において前記点灯モードの状態に設定された放電セル内の前記列電極及び前記一方の行電極間にて微小発光放電を生起させる微小発光行程を実行することを特徴とする請求項１０記載のプラズマディスプレイ装置。
14. 前記微小発光放電は、輝度レベル０よりも１段階だけ高輝度な階調に対応した発光を伴う放電であることを特徴とする請求項１３記載のプラズマディスプレイ装置。
15. 前記蛍光体層には、蛍光体材料と二次電子放出材料とが含まれることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
16. 前記二次電子放出材料は酸化マグネシウムからなることを特徴とする請求項１４記載のプラズマディスプレイパネルの駆動方法。
17. 前記酸化マグネシウムは、電子線によって励起されて波長域200〜300nm内にピークを有するカソード・ルミネッセンス発光を行う酸化マグネシウム結晶体を含むことを特徴とする請求項１６記載のプラズマディスプレイパネルの駆動方法。
18. 前記酸化マグネシウム結晶体が、気相酸化法によって生成された酸化マグネシウム単結晶体であることを特徴とする請求項１７記載のプラズマディスプレイパネルの駆動方法。
19. 前記放電空間内において前記二次電子放出材からなる粒子が前記放電ガスに接触していることを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。
20. 前記サスティンパルス及び前記補助パルスは互いに同極性のピーク電位を有することを特徴とする請求項１に記載のプラズマディスプレイパネルの駆動方法。

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