JP2008148111A - 通信装置 - Google Patents
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Abstract
【課題】低消費電力かつ安価な通信装置を得ること。
【解決手段】受信アナログ信号を1ビットデジタル信号に変換するΔΣ変調器2と、ΔΣ変調器2から出力された1ビットデジタル信号に含まれた量子化雑音を除去したフィリタリング信号を生成するデジタルフィルタ3と、フィルタリング信号のサンプリングレートを復調処理に応じたサンプリングレートに変換するダウンサンプラ4と、前記サンプリングレート変換後の信号を復調する復調回路5と、を備える。
【選択図】 図1
【解決手段】受信アナログ信号を1ビットデジタル信号に変換するΔΣ変調器2と、ΔΣ変調器2から出力された1ビットデジタル信号に含まれた量子化雑音を除去したフィリタリング信号を生成するデジタルフィルタ3と、フィルタリング信号のサンプリングレートを復調処理に応じたサンプリングレートに変換するダウンサンプラ4と、前記サンプリングレート変換後の信号を復調する復調回路5と、を備える。
【選択図】 図1
Description
本発明は、アナログ信号をデジタル信号に変換して復調を行う通信装置に関するものである。
従来の通信装置の受信回路では、アナログ信号からデジタル信号の変換にAD(Analog-Digital)コンバータが使用されている。たとえば、下記非特許文献1に記載されている従来の電灯線通信装置に用いられている受信回路構成について説明する。図16は、下記非特許文献1の電灯線通信装置に用いられている受信回路構成を示す。図16に示すように、従来の受信回路は、伝送路である電灯線100から受信信号を受け取る結合回路101と、結合回路101が受け取った受信信号を増幅する可変ゲインアンプ102と、増幅された受信信号から不要な信号成分を除去するアナログフィルタ103と、アナログフィルタ103から出力された信号を多ビットのデジタル信号に変換するADコンバータ104と、デジタル信号からさらに不要な雑音成分を除去するデジタルフィルタ105と、デジタルフィルタ105から出力された信号を復調する復調回路106と、可変ゲインアンプ102のゲインの制御を行うゲイン制御回路107と、で構成される。
復調回路106は、たとえば、Differential Binary Phase Shift Keying(DBPSK),Differential Quadrate Phase Shift Keying(DQPSK)などの変調方式で変調された信号をもとの信号に復調する回路である。また、ゲイン制御回路107は、ADコンバータ104で変換されたデジタル信号の振幅を検出し、この検出結果に基づいて、ADコンバータ104に入力される信号がADコンバータ104のダイナミックレンジを越えない適切な振幅となるよう、可変ゲインアンプ102のゲインの制御を行う。
また、アナログ信号をデジタル信号に変換する方法として、音声処理回路にΔΣ変調器を用いてアナログ信号をデジタル信号に変換する方法がある(たとえば、下記特許文献1参照)。ΔΣ変調器は、入力されるアナログ信号の振幅に応じてローレベル電位とハイレベル電位の出現頻度が変化する、1ビットデジタル信号を出力する。ΔΣ変調器の出力である1ビットデジタル信号の量子化雑音成分をフィルタで除去することにより、ΔΣ変調器に入力されたアナログ信号を多ビットのデジタル情報に変換した信号を得ることが可能である。
しかしながら、上記従来の通信装置の受信回路では、受信信号をアナログ信号からデジタル信号に変換するために、ADコンバータを使用していた。一般的にADコンバータは消費電力が大きく、また、高価である。そのため、ADコンバータの使用が通信装置の低消費電力化、低価格化を阻害する要因となるという問題があった。
また、アナログ信号をデジタル信号に変換する方法としてΔΣ変調器を使用する方法がある(上記特許文献1参照)。しかし、上記特許文献1に記載の技術は、システムクロックを生成するための技術であって、通信装置の受信回路への適用については触れられていない。仮に通信装置へ適用する場合には、ΔΣ変調器によって生じる量子化雑音の大きさは一定であるのに対して、通信装置への入力信号である受信信号は、送信機と受信機との位置関係などによってその振幅が変動するため、受信信号の振幅が小さい場合に、量子化雑音により通信エラーが引き起こされる可能性があるという問題があった。
本発明は、上記に鑑みてなされたものであって、受信信号の通信品質を保った上で、低消費電力かつ安価な通信装置を得ることを目的とする。
上述した課題を解決し、目的を達成するために、本発明は、受信アナログ信号を1ビットデジタル信号に変換するデルタシグマ変調手段と、前記デルタシグマ変調手段から出力された1ビットデジタル信号に含まれた量子化雑音を除去したフィリタリング信号を生成するデジタルフィルタと、前記フィルタリング信号のサンプリングレートを復調処理に応じたサンプリングレートに変換するダウンサンプラと、前記サンプリングレート変換後の信号を復調する復調手段と、を備えることを特徴とする。
この発明によれば、ADコンバータとしてΔΣ変調器を用い、デジタルフィルタで量子化ノイズを除去するようにしたので、低消費電力かつ安価な通信装置が実現できるという効果を奏する。
以下に、本発明にかかる通信装置の実施の形態を図面に基づいて詳細に説明する。なお、この実施の形態によりこの発明が限定されるものではない。
実施の形態1.
図1は、本発明にかかる通信装置の実施の形態1の機能構成例を示す図である。図1に示すように、本実施の形態の通信装置は、受信した信号から不要な雑音成分を除去するアナログフィルタ1と、アナログフィルタ1によって雑音成分が除去された受信信号を1ビットデジタル信号に変換するΔΣ変調器2と、ΔΣ変調器2の出力である1ビットデジタル信号から量子化雑音を除去した多ビットのデジタル信号に変換するデジタルフィルタ3と、デジタルフィルタ3の出力である多ビットデジタル信号に対して、間引きを行うことにより復調回路5に入力可能なサンプリングレートに変換するダウンサンプラ4と、ダウンサンプラ4から出力されたサンプリングレート変換後の信号を、受信信号の変調方式に応じて(たとえばDBPSK(Differential Binary Phase Shift Keying)やDQPSK(Differential Quadrate Phase Shift Keying)など)復調する復調回路5と、で構成される。
図1は、本発明にかかる通信装置の実施の形態1の機能構成例を示す図である。図1に示すように、本実施の形態の通信装置は、受信した信号から不要な雑音成分を除去するアナログフィルタ1と、アナログフィルタ1によって雑音成分が除去された受信信号を1ビットデジタル信号に変換するΔΣ変調器2と、ΔΣ変調器2の出力である1ビットデジタル信号から量子化雑音を除去した多ビットのデジタル信号に変換するデジタルフィルタ3と、デジタルフィルタ3の出力である多ビットデジタル信号に対して、間引きを行うことにより復調回路5に入力可能なサンプリングレートに変換するダウンサンプラ4と、ダウンサンプラ4から出力されたサンプリングレート変換後の信号を、受信信号の変調方式に応じて(たとえばDBPSK(Differential Binary Phase Shift Keying)やDQPSK(Differential Quadrate Phase Shift Keying)など)復調する復調回路5と、で構成される。
図2は、ΔΣ変調器2の機能構成例を示す図である。図2に示すように、ΔΣ変調器2は、入力されたアナログ信号からフィードバック信号の減算を行う減算器10と、減算器10の出力信号を積分する積分器11と、基準電圧を発生する基準電圧発生回路12と、積分器11の出力信号と基準電圧発生回路12の出力信号とを比較し、1ビットデジタル信号を出力するコンパレータ13と、コンパレータ13の出力信号を一定時間遅延させる遅延回路14と、遅延回路14の出力信号をアナログ信号に変換してフィードバック信号として減算器10に出力する1ビットDA(Digital-Analog)コンバータ15と、で構成される。なお、図2で示した構成は、一例であり、1ビットデジタル信号を出力するΔΣ変調器であれば、どのような構成でもよい。
ΔΣ変調器2は、入力されるアナログ信号の振幅に応じてローレベル電位とハイレベル電位の出現頻度が変化する、1ビットデジタル信号を出力する。さらに、ΔΣ変調器2の出力である1ビットデジタル信号の量子化雑音成分をデジタルフィルタ3で除去することにより、ΔΣ変調器2に入力されるアナログ信号を多ビットのデジタル情報に変換した信号を得ることができる。図3−1,3−2,3−3にこれらの動作を説明する図を示す。図3−1は、ΔΣ変調器2に入力される信号の例、図3−2は、図3−1の入力信号に対応するΔΣ変調器2の出力信号の例,図3−3は、図3−2の出力からデジタルフィルタ3によって量子化雑音を除去した信号の例である。このように、図3−3に示すデジタルフィルタ3から出力されるデータは、図3−1に示す信号を他ビットのデジタル信号に変換したものとなる。
図4−1〜図8−2は、本実施形態の動作を説明するための図である。図4−1,4−2はアナログフィルタ1の入力である受信信号の例、図5−1,5−2はアナログフィルタ1の出力信号の例、図6−1,6−2はΔΣ変調器2の出力信号の例、図7−1,7−2はデジタルフィルタ3の出力信号の例、図8−1,8−2はダウンサンプラ4の出力信号の例、をそれぞれ示したものである。図4−1〜図8−2において、図番号の枝番を1としたものはそれぞれの信号のスペクトラムを示し、図番号の枝番を2としたものはそれぞれの信号の時間波形を示している。スペクトラムの図においては、通信キャリア信号20(実線)と雑音21(右下がり斜線領域)と量子化雑音22(右上がり斜線領域)とに分けて示している。
なお、図4−1〜図8−2では、複数のキャリアを使用して情報の伝送を行うマルチキャリア方式で通信を行う場合を例にあげている。図4−1に示すように、受信信号は通信キャリア信号20に、伝送路上などで発生した雑音21が重畳された信号である。アナログフィルタ1は通信キャリア帯域外の不要な雑音成分を抑制するため、図5−1に示すようにアナログフィルタ1の出力においては、雑音21が通信キャリア帯域外で抑制されている。
ΔΣ変調器2は、入力されたデジタルフィルタ3の出力信号の振幅に応じてローレベル電位とハイレベル電位の出現頻度が変化する、1ビットデジタル信号を出力する。このため、図6−1に示すように、ΔΣ変調器2の出力には量子化雑音22が発生し、これが入力された信号のスペクトラムに重畳される。デジタルフィルタ3は、量子化雑音22を抑制することによって、図7−1,7−2に示すように、ΔΣ変調器2の出力信号を多ビットデジタル信号に変換した信号を得る。
ダウンサンプラ4は、デジタルフィルタ3の出力である多ビットデジタル信号を間引くことにより、図8−1,8−2に示すように、サンプリングレートを低下させた信号を出力する。ダウンサンプラはN個のデータにつき、(N−1)個のデータを間引き、サンプリングレートを1/Nにするものとする。一般に、ΔΣ変調器2の動作周波数は高いため、デジタルフィルタ3の出力である多ビットデジタル信号の周波数も高く、復調回路5がその周波数に対応するのは困難である。このため、ダウンサンプラ4により復調回路5に入力可能なサンプリングレートに変換する。なお、図8−1,8−2の例では、3個のデータにつき2個のデータを間引くことにより、サンプリングレートを1/3に変換している。
以上のように、本実施の形態では、ΔΣ変調器2を使用してアナログ信号をデジタル信号に変換するようにした。このため、従来の通信装置に比べて低消費電力かつ低価格で、受信信号をデジタル信号に変換する通信装置を実現することができる。
実施の形態2.
図9は、本発明にかかる通信装置の実施の形態2の機能構成例を示す図である。図9に示すように、本実施の形態の通信装置は、実施の形態1の通信装置に、ゲイン制御回路7の指示に基づきゲインを設定して信号の増幅を行う可変ゲインアンプ6,ΔΣ変調器2の出力信号を参照して同電位の状態が継続する期間を計測し、所定の計測期間内の計測値の最大値に応じてゲインを決定し、可変ゲインアンプ6に決定したゲインを通知するゲイン制御回路7,ゲイン制御回路7の計測開始指示からの経過時間を計測し、所定の計測期間が経過すると計測期間の終了をゲイン制御回路7に通知するタイマ8を追加している。実施の形態1と同様の機能のものは、同一の符号を付して説明を省略する。以下、実施の形態1と異なる部分について説明する。
図9は、本発明にかかる通信装置の実施の形態2の機能構成例を示す図である。図9に示すように、本実施の形態の通信装置は、実施の形態1の通信装置に、ゲイン制御回路7の指示に基づきゲインを設定して信号の増幅を行う可変ゲインアンプ6,ΔΣ変調器2の出力信号を参照して同電位の状態が継続する期間を計測し、所定の計測期間内の計測値の最大値に応じてゲインを決定し、可変ゲインアンプ6に決定したゲインを通知するゲイン制御回路7,ゲイン制御回路7の計測開始指示からの経過時間を計測し、所定の計測期間が経過すると計測期間の終了をゲイン制御回路7に通知するタイマ8を追加している。実施の形態1と同様の機能のものは、同一の符号を付して説明を省略する。以下、実施の形態1と異なる部分について説明する。
ΔΣ変調器2の出力信号は、入力信号の振幅が大きい場合には同じ電位の状態が継続する時間が長く、入力信号の振幅が小さい場合には、同じ電位の状態が継続する時間が短いという性質を持つ。図10−1,10−2は、異なる振幅の信号をΔΣ変調器2に入力した場合のΔΣ変調器2の出力信号の差異を説明するための図である。図10−1の(a)は大きい振幅の入力信号、(b)は大きい振幅の信号を、それぞれ入力した場合のΔΣ変調器2の出力である。図10−2の(a)は小さい振幅の入力信号、(b)は小さい振幅の信号を、それぞれ入力した場合のΔΣ変調器2の出力である。図10−1の(b)と図10−2の(b)とを比較すると、図10−2の(b)では図10−1の(b)より電位が短い時間で変化している。
一方、本実施の形態では、可変ゲインアンプ6が受信信号を増幅するが、伝送路における通信信号の減衰の程度により受信信号の振幅が異なるため、最適なゲインは一定でない。図11−1〜図14−2は、本実施形態における可変ゲインアンプ6のゲインが十分でない場合と適切な場合のゲイン設定の例を示す図である。図11−1,11−2は、可変ゲインアンプ6のゲインが十分でない場合について、可変ゲインアンプの出力信号の例を示したものである。図12−1,12−2は、可変ゲインアンプ6のゲインが十分でない場合について、ΔΣ変調器2の出力の例を示したものである。図13−1,13−2は、可変ゲインアンプ6のゲイン設定が適切な場合について、可変ゲインアンプの出力信号の例を示したものである。図14−1,14−2は、可変ゲインアンプ6のゲイン設定が適切な場合について、ΔΣ変調器2の出力の例を示したものである。図11−1〜図14−2において、いずれも、図番号の枝番を1としたものはそれぞれの信号のスペクトルを示し、図番号の枝番を2としたものはそれぞれの信号の時間波形を示している。
図12−1に示すように、可変ゲインアンプ6のゲインが十分でない場合には、通信キャリア信号20の電圧とΔΣ変調器2によって生じる量子化雑音22の電圧の差が小さく、必要な信号対雑音比が得られず誤り無く通信を行うことはできない。これに対し、可変ゲインアンプ6のゲイン設定が適切な場合には、図14−1に示すように、通信キャリア信号20の電圧が量子化雑音22に比べ十分大きくなり、誤りが発生しにくくなる。
このため、本実施の形態では、ゲイン制御回路7が、ΔΣ変調器2の出力信号に基づいて可変ゲインアンプ6に対して適切なゲインを設定するようにしている。
つづいて、可変ゲインアンプ6の制御動作について説明する。本実施の形態では、ゲイン制御回路7が、ΔΣ変調器2の出力に基づき受信中の信号に対する最適ゲインを決定して可変ゲインアンプ6に通知し、可変ゲインアンプ6は通知されたゲインで受信信号の増幅を行う。ΔΣ変調器2の出力は、前述のとおり、入力信号の振幅が同じ電位の状態が継続する時間(以下、電位継続時間という)に個別に対応している。この入力信号の振幅と電位継続時間との対応を用いて、要求されている通信品質を満たすために必要な最小の振幅、に対応する電位継続時間(以下、下限電位継続時間という)を算出する。また、ゲインが大きすぎる場合には、飽和などの問題が生じるため、通信装置の特性に基づいて、電位継続時間の上限(上限電位継続時間)を設定し、下限電位継続時間から上限電位継続時間までの範囲を基準継続時間範囲とする。
つぎに、ゲイン制御回路7は、ΔΣ変調器2の出力を参照することにより電位継続時間の計測を開始し、開始と同時にタイマ8へタイマ計測開始を指示する。タイマ8は、タイマ計測開始の指示を受け取るとその時点から経過時間のカウントをはじめ、所定の計測期間が経過すると、ゲイン制御回路7に計測期間終了信号を送出する。ゲイン制御回路7は、タイマ8から計測期間終了信号を受け取ると、電位継続時間の計測の開始からその時点までに計測した電位継続時間のうちの、最大値を算出する。
そして、ゲイン制御回路7は、算出した電位継続時間の最大値と基準継続時間範囲に基づきゲインを決定し、可変ゲインアンプ6に決定したゲインを通知する。そして、可変ゲインアンプ6は、通知されたゲインを設定し、そのゲインで受信信号を増幅する。ゲイン制御回路7は、たとえば、電位継続時間の最大値が基準継続時間範囲を下回る場合には、ゲインが十分でないため、ゲインを大きくする。電位継続時間の最大値が基準継続時間範囲を上回る場合には、逆にゲインを小さくする。計測した電位継続時間の最大値が、基準継続時間範囲内であれば、設定されているゲインは変更する必要がない。このように電位継続時間の計測,ゲイン決定,ゲイン設定を繰り返すことにより、電位継続時間が基準継続時間範囲に収まるように制御する。
以上のように、本実施の形態では、ゲイン制御回路7が、ΔΣ変調器2の出力信号の同電位の状態が継続する時間を計測し、所定の計測期間内の計測値の最大値が基準継続時間範囲に入るように可変ゲインアンプ6のゲインを制御するようにした。このため、ΔΣ変調器2で発生する量子化雑音によって生じる通信エラーを防止することができる。
実施の形態3.
図15は、本発明にかかる通信装置の実施の形態3の動作を説明するための図である。本実施の形態では、図15に示すように複数のキャリアを有する信号を受信する例について説明する。本実施の形態の機能構成は実施の形態2と同様である。以下、実施の形態2と異なる部分について説明する。
図15は、本発明にかかる通信装置の実施の形態3の動作を説明するための図である。本実施の形態では、図15に示すように複数のキャリアを有する信号を受信する例について説明する。本実施の形態の機能構成は実施の形態2と同様である。以下、実施の形態2と異なる部分について説明する。
図15の(a)は基本周波数Fの1倍,(b)はFの2倍,(c)はFの3倍,(d)はFの4倍,(e)はFの5倍,(f)はFの6倍,(g)はFの7倍,のそれぞれの周波数をもつキャリア信号を示している。図15の(h)は、(a)から(h)までの7種類のキャリア信号を合成した信号である。図15の(h)に示すように、7種類のキャリア信号を合成した信号(h)は、1/Fの周期で同じ波形が繰り返される。この合成波の繰り返し周期は、キャリア信号がFの整数倍のもののみの場合には1/Fとなる。Fの整数倍以外の場合も含む一般の複数のキャリア周波数が合成される場合には、キャリア信号の周期の最小公倍数となる。
本実施の形態では、実施の形態2における所定の計測時間を、受信信号の繰り返し周期以上の長さの予め定められた時間とする。この繰返し周期は、前述のとおり、信号の周期の最小公倍数として算出することができる。所定の計測時間を繰り返し周期未満に設定すると、受信信号に含まれる振幅の最大値に対応する電位継続時間を計測していない可能性が高くなるが、繰り返し周期以上に設定すれば、受信信号に含まれる振幅の最大値に対応する電位継続時間を正しく計測することができる。なお、本実施の形態の動作は、このように所定の計測時間を通信信号の繰り返し周期に基づいて決定する動作以外は、実施の形態2と同様である。
以上のように、本実施の形態では、ΔΣ変調器2の出力信号の同電位の状態が継続する時間を計測し、受信信号のキャリア周波数から受信信号の繰り返し周期を求め、繰り返し周期以上の期間で、所定の計測期間内の計測値の最大値が基準継続時間範囲に入るように可変ゲインアンプ6のゲインを制御するようにした。このため、ΔΣ変調器に入力される信号の最大振幅が正確に検出でき、可変ゲインアンプ6のゲインの最適な制御ができる。
以上のように、本発明にかかる通信装置は、アナログ信号をデジタル信号に変換して復調を行う通信装置に有用であり、特に、低電力かつ低価格を要求される通信装置に適している。
1 アナログフィルタ
2 ΔΣ変調器
3 デジタルフィルタ
4 ダウンサンプラ
5 復調回路
6 可変ゲインアンプ
7 ゲイン制御回路
8 タイマ
10 減算器
11 積分器
12 基準電圧発生回路
13 コンパレータ
14 遅延回路
15 1ビットDAコンバータ
2 ΔΣ変調器
3 デジタルフィルタ
4 ダウンサンプラ
5 復調回路
6 可変ゲインアンプ
7 ゲイン制御回路
8 タイマ
10 減算器
11 積分器
12 基準電圧発生回路
13 コンパレータ
14 遅延回路
15 1ビットDAコンバータ
Claims (4)
- 受信アナログ信号を1ビットデジタル信号に変換するデルタシグマ変調手段と、
前記デルタシグマ変調手段から出力された1ビットデジタル信号に含まれた量子化雑音を除去したフィリタリング信号を生成するデジタルフィルタと、
前記フィルタリング信号のサンプリングレートを復調処理に応じたサンプリングレートに変換するダウンサンプラと、
前記サンプリングレート変換後の信号を復調する復調手段と、
を備えることを特徴とする通信装置。 - 前記デルタシグマ変調手段から出力された1ビットデジタル信号の同電位継続時間を計測し、所定の計測期間内における同電位継続時間の最大値を算出し、当該最大値が前記同電位継続時間に関する所定の基準時間範囲内となるようにゲインを決定するゲイン制御手段と、
前記ゲイン制御手段が決定したゲインに基づき前記受信アナログ信号を増幅し、増幅後の信号を前記デルタシグマ変調手段に出力する可変ゲイン増幅手段と、
をさらに備えることを特徴とする請求項1に記載の通信装置。 - 前記所定の基準時間範囲の下限値を、通信システムとして要求されている信号対雑音比に基づいて決定することを特徴とする請求項2に記載の通信装置。
- 前記受信アナログ信号を複数のキャリア信号が重畳された信号とし、前記所定の計測期間を、前記複数のキャリア信号の周期の最小公倍数以上とすることを特徴とする請求項2または3に記載の通信装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006334442A JP2008148111A (ja) | 2006-12-12 | 2006-12-12 | 通信装置 |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2010074901A (ja) * | 2008-09-17 | 2010-04-02 | Toshiba Corp | 電力系統保護制御装置 |
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2006
- 2006-12-12 JP JP2006334442A patent/JP2008148111A/ja active Pending
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