JP2007220856A5 - - Google Patents
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Claims (6)
- 積層された複数のセラミック層と、これらのセラミック層に形成された導体膜と、前記積層された複数のセラミック層のうち所定のセラミック層を貫通して形成されたビアホール導体とを備えた多層セラミック基板において、前記ビアホール導体を形成するために充填される導電性ペーストが少なくとも銀粉と有機ビヒクルとを含み、前記銀粉が少なくとも結晶子径10nm以上50nm以下の銀粉と55nm以上150nm以下の銀粉を含むことを特徴とする多層セラミック基板。
- 積層された複数のセラミック層と、これらのセラミック層に形成された導体膜を備えた多層セラミック基板において、前記導体膜を形成するための導電性ペーストが少なくとも銀粉と有機ビヒクルとを含み、前記銀粉が少なくとも結晶子径10nm以上50nm以下の銀粉と55nm以上150nm以下の銀粉を含むことを特徴とする多層セラミック基板。
- 請求項1又は請求項2に記載の多層セラミック基板において、焼成前の多層セラミック層の少なくとも一方の主面に、前記多層セラミック層の焼成条件では焼結しない収縮抑制層を密着させ、これを前記多層セラミック層の焼成条件で焼成した後、未焼結の収縮抑制層を除去することにより得られる、XY方向の焼成収縮を抑制した多層セラミック基板。
- 前記多層セラミック基板において、前記10nm以上50nm以下の銀粉の混合比率がすべての銀重量に対して15wt%以上85wt%以下であることを特徴とする請求項1又は請求項2に記載の多層セラミック基板。
- セラミック層と、導体膜と、ビアホール導体とを備えた多層セラミック基板の製造方法であって、セラミックグリーンシートにビアホールを形成する工程と、少なくとも結晶子径10nm以上50nm以下の銀粉と55nm以上150nm以下の銀粉を混合してなる導電性ペーストを前記ビアホールに充填してビアホール導体を形成する工程と、ビアホール導体を形成した複数の前記セラミックシートから積層体を作製する工程と、前記積層体を焼成する工程と、を含むことを特徴とする多層セラミック基板の製造方法。
- セラミック層と、導体膜とを備えた多層セラミック基板の製造方法であって、少なくとも結晶子径10nm以上50nm以下の銀粉と55nm以上150nm以下の銀粉を混合してなる導電性ペーストを用いてセラミックグリーンシートに導電膜を形成する工程と、導電膜を形成した複数の前記セラミックシートから積層体を作製する工程と、前記積層体を焼成する工程と、を含むことを特徴とする多層セラミック基板の製造方法。
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