JP2007103593A - 半導体装置及びその製造方法 - Google Patents

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Abstract

【課題】 異種の金属膜の積層構造からなる導電膜に対するボンディングパッドの保護膜の開口を保護膜の減損を生じることなく形成し、かつダイシング工程等水溶液に浸される工程において金属膜の溶解を回避するボンディングパッドを提供する。
【解決手段】 アルミ膜とアルミ膜上に堆積されたTi,TiN等の反射防止膜を含む導電膜の上に堆積した保護膜と前記反射防止膜を除去して前記アルミ膜を露出させたボンディングパッド等の保護膜開口を有し、前記保護膜の除去領域が、前記反射防止膜の除去領域の内側となるように、前記反射防止膜を除去するエッチング工程が、前記保護膜の堆積前に行われる。
【選択図】 図1

Description

本発明は、異種の金属膜の積層構造からなる導電膜に対するボンディングパッド等の保護膜の開口を有する半導体装置及びその製造方法に関する。
図2は、異種の金属膜の積層構造からなる導電膜に対するボンディングパッド等の保護膜の開口を有する一般的な半導体装置及びその製造方法の例である。この例の場合、図2(a)に示す様に、層間絶縁膜1の上にTi、TiN膜等のバリアメタル膜2と、アルミ膜3(Si、Cuを含有する場合もある)と、Ti、TiN膜等の反射防止膜4とをスパッタ等で順次に堆積させて、異種の金属膜の積層構造からなる導電膜5を形成し、配線、ボンディングパッド等のパターンに導電膜5を加工する。
次に、図2(b)、(c)に示す様に、シリコン窒化膜、あるいはシリコン酸化膜とシリコン窒化膜の2層膜等からなる保護膜6をCVD等で堆積させて、ボンディングパッドに対応するパターンの保護膜6の開口7をドライエッチング等で形成し、ボンディングパッド8を形成する。
このとき、アルミ膜3の上に反射防止膜4が残存すると、ボンディングパッド8とボンディングワイヤとの間の電気的な接触抵抗が高くなり、本来の電気特性が得られないため、保護膜の開口7を形成するドライエッチングの工程で、ボンディングパッド8の反射防止膜4を同時に除去し、アルミ膜3を露出させる。
しかし、図2(d)に示す様に、ボンディングパッド8の保護膜開口7の端部では、Ti、TiN膜等の反射防止膜4とアルミ膜3との界面が開口7に露出しているため、その後、ダイシング工程等水溶液に浸される工程において、異種の金属間で生じる局部的な電池効果により、イオン化傾向の高いAl(アルミニウム)がアルミ膜3のTi、TiN膜等の反射防止膜4との界面近傍から溶解し、ボンディングパッド8に腐食穴9が発生する。また、溶解したAlの反応生成物である水酸化アルミ10がボンディングパッド8の表面に再付着する。
ボンディングパッド8の表面に再付着した水酸化アルミ10は、ボンディングパッド8とボンディングワイヤとの間の電気的、機械的な接触を阻害する要因となる。特に、ダイシング工程で生成し、ボンディングパッド8の表面に再付着した水酸化アルミ10は、ダイシング中に発生するシリコンの微細な切り屑をボンディングパッド8の表面に強固に付着させる接着剤としても働くため、ボンディングパッド8とボンディングワイヤとの間の機械的な接触を大いに阻害する要因となる。
この問題を回避するため、図3(a)に示す様に、保護膜の開口7を形成した後に、図3(b)に示す様に、絶縁膜11を堆積して、図3(c)に示す様に、絶縁膜11の全面に異方性のドライエッチングを施して、絶縁膜11からなる側壁保護膜12を開口8の側面に形成し、Ti、TiN膜等の反射防止膜4とアルミ膜3との界面が開口7に露出することを防止する方法が提案されている。(特許文献1を参照のこと。)
特開平11−312670号公報
しかしながら、図3に示した従来方法の場合、側壁保護膜12を加工形成するため絶縁膜11の全面を異方性のドライエッチングした際に、ボンディングパッド8の表面に絶縁膜11が残存しないように、絶縁膜11の膜厚分に必要なエッチングよりも過大なエッチングが必要となる。一般的にシリコン酸化膜、シリコン窒化膜等の絶縁膜は、各々のエッチング選択比はそれほど大きくない。このため、絶縁膜11の全面をエッチングする際に、保護膜6もエッチングされ、保護膜6の膜厚が減損する可能性が高い。保護膜6の膜厚が減損するということは、本来の役割である、ICの保護を阻害する要因となり、ICの信頼性上で重大な問題である。
本発明は、ボンディングパッド等の保護膜の開口内で異種の金属膜の積層界面が露出しない構造を、保護膜が減損することなく実現する半導体装置及びその製造方法を提案することを目的とする。
本発明の半導体装置及びその製造方法は、第1の金属膜と第1の金属膜上に堆積された第1の金属膜とは異種の金属からなる第2の金属膜を含む導電膜と、前記導電膜の上部に堆積した絶縁膜からなる保護膜と、前記保護膜及び前記第2の金属膜を除去して前記第1の金属膜を露出させた開口を有し、前記保護膜の除去領域が、前記第2の金属膜における除去領域の内側となるように開口部を加工している。
このため、ボンディングパッド等の保護膜の開口内で異種の金属膜の積層界面が露出することがなく、その後、ダイシング工程等水溶液に浸される工程において、第1の金属膜と第2の金属膜との間の異種金属で生じる局部的な電池効果が生じなく、イオン化傾向の高い金属の溶解を回避できる。
また、前記第2の金属膜の除去するエッチング工程が、前記保護膜の堆積前に行われるため、保護膜の堆積工程、前記開口部の形成工程へ影響を与えることはなく、保護膜の減損等の問題は生じない。
本発明の半導体装置及びその製造方法は、ボンディングパッド等の保護膜の開口内でアルミ膜とTi、TiN等の反射防止膜となる異種の金属膜との積層界面が露出しない構造を、保護膜の減損することなく実現することができ、ダイシング工程等水溶液に浸される工程においてイオン化傾向の高いAlの溶解を回避することができるため、信頼性の高い半導体装置が提供できる。
以下、本発明の実施形態を図1により説明する。
図1(a)に示す様に、層間絶縁膜1の上にTi、TiN膜等のバリアメタル膜2と、アルミ膜3(Si、Cuを含有する場合もある)と、Ti、TiN膜等の反射防止膜4とをスパッタ等で順次に堆積させて、異種の金属膜の積層構造からなる導電膜5を形成し、配線、ボンディングパッド等のパターンに導電膜5を加工する。
次に、図1(b)に示す様に、ボンディングパッド等、最終的に保護膜の開口を形成する領域より一回り大きい領域の反射防止膜4をドライエッチングで除去して、反射防止膜4の開口13を形成する。このとき、(反射防止膜の開口13の大きさ)>(保護膜の開口7の大きさ)となっている。
その後、図1(c)、(d)に示す様に、シリコン窒化膜、あるいはシリコン酸化膜とシリコン窒化膜の2層膜等からなる保護膜6をCVD等で堆積させて、ボンディングパッドに対応するパターンの保護膜6の開口7をドライエッチング等で形成し、ボンディングパッド8を形成する。
図1(d)に示す様に、本実施形態では、アルミ膜3と反射防止膜4の界面が、保護膜の開口7に露出することがなく、ダイシング工程等水溶液に浸される工程においてイオン化傾向の高いAlの溶解を回避することができる。
また、保護膜6のエッチングも、一般的な半導体製造装置と同様であり、保護膜を減損することはなく、信頼性も高いことがわかる。
本発明の実施形態を示す断面図 従来の一般的な半導体装置を示す断面図 従来例の半導体装置を示す断面図
符号の説明
1 層間絶縁膜
2 バリアメタル膜
3 アルミ膜
4 反射防止膜
5 導電膜
6 保護膜
7 保護膜の開口
8 ボンディングパッド
9 ボンディングパッドに生じた腐食穴
10 水酸化アルミ
11 絶縁膜
12 側壁保護膜
13 反射防止膜の開口

Claims (3)

  1. 第1の金属膜と第1の金属膜上に堆積された第1の金属膜とは異なる第2の金属膜とを含む導電膜と、
    前記導電膜の上部に堆積した絶縁膜からなる保護膜と、
    前記保護膜及び前記第2の金属膜を除去して前記第1の金属膜を露出させた開口を有し、前記保護膜の除去領域が、前記第2の金属膜における除去領域の内側となることを特徴とする半導体装置。
  2. 第1の金属膜と第1の金属膜上に堆積された第1の金属膜とは異なる第2の金属膜とを含む導電膜とを形成する工程と、
    前記第2の金属膜を除去して前記第1の金属膜を露出させるための第1の開口を形成する工程と、
    前記開口を有する前記導電膜に絶縁膜からなる保護膜を堆積する工程と、
    前記第1の開口の上に堆積された前記保護膜を除去して前記第1の金属膜を露出させた第2の開口を形成する工程とからなり、前記第2の開口は前記第1の開口の内側に位置することを特徴とする半導体装置の製造方法。
  3. 前記第1の金属膜はアルミニウムを主とする低抵抗の金属膜であり、前記第2の金属膜はチタンあるいは窒化チタン等の比較的高抵抗の反射防止膜であることを特徴とする請求項1に記載の半導体装置。
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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009117464A (ja) * 2007-11-02 2009-05-28 Kyocera Corp 半導体素子及び該半導体素子の実装構造体
CN101866866A (zh) * 2009-04-16 2010-10-20 瑞萨电子株式会社 半导体集成电路器件及其制造方法
US8390134B2 (en) 2009-05-20 2013-03-05 Renesas Electronics Corporation Semiconductor device having surface protective films on bond pad
CN103646883A (zh) * 2013-11-28 2014-03-19 上海华力微电子有限公司 一种铝衬垫制备方法
CN109166838A (zh) * 2018-08-29 2019-01-08 上海华虹宏力半导体制造有限公司 顶层金属键合垫的引出结构及其制造方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01312670A (ja) * 1988-06-13 1989-12-18 Mitsubishi Electric Corp 図面処理装置
JPH02205323A (ja) * 1989-02-03 1990-08-15 Seiko Epson Corp 半導体装置の製造方法
JP2001007148A (ja) * 1999-06-23 2001-01-12 Seiko Epson Corp 半導体装置及びその製造方法
JP2006303452A (ja) * 2005-03-25 2006-11-02 Sanyo Electric Co Ltd 半導体装置及びその製造方法

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01312670A (ja) * 1988-06-13 1989-12-18 Mitsubishi Electric Corp 図面処理装置
JPH02205323A (ja) * 1989-02-03 1990-08-15 Seiko Epson Corp 半導体装置の製造方法
JP2001007148A (ja) * 1999-06-23 2001-01-12 Seiko Epson Corp 半導体装置及びその製造方法
JP2006303452A (ja) * 2005-03-25 2006-11-02 Sanyo Electric Co Ltd 半導体装置及びその製造方法

Cited By (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2009117464A (ja) * 2007-11-02 2009-05-28 Kyocera Corp 半導体素子及び該半導体素子の実装構造体
CN101866866A (zh) * 2009-04-16 2010-10-20 瑞萨电子株式会社 半导体集成电路器件及其制造方法
JP2010251537A (ja) * 2009-04-16 2010-11-04 Renesas Electronics Corp 半導体集積回路装置および半導体集積回路装置の製造方法
US8373270B2 (en) 2009-04-16 2013-02-12 Renesas Electronics Corporation Semiconductor integrated circuit device and method of manufacturing same
US20130065330A1 (en) * 2009-04-16 2013-03-14 Renesas Electronics Corporation Semiconductor integrated circuit device and method of manufacturing same
US9048200B2 (en) 2009-04-16 2015-06-02 Renesas Electronics Corporation Semiconductor integrated circuit device and method of manufacturing same
CN104835795A (zh) * 2009-04-16 2015-08-12 瑞萨电子株式会社 半导体器件
US9536821B2 (en) 2009-04-16 2017-01-03 Renesas Electronics Corporation Semiconductor integrated circuit device having protective split at peripheral area of bonding pad and method of manufacturing same
US8390134B2 (en) 2009-05-20 2013-03-05 Renesas Electronics Corporation Semiconductor device having surface protective films on bond pad
US8716122B2 (en) 2009-05-20 2014-05-06 Renesas Electronics Corporation Method of manufacturing semiconductor device having surface protective films on bond pad
CN103646883A (zh) * 2013-11-28 2014-03-19 上海华力微电子有限公司 一种铝衬垫制备方法
CN109166838A (zh) * 2018-08-29 2019-01-08 上海华虹宏力半导体制造有限公司 顶层金属键合垫的引出结构及其制造方法

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