JP2006098944A - 表示制御装置及び画像形成装置 - Google Patents
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Abstract
【課題】 メモリへのアクセス頻度を低減させ、簡易的な構成により消費電力を抑えることができる表示制御装置を提供する。
【解決手段】 外部メモリ13は、LCDモジュール14に表示する表示データを記憶し、CPU12は、表示データの外部メモリ13における開始アドレスを設定し、設定された開始アドレスを記憶し、割り込み発生部113は、記憶された開始アドレスが所定期間以上変化していないことを検出し、クロック信号生成部114は、開始アドレスが所定期間以上変化していないことが検出された場合、外部メモリ13からLCDモジュール14へ当該表示データを転送するクロック信号の周波数を低減する。
【選択図】 図1
【解決手段】 外部メモリ13は、LCDモジュール14に表示する表示データを記憶し、CPU12は、表示データの外部メモリ13における開始アドレスを設定し、設定された開始アドレスを記憶し、割り込み発生部113は、記憶された開始アドレスが所定期間以上変化していないことを検出し、クロック信号生成部114は、開始アドレスが所定期間以上変化していないことが検出された場合、外部メモリ13からLCDモジュール14へ当該表示データを転送するクロック信号の周波数を低減する。
【選択図】 図1
Description
本発明は、クロック信号に同期して表示データを表示装置に出力する表示制御装置及び画像を形成する画像形成装置に関するものである。
従来、画像形成装置の液晶画面として使用されているLCDモジュールでは、画面を表示させる際、表示データを記憶するメモリへアクセスし、その一画面分の表示データを取得して表示を行っている。
そして、従来のLCDモジュールは、一画面を表示させる場合、同じ画面を表示させる場合であったとしても、常に表示画面に対応する表示データの取得を行わなければならない。
画面を表示させるための表示データをメモリから取得する際は、その画面の表示データの開始アドレスを設定し、画面のサイズ、画素数などから終了アドレスを設定する。この開始アドレスが変わらなければ画面は同じ画面を表示しているとみなすことができる。
例えば、特許文献1の表示制御装置では、メモリへのアクセスを行わない際にクロックの調整を行うとあるが、この方式はVRAMをチップ内に内蔵している方式で、チップ外部に画像用のデータを格納するメモリが存在し、そこからVRAMにデータを取り込み画像形成用のデータとする。このようにVRAMが独立して存在しており、CPUとVRAM間の速度の調整を行っている。
また、例えば、特許文献2のディスプレイ装置では、クロックの変化に使用するトリガとして開始アドレスと終了アドレスとを用い、画面の変化量を検知し、その変化量に合わせてクロックを変化させている。
特開2003−5948号公報
特開2002−229549号公報
しかしながら、特許文献1の表示制御装置は、CPUとVRAMとの間の速度を調整するものであり、VRAMとLCDとの間の速度を調整するものではない。また、特許文献2のディスプレイ装置は、クロックの変化を画面の変化量にて判断する為、どれだけの変化量であるかを判断する為のステートが別途必要となり、簡易的に実現させることが困難である。
本発明は、上記の問題を解決するためになされたもので、メモリへのアクセス頻度を低減させ、簡易的な構成により消費電力を抑えることができる表示制御装置及び画像形成装置を提供することを目的とするものである。
本発明に係る表示制御装置は、クロック信号に同期して表示データを表示装置に出力する表示制御装置であって、表示装置に表示する表示データを記憶する表示データ記憶手段と、前記表示データ記憶手段における前記表示データの開始アドレスを設定するアドレス設定手段と、前記アドレス設定手段によって設定された開始アドレスを記憶するアドレス記憶手段と、前記アドレス記憶手段に記憶されている開始アドレスが所定期間以上変化していないことを検出する検出手段と、前記検出手段によって開始アドレスが所定期間以上変化していないと検出された場合、前記表示データ記憶手段から表示装置へ当該表示データを転送するクロック信号の周波数を低減するクロック信号低減手段とを備える。
この構成によれば、表示データ記憶手段に、表示装置に表示する表示データが記憶されており、アドレス設定手段によって、表示データの表示データ記憶手段における開始アドレスが設定され、アドレス設定手段によって設定された開始アドレスがアドレス記憶手段に記憶される。そして、検出手段によって、アドレス記憶手段に記憶されている開始アドレスが所定期間以上変化していないことが検出され、クロック信号低減手段によって、検出手段により開始アドレスが所定期間以上変化していないことが検出された場合、表示データ記憶手段から表示装置へ当該表示データを転送するクロック信号の周波数が低減される。
また、上記の表示制御装置において、前記クロック信号低減手段は、前記検出手段によって開始アドレスが所定期間以上変化していないことが検出された場合、前記クロック信号の周波数を分周し、周波数を分周した前記クロック信号を前記表示装置へ出力することが好ましい。
この構成によれば、クロック信号低減手段によって、検出手段により開始アドレスが所定期間以上変化していないことが検出された場合、クロック信号の周波数が分周され、周波数が分周されたクロック信号が表示装置へ出力されるので、予め設定されているクロック信号の周波数を分周させることにより簡易にクロック信号を生成することができる。
また、上記の表示制御装置において、前記クロック信号低減手段によってクロック信号の周波数が低減されている状態で、前記アドレス設定手段によって新たな開始アドレスが設定された場合、前記クロック信号の周波数を元の周波数に復帰させるクロック信号復帰手段をさらに備えることが好ましい。
この構成によれば、クロック信号低減手段によりクロック信号の周波数が低減されている状態で、アドレス設定手段により新たな開始アドレスが設定された場合、クロック信号復帰手段によって、クロック信号の周波数が、低減される前のクロック信号の周波数に復帰される。
本発明に係る画像形成装置は、画像を形成する画像形成装置であって、通常モードと、前記通常モードよりも消費電力を抑えた省電力モードとを切り替えるモード切替手段と、前記通常モードに対応する表示データと前記省電力モードに対応する表示データとを記憶する表示データ記憶手段と、前記モード切替手段によって前記通常モードから前記省電力モードに切り替えられた場合、前記表示データ記憶手段における前記省電力モードに対応する表示データの開始アドレスを設定するアドレス設定手段と、前記アドレス設定手段によって設定された開始アドレスを記憶するアドレス記憶手段と、前記アドレス記憶手段に記憶されている開始アドレスが所定期間以上変化していないことを検出する検出手段と、前記検出手段によって開始アドレスが所定期間以上変化していないことが検出された場合、前記表示データ記憶手段から表示装置へ当該表示データを転送するクロック信号の周波数を低減するクロック信号低減手段とを備える。
この構成によれば、モード切替手段によって、通常モードと通常モードよりも消費電力を抑えた省電力モードとが切り替えられる。そして、表示データ記憶手段に、通常モードに対応する表示データと省電力モードに対応する表示データとが記憶されており、アドレス設定手段によって、モード切替手段により通常モードから省電力モードに切り替えられた場合、表示データ記憶手段における省電力モードに対応する表示データの開始アドレスが設定される。そして、アドレス記憶手段に、アドレス設定手段によって設定された開始アドレスが記憶され、検出手段によって、アドレス記憶手段に記憶されている開始アドレスが所定期間以上変化していないことが検出される。検出手段により開始アドレスが所定期間以上変化していないことが検出された場合、クロック信号低減手段によって、表示データ記憶手段から表示装置へ当該表示データを転送するクロック信号の周波数が低減される。
請求項1に記載の発明によれば、開始アドレスが所定期間変化していない場合、すなわち、所定期間同じ表示画像が表示装置に表示される場合、クロック信号の周波数を低減させることによってメモリへのアクセス頻度を低減させ、簡易的な構成により消費電力を抑えることができる。
請求項2に記載の発明によれば、予め設定されているクロック信号の周波数を分周させることにより簡易にクロック信号を生成することができる。
請求項3に記載の発明によれば、クロック信号の周波数が低減されている状態で、新たな開始アドレスが設定された場合、クロック信号の周波数が、低減される前のクロック信号の周波数に復帰されるので、現在表示されている表示画像から異なる表示画像に変わったとしても、クロック信号の周波数を切り替えることにより、違和感のない表示画像に切り替えることができる。
請求項4に記載の発明によれば、画像形成装置のように通常モードから省電力モードに切り替えられ、所定期間同じ表示画像が表示装置に表示される場合、クロック信号の周波数を低減させることによってメモリへのアクセス頻度を低減させ、簡易的な構成により消費電力を抑えることができる。
以下、本発明の一実施の形態による表示制御装置について図面を参照しながら説明する。
図1は、本発明に係る表示制御装置の構成を示すブロック図である。図1に示す表示制御装置1は、LCD(Liquid Crystal Display;液晶表示装置)コントローラ11、CPU(中央演算処理装置)12、外部メモリ13、LCDモジュール14及び開始アドレス記憶部15を備えて構成される。
外部メモリ13は、LCDモジュール14の画面上に表示する表示データを記憶する。外部メモリ13には、LCDモジュール14に表示すべき1画面分の表示データが複数記憶されている。
CPU12は、外部メモリ13に記憶されている表示データの開始アドレスを設定すると共に、画面のサイズ及び画素数などに応じて終了アドレスを設定する。開始アドレス記憶部15は、例えばRAM(ランダムアクセスメモリ)で構成され、CPU12によって設定された開始アドレスを記憶する。
LCDコントローラ11は、メモリI/F(インタフェース)部111、表示制御部112、割り込み発生部113及びクロック信号生成部114を備えて構成される。
メモリI/F部111は、外部メモリ13とのインタフェースであり、CPU12によって設定された開始アドレス及び終了アドレスに基づいて外部メモリ13から表示データを取得し、取得した表示データを表示制御部112へ出力する。表示制御部112は、メモリI/F部111から出力された表示データをLCDモジュール14に表示するよう制御する。
割り込み発生部113は、CPU12によって設定された開始アドレスが所定期間以上変化しない場合、割り込み信号IRQを発生させ、発生させた割り込み信号IRQをCPU12へ出力する。CPU12は、割り込み発生部113によって出力された割り込み信号IRQが入力されると、クロック信号の速度を低減させる速度低減信号CLK_ENをクロック信号生成部114へ出力する。
クロック信号生成部114は、LCDモジュール14に応じて設定される第1のクロック信号LCD_CLKを生成し、生成した第1のクロック信号LCD_CLKをLCDモジュール14へ出力する。クロック信号生成部114は、CPU12によって出力される速度低減信号CLK_ENが入力されると、LCDモジュール14に応じて予め設定されている最低周波数の第2のクロック信号LCD_CLKを生成し、LCDモジュール14へ出力する。クロック信号の周波数が高くなるほど、表示データがLCDモジュール14へ転送される速度が速くなり、クロック信号の周波数が低くなるほど、表示データがLCDモジュール14へ転送される速度が遅くなる。なお、クロック信号生成部114は、分周回路を備えており、第1のクロック信号の周波数を分周することによって、第2のクロック信号を生成する。第2のクロック信号は、LCDモジュール14に表示される画像が人間の目にちらつかない程度の速度であり、この際、LCDモジュール14のクロック信号の最小速度が仕様によって決まっており、その最小速度が第2のクロック信号の速度よりも速い場合、その最小速度に設定する。
このように、クロック信号生成部114によって、CPU12により開始アドレスが所定時間の間変化していないと判断された場合、クロック信号の周波数が分周され、周波数が分周されたクロック信号がLCDモジュール14へ出力されるので、予め設定されているクロック信号の周波数を分周させることにより簡易にクロック信号を生成することができる。
また、クロック信号生成部114は、CPU12によって出力される速度復帰信号RES_CLKが入力されると、LCDモジュール14に応じて予め設定されている通常時の第1のクロック信号LCD_CLKを生成し、LCDモジュール14へ出力する。これにより、クロック信号生成部114は、最低周波数に設定されている第2のクロック信号LCD_CLKを通常時の周波数の第1のクロック信号LCD_CLKに復帰させる。
なお、本実施形態におけるクロック信号生成部114は、逓倍回路を備えていてもよく、LCDモジュール14の仕様に応じて何逓倍するかを選択可能に構成してもよい。この場合、異なる仕様のLCDモジュールや、異なるメーカのLCDモジュールに変更したとしても、逓倍回路の設定を変更するのみで対応することができる。
LCDモジュール14は、クロック信号生成部114によって生成されるクロック信号LCD_CLKに同期させて画像を表示する。
次に、図1に示す表示制御装置1の動作について説明する。図2は、図1に示す表示制御装置の動作について説明するためのフローチャートである。
まず、ステップS1において、CPU12は、LCDモジュール14に表示する表示データの外部メモリ13における開始アドレスを設定する。ここで、CPU12は、内部のメモリに表示データの外部メモリ13における開始アドレスを予め記憶しており、記憶している開始アドレスを読み出してメモリI/F部111に対し、外部メモリ13における表示データの開始アドレスと終了アドレスとを設定する。メモリI/F部111は、設定された開始アドレスと終了アドレスとに対応する表示データを読み出し、読み出した表示データを表示制御部112へ出力する。
次に、ステップS2において、CPU12は、開始アドレスが開始アドレス記憶部15に記憶されているか否かを判断する。ここで、開始アドレスが開始アドレス記憶部15に記憶されていると判断された場合(ステップS2でYES)、ステップS5に処理を移行し、開始アドレスが開始アドレス記憶部15に記憶されていないと判断された場合(ステップS2でNO)、ステップS3に処理を移行する。
開始アドレスが開始アドレス記憶部15に記憶されていないと判断された場合、ステップS3において、CPU12は、設定した開始アドレスを開始アドレス記憶部15に記憶する。
次に、ステップS4において、クロック信号生成部114は、LCDモジュール14に表示データを表示するタイミングを決定する第1のクロック信号LCD_CLKを生成し、LCDモジュール14へ出力する。なお、このときの第1のクロック信号LCD_CLKは、LCDモジュール14に応じた周波数に予め設定される。
一方、開始アドレスが開始アドレス記憶部15に記憶されていると判断された場合、ステップS5において、割り込み発生部113は、CPU12によって設定された開始アドレスと、開始アドレス記憶部15に記憶されている開始アドレスとを比較し、設定された開始アドレスが、開始アドレス記憶部15に記憶されている開始アドレスから変化したか否かを判断する。ここで、開始アドレスが変化したと判断された場合(ステップS5でNO)、ステップS3に処理を移行し、変化した開始アドレスを新たに記憶する。開始アドレスが変化していないと判断された場合(ステップS5でYES)、ステップS6に処理を移行する。
開始アドレスが変化していないと判断された場合、ステップS6において、割り込み発生部113は、予め設定されている所定期間が経過したか否かを判断する。経過時間は、開始アドレスが記憶されてからの時間が、例えば割り込み発生部113が備えるタイマ機能又はカウンタ機能によって計時され、計時された時間が予め設定されている所定時間に達したか否かが判断される。なお、本実施形態における所定時間は、例えば15分に予め設定されている。ここで、所定期間経過したと判断された場合(ステップS6でYES)、ステップS7に処理を移行する。所定期間経過していないと判断された場合(ステップS6でNO)、ステップS1に処理を戻し、開始アドレスの設定が行われる。
開始アドレスに変化がなく、かつ所定時間経過したと判断された場合、ステップS7において、割り込み発生部113は、割り込み信号IRQを発生させ、発生させた割り込み信号IRQをCPU12へ出力する。
次に、ステップS8において、CPU12は、割り込み発生部113からの割り込み信号IRQが入力されると、第1のクロック信号LCD_CLKの周波数を低減させる速度低減信号CLK_ENをクロック信号生成部114へ出力する。
次に、ステップS9において、クロック信号生成部114は、CPU12からの速度低減信号CLK_ENが入力されると、第1のクロック信号を分周し、第1のクロック信号よりも周波数の低い第2のクロック信号を生成し、生成した第2のクロック信号をLCDモジュール14へ出力する。
このように、開始アドレスが変化しない限り、すなわち、LCDモジュール14に表示される表示画面が変化しない限り、通常のクロック信号の周波数よりも低減されたクロック信号に同期して表示データが表示される。
また、ステップS9において第2のクロック信号が生成され、クロック信号が低減されている状態で、ステップS5において開始アドレスに変化があると判断された場合、CPU12は、当該新たな開始アドレスを開始アドレス記憶部15に記憶し、速度復帰信号RES_CLKをクロック信号生成部114へ出力する。そして、ステップS4においてクロック信号生成部114は、速度復帰信号RES_CLKが入力されると、第1のクロック信号を生成し、生成した第1のクロック信号をLCDモジュール14へ出力する。
なお、ステップS3の処理の後、CPU12が第2のクロック信号が出力さているか否かを判断し、第2のクロック信号が出力されている場合、速度復帰信号RES_CLKをクロック信号生成部114へ出力し、ステップS4においてクロック信号生成部114が第1のクロック信号を生成し、生成した第1のクロック信号をLCDモジュール14へ出力し、第2のクロック信号が出力されていない場合、ステップS4においてクロック信号生成部114が第1のクロック信号を生成し、生成した第1のクロック信号をLCDモジュール14へ出力してもよい。
このように、外部メモリ13に、LCDモジュール14に表示する表示データが記憶されており、CPU12によって、外部メモリ13における表示データの開始アドレスが設定され、設定された開始アドレスが開始アドレス記憶部15に記憶される。そして、割り込み発生部113によって、開始アドレス記憶部15に記憶されている開始アドレスが所定期間以上変化していないことが検出され、開始アドレスが所定期間以上変化していないことが検出された場合、クロック信号生成部114によって、外部メモリ13からLCDモジュール14へ当該表示データを転送するクロック信号の周波数が低減される。
したがって、開始アドレスが所定期間以上変化していない場合、すなわち、所定期間以上同じ表示画像がLCDに表示される場合、クロック信号の周波数を低減させることによって外部メモリ13へのアクセス頻度を低減させ、簡易的な構成により消費電力を抑えることができる。
また、クロック信号生成部114によりクロック信号の周波数が低減されている状態で、CPU12により新たな開始アドレスが設定された場合、クロック信号生成部114によって、クロック信号の周波数が、低減される前のクロック信号の周波数に復帰される。したがって、クロック信号の周波数が低減されている状態で、新たな開始アドレスが設定された場合、クロック信号の周波数が、低減される前の元の周波数に復帰されるので、現在表示されている表示画像から異なる表示画像に変わったとしても、クロック信号の周波数を切り替えることにより、違和感のない表示画像に切り替えることができる。
なお、複写機、プリンタ機、スキャナ機、ファクシミリ機、又は複写機能、プリンタ機能、スキャナ機能及びファクシミリ機能等を有する複合機等の画像形成装置には、通常モードから省電力モード(スリープモード)に切り替え可能なものがある。そこで、画像形成装置が上記の表示制御装置1を備え、通常モードからスリープモードに切り替わったか否かを判断し、通常モードからスリープモードに切り替わった場合、クロック信号生成部114へ速度低減信号CLK_ENを出力してもよい。
すなわち、画像を形成する画像形成装置は、通常モードと通常モードよりも消費電力を抑えた省電力モードとを切り替えるモード切替部と、図1に示す表示制御装置1とを備える。そして、外部メモリ13は、通常モードに対応する表示データと省電力モードに対応する表示データとを記憶し、CPU12は、モード切替部によって通常モードから省電力モードに切り替えられた場合、外部メモリ13における省電力モードに対応する表示データの開始アドレスを設定し、開始アドレス記憶部15は、CPU12によって設定された開始アドレスを記憶し、割り込み発生部113は、開始アドレス記憶部15に記憶されている開始アドレスが所定期間以上変化していないことを検出し、割り込み発生部113によって開始アドレスが所定期間以上変化していないことが検出された場合、クロック信号生成部114は、外部メモリ13からLCDモジュール14へ当該表示データを転送するクロック信号の周波数を低減する。また、モード切替部によってスリープモードから通常モードへ切り替えられた場合、CPU12は、クロック信号生成部114へ速度復帰信号RES_CLKを出力してもよい。
このように、画像形成装置のように通常モードから省電力モードに切り替えられ、所定期間同じ表示画像がLCDモジュール14に表示される場合、クロック信号の周波数を低減させることによってメモリへのアクセス頻度を低減させ、簡易的な構成により消費電力を抑えることができる。
1 表示制御装置
11 LCDコントローラ
12 CPU
13 外部メモリ
14 LCDモジュール
111 メモリI/F部
112 表示制御部
113 割り込み発生部
114 クロック信号生成部
11 LCDコントローラ
12 CPU
13 外部メモリ
14 LCDモジュール
111 メモリI/F部
112 表示制御部
113 割り込み発生部
114 クロック信号生成部
Claims (4)
- クロック信号に同期して表示データを表示装置に出力する表示制御装置であって、
表示装置に表示する表示データを記憶する表示データ記憶手段と、
前記表示データ記憶手段における前記表示データの開始アドレスを設定するアドレス設定手段と、
前記アドレス設定手段によって設定された開始アドレスを記憶するアドレス記憶手段と、
前記アドレス記憶手段に記憶されている開始アドレスが所定期間以上変化していないことを検出する検出手段と、
前記検出手段によって開始アドレスが所定期間以上変化していないことが検出された場合、前記表示データ記憶手段から表示装置へ当該表示データを転送するクロック信号の周波数を低減するクロック信号低減手段とを備えることを特徴とする表示制御装置。 - 前記クロック信号低減手段は、前記検出手段によって開始アドレスが所定期間以上変化していないことが検出された場合、前記クロック信号の周波数を分周し、周波数を分周した前記クロック信号を前記表示装置へ出力することを特徴とする請求項1記載の表示制御装置。
- 前記クロック信号低減手段によってクロック信号の周波数が低減されている状態で、前記アドレス設定手段によって新たな開始アドレスが設定された場合、前記クロック信号の周波数を元の周波数に復帰させるクロック信号復帰手段をさらに備えることを特徴とする請求項1又は2記載の表示制御装置。
- 画像を形成する画像形成装置であって、
通常モードと、前記通常モードよりも消費電力を抑えた省電力モードとを切り替えるモード切替手段と、
前記通常モードに対応する表示データと前記省電力モードに対応する表示データとを記憶する表示データ記憶手段と、
前記モード切替手段によって前記通常モードから前記省電力モードに切り替えられた場合、前記表示データ記憶手段における前記省電力モードに対応する表示データの開始アドレスを設定するアドレス設定手段と、
前記アドレス設定手段によって設定された開始アドレスを記憶するアドレス記憶手段と、
前記アドレス記憶手段に記憶されている開始アドレスが所定期間以上変化していないことを検出する検出手段と、
前記検出手段によって開始アドレスが所定期間以上変化していないことが検出された場合、前記表示データ記憶手段から表示装置へ当該表示データを転送するクロック信号の周波数を低減するクロック信号低減手段とを備えることを特徴とする画像形成装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004287163A JP2006098944A (ja) | 2004-09-30 | 2004-09-30 | 表示制御装置及び画像形成装置 |
Applications Claiming Priority (1)
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JP2004287163A JP2006098944A (ja) | 2004-09-30 | 2004-09-30 | 表示制御装置及び画像形成装置 |
Publications (1)
Publication Number | Publication Date |
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008176730A (ja) * | 2007-01-22 | 2008-07-31 | Ricoh Co Ltd | 画像形成装置及びその制御方法 |
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2004
- 2004-09-30 JP JP2004287163A patent/JP2006098944A/ja active Pending
Cited By (1)
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