JP2005353908A - スタック実装構造 - Google Patents
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Abstract
【課題】 小型化が可能となるスタック実装構造を提供する。
【解決手段】 本発明に係るスタック実装構造20は、実装基板24上に、電子デバイスが複数段積み重ねられて実装されたスタック実装構造において、最下段の電子デバイス21が、バンプ22を介してはんだ23により実装基板24上にフリップチップ実装され、2段目以降の電子デバイス25、28が、各下段側の電子デバイスを覆うようにして、各電子デバイス25、28に複数段に形成されたバンプ26、29を介してはんだ23により実装基板24上にフリップチップ実装されていることを特徴とする。
【選択図】 図1
【解決手段】 本発明に係るスタック実装構造20は、実装基板24上に、電子デバイスが複数段積み重ねられて実装されたスタック実装構造において、最下段の電子デバイス21が、バンプ22を介してはんだ23により実装基板24上にフリップチップ実装され、2段目以降の電子デバイス25、28が、各下段側の電子デバイスを覆うようにして、各電子デバイス25、28に複数段に形成されたバンプ26、29を介してはんだ23により実装基板24上にフリップチップ実装されていることを特徴とする。
【選択図】 図1
Description
本発明は、半導体チップ等の電子デバイスを実装基板上に多段に搭載できるスタック実装構造に関する。
図3は、従来の一般的なスタック実装構造10の説明断面図である。
実装基板12上に、最下段の電子デバイス(半導体チップ)13がフェイスアップの状態で接着剤によって固定され、この電子デバイス13の電極と実装基板12上の電極(パッド)とが、ボンディングワイヤ14によって電気的に接続されている。この電子デバイス13上にスペーサ15が接着剤によって固定され、スペーサ15上に2段目の電子デバイス16がフェイスアップ状態で接着剤によって固定され、この電子デバイス16がボンディングワイヤ17によって実装基板12に電気的に接続される。上記と同様にして、3段目以降の電子デバイス18がスペーサ15を介して搭載され、ボンディングワイヤ19によって実装基板12に電気的に接続され、このようにして多層のスタック実装構造10が形成される。
スペーサ15は、電子デバイス16、17とボンディングワイヤ14、17との干渉を避けるため、電子デバイス13、16、17間に所要の間隙を確保するために必要となる。
実装基板12上に、最下段の電子デバイス(半導体チップ)13がフェイスアップの状態で接着剤によって固定され、この電子デバイス13の電極と実装基板12上の電極(パッド)とが、ボンディングワイヤ14によって電気的に接続されている。この電子デバイス13上にスペーサ15が接着剤によって固定され、スペーサ15上に2段目の電子デバイス16がフェイスアップ状態で接着剤によって固定され、この電子デバイス16がボンディングワイヤ17によって実装基板12に電気的に接続される。上記と同様にして、3段目以降の電子デバイス18がスペーサ15を介して搭載され、ボンディングワイヤ19によって実装基板12に電気的に接続され、このようにして多層のスタック実装構造10が形成される。
スペーサ15は、電子デバイス16、17とボンディングワイヤ14、17との干渉を避けるため、電子デバイス13、16、17間に所要の間隙を確保するために必要となる。
従来の上記スタック実装構造10のものでは、各段の電子デバイスをボンディングワイヤにより実装基板12に電気的に接続する構造のものとなっているので、実装基板12にボンディングワイヤを張るスペースが必要となり、全体のサイズが大きくなってしまうという課題がある。
また、ボンディングワイヤとの干渉をさけるためのスペーサ15が必須となり、やはり大型化すると共に、製造工数も増加し、コストアップの要因となっていた。
そこで、本発明は上記課題を解決すべくなされたもので、その目的とするところは、小型化が可能となるスタック実装構造を提供するにある。
また、ボンディングワイヤとの干渉をさけるためのスペーサ15が必須となり、やはり大型化すると共に、製造工数も増加し、コストアップの要因となっていた。
そこで、本発明は上記課題を解決すべくなされたもので、その目的とするところは、小型化が可能となるスタック実装構造を提供するにある。
本発明に係るスタック実装構造は、実装基板上に、電子デバイスが複数段積み重ねられて実装されたスタック実装構造において、最下段の電子デバイスが、バンプを介してはんだにより実装基板上にフリップチップ実装され、2段目以降の電子デバイスが、各下段側の電子デバイスを覆うようにして、各電子デバイスに複数段に形成されたバンプを介してはんだにより実装基板上にフリップチップ実装されていることを特徴とする。
また、バンプが各電子デバイスの下面側の周縁部に設けられていることを特徴とする。
また、バンプが金バンプであることを特徴とする。
また、フリップチップ実装された最上段の電子デバイス上に、さらに電子デバイスが1または複数段積層され、この積層された電子デバイスが、実装基板上にボンディングワイヤにより電気的に接続されていることを特徴とする。
また、バンプが金バンプであることを特徴とする。
また、フリップチップ実装された最上段の電子デバイス上に、さらに電子デバイスが1または複数段積層され、この積層された電子デバイスが、実装基板上にボンディングワイヤにより電気的に接続されていることを特徴とする。
また、フリップチップ実装された電子デバイスの実装基板との間の間隙および各電子デバイス間の間隙にアンダーフィル樹脂が充填されると共に、電子デバイスが封止樹脂により封止されていることを特徴とする。
本発明に係るスタック実装構造によれば、ボンディングワイヤを張るための広いスペースが必要なく、またスペーサを介在させなくともよいので、より小型化できるという効果がある。
以下本発明における最良の実施の形態を添付図面と共に詳細に説明する。
図1はスタック実装構造20の第1の実施の形態を示す説明断面図であり、以下製造方法と共に説明する。
まず、最下段の電子デバイス(本実施の形態では半導体チップ)21を、バンプ22を介してはんだ23により実装基板24上にフリップチップ実装して搭載する。
図1はスタック実装構造20の第1の実施の形態を示す説明断面図であり、以下製造方法と共に説明する。
まず、最下段の電子デバイス(本実施の形態では半導体チップ)21を、バンプ22を介してはんだ23により実装基板24上にフリップチップ実装して搭載する。
バンプ22は、金バンプが好適であり、公知のバンプボンダーにより、キャピラリから金線を引き出し、金線先端を加熱して金ボールに形成し、この金ボールを電子デバイスのパッドに接合し、金線を金ボールの直近で切断することによって形成できる。 バンプ22は、電子デバイス21の下面側(回路が形成されている側)の所要周縁部に回路を囲むようにして形成される。
また、はんだ23は、あらかじめ実装基板24上に公知の方法により形成しておく。
また、はんだ23は、あらかじめ実装基板24上に公知の方法により形成しておく。
バンプ22が形成された電子デバイス21を、回路側を下向きにして、すなわちフェイスダウンの状態で、実装基板24上に位置決めして配置し、電子デバイス21の上面にボンディングツール(図示せず)を押し当て、ボンディングツールによりバンプ22を介してはんだ23を加熱して、はんだ23を溶融することによって、電子デバイス21を実装基板23上にフリップチップ接続することができる。
2段目の電子デバイス25は最下段の電子デバイス21よりも大きなサイズに形成されている。そして、その下面側(回路が形成されている側)の所要周縁部に、回路を囲むようにして、複数段(図示の例では3段)の金ボールからなるバンプ(複数段のバンプ)26が形成されている。バンプ26は、まず1つの金ボールからなるバンプを形成し、このバンプ上に同様にして金ボールからなるバンプを次々団子状に積み重ねるようにして形成することによって作成できる。
用いる金線の太さ等によって、金ボールの大きさを調整できる。したがって、金ボールの大きさや、積み重ねる金ボールの数によって、バンプ26の高さを自在に調整できる。
上記のようにしてバンプ26を形成した電子デバイス25を、下段側の電子デバイス21を覆うようにして、上記と同様にボンディングツールを用い、バンプ26を介してはんだ23を溶融して実装基板24上にフリップチップ実装する。
上記のようにしてバンプ26を形成した電子デバイス25を、下段側の電子デバイス21を覆うようにして、上記と同様にボンディングツールを用い、バンプ26を介してはんだ23を溶融して実装基板24上にフリップチップ実装する。
3段目の電子デバイス28も同様にして、下面側の回路を囲むようにして複数段(図示の例では4段)の金ボールからなるバンプ29を形成し、下段側の電子デバイス25を覆うようにして、上記と同様にボンディングツールを用い、バンプ29を介してはんだ23を溶融して実装基板24上にフリップチップ実装する。
このようにして、適宜複数段の電子デバイスをフリップチップ実装できる。
このようにして、適宜複数段の電子デバイスをフリップチップ実装できる。
フリップチップ実装された電子デバイス21、25、28の実装基板24との間の間隙、および各電子デバイス21、25、28間の間隙にアンダーフィル樹脂を充填すると共に、電子デバイス21、25、28を封止樹脂30により封止することによって、樹脂封止されたスタック実装構造20を形成できる。
なお、31は実装基板24の下面側に設けられた外部接続用のバンプである。実装基板24は公知の単層または多層の配線パターン(図示せず)を有する。
なお、31は実装基板24の下面側に設けられた外部接続用のバンプである。実装基板24は公知の単層または多層の配線パターン(図示せず)を有する。
上記のように、本実施の形態に係るスタック実装構造20では、バンプ26の高さを調整することによって、下段側の電子デバイスとの間に僅かの隙間が生じるようにして上段側の電子デバイスを実装、搭載できるので、従来のようにスペーサが必要でなく、高さの低いスタック実装構造を形成できる。
また、実装基板24にワイヤボンディングのためのスペースが必要でないので、小型のスタック実装構造となる。
また、実装基板24にワイヤボンディングのためのスペースが必要でないので、小型のスタック実装構造となる。
図2はスタック実装構造20の他の実施の形態を示す説明断面図である。
本実施の形態でも、上記実施の形態と同様にして、実装基板24上に多段(図示の例では2段)の電子デバイス21、25をバンプ22、26を介してはんだ23によりフリップチップ実装する。
本実施の形態でも、上記実施の形態と同様にして、実装基板24上に多段(図示の例では2段)の電子デバイス21、25をバンプ22、26を介してはんだ23によりフリップチップ実装する。
本実施の形態では、さらに、フリップチップ実装された最上段の電子デバイス25上に、さらに電子デバイス32を接着剤等によってフェイスアップ状態で固定、積層し、この積層された電子デバイス32の電極と、実装基板24上のパッドとをボンディングワイヤ33により電気的に接続している。
そして、これら電子デバイス21、25、32を封止樹脂30で封止して、樹脂封止されたスタック実装構造20を形成している。電子デバイス32上にさらにスペーサを介して多段に電子デバイスを積層し、これら電子デバイスと実装基板24との間をボンディングワイヤによって電気的に接続するようにしてもよい。
20 スタック実装構造
21、25、28、32 電子デバイス
22、26、29 バンプ
23 はんだ
24 実装基板
30 封止樹脂
31 バンプ
33 ボンディングワイヤ
21、25、28、32 電子デバイス
22、26、29 バンプ
23 はんだ
24 実装基板
30 封止樹脂
31 バンプ
33 ボンディングワイヤ
Claims (5)
- 実装基板上に、電子デバイスが複数段積み重ねられて実装されたスタック実装構造において、
最下段の電子デバイスが、バンプを介してはんだにより実装基板上にフリップチップ実装され、
2段目以降の電子デバイスが、各下段側の電子デバイスを覆うようにして、各電子デバイスに複数段に形成されたバンプを介してはんだにより実装基板上にフリップチップ実装されていることを特徴とするスタック実装構造。 - バンプが各電子デバイスの下面側の周縁部に設けられていることを特徴とする請求項1記載のスタック実装構造。
- バンプが金バンプであることを特徴とする請求項1または2記載のスタック実装構造。
- フリップチップ実装された最上段の電子デバイス上に、さらに電子デバイスが1または複数段積層され、この積層された電子デバイスが、実装基板上にボンディングワイヤにより電気的に接続されていることを特徴とする請求項1〜3いずれか1項記載のスタック実装構造。
- フリップチップ実装された電子デバイスの実装基板との間の間隙および各電子デバイス間の間隙にアンダーフィル樹脂が充填されると共に、電子デバイスが封止樹脂により封止されていることを特徴とする請求項1〜4いずれか1項記載のスタック実装構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004174341A JP2005353908A (ja) | 2004-06-11 | 2004-06-11 | スタック実装構造 |
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007288003A (ja) * | 2006-04-18 | 2007-11-01 | Sharp Corp | 半導体装置 |
US8573748B2 (en) | 2010-03-01 | 2013-11-05 | Canon Kabushiki Kaisha | Recording head |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002033441A (ja) * | 2000-07-14 | 2002-01-31 | Mitsubishi Electric Corp | 半導体装置 |
JP2003051580A (ja) * | 2001-08-03 | 2003-02-21 | Seiko Epson Corp | 半導体装置及びその製造方法 |
JP2004079923A (ja) * | 2002-08-22 | 2004-03-11 | Fujitsu Ltd | 半導体装置及びその製造方法 |
JP2005317862A (ja) * | 2004-04-30 | 2005-11-10 | Shinko Electric Ind Co Ltd | 半導体素子の接続構造 |
-
2004
- 2004-06-11 JP JP2004174341A patent/JP2005353908A/ja active Pending
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