JP2005294632A - 表面実装素子の半田付け構造 - Google Patents
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Abstract
【解決手段】 素子本体2と、素子本体2より突出された第1〜第3リード端子3,4,5から表面実装素子1が構成され、第1〜第3リード端子3,4,5を基板10に半田付けする表面実装素子1の半田付け構造であって、基板10には、第1〜第3リード端子3,4,5に対応する位置に端子用ランド11,12,13と素子本体2に対応する位置に素子本体用ランド14を設け、端子用ランド11,12,13とリード端子3,4,5間に半田16を配置すると共に、素子本体用ランド14と素子本体2間に半田16を配置し、その半田16の配置位置を表面実装素子1の重心位置Oを中心として半田量を含めてほぼバランスを取る位置とした。
【選択図】 図1
Description
2 素子本体
3 第1リード端子(リード端子)
4 第2リード端子(リード端子)
5 第3リード端子(リード端子)
10 基板
11,12,13 端子用ランド
14 素子本体用ランド
16 半田
O 表面実装素子の重心位置
Claims (2)
- 素子本体と、この素子本体より突出されたリード端子とから表面実装素子が構成され、前記リード端子を基板に半田付けするようにした表面実装素子の半田付け構造であって、
前記基板には、前記リード端子に対応する位置に端子用ランドと前記素子本体に対応する位置に素子本体用ランドとを設け、前記各端子用ランドと前記各リード端子との間に半田を配置すると共に、前記素子本体用ランドと前記素子本体との間に半田を配置し、且つ、その半田の配置位置を前記表面実装素子の重心位置を中心として半田量を含めてほぼバランスを取る位置としたことを特徴とする表面実装素子の半田付け構造。 - 前記端子用ランド及び前記素子本体用ランド上に配置する半田は、ランドの面積が大きい場合に複数に分割して配置するようにしたことを特徴とする請求項1に記載の表面実装素子の半田付け構造。
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Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012209408A (ja) * | 2011-03-29 | 2012-10-25 | Seiko Epson Corp | 電子部品の製造方法と配線基板 |
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US9815133B2 (en) | 2014-08-05 | 2017-11-14 | Canon Kabushiki Kaisha | Method for producing a module |
WO2023162578A1 (ja) * | 2022-02-24 | 2023-08-31 | パナソニックIpマネジメント株式会社 | 回路基板および電子部品の実装方法 |
JP7538405B2 (ja) | 2020-08-25 | 2024-08-22 | 株式会社ノーリツ | 電子部品実装基板 |
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2004
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