JP2005251829A - 半導体装置及びその検査方法 - Google Patents
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Abstract
【課題】従来電極パッドとその電極パッド直下の配線層間の絶縁膜に欠陥が生じた場合、この欠陥を検査し、さらに絶縁膜の欠陥が生じた電極パッドを複数電極パッドより特定して検出することができなかった。
【解決手段】本発明における半導体装置は絶縁膜を介して全ての電極パッドの直下を通る配線層を備え、前記電極パッドの少なくとも1つが前記配線層と電気的に接続されたことを特徴とするものである。また本発明における半導体装置の検査方法は前述の半導体装置において配線層に接続された第1の電極パッドと配線層に接続されていない第2の電極パッド間で電圧を印加し、リーク電流を測定することを特徴とするものである。
【選択図】図1
【解決手段】本発明における半導体装置は絶縁膜を介して全ての電極パッドの直下を通る配線層を備え、前記電極パッドの少なくとも1つが前記配線層と電気的に接続されたことを特徴とするものである。また本発明における半導体装置の検査方法は前述の半導体装置において配線層に接続された第1の電極パッドと配線層に接続されていない第2の電極パッド間で電圧を印加し、リーク電流を測定することを特徴とするものである。
【選択図】図1
Description
本発明は、電極パッド直下に絶縁膜を介して配線層を有する半導体装置に関するものであり、特に電極パッド直下の絶縁膜に生じる欠陥を電気的に検出することができる構造をもつ半導体装置及びこの半導体装置の検査方法に関するものである。
半導体素子表面には通常半導体素子外部から半導体素子内部に電力や信号を供給し、半導体内部の電気信号を半導体外部に取り出すために、図3(a)に示すように外部接続用電極である電極パッド1が半導体素子上に複数存在する。現在、この電極パッド1直下に、図3(b)のような絶縁膜4を介して配線層3を形成した構造を有した半導体装置が実用化されている(例えば特許文献1、特許文献2、特許文献3参照)。
特開2000−12633号公報
特開2000−252450号公報
特開2001−127127号公報
図3(b)に示すように電極パッド1直下に絶縁膜4を介して配線層3を有する半導体装置において、プロービングなどのウエハレベルでの検査工程やボンディング及びバンプ形成など組立工程の際電極パッド1を通じて絶縁膜4にストレスがかかり、その結果電極パッド1とその電極パッド直下の配線層3間の絶縁膜4に欠陥7が生じることが懸念されている。このようにして電極パッド1直下の絶縁膜4に欠陥7が発生した状態で電極パッド1と配線層3に電位差が生じるとリーク電流が欠陥7を通して流れるため、半導体装置は正常動作を示さない。
従来、半導体基板に形成された素子間あるいはその素子と配線層間における絶縁膜の破壊を電気的に検査できる半導体装置及びその検査方法が考案され実施されているが、電極パッドとその電極パッド直下の配線層間の絶縁膜に欠陥が生じた場合この欠陥を検査し、絶縁膜の欠陥が生じた電極パッドを複数電極パッドより特定し検出することはできなかった。本発明は電極パッドとその電極パッド直下の配線層間の絶縁膜に生じた欠陥を電気的に検査し、絶縁膜の欠陥が生じた電極パッドを複数電極パッドより特定し検出することを目的とするものである。
本発明における半導体装置は絶縁膜を介して全ての電極パッドの直下を通る配線層を備え、前記電極パッドの少なくとも1つが前記配線層と電気的に接続されたことを特徴とするものである。また本発明における半導体装置の検査方法は前記の半導体装置において配線層に接続された第1の電極パッドと配線層に接続されていない第2の電極パッド間で電圧を印加し、リーク電流を測定することを特徴とするものである。
この半導体装置及び半導体装置の検査方法を用いることで、配線層に接続されていない第2の電極パッド全てにおいて電極パッドとその直下の配線層との間に電圧を印加することが可能となる。また電極パッドとその電極パッド直下の配線層間の絶縁膜に欠陥が生じている場合、その欠陥によって絶縁破壊が生じる。従って電極パッドとその直下の配線層との間に電圧を印加し、そのリーク電流を測定することによって電極パッドと電極パッド直下の配線層間の絶縁膜に生じる欠陥の有無を検査することが可能となる。さらに異なる電極パッドを個々に検査することが可能であるため、絶縁膜の欠陥が生じた電極パッドを複数電極パッドより特定し検出することが可能となる。
配線層が電源配線やアース配線など半導体素子に接続している配線などと接続されている場合、本発明の方法によって検出したリーク電流が前記半導体素子内並びに電源配線あるいはアース配線との間の絶縁膜破壊による可能性がある。このため、配線層は接続された電極パッド以外とは電気的に接続されていないことが望ましい。
また、1つの電極パッド直下の絶縁膜に生じる欠陥をむらなく検出するため、電極直下の配線層の幅が前記電極パッドの幅以上であってもよい。
また、配線層の一部が切断した場合にも全電極パッドとその直下の配線層に電圧を印加できるように配線層がすべての電極パッド直下を通りリング状に形成されていてもよい。
また、半導体装置の構造上配線層をリング状に形成できない場合、配線層が分断され分断された個々の前記配線層に少なくとも1つの電極パッドが接続されている構造を形成してもよい。
本発明における半導体装置及びその検査方法によって、電極パッドと電極パッド直下の配線層間の絶縁膜に生じる欠陥の有無を検査することが可能となる。さらに異なる電極パッドを個々に検査することが可能であるため、絶縁膜の欠陥が生じた電極パッドを複数電極パッドより特定し検出することが可能となる。
図1は本発明の一実施形態である半導体装置を示す。半導体素子上面には図1(a)で示すように複数の電極パッド1と検査用電極パッド2を有する。絶縁膜4を介して全ての電極パッドの直下を通る配線層3を備え、前記検査用電極パッド2は図1(b)のようにヴィア5を通じて前記配線層3と電気的に接続されている。一方で検査用電極パッド2以外の電極パッド1は図1(c)のように配線層3と電気的に接続されていない構造を有する。
図2は本発明の一実施形態である半導体装置を示す。図1では配線層3がリング状に形成されている半導体装置の実施形態を示しているが、図2のように配線層3が分断され、分断された個々の前記配線層3に検査用電極パッド2が接続されている構造を有してもよい。また、図1では配線層に接続している検査用電極パッド2を1つ有する半導体装置の実施形態を示しているが、図2のように検査用電極パッド2が2つ以上存在する構造を有してもよい。
本発明における半導体装置の検査方法の一実施形態は次のとおりである。検査用電極パッド2と電極パッド1に電圧を印加する。この状態で検査用電極パッド2と電極パッド1に流れるリーク電流値を測定する。あらかじめ印加する電圧値に対するリーク電流判断基準値を設定し、検出したリーク電流値がリーク電流判断基準値以下である場合「PASS」を出力し、検出したリーク電流値がリーク電流判断基準値以上である場合「FAIL」を出力する。
この実施形態において検査時すべての電極パッド1を同時に測定してもよい。本発明における検査手法としてプローブ針を用いたウエハレベルでのプローブ検査に限らず、バンプなどプローブ針以外のコンタクターを用いたウエハレベルでのプローブ検査や、パッケージに組み立てた後ソケットを介して行う検査方法でもよい。
本発明における半導体装置及びその検査方法は、電極パッド直下に配線層を有する半導体装置の新たなる品種を開発する段階において、プローブやボンディングなどの欠陥に対する信頼性を評価する際に有用である。さらに、プロービングなどの検査工程やボンディングあるいはバンプ形成などの組立工程の際、電極パッド直下の絶縁膜における欠陥がないように管理する工程管理手法としても有用である。
1 電極パッド
2 検査用電極パッド
3 配線層
4 絶縁膜
5 ヴィア
6 半導体基板
7 欠陥
2 検査用電極パッド
3 配線層
4 絶縁膜
5 ヴィア
6 半導体基板
7 欠陥
Claims (6)
- 絶縁膜を介して全ての電極パッドの直下を通る配線層を備え、前記電極パッドの少なくとも1つが前記配線層と電気的に接続されたことを特徴とする半導体装置。
- 配線層は接続された電極パッド以外とは電気的に接続されていないことを特徴とする請求項1記載の半導体装置。
- 電極直下の配線層の幅が前記電極パッドの幅以上であることを特徴とする請求項1または請求項2記載の半導体装置。
- 配線層がすべての電極パッド直下を通りリング状に形成されていることを特徴とする請求項1〜3のいずれか1項記載の半導体装置。
- 配線層が分断され、分断された個々の前記配線層に少なくとも1つの電極パッドが接続されている請求項1〜3のいずれか1項記載の半導体装置。
- 装置において配線層に接続された第1の電極パッドと配線層に接続されていない第2の電極パッド間で電圧を印加し、リーク電流を測定することを特徴とする半導体装置の検査方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004057208A JP2005251829A (ja) | 2004-03-02 | 2004-03-02 | 半導体装置及びその検査方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004057208A JP2005251829A (ja) | 2004-03-02 | 2004-03-02 | 半導体装置及びその検査方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2005251829A true JP2005251829A (ja) | 2005-09-15 |
Family
ID=35032053
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004057208A Pending JP2005251829A (ja) | 2004-03-02 | 2004-03-02 | 半導体装置及びその検査方法 |
Country Status (1)
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JP (1) | JP2005251829A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7567484B2 (en) | 2006-04-28 | 2009-07-28 | Kawasaki Microelectronics, Inc. | Method of preventing dielectric breakdown of semiconductor device and semiconductor device preventing dielectric breakdown |
JP2013093500A (ja) * | 2011-10-27 | 2013-05-16 | Fuji Electric Co Ltd | 半導体装置およびその試験方法 |
-
2004
- 2004-03-02 JP JP2004057208A patent/JP2005251829A/ja active Pending
Cited By (2)
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