JP2003519395A - 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン - Google Patents

光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン

Info

Publication number
JP2003519395A
JP2003519395A JP2000590149A JP2000590149A JP2003519395A JP 2003519395 A JP2003519395 A JP 2003519395A JP 2000590149 A JP2000590149 A JP 2000590149A JP 2000590149 A JP2000590149 A JP 2000590149A JP 2003519395 A JP2003519395 A JP 2003519395A
Authority
JP
Japan
Prior art keywords
binary
bit
gray scale
plane
read
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2000590149A
Other languages
English (en)
Other versions
JP2003519395A5 (ja
Inventor
ティモシー マーティン コーカー
ウィリアム オルデン クロスランド
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Qinetiq Ltd
Original Assignee
Qinetiq Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Qinetiq Ltd filed Critical Qinetiq Ltd
Publication of JP2003519395A publication Critical patent/JP2003519395A/ja
Publication of JP2003519395A5 publication Critical patent/JP2003519395A5/ja
Pending legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G02OPTICS
    • G02BOPTICAL ELEMENTS, SYSTEMS OR APPARATUS
    • G02B26/00Optical devices or arrangements for the control of light using movable or deformable optical elements
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611Control of matrices with row and column drivers
    • G09G3/3648Control of matrices with row and column drivers using an active matrix
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/2007Display of intermediate tones
    • G09G3/2018Display of intermediate tones by time modulation using two or more time intervals
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2320/00Control of display operating conditions
    • G09G2320/02Improving the quality of display appearance
    • G09G2320/0247Flicker reduction other than flicker reduction circuits used for single beam cathode-ray tubes
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2320/00Control of display operating conditions
    • G09G2320/02Improving the quality of display appearance
    • G09G2320/0257Reduction of after-image effects
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611Control of matrices with row and column drivers
    • G09G3/3648Control of matrices with row and column drivers using an active matrix
    • G09G3/3651Control of matrices with row and column drivers using an active matrix using multistable liquid crystals, e.g. ferroelectric liquid crystals

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Theoretical Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Optics & Photonics (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Liquid Crystal Display Device Control (AREA)
  • Liquid Crystal (AREA)
  • Transforming Electric Information Into Light Information (AREA)

Abstract

(57)【要約】 多重レベルの空間光モジュレーションの方法において、n桁2進数が、2値画素のアレイにおける各ピクセルの場所の予定されたグレイ・レベルを表す、重み付けビット・プレーン技術を使用して、代表的な2進数が、そこにある1及び0の不均等性を低減するために、近接する値に変えられる。前記方法は、グレイ・スケールをいくらか変更する単一のフレームに適用されてもよく、または少なくともいくつかの2進数が、前記フレームのセットに対して、1及び0の不均等性を低減するために、異なるフレームにおいて異なる値に変えられる一方で、前記グレイ・スケールを時間平均として維持しまたはそれに近似する、多重フレーム方法が使用されてもよい。前記方法は、液晶空間アレイ・モジュレータにおけるピクセルに関するdcバランスを維持しまたはそれに近似することに関して、特に有用である。

Description

【発明の詳細な説明】
【0001】 (技術分野) 本発明は、ディスプレイまたはモジュレータによって得られる瞬時の強度分布
(intensity distribution)が本質的にバイナリであるが、時間的に平均した分
布が効果的に、多重の強度レベルを有し、または有するように見える方法で変え
られる、ディスプレイまたは空間光モジュレータを操作する方法に関する。表示
の目的で、これは、前記変更が、好ましくはちらつきを避けて、平均化が目で生
じるくらい十分に迅速でなければならない(must be sufficiently fast for av
eraging to occur at the eye)ことを意味する。この条件は、他の目的に適用
されても、されなくてもよい。
【0002】 (背景技術) 本発明は、個別に扱われるセルまたはピクセルのアレイを具備するもの、及び
バイナリ・イメージが、例えば変調光線の走査によって生成されるものを含む、
バイナリ・イメージを生成することができる空間光モジュレータとの関連で使用
されうる。ここで使用されている「バイナリ空間光モジュレータ」という用語は
、それらが表示目的で使用されても、他の目的で使用されても、例えば情報レコ
ーディング、及び光学システムにおける可変的コンポーネント(例えばレンズ、
フィルタ、及び回折格子)である、すべての装置を含むことを意図する。前記用
語は、存在する光線が、モジュレータによって影響を受ける受動モジュレータ、
及び光源、例えば光エミッタ(light emitter)のアレイ及びエレクトロルミネ
ッセンス装置(electroluminescent devices)として振舞うものも網羅すること
を意図する。
【0003】 ここで使用される「イメージ(image)」という用語は、通常、しかし常にで
はないが、光度(light intensity)の空間的に変化した光分布を示すために使
用され、その結果または結果となる分布は、「ディスプレイ(display)」とい
う用語によって意味される。
【0004】 さらに、「グレイ・スケール」という用語は、ここでは多重レベルの分布を表
すものとして使用されているが、前記用語は、白を含む、色に関連して使用され
ることが明確にされるべきである。さらに、本発明の前記方法、アレイ、バック
プレーン、電気回路等及びその実施形態は、白を含む単一の色(モノクローム・
イメージ)と関連して記述されるが、可変的な着色イメージまたはディスプレイ
等が、例えば単一のアレイを様々な色ピクセルへと、空間的に細分化し、例えば
投影または時間的マルチプレックス(temporal multiplexing)、例えば赤緑及
び青イメージの順次投影(sequential projection)によって、異なる色のモノ
クローム・アレイからディスプレイを重ね合わせることによって、本質的に公知
の方法で生成されるであろう。
【0005】 複数の彩度効果(intensity effect)を達成するための、時間的に可変的なバ
イナリ・モジュレーションが公知であり、複数ビット・プレーンの使用によって
生み出されうる。そのような体系において、前記アレイのピクセルに割り当てら
れたグレイ・スケール値に対応する幅の、デジタル化された値のアレイは、多数
のビット・プレーンに分解される。この複数ビット・プレーン技術は、上述され
たバイナリ空間光モジュレータとともに使用されてもよい。
【0006】 同等な持続時間の、対応する複数のビットプレーンとともに、nレベルのグレ
イ・スケール・イメージを、同等の持続時間の複数のバイナリ・イメージ・プレ
ーンに分解することが可能である。しかしながら、好ましい形態においては、重
み付けビットプレーン技術として公知のとおり、前記ビット・プレーンの持続時
間は重み付けされ、各ビットプレーンはデジタル化の一つのレベル(指数)を表
す。これは、イメージを合成するために必要とされるビット・プレーンの数を低
減させ、扱うための条件をいくらか低減させる。
【0007】 一定の場合においては、2以外のデジタル・ベース(digital base)を使用す
ることができるが、これは各ビット・プレーンがバイナリでない限り、及びそれ
ゆえに簡単に記憶されない限り、問題を複雑にする。さらに、前記ビット・プレ
ーンの各場所は、一つ以上のゼロ以外の値を有するであろうし、(前記非バイナ
リ・プレーンを、さらに二つ以上のバイナリ・プレーンに分解することによって
)前記ビット・プレーンに対するゼロ以外の値における変化は、各ピクセルのオ
ペレーションの持続時間に関して考慮される必要がある。後述の内容は、バイナ
リ重み付けに制限されるが、そのような文脈で述べられる原理は、当業者が、要
求されまたは所望される場合に、他の指数ベース(exponential bases)に外挿
することができるようにするのに十分であると考えられる。
【0008】 デジタル化がバイナリであり、各ビット・プレーンが1及び0のデジタルのア
レイである場合、デジタル化されたグレイ・スケール・イメージと同等の、時間
平均化されたイメージを供給するために、そのバイナリ重み付けに比例する合計
期間、各ビット・プレーンを表示するだけでよい。
【0009】 可能な場合には、グレイ・スケール・イメージにコントリビュートするために
必要な合計持続期間、各バイナリ・ビット・プレーンを一回表示するのが便利で
あるが、すべてのビットプレーンを表示するために費やされる合計時間と相対し
て、各ビットプレーンを表示するために費やされる合計時間が、そのバイナリ重
み付けに比例する場合、必ずしも順番にではなく、複数回、前記ビット・プレー
ンの一つ以上を表示することも可能である。
【0010】 最近、能動半導体バックプレーン(active semiconductor backplane)と共通
フロント電極(common front electrode)との間に配置された、スメクティック
な(smectic)液晶層の形式の、革新的な空間光モジュレータが開発された。そ
れは迅速で、かつ可能であれば高価でない、表示装置としてだけではなく、相関
及びホログラフィック・スイッチ等、他の形式の光学処理に関しても潜在的な応
用を有する、相対的に大きな数のピクセル(320×240乃至640×480
)を具備する空間光モジュレータに対する要求に応答して開発された。それが駆
動される方法、及び適用される電圧の値によって、前記モジュレータは、少なく
とも10MHzのライン・レート(line rate)及び15乃至20kHzまでの
フレーム・レート(frame rate)で駆動されてもよく、1秒あたり、およそ1乃
至1.5Gピクセルのデータ入力を必要とする。典型的には、前記ピクセル・ア
ドレス時間は、およそ100ナノ秒である一方で、前記ピクセルは実際には、光
学状態間で切り替えるのに、およそ1乃至5マイクロ秒かかる;全体のフレーム
書き込み時間が24マイクロ秒のオーダである一方で、フレームからフレームの
書き込み期間は、およそ80マイクロ秒である。
【0011】 この空間光モジュレータは、単一パス体系に従って駆動されることができ、そ
こではフロント電極は、バックプレーン・ピクセルに相対して、V/2の電位で
配置され、それはゼロ・ボルトまたはVボルトに切り替えられる。
【0012】 代替的に、それは、一つのパスにおいて、フロント電極がゼロ・ボルトで配置
され、選択されたピクセルが、バックプレーン・アレイのピクセル・エレメント
をVボルトに切り替えることによって、ONにされ、他方のパスにおいては、フ
ロント電極はVボルトに配置され、選択されたピクセルは、前記アレイのエレメ
ントをゼロ・ボルトに切り替えることによってOFFにされる、二重のパス体系
に従って駆動されうる。切り替えられる処理に置かれていないピクセルに関して
は、バックプレーンのエレメントは、フロント電極の電圧に従う。それらの間で
同じ電位差を維持するために、前記アレイのすべてのバックプレーン・ピクセル
・エレメントにおける電圧は、フロント電極における電圧が、ゼロとVボルトの
間で変化すると同時に切り替えられる。
【0013】 本出願人の、係属中の国際特許出願(参照:P20957WO、優先権GB9
827952.4;P20958WO及びP20958WO1、双方の優先権G
B9827965.6;P20959WO、優先権GB9827900.3;P
20960WO、優先権GB9827901.1;P20961WO、優先権G
B9827964.9;P20962WO、優先権GB9827945.8;及
びP20963WO1、優先権GB9827944.1)は、前の段落において
参照された単一及び二重のパス体系を含む、この空間光モジュレータに関連した
他の本発明の特徴に関する。
【0014】 前述の空間光モジュレータは、理想的に、上述のビットプレーン技術の使用に
適している。しかしながら、本発明は、液晶モジュレータに限定されず、上述さ
れたあらゆる空間光モジュレータに応用することができる。
【0015】 特に液晶ディスプレイ及びモジュレータを操作する時に生じる本出願人の問題
は、個別のピクセルにおいてdcバランスを維持することである。最初は、液晶
光モジュレータは、少なくとも一つは透明である、反対の電極を有するプレート
の間にはさまれた液晶物質の層を具備する単一のセルの形式であった。そのよう
なセルは、動作が遅く、液晶物質の劣化により寿命が短くなりがちであった。ご
く初期に、液晶セルへの、平均的有限dc電圧(average finite dc voltage)
の応用は有効ではないことが認識され、少なくともある場合においては、液晶物
質それ自身の電解による劣化が生じ、平均dc電圧をゼロにするような体系が展
開された(dcバランス)。
【0016】 dc電圧が適用される時に、他の効果も稼動しているということが、評価され
ている。ある長さの時間、液晶電子光学装置を駆動する時、イメージ・スティッ
キング(image sticking)として知られる現象が生じるかもしれない。この効果
の詳細な原因は未知であるが、イオンが捕えられ、または空間電荷が、全体のd
c場に応答して前記物質の中で誘導されるという理論があり、これによって、外
部dc場が除去される時でさえも、残りの場が結果として生まれる。
【0017】 劣化を避けるため、またはイメージ・スティッキングを避けるために、液晶物
質に加えられる時間平均電圧(すなわち、電圧が実際に、外部ソースから液晶に
加えられている時間に対する平均)がゼロであることが望ましいのは明らかであ
る。
【0018】 本発明は、少なくともビット・プレーンのいくつかが変更される、上述の重み
付けビット・プレーン技術のためのものである。それは特に、しかし排他的でな
い関連性を、ディスプレイの目的で、有効なグレイ・スケール強度分布の生成に
関して有しており、バイナリ・イメージの有効な持続時間(長さ及び/または繰
返しの数)は、例えば見る人による、それの時間的統合が、グレイ・スケール・
イメージを与えるものである。
【0019】 一つのグレイ・スケール・イメージに関する異なるビット・プレーンは、順番
のバイナリ文字列としてコンピュータに記憶されることができ、前記イメージが
繰り返される必要がない限り、それらが廃棄されうる所望の順番で、1回に一つ
、読み取られるであろう。計算上、それらが記憶された順番で、ビット・プレー
ンを読み取るのが最も簡単であるのは、記憶される必要がある唯一のアドレスは
、最初に記憶されたビット・プレーンの開始アドレスだからであり、すべてのビ
ット・プレーンは、単に、各ビット・プレーンに関して、順番に予め決められた
数のデータ・ビットを計時する(clock out)ことによって、1回に一つが読み
取られる。
【0020】 特に、ビット・プレーンが、リアルタイムで生成されている場合に、連続する
イメージに関してビット・プレーンと、読み取られたビット・プレーンを取りか
えることが、すぐに可能であるかもしれない。しかしながら、他の状況において
は、これは困難であり、連続するイメージに関するビット・プレーンのセットは
、通常は他のところに記憶されるであろう。一定の場合において、そのうちの一
つが書き込まれている一方で、他方は読み取られる、及びその反対である二つだ
けのビット・プレーンのために、記憶装置を供給することが可能であろう。
【0021】 イメージ標準を所望のとおりに変換するために、例えばライン・シーケンシャ
ル(line sequential)から飛び越し走査(interlaced)に変換するために、読
み取り及び/または書き込み処理を制御することも可能であろう。
【0022】 各ビット・プレーンがメモリから読み取られる時またはその後、それは、例え
ば、上述の単一パス体系を使用して書き込まれ、及び目が予定されたグレイ・ス
ケール・イメージを合成するように、その重み付けに対応する期間中、観察され
る。単一パス体系は、第二のパスに対する必要性なく、前のビット・フレームを
単に上書きし、関連するフロント電極はパルスを切り替え及び消去する限りは、
好ましい。連続する有効イメージの間の損失時間の回避によって、連続した照明
及び正確に重み付けされた持続時間のビット・フレームのより簡単な供給が可能
になる。
【0023】 そのような体系において、各ピクセルは、それが表すグレイ・スケールにおけ
る点に従って、一連の電圧パルスにさらされる(グレイ・スケール・レベルを表
す数であり、通常そのオーダであるが必ずしもそうとは限らない)。使用される
重み付けによって、電圧の応用があるよりも、グレイ・スケールには多くの点が
あり、それは前記アレイを実際に駆動するために費やされる時間を低減するので
、効果的である。各適用される電圧は、前の電圧と比較して、同じか、または反
対の極であってもよく、ビット・プレーンの数と等しい(極は無視する)、同じ
数の電圧パルスが、イメージを合成するために各ピクセルに加えられる。
【0024】 例えば、バイナリ重み付けを伴う64レベル・グレイ・スケールにおいて、n
が0から5の間で変化する2tの相対的持続時間を有する6ビット・プレーン
があり、各ピクセルは、対応する6桁2進数で表すことができる。
【0025】 しかしながら、ニ重パス体系は、代替的に、複数の、または重み付けされたビ
ット・プレーン体系における使用に適応しうる。
【0026】 dcバランスを達成するために、それ自身がdcバランスを生み出すあらゆる
バイナリ・イメージング方法―例えば、ブランク・イメージ(blank image)か
ら開始し、書き込み、観察、及び選択されたピクセルのみの選択的加圧(+V)
及びドリブン・ブランキング(driven blanking)(−V)によってバイナリ・
イメージを消去することにより、各バイナリ・ビット・プレーンを生成すること
が可能であろう。
【0027】 しかしながら、そのような体系のほとんどまたはすべてにおいて、例えば、介
在するブランキング・ステップ(blanking step)等により、バイナリ・イメー
ジの実際の持続時間は、それに割り当てられる時間に対して、直接比例せず、ビ
ット・プレーン期間のバイナリ性質における一定の度合いの歪み、それによって
認められるグレイ・スケール値につながる。これは、所望されれば補うことがで
きる一方で、さらに複雑になることを表す。
【0028】 本発明は、dcバランスが、本質的にdcバランスが取れたバイナリ・イメー
ジを採用すること以外の方法で、アプローチされまたは達成される、複数のまた
は重み付けビット・プレーン体系を供給する。
【0029】 選択されたピクセルに関して、各グレイ・スケール・レベルは、2進数で表示
することができ、均等な数の0及び1の桁を有する一定の2進数、例えば111
000及び010101がある。これらの場合、6ビット・プレーンに対する平
均dc電圧はゼロになるであろう。他の2進数、例えば011000及び010
001は、この理想に近づき、他、特に111111及び000000は、そこ
から除去される(far removed therefrom)。
【0030】 前記体系においてdcバランスを達成するために、他の可能性は、(a)それ
ら自身でdcバランスを達成する数のみを使用すること、または(b)少なくと
も、dcバランスに近くアプローチする近接した数に、グレイ・スケール数を変
えることである。これによって、単一または二重パス体系(上述の内容、及び本
出願人の係属中の出願P20961WO及び20962WOを参照)の使用が可
能になり、各走査中にすべてのエレメントを扱う。これらの体系のいくつかは、
本質的に、通常は固有のdcバランスを供給しないが、この場合においては、d
cバランスまたは少なくともそれらの近似が、グレイ・スケール・イメージング
時間に対して得られうる。
【0031】 第一の例(a)においては、所望のグレイ・レベルが異なっており、値の最も
近い数によって近似され、例えば000110は000111になり、1000
10は100011になる。欠点は、グレイスケールの顕著な歪みがありうるこ
とである。
【0032】 第二の例(b)においては、前記グレイスケールの歪みは低減されうるが、精
密なdcバランスは犠牲になる。例えば、001000という数は001001
になり、110111は110110になるかもしれない。
【0033】 いずれの例においても、さらなる変更的ステップが取られない限り、グレイ・
スケールの極値は省略され(例えば、隣接する、より小さい極値と取り替えられ
る)、コントラスト範囲をいくらか低減させまたは圧縮する。
【0034】 従って、本発明は、重み付けビット・プレーン技術を使用してグレイ・スケー
ル・イメージングの方法を供給し、そこにおいては、n桁の2進数は2値画素の
アレイにおける各ピクセルの場所の予定されたグレイ・レベルを表し、少なくと
も一つの前記2進数は、不均等な数の1及び0を有し、前記方法は、1及び0の
不均等性を低減させるように、前記数を隣接する値に変えるステップを具備する
(単一のイメージ方法)。
【0035】 詳細において、dc及びグレイ・スケール・レベルの両方の時間平均化は、2
進数の適切な選択によって、1つ以上のフレームに対して実行される。この方法
において、dcバランスは、近接して近似し、または好ましくは到達されること
ができる一方で、平均グレイ・スケール・レベルが近似され、または好ましくは
維持されうる。例えば、110110(27)は第一のフレームにおいて001
110(28)と取り替えられ、第二のグレームにおいて010110(26)
と取り替えられる。平均グレイ・スケール・レベルは所望のとおり27であり、
実際に使用される両方の2進数は、本質的にdcバランスを供給する。
【0036】 より複雑な例において、グレイ・スケール・レベル15(111100)は、
グレイ・レベル14(011100)のための追加のフレーム及びグレイ・レベ
ル16(000010)のためのさらに他のフレームとともに、2回使用される
ことができ、前記フレームは所望の順番である。四つのフレームに対して、平均
グレイ・レベルは15であり、均等な数の2進数、1及び0がある。
【0037】 従って、本発明はまた、重み付けビット・プレーン技術を使用して、グレイ・
スケール・イメージを書き込み及び表示する方法も供給し、そこではn桁の2進
数は、2値画素のアレイにおける各ピクセルの場所の予定されたグレイ・レベル
を表し、少なくとも一つの前記2進数は、不均等な数の1及び0を有し、そこで
は前記グレイ・スケール・イメージに近似する複数のイメージが連続して書き込
まれ、前記方法は、1及び0の不均等性を低減するために、前記複数のイメージ
に対して、前記数を、近接する値に変えるステップを具備する(複数のイメージ
方法)。好ましくは、前記不均等性は排除される。前記複数のイメージに対して
計測されるグレイ・スケールは、少なくとも近似するが、好ましくは維持される
【0038】 再度、グレイ・スケールの極値は、好ましくは省略される。いずれの場合も、
完全なグレイ・スケール範囲が維持され、dcバランスは、他の手段、例えば、
上述のように、蓄積したdcインバランスのコンピュータ・シミュレーションに
従って適切に、変更dcパルスを加えることによって、周期的に回復することが
できる。しかしながら、これが通常好まれないのは、少なくとも一つのピクセル
が、イメージ期間中、グレイ・スケール極値に維持される可能性のために、使用
されたビット・プレーンの数に等しい、多くの変更dcパルスを使用することを
潜在的に伴うからである。
【0039】 グレイ・スケール・イメージングにおいてdcバランスを維持するこれらの方
法は、少なくとも部分的に、グレイ・スケール・レベルの数と比較した、アドレ
ス・ステップの数の減少から生じる。複数の、または重み付けビット・プレーン
体系のオペレーションにおける使用のために、グレイ・スケール値またはグレイ
・スケール値の組み合わせを抽出する一つの方法、すなわち、予定されたイメー
ジ自身から抽出された入力グレイ・スケール値を取り替えることは、ルックアッ
プ・テーブルの手段による。
【0040】 上述のとおりに操作される重み付けビットプレーン方法は、液晶ピクセルの緩
和(relaxation)が、最長のビットプレーンの持続期間中、無視されることを必
要とし、これは常に可能とは限らない。そのような場合、前記ビットプレーンは
、ビットプレーン期間中にリフレッシュされうるが、dcバランスを犠牲にする
可能性がある。しかしながら、正確に蓄積されたグレイ・スケールを入手する場
合には、効果的である。
【0041】 基本的に、リフレッシュ・ステップは、ピクセルの切り替えられた状態を回復
するために、ビットプレーンの開始時に加えられたのと同じ電圧を繰り返し加え
ることを含む。n番目の電力バイナリ重み付けビットプレーンは、リフレッシュ
書き込みステージが含まれる場合、2グレイスケールが、バイナリ・イメージ
の2フレーム書き込みを伴うように、第一の書き込みに続いて、(2−1)
回リフレッシュされる必要があるかもしれない。しかしながら、書き込みステッ
プの増加する数は、dcバランスを供給する方向で、本発明に従ってビット・フ
レームを変えることをより困難にし、2フレーム書き込みの制限において、本
発明はうまく適用されることができない。
【0042】 しかしながら、リフレッシングが、より長い持続期間のビットプレーンを有す
るもののみ必要である場合がある。そのような場合、上述されたとおり、ピクセ
ルを記述する実際の2進数を使用して、本発明に従った方法を実行することが、
ここでも可能になるであろう。しかしながら、本発明に従った好ましい方法は、
リフレッシュされた値を含む、全体のフレーム(単一イメージ方法)または複数
のフレーム(複数イメージ方法)に対して生じる、1及び0の集合を決定するこ
とによって、及び不均等性を低減させることを決定したとおり、1及び0の不均
等性を有するピクセルに関して、前記数を変えることによって実行される。すな
わち、この好ましい方法は、リフレッシュの必要性に従って拡張されたとおり、
各ピクセルに関する2進数上で動作する。
【0043】 例えば、4桁のピクセルのみを具備する2進数によって表される簡単なピクセ
ルの例を取ってみると、高い順に最初の2桁は、リフレッシュされる必要がある
が、3番目及び4番目は、リフレッシュされる必要なく表示されることができ、
最長のビット・プレーンは4回、次に長いものは2回、リフレッシュする必要が
あるであろう。1001という数を取ってみると、これは(1111)(00)
01になり、括弧は、5単位の値を有するが3つの0しか有しない、本来の桁を
区別する。本来の数を1000に変換することで、拡張された数(111100
00)における値の均等性を与える。
【0044】 リフレッシュ体系において、ビットプレーンは、その持続時間によって、1回
以上読み取られる。このように、その最後の読み取りを受けるまで、ビットプレ
ーンを廃棄することはできない。さらに、各ビット・プレーンが次のビットフレ
ームに進む前に、必要とされる回数だけ繰返し読み取られる場合、2つのビット
プレーンの開始アドレスを記憶する必要がある。
【0045】 例えば、それぞれ4t、2t、及びtの相対的持続期間を有する三つのビット
プレーンA、B、及びCの単純なケースを取ってみると、これらを、AAAAB
BCの順番に読み取ることが可能であろう。しかしながら、これは1回だけ読み
取られるフレームCは別として、リフレッシュ読み取りのための正しい場所に到
達するために、前記ビットプレーンの各々の開始アドレスを記憶することを必要
とする。
【0046】 加えて、おそらくより重要なことであるのが、新しいイメージに進む前に、グ
レイ・スケール・イメージ全体を書きなおす必要がある場合がありことであり、
その場合、例えば、ディスプレイ時間が長いか、または緩和が早い。そのような
場合、次に使用されるべきビットプレーンの開始アドレスを記憶するだけでなく
、イメージ情報がもはや要求されなくなるまで、シーケンス全体の第一のビット
・プレーンの開始アドレスも記憶する必要がある。
【0047】 そのような場合における、読み取りの改良された方法は、複数の開始アドレス
の記憶を回避することを可能にする。好ましい実施形態の空間光モジュレータを
使用する場合に、高速で画像を読み取ることに関与して、この、明らかに重要で
ないステップが、計算上重要かつ効果的になりうる。
【0048】 実質的に、複数の最高順位ビットプレーン(またはすべてのビットプレーン)
は、予定された持続時間(重み付け)の減少順に、連続した場所におけるバイナ
リ文字列としてメモリに記憶され、予め決められた数の読み取りパスが、前記複
数の重み付けビットプレーンに等しい、前記記憶されたビットプレーンのセット
から作られ、各パスは、最高順位ビットプレーンで始まり、順番に記憶されたビ
ットプレーンに沿って継続し、前記シーケンスの長さは、予め決められた数の読
み取りパスの終わりで、各ビット・フレームが、その持続時間(重み付け)と比
例した、または等しい複数の回数、読み取られるように選択され、及び変えられ
る。この迅速な読み取りのための一般的方法は、本出願と同日に提出される出願
人の係属中の国際特許出願(参照番号:P20963WO1)の主題を形成して
いる。
【0049】 この体系に従って、上述された3重ビットフレーム・イメージは、読み取りパ
スABC(1回)、AB(1回)、及びA(2回)で読み取られ、結合されると
、すべての順番、例えば所望されるとおりに、ABCABAA、またはABCA
AABまたはABAAABCを与えることができる。各読み取りパスは、同じ場
所で始まり、カウンタによって決定されるアドレスへと続くので、開始アドレス
のみが記憶される必要がある。
【0050】 グレイ・スケール・イメージングが本発明に従って実行されるが、複数の最高
順位ビットプレーンのリフレッシュを伴う場合、この迅速読み取り方法を、リフ
レッシュされるビットプレーン、さらに次に最低順位のビットプレーンを具備す
るセットに適用することが可能である。リフレッシュされない、残りの低位ビッ
トプレーンは、それらの重み付けに従って、前記セットの最低順位ビットプレー
ンよりも少ない持続時間中、1回読み取られるであろう。これは、前記複数の読
み取り内の一期間または複数期間を含む、いつでも実行されることができるが、
好ましくは、全体のセットが、迅速読み取りを受ける前または後に実行される。
【0051】 上述のグレイ・スケール及びリフレッシュ体系のいくつかは、自動的にdcバ
ランスを供給する一方で、これをしない体系のさらなるオプションは、例えばイ
メージを書き込み、それからそれらを緩和させる一方で、インバランスを計算し
(例えば、付随するコンピュータ・シミュレーションにおいて)、それからゼロ
平均dcを供給するような大きさ及び持続時間を有するピクセルに、ローカルd
c電圧を加えて、dcインバランスを蓄積させることである。
【0052】 アドレス可能アレイを統合している液晶セルが上で参照されていることが理解
されるべきであり、本発明の方法は、あらゆるバイナリ空間光モジュレータとの
関連で使用されてもよい。イメージング装置が液晶装置である場合、グレイス・
ケール・イメージを合成するために使用されるバイナリ・イメージの延長は、連
続するバイナリ・イメージの間のac場の適用による、公知の方法で達成されて
もよい。
───────────────────────────────────────────────────── フロントページの続き (81)指定国 EP(AT,BE,CH,CY, DE,DK,ES,FI,FR,GB,GR,IE,I T,LU,MC,NL,PT,SE),OA(BF,BJ ,CF,CG,CI,CM,GA,GN,GW,ML, MR,NE,SN,TD,TG),AP(GH,GM,K E,LS,MW,SD,SL,SZ,TZ,UG,ZW ),EA(AM,AZ,BY,KG,KZ,MD,RU, TJ,TM),AE,AL,AM,AT,AU,AZ, BA,BB,BG,BR,BY,CA,CH,CN,C R,CU,CZ,DE,DK,DM,EE,ES,FI ,GB,GD,GE,GH,GM,HR,HU,ID, IL,IN,IS,JP,KE,KG,KP,KR,K Z,LC,LK,LR,LS,LT,LU,LV,MA ,MD,MG,MK,MN,MW,MX,NO,NZ, PL,PT,RO,RU,SD,SE,SG,SI,S K,SL,TJ,TM,TR,TT,TZ,UA,UG ,US,UZ,VN,YU,ZA,ZW (72)発明者 クロスランド ウィリアム オルデン イギリス ケンブリッジ シービー2 1 ピーゼット トランピントン ストリート (番地なし) ユニヴァーシティー オ ブ ケンブリッジ エンジニアリング デ パートメント Fターム(参考) 5C006 AA11 AF01 AF11 AF44 FA21 5C058 AA07 AA08 AA11 AA12 BA01 BA06 BA07 BB03 BB14

Claims (12)

    【特許請求の範囲】
  1. 【請求項1】 重み付けビット・プレーン技術を使用したグレイ・スケール
    ・イメージングの方法であって、n桁2進数が、2値画素のアレイにおいて、各
    画素の場所の、予定されたグレイ・レベルを表し、少なくとも一つの前記2進数
    は、不均等な数の1及び0を有し、1及び0の前記不均等性を低減させるように
    、前記数を、近接した値に変えるステップを具備することを特徴とする方法。
  2. 【請求項2】 重み付けビット・プレーン技術を使用してグレイ・スケール
    ・イメージを書き、及び表示する方法であって、n桁の2進数は、2値画素のア
    レイにおいて、各画素の場所の、予定されたグレイ・レベルを表し、少なくとも
    一つの前記2進数は、不均等な数の1及び0を有し、それぞれが前記グレイ・ス
    ケール・イメージに近似した複数のグレイ・スケール・イメージは、連続して書
    かれ、1及び0の前記不均等性を低減させるように、前記数を、前記複数のイメ
    ージの少なくとも一つにおいて、近接した値に変えるステップを具備することを
    特徴とする方法。
  3. 【請求項3】 前記複数のイメージに対する前記数の前記値は、予定された
    グレイ・スケール・レベルに等しい平均グレイ・スケール・レベルを供給するこ
    とを特徴とする、請求項2に記載の方法。
  4. 【請求項4】 1及び0の前記不均等性がゼロに低減される(均等性)こと
    を特徴とする、請求項1〜3のいずれか一項に記載の方法。
  5. 【請求項5】 前記数は、ルックアップ・テーブルにおけるデータに従って
    変えられることを特徴とする、請求項1〜4のいずれか一項に記載の方法。
  6. 【請求項6】 少なくとも最高順位のビットプレーンがリフレッシュされ、
    前記不均等性の決定は、各ビットプレーンがリフレッシュされる回数を考慮する
    ことを特徴とする、請求項1〜5のいずれか一項に記載の方法。
  7. 【請求項7】 複数の前記最高順位ビットプレーンがリフレッシュされ、前
    記複数に、次の最高順位ビットプレーンを加えたものが一つのセットを構成し、
    それにおいては、前記ビットプレーンのセットは、メモリにおいて連続したロケ
    ーションに、予定された持続時間(重み付け)の減少順に、バイナリ文字列とし
    て記憶され、前記複数に等しい多くの読み取りパスが、前記記憶されたビットプ
    レーンのセットから作られ、各パスは最高順位ビットプレーンで開始し、順番に
    前記記憶されたビットプレーンに沿って継続し、前記シーケンスの長さは、前記
    読み取りパスの数の最後において、各ビットプレーンが、その持続時間(重み付
    け)と比例した、または等しい、複数の回数にわたって読み取られるように変更
    され、及び選択されることを特徴とする、請求項1〜6のいずれか一項に記載の
    方法。
  8. 【請求項8】 前記セットは、ビットプレーンのすべてであることを特徴と
    する、請求項6に記載の方法。
  9. 【請求項9】 重み付けに従って、前記セットの最低順位のビットプレーン
    の持続時間より短い持続時間において、1回読み取られる、少なくとも一つの、
    追加的な、より低位なビットプレーンがあることを特徴とする、請求項6に記載
    の方法。
  10. 【請求項10】 前記読み取りパスの数は繰り返されることを特徴とする、
    請求項6〜8のいずれか一項に記載の方法。
  11. 【請求項11】 液晶ディスプレイの形式で、空間光モジュレータを扱うた
    めに使用される時の、請求項1〜10のいずれか一項に記載の方法。
  12. 【請求項12】 イメージが書かれていない時、小さなac電位差が、周期
    的に前記アレイのピクセルに適用されることを特徴とする、請求項1〜11のい
    ずれか一項に記載の方法。
JP2000590149A 1998-12-19 1999-12-16 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン Pending JP2003519395A (ja)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
GB9827944.1 1998-12-19
GBGB9827944.1A GB9827944D0 (en) 1998-12-19 1998-12-19 Displays based on multiple digital bit planes
PCT/GB1999/004260 WO2000038162A1 (en) 1998-12-19 1999-12-16 Modified weighted bit planes for displaying grey levels on optical arrays

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2011092803A Division JP2011191770A (ja) 1998-12-19 2011-04-19 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン

Publications (2)

Publication Number Publication Date
JP2003519395A true JP2003519395A (ja) 2003-06-17
JP2003519395A5 JP2003519395A5 (ja) 2007-02-15

Family

ID=10844517

Family Applications (3)

Application Number Title Priority Date Filing Date
JP2000590149A Pending JP2003519395A (ja) 1998-12-19 1999-12-16 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン
JP2000590155A Expired - Fee Related JP4612952B2 (ja) 1998-12-19 1999-12-16 グレイスケール画像表示のための複数デジタル・ビットプレーンの高速読出し
JP2011092803A Abandoned JP2011191770A (ja) 1998-12-19 2011-04-19 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン

Family Applications After (2)

Application Number Title Priority Date Filing Date
JP2000590155A Expired - Fee Related JP4612952B2 (ja) 1998-12-19 1999-12-16 グレイスケール画像表示のための複数デジタル・ビットプレーンの高速読出し
JP2011092803A Abandoned JP2011191770A (ja) 1998-12-19 2011-04-19 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン

Country Status (9)

Country Link
US (2) US6930693B1 (ja)
EP (2) EP1141933B8 (ja)
JP (3) JP2003519395A (ja)
KR (2) KR20010089656A (ja)
AU (2) AU1869300A (ja)
CA (2) CA2353821A1 (ja)
DE (1) DE69933238T2 (ja)
GB (1) GB9827944D0 (ja)
WO (2) WO2000038162A1 (ja)

Families Citing this family (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2836588B1 (fr) * 2002-02-26 2004-05-21 Thomson Licensing Sa Procede d'affichage numerique d'image et dispositif d'affichage numerique
GB2417360B (en) * 2003-05-20 2007-03-28 Kagutech Ltd Digital backplane
US20050062765A1 (en) * 2003-09-23 2005-03-24 Elcos Microdisplay Technology, Inc. Temporally dispersed modulation method
US7499065B2 (en) * 2004-06-11 2009-03-03 Texas Instruments Incorporated Asymmetrical switching delay compensation in display systems
JP5713562B2 (ja) * 2007-01-30 2015-05-07 エフ・ポスザツト・ヒユー・エル・エル・シー 画像転写装置
WO2008094950A1 (en) * 2007-01-30 2008-08-07 F. Poszat Hu, L.L.C. Spatial light modulator
JP5017376B2 (ja) * 2007-02-05 2012-09-05 エフ・ポスザツト・ヒユー・エル・エル・シー ホログラフィック画像処理システム
US8022861B2 (en) * 2008-04-04 2011-09-20 Toyota Motor Engineering & Manufacturing North America, Inc. Dual-band antenna array and RF front-end for mm-wave imager and radar
WO2011092616A1 (en) * 2010-01-28 2011-08-04 Raman Research Institute A method to display images on a display device using bit slice addressing technique
US9922608B2 (en) 2015-05-27 2018-03-20 Apple Inc. Electronic device display with charge accumulation tracker
US11030942B2 (en) 2017-10-13 2021-06-08 Jasper Display Corporation Backplane adaptable to drive emissive pixel arrays of differing pitches
US10951875B2 (en) 2018-07-03 2021-03-16 Raxium, Inc. Display processing circuitry
US11710445B2 (en) 2019-01-24 2023-07-25 Google Llc Backplane configurations and operations
US11637219B2 (en) 2019-04-12 2023-04-25 Google Llc Monolithic integration of different light emitting structures on a same substrate
US11238782B2 (en) 2019-06-28 2022-02-01 Jasper Display Corp. Backplane for an array of emissive elements
US11626062B2 (en) 2020-02-18 2023-04-11 Google Llc System and method for modulating an array of emissive elements
EP4133475A4 (en) 2020-04-06 2024-04-10 Google LLC DISPLAY SETS
US11538431B2 (en) 2020-06-29 2022-12-27 Google Llc Larger backplane suitable for high speed applications
WO2023287936A1 (en) 2021-07-14 2023-01-19 Google Llc Backplane and method for pulse width modulation

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07287556A (ja) * 1995-04-24 1995-10-31 Hitachi Ltd 液晶表示装置の駆動装置

Family Cites Families (20)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4775891A (en) * 1984-08-31 1988-10-04 Casio Computer Co., Ltd. Image display using liquid crystal display panel
JPH05127612A (ja) * 1991-11-05 1993-05-25 Nippon Hoso Kyokai <Nhk> 中間調画像表示方法
ATE261168T1 (de) * 1992-10-15 2004-03-15 Texas Instruments Inc Anzeigevorrichtung
US5365283A (en) * 1993-07-19 1994-11-15 Texas Instruments Incorporated Color phase control for projection display using spatial light modulator
TW294807B (ja) * 1993-10-08 1997-01-01 Toshiba Co Ltd
JP2666739B2 (ja) * 1994-09-29 1997-10-22 日本電気株式会社 表示制御装置
US6025818A (en) 1994-12-27 2000-02-15 Pioneer Electronic Corporation Method for correcting pixel data in a self-luminous display panel driving system
JP2796619B2 (ja) * 1994-12-27 1998-09-10 セイコーインスツルメンツ株式会社 液晶表示パネルの階調駆動装置
US5777589A (en) * 1995-04-26 1998-07-07 Texas Instruments Incorporated Color display system with spatial light modulator(s) having color-to-color variations in data sequencing
US5959598A (en) * 1995-07-20 1999-09-28 The Regents Of The University Of Colorado Pixel buffer circuits for implementing improved methods of displaying grey-scale or color images
US6512853B2 (en) * 1995-08-14 2003-01-28 Barkfort Limited Method and apparatus for compressing digital image data
US6320986B1 (en) * 1995-08-18 2001-11-20 International Business Machines Corporation Preprocessing multiple bit per pixel sampled data for Lempel-Ziv compression
CA2184129A1 (en) 1995-08-31 1997-03-01 Donald B. Doherty Bit-splitting for pulse width modulated spatial light modulator
US5940142A (en) * 1995-11-17 1999-08-17 Matsushita Electronics Corporation Display device driving for a gray scale expression, and a driving circuit therefor
JP3618024B2 (ja) * 1996-09-20 2005-02-09 パイオニア株式会社 自発光表示器の駆動装置
EP0883295A3 (en) * 1997-06-04 1999-08-11 Texas Instruments Incorporated Method and system for the displaying of digital video data using pulse width modulation
US5841413A (en) * 1997-06-13 1998-11-24 Matsushita Electric Industrial Co., Ltd. Method and apparatus for moving pixel distortion removal for a plasma display panel using minimum MPD distance code
US6034664A (en) * 1997-06-25 2000-03-07 Sun Microsystems, Inc. Method and apparatus for pseudo-random noise generation based on variation of intensity and coloration
US6278434B1 (en) * 1998-10-07 2001-08-21 Microsoft Corporation Non-square scaling of image data to be mapped to pixel sub-components
JP3283005B2 (ja) * 1998-11-05 2002-05-20 インターナショナル・ビジネス・マシーンズ・コーポレーション 画像データの遷移を生じないようにするデータ転送方法

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07287556A (ja) * 1995-04-24 1995-10-31 Hitachi Ltd 液晶表示装置の駆動装置

Also Published As

Publication number Publication date
KR20010089656A (ko) 2001-10-08
DE69933238D1 (de) 2006-10-26
JP2011191770A (ja) 2011-09-29
EP1141933B8 (en) 2007-01-17
JP4612952B2 (ja) 2011-01-12
US6930693B1 (en) 2005-08-16
EP1153383A1 (en) 2001-11-14
EP1141933B1 (en) 2006-09-13
DE69933238T2 (de) 2007-04-19
CA2353821A1 (en) 2000-06-29
GB9827944D0 (en) 1999-02-10
EP1141933A1 (en) 2001-10-10
AU1870700A (en) 2000-07-12
CA2354276A1 (en) 2000-06-29
JP2003519396A (ja) 2003-06-17
WO2000038162A1 (en) 2000-06-29
US6930692B1 (en) 2005-08-16
AU1869300A (en) 2000-07-12
WO2000038168A1 (en) 2000-06-29
KR20010081083A (ko) 2001-08-25

Similar Documents

Publication Publication Date Title
JP2011191770A (ja) 光学アレイにグレイ・レベルを表示するための変更重み付けビット・プレーン
US6369832B1 (en) Pixel buffer circuits for implementing improved methods of displaying grey-scale or color images
US6784898B2 (en) Mixed mode grayscale method for display system
JP3969748B2 (ja) マトリックスディスプレイの制御回路および方法
US5731802A (en) Time-interleaved bit-plane, pulse-width-modulation digital display system
US20030090478A1 (en) Pixel buffer circuits for implementing improved methods of displaying grey-scale or color images
US6384817B1 (en) Apparatus for applying voltages to individual columns of pixels in a color electro-optic display device
US5689280A (en) Display apparatus and a driving method for a display apparatus
JP2003532160A (ja) モノクローム及びカラーのデジタル・ディスプレイ・システム並びにその実施のための方法
US6462728B1 (en) Apparatus having a DAC-controlled ramp generator for applying voltages to individual pixels in a color electro-optic display device
JP3453141B2 (ja) 異なる階調を表示する方法及び同方法を実施する装置
US7145581B2 (en) Selectively updating pulse width modulated waveforms while driving pixels
JP2006500613A (ja) アクティブマトリクスディスプレイ
JP3524778B2 (ja) 表示装置の動作方法

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20061218

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20061218

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20100408

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20100517

A602 Written permission of extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A602

Effective date: 20100528

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20101008

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20101222

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20110419