JP2003297740A - 微細パターン形成方法 - Google Patents
微細パターン形成方法Info
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Abstract
(57)【要約】
【課題】 エッチングの耐性が優秀なレジストを使用し
て微細なパターンを形成することができる微細パターン
形成方法を提供する。 【解決手段】 導電膜を含んだ半導体基板に対して、i
線用、ArF両レジスト膜を順にコーティングし、所定
パターンのマスクをかけて露光及び第1ベイキングして
ArFレジスト内にOH基またはCOOH基を生成し、
マスクを除去し、第1現像により第1レジストパターン
を形成し、露光及び第2ベイキングし、HMDSを利用
してシリル化して第1レジストパターンの表面にシリコ
ン酸化膜を形成し、シリコン酸化膜を含む第1レジスト
パターンをマスクとしてi線用レジスト膜を乾式現像し
て第2レジストパターンを形成し、シリコン酸化膜を含
んだ第1及び第2レジストパターンをマスクとして導電
膜をエッチングする。
て微細なパターンを形成することができる微細パターン
形成方法を提供する。 【解決手段】 導電膜を含んだ半導体基板に対して、i
線用、ArF両レジスト膜を順にコーティングし、所定
パターンのマスクをかけて露光及び第1ベイキングして
ArFレジスト内にOH基またはCOOH基を生成し、
マスクを除去し、第1現像により第1レジストパターン
を形成し、露光及び第2ベイキングし、HMDSを利用
してシリル化して第1レジストパターンの表面にシリコ
ン酸化膜を形成し、シリコン酸化膜を含む第1レジスト
パターンをマスクとしてi線用レジスト膜を乾式現像し
て第2レジストパターンを形成し、シリコン酸化膜を含
んだ第1及び第2レジストパターンをマスクとして導電
膜をエッチングする。
Description
【0001】
【発明の属する技術分野】本発明は半導体素子の製造方
法に係り、より詳細にはフォトリソグラフィ(phot
olithography)工程を利用して微細な間隔
のパターンを形成することができる微細パターン形成方
法に関するものである。
法に係り、より詳細にはフォトリソグラフィ(phot
olithography)工程を利用して微細な間隔
のパターンを形成することができる微細パターン形成方
法に関するものである。
【0002】
【従来の技術】フォトリソグラフィ(photolit
hography)工程では、0.25μmデザインル
ール(design rule)のディバイス(dev
ice)にはKrF光源が用いられているが、KrF光
源ではレジスト(resist)パターニングの限界に
直面していて、その代案として波長193nmのArF
光源の適用が実験されている。
hography)工程では、0.25μmデザインル
ール(design rule)のディバイス(dev
ice)にはKrF光源が用いられているが、KrF光
源ではレジスト(resist)パターニングの限界に
直面していて、その代案として波長193nmのArF
光源の適用が実験されている。
【0003】しかし、ArFリソグラフィ工程をディバ
イスに適用した時に発生する色々な問題のうちに、Ar
Fレジストをバリアにしたエッチングの耐性を改善する
ためには193nmの波長に対して吸収が非常に大き
い、という問題があった。したがって、このような結果
はレジストコーティングの厚さを低くする要因として作
用する。一般的なパターンの崩壊を考慮すると、レジス
トの厚さは縦横比が3:1程度なければならず、ArF
用のレジストはi線(アイ線、i−line)レジスト
に比べてエッチングの耐性が弱く半分程度しかないた
め、薄いArFレジストの厚さはエッチング工程に負担
を与えていた。
イスに適用した時に発生する色々な問題のうちに、Ar
Fレジストをバリアにしたエッチングの耐性を改善する
ためには193nmの波長に対して吸収が非常に大き
い、という問題があった。したがって、このような結果
はレジストコーティングの厚さを低くする要因として作
用する。一般的なパターンの崩壊を考慮すると、レジス
トの厚さは縦横比が3:1程度なければならず、ArF
用のレジストはi線(アイ線、i−line)レジスト
に比べてエッチングの耐性が弱く半分程度しかないた
め、薄いArFレジストの厚さはエッチング工程に負担
を与えていた。
【0004】図1及び図2は従来技術による問題点を図
示した図面であり、ArFレジストを利用して微細パタ
ーンを形成したものを示した写真である。図1は従来技
術によるArFレジストを利用して、ランディングプラ
グ形成用のコンタクトをエッチングにより形成した結果
を示した写真であり、図2は従来技術によるArFレジ
ストを利用して、ゲートをエッチングにより形成した結
果を示した写真である。
示した図面であり、ArFレジストを利用して微細パタ
ーンを形成したものを示した写真である。図1は従来技
術によるArFレジストを利用して、ランディングプラ
グ形成用のコンタクトをエッチングにより形成した結果
を示した写真であり、図2は従来技術によるArFレジ
ストを利用して、ゲートをエッチングにより形成した結
果を示した写真である。
【0005】前記エッチングの耐性が弱いArFフォト
レジストを利用して、ランディングプラグ形成用コンタ
クトあるいはゲートを形成する場合、図1及び図2に示
すように、パターン変形を誘発するという問題点があっ
た。
レジストを利用して、ランディングプラグ形成用コンタ
クトあるいはゲートを形成する場合、図1及び図2に示
すように、パターン変形を誘発するという問題点があっ
た。
【0006】
【特許文献1】 特開2002―064059号
【0007】
【発明が解決しようとする課題】そこで本発明は前記従
来の技術の問題点を解決するために創出されたものであ
って、その目的は、エッチングの耐性が優秀なレジスト
を使用して微細なパターンを形成することができる微細
パターン形成方法を提供することにある。
来の技術の問題点を解決するために創出されたものであ
って、その目的は、エッチングの耐性が優秀なレジスト
を使用して微細なパターンを形成することができる微細
パターン形成方法を提供することにある。
【0008】
【課題を解決するための手段】前記課題を解決するため
になされた本発明による微細パターン形成方法は、導電
膜を含んだ半導体基板に対して、i線用レジスト膜をコ
ーティングする段階と、ポジティブ型のArFレジスト
膜をコーティングする段階と、所定のパターンを有する
マスクを利用して露光及び第1ベイキング工程を実施し
て、前記ポジティブ型のArFレジスト膜の内部に、後
にシリル化(silylation)反応をおこすため
のアルコール基(OH)またはカルボキシル基(COO
H)を生成する段階と、前記マスクを除去する段階と、
第1現像工程を実施して第1レジストパターンを形成す
る段階と、露光及び第2ベイキング工程を実施する段階
と、HMDS(Hexa Methyl DiSila
zane)を利用してシリル化工程を実施して、前記ア
ルコール基(OH)またはカルボキシル基(COOH)
と前記HMDSの反応により前記第1レジストパターン
の表面にシリコン酸化膜を形成する段階と、前記シリコ
ン酸化膜を含む第1レジストパターンをマスクとして、
前記i線用レジスト膜に乾式現像工程を実施して第2レ
ジストパターンを形成する段階と、前記シリコン酸化膜
を含んだ第1及び第2レジストパターンをマスクとし
て、前記導電膜をエッチングして導電パターンを形成す
る段階とを含むことを特徴とする。
になされた本発明による微細パターン形成方法は、導電
膜を含んだ半導体基板に対して、i線用レジスト膜をコ
ーティングする段階と、ポジティブ型のArFレジスト
膜をコーティングする段階と、所定のパターンを有する
マスクを利用して露光及び第1ベイキング工程を実施し
て、前記ポジティブ型のArFレジスト膜の内部に、後
にシリル化(silylation)反応をおこすため
のアルコール基(OH)またはカルボキシル基(COO
H)を生成する段階と、前記マスクを除去する段階と、
第1現像工程を実施して第1レジストパターンを形成す
る段階と、露光及び第2ベイキング工程を実施する段階
と、HMDS(Hexa Methyl DiSila
zane)を利用してシリル化工程を実施して、前記ア
ルコール基(OH)またはカルボキシル基(COOH)
と前記HMDSの反応により前記第1レジストパターン
の表面にシリコン酸化膜を形成する段階と、前記シリコ
ン酸化膜を含む第1レジストパターンをマスクとして、
前記i線用レジスト膜に乾式現像工程を実施して第2レ
ジストパターンを形成する段階と、前記シリコン酸化膜
を含んだ第1及び第2レジストパターンをマスクとし
て、前記導電膜をエッチングして導電パターンを形成す
る段階とを含むことを特徴とする。
【0009】好ましくは、前記i線用レジスト膜をコー
ティングする以前に、前記基板をHMDS蒸気処理す
る。
ティングする以前に、前記基板をHMDS蒸気処理す
る。
【0010】また好ましくは、前記i線用レジスト膜は
0.2〜1.5μmの厚さでコーティングし、前記ポジ
ティブ型のArFレジスト膜は0.05〜0.2μmの
厚さでコーティングする。
0.2〜1.5μmの厚さでコーティングし、前記ポジ
ティブ型のArFレジスト膜は0.05〜0.2μmの
厚さでコーティングする。
【0011】また好ましくは、前記ポジティブ型のAr
Fレジスト膜をコーティングする前に、前記i線用レジ
スト膜に200℃温度で90秒間ハードベイキング工程
を実施する段階を追加する。
Fレジスト膜をコーティングする前に、前記i線用レジ
スト膜に200℃温度で90秒間ハードベイキング工程
を実施する段階を追加する。
【0012】また好ましくは、前記ポジティブ型のAr
Fレジスト膜をコーティングした後に、110℃の温度
で90秒間ソフトベイキング工程を実施する段階をさら
に追加する。
Fレジスト膜をコーティングした後に、110℃の温度
で90秒間ソフトベイキング工程を実施する段階をさら
に追加する。
【0013】また好ましくは、前記第1現像工程はTM
AH溶液を利用して60秒間実施し、前記TMAH溶液
の濃度は0.1〜10%を維持する。
AH溶液を利用して60秒間実施し、前記TMAH溶液
の濃度は0.1〜10%を維持する。
【0014】また好ましくは、前記第1レジストパター
ンを含んだ基板上に露光及び第2ベイキング工程を実施
する段階で、ArF露光工程は5〜50mJ/cm2の
エネルギーを供給する。
ンを含んだ基板上に露光及び第2ベイキング工程を実施
する段階で、ArF露光工程は5〜50mJ/cm2の
エネルギーを供給する。
【0015】また好ましくは、前記第1及び第2ベイキ
ング工程は110℃の温度で90秒間実施する。
ング工程は110℃の温度で90秒間実施する。
【0016】また好ましくは、前記シリル化工程は12
0℃の温度で90秒間実施し、シリル化剤はヘキサメチ
ルジシラザン(Hexamethyl disilaz
ane)、テトラメチルジシラザン(Tetramet
hyl disilazane)、ビスジメチルアミノ
ジメチルシラン(bisdimethyl dimet
hylsilane)、ビスジメチルアミノメチルシラ
ン(bisdimethylamino methyl
silane)、ジメチルシリルジメチルアミン(di
methylsilyl dimethylamin
e)、ジメチルシリルジエチルアミン(dimethy
l diethylamine)、トリメチルシリルジ
メチルアミン(trimethylsilyl dim
ethylamine)、トリメチルシリルジエチルア
ミン(trimethylsilyl diethyl
amine)及びジメチルアミノペンタメチルジシラン
(dimethylaminopentamethyl
silane)でなされる群からいずれか一つを選択す
る。
0℃の温度で90秒間実施し、シリル化剤はヘキサメチ
ルジシラザン(Hexamethyl disilaz
ane)、テトラメチルジシラザン(Tetramet
hyl disilazane)、ビスジメチルアミノ
ジメチルシラン(bisdimethyl dimet
hylsilane)、ビスジメチルアミノメチルシラ
ン(bisdimethylamino methyl
silane)、ジメチルシリルジメチルアミン(di
methylsilyl dimethylamin
e)、ジメチルシリルジエチルアミン(dimethy
l diethylamine)、トリメチルシリルジ
メチルアミン(trimethylsilyl dim
ethylamine)、トリメチルシリルジエチルア
ミン(trimethylsilyl diethyl
amine)及びジメチルアミノペンタメチルジシラン
(dimethylaminopentamethyl
silane)でなされる群からいずれか一つを選択す
る。
【0017】また好ましくは、前記乾式現像工程は酸素
プラズマを利用し、上部電極を500ワット(watt
(W))として下部電極を100ワットとし、75ワッ
トのバイアスパワーを加えて、30℃温度及び5mTo
rrの圧力を維持した状態で、酸素ガスを35sccm
で供給する。
プラズマを利用し、上部電極を500ワット(watt
(W))として下部電極を100ワットとし、75ワッ
トのバイアスパワーを加えて、30℃温度及び5mTo
rrの圧力を維持した状態で、酸素ガスを35sccm
で供給する。
【0018】以上のような本発明の目的と、他の特徴及
び長所などは次に参照する本発明の好適な実施例に対す
る以下の説明から明確になるであろう。
び長所などは次に参照する本発明の好適な実施例に対す
る以下の説明から明確になるであろう。
【0019】
【発明の実施の形態】図3ないし図8は本発明による微
細パターン形成方法を図示した工程断面図であり、0.
10μmの大きさのビットラインマスクの形成に適用し
た場合である。
細パターン形成方法を図示した工程断面図であり、0.
10μmの大きさのビットラインマスクの形成に適用し
た場合である。
【0020】本発明の微細パターン形成方法は、図3に
示すように、まず、導電膜(図示せず)を含んだ半導体
基板100上にi線用レジスト膜102を塗布する。こ
の時、半導体基板100は基板とi線用レジスト膜との
間の接着力を増加させるためにHMDSを利用して蒸気
処理されたものである。また、i線用レジスト膜102
は0.2〜1.5μmの厚さ範囲で塗布し、望ましくは
1.0μmの厚さ範囲で塗布する。i線用レジスト膜1
02の代りに有機物質の反射防止膜を0.5〜3.0μ
mの厚さでコーティングすることもできる。
示すように、まず、導電膜(図示せず)を含んだ半導体
基板100上にi線用レジスト膜102を塗布する。こ
の時、半導体基板100は基板とi線用レジスト膜との
間の接着力を増加させるためにHMDSを利用して蒸気
処理されたものである。また、i線用レジスト膜102
は0.2〜1.5μmの厚さ範囲で塗布し、望ましくは
1.0μmの厚さ範囲で塗布する。i線用レジスト膜1
02の代りに有機物質の反射防止膜を0.5〜3.0μ
mの厚さでコーティングすることもできる。
【0021】続いて図4に示すように、i線用レジスト
膜102にハードベイキング(hard bakin
g)工程を実施する。この時のハードベイキング120
は200℃の温度で90秒間実施する。
膜102にハードベイキング(hard bakin
g)工程を実施する。この時のハードベイキング120
は200℃の温度で90秒間実施する。
【0022】その次に図5に示すように、前記ハードベ
イキング工程の完了したi線用レジスト膜103にポジ
ティブ型のArFレジスト膜104をコーティングした
後、ポジティブ型のArFレジスト膜104にソフトベ
イキング(soft baking)工程を実施する。
この時のソフトベイキング122は110℃の温度で9
0秒間実施する。また、ポジティブ型のArFレジスト
膜104はレジストパターンが崩壊しないように0.0
5〜0.2μmの厚さで薄くコーティングする。ポジテ
ィブ型のArFレジスト膜104の代りにEUV、E−
ビーム、イオンビーム及びX−Rayのうちいずれか一
つを使用することもできる。
イキング工程の完了したi線用レジスト膜103にポジ
ティブ型のArFレジスト膜104をコーティングした
後、ポジティブ型のArFレジスト膜104にソフトベ
イキング(soft baking)工程を実施する。
この時のソフトベイキング122は110℃の温度で9
0秒間実施する。また、ポジティブ型のArFレジスト
膜104はレジストパターンが崩壊しないように0.0
5〜0.2μmの厚さで薄くコーティングする。ポジテ
ィブ型のArFレジスト膜104の代りにEUV、E−
ビーム、イオンビーム及びX−Rayのうちいずれか一
つを使用することもできる。
【0023】この後、図6に示すように、前記ソフトベ
イキング工程の完了したポジティブ型のArFレジスト
膜105に、所定パターンを有するマスク130をかぶ
せて、ArF光140を照射して露光を実施した後、P
E(Post Exposure)ベイキング工程12
4を実施する。この時のPEベイキング124は110
℃の温度で90秒間実施する。また、ArF光140の
代りにArF、EUV、Eビーム、イオンビーム及びX
−Rayを使用することもできる。
イキング工程の完了したポジティブ型のArFレジスト
膜105に、所定パターンを有するマスク130をかぶ
せて、ArF光140を照射して露光を実施した後、P
E(Post Exposure)ベイキング工程12
4を実施する。この時のPEベイキング124は110
℃の温度で90秒間実施する。また、ArF光140の
代りにArF、EUV、Eビーム、イオンビーム及びX
−Rayを使用することもできる。
【0024】図9及び図10は、本発明によるポジティ
ブ型のArFレジスト膜を露光及びベイキングすること
により、後にシリル化反応をおこすためのアルコール基
(OH)またはカルボキシル基(COOH)を生成させ
るメカニズムを示した図面である。
ブ型のArFレジスト膜を露光及びベイキングすること
により、後にシリル化反応をおこすためのアルコール基
(OH)またはカルボキシル基(COOH)を生成させ
るメカニズムを示した図面である。
【0025】ポジティブ型のArFレジスト膜105を
露光した後で、PEベイキング124を実施することに
より、膜内に、図9に示すように、後にシリル化反応を
おこすためのアルコール基(OH)が生成され、または
図10に示すように、カルボキシル基(COOH)が生
成される。
露光した後で、PEベイキング124を実施することに
より、膜内に、図9に示すように、後にシリル化反応を
おこすためのアルコール基(OH)が生成され、または
図10に示すように、カルボキシル基(COOH)が生
成される。
【0026】続いて、前記マスクを除去した後に、図7
に示すように、前記PEベイキング工程の完了したポジ
ティブ型のArFレジスト膜を、TMAH溶液を利用し
て60秒間現像して第1レジストパターン106を形成
する。この時、前記TMAH溶液は0.1〜10%の濃
度を使用し、望ましくは2.38%の濃度を使用する。
に示すように、前記PEベイキング工程の完了したポジ
ティブ型のArFレジスト膜を、TMAH溶液を利用し
て60秒間現像して第1レジストパターン106を形成
する。この時、前記TMAH溶液は0.1〜10%の濃
度を使用し、望ましくは2.38%の濃度を使用する。
【0027】その次に、第1レジストパターン106を
含んだ基板にArF光を利用して露光工程を実施した
後、110℃の温度で90秒間ベイキング工程を実施す
る。この時、前記ArF光は5〜50mJ/cm2のエ
ネルギーを有し、望ましくは30mJ/cm2のエネル
ギーを有する。
含んだ基板にArF光を利用して露光工程を実施した
後、110℃の温度で90秒間ベイキング工程を実施す
る。この時、前記ArF光は5〜50mJ/cm2のエ
ネルギーを有し、望ましくは30mJ/cm2のエネル
ギーを有する。
【0028】この後、図8に示すように、HMDSを利
用して120度で90秒間シリル化工程を実施して第1
レジストパターン106の上部にシリコン酸化膜(Si
OX)108を形成する。この時、シリコン酸化膜10
8は前記PEベイキング工程で生成されたアルコール基
(OH)またはカルボキシル酸(COOH)と、HMD
S中のシリコン(Si)が結合することにより形成され
る。また、前記シリル化工程で使われるシリル化剤(s
ilyalating agent)はヘキサメチルジ
シラザン(Hexamethyl disilazan
e)、テトラメチルジシラザン(Tetramethy
l disilazane)、ビスジメチルアミノジメ
チルシラン(bisdimethyl dimethy
lsilane)、ビスジメチルアミノメチルシラン
(bisdimethylamino methyls
ilane)、ジメチルシリルジメチルアミン(dim
ethylsilyl dimethylamin
e)、ジメチルシリルジエチルアミン(dimethy
l diethylamine)、トリメチルシリルジ
メチルアミン(trimethylsilyl dim
ethylamine)、トリメチルシリルジエチルア
ミン(trimethylsilyl diethyl
amine)及びジメチルアミノペンタメチルジシラン
(dimethylamino pentamethy
lsilane)でなされる群からいずれか一つ選択さ
れる。
用して120度で90秒間シリル化工程を実施して第1
レジストパターン106の上部にシリコン酸化膜(Si
OX)108を形成する。この時、シリコン酸化膜10
8は前記PEベイキング工程で生成されたアルコール基
(OH)またはカルボキシル酸(COOH)と、HMD
S中のシリコン(Si)が結合することにより形成され
る。また、前記シリル化工程で使われるシリル化剤(s
ilyalating agent)はヘキサメチルジ
シラザン(Hexamethyl disilazan
e)、テトラメチルジシラザン(Tetramethy
l disilazane)、ビスジメチルアミノジメ
チルシラン(bisdimethyl dimethy
lsilane)、ビスジメチルアミノメチルシラン
(bisdimethylamino methyls
ilane)、ジメチルシリルジメチルアミン(dim
ethylsilyl dimethylamin
e)、ジメチルシリルジエチルアミン(dimethy
l diethylamine)、トリメチルシリルジ
メチルアミン(trimethylsilyl dim
ethylamine)、トリメチルシリルジエチルア
ミン(trimethylsilyl diethyl
amine)及びジメチルアミノペンタメチルジシラン
(dimethylamino pentamethy
lsilane)でなされる群からいずれか一つ選択さ
れる。
【0029】続いて、シリコン酸化膜(SiOX)10
8を含んだ第1レジストパターン106をマスクとし
て、酸素プラズマを利用した乾式現像工程を実施して第
2レジストパターン110を形成する。この時、前記乾
式現像工程は、上部電極を500ワットとして下部電極
を100ワットとし、75ワットのバイアスパワーを加
えて、30℃温度及び5mTorr圧力下で酸素ガスを
35sccmで供給しながら実施される。
8を含んだ第1レジストパターン106をマスクとし
て、酸素プラズマを利用した乾式現像工程を実施して第
2レジストパターン110を形成する。この時、前記乾
式現像工程は、上部電極を500ワットとして下部電極
を100ワットとし、75ワットのバイアスパワーを加
えて、30℃温度及び5mTorr圧力下で酸素ガスを
35sccmで供給しながら実施される。
【0030】その次に、シリコン酸化膜108を含んだ
第1及び第2レジストパターン106,110をマスク
として導電膜をエッチングしてビットライン112を形
成する。
第1及び第2レジストパターン106,110をマスク
として導電膜をエッチングしてビットライン112を形
成する。
【0031】
【発明の効果】以上のように本発明によれば、まず、ポ
ジティブ型のArFレジストにパターンのイメージを形
成し、前記ポジティブ型のArFレジストのイメージを
エッチングの耐性が優秀なi線用レジストに転写するこ
とによって、ArF用レジストのエッチングの耐性不足
により発生するパターン変形を防止することができ、前
記パターン変形によるディバイスの収率低下を防止して
半導体素子の製造原価を低くすることができる。
ジティブ型のArFレジストにパターンのイメージを形
成し、前記ポジティブ型のArFレジストのイメージを
エッチングの耐性が優秀なi線用レジストに転写するこ
とによって、ArF用レジストのエッチングの耐性不足
により発生するパターン変形を防止することができ、前
記パターン変形によるディバイスの収率低下を防止して
半導体素子の製造原価を低くすることができる。
【0032】また、本発明によれば、ポジティブ型のA
rFレジストを利用してデザインルールが100nm未
満の半導体素子を製造することができる。
rFレジストを利用してデザインルールが100nm未
満の半導体素子を製造することができる。
【0033】その他、本発明はその要旨を逸脱しない範
囲で多様に変更して実施することができる。
囲で多様に変更して実施することができる。
【図1】従来技術によるArFレジストを利用して、ラ
ンディングプラグ形成用コンタクトをエッチングにより
形成した結果を示した写真である。
ンディングプラグ形成用コンタクトをエッチングにより
形成した結果を示した写真である。
【図2】従来技術によるArFレジストを利用して、ゲ
ートをエッチングにより形成した結果を示した写真であ
る。
ートをエッチングにより形成した結果を示した写真であ
る。
【図3】本発明による微細パターン形成方法を説明する
ための工程断面図である。
ための工程断面図である。
【図4】本発明による微細パターン形成方法を説明する
ための工程断面図である。
ための工程断面図である。
【図5】本発明による微細パターン形成方法を説明する
ための工程断面図である。
ための工程断面図である。
【図6】本発明による微細パターン形成方法を説明する
ための工程断面図である。
ための工程断面図である。
【図7】本発明による微細パターン形成方法を説明する
ための工程断面図である。
ための工程断面図である。
【図8】本発明による微細パターン形成方法を説明する
ための工程断面図である。
ための工程断面図である。
【図9】本発明によるポジティブ型のArFレジストを
露光及びベイキングする場合、後にシリル化反応をおこ
すためのアルコール基(OH)を生成させるメカニズム
を示した図面である。
露光及びベイキングする場合、後にシリル化反応をおこ
すためのアルコール基(OH)を生成させるメカニズム
を示した図面である。
【図10】同じく、本発明によるポジティブ型のArF
レジストを露光及びベイキングする場合、後にシリル化
反応をおこすためのカルボキシル基(COOH)を生成
させるメカニズムを示した図面である。
レジストを露光及びベイキングする場合、後にシリル化
反応をおこすためのカルボキシル基(COOH)を生成
させるメカニズムを示した図面である。
100 半導体基板
102 i線用レジスト膜
103 i線用レジスト膜
104 ArFレジスト膜
105 ArFレジスト膜
106 第1レジストパターン
108 シリコン酸化膜
120 ハードベイキング工程
122 ソフトベイキング工程
124 PEベイキング工程
130 マスク
140 ArF光
─────────────────────────────────────────────────────
フロントページの続き
Fターム(参考) 2H096 AA25 CA05 EA02 EA04 EA14
FA01 GA08 HA23 JA03 JA04
KA06 KA21
5F046 LB09 NA01
Claims (13)
- 【請求項1】 導電膜を含んだ半導体基板に対して、 i線用レジスト膜をコーティングする段階と、 ポジティブ型のArFレジスト膜をコーティングする段
階と、 所定のパターンを有するマスクを利用し露光及び第1ベ
イキング工程を実施して、前記ポジティブ型のArFレ
ジスト膜の内部に、後にシリル化反応をおこすためのア
ルコール基またはカルボキシル基を生成する段階と、 前記マスクを除去する段階と、 第1現像工程を実施して第1レジストパターンを形成す
る段階と、 露光及び第2ベイキング工程を実施する段階と、 HMDSを利用してシリル化工程を実施して、前記アル
コール基またはカルボキシル基と前記HMDSの反応に
より前記第1レジストパターンの表面にシリコン酸化膜
を形成する段階と、 前記シリコン酸化膜を含む第1レジストパターンをマス
クとして、前記i線用レジスト膜に乾式現像工程を実施
して第2レジストパターンを形成する段階と、 前記シリコン酸化膜を含んだ第1及び第2レジストパタ
ーンをマスクとして、前記導電膜をエッチングして導電
パターンを形成する段階とを含むことを特徴とする微細
パターン形成方法。 - 【請求項2】 前記i線用レジスト膜をコーティングす
る前に、前記基板をHMDS蒸気処理する段階をさらに
含むことを特徴とする請求項1に記載の微細パターン形
成方法。 - 【請求項3】 前記i線用レジスト膜は0.2〜1.5
μmの厚さでコーティングし、前記ポジティブ型のAr
Fレジスト膜は0.05〜0.2μmの厚さでコーティ
ングすることを特徴とする請求項1に記載の微細パター
ン形成方法。 - 【請求項4】 前記ポジティブ型のArFレジスト膜を
コーティングする前に、200℃の温度で90秒間ハー
ドベイキング工程を実施する段階をさらに含むことを特
徴とする請求項1に記載の微細パターン形成方法。 - 【請求項5】 前記ポジティブ型のArFレジスト膜を
コーティングした後に、110℃の温度で90秒間ソフ
トベイキング工程を実施する段階をさらに含むことを特
徴とする請求項1に記載の微細パターン形成方法。 - 【請求項6】 前記第1現像工程は、TMAH溶液を利
用して60秒間実施することを特徴とする請求項1に記
載の微細パターン形成方法。 - 【請求項7】 前記TMAH溶液の濃度は0.1〜10
%であることを特徴とする請求項6に記載の微細パター
ン形成方法。 - 【請求項8】 前記の、第1レジストパターンを含んだ
基板上に露光及び第2ベイキング工程を実施する段階
で、前記露光工程では5〜50mJ/cm2のエネルギ
ーを供給することを特徴とする請求項1に記載の微細パ
ターン形成方法。 - 【請求項9】 前記第1及び第2ベイキング工程は各
々、110℃の温度で90秒間実施することを特徴とす
る請求項1に記載の微細パターン形成方法。 - 【請求項10】 前記シリル化工程は120℃の温度で
90秒間実施することを特徴とする請求項1に記載の微
細パターン形成方法。 - 【請求項11】 前記シリル化工程で、シリル化剤はヘ
キサメチルジシラザン、テトラメチルジシラザン、ビス
ジメチルアミノジメチルシラン、ビスジメチルアミノメ
チルシラン、ジメチルシリルジメチルアミン、ジメチル
シリルジエチルアミン、トリメチルシリルジメチルアミ
ン、トリメチルシリルジエチルアミン及びジメチルアミ
ノペンタメチルジシランでなされる群からいずれか一つ
を選択することを特徴とする請求項1または10に記載
の微細パターン形成方法。 - 【請求項12】 前記乾式現像工程は酸素プラズマを利
用することを特徴とする請求項1に記載の微細パターン
形成方法。 - 【請求項13】 前記乾式現像工程は、上部電極を50
0ワットとし、下部電極を100ワットとし、75ワッ
トのバイアスパワーを加え、30℃の温度及び5mTo
rrの圧力を維持した状態で、酸素ガスを35sccm
で供給しながら実施されることを特徴とする請求項1ま
たは12に記載の微細パターン形成方法。
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Publication Number | Publication Date |
---|---|
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---|---|---|---|
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KR100633994B1 (ko) * | 2005-07-26 | 2006-10-13 | 동부일렉트로닉스 주식회사 | 반도체 소자의 웰 포토레지스트 패턴 및 그 형성 방법 |
KR100798277B1 (ko) * | 2006-10-16 | 2008-01-24 | 동부일렉트로닉스 주식회사 | 반도체 소자 제조 방법 |
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CN103681251B (zh) * | 2012-09-20 | 2018-02-09 | 中国科学院微电子研究所 | 混合光学和电子束光刻方法 |
CN105679657B (zh) * | 2016-01-26 | 2018-06-08 | 京东方科技集团股份有限公司 | 一种图案化方法及阵列基板的制备方法 |
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KR100313150B1 (ko) | 1997-12-31 | 2001-12-28 | 박종섭 | 리소콜릴에시딜(메타)아크릴레이트 단량체와 그를 도입한 공중합체 수지 및 이 수지를 이용한 포토레지스트 |
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KR100376984B1 (ko) | 1998-04-30 | 2003-07-16 | 주식회사 하이닉스반도체 | 포토레지스트중합체및이를이용한미세패턴의형성방법 |
KR100419028B1 (ko) | 1998-05-13 | 2004-07-19 | 주식회사 하이닉스반도체 | 옥사비시클로화합물,이화합물이도입된포토레지스트중합체및이를이용한포토레지스트미세패턴의형성방법 |
GB2344104B (en) | 1998-11-27 | 2004-04-07 | Hyundai Electronics Ind | Photoresist composition comprising a cross-linker |
KR100557609B1 (ko) | 1999-02-22 | 2006-03-10 | 주식회사 하이닉스반도체 | 신규의 포토레지스트 가교제 및 이를 이용한 포토레지스트 조성물 |
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- 2002-03-26 KR KR10-2002-0016350A patent/KR100415091B1/ko not_active IP Right Cessation
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