JP2003234655A - Ｄ／ａ変換回路およびこれを用いる有機ｅｌ駆動回路 - Google Patents
Ｄ／ａ変換回路およびこれを用いる有機ｅｌ駆動回路Info
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- JP2003234655A JP2003234655A JP2002033719A JP2002033719A JP2003234655A JP 2003234655 A JP2003234655 A JP 2003234655A JP 2002033719 A JP2002033719 A JP 2002033719A JP 2002033719 A JP2002033719 A JP 2002033719A JP 2003234655 A JP2003234655 A JP 2003234655A
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Abstract
(57)【要約】
【課題】リーク電流を低減することができ、精度の高い
Ｄ／Ａおよびこれを用いる有機ＥＬ駆動回路を提供す
る。 【解決手段】この発明は、複数の出力側トランジスタが
パラレルにカレントミラー接続され入力側トランジスタ
に所定の駆動電流を受けるカレントミラー回路と、入力
側トランジスタのベースあるいはゲートと出力側トラン
ジスタとのベースあるはゲートとが共通に接続された接
続ラインに駆動電流を供給する駆動電流供給回路とを有
しこの駆動電流供給回路が、入力側トランジスタにカレ
ントミラー接続されたダイオード接続の第１のトランジ
スタとこの第１のトランジスタの出力側に対して出力側
が所定のバイアスラインとグランドとの間に縦方向に従
属接続された第２のトランジスタとを有しこの第２のト
ランジスタのベースあるいはゲートが入力側トランジス
タの入力側に接続され入力側トランジスタがダイオード
接続されていない。
Ｄ／Ａおよびこれを用いる有機ＥＬ駆動回路を提供す
る。 【解決手段】この発明は、複数の出力側トランジスタが
パラレルにカレントミラー接続され入力側トランジスタ
に所定の駆動電流を受けるカレントミラー回路と、入力
側トランジスタのベースあるいはゲートと出力側トラン
ジスタとのベースあるはゲートとが共通に接続された接
続ラインに駆動電流を供給する駆動電流供給回路とを有
しこの駆動電流供給回路が、入力側トランジスタにカレ
ントミラー接続されたダイオード接続の第１のトランジ
スタとこの第１のトランジスタの出力側に対して出力側
が所定のバイアスラインとグランドとの間に縦方向に従
属接続された第２のトランジスタとを有しこの第２のト
ランジスタのベースあるいはゲートが入力側トランジス
タの入力側に接続され入力側トランジスタがダイオード
接続されていない。
Description
【０００１】
【発明の属する技術分野】この発明は、Ｄ／Ａ変換回路
およびこれを用いる有機ＥＬ駆動回路に関し、詳しく
は、カレントミラー回路を利用して入力デジタル値に対
応する電流値を生成して有機ＥＬパネルのピン駆動電流
を発生するカラムライン（陽極側ドライブライン、以下
同じ）の電流駆動回路において、リーク電流を低減する
ことができかつ高い精度でＤ／Ａ変換して駆動電流を生
成することができるＤ／Ａ変換回路およびこれを用いる
有機ＥＬ駆動回路の改良に関する。
およびこれを用いる有機ＥＬ駆動回路に関し、詳しく
は、カレントミラー回路を利用して入力デジタル値に対
応する電流値を生成して有機ＥＬパネルのピン駆動電流
を発生するカラムライン（陽極側ドライブライン、以下
同じ）の電流駆動回路において、リーク電流を低減する
ことができかつ高い精度でＤ／Ａ変換して駆動電流を生
成することができるＤ／Ａ変換回路およびこれを用いる
有機ＥＬ駆動回路の改良に関する。
【０００２】
【従来の技術】有機ＥＬ表示装置は、自発光による高輝
度表示が可能であることから、小画面での表示に適し、
携帯電話機、ＤＶＤプレーヤ、ＰＤＡ（携帯端末装置）
等に搭載される次世代表示装置として現在注目されてい
る。この有機ＥＬ表示装置には、液晶表示装置のように
電圧駆動を行うと、輝度ばらつきが大きくなり、かつ、
Ｒ（赤），Ｇ（緑），Ｂ（青）に感度差があることから
制御が難しくなる問題点がある。そこで、最近では、電
流駆動のドライバを用いた有機ＥＬ表示装置が提案され
ている。例えば、特開平１０−１１２３９１号などで
は、電流駆動により輝度ばらつきの問題を解決する技術
が記載されている。
度表示が可能であることから、小画面での表示に適し、
携帯電話機、ＤＶＤプレーヤ、ＰＤＡ（携帯端末装置）
等に搭載される次世代表示装置として現在注目されてい
る。この有機ＥＬ表示装置には、液晶表示装置のように
電圧駆動を行うと、輝度ばらつきが大きくなり、かつ、
Ｒ（赤），Ｇ（緑），Ｂ（青）に感度差があることから
制御が難しくなる問題点がある。そこで、最近では、電
流駆動のドライバを用いた有機ＥＬ表示装置が提案され
ている。例えば、特開平１０−１１２３９１号などで
は、電流駆動により輝度ばらつきの問題を解決する技術
が記載されている。
【０００３】携帯電話機用の有機ＥＬ表示装置の有機Ｅ
Ｌ表示パネルでは、カラムラインの数が３９６個（１３
２×３）の端子ピン（以下ピン）、ローラインが１６２
個のピンを持つものが提案され、カラムライン、ローラ
インのピンはこれ以上に増加する傾向にある。このよう
なピン数の増加により、特に、カラムライン側では複数
のカラムＩＣドライバがフルカラーでＲ，Ｇ，Ｂ各４４
ピンの１３２ピンとなり、それが２ドライバ必要にな
る。そのためカラムＩＣドライバ相互間の特性のばらつ
きにより輝度むらが発生する問題がある。そこで、この
ような問題を解決する発明として、この出願人は、すで
に特願２００１−８６９６７号「有機ＥＬ駆動回路およ
びこれを用いる有機ＥＬ表示装置」を出願している。ま
た、この種の問題を解決する技術として特開２００１−
４２８２７号「ディスプレイ装置及びディスプレイパネ
ルの駆動回路」を挙げることができる。
Ｌ表示パネルでは、カラムラインの数が３９６個（１３
２×３）の端子ピン（以下ピン）、ローラインが１６２
個のピンを持つものが提案され、カラムライン、ローラ
インのピンはこれ以上に増加する傾向にある。このよう
なピン数の増加により、特に、カラムライン側では複数
のカラムＩＣドライバがフルカラーでＲ，Ｇ，Ｂ各４４
ピンの１３２ピンとなり、それが２ドライバ必要にな
る。そのためカラムＩＣドライバ相互間の特性のばらつ
きにより輝度むらが発生する問題がある。そこで、この
ような問題を解決する発明として、この出願人は、すで
に特願２００１−８６９６７号「有機ＥＬ駆動回路およ
びこれを用いる有機ＥＬ表示装置」を出願している。ま
た、この種の問題を解決する技術として特開２００１−
４２８２７号「ディスプレイ装置及びディスプレイパネ
ルの駆動回路」を挙げることができる。
【０００４】図３は、後者のカラムドライバの説明図で
あって、１０は、ＩＣ化されたカラムライン電流駆動回
路である。内部にＤ／Ａ変換回路を有する基準電圧発生
回路１１で入力されたデジタル値に対応する基準電圧を
発生して、これをオペアンプ（ＯＰ）を有する定電流回
路で構成される基準電流発生回路１２で基準電流ＩREF
に変換する。基準電流発生回路１２で出力される基準電
流ＩREFをカレントミラー電流出力回路１３で受ける。
カレントミラー電流出力回路１３は、１個の入力側トラ
ンジスタＱpと出力ピンに対応するｎ個の出力側トラン
ジスタＱ1〜Ｑmを有するカレントミラー回路１３ａと、
出力側トランジスタＱ1〜Ｑmの出力を受ける各スイッチ
Ｓ1〜ＳmからなるスイッチブロックＳＢとを有してい
る。各ドライバのトランジスタＱ1〜Ｑmの出力は、カラ
ム側のピンに対する駆動電流としてスイッチＳ1〜Ｓm，
出力端子Ｘ1〜Ｘmを介して出力される。なお、ＧＡ1〜
ＧＡmは、スイッチブロックＳＢの各スイッチＳ1〜Ｓm
のＯＮ／ＯＦＦを制御する制御信号である。また、基準
電圧発生回路１１のＤ／Ａ変換回路は、ＣＰＵ，ＭＰＵ
等のプロセッサから表示輝度に応じた表示データがレジ
スタ等を介して入力され、そのデジタル値を受けて基準
電圧に対応する信号を発生する。
あって、１０は、ＩＣ化されたカラムライン電流駆動回
路である。内部にＤ／Ａ変換回路を有する基準電圧発生
回路１１で入力されたデジタル値に対応する基準電圧を
発生して、これをオペアンプ（ＯＰ）を有する定電流回
路で構成される基準電流発生回路１２で基準電流ＩREF
に変換する。基準電流発生回路１２で出力される基準電
流ＩREFをカレントミラー電流出力回路１３で受ける。
カレントミラー電流出力回路１３は、１個の入力側トラ
ンジスタＱpと出力ピンに対応するｎ個の出力側トラン
ジスタＱ1〜Ｑmを有するカレントミラー回路１３ａと、
出力側トランジスタＱ1〜Ｑmの出力を受ける各スイッチ
Ｓ1〜ＳmからなるスイッチブロックＳＢとを有してい
る。各ドライバのトランジスタＱ1〜Ｑmの出力は、カラ
ム側のピンに対する駆動電流としてスイッチＳ1〜Ｓm，
出力端子Ｘ1〜Ｘmを介して出力される。なお、ＧＡ1〜
ＧＡmは、スイッチブロックＳＢの各スイッチＳ1〜Ｓm
のＯＮ／ＯＦＦを制御する制御信号である。また、基準
電圧発生回路１１のＤ／Ａ変換回路は、ＣＰＵ，ＭＰＵ
等のプロセッサから表示輝度に応じた表示データがレジ
スタ等を介して入力され、そのデジタル値を受けて基準
電圧に対応する信号を発生する。
【０００５】さらに、スイッチブロックＳＢの位置に
は、ピン対応に入力側トランジスタを設け、出力側トラ
ンジスタをピンに接続した一対のカレントミラー電流出
力回路を設けて、ＧＡ1〜ＧＡmに応じてこの回路をスイ
ッチング制御する構成の電流駆動回路がある。この場合
には、前記のカレントミラー電流出力回路１３ａは、手
前の入力段となる基準電流発生回路から基準電流を受け
てピン対応に多数のミラー電流を生成するカレントミラ
ーのドライブ段、あるいは基準電流をｋ倍（ｋは２以上
の整数）の電流に増幅するカレントミラーの電流ドライ
ブ段となって、ピン対応に設けられた前記の入力側トラ
ンジスタを駆動することになる。先の特願２００１−８
６９６７号のカラムラインの電流駆動回路はこのような
回路構成を採っている。このように、複数の出力側トラ
ンジスタをパラレルに駆動するカレントミラー回路をド
ライブ段（特願２００１−８６９６７号）、あるいは出
力段（図３の回路）に用いる電流駆動回路があるが、フ
ルカラー表示で高画質表示を確保するための回路とし
て、特願２００１−８６９６７号のようにパラレル駆動
のカレントミラー回路をドライブ段とした場合には、Ｇ
Ａ1〜ＧＡmによる制御をせずに、このドライブ段の後に
ピン対応にＤ／Ａ変換回路を設けて、カラム側のピン対
応にＤ／Ａ変換回路が表示データを受けてこの表示デー
タをピン対応にＤ／Ａ変換して１ライン分の駆動電流を
同時に生成する電流駆動回路がある。なお、この場合の
Ｄ／Ａ変換回路は、基準電圧発生回路１１側に設けられ
ているＤ／Ａ変換回路をこのドライブ段に移動させたも
のである。
は、ピン対応に入力側トランジスタを設け、出力側トラ
ンジスタをピンに接続した一対のカレントミラー電流出
力回路を設けて、ＧＡ1〜ＧＡmに応じてこの回路をスイ
ッチング制御する構成の電流駆動回路がある。この場合
には、前記のカレントミラー電流出力回路１３ａは、手
前の入力段となる基準電流発生回路から基準電流を受け
てピン対応に多数のミラー電流を生成するカレントミラ
ーのドライブ段、あるいは基準電流をｋ倍（ｋは２以上
の整数）の電流に増幅するカレントミラーの電流ドライ
ブ段となって、ピン対応に設けられた前記の入力側トラ
ンジスタを駆動することになる。先の特願２００１−８
６９６７号のカラムラインの電流駆動回路はこのような
回路構成を採っている。このように、複数の出力側トラ
ンジスタをパラレルに駆動するカレントミラー回路をド
ライブ段（特願２００１−８６９６７号）、あるいは出
力段（図３の回路）に用いる電流駆動回路があるが、フ
ルカラー表示で高画質表示を確保するための回路とし
て、特願２００１−８６９６７号のようにパラレル駆動
のカレントミラー回路をドライブ段とした場合には、Ｇ
Ａ1〜ＧＡmによる制御をせずに、このドライブ段の後に
ピン対応にＤ／Ａ変換回路を設けて、カラム側のピン対
応にＤ／Ａ変換回路が表示データを受けてこの表示デー
タをピン対応にＤ／Ａ変換して１ライン分の駆動電流を
同時に生成する電流駆動回路がある。なお、この場合の
Ｄ／Ａ変換回路は、基準電圧発生回路１１側に設けられ
ているＤ／Ａ変換回路をこのドライブ段に移動させたも
のである。
【０００６】
【発明が解決しようとする課題】図４は、そのＤ／Ａ変
換回路１４の一例である。Ｄ0〜Ｄn-1がデジタル値の入
力であり、表示データがレジスタ等を介して設定され
る。そして、図３の各ドライバのトランジスタＱ1〜Ｑm
の出力をこれのドライブ段とする。このドライブ段それ
ぞれの１ピン分の駆動回路を簡略化して定電流源１４ａ
として示すと、このＤ／Ａ変換回路１４は、この定電流
源１４ａからの電流Ｉをコレクタに受けるダイオード接
続の入力側npn型バイポーラトランジスタＱaとを有し、
これにカレントミラー接続された出力側npn型バイポー
ラトランジスタＱb〜Ｑn-1、各出力側トランジスタＱb
〜Ｑn-1のエミッタとグランドＧＮＤ間にスイッチ回路
として接続されたＮチャネルＭＯＳＦＥＴトランジスタ
Ｔrb〜Ｔrn-1が設けられている。そして、トランジスタ
Ｔrb〜Ｔrn-1のゲートがそれぞれＤ0〜Ｄn-1の各入力端
子に接続されている。出力側トランジスタＱb〜Ｑn-1
は、それぞれのコレクタが出力端子１４ｂに接続され、
トランジスタＱaのエミッタ面積に対してそれぞれのト
ランジスタが×１，×２，×３，…×ｎの倍数のエミッ
タ面積比を持っている。なお、入力側トランジスタＱa
のエミッタはグランドＧＮＤに接続されている。このよ
うなＤ／Ａ変換回路１４にあっては、出力電流が大きく
なると、その分カレントミラーのベース駆動電流が大き
くなるが、そのベース駆動電流が入力側トランジスタＱ
aの駆動電流から分流されるために、出力電流が大きく
なるにつれてビット変換精度が悪くなる問題がある。
換回路１４の一例である。Ｄ0〜Ｄn-1がデジタル値の入
力であり、表示データがレジスタ等を介して設定され
る。そして、図３の各ドライバのトランジスタＱ1〜Ｑm
の出力をこれのドライブ段とする。このドライブ段それ
ぞれの１ピン分の駆動回路を簡略化して定電流源１４ａ
として示すと、このＤ／Ａ変換回路１４は、この定電流
源１４ａからの電流Ｉをコレクタに受けるダイオード接
続の入力側npn型バイポーラトランジスタＱaとを有し、
これにカレントミラー接続された出力側npn型バイポー
ラトランジスタＱb〜Ｑn-1、各出力側トランジスタＱb
〜Ｑn-1のエミッタとグランドＧＮＤ間にスイッチ回路
として接続されたＮチャネルＭＯＳＦＥＴトランジスタ
Ｔrb〜Ｔrn-1が設けられている。そして、トランジスタ
Ｔrb〜Ｔrn-1のゲートがそれぞれＤ0〜Ｄn-1の各入力端
子に接続されている。出力側トランジスタＱb〜Ｑn-1
は、それぞれのコレクタが出力端子１４ｂに接続され、
トランジスタＱaのエミッタ面積に対してそれぞれのト
ランジスタが×１，×２，×３，…×ｎの倍数のエミッ
タ面積比を持っている。なお、入力側トランジスタＱa
のエミッタはグランドＧＮＤに接続されている。このよ
うなＤ／Ａ変換回路１４にあっては、出力電流が大きく
なると、その分カレントミラーのベース駆動電流が大き
くなるが、そのベース駆動電流が入力側トランジスタＱ
aの駆動電流から分流されるために、出力電流が大きく
なるにつれてビット変換精度が悪くなる問題がある。
【０００７】このような問題を解決するために図５のよ
うなウイルソン型カレントミラーを用いたＤ／Ａ変換回
路がＤ／Ａ変換回路１４として利用される。図５は、カ
レントミラー接続されたベース駆動電流を出力側から補
うものである。そのためにnpn型バイポーラトランジス
タＱqが出力側トランジスタＱbのコレクタと出力端子１
４ｂとの間に設けられている。そして、トランジスタＱ
qのエミッタとトランジスタＱbのコレクタとが接続さ
れ、そのエミッタがカレントミラーの共通のベースライ
ンに接続されている。そのベースは、トランジスタＱa
のコレクタに接続され、ベース駆動電流供給回路１４c
が設けらている。これにより入力側トランジスタＱaの
駆動電流からベース駆動電流が分流されないのでビット
変換精度は低下しないで済む。しかし、Ｄ／Ａ変換して
いないときにあっても、すなわち、Ｄ0〜Ｄn-1が”００
０…０”のときであっても、出力端子１４ａからトラン
ジスタＱqのコレクタ−エミッタ，トランジスタＱaのベ
ース−エミッタを介してグランドＧＮＤへとリーク電流
が流れる。このリーク電流は、トランジスタＱaのベー
ス駆動電流のほかに、図示するように出力端子１４bか
らグランドＧＮＤへと流れ、その電流値は数百ｎＡにも
なる。このリーク電流を持つＤ／Ａ変換回路１４は、ピ
ン数分だけ設けられるので、その分無駄な消費電力が増
加することになる。この発明の目的は、このような従来
技術の問題点を解決するものであって、リーク電流を低
減することができかつ高い精度でＤ／Ａ変換して駆動電
流を生成することができるＤ／Ａ変換回路およびこれを
用いる有機ＥＬ駆動回路を提供することにある。
うなウイルソン型カレントミラーを用いたＤ／Ａ変換回
路がＤ／Ａ変換回路１４として利用される。図５は、カ
レントミラー接続されたベース駆動電流を出力側から補
うものである。そのためにnpn型バイポーラトランジス
タＱqが出力側トランジスタＱbのコレクタと出力端子１
４ｂとの間に設けられている。そして、トランジスタＱ
qのエミッタとトランジスタＱbのコレクタとが接続さ
れ、そのエミッタがカレントミラーの共通のベースライ
ンに接続されている。そのベースは、トランジスタＱa
のコレクタに接続され、ベース駆動電流供給回路１４c
が設けらている。これにより入力側トランジスタＱaの
駆動電流からベース駆動電流が分流されないのでビット
変換精度は低下しないで済む。しかし、Ｄ／Ａ変換して
いないときにあっても、すなわち、Ｄ0〜Ｄn-1が”００
０…０”のときであっても、出力端子１４ａからトラン
ジスタＱqのコレクタ−エミッタ，トランジスタＱaのベ
ース−エミッタを介してグランドＧＮＤへとリーク電流
が流れる。このリーク電流は、トランジスタＱaのベー
ス駆動電流のほかに、図示するように出力端子１４bか
らグランドＧＮＤへと流れ、その電流値は数百ｎＡにも
なる。このリーク電流を持つＤ／Ａ変換回路１４は、ピ
ン数分だけ設けられるので、その分無駄な消費電力が増
加することになる。この発明の目的は、このような従来
技術の問題点を解決するものであって、リーク電流を低
減することができかつ高い精度でＤ／Ａ変換して駆動電
流を生成することができるＤ／Ａ変換回路およびこれを
用いる有機ＥＬ駆動回路を提供することにある。
【０００８】
【課題を解決するための手段】このような目的を達成す
るためのこの発明のＤ／Ａ変換回路およびこれを用いる
有機ＥＬ駆動回路の特徴は、複数の出力側トランジスタ
がパラレルにカレントミラー接続され入力側トランジス
タに所定の駆動電流を受けるカレントミラー回路と、入
力側トランジスタのベースあるいはゲートと出力側トラ
ンジスタとのベースあるいはゲートとが共通に接続され
た接続ラインに駆動電流を供給する駆動電流供給回路と
を有し、この駆動電流供給回路が、入力側トランジスタ
にカレントミラー接続されたダイオード接続の第１のト
ランジスタとこの第１のトランジスタの出力側に対して
出力側が所定のバイアスラインとグランドとの間に縦方
向に従属接続された第２のトランジスタとを有し、この
第２のトランジスタのベースあるいはゲートが入力側ト
ランジスタの入力側に接続され、入力側トランジスタが
ダイオード接続されていないものである。
るためのこの発明のＤ／Ａ変換回路およびこれを用いる
有機ＥＬ駆動回路の特徴は、複数の出力側トランジスタ
がパラレルにカレントミラー接続され入力側トランジス
タに所定の駆動電流を受けるカレントミラー回路と、入
力側トランジスタのベースあるいはゲートと出力側トラ
ンジスタとのベースあるいはゲートとが共通に接続され
た接続ラインに駆動電流を供給する駆動電流供給回路と
を有し、この駆動電流供給回路が、入力側トランジスタ
にカレントミラー接続されたダイオード接続の第１のト
ランジスタとこの第１のトランジスタの出力側に対して
出力側が所定のバイアスラインとグランドとの間に縦方
向に従属接続された第２のトランジスタとを有し、この
第２のトランジスタのベースあるいはゲートが入力側ト
ランジスタの入力側に接続され、入力側トランジスタが
ダイオード接続されていないものである。
【０００９】
【発明の実施の形態】このように、この発明にあって
は、出力端子とは異なる所定のバイアスラインから電流
が供給されてベースあるはゲートへ駆動電流を供給する
駆動電流供給回路を設け、この駆動電流供給回路からＤ
／Ａ変換のカレントミラー回路のベースあるはゲートの
接続ラインに電流を供給するようにしているので、出力
端子側からのリーク電流が発生することなく、カレント
ミラー接続のベースあるはゲートへ駆動電流を供給する
ことができる。その結果、リーク電流を低減することが
でき、精度の高いＤ／Ａ変換回路およびこれを用いる有
機ＥＬ駆動回路を実現することができる。
は、出力端子とは異なる所定のバイアスラインから電流
が供給されてベースあるはゲートへ駆動電流を供給する
駆動電流供給回路を設け、この駆動電流供給回路からＤ
／Ａ変換のカレントミラー回路のベースあるはゲートの
接続ラインに電流を供給するようにしているので、出力
端子側からのリーク電流が発生することなく、カレント
ミラー接続のベースあるはゲートへ駆動電流を供給する
ことができる。その結果、リーク電流を低減することが
でき、精度の高いＤ／Ａ変換回路およびこれを用いる有
機ＥＬ駆動回路を実現することができる。
【００１０】
【実施例】図１は、この発明の有機ＥＬ駆動回路を適用
した一実施例のカラムドライバを中心とするブロック
図、図２は、他の実施例のカラムドライバを中心とする
ブロック図である。なお、図３，図４と同一の構成要素
は同一の符号で示す。図１において、１は、有機ＥＬ駆
動回路のカラムドライバであって、２は、そのＤ／Ａ変
換回路、３は、そのカレントミラー電流出力回路であ
る。Ｄ／Ａ変換回路２は、図４のＤ／Ａ変換回路１４に
対応しているが、トランジスタＱqは削除されている。
出力側トランジスタＱbのコレクタは、図４と同様に出
力端子２ｂに接続されている。削除されたトランジスタ
Ｑqに換えてベース駆動電流供給回路４が設けられてい
る。このベース駆動電流供給回路４は、トランジスタＱ
aにカレントミラー接続されたダイオード接続のバイポ
ーラトランジスタＱrと、これの上流に設けられたＮチ
ャネル型のＭＯＳＦＥＴトランジスタＴrr、そして、バ
イポーラトランジスタＱrの下流でグランドＧＮＤとの
間に設けられた抵抗ＲrとＮチャネル型のＭＯＳＦＥＴ
トランジスタＴrraの直列回路とからなる。なお、図
４，図５では示していないが、トランジスタＱaの下流
にもグランドＧＮＤとの間に抵抗ＲaとＮチャネル型の
ＭＯＳＦＥＴトランジスタＴraの直列回路が同様に設け
られている。これら下流に設けられる直列回路は、Ｄ／
Ａ変換回路の出力側カレントミラーとの電流バランスを
採るためのものであり、これにより変換精度を確保する
役割を持つ。それぞれの直列回路のトランジスタＴraと
トランジスタＴrraのゲートは、それぞれ電源ライン＋
ＶDDにプルアップされている。ここで、２aは、Ｄ／Ａ
変換回路２の入力端子であり、図３の各ドライバのトラ
ンジスタＱ1〜Ｑmの出力をこれのドライブ段とし、この
ドライブ段のそれぞれの１ピン分の駆動回路を簡略化し
て定電流源１４ａから駆動電流を受ける。トランジスタ
Ｔrrのゲートは、トランジスタＱaのコレクタに接続さ
れ、ソースがトランジスタＱrのコレクタに接続され、
さらにトランジスタＱaのベースに接続されている。そ
のドレインは、電源ライン＋ＶDDラインに接続されてい
る。また、トランジスタＱrのエミッタはグランドＧＮ
Ｄに接続されている。これにより、各出力側トランジス
タＱb〜Ｑn-1のベース駆動電流がトランジスタＴrrを介
して電源ライン＋ＶDDから供給される。なお、トランジ
スタＴrrのドレインは、電源ライン＋ＶDDではなく、所
定のバイアスラインに接続されていてもよい。その結
果、図５の場合と同様にこのＡ／Ｄ変換回路２は、精度
の高いビット変換が可能である。なお、以上の場合、入
力側バイポーラトランジスタＱaは、ダイオード接続さ
れていない。
した一実施例のカラムドライバを中心とするブロック
図、図２は、他の実施例のカラムドライバを中心とする
ブロック図である。なお、図３，図４と同一の構成要素
は同一の符号で示す。図１において、１は、有機ＥＬ駆
動回路のカラムドライバであって、２は、そのＤ／Ａ変
換回路、３は、そのカレントミラー電流出力回路であ
る。Ｄ／Ａ変換回路２は、図４のＤ／Ａ変換回路１４に
対応しているが、トランジスタＱqは削除されている。
出力側トランジスタＱbのコレクタは、図４と同様に出
力端子２ｂに接続されている。削除されたトランジスタ
Ｑqに換えてベース駆動電流供給回路４が設けられてい
る。このベース駆動電流供給回路４は、トランジスタＱ
aにカレントミラー接続されたダイオード接続のバイポ
ーラトランジスタＱrと、これの上流に設けられたＮチ
ャネル型のＭＯＳＦＥＴトランジスタＴrr、そして、バ
イポーラトランジスタＱrの下流でグランドＧＮＤとの
間に設けられた抵抗ＲrとＮチャネル型のＭＯＳＦＥＴ
トランジスタＴrraの直列回路とからなる。なお、図
４，図５では示していないが、トランジスタＱaの下流
にもグランドＧＮＤとの間に抵抗ＲaとＮチャネル型の
ＭＯＳＦＥＴトランジスタＴraの直列回路が同様に設け
られている。これら下流に設けられる直列回路は、Ｄ／
Ａ変換回路の出力側カレントミラーとの電流バランスを
採るためのものであり、これにより変換精度を確保する
役割を持つ。それぞれの直列回路のトランジスタＴraと
トランジスタＴrraのゲートは、それぞれ電源ライン＋
ＶDDにプルアップされている。ここで、２aは、Ｄ／Ａ
変換回路２の入力端子であり、図３の各ドライバのトラ
ンジスタＱ1〜Ｑmの出力をこれのドライブ段とし、この
ドライブ段のそれぞれの１ピン分の駆動回路を簡略化し
て定電流源１４ａから駆動電流を受ける。トランジスタ
Ｔrrのゲートは、トランジスタＱaのコレクタに接続さ
れ、ソースがトランジスタＱrのコレクタに接続され、
さらにトランジスタＱaのベースに接続されている。そ
のドレインは、電源ライン＋ＶDDラインに接続されてい
る。また、トランジスタＱrのエミッタはグランドＧＮ
Ｄに接続されている。これにより、各出力側トランジス
タＱb〜Ｑn-1のベース駆動電流がトランジスタＴrrを介
して電源ライン＋ＶDDから供給される。なお、トランジ
スタＴrrのドレインは、電源ライン＋ＶDDではなく、所
定のバイアスラインに接続されていてもよい。その結
果、図５の場合と同様にこのＡ／Ｄ変換回路２は、精度
の高いビット変換が可能である。なお、以上の場合、入
力側バイポーラトランジスタＱaは、ダイオード接続さ
れていない。
【００１１】さらに、ここでは、出力端子２bからトラ
ンジスタＱaのベースが切り離されているので、Ｄ／Ａ
変換していないときであっても、すなわち、Ｄ0〜Ｄn-1
が”０００…０”のときにも、出力端子２ｂからのリー
ク電流はなくなる。このときの駆動電流は、ＭＯＳＦＥ
ＴトランジスタＴrrを介してトランジスタＱa，Ｑrのベ
ースに流す駆動電流とトランジスタＱrのコレクタ−エ
ミッタ間に流れる電流だけになる。トランジスタＱrと
トランジスタＴrrとからなるベース駆動電流供給回路４
は、ベース電流駆動のための電流を補給する回路であ
る。この回路から供給される電流は、上流のＭＯＳＦＥ
ＴトランジスタＴrrのドレイン−ソース間の高抵抗値を
介して流す数百ｎＡオーダ程度のもので済む。ここで、
トランジスタＱaとトランジスタＱrのエミッタ面積比を
１０：１とすれば、トランジスタＱaの動作電流とし
て、例えば、９００ｎＡ流すと、トランジスタＱr側に
９０ｎＡ流すことになる。このような回路において、リ
ーク電流が図５のリーク電流と同様にたとえ数百ｎＡあ
ったとしても、このリーク電流は、有機ＥＬパネルの出
力側（ピン９側）とは切り離されているので、ここでの
リーク電流が出力側に影響することはない。そのため、
リーク電流による出力側への影響が排除され、その影響
による電力消費分が低減される。図５においてリーク電
流が影響する出力側の電圧は、１５Ｖ乃至２０Ｖの電圧
の電源ライン＋Ｖccになるので、リーク電流に対する消
費電力への影響は大きいが、前記のベース駆動電流供給
回路４は、たとえリーク電流があっても５Ｖ乃至これ以
下の電圧の電源ライン＋ＶDDになっているので、トータ
ルとしての消費電力の低減につながる。しかも、上流側
にＭＯＳＦＥＴトランジスタを設けているので、ゲート
電流はほとんど流れずに済み、トランジスタＱaに流れ
る電流精度は向上する。これによりＤ／Ａ変換精度を向
上させることができる。なお、抵抗Ｒb〜Ｒn-1は、出力
側トランジスタＱb〜Ｑn-1のエミッタとトランジスタＴ
rb〜Ｔrn-1のドレインとの間に挿入されたエミッタ抵抗
である。これによりソース−ドレイン間の寄生容量との
関係で所定の時定数を確保できるが、これらのエミッタ
抵抗は必ず必要なものではない。
ンジスタＱaのベースが切り離されているので、Ｄ／Ａ
変換していないときであっても、すなわち、Ｄ0〜Ｄn-1
が”０００…０”のときにも、出力端子２ｂからのリー
ク電流はなくなる。このときの駆動電流は、ＭＯＳＦＥ
ＴトランジスタＴrrを介してトランジスタＱa，Ｑrのベ
ースに流す駆動電流とトランジスタＱrのコレクタ−エ
ミッタ間に流れる電流だけになる。トランジスタＱrと
トランジスタＴrrとからなるベース駆動電流供給回路４
は、ベース電流駆動のための電流を補給する回路であ
る。この回路から供給される電流は、上流のＭＯＳＦＥ
ＴトランジスタＴrrのドレイン−ソース間の高抵抗値を
介して流す数百ｎＡオーダ程度のもので済む。ここで、
トランジスタＱaとトランジスタＱrのエミッタ面積比を
１０：１とすれば、トランジスタＱaの動作電流とし
て、例えば、９００ｎＡ流すと、トランジスタＱr側に
９０ｎＡ流すことになる。このような回路において、リ
ーク電流が図５のリーク電流と同様にたとえ数百ｎＡあ
ったとしても、このリーク電流は、有機ＥＬパネルの出
力側（ピン９側）とは切り離されているので、ここでの
リーク電流が出力側に影響することはない。そのため、
リーク電流による出力側への影響が排除され、その影響
による電力消費分が低減される。図５においてリーク電
流が影響する出力側の電圧は、１５Ｖ乃至２０Ｖの電圧
の電源ライン＋Ｖccになるので、リーク電流に対する消
費電力への影響は大きいが、前記のベース駆動電流供給
回路４は、たとえリーク電流があっても５Ｖ乃至これ以
下の電圧の電源ライン＋ＶDDになっているので、トータ
ルとしての消費電力の低減につながる。しかも、上流側
にＭＯＳＦＥＴトランジスタを設けているので、ゲート
電流はほとんど流れずに済み、トランジスタＱaに流れ
る電流精度は向上する。これによりＤ／Ａ変換精度を向
上させることができる。なお、抵抗Ｒb〜Ｒn-1は、出力
側トランジスタＱb〜Ｑn-1のエミッタとトランジスタＴ
rb〜Ｔrn-1のドレインとの間に挿入されたエミッタ抵抗
である。これによりソース−ドレイン間の寄生容量との
関係で所定の時定数を確保できるが、これらのエミッタ
抵抗は必ず必要なものではない。
【００１２】カレントミラー電流出力回路３は、ドライ
ブ段カレントミラー回路３ａと出力段カレントミラー回
路３ｂとからなる。カレントミラー回路３ａは、ピーク
電流生成回路であって、ダイオード接続された入力側ト
ランジスタＱsと出力側トランジスタＱtとからなり、そ
れぞれのエミッタ側がＰチャネルＭＯＳＦＥＴトランジ
スタＴrs，ＮチャネルＭＯＳＦＥＴトランジスタＴrtを
介して出力段カレントミラー回路３ｂの入力端子３ｃに
接続されている。入力側トランジスタＱsのコレクタ
は、Ｄ／Ａ変換回路２の出力端子２bに接続され、出力
側トランジスタＱtのコレクタは、グランドＧＮＤに接
続されている。トランジスタＱsとトランジスタＱtのエ
ミッタ面積比は１：ｘである。ここで、Ｄ／Ａ変換回路
２の出力電流をＩaとすると、これに対して入力端子３c
に（ｘ＋１）Ｉaの駆動電流を発生することができる。
ブ段カレントミラー回路３ａと出力段カレントミラー回
路３ｂとからなる。カレントミラー回路３ａは、ピーク
電流生成回路であって、ダイオード接続された入力側ト
ランジスタＱsと出力側トランジスタＱtとからなり、そ
れぞれのエミッタ側がＰチャネルＭＯＳＦＥＴトランジ
スタＴrs，ＮチャネルＭＯＳＦＥＴトランジスタＴrtを
介して出力段カレントミラー回路３ｂの入力端子３ｃに
接続されている。入力側トランジスタＱsのコレクタ
は、Ｄ／Ａ変換回路２の出力端子２bに接続され、出力
側トランジスタＱtのコレクタは、グランドＧＮＤに接
続されている。トランジスタＱsとトランジスタＱtのエ
ミッタ面積比は１：ｘである。ここで、Ｄ／Ａ変換回路
２の出力電流をＩaとすると、これに対して入力端子３c
に（ｘ＋１）Ｉaの駆動電流を発生することができる。
【００１３】カレントミラー回路３ａは、トランジスタ
ＴrtがＯＮしているときには、（１＋ｘ）倍の駆動電流
を生成する。トランジスタＴrsは、トランジスタＴrtに
対応して設けられた負荷トランジスタであって、そのゲ
ートはグランドＧＮＤに接続されていて、駆動ラインを
バランスさせるために挿入されている。なお、トランジ
スタＴrtは、駆動初期の一定期間だけコントロール信号
CONTを受けてＯＮになる。これにより出力段カレントミ
ラー回路３ｂの入力側トランジスタＱxがベース電流補
正駆動用のカレントミラートランジスタＱu，Ｑwを介し
て駆動される。その結果、入力側トランジスタＱxによ
りトランジスタＴrtがＯＮしたピーク駆動時の一定期間
には（１＋ｘ）Ｉaの電流が流れる。その後に通常駆動
電流として駆動電流Ｉaが出力される。それらが出力段
カレントミラー回路３ｂの出力側トランジスタＱyでさ
らにＮ倍に電流増幅されて、有機ＥＬパネルのピン９に
出力される。なお、出力段カレントミラー回路３ｂのト
ランジスタＱxとトランジスタＱyのエミッタ面積比は
１：Ｎであり、これらトランジスタのエミッタは、電源
ライン＋ＶDDではなく、これより高い電圧、例えば、＋
１５Ｖ乃至＋２０Ｖ程度の電源ライン＋Ｖccに接続さ
れ、出力側トランジスタＱyのコレクタは、カラム側の
ピン９に接続されている。そこで、ピーク時にはＮ×
（１＋ｘ）Ｉaの駆動電流を流してピン９を駆動する。
これにより容量性負荷となる特性を持つ有機ＥＬ素子が
ピーク電流で初期充電されて電流駆動される。ところ
で、ピーク電流生成回路であるカレントミラー回路３ａ
を前記したようにＤ／Ａ変換回路２と出力段カレントミ
ラー回路３ｂとの間に設けることにより消費電力の低減
を図ることができる。それは、通常、ピーク電流生成回
路が図３に示す 基準電圧発生回路１１に設けられるか
らである。この場合には、ドライブ段となるカレントミ
ラー電流出力回路１３を経てカレントミラー電流出力回
路３に至るまでにピーク電流信号が多数のステージを経
てそれぞれのステージに流れることになる。そのために
各ステージを構成するトランジスタでピーク電流分の電
力が消費される。しかし、この実施例のように最終段に
近い位置にピーク電流生成回路を配置することで、その
分無駄な電力消費が抑えられる。
ＴrtがＯＮしているときには、（１＋ｘ）倍の駆動電流
を生成する。トランジスタＴrsは、トランジスタＴrtに
対応して設けられた負荷トランジスタであって、そのゲ
ートはグランドＧＮＤに接続されていて、駆動ラインを
バランスさせるために挿入されている。なお、トランジ
スタＴrtは、駆動初期の一定期間だけコントロール信号
CONTを受けてＯＮになる。これにより出力段カレントミ
ラー回路３ｂの入力側トランジスタＱxがベース電流補
正駆動用のカレントミラートランジスタＱu，Ｑwを介し
て駆動される。その結果、入力側トランジスタＱxによ
りトランジスタＴrtがＯＮしたピーク駆動時の一定期間
には（１＋ｘ）Ｉaの電流が流れる。その後に通常駆動
電流として駆動電流Ｉaが出力される。それらが出力段
カレントミラー回路３ｂの出力側トランジスタＱyでさ
らにＮ倍に電流増幅されて、有機ＥＬパネルのピン９に
出力される。なお、出力段カレントミラー回路３ｂのト
ランジスタＱxとトランジスタＱyのエミッタ面積比は
１：Ｎであり、これらトランジスタのエミッタは、電源
ライン＋ＶDDではなく、これより高い電圧、例えば、＋
１５Ｖ乃至＋２０Ｖ程度の電源ライン＋Ｖccに接続さ
れ、出力側トランジスタＱyのコレクタは、カラム側の
ピン９に接続されている。そこで、ピーク時にはＮ×
（１＋ｘ）Ｉaの駆動電流を流してピン９を駆動する。
これにより容量性負荷となる特性を持つ有機ＥＬ素子が
ピーク電流で初期充電されて電流駆動される。ところ
で、ピーク電流生成回路であるカレントミラー回路３ａ
を前記したようにＤ／Ａ変換回路２と出力段カレントミ
ラー回路３ｂとの間に設けることにより消費電力の低減
を図ることができる。それは、通常、ピーク電流生成回
路が図３に示す 基準電圧発生回路１１に設けられるか
らである。この場合には、ドライブ段となるカレントミ
ラー電流出力回路１３を経てカレントミラー電流出力回
路３に至るまでにピーク電流信号が多数のステージを経
てそれぞれのステージに流れることになる。そのために
各ステージを構成するトランジスタでピーク電流分の電
力が消費される。しかし、この実施例のように最終段に
近い位置にピーク電流生成回路を配置することで、その
分無駄な電力消費が抑えられる。
【００１４】図２は、他の実施例であって、入力デジタ
ル値をＤo〜Ｄ4の５ビットとして１６倍までの電流を発
生する例である。出力側トランジスタは、Ｑb〜Ｑfであ
り、スイッチ回路としてのトランジスタは、Ｔrb〜Ｔrf
である。なお、出力側トランジスタＱb〜Ｑfのエミッタ
とトランジスタＴrb〜Ｔrfのドレインとの間に挿入され
た図１に示す抵抗Ｒb〜Ｒfは、省略してある。同様に、
トランジスタＱa，Ｑrの下流の抵抗Ｒa，Ｒrも省略して
ある。この実施例では、Ｄ／Ａ変換回路２の、×８，×
１６の倍数の桁位置のビットに対するカレントミラーの
出力側のトランジスタを×４倍として、これに対して縦
にカレントミラー回路を積上げて従属接続し、電流増幅
する回路としたＤ／Ａ変換回路２０である。すなわち、
８倍の桁位置のカレントミラー回路５は、×４の倍数の
カレントミラーの出力側トランジスタＱeの上流にカレ
ントミラー回路６が設けられ、合計で８倍の電流値８Ｉ
を出力端子２bから引き込む。１６倍の桁位置のカレン
トミラー回路７は、×４の倍数のカレントミラーの出力
側トランジスタＱfの上流にカレントミラー回路８が設
けられ、合計で１６倍の電流値１６Ｉを出力端子２bか
ら引き込む。カレントミラー回路６は、出力側トランジ
スタＱeのコレクタにコレクタが接続され、エミッタが
出力端子２bに接続された入力側トランジスタＱgと、コ
レクタがグランドＧＮＤに接続され、エミッタが出力端
子２ｂに接続された出力側トランジスタＱhからなる。
トランジスタＱgとトランジスタＱhとのエミッタ面積比
は１：１であって、トランジスタＱgは、トランジスタ
Ｑa，Ｑbと同様なエミッタ面積を持っている。したがっ
て、カレントミラー回路５は、トランジスタＱaに対し
て×８の倍数のエミッタ面積を持つ図１の場合の×８の
トランジスタを設けるよりも×１の倍数のトランジスタ
が２個と×４の倍数のトランジスタ１個で済む。その結
果、トランジスタの専有面積が全体として小さくなる。
ル値をＤo〜Ｄ4の５ビットとして１６倍までの電流を発
生する例である。出力側トランジスタは、Ｑb〜Ｑfであ
り、スイッチ回路としてのトランジスタは、Ｔrb〜Ｔrf
である。なお、出力側トランジスタＱb〜Ｑfのエミッタ
とトランジスタＴrb〜Ｔrfのドレインとの間に挿入され
た図１に示す抵抗Ｒb〜Ｒfは、省略してある。同様に、
トランジスタＱa，Ｑrの下流の抵抗Ｒa，Ｒrも省略して
ある。この実施例では、Ｄ／Ａ変換回路２の、×８，×
１６の倍数の桁位置のビットに対するカレントミラーの
出力側のトランジスタを×４倍として、これに対して縦
にカレントミラー回路を積上げて従属接続し、電流増幅
する回路としたＤ／Ａ変換回路２０である。すなわち、
８倍の桁位置のカレントミラー回路５は、×４の倍数の
カレントミラーの出力側トランジスタＱeの上流にカレ
ントミラー回路６が設けられ、合計で８倍の電流値８Ｉ
を出力端子２bから引き込む。１６倍の桁位置のカレン
トミラー回路７は、×４の倍数のカレントミラーの出力
側トランジスタＱfの上流にカレントミラー回路８が設
けられ、合計で１６倍の電流値１６Ｉを出力端子２bか
ら引き込む。カレントミラー回路６は、出力側トランジ
スタＱeのコレクタにコレクタが接続され、エミッタが
出力端子２bに接続された入力側トランジスタＱgと、コ
レクタがグランドＧＮＤに接続され、エミッタが出力端
子２ｂに接続された出力側トランジスタＱhからなる。
トランジスタＱgとトランジスタＱhとのエミッタ面積比
は１：１であって、トランジスタＱgは、トランジスタ
Ｑa，Ｑbと同様なエミッタ面積を持っている。したがっ
て、カレントミラー回路５は、トランジスタＱaに対し
て×８の倍数のエミッタ面積を持つ図１の場合の×８の
トランジスタを設けるよりも×１の倍数のトランジスタ
が２個と×４の倍数のトランジスタ１個で済む。その結
果、トランジスタの専有面積が全体として小さくなる。
【００１５】なお、ここで各トランジスタに流れる電流
値は、μＡオーダの微少電流であるので、セル化されて
形成された１個のトランジスタにおいてエミッタ面積比
が×１のものであっても、４倍の電流値４Ｉを十分に流
せる能力がある。また、微少な電流を生成する場合に×
ｎのエミッタ面積比のカレントミラー回路の出力側トラ
ンジスタＱは、通常、セルとして形成されたトランジス
タＱをｎ個パラレルに接続することで形成される。そこ
で、前記の場合には、×１のトランジスタが６個とな
り、図１の実施例では、×８の倍数の場合、×１のトラ
ンジスタを８個用いることになるので、この場合よりも
トランジスタの数が２個少なくて済む。１６倍の桁位置
のカレントミラー回路７も同様な形態を採っていて、カ
レントミラー回路８は、入力側トランジスタＱiと出力
側トランジスタＱjからなる。ここで、トランジスタＱi
とトランジスタＱjとのエミッタ面積比は１：３であっ
て、る。全体として１６Ｉの電流を出力端子２bからシ
ンクすることができる。この場合には、×１のトランジ
スタが８個となり、×１のトランジスタを１６個用いる
図１の×１６の倍数の出力トランジスタの場合の半分と
なる。
値は、μＡオーダの微少電流であるので、セル化されて
形成された１個のトランジスタにおいてエミッタ面積比
が×１のものであっても、４倍の電流値４Ｉを十分に流
せる能力がある。また、微少な電流を生成する場合に×
ｎのエミッタ面積比のカレントミラー回路の出力側トラ
ンジスタＱは、通常、セルとして形成されたトランジス
タＱをｎ個パラレルに接続することで形成される。そこ
で、前記の場合には、×１のトランジスタが６個とな
り、図１の実施例では、×８の倍数の場合、×１のトラ
ンジスタを８個用いることになるので、この場合よりも
トランジスタの数が２個少なくて済む。１６倍の桁位置
のカレントミラー回路７も同様な形態を採っていて、カ
レントミラー回路８は、入力側トランジスタＱiと出力
側トランジスタＱjからなる。ここで、トランジスタＱi
とトランジスタＱjとのエミッタ面積比は１：３であっ
て、る。全体として１６Ｉの電流を出力端子２bからシ
ンクすることができる。この場合には、×１のトランジ
スタが８個となり、×１のトランジスタを１６個用いる
図１の×１６の倍数の出力トランジスタの場合の半分と
なる。
【００１６】以上説明してきたが、実施例では、入力側
のトランジスタＱaにカレントミラー接続されたバイポ
ーラトランジスタＱrと、これの上流に設けられたＮチ
ャネルのＭＯＳＦＥＴトランジスタＴrrとからなるベー
ス駆動電流供給回路４を設けているが、トランジスタＴ
rrは、抵抗とバイポーラトランジスタの直列回路であっ
てもよい。この場合には、少し電流が増加するが、それ
でもＤ／Ａ変換していないときの駆動電流については、
図５の場合のリーク電流値よりも小さくすることができ
る。また、実施例のｎｐｎ型トランジスタは、ｐｎｐト
ランジスタに、ｐｎｐ型トランジスタは、ｎｐｎトラン
ジスタに置き換えることができる。この場合には、電源
電圧は負となり、上流に設けたトランジスタは下流に設
けることになる。さらに、実施例のＤ／Ａ変換回路は、
バイポーラトランジスタを主体として構成しているが、
ＭＯＳＦＥＴトランジスタを主体として構成してもよい
ことはもちろんである。この場合、カレントミラー回路
の入力側トランジスタと出力側トランジスタとは、ゲー
トが共通に接続されることになる。
のトランジスタＱaにカレントミラー接続されたバイポ
ーラトランジスタＱrと、これの上流に設けられたＮチ
ャネルのＭＯＳＦＥＴトランジスタＴrrとからなるベー
ス駆動電流供給回路４を設けているが、トランジスタＴ
rrは、抵抗とバイポーラトランジスタの直列回路であっ
てもよい。この場合には、少し電流が増加するが、それ
でもＤ／Ａ変換していないときの駆動電流については、
図５の場合のリーク電流値よりも小さくすることができ
る。また、実施例のｎｐｎ型トランジスタは、ｐｎｐト
ランジスタに、ｐｎｐ型トランジスタは、ｎｐｎトラン
ジスタに置き換えることができる。この場合には、電源
電圧は負となり、上流に設けたトランジスタは下流に設
けることになる。さらに、実施例のＤ／Ａ変換回路は、
バイポーラトランジスタを主体として構成しているが、
ＭＯＳＦＥＴトランジスタを主体として構成してもよい
ことはもちろんである。この場合、カレントミラー回路
の入力側トランジスタと出力側トランジスタとは、ゲー
トが共通に接続されることになる。
【００１７】
【発明の効果】以上説明してきたように、この発明にあ
っては、出力端子とは異なる所定のバイアスラインから
電流が供給されてベースあるはゲートへ駆動電流を供給
する駆動電流供給回路を設け、この駆動電流供給回路か
らＤ／Ａ変換のカレントミラー回路のベースあるはゲー
トの接続ラインに電流を供給するようにしているので、
出力端子側からのリーク電流が発生することなく、カレ
ントミラー接続のベースあるはゲートへ駆動電流を供給
することができる。その結果、リーク電流を低減するこ
とができ、精度の高いＤ／Ａ変換回路およびこれを用い
る有機ＥＬ駆動回路を実現することができる。
っては、出力端子とは異なる所定のバイアスラインから
電流が供給されてベースあるはゲートへ駆動電流を供給
する駆動電流供給回路を設け、この駆動電流供給回路か
らＤ／Ａ変換のカレントミラー回路のベースあるはゲー
トの接続ラインに電流を供給するようにしているので、
出力端子側からのリーク電流が発生することなく、カレ
ントミラー接続のベースあるはゲートへ駆動電流を供給
することができる。その結果、リーク電流を低減するこ
とができ、精度の高いＤ／Ａ変換回路およびこれを用い
る有機ＥＬ駆動回路を実現することができる。
【図１】図１は、この発明の有機ＥＬ駆動回路を適用し
た一実施例のカラムドライバを中心とするブロック図で
ある。
た一実施例のカラムドライバを中心とするブロック図で
ある。
【図２】図２は、他の実施例のカラムドライバを中心と
するブロック図である。
するブロック図である。
【図３】図３は、従来のカラムドライバの一例の説明図
である。
である。
【図４】図４は、従来の有機ＥＬ駆動回路のＤ／Ａ変換
回路の一例の説明図である。
回路の一例の説明図である。
【図５】図５は、従来の有機ＥＬ駆動回路のＤ／Ａ変換
回路の他の一例の説明図である。
回路の他の一例の説明図である。
１…カラムドライバ、２，１４…Ｄ／Ａ変換回路、２a
…入力端子、２b…出力端子、３，１３…カレントミラ
ー電流出力回路、３ａ…ドライブ段カレントミラー回
路、３b…出力段カレントミラー回路、４，１１c…ベー
ス駆動電流供給回路、５，６，７，８…カレントミラー
回路、９…ピン、１０…カラムライン電流駆動回路、Ｑ
1〜Ｑm，Ｑa〜Ｑn-1…トランジスタ。
…入力端子、２b…出力端子、３，１３…カレントミラ
ー電流出力回路、３ａ…ドライブ段カレントミラー回
路、３b…出力段カレントミラー回路、４，１１c…ベー
ス駆動電流供給回路、５，６，７，８…カレントミラー
回路、９…ピン、１０…カラムライン電流駆動回路、Ｑ
1〜Ｑm，Ｑa〜Ｑn-1…トランジスタ。
─────────────────────────────────────────────────────
フロントページの続き
(72)発明者 藤沢 雅憲
京都市右京区西院溝崎町21番地 ローム株
式会社内
Ｆターム(参考） 5C080 AA06 BB05 CC03 DD26 EE28
FF11 JJ03
5J022 AB04 BA01 CF04 CF07
Claims (7)
- 【請求項１】複数の出力側トランジスタがパラレルにカ
レントミラー接続され入力側トランジスタに所定の駆動
電流を受けるカレントミラー回路を有し、それぞれ前記
出力側トランジスタが入力データのビット桁位置対応に
配置されて前記入力データに応じて選択的に駆動され、
前記入力データに対応する変換アナログ電流を前記出力
側トランジスタに流れる合計の電流値として出力端子に
発生するＤ／Ａ変換回路において、 前記入力側トランジスタのベースあるいはゲートと前記
出力側トランジスタとのベースあるいはゲートとが共通
に接続された接続ラインに駆動電流を供給する駆動電流
供給回路を備え、この駆動電流供給回路は、前記入力側
トランジスタにカレントミラー接続されたダイオード接
続の第１のトランジスタとこの第１のトランジスタの出
力側に対して出力側が所定のバイアスラインとグランド
との間に縦方向に従属接続された第２のトランジスタと
を有し、この第２のトランジスタのベースあるいはゲー
トが前記入力側トランジスタの入力側に接続され、前記
入力側トランジスタがダイオード接続されていないこと
を特徴とするＤ／Ａ変換回路。 - 【請求項２】前記第１のトランジスタと前記入力側トラ
ンジスタおよび前記出力側トランジスタとは、バイポー
ラトランジスタで構成され、前記第２のトランジスタ
は、ＭＯＳＦＥＴトランジスタである請求項１記載のＤ
／Ａ変換回路。 - 【請求項３】前記第１、第２のトランジスタと前記入力
側トランジスタおよび前記出力側トランジスタは、ＭＯ
ＳＦＥＴトランジスタである請求項１記載のＤ／Ａ変換
回路。 - 【請求項４】表示データを受けてこれに対応する表示の
ためのアナログの電流を発生するＤ／Ａ変換回路と、 このＤ／Ａ変換回路からの出力電流で駆動され有機ＥＬ
表示パネルの端子ピンを駆動するカレントミラー電流出
力回路とを備え、 前記Ｄ／Ａ変換回路は、複数の出力側トランジスタがパ
ラレルにカレントミラー接続され入力側トランジスタに
所定の駆動電流を受けるカレントミラー回路と、前記入
力側トランジスタのベースあるいはゲートと前記出力側
トランジスタとのベースあるいはゲートとが共通に接続
された接続ラインに駆動電流を供給する駆動電流供給回
路とを有し、この駆動電流供給回路は、前記入力側トラ
ンジスタにカレントミラー接続されたダイオード接続の
第１のトランジスタとこの第１のトランジスタの出力側
に対して出力側が所定のバイアスラインとグランドとの
間に縦方向に従属接続された第２のトランジスタとを有
し、この第２のトランジスタのベースあるいはゲートが
前記入力側トランジスタの入力側に接続され、前記入力
側トランジスタがダイオード接続されていないことを特
徴とする有機ＥＬ駆動回路。 - 【請求項５】前記第１のトランジスタと前記入力側トラ
ンジスタおよび前記出力側トランジスタとは、バイポー
ラトランジスタで構成され、前記第２のトランジスタ
は、ＭＯＳＦＥＴトランジスタである請求項４記載の有
機ＥＬ駆動回路。 - 【請求項６】前記第１、第２のトランジスタと前記入力
側トランジスタおよび前記出力側トランジスタは、ＭＯ
ＳＦＥＴトランジスタである請求項４記載の有機ＥＬ駆
動回路。 - 【請求項７】さらに、ピーク電流生成回路を有し、この
ピーク電流生成回路は、前記Ｄ／Ａ変換回路の前記出力
電流を受けてその出力電流に応じたピーク電流を生成し
前記カレントミラー電流出力回路を駆動する請求項４記
載の有機ＥＬ駆動回路。
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