JP2003228341A5 - - Google Patents
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- デジタル映像信号を受け取るバス配線と、前記バス配線上のデジタル映像信号を順次サンプリングして並列的に出力するデータレジスタとを備え、前記データレジスタはデジタル映像信号の信号電圧をそれぞれビット単位にレベル変換する複数のサンプリングラッチを含み、各サンプリングラッチは複数の容量素子、並びに前記複数の容量素子を並列に接続して前記バス配線の対応ビット線からの信号電圧を前記複数の容量素子にそれぞれ保持させるサンプル状態およびこのサンプル状態に続いて前記複数の容量素子を直列に接続して電荷の再配分によりレベル加算させた信号電圧を前記複数の容量素子から出力する出力状態を設定する接続制御回路を含むことを特徴とする信号処理回路。
- 前記サンプリングラッチは前記出力状態で前記複数の容量素子から出力される信号電圧により動作するインバータ回路を含むことを特徴とする請求項１に記載の信号処理回路。
- 前記複数の容量素子は第１および第２容量素子を含み、前記接続制御回路は前記サンプル状態で導通する第１から第３スイッチ素子および前記出力状態で導通する第４および第５スイッチ素子を含み、前記第２容量素子は一端において前記第１スイッチ素子を介して前記ビット線に接続されると共に他端において基準電位端子に接続され、前記第１容量素子は一端において前記第１および第２スイッチ素子を介して前記ビット線に接続されさらに前記第５スイッチ素子を介して前記インバータ回路の入力端に接続されると共に他端において前記第３スイッチ素子を介して前記基準電位端子に接続されさらに前記第４スイッチ素子を介して前記第２容量素子の前記一端に接続されることを特徴とする請求項２に記載の信号処理回路。
- 前記第１、第２、第４および第５スイッチ素子の各々は一対のＰおよびＮチャネル薄膜トランジスタで構成されるトランスファゲートであり、前記第３スイッチ素子は単一のＮチャネル薄膜トランジスタであることを特徴とする請求項３に記載の信号処理回路。
- 前記複数の容量素子はさらに第３容量素子を含み、前記接続制御回路は前記サンプル状態で導通する第６および第７スイッチ素子並びに出力状態で導通する第８スイッチ素子を含み、前記ビット線は前記第１および第６スイッチ素子および前記第３容量素子を介して前記基準電位端子に接続され、前記第２容量素子の他端は前記第７スイッチ素子を介して前記基準電位端子に接続されさらに前記第８スイッチ素子および前記第３容量素子を介して前記基準電位端子に接続されることを特徴とする請求項３に記載の信号処理回路。
- さらに前記データレジスタから並列的に出力されるデジタル映像信号をアナログ形式の階調電圧にそれぞれ変換するＤ／Ａコンバータを備えることを特徴とする請求項１に記載の信号処理回路。
- 複数の表示画素部と、前記複数の表示画素部に接続される複数の信号線と、前記複数の信号線を映像信号に対応して駆動する信号線駆動回路とを備え、前記信号線駆動回路は請求項１に記載の信号処理回路を含むことを特徴とする表示装置。
- ディジタル入力配線に一方の電極が接続され他方の電極が所定の電位に接続された第１容量と、ディジタル入力配線に一方の電極が接続され他方の電極が前記第１容量の一方の電極に接続されると共に所定の電位に接続された第２容量とを備えた信号処理回路であって、ディジタル入力信号を前記第１容量と前記第２容量に電気的に独立して書き込む書込モードと、前記第１容量の一方の電極を前記第２容量の他方の電極に電気的に接続することで前記第１容量の一方の電極の電位を調整する電位調整モードとを実現するスイッチ回路群を含むことを特徴とする信号処理回路。
- デジタル映像信号を受け取るバス配線と、前記バス配線上のデジタル映像信号を順次サンプリングして並列的に出力するデータレジスタとを備え、前記データレジスタはデジタル映像信号の信号電圧をそれぞれビット単位にレベル変換する複数のサンプリングラッチを含み、各サンプリングラッチは複数の容量素子、並びに前記複数の容量素子を並列に接続して前記バス配線の対応ビット線からの信号電圧を前記複数の容量素 子にそれぞれ保持させるサンプル状態およびこのサンプル状態に続いて前記複数の容量素子を直列に接続して電荷の再配分によりレベルシフトさせた信号電圧を前記複数の容量素子の１つから出力する出力状態を設定する接続制御回路を含むことを特徴とする信号処理回路。
- デジタル映像信号を受け取るバス配線と、複数の容量素子と、前記複数の容量素子を並列に接続して前記バス配線からの信号電圧を前記複数の容量素子にそれぞれ保持させるサンプル状態およびこのサンプル状態に続いて前記複数の容量素子を直列に接続して電荷の再配分によりレベルシフトさせた信号電圧を前記複数の容量素子の１つから出力する出力状態を設定する接続制御回路とを含むことを特徴とする信号処理回路。
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| JP2002027128A JP4047594B2 (ja) | 2002-02-04 | 2002-02-04 | 信号処理回路 |
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