JP2002329682A - Cu薄膜作製方法 - Google Patents
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Abstract
なCVD法によって成膜するCu−CVD工程と、当該
第一の銅膜上に電解銅めっき法によって第二の銅膜を作
製するめっき工程とを含むCu薄膜の作製方法におい
て、第一の銅膜と、その上に電解銅めっき法によって作
製された第二の銅膜との界面近傍に微細な空孔が生成さ
れることを効果的に防止できるCu薄膜の作製方法を提
案する。 【解決手段】 Cu-Seed膜となる第一の銅膜(as depo.
膜)を成膜するCu−CVD工程と、めっき工程との間
に、前記第一の銅膜を、プラズマ、又は分子を熱分解し
て生成した遊離活性種のいずれかを使用した活性雰囲気
に晒して改質を行う改質工程を介在させることによって
課題を解決した。
Description
法に関し、特に、被処理基板上に形成され、凹部が設け
られている絶縁膜上に形成した拡散バリア膜上に銅膜を
形成し、前記凹部を銅材料で充填する配線用のCu薄膜
の作製に適したCu薄膜の作製方法に関する。
い、配線材料としてCu(銅)が使用されている。その
理由は、Cuは、Al(アルミニウム)に比較して低抵
抗であり、ストレスマイグレイションやエレクトロマイ
グレイションという配線を構成する金属原子の拡散挙動
が支配する現象に対して高い耐性をもっているからであ
る。
ては、絶縁膜に配線及び接続孔(ビアホール、またはコ
ンタクトホール)のパターンを形成し、その後バリア膜
を成膜、さらに、銅(Cu)膜をパターン凹部に埋め込
み、CMP(化学的機械研磨法)により余分な銅膜等を
除去して行う方法が用いられている。
の作製方法を図1を用いて説明する。図1(a)のよう
に、基体(半導体基板)1上に形成され、凹部が設けら
れた絶縁膜2を所定パターンにエッチングした後、図1
(b)図示のように、PVD法により下地バリア膜3を
成膜する。次いで、図1(c)図示のように、PVD法
により第一の銅膜4を成膜する(この、第一の銅膜(as
depo.膜)は、電解銅めっきの電極用下地膜となるもの
で、Cu-Seed 膜と呼ばれるものである。)。次に、図1
(d)図示のように、電解めっき装置を用い、この第一
の銅膜(Cu-Seed 膜)4を電極とし、絶縁膜2の所定パ
ターン内を符号5で表すように第二の銅膜で埋め込む。
次いで、図1(e)図示のように、CMP(化学的機械
研磨法)により余分な銅膜等を除去するものである。
素子の配線として使用されるものであるが、近年、デバ
イスの集積化が進むにつれて、微細で、深い穴や溝への
被覆性の良いバリア膜やCu-Seed 膜の成膜が求められて
いる。
かからない技術として広く採用されてきているが、上述
のように、予め、Cu-Seed 膜となる第一の銅膜を形成し
ておく必要がある。
被覆性で作製する方法として注目されている方法の一つ
に、有機金属化合物や有機金属錯体を原料として用いた
CVD法(化学気相成長法)がある。
D法を用いた従来の配線用のCu薄膜の作製方法を図2
を用いて説明する。図2(a)のように、基体(半導体
基板)1上に形成され、凹部が設けられた絶縁膜2を所
定パターンにエッチングした後、図2(b)図示のよう
に、例えば、MOCVD法(Metal Organic ChemicalVa
por Depositon)により下地バリア膜(例えば、TiN
膜)3を成膜する。次いで、図2(c)図示のように、
CVD法によりCu-Seed 膜となる第一の銅膜(as depo.
膜)4を成膜する。次いで、図2(e)図示のように、
電解めっき装置により、Cu-Seed 膜となる第一の銅膜4
を電極とし、絶縁膜2の所定パターン内を符号5で表す
ように第二の銅膜で埋め込み、図2(f)図示のよう
に、CMP(化学的機械研磨法)により余分な銅膜等を
除去するものである。なお、第一の銅膜4を成膜した後
に、図2(d)図示のように、密着性改善を目的として
加熱(アニール)処理を行い、アニール処理後の第一の
銅膜4をCu-Seed 膜とすることもある。また、図示して
いないが、下地バリア膜3を成膜した後、第一の銅膜4
の成膜前に、密着性改善を目的としてプラズマ処理など
を行うこともある。
て、Cu-Seed 膜となる第一の銅膜の作製に前記のように
有機金属化合物や有機金属錯体を原料として用いたCV
D法を用いることにより、微細パターンに対応できる第
一の銅膜( Cu-Seed膜)形成が可能になった。
いた従来の配線用Cu薄膜作製方法における図2(e)
図示の状態の電解銅めっき後の膜の断面をSEM(走査
型電子顕微鏡)で観察したところ、第一の銅膜と、電解
銅めっきにより形成された第二の銅膜との界面近傍に微
細な空孔が存在することが明らかになった(図3、図
4)。
膜(Cu-Seed 膜)の上に電解銅めっきにより形成された
第二の銅膜の界面特性を悪化させるものである。そし
て、このようにして作製されたCu薄膜が配線として使
用されると、配線抵抗の増大、エレクトロマイグレーシ
ョン耐性の低下などの不具合を生じさせるものである。
現状の動作速度より更なる高速化が求められている。こ
のような高速化素子を作製するには、配線抵抗の低抵抗
化は必須である。しかるに、前記のように、as depo.
状態である第一の銅膜( Cu-Seed膜)と、この上に電解
銅めっきにより形成された第二の銅膜との界面近傍に微
細な空孔が存在することによって、配線抵抗の増大がも
たらされてしまうと、高速化素子の作製にとっては致命
的な欠点となりかねない。
することにより、配線部分が微細化され、この部分に流
す電流密度が増加する。このため、従来より更なるエレ
クトロマイグレーション耐性が配線に求められるので、
エレクトロマイグレーション耐性の低下も、高速化素子
の作製にとって、致命的な欠点になりかねない。
D法によって Cu-Seed膜となる第一の銅膜(as depo.
膜)を成膜し、次いで当該第一の銅膜を電極とした電解
銅めっき法によって第一の銅膜上に更に第二の銅膜を作
製するめっき工程とを含むCu薄膜の作製において、前
記第一の銅膜と第二の銅膜との界面近傍に微細な空孔が
生成されることを効果的に防止できるCu薄膜の作製方
法を提案することを目的としている。
なCVD法によって Cu-Seed膜となる第一の銅膜(asde
po.膜)を形成した後、当該第一の銅膜を電解銅めっき
用電極として用いるめっき工程を行う前に、当該第一の
銅膜を活性雰囲気で処理する改質工程を行い、このよう
に改質処理された第一の銅膜を Cu-Seed膜とすることに
より、前記課題を解決したものである。
製方法は、半導体基板などの基体と、当該基体の所定の
表面(例えば、半導体基板上に形成され、凹部が設けら
れた絶縁膜の表面など)に第一の銅膜をCVD法によっ
て成膜するCu−CVD工程と、当該第一の銅膜を電極
とした電解銅めっき法によって当該第一の銅膜上に更に
第二の銅膜を成膜するめっき工程とを含むCu薄膜作製
方法において、前記Cu−CVD工程と、めっき工程と
の間に、前記as depo.状態にある第一の銅膜を活性雰囲
気に晒して改質を行う改質工程を介在させることを特徴
とするものである。
としては、プラズマ、又は分子を熱分解して生成した遊
離活性種のいずれかを採用することができる。
存在している活性雰囲気で行われることが望ましく、更
に、改質工程は、基体の温度を−100℃〜250℃の
範囲に保って行うことが望ましい。
と同一の真空内で行うことが望ましく、更に、密着性改
善工程を、Cu−CVD工程の前、Cu−CVD工程と
改質工程との間、改質工程とめっき工程との間の、少な
くとも一箇所に介在させることもできる。
プラズマ処理や、アニール処理を行うことができる。
の好ましい実施形態を説明する。
方法が、例えば、被処理基板上に形成され、凹部が設け
られている絶縁膜上に形成した拡散バリア膜上に第一の
銅膜が形成され、次いで、前記凹部を銅材料で充填する
配線用のCu薄膜の作製に用いられる際に使用し得るも
のである。例えば、図7図示のように、半導体基板31
上に形成され、凹部が設けられた絶縁膜32上に、拡散
バリア用下地膜(例えば、TiN膜)33が成膜され、
この上に、Cu−CVD法によって第一の銅膜(as dep
o.膜)34が形成され、次いで、このas depo.状態の第
一の銅膜34に改質処理が施される工程を行うまでのシ
ステムの一例を表すものである。
電率膜であってもかまわない。しかも、拡散バリア用下
地膜33は、TiN膜に限られることなく、Ta、Ta
N、WxNや、TiSiN等の高融点金属膜でも可能で
あり、また、この拡散バリア用下地膜33の成膜方法も
CVD法に限られず、スパッタリングなどを用いてもか
まわない。
用し得るCu薄膜作製装置がマルチチャンバ方式の装置
として構成されている場合の一例を説明するものであ
る。搬送ロボット(基板搬送機構)11を内蔵したセパ
レーションチャンバ(トランスファーチャンバ)12が
中央に設けられており、セパレーションチャンバ12の
周囲に、拡散バリア膜成膜用のTiN−CVDチャンバ
13、Cu−CVDチャンバ14、改質処理チャンバ1
5、アニールチャンバ16が配置されていると共に、2
つのロード/アンロードモジュール17、18が付設さ
れている。各チャンバには、それぞれ真空排気機構13
a、14a、15a、16aが備えられており、また、
各チャンバ等には、それぞれゲートバルブ19が設けら
れている。真空排気機構13a、14a、15a、16
aの動作は不図示のコントローラによって制御され、各
チャンバ内が内部を適宜、減圧状態、すなわち所望の真
空状態に保持される。また、各チャンバで使用されるプ
ロセスガス等の流量制御も不図示のコントローラによっ
て行われる。
機械・システムを構成する部分で、機能的にまとまった
部分を意味する。したがって、前記のTiN−CVDチ
ャンバ13、Cu−CVDチャンバ14、改質処理チャ
ンバ15、アニールチャンバ16も、モジュールとして
構成されており、これらのプロセスが実施される場所を
指す用語としてチャンバが使用される。
搬送ロボット(基板搬送機構)11が設けられ、搬送ロ
ボット11は、そのハンドで基板(半導体基板)31を
各チャンバ等に搬入、又は、各チャンバ等から搬出す
る。上記装置において、カセット(図示せず)にセット
された1枚の基板(半導体基板)31は、図面左側のロ
ード/アンロード・ロック・モジュール18から搬送ロ
ボット11によってセパレーションチャンバ12内に搬
入される。
3、Cu−CVDチャンバ14、改質処理チャンバ1
5、アニールチャンバ16の各プロセスチャンバは、搬
送ロボット11により各プロセスチャンバ内に搬入され
る基板(半導体基板)31を配置できる基板支持機構
(不図示)を具備している。基板支持機構(不図示)
は、基板(半導体基板)31を所定の温度に保持できる
基板加熱機構(不図示)を備えており、各工程のプロセ
スは、基板(半導体基板)31が基板支持機構に配置さ
れている状態で進行する。
線用のCu薄膜の作製に用いられる場合の図5図示の装
置を用いたプロセスの一例を説明する。
で、図7(b)図示のように、基板(半導体基板)31
上に形成され、凹部が設けられた絶縁膜32上に、拡散
バリア用下地膜としてTiN膜33が、MOCVD(Me
tal Organic Chemical VaporDeposition )法で成膜さ
れる。
7(c)図示のように、CVD法により第一の銅膜34
を成膜する。こうして、as depo.状態である第一の銅膜
34が形成された後、本発明のCu薄膜作製方法に必須
の、第一の銅膜(as depo.膜)34を活性雰囲気に晒し
て改質を行う改質処理が図7(d)の工程で行われる。
ムでは、改質処理チャンバ15において、第一の銅膜3
4をプラズマに晒す処理として行われる。この改質処理
により、図7(e)図示の電解銅めっき工程に移行され
る直前の、改質処理を施した第一の銅膜34(図7
(d)において、 Cu-Seed膜34aとして表示)が形成
される。
めの密着性改善工程を、Cu−CVD工程(図7
(c))の前、Cu−CVD工程(図7(c))と改質
工程(図7(d))との間、改質工程(図7(d))の
後の、少なくとも一箇所に介在させることもできる。例
えば、拡散バリア用下地膜としてTiN膜33が成膜さ
れた((図7(b))後、Cu−CVD工程で第一の銅
膜34が成膜される((図7(c))前に密着性改善工
程を介在させ、更に、Cu−CVD工程で第一の銅膜3
4が成膜された((図7(c))後、改質処理が行われ
る(図7(d))前に密着性改善工程を介在させること
などが可能である。
装置の場合、アニールチャンバ16が備えられているの
で、アニール処理を行うことができる。また、密着性改
善工程としては、プラズマ処理を行うことも可能であ
る。
体基板)31は、搬送ロボット11によってロード/ア
ンロード・ロックモジュール17に戻されて搬出され、
大気開放後、図7(e)図示のめっき工程へと進められ
ることになる。
ように、基板(半導体基板)31の表面に、Cu−CV
D法によってas depo.状態の第一の銅膜34を成膜し、
電解銅めっき法によってこの第一の銅膜34上に更に第
二の銅膜35を成膜する一連のCu薄膜作製工程におい
て、第一の銅膜34形成後に、第一の銅膜34を活性雰
囲気に晒して改質を行う改質工程(図7(d))を介在
させ、かかる改質のなされた第一の銅膜34をCu-Seed
膜34aとし、この上に電解銅めっき法によって第二の
銅膜35を成膜することを特徴としている。
Cu薄膜作製方法が、配線用Cu薄膜の作製に用いられ
る場合の各工程のプロセス条件の一例を以下に説明す
る。
13では、基板(半導体基板)31上に形成され、凹部
が設けられた絶縁膜32上に、拡散バリア用下地膜とし
てTiN膜33がMOCVDで成膜されて、図7(b)
図示状態となるTiNCVD成膜工程を行う。具体的に
は、拡散バリア用TiN−CVDチャンバ13内の圧力
は、例えば、0.1〜15Paの範囲で、基板(半導体
基板)31の温度は、約300〜400℃となるように
加熱される。この状態で、まず原料ガスとしてTDAA
T(テトラキスジアルキルアミノチタン)を、例えば、
0.004〜0.2g/min.の範囲で供給する。こ
のとき、配管内で原料ガスの流動性を良くするために添
加するキャリアガス(Ar:アルゴンガス)は、約0.
05〜3.0g/min(約30〜170ml/mi
n)の流量範囲とする。添加ガス(NH3:アンモニア
ガス)は、例えば、0.76〜380mg/minの流
量範囲で供給される。上記の条件で、拡散バリア膜33
を、10nmの膜厚で成膜した(図7(b))。
基板(半導体基板)31は、Cu−CVDチャンバ14
内に搬入され、ここで、拡散バリア用下地膜としてのT
iN膜33の上に、CVD法によって第一の銅膜34が
形成される(図7(c))。Cu−CVDチャンバ14
内の内部圧力は、例えば、1.0KPaに保持され、基
板(半導体基板)31の温度は、約170℃に設定され
ている。この状態で、原料ガスとしてCu(hfac)
(tmvs)(トリメチルビニルシリルヘキサフルオロ
アセチルアセトナト酸塩銅I)を使用し、as depo.状態
である第一の銅膜34の成膜を行った(図7(c))。
(半導体基板)31は、図6にその一例の概略構成が説
明されている改質処理チャンバ15の真空室21a内
に、ゲートバルブ19を介し、搬送ロボット11により
搬入され、基板支持機構23上に配置される。次いで、
例えば、以下のように、改質処理が行われる。
23に対向して備えられているガス供給器22を介し
て、真空室21a内にArガスが導入される。排気室2
1b側に付設されている真空排気機構15aによって排
気を行い、真空室21a内を所定の真空度に保ちつつ、
整合回路26を介して基板支持機構23に接続されてい
る高周波電源25から、基板支持機構23側に高周波電
力を供給し、真空室21a内にプラズマ放電を生成し、
生成されたArガスのプラズマに基板(半導体基板)3
1を晒す。
て、基板(半導体基板)31の温度を室温に保ち、Ar
ガスを、200ml/min.の流量範囲で導入し、改
質処理チャンバ15内を0.7Paの真空度に保ち、基
板支持機構23側に、60MHzの高周波電力を200
W供給し、プラズマ放電を40秒間維持させる条件を採
用できる。
されたArガスを導入すると、以下の試験例で実証され
たように、第一の銅膜34と、この上に電解銅めっき法
により形成される第二の銅膜35との界面近傍に微細な
空孔が生成されることをより効果的に防止できるので有
利である。例えば、前記のプロセス条件において、Ar
ガスを3%H2/Arガスに代え、前記のプロセス条件
のArガスの流量で導入することができる。
方法において、改質処理チャンバ15で行われる改質工
程(前述の場合は、プラズマ処理工程)が完了するまで
は、処理中の基板(半導体基板)31を大気に晒すこと
なく、真空の雰囲気で連続的に処理工程を進行させるこ
とが望ましい。
された第一の銅膜34(Cu-Seed膜34a)を電極とし
た電解銅めっき法によって第一の銅膜34の上に、更に
第二の銅膜35を形成した試料基板について、めっき後
の膜の断面をSEM(走査型電子顕微鏡)で観察した。
Arガスのプラズマを用いて改質処理を行ったものも、
H2ガスが混合されたArガスのプラズマを用いて改質
処理を行ったものも、図3、図4図示の従来の場合と同
じ拡大倍率にて観察したところ、第一の銅膜( Cu-Seed
膜)と、この上に電解銅めっき法によって形成した第二
の銅膜との界面近傍に空孔の存在は確認できなかった。
れた前述の試料基板について、Arガスのプラズマを用
いて改質処理を行ったものと、H2ガスが混合されたA
rガスのプラズマを用いて改質処理を行ったものとを比
較すべく、更に、倍率を大きくして観察したところ、A
rガスのプラズマを用いて改質処理を行ったものでは、
僅かながら、第一の銅膜と、この上に電解銅めっき法に
よって形成された第二の銅膜との界面近傍に微細な空孔
が存在していることが確認できた。しかし、H 2ガスが
混合されたArガス(3%H2/Arガス)のプラズマ
を用いる改質処理が介在されている場合には、同じ拡大
倍率でも、第一の銅膜と、この上に電解銅めっき法によ
って形成された第二の銅膜との界面近傍に微細な空孔の
存在は確認できなかった。そこで、 Cu-Seed膜となる第
一の銅膜と第二の銅膜との界面近傍に微細な空孔が生成
されることをより効果的に防止する上では、H2ガスが
混合されたArガスのプラズマを用いる方が望ましいと
考えられる。
い実施形態を説明したが、本発明はかかる実施形態に限
定されるものではなく、特許請求の範囲の記載から把握
される技術的範囲において種々の形態に変更可能であ
る。
との間で、第一の銅膜を活性雰囲気に晒して改質を行う
改質工程の活性雰囲気を作る手段として、プラズマに代
えて、分子を熱分解して生成した遊離活性種を採用する
こともできる。
て、改質処理チャンバ15として、真空排気可能なチャ
ンバ内に配置されているタングステン等の高融点金属か
らなる発熱体を1000℃〜2000℃程度の高温に維
持しながら原料ガスを導入し、当該原料ガスが発熱体の
表面を通過する際に分解及び/又は活性化される方式の
改質処理チャンバを採用し、原料ガスとして、Arガ
ス、又はH2ガスが混合されたArガスを導入するよう
に構成することができる。
ャンバ15としては、従来公知のプラズマCVDチャン
バを、また、前記の活性雰囲気を作る手段として分子を
熱分解して生成した遊離活性種が採用される改質処理チ
ャンバとしては、従来公知の発熱体CVDチャンバをそ
れぞれ応用して用いることができる。
間で、第一の銅膜を活性雰囲気に晒して改質を行う際
に、活性雰囲気を作る手段として前述したプラズマを用
いる場合であっても、分子を熱分解して生成した遊離活
性種を用いる場合であっても、基板(半導体基板)31
の温度は、−100℃〜250℃の範囲に保持しておく
ことが望ましい。これは、第一の銅膜34を成膜する前
段のCu−CVD工程の成膜温度領域(通常、約200
℃程度)からあまり高くない温度領域で改質処理するこ
とによって、成膜されている第一の銅膜34の銅原子が
移動しないようにするためである。第一の銅膜34は、
その後の電解銅めっき工程での電極としての機能が満足
される厚さであれば、コスト上、薄さを求められるもの
であり、通常は、100nm程度以下の厚さにされてい
る。このような薄い第一の銅膜34に対して、プラズマ
の照射や発熱体から受ける輻射熱等による基板(半導体
基板)31の温度上昇を防止し、銅原子の移動による流
動化や凝集を妨げるため、改質処理中の基板(半導体基
板)31は、Cu−CVD工程の成膜温度領域からあま
り高くない、好ましくは、Cu−CVD工程の成膜温度
領域より低い温度領域に保たれていることが望ましい。
ただし、液体窒素の温度(−100℃)より低くなる
と、実用上、冷媒として液体窒素を用いることができな
くなるので、コストの低減や、装置の簡略化を図れる実
用的な下限の温度としては、−100℃となる。
体基板)31の温度調節は、基板支持機構23に備えら
れている温度調節機構(不図示)によって行われる。
Cu-Seed膜となる第一の銅膜(as depo.膜)を被覆性が
良好なCVD法によって成膜する工程と、この第一の銅
膜の上に電解銅めっき法によって第二の銅膜を成膜する
工程とを含むCu薄膜の作製において、第一の銅膜と、
その上に電解銅めっき法によって形成される第二の銅膜
との界面近傍に微細な空孔が生成されることを効果的に
防止できる。
動作速度の更なる高速化素子に対応できる程度に配線抵
抗が小さい半導体集積回路素子の作製に用いることがで
きる。また、半導体集積回路素子の集積度が増大するこ
とにより、配線部分が微細化され、この部分に流す電流
密度が増加して、更なるエレクトロマイグレーション耐
性が求められる配線の作製にも用いることができる。
ス配線化が一層進むことが予想されるが、デュアルダマ
シンでは、そのエッチストップに使用されるSiN膜
が、デュアルダマシンのviaや、溝の形成時に、オー
バーハング状態となってしまう。このオーバーハング状
のSiN膜の直下へも段差被覆性の良いCu−CVD法
を用いて Cu-Seed膜を形成することが試みられている。
の直下にCu−CVD法を用いて Cu-Seed膜となる第一
の銅膜(as depo.膜)が形成され、この第一の銅膜を電
極とした電解銅めっき法によって第二の銅膜が形成され
る際にも、本発明のCu薄膜作製方法を採用すれば、第
一の銅膜と、その上に電解銅めっき法によって形成され
る第二の銅膜との界面近傍に微細な空孔が生成されるこ
とを効果的に防止できる。
製方法の工程を説明する図である。
の作製方法の工程を説明する図である。
法によって作製されたCu薄膜の、めっき後の膜断面の
状態を説明する拡大断面図である。
膜と第二の銅膜との界面近傍部分を図3図示の状態より
更に拡大して表した拡大断面図である。
概略構成例を表す図である。
理チャンバの概略構成例を表す断面図である。
が、配線用Cu薄膜に用いられる場合の工程の一例を説
明する図である。
ャンバ) 13 TiN−CVDチャンバ 14 Cu−CVDチャンバ 15 改質処理チャンバ 16 アニールチャンバ 17、18 ロード/アンロードモジュール 13a、14a、15a、16a 真空排気機構 19 ゲートバルブ 21a 真空室 23 基板支持機構 24 ガス導入管 22 ガス供給器 21b 排気室 26 整合回路 25 高周波電源
Claims (7)
- 【請求項1】 基体と、当該基体の所定の表面に第一の
銅膜をCVD法によって成膜するCu−CVD工程と、
当該第一の銅膜を電極とした電解銅めっき法によって当
該第一の銅膜上に更に第二の銅膜を成膜するめっき工程
とを含むCu薄膜作製方法において、 前記Cu−CVD工程と、めっき工程との間に、前記第
一の銅膜を活性雰囲気に晒して改質を行う改質工程を介
在させることを特徴としたCu薄膜作製方法。 - 【請求項2】 改質工程の活性雰囲気を作る手段として
プラズマを使用することを特徴とする請求項1記載のC
u薄膜作製方法。 - 【請求項3】 改質工程の活性雰囲気を作る手段として
分子を熱分解して生成した遊離活性種を使用することを
特徴とする請求項1記載のCu薄膜作製方法。 - 【請求項4】 改質工程は、水素を含有したガスが存在
している活性雰囲気で行われることを特徴とする請求項
1乃至3のいずれか一項記載のCu薄膜作製方法。 - 【請求項5】 改質工程は、基体の温度を−100℃〜
250℃の範囲に保って行うことを特徴とする請求項1
乃至4のいずれか一項記載のCu薄膜作製方法。 - 【請求項6】 改質工程は、前記Cu−CVD工程と同
一の真空内で行うことを特徴とした請求項1乃至5のい
ずれか一項記載のCu薄膜作製方法。 - 【請求項7】 密着性改善工程が、Cu−CVD工程の
前、Cu−CVD工程と改質工程との間、改質工程とめ
っき工程との間の少なくとも一箇所で行われることを特
徴とした請求項1乃至5のいずれか一項記載のCu薄膜
作製方法。
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Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2005017990A1 (ja) * | 2003-08-15 | 2005-02-24 | Tokyo Electron Limited | 成膜方法、半導体装置の製造方法、半導体装置、基板処理システム |
KR100845715B1 (ko) * | 2006-12-27 | 2008-07-10 | 동부일렉트로닉스 주식회사 | 반도체 소자의 금속배선 구조 및 그의 형성방법 |
JP2020013878A (ja) * | 2018-07-18 | 2020-01-23 | 住友重機械工業株式会社 | 負イオン照射装置、及び負イオン照射装置の制御方法 |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2004221334A (ja) * | 2003-01-15 | 2004-08-05 | Seiko Epson Corp | 金属素子形成方法、半導体装置の製造方法及び電子デバイスの製造方法、半導体装置及び電子デバイス、並びに電子機器 |
US7338903B2 (en) * | 2004-04-24 | 2008-03-04 | Taiwan Semiconductor Manufacturing Co., Ltd. | Sequential reducing plasma and inert plasma pre-treatment method for oxidizable conductor layer |
US7579274B2 (en) * | 2006-02-21 | 2009-08-25 | Alchimer | Method and compositions for direct copper plating and filing to form interconnects in the fabrication of semiconductor devices |
US8530347B2 (en) * | 2010-10-05 | 2013-09-10 | Freescale Semiconductor, Inc. | Electronic device including interconnects with a cavity therebetween and a process of forming the same |
TWI527189B (zh) * | 2013-12-24 | 2016-03-21 | 矽品精密工業股份有限公司 | 半導體基板及其製法 |
CN108109928A (zh) * | 2017-12-29 | 2018-06-01 | 中芯长电半导体(江阴)有限公司 | 半导体芯片的封装结构及封装方法 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6277249B1 (en) * | 2000-01-21 | 2001-08-21 | Applied Materials Inc. | Integrated process for copper via filling using a magnetron and target producing highly energetic ions |
US6921712B2 (en) * | 2000-05-15 | 2005-07-26 | Asm International Nv | Process for producing integrated circuits including reduction using gaseous organic compounds |
US6491978B1 (en) * | 2000-07-10 | 2002-12-10 | Applied Materials, Inc. | Deposition of CVD layers for copper metallization using novel metal organic chemical vapor deposition (MOCVD) precursors |
US6423201B1 (en) * | 2000-08-23 | 2002-07-23 | Applied Materials, Inc. | Method of improving the adhesion of copper |
JP4300259B2 (ja) * | 2001-01-22 | 2009-07-22 | キヤノンアネルバ株式会社 | 銅配線膜形成方法 |
-
2001
- 2001-04-27 JP JP2001132771A patent/JP2002329682A/ja not_active Withdrawn
-
2002
- 2002-04-26 US US10/132,427 patent/US6887522B2/en not_active Expired - Fee Related
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2005017990A1 (ja) * | 2003-08-15 | 2005-02-24 | Tokyo Electron Limited | 成膜方法、半導体装置の製造方法、半導体装置、基板処理システム |
US7875549B2 (en) | 2003-08-15 | 2011-01-25 | Tokyo Electron Limited | Fluorine doped carbon films produced by modification by radicals |
US8119518B2 (en) | 2003-08-15 | 2012-02-21 | Tokyo Electron Limited | Noble metal barrier for fluorine-doped carbon films |
KR100845715B1 (ko) * | 2006-12-27 | 2008-07-10 | 동부일렉트로닉스 주식회사 | 반도체 소자의 금속배선 구조 및 그의 형성방법 |
JP2020013878A (ja) * | 2018-07-18 | 2020-01-23 | 住友重機械工業株式会社 | 負イオン照射装置、及び負イオン照射装置の制御方法 |
JP7412074B2 (ja) | 2018-07-18 | 2024-01-12 | 住友重機械工業株式会社 | 負イオン照射装置、及び負イオン照射装置の制御方法 |
Also Published As
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US20020157610A1 (en) | 2002-10-31 |
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