JP2002169618A - 定電圧電源回路および該定電圧電源回路を内蔵した電子機器 - Google Patents
定電圧電源回路および該定電圧電源回路を内蔵した電子機器Info
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- JP2002169618A JP2002169618A JP2000363981A JP2000363981A JP2002169618A JP 2002169618 A JP2002169618 A JP 2002169618A JP 2000363981 A JP2000363981 A JP 2000363981A JP 2000363981 A JP2000363981 A JP 2000363981A JP 2002169618 A JP2002169618 A JP 2002169618A
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Abstract
(57)【要約】
【課題】 過負荷に対する過電流制限機能と出力短絡に
対する短絡電流制限機能を独立させてそれぞれ任意に設
定でき、起動時の条件にかかわらず、出力電圧を定電圧
域まで起動でき、入力電圧条件など外部の条件が変わっ
てもフの字形あるいはフォールドバック形の過電流制限
値を最適に調整でき、垂下形の過電流制限回路を適正に
動作させ所望の出力電流を得ることができ、短絡電流値
も最適な値に設定することが可能な定電圧電源回路、お
よび該定電圧電源回路を使用した応用機器を提供するこ
と。 【解決手段】 誤差増幅器Ａ１の出力により出力制御部
（出力トランジスタ）Ｃ５を制御している。負荷電流を
電流検出回路Ｃ１で検出しそれによって発生する電圧と
出力電圧を検出する電圧検出回路Ｃ３の出力をオフセッ
トを有する比較器Ａ３に入力し、その出力により出力制
御部Ｃ５を制御する。
対する短絡電流制限機能を独立させてそれぞれ任意に設
定でき、起動時の条件にかかわらず、出力電圧を定電圧
域まで起動でき、入力電圧条件など外部の条件が変わっ
てもフの字形あるいはフォールドバック形の過電流制限
値を最適に調整でき、垂下形の過電流制限回路を適正に
動作させ所望の出力電流を得ることができ、短絡電流値
も最適な値に設定することが可能な定電圧電源回路、お
よび該定電圧電源回路を使用した応用機器を提供するこ
と。 【解決手段】 誤差増幅器Ａ１の出力により出力制御部
（出力トランジスタ）Ｃ５を制御している。負荷電流を
電流検出回路Ｃ１で検出しそれによって発生する電圧と
出力電圧を検出する電圧検出回路Ｃ３の出力をオフセッ
トを有する比較器Ａ３に入力し、その出力により出力制
御部Ｃ５を制御する。
Description
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、出力電流を所定値
以下に制限する定電圧電源回路に関し、特に、出力短絡
に対する保護機能を有する定電圧電源回路に関する。本
発明は、電圧制御回路、過負荷保護回路、短絡保護回路
などの回路に転用でき、携帯電話などの携帯用電子機器
やパソコンなどの電源として有用である。
以下に制限する定電圧電源回路に関し、特に、出力短絡
に対する保護機能を有する定電圧電源回路に関する。本
発明は、電圧制御回路、過負荷保護回路、短絡保護回路
などの回路に転用でき、携帯電話などの携帯用電子機器
やパソコンなどの電源として有用である。
【０００２】
【従来の技術】出力電流を所定値以下に制限する定電圧
電源回路としては、特公平７−７４９７６号公報「電圧
制御回路」、特許第２７７３１５６号公報「定電圧保護
装置」、特開平６−９５７５０号公報「電流制限回
路」、実公平６−７３６８号公報「過負荷保護回路」、
特開２０００−１３３７２１号公報「短絡保護回路」な
どが提案されており、図７（ａ）の垂下形，同図（ｂ）
のフの字形，同図（ｃ）のフォールドバック形などの出
力特性を持たせることにより過負荷時の出力トランジス
タの破損を防止するようにしている。
電源回路としては、特公平７−７４９７６号公報「電圧
制御回路」、特許第２７７３１５６号公報「定電圧保護
装置」、特開平６−９５７５０号公報「電流制限回
路」、実公平６−７３６８号公報「過負荷保護回路」、
特開２０００−１３３７２１号公報「短絡保護回路」な
どが提案されており、図７（ａ）の垂下形，同図（ｂ）
のフの字形，同図（ｃ）のフォールドバック形などの出
力特性を持たせることにより過負荷時の出力トランジス
タの破損を防止するようにしている。
【０００３】ここで、フの字形の出力特性を有する電圧
制御回路の一従来例を説明する。図８は、特公平７−７
４９７６号公報に開示されている電圧制御回路を示す図
である。同図において、１は入力端子、２は制御用ＭＯ
Ｓ型トランジスタ、３は出力端子、４，５，８および１
０は抵抗、６は増幅器、７は電源、９および１１はトラ
ンジスタ、１２は接続点である。
制御回路の一従来例を説明する。図８は、特公平７−７
４９７６号公報に開示されている電圧制御回路を示す図
である。同図において、１は入力端子、２は制御用ＭＯ
Ｓ型トランジスタ、３は出力端子、４，５，８および１
０は抵抗、６は増幅器、７は電源、９および１１はトラ
ンジスタ、１２は接続点である。
【０００４】図８の電圧制御回路において、抵抗５の両
端電圧と電源７の基準電圧Ｖｒｅｆが等しくなるよう
に、増幅器６の出力が制御用ＭＯＳ型トランジスタ２の
ＯＮ抵抗を制御することによって、出力端子３の電圧を
一定に保とうとし、定電圧電源として機能する。出力端
子３が接地に短絡すると、制御用ＭＯＳ型トランジスタ
２に大電流が流れ、トランジスタ９がオンし、接続点１
２の電圧が降下してトランジスタ１１をオンする方向に
向かわせる。これにより、制御用ＭＯＳ型トランジスタ
２はオフする方向に向かい、結果的に、制御用ＭＯＳ型
トランジスタ２に流れる電流は規制される。
端電圧と電源７の基準電圧Ｖｒｅｆが等しくなるよう
に、増幅器６の出力が制御用ＭＯＳ型トランジスタ２の
ＯＮ抵抗を制御することによって、出力端子３の電圧を
一定に保とうとし、定電圧電源として機能する。出力端
子３が接地に短絡すると、制御用ＭＯＳ型トランジスタ
２に大電流が流れ、トランジスタ９がオンし、接続点１
２の電圧が降下してトランジスタ１１をオンする方向に
向かわせる。これにより、制御用ＭＯＳ型トランジスタ
２はオフする方向に向かい、結果的に、制御用ＭＯＳ型
トランジスタ２に流れる電流は規制される。
【０００５】図９は、このとき制御用ＭＯＳ型トランジ
スタ２に流れる電流すなわち出力端子３から取り出せる
電流と出力電圧特性（いわゆるフの字形特性）を示す図
であり、最大電流値から出力電流，出力電流ともに低下
する。これはトランジスタ９のソースの電圧（出力端子
３の電圧）とＩＣの基板の電位が異なることに起因して
いる。
スタ２に流れる電流すなわち出力端子３から取り出せる
電流と出力電圧特性（いわゆるフの字形特性）を示す図
であり、最大電流値から出力電流，出力電流ともに低下
する。これはトランジスタ９のソースの電圧（出力端子
３の電圧）とＩＣの基板の電位が異なることに起因して
いる。
【０００６】フの字形の特性のものは、定電流性負荷に
おいては安定点が定電圧領域と過負荷保護領域の２点に
存在し（図７（ｂ）参照）、起動時に出力電圧が過負荷
保護領域の低い状態に留まってしまい、定電圧領域まで
起動できない（後述する図１０（ａ）も参照のこと）。
おいては安定点が定電圧領域と過負荷保護領域の２点に
存在し（図７（ｂ）参照）、起動時に出力電圧が過負荷
保護領域の低い状態に留まってしまい、定電圧領域まで
起動できない（後述する図１０（ａ）も参照のこと）。
【０００７】なお、上述したように、過負荷時の出力ト
ランジスタの破損を防止する方法として、フの字形の特
性の他に、垂下形，フォールドバック形の出力特性を持
たせる方法が知られているが、垂下形のものは垂下部分
の電流値を高く設定すると短絡した場合の発熱が大きく
なり保護が不充分になりやすく、フォールドバック形の
ものは２安定回路を用いているので当該保護回路が一旦
機能すると、過負荷状態が解除されても、負荷を開放し
たりリセットスイッチを用いるなどによらなければ復帰
できない。
ランジスタの破損を防止する方法として、フの字形の特
性の他に、垂下形，フォールドバック形の出力特性を持
たせる方法が知られているが、垂下形のものは垂下部分
の電流値を高く設定すると短絡した場合の発熱が大きく
なり保護が不充分になりやすく、フォールドバック形の
ものは２安定回路を用いているので当該保護回路が一旦
機能すると、過負荷状態が解除されても、負荷を開放し
たりリセットスイッチを用いるなどによらなければ復帰
できない。
【０００８】
【発明が解決しようとする課題】そのために、上述した
公開公報に開示されている如き様々な回路構成が提案さ
れているが、これら従来のものは次のような問題を有し
ていた。すなわち、 過負荷に対する過電流制限機能と出力短絡に対する短
絡電流制限機能を独立させてそれぞれ任意に設定するこ
とができないという問題があった。
公開公報に開示されている如き様々な回路構成が提案さ
れているが、これら従来のものは次のような問題を有し
ていた。すなわち、 過負荷に対する過電流制限機能と出力短絡に対する短
絡電流制限機能を独立させてそれぞれ任意に設定するこ
とができないという問題があった。
【０００９】従来の短絡保護のための単一の電流制限
回路では、図１０（ａ）に示すように、定電流性負荷に
おいて安定点が過負荷保護域と低電圧域の２点存在し起
動時等条件によっては出力電圧が過負荷保護域に保持さ
れ定電圧域まで起動できない場合があるという問題があ
った。
回路では、図１０（ａ）に示すように、定電流性負荷に
おいて安定点が過負荷保護域と低電圧域の２点存在し起
動時等条件によっては出力電圧が過負荷保護域に保持さ
れ定電圧域まで起動できない場合があるという問題があ
った。
【００１０】また、垂下形の過電流制限回路とフの字
形あるいはフォールドバック形の短絡電流制限回路を組
み合わせた回路も用いられることがあったが、この場
合、入力電圧条件など外部の条件によってフの字形ある
いはフォールドバック形の過電流制限値が、例えば図１
０（ｂ）または図１０（ｃ）に示すように変化してしま
い、垂下形の過電流制限回路が適正に動作せず所望の出
力電流が得られないことがあるという問題があった。
形あるいはフォールドバック形の短絡電流制限回路を組
み合わせた回路も用いられることがあったが、この場
合、入力電圧条件など外部の条件によってフの字形ある
いはフォールドバック形の過電流制限値が、例えば図１
０（ｂ）または図１０（ｃ）に示すように変化してしま
い、垂下形の過電流制限回路が適正に動作せず所望の出
力電流が得られないことがあるという問題があった。
【００１１】さらに、短絡電流値が製造パラメータの
ばらつきにより変化するため、回路定数の補正が必要で
あり、短絡電流値を所望の値に調整することができない
という問題があった。
ばらつきにより変化するため、回路定数の補正が必要で
あり、短絡電流値を所望の値に調整することができない
という問題があった。
【００１２】本発明の目的は、上記問題点を解消するこ
とにあり、特に請求項１〜８記載の発明は、過負荷に対
する過電流制限機能と出力短絡に対する短絡電流制限機
能を独立させてそれぞれ任意に設定でき、起動時の条件
にかかわらず、出力電圧を定電圧域まで起動でき、入力
電圧条件など外部の条件が変わってもフの字形あるいは
フォールドバック形の過電流制限値を最適に調整でき、
垂下形の過電流制限回路を適正に動作させ所望の出力電
流を得ることができ、短絡電流値も最適な値に設定する
ことが可能な定電圧電源回路を提供することを目的と
し、請求項９および１０記載の発明は、該定電圧電源回
路を使用した応用機器を提供することを目的としてい
る。
とにあり、特に請求項１〜８記載の発明は、過負荷に対
する過電流制限機能と出力短絡に対する短絡電流制限機
能を独立させてそれぞれ任意に設定でき、起動時の条件
にかかわらず、出力電圧を定電圧域まで起動でき、入力
電圧条件など外部の条件が変わってもフの字形あるいは
フォールドバック形の過電流制限値を最適に調整でき、
垂下形の過電流制限回路を適正に動作させ所望の出力電
流を得ることができ、短絡電流値も最適な値に設定する
ことが可能な定電圧電源回路を提供することを目的と
し、請求項９および１０記載の発明は、該定電圧電源回
路を使用した応用機器を提供することを目的としてい
る。
【００１３】
【課題を解決するための手段】本発明は、上記目的を達
成するために、次のような構成を有する。すなわち、 （１）請求項１記載の発明は、入力電源（Ｖｄｄ）と出
力端子（ＶＯＵＴ）の間に接続された出力制御部（Ｃ
５）と、第１の基準電圧（Ｅ１）と出力端子（ＶＯＵ
Ｔ）の電圧を検出する電圧検出回路（Ｃ３）の出力とを
入力し前記出力制御部（Ｃ５）を制御するための制御信
号を出力する誤差増幅器（Ａ１）を有し、該制御信号に
よって前記出力制御部（Ｃ５）を制御して出力端子（Ｖ
ＯＵＴ）に定電圧を出力する定電圧電源回路であって、
出力制御部（Ｃ５）の出力負荷電流を検出する電流検出
回路（Ｃ１）と、該電流検出回路（Ｃ１）で検出された
出力負荷電流によって発生する電圧と電圧検出回路（Ｃ
３）の出力を比較するオフセットを有する比較器（Ａ
３）と、該比較器（Ａ３）の出力により前記制御信号を
制御する制御回路（Ｃ２）を有することを特徴としてい
る。
成するために、次のような構成を有する。すなわち、 （１）請求項１記載の発明は、入力電源（Ｖｄｄ）と出
力端子（ＶＯＵＴ）の間に接続された出力制御部（Ｃ
５）と、第１の基準電圧（Ｅ１）と出力端子（ＶＯＵ
Ｔ）の電圧を検出する電圧検出回路（Ｃ３）の出力とを
入力し前記出力制御部（Ｃ５）を制御するための制御信
号を出力する誤差増幅器（Ａ１）を有し、該制御信号に
よって前記出力制御部（Ｃ５）を制御して出力端子（Ｖ
ＯＵＴ）に定電圧を出力する定電圧電源回路であって、
出力制御部（Ｃ５）の出力負荷電流を検出する電流検出
回路（Ｃ１）と、該電流検出回路（Ｃ１）で検出された
出力負荷電流によって発生する電圧と電圧検出回路（Ｃ
３）の出力を比較するオフセットを有する比較器（Ａ
３）と、該比較器（Ａ３）の出力により前記制御信号を
制御する制御回路（Ｃ２）を有することを特徴としてい
る。
【００１４】（２）請求項２記載の発明は、請求項１記
載の定電圧電源回路において、電圧検出回路（Ｃ３）の
出力によって、オフセットを有する比較器（Ａ３）の出
力を制御するようにしたことを特徴としている。
載の定電圧電源回路において、電圧検出回路（Ｃ３）の
出力によって、オフセットを有する比較器（Ａ３）の出
力を制御するようにしたことを特徴としている。
【００１５】（３）請求項３記載の発明は、入力電源
（Ｖｄｄ）と出力端子（ＶＯＵＴ）の間に接続された出
力制御部（Ｃ５）と、第１の基準電圧（Ｅ１）と出力端
子（ＶＯＵＴ）の電圧を検出する電圧検出回路（Ｃ３）
の出力とを入力し出力制御部（Ｃ５）を制御するための
制御信号を出力する誤差増幅器（Ａ１）を有し、該制御
信号によって前記出力制御部（Ｃ５）を制御して前記出
力端子（ＶＯＵＴ）に定電圧を出力する定電圧電源回路
であって、出力制御部（Ｃ５）の出力負荷電流を検出す
る電流検出回路（Ｃ１）と、該出力負荷電流によって発
生する電圧と第２の基準電圧（Ｅ２）との比較結果に基
づいて前記制御信号を制御する制御回路（Ｃ４）を具備
し、負荷電流を一定の値に制限する第１の電流制限回路
と、電流検出回路（Ｃ１）で検出された出力負荷電流に
よって発生する電圧と電圧検出回路（Ｃ３）の出力を比
較するオフセットを有する比較器（Ａ３）と、該比較器
（Ａ３）の出力により前記制御信号を制御する制御回路
（Ｃ２）を有し、出力電圧に応じて負荷電流を任意の値
に制御する第２の電流制限回路を有し、前記出力電圧に
応じて第２の電流制限回路の動作を制御するようにした
ことを特徴としている。
（Ｖｄｄ）と出力端子（ＶＯＵＴ）の間に接続された出
力制御部（Ｃ５）と、第１の基準電圧（Ｅ１）と出力端
子（ＶＯＵＴ）の電圧を検出する電圧検出回路（Ｃ３）
の出力とを入力し出力制御部（Ｃ５）を制御するための
制御信号を出力する誤差増幅器（Ａ１）を有し、該制御
信号によって前記出力制御部（Ｃ５）を制御して前記出
力端子（ＶＯＵＴ）に定電圧を出力する定電圧電源回路
であって、出力制御部（Ｃ５）の出力負荷電流を検出す
る電流検出回路（Ｃ１）と、該出力負荷電流によって発
生する電圧と第２の基準電圧（Ｅ２）との比較結果に基
づいて前記制御信号を制御する制御回路（Ｃ４）を具備
し、負荷電流を一定の値に制限する第１の電流制限回路
と、電流検出回路（Ｃ１）で検出された出力負荷電流に
よって発生する電圧と電圧検出回路（Ｃ３）の出力を比
較するオフセットを有する比較器（Ａ３）と、該比較器
（Ａ３）の出力により前記制御信号を制御する制御回路
（Ｃ２）を有し、出力電圧に応じて負荷電流を任意の値
に制御する第２の電流制限回路を有し、前記出力電圧に
応じて第２の電流制限回路の動作を制御するようにした
ことを特徴としている。
【００１６】（４）請求項４〜６記載の発明は、請求項
１〜３記載の発明において、出力制御部（Ｃ５）を、バ
イポーラトランジスタ（Ｑ１）で構成したものである。
１〜３記載の発明において、出力制御部（Ｃ５）を、バ
イポーラトランジスタ（Ｑ１）で構成したものである。
【００１７】（５）請求項７記載の発明は、比較器（Ａ
３）のオフセットを、比較器を構成する対となる差動入
力トランジスタのゲートサイズ（Ｗ／Ｌ）またはしきい
値Ｖthを互いに異ならせる、または異なる抵抗成分を挿
入することにより、差動対の定数を変えることにより設
定したことを特徴としている。
３）のオフセットを、比較器を構成する対となる差動入
力トランジスタのゲートサイズ（Ｗ／Ｌ）またはしきい
値Ｖthを互いに異ならせる、または異なる抵抗成分を挿
入することにより、差動対の定数を変えることにより設
定したことを特徴としている。
【００１８】（６）請求項８記載の発明は、電圧検出回
路（Ｃ３）を、カレントミラー接続された一対のトラン
ジスタで構成したものに特定したものである。 （７）請求項９〜１０記載の発明は、上記定電圧電源回
路を内蔵した携帯電話、ＰＨＳ、ＰＤＡ、またはノート
パソコンなどの携帯用電子機器である。
路（Ｃ３）を、カレントミラー接続された一対のトラン
ジスタで構成したものに特定したものである。 （７）請求項９〜１０記載の発明は、上記定電圧電源回
路を内蔵した携帯電話、ＰＨＳ、ＰＤＡ、またはノート
パソコンなどの携帯用電子機器である。
【００１９】
【発明の実施の形態】（発明の概要）以下、図面を用い
て本発明の概略を説明する。図１は、本発明に係る定電
圧電源回路の概要図であり、Ａ１は誤差増幅器、Ａ２お
よびＡ４は比較器、Ａ３はオフセットを有する比較器、
Ｃ１は電流検出回路、Ｃ２およびＣ４は制御回路、Ｃ３
は電圧検出回路、Ｃ５は出力制御部（出力トランジス
タ）を示している。制御回路Ｃ２がフォールドバック形
電流制限用として、制御回路Ｃ４が垂下形電流制限用と
して働く。
て本発明の概略を説明する。図１は、本発明に係る定電
圧電源回路の概要図であり、Ａ１は誤差増幅器、Ａ２お
よびＡ４は比較器、Ａ３はオフセットを有する比較器、
Ｃ１は電流検出回路、Ｃ２およびＣ４は制御回路、Ｃ３
は電圧検出回路、Ｃ５は出力制御部（出力トランジス
タ）を示している。制御回路Ｃ２がフォールドバック形
電流制限用として、制御回路Ｃ４が垂下形電流制限用と
して働く。
【００２０】図２は、図１の定電圧電源回路の出力特性
図であり、（イ）の部分は定電圧状態の部分を示し、
（ロ）の部分は出力電流が一定の値（Ｉｍ）を超えない
ように制御された状態の部分を示し、（ハ）の部分はフ
ォールドバック状態の部分を示している。
図であり、（イ）の部分は定電圧状態の部分を示し、
（ロ）の部分は出力電流が一定の値（Ｉｍ）を超えない
ように制御された状態の部分を示し、（ハ）の部分はフ
ォールドバック状態の部分を示している。
【００２１】図１の定電圧電源回路において、電流検出
回路Ｃ１で出力端子ＶＯＵＴの出力電流に比例した電圧
を検出し、この出力電流に比例した電圧と基準電圧Ｅ２
とを比較器Ａ２で比較し、比較器Ａ２の出力により制御
回路Ｃ４を介して出力制御部Ｃ５（出力トランジスタ）
を制御して出力電圧を低下させ、負荷となる出力電流が
一定の値（図２のＩｍ）を超えないようにする。これに
より「過電流制限回路」を実現している。この状態が図
２の（ロ）の出力電流が制限された部分である。
回路Ｃ１で出力端子ＶＯＵＴの出力電流に比例した電圧
を検出し、この出力電流に比例した電圧と基準電圧Ｅ２
とを比較器Ａ２で比較し、比較器Ａ２の出力により制御
回路Ｃ４を介して出力制御部Ｃ５（出力トランジスタ）
を制御して出力電圧を低下させ、負荷となる出力電流が
一定の値（図２のＩｍ）を超えないようにする。これに
より「過電流制限回路」を実現している。この状態が図
２の（ロ）の出力電流が制限された部分である。
【００２２】また、電流検出回路Ｃ１で出力端子ＶＯＵ
Ｔの出力電流に比例した電圧を検出し、この出力電流に
比例した電圧と電圧検出回路Ｃ３で検出した出力端子Ｖ
ＯＵＴの出力電圧に比例した基準電圧とを、オフセット
を持った比較器Ａ３に入力して比較する。出力電流が大
きくなるにつれて出力電流に比例した電圧も大きくな
り、比較器Ａ３のオフセット（α）と各々の電圧差があ
る関係になると、比較器Ａ３からの出力により制御回路
Ｃ２を介して出力制御部Ｃ５（出力トランジスタ）を制
御して出力電圧を減少させるように制御する。
Ｔの出力電流に比例した電圧を検出し、この出力電流に
比例した電圧と電圧検出回路Ｃ３で検出した出力端子Ｖ
ＯＵＴの出力電圧に比例した基準電圧とを、オフセット
を持った比較器Ａ３に入力して比較する。出力電流が大
きくなるにつれて出力電流に比例した電圧も大きくな
り、比較器Ａ３のオフセット（α）と各々の電圧差があ
る関係になると、比較器Ａ３からの出力により制御回路
Ｃ２を介して出力制御部Ｃ５（出力トランジスタ）を制
御して出力電圧を減少させるように制御する。
【００２３】さらにこの働きが進むと出力電圧に比例し
た基準電圧（後述するＶ６）が下がり急激に出力電流と
出力電圧を減少させる。この状態が図２の（ハ）のフォ
ールドバック形特性の部分である。これによりフォール
ドバック形特性を有する「短絡電流制限回路」を実現し
ている。
た基準電圧（後述するＶ６）が下がり急激に出力電流と
出力電圧を減少させる。この状態が図２の（ハ）のフォ
ールドバック形特性の部分である。これによりフォール
ドバック形特性を有する「短絡電流制限回路」を実現し
ている。
【００２４】このとき、比較器Ａ３のオフセット値によ
り短絡時の電流値が決まる。このオフセット値は、差動
入力トランジスタのゲートサイズＷ／Ｌやしきい値Ｖth
を変えたり、その他抵抗成分を挿入するなどして差動対
の定数を変えることにより任意に設定できる。さらに、
出力電圧を検出する電圧検出回路Ｃ３からの出力によ
り、所望の出力電圧以下になった時点で比較器Ａ４から
の制御を実施する。これによりある出力電圧値までは、
電流検出回路Ｃ１で出力電流に比例した電圧として検出
された電圧と基準電圧とを比較器Ａ２で比較し出力電圧
を減少させる「過電流制限回路」のみを動作させ、出力
電圧がある電圧値まで下がった時点（図２のｔ点）から
「短絡電流制限回路」の制御を有効にする。
り短絡時の電流値が決まる。このオフセット値は、差動
入力トランジスタのゲートサイズＷ／Ｌやしきい値Ｖth
を変えたり、その他抵抗成分を挿入するなどして差動対
の定数を変えることにより任意に設定できる。さらに、
出力電圧を検出する電圧検出回路Ｃ３からの出力によ
り、所望の出力電圧以下になった時点で比較器Ａ４から
の制御を実施する。これによりある出力電圧値までは、
電流検出回路Ｃ１で出力電流に比例した電圧として検出
された電圧と基準電圧とを比較器Ａ２で比較し出力電圧
を減少させる「過電流制限回路」のみを動作させ、出力
電圧がある電圧値まで下がった時点（図２のｔ点）から
「短絡電流制限回路」の制御を有効にする。
【００２５】（具体的構成例）次に、図１の具体的回路
構成例を説明する。図３および図４は、図１の具体的回
路構成例を示す図であり、図３では図１の構成部分との
対応関係を示すために破線で囲むとともに対応する参照
符号を示し、図４では図１の構成部分（素子）に説明の
ための参照符号を付してある。
構成例を説明する。図３および図４は、図１の具体的回
路構成例を示す図であり、図３では図１の構成部分との
対応関係を示すために破線で囲むとともに対応する参照
符号を示し、図４では図１の構成部分（素子）に説明の
ための参照符号を付してある。
【００２６】図４において、基準電圧源Ｅ１、誤差増幅
器Ａ１、出力トランジスタＭ８（図１の出力制御部Ｃ５
に対応）、出力電圧設定用抵抗Ｒ５、Ｒ６からなる定電
圧電源回路において、出力トランジスタＭ８にカレント
ミラー接続されたトランジスタＭ１およびトランジスタ
Ｍ２には、負荷電流に比例したある電流が流れる（負荷
電流をモニタする）。この結果、まずトランジスタＭ１
により電流Ｉ１が流れると、抵抗Ｒ１の両端に出力トラ
ンジスタＭ８の負荷電流に応じた電圧Ｖ１が発生する。
器Ａ１、出力トランジスタＭ８（図１の出力制御部Ｃ５
に対応）、出力電圧設定用抵抗Ｒ５、Ｒ６からなる定電
圧電源回路において、出力トランジスタＭ８にカレント
ミラー接続されたトランジスタＭ１およびトランジスタ
Ｍ２には、負荷電流に比例したある電流が流れる（負荷
電流をモニタする）。この結果、まずトランジスタＭ１
により電流Ｉ１が流れると、抵抗Ｒ１の両端に出力トラ
ンジスタＭ８の負荷電流に応じた電圧Ｖ１が発生する。
【００２７】この電圧Ｖ１がトランジスタＭ３のしきい
値電圧以上になるとトランジスタＭ３がオンになり電流
Ｉ３が流れ出す。電流Ｉ３が流れ出すと抵抗Ｒ２の両端
にＶ２が発生し、この電圧Ｖ２がトランジスタＭ６のし
きい値電圧以上になるとトランジスタＭ６がオンになり
出力トランジスタＭ８のゲート電圧を制御し出力電圧を
低下させ負荷電流が一定の値を超えないように制御され
る。これにより垂下形の電流制限を実現することができ
る。
値電圧以上になるとトランジスタＭ３がオンになり電流
Ｉ３が流れ出す。電流Ｉ３が流れ出すと抵抗Ｒ２の両端
にＶ２が発生し、この電圧Ｖ２がトランジスタＭ６のし
きい値電圧以上になるとトランジスタＭ６がオンになり
出力トランジスタＭ８のゲート電圧を制御し出力電圧を
低下させ負荷電流が一定の値を超えないように制御され
る。これにより垂下形の電流制限を実現することができ
る。
【００２８】一方、同様にトランジスタＭ２により電流
Ｉ２が抵抗Ｒ３に流れ、抵抗Ｒ３の両端に負荷電流に応
じた電圧Ｖ３が発生する。この電圧Ｖ３と出力電圧に比
例した電圧Ｖ６とが比較器Ａ３に入力される。ここで比
較器Ａ３にオフセットα（差動入力トランジスタのゲー
トサイズ（Ｗ／Ｌ）やしきい値Ｖthを変えたり、その他
抵抗成分を挿入するなどして差動対の定数を変えること
などによって設定される）を持たすことで「Ｖ３−α
（オフセット電圧）＝電圧Ｖ６」となるように比較器Ａ
３の出力がコントロールされる。
Ｉ２が抵抗Ｒ３に流れ、抵抗Ｒ３の両端に負荷電流に応
じた電圧Ｖ３が発生する。この電圧Ｖ３と出力電圧に比
例した電圧Ｖ６とが比較器Ａ３に入力される。ここで比
較器Ａ３にオフセットα（差動入力トランジスタのゲー
トサイズ（Ｗ／Ｌ）やしきい値Ｖthを変えたり、その他
抵抗成分を挿入するなどして差動対の定数を変えること
などによって設定される）を持たすことで「Ｖ３−α
（オフセット電圧）＝電圧Ｖ６」となるように比較器Ａ
３の出力がコントロールされる。
【００２９】いま、過負荷状態になり「Ｖ３−α＞Ｖ
６」となった時点で比較器Ａ３の出力によりトランジス
タＭ５のゲート電圧が上昇し電圧Ｖ４が発生することに
よりトランジスタＭ７が動作し出力電圧を低下させ負荷
電流を制限する。この状態よりさらに過負荷状態が継続
されると電圧Ｖ６電圧の低下により比較器Ａ３による電
圧Ｖ３に対する制御すべき電流値が低下していく。本回
路の場合、図示のように電流値が低下するにつれて出力
電圧も徐々に低下する。この状態が続くことによりフォ
ールドバック形の電流制限が実現できる。
６」となった時点で比較器Ａ３の出力によりトランジス
タＭ５のゲート電圧が上昇し電圧Ｖ４が発生することに
よりトランジスタＭ７が動作し出力電圧を低下させ負荷
電流を制限する。この状態よりさらに過負荷状態が継続
されると電圧Ｖ６電圧の低下により比較器Ａ３による電
圧Ｖ３に対する制御すべき電流値が低下していく。本回
路の場合、図示のように電流値が低下するにつれて出力
電圧も徐々に低下する。この状態が続くことによりフォ
ールドバック形の電流制限が実現できる。
【００３０】また、比較器Ａ３にオフセットを持たせて
おくことにより、出力電圧が０Ｖすなわち短絡状態にお
いてオフセット電圧に応じた短絡電流値Ｉｓに相当する
電流を流し続けることができる。このことにより、過負
荷状態が解除された場合の出力電圧の復帰が容易に行え
る。
おくことにより、出力電圧が０Ｖすなわち短絡状態にお
いてオフセット電圧に応じた短絡電流値Ｉｓに相当する
電流を流し続けることができる。このことにより、過負
荷状態が解除された場合の出力電圧の復帰が容易に行え
る。
【００３１】これら一連の動作を出力電圧を検出し所望
の電圧以下のときにすなわち電圧Ｖ６がトランジスタＭ
４のしきい値電圧以下になった時点（図中ｔ点）でトラ
ンジスタＭ４がオフしフォールドバック回路を動作させ
る。これにより、オフセット値の設定値αおよびトラン
ジスタＭ４のしきい値Ｖthをどのような値を選択するか
によって、所望の過負荷電流値（制限電流値）Ｉｍ、フ
ォールドバック状態からの短絡電流値Ｉｓ、および制限
電流値Ｉｍからフォールドバック形電流制限動作への切
り替え点ｔ（電圧Ｖｔ）を独立して任意に決定すること
が可能となる。
の電圧以下のときにすなわち電圧Ｖ６がトランジスタＭ
４のしきい値電圧以下になった時点（図中ｔ点）でトラ
ンジスタＭ４がオフしフォールドバック回路を動作させ
る。これにより、オフセット値の設定値αおよびトラン
ジスタＭ４のしきい値Ｖthをどのような値を選択するか
によって、所望の過負荷電流値（制限電流値）Ｉｍ、フ
ォールドバック状態からの短絡電流値Ｉｓ、および制限
電流値Ｉｍからフォールドバック形電流制限動作への切
り替え点ｔ（電圧Ｖｔ）を独立して任意に決定すること
が可能となる。
【００３２】このようにすることにより、垂下形の電流
制限状態における電圧、すなわち定電圧値Ｖｍとフォー
ルドバック形電流制限動作への切り替え点ｔとの電圧の
間の差分（Ｖｍ−Ｖｔ）を任意に設定できるようにな
る。この差分（Ｖｍ−Ｖｔ）をある程度の大きさに設定
することにより、電圧変動などによって瞬間的に過負荷
状態になった場合にすぐフォールドバック動作に移行し
てしまうなどの不安定さを解消でき、所望の動作をする
定電圧電源回路を設計しやすくなる。
制限状態における電圧、すなわち定電圧値Ｖｍとフォー
ルドバック形電流制限動作への切り替え点ｔとの電圧の
間の差分（Ｖｍ−Ｖｔ）を任意に設定できるようにな
る。この差分（Ｖｍ−Ｖｔ）をある程度の大きさに設定
することにより、電圧変動などによって瞬間的に過負荷
状態になった場合にすぐフォールドバック動作に移行し
てしまうなどの不安定さを解消でき、所望の動作をする
定電圧電源回路を設計しやすくなる。
【００３３】上述した図４の定電圧電源回路は、出力ト
ランジスタＭ８が本体のトランジスタと同様のＭＯＳト
ランジスタを使用したもので同一プロセスで製造できる
ため出力トランジスタを内蔵型とすることができる。
ランジスタＭ８が本体のトランジスタと同様のＭＯＳト
ランジスタを使用したもので同一プロセスで製造できる
ため出力トランジスタを内蔵型とすることができる。
【００３４】図５および図６は、出力トランジスタを本
体のトランジスタ（ＭＯＳ）と異なるバイポーラトラン
ジスタにして外付け構造とした具体的構成例である。図
５では図１の構成部分との対応関係を示すために破線で
囲むとともに対応する参照符号を示し、図６では図１の
構成部分（素子）に説明のための参照符号を付してあ
る。
体のトランジスタ（ＭＯＳ）と異なるバイポーラトラン
ジスタにして外付け構造とした具体的構成例である。図
５では図１の構成部分との対応関係を示すために破線で
囲むとともに対応する参照符号を示し、図６では図１の
構成部分（素子）に説明のための参照符号を付してあ
る。
【００３５】図６において、基準電圧源Ｅ１、誤差増幅
器Ａ１、トランジスタＭ８、定電流源、出力トランジス
タＱ１、出力電圧設定用抵抗Ｒ５、Ｒ６からなる定電圧
回路において、トランジスタＭ８にカレントミラー接続
されたトランジスタＭ１およびトランジスタＭ２には、
出力トランジスタＱ１のベース電流に比例したある電流
Ｉ１が流れる。
器Ａ１、トランジスタＭ８、定電流源、出力トランジス
タＱ１、出力電圧設定用抵抗Ｒ５、Ｒ６からなる定電圧
回路において、トランジスタＭ８にカレントミラー接続
されたトランジスタＭ１およびトランジスタＭ２には、
出力トランジスタＱ１のベース電流に比例したある電流
Ｉ１が流れる。
【００３６】この結果、まずトランジスタＭ１に電流Ｉ
１が流れると、抵抗Ｒ１の両端に該負荷電流に応じた電
圧Ｖ１が発生する。この電圧Ｖ１がトランジスタＭ６の
しきい値電圧以上になると誤差増幅器Ａ１の出力を制御
することでトランジスタＭ８のゲート電圧を制御し出力
電圧を低下させベース電流が一定の値を超えないように
制御される。これにより垂下型の電流制限を実現するこ
とができる。
１が流れると、抵抗Ｒ１の両端に該負荷電流に応じた電
圧Ｖ１が発生する。この電圧Ｖ１がトランジスタＭ６の
しきい値電圧以上になると誤差増幅器Ａ１の出力を制御
することでトランジスタＭ８のゲート電圧を制御し出力
電圧を低下させベース電流が一定の値を超えないように
制御される。これにより垂下型の電流制限を実現するこ
とができる。
【００３７】一方、同様にトランジスタＭ２により電流
Ｉ２が抵抗Ｒ３に流れ、抵抗Ｒ３の両端に負荷電流に応
じた電圧Ｖ３が発生する。このＶ３と出力電圧に比例し
た電圧Ｖ６（図では抵抗Ｒ６の両端の電圧）とが比較器
Ａ３に入力される。ここで比較器Ａ３にオフセットを持
たせておくことで「Ｖ３−α（オフセット電圧）＝Ｖ
６」となるように比較器Ａ３の出力がコントロールされ
る。
Ｉ２が抵抗Ｒ３に流れ、抵抗Ｒ３の両端に負荷電流に応
じた電圧Ｖ３が発生する。このＶ３と出力電圧に比例し
た電圧Ｖ６（図では抵抗Ｒ６の両端の電圧）とが比較器
Ａ３に入力される。ここで比較器Ａ３にオフセットを持
たせておくことで「Ｖ３−α（オフセット電圧）＝Ｖ
６」となるように比較器Ａ３の出力がコントロールされ
る。
【００３８】いま、過負荷状態になり「Ｖ３−α＞Ｖ
６」となった時点で比較器Ａ３の出力によりトランジス
タＭ５のゲート電圧が上昇し、トランジスタＭ５がオン
になって抵抗Ｒ４に電流が流れ、その両端に電圧Ｖ４が
発生する。この電圧Ｖ４によりトランジスタＭ７が動作
し誤差増幅器Ａ１の出力を制御することでトランジスタ
Ｍ８のゲート電圧を制御し、出力電圧を低下させて出力
トランジスタＱ１のベース電流を制限する。
６」となった時点で比較器Ａ３の出力によりトランジス
タＭ５のゲート電圧が上昇し、トランジスタＭ５がオン
になって抵抗Ｒ４に電流が流れ、その両端に電圧Ｖ４が
発生する。この電圧Ｖ４によりトランジスタＭ７が動作
し誤差増幅器Ａ１の出力を制御することでトランジスタ
Ｍ８のゲート電圧を制御し、出力電圧を低下させて出力
トランジスタＱ１のベース電流を制限する。
【００３９】この状態よりさらに過負荷状態が継続され
ると、電圧Ｖ６の低下により比較器Ａ３による電圧Ｖ３
に対する制御すべき電流値が低下していく。この状態が
続くことによりフォールドバック型の電流制限が実現で
きる。
ると、電圧Ｖ６の低下により比較器Ａ３による電圧Ｖ３
に対する制御すべき電流値が低下していく。この状態が
続くことによりフォールドバック型の電流制限が実現で
きる。
【００４０】比較器Ａ３にオフセットを持たすことで出
力電圧が０Ｖすなわち短絡状態においてオフセット電圧
に応じた短絡電流Ｉｓを流し続けることができる。この
ことにより、過負荷状態が解除された場合の出力電圧の
復帰が容易に行える。
力電圧が０Ｖすなわち短絡状態においてオフセット電圧
に応じた短絡電流Ｉｓを流し続けることができる。この
ことにより、過負荷状態が解除された場合の出力電圧の
復帰が容易に行える。
【００４１】これら一連の動作において、出力電圧を検
出し所望の電圧以下のときにすなわち抵抗Ｒ６の両端の
電圧Ｖ６がトランジスタＭ４のしきい値電圧以下になっ
た時点でトランジスタＭ４がオフしフォールドバック回
路を動作させることで、任意に過負荷電流値Ｉｍとフォ
ールドバック状態からの短絡電流値Ｉｓを独立して決定
することが可能となる。
出し所望の電圧以下のときにすなわち抵抗Ｒ６の両端の
電圧Ｖ６がトランジスタＭ４のしきい値電圧以下になっ
た時点でトランジスタＭ４がオフしフォールドバック回
路を動作させることで、任意に過負荷電流値Ｉｍとフォ
ールドバック状態からの短絡電流値Ｉｓを独立して決定
することが可能となる。
【００４２】なお、上記図３〜６の具体的回路構成はあ
くまでも例を示したにすぎず様々な変形が可能である。
例えば、定電圧電源回路を構成するトランジスタ素子
は、上記実施例に限らず、ＰｃｈとＮｃｈ、ＭＯＳ（ユ
ニポーラ）とバイポーラの間でトランジスタ形式を適宜
変更することも可能である。
くまでも例を示したにすぎず様々な変形が可能である。
例えば、定電圧電源回路を構成するトランジスタ素子
は、上記実施例に限らず、ＰｃｈとＮｃｈ、ＭＯＳ（ユ
ニポーラ）とバイポーラの間でトランジスタ形式を適宜
変更することも可能である。
【００４３】本発明は、実質的に同一の構成で電圧制御
回路、過負荷保護回路、短絡保護回路などの回路に転用
でき、携帯電話、ＰＨＳ、ＰＤＡ、ノートパソコンなど
の携帯用電子機器の電源として特に有用である。
回路、過負荷保護回路、短絡保護回路などの回路に転用
でき、携帯電話、ＰＨＳ、ＰＤＡ、ノートパソコンなど
の携帯用電子機器の電源として特に有用である。
【００４４】
【発明の効果】請求項１〜８記載の本発明によれば、過
負荷に対する過電流制限機能と出力短絡に対する短絡電
流制限機能を独立させてそれぞれ任意に設定でき、起動
時の条件にかかわらず、出力電圧を定電圧域まで起動で
き、入力電圧条件など外部の条件が変わってもフの字形
あるいはフォールドバック形の過電流制限値を最適に調
整でき、垂下形の過電流制限回路を適正に動作させ所望
の出力電流を得ることができ、短絡電流値も最適な値に
設定することが可能な定電圧電源が実現できる。また、
請求項９および１０記載の発明によれば、上記の如き特
徴を有する電源回路を内蔵した電子機器を実現できる。
負荷に対する過電流制限機能と出力短絡に対する短絡電
流制限機能を独立させてそれぞれ任意に設定でき、起動
時の条件にかかわらず、出力電圧を定電圧域まで起動で
き、入力電圧条件など外部の条件が変わってもフの字形
あるいはフォールドバック形の過電流制限値を最適に調
整でき、垂下形の過電流制限回路を適正に動作させ所望
の出力電流を得ることができ、短絡電流値も最適な値に
設定することが可能な定電圧電源が実現できる。また、
請求項９および１０記載の発明によれば、上記の如き特
徴を有する電源回路を内蔵した電子機器を実現できる。
【図１】本発明に係る定電圧電源回路の概要図である。
【図２】図１の定電圧電源回路の出力特性図である。
【図３】図１の具体的回路構成例を示す図である（出力
トランジスタを本体のトランジスタ（ＭＯＳ）と同じ型
ＭＯＳトランジスタを用いた場合）。
トランジスタを本体のトランジスタ（ＭＯＳ）と同じ型
ＭＯＳトランジスタを用いた場合）。
【図４】図１の具体的回路構成例を示す図である（出力
トランジスタを本体のトランジスタ（ＭＯＳ）と同じ型
ＭＯＳトランジスタを用いた場合）。
トランジスタを本体のトランジスタ（ＭＯＳ）と同じ型
ＭＯＳトランジスタを用いた場合）。
【図５】図１の具体的回路構成例を示す図である（出力
トランジスタを本体のトランジスタ（ＭＯＳ）と異なる
バイポーラＭＯＳトランジスタを用いた場合）。
トランジスタを本体のトランジスタ（ＭＯＳ）と異なる
バイポーラＭＯＳトランジスタを用いた場合）。
【図６】図１の具体的回路構成例を示す図である（出力
トランジスタを本体のトランジスタ（ＭＯＳ）と異なる
バイポーラＭＯＳトランジスタを用いた場合）。
トランジスタを本体のトランジスタ（ＭＯＳ）と異なる
バイポーラＭＯＳトランジスタを用いた場合）。
【図７】従来知られている過負荷時の出力トランジスタ
の破損を防止するための出力特性（垂下形，フの字形，
フォールドバック形）を示す図である。
の破損を防止するための出力特性（垂下形，フの字形，
フォールドバック形）を示す図である。
【図８】従来の電圧制御回路を示す図である。
【図９】図８の回路における出力端子から取り出せる電
流と出力電圧特性（いわゆるフの字形特性）を示す図で
ある。
流と出力電圧特性（いわゆるフの字形特性）を示す図で
ある。
【図１０】従来の問題点を説明するための出力特性図で
ある。
ある。
Ａ１：誤差増幅器、 Ａ２，Ａ４：比較器、 Ａ３：オフセットを有する比較器、 Ｃ１：電流検出回路、 Ｃ２：，Ｃ４：制御回路、 Ｃ３：電圧検出回路、 Ｃ５：出力制御部（出力トランジスタ）、 Ｍ１〜Ｍ８：トランジスタ、 Ｑ１：出力トランジスタ。
Claims (10)
- 【請求項１】 入力電源（Ｖｄｄ）と出力端子（ＶＯＵ
Ｔ）の間に接続された出力制御部（Ｃ５）と、第１の基
準電圧（Ｅ１）と出力端子（ＶＯＵＴ）の電圧を検出す
る電圧検出回路（Ｃ３）の出力とを入力し前記出力制御
部（Ｃ５）を制御するための制御信号を出力する誤差増
幅器（Ａ１）を有し、該制御信号によって前記出力制御
部（Ｃ５）を制御して前記出力端子（ＶＯＵＴ）に定電
圧を出力する定電圧電源回路であって、 前記出力制御部（Ｃ５）の出力負荷電流を検出する電流
検出回路（Ｃ１）と、該電流検出回路（Ｃ１）で検出さ
れた出力負荷電流によって発生する電圧と前記電圧検出
回路（Ｃ３）の出力を比較するオフセットを有する比較
器（Ａ３）と、該比較器（Ａ３）の出力により前記制御
信号を制御する制御回路（Ｃ２）を有することを特徴と
する定電圧電源回路。 - 【請求項２】 請求項１記載の定電圧電源回路におい
て、 前記電圧検出回路（Ｃ３）の出力によって、前記オフセ
ットを有する比較器（Ａ３）の出力を制御することを特
徴とする定電圧電源回路。 - 【請求項３】 入力電源（Ｖｄｄ）と出力端子（ＶＯＵ
Ｔ）の間に接続された出力制御部（Ｃ５）と、第１の基
準電圧（Ｅ１）と出力端子（ＶＯＵＴ）の電圧を検出す
る電圧検出回路（Ｃ３）の出力とを入力し前記出力制御
部（Ｃ５）を制御するための制御信号を出力する誤差増
幅器（Ａ１）を有し、該制御信号によって前記出力制御
部（Ｃ５）を制御して前記出力端子（ＶＯＵＴ）に定電
圧を出力する定電圧電源回路であって、 前記出力制御部（Ｃ５）の出力負荷電流を検出する電流
検出回路（Ｃ１）と、該出力負荷電流によって発生する
電圧と第２の基準電圧（Ｅ２）との比較結果に基づいて
前記制御信号を制御する制御回路（Ｃ４）を具備し、負
荷電流を一定の値に制限する第１の電流制限回路と、 前記電流検出回路（Ｃ１）で検出された出力負荷電流に
よって発生する電圧と前記電圧検出回路（Ｃ３）の出力
を比較するオフセットを有する比較器（Ａ３）と、該比
較器（Ａ３）の出力により前記制御信号を制御する制御
回路（Ｃ２）を有し、出力電圧に応じて負荷電流を任意
の値に制御する第２の電流制限回路を有し、 前記出力電圧に応じて前記第２の電流制限回路の動作を
制御することを特徴とする定電圧電源回路。 - 【請求項４】 入力電源（Ｖｄｄ）と出力端子（ＶＯＵ
Ｔ）の間に接続された出力トランジスタ（Ｑ１）と、第
１の基準電圧（Ｅ１）と出力端子（ＶＯＵＴ）の電圧を
検出する電圧検出回路（Ｃ３）の出力とを入力し前記出
力制御部（Ｃ５）を制御するための制御信号を出力する
誤差増幅器（Ａ１）を有し、該制御信号によって前記出
力トランジスタ（Ｑ１）を制御して前記出力端子（ＶＯ
ＵＴ）に定電圧を出力する定電圧電源回路であって、 前記出力トランジスタ（Ｑ１）のベース電流を検出する
電流検出回路（Ｃ１）と、該電流検出回路（Ｃ１）で検
出されたベース電流によって発生する電圧と前記電圧検
出回路（Ｃ３）の出力を比較するオフセットを有する比
較器（Ａ３）と、該比較器（Ａ３）の出力により前記制
御信号を制御する制御回路（Ｃ２）を有することを特徴
とする定電圧電源回路。 - 【請求項５】 請求項４記載の定電圧電源回路におい
て、 前記電圧検出回路（Ｃ３）の出力によって、前記オフセ
ットを有する比較器（Ａ３）の出力を制御することを特
徴とする定電圧電源回路。 - 【請求項６】 入力電源（Ｖｄｄ）と出力端子（ＶＯＵ
Ｔ）の間に接続された出力トランジスタ（Ｑ１）と、第
１の基準電圧（Ｅ１）と出力端子（ＶＯＵＴ）の電圧を
検出する電圧検出回路（Ｃ３）の出力とを入力し前記出
力トランジスタ（Ｑ１）を制御するための制御信号を出
力する誤差増幅器（Ａ１）を有し、該制御信号によって
前記出力トランジスタ（Ｑ１）を制御して前記出力端子
（ＶＯＵＴ）に定電圧を出力する定電圧電源回路であっ
て、 前記出力トランジスタ（Ｑ１）のベース電流を検出する
電流検出回路（Ｃ１）と、該ベース電流によって発生す
る電圧と第２の基準電圧（Ｅ２）との比較結果に基づい
て前記制御信号を制御する制御回路（Ｃ４）を具備し、
負荷電流を一定の値に制限する第１の電流制限回路と、 前記電流検出回路（Ｃ１）で検出された出力負荷電流に
よって発生する電圧と前記電圧検出回路（Ｃ３）の出力
を比較するオフセットを有する比較器（Ａ３）と、該比
較器（Ａ３）の出力により前記制御信号を制御する制御
回路（Ｃ２）を有し、出力電圧に応じて負荷電流を任意
の値に制御する第２の電流制限回路を有し、 前記出力電圧に応じて前記第２の電流制限回路の動作を
制御することを特徴とする定電圧電源回路。 - 【請求項７】 前記オフセットは、比較器を構成する対
となる差動入力トランジスタのゲートサイズ（Ｗ／Ｌ）
またはしきい値Ｖthを互いに異ならせる、または異なる
抵抗成分を挿入することにより、差動対の定数を変える
ことにより設定されることを特徴とする請求項１〜６の
いずれか１項に記載の定電圧電源回路。 - 【請求項８】 前記電圧検出回路（Ｃ３）は、カレント
ミラー接続された一対のトランジスタで構成されること
を特徴とする請求項１〜７のいずれか１項に記載の定電
圧電源回路。 - 【請求項９】 請求項１〜８のいずれか１項に記載の定
電圧電源回路を内蔵することを特徴とする電子機器。 - 【請求項１０】 請求項９記載の電子機器は、携帯電
話、ＰＨＳ、ＰＤＡ、またはノートパソコンのいずれか
であることを特徴とする携帯用電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000363981A JP4289784B2 (ja) | 2000-11-30 | 2000-11-30 | 定電圧電源回路および該定電圧電源回路を内蔵した電子機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2000363981A JP4289784B2 (ja) | 2000-11-30 | 2000-11-30 | 定電圧電源回路および該定電圧電源回路を内蔵した電子機器 |
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2009056992A Division JP4880007B2 (ja) | 2009-03-10 | 2009-03-10 | 定電圧電源回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2002169618A true JP2002169618A (ja) | 2002-06-14 |
| JP4289784B2 JP4289784B2 (ja) | 2009-07-01 |
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| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2000363981A Expired - Fee Related JP4289784B2 (ja) | 2000-11-30 | 2000-11-30 | 定電圧電源回路および該定電圧電源回路を内蔵した電子機器 |
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|---|---|
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Cited By (21)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005165716A (ja) * | 2003-12-03 | 2005-06-23 | Toshiba Corp | レギュレータ装置およびそれに用いる逆流防止ダイオード回路 |
| JP2006155099A (ja) * | 2004-11-26 | 2006-06-15 | Sony Corp | 定電圧電源回路 |
| JP2006178539A (ja) * | 2004-12-20 | 2006-07-06 | Freescale Semiconductor Inc | 過電流保護回路及び直流電源装置 |
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