JP2001249641A - プラズマディスプレーパネルの駆動方法及び装置 - Google Patents
プラズマディスプレーパネルの駆動方法及び装置Info
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- G09G3/28—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels
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Abstract
(57)【要約】
【課題】 本発明は高速でアドレスすることができるよ
うにしたプラズマディスプレーパネルに関する。 【解決手段】 本発明によるプラズマディスプレーパネ
ルの駆動方法は、放電セルを選択するためのアドレス期
間の間にアドレス電極にデータパルスを供給し、その
際、データパルスの前と後ろに位置されるように補助デ
ータパルスをアドレス電極に供給し、走査／サステイニ
ング電極に走査パルスを順次供給する。
うにしたプラズマディスプレーパネルに関する。 【解決手段】 本発明によるプラズマディスプレーパネ
ルの駆動方法は、放電セルを選択するためのアドレス期
間の間にアドレス電極にデータパルスを供給し、その
際、データパルスの前と後ろに位置されるように補助デ
ータパルスをアドレス電極に供給し、走査／サステイニ
ング電極に走査パルスを順次供給する。
Description
【０００１】
【発明の属する技術分野】本発明はプラズマディスプレ
ーパネルの駆動方法及び装置に関し、特に高速でアドレ
スすることができるようにしたプラズマディスプレーパ
ネルの駆動方法及び装置に関する。
ーパネルの駆動方法及び装置に関し、特に高速でアドレ
スすることができるようにしたプラズマディスプレーパ
ネルの駆動方法及び装置に関する。
【０００２】
【従来の技術】最近、平板ディスプレー装置として大型
パネルの製作が容易なプラズマディスプレーパネル（Ｐ
ＤＰ）が注目を浴びている。最近のＰＤＰとしては図１
に示されているような、３電極を具備して交流電圧によ
って駆動される３電極交流放電型のＰＤＰが代表的であ
る。
パネルの製作が容易なプラズマディスプレーパネル（Ｐ
ＤＰ）が注目を浴びている。最近のＰＤＰとしては図１
に示されているような、３電極を具備して交流電圧によ
って駆動される３電極交流放電型のＰＤＰが代表的であ
る。
【０００３】図１を参照すると、３電極交流放電型ＰＤ
Ｐの放電セルは、上部基板（１０）に形成された走査／
放電維持電極（１２Ｙ）、共通放電維持電極（１２
Ｚ）、下部基板（１８）に形成されたアドレス電極（２
０Ｘ）とを具備している。走査／放電維持電極（１２
Ｙ）と共通放電維持電極（１２Ｚ）を並べて形成させた
上部基板（１０）にはそれらの電極を覆うように上部誘
電層（１４）と保護膜（１６）が積層されている。上部
誘電層（１４）はプラズマ放電時に発生した壁電荷が蓄
積される。保護膜（１６）はプラズマ放電時に発生され
たスパタリングによる上部誘電層（１４）の損傷を防ぐ
と共に２次電子の放出の効率を高めるために使用されて
いる。保護膜（１６）としては通常酸化マグネシウム
（ＭｇＯ）が利用される。アドレス電極（２０Ｘ）が形
成された下部基板（１８）には、同様にそれらの電極を
覆う下部誘電層（２２）が形成され、さらにその表面と
隔壁（２４）の表面には蛍光体（２６）が塗布されてい
る。アドレス電極（２０Ｘ）は走査／放電維持電極（１
２Ｙ）及び共通放電維持電極（１２Ｚ）と直交する方向
に形成されている。隔壁（２４）はアドレス電極（２０
Ｘ）と並列に形成されており、放電によって生成された
紫外線及び可視光が隣接した放電セルにリークするのを
防止している。蛍光体（２６）はプラズマ放電時に発生
した紫外線によって励起されて赤色、緑色または青色の
いずれか一つの可視光線を発生する。上／下の基板と隔
壁の間に形成された放電空間にはガス放電のための不活
性ガスが注入されている。
Ｐの放電セルは、上部基板（１０）に形成された走査／
放電維持電極（１２Ｙ）、共通放電維持電極（１２
Ｚ）、下部基板（１８）に形成されたアドレス電極（２
０Ｘ）とを具備している。走査／放電維持電極（１２
Ｙ）と共通放電維持電極（１２Ｚ）を並べて形成させた
上部基板（１０）にはそれらの電極を覆うように上部誘
電層（１４）と保護膜（１６）が積層されている。上部
誘電層（１４）はプラズマ放電時に発生した壁電荷が蓄
積される。保護膜（１６）はプラズマ放電時に発生され
たスパタリングによる上部誘電層（１４）の損傷を防ぐ
と共に２次電子の放出の効率を高めるために使用されて
いる。保護膜（１６）としては通常酸化マグネシウム
（ＭｇＯ）が利用される。アドレス電極（２０Ｘ）が形
成された下部基板（１８）には、同様にそれらの電極を
覆う下部誘電層（２２）が形成され、さらにその表面と
隔壁（２４）の表面には蛍光体（２６）が塗布されてい
る。アドレス電極（２０Ｘ）は走査／放電維持電極（１
２Ｙ）及び共通放電維持電極（１２Ｚ）と直交する方向
に形成されている。隔壁（２４）はアドレス電極（２０
Ｘ）と並列に形成されており、放電によって生成された
紫外線及び可視光が隣接した放電セルにリークするのを
防止している。蛍光体（２６）はプラズマ放電時に発生
した紫外線によって励起されて赤色、緑色または青色の
いずれか一つの可視光線を発生する。上／下の基板と隔
壁の間に形成された放電空間にはガス放電のための不活
性ガスが注入されている。
【０００４】このように形成されている放電セル（１）
は図２に図示されているようにマトリックス形態で配置
される。すなわち、放電セル（１）は走査／放電維持電
極ライン（Ｙ１〜Ｙｍ）、共通放電維持電極ライン（Ｚ
１〜Ｚｍ）及びアドレス電極ライン（Ｘ１〜Ｘｎ）の交
差部に設けられる。走査／放電維持電極ライン（Ｙ１〜
Ｙｍ）は１本ずつ順次に駆動され、共通放電維持電極ラ
イン（Ｚ１〜Ｚｍ）は全体が同時に駆動される。アドレ
ス電極ライン（Ｘ１〜Ｘｎ）は奇数番目のラインと偶数
番目のラインに分割されて駆動される。
は図２に図示されているようにマトリックス形態で配置
される。すなわち、放電セル（１）は走査／放電維持電
極ライン（Ｙ１〜Ｙｍ）、共通放電維持電極ライン（Ｚ
１〜Ｚｍ）及びアドレス電極ライン（Ｘ１〜Ｘｎ）の交
差部に設けられる。走査／放電維持電極ライン（Ｙ１〜
Ｙｍ）は１本ずつ順次に駆動され、共通放電維持電極ラ
イン（Ｚ１〜Ｚｍ）は全体が同時に駆動される。アドレ
ス電極ライン（Ｘ１〜Ｘｎ）は奇数番目のラインと偶数
番目のラインに分割されて駆動される。
【０００５】このような３電極交流の面放電型ＰＤＰが
実際に表示用に駆動されるときには階調を得るために数
回に分けて、すなわち多数のサブフィールドに分けて駆
動される。各サブフィールド期間にはビデオデータの加
重値に比例させた回数だけ発光させる。この多数回の発
光を組み合わせることで階調の表示が行われる。通常、
８ビットのビデオデータを利用して２５６階調で画像を
表示させている。その場合、各フレームの表示期間（例
えば、１／６０秒＝約１６.７ｍｓｅｃ）は、図３に図
示されているように、８つのサブフィールド（ＳＦ１〜
ＳＦ８）があり、それぞれのサブフィールドは、リセッ
ト期間、アドレス期間及び放電維持期間に分かれてい
る。放電維持期間は、１：２：４：８：…：１２８の比
率で加重値が付与され、それぞれのサブフィールドで時
間を異にしている。ここで、リセット期間は放電セルを
初期化する期間であり、アドレス期間はビデオデータの
論理値に応じて選択的にアドレス放電を生じさせる期間
であり、放電維持期間はアドレス放電が発生した放電セ
ルで放電を維持させる期間である。リセット期間とアド
レス期間は各サブフィールド期間とも同一に割り当てら
れている。
実際に表示用に駆動されるときには階調を得るために数
回に分けて、すなわち多数のサブフィールドに分けて駆
動される。各サブフィールド期間にはビデオデータの加
重値に比例させた回数だけ発光させる。この多数回の発
光を組み合わせることで階調の表示が行われる。通常、
８ビットのビデオデータを利用して２５６階調で画像を
表示させている。その場合、各フレームの表示期間（例
えば、１／６０秒＝約１６.７ｍｓｅｃ）は、図３に図
示されているように、８つのサブフィールド（ＳＦ１〜
ＳＦ８）があり、それぞれのサブフィールドは、リセッ
ト期間、アドレス期間及び放電維持期間に分かれてい
る。放電維持期間は、１：２：４：８：…：１２８の比
率で加重値が付与され、それぞれのサブフィールドで時
間を異にしている。ここで、リセット期間は放電セルを
初期化する期間であり、アドレス期間はビデオデータの
論理値に応じて選択的にアドレス放電を生じさせる期間
であり、放電維持期間はアドレス放電が発生した放電セ
ルで放電を維持させる期間である。リセット期間とアド
レス期間は各サブフィールド期間とも同一に割り当てら
れている。
【０００６】図４は従来のＰＤＰの駆動方法による波形
図を表した図面である。図４に示していないが、まず、
リセット期間に発生するリセット放電によってすべての
放電セルが初期化される。アドレス期間には走査／放電
維持電極ライン（Ｙ１〜Ｙｍ）に順次走査パルス（Ｓ
Ｐ）が供給される、その走査パルス（ＳＰ）に同期して
データパルス（ＤＰ）がアドレス電極ライン（Ｘ１〜Ｘ
ｎ）に供給される。このデータパルス（ＤＰ）が供給さ
れた放電セルでアドレス放電が起きる。放電維持期間に
は走査／放電維持電極ライン（Ｙ１〜Ｙｍ）と共通放電
維持電極ライン（Ｚ１〜Ｚｍ）に交互に放電維持パルス
（ＳＵＳＰｙ、ＳＵＳＰｚ）が供給されてアドレス放電
によって選択された放電セルで維持放電が生じる。
図を表した図面である。図４に示していないが、まず、
リセット期間に発生するリセット放電によってすべての
放電セルが初期化される。アドレス期間には走査／放電
維持電極ライン（Ｙ１〜Ｙｍ）に順次走査パルス（Ｓ
Ｐ）が供給される、その走査パルス（ＳＰ）に同期して
データパルス（ＤＰ）がアドレス電極ライン（Ｘ１〜Ｘ
ｎ）に供給される。このデータパルス（ＤＰ）が供給さ
れた放電セルでアドレス放電が起きる。放電維持期間に
は走査／放電維持電極ライン（Ｙ１〜Ｙｍ）と共通放電
維持電極ライン（Ｚ１〜Ｚｍ）に交互に放電維持パルス
（ＳＵＳＰｙ、ＳＵＳＰｚ）が供給されてアドレス放電
によって選択された放電セルで維持放電が生じる。
【０００７】このようなサブフィールド駆動方法で画像
を表示する期間で適切な輝度を出すためには放電維持期
間に充分な時間を確保しなければなならない。しかし、
ＰＤＰの解像度が高くなればなるほど走査／放電維持電
極ライン（Ｙ）の数が増加し、放電セルを選択するため
のアドレス期間が増加する。このようにアドレス期間が
増加すると画像を表示する放電維持期間が相対的に短く
なってＰＤＰの輝度が低下する。
を表示する期間で適切な輝度を出すためには放電維持期
間に充分な時間を確保しなければなならない。しかし、
ＰＤＰの解像度が高くなればなるほど走査／放電維持電
極ライン（Ｙ）の数が増加し、放電セルを選択するため
のアドレス期間が増加する。このようにアドレス期間が
増加すると画像を表示する放電維持期間が相対的に短く
なってＰＤＰの輝度が低下する。
【０００８】このような問題を解決するためにアドレス
放電のためのパルス幅を減らすことができる。しかし、
アドレス放電のためのパルス幅が減るとアドレス放電が
不安定になってアドレスに失敗する確率が増加する。特
に、走査／放電維持電極ライン（Ｙ）の数が増加すると
ライン当たり１μｓ程度の極めて短い期間でアドレス放
電を終えなければならなくなる。しかし１μｓ程度のア
ドレス放電では放電セルに充分な壁電荷を形成できな
い。また、放電セル毎に空間電荷の状態が異なって隣接
セルの影響によってアドレス放電が不安定になる。
放電のためのパルス幅を減らすことができる。しかし、
アドレス放電のためのパルス幅が減るとアドレス放電が
不安定になってアドレスに失敗する確率が増加する。特
に、走査／放電維持電極ライン（Ｙ）の数が増加すると
ライン当たり１μｓ程度の極めて短い期間でアドレス放
電を終えなければならなくなる。しかし１μｓ程度のア
ドレス放電では放電セルに充分な壁電荷を形成できな
い。また、放電セル毎に空間電荷の状態が異なって隣接
セルの影響によってアドレス放電が不安定になる。
【０００９】
【発明が解決しようとする課題】従って、本発明の目的
は高速でアドレスすることができるようにしたプラズマ
ディスプレーパネルの駆動方法及び装置を提供すること
にある。
は高速でアドレスすることができるようにしたプラズマ
ディスプレーパネルの駆動方法及び装置を提供すること
にある。
【００１０】
【課題を解決するための手段】本発明は、アドレス放電
時間を１μｓ以上に確保しながらアドレス期間を短縮さ
せるようにしたものである。具体的には、本発明による
プラズマディスプレーパネルの駆動方法は、放電セルを
選択するためのアドレス期間の間にアドレス電極にデー
タパルスを供給し、その時、そのデータパルスの前と後
ろで補助データパルスをアドレス電極に供給して、走査
／サステイニング電極に走査パルスを順次供給するよう
にしたことを特徴とする。
時間を１μｓ以上に確保しながらアドレス期間を短縮さ
せるようにしたものである。具体的には、本発明による
プラズマディスプレーパネルの駆動方法は、放電セルを
選択するためのアドレス期間の間にアドレス電極にデー
タパルスを供給し、その時、そのデータパルスの前と後
ろで補助データパルスをアドレス電極に供給して、走査
／サステイニング電極に走査パルスを順次供給するよう
にしたことを特徴とする。
【００１１】本発明によるプラズマディスプレーパネル
の駆動方法の他の実施態様は、放電セルを選択するため
のアドレス期間の間に走査／放電維持電極に順次に走査
パルスを供給するが、その際、その走査パルスが走査／
サステイニング電極に供給される時に走査パルスの前の
走査パルスと一部重畳させて補助走査パルスを供給し、
アドレス期間の間にデータの論理値に応じて相異なるパ
ルス幅を有する第１及び第２データパルスのいずれかを
アドレス電極に供給することを特徴とする。
の駆動方法の他の実施態様は、放電セルを選択するため
のアドレス期間の間に走査／放電維持電極に順次に走査
パルスを供給するが、その際、その走査パルスが走査／
サステイニング電極に供給される時に走査パルスの前の
走査パルスと一部重畳させて補助走査パルスを供給し、
アドレス期間の間にデータの論理値に応じて相異なるパ
ルス幅を有する第１及び第２データパルスのいずれかを
アドレス電極に供給することを特徴とする。
【００１２】本発明によるプラズマディスプレーパネル
の駆動装置は、データが入力されるシフトレジスタと、
シフトレジスタに保存されているデータの入力を受ける
と共に入力されたデータを一次的に保存する多数のメモ
リと、メモリに保存されているデータの入力を受けて補
助データを生成する補助データ生成部と、メモリに保存
されたデータと補助データ生成部で生成された補助デー
タの入力を受けてデータ及び補助データの中にいずれか
の一つを出力する出力手段とを具備する。
の駆動装置は、データが入力されるシフトレジスタと、
シフトレジスタに保存されているデータの入力を受ける
と共に入力されたデータを一次的に保存する多数のメモ
リと、メモリに保存されているデータの入力を受けて補
助データを生成する補助データ生成部と、メモリに保存
されたデータと補助データ生成部で生成された補助デー
タの入力を受けてデータ及び補助データの中にいずれか
の一つを出力する出力手段とを具備する。
【００１３】
【作用】本発明によるプラズマディスプレーパネルの駆
動方法及び装置によると走査パルスを所定の時間に重畳
されるように走査／放電維持電極ラインに供給すること
ができるので高速でアドレスすることができる。
動方法及び装置によると走査パルスを所定の時間に重畳
されるように走査／放電維持電極ラインに供給すること
ができるので高速でアドレスすることができる。
【００１４】
【発明の実施の形態】本発明の実施形態を添付した図５
〜図１０を参照して詳細に説明する。図５は本発明の第
１実施形態によるとプラズマディスプレーパネルを駆動
する方法を表している図である。
〜図１０を参照して詳細に説明する。図５は本発明の第
１実施形態によるとプラズマディスプレーパネルを駆動
する方法を表している図である。
【００１５】図５を参照すると、本発明の第１実施形態
によるプラズマディスプレーパネルの駆動方法ではアド
レス電極ラインに供給されるデータパルスはデータ論理
値によってパルス幅が異なるようになっている。アドレ
ス電極ライン（Ｘ）に供給されるデータの論理値が
‘１’である場合、幅（Ｔｄ）のメインデータパルス
（ＭＤＰ）が印加される。その幅の例を挙げると、１μ
ｓ程度の幅である。アドレス電極ライン（Ｘ）に供給さ
れるデータの論理値が‘０’である場合、幅（Ｔｄ）よ
り短い微細幅（Ｔａｄ）の補助データパルス（ＡＤＰ）
が印加される。この補助データパルス（ＡＤＰ）は本来
のデータパルスの後端部で供給される。すなわち、図５
では、あるサブフレームでのある部分（Ｘｎ）のデータ
が、１０１１０１となっている例を示している。走査／
放電維持電極ライン（Ｙ）にはメインデータパルス（Ｍ
ＤＰ）のパルス幅に対応するメイン走査パルス（ＭＳ
Ｐ）と補助データパルス（ＡＤＰ）のパルス幅に対応す
る補助走査パルス（ＡＳＰ）が供給される。補助走査パ
ルス（ＡＳＰ）はメイン走査パルス（ＭＳＰ）（すなわ
ち、メインデータパルス（ＭＤＰ））に先行して供給さ
れ、補助走査パルス（ＡＳＰ）とメイン走査パルス（Ｍ
ＳＰ）のパルス幅が合されて走査パルスとなる。
によるプラズマディスプレーパネルの駆動方法ではアド
レス電極ラインに供給されるデータパルスはデータ論理
値によってパルス幅が異なるようになっている。アドレ
ス電極ライン（Ｘ）に供給されるデータの論理値が
‘１’である場合、幅（Ｔｄ）のメインデータパルス
（ＭＤＰ）が印加される。その幅の例を挙げると、１μ
ｓ程度の幅である。アドレス電極ライン（Ｘ）に供給さ
れるデータの論理値が‘０’である場合、幅（Ｔｄ）よ
り短い微細幅（Ｔａｄ）の補助データパルス（ＡＤＰ）
が印加される。この補助データパルス（ＡＤＰ）は本来
のデータパルスの後端部で供給される。すなわち、図５
では、あるサブフレームでのある部分（Ｘｎ）のデータ
が、１０１１０１となっている例を示している。走査／
放電維持電極ライン（Ｙ）にはメインデータパルス（Ｍ
ＤＰ）のパルス幅に対応するメイン走査パルス（ＭＳ
Ｐ）と補助データパルス（ＡＤＰ）のパルス幅に対応す
る補助走査パルス（ＡＳＰ）が供給される。補助走査パ
ルス（ＡＳＰ）はメイン走査パルス（ＭＳＰ）（すなわ
ち、メインデータパルス（ＭＤＰ））に先行して供給さ
れ、補助走査パルス（ＡＳＰ）とメイン走査パルス（Ｍ
ＳＰ）のパルス幅が合されて走査パルスとなる。
【００１６】このような走査パルスは、当該セルにメイ
ンデータパルス（ＭＤＰ）が印加される始点より少し前
の時点、即ち補助走査パルス（ＡＳＰ）の幅（Ｔａｄ）
だけ先行して印加されることになる。特定の走査／放電
維持電極ライン（例えばＹｍ）の次の走査／放電維持電
極ライン（Ｙｍ＋１）に供給される走査パルスは走査／
放電維持電極ライン（Ｙｍ）に供給された走査パルスと
補助走査パルス（ＡＳＰ）の幅だけ重なるように印加さ
れる。すなわち一部が重畳される。この重なったときに
補助データパルスも印加される。ここで、補助データパ
ルス（ＡＤＰ）と補助走査パルス（ＡＳＰ）は、正常な
アドレス放電を生じさせない程度の短い時間であって、
その間にプライミング粒子を供給する役割を果たしてい
る。詳細に説明すると、メインデータパルス（ＭＤＰ）
が供給される放電セルでは、先行する走査／放電維持電
極ラインに走査パルスが供給されたときのメインデータ
パルス（ＭＤＰ）の後端部または補助データパルス（Ａ
ＤＰ）と当該走査／放電維持電極ラインへ供給された補
助走査パルス（ＡＳＰ）が重畳された部分で補助放電が
発生する。その後に加えられるメインデータパルス（Ｍ
ＤＰ）と走査／放電維持電極ライン（Ｙ）に供給された
メイン走査パルス（ＡＳＰ）とが重畳された部分で正常
なアドレス放電が発生する。結果的に、メインデータパ
ルス（ＭＤＰ）が供給される放電セルで図５のＡのよう
にＴａｄ＋Ｔｄ時間の間でアドレス放電が行われること
になる（Ｙm+3とＸn+i参照）。そして、補助データパル
ス（ＡＤＰ）が供給される放電セル（論理値０のセル）
では、図５のＢのように先行する走査／放電維持電極ラ
イン（Ｙ）に供給されたメイン走査パルス（ＭＳＰ）及
び現在の走査／放電維持電極ライン（Ｙ）に供給された
補助データパルス（ＡＤＰ）と補助放電が発生される
（Ｙm+3とＸn+j参照）。しかし、この補助放電は極めて
短い時間（Ｔａｓ）の間に発生されるために壁電荷を形
成できない。
ンデータパルス（ＭＤＰ）が印加される始点より少し前
の時点、即ち補助走査パルス（ＡＳＰ）の幅（Ｔａｄ）
だけ先行して印加されることになる。特定の走査／放電
維持電極ライン（例えばＹｍ）の次の走査／放電維持電
極ライン（Ｙｍ＋１）に供給される走査パルスは走査／
放電維持電極ライン（Ｙｍ）に供給された走査パルスと
補助走査パルス（ＡＳＰ）の幅だけ重なるように印加さ
れる。すなわち一部が重畳される。この重なったときに
補助データパルスも印加される。ここで、補助データパ
ルス（ＡＤＰ）と補助走査パルス（ＡＳＰ）は、正常な
アドレス放電を生じさせない程度の短い時間であって、
その間にプライミング粒子を供給する役割を果たしてい
る。詳細に説明すると、メインデータパルス（ＭＤＰ）
が供給される放電セルでは、先行する走査／放電維持電
極ラインに走査パルスが供給されたときのメインデータ
パルス（ＭＤＰ）の後端部または補助データパルス（Ａ
ＤＰ）と当該走査／放電維持電極ラインへ供給された補
助走査パルス（ＡＳＰ）が重畳された部分で補助放電が
発生する。その後に加えられるメインデータパルス（Ｍ
ＤＰ）と走査／放電維持電極ライン（Ｙ）に供給された
メイン走査パルス（ＡＳＰ）とが重畳された部分で正常
なアドレス放電が発生する。結果的に、メインデータパ
ルス（ＭＤＰ）が供給される放電セルで図５のＡのよう
にＴａｄ＋Ｔｄ時間の間でアドレス放電が行われること
になる（Ｙm+3とＸn+i参照）。そして、補助データパル
ス（ＡＤＰ）が供給される放電セル（論理値０のセル）
では、図５のＢのように先行する走査／放電維持電極ラ
イン（Ｙ）に供給されたメイン走査パルス（ＭＳＰ）及
び現在の走査／放電維持電極ライン（Ｙ）に供給された
補助データパルス（ＡＤＰ）と補助放電が発生される
（Ｙm+3とＸn+j参照）。しかし、この補助放電は極めて
短い時間（Ｔａｓ）の間に発生されるために壁電荷を形
成できない。
【００１７】また、補助放電の大きさを小さくするため
に図６に図示されているように補助放電のための補助走
査パルス（ＡＳＰ）が電圧（Ｖａｓ）を正常なアドレス
放電のためのメイン走査パルス（ＭＳＰ）の電圧（Ｖ
ｓ）より小さく印加することができる。
に図６に図示されているように補助放電のための補助走
査パルス（ＡＳＰ）が電圧（Ｖａｓ）を正常なアドレス
放電のためのメイン走査パルス（ＭＳＰ）の電圧（Ｖ
ｓ）より小さく印加することができる。
【００１８】このような本発明の第１実施形態によると
データの論理値が‘０’である時の補助データや先のメ
インデータの後端部で補助放電を起こして、この補助放
電で発生されたプライミング荷電粒子を利用してアドレ
ス放電をさせるためにアドレス放電のためのパルス幅を
短くしても確実にアドレス放電させることができ、高速
でアドレスが可能である。また、走査／放電維持電極ラ
イン（Ｙ）に供給される走査パルスを所定の時間ずつ重
畳されるように供給することで高速でアドレスをするこ
とができる。
データの論理値が‘０’である時の補助データや先のメ
インデータの後端部で補助放電を起こして、この補助放
電で発生されたプライミング荷電粒子を利用してアドレ
ス放電をさせるためにアドレス放電のためのパルス幅を
短くしても確実にアドレス放電させることができ、高速
でアドレスが可能である。また、走査／放電維持電極ラ
イン（Ｙ）に供給される走査パルスを所定の時間ずつ重
畳されるように供給することで高速でアドレスをするこ
とができる。
【００１９】図７は本発明の第２実施形態によるとＰＤ
Ｐのアドレス期間を表す駆動波形である。図７を参照す
ると、本発明の第２実施形態でもＰＤＰのアドレス期間
に走査／放電維持電極ライン（Ｙ）には順次に走査パル
ス（Ｖｓ）が印加されて、アドレス電極ライン（Ｘ）に
は走査／放電維持電極ライン（Ｙ）に供給される走査パ
ルス（Ｖｓ）に同期して補助データパルス（ＡＤＰ）と
メインデータパルス（ＭＤＰ）が供給される。アドレス
電極ライン（Ｘ）に論理値が‘１’であるデータパルス
が供給される場合に小さい幅（Ｔｄ）、例えば、１μｓ
程度の幅を有するメインデータパルス（ＭＤＰ）が印加
されて、また、そのメインデータパルス（ＭＤＰ）が印
加される時にメインデータパルス（ＭＤＰ）の前と後ろ
にはメインデータパルス（ＭＤＰ）の幅（Ｔｄ）より小
さい幅（Ｔａｄ）を有する補助データパルス（ＡＤＰ）
が印加される。そして、走査／放電維持電極ライン
（Ｙ）に順次印加される走査パルス（Ｖｓ）はメインデ
ータパルス（ＭＤＰ）及び補助データパルス（ＡＤＰ）
の幅（Ｔａｄ＋Ｔｄ＝Ｔｓ）を有する。これも同様にメ
イン走査パルス（ＭＳＰ）と補助データパルス（ＡＤ
Ｐ）の幅（Ｔａｄ＝Ｔａｓ）を有する補助走査パルス
（ＡＳＰ）とで形成されている。メイン走査パルス（Ｍ
ＳＰ）は走査／放電維持電極ライン（Ｙ）に順次印加さ
れ、補助走査パルス（ＡＳＰ）がそのメイン走査パルス
（ＭＳＰ）の前に印加される。走査／放電維持電極ライ
ン（Ｙ）に順次供給される走査パルスは、先の例と同様
に補助走査パルス（ＡＳＰ）の幅（Ｔａｓ）のだけ重畳
される。
Ｐのアドレス期間を表す駆動波形である。図７を参照す
ると、本発明の第２実施形態でもＰＤＰのアドレス期間
に走査／放電維持電極ライン（Ｙ）には順次に走査パル
ス（Ｖｓ）が印加されて、アドレス電極ライン（Ｘ）に
は走査／放電維持電極ライン（Ｙ）に供給される走査パ
ルス（Ｖｓ）に同期して補助データパルス（ＡＤＰ）と
メインデータパルス（ＭＤＰ）が供給される。アドレス
電極ライン（Ｘ）に論理値が‘１’であるデータパルス
が供給される場合に小さい幅（Ｔｄ）、例えば、１μｓ
程度の幅を有するメインデータパルス（ＭＤＰ）が印加
されて、また、そのメインデータパルス（ＭＤＰ）が印
加される時にメインデータパルス（ＭＤＰ）の前と後ろ
にはメインデータパルス（ＭＤＰ）の幅（Ｔｄ）より小
さい幅（Ｔａｄ）を有する補助データパルス（ＡＤＰ）
が印加される。そして、走査／放電維持電極ライン
（Ｙ）に順次印加される走査パルス（Ｖｓ）はメインデ
ータパルス（ＭＤＰ）及び補助データパルス（ＡＤＰ）
の幅（Ｔａｄ＋Ｔｄ＝Ｔｓ）を有する。これも同様にメ
イン走査パルス（ＭＳＰ）と補助データパルス（ＡＤ
Ｐ）の幅（Ｔａｄ＝Ｔａｓ）を有する補助走査パルス
（ＡＳＰ）とで形成されている。メイン走査パルス（Ｍ
ＳＰ）は走査／放電維持電極ライン（Ｙ）に順次印加さ
れ、補助走査パルス（ＡＳＰ）がそのメイン走査パルス
（ＭＳＰ）の前に印加される。走査／放電維持電極ライ
ン（Ｙ）に順次供給される走査パルスは、先の例と同様
に補助走査パルス（ＡＳＰ）の幅（Ｔａｓ）のだけ重畳
される。
【００２０】本実施形態の駆動波形の動作過程を詳細に
説明する。先に図７のＡのように隣接される放電セルす
べてにメインデータパルス（ＭＤＰ）が印加される場
合、メインデータパルス（ＭＤＰ）の間には一つの補助
データパルス（ＡＤＰ）が印加される。また、図７のＢ
及びＣのように孤立している放電セルにメインデータパ
ルス（ＭＤＰ）が印加される場合に、メインデータパル
ス（ＭＤＰ）の前と後ろに補助データパルス（ＡＤＰ）
が印加される。また、メインデータパルス（ＭＤＰ）が
印加されない場合には補助データパルス（ＡＤＰ）も印
加されない。表１及び図８を参照して補助データパルス
（ＡＤＰ）が印加される方法を詳細に説明する。
説明する。先に図７のＡのように隣接される放電セルす
べてにメインデータパルス（ＭＤＰ）が印加される場
合、メインデータパルス（ＭＤＰ）の間には一つの補助
データパルス（ＡＤＰ）が印加される。また、図７のＢ
及びＣのように孤立している放電セルにメインデータパ
ルス（ＭＤＰ）が印加される場合に、メインデータパル
ス（ＭＤＰ）の前と後ろに補助データパルス（ＡＤＰ）
が印加される。また、メインデータパルス（ＭＤＰ）が
印加されない場合には補助データパルス（ＡＤＰ）も印
加されない。表１及び図８を参照して補助データパルス
（ＡＤＰ）が印加される方法を詳細に説明する。
【００２１】
【００２２】表１及び図８を参照すると、第１と第２デ
ータ（Ｄ１、Ｄ２）にメインデータパルス（ＭＤＰ）が
印加される。この時、表１によって第１及び第２データ
（Ｄ１、Ｄ２）の間には補助データパルス（ＡＳＰ）が
印加される。そして、第２データ（Ｄ２）にはメインデ
ータパルス（ＭＤＰ）が印加されるが、第３データ（Ｄ
３）にはメインデータパルス（ＭＤＰ）が印加されな
い。この時、表１によって第２データ（Ｄ２）に供給さ
れるメインデータパルス（ＭＤＰ）の前後に補助データ
パルス（ＡＳＰ）が印加される。また、第３及び第４デ
ータ（Ｄ３、Ｄ４）にはメインデータパルス（ＭＤＰ）
が印加されない。従って、表１によって第３及び第４デ
ータ（Ｄ３、Ｄ４）の間には補助データパルス（ＡＳ
Ｐ）が印加されない。そして、第４データ（Ｄ４）には
メインデータパルス（ＭＤＰ）が印加されないが、第５
データ（Ｄ５）にはメインデータパルス（ＭＤＰ）が印
加される。この時、表１によって第４及び第５データ
（Ｄ４、Ｄ５）の間には補助データパルス（ＡＳＰ）が
印加される。また、第５データ（Ｄ５）にはメインデー
タパルス（ＭＤＰ）が印加されるが、第６データ（Ｄ
６）にはメインデータパルス（ＭＤＰ）が印加されな
い。従って、表１によって第５及び第６データ（Ｄ６）
の間には補助データパルス（ＡＳＰ）が印加される。即
ち、本発明では表１の規則によってアドレス電極ライン
（Ｘ）に補助データパルス（ＡＳＰ）が印加される。
ータ（Ｄ１、Ｄ２）にメインデータパルス（ＭＤＰ）が
印加される。この時、表１によって第１及び第２データ
（Ｄ１、Ｄ２）の間には補助データパルス（ＡＳＰ）が
印加される。そして、第２データ（Ｄ２）にはメインデ
ータパルス（ＭＤＰ）が印加されるが、第３データ（Ｄ
３）にはメインデータパルス（ＭＤＰ）が印加されな
い。この時、表１によって第２データ（Ｄ２）に供給さ
れるメインデータパルス（ＭＤＰ）の前後に補助データ
パルス（ＡＳＰ）が印加される。また、第３及び第４デ
ータ（Ｄ３、Ｄ４）にはメインデータパルス（ＭＤＰ）
が印加されない。従って、表１によって第３及び第４デ
ータ（Ｄ３、Ｄ４）の間には補助データパルス（ＡＳ
Ｐ）が印加されない。そして、第４データ（Ｄ４）には
メインデータパルス（ＭＤＰ）が印加されないが、第５
データ（Ｄ５）にはメインデータパルス（ＭＤＰ）が印
加される。この時、表１によって第４及び第５データ
（Ｄ４、Ｄ５）の間には補助データパルス（ＡＳＰ）が
印加される。また、第５データ（Ｄ５）にはメインデー
タパルス（ＭＤＰ）が印加されるが、第６データ（Ｄ
６）にはメインデータパルス（ＭＤＰ）が印加されな
い。従って、表１によって第５及び第６データ（Ｄ６）
の間には補助データパルス（ＡＳＰ）が印加される。即
ち、本発明では表１の規則によってアドレス電極ライン
（Ｘ）に補助データパルス（ＡＳＰ）が印加される。
【００２３】結果的に、本発明ではメインデータパルス
（ＭＤＰ）が供給される放電セルでアドレス放電はＴａ
ｄ＋Ｔｄ＋Ｔａｄの時間の間に放電が起き、アドレス放
電時間を延ばす効果が発生される。また、走査／放電維
持電極ライン（Ｙ）に供給される走査パルス（Ｖｓ）を
所定の時間だけ重畳させることで重畳される時間だけア
ドレス期間を短くすることができる。また、メインデー
タパルス（ＭＤＰ）が印加されない放電セルでは補助デ
ータパルス（ＡＤＰ）を印加しないことで消費電力を最
小化することができる。
（ＭＤＰ）が供給される放電セルでアドレス放電はＴａ
ｄ＋Ｔｄ＋Ｔａｄの時間の間に放電が起き、アドレス放
電時間を延ばす効果が発生される。また、走査／放電維
持電極ライン（Ｙ）に供給される走査パルス（Ｖｓ）を
所定の時間だけ重畳させることで重畳される時間だけア
ドレス期間を短くすることができる。また、メインデー
タパルス（ＭＤＰ）が印加されない放電セルでは補助デ
ータパルス（ＡＤＰ）を印加しないことで消費電力を最
小化することができる。
【００２４】図９は図７に図示されたアドレス電極ライ
ンにデータを供給するためのアドレス駆動部を表す回路
図である。図９を参照すると、本発明のアドレス駆動部
はデータ入力手段（３０）と現在のアドレス電極ライン
（Ｘ）に供給されるデータが保存される第１ラッチ（４
２）と、次にアドレス電極ライン（Ｘ）に供給されるデ
ータが保存される第２ラッチ（４０）と、第１ラッチ
（４２）と第２ラッチ（４０）に保存されたデータを利
用して補助データパルス（ＡＤＰ）を生成する補助デー
タパルス生成部（４４）と、補助データパルス生成部
（４４）の出力と第１ラッチ（４２）の出力を入力とし
て受けてこれらの中のいずれか一つを出力するマルチプ
レクサ（５４）とで構成されている。データ入力手段
（３０）はそれぞれ１６ｂｉｔで構成された四つのシフ
トレジスタ（３２、３４、３６、３８）で構成されてい
る。シフトレジスタ（３２、３４、３６、３８）は図示
されないデータ供給部からデータの入力を受けて、入力
されたデータを第１クロック（ＣＬＫ１）信号に同期し
てシフトさせる。シフトレジスタ（３２、３４、３６、
３８）に１６ｂｉｔのデータが入力されると、シフトレ
ジスタ（３２、３４、３６、３８）は自分に入力された
データを第２ラッチ（４０）に供給する。第２ラッチ
（４０）はシフトレジスタ（３２、３４、３６、３８）
からデータの入力を受けて、入力されたデータを第２ク
ロック（ＣＬＫ２）信号に同期して第１ラッチ（４２）
及び補助データパルス生成部（４４）に転送する。これ
と同時に第２ラッチ（４０）はシフトレジスタ（３２、
３４、３６、３８）からデータを受け取る。即ち、第１
ラッチ（４２）には現在のアドレス電極ライン（Ｘ）に
供給されるデータが保存されて、第２ラッチ（４０）に
は次のアドレス電極ライン（Ｘ）に供給されるデータが
保存される。第１ラッチ（４２）は第３クロック（ＣＬ
Ｋ３）信号に同期して自分に保存されている現在のデー
タを補助データパルス生成部（４４）とマルチプレクサ
（５４）に供給する。補助データパルス生成部（４４）
は第２ラッチ（４０）から第１ラッチ（４２）に転送さ
れる次のデータと、第１ラッチ（４２）からマルチプレ
クサ（５４）に供給される現在のデータを入力として補
助データパルス（ＡＤＰ）を生成する。そのため、補助
データパルス生成部（４４）は多数のＯＲゲート（４
６、４８、５０、５２）で構成されている。即ち、補助
データパルス生成部（４４）は次のデータと現在のデー
タを論理和して補助データパルス（ＡＤＰ）を生成す
る。補助データパルス生成部（４４）は第１及び第２ラ
ッチ（４２、４０）に記憶されるビットの数（６４ｂｉ
ｔ）だけのＯＲゲートを含む。即ち、第１及び第２ラッ
チ（４２、４０）に６４ｂｉｔのデータが記憶されると
すると補助データパルス生成部（４４）は６４のＯＲゲ
ートを含む。補助データパルス生成部（４４）で生成さ
れた補助データパルス（ＡＤＰ）及び第１ラッチ（４
２）から出力される現在のデータ（即ち、メインデータ
パルス（ＭＤＰ））はマルチプレクサ（５４）に入力さ
れる。マルチプレクサ（５４）は第４クロック（ＣＬＫ
４）に‘１’のクロック信号が入力されると補助データ
パルス（ＡＤＰ）を出力して、第４クロック（ＣＬＫ
４）に‘０’のクロック信号が入力されるとメインデー
タパルス（ＭＤＰ）を出力する。マルチプレクサ（５
４）からアドレス電極ライン（Ｘ）に出力される出力波
形を図１０を参照して詳細に説明する。
ンにデータを供給するためのアドレス駆動部を表す回路
図である。図９を参照すると、本発明のアドレス駆動部
はデータ入力手段（３０）と現在のアドレス電極ライン
（Ｘ）に供給されるデータが保存される第１ラッチ（４
２）と、次にアドレス電極ライン（Ｘ）に供給されるデ
ータが保存される第２ラッチ（４０）と、第１ラッチ
（４２）と第２ラッチ（４０）に保存されたデータを利
用して補助データパルス（ＡＤＰ）を生成する補助デー
タパルス生成部（４４）と、補助データパルス生成部
（４４）の出力と第１ラッチ（４２）の出力を入力とし
て受けてこれらの中のいずれか一つを出力するマルチプ
レクサ（５４）とで構成されている。データ入力手段
（３０）はそれぞれ１６ｂｉｔで構成された四つのシフ
トレジスタ（３２、３４、３６、３８）で構成されてい
る。シフトレジスタ（３２、３４、３６、３８）は図示
されないデータ供給部からデータの入力を受けて、入力
されたデータを第１クロック（ＣＬＫ１）信号に同期し
てシフトさせる。シフトレジスタ（３２、３４、３６、
３８）に１６ｂｉｔのデータが入力されると、シフトレ
ジスタ（３２、３４、３６、３８）は自分に入力された
データを第２ラッチ（４０）に供給する。第２ラッチ
（４０）はシフトレジスタ（３２、３４、３６、３８）
からデータの入力を受けて、入力されたデータを第２ク
ロック（ＣＬＫ２）信号に同期して第１ラッチ（４２）
及び補助データパルス生成部（４４）に転送する。これ
と同時に第２ラッチ（４０）はシフトレジスタ（３２、
３４、３６、３８）からデータを受け取る。即ち、第１
ラッチ（４２）には現在のアドレス電極ライン（Ｘ）に
供給されるデータが保存されて、第２ラッチ（４０）に
は次のアドレス電極ライン（Ｘ）に供給されるデータが
保存される。第１ラッチ（４２）は第３クロック（ＣＬ
Ｋ３）信号に同期して自分に保存されている現在のデー
タを補助データパルス生成部（４４）とマルチプレクサ
（５４）に供給する。補助データパルス生成部（４４）
は第２ラッチ（４０）から第１ラッチ（４２）に転送さ
れる次のデータと、第１ラッチ（４２）からマルチプレ
クサ（５４）に供給される現在のデータを入力として補
助データパルス（ＡＤＰ）を生成する。そのため、補助
データパルス生成部（４４）は多数のＯＲゲート（４
６、４８、５０、５２）で構成されている。即ち、補助
データパルス生成部（４４）は次のデータと現在のデー
タを論理和して補助データパルス（ＡＤＰ）を生成す
る。補助データパルス生成部（４４）は第１及び第２ラ
ッチ（４２、４０）に記憶されるビットの数（６４ｂｉ
ｔ）だけのＯＲゲートを含む。即ち、第１及び第２ラッ
チ（４２、４０）に６４ｂｉｔのデータが記憶されると
すると補助データパルス生成部（４４）は６４のＯＲゲ
ートを含む。補助データパルス生成部（４４）で生成さ
れた補助データパルス（ＡＤＰ）及び第１ラッチ（４
２）から出力される現在のデータ（即ち、メインデータ
パルス（ＭＤＰ））はマルチプレクサ（５４）に入力さ
れる。マルチプレクサ（５４）は第４クロック（ＣＬＫ
４）に‘１’のクロック信号が入力されると補助データ
パルス（ＡＤＰ）を出力して、第４クロック（ＣＬＫ
４）に‘０’のクロック信号が入力されるとメインデー
タパルス（ＭＤＰ）を出力する。マルチプレクサ（５
４）からアドレス電極ライン（Ｘ）に出力される出力波
形を図１０を参照して詳細に説明する。
【００２５】図１０を参照する。先に第１ラッチ（４
２）及び第２ラッチ（４０）に‘１’のメインデータパ
ルス（ＭＤＰ）が保存されていると仮定する。即ち、第
１ラッチ（４２）には第１データ（Ｄ１）が保存されて
いて、第２ラッチ（４０）には第２データ（Ｄ２）が保
存されている。補助データパルス生成部（４４）は第１
ラッチ（４２）及び第２ラッチ（４０）に保存されてい
る‘１’のメインデータパルス（ＭＤＰ）の入力を受け
て‘１’の補助データパルス（ＡＳＰ）を生成する。第
１ラッチ（４２）に保存されている‘１’のメインデー
タパルス（ＭＤＰ）はマルチプレクサ（５４）に転送さ
れて、マルチプレクサ（５４）は第４クロック（ＣＬＫ
４）に‘０’のクロック信号が入力される時、第１デー
タ（Ｄ１）をアドレス電極ライン（Ｘ）に供給する。ま
た、マルチプレクサ（５４）は第４クロック（ＣＬＫ
４）に‘１’のクロック信号が入力される時、‘１’の
補助データパルス（ＡＳＰ）をアドレス電極ライン
（Ｘ）に供給する。従って、アドレス電極ライン（Ｘ）
には図１０のＡのようなアドレスデータが供給される。
以後、第１ラッチ（４２）には第２データ（Ｄ２）が入
力されて、第２ラッチ（４０）には第３データ（Ｄ３）
が入力される。補助データパルス生成部（４４）は第１
及び第２ラッチ（４０）に保存されている第２及び第３
データ（Ｄ２、Ｄ３）の入力を受けて‘１’の補助デー
タパルス（ＡＳＰ）を生成する。マルチプレクサ（５
４）は第４クロック（ＣＬＫ４）に‘０’のクロック信
号が入力される時、第１ラッチ（４２）に保存されてい
る第２データ（Ｄ２）をアドレス電極ライン（Ｘ）に供
給して、第４クロック（ＣＬＫ４）に‘１’のクロック
信号が入力される時、補助データパルス（ＡＳＰ）をア
ドレス電極ライン（Ｘ）に供給する。従って、アドレス
電極ライン（Ｘ）には図１０のＢようなアドレスデータ
が供給される。以後、第１ラッチ（４２）には第３デー
タ（Ｄ３）が入力されて、第２ラッチ（４０）には第４
データ（Ｄ４）が入力される。補助データパルス生成部
（４４）は第１及び第２ラッチ（４０）に保存されてい
る第３及び第４データ（Ｄ３、Ｄ４）の入力を受けて
‘０’の補助データパルス（ＡＳＰ）を生成する。マル
チプレクサ（５４）は第４クロック（ＣＬＫ４）に
‘０’のクロック信号が入力される時、第１ラッチ（４
２）に保存されている第３データ（Ｄ３）をアドレス電
極ライン（Ｘ）に供給して、第４クロック（ＣＬＫ４）
に‘１’のクロック信号が入力される時、補助データパ
ルス（ＡＳＰ）をアドレス電極ライン（Ｘ）に供給す
る。従って、アドレス電極ライン（Ｘ）には図１０のＣ
ようなアドレスデータが供給される。本発明ではこのよ
うな過程を繰り返してアドレス電極ラインにアドレスデ
ータを供給する。
２）及び第２ラッチ（４０）に‘１’のメインデータパ
ルス（ＭＤＰ）が保存されていると仮定する。即ち、第
１ラッチ（４２）には第１データ（Ｄ１）が保存されて
いて、第２ラッチ（４０）には第２データ（Ｄ２）が保
存されている。補助データパルス生成部（４４）は第１
ラッチ（４２）及び第２ラッチ（４０）に保存されてい
る‘１’のメインデータパルス（ＭＤＰ）の入力を受け
て‘１’の補助データパルス（ＡＳＰ）を生成する。第
１ラッチ（４２）に保存されている‘１’のメインデー
タパルス（ＭＤＰ）はマルチプレクサ（５４）に転送さ
れて、マルチプレクサ（５４）は第４クロック（ＣＬＫ
４）に‘０’のクロック信号が入力される時、第１デー
タ（Ｄ１）をアドレス電極ライン（Ｘ）に供給する。ま
た、マルチプレクサ（５４）は第４クロック（ＣＬＫ
４）に‘１’のクロック信号が入力される時、‘１’の
補助データパルス（ＡＳＰ）をアドレス電極ライン
（Ｘ）に供給する。従って、アドレス電極ライン（Ｘ）
には図１０のＡのようなアドレスデータが供給される。
以後、第１ラッチ（４２）には第２データ（Ｄ２）が入
力されて、第２ラッチ（４０）には第３データ（Ｄ３）
が入力される。補助データパルス生成部（４４）は第１
及び第２ラッチ（４０）に保存されている第２及び第３
データ（Ｄ２、Ｄ３）の入力を受けて‘１’の補助デー
タパルス（ＡＳＰ）を生成する。マルチプレクサ（５
４）は第４クロック（ＣＬＫ４）に‘０’のクロック信
号が入力される時、第１ラッチ（４２）に保存されてい
る第２データ（Ｄ２）をアドレス電極ライン（Ｘ）に供
給して、第４クロック（ＣＬＫ４）に‘１’のクロック
信号が入力される時、補助データパルス（ＡＳＰ）をア
ドレス電極ライン（Ｘ）に供給する。従って、アドレス
電極ライン（Ｘ）には図１０のＢようなアドレスデータ
が供給される。以後、第１ラッチ（４２）には第３デー
タ（Ｄ３）が入力されて、第２ラッチ（４０）には第４
データ（Ｄ４）が入力される。補助データパルス生成部
（４４）は第１及び第２ラッチ（４０）に保存されてい
る第３及び第４データ（Ｄ３、Ｄ４）の入力を受けて
‘０’の補助データパルス（ＡＳＰ）を生成する。マル
チプレクサ（５４）は第４クロック（ＣＬＫ４）に
‘０’のクロック信号が入力される時、第１ラッチ（４
２）に保存されている第３データ（Ｄ３）をアドレス電
極ライン（Ｘ）に供給して、第４クロック（ＣＬＫ４）
に‘１’のクロック信号が入力される時、補助データパ
ルス（ＡＳＰ）をアドレス電極ライン（Ｘ）に供給す
る。従って、アドレス電極ライン（Ｘ）には図１０のＣ
ようなアドレスデータが供給される。本発明ではこのよ
うな過程を繰り返してアドレス電極ラインにアドレスデ
ータを供給する。
【００２６】
【発明の効果】上述したように、本発明によるプラズマ
ディスプレーパネルの駆動方法及び装置によると走査パ
ルスを所定の時間に重畳されるように走査／放電維持電
極ラインに供給するので、ここのアドレス放電期間、す
なわちアドレスのためのパルス幅を短くしても確実にア
ドレスすることができる、すなわち、高速でアドレスす
ることができる。
ディスプレーパネルの駆動方法及び装置によると走査パ
ルスを所定の時間に重畳されるように走査／放電維持電
極ラインに供給するので、ここのアドレス放電期間、す
なわちアドレスのためのパルス幅を短くしても確実にア
ドレスすることができる、すなわち、高速でアドレスす
ることができる。
【図１】 従来の３電極の交流の面放電プラズマディス
プレーパネルの放電セルの構造を表す斜視図である。
プレーパネルの放電セルの構造を表す斜視図である。
【図２】 図１に図示された放電セルを含むプラズマデ
ィスプレーパネルの全体的な電極の配置図である。
ィスプレーパネルの全体的な電極の配置図である。
【図３】 通常のサブフィールド駆動方法を説明するた
めの一つのフレーム構成図である。
めの一つのフレーム構成図である。
【図４】 従来のプラズマディスプレーパネルの駆動方
法を表す波形図である。
法を表す波形図である。
【図５】 本発明の第１の実施形態によるプラズマディ
スプレーパネルの駆動方法を表す波形図である。
スプレーパネルの駆動方法を表す波形図である。
【図６】 本発明の異なる実施形態によるプラズマディ
スプレーパネルの駆動方法を表す波形図である。
スプレーパネルの駆動方法を表す波形図である。
【図７】 本発明の第２の実施形態によるプラズマディ
スプレーパネルの駆動方法を表す波形図である
スプレーパネルの駆動方法を表す波形図である
【図８】 図７に図示された補助データパルスの印加過
程を表す波形図である。
程を表す波形図である。
【図９】 図７に図示された駆動波形を生成するための
回路図である。
回路図である。
【図１０】 図９に図示された回路図で駆動波形を生成
する過程を表す波形図である。
する過程を表す波形図である。
１：放電セル １０：上部基板 １２Ｙ：走査／放電維持電極 １２Ｚ：共通放電維持電極 １４：上部誘電層 １６：保護膜 １８：下部基板 ２０Ｘ：アドレス電極 ２２：下部誘電層 ２４：隔壁 ２６：蛍光体 ３０：データ入力手段 ３２、３４、３６、３８：シフトレジスタ ４０：第２ラッチ ４２：第１ラッチ ４４：補助データパルス生成部 ４６、４８、５０、５２：ＯＲゲート ５４：マルチプレクサ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ダイ・ジン・ミュン 大韓民国・キョンギ−ド・コヤン−シ・ド ゥキャン−ク・カンサン−ドン・216・サ ムソン ヴィラ・シイ−301 (72)発明者 ジュン・ヨン・ユー 大韓民国・ソウル・セオダイムン−ク・ホ ンジェウン−３ドン・202−５・ヒュンダ イ アパートメント・102−1101
Claims (17)
- 【請求項１】 走査／放電維持電極及びアドレス電極を
含むプラズマディスプレーパネルの駆動方法において、
放電セルを選択するためのアドレス期間の間に前記アド
レス電極にデータパルスを供給する段階と、前記アドレ
ス電極に前記データパルスが供給される時に前記データ
パルスの前と後ろに補助データパルスを前記アドレス電
極に供給する段階と、前記走査／サステイニング電極に
走査パルスが順次供給する段階を含むことを特徴とする
プラズマディスプレーパネルの駆動方法。 - 【請求項２】 前記データパルスは前記補助データパル
スより広いパルス幅を有することを特徴とする請求項１
記載のプラズマディスプレーパネルの駆動方法。 - 【請求項３】 前記走査／放電維持電極に印加される走
査パルスは所定の幅だけ重畳されることを特徴とする請
求項１記載のプラズマディスプレーパネルの駆動方法。 - 【請求項４】 前記走査／放電維持電極に印加される走
査パルスは前記補助データパルスの幅だけ重畳されるこ
とを特徴とする請求項１記載のプラズマディスプレーパ
ネルの駆動方法。 - 【請求項５】 前記走査パルスのパルス幅は前記データ
パルス及び前記データパルスの前後に位置される補助デ
ータパルスの幅と対応していることを特徴とする請求項
１記載のプラズマディスプレーパネルの駆動方法。 - 【請求項６】 前記隣接される放電セルに連続的にデー
タパルスが供給される時に前記データパルスの間には一
つの補助データパルスが供給されることを特徴とする請
求項１記載のプラズマディスプレーパネルの駆動方法。 - 【請求項７】 前記データパルスの幅は１μｓ以下であ
ることを特徴とする請求項１記載のプラズマディスプレ
ーパネルのの駆動方法。 - 【請求項８】 走査／放電維持電極及びアドレス電極を
含むプラズマディスプレーパネルの駆動方法において、
放電セルを選択するためのアドレス期間の間に前記走査
／放電維持電極に順次走査パルスを供給する段階と、前
記走査パルスが前記走査／サステイニング電極に供給さ
れる時に前記走査パルスの前の走査パルスと重畳される
ように補助走査パルスを供給する段階と、前記アドレス
期間の間にデータの論理値に応じて相異なパルス幅を有
する第１及び第２データパルスの中のいずれか一つを前
記アドレス電極に供給する段階を含むことを特徴とする
プラズマディスプレーパネルの駆動方法。 - 【請求項９】 前記走査パルスは前記補助走査パルスよ
り広い幅を有することを特徴とする請求項８記載のプラ
ズマディスプレーパネルの駆動方法。 - 【請求項１０】 前記データ論理値がハイ論理である場
合、前記走査パルスと対応される第１データパルスが供
給されて、前記データの論理値がローである場合前記補
助走査パルスと対応される第２データパルスが供給され
ることを特徴とする請求項８記載のプラズマディスプレ
ーパネルの駆動方法。 - 【請求項１１】 前記プラズマディスプレーパネルの放
電セルに前記データパルスが供給される場合、以前のラ
インの走査時間に供給されたデータパルス及び補助デー
タパルスの中のいずれかの一つと重畳される補助走査パ
ルスによって微弱な補助放電が発生されて、その補助放
電によって生成された荷電粒子を利用して現在の走査ラ
インの走査時間に供給されたデータパルスとそれに重畳
される走査パルスによってアドレス放電が起きることを
特徴とするプラズマディスプレーパネルの駆動方法。 - 【請求項１２】 前記補助走査パルスは前記走査パルス
より低い電圧レベルを有することを特徴とする請求項８
記載のプラズマディスプレーパネルの駆動方法。 - 【請求項１３】 データが入力されるシフトレジスタ
と、前記シフトレジスタに保存されている前記データの
入力を受けると共にその入力されたデータを一次的に保
存する多数のメモリと、前記メモリに保存されている前
記データの入力を受けて補助データを生成する補助デー
タ生成部と、前記メモリに保存されたデータ及び前記補
助データ生成部で生成された補助データの入力を受けて
前記データ及び補助データのいずれかの一つを出力する
出力手段とを具備することを特徴とするプラズマディス
プレーパネルの駆動装置。 - 【請求項１４】 前記メモリは前記シフトレジスタから
データの入力を受ける第１ラッチと、前記第１ラッチか
らデータの入力を受ける第２ラッチとで構成されること
を特徴とする請求１３記載のプラズマディスプレーパネ
ルの駆動装置。 - 【請求項１５】 前記第１ラッチには現在のアドレス電
極に供給されるデータが保存されて、前記第２ラッチに
は次のアドレス電極などに供給されるデータが保存され
ることを特徴とする請求１４記載のプラズマディスプレ
ーパネルの駆動装置。 - 【請求項１６】 前記補助生成部は前記現在のデータ及
び次のデータを論理和演算して補助データを生成するこ
とを特徴とする請求１４記載のプラズマディスプレーパ
ネルの駆動装置。 - 【請求項１７】 前記出力手段は前記第２ラッチからデ
ータの入力を受けると共に前記補助データの入力を受け
ていずれか一つを出力するマルチプレクサなどで構成さ
れることを特徴とする請求１４記載のプラズマディスプ
レーパネルの駆動装置。
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|---|---|---|---|
| KR1020000001547A KR100330031B1 (ko) | 2000-01-13 | 2000-01-13 | 플라즈마 디스플레이 패널의 구동방법 |
| KR10-2000-0064827A KR100381049B1 (ko) | 2000-11-02 | 2000-11-02 | 플라즈마 디스플레이 패널의 구동방법 및 장치 |
| KR1547/2000 | 2000-11-02 | ||
| KR64827/2000 | 2000-11-02 |
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|---|---|
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ID=26636721
Family Applications (1)
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|---|---|---|---|
| JP2001006524A Pending JP2001249641A (ja) | 2000-01-13 | 2001-01-15 | プラズマディスプレーパネルの駆動方法及び装置 |
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2001
- 2001-01-12 US US09/758,232 patent/US6407510B1/en not_active Expired - Fee Related
- 2001-01-15 JP JP2001006524A patent/JP2001249641A/ja active Pending
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