KR20020096397A - 플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치 - Google Patents

플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치 Download PDF

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Abstract

본 발명은 주사펄스가 겹치는 시간을 최대한으로 늘여서 고속 어드레싱을 가능하도록 한 플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널의 스캔 구동방법은 어드레스전극에 '1'의 비디오신호에 대응하는 제1 데이터펄스가 인가되는 단계와, 제1 데이터펄스가 인가됨과 동시에 제1 데이터펄스의 폭과 상이한 '1'의 비디오신호에 대응하는 제2 데이터펄스가 제1 데이터펄스의 앞과 뒤에 인가되는 단계와, 어드레스전극과 교차되는 방향으로 형성되는 주사/서스테인전극에는 제1 데이터펄스 및 제2 데이터펄스와 동기되게 서서히 하강하는 슬로프 파형을 가지는 주사펄스가 공급되는 단계를 포함한다.
본 발명에 의하면, 중첩되게 인가되는 주사펄스의 초기단계를 서서히 하강하게 하는 슬로프 파형으로 형성함으로써 중첩되는 시간을 더 늘리고 이로써 어드레싱 시간을 더 줄일 수 있게 된다.

Description

플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치{Driving Method for Scanning of Plasma Display Panel and Apparatus Thereof}
본 발명은 플라즈마 디스플레이 패널의 구동방법 및 그 장치에 관한 것으로 특히, 주사펄스가 겹치는 시간을 최대한으로 늘여서 고속 어드레싱을 가능하도록 한 플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치에 관한 것이다.
최근, 평판 디스플레이 장치로서 대형패널의 제작이 용이한 플라즈마 디스플레이 패널(이하 "PDP"라 함)이 주목받고 있다. PDP로는 도 1에 도시된 바와 같이 3전극을 구비하고 교류전압에 의해 구동되는 3전극 교류 면방전형 PDP가 대표적이다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 주사/서스테인전극(12Y) 및 공통서스테인전극(12Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(20X)을 구비한다. 주사/서스테인전극(12Y)과 공통서스테인전극(12Z)이 나란하게 형성된 상부기판(10)에는 상부 유전층(14)과 보호막(16)이 적층된다. 상부 유전층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다. 어드레스전극(20X)이 형성된 하부기판(18) 상에는 하부 유전층(22), 격벽(24)이 형성되며, 하부 유전층(22)과 격벽(24) 표면에는 형광체(26)가 도포된다. 어드레스전극(20X)은 주사/서스테인전극(12Y) 및 공통서스테인전극(12Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(20X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체(26)는 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하판과 격벽 사이에 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이러한 방전셀은 도 2에 도시된 바와 같이 매트릭스 형태로 배치된다. 도 2에서 방전셀(1)은 주사/서스테인전극라인(Y1 내지 Ym), 공통서스테인전극라인(Z1 내지 Zm) 및 어드레스전극라인(X1 내지 Xn)의 교차부에 마련된다. 주사/서스테인전극라인(Y1 내지 Ym)은 순차적으로 구동되고, 공통서스테인전극라인(Z1 내지 Zm)은 공통적으로 구동된다. 어드레스전극라인들(X1 내지 Xn)은 기수번째 라인들과 우수번째 라인들로 분할되어 구동된다.
이러한 3전극 교류 면방전형 PDP는 다수개의 서브필드로 분리되어 구동되고, 각 서브필드기간에는 비디오 데이터의 가중치에 비례시킨 횟수의 발광이 진행됨으로써 계조표시가 행해지게 된다. 실례로, 8비트의 비디오 데이터를 이용하여 256 계조로 화상이 표시되는 경우 각 방전셀(1)에서의 1 프레임 표시기간(예를 들면, 1/60초=약 16.7msec)은 도 3에 도시된 바와 같이 8개의 서브필드(SF1 내지 SF8)로 분할된다. 각 서브필드(SF1 내지 SF8)는 다시 리셋 기간, 어드레스 기간 및 서스테인 기간으로 분할하고, 서스테인 기간에 1:2:4:8:…:128의 비율로 가중치를 부여하게 된다. 여기서, 리셋 기간은 방전셀을 초기화하는 기간이고, 어드레스 기간은 비디오데이터의 논리값에 따라 선택적인 어드레스방전이 발생하게 하는 기간이며, 서스테인 기간은 상기 어드레스방전이 발생된 방전셀에서 방전이 유지되게 하는 기간이다. 리셋 기간과 어드레스 기간은 각 서브필드 기간에 동일하게 할당된다.
도 4는 종래의 PDP의 구동방법에 따른 파형도를 나타내는 도면이다.
도 4를 참조하면, 우선 도시하지 않은 리셋 기간에서 모든 방전셀들에서 방전이 발생되게 함으로써 모든 방전셀들을 초기화하게 된다. 이러한 리셋 기간에 이어 어드레스 기간에서는 주사/서스테인전극라인들(Y1 내지 Ym)에 순차적으로 주사펄스(SP)를 공급함과 아울러 그 주사펄스(SP)에 동기되는 데이터펄스(DP)를 어드레스전극라인들(X1 내지 Xn)에 공급함으로써 선택적인 어드레스방전이 발생되게 한다. 이어서, 서스테인 기간에서 주사/서스테인전극라인들(Y1 내지 Ym)과 공통서스테인전극라인들(Z1 내지 Zm)에 교번적으로 서스테인펄스(SUSPy, SUSPz)를 공급함으로써 상기 어드레스방전이 발생된 방전셀들에서 서스테인 방전이 소정의 기간동안유지되게 한다.
이러한 서브필드 구동방법에서 서스테인 기간은 화상을 표시하는 기간으로 적절한 휘도를 내기 위해서는 어느 정도의 시간을 확보하여야 한다. 그런데, 고 해상도화 되거나 화면의 크기가 증가하게 되면 PDP의 주사/서스테인전극라인(Y) 수가 증가하게 된다. 이에 따라, 어드레스기간이 증가하게 되므로 자연히 서스테인 기간이 짧아지게 되어 휘도가 낮아지는 문제가 발생하게 된다. 이로 인하여, 어드레스 전극라인을 분할하여 멀티-어드레스를 하는 경우에는 그 만큼 구동 IC가 추가되어 제조 원가가 증가하게 된다.
이러한 문제점을 해결하기 위해서는 어드레스방전을 위한 펄스폭을 줄여야하나 펄스폭을 줄이는 경우 방전이 불안정하게 되어 어드레스 실패확률이 증가하게 된다. 이러한 어드레스 실패를 없애기 위해서는 보조 전극라인들을 추가하여 어드레스 방전이 일어나기 전에 프라이밍 입자를 제공해주는 방법과 기존의 3전극 구조에서 어드레스 펄스의 재구성 및 최적화에 의한 방법이 고려될 수 있다. 그러나, 보조전극라인에 의한 프라이밍 입자의 생성은 패널의 제작공정이 복잡해지고 구동이 어려운 단점이 있다. 따라서, 기존의 3전극 구조에서 어드레스 펄스를 개선하는 방법이 최선의 방법이라고 할 수 있다. 그러나, 주사/서스테인전극라인(Y) 수가 증가하게 되면 라인당 1㎲ 정도의 매우 짧은 기간동안 어드레스 방전이 발생하여야 하는데 종래의 1㎲ 펄스로는 어드레스가 불가능하다고 알려져 있다. 이는 1㎲ 동안에는 방전이 충분히 성숙되지 못하고 끝나기 때문에 어드레스방전시 방전유지에 필요한 충분한 벽전하를 주사/서스테인전극(12Y) 및 공통서스테인전극(12Z)상에 형성하지 못하기 때문이다. 또한, 방전셀마다 공간전하의 상태가 다르고 인접 셀에 의한 영향에 의해 어드레스가 불안정해진다. 이러한 문제점을 해결하기 위하여 도 5와 같은 구동파형이 제안되었다.
도 5를 참조하면, 종래의 구동파형의 어드레스 기간에 주사/서스테인전극라인(Y)에는 순차적으로 주사펄스(Vs)가 인가되고, 어드레스전극라인(X)에는 주사/서스테인전극라인(Y)에 공급되는 주사펄스(Vs)에 동기되어 보조 데이터펄스(ADP) 및 메인 데이터펄스(MDP)가 공급된다. 어드레스전극라인(X)에 논리값이 '1'인 데이터펄스(DP)가 공급될 경우 작은 폭(Td)을 가지는 메인 데이터펄스(MDP)가 인가되고, 데이터의 논리값이 '0'인 경우 메인 데이터펄스(MDP)가 인가되지 않는다. 또한, 메인 데이터펄스(MDP)가 인가될 때 메인 데이터펄스(MDP)의 앞 및 뒤에는 메인 데이터펄스(MDP)의 폭(Td)보다 작은 폭(Tad)을 가지는 보조 데이터펄스(ADP)가 인가된다. 그리고, 주사/서스테인전극라인들(Y1 내지 Ym)에 순차적으로 인가되는 주사펄스(Vs)는 메인 데이터펄스(MDP) 및 보조 데이터펄스(ADP)의 폭(Tad+Td=Ts)을 가지는 메인 주사펄스(MSP)와 보조 데이터펄스(ADP) 폭(Tad=Tas)을 가지는 보조 주사펄스(ASP)로 나뉘어진다. 메인 주사펄스(MSP)는 주사/서스테인전극라인들(Y1 내지 Ym)에 순차적으로 인가되고 보조 주사펄스(ASP)는 메인 주사펄스(MSP)에 선행되어 인가된다. 주사/서스테인전극라인들(Y)에 순차적으로 공급되는 주사펄스(Vs)는 보조 주사펄스(ASP)의 폭(Tas) 만큼씩 중첩되게 인가된다.
이러한 종래의 구동파형의 인가과정을 상세히 설명하면, 먼저 도 5의 A와 같이 제1 어드레스전극라인(X1)에 제1 메인 데이터펄스(MDP1)가 인가되는 경우 하나의 보조 데이터펄스(ADP)가 인가된다. 또한, 제2 어드레스전극라인(X2) 이후의 방전셀에서 제1 메인 데이터펄스(MDP1)보다 작은 폭의 제2 메인 데이터펄스(MDP2)가 인가되는 경우 도 5의 B 및 C와 같이 제2 메인 데이터펄스(MDP)의 앞 및 뒤에 보조 데이터펄스(ADP)가 인가된다. 또한, 메인 데이터펄스(MDP)가 인가되지 않는 경우 보조 데이터펄스(ADP)도 인가되지 않는다.
결과적으로, 종래의 구동파형에서는 메인 데이터펄스(MDP)가 공급되는 방전셀에서 어드레스 방전은 Tad+Td+Tad의 시간동안 방전이 일어나게 되어 어드레스 방전시간을 늘려준 효과가 발생된다. 또한, 주사/서스테인전극라인(Y)에 공급되는 주사펄스(Vs)가 소정 시간만큼 중첩되게 함으로써 중첩되는 시간만큼 어드레스 시간을 짧게 할 수 있다.
그러나 종래 기술에서의 주사펄스(Vs)가 중첩되는 시간은 보조 데이터펄스(ADP)가 중첩되는 부분으로 한정되므로 어드레스 시간을 줄이는 데는 한계가 있게 된다.
따라서, 본 발명의 목적은 주사펄스가 중첩되는 시간을 최대한으로 늘여서 고속 어드레싱이 가능하도록 한 플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치를 제공하는데 있다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도.
도 2는 도 1에 도시된 방전셀들을 포함하는 플라즈마 디스플레이 패널의 전체적인 전극 배치도.
도 3은 통상의 서브필드 구동방법을 설명하기 위한 한 프레임 구성도.
도 4는 종래의 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 5는 종래의 다른 기술에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 6은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 7은 도 6에 도시된 구동방법을 나타내기 위한 구동회로도.
도 8은 도 7에 도시된 구동회로를 구동하기 위한 스위치소자의 구동파형도.
도 9는 도 6에 도시된 구동방법을 나타내기 위한 다른 구동회로도.
< 도면의 주요 부분에 대한 부호의 설명 >
1 : 방전셀10 : 상부기판
12Y : 주사/서스인전극 12Z : 공통서스테인전극
14,22 : 유전체층16 : 보호막
18 : 하부기판20X : 어드레스전극
24 : 격벽26 : 형광체층
40 : 스캔구동부 42,44 : 슬로프 파형 발생부
상기 목적을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널의 스캔 구동방법은 어드레스전극에 '1'의 비디오신호에 대응하는 제1 데이터펄스가 인가되는 단계와, 상기 제1 데이터펄스가 인가됨과 동시에 상기 제1 데이터펄스의 폭과 상이한 '1'의 비디오신호에 대응하는 제2 데이터펄스가 상기 제1 데이터펄스의 앞과 뒤에 인가되는 단계와, 상기 어드레스전극과 교차되는 방향으로 형성되는 주사/서스테인전극에는 상기 제1 데이터펄스 및 제2 데이터펄스와 동기되게 서서히 하강하는 슬로프 파형을 가지는 주사펄스가 공급되는 단계를 포함한다.
이 경우 제 2 데이터펄스의 펄스 폭은 제 1 데이터펄스의 펄스 폭 보다 좁게 설정되는 것을 특징으로 한다.
또한 주사/서스테인전극은 적어도 2개 이상의 블록으로 분할되고, 상기 제 2 데이터펄스와 동기되도록 상기 각각의 블록에 포함된 주사/서스테인전극에 순차적으로 상기 슬로프 파형의 주사펄스가 공급되는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 스캔 구동장치는 스캔전압을 발생하기 위한 스캔전압원과, 상기 스캔전압원에 접속되어 어드레스 기간동안 상기 스캔전압원을 구동시키기 위한 제1 스위치 소자와, 상기 제1 스위치소자에 접속되어 주사/서스테인전극에 주사펄스를 공급하기 위한 스캔구동부와, 상기 스캔구동부에 접속되어 상기 주사펄스에 하강하는 슬로프 파형을 가지도록 하는 슬로프 파형 발생부를 구비하는 것을 특징으로 한다.
이 때 슬로프 파형 발생부는 슬로프형의 펄스를 공급하도록 스위칭하는 제4 스위치 소자와, 상기 제4 스위치 소자의 게이트에 접속되어 제4 스위치 소자를 턴온시키는 제1 스위치와, 상기 제1 스위치와 제4 스위치 소자의 게이트 사이에 접속되어 제4 스위치 소자에 입력되는 전압을 제어하는 제1 저항소자와, 상기 제4 스위치 소자의 게이트와 드레인 사이에 접속되어 상기 제1 저항소자와 더불어 공진회로를 형성하게 하는 캐패시터를 구비하는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시 예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 6 내지 도 9를 참조하여 본 발명의 바람직한 실시 예에 대하여 설명하기로 한다.
도 6은 본 발명의 실시 예에 의한 어드레스기간의 구동파형을 나타내는 파형도이다.
도 6을 참조하면, 본 발명의 실시 예에 의한 어드레스기간에는 주사/서스테인전극라인(Y)에 순차적으로 주사펄스(Vs)가 공급되고, 어드레스전극라인(X)에는 주사/서스테인전극라인(Y)에 공급되는 주사펄스(Vs)와 동기되어 보조펄스(ADP) 및 메인 데이터펄스(MDP)가 공급된다. 주사/서스테인전극라인(Y)에 공급되는 주사펄스(Vs)는 소정 시간씩 중첩되게 인가된다. 이때 제1 주사/서스테인전극라인(Y1)을 제외한 나머지 주사/서스테인전극라인(Y2 내지 Ym)에는 슬로프 파형을 가지는 주사펄스(Vs)가 상기 소정 시간만큼 인가된다.
어드레스전극라인(X)에 논리값이 '1'인 데이터펄스(DP)가 공급될 경우 작은 폭(Td)을 가지는 메인 데이터펄스(MDP)가 인가되고, 데이터의 논리값이 '0'인 경우 메인 데이터펄스(MDP)가 인가되지 않는다. 또한, 메인 데이터펄스(MDP)가 인가될때 메인 데이터펄스(MDP)의 앞 및 뒤에는 메인 데이터펄스(MDP)의 폭(Td)보다 작은 폭(Tad)을 가지는 보조 데이터펄스(ADP)가 인가된다. 그리고, 주사/서스테인전극라인(Y)에 순차적으로 인가되는 주사펄스(Vs)는 메인 데이터펄스(MDP) 및 보조 데이터펄스(ADP)의 폭(Tad+Td=Ts)을 가지는 메인 주사펄스(MSP)와 보조 데이터펄스(ADP) 폭(Tad=Tas)을 가지는 슬로프 보조 주사펄스(SASP)로 나뉘어진다. 메인 주사펄스(MSP)는 주사/서스테인전극라인(Y)에 순차적으로 인가되고 슬로프 보조 주사펄스(SASP)는 메인 주사펄스(MSP)에 선행되어 인가된다. 주사/서스테인전극라인들(Y)에 순차적으로 공급되는 주사펄스는 슬로프 보조 주사펄스(SASP)의 폭(Tas) 만큼씩 중첩되게 인가된다. 이때 슬로프 보조 주사펄스(SASP)는 슬로프(Slope) 형태의 파형을 가지면서 변화된다.
이러한 본 발명의 구동파형의 인가과정을 상세히 설명하면, 제1 주사/서스테인전극라인(Y1)은 종래의 기술과 같이 어드레스전극(X)에 제1 메인 데이터펄스(MDP1)+ 제1 보조 데어터펄스(ADP1)가 입력되면 이에 동기되게 주사펄스(Vsc)가 인가된다. 이로써 정상적인 어드레스 방전이 일어나게 된다.
다음으로 제2 메인 데이터펄스(MDP2)가 있는 경우, 제2 주사/서스테인전극라인(Y2)에 대한 데이터펄스(DP)는 제1 슬로프 보조 데이터펄스(SADP1)+제2 메인 데이터펄스(MDP2)+제2 슬로프 보조 데이터펄스(SADP2)가 된다. 이 경우 제1 슬로프 보조 데이터펄스(SADP1)에 의한 영향은 오히려 받을 수 없는 상황이 된다. 물론 제1 슬로프 보조 데이터펄스(SADP1)이 있는 동안 제2 주사/서스테인전극라인(Y2)의 주사펄스(SP)가 구형파로 시작하는 경우보다는 어드레스 방전 조건이 미약해지게된다. 그러나 이러한 문제는 두가지 이유에서 해소될 수 있다.
첫째, 제2 주사/서스테인전극라인(Y2)에 인가되는 주사펄스(Vsc)와 제1 슬로프 보조 데이터펄스(SADP1)가 인가되는 구동시간에는 강한 어드레스 방전이 일어나지는 않으나 서서히 하강하는 펄스에 의해 약한 방전은 이루어지고 이로 인해 어드레스 방전의 효과는 나타나게 된다. 예를 들어, 램프 펄스로 리셋 방전을 일으키는 종래 기술에서 램프 펄스에 의해 강한 방전을 방지하는 효과가 있지만, 리셋방전이나 효과에 영향을 주는 것은 아니기 때문이다.
둘째, 서서히 하강하는 주사펄스(SP)에 의해 중첩되는 시간을 더욱 늘일 수 있다는 것이다. 즉, 중첩에 의한 효과는 단순 오버랩하는 방법의 대체 효과가 아니라 중첩 시간을 늘임으로써 어드레스 시간을 더욱 줄일 수 있게 된다.
도 6에서 슬로프 파형 부분이 주사펄스(Vs)가 중첩되는 부분(ADP1,ADP2,...)과 일치하게 표시가 되어 있지만 실제 이렇게 맞아야만 하는 것은 아니다. 즉, 서서히 변화하는 파형의 모양이나 기울기, 중첩되는 시간은 실제 디스플레이를 통해 조정될 수 있다.
도 7은 본 발명에 따른 PDP의 슬로프 파형을 가지는 주사펄스가 인가되기 위한 구동회로를 나타낸 도면이고, 도 8은 도 7에 도시된 구동회로를 구동하기 위한 스위치소자의 구동파형도이다.
도 7을 참조하면, PDP의 구동회로는 제1 스위치 소자(Q1), 스캔 구동부(40) 및 슬로프 파형 발생부(42)를 구비한다.
제1 스위치 소자(Q1)는 스캔전압원(Vsc)과 스캔 구동부(40) 사이에 접속되어스캔전압원(Vsc)이 어드레스 기간동안 공급되게 한다.
스캔 구동부(40)는 제1 스위치 소자(Q1)와 슬로프 파형 발생부(42) 사이에 직렬 접속되어 순차적으로 주사펄스(SP)를 출력한다. 또한 스캔 구동부(40)는 스위칭 작용을 위해 직렬 접속의 제2 스위치 소자(Q2) 및 제3 스위치 소자(Q3)를 구비한다. 제2 스위치 소자(Q2)가 턴온시에는 주사펄스(SP)가 하이 전압을 갖고, 제3 스위치 소자(Q3)가 턴온시에는 로우 전압을 갖는다.
슬로프 파형 발생부(42)는 회로 내에 신호를 입력시키는 제1 스위치(SW1)와, 제1 스위치(SW1)와 기저전압원(GND) 사이에 접속되어 스위칭 작용을 제4 스위치 소자(Q4)와, 제1 스위치(SW1)와 제4 스위치 소자(Q4)의 게이트 사이에 접속되어 제1 스위치(SW1)로부터 입력되는 입력 펄스 전압의 슬로프 기울기를 조정하는 저항소자(R1)와, 제4 스위치 소자(Q4)의 게이트와 드레인 사이에 접속되어 저항 소자(R1)와 더불어 RC 공진 회로를 형성하여 공진파형을 생성하게 하는 캐패시터(C)를 구비한다.
도 8을 참조하면, 제1 스위치 소자(Q1)는 주사/서스테인전극라인(Y)에 스캔전압을 공급하는 기능이므로 어드레스 기간동안에는 항상 온 상태이다. 제2 스위치 소자(Q2) 및 제3 스위치 소자(Q3)는 스캔 구동부(40) 내부의 스위치로서 한 채널을 나타내고 있다. 주사펄스(SP)는 제3 스위치 소자(Q3)가 턴온될 때 출력 파형이 하강하면서 발생한다. 제4 스위치 소자(Q4)는 본 발명에 의한 슬로프 파형을 만드는 스위치이며 제3 스위치 소자(Q3)와 같은 스위칭 동작을 한다. 즉, 제3 스위치 소자(Q3)가 턴온 상태일 때는 출력단을 제4 스위치 소자(Q4)와 연결한다는 의미의 동작이다. 또한 실제 슬로프 파형은 제4 스위치 소자(Q4)와 주변 회로에 의해 발생되고 제3 스위치 소자(Q3)를 통해 출력된다.
도 9는 도 7에 도시된 구동회로에 스위칭 동작이나 구동회로의 동작을 안정화시키기 위한 수단을 부가한 구동회로도이다.
도 9에 있어서 도 7과 중복되는 부호의 소자는 동일한 동작을 하며 이에 대한 설명은 생략한다.
도 9를 참조하면, 슬로프 파형 발생부(44)는 회로 내에 신호를 입력시키는 제1 스위치(SW1)와, 제1 스위치(SW1)와 기저전압원(GND) 사이에 접속되어 스위칭 작용을 제4 스위치 소자(Q4)와, 제1 스위치(SW1)와 제4 스위치 소자(Q4)의 게이트 사이에 접속되어 제1 스위치(SW1)로부터 입력되는 입력 펄스 전압의 슬로프 기울기를 조정하는 제1 저항소자(R1)와, 제4 스위치 소자(Q4)의 게이트와 드레인 사이에 접속되어 제1 저항소자(R1)와 더불어 RC 공진 회로를 형성하여 공진파형을 생성하게 하는 캐패시터(C)를 구비한다.
또한 캐패시터(C)와 제4 스위치 소자(Q4)의 드레인 사이에 접속되어 캐패시터(C)와 더불어 RC 공진회로를 형성하는 직렬 접속의 제2 저항소자(R2) 및 제3 저항소자(R3)와, 제2 저항소자(R2)와 병렬접속의 제1 다이오드(D1)와, 제1 스위치(SW1)와 제4 스위치 소장(Q4)의 게이트 사이에 접속됨과 아울러 제1 저항소자(R1)와 병렬 접속되는 제4 저항소자(R4)와 제2 다이오드(D2)를 구비한다.
제4 저항소자(R4)와 제2 다이오드(D2)는 제1 스위치(SW1)가 로우 레벨로 떨어질 때 빠른 스위칭 동작을 하게 한다. 따라서, 제1 저항소자(R1)는 제4 저항소자(R4)보다 매우 큰 값을 가지도록 한다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 스캔 구동방법 및 그 장치에 의하면 중첩되게 인가되는 주사펄스의 초기단계를 서서히 하강하게 하는 슬로프 파형으로 형성함으로써 중첩되는 시간을 더 늘리고 이로써 어드레싱 시간을 더 줄일 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (10)

  1. 어드레스전극에 '1'의 비디오신호에 대응하는 제1 데이터펄스가 인가되는 단계와,
    상기 제1 데이터펄스가 인가됨과 동시에 상기 제1 데이터펄스의 폭과 상이한 '1'의 비디오신호에 대응하는 제2 데이터펄스가 상기 제1 데이터펄스의 앞과 뒤에 인가되는 단계와,
    상기 어드레스전극과 교차되는 방향으로 형성되는 주사/서스테인전극에는 상기 제1 데이터펄스 및 제2 데이터펄스와 동기되게 서서히 하강하는 슬로프 파형을 가지는 주사펄스가 공급되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동방법.
  2. 제 1 항에 있어서,
    상기 제 2 데이터펄스의 펄스 폭은 상기 제 1 데이터펄스의 펄스 폭 보다 좁게 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동방법.
  3. 제 1 항에 있어서,
    상기 주사/서스테인전극은 적어도 2개 이상의 블록으로 분할되고, 상기 제 2 데이터펄스와 동기되도록 상기 각각의 블록에 포함된 주사/서스테인전극에 순차적으로 상기 슬로프 파형의 주사펄스가 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동방법.
  4. 제 3 항에 있어서,
    상기 슬로프 파형의 주사펄스의 형태, 기울기 및 중첩되는 시간은 가변되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동방법.
  5. 스캔전압을 발생하기 위한 스캔전압원과,
    상기 스캔전압원에 접속되어 어드레스 기간동안 상기 스캔전압원을 구동시키기 위한 제1 스위치 소자와,
    상기 제1 스위치소자에 접속되어 주사/서스테인전극에 주사펄스를 공급하기 위한 스캔구동부와,
    상기 스캔구동부에 접속되어 상기 주사펄스에 하강하는 슬로프 파형을 가지도록 하는 슬로프 파형 발생부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동장치.
  6. 제 5 항에 있어서,
    상기 스캔구동부는 상기 주사/서스테인전극에 하이 전압의 주사펄스를 공급하게 하는 제2 스위치 소자와,
    상기 제2 스위치 소자에 접속되어 상기 주사/서스테인전극에 로우 전압의 주사펄스를 공급하게 하는 제3 스위치 소자를 구비하는 것을 특징으로 하는 플라즈마디스플레이 패널의 스캔 구동장치.
  7. 제 5 항에 있어서,
    상기 슬로프 파형 발생부는 슬로프형의 펄스를 공급하도록 스위칭하는 제4 스위치 소자와,
    상기 제4 스위치 소자의 게이트에 접속되어 제4 스위치 소자를 턴온시키는 제1 스위치와,
    상기 제1 스위치와 제4 스위치 소자의 게이트 사이에 접속되어 제4 스위치 소자에 입력되는 전압을 제어하는 제1 저항소자와,
    상기 제4 스위치 소자의 게이트와 드레인 사이에 접속되어 상기 제1 저항소자와 더불어 공진회로를 형성하게 하는 캐패시터를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동장치.
  8. 제 7 항에 있어서,
    상기 캐패시터와 제4 스위치 소자의 드레인 사이에 접속되어 상기 캐패시터와 공진회로를 형성하여 슬로프형 주사펄스의 시간을 제어하도록 하는 제2 저항소자 및 제3 저항소자와,
    상기 제2 저항소자에 병렬 접속되는 제1 다이오드를 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동장치.
  9. 제 7 항에 있어서,
    상기 제1 저항소자에 병렬로 접속되어 제1 스위치 신호가 로우 레벨로 떨어질 때 빠른 스위칭 동작을 하도록 하는 제4 저항소자와 제2 다이오드를 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동장치.
  10. 제 9 항에 있어서,
    상기 제4 저항소자는 제1 저항소자보다 매우 작은 저항값을 가지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 스캔 구동장치.
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