JP2001054136A - 時間軸誤差補正回路 - Google Patents
時間軸誤差補正回路Info
- Publication number
- JP2001054136A JP2001054136A JP11222229A JP22222999A JP2001054136A JP 2001054136 A JP2001054136 A JP 2001054136A JP 11222229 A JP11222229 A JP 11222229A JP 22222999 A JP22222999 A JP 22222999A JP 2001054136 A JP2001054136 A JP 2001054136A
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- memory
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- Pending
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- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】
【課題】 応答の早い時間軸誤差補正回路を得る。
【解決手段】 再生映像信号よりＦＭ輝度信号成分を分
離し、復調した再生輝度信号から同期信号を分離する同
期分離手段１１１と、書き込みクロック発生手段１１２
と、読み出しクロック発生手段１１３と、第１のメモリ
１０７ａならびに第２のメモリ１０７ｂにサンプリング
された信号を書き込む書き込み制御手段１１９と、前記
第１のメモリ１０７ａならびに第２のメモリ１０７ｂか
ら前記再生輝度信号を読み出す読み出し制御手段１２０
と、搬送波発生手段１１４と、前記第２のメモリ１０７
ｂの出力から第１，第２の色差信号を出力する復調手段
１０９と、位相誤差を補正する位相誤差補正回路１１０
とを備える。
離し、復調した再生輝度信号から同期信号を分離する同
期分離手段１１１と、書き込みクロック発生手段１１２
と、読み出しクロック発生手段１１３と、第１のメモリ
１０７ａならびに第２のメモリ１０７ｂにサンプリング
された信号を書き込む書き込み制御手段１１９と、前記
第１のメモリ１０７ａならびに第２のメモリ１０７ｂか
ら前記再生輝度信号を読み出す読み出し制御手段１２０
と、搬送波発生手段１１４と、前記第２のメモリ１０７
ｂの出力から第１，第２の色差信号を出力する復調手段
１０９と、位相誤差を補正する位相誤差補正回路１１０
とを備える。
Description
【０００１】
【発明の属する技術分野】この発明は、ビデオテープレ
コーダ（ＶＴＲ）の再生時における時間軸の誤差を補正
する時間軸誤差補正回路に関するものである。
コーダ（ＶＴＲ）の再生時における時間軸の誤差を補正
する時間軸誤差補正回路に関するものである。
【０００２】
【従来の技術】図２は、例えばテレビジョン学会誌、第
35巻第６号（1981）P495「磁気記録（VII ）−時間軸変
動とその補正法−」に記載された従来の時間軸誤差補正
回路である。同図の時間軸誤差補正回路１００ｂにおい
て、再生ヘッド１０１より得られた再生映像信号はヘッ
ドアンプ１０２により増幅され、ヘッドアンプ１０２の
出力はハイパスフィルタ（ＨＰＦ）１０３及びローパス
フィルタ（ＬＰＦ）１０４に与えられる。ＨＰＦ１０３
及びＬＰＦ１０４で入力信号は、それぞれＦＭ輝度信号
及び低域変換色信号に分離される。分離されたＦＭ輝度
信号はＦＭ復調器１０５で復調され、加算器１２３に入
力される。
35巻第６号（1981）P495「磁気記録（VII ）−時間軸変
動とその補正法−」に記載された従来の時間軸誤差補正
回路である。同図の時間軸誤差補正回路１００ｂにおい
て、再生ヘッド１０１より得られた再生映像信号はヘッ
ドアンプ１０２により増幅され、ヘッドアンプ１０２の
出力はハイパスフィルタ（ＨＰＦ）１０３及びローパス
フィルタ（ＬＰＦ）１０４に与えられる。ＨＰＦ１０３
及びＬＰＦ１０４で入力信号は、それぞれＦＭ輝度信号
及び低域変換色信号に分離される。分離されたＦＭ輝度
信号はＦＭ復調器１０５で復調され、加算器１２３に入
力される。
【０００３】低域変換色信号は、バーストゲート１２
２、位相制御回路（ＡＰＣ）１２１、周波数変換器（Ｈ
ＥＴ）１２５によって構成された自動位相制御ループ
（ＡＰＣループ）により元の副搬送波周波数に変換さ
れ、バンドパスフィルタ（ＢＰＦ）１２６を通した後、
加算器１２３にて復調した再生輝度信号と加算される。
バーストゲート１２２より得られたバースト信号は、同
期分離回路１１１より得られた同期信号をＰＬＬ回路12
４にて逓倍した信号と位相比較される。そのためバンド
パスフィルタ１２６より出力される搬送波色信号には、
再生輝度信号の時間軸変動と同量の変動分が付加され
る。
２、位相制御回路（ＡＰＣ）１２１、周波数変換器（Ｈ
ＥＴ）１２５によって構成された自動位相制御ループ
（ＡＰＣループ）により元の副搬送波周波数に変換さ
れ、バンドパスフィルタ（ＢＰＦ）１２６を通した後、
加算器１２３にて復調した再生輝度信号と加算される。
バーストゲート１２２より得られたバースト信号は、同
期分離回路１１１より得られた同期信号をＰＬＬ回路12
４にて逓倍した信号と位相比較される。そのためバンド
パスフィルタ１２６より出力される搬送波色信号には、
再生輝度信号の時間軸変動と同量の変動分が付加され
る。
【０００４】加算器１２３より出力された時間軸変動を
持った映像信号は、Ａ／Ｄ変換器1０６により変換され
た後、メモリ1 ０７に書き込まれる。この際、書き込み
クロックは、書き込みクロック発生回路1 １２にて同期
分離回路１１１より出力された同期信号に同期するよう
に発生させられているため、メモリ1 ０７に書き込まれ
たデータは時間軸変動を除去される。よってこのメモリ
１０７に記憶されたデータを、基準同期信号発生器1 １
５からの基準同期信号に位相同期するように読み出しク
ロック発生回路1 １３より出力された読み出しクロック
で読み出し、Ｄ／Ａ変換器1 ０８でアナログ信号にもど
すことによって時間軸補正された再生映像信号が出力さ
れる。
持った映像信号は、Ａ／Ｄ変換器1０６により変換され
た後、メモリ1 ０７に書き込まれる。この際、書き込み
クロックは、書き込みクロック発生回路1 １２にて同期
分離回路１１１より出力された同期信号に同期するよう
に発生させられているため、メモリ1 ０７に書き込まれ
たデータは時間軸変動を除去される。よってこのメモリ
１０７に記憶されたデータを、基準同期信号発生器1 １
５からの基準同期信号に位相同期するように読み出しク
ロック発生回路1 １３より出力された読み出しクロック
で読み出し、Ｄ／Ａ変換器1 ０８でアナログ信号にもど
すことによって時間軸補正された再生映像信号が出力さ
れる。
【０００５】
【発明が解決しようとする課題】上記のような従来の時
間軸誤差補正回路では、低域変換色信号は、バーストゲ
ート、位相制御回路（ＡＰＣ）、周波数変換器（ＨＥ
Ｔ）によって構成された自動位相制御ループ（ＡＰＣル
ープ）により元の副搬送波周波数に変換する構成を取っ
ているため、応答が遅いという問題点があった。
間軸誤差補正回路では、低域変換色信号は、バーストゲ
ート、位相制御回路（ＡＰＣ）、周波数変換器（ＨＥ
Ｔ）によって構成された自動位相制御ループ（ＡＰＣル
ープ）により元の副搬送波周波数に変換する構成を取っ
ているため、応答が遅いという問題点があった。
【０００６】この発明は、上述のような課題を解消する
ためになされたもので、応答を高速化した時間軸誤差補
正回路を得ることを目的としている。
ためになされたもので、応答を高速化した時間軸誤差補
正回路を得ることを目的としている。
【０００７】
【課題を解決するための手段】この発明に係る時間軸誤
差補正回路は、時間軸変動を含む再生映像信号よりＦＭ
輝度信号成分を分離し、復調した再生輝度信号から同期
信号を分離する同期分離手段と、前記同期信号に位相同
期した書き込みクロックを発生させる書き込みクロック
発生手段と、前記書き込みクロックによって前記再生輝
度信号をサンプリングした信号を前記同期信号に同期し
て第１のメモリに書き込む手段と、時間軸変動を伴わず
一定の基準クロックを発生させる読み出しクロック発生
手段と、前記読み出しクロック発生手段からの読み出し
クロックによって、読み出しクロックを分周した基準同
期信号のリセットタイミングで前記第１のメモリから前
記再生輝度信号を読み出す手段と、前記再生映像信号よ
り低域変換色信号を分離し、前記書き込みクロックによ
って前記低域変換色信号をサンプリングした信号を前記
同期信号に同期して第２のメモリに書き込む手段と、前
記読み出しクロック発生手段からの読み出しクロックに
よって、読み出しクロックを分周した基準同期信号のリ
セットタイミングで前記第２のメモリから前記低域変換
色信号を読み出す手段と、前記同期信号を分離する手段
より搬送波信号を発生する搬送波発生手段と、前記読み
出しクロックに従って前記第２のメモリ出力から第１，
第２の色差信号を出力する復調手段と、前記第１，第２
の色差信号より位相誤差を補正する位相誤差補正回路と
を備えたものである。
差補正回路は、時間軸変動を含む再生映像信号よりＦＭ
輝度信号成分を分離し、復調した再生輝度信号から同期
信号を分離する同期分離手段と、前記同期信号に位相同
期した書き込みクロックを発生させる書き込みクロック
発生手段と、前記書き込みクロックによって前記再生輝
度信号をサンプリングした信号を前記同期信号に同期し
て第１のメモリに書き込む手段と、時間軸変動を伴わず
一定の基準クロックを発生させる読み出しクロック発生
手段と、前記読み出しクロック発生手段からの読み出し
クロックによって、読み出しクロックを分周した基準同
期信号のリセットタイミングで前記第１のメモリから前
記再生輝度信号を読み出す手段と、前記再生映像信号よ
り低域変換色信号を分離し、前記書き込みクロックによ
って前記低域変換色信号をサンプリングした信号を前記
同期信号に同期して第２のメモリに書き込む手段と、前
記読み出しクロック発生手段からの読み出しクロックに
よって、読み出しクロックを分周した基準同期信号のリ
セットタイミングで前記第２のメモリから前記低域変換
色信号を読み出す手段と、前記同期信号を分離する手段
より搬送波信号を発生する搬送波発生手段と、前記読み
出しクロックに従って前記第２のメモリ出力から第１，
第２の色差信号を出力する復調手段と、前記第１，第２
の色差信号より位相誤差を補正する位相誤差補正回路と
を備えたものである。
【０００８】この発明によれば、色信号系の処理をフィ
ードフォワード方式で行うので応答が高速化する。
ードフォワード方式で行うので応答が高速化する。
【０００９】
【発明の実施の形態】以下、この発明をその実施の形態
を示す図面に基づいて具体的に説明する。実施の形態
１．図１はこの発明の実施の形態１である時間軸誤差補
正装置１００を示すものである。同図において、１０１
は再生ヘッド、１０２はヘッドアンプ、１０３はハイパ
スフィルタ（ＨＰＦ）、１０４はローパスフィルタ（Ｌ
ＰＦ）、１０５はＦＭ復調器、１０６ａ，１０６ｂはＡ
／Ｄ変換器、１０７ａ，１０７ｂはメモリ、１０８ａ，
１０８ｂ，１０８ｃはＤ／Ａ変換器、１０９は色復調
器、１１０は位相誤差補正手段、１１１は同期分離回
路、１１２は書き込みクロック発生回路、１１３は読み
出しクロック発生回路、１１４は搬送波発生手段、１１
５は基準同期信号発生回路、１１６はドラムモータ、１
１７はドラムサーボ、１１８は分周器、１１９は書き込
み制御手段、１２０は読み出し制御手段である。
を示す図面に基づいて具体的に説明する。実施の形態
１．図１はこの発明の実施の形態１である時間軸誤差補
正装置１００を示すものである。同図において、１０１
は再生ヘッド、１０２はヘッドアンプ、１０３はハイパ
スフィルタ（ＨＰＦ）、１０４はローパスフィルタ（Ｌ
ＰＦ）、１０５はＦＭ復調器、１０６ａ，１０６ｂはＡ
／Ｄ変換器、１０７ａ，１０７ｂはメモリ、１０８ａ，
１０８ｂ，１０８ｃはＤ／Ａ変換器、１０９は色復調
器、１１０は位相誤差補正手段、１１１は同期分離回
路、１１２は書き込みクロック発生回路、１１３は読み
出しクロック発生回路、１１４は搬送波発生手段、１１
５は基準同期信号発生回路、１１６はドラムモータ、１
１７はドラムサーボ、１１８は分周器、１１９は書き込
み制御手段、１２０は読み出し制御手段である。
【００１０】図１において、再生ヘッド１０１より得ら
れた再生信号はヘッドアンプ１０２より増幅された後、
ハイパスフィルタ１０３及びローパスフィルタ１０４に
より、それぞれＦＭ輝度信号、低域変換色信号に分離さ
れる。ＦＭ輝度信号は、ＦＭ復調器１０５によって復調
された後、Ａ／Ｄ変換器１０６ａに入力され、低域変換
色信号は、Ａ／Ｄ変換器１０６ｂに入力される。Ａ／Ｄ
変換器１０６ａ、１０６ｂによってディジタル信号に変
換された輝度信号および色信号は、書き込みクロック発
生回路１１２のクロックに同期して書き込み制御手段１
１９によりメモリ１０７ａ，１０７ｂに書き込まれる。
書き込みクロック発生回路１１２のクロックは、同期信
号分離回路１１１より分離した同期信号に位相同期する
ように得られる。
れた再生信号はヘッドアンプ１０２より増幅された後、
ハイパスフィルタ１０３及びローパスフィルタ１０４に
より、それぞれＦＭ輝度信号、低域変換色信号に分離さ
れる。ＦＭ輝度信号は、ＦＭ復調器１０５によって復調
された後、Ａ／Ｄ変換器１０６ａに入力され、低域変換
色信号は、Ａ／Ｄ変換器１０６ｂに入力される。Ａ／Ｄ
変換器１０６ａ、１０６ｂによってディジタル信号に変
換された輝度信号および色信号は、書き込みクロック発
生回路１１２のクロックに同期して書き込み制御手段１
１９によりメモリ１０７ａ，１０７ｂに書き込まれる。
書き込みクロック発生回路１１２のクロックは、同期信
号分離回路１１１より分離した同期信号に位相同期する
ように得られる。
【００１１】メモリ１０７ａ，１０７ｂに書き込まれた
輝度信号，色信号は、時間軸変動を伴わない基準クロッ
クである読み出しクロック発生回路１１３のクロックに
より、そのクロックの分周である基準同期信号発生回路
１１５のタイミングで読み出す。このため、読み出しク
ロックならびに基準同期信号を受けた読み出し制御手段
１２０によりメモリ１０７ａ，１０７ｂから読み出すこ
とで、時間軸変動成分の除去された輝度信号及び色信号
を得ることができる。時間軸変動成分の除去された輝度
信号はＤ／Ａ変換器１０８ａでアナログ信号Ｙに変換さ
れる。また、時間軸変動成分の除去された色信号は、色
復調回路１０９で搬送波発生手段１１４からの位相情報
に従って２つの色差信号に復調され、位相誤差補正手段
１１０で誤差を補正した後、Ｄ／Ａ変換器１０８ｂ，１
０８ｃでアナログ信号Ｃｂ，Ｃｒに変換される。
輝度信号，色信号は、時間軸変動を伴わない基準クロッ
クである読み出しクロック発生回路１１３のクロックに
より、そのクロックの分周である基準同期信号発生回路
１１５のタイミングで読み出す。このため、読み出しク
ロックならびに基準同期信号を受けた読み出し制御手段
１２０によりメモリ１０７ａ，１０７ｂから読み出すこ
とで、時間軸変動成分の除去された輝度信号及び色信号
を得ることができる。時間軸変動成分の除去された輝度
信号はＤ／Ａ変換器１０８ａでアナログ信号Ｙに変換さ
れる。また、時間軸変動成分の除去された色信号は、色
復調回路１０９で搬送波発生手段１１４からの位相情報
に従って２つの色差信号に復調され、位相誤差補正手段
１１０で誤差を補正した後、Ｄ／Ａ変換器１０８ｂ，１
０８ｃでアナログ信号Ｃｂ，Ｃｒに変換される。
【００１２】また、ドラムモータ１１６の時間軸変動の
平均速度と、読み出しクロックを同期させることにより
メモリ１０７ａ，１０７ｂをオーバーフローさせること
なく時間軸補正をするため、ドラムモータ１１６を制御
するドラムサーボ１１７の基準信号は、基準同期信号発
生回路１１５より出力された基準クロックを分周器１１
８で分周した信号を入力する。
平均速度と、読み出しクロックを同期させることにより
メモリ１０７ａ，１０７ｂをオーバーフローさせること
なく時間軸補正をするため、ドラムモータ１１６を制御
するドラムサーボ１１７の基準信号は、基準同期信号発
生回路１１５より出力された基準クロックを分周器１１
８で分周した信号を入力する。
【００１３】
【発明の効果】この発明は、以上説明したように構成さ
れているので、以下に示すような効果を奏する。
れているので、以下に示すような効果を奏する。
【００１４】時間軸誤差を補正されたメモリ読み出し後
の色信号を復調するようなフィードフォワード型の構成
をとるため、応答が早い。
の色信号を復調するようなフィードフォワード型の構成
をとるため、応答が早い。
【００１５】色復調を行うための搬送波信号を基準クロ
ックから作るため、同期分離回路から作っている場合に
比べ、演算精度が高い。
ックから作るため、同期分離回路から作っている場合に
比べ、演算精度が高い。
【図１】 この発明の実施の形態１に係る時間軸誤差補
正回路を示すブロック図である。
正回路を示すブロック図である。
【図２】 従来の時間軸誤差補正回路を示す図である。
１００，１００ｂ 時間軸誤差補正回路、１０１ 再生
ヘッド、１０２ ヘッドアンプ、１０３ ハイパスフィ
ルタ、１０４ ローパスフィルタ、１０５ ＦＭ復調
器、１０６ａ，１０６ｂ Ａ／Ｄ変換器、１０７ａ，１
０７ｂ メモリ、１０８ａ，１０８ｂ，１０８ｃ Ｄ／
Ａ変換器、１０９ 色復調器、１１０ 位相誤差補正手
段、１１１ 同期分離回路、１１２ 書き込みクロック
発生回路、１１３ 読み出しクロック発生回路、１１４
搬送波発生手段、１１５ 基準同期信号発生回路、１
１６ ドラムモータ、１１７ ドラムサーボ、１１８
分周器、１１９ 書き込み制御手段、１２０ 読み出し
制御手段、１２１ 位相制御回路 、１２２ バースト
ゲート、１２３ 加算器、１２４ ＰＬＬ回路、１２５
周波数変換器、１２６ バンドパスフィルタ。
ヘッド、１０２ ヘッドアンプ、１０３ ハイパスフィ
ルタ、１０４ ローパスフィルタ、１０５ ＦＭ復調
器、１０６ａ，１０６ｂ Ａ／Ｄ変換器、１０７ａ，１
０７ｂ メモリ、１０８ａ，１０８ｂ，１０８ｃ Ｄ／
Ａ変換器、１０９ 色復調器、１１０ 位相誤差補正手
段、１１１ 同期分離回路、１１２ 書き込みクロック
発生回路、１１３ 読み出しクロック発生回路、１１４
搬送波発生手段、１１５ 基準同期信号発生回路、１
１６ ドラムモータ、１１７ ドラムサーボ、１１８
分周器、１１９ 書き込み制御手段、１２０ 読み出し
制御手段、１２１ 位相制御回路 、１２２ バースト
ゲート、１２３ 加算器、１２４ ＰＬＬ回路、１２５
周波数変換器、１２６ バンドパスフィルタ。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 栗崎 一浩 東京都千代田区丸の内二丁目２番３号 三 菱電機株式会社内 (72)発明者 濱田 慎司 東京都千代田区丸の内二丁目２番３号 三 菱電機株式会社内 Ｆターム(参考） 5C053 FA21 HA33 HC02 KA10 KA12 KA13 KA18 KA25 5C055 AA01 BA03 EA01 GA16 HA03 5D044 AB07 BC01 CC03 FG12
Claims (1)
- 【請求項１】 時間軸変動を含む再生映像信号よりＦＭ
輝度信号成分を分離し、復調した再生輝度信号から同期
信号を分離する同期分離手段と、前記同期信号に位相同
期した書き込みクロックを発生させる書き込みクロック
発生手段と、前記書き込みクロックによって前記再生輝
度信号をサンプリングした信号を前記同期信号に同期し
て第１のメモリに書き込む手段と、時間軸変動を伴わず
一定の基準クロックを発生させる読み出しクロック発生
手段と、前記読み出しクロック発生手段からの読み出し
クロックによって、読み出しクロックを分周した基準同
期信号のリセットタイミングで前記第１のメモリから前
記再生輝度信号を読み出す手段と、前記再生映像信号よ
り低域変換色信号を分離し、前記書き込みクロックによ
って前記低域変換色信号をサンプリングした信号を前記
同期信号に同期して第２のメモリに書き込む手段と、前
記読み出しクロック発生手段からの読み出しクロックに
よって、読み出しクロックを分周した基準同期信号のリ
セットタイミングで前記第２のメモリから前記低域変換
色信号を読み出す手段と、前記同期信号を分離する手段
より搬送波信号を発生する搬送波発生手段と、前記読み
出しクロックに従って前記第２のメモリ出力から第１，
第２の色差信号を出力する復調手段と、前記第１，第２
の色差信号より位相誤差を補正する位相誤差補正回路と
を備えた時間軸誤差補正回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11222229A JP2001054136A (ja) | 1999-08-05 | 1999-08-05 | 時間軸誤差補正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11222229A JP2001054136A (ja) | 1999-08-05 | 1999-08-05 | 時間軸誤差補正回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2001054136A true JP2001054136A (ja) | 2001-02-23 |
Family
ID=16779151
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11222229A Pending JP2001054136A (ja) | 1999-08-05 | 1999-08-05 | 時間軸誤差補正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2001054136A (ja) |
-
1999
- 1999-08-05 JP JP11222229A patent/JP2001054136A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| RD01 | Notification of change of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7421 Effective date: 20040630 |