JP2000232465A - インタフェース制御装置及びインタフェース制御方法 - Google Patents
インタフェース制御装置及びインタフェース制御方法Info
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- JP2000232465A JP2000232465A JP11030075A JP3007599A JP2000232465A JP 2000232465 A JP2000232465 A JP 2000232465A JP 11030075 A JP11030075 A JP 11030075A JP 3007599 A JP3007599 A JP 3007599A JP 2000232465 A JP2000232465 A JP 2000232465A
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- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
Abstract
(57)【要約】
【課題】その時々の通信条件に応じて最適な通信性能を
設定し、ユーザが意識することなく最良の条件でネット
ワークに接続することができるインタフェース制御装置
を提供する。 【解決手段】クロックジェネレータ１４がクロック信号
ＣＬＫを発生する。クロック制御回路１３がクロック信
号ＣＬＫの周波数を変更することによりインタフェース
制御装置１のデータ転送速度を変更する。内部回路１２
は入力データが自身宛のデータか否かを判定する。他の
装置宛のデータが入力された場合、内部回路１２及びイ
ンタフェース回路１１によりクロック信号ＣＬＫに同期
をとってデータが送信される。この送信時よりも遅い転
送速度でＤＶＣ２とＰＣ３及びＶＴＲ４との間でデータ
転送が実施される。
設定し、ユーザが意識することなく最良の条件でネット
ワークに接続することができるインタフェース制御装置
を提供する。 【解決手段】クロックジェネレータ１４がクロック信号
ＣＬＫを発生する。クロック制御回路１３がクロック信
号ＣＬＫの周波数を変更することによりインタフェース
制御装置１のデータ転送速度を変更する。内部回路１２
は入力データが自身宛のデータか否かを判定する。他の
装置宛のデータが入力された場合、内部回路１２及びイ
ンタフェース回路１１によりクロック信号ＣＬＫに同期
をとってデータが送信される。この送信時よりも遅い転
送速度でＤＶＣ２とＰＣ３及びＶＴＲ４との間でデータ
転送が実施される。
Description
【０００１】
【発明の属する技術分野】本発明は、ＩＥＥＥ１３９４
規格に準拠したインタフェース制御装置及びインタフェ
ース制御方法に関するものである。
規格に準拠したインタフェース制御装置及びインタフェ
ース制御方法に関するものである。
【０００２】ＩＥＥＥ１３９４バスにより複数の装置を
接続したネットワークシステムにおいて、データ通信を
行う装置間に他の装置が介在するとき、その中間に位置
する装置は、データ転送を仲介する機能、いわゆるリピ
ート機能を備えている。このリピート機能を備える携帯
機器等では、消費電力の低減が要求されている。
接続したネットワークシステムにおいて、データ通信を
行う装置間に他の装置が介在するとき、その中間に位置
する装置は、データ転送を仲介する機能、いわゆるリピ
ート機能を備えている。このリピート機能を備える携帯
機器等では、消費電力の低減が要求されている。
【０００３】
【従来技術】図４は、パーソナルコンピュータ（ＰＣ）
３０、デジタルビデオカメラ（ＤＶＣ）３１、ビデオテ
ープレコーダ（ＶＴＲ）３２をＩＥＥＥ１３９４バス３
３で接続したシステム構成図である。各機器３０〜３２
は、データ転送を仲介するリピート機能を備える。
３０、デジタルビデオカメラ（ＤＶＣ）３１、ビデオテ
ープレコーダ（ＶＴＲ）３２をＩＥＥＥ１３９４バス３
３で接続したシステム構成図である。各機器３０〜３２
は、データ転送を仲介するリピート機能を備える。
【０００４】図５は、ＤＶＣ３１に搭載されるインタフ
ェース制御装置３５のブロック回路図である。インタフ
ェース制御装置３５は、入出力ポート３６，３７、イン
タフェース回路３８，３９、バッファ４０、クロックジ
ェネレータ４１を含む。
ェース制御装置３５のブロック回路図である。インタフ
ェース制御装置３５は、入出力ポート３６，３７、イン
タフェース回路３８，３９、バッファ４０、クロックジ
ェネレータ４１を含む。
【０００５】ＤＶＣ３１が自身宛のデータを受信する場
合、入力データを入出力ポート３６，３７からインタフ
ェース回路３８，３９を介してバッファ４０に格納し
て、該データを画像処理等を行う内部処理回路（図示せ
ず）に取り込む。また、画像データ等を送信する場合、
ＤＶＣ３１は、内部処理回路からの画像データをバッフ
ァ４０に格納して、該データをインタフェース回路３
８，３９を介して入出力ポートから出力する。このよう
にして、図４に示すＰＣ３０−ＤＶＣ３１間またはＤＶ
Ｃ３１−ＶＴＲ３２間のデータ転送を行う。
合、入力データを入出力ポート３６，３７からインタフ
ェース回路３８，３９を介してバッファ４０に格納し
て、該データを画像処理等を行う内部処理回路（図示せ
ず）に取り込む。また、画像データ等を送信する場合、
ＤＶＣ３１は、内部処理回路からの画像データをバッフ
ァ４０に格納して、該データをインタフェース回路３
８，３９を介して入出力ポートから出力する。このよう
にして、図４に示すＰＣ３０−ＤＶＣ３１間またはＤＶ
Ｃ３１−ＶＴＲ３２間のデータ転送を行う。
【０００６】また、ＤＶＣ３１が自身宛でないデータを
受信する場合、即ち、ＰＣ３０−ＶＴＲ３２間でデータ
転送が行われる場合では、ＤＶＣ３１のインタフェース
制御装置３５はそのデータ転送の仲介を行う。つまり、
インタフェース制御装置３５はリピート転送を実施す
る。
受信する場合、即ち、ＰＣ３０−ＶＴＲ３２間でデータ
転送が行われる場合では、ＤＶＣ３１のインタフェース
制御装置３５はそのデータ転送の仲介を行う。つまり、
インタフェース制御装置３５はリピート転送を実施す
る。
【０００７】詳しくは、ＤＶＣ３１は、ＰＣ３０−ＶＴ
Ｒ３２間で送受信されるデータを入出力ポート３６，３
７、インタフェース回路３８，３９を介して一旦バッフ
ァ４０に取り込む。そして、クロックジェネレータ４１
のクロック信号により再度クロッキングすることで、Ｐ
Ｃ３０−ＶＴＲ３２間のデータの受け渡しが行われる。
なお、図５における一点鎖線は、ＶＴＲ３２からＰＣ３
０へのデータの流れを示し、二点鎖線は、ＰＣ３０から
ＶＴＲ３２へのデータの流れを示している。
Ｒ３２間で送受信されるデータを入出力ポート３６，３
７、インタフェース回路３８，３９を介して一旦バッフ
ァ４０に取り込む。そして、クロックジェネレータ４１
のクロック信号により再度クロッキングすることで、Ｐ
Ｃ３０−ＶＴＲ３２間のデータの受け渡しが行われる。
なお、図５における一点鎖線は、ＶＴＲ３２からＰＣ３
０へのデータの流れを示し、二点鎖線は、ＰＣ３０から
ＶＴＲ３２へのデータの流れを示している。
【０００８】
【発明が解決しようとする課題】ところで、ＩＥＥＥ１
３９４規格では、１００Ｍｂｉｔ／ｓ，２００Ｍｂｉｔ
／ｓ，４００Ｍｂｉｔ／ｓの転送速度が規定されてい
る。従って、設計時において、機器のデータ転送要求、
消費電力の要求に基づいて適した転送速度が採用され
る。つまり、携帯機器等のバッテリで駆動されるもので
は、消費電力を低減すべく低速の転送速度に設定されて
いる。従って、上記のような携帯機器、即ちバッテリで
駆動されることが多いＤＶＣ３１の通信性能は、通常、
１００Ｍｂｉｔ／ｓの転送速度が設定される。一方、家
庭に備えられる、即ち家庭用の外部電源で駆動されるＰ
Ｃ３０及びＶＴＲ３１の通信性能は、４００Ｍｂｉｔ／
ｓの転送速度が設定される。
３９４規格では、１００Ｍｂｉｔ／ｓ，２００Ｍｂｉｔ
／ｓ，４００Ｍｂｉｔ／ｓの転送速度が規定されてい
る。従って、設計時において、機器のデータ転送要求、
消費電力の要求に基づいて適した転送速度が採用され
る。つまり、携帯機器等のバッテリで駆動されるもので
は、消費電力を低減すべく低速の転送速度に設定されて
いる。従って、上記のような携帯機器、即ちバッテリで
駆動されることが多いＤＶＣ３１の通信性能は、通常、
１００Ｍｂｉｔ／ｓの転送速度が設定される。一方、家
庭に備えられる、即ち家庭用の外部電源で駆動されるＰ
Ｃ３０及びＶＴＲ３１の通信性能は、４００Ｍｂｉｔ／
ｓの転送速度が設定される。
【０００９】ところが、リピート転送時に実施可能な転
送速度は、仲介するデバイスのクロックジェネレータの
クロック周波数によって決定される。つまり、図６のよ
うに低速の通信性能を持つＤＶＣ３１が高速の通信性能
を持つＰＣ３０及びＶＴＲ３２の間に接続されると、リ
ピート転送動作は、低速の１００Ｍｂｉｔ／ｓの転送速
度で行われることとなる。その結果、高速で通信できる
ＰＣ３０やＶＴＲ３２の性能を十分に活かすことができ
ない。また、携帯機器としてのＤＶＣ３１を高速に設計
すると、消費電力が増加するためバッテリ駆動時では、
電力の消耗が問題となってしまう。
送速度は、仲介するデバイスのクロックジェネレータの
クロック周波数によって決定される。つまり、図６のよ
うに低速の通信性能を持つＤＶＣ３１が高速の通信性能
を持つＰＣ３０及びＶＴＲ３２の間に接続されると、リ
ピート転送動作は、低速の１００Ｍｂｉｔ／ｓの転送速
度で行われることとなる。その結果、高速で通信できる
ＰＣ３０やＶＴＲ３２の性能を十分に活かすことができ
ない。また、携帯機器としてのＤＶＣ３１を高速に設計
すると、消費電力が増加するためバッテリ駆動時では、
電力の消耗が問題となってしまう。
【００１０】高速で通信できるＰＣ３０、ＶＴＲ３２間
を、図７のように「ＰＣ３０−ＶＴＲ３２−ＤＶＣ３
１」の関係で接続すれば、２つの装置３０，３２間で４
００Ｍｂｉｔ／ｓにて通信を行うことができる。しかし
ながら、このように接続形態を変更するためには、各機
器の通信速度を予め意識しなければならず、特に家庭で
使用される場合には、そのような接続を要求することは
困難となっている。
を、図７のように「ＰＣ３０−ＶＴＲ３２−ＤＶＣ３
１」の関係で接続すれば、２つの装置３０，３２間で４
００Ｍｂｉｔ／ｓにて通信を行うことができる。しかし
ながら、このように接続形態を変更するためには、各機
器の通信速度を予め意識しなければならず、特に家庭で
使用される場合には、そのような接続を要求することは
困難となっている。
【００１１】本発明は上記問題点を解決するためになさ
れたものであって、その目的は、その時々の通信条件に
応じて最適な通信性能を設定し、ユーザが意識すること
なく最良の条件でネットワークに接続することができる
インタフェース制御装置及び、インタフェース制御方法
を提供することにある。
れたものであって、その目的は、その時々の通信条件に
応じて最適な通信性能を設定し、ユーザが意識すること
なく最良の条件でネットワークに接続することができる
インタフェース制御装置及び、インタフェース制御方法
を提供することにある。
【００１２】
【課題を解決するための手段】請求項１に記載の発明に
よれば、その時々の通信条件に応じてクロック発生手段
が発生するクロック信号の周波数がクロック制御手段に
より変更される。具体的には、リピート転送処理を実施
する場合と、自身と他の装置との間で転送処理を実施す
る場合とで自身の通信性能の変更が可能となる。従っ
て、ネットワークに接続する各装置間のデータ転送が最
適な転送速度で実施される。
よれば、その時々の通信条件に応じてクロック発生手段
が発生するクロック信号の周波数がクロック制御手段に
より変更される。具体的には、リピート転送処理を実施
する場合と、自身と他の装置との間で転送処理を実施す
る場合とで自身の通信性能の変更が可能となる。従っ
て、ネットワークに接続する各装置間のデータ転送が最
適な転送速度で実施される。
【００１３】請求項２に記載の発明によれば、他の装置
の通信性能に応じて自身の通信性能を第１の転送速度に
設定してリピート転送が実施される。また、第１の転送
速度よりも遅い第２の転送速度で自機と他の装置との間
でデータ転送が行われる。従って、リピート転送時で
は、他の装置の要求が満たされることになる。また、自
機と他の装置との通信は、消費電力が考慮された通信速
度で実施される。
の通信性能に応じて自身の通信性能を第１の転送速度に
設定してリピート転送が実施される。また、第１の転送
速度よりも遅い第２の転送速度で自機と他の装置との間
でデータ転送が行われる。従って、リピート転送時で
は、他の装置の要求が満たされることになる。また、自
機と他の装置との通信は、消費電力が考慮された通信速
度で実施される。
【００１４】請求項３に記載の発明によれば、外部電源
による動作時では、リピート転送を行うときに自身の通
信性能が、他の装置の通信性能に応じて第１の転送速度
に変更され、自身が他の装置との間でデータ転送を行う
ときに自身の通信性能が、前記第１の転送速度よりも遅
い第２の転送速度に変更される。一方、内部電源による
動作時では、リピート転送を行うときに自身の通信性能
が、前記第２の転送速度に変更される。
による動作時では、リピート転送を行うときに自身の通
信性能が、他の装置の通信性能に応じて第１の転送速度
に変更され、自身が他の装置との間でデータ転送を行う
ときに自身の通信性能が、前記第１の転送速度よりも遅
い第２の転送速度に変更される。一方、内部電源による
動作時では、リピート転送を行うときに自身の通信性能
が、前記第２の転送速度に変更される。
【００１５】請求項４に記載の発明によれば、内部電源
による動作時では、リピート転送を行うときに自身の通
信性能が、他の装置の通信性能に応じて第１の転送速度
に変更され、自身が他の装置との間でデータ転送を行う
ときに通信性能が、前記第１の転送速度よりも遅い第２
の転送速度に変更される。一方、外部電源による動作時
では、自身の通信性能が、前記第１の転送速度に変更さ
れる。
による動作時では、リピート転送を行うときに自身の通
信性能が、他の装置の通信性能に応じて第１の転送速度
に変更され、自身が他の装置との間でデータ転送を行う
ときに通信性能が、前記第１の転送速度よりも遅い第２
の転送速度に変更される。一方、外部電源による動作時
では、自身の通信性能が、前記第１の転送速度に変更さ
れる。
【００１６】請求項５に記載の発明によれば、発振回路
により基本信号が発生され、該基本信号が分周回路によ
り分周される。この基本信号の分周比がクロック制御手
段により変更されることでクロック信号の周波数が変更
される。つまり、クロック信号に応じて通信速度が変更
される。
により基本信号が発生され、該基本信号が分周回路によ
り分周される。この基本信号の分周比がクロック制御手
段により変更されることでクロック信号の周波数が変更
される。つまり、クロック信号に応じて通信速度が変更
される。
【００１７】請求項６に記載の発明によれば、他の装置
と接続するための複数の入出力ポートが備えられ、リピ
ート転送時には、入力データが入力された入出力パート
とは別のポートからデータが送信される。
と接続するための複数の入出力ポートが備えられ、リピ
ート転送時には、入力データが入力された入出力パート
とは別のポートからデータが送信される。
【００１８】請求項７に記載の発明によれば、自身と他
の装置との間でデータ転送を開始するまでは、他の装置
の通信性能に応じた第１の通信速度が通知手段により他
の装置に対して通知される。また、自身と他の装置との
間でデータ転送を行うときは、前記第１の通信速度より
も遅い第２の通信速度が通知手段により他の装置に対し
て通知される。
の装置との間でデータ転送を開始するまでは、他の装置
の通信性能に応じた第１の通信速度が通知手段により他
の装置に対して通知される。また、自身と他の装置との
間でデータ転送を行うときは、前記第１の通信速度より
も遅い第２の通信速度が通知手段により他の装置に対し
て通知される。
【００１９】請求項８に記載の発明によれば、リピート
転送を行うためのデータが入力されるまでは、自身の通
信性能が前記第２の通信速度に設定される。請求項９に
記載の発明によれば、リピート転送すべくデータを送信
するときの通信速度よりも遅い通信速度で、内部処理回
路と他の装置との間でデータ転送が実施される。
転送を行うためのデータが入力されるまでは、自身の通
信性能が前記第２の通信速度に設定される。請求項９に
記載の発明によれば、リピート転送すべくデータを送信
するときの通信速度よりも遅い通信速度で、内部処理回
路と他の装置との間でデータ転送が実施される。
【００２０】請求項１０に記載の発明によれば、外部電
源による動作時には、他の装置の通信性能に応じた第１
の転送速度でデータ転送が行われ、内部電源による動作
時には、前記第１の通信速度よりも遅い第２の通信速度
でデータ転送が行われる。
源による動作時には、他の装置の通信性能に応じた第１
の転送速度でデータ転送が行われ、内部電源による動作
時には、前記第１の通信速度よりも遅い第２の通信速度
でデータ転送が行われる。
【００２１】
【発明の実施の形態】以下、本発明をデジタルビデオカ
メラ（ＤＶＣ）に搭載されるインタフェース制御装置に
具体化した一実施形態を図面に従って説明する。本デジ
タルビデオカメラ（ＤＶＣ）はネットワークに接続する
ための通信機能を備える。
メラ（ＤＶＣ）に搭載されるインタフェース制御装置に
具体化した一実施形態を図面に従って説明する。本デジ
タルビデオカメラ（ＤＶＣ）はネットワークに接続する
ための通信機能を備える。
【００２２】図１は、本実施形態のインタフェース制御
装置１のブロック回路図である。また、図２は、デジタ
ルビデオカメラ（ＤＶＣ）２、パーソナルコンピュータ
（ＰＣ）３、ビデオテープレコーダ（ＶＴＲ）４をＩＥ
ＥＥ１３９４バス５で接続したシステム構成図である。
ＤＶＣ２の入出力ポート６，７は、それぞれＩＥＥＥ１
３９４バス５でＰＣ３の入出力ポート８及びＶＴＲ４の
入出力ポート９に接続される。
装置１のブロック回路図である。また、図２は、デジタ
ルビデオカメラ（ＤＶＣ）２、パーソナルコンピュータ
（ＰＣ）３、ビデオテープレコーダ（ＶＴＲ）４をＩＥ
ＥＥ１３９４バス５で接続したシステム構成図である。
ＤＶＣ２の入出力ポート６，７は、それぞれＩＥＥＥ１
３９４バス５でＰＣ３の入出力ポート８及びＶＴＲ４の
入出力ポート９に接続される。
【００２３】図１に示すように、インタフェース制御装
置１は、入出力ポート６，７、インタフェース回路１
１、内部回路１２、クロック制御回路１３及びクロック
ジェネレータ１４を含む。インタフェース制御装置１
は、１チップ半導体集積回路装置（ＬＳＩ）内に形成さ
れる。
置１は、入出力ポート６，７、インタフェース回路１
１、内部回路１２、クロック制御回路１３及びクロック
ジェネレータ１４を含む。インタフェース制御装置１
は、１チップ半導体集積回路装置（ＬＳＩ）内に形成さ
れる。
【００２４】入出力ポート６，７はインタフェース回路
１１に接続され、該インタフェース回路１１は内部回路
１２に接続される。内部回路１２には、図示しないＡＣ
アダプタ等による外部電源またはＤＶＣ２の内蔵バッテ
リＢから電源が供給される。
１１に接続され、該インタフェース回路１１は内部回路
１２に接続される。内部回路１２には、図示しないＡＣ
アダプタ等による外部電源またはＤＶＣ２の内蔵バッテ
リＢから電源が供給される。
【００２５】内部回路１２はバッファ１５を含み、入出
力ポート６，７からインタフェース回路１１を介して入
力される転送データをバッファ１５に一旦格納する。そ
して、内部回路１２は、該データが自身宛のデータか否
かを判定して、自身宛のデータであれば、画像処理等の
制御を実施する内部処理回路にデータを出力する。一
方、自身宛のデータでなければ、リピート転送を実施す
べくバッファ１５に格納したデータをインタフェース回
路６，７を介して出力するように構成される。また、内
部回路１２は、内部処理回路からの画像データをバッフ
ァ１５に格納し、該格納データをインタフェース回路１
１に出力する。
力ポート６，７からインタフェース回路１１を介して入
力される転送データをバッファ１５に一旦格納する。そ
して、内部回路１２は、該データが自身宛のデータか否
かを判定して、自身宛のデータであれば、画像処理等の
制御を実施する内部処理回路にデータを出力する。一
方、自身宛のデータでなければ、リピート転送を実施す
べくバッファ１５に格納したデータをインタフェース回
路６，７を介して出力するように構成される。また、内
部回路１２は、内部処理回路からの画像データをバッフ
ァ１５に格納し、該格納データをインタフェース回路１
１に出力する。
【００２６】内部回路１２は、クロック制御回路１３に
接続される。そして、内部回路１２は、今、外部電源に
より駆動されているのか、或いはバッテリＢにより駆動
されているのかを判定させるための電源判定信号ＳＡを
クロック制御回路１３に出力する。さらに、内部回路１
２は、画像データの送信処理を実施する場合には自機か
らの送信を判定させるための自機判定信号ＳＢを、リピ
ート転送を実施する場合にはリピート転送を判定させる
ためのリピート判定信号ＳＣをクロック制御回路１３に
出力する。
接続される。そして、内部回路１２は、今、外部電源に
より駆動されているのか、或いはバッテリＢにより駆動
されているのかを判定させるための電源判定信号ＳＡを
クロック制御回路１３に出力する。さらに、内部回路１
２は、画像データの送信処理を実施する場合には自機か
らの送信を判定させるための自機判定信号ＳＢを、リピ
ート転送を実施する場合にはリピート転送を判定させる
ためのリピート判定信号ＳＣをクロック制御回路１３に
出力する。
【００２７】クロック制御回路１３は、電源判定回路１
６、自機判定回路１７、リピート判定回路１８を含む。
電源判定回路１６は、内部回路１２からの電源判定信号
ＳＡに基づいて、内部回路１２に外部電源が供給されて
いるのか否かを判定する。自機判定回路１７は、内部回
路１２からの自機判定信号ＳＢに基づいて、画像データ
の送信処理の実施を判定する。リピート判定回路１８
は、内部回路１２からのリピート判定信号ＳＣに基づい
て、リピート転送の実施を判定する。
６、自機判定回路１７、リピート判定回路１８を含む。
電源判定回路１６は、内部回路１２からの電源判定信号
ＳＡに基づいて、内部回路１２に外部電源が供給されて
いるのか否かを判定する。自機判定回路１７は、内部回
路１２からの自機判定信号ＳＢに基づいて、画像データ
の送信処理の実施を判定する。リピート判定回路１８
は、内部回路１２からのリピート判定信号ＳＣに基づい
て、リピート転送の実施を判定する。
【００２８】クロック制御回路１３は、クロックジェネ
レータ１４に接続され、前述した各回路１６，１７，１
８の判定結果に基づいて制御信号ＳＤを出力する。この
制御信号ＳＤにより、クロックジェネレータ１４から出
力されるクロック信号ＣＬＫの周波数が制御される。
レータ１４に接続され、前述した各回路１６，１７，１
８の判定結果に基づいて制御信号ＳＤを出力する。この
制御信号ＳＤにより、クロックジェネレータ１４から出
力されるクロック信号ＣＬＫの周波数が制御される。
【００２９】詳しくは、クロックジェネレータ１４は、
発振回路１９と分周回路２０と含む。発振回路１９によ
り基本信号が生成され、該基本信号を分周回路２０が分
周することでクロック信号ＣＬＫが生成される。分周回
路２０は、クロック制御回路１３から入力される制御信
号ＳＤに基づいて、その分周比を変更する。つまり、ク
ロック信号ＣＬＫの周波数が変更される。このようにク
ロックジェネレータ１４内で生成されたクロック信号Ｃ
ＬＫが内部回路１２及びインタフェース回路１１に供給
される。このクロック信号ＣＬＫに同期して内部回路１
２及びインタフェース回路１１はバッファ１５に格納さ
れた画像データの転送処理を実施する。
発振回路１９と分周回路２０と含む。発振回路１９によ
り基本信号が生成され、該基本信号を分周回路２０が分
周することでクロック信号ＣＬＫが生成される。分周回
路２０は、クロック制御回路１３から入力される制御信
号ＳＤに基づいて、その分周比を変更する。つまり、ク
ロック信号ＣＬＫの周波数が変更される。このようにク
ロックジェネレータ１４内で生成されたクロック信号Ｃ
ＬＫが内部回路１２及びインタフェース回路１１に供給
される。このクロック信号ＣＬＫに同期して内部回路１
２及びインタフェース回路１１はバッファ１５に格納さ
れた画像データの転送処理を実施する。
【００３０】具体的に本実施形態では、ＤＶＣ２がバッ
テリＢで駆動されているとき、リピート転送を実施する
場合、分周回路２０は、制御信号ＳＤに応答して第１の
分周比に設定を変更する。この第１の分周比は、４００
Ｍｂｉｔ／ｓの転送速度に対応している。従って、ＤＶ
Ｃ２は、その通信を４００Ｍｂｉｔ／ｓの転送速度にて
実施する。ＤＶＣ２がバッテリＢで駆動され、且つ自機
に対するデータ転送を行う場合、分周回路２０は制御信
号ＳＤに応答して第２の分周比に設定を変更する。この
第２の分周比は、１００Ｍｂｉｔ／ｓの転送速度に対応
している。従って、ＤＶＣ２は、その通信を１００Ｍｂ
ｉｔ／ｓの転送速度にて実施する。これらに対してＤＶ
Ｃ２が外部電源で駆動されている時、分周回路２０は制
御信号ＳＤに応答して第１の分周比に設定を変更する。
従って、ＤＣＶ２は、リピート転送、画像データの送信
処理を、４００Ｍｂｉｔ／ｓの転送速度にて実施する。
テリＢで駆動されているとき、リピート転送を実施する
場合、分周回路２０は、制御信号ＳＤに応答して第１の
分周比に設定を変更する。この第１の分周比は、４００
Ｍｂｉｔ／ｓの転送速度に対応している。従って、ＤＶ
Ｃ２は、その通信を４００Ｍｂｉｔ／ｓの転送速度にて
実施する。ＤＶＣ２がバッテリＢで駆動され、且つ自機
に対するデータ転送を行う場合、分周回路２０は制御信
号ＳＤに応答して第２の分周比に設定を変更する。この
第２の分周比は、１００Ｍｂｉｔ／ｓの転送速度に対応
している。従って、ＤＶＣ２は、その通信を１００Ｍｂ
ｉｔ／ｓの転送速度にて実施する。これらに対してＤＶ
Ｃ２が外部電源で駆動されている時、分周回路２０は制
御信号ＳＤに応答して第１の分周比に設定を変更する。
従って、ＤＣＶ２は、リピート転送、画像データの送信
処理を、４００Ｍｂｉｔ／ｓの転送速度にて実施する。
【００３１】また、例えば、ＤＶＣ２がＩＥＥＥ１３９
４バスに接続されたとき、その際のバスリセット時にお
いて、ＤＶＣ２，ＰＣ３，ＶＴＲ４間でネゴシエーショ
ンが実施される。詳しくは、ＤＶＣ２の内部回路１２
は、ＰＣ３及びＶＴＲ４から自身の通信性能を知らせる
ための情報を含む転送データを入出力ポート６，７、イ
ンタフェース回路１１を介して取り込む。該データによ
り内部回路１２は、ＰＣ３及びＶＴＲ４の通信性能を判
定する。つまり、図２に示すように、通信性能が共に４
００Ｍｂｉｔ／ｓであることを判定し、内部回路１２
は、自身の通信性能が４００Ｍｂｉｔ／ｓである旨の情
報を含む転送データを生成して、インタフェース回路１
１、入出力ポート６，７を介して出力する。
４バスに接続されたとき、その際のバスリセット時にお
いて、ＤＶＣ２，ＰＣ３，ＶＴＲ４間でネゴシエーショ
ンが実施される。詳しくは、ＤＶＣ２の内部回路１２
は、ＰＣ３及びＶＴＲ４から自身の通信性能を知らせる
ための情報を含む転送データを入出力ポート６，７、イ
ンタフェース回路１１を介して取り込む。該データによ
り内部回路１２は、ＰＣ３及びＶＴＲ４の通信性能を判
定する。つまり、図２に示すように、通信性能が共に４
００Ｍｂｉｔ／ｓであることを判定し、内部回路１２
は、自身の通信性能が４００Ｍｂｉｔ／ｓである旨の情
報を含む転送データを生成して、インタフェース回路１
１、入出力ポート６，７を介して出力する。
【００３２】これと同時に、内部回路１２は、初期設定
のための信号をクロック制御回路１３に出力する。クロ
ック制御回路１３は、該信号に基づいて分周回路２０の
分周比を第１の分周比に設定して、クロック信号ＣＬＫ
の周波数を、通信性能が４００Ｍｂｉｔ／ｓとなるよう
に設定する。このようにして、ＤＶＣ２はネットワーク
に接続されたＰＣ３，ＶＴＲ４の通信性能に応じて自身
の通信性能を設定して、各機器２，３，４間のデータ転
送のための準備が終了する。
のための信号をクロック制御回路１３に出力する。クロ
ック制御回路１３は、該信号に基づいて分周回路２０の
分周比を第１の分周比に設定して、クロック信号ＣＬＫ
の周波数を、通信性能が４００Ｍｂｉｔ／ｓとなるよう
に設定する。このようにして、ＤＶＣ２はネットワーク
に接続されたＰＣ３，ＶＴＲ４の通信性能に応じて自身
の通信性能を設定して、各機器２，３，４間のデータ転
送のための準備が終了する。
【００３３】本実施形態では、クロックジェネレータ１
４がクロック発生手段に相当し、インタフェース回路１
１及び内部回路１２がリピート転送手段に相当する。ま
た、内部回路１２が通知手段に相当し、クロック制御回
路１３がクロック制御手段に相当する。さらに、本実施
形態では、４００Ｍｂｉｔ／ｓが第１の通信速度に相当
し、１００Ｍｂｉｔ／ｓが第２の通信速度に相当する。
４がクロック発生手段に相当し、インタフェース回路１
１及び内部回路１２がリピート転送手段に相当する。ま
た、内部回路１２が通知手段に相当し、クロック制御回
路１３がクロック制御手段に相当する。さらに、本実施
形態では、４００Ｍｂｉｔ／ｓが第１の通信速度に相当
し、１００Ｍｂｉｔ／ｓが第２の通信速度に相当する。
【００３４】次に、上記のように構成されたインタフェ
ース制御装置１の作用を説明する。先ず、内蔵するバッ
テリＢによりＤＶＣ２が駆動されているときに、撮影し
た画像データをＤＶＣ２からＰＣ３に転送する場合を説
明する。
ース制御装置１の作用を説明する。先ず、内蔵するバッ
テリＢによりＤＶＣ２が駆動されているときに、撮影し
た画像データをＤＶＣ２からＰＣ３に転送する場合を説
明する。
【００３５】ＤＶＣ２がネットワークに接続されると、
バスリセットによりＤＶＣ２の通信性能は４００Ｍｂｉ
ｔ／ｓの転送速度に設定される。その後、ＰＣ３からＤ
ＶＣ２に対して画像データの送信要求コマンドを保持し
た転送データが発行されると、ＤＶＣ２は、該データを
入出力ポート６からインタフェース回路１１を介して内
部回路１２のバッファ１５に取り込む。内部回路１２は
バッファ１５のデータに基づいて自身宛の転送データで
あることを判断して、画像処理等を実施する内部処理回
路に信号を出力する。そして、同信号に応答して内部処
理回路から内部回路１２のバッファ１５に画像データが
格納される。
バスリセットによりＤＶＣ２の通信性能は４００Ｍｂｉ
ｔ／ｓの転送速度に設定される。その後、ＰＣ３からＤ
ＶＣ２に対して画像データの送信要求コマンドを保持し
た転送データが発行されると、ＤＶＣ２は、該データを
入出力ポート６からインタフェース回路１１を介して内
部回路１２のバッファ１５に取り込む。内部回路１２は
バッファ１５のデータに基づいて自身宛の転送データで
あることを判断して、画像処理等を実施する内部処理回
路に信号を出力する。そして、同信号に応答して内部処
理回路から内部回路１２のバッファ１５に画像データが
格納される。
【００３６】また、内部回路１２は、ＰＣ３に対して自
機からの通信を１００Ｍｂｉｔ／ｓの転送速度で実施す
る旨の転送データを、インタフェース回路１１を介して
入出力ポート６から出力する。
機からの通信を１００Ｍｂｉｔ／ｓの転送速度で実施す
る旨の転送データを、インタフェース回路１１を介して
入出力ポート６から出力する。
【００３７】そして、内部回路１２は、各判定信号Ｓ
Ａ，ＳＢ，ＳＣをクロック制御回路１３に出力する。す
ると、電源判定回路１６によりバッテリＢ駆動であるこ
とが判定され、自機判定回路１７により自機からの画像
データの転送処理が判定される。この判定結果に基づい
て、クロック制御回路１３は、分周回路２０の分周比を
第２の分周比に変更してクロック信号ＣＬＫの周波数を
変更する。
Ａ，ＳＢ，ＳＣをクロック制御回路１３に出力する。す
ると、電源判定回路１６によりバッテリＢ駆動であるこ
とが判定され、自機判定回路１７により自機からの画像
データの転送処理が判定される。この判定結果に基づい
て、クロック制御回路１３は、分周回路２０の分周比を
第２の分周比に変更してクロック信号ＣＬＫの周波数を
変更する。
【００３８】このように変更されたクロック信号ＣＬＫ
に同期して、内部回路１２のバッファ１５に格納された
画像データが、インタフェース回路１１を介して入出力
ポート６から出力される。つまり、１００Ｍｂｉｔ／ｓ
の転送速度で、画像データがＰＣ３へ送出される。
に同期して、内部回路１２のバッファ１５に格納された
画像データが、インタフェース回路１１を介して入出力
ポート６から出力される。つまり、１００Ｍｂｉｔ／ｓ
の転送速度で、画像データがＰＣ３へ送出される。
【００３９】一方、ＰＣ３は、１００Ｍｂｉｔ／ｓの転
送速度で送られてくる画像データを取り込み、ディスプ
レー（図示せず）に画像を表示する処理などを実行す
る。引き続き、ＤＶＣ２からＰＣ３へ転送される画像デ
ータは、１００Ｍｂｉｔ／ｓの転送速度でデータ転送が
実施される。
送速度で送られてくる画像データを取り込み、ディスプ
レー（図示せず）に画像を表示する処理などを実行す
る。引き続き、ＤＶＣ２からＰＣ３へ転送される画像デ
ータは、１００Ｍｂｉｔ／ｓの転送速度でデータ転送が
実施される。
【００４０】次いで、上記のように、ＤＶＣ２の通信性
能が１００Ｍｂｉｔ／ｓの転送速度で設定されている状
態からＤＶＣ２がリピート転送を実施する場合を説明す
る。先ず、ＰＣ２がＶＴＲ３に対して、例えば記録用デ
ータを送信すると、該データは、ＤＶＣ２の入出力ポー
ト６からインタフェース回路１１を介して内部回路１２
のバッファ１５に一旦格納される。内部回路１２は、バ
ッファ１５の入力データに基づいて、自身宛のデータで
ないことを判定して、リピート判定信号ＳＣをクロック
制御回路１３に出力する。またこのとき、内部回路１２
は、ＰＣ３及びＶＴＲ４に対して自機の通信性能の変更
を通知する。即ち、４００Ｍｂｉｔ／ｓの転送速度にて
通信を実施する旨の転送データがインタフェース１１を
介して入出力ポート６，７から送出される。
能が１００Ｍｂｉｔ／ｓの転送速度で設定されている状
態からＤＶＣ２がリピート転送を実施する場合を説明す
る。先ず、ＰＣ２がＶＴＲ３に対して、例えば記録用デ
ータを送信すると、該データは、ＤＶＣ２の入出力ポー
ト６からインタフェース回路１１を介して内部回路１２
のバッファ１５に一旦格納される。内部回路１２は、バ
ッファ１５の入力データに基づいて、自身宛のデータで
ないことを判定して、リピート判定信号ＳＣをクロック
制御回路１３に出力する。またこのとき、内部回路１２
は、ＰＣ３及びＶＴＲ４に対して自機の通信性能の変更
を通知する。即ち、４００Ｍｂｉｔ／ｓの転送速度にて
通信を実施する旨の転送データがインタフェース１１を
介して入出力ポート６，７から送出される。
【００４１】そして、クロック制御回路１３は、リピー
ト判定回路１８の判定結果に基づいて、制御信号ＳＤを
クロックジェネレータ１４の分周回路２０に出力して、
クロック信号ＣＬＫを、４００Ｍｂｉｔ／ｓの転送速度
に対応した周波数に変更する。このクロック信号ＣＬＫ
に基づいて内部回路１２のバッファ１５に一旦格納され
たデータが、インタフェース回路１１を介して入出力ポ
ート７から出力される。つまり、４００Ｍｂｉｔ／ｓの
転送速度でデータがＶＴＲ４へ送信される。
ト判定回路１８の判定結果に基づいて、制御信号ＳＤを
クロックジェネレータ１４の分周回路２０に出力して、
クロック信号ＣＬＫを、４００Ｍｂｉｔ／ｓの転送速度
に対応した周波数に変更する。このクロック信号ＣＬＫ
に基づいて内部回路１２のバッファ１５に一旦格納され
たデータが、インタフェース回路１１を介して入出力ポ
ート７から出力される。つまり、４００Ｍｂｉｔ／ｓの
転送速度でデータがＶＴＲ４へ送信される。
【００４２】一方、ＶＴＲ４は、４００Ｍｂｉｔ／ｓで
転送されてきたデータを取り込み、転送データの記録処
理等を実施する。引き続き、ＰＣ３からＶＴＲ４へ転送
されるデータは、４００Ｍｂｉｔ／ｓの転送速度で一旦
ＤＶＣ２に取り込まれた後、ＤＶＣ２における４００Ｍ
ｂｉｔ／ｓのリピート転送処理によってＶＴＲ４に送信
される。また同様に、ＶＴＲ４からＰＣ３へ転送される
データも、４００Ｍｂｉｔ／ｓの転送速度で一旦ＤＶＣ
２に取り込まれた後、ＰＣ３に送信される。
転送されてきたデータを取り込み、転送データの記録処
理等を実施する。引き続き、ＰＣ３からＶＴＲ４へ転送
されるデータは、４００Ｍｂｉｔ／ｓの転送速度で一旦
ＤＶＣ２に取り込まれた後、ＤＶＣ２における４００Ｍ
ｂｉｔ／ｓのリピート転送処理によってＶＴＲ４に送信
される。また同様に、ＶＴＲ４からＰＣ３へ転送される
データも、４００Ｍｂｉｔ／ｓの転送速度で一旦ＤＶＣ
２に取り込まれた後、ＰＣ３に送信される。
【００４３】また、ＤＶＣ２の通信性能が４００Ｍｂｉ
ｔ／ｓの転送速度で設定されている状態で、ＤＶＣ２か
らＶＴＲ４に画像データを転送するとき、内部回路１２
は、クロック制御回路１３に自機判定信号ＳＢを出力す
る。またこのとき、内部回路１２は、ＶＴＲ４に対して
自身からの通信を１００Ｍｂｉｔ／ｓの転送速度にて実
施する旨の転送データを送出する。
ｔ／ｓの転送速度で設定されている状態で、ＤＶＣ２か
らＶＴＲ４に画像データを転送するとき、内部回路１２
は、クロック制御回路１３に自機判定信号ＳＢを出力す
る。またこのとき、内部回路１２は、ＶＴＲ４に対して
自身からの通信を１００Ｍｂｉｔ／ｓの転送速度にて実
施する旨の転送データを送出する。
【００４４】そして、クロック制御回路１３によりクロ
ックジェネレータ１４のクロック信号ＣＬＫの周波数が
変更される。これにより、内部処理回路から内部回路１
２のバッファ１５に格納された画像データがインタフェ
ース回路１１に出力されて、入出力ポート７から１００
Ｍｂｉｔ／ｓの転送速度でＶＴＲ４に出力される。
ックジェネレータ１４のクロック信号ＣＬＫの周波数が
変更される。これにより、内部処理回路から内部回路１
２のバッファ１５に格納された画像データがインタフェ
ース回路１１に出力されて、入出力ポート７から１００
Ｍｂｉｔ／ｓの転送速度でＶＴＲ４に出力される。
【００４５】ＶＴＲ４は転送されてきたデータを１００
Ｍｂｉｔ／ｓの同期速度で取り込み該データの記憶処理
等を実施する。このように、ＤＶＣ２が内蔵バッテリＢ
で駆動されているときは、図２に示すように、ＰＣ３−
ＤＶＣ２間またはＤＶＣ２−ＶＴＲ４間でデータ転送が
行われる場合、１００Ｍｂｉｔ／ｓの転送速度で通信が
実施される。また、ＰＣ３−ＶＴＲ４間でデータ転送が
行われる場合、ＤＶＣ２によるリピート転送が４００Ｍ
ｂｉｔ／ｓの通信速度で実施されて、４００Ｍｂｉｔ／
ｓの転送速度で通信が実施される。
Ｍｂｉｔ／ｓの同期速度で取り込み該データの記憶処理
等を実施する。このように、ＤＶＣ２が内蔵バッテリＢ
で駆動されているときは、図２に示すように、ＰＣ３−
ＤＶＣ２間またはＤＶＣ２−ＶＴＲ４間でデータ転送が
行われる場合、１００Ｍｂｉｔ／ｓの転送速度で通信が
実施される。また、ＰＣ３−ＶＴＲ４間でデータ転送が
行われる場合、ＤＶＣ２によるリピート転送が４００Ｍ
ｂｉｔ／ｓの通信速度で実施されて、４００Ｍｂｉｔ／
ｓの転送速度で通信が実施される。
【００４６】次に、ＤＶＣ２が外部電源で駆動される場
合を説明する。先ず、外部電源がＤＶＣ２に接続される
と内部回路１２が外部電源の供給を判断して、クロック
制御回路１３に対して電源判定信号ＳＡを出力する。ま
たこのとき、内部回路１２は、ＰＣ３及びＶＴＲ４に対
して、自身からの通信を４００Ｍｂｉｔ／ｓの転送速度
にて実施する旨の転送データを、インタフェース回路１
１を介して入出力ポート６，７から出力する。
合を説明する。先ず、外部電源がＤＶＣ２に接続される
と内部回路１２が外部電源の供給を判断して、クロック
制御回路１３に対して電源判定信号ＳＡを出力する。ま
たこのとき、内部回路１２は、ＰＣ３及びＶＴＲ４に対
して、自身からの通信を４００Ｍｂｉｔ／ｓの転送速度
にて実施する旨の転送データを、インタフェース回路１
１を介して入出力ポート６，７から出力する。
【００４７】クロック制御回路１３は、電源判定回路１
６により外部電源で駆動していることを判定して、通信
性能を４００Ｍｂｉｔ／ｓの転送速度に変更すべく分周
回路２０の分周比を変更する。これにより、クロック信
号ＣＬＫの周波数が変更されて、内部回路１２及びイン
タフェース回路１１により４００Ｍｂｉｔ／ｓの転送速
度でデータが転送される。
６により外部電源で駆動していることを判定して、通信
性能を４００Ｍｂｉｔ／ｓの転送速度に変更すべく分周
回路２０の分周比を変更する。これにより、クロック信
号ＣＬＫの周波数が変更されて、内部回路１２及びイン
タフェース回路１１により４００Ｍｂｉｔ／ｓの転送速
度でデータが転送される。
【００４８】つまり、図３に示すように、ＤＶＣ２が外
部電源で駆動されているときは、ＰＣ３−ＶＴＲ４間、
ＰＣ３−ＤＶＣ２間、ＤＶＣ２−ＶＴＲ４間の全ての通
信が４００Ｍｂｉｔ／ｓの転送速度で実施される。
部電源で駆動されているときは、ＰＣ３−ＶＴＲ４間、
ＰＣ３−ＤＶＣ２間、ＤＶＣ２−ＶＴＲ４間の全ての通
信が４００Ｍｂｉｔ／ｓの転送速度で実施される。
【００４９】なお、例えば、ＰＣ３の通信性能が４００
Ｍｂｉｔ／ｓの転送速度、ＶＴＲ４の通信性能が２００
Ｍｂｉｔ／ｓの転送速度であれば、ＶＴＲ４との間でネ
ゴシエーションが行われ、ＤＶＣ２はリピート転送時の
自身の通信性能を２００Ｍｂｉｔ／ｓの転送速度に設定
する。なお、ＰＣ４もＶＴＲ４の通信性能に応じてその
通信性能を、２００Ｍｂｉｔ／ｓの転送速度に設定す
る。この場合、２００Ｍｂｉｔ／ｓが第１の通信速度に
相当する。また、ネットワークに接続される機器として
は、上述のように、ＤＶＣ２，ＰＣ３，ＶＴＲ４が接続
される場合に限定するものではなく、接続される機器の
種類、個数等が異なるネットワークシステムに適用でき
ることは明らかである。
Ｍｂｉｔ／ｓの転送速度、ＶＴＲ４の通信性能が２００
Ｍｂｉｔ／ｓの転送速度であれば、ＶＴＲ４との間でネ
ゴシエーションが行われ、ＤＶＣ２はリピート転送時の
自身の通信性能を２００Ｍｂｉｔ／ｓの転送速度に設定
する。なお、ＰＣ４もＶＴＲ４の通信性能に応じてその
通信性能を、２００Ｍｂｉｔ／ｓの転送速度に設定す
る。この場合、２００Ｍｂｉｔ／ｓが第１の通信速度に
相当する。また、ネットワークに接続される機器として
は、上述のように、ＤＶＣ２，ＰＣ３，ＶＴＲ４が接続
される場合に限定するものではなく、接続される機器の
種類、個数等が異なるネットワークシステムに適用でき
ることは明らかである。
【００５０】以上記述したように、本実施の形態によれ
ば、以下の効果を奏する。 （１）ネットワークに接続されたＤＶＣ２は、その時々
の通信条件に応じて最適な通信性能が設定され、ユーザ
が意識することなく最良の条件でネットワークに接続す
ることができる。このため、特に、家電機器等に本イン
タフェース制御装置１を適用すれば、ユーザが機器の接
続方法を意識することなく使用でき実用上好ましいもの
となる。
ば、以下の効果を奏する。 （１）ネットワークに接続されたＤＶＣ２は、その時々
の通信条件に応じて最適な通信性能が設定され、ユーザ
が意識することなく最良の条件でネットワークに接続す
ることができる。このため、特に、家電機器等に本イン
タフェース制御装置１を適用すれば、ユーザが機器の接
続方法を意識することなく使用でき実用上好ましいもの
となる。
【００５１】（２）ＰＣ３とＶＴＲ４との間でデータ転
送が行われるとき、ＰＣ３とＶＴＲ４の通信性能に応じ
てＤＶＣ２の通信性能が４００Ｍｂｉｔ／ｓの転送速度
に設定され、リピート転送が実施される。従って、ＰＣ
３とＶＴＲ４間で最適な転送速度で転送処理が実施でき
る。また、内部電源としてのバッテリＢ駆動時では、Ｄ
ＶＣ２−ＰＣ３間の通信またはＤＶＣ２−ＶＴＲ４間の
通信は、１００Ｍｂｉｔ／ｓの転送速度で実施されるの
で、ＤＶＣ２の消費電力の低減を図ることができる。
送が行われるとき、ＰＣ３とＶＴＲ４の通信性能に応じ
てＤＶＣ２の通信性能が４００Ｍｂｉｔ／ｓの転送速度
に設定され、リピート転送が実施される。従って、ＰＣ
３とＶＴＲ４間で最適な転送速度で転送処理が実施でき
る。また、内部電源としてのバッテリＢ駆動時では、Ｄ
ＶＣ２−ＰＣ３間の通信またはＤＶＣ２−ＶＴＲ４間の
通信は、１００Ｍｂｉｔ／ｓの転送速度で実施されるの
で、ＤＶＣ２の消費電力の低減を図ることができる。
【００５２】尚、上記各実施形態は、以下の態様で実施
してもよい。 ○上記実施形態のＤＶＣ２は、画像データ送信時におい
て、自身の通信性能を１００Ｍｂｉｔ／ｓの転送速度に
設定するものであるが、例えば、画像データを受け取る
機能のあるＤＶＣでは、画像データの受信時において
も、自身の通信性能を１００Ｍｂｉｔ／ｓの転送速度に
設定するようにしてもよい。このようにしても、ＤＶＣ
の消費電力の低減を図ることができる。
してもよい。 ○上記実施形態のＤＶＣ２は、画像データ送信時におい
て、自身の通信性能を１００Ｍｂｉｔ／ｓの転送速度に
設定するものであるが、例えば、画像データを受け取る
機能のあるＤＶＣでは、画像データの受信時において
も、自身の通信性能を１００Ｍｂｉｔ／ｓの転送速度に
設定するようにしてもよい。このようにしても、ＤＶＣ
の消費電力の低減を図ることができる。
【００５３】また、本インタフェース制御装置１を適用
する機器は、ＤＶＣに限ることなく、例えば、小型携帯
用パソコン等であってもよい。 ○上記実施形態では、クロックジェネレータ１４は、分
周回路２０の分周比を変更する構成であったが、これに
限定しない。例えば、周波数を変更可能な発振器を備
え、クロック制御回路１３からの制御信号に基づいて、
発振器がクロック信号ＣＬＫの周波数を変更するように
構成してもよい。
する機器は、ＤＶＣに限ることなく、例えば、小型携帯
用パソコン等であってもよい。 ○上記実施形態では、クロックジェネレータ１４は、分
周回路２０の分周比を変更する構成であったが、これに
限定しない。例えば、周波数を変更可能な発振器を備
え、クロック制御回路１３からの制御信号に基づいて、
発振器がクロック信号ＣＬＫの周波数を変更するように
構成してもよい。
【００５４】○上記実施形態では、内部回路１２からの
電源判定信号ＳＡにより、ＤＶＣ２が外部電源で駆動さ
れているのか、或いはバッテリＢで駆動されているかを
判定する構成であったが、これに限定するものではな
い。例えば、ＤＶＣ２内に別に設けられた電源検出回路
からの信号に基づいてクロック制御回路１３が外部電源
により駆動されているのか否かを判定できるように構成
してもよい。また、電源判定回路１６が自身に供給され
る電源に基づいて判断する構成としてもよい。
電源判定信号ＳＡにより、ＤＶＣ２が外部電源で駆動さ
れているのか、或いはバッテリＢで駆動されているかを
判定する構成であったが、これに限定するものではな
い。例えば、ＤＶＣ２内に別に設けられた電源検出回路
からの信号に基づいてクロック制御回路１３が外部電源
により駆動されているのか否かを判定できるように構成
してもよい。また、電源判定回路１６が自身に供給され
る電源に基づいて判断する構成としてもよい。
【００５５】○上記実施形態では、ＤＶＣ２の通信性能
は、バッテリ駆動時において、自身とＰＣ３，ＶＴＲ４
との間でデータ転送を行う場合に１００Ｍｂｉｔ／ｓ、
リピート転送を実施する場合に４００Ｍｂｉｔ／ｓの転
送速度に設定し、外部電源駆動時において、４００Ｍｂ
ｉｔ／ｓの転送速度に設定するものであったが、これに
限定するものではない。
は、バッテリ駆動時において、自身とＰＣ３，ＶＴＲ４
との間でデータ転送を行う場合に１００Ｍｂｉｔ／ｓ、
リピート転送を実施する場合に４００Ｍｂｉｔ／ｓの転
送速度に設定し、外部電源駆動時において、４００Ｍｂ
ｉｔ／ｓの転送速度に設定するものであったが、これに
限定するものではない。
【００５６】例えば、外部電源駆動時においても、ＤＶ
Ｃ２がデータ転送する場合に１００Ｍｂｉｔ／ｓ、リピ
ート転送を実施する場合に４００Ｍｂｉｔ／ｓの転送速
度を設定するものであってもよい。
Ｃ２がデータ転送する場合に１００Ｍｂｉｔ／ｓ、リピ
ート転送を実施する場合に４００Ｍｂｉｔ／ｓの転送速
度を設定するものであってもよい。
【００５７】また、バッテリ駆動時には、リピート転送
であるか否かに拘わらず、１００Ｍｂｉｔ／ｓに通信速
度を設定し、外部電源駆動時において、自身とＰＣ３，
ＶＴＲ４との間でデータ転送を行う場合に１００Ｍｂｉ
ｔ／ｓ、リピート転送を実施する場合に４００Ｍｂｉｔ
／ｓの転送速度に設定するものでもよい。
であるか否かに拘わらず、１００Ｍｂｉｔ／ｓに通信速
度を設定し、外部電源駆動時において、自身とＰＣ３，
ＶＴＲ４との間でデータ転送を行う場合に１００Ｍｂｉ
ｔ／ｓ、リピート転送を実施する場合に４００Ｍｂｉｔ
／ｓの転送速度に設定するものでもよい。
【００５８】さらには、リピート転送であるか否かに拘
わらず、バッテリ駆動時には１００Ｍｂｉｔ／ｓに、外
部電源駆動時には４００Ｍｂｉｔ／ｓに転送速度を設定
するものであってもよい。
わらず、バッテリ駆動時には１００Ｍｂｉｔ／ｓに、外
部電源駆動時には４００Ｍｂｉｔ／ｓに転送速度を設定
するものであってもよい。
【００５９】勿論、外部電源により駆動されているとき
も、自身とＰＣ３，ＶＴＲ４との間でデータ転送を行う
場合に１００Ｍｂｉｔ／ｓ、リピート転送を実施する場
合に４００Ｍｂｉｔ／ｓの転送速度に設定するものであ
ってもよい。
も、自身とＰＣ３，ＶＴＲ４との間でデータ転送を行う
場合に１００Ｍｂｉｔ／ｓ、リピート転送を実施する場
合に４００Ｍｂｉｔ／ｓの転送速度に設定するものであ
ってもよい。
【００６０】○上記実施形態では、バスリセット時にお
いて、ＤＶＣ２は自機の通信性能として、４００Ｍｂｉ
ｔ／ｓの転送速度をＰＣ３，ＶＴＲ４に通知する構成で
あったが、これに限定するものではない。例えば、ＤＶ
Ｃ２がバッテリで駆動されている状態で、バスリセット
が実施されたとき、１００Ｍｂｉｔ／ｓの転送速度を通
知する構成にしてもよい。このようすれば、消費電力の
低減を図ることができ、実用上好ましいものとなる。
いて、ＤＶＣ２は自機の通信性能として、４００Ｍｂｉ
ｔ／ｓの転送速度をＰＣ３，ＶＴＲ４に通知する構成で
あったが、これに限定するものではない。例えば、ＤＶ
Ｃ２がバッテリで駆動されている状態で、バスリセット
が実施されたとき、１００Ｍｂｉｔ／ｓの転送速度を通
知する構成にしてもよい。このようすれば、消費電力の
低減を図ることができ、実用上好ましいものとなる。
【００６１】
【発明の効果】以上詳述したように、本発明によれば、
その時々の通信条件に応じて最適な通信性能を設定し、
ユーザが意識することなく最良の条件でネットワークに
接続することができる。このため、特に、家電機器等に
適用すれば、ユーザが機器の接続方法を意識することな
く使用でき実用上好ましいものとなる。
その時々の通信条件に応じて最適な通信性能を設定し、
ユーザが意識することなく最良の条件でネットワークに
接続することができる。このため、特に、家電機器等に
適用すれば、ユーザが機器の接続方法を意識することな
く使用でき実用上好ましいものとなる。
【図１】 一実施形態のインタフェース制御装置のブロ
ック回路図。
ック回路図。
【図２】 ＩＥＥＥ１３９４バスで各機器を接続したシ
ステム構成図。
ステム構成図。
【図３】 ＩＥＥＥ１３９４バスで各機器を接続したシ
ステム構成図。
ステム構成図。
【図４】 ＩＥＥＥ１３９４バスで各機器を接続したシ
ステム構成図。
ステム構成図。
【図５】 従来のインタフェース制御装置のブロック回
路図。
路図。
【図６】 各機器間のデータの転送速度を説明するため
の図。
の図。
【図７】 各機器間のデータの転送速度を説明するため
の図。
の図。
１ インタフェース制御装置 ３ 他の装置としてのパーソナルコンピュータ ４ 他の装置としてのビデオテープレコーダ ６，７ 入出力ポート １１ リピート転送手段を構成するインタフェース回路 １２ リピート転送手段を構成する内部回路 １３ クロック制御手段としてのクロック制御回路 １４ クロック発生手段としてのクロックジェネレータ Ｂ 内部電源としてのバッテリ ＣＬＫ クロック信号
Claims (10)
- 【請求項１】 複数の他の装置と接続され、データ通信
を行うためのインタフェース制御装置であって、 クロック信号を発生するクロック発生手段と、 入力データが自身宛のデータか否かを判定し、前記他の
装置宛のデータが入力された場合、前記クロック信号に
同期して前記データをネットワークに送信するリピート
転送手段と、 その時々の通信条件に応じて前記クロック信号の周波数
を変更するクロック制御手段と、を備えた、ことを特徴
とするインタフェース制御装置。 - 【請求項２】 請求項１に記載のインタフェース制御装
置において、 前記クロック制御手段は、リピート転送を行うときに前
記他の装置の通信性能に応じて第１の転送速度に変更
し、自身が他の装置とデータ転送を行うときに前記第１
の転送速度よりも遅い第２の転送速度に変更する、こと
を特徴とするインタフェース制御装置。 - 【請求項３】 内部電源または外部電源により動作可能
なインタフェース制御装置であって、 前記クロック制御手段は、前記外部電源による動作時で
は、リピート転送を行うときに前記他の装置の通信性能
に応じて第１の転送速度に変更し、自身が他の装置とデ
ータ転送を行うときに前記第１の転送速度よりも遅い第
２の転送速度に変更し、一方、前記内部電源による動作
時では、リピート転送を行うときに前記第２の転送速度
に変更する、ことを特徴とする請求項１に記載のインタ
フェース制御装置。 - 【請求項４】 内部電源または外部電源により動作可能
なインタフェース制御装置であって、 前記クロック制御手段は、前記内部電源による動作時で
は、リピート転送を行うときに前記他の装置の通信性能
に応じて第１の転送速度に変更し、自身が他の装置とデ
ータ転送を行うときに前記第１の転送速度よりも遅い第
２の転送速度に変更し、一方、前記外部電源による動作
時では、前記第１の転送速度に変更する、ことを特徴と
する請求項１に記載のインタフェース制御装置。 - 【請求項５】 請求項１に記載のインタフェース制御装
置において、 前記クロック信号発生手段は、基本信号を発生する発振
回路と、前記基本信号の分周する分周回路とを備え、前
記クロック制御手段は、前記分周回路の分周比を変更す
る、ことを特徴とするインタフェース制御装置。 - 【請求項６】 請求項１に記載のインタフェース制御装
置において、 前記他の装置と接続するための複数の入出力ポートを備
え、リピート転送時には、前記入力データが入力された
入出力パートとは別のポートから前記データを送信す
る、ことを特徴とするインタフェース制御装置。 - 【請求項７】 請求項１に記載のインタフェース制御装
置において、 前記他の装置に対して通信速度を通知する通知手段を備
え、 前記通知手段は、自身と前記他の装置との間でデータ転
送を開始するまでは、他の装置の通信性能に応じた第１
の通信速度を他の装置に対して通知し、自身と他の装置
との間でデータ転送を行うときは、前記第１の通信速度
よりも遅い第２の通信速度を他の装置に対して通知す
る、ことを特徴とするインタフェース制御装置。 - 【請求項８】 請求項７に記載のインタフェース制御装
置において、 前記クロック制御手段は、リピート転送を行うためのデ
ータが入力されるまでは、通信性能を前記第２の通信速
度に設定する、ことを特徴とするインタフェース制御装
置。 - 【請求項９】 複数の他の装置と接続され、自身宛のデ
ータであれば入力データを内部処理回路に取り込み、他
の装置宛のデータであれば、第１の転送速度で他の装置
に対して入力データを送信するインタフェース制御装置
に適用されるインタフェース制御方法であって、 前記第１の通信速度よりも遅い第２の通信速度で内部処
理回路と前記他の装置との間でデータ転送を行う、こと
を特徴とするインタフェース制御方法。 - 【請求項１０】 複数の他の装置と接続され、自身宛の
データであれば入力データを内部処理回路に取り込み、
他の装置宛のデータであれば、他の装置に対して入力デ
ータを送信し、内部電源または外部電源により動作可能
なインタフェース制御装置に適用されるインタフェース
制御方法であって、 前記外部電源による動作時には、前記他の装置の通信性
能に応じた第１の転送速度でデータ転送を行い、 前記内部電源による動作時には、前記第１の通信速度よ
りも遅い第２の通信速度でデータ転送を行う、ことを特
徴とするインタフェース制御方法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03007599A JP4091195B2 (ja) | 1999-02-08 | 1999-02-08 | インタフェース制御装置及びインタフェース制御方法 |
| TW089100806A TW558877B (en) | 1999-02-08 | 2000-01-19 | Interface controller with variable transfer rate |
| US09/490,120 US6665810B1 (en) | 1999-02-08 | 2000-01-24 | Interface controller that controls the rate at which data is transfer based on the destination address of the data |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03007599A JP4091195B2 (ja) | 1999-02-08 | 1999-02-08 | インタフェース制御装置及びインタフェース制御方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2000232465A true JP2000232465A (ja) | 2000-08-22 |
| JP4091195B2 JP4091195B2 (ja) | 2008-05-28 |
Family
ID=12293691
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03007599A Expired - Fee Related JP4091195B2 (ja) | 1999-02-08 | 1999-02-08 | インタフェース制御装置及びインタフェース制御方法 |
Country Status (3)
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|---|---|
| US (1) | US6665810B1 (ja) |
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| TW (1) | TW558877B (ja) |
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| JP2016171470A (ja) * | 2015-03-13 | 2016-09-23 | パナソニックＩｐマネジメント株式会社 | 通信装置、受信装置、通信システム |
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| DE10121912C2 (de) * | 2001-05-05 | 2003-05-22 | Phoenix Contact Gmbh & Co | Verfahren zur zentralen Datenraten-Einstellung in einer Datenübertragungsanlage sowie Vorrichtung zur zentralen Datenraten-Einstellung |
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| US7720136B2 (en) | 2006-12-26 | 2010-05-18 | Provigent Ltd | Adaptive coding and modulation based on link performance prediction |
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| US7821938B2 (en) | 2007-04-20 | 2010-10-26 | Provigent Ltd. | Adaptive coding and modulation for synchronous connections |
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1999
- 1999-02-08 JP JP03007599A patent/JP4091195B2/ja not_active Expired - Fee Related
-
2000
- 2000-01-19 TW TW089100806A patent/TW558877B/zh not_active IP Right Cessation
- 2000-01-24 US US09/490,120 patent/US6665810B1/en not_active Expired - Lifetime
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| US6665810B1 (en) | 2003-12-16 |
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