JP2000124705A - ２帯域フィルタ - Google Patents
２帯域フィルタInfo
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- Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)
Abstract
(57)【要約】 （修正有）
【課題】 本発明はフィルタの形状を大きくすることな
くフィルタの通過特性が得られるようにした２帯域フィ
ルタに関するものである。 【解決手段】 誘電体１４上に設けたストリップライン
１４Ａ，１４Ｂに対向しないように、線路幅をストリッ
プライン長方向に垂直方向の最小線路幅以下とした伝送
線路パターン１６Ａを誘電体１６上に設け、端面電極２
０Ａ，２０Ｂに接続してインダクタンスを形成し、帯域
通過フィルタ２の帯域４における入力インピーダンス２
Ｃとし、帯域６における入力インピーダンス２Ｄとし、
また、入出力容量パターン１８Ａの線路長をストリップ
ライン１９Ａの線路長の４分の１以下として、帯域通過
フィルタ３の帯域４における入力インピーダンス３Ｃと
し、帯域６における入力インピーダンス３Ｄとした。
くフィルタの通過特性が得られるようにした２帯域フィ
ルタに関するものである。 【解決手段】 誘電体１４上に設けたストリップライン
１４Ａ，１４Ｂに対向しないように、線路幅をストリッ
プライン長方向に垂直方向の最小線路幅以下とした伝送
線路パターン１６Ａを誘電体１６上に設け、端面電極２
０Ａ，２０Ｂに接続してインダクタンスを形成し、帯域
通過フィルタ２の帯域４における入力インピーダンス２
Ｃとし、帯域６における入力インピーダンス２Ｄとし、
また、入出力容量パターン１８Ａの線路長をストリップ
ライン１９Ａの線路長の４分の１以下として、帯域通過
フィルタ３の帯域４における入力インピーダンス３Ｃと
し、帯域６における入力インピーダンス３Ｄとした。
Description
【０００１】
【発明の属する技術分野】本発明は携帯電話機等の高周
波回路部に使用される２帯域フィルタに関するものであ
る。
波回路部に使用される２帯域フィルタに関するものであ
る。
【０００２】
【従来の技術】従来の２帯域フィルタは、図２６に示さ
れるように、２つのフィルタ２２，２３の接続部となる
入力接続端子２１Ａにおいて、一方のフィルタ２２の低
域通過帯域における入力部２２Ａ側の入力インピーダン
ス２２Ｃが、他方のフィルタ２３の低域通過帯域におけ
る入力部２３Ａ側の入力インピーダンス２３Ｃの影響を
受けて、高域通過帯域が特性劣化しないように一方のフ
ィルタ２３の低域通過帯域における入力部２３Ａ側の入
力インピーダンス２３Ｃを完全にオープンとしていた。
また高域通過帯域におけるフィルタ２２の入力部２２Ａ
側の入力インピーダンス２２Ｄについても同様である。
れるように、２つのフィルタ２２，２３の接続部となる
入力接続端子２１Ａにおいて、一方のフィルタ２２の低
域通過帯域における入力部２２Ａ側の入力インピーダン
ス２２Ｃが、他方のフィルタ２３の低域通過帯域におけ
る入力部２３Ａ側の入力インピーダンス２３Ｃの影響を
受けて、高域通過帯域が特性劣化しないように一方のフ
ィルタ２３の低域通過帯域における入力部２３Ａ側の入
力インピーダンス２３Ｃを完全にオープンとしていた。
また高域通過帯域におけるフィルタ２２の入力部２２Ａ
側の入力インピーダンス２２Ｄについても同様である。
【０００３】
【発明が解決しようとする課題】上記構成において問題
となるのは、一方のフィルタ２２の通過あるいは阻止帯
域である低域通過帯域における他方のフィルタ２３の入
力接続端子２１Ａにおける入力インピーダンス２３Ｃを
オープンとするために、外部移相回路２６を付加しなけ
ればならず、回路規模が大きくなり、２帯域フィルタ形
状が大きくなるという問題があった。高域通過帯域につ
いても同様である。
となるのは、一方のフィルタ２２の通過あるいは阻止帯
域である低域通過帯域における他方のフィルタ２３の入
力接続端子２１Ａにおける入力インピーダンス２３Ｃを
オープンとするために、外部移相回路２６を付加しなけ
ればならず、回路規模が大きくなり、２帯域フィルタ形
状が大きくなるという問題があった。高域通過帯域につ
いても同様である。
【０００４】そこで、本発明は外部移相回路を付加せ
ず、フィルタの形状を大きくしなくても、２帯域フィル
タの低域及び高域通過帯域の特性劣化を起こさず、フィ
ルタを小型化することを目的とするものである。
ず、フィルタの形状を大きくしなくても、２帯域フィル
タの低域及び高域通過帯域の特性劣化を起こさず、フィ
ルタを小型化することを目的とするものである。
【０００５】
【課題を解決するための手段】そしてこの目的を達成す
るために本発明は、低域通過帯域における一方の帯域通
過フィルタの入力部の入力インピーダンスを考慮して、
他方の帯域通過フィルタの前記帯域における入力部の入
力インピーダンスを設定し、２つのフィルタを並列に接
続することにより、前記通過帯域特性が得られるように
したものである。高域通過帯域においても、同様にして
通過帯域特性が得られるようにしたものである。
るために本発明は、低域通過帯域における一方の帯域通
過フィルタの入力部の入力インピーダンスを考慮して、
他方の帯域通過フィルタの前記帯域における入力部の入
力インピーダンスを設定し、２つのフィルタを並列に接
続することにより、前記通過帯域特性が得られるように
したものである。高域通過帯域においても、同様にして
通過帯域特性が得られるようにしたものである。
【０００６】
【発明の実施の形態】本発明の請求項１に記載の発明
は、２つのフィルタを有する２帯域フィルタにおいて、
一方のフィルタを通過あるいは阻止帯域における入力イ
ンピーダンスに基づいて構成するとともに、他方のフィ
ルタを一方のフィルタの通過あるいは阻止帯域における
他方のフィルタの入力インピーダンスに基づいて構成
し、それらを並列接続したフィルタであり、外部移相回
路を付加することなく良好な通過帯域特性が得られると
いう作用を有する。
は、２つのフィルタを有する２帯域フィルタにおいて、
一方のフィルタを通過あるいは阻止帯域における入力イ
ンピーダンスに基づいて構成するとともに、他方のフィ
ルタを一方のフィルタの通過あるいは阻止帯域における
他方のフィルタの入力インピーダンスに基づいて構成
し、それらを並列接続したフィルタであり、外部移相回
路を付加することなく良好な通過帯域特性が得られると
いう作用を有する。
【０００７】請求項２に記載の発明は、２つのフィルタ
を有する２帯域をフィルタであり、所定インピーダンス
の回路系において、一方のフィルタの通過あるいは阻止
帯域における入力アドミタンスのコンダクタンス成分
を、回路系のアドミタンスと等しいフィルタで構成した
２帯域フィルタであり、接続するフィルタの入力インピ
ーダンスを複雑化することなく、抵抗分を有しない所望
のリアクタンス成分のみとするだけでフィルタの整合が
得られ、挿入損失を増加させることなく通過特性が得ら
れるという作用を有する。
を有する２帯域をフィルタであり、所定インピーダンス
の回路系において、一方のフィルタの通過あるいは阻止
帯域における入力アドミタンスのコンダクタンス成分
を、回路系のアドミタンスと等しいフィルタで構成した
２帯域フィルタであり、接続するフィルタの入力インピ
ーダンスを複雑化することなく、抵抗分を有しない所望
のリアクタンス成分のみとするだけでフィルタの整合が
得られ、挿入損失を増加させることなく通過特性が得ら
れるという作用を有する。
【０００８】請求項３に記載の発明は、一方のフィルタ
の通過あるいは阻止帯域における他方のフィルタの入力
インピーダンスを、抵抗成分を有しない純リアクタンス
性となるフィルタで構成した２帯域フィルタであり、２
つのフィルタを接続しても挿入損失が増加しないという
作用を有する。
の通過あるいは阻止帯域における他方のフィルタの入力
インピーダンスを、抵抗成分を有しない純リアクタンス
性となるフィルタで構成した２帯域フィルタであり、２
つのフィルタを接続しても挿入損失が増加しないという
作用を有する。
【０００９】請求項４に記載の発明は、複数のシールド
パターンを有する誘電体の間に複数のストリップライン
を有する誘電体と上記複数のストリップラインに対向す
る入出力容量パターンまたは接続する入出力パターンを
有する誘電体層とを配し、その誘電体層に前記入出力容
量パターンまたは入出力パターンに接続された端面電極
を形成するとともに、前記端面電極に接続された伝送線
路を形成し、前記伝送線路を前記複数のストリップライ
ンに対向しないように設けた２帯域フィルタであり、ス
トリップラインと伝送線路が結合しないようにし、伝送
線路でインダクタンス素子を形成し、通過あるいは阻止
帯域外の入力インピーダンスを高インピーダンスとし、
抵抗成分が０の純リアクタンスとして、他方のフィルタ
の通過あるいは阻止帯域の入力インピーダンスとの整合
がとれ、損失を増加させずに通過あるいは阻止帯域を得
るという作用を有する。
パターンを有する誘電体の間に複数のストリップライン
を有する誘電体と上記複数のストリップラインに対向す
る入出力容量パターンまたは接続する入出力パターンを
有する誘電体層とを配し、その誘電体層に前記入出力容
量パターンまたは入出力パターンに接続された端面電極
を形成するとともに、前記端面電極に接続された伝送線
路を形成し、前記伝送線路を前記複数のストリップライ
ンに対向しないように設けた２帯域フィルタであり、ス
トリップラインと伝送線路が結合しないようにし、伝送
線路でインダクタンス素子を形成し、通過あるいは阻止
帯域外の入力インピーダンスを高インピーダンスとし、
抵抗成分が０の純リアクタンスとして、他方のフィルタ
の通過あるいは阻止帯域の入力インピーダンスとの整合
がとれ、損失を増加させずに通過あるいは阻止帯域を得
るという作用を有する。
【００１０】請求項５に記載の発明は、伝送線路のスト
リップライン長方向に垂直方向の線路幅をストリップラ
インの最小線路幅以下とし、伝送線路でインダクタンス
素子を形成し、通過あるいは阻止帯域外の入力インピー
ダンスを高インピーダンスとし、抵抗成分が０の純リア
クタンスとして、他方のフィルタの通過あるいは阻止帯
域の入力インピーダンスとの整合がとれ、損失を増加さ
せずに通過あるいは阻止帯域を得るという作用を有す
る。
リップライン長方向に垂直方向の線路幅をストリップラ
インの最小線路幅以下とし、伝送線路でインダクタンス
素子を形成し、通過あるいは阻止帯域外の入力インピー
ダンスを高インピーダンスとし、抵抗成分が０の純リア
クタンスとして、他方のフィルタの通過あるいは阻止帯
域の入力インピーダンスとの整合がとれ、損失を増加さ
せずに通過あるいは阻止帯域を得るという作用を有す
る。
【００１１】請求項６に記載の発明は、複数のストリッ
プラインの開放端に対向する入出力容量パターンと前記
伝送線路を接続する端面電極を形成し、前記入出力容量
パターンのストリップライン長方向のパターン長をスト
リップライン長の４分の１以下として、高い結合インピ
ーダンスで容量を形成して、通過あるいは阻止帯域外の
入力インピーダンスを高インピーダンスとし、抵抗成分
が０の純リアクタンスとして、他方のフィルタの通過あ
るいは阻止帯域の入力インピーダンスとの整合がとれ、
損失を増加させずに通過あるいは阻止帯域を得るという
作用を有する。
プラインの開放端に対向する入出力容量パターンと前記
伝送線路を接続する端面電極を形成し、前記入出力容量
パターンのストリップライン長方向のパターン長をスト
リップライン長の４分の１以下として、高い結合インピ
ーダンスで容量を形成して、通過あるいは阻止帯域外の
入力インピーダンスを高インピーダンスとし、抵抗成分
が０の純リアクタンスとして、他方のフィルタの通過あ
るいは阻止帯域の入力インピーダンスとの整合がとれ、
損失を増加させずに通過あるいは阻止帯域を得るという
作用を有する。
【００１２】請求項７に記載の発明は、請求項１におい
て２つのフィルタの入力部を接続した入力接続端子から
入力された入力信号が、それぞれ独立に出力される２帯
域フィルタであり、入力部に外部移相回路を付加するこ
となく、１入力２出力型とし、良好なフィルタ特性が得
られるという作用を有する。
て２つのフィルタの入力部を接続した入力接続端子から
入力された入力信号が、それぞれ独立に出力される２帯
域フィルタであり、入力部に外部移相回路を付加するこ
となく、１入力２出力型とし、良好なフィルタ特性が得
られるという作用を有する。
【００１３】請求項８に記載の発明は、請求項１におい
て２つのフィルタにそれぞれ独立に入力信号が入力さ
れ、前記入力信号が２つのフィルタの出力部を接続した
出力接続端子から出力される２帯域フィルタであり、出
力部に外部移相回路を付加することなく、２入力１出力
型とし、良好なフィルタ特性が得られるという作用を有
する。
て２つのフィルタにそれぞれ独立に入力信号が入力さ
れ、前記入力信号が２つのフィルタの出力部を接続した
出力接続端子から出力される２帯域フィルタであり、出
力部に外部移相回路を付加することなく、２入力１出力
型とし、良好なフィルタ特性が得られるという作用を有
する。
【００１４】請求項９に記載の発明は、請求項１におい
て２つのフィルタの入力部を接続した入力接続端子から
入力された入力信号が、前記２つのフィルタの出力部を
接続した出力接続端子から出力される２帯域フィルタで
あり、入力部および出力部に外部移相回路を付加するこ
となく、１入力１出力型とし、良好なフィルタ特性が得
られるという作用を有する。
て２つのフィルタの入力部を接続した入力接続端子から
入力された入力信号が、前記２つのフィルタの出力部を
接続した出力接続端子から出力される２帯域フィルタで
あり、入力部および出力部に外部移相回路を付加するこ
となく、１入力１出力型とし、良好なフィルタ特性が得
られるという作用を有する。
【００１５】以下、本発明の一実施の形態を図面を用い
て説明する。図１は本発明の一実施の形態におけるフィ
ルタの構成であり、図２は同実施の形態におけるフィル
タの斜視図を示し、図３は同実施の形態におけるフィル
タの分解斜視図を示し、図４、図７、図１０、図１５、
図１８は同実施の形態におけるフィルタの入力部から出
力部への通過特性を示し、図５、図８、図１１、図１
６、図１９は同実施の形態におけるフィルタの入力部か
ら出力部側を見たインピーダンス特性を示し、図６、図
９、図１４、図１７は同実施の形態におけるフィルタの
構成素子２２，２３，２，３の構成を示し、図１２、図
２０、図２１、図２２、図２３は同実施の形態における
フィルタの等価回路を示している。
て説明する。図１は本発明の一実施の形態におけるフィ
ルタの構成であり、図２は同実施の形態におけるフィル
タの斜視図を示し、図３は同実施の形態におけるフィル
タの分解斜視図を示し、図４、図７、図１０、図１５、
図１８は同実施の形態におけるフィルタの入力部から出
力部への通過特性を示し、図５、図８、図１１、図１
６、図１９は同実施の形態におけるフィルタの入力部か
ら出力部側を見たインピーダンス特性を示し、図６、図
９、図１４、図１７は同実施の形態におけるフィルタの
構成素子２２，２３，２，３の構成を示し、図１２、図
２０、図２１、図２２、図２３は同実施の形態における
フィルタの等価回路を示している。
【００１６】本実施の形態は、図１に示されるように低
域側帯域通過フィルタ２の入力部２Ａと高域側帯域通過
フィルタ３の入力部３Ａを接続して２帯域フィルタ１の
入力接続端子１Ａとし、また低域側帯域通過フィルタ２
の出力部２Ｂと高域側帯域通過フィルタ３の出力部３Ｂ
を接続して２帯域フィルタ１の出力接続端子１Ｂとし
て、２帯域フィルタ１を構成している。
域側帯域通過フィルタ２の入力部２Ａと高域側帯域通過
フィルタ３の入力部３Ａを接続して２帯域フィルタ１の
入力接続端子１Ａとし、また低域側帯域通過フィルタ２
の出力部２Ｂと高域側帯域通過フィルタ３の出力部３Ｂ
を接続して２帯域フィルタ１の出力接続端子１Ｂとし
て、２帯域フィルタ１を構成している。
【００１７】次に、本実施の形態は図３に示されるよう
に１０層の誘電体１１〜２０を積層した構成を有してお
り、誘電体１２，１７，２０の上面にはそれぞれシール
ドパターン１２Ａ，１７Ａ，２０Ａが設けられている。
また誘電体１３の上面には入出力容量パターン１３Ａと
ローディング容量パターン１３Ｂが、誘電体１５の上面
には入出力容量パターン１５Ａと段間容量パターン１５
Ｂがそれぞれ設けられ、さらに誘電体１４の上面には共
振器Ａ，Ｂを構成するストリップライン１４Ａ，１４Ｂ
が設けられている。
に１０層の誘電体１１〜２０を積層した構成を有してお
り、誘電体１２，１７，２０の上面にはそれぞれシール
ドパターン１２Ａ，１７Ａ，２０Ａが設けられている。
また誘電体１３の上面には入出力容量パターン１３Ａと
ローディング容量パターン１３Ｂが、誘電体１５の上面
には入出力容量パターン１５Ａと段間容量パターン１５
Ｂがそれぞれ設けられ、さらに誘電体１４の上面には共
振器Ａ，Ｂを構成するストリップライン１４Ａ，１４Ｂ
が設けられている。
【００１８】また、図２に示すように２帯域フィルタ１
０の側面には入出力容量パターン１３Ａのそれぞれにつ
ながる端面電極２０Ａ，２０Ｂが設けられている。ここ
で入出力容量パターン１３Ａはストリップライン１４
Ａ，１４Ｂと接続、または誘電体１３を介して対向して
設けられており、図１２の等価回路で示される入出力コ
ンデンサＣ１を構成している。同様にローディング容量
パターン１３Ｂはストリップライン１４Ａ，１４Ｂと誘
電体１３を介して対向することにより、ローディングコ
ンデンサＣ２を構成し、さらに段間容量パターン１５Ｂ
はストリップライン１４Ａ，１４Ｂと誘電体１４を介し
て対向することにより段間コンデンサＣ３を、またスト
リップライン１４Ａと１４Ｂは線路間結合しており、電
磁界結合Ｍを構成している。
０の側面には入出力容量パターン１３Ａのそれぞれにつ
ながる端面電極２０Ａ，２０Ｂが設けられている。ここ
で入出力容量パターン１３Ａはストリップライン１４
Ａ，１４Ｂと接続、または誘電体１３を介して対向して
設けられており、図１２の等価回路で示される入出力コ
ンデンサＣ１を構成している。同様にローディング容量
パターン１３Ｂはストリップライン１４Ａ，１４Ｂと誘
電体１３を介して対向することにより、ローディングコ
ンデンサＣ２を構成し、さらに段間容量パターン１５Ｂ
はストリップライン１４Ａ，１４Ｂと誘電体１４を介し
て対向することにより段間コンデンサＣ３を、またスト
リップライン１４Ａと１４Ｂは線路間結合しており、電
磁界結合Ｍを構成している。
【００１９】なお、図１３の等価回路は、図１２に示す
等価回路の入出力コンデンサＣ１を削除した場合であ
り、その他の構成については、図１２の等価回路と同一
なので説明を省略する。
等価回路の入出力コンデンサＣ１を削除した場合であ
り、その他の構成については、図１２の等価回路と同一
なので説明を省略する。
【００２０】すなわち、入出力容量パターン１３Ａ、ス
トリップライン１４Ａ，１４Ｂ、ローディング容量パタ
ーン１３Ｂ、段間容量パターン１５Ｂによって、図７に
示す通過帯域特性および図８に示すインピーダンス特性
を有する帯域通過フィルタ２を構成し、同様に誘電体１
８上に設けた入出力容量パターン１８Ａとローディング
容量パターン１８Ｂ、段間容量パターン１８Ｃおよび誘
電体１９上に設けたストリップライン１９Ａ，１９Ｂに
より、図１０に示す通過帯域特性および図１１に示すイ
ンピーダンス特性を有する帯域通過フィルタ３を構成し
ている。
トリップライン１４Ａ，１４Ｂ、ローディング容量パタ
ーン１３Ｂ、段間容量パターン１５Ｂによって、図７に
示す通過帯域特性および図８に示すインピーダンス特性
を有する帯域通過フィルタ２を構成し、同様に誘電体１
８上に設けた入出力容量パターン１８Ａとローディング
容量パターン１８Ｂ、段間容量パターン１８Ｃおよび誘
電体１９上に設けたストリップライン１９Ａ，１９Ｂに
より、図１０に示す通過帯域特性および図１１に示すイ
ンピーダンス特性を有する帯域通過フィルタ３を構成し
ている。
【００２１】ここでストリップライン１４Ａ，１４Ｂに
対向しないように、線路幅をストリップライン１４Ａ，
１４Ｂのストリップライン長方向に垂直方向の最小線路
幅以下とした伝送線路パターン１６Ａを誘電体１６上に
設け、端面電極２０Ａ，２０Ｂに接続してインダクタン
スを形成することにより、図１２の等価回路で示される
伝送線路ＴＬ１を構成し、図１６に示すようなインピー
ダンス特性として低域側帯域通過フィルタ２の帯域４に
おける入力インピーダンス２２Ｃとし、帯域５における
入力インピーダンス２２Ｄとし、また、入出力容量パタ
ーン１８Ａの線路長をストリップライン長方向のストリ
ップライン１９Ａの線路長の４分の１以下として、図１
９に示すようなインピーダンス特性として高域側帯域通
過フィルタ３の帯域４における入力インピーダンス２３
Ｃとし、帯域５における入力インピーダンス２３Ｄとし
ている。
対向しないように、線路幅をストリップライン１４Ａ，
１４Ｂのストリップライン長方向に垂直方向の最小線路
幅以下とした伝送線路パターン１６Ａを誘電体１６上に
設け、端面電極２０Ａ，２０Ｂに接続してインダクタン
スを形成することにより、図１２の等価回路で示される
伝送線路ＴＬ１を構成し、図１６に示すようなインピー
ダンス特性として低域側帯域通過フィルタ２の帯域４に
おける入力インピーダンス２２Ｃとし、帯域５における
入力インピーダンス２２Ｄとし、また、入出力容量パタ
ーン１８Ａの線路長をストリップライン長方向のストリ
ップライン１９Ａの線路長の４分の１以下として、図１
９に示すようなインピーダンス特性として高域側帯域通
過フィルタ３の帯域４における入力インピーダンス２３
Ｃとし、帯域５における入力インピーダンス２３Ｄとし
ている。
【００２２】以上の構成とし、低域側帯域通過フィルタ
２の入力部２Ａと高域側帯域通過フィルタ３の入力部３
Ａを接続することにより、低域通過帯域４における等価
回路は図２０のようになり、低域側帯域通過フィルタ２
の帯域４における入力インピーダンス２Ｃは、図２１の
ように２ＣＡから２ＣＢとなり、整合が得られる。また
高域通過帯域５における等価回路は図２２のようにな
り、高域側帯域通過フィルタ３の帯域５における入力イ
ンピーダンス３Ｄは、図２３のように３ＤＡから３ＤＢ
となり、整合が得られる。低域側帯域通過フィルタ２の
出力部２Ｂと高域側帯域通過フィルタ３の出力部３Ｂを
接続することにより、同様にして整合が得られる。
２の入力部２Ａと高域側帯域通過フィルタ３の入力部３
Ａを接続することにより、低域通過帯域４における等価
回路は図２０のようになり、低域側帯域通過フィルタ２
の帯域４における入力インピーダンス２Ｃは、図２１の
ように２ＣＡから２ＣＢとなり、整合が得られる。また
高域通過帯域５における等価回路は図２２のようにな
り、高域側帯域通過フィルタ３の帯域５における入力イ
ンピーダンス３Ｄは、図２３のように３ＤＡから３ＤＢ
となり、整合が得られる。低域側帯域通過フィルタ２の
出力部２Ｂと高域側帯域通過フィルタ３の出力部３Ｂを
接続することにより、同様にして整合が得られる。
【００２３】次に、図４に本発明の一実施の形態におけ
る２帯域フィルタの通過特性を示すが、前記構成により
帯域４および帯域５において通過帯域特性が得られてい
る。
る２帯域フィルタの通過特性を示すが、前記構成により
帯域４および帯域５において通過帯域特性が得られてい
る。
【００２４】また、帯域通過フィルタ２の帯域４におけ
る入力部２Ａの入力インピーダンス２Ｃのコンダクタン
スを所定の回路インピーダンスのコンダクタンスと等し
くし、帯域通過フィルタ３の帯域４における入力部３Ａ
の入力インピーダンス３Ｃを抵抗分が０の純リアクタン
ス性とすることで、損失を増加させることなく、同様の
効果が得られる。帯域５においても同様である。
る入力部２Ａの入力インピーダンス２Ｃのコンダクタン
スを所定の回路インピーダンスのコンダクタンスと等し
くし、帯域通過フィルタ３の帯域４における入力部３Ａ
の入力インピーダンス３Ｃを抵抗分が０の純リアクタン
ス性とすることで、損失を増加させることなく、同様の
効果が得られる。帯域５においても同様である。
【００２５】なお、本実施の形態では、２つの帯域通過
フィルタ２，３の入力部２Ａと３Ａ、出力部２Ｂ，３Ｂ
を接続した１入力１出力型の２帯域フィルタについて説
明したが、２つの帯域通過フィルタ２，３の入力部２Ａ
と３Ａのみを接続した図２４のような１入力２出力型の
２帯域フィルタ、２つの帯域フィルタ２，３の出力部２
Ｂと３Ｂのみを接続した図２５のような２入力１出力型
の２帯域フィルタでも同様に実現できるものである。
フィルタ２，３の入力部２Ａと３Ａ、出力部２Ｂ，３Ｂ
を接続した１入力１出力型の２帯域フィルタについて説
明したが、２つの帯域通過フィルタ２，３の入力部２Ａ
と３Ａのみを接続した図２４のような１入力２出力型の
２帯域フィルタ、２つの帯域フィルタ２，３の出力部２
Ｂと３Ｂのみを接続した図２５のような２入力１出力型
の２帯域フィルタでも同様に実現できるものである。
【００２６】また、本実施の形態では帯域通過フィルタ
を使用したが、帯域阻止フィルタを使用した場合にも、
同様にして２帯域フィルタを実現できる。
を使用したが、帯域阻止フィルタを使用した場合にも、
同様にして２帯域フィルタを実現できる。
【００２７】
【発明の効果】以上のように本発明は、２つのフィルタ
を有する２帯域フィルタにおいて、一方のフィルタの通
過あるいは阻止帯域における入力インピーダンスを考慮
し、一方のフィルタの通過あるいは阻止帯域における他
方のフィルタの入力インピーダンスを考慮して２つのフ
ィルタを並列に接続した２帯域フィルタである。そして
以上の構成とすれば、外部移相回路を付加することな
く、２つのフィルタの通過あるいは阻止帯域が得られ、
フィルタの構成を簡略化でき、形状を小型化できる。
を有する２帯域フィルタにおいて、一方のフィルタの通
過あるいは阻止帯域における入力インピーダンスを考慮
し、一方のフィルタの通過あるいは阻止帯域における他
方のフィルタの入力インピーダンスを考慮して２つのフ
ィルタを並列に接続した２帯域フィルタである。そして
以上の構成とすれば、外部移相回路を付加することな
く、２つのフィルタの通過あるいは阻止帯域が得られ、
フィルタの構成を簡略化でき、形状を小型化できる。
【図１】本発明の一実施の形態におけるフィルタの構成
図
図
【図２】同斜視図
【図３】同分解斜視図
【図４】本発明の一実施の形態におけるフィルタの通過
特性を示す図
特性を示す図
【図５】同インピーダンス特性を示す図
【図６】本発明の一実施の形態におけるフィルタの構成
素子２２を示す構成図
素子２２を示す構成図
【図７】同通過特性を示す図
【図８】同インピーダンス特性を示す図
【図９】本発明の一実施の形態におけるフィルタの構成
素子２３を示す構成図
素子２３を示す構成図
【図１０】同通過特性を示す図
【図１１】同インピーダンス特性を示す図
【図１２】本発明の一実施の形態におけるフィルタの等
価回路図
価回路図
【図１３】本発明の一実施の形態における他のフィルタ
の等価回路図
の等価回路図
【図１４】本発明の一実施の形態におけるフィルタの構
成素子２を示す構成図
成素子２を示す構成図
【図１５】同通過特性を示す図
【図１６】同インピーダンス特性を示す図
【図１７】本発明の一実施の形態におけるフィルタの構
成素子３を示す構成図
成素子３を示す構成図
【図１８】同通過特性を示す図
【図１９】同インピーダンス特性を示す図
【図２０】本発明の一実施の形態におけるフィルタの等
価回路図
価回路図
【図２１】同インピーダンス特性を示す図
【図２２】本発明の一実施の形態におけるフィルタの等
価回路図
価回路図
【図２３】同インピーダンス特性を示す図
【図２４】本発明の一実施の形態におけるフィルタの構
成図
成図
【図２５】本発明の一実施の形態におけるフィルタの構
成図
成図
【図２６】従来のフィルタの構成図
【符号の説明】 １ ２帯域フィルタ １Ａ 入力接続端子 １Ｂ 出力接続端子 ２ 低域側帯域通過フィルタ ２Ａ 入力部 ２Ｂ 出力部 ２Ｃ 低域通過帯域における低域側帯域通過フィルタの
入力インピーダンス ２Ｄ 高域通過帯域における低域側帯域通過フィルタの
入力インピーダンス ２Ｅ 低域通過帯域における低域側帯域通過フィルタの
出力インピーダンス ２Ｆ 高域通過帯域における低域側帯域通過フィルタの
出力インピーダンス ３ 高域側帯域通過フィルタ ３Ａ 入力部 ３Ｂ 出力部 ３Ｃ 低域通過帯域における高域側帯域通過フィルタの
入力インピーダンス ３Ｄ 高域通過帯域における高域側帯域通過フィルタの
入力インピーダンス ３Ｅ 低域通過帯域における高域側帯域通過フィルタの
出力インピーダンス ３Ｆ 高域通過帯域における高域側帯域通過フィルタの
出力インピーダンス
入力インピーダンス ２Ｄ 高域通過帯域における低域側帯域通過フィルタの
入力インピーダンス ２Ｅ 低域通過帯域における低域側帯域通過フィルタの
出力インピーダンス ２Ｆ 高域通過帯域における低域側帯域通過フィルタの
出力インピーダンス ３ 高域側帯域通過フィルタ ３Ａ 入力部 ３Ｂ 出力部 ３Ｃ 低域通過帯域における高域側帯域通過フィルタの
入力インピーダンス ３Ｄ 高域通過帯域における高域側帯域通過フィルタの
入力インピーダンス ３Ｅ 低域通過帯域における高域側帯域通過フィルタの
出力インピーダンス ３Ｆ 高域通過帯域における高域側帯域通過フィルタの
出力インピーダンス
───────────────────────────────────────────────────── フロントページの続き (72)発明者 石崎 俊雄 大阪府門真市大字門真1006番地 松下電器 産業株式会社内 (72)発明者 山田 徹 大阪府門真市大字門真1006番地 松下電器 産業株式会社内 (72)発明者 北沢 祥一 京都府京田辺市大住浜55−12 松下日東電 器株式会社内 Ｆターム(参考） 5J006 HA35 HB05 HB13 HB17 JA01 JA05 JA11 JA31 KA02 KA11 KA23 LA07 LA21 LA24 NA04 NB07 NC03 5J024 AA01 BA18 CA09 CA10 DA21 DA29 EA03 EA05 KA03 5K062 AB10 AE04 BB03 BB09 BC03 BC05 BF03
Claims (9)
- 【請求項１】 ２つのフィルタを有する２帯域フィルタ
において、一方のフィルタを通過あるいは阻止帯域にお
ける入力インピーダンスに基づいて構成するとともに、
他方のフィルタを一方のフィルタの通過あるいは阻止帯
域における他方のフィルタの入力インピーダンスに基づ
いて構成し、それらを並列接続した２帯域フィルタ。 - 【請求項２】 所定インピーダンスの回路系において、
一方のフィルタの通過あるいは阻止帯域における入力ア
ドミタンスのコンダクタンス成分を、回路系アドミタン
スと等しいフィルタで構成した請求項１記載の２帯域フ
ィルタ。 - 【請求項３】 一方のフィルタの通過あるいは阻止帯域
における他方のフィルタの入力インピーダンスを、抵抗
成分を有しない純リアクタンス性となるフィルタで構成
した請求項１記載の２帯域フィルタ。 - 【請求項４】 複数のシールドパターンを有する誘電体
の間に複数のストリップラインを有する誘電体と上記複
数のストリップラインに対向する入出力容量パターンま
たは接続する入出力パターンを有する誘電体層とを配
し、その誘電体層に入出力容量パターンまたは入出力パ
ターンに接続された端面電極を形成するとともに、前記
端面電極に接続された伝送線路を形成し、前記伝送線路
を前記複数のストリップラインに対向しないように設け
た請求項１記載の２帯域フィルタ。 - 【請求項５】 伝送線路のストリップライン長方向に垂
直方向の線路幅をストリップラインのストリップライン
長方向に垂直方向の最小線路幅以下とした請求項４記載
の２帯域フィルタ。 - 【請求項６】 複数のストリップラインの開放端に対向
する入出力容量パターンと伝送線路を接続する端面電極
を形成し、前記入出力容量パターンのストリップライン
長方向のパターン長をストリップライン長の４分の１以
下とした請求項４記載の２帯域フィルタ。 - 【請求項７】 ２つのフィルタの入力部を接続した入力
接続端子から入力された入力信号が、それぞれ独立に出
力される請求項１記載の２帯域フィルタ。 - 【請求項８】 ２つのフィルタにそれぞれ独立に入力信
号が入力され、前記入力信号が２つのフィルタの出力部
を接続した出力接続端子から出力される請求項１記載の
２帯域フィルタ。 - 【請求項９】 ２つのフィルタの入力部を接続した入力
接続端子から入力された入力信号が、前記２つのフィル
タの出力部を接続した出力接続端子から出力される請求
項１記載の２帯域フィルタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10298219A JP2000124705A (ja) | 1998-10-20 | 1998-10-20 | ２帯域フィルタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10298219A JP2000124705A (ja) | 1998-10-20 | 1998-10-20 | ２帯域フィルタ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000124705A true JP2000124705A (ja) | 2000-04-28 |
Family
ID=17856774
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10298219A Withdrawn JP2000124705A (ja) | 1998-10-20 | 1998-10-20 | ２帯域フィルタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000124705A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100344625B1 (ko) * | 2000-07-25 | 2002-07-25 | 삼성전기주식회사 | 지향성 커플러 |
| JP2003046358A (ja) * | 2001-05-16 | 2003-02-14 | Matsushita Electric Ind Co Ltd | 積層フィルタ、積層複合デバイス、および通信装置 |
| US7272367B2 (en) | 2003-05-15 | 2007-09-18 | Sharp Kabushiki Kaisha | Multiband filter circuit and high-frequency transmitter |
| WO2009040282A1 (de) * | 2007-09-20 | 2009-04-02 | Gigaset Communications Gmbh | Filteranordnung |
| JP2010239250A (ja) * | 2009-03-30 | 2010-10-21 | Kyocera Corp | バンドパスフィルタ |
| JPWO2022185504A1 (ja) * | 2021-03-05 | 2022-09-09 |
-
1998
- 1998-10-20 JP JP10298219A patent/JP2000124705A/ja not_active Withdrawn
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100344625B1 (ko) * | 2000-07-25 | 2002-07-25 | 삼성전기주식회사 | 지향성 커플러 |
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| JP4630517B2 (ja) * | 2001-05-16 | 2011-02-09 | パナソニック株式会社 | 積層フィルタ、積層複合デバイス、および通信装置 |
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| JP2010239250A (ja) * | 2009-03-30 | 2010-10-21 | Kyocera Corp | バンドパスフィルタ |
| JPWO2022185504A1 (ja) * | 2021-03-05 | 2022-09-09 | ||
| JP7286046B2 (ja) | 2021-03-05 | 2023-06-02 | 三菱電機株式会社 | マルチバンドフィルタ |
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