HK5294A - A data processor control unit having an interrupt service using instruction prefetch redirection - Google Patents
A data processor control unit having an interrupt service using instruction prefetch redirection Download PDFInfo
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Claims (4)
1. Verfahren zur Ausschaltung von Ausfürungszyklen bei einem datenverarbeitenden System mit einem Datenprozessor zur Befehlsausführung und mit einer Steuereinheit (10) zum Beschaffen der Befehle für den Datenprozessor, die beim Ausbleiben einer Unterbrechungsanforderung aus einem peripheren Gerät je nach Wahl im voraus geholte, normale Befehle und auf eine Unterbrechungsanforderung hin im voraus geholte Unterbrechungsbefehle beschafft, wobei vom Datenprozessor gerade keine Befehle ausgeführt werden, die dem Unterbrechungsbefehlsfluß zugeordnet sind, um in Abhängigkeit von einer Unterbrechungsanforderung eine Unterbrechungs-Serviceroutine auszuführen, und wobei eine Anforderung aus dem peripheren Gerät wahrgenommen wird, um einen Fluß normaler Befehle aus der Steuereinheit zu dem Datenprozessor zu unterbrechen, dadurch gekennzeichnet,
daß in Abhängigkeit von der Anforderung, einen normalen Befehlsfluß zu unterbrechen, ein Steuersignal (Festhalten) während einer Zeitspanne von mindestens einem Befehlszyklus beschafft wird,
daß beim Auftreten des Steuersignals (Festhalten) das Imvorausholen normaler Befehle während des mindestens einen Befehlszyklus umadressiert wird, um wenigstens einen Unterbrechungsbefehl im voraus zu holen, wobei dieser Vorgang vor der vollständigen Ausführung der vorgeholten, normalen Befehle in Gang gesetzt wird, und
daß das Imvorausholen des wenigstens einen Unterbrechungsbefehls unmittelbar nach der Zyklusdauer des Steuersignals (Festhalten) für mindestens einen Befehl umgelenkt wird, um weiterhin normale Befehle im voraus zu holen, wobei dieser Vorgang eingeleitet wird, bevor die Ausführung des wenigstens einen im voraus geholten Unterbrechungsbefehls beendet ist.
2. Verfahren des Anspruches 1, ferner dadurch gekennzeichnet, daß das Imvorausholen des wenigstens einen Unterbrechungsbefehls vor dem Decodieren in Gang gesetzt wird, ob der neueste, im voraus geholte, normale Befehl mehrere Wörter enthält, die nicht vollständig im voraus geholt sind.
3. Verfahren des Anspruches 1, ferner dadurch gekennzeichnet, daß das Imvorausholen der normalen Befehle vor der Decodierung in Gang gesetzt wird, ob der neueste, im voraus geholte Unterbrechungsbefehl mehrere Wörter enthält, die nicht vollständig im voraus geholt sind.
4. Steuereinheit (10) eines Datenprozessors zur Beschaffung im voraus geholter, normaler, für eine Ausführung durch einen Datenprozessor vorgesehener Befehle, die durch ein Unterbrechungs-Anforderungssignal unterbrochen werden können, um wenigstens einen im voraus geholten Unterbrechungsbefehl zu schaffen, während die Zyklen der Befehlsausführung, die während einer Unterbrechung allgemein verlorengehen, möglichst klein gehalten werden,
mit Programmadressen-Sammelleitungen (16) zum Übermitteln normaler Befehlsadressen und Unterbrechungs-Befehlsadressen,
mit einem Programmadressenspeicher (14), der zum wahlweisen Empfang, Speichern und Beschaffen normaler Befehlsadressen an den Programmadressen-Sammelleitungen (16) angeschlossen ist,
mit einem Speicher (30) für im voraus geholte Adressen, der zum wahlweisen Speichern und Beschaffen normaler Befehlsadressen an den Programmadressen-Sammelleitungen (16) angeschlossen ist,
mit einem Schrittschalter (28), dessen Eingang an den Programmadressen-Sammelleitungen (16) und dessen Ausgang an dem Speicher (30) für im voraus geholte Adressen angeschlossen ist, um die Befehlsadressen, die von diesem Speicher (30) gespeichert sind, wahlweise auf eine nachfolgende Befehlsadresse weiterzuschalten, gekennzeichnet
durch eine Unterbrechungs-Steuerung (34) zur Bildung eines Unterbrechungshol-Steuersignals bei der Wahrnehmung des Unterbrechungs-Anforderungssignals und vor der Decodierung, ob der neueste,im voraus geholte, normale Befehl mehrere Wörter enthält, die nicht vollständig im voraus geholt sind, wobei das Unterbrechungshol-Steuersignal eine Steuerung vornimmt, wenn ein oder mehrere vorherbestimmte Unterbrechungs-Adressen auf die Programmadressen-Sammelleitungen (16) gelangen,
durch eine Unterbrechungsadressen-Einrichtung (36), die sowohl an den Programmadressen-Sammelleitungen (16) als auch an der Unterbrechungs-Steuerung (34) angeschlossen ist, um wahlweise eine oder mehrere vorherbestimmte Unterbrechungs-Adressen in Abhängigkeit sowohl von dem Unterbrechungs-Anforderungssignal als auch von dem Unterbrechungsholsignal an die Programmadressen-Sammelleitungen (16) anzuliefern, durch einen Programmspeicher (15), dessen Eingang an den Programmadressen-Sammelleitungen (16) angeschlossen ist, und dessen Ausgang der Lieferung im voraus geholter, normaler Befehle und im voraus geholter Unterbrechungsbefehle in Abhängigkeit von normalen Befehlsadressen bzw. Unterbrechungsbefehls-Adressen dient,
durch einen ersten Befehlsspeicher (18), dessen Eingang mit dem Programmspeicher (15) und mit der Unterbrechungs-Steuerung (34) zum wahlweisen Empfang, Speichern und Liefern von Befehlen und zur Schaffung eines Unterbrechungs-Anerkenntnissignals verbunden ist, das anzeigt, daß ein Unterbrechungsbefehl gespeichert wird,
durch einen Befehlsdecodierer (22), dessen erster Eingang an dem ersten Befehlsspeicher (18) zum Empfang des Unterbrechungs-Anerkenntnissignals und dessen zweiter Eingang an dem ersten Befehlsspeicher (18) zum wahlweisen Empfang eines Befehls angeschlossen ist, und dessen Ausgang der wahlweisen Lieferung decodierter Befehle dient, und
durch einen zweiten Befehlsspeicher (24), dessen erster Eingang mit dem Ausgang des Befehlsdecodierers (22) verbunden ist, wobei ein zweiter Eingang zum Empfang des Unterbrechungs-Anerkenntnissignals, ein Ausgang zur wahlweisen Lieferung decodierter Befehle an den Datenprozessor und ein Ausgang zur Lieferung eines Steuersignals (Festhalten) während der Dauer wenigstens eines Befehlszyklus in Abhängigkeit von der Anforderung vorgesehen sind, einen normalen Befehlsfluß zu unterbrechen, um den Inhalt des Programmadressenspeichers (14) konstant zu halten.
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|---|---|
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Families Citing this family (66)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6282402A (ja) * | 1985-10-07 | 1987-04-15 | Toshiba Corp | シ−ケンス制御装置 |
| JPH0740225B2 (ja) * | 1985-12-25 | 1995-05-01 | 日本電気株式会社 | プログラムスキツプ動作制御方式 |
| JPS6398737A (ja) * | 1986-10-15 | 1988-04-30 | Mitsubishi Electric Corp | デ−タ処理装置 |
| DE3856067T2 (de) * | 1987-07-06 | 1998-06-10 | Hitachi Ltd | Datenprozessor mit einer Unterbrechungsfunktion |
| US5247628A (en) * | 1987-11-30 | 1993-09-21 | International Business Machines Corporation | Parallel processor instruction dispatch apparatus with interrupt handler |
| US5822578A (en) * | 1987-12-22 | 1998-10-13 | Sun Microsystems, Inc. | System for inserting instructions into processor instruction stream in order to perform interrupt processing |
| DE68927313T2 (de) * | 1988-06-27 | 1997-05-07 | Digital Equipment Corp | Operandenspezifiererverarbeitung |
| JPH07120278B2 (ja) * | 1988-07-04 | 1995-12-20 | 三菱電機株式会社 | データ処理装置 |
| US5019967A (en) * | 1988-07-20 | 1991-05-28 | Digital Equipment Corporation | Pipeline bubble compression in a computer system |
| US5590293A (en) * | 1988-07-20 | 1996-12-31 | Digital Equipment Corporation | Dynamic microbranching with programmable hold on condition, to programmable dynamic microbranching delay minimization |
| US5006980A (en) * | 1988-07-20 | 1991-04-09 | Digital Equipment Corporation | Pipelined digital CPU with deadlock resolution |
| US5117498A (en) * | 1988-08-19 | 1992-05-26 | Motorola, Inc. | Processer with flexible return from subroutine |
| JP2504149B2 (ja) * | 1988-12-02 | 1996-06-05 | 三菱電機株式会社 | 命令キュ―管理装置 |
| JPH0640316B2 (ja) * | 1989-04-20 | 1994-05-25 | 工業技術院長 | 演算レジスタ上でのデータ待ち合せ実現方法 |
| CA2019299C (en) * | 1989-06-22 | 2002-01-15 | Steven Frank | Multiprocessor system with multiple instruction sources |
| JPH0437927A (ja) * | 1990-06-01 | 1992-02-07 | Sony Corp | プロセッサの処理方法 |
| US5287522A (en) * | 1990-06-29 | 1994-02-15 | Bull Hn Information Systems, Inc. | External procedure invocation apparatus utilizing internal branch vector interrupts and vector address generation, in a RISC chip |
| JP2556182B2 (ja) * | 1990-08-29 | 1996-11-20 | 三菱電機株式会社 | デ−タ処理装置 |
| JPH04318654A (ja) * | 1991-02-13 | 1992-11-10 | Hewlett Packard Co <Hp> | マイクロプロセッサへの割り込みのリダイレクションシステム |
| JP2677719B2 (ja) * | 1991-05-08 | 1997-11-17 | 富士通株式会社 | 情報処理装置 |
| JP2682264B2 (ja) * | 1991-05-21 | 1997-11-26 | 日本電気株式会社 | プログラムカウンタ装置 |
| JPH04346127A (ja) | 1991-05-23 | 1992-12-02 | Sony Corp | 電子装置 |
| US5297282A (en) * | 1991-05-29 | 1994-03-22 | Toshiba America Information Systems, Inc. | Resume processing function for the OS/2 operating system |
| US5542076A (en) * | 1991-06-14 | 1996-07-30 | Digital Equipment Corporation | Method and apparatus for adaptive interrupt servicing in data processing system |
| US5355490A (en) * | 1991-06-14 | 1994-10-11 | Toshiba America Information Systems, Inc. | System and method for saving the state for advanced microprocessor operating modes |
| US5455909A (en) * | 1991-07-05 | 1995-10-03 | Chips And Technologies Inc. | Microprocessor with operation capture facility |
| WO1993006549A1 (en) * | 1991-09-19 | 1993-04-01 | Chips And Technologies, Inc. | A system for performing input and output operations to and from a processor |
| US5623665A (en) * | 1992-01-13 | 1997-04-22 | Sony Corporation | Electronic apparatus for patching a read-only memory |
| JP3230262B2 (ja) * | 1992-01-24 | 2001-11-19 | ソニー株式会社 | 電子装置及びその固定情報修正方法 |
| US5805902A (en) * | 1993-07-02 | 1998-09-08 | Elonex I.P. Holdings, Ltd. | Structure and method for issuing interrupt requests as addresses and for decoding the addresses issued as interrupt requests |
| GB2281986B (en) * | 1993-09-15 | 1997-08-06 | Advanced Risc Mach Ltd | Data processing reset |
| US5475822A (en) * | 1993-11-15 | 1995-12-12 | Motorola, Inc. | Data processing system for resuming instruction execution after an interrupt and method therefor |
| JPH07244649A (ja) * | 1994-03-08 | 1995-09-19 | Fujitsu Ltd | 割込処理分散方式 |
| US5889973A (en) * | 1995-03-31 | 1999-03-30 | Motorola, Inc. | Method and apparatus for selectively controlling interrupt latency in a data processing system |
| US6052801A (en) * | 1995-05-10 | 2000-04-18 | Intel Corporation | Method and apparatus for providing breakpoints on a selectable address range |
| US5659679A (en) * | 1995-05-30 | 1997-08-19 | Intel Corporation | Method and apparatus for providing breakpoints on taken jumps and for providing software profiling in a computer system |
| US5740413A (en) * | 1995-06-19 | 1998-04-14 | Intel Corporation | Method and apparatus for providing address breakpoints, branch breakpoints, and single stepping |
| US5621886A (en) * | 1995-06-19 | 1997-04-15 | Intel Corporation | Method and apparatus for providing efficient software debugging |
| US5687339A (en) * | 1995-09-14 | 1997-11-11 | Elan Microelectronics Corp. | Pre-reading and pre-decoding of instructions of a microprocessor within single cycle |
| US5954819A (en) * | 1996-05-17 | 1999-09-21 | National Semiconductor Corporation | Power conservation method and apparatus activated by detecting programmable signals indicative of system inactivity and excluding prefetched signals |
| US6785803B1 (en) * | 1996-11-13 | 2004-08-31 | Intel Corporation | Processor including replay queue to break livelocks |
| US5907712A (en) * | 1997-05-30 | 1999-05-25 | International Business Machines Corporation | Method for reducing processor interrupt processing time by transferring predetermined interrupt status to a system memory for eliminating PIO reads from the interrupt handler |
| US5905880A (en) * | 1997-09-29 | 1999-05-18 | Microchip Technology Incorporated | Robust multiple word instruction and method therefor |
| US5901309A (en) * | 1997-10-07 | 1999-05-04 | Telefonaktiebolaget Lm Ericsson (Publ) | Method for improved interrupt handling within a microprocessor |
| US6044430A (en) | 1997-12-17 | 2000-03-28 | Advanced Micro Devices Inc. | Real time interrupt handling for superscalar processors |
| US6275924B1 (en) * | 1998-09-15 | 2001-08-14 | Texas Instruments Incorporated | System for buffering instructions in a processor by reissuing instruction fetches during decoder stall time |
| US7401205B1 (en) * | 1999-08-13 | 2008-07-15 | Mips Technologies, Inc. | High performance RISC instruction set digital signal processor having circular buffer and looping controls |
| US6889279B2 (en) * | 2000-12-11 | 2005-05-03 | Cadence Design Systems, Inc. | Pre-stored vector interrupt handling system and method |
| US20020184566A1 (en) | 2001-06-01 | 2002-12-05 | Michael Catherwood | Register pointer trap |
| US6985986B2 (en) | 2001-06-01 | 2006-01-10 | Microchip Technology Incorporated | Variable cycle interrupt disabling |
| US7020788B2 (en) | 2001-06-01 | 2006-03-28 | Microchip Technology Incorporated | Reduced power option |
| US6952711B2 (en) | 2001-06-01 | 2005-10-04 | Microchip Technology Incorporated | Maximally negative signed fractional number multiplication |
| US7007172B2 (en) | 2001-06-01 | 2006-02-28 | Microchip Technology Incorporated | Modified Harvard architecture processor having data memory space mapped to program memory space with erroneous execution protection |
| US7003543B2 (en) | 2001-06-01 | 2006-02-21 | Microchip Technology Incorporated | Sticky z bit |
| US6976158B2 (en) | 2001-06-01 | 2005-12-13 | Microchip Technology Incorporated | Repeat instruction with interrupt |
| US6937084B2 (en) | 2001-06-01 | 2005-08-30 | Microchip Technology Incorporated | Processor with dual-deadtime pulse width modulation generator |
| US6934728B2 (en) | 2001-06-01 | 2005-08-23 | Microchip Technology Incorporated | Euclidean distance instructions |
| US6975679B2 (en) | 2001-06-01 | 2005-12-13 | Microchip Technology Incorporated | Configuration fuses for setting PWM options |
| US7467178B2 (en) | 2001-06-01 | 2008-12-16 | Microchip Technology Incorporated | Dual mode arithmetic saturation processing |
| GB2400198B (en) | 2003-04-04 | 2006-04-05 | Advanced Risc Mach Ltd | Controlling execution of a block of program instructions within a computer processing system |
| US7200719B2 (en) * | 2003-07-31 | 2007-04-03 | Freescale Semiconductor, Inc. | Prefetch control in a data processing system |
| JP4247132B2 (ja) * | 2004-01-29 | 2009-04-02 | 株式会社ルネサステクノロジ | 情報処理装置 |
| CN102141904B (zh) * | 2011-03-31 | 2014-02-12 | 杭州中天微系统有限公司 | 支持中断屏蔽指令的数据处理器 |
| CN104011684B (zh) * | 2011-12-22 | 2018-01-26 | 英特尔公司 | 具有内嵌中断服务功能的中断返回指令 |
| CN111190658B (zh) * | 2020-01-08 | 2023-02-28 | 乐鑫信息科技(上海)股份有限公司 | 一种基于片内执行且在不具有MMU的SoC片上支持应用程序动态加载的系统 |
| CN113672360B (zh) * | 2021-07-07 | 2025-03-14 | 杭州中天微系统有限公司 | 中断处理单元、相关装置和方法 |
Family Cites Families (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CA1059639A (en) * | 1975-03-26 | 1979-07-31 | Garvin W. Patterson | Instruction look ahead having prefetch concurrency and pipe line features |
| US4181934A (en) * | 1976-12-27 | 1980-01-01 | International Business Machines Corporation | Microprocessor architecture with integrated interrupts and cycle steals prioritized channel |
| US4339793A (en) * | 1976-12-27 | 1982-07-13 | International Business Machines Corporation | Function integrated, shared ALU processor apparatus and method |
| US4210960A (en) * | 1977-09-02 | 1980-07-01 | Sperry Corporation | Digital computer with overlapped operation utilizing conditional control to minimize time losses |
| EP0020931B1 (de) * | 1979-06-21 | 1984-10-10 | International Business Machines Corporation | Programmunterbrechungsvorrichtung für Datenverarbeitungsanlage mit frühzeitigem Befehlsaufruf |
| US4527237A (en) * | 1979-10-11 | 1985-07-02 | Nanodata Computer Corporation | Data processing system |
| US4402042A (en) * | 1980-11-24 | 1983-08-30 | Texas Instruments Incorporated | Microprocessor system with instruction pre-fetch |
| JPS57130998A (en) * | 1981-02-04 | 1982-08-13 | Japan Found Cancer | Human interferon-beta-gene |
| US4399507A (en) * | 1981-06-30 | 1983-08-16 | Ibm Corporation | Instruction address stack in the data memory of an instruction-pipelined processor |
| IE54592B1 (en) * | 1982-03-08 | 1989-12-06 | Genentech Inc | Anumal interferons, processes involved in their production, compositions containing them, dna sequences coding therefor and espression vehicles containing such sequences and cells transformed thereby |
| DE3220116A1 (de) * | 1982-05-28 | 1983-12-01 | Dr. Karl Thomae Gmbh, 7950 Biberach | Mikrobiologisch hergestellte (alpha)- und ss-interferone, dna-sequenzen, die fuer diese interferone codieren, mikroorganismen, die diese genetische information enthalten, und verfahren zu ihrer herstellung |
| EP0134831B1 (de) * | 1983-09-16 | 1987-01-07 | Ibm Deutschland Gmbh | Einrichtung im Befehlswerk eines Fliessbandprozessors zur Befehlsunterbrechung und -wiederholung |
| US4586130A (en) * | 1983-10-03 | 1986-04-29 | Digital Equipment Corporation | Central processing unit for a digital computer |
-
1985
- 1985-11-27 US US06/802,491 patent/US4709324A/en not_active Expired - Lifetime
-
1986
- 1986-11-04 CA CA000522157A patent/CA1265873A/en not_active Expired - Lifetime
- 1986-11-04 IL IL80499A patent/IL80499A/xx not_active IP Right Cessation
- 1986-11-10 DE DE8787900384T patent/DE3681733D1/de not_active Expired - Lifetime
- 1986-11-10 WO PCT/US1986/002466 patent/WO1987003394A1/en not_active Ceased
- 1986-11-10 JP JP62500354A patent/JPH083791B2/ja not_active Expired - Lifetime
- 1986-11-10 KR KR1019870700645A patent/KR940009100B1/ko not_active Expired - Lifetime
- 1986-11-10 EP EP87900384A patent/EP0247175B1/de not_active Expired - Lifetime
- 1986-11-10 AU AU67796/87A patent/AU6779687A/en not_active Abandoned
- 1986-11-26 CN CN86107934A patent/CN1009396B/zh not_active Expired
-
1987
- 1987-07-08 FI FI873030A patent/FI90804C/fi not_active IP Right Cessation
-
1993
- 1993-12-04 SG SG130093A patent/SG130093G/en unknown
-
1994
- 1994-01-20 HK HK52/94A patent/HK5294A/en not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| IL80499A0 (en) | 1987-02-27 |
| EP0247175A1 (de) | 1987-12-02 |
| FI90804C (fi) | 1994-03-25 |
| FI873030A7 (fi) | 1987-07-08 |
| EP0247175B1 (de) | 1991-09-25 |
| JPH083791B2 (ja) | 1996-01-17 |
| KR940009100B1 (ko) | 1994-09-29 |
| JPS63501454A (ja) | 1988-06-02 |
| FI90804B (fi) | 1993-12-15 |
| CA1265873A (en) | 1990-02-13 |
| US4709324A (en) | 1987-11-24 |
| DE3681733D1 (de) | 1991-10-31 |
| CN1009396B (zh) | 1990-08-29 |
| EP0247175A4 (de) | 1988-03-22 |
| FI873030A0 (fi) | 1987-07-08 |
| IL80499A (en) | 1990-06-10 |
| WO1987003394A1 (en) | 1987-06-04 |
| KR880700969A (ko) | 1988-04-13 |
| CN86107934A (zh) | 1987-08-12 |
| AU6779687A (en) | 1987-07-01 |
| SG130093G (en) | 1994-02-25 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| PF | Patent in force | ||
| AS | Change of ownership |
Owner name: FREESCALE SEMICONDUCTOR, INC. Free format text: FORMER OWNER(S): MOTOROLA INC |
|
| PE | Patent expired |
Effective date: 20061109 |