ES2374774A1 - Método de fabricación de dispositivos rb-igbt. - Google Patents
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Abstract
Método de fabricación de dispositivos RB-IGBT.Se presenta un método de fabricación de dispositivos IGBT, con capacidad de bloqueo en inversa. Para ello, se ha utilizado la técnica de aislamiento por trinchera donde el proceso de impurificación de la misma se ha realizado utilizando una fuente sólida con obleas de boro, resultando en un abaratamiento tanto en material de partida como en una reducción del tiempo de proceso.
Description
Método de fabricación de dispositivos
RB-IGBT.
La invención propuesta en esta Memoria de
invención se enmarca en el campo de la electrónica de
potencia. En concreto, los dispositivos IGBT ("Insulated
Gate Bipolar Transistor", en español "Transistor
bipolar de puerta aislada") fabricados en silicio con
capacidad de bloqueo en tensión inversa son dispositivos conocidos
como RB-IGBT ("Reverse Blocking
IGBT", en español "IGBT de bloqueo
inverso") y son muy similares a los dispositivos IGBT
convencionales, pero con una protección adicional en la periferia
del dispositivo que lo dota de capacidad para soportar una alta
tensión eléctrica en inversa. Desde el punto de vista del usuario,
el RB-IGBT se comporta como un interruptor
controlable que permite el paso de corriente en una dirección
(unidireccional en corriente) y el bloqueo de tensión en ambos
sentidos. Los circuitos de potencia típicos en los cuales se
requiere este tipo de dispositivos son los inversores de corriente,
los convertidores resonantes utilizados en distintas aplicaciones,
los circuitos de protección serie en líneas AC y en los
interruptores bidireccionales empleados básicamente en convertidores
matriciales. El considerable desarrollo que están experimentando los
convertidores matriciales durante los últimos años, representa,
quizás, la principal aplicación actual de los
RB-IGBT [P. W. Wheeler, J. Rodríguez, J. C. Clare,
L. Empringham, A. Weinstein. "Matrix Converters: A Technology
Review". IEEE Trans. on Industrial Electronics, Vol. 49, No. 2,
April 2002, p. 276-288]. Se trata de aplicaciones en
un gran número de dominios técnicos: energías renovables (eólica,
fotovoltaica o células de combustible), variadores de velocidad para
el control de motores de alterna (en transporte, elevadores, grúas,
prensas, industria de procesos, etc.); convertidores para
aplicaciones submarinas y de alta temperatura; convertidores para
ambientes sensibles (hospitales, centros de cálculo, etc.),
accionamientos en aplicaciones aeroespaciales (p. ej. el control de
los alerones de los aviones civiles), etc.
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En una estructura IGBT convencional, la tensión
en directo la soporta la unión pozo P/capa epitaxiada y la tensión
en inverso la unión epitaxia/substrato como se detalla en la Fig. 1
(a) donde se muestra la zona de la terminación de un dispositivo
IGBT convencional. Al cortar la oblea en dados individuales, el
extremo de la unión capa epitaxiada/substrato que soporta la tensión
en inversa queda al aire con lo cual la tensión que puede soportar
es muy baja debido al elevado campo eléctrico que se genera en dicha
superficie produciéndose elevadas corrientes de fuga. Para poder
dotar a un dispositivo IGBT de capacidad de bloqueo en inversa, es
necesario proteger la periferia del dispositivo con objeto de evitar
que dicha unión quede al aire. Para ello, se extiende verticalmente
la unión capa epitaxiada/sustrato con una región tipo P que alcanza
la superficie superior pasivada del componente.
Básicamente, existen tres técnicas para proteger
la periferia de un dispositivo IGBT y dotarlo de capacidad de
bloqueo en inversa (ánodo polarizado negativamente): aislamiento
tipo MESA, aislamiento por difusión y aislamiento por trinchera. En
la Fig. 2 se muestra esquemáticamente cada una de dichas
técnicas.
El aislamiento tipo MESA consiste en realizar
dos grabados tipo MESA a ambos lados de la línea de corte, lo
suficientemente profundo como para que se alcance la unión entre la
epitaxia y el sustrato [M. Takei, Y. Harada and K. Ueno. "600
V-IGBT with Reverse Blocking Capability".
Proceedings of 12th International Symposium on Power Semiconductor
Devices & ICs (ISPSD'01). June 2001, Osaka (Japan)]. Esta
técnica se usa principalmente para dispositivos de gran área como
los tiristores, en los cuales el ángulo de grabado y la pasivación
aseguran la capacidad de bloqueo en inversa. Aunque sería posible
proteger la superficie lateral de dispositivos más pequeños como los
IGBTs, éstos necesitarían de un substrato P^{+} grueso debido a
razones estructurales ya que el resultado es una estructura
mecánicamente débil, resultando en un compromiso entre ambos
factores. Cabe remarcar que, en este caso, el área final del
dispositivo es sumamente grande debido a la anchura de los grabados
tipo MESA tal y como se aprecia en la figura.
El aislamiento por difusión consiste en definir
una difusión tipo P en la región de la línea de corte lo
suficientemente profunda como para que llegue al substrato como se
puede ver en la Fig. 2. Esta técnica requiere de un proceso de
difusión a temperaturas extremadamente altas (>1250ºC) y un
tratamiento térmico posterior lo suficientemente largo para
conseguir que las difusiones profundas alcancen el substrato tipo P
[T. Naito, M. Takei, M. Nemoto, T. Hayashi and K. Ueno. "1200 V
Reverse Blocking IGBT with low loss for Matrix Converter".
Proceedings of 16th International Symposium on Power Semiconductor
Devices & ICs (ISPSD'04). June 2004, Kitakyushu (Japan). H.
Takahashi, M. Kaneda and T. Minato. "1200 V class Reverse Blocking
IGBT (RB-IGBT) for AC Matriz Converter".
Proceedings of 16th International Symposium on Power Semiconductor
Devices & ICs (ISPSD'04). June 2004, Kitakyushu (Japan). M.
Takei, T. Naito and K. Lleno. "Reverse Blocking IGBT for Matrix
Converter with Ultra-thin Water Technology". IEE
Proceedings on Circuits, Devices and Systems, Vol 151, No3, June
2004, pp.243-247. E.R. Motto, J.F. Donlon, M.
Tabata, H. Takahashi, Y. Yu and G. Makumdar. "Application
Characteristics of an Experimental RB-IGBT (Reverse
Blocking TGBT) Module". Proceedings of the IEEE 39^{th} Annual
Meeting Industry Applications Conference, Vol.3, October 2004, pp.
1540-1544.]. Además, al igual que en el caso de
aislamiento tipo MESA, el área del chip se incrementa notablemente
usando esta técnica debido, en este caso a la difusión lateral. Esta
es la técnica más utilizada para la definición de dispositivos
RB-IGBT. De hecho, actualmente solo existen
comercialmente tres referencias de este tipo dispositivos
RB-IGBT siendo la técnica de aislamiento utilizada
la de difusión (Véanse las Patentes 1 y 2, reseñadas más adelante).
La tensión de ruptura tanto en inversa como en polarización directa
(la característica corriente- tensión es prácticamente simétrica) es
de 1200 V y los comercializa la empresa IXYS Corporation [A.
Lindemann. "A new IGBT with Reverse Blocking Capability".
Application Note of IXYS Semiconductor GmbH Corporation. (t052804).
May 2004].
En la tecnología planar se entiende por
trinchera a un pozo realizado en la oblea de silicio mediante una
técnica de grabado apropiada. En el caso del aislamiento mediante,
el área total del chip requerida es menor, debido a que la anchura
de la trinchera de aislamiento se sitúa en torno a las 15 \mum.
Además, se requieren procesos térmicos estándar y no existe
limitación en el espesor de las obleas. Tal y como se aprecia en la
Fig. 1, esta técnica consiste en definir dos trincheras de unas 15
\mum de ancho, a ambos lados de la línea de corte y de profundidad
dependiente de la capacidad de bloqueo requerida (espesor de la capa
epitaxíada). En este sentido, para una tensión de 600 V, se requiere
una profundidad del orden de las 110 \mum. y para una tensión de
1200 V dicho valor aumenta hasta valores superiores a las 200
\mum. Además, dichas trincheras deben ser impurificadas
uniformemente tipo P en la totalidad de las paredes y
posteriormente, rellenadas con silicio policristalino. La técnica
utilizada para el impurificación en la única referencia
bibliográfica que se ha encontrado es la de implantación iónica [N.
Tokuda, M. Kaneda and T. Minato. "An ultra-small
isolation area of 600 V class Reverse Blocking IGBT with Deep Trench
Isolation process (TI-RB-IGBT)".
Proceedings of 16th International Symposium on Power Semiconductor
Devices & ICs (ISPSD'04). June 2004, Kitakyushu (Japan)]. Sin
embargo, para poder impurificar este tipo de trincheras (muy
estrechas y muy profundas) se requiere un equipo de implantación
iónica con unas características muy especiales que permitan
controlar de forma muy precisa el ángulo de incidencia de la
implantación y el ángulo de rotación de la oblea para poder
implantar uniformemente las cuatro paredes de la trinchera. Este
tipo de procesado, ciertamente, es muy costoso en tiempo y en
equipamiento necesario. En efecto, fabricar así los dispositivos
requerirá un control muy preciso de todos los parámetros
involucrados, ya que se pueden generar problemas de sombras de
implantación, efectos de acanalamiento, desuniformidad del
impurificado, baja repetitividad, etc. Además, cabe mencionar
también, el elevado precio de adquisición y mantenimiento de dichos
equipos en comparación con los utilizados para oxidaciones y
recocidos como los usados en la presente propuesta de invención
donde el impurificado se consigue utilizando obleas impurificantes
de BN.
Por consiguiente, el procedimiento de
fabricación de dispositivos IGBT presentado en esta patente de
invención constituye un abaratamiento tanto en material de partida
como en una reducción del tiempo de proceso. En el siguiente
apartado se detallará dicho proceso de fabricación que tiene como
objetivo la integración en silicio de dispositivos IGBT con
capacidad de bloqueo en inversa.
\vskip1.000000\baselineskip
- 1.
- Título de la Patente: Reverse Blocking IGBT. Número: US6727527.
- 2.
- Título de la Patente: Reverse blocking type semiconductor device and method of manufacturing the same. Número: JP2005252212.
\vskip1.000000\baselineskip
La invención que se propone en esta patente
define un proceso de fabricación para la fabricación de dispositivos
RB-IGBT. Este proceso consta de dos partes: una
primera donde se realiza el aislamiento de la periferia del
dispositivo mediante una trinchera impurificada con fuente sólida y
una segunda, donde se define la estructura IGBT convencional que
aislada mediante la trinchera, dotará al dispositivo de capacidad de
bloqueo en inversa.
\vskip1.000000\baselineskip
La realización práctica de los dispositivos
RB-IGBT implica, en primer lugar, disponer de un
proceso tecnológico estándar para la fabricación de estructuras IGBT
convencionales basado en un proceso de doble difusión. En segundo
lugar, para poder dotar al IGBT de capacidad de bloqueo en inversa,
se requiere de un proceso tecnológico adicional previo a la
definición de la estructura IGBT convencional cuyo principal
objetivo es la protección de la periferia del dispositivo. Hasta la
fecha, este proceso resultaba en un aumento considerable de la
superficie de silicio cuando se elegía la opción de grabado tipo
MESA o de difusión profunda, o bien, en un complicado y costoso
proceso de implantación iónica (necesario para introducir en el
dispositivo las impurezas necesarias), si se considera la opción de
realizar el aislamiento de la periferia mediante trincheras.
En la presente invención se ha optado por esta
última técnica de aislamiento por trinchera pero mejorando y
simplificando el proceso de impurificado de las paredes de la misma.
El hecho mismo de utilizar la técnica de aislamiento por trinchera
se debe básicamente a dos motivos: el primero hace referencia a las
ventajas mencionadas en el apartado anterior (Estado de la Técnica)
frente a otros procedimientos, y, en segundo lugar, a la viabilidad
de realizar dicho proceso con equipos estándar de grabado
disponibles en la mayoría de las actuales salas blancas de
fabricación microelectrónica. En líneas generales, el uso de esta
técnica en concreto supondrá, en términos prácticos, una disminución
considerable del área de silicio a emplear, e, igualmente, de los
costes de realización de la impurificación de la trinchera,
comparada con las existentes hasta la fecha.
Tal y como se ha comentado, la integración en
Silicio de estructuras RB-IGBT consta de dos partes
claramente diferenciadas: una primera donde se realiza el
aislamiento del dispositivo IGBT mediante trinchera y una segunda
parte donde se integra la estructura IGBT convencional.
En la Fig. 3 se muestra el diagrama de bloques
del proceso de fabricación de las estructuras
RB-IGBT.
El principal objetivo de la presente invención
se basa en la definición de trincheras profundas en el silicio, su
impurificación y posterior rellenado con silicio policristalino. Tal
y como se ha comentado anteriormente, dicho proceso es necesario
para el aislamiento de las estructuras IGBT que las dota de
capacidad de bloqueo en inversa. El primer paso consiste en la
definición de la trinchera profunda. Dicha trinchera tendrá una
profundidad superior al espesor de la capa epitaxiada tipo N de
manera que contactará la parte superior pasivada del dispositivo con
el substrato tipo P como se puede apreciar en la Fig. 1. Además,
dicha trinchera debe ser impurificada de manera uniforme en la
totalidad de la superficie de las paredes. Por esta razón, en esta
patente de invención se propone un proceso de introducción de los
átomos impureza, en la trinchera, por medio de una fuente sólida.
Dicha combinación de aislamiento por trinchera y su proceso de
impurificación con fuente sólida mejora las técnicas de aislamiento
propuestas hasta la fecha en la literatura en términos de coste,
repetitividad y uniformidad en el impurificado y disminución del
área de silicio requerida para realizar el aislamiento. Los pasos
críticos en el proceso de la formación de la trinchera son la
optimización de su anchura y profundidad, la optimización del
proceso de impurificado con fuente sólida y su posterior rellenado
con silicio policristalino.
Para optimizar el proceso de grabado de la
trinchera hay que tener en cuenta que uno de los parámetros que
definirá la anchura máxima de la trinchera será el espesor máximo de
la capa de silicio policristalino que se pueda depositar para su
posterior rellenado.
El proceso de impurificado de la trinchera
mediante una fuente sólida consiste básicamente en colocar las
obleas con impurezas de BN (nitruro de boro) entre las obleas de
proceso y realizar, en base a las simulaciones tecnológicas que se
han realizado previamente de las que se obtienen los picos y las
profundidades del impurificado, una oxidación a 1250ºC durante 20
minutos, seguido de un decapado del óxido crecido. El resultado
final de esta etapa es la obtención de una impurificación uniforme
de las paredes de las trincheras. Además, el proceso requiere
también etapas adicionales de oxidación y decapado para garantizar
una buena calidad de la superficie de las paredes de la trinchera.
La principal ventaja de esta técnica es que es un proceso estándar
de cualquier Sala Blanca con tecnología CMOS (hornos de difusión y
recocido con atmósfera controlada) que permite obtener una buena
repetitividad y uniformidad en el impurificado, en cuando a
profundidad y niveles de concentración. Además, la puesta a punto de
dicho proceso no es tan crítica como en el caso de la implantación
iónica y los equipos utilizados son mucho menos costosos que en el
caso de los implantadores iónicos.
Una vez las paredes de la trinchera han sido
impurificadas y alisadas mediante tratamientos térmicos para obtener
una buena calidad de la superficie, se deposita el espesor de
silicio policristalino necesario para rellenar la trinchera.
A continuación, una vez depositado el silicio
policristalino se graba el mismo espesor depositado con objeto de
eliminar la capa de silicio policristalino de la superficie. Una vez
la superficie del chip quede completamente limpia con el Si a la
vista se inicia el proceso estándar de fabricación de las
estructuras IGBT. Este proceso se basa en un proceso estándar de
fabricación de estructuras VDMOS/IGBT de doble difusión.
Dichas estructuras IGBT convencionales están
formadas por un número determinado de celdas básicas en paralelo y
que determinarán la capacidad en corriente del dispositivo. Además
para que el dispositivo soporte la tensión de ruptura deseada, será
necesario integrar una terminación adecuada (anillos de guarda
flotantes). Dicha terminación se puede ver en la Fig. 1 (elemento
12).
Una vez limpia la superficie del chip después de
optimizar el proceso de definición de las trincheras de aislamiento,
se crece un óxido térmico que hará las funciones de óxido de campo
inicial. A continuación, a través de un proceso fotolitográfico
estándar de depósito y revelado de resina, se graba el óxido de
campo en determinadas zonas de manera que se definen unas ventanas
que nos servirán para implantar a través de ellas especies dopantes
tipo P, en este caso boro con una concentración elevada, que
formarán los pozos profundos P^{+} de las celdas básicas. Al mismo
tiempo, mediante esta implantación se definen los anillos de guarda
flotantes de la terminación del dispositivo, necesaria para soportar
la tensión de ruptura requerida. Una vez decapada la resina, se
crece de nuevo un óxido térmico que junto con el óxido crecido
anteriormente, obtendremos un espesor final del óxido de campo de
alrededor de 7500 \ring{A}. A continuación se define el área
activa del dispositivo a través de un nuevo proceso fotolitográfico
grabando el óxido de campo. Una oxidación térmica en el rango de los
900-1000ºC, definirá el óxido de puerta, cuyo
espesor, junto con la densidad de impurezas del pozo P que se
definirá posteriormente, serán los parámetros que determinan la
tensión umbral del dispositivo fabricado. A continuación se deposita
el silicio policristalino que actuará como metal de puerta. Para
mejorar la resistividad de este material se realiza un proceso de
impurificado del silicio policristalino con POCl_{3}. Después de
un nuevo proceso fotolitográfico se graba el silicio policristalino
y se realiza una implantación con impurezas de Boro para definir el
pozo P de la celda básica, actuando de esta manera el silicio
policristalino como máscara de implantación. Una vez activadas las
impurezas del pozo P mediante un proceso térmico adecuado, se reduce
el espesor del óxido no cubierto por el silicio policristalino que
servirá de pantalla para la posterior implantación de boro altamente
impurificados a través de un nuevo proceso fotolitográfico y que
servirá para definir las zonas P^{++} de mejora de contacto de
fuente de la celda básica. Posteriormente, en el paso siguiente, se
definirán las zonas N^{+} de fuente mediante una doble
implantación con impurezas de Fósforo y Arsénico altamente
impurificados para obtener una baja resistencia del contacto de
fuente. Mediante un recocido en ambiente neutro en el rango de los
1000ºC se activan simultáneamente las impurezas de P^{++} y
N^{+} de fuente.
Después de realizar todas las implantaciones en
la cara anterior de las obleas se procede al decapado de su cara
posterior con RIE ("Reactive Ion Etching", en
español "Grabado de iones reactivos") protegiendo
aquella con resina. A continuación se deposita un óxido inter nivel
impurificado de alrededor de 1 \mum. y se le hace casi fluido a
alta temperatura durante cerca de una hora hasta lograr una
superficie homogénea. Después, mediante una máscara se realiza la
apertura de contactos con un grabado seco de los óxidos ínter nivel
y térmico. Tras la deposición de una capa metálica de Al/Cu
(aluminio/cobre) en la cara anterior, se realiza la etapa
fotolitográfica que permite grabar la metalización. A continuación
se metaliza, con esa misma aleación Al/Cu, la cara posterior de la
oblea con un espesor más fino que en la cara anterior y se procede a
su posterior recocido. La pasivación de la cara anterior de la oblea
se lleva a cabo mediante la deposición de un
óxido-nitruro de un espesor en el rango de 1 \mum.
Finalmente, mediante la técnica de
"lift-off" (en español, "grabado
mediante máscara") y utilizando la misma máscara de pasivación,
se deposita, en la cara anterior, una tricapa metálica de titanio,
níquel y oro en las zonas de contacto o pads del
dispositivo.
\vskip1.000000\baselineskip
Fig. 1 Celda básica de un IGBT (a) y de la
terminación de un RB-IGBT (b).
Fig. 2 Diferentes técnicas de protección de la
periferia de un IGBT.
Fig. 3 Esquema del proceso de fabricación de
estructuras RB-IGBT.
Fig. 4 Esquema de la región de la terminación,
aislamiento por trinchera y línea de corte de un dispositivo
RB-IGBT.
Fig. 5 Esquema detallado de la celda básica de
un dispositivo RB-IGBT.
Fig. 6 Característica I(V) de un
dispositivo RB-IGBT.
\vskip1.000000\baselineskip
Ejemplo de
realización
En primer lugar, se describe brevemente el
contenido de cada una de las figuras adjuntas, pasándose a
continuación a describir el proceso de fabricación de la
invención.
\vskip1.000000\baselineskip
Figura
1
En esta figura se muestra el corte transversal
de una estructura IGBT convencional y una RB-IGBT.
Como se puede ver, la principal diferencia reside en la inclusión de
una trinchera dopada tipo P, estrecha y profunda que alcanza el
substrato P y que dota al IGBT de capacidad de bloqueo en inversa.
Los números de referencia utilizados son:
- (1)
- Aluminio.
- (2)
- SiO_{2}.
- (3)
- Silicio policristalino.
- (4)
- Difusión N+ de fuente.
- (5)
- Difusión P+.
- (6)
- Difusión P de Pozo P (body).
- (7)
- Unión que soporta la tensión en directo.
- (8)
- Epitaxia N-.
- (9)
- Substrato P+.
- (10)
- Unión que soporta la tensión en inverso.
- (11)
- Substrato P+.
- (12)
- Anillos de guarda.
\vskip1.000000\baselineskip
Figura
2
En esta figura se muestran las diferentes
técnicas que se utilizan para proteger la periferia de los
dispositivos RB-IGBT. Se aprecia claramente como el
uso de la técnica de la trinchera reduce enormemente el área de
Silicio a utilizar, mientras que el uso de grabados tipo MESA a
ambos lados de la línea de corte es la que requiere un área mayor.
Los números de referencia utilizados en esta figura son:
- (1)
- Trinchera.
- (2)
- Difusión.
- (3)
- Mesa.
- (4)
- Línea de corte.
\vskip1.000000\baselineskip
Figura
3
En esta figura se muestra el diagrama de bloques
con las diferentes etapas secuenciales del proceso de fabricación de
los dispositivos RB-IGBT, incluyendo cada uno de los
procesos fotolitográficos necesarios.
\vskip1.000000\baselineskip
Figura
4
En esta figura se muestra un corte transversal
de la periferia de un dispositivo RB-IGBT. Para
poder soportar la tensión de ruptura requerida para el dispositivo,
se requiere el uso de técnicas de terminación. En este caso de han
usado anillos de guarda flotantes (4) y un limitador de canal (en
inglés, denominado channel stopper (3)). Entre la línea de
corte (1) y el channel stopper (3) se ha definido una
trinchera de aislamiento estrecha y profunda (2) impurificada con
boro (6) y rellena con silicio policristalino (7) y que contacta con
el substrato tipo P (9) a través de la epitaxia tipo N (8). Los
números de referencia utilizados en esta figura son:
- (1)
- Línea de corte.
- (2)
- Trinchera de aislamiento.
- (3)
- Channel stopper.
- (4)
- Anillos de guarda.
- (5)
- Terminación.
- (6)
- Difusión P+.
- (7)
- Silicio policristalino.
- (8)
- Epitaxia N-.
- (9)
- Substrato P+.
- (10)
- Área activa.
\vskip1.000000\baselineskip
Figura
5
Muestra una celda básica de un dispositivo
RB-IGBT donde los números de referencia indican las
siguientes partes:
- (1)
- Pozo profundo P^{+}.
- (2)
- Óxido de campo.
- (3)
- Óxido de puerta.
- (4)
- Silicio policristalino.
- (5)
- Pozo P (body).
- (6)
- Difusión P^{++}.
- (7)
- Difusión N^{+} de fuente.
- (8)
- Óxido intel nivel.
- (9)
- Aluminio.
- (10)
- Epitaxia N^{-}.
\vskip1.000000\baselineskip
Figura
6
En esta figura se muestra una característica
I(V) de uno de los primeros prototipos de dispositivos
RB-IGBT que se han fabricado en una Sala Blanca
donde se aprecia claramente la capacidad de bloqueo bidireccional
del dispositivo, siendo la tensión de ruptura de alrededor de 500
V.
Tal y como se ha comentado, el proceso de
fabricación de dispositivos RB-IGBT consta de dos
etapas claramente diferenciadas. Una primera donde se realiza el
proceso de definición, impurificación y rellenado de las trincheras
en la periferia del dispositivo y que dotarán al mismo de capacidad
de bloqueo en inversa. Una segunda parte, dará cuenta de la
definición de la celda básica y de la terminación del dispositivo
RB-IGBT. El número de celdas a implementar será el
que dotará al dispositivo de la capacidad en corriente deseada y la
terminación del mismo será diseñada de manera que el dispositivo
soporte la tensión de ruptura requerida, en este caso 500 V.
\vskip1.000000\baselineskip
En la Fig. 4 se muestra un esquema de la región
de la terminación, la trinchera de aislamiento y la línea de corte
de un dispositivo RB-IGBT. Se puede apreciar como la
terminación del dispositivo IGBT consta de 5 anillos de guarda y un
"channel stopper" (limitador de canal). Entre la
terminación y la línea de corte se ha realizado la trinchera de
aislamiento. Como se muestra en la figura, las paredes de la
trinchera están impurificadas con impurezas tipo P y rellenas con
silicio policristalino. Su profundidad es tal que alcanza el
substrato de manera que la estructura IGBT queda aislada de la
periferia. Para los dispositivos aquí presentados se ha optado por
una tensión de ruptura de 500 V con lo que la capa epitaxial
requerida en base a las simulaciones realizadas ha de ser de 100
\mum. Así, para poder asegurar que la trinchera alcance el
substrato se ha apuntado a una profundidad de trinchera superior al
espesor de la capa epitaxial. Para poder realizar ataques profundos
de silicio, se dispone de un equipo ALCATEL 601-E.
Se trata de un equipo especialmente diseñado para grabados profundos
tipo DRIE ("Deep Reactive Ion Etching", en
español "Grabado profundo de iones reactivos"). Este
tipo de sistemas están pensados para obtener una alta tasa de
grabado, buena uniformidad, selectividad y perfil prácticamente
vertical. Esto se consigue gracias a la ignición inductiva del
plasma (ICP, "Inductively Coupled Plasma", en
español "Plasma acoplado inductivamente") y a un
generador pulsante que polariza independientemente el substrato,
junto a unos imanes que direccionan y concentran el plasma de alta
densidad. Para realizar los ataques profundos del silicio, se han
seleccionado las condiciones óptimas de presión, concentración de
gases y tiempo de ataque, de forma que el grabado final cumpliese
las características finales requeridas.
La optimización de la parte del aislamiento por
trinchera se ha focalizado en tres partes: la optimización de la
anchura y profundidad, la optimización del proceso de impurificado
con fuente sólida y el posterior rellenado de la trinchera con
silicio policristalino.
\vskip1.000000\baselineskip
Para optimizar el proceso de grabado de la
trinchera se han realizado pruebas previas donde se han definido
trincheras de diferentes anchuras y profundidades. Hay que tener en
cuenta que uno de los parámetros que definirá la anchura máxima de
la trinchera será el espesor máximo de la capa de silicio
policristalino que se pueda depositar para su posterior rellenado.
Obviamente, también hay que tener en cuenta que cuanto más estrecha
sea la trinchera menos área de silicio se requiere, aunque también
hay que asegurar que las paredes queden impurificadas uniformemente
y la trinchera rellena con silicio policristalino. En este sentido,
en la sala blanca se han depositado espesores de silicio
policristalino de hasta 10 micras con buena repetitividad. De esta
manera, teniendo en cuenta todos estos factores, se han definido
trincheras de 12 micras obteniendo un buen rellenado con silicio
policristalino. En cuanto a la profundidad de la trinchera, ésta
dependerá de la tensión de ruptura requerida para el dispositivo,
cómo se ha expuesto en líneas precedentes. En nuestro caso, para una
tensión de ruptura de 500 V, la profundidad de la trinchera
requerida ha de ser superior al espesor de la epitaxia (100 \mum).
Se ha corroborado mediante las inspecciones al microscopio óptico de
las pruebas realizadas que la profundidad del grabado de la
trinchera depende enormemente de la anchura de la misma. Así, para
trincheras de anchura 12 micras, la profundidad obtenida es de 210
\mum, mientras que las trincheras con anchuras de 100 \mum. la
profundidad ha llegado a los 280 \mum. para unas mismas
condiciones de grabado. Por tanto, cuanto mayor sea la anchura de la
trinchera a grabar, la velocidad de ataque será también mayor.
Debido a que en los dispositivos RB-IGBT presentados
en esta memoria de invención la tensión de ruptura requerida es del
orden de los 500 V, obtenemos que para grabar una trinchera de 12
\mum. de ancho y una profundidad de 110 \mum., necesitamos un
tiempo de ataque del silicio de aproximadamente unos 45 minutos.
\vskip1.000000\baselineskip
El proceso de impurificación de la trinchera con
fuente sólida consiste básicamente en colocar las obleas
impurificantes de BN (nitruro de boro) entre las obleas de proceso y
realizar, una oxidación a 1250ºC durante 20 minutos, seguido de un
decapado del óxido crecido. El resultado final de esta etapa es la
obtención de un impurificado uniforme de las paredes de las
trincheras. Además, el proceso requiere también etapas adicionales
de oxidación y decapado para garantizar una buena calidad de la
superficie de las paredes de la trinchera. En concreto, los pasos
tecnológicos necesarios para impurificar con fuente sólida se listan
a continuación:
- -
- Oxido sacrificial de 2000 \ring{A}.
- -
- Grabado húmedo del óxido sacrificial de 2000 \ring{A}.
- -
- Oxidación a 1250ºC durante 20 minutos con obleas dopantes de BN.
- -
- Decapado del óxido crecido.
- -
- Oxidación a 800ºC durante 20 minutos.
- -
- Decapado del óxido crecido.
\vskip1.000000\baselineskip
Debido a que el grabado profundo de la trinchera
con el equipo antes mencionado deja la superficie de su pared rugosa
en exceso, la principal misión del óxido sacrificial inicial es la
de mejorar la calidad de la superficie donde a continuación se
realizará la impurificación alisando y limpiando la pared de
posibles restos de partículas del grabado seco anterior.
La principal ventaja de esta técnica es que es
un proceso estándar de cualquier sala blanca con capacidad para
fabricar tecnología CMOS (hornos de difusión y recocido) y que,
además, permite obtener una buena repetitividad y uniformidad en la
impurificación en cuando a profundidad y niveles de concentración.
Además, la puesta a punto de dicho proceso no es tan crítica como en
el caso de la implantación iónica y los equipos utilizado son mucho
menos costosos que en el caso de los implantadores iónicos.
\vskip1.000000\baselineskip
Antes de proceder al rellenado de la trinchera
con silicio policristalino se realiza una oxidación de 2500
\ring{A} a lo largo de toda la pared de la trinchera. Esta
oxidación se utiliza para aislar por completo el silicio
policristalino del interior de la trinchera con el Si tipo N de la
epitaxia. A continuación, se deposita el espesor de silicio
policristalino necesario para rellenar la trinchera. Para la
fabricación de las estructuras RB-IGBT se utilizará
un espesor de silicio policristalino de 6.5 \mum. para poder
asegurar que las trincheras de 12 \mum. de anchura queden
completamente rellenas. A continuación, una vez depositado el
silicio policristalino se graba el mismo espesor depositado con
objeto de eliminar la capa de silicio policristalino de la
superficie. Seguidamente, se graban los 2500 \ring{A} de óxido y
se deja la superficie completamente limpia con el silicio a la vista
para el posterior inicio del proceso estándar de fabricación de
dispositivos IGBT.
\vskip1.000000\baselineskip
La segunda parte del proceso de fabricación
consiste en la definición de la estructura convencional IGBT. Este
proceso se basa en un proceso estándar de fabricación de estructuras
VDMOS/IGBT de doble difusión. Dicha estructura IGBT convencional
está formada por un número determinado de celdas básicas que
determinaran la capacidad en corriente del dispositivo y una
terminación que permitirá soportar una determinada tensión de
ruptura. En la Fig. 5, se detallan las partes esenciales de la celda
básica de un IGBT.
Una vez limpia la superficie del chip después de
optimizar el proceso de definición de las trincheras de aislamiento,
se crece un óxido térmico de 6200 \ring{A} que hará las funciones
de óxido de campo inicial. A continuación, a través de un proceso
fotolitográfico estándar de depósito y revelado de resina, se graba
el óxido de campo en determinadas zonas de manera que se definen
unas ventanas que nos servirán para implantar a través de ellas
especies dopantes tipo P, en este caso boro con una concentración
elevada (4x10^{15} cm^{-2} y 100 keV), que formarán los pozos
profundos P^{+} de las celdas básicas. Al mismo tiempo, mediante
esta implantación se definen los anillos de guarda flotantes de la
terminación del dispositivo, necesaria para soportar la tensión de
ruptura requerida. En nuestro caso, para un dispositivo de 500 V el
número de anillos de guarda es de 5 más un anillo adicional N+ que
actúa como limitador de canal o "channel stopper".
Una vez decapada la resina, se crece de nuevo un
óxido térmico que junto con el óxido crecido anteriormente,
obtendremos un espesor final del óxido de campo de alrededor de 7500
\ring{A}. A continuación se define el área activa del dispositivo
a través de un nuevo proceso fotolitográfico grabando el óxido de
campo. Una oxidación térmica a 950ºC, definirá el óxido de puerta
(780 \ring{A}). Este espesor de óxido de puerta, junto con el
dopaje del pozo P que se definirá posteriormente, serán los
parámetros que determinarán la tensión umbral del dispositivo. A
continuación se depositan 6000 \ring{A} el silicio policristalino
que actuará como metal de puerta. Para mejorar la resistividad de
este material se realiza un proceso de impurificado del silicio
policristalino con POCl_{3}. Después de un nuevo proceso
fotolitográfico se graba el silicio policristalino y se realiza una
implantación con boro de 8 x 10^{15} cm^{-2} y 150 keV de
energía para definir el pozo P de la celda básica, actuando de esta
manera el silicio policristalino como máscara de implantación. Una
vez activadas las impurezas del pozo P mediante un proceso térmico,
se reduce el espesor del óxido no cubierto por el silicio
policristalino, dejando el óxido fino con un espesor de unos 400
\ring{A}. Este óxido servirá de pantalla para la posterior
implantación de boro altamente impurificado (4x10^{15} cm^{-2} y
120 keV), a través de un nuevo proceso fotolitográfico y que servirá
para definir las zonas P^{++} de mejora de contacto de fuente de
la celda básica. Después, se definirán las zonas N^{+} de fuente
mediante una doble implantación de fósforo y arsénico altamente
impurificados (1E14 cm^{-2} y 3E15 cm^{-2}, respectivamente)
para obtener una baja resistencia de contacto de fuente. Mediante un
recocido en ambiente neutro a 950ºC durante 50 min. se activan
simultáneamente las impurezas de P^{++} y N^{+} de fuente.
Después de realizar todas las implantaciones en
la cara anterior de las obleas se procede al decapado de la cara
posterior de la oblea con RIE protegiendo la cara anterior con
resina. A continuación se deposita un óxido ínter nivel BPTEOS
impurificado de 1.3 \mum. y se somete a un tratamiento térmico a
950ºC durante 50 minutos para homogeneizar la superficie y dejarla
perfectamente plana. Mediante una máscara fotolitográfica se realiza
la apertura de contactos con un grabado seco de los óxidos ínter
nivel y térmico. Tras la deposición de 3 \mum. de Al/Cu
(aluminio/cobre), se realiza la etapa fotolitográfica que permite
grabar la metalización. A continuación se metaliza la cara posterior
de la oblea con 0.5 \mum. de Al/Cu y su posterior sinterización a
350ºC. La pasivación de la cara anterior de la oblea se lleva a cabo
mediante la deposición de un óxido-nitruro de 1.1
\mum. Finalmente, mediante la técnica de
"lift-off" (en español, "Grabado
mediante máscara") y utilizando la misma máscara de pasivación,
se deposita una tricapa metálica de titanio, níquel y oro en las
zonas de contactos eléctricos o pads del dispositivo.
En la Fig. 6 se muestra la característica
I(V) de uno los primeros prototipos de dispositivos
RB-IGBT fabricados en una Sala Blanca donde se
aprecia claramente la capacidad de bloqueo bidireccional del
dispositivo, siendo la tensión de ruptura de alrededor de 500 V.
Por último, se lista a continuación una
secuencia de pasos aún más detallada del procedimiento de la
invención descrito en la Fig., 3:
- 1)
- Definición mediante grabado de las trincheras profundas en la oblea de silicio.
- 2)
- Impurificación de las trincheras, de manera uniforme, en la totalidad de las paredes de dichas trincheras.
- 3)
- Rellenado de las trincheras con silicio policristalino.
- 4)
- Crecimiento térmico de una capa de óxido de silicio en un horno de difusión a determinada temperatura y durante un tiempo de oxidación.
- 5)
- Definición, mediante implantación, de los pozos profundos P^{+} de las celdas básicas y los anillos de guarda flotantes P^{+} del dispositivo.
- 6)
- Crecimiento térmico de una capa de óxido de silicio en un horno de difusión a determinada temperatura y durante un tiempo de oxidación.
- 7)
- Definición mediante la fotolitografía del área activa del dispositivo.
- 8)
- Oxidación térmica para definir el óxido de la puerta del dispositivo.
- 9)
- Deposito de silicio policristalino.
- 10)
- Impurificado de la capa de silicio policristalino.
- 11)
- Grabado, mediante la fotolitografía, de la capa de silicio policristalino e implantación de impurezas de boro.
- 12)
- Activación de las impurezas de boro implantadas en la fase precedente en un horno de difusión.
- 13)
- Implantación de boro para definir las zonas P^{++} de mejora de la resistencia de contacto fuente en la celda básica.
- 14)
- Definición mediante la fotolitografía, de las zonas N^{+}.
- 15)
- Implantación de los elementos fósforo y arsénico para definir las zonas N+ del contacto de fuente del dispositivo.
- 16)
- Recocido en un horno térmico con atmósfera neutra para activar impurezas, P^{++} y N^{+}, simultáneamente.
- 17)
- Acción de decapado de la cara posterior de la oblea de silicio por medio de un procedimiento de reacción iónica (RIE).
- 18)
- Deposito de un óxido ínter nivel impurificado, espesor 1 micra, y calentado a temperatura próxima a su punto de fusión durante un tiempo.
- 19)
- Apertura de los contactos eléctricos.
- 20)
- Metalización de las caras anterior y posterior del dispositivo, mediante la aleación Al/Cu (aluminio/cobre) y su recocido en horno térmico.
- 21)
- Pasivación de la cara anterior del dispositivo.
- 22)
- Mediante la técnica lift-off, deposito de una capa triple de titanio, níquel y oro en la cara anterior para formar los contactos eléctricos del dispositivo.
Claims (2)
1. Método de fabricación de dispositivos
RB-IGBT (Reverse Blocking - Insulated Gate Bipolar
Transistor, o transistor bipolar de puerta aislada en tensión
inversa bloqueadora) que comprende un diseño basado en la técnica de
aislamiento por trinchera y caracterizado por los siguientes
pasos de procesado (Figura 3):
- 1.1.
- Definición mediante grabado de las trincheras profundas en la oblea de silicio,
- 1.2.
- impurificación de las trincheras, de manera uniforme, en la totalidad de las paredes de dichas trincheras,
- 1.3.
- rellenado de las trincheras con silicio policristalino,
- 1.4.
- crecimiento térmico de una capa de óxido de silicio en un horno de difusión a determinada temperatura y durante un tiempo de oxidación,
- 1.5.
- definición, mediante implantación, de los pozos profundos P^{+} de las celdas básicas y los anillos de guarda flotantes P^{+} del dispositivo,
- 1.6.
- crecimiento térmico de una capa de óxido de silicio en un horno de difusión a determinada temperatura y durante un tiempo de oxidación,
- 1.7.
- definición mediante la fotolitografía del área activa del dispositivo,
- 1.8.
- oxidación térmica para definir el óxido de la puerta del dispositivo,
- 1.9.
- deposito de silicio policristalino,
- 1.10.
- impurificado de la capa de silicio policristalino,
- 1.11.
- grabado, mediante la fotolitografía, de la capa de silicio policristalino e implantación de impurezas de boro,
- 1.12.
- activación de las impurezas de boro implantadas en la fase precedente en un horno de difusión,
- 1.13.
- implantación de boro para definir las zonas P^{++} de mejora de la resistencia de contacto fuente en la celda básica,
- 1.14.
- definición mediante la fotolitografía, de las zonas N^{+},
- 1.15.
- implantación de los elementos fósforo y arsénico para definir las zonas N+ del contacto de fuente del dispositivo,
- 1.16.
- recocido en un horno térmico con atmósfera neutra para activar impurezas, P^{++} y N^{+}, simultáneamente,
- 1.17.
- acción de decapado de la cara posterior de la oblea de silicio por medio de un procedimiento de reacción iónica (RIE),
- 1.18.
- deposito de un óxido ínter nivel impurificado, espesor 1 micra, y calentado a temperatura próxima a su punto de fusión durante un tiempo,
- 1.19.
- apertura de los contactos eléctricos,
- 1.20.
- metalización de las caras anterior y posterior del dispositivo, mediante la aleación Al/Cu (aluminio/cobre) y su recocido en horno térmico,
- 1.21.
- pasivación de la cara anterior del dispositivo,
- 1.22.
- mediante la técnica lift-off, deposito de una capa triple de titanio, níquel y oro en la cara anterior para formar los contactos eléctricos del dispositivo.
\vskip1.000000\baselineskip
2. Método de fabricación de dispositivos
RB-IGBT (Reverse Blocking - Insulated Gate Bipolar
Transistor, o transistor bipolar de puerta aislada en tensión
inversa bloqueadora) que comprende un diseño basado en la técnica de
aislamiento por trinchera descrito en la reivindicación 1, y
caracterizado, además, por nueve etapas de fotolitografía
(Figura 3) con la máscara debida, al objeto de formar las distintas
zonas activas y contactos eléctricos del dispositivo.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
ES200800799A ES2374774B1 (es) | 2008-03-18 | 2008-03-18 | Método de fabricación de dispositivos rb-igbt. |
PCT/ES2009/070043 WO2009115630A1 (es) | 2008-03-18 | 2009-02-25 | Metodo de fabricacion de dispositivos rb-igbt |
Applications Claiming Priority (1)
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---|---|---|---|
ES200800799A ES2374774B1 (es) | 2008-03-18 | 2008-03-18 | Método de fabricación de dispositivos rb-igbt. |
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---|---|
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ES2374774B1 ES2374774B1 (es) | 2013-01-30 |
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ID=41090524
Family Applications (1)
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---|---|---|---|
ES200800799A Expired - Fee Related ES2374774B1 (es) | 2008-03-18 | 2008-03-18 | Método de fabricación de dispositivos rb-igbt. |
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Country | Link |
---|---|
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WO (1) | WO2009115630A1 (es) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6103578A (en) * | 1997-02-10 | 2000-08-15 | Mitsubishi Denki Kabushiki Kaisha | Method for forming high breakdown semiconductor device |
EP1030372A2 (en) * | 1995-07-19 | 2000-08-23 | Mitsubishi Denki Kabushiki Kaisha | Method of making an IGBT device |
US20050042830A1 (en) * | 2001-12-31 | 2005-02-24 | Blanchard Richard A. | High voltage power MOSFET having a voltage sustaining region that includes Doped Columns Formed by trench etching and diffusion from regions of oppositely doped polysilicon |
-
2008
- 2008-03-18 ES ES200800799A patent/ES2374774B1/es not_active Expired - Fee Related
-
2009
- 2009-02-25 WO PCT/ES2009/070043 patent/WO2009115630A1/es active Application Filing
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
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EP1030372A2 (en) * | 1995-07-19 | 2000-08-23 | Mitsubishi Denki Kabushiki Kaisha | Method of making an IGBT device |
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Non-Patent Citations (1)
Title |
---|
TOKUDA, N.; KANEDA, M. & MINATO, T.: "An ultra-small isolation area for 600V class Reverse Blocking IGBT with Deep Trench Isolation process (TI-RB-IGBT)". Proceedings of 2004 International Symposium on Power Semiconductor Devices & ICs. Kitakyushu, Japón. Junio de 2004. Páginas 129-132. * |
Also Published As
Publication number | Publication date |
---|---|
ES2374774B1 (es) | 2013-01-30 |
WO2009115630A1 (es) | 2009-09-24 |
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