DE602004008712T2 - Speicherbandbreiten-Steuereinrichtung - Google Patents

Speicherbandbreiten-Steuereinrichtung Download PDF

Info

Publication number
DE602004008712T2
DE602004008712T2 DE602004008712T DE602004008712T DE602004008712T2 DE 602004008712 T2 DE602004008712 T2 DE 602004008712T2 DE 602004008712 T DE602004008712 T DE 602004008712T DE 602004008712 T DE602004008712 T DE 602004008712T DE 602004008712 T2 DE602004008712 T2 DE 602004008712T2
Authority
DE
Germany
Prior art keywords
buffer
memory
data
read
requests
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
DE602004008712T
Other languages
German (de)
English (en)
Other versions
DE602004008712D1 (de
Inventor
Kenichi Okuno
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Publication of DE602004008712D1 publication Critical patent/DE602004008712D1/de
Application granted granted Critical
Publication of DE602004008712T2 publication Critical patent/DE602004008712T2/de
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/16Handling requests for interconnection or transfer for access to memory bus
    • G06F13/1668Details of memory controller
    • G06F13/1673Details of memory controller using buffers

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)
  • Information Transfer Systems (AREA)
  • Communication Control (AREA)
  • Memory System (AREA)
DE602004008712T 2003-09-08 2004-09-07 Speicherbandbreiten-Steuereinrichtung Expired - Lifetime DE602004008712T2 (de)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2003315731 2003-09-08
JP2003315731A JP2005084907A (ja) 2003-09-08 2003-09-08 メモリ帯域制御装置

Publications (2)

Publication Number Publication Date
DE602004008712D1 DE602004008712D1 (de) 2007-10-18
DE602004008712T2 true DE602004008712T2 (de) 2008-06-12

Family

ID=34131940

Family Applications (1)

Application Number Title Priority Date Filing Date
DE602004008712T Expired - Lifetime DE602004008712T2 (de) 2003-09-08 2004-09-07 Speicherbandbreiten-Steuereinrichtung

Country Status (5)

Country Link
US (1) US7657711B2 (enExample)
EP (1) EP1513071B1 (enExample)
JP (1) JP2005084907A (enExample)
CN (1) CN100397374C (enExample)
DE (1) DE602004008712T2 (enExample)

Families Citing this family (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4135747B2 (ja) * 2006-04-06 2008-08-20 ソニー株式会社 データ処理装置及びフラッシュメモリへのアクセス方法
JPWO2008032711A1 (ja) * 2006-09-13 2010-01-28 パナソニック株式会社 メモリコントローラ、不揮発性記憶装置、アクセス装置、及び不揮発性記憶システム
JP4679494B2 (ja) * 2006-11-22 2011-04-27 Necシステムテクノロジー株式会社 ディスクアレイ装置システム、ディスクアレイ装置制御方法、および、プログラム
JP5045229B2 (ja) * 2007-05-14 2012-10-10 富士ゼロックス株式会社 ストレージシステム及びストレージ装置
US8250312B2 (en) 2009-04-29 2012-08-21 Micron Technology, Inc. Configurable multi-port memory devices and methods
US20120066471A1 (en) * 2010-09-14 2012-03-15 Advanced Micro Devices, Inc. Allocation of memory buffers based on preferred memory performance
US20120066444A1 (en) * 2010-09-14 2012-03-15 Advanced Micro Devices, Inc. Resolution Enhancement of Video Stream Based on Spatial and Temporal Correlation
JP5754273B2 (ja) 2011-07-11 2015-07-29 株式会社リコー メモリ制御装置、情報処理装置およびメモリ制御方法
US10216448B2 (en) 2014-09-11 2019-02-26 Hitachi, Ltd. Storage system with read request accelerator having dynamic internal data memory allocation
US10095422B2 (en) * 2016-10-28 2018-10-09 Veritas Technologies, LLC Systems and methods for allocating input/output bandwidth in storage systems
US11258877B2 (en) 2018-07-26 2022-02-22 Netapp, Inc. Methods for managing workloads in a storage system and devices thereof
US11983164B1 (en) 2022-11-17 2024-05-14 Bank Of America Corporation System and method for data community detection via data network telemetry
US12021731B1 (en) 2023-01-05 2024-06-25 Bank Of America Corporation System and method for evaluating compliance of transmitted object data via data efficiency mapping

Family Cites Families (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63132369A (ja) 1986-11-21 1988-06-04 Oki Electric Ind Co Ltd メモリ情報転送方式
JPH03273353A (ja) 1990-03-22 1991-12-04 Hitachi Ltd 通信制御装置
JP3273191B2 (ja) 1991-11-29 2002-04-08 日本電気エンジニアリング株式会社 データ転送装置
JP3364751B2 (ja) 1992-02-20 2003-01-08 日本電気エンジニアリング株式会社 データ転送システム
KR960706657A (ko) * 1993-11-30 1996-12-09 토마스 씨. 토코스 공유 메모리 시스템에서의 병행 동작을 가능하게 하고 최대화하는 방법 및 장치(method and apparatus for providing and maximizing concurrent operations in a shared memory system)
WO1995015528A1 (en) * 1993-11-30 1995-06-08 Vlsi Technology, Inc. A reallocatable memory subsystem enabling transparent transfer of memory function during upgrade
US5634004A (en) * 1994-05-16 1997-05-27 Network Programs, Inc. Directly programmable distribution element
JPH11511313A (ja) * 1995-08-16 1999-09-28 スターガイド デジタル ネットワークス,インコーポレイティド 音声信号および映像信号伝送用の帯域幅の動的割当て方法
JP3273353B2 (ja) 1995-12-21 2002-04-08 日立造船株式会社 硫酸プラント排ガスの乾式脱硫方法
US6098123A (en) 1997-05-08 2000-08-01 International Business Machines Corporation Method and apparatus for dynamic allocation of bandwidth to/from network adapter memory amongst active input/output ports
JPH10340243A (ja) 1997-06-06 1998-12-22 Hitachi Ltd 入出力データ転送システム
US6903733B1 (en) * 1997-11-24 2005-06-07 Pixelworks, Inc. Ultra-high bandwidth multi-port memory system for image scaling applications
US6339434B1 (en) * 1997-11-24 2002-01-15 Pixelworks Image scaling circuit for fixed pixed resolution display
JP2000330923A (ja) 1999-05-19 2000-11-30 Nec Corp データ転送システム及び転送方法並びに記録媒体
US6501734B1 (en) * 1999-05-24 2002-12-31 Advanced Micro Devices, Inc. Apparatus and method in a network switch for dynamically assigning memory interface slots between gigabit port and expansion port
KR100724438B1 (ko) * 2001-12-26 2007-06-04 엘지전자 주식회사 기지국 모뎀의 메모리 제어장치

Also Published As

Publication number Publication date
US7657711B2 (en) 2010-02-02
JP2005084907A (ja) 2005-03-31
EP1513071A3 (en) 2005-12-14
CN1601501A (zh) 2005-03-30
US20050086425A1 (en) 2005-04-21
DE602004008712D1 (de) 2007-10-18
EP1513071A2 (en) 2005-03-09
EP1513071B1 (en) 2007-09-05
CN100397374C (zh) 2008-06-25

Similar Documents

Publication Publication Date Title
DE69032384T2 (de) Datenpuffer
EP0951682B1 (de) IO- UND SPEICHERBUSSYSTEM FÜR DFPs SOWIE BAUSTEINE MIT ZWEI- ODER MEHRDIMENSIONALEN PROGRAMMIERBAREN ZELLSTRUKTUREN
DE69810132T2 (de) Multiport drams mit internen cache-speichern
DE69229716T2 (de) Schaltungsarchitektur zum mehrkanaligen DMA-Betrieb
DE60314347T2 (de) Betriebsmittelverwaltungsgerät
DE69727721T2 (de) Rechnervorrichtung und Bussteuerungsschema
DE69637320T2 (de) Methode und Apparat für Vermittlung, Mehrfachsendeverfahren, Multiplexierung und Demultiplexierung einer ATM-Zelle
DE2422802A1 (de) Datenverarbeitungsanlage
DE102008055892A1 (de) Abspeichern von Abschnitten eines Datenübertragungsdeskriptors in einem gecachten und einem nicht gecachten Adressbereich
DE68927795T2 (de) Übertragungssystem mit einem gemeinsamen Speicher
DE3650249T2 (de) Hochkapazitätsspeicher für Multiprozessorsystem.
DE60307798T2 (de) Arbitrierung von gemeinsamen Speicher
DE69119149T2 (de) Struktur zur direkten Speicher-zu-Speicher-Übertragung
DE102013018135B4 (de) Adressenbit-Wiederabbildungsschema zur Reduzierung einer Zugriffsauflösung von DRAM-Zugriffen
DE60009817T2 (de) Gemeinsamen Speicher verteilende Multiprozessorvorrichtung
DE2813080A1 (de) Einrichtung zur speicheradressierung
WO2006015910A1 (de) Botschaftsverwalter und verfahren zur steuerung des zugriffs auf daten eines botschaftsspeichers eines kommunikationsbausteins
EP0739509B1 (de) Anordnung mit master- und slave-einheiten
DE60009618T2 (de) Multiprozessorvorrichtung mit einer Schnittstelle für einen gemeinsamen Speicher
DE2558417A1 (de) Datenverarbeitungssystem
DE102005048581B4 (de) Teilnehmerschnittstelle zwischen einem FlexRay-Kommunikationsbaustein und einem FlexRay-Teilnehmer und Verfahren zur Übertragung von Botschaften über eine solche Schnittstelle
EP1118999A1 (de) Verfahren und Vorrichtung zum wechselweisen Betreiben eines Schreib-Lese-Speichers im Ein-Speicher-Betriebsmodus und im verschränkten Mehr-Speicher-Betriebsmodus
DE102008001739B4 (de) Verfahren zum Steuern eines Zugriffs auf Bereiche eines Speichers aus mehreren Prozessen heraus und Kommunikations-Modul mit einem Nachrichten-Speicher zur Realisierung des Verfahrens
DE602004005820T2 (de) Prozessorarray
DE69125815T2 (de) Anordnung und Verfahren zu einer variablen Datenzuweisung

Legal Events

Date Code Title Description
8364 No opposition during term of opposition