DE2638730C2 - n-Kanal-Speicher-FET, Verfahren zum Entladen des Speichergate des n-Kanal-Speicher-FET und Verwendung des n-Kanal-Speicher-FET - Google Patents
n-Kanal-Speicher-FET, Verfahren zum Entladen des Speichergate des n-Kanal-Speicher-FET und Verwendung des n-Kanal-Speicher-FETInfo
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Description
60
Die Erfindung betrifft einen n-Kanal-Speicher-FET
nach dem Hauptpatent 24 45 137, dieser n-Kanal-Speicher-FET
weist die im Oberbegriff des Anspruchs 1 b5 genannten Merkmale auf.
Bei Verwendung derartiger n-Kanal-Speicher-FETs
in der Matrix eines Programmspeichers, in der die Drain-Zonen benachbarter n-Kanal-Speicher-FETs
miteinander verbunden sind, tritt manchmal eine Störung auf, wenn das Speichergate eines bestimmten
/J-Kanal-Speicher-FET durch Zufuhr von Elektronen
mittels der Kanalinjektion aufgeladen (programmiert) wird. Diese Störung besteht darin, daß die Speichergates
benachbarter, programmierter n-Kanal-Speicher-FETs
teilweise oder ganz entladen werden, weil infolge der zwischen ihren Drain-Zonen und dem Substrat
anliegenden Spannung ein Avalanche-Durchbruch zwischen den Drain-Zonen und dem Substrat auftritt Diese
Störung, die als Nachbarwortstörung bezeichnet wird, ist in den Unterlagen des luxemburgischen Patents,
72 605 in denen auch die Lehre des Hauptpatents vorveröffentlicht ist beschrieben. Dort ist außerdem
angegeben, daß die Nachbarwortstörung dann nicht auftritt, wenn der Isolator zwischen dem Speichergate
und dem Halbleitersubstrat mindestens 45 nm dick ist
Ein n-Kanal-Speicher-FET mit einem so dicken
Isolator zwischen dem Speichergate und dem Halbleitersubstrat hat jedoch den Nachteil, daß zum
Entladen des Speichergates, also zum Löschen des n-Kanal-Speicher-FET, hohe Spannungen erforderlich
sind. Wie in den bereits genannten Unterlagen des luxemburgischen Patents angegeben ist wird zum
Löschen des π-Kanal-Speicher-FET entweder eine solche Spannung zwischen der Source- und/oder der
Drain-Zone einerseits und dem Substrat andererseits angelegt, daß ein Avalanche-Durchbruch zwischen der
Source- und/oder der Drain-Zone und dem Substrat erfolgt oder aber es wird zwischen dem Steuergate
einerseits und der Source-Zone oder dem Substrat oder der Drain-Zone eine Spannung solcher Größe angelegt,
daß das Speichergate infolge des Fowler-Nordheim-Tunneleffektes entladen wird. Sowohl die Avalanche-Durchbruchspannung
(vgl. die in Japan J. Appl. Phys., Band 13, 1974, S. 367, 368, veröffentlichten Messungen
an einem gewöhnlichen MOS-FET) als auch die für die Auslösung des Fowler-Nordheim-Tunneleffekts erforderliche
Mindestspannung nimmt mit der Dicke des Isolators zwischen dem Speichergate und dem Halbleitersubstrat
zu.
Der Erfindung liegt die Aufgabe zugrunde, den n-Kanal-Speicher-FET nach dem Hauptpatent so zu j
verbessern, daß er mit niedrigen Löschspannungen mittels des Avalanche-Effektes oder des Fowler-Nordheim-Tunneleffekts
löschbar ist und trotzdem sicher gegen Nachbarwortstörungen ist. Diese Aufgabe wird
durch die im Kennzeichen des Anspruchs 1 genannten Maßnahmen gelöst.
Da der Isolator zwischen dem Speichergate und dem Halbleitersubstrat an dem drainseitigen Ende des
Speichergate dicker ist als an dem sourceseitigen Speichergateende, ist die zur Löschung nötige Speichergate-Source-Spannung
niedriger als diejenige Speichergate-Drain-Spannung, die zu einer durch Avalanche-Effekt
bewirkten teilweise oder völligen Löschung über das drainseitige Speichergateende führt.
Eine Ausgestaltung des erfindungsgemäßen n-Kanal-Speicher-FET
und Verfahren zum Entladen seines Speichergate sind in den Unteransprüchen angegeben.
In der DE-OS 21 59 192 ist ein MNOS-Speicher-FET beschrieben, bei dem die erste Gate-Isolierschicht, die
aus S1O2 besteht im sourcenahen Bereich dünner ist als
im drainnahen Bereich. Dadurch wird die Durchbruchspannung zwischen der Drain-Zone und dem Substrat
erhöht, so daß der MNOS-Speicher-FET auch in solchen integrierten Schaltungen verwendet werden
kann, die eine höhere Drain-Substrat-Spaniiung erforjg
dem.
Die Erfindung_wird anhand der Figur näher erläutert,
'$_ welche ein der Übersichtlichkeit wegen vereinfachtes,
nicht überall maßstabsgetreues Schema eines Ausfüh- $ rungsbeispieles zeigt.
Das in der Figur gezeigte Ausführungsbeispiel eines ί n-Kanal-Speicher-FET ist im wesentlichen — abgese-■;
hen von der erfindungsgemäßen Dimensionierung des j Isolators — bereits im Hauptpatent beschrieben,
■■- weswegen die Erläuterungen hier entsprechend kurz
'. gefaßt werden dürfen. Erkennbar sind in dieser Figur die
!; Anschlußbereiche Drain-Zone D und Source-Zone S.
K Dazwischen liegt der Kanalbereich, der sowohl vom ■',"; mittels Kanalinjektion programmierbaren Speichergate
G1 als auch vom von außen steuerbaren Steuergate G 2
: ·; gesteuert wird. — Symbolisch ist in der Figur durch die
.v Andeutung eines Anschlusses gezeigt daß das Steuergate
G 2 von außen steuerbar ist wohingegen das '·■'; Speichergate G1 wegen des es allseitig umgebenden
Isolators /5 nicht ohmisch, sondern nur kapazitiv, und zwar über das Steuergate G 2, von außen steuerbar ist
Der Kanalbereich ist vom Speichergate, und auch vom Steuergate, durch Oxidschichten isoliert wobei der
Isolator zwischen dem sourcenahen Speichergatebereich einerseits und der Source-Zone andererseits nur
die relativ kleine Dicke χ 2 aufweist im Vergleich zum Isolator zwischen dem drainnahen Speichergatebereich
einerseits und Kanalbereich und Drain-Zone D andererseits — dort ist nämlich der Abstand χ 3 relativ
groß. Insbesondere kann χ 3 gemäß der Lehre des luxemburgischen Patents 72 605 so dick gewählt
werden, z. B. 60 nm dick sein, daß keine Nachbarwortstörungen zu befürchten sind — obwohl das Speichergate
G1 von der Source-Zone S den vergleichsweise sehr
viel geringeren Abstand χ 2 von z. B. nur 30 nm, also z. B. nur den halben Abstand, aufweist.
Das programmierte, also z. B. auf —10 V aufgeladene
Speichergate G 1 kann, wie bereits erwähnt, aufgrund der erfindungsgemäßen Dimensionierung des Isolators
mit niedrigen Löschspannungen auf verschiedene Weise gelöscht werden:
1. Man kann dazu die Durchbruchsspannung zwisehen Source-Zone S, ζ. B. +25 V, und Substrat HT,
z. B. —5 V, anlegen, so daß aufgrund des Avalanche-Effektes dort aufgeheizte Löcher von diesem
pn-übergang über den kleinen Abstand χ 2 zum Speichergate Gi gelangen und die dort gespeicherten
Elektronen kompensieren. Die Avalanche-Durchbruchsspannung zwischen Substrat und
Source-Zone ist besonders gering, weil der Abstand χ 2 besonders klein ist. Es empfiehlt sich oft, das
Steuergate dabei mit nichtpositiver Vorspannung, z. B. —5 V oder noch negativer, zu versorgen, damit
das Potential des Speichergate G1 während der
ganzen Löschung negativ bleibt und daher die aufgeheizten Löcher anzieht.
2. Eine Löschung mit niedrigen Löschspannungen kann auch dadurch erfolgen, daß zwischen dem
Steuergate G 2 und der Source-Zone S und/oder dem Substrat HT eine Löschspannung solcher
Polarität angelegt wird, daß die im Speichergate gespeicherte Elektronen zum Abfließen durch den t,=,
Isolator zur Source-Zone hin oder zum Substrat hin veranlaßt werden (Fowler-Nordheim-Tunnel-Effekt).
Das Speichergate G 2 kann, wie bereits z. B. durch das
luxemburgische Patent 72 605 bekannt ist insbesondere auch zum Lesen verwendet werden, indem nämlich bei
entsprechenden positiven Lesepotentialen am Steuergate GX z. B. +5 V an G2 bei 0 V an Sund 5 V an D,
der Kanal des n-Kanal-Speicher-FET leitend ist falls das Speichergate G1 ungeladen ist — aber der Kanal
nichtleitend ist falls das Speichergate G1 negativ, z. B.
auf — 10 V oder 0 V an S, D und G 2, aufgeladen ist Das
Steuergate wird darüber hinaus zur Programmierung des iJ-Kanal-Speicher-FET verwendet, indem man
während der Programmierung durch positive Potentiale am Steuergate G 2, z. B. + 25 V an G 2 bei 0 V an S und
+20 V an D, den Kanal zuverlässig in den gutleitenden Zustand steuert um so dort die Kanalinjektion zu
ermöglichen.
Falls das Speichergate G1 bzw. der von ihm
gesteuerte Kanalbereich nicht nur an die Source-Zone 5, sondern auch an die Drain-Zone D angrenzt kann die
Kanalinjektion an einer drainnahen Kanalbereichsstelle erzeugt werden, statt sie irgendwo zwischen Drain-Zone
und Source-Zone erzeugen zu müssen. Die Ausnutzung einer drainnahen Kanalbereichsstelle zur
Erzeugung der Kanalinjektion hat den Vorteil, daß dann auch die zum Programmieren notwendigen Betriebsspannungen
besonders niedrig gewählt werden können. Je näher außerdem der vom Speichergate G1
gesteuerte Kanalbereich an die Drain-Zone D heranre'cht, umso zuverlässiger wird bei einer relativ
geringen negativen Aufladung des Speichergate G 1 eine Sperrung des Kanals während des Lesens bewirkt,
bei dem, verglichen mit dem Sourcepotential, ein positives Potential an der Drain-Zone liegt.
Bei dem /7-Kanal-Speicher-FET nach der Erfindung
wird also durch die Verschiedenheit der Abstände χ 2 und χ 3 des Speichergate von den Anschlußbereichen
bzw. vom Kanalbereich erreicht, daß die Avalanche-Durchbruchspannung zwischen Source-Zone und Substrat
kleiner ist als zwischen Drain-Zone und Substrat. Dadurch kann, bei konstant gehaltenem Steuergatepotential,
das Drainpotential sehr viel positiver als das Sourcepotential gemacht werden, bevor eine drainnahe
statt sourcenahe Speichergateentladung aufgrund eines Avalanche-Effektes eintritt. Die insbesondere auf dem
drainnahen Avalanche-Effekt und/oder drainnahen Fowler-Nordheim-Tunneleffekt beruhenden Nachbarwortstörungen
sind leicht unterdrückbar, ohne daß beim Löschen, was ja durch einen sourceseitigen Effekt
erfolgt eine entsprechende Erhöhung der Löschbetriebsspannungen in Kauf genommen werden muß.
Bei dem n-Kanal-Speicher-FET nach der Erfindung
darf sogar durch Verringerung der Dicke χ 2 die Avalanche-Durchbruchspannung zwischen Source-Zone
Sund Substrat HTso stark erniedrigt werden, daß, bei 0 V an Steuergate G 2 und an Source-Zone S, das
programmierte, z.B. dann auf — 10V gegenüber der
Source-Zone Saufgeladene Speichergate G 1 durch den Avalanche-Effekt gerade noch nicht gelöscht wird,
wenn gleichzeitig an das Substrat die für den Normalbetrieb übliche Vorspannung, z. B. —5 V an HT,
angelegt wird. Dies bedeutet z. B. daß in diesem Falle die Source-ZSubstrat-Durchbruchspannung nur noch
etwas mehr als 5 V betragen muß und daß vor allem die den Fowler-Nordheim-Tunneleffekt auslösende Spannung
bei Entladung des Speichergate zur auf 0 V liegenden Source-Zone Shin nur noch etwas über 10 V
liegen muß. Ein SiCVlsolator Is darf also eine Dicke χ 2
von ca. 25 nm besitzen, ohne eine Teillöschung im
Rahmen dieser bei Normalbetrieb oft angelegten Betriebsspannungen zu bewirken.
In diesem Dimensionierungsfall wäre, bei OV am Steuergate G 2 und —5 V am Substrat HT, nur eine
Löschspannung von etwas mehr als 10 V, z. B. +15 V, an j
der Source-Zone 5 nötig, um das Speichergate G i völlig zu entladen, und zwar besonders dann, falls die
effektiv wirksame Kapazität zwischen Steuergate G 2 einerseits und Speichergate G 1 andererseits sehr viel
größer, z. B. 5mal größer, als die Eigenkapazität |U
zwischen Speichergate G 1 einerseits und Source-Zone S und Drain-Zone D und Substrat HT andererseits
ist. — Wäre statt dieser Dimensionierung die SiO2-Isolatordicke
χ 2 unter dem die Source-Zone bedeckenden Speichergatebereich gleich groß wie die SiCVIsolatordicke
χ 3 unter dem drainseitigen Ende des Speichergate G 1, nämlich z. B. ca. 60 nm, dann wäre erfahrungsgemäß
eine Löschspannung von ca. +30V an der Source-Zone 5 bei OV am Steuergate und —5 V am
Substrat nötig. Durch die Wahl des geringen Abstandes χ 2 mit z.B. ca. 25 nm, konnte hier also die
Löschspannung um ca. 15 V erniedrigt werden — und zwar ohne die Gefahr von Nachbarwortstörungen beim
Programmieren in bereits programmierten, weiteren solchen n-Kanal-Speicher-FETs zu begünstigen, solan
ge die oben angegebene, nötige Isolatormindestdicke, vgl. χ 3, zwischen Drain-Zone und Speichergate
eingehalten wird.
Die notwendige Löschmindestspannung, welche zur Löschung mittels des Fowler-Nordheim-Tunneleffektes
notwendig ist, ist bekanntlich angenähert proportional der Isolatordicke. Aufgrund dieser linearen Abhängigkeit
der Löschmindestspannung von der Isolatordicke ist es nicht schwierig, eine andere, für einen geplanten
Wert der Löschspannung günstige Isolatordicke χ 2 festzulegen,
Die bei dem /7-Kanal-Speicher-FET nach der
Erfindung nötigen, niedrigen Löschspannungen können leicht von der Randelektronik eines Speicherbausteins
geliefert werden.
Hierzu 1 Blatt Zeichnuncen
Claims (5)
1. π-Kanal-Speicher-FET mit einem Halbleitersubstrat
in dem eine Source-Zone und eine Drain-Zone ausgebildet sind, mit einem über dem
Kanalbereich zwischen Source- und Drain-Zone angeordneten, allseitig von einem Isolator umschlossenen
Speichergate und mit einem kapazitiv auf das Speichergate einwirkenden Steuergate, zur Ausübung
des Verfahrens nach Anspruch 1 des Hauptpatents 24 45 137, wobei im Betrieb das Speichergate
entweder ungeladen oder negativ aufgeladen ist, wobei ferner die negative Aufladung des Speichergate
durch Zufuhr von Elektronen vom Kanalbereich durch den Isolator hindurch zum Speichergate
erfolgt, wobei der Ladungszustand des Speichergate dadurch festgestellt wird, daß an die Drain-Zone ein
gegenüber der Source-Zone positives Potential angelegt wird und gleichzeitig dem Steuergate ein
solches Potental gegenüber der Source-Zone zügeführt wird, daß der Kanal bei ungeladenem
Speichergate leitend und bei negativ aufgeladenem Speichergate nichtleitend ist (Lesen), und wobei zur
Zufuhr von Elektronen zum Speichergate an die Drain-Zone bei mittels des Steuergate leitend
gesteuertem Kanal ein so hohes positives Potential gelegt wird, daß Elektronen im Kanalbereich eine
solche Energie erreichen, daß sie den Isolator durchdringen und zum Speichergate gelangen
(Kanalinjektion), dadurch gekennzeichnet, daß der vom Speichergate (G 1) gesteuerte Kanalbereich
an die Source-Zone ('S,)angrenzt und daß der
Isolator (Is) zwischen dem sourcenahen Speichergatebereich (G 1) einerseits und der Source-Zone (S)
andererseits dünner (x 2) ist als zwischen dem drainnahen Speichergatebereich (G 1) einerseits und
dem Kanal und der Drain-Zone (D) andererseits (x 3).
2. π-Kanal-Speicher-FET nach Anspruch 1, dadurch gekennzeichnet, daß der vom Speichergate
(G 1) gesteuerte Kanalbereich auch an die Drain-Zone (D) angrenzt.
3. Verfahren zum Entladen des Speiche, gate des
π-Kanal-Speicher-FET nach Anspruch T'oder 2, dadurch gekennzeichnet, daß zwischen der Source-Zone
(S) und dem Substrat (HT) eine solche Spannung angelegt wird, daß ein Avalanche-Durchbruch
erfolgt.
4. Verfahren zum Entladen des Speichergate des π-Kanal-Speicher-FET nach Anspruch 1 oder 2,
dadurch gekennzeichnet, daß eine zur Auslösung des Fowler-Nordheim-Tunneleffektes ausreichende
Spannung zwischen dem Steuergate (G 2) einerseits und der Source-Zone (S) und/oder dem Substrat
fW7)andererseits angelegt wird.
5. Verwendung eines π-Kanal-Speicher-FET nach Anspruch 1 oder 2 in einem Programmspeicher
eines Fernsprech-Vermittlungssystems.
Priority Applications (5)
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---|---|---|---|
DE2445137A DE2445137C3 (de) | 1974-09-20 | 1974-09-20 | Verfahren zum Betrieb eines n-Kanal-Speicher-FET, n-Kanal-Speicher-FET zur Ausübung des Verfahrens und Anwendung des Verfahrens auf die n-Kanal-Speicher-FETs einer Speichermatrix |
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