DE2621840A1

DE2621840A1 - Verfahren und schaltungsanordnung zur decodierung eines phasendifferenzsignals

Info

Publication number: DE2621840A1
Application number: DE19762621840
Authority: DE
Inventors: Kenneth Wayne Turner
Original assignee: Teletype Corp
Current assignee: AT&T Teletype Corp
Priority date: 1975-05-29
Filing date: 1976-05-17
Publication date: 1976-12-09
Also published as: US3982195A; GB1542655A; CA1055847A; JPS51147165A; IT1078815B

Description

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TELETYPE CORPORATION in Skokie, Illinois/V.St.A.

Verfahren und Schaltungsanordnung zur Decodierung eines Phasendifferenzsignals

Die Erfindung bezieht sich auf ein Verfahren zur Decodierung eines Phasendifferenzsignals, dem ein regelmäßiger, der Schrittlänge entsprechender Taktpuls überlagert ist, sowie auf eine Schaltungsanordnung zur Ausführung dieses Verfahrens.

Es sind verschiedene Systeme für die Serienübertragung von Daten innerhalb oder außerhalb eines Nachrichtenendgerätes bekanntgeworden. Bei den meisten Übertragungsverfahren wird die Information durch zwei verschiedene Zustände ausgedrückt. Man benötigt hierzu nur eine Doppelleitung, aber zusätzlich muß irgendwie für die Synchronisierung des Senders und des Empfängers gesorgt werden. Bei dem Phasendifferenzverfahren können dagegen die Daten und die Synchronisiersignale über die gleiche Doppelleitung übertragen werden. Das normale Telegrafiersignal stellt eine Serie binärer Informationen dar, bei der die beiden möglichen Zustände jeweils während eines ganzen Schritts andauern. Eine Taktinformation ist in einem solchen Signal nicht enthalten. Be^rhythmiseher Sendung muß deshalb ein gemeinsamer Schritt-Takt vorgesehen sein, um die Synchro-

Dr.Hk/Du.

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nisierung zwischen allen Stufen der Anlage aufrechtzuerhalten. In einem Datenendgerät, das solche Zustandssignale zur Informationsübertragung verwendet, benötigt man also im allgemeinen eine zusätzliche Doppelleitung für die Übertragung der Taktinformation zwischen den verschiedenen Stufen. Dadurch werden Kosten und Kompliziertheit der Übertragungsanlage erhöht. Die Übertragung der üblichen Telegrafensignale und des zugehörigen Taktsignals über Fernsprechleitungen ist schwierig und kostspielig. Außerdem können im Zweidraht-Gleichstrombetrieb keine Trenntransformatoren verwendet werden. Dies fällt insbesondere ins Gewicht, wenn private oder betriebliche Nebenstellenanlagen zur Informationsübertragung verwendet v/erden. Man benötigt dann zusätzliche Wechselstrommodulatoren und Demodulatoren, die eine weitere Erhöhung der Kosten bedeuten.

Beim Phasendifferenzsignal mit überlagertem Taktpuls tritt dagegen mindestens einmal in jedem Taktintervall (Datenschritt) ein Phasensprung auf, unabhängig von den übertragenen Daten. Wenn z. B. vier aufeinanderfolgende Stromschritte übertragen werden sollen, wird dies im Phasendifferenzsignal durch vier Phasensprünge in gleichen Abständen angezeigt. Ein Trennschritt wird durch einen zusätzlichen Phasensprung in der Mitte zwischen zwei aufeinanderfolgenden Schrittimpulsen dargestellt. So ergeben z. B. vier aufeinanderfolgende Trennschritte acht Phasensprünge, nämlich vier Übergänge an den Schrittgrenzen und vier Übergänge in der Mitte eines Schritts. Das Phasendifferenzssignal drückt also sowohl Dateninformationen, als auch die Taktinformationen aus. Die getrennte Übertragung zusätzlicher Synchronisiersignale ist infolgedessen überflüssig. Ferner können die Phasendifferenzsignale ohne weiteres mit Transformatorkopplung weitergeleitet werden, denn alle Informationen bestehen aus Zustandsänderungen.

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So kann das Phasendifferenzsignal auf normalen Fernsprechleitungen übertragen werden, ohne daß Tonfrequenzmodulatoren und Demodulatoren erforderlich sind.

Der im Kennzeichen des Anspruchs 1 angegebenen Erfindung liegt die Aufgabe zu Grunde, ein Decodiergerät für ein Phasendifferenzsignal zur Verfügung zu stellen, das einfach und zuverlässig ist und keine zusätzliche Synchronisierung benötigt. Dies wird erfindungsgemäß dadurch erreicht, daß unter Steuerung durch einen mit der Taktfrequenz synchronisierten Oszillator in der ersten Hälfte jedes Informationsschritts der Zustand des Phasendifferenzsignals abgetastet und mit dem Zustand desselben Signals in der zweiten Schritthälfte verglichen wird und daß das Vergleichsergebnis gespeichert wird.

Dieses einfache, leicht durchführbare Verfahren benötigt keinen aufwendigen lokalen Oszillator, weil die Oszillatorfrequenz ständig synchronisiert und nachgeregelt wird.

Eine bevorzugte Schaltungsanordnung zur Ausführung dieses Verfahrens enthält einen Zähler, der mit den Ausgangssignalen des Oszillators beaufschlagt wird und durch seinen Inhalt das Vergleichsergebnis ausdrückt.

Weitere vorteilhafte Ausbildungen der Schaltungsanordnung ergeben sich aus den Unteransprüchen.

Ein Ausführungsbeispiel der Erfindung wird nachstehend an Hand der Zeichnung beschrieben. Hierin sind

Fig, 1 ein schematisches Schaltbild einer Schaltungsanordnung zur Decodierung von Phasendifferenzsignalen und

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Fig. 2 A und 2B zusammen gemäß Fig. 2 Darstellungen des zeitlichen Verlaufs verschiedener Signale innerhalb der Schaltungsanordnung nach Fig. 1.

Das ankommenden Phasendifferenzsignal A wird in einem Flankendetektor 6 verarbeitet und in einem UND-Glied 8 von den Phasensprüngen 10 in der Mitte der Trennschritte (Fig. 2A) befreit. Die so gewonnene Taktinformation, die dem Schrittabstand entspricht, wird auf den einen Eingang 12 einer Phasenvergleichsstufe 14 gegeben. Der andere Eingang 16 derselben ist mit dem Ausgang eines Zählers 18 verbunden. Am Ausgang der Phasenvergleichsstufe 14 tritt ein Puls konstanter Amplitude auf, dessen Breite proportional zur Phasendifferenz zwischen den beiden Zuständen des Eingangssignals ist. Das Ausgangssignal der Phasenvergleichsstufe 14 wird über einen Tiefpaß 20 geleitet, der zur Mittelwertbildung der ankommenden Impulse dient und eine veränderliche Gleichspannung liefert, die proportional zur Phasendifferenz zwischen den beiden Eingangssignalen der Vergleichsstufe 14 ist. Der Ausgang des Tiefpasses ist mit dem Eingang eines spannungsgesteuerten Oszillators 22 verbunden. Die Frequenz des Oszillators 22 hängt also von der Steuerspannung am Ausgang des Tiefpasses 20 ab und wird infolgedessen durch die vom ankommenden Signal A abgeleitete Taktinformation gesteuert. Ferner werden verschiedene Signalzustände aus dem Zähler 18 einem Decoder 24 zugeführt, der zwei UND-Glieder 26 und 28 enthält. Ein erstes UND-Glied 26 liefert ein Signal während der ersten Hälfte eines Schritts des ankommenden Phasendifferenzsignals und beaufschlagt einen Eingang eines Abtast- und Haltekreises 30, der den Datenzustand in der ersten Hälfte des betreffenden Schrittintervalls abtastet. Diese abgetastete Information wird in einem exclusiven NOR-Glied 32 mit dem ankommenden Phasendifferenzsignal A verglichen.

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Der Ausgang des NOR-Gliedes 32 ist mit einem zweiten Abtast- und Haltekreis 34 verbunden, dessen anderer Eingang mit einem Signal vom Ausgang des zweiten UND-Gliedes 28 des Decoders 24 beaufschlagt wird; dieses Signal tritt in der zweiten Hälfte des gleichen Schrittintervalls auf. Wenn also der Zustand innerhalb des betreffenden Schritts im gesamten Schrittintervall derselbe bleibt, hat das Abtastsignal einen hohen Wert und wenn der Zustand sich ändert, weil in der Kitte des Schritts ein Phasensprung 10 auftritt, hat die abgetastete Information in der zweiten Hälfte des Grundintervalls einen niedrigen Wert, was einem Trennschritt signal entspricht. Auf diese Weise v/erden die Dateninformationen aus dem ankommenden Phasendifferenzsignal entnommen und in ein Gleichstromsignal umgesetzt. Der gesteuerte Oszillator 22 liefert an seinen Ausgängen 36 und 38 Signale, die mit der Taktinformation des Phasendifferenzsignals synchronisiert sind und zum weiteren Gebrauch innerhalb des betreffenden Gerätes zur Verfügung stehen.

Im einzelnen wird das ankommende Phasendifferenzsignal A auf den Eingang des Flankendetektors 6 gegeben. Wie Fig. 2 A zeigt, tritt in dem Signal A am Ende jedes einem Schritt entsprechenden Grundintervalls eine Zustandsänderung auf, unabhängig von der Anzahl der jeweils vorliegenden Trenn- und Stromschritte. Wie erwähnt, zeichnet sich ein Trennschritt durch eine weitere Zustandsänderung 10 in der Mitte eines Schritts aus, während ein Zeichenschritt keinen solchen Phasensprung aufweist. Am Ausgang des Flankendetektors 6 ergibt sich ein Puls C aus positiven Impulsen, die bei jeder Zustandsänderung auftreten und zwar zeigen die Impulse 42 Grundschrittübergänge und die Impulse 44 Übergänge in der Schrittmitte. Die eigentliche Dateninformation v/ird von den Mittenimpulsen 44

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geliefert, die einen Trennschritt anzeigen. Die Ausgangsimpulse des Flankendetektors 6 gelangen auf einen Eingang des UND-Gliedes 8, dessen anderer Eingang mit dem Ausgangssignal des vierstufigen Zählers 18 beaufschlagt ist.

Der als Schieberegister ausgebildete Zähler enthält die vier Stufen 48, 50, 52 und 54, deren logische Funktionen denjenigen eines Flipflops vom Typ D entsprechen. Der Zähler 18 liefert vier Ausgangssignale D, E, F und G seiner Stufen, die in Fig. 2 A und 2 B dargestellt sind. Diese Zählerbauart ist besonders günstig, da sie nach den Herstellungsmethoden der MOS-Technik bequem ausgeführt werden kann. Der dargestellte Zähler 18 hat für jeden vollständigen Zyklus acht verschiedene Zustände, wie sich aus der folgenden Wahrheitstabelle ergibt.

Ausgänge	Zählergebnis
DEFG
0 0 0 0	0
10 0 0	1
110 0	2
1110	3
1111	4
Olli	5
0 0 11	6
0 0 0 1	7

Die vier Stufen des Zählers 18 werden von den beiden komplementären Ausgangsphasen 36 und 38 des spannungsgesteuerten Oszillators 52 fortgeschaltet. Der Eingang eines zur Unterdrückung eines unzulässigen Zählerzustands dienenden NOR-Gliedes 56 ist mit dem Ausgang D der ersten Zählerstufe verbunden, während der andere Eingang dieses

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NOR-Gliedes mit dem komplementären Ausgang F der dritten Zählerstufe 52 verbunden ist. Das Ausgangssignal des NOR-Gliedes 56 geht zu einem Eingang eines zweiten NOR-Gliedes 58, dessen anderer Eingang an den Direktausgang G der letzten Schieberegisterstufe 57 angeschlossen ist und der Ausgang des zweiten NOR-Gliedes 58 am Eingang der ersten Schieberegisterstufe 48 liegt. Der dargestellte Zähler entspricht ungefähr einem vierphasigen verschränkten Ringzähler bekannter Art.

Um die Impulse 44, die von den Phasensprüngen in der Schrittmitte herrühren, aus dem Ausgangssignal des Flankendetektors 6 zu eliminieren, wird dem anderen Eingang des UND-Gliedes 8 das komplementäre Ausgangssignal der zweiten Stufe 50 des Schieberegisters zugeführt. Wie aus Fig. 2 ersichtlich ist, hat das komplementäre Ausgangssignal E der zweiten Zählerstufe 50 in der Mitte jedes Schritts und damit im Zeitpunkt des Auftretens eines etwaigen Impulses 44 stets einen niedrigen Wert und hält so auch den Ausgang des UND-Gliedes 8 im Mittelteil jedes Schrittintervalls, unabhängig vom Zustand des Eingangssignals, auf niedrigem Pegel. Das Signal E nimmt dagegen in den Zeitpunkten der regelmäßigen Taktimpulse 42 stets einen hohen Wert an. Infolgedessen hat das Ausgangssignal H des UND-Gliedes 8 in der Zeitspanne, die für die Datenimpulse zur Verfugung steht, stets einen niedrigen Wert und die Vergleichsstufe 14 wird ausschließlich mit den rhythmischen Taktimpulsen 42 versorgt. Das Signal H wird auf den Eingang 12 der Phasenvergleichsstufe 14 gegeben; am anderen Eingang 16.derselben wird das direkte Ausgangssignal G der letzten Stufe 54 des Schieberegisterzählers 18.zugeführt.

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Die Signale K und G werden verglichen und am Ausgang eines Tiefpasses 20 wird aus dem Vergleichsergebnis eine Steuerspannung abgeleitet, die auf den Steuereingang 60 des spannungsgesteuerten Oszillators 22 gegeben wird. Der Oszillator 22 ist so vorgespannt, daß in Abwesenheit einer Steuerspannung die Oszillatorfrequenz absinkt. Das Ausgangssignal des Tiefpasses 20 wirkt dieser Vorspannung entgegen und hebt die Oszillatorfrequenz so weit an, daß sie mit der Taktfrequenz des Phasendifferenzsignals übereinstimmt. Da die Ausgangsimpulse G mit dem Auftreten der Impulse H zusammenfallen sollen, ist die Oszillatorfrequenz achtmal so hoch wie die Schrittfrequenz des Phasendifferenzsignals gewählt und der Beginn eines Zählzyklus des Zählers 18 entspricht dem Auftreten eines vom Detektor festgestellten Phasensprungs der Grundperiode, also dem Signal H (Fig. 2A). Die Nennfrequenz des Osziallators 22 ist so gewählt, daß sie mit der Taktfrequenz übereinstimmt, die zur ursprünglichen Erzeugung des Phasendiff erenzsignals verwendet wurde; es könnten aber auch andere Frequenzbeziehungen angewandt werden. Kurz gesagt wird die Ausgangsfrequenz des Oszillators 22 mit der ursprünglichen Frequenz des das Differenzsignal erzeugenden Taktpulses synchronisiert und der Zählerzyklus wird seinerseits mit den Schrittübergängen des Phasendifferenzsignals synchronisiert. Das direkte und das negierte Ausgangssignal des spannungsgesteuerten Oszillators 22 werden allen Stufen 48 bis 54 des Schieberegisterzählers 18 zugeführt. Die Ausgänge bestimmter Stufen des Zählers 18 gehen zum Decoder 24, der die UND-Glieder 26 und 28 enthält.

Die Eingänge des ersten UND-Gliedes 26 werden mit dem direkten Ausgangssignal D der ersten Schieberegisterstufe 48 und mit dem komplementären Ausgangssignal E

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der zweiten Schieberegisterstufe 50 beaufschlagt. Das Ausgangssignal J dieses ersten UND-Gliedes 26 ist in Fig. 2B dargestellt und besteht aus einer Reihe regelmäßiger positiver Impulse, die jeweils in der ersten Hälfte eines Schrittintervalls des Phasendifferenzsignals A auftreten. Ebenso werden die Eingänge des zweiten UND-Gliedes 28 mit dem komplementären Ausgangssignal D der ersten Stufe 48 des Schieberegisterzählers 18 und dem komplementären Ausgangssignal E der dritten Stufe des Zählers 18 beaufschlagt. Das zweite UND-Glied 28 bildet daraus einen Puls K (Fig. 2B), dessen Impulse regelmäßig in der zweiten Hälfte des SchrittintervalIs erfolgen.

Wie erwähnt, bleibt das Niveau des Phasendifferenzsignals bei einem Stromschritt im ganzen Schrittintervall konstant, ändert sich aber in der Mitte des SchrittIntervalls, wenn ein Trennschritt vorliegt. Die Abtast-und Vergleichsstufe 30 enthält einen als MOSFET ausgebildeten Schalttransistor 62, dessen Gate-Elektrode 64 mit dem Ausgang des ersten UND-Gliedes 26 verbunden ist und dessen Source-Elektrode 66 vom eintreffenden Phasendifferenzsignal A beaufschlagt wird. Die Drain-Elektrode 68 des MOSFET ist mit der einen Belegung eines Speicherkondensators verbunden. Die andere Belegung dieses Kondensators ist geerdet. Wenn der Ausgang des UND-Gliedes 26 in der ersten Hälfte eines Schrittintervalls einen hohen Zustand annimmt, wird der Zustand des Phasendifferenzsignals A über den MOSFET 64 zum Speicherkondensator 70 durchgeschaltet, der den abgetasteten Zustand speichert. Dieses gespeicherte Ausgangssignal ist mit L bezeichnet. Die Vorder- und Hinterflanken 72 und 74 des gespeicherten Signals L sind etwas abgeschrägt, weil der Kondensator 70 sich nicht augenblicklich auflädt. Der Ausgang des ersten Abtast-

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und Haltekreises 30 ist mit dem einen Eingang des exclusiven NOR-Gliedes 32 verbunden, dessen anderer Eingang von dem eintreffenden Phasendifferenzsignal A direkt beaufschlagt wird. Ein exclusives NOR-Glied gibt bekanntlich ein niedriges Ausgangssignal, wenn beide Eingangssignale verschiedene Werte haben, und ein hohes Ausgangssignal, wenn beide Eingänge denselben Zustand annehmen (s. die nachfolgende Wahrheitstafel).

Exclusives NOR-Glied Eingang 1 Eingang 2 Ausgang

0 Ol

1 OO 0 10

Das exclusive NOR-Glied 32 liefert also ein niedriges Ausgangssignal, wenn das Phasendifferenzsignal einen Phasensprung entsprechend einem Trennschritt im Schrittintervall erleidet; andererseits bleibt das NOR-Glied 32 auf hohem Wert, wenn das Phasendifferenzsignal A entsprechend einem Stromschritt in dem betreffenden Schrittintervall konstant bleibt. Das Ausgangssignal M des exclusiven NOR-Gliedes (Fig. 2B) wird auf die Source-Elektrode 76 eines zweiten Schalttransistors 78 in MOSFET-Technik gegeben. Das Gate 80 des MOSFET wird vom Ausgangssignal K des zweiten UND-Gliedes 28 beaufschlagt. Die Drain-Elektrode 82 des MOSFET 78 ist mit einem Speicherkondensator 84 verbunden, an dem das decodierte Gleichstromsignal abgenommen werden kann. Der Ausgang des exclusiven NOR-Gliedes 32 wird nämlich von der zweiten Abtast- und Haltestufe 34 abgetastet, wenn das Ausgangssignal H des zweiten UND-Gliedes 28 einen hohen Wert besitzt. Diese Bedingung tritt während der zweiten Hälfte

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jedes Schrittintervalls ein und bleibt bis zum nächsten Abtasten bestehen. Die Ladung N des Kondensators 84 folgt also dem Signalpegel am Ausgang des NOR-Gliedes 32 während des Abtastintervalls, wenn der Ausgang des UND-Gliedes auf hohem Wert liegt; dieser Zustand wird während eines vollen SchrittintervalIs beibehalten. Wie erwähnt, ist das Ausgangssignal des exclusiven NOR-Gliedes bei Vorliegen eines Trennsignals in der zweiten Hälfte des Schrittintervalls niedrig, weil in der Mitte des Schritts ein Phasensprung stattgefunden hat, bleibt jedoch auf hohem Niveau, wenn ein Stromschritt vorliegt. Wie die Darstellung des Signals N in Fig. 2B zeigt, ist dieses Signal zwar um drei Viertel einer Schrittperiode verzögert, entspricht aber im übrigen genau der vom eintreffenden Phasendifferenzsignal A übermittelten Datenfolge, wobei ein Stromschritt durch Ladung und ein Trennschritt durch Entladung des Kondensators 84 ausgedrückt wird.

Die dargestellte Schaltungsanordnung leistet also die Decodierung des eintreffenden Phasendifferenzsignals A und erzeugt das Gleichstromsignal N, sowie ein Taktsignal B.

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Claims

Patentansprüche

1. Verfahren zur Decodierung eines Phasendifferenzsignals, dem ein regelmäßiger, der Schrittlänge entsprechender Taktpuls überlagert ist, dadurch gekennzeichnet, daß unter Steuerung durch einen mit der Taktfrequenz synchronisierten Oszillator in der ersten Hälfte jedes Informationsschrittes der Zustand des Phasendifferenzsignals (A) abgetastet und mit dem Zustand desselben Signals in der zweiten Schritthälfte verglichen wird und daß das Vergleichsergebnis gespeichert wird.

2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß zur Bildung des Synchronisiersignals für den Oszillator die in der Mitte eines Schrittes auftretenden Phasensprünge unterdrückt werden.

3. Schaltungsanordnung zur Ausführung des Verfahrens nach Anspruch 1 und 2 zur Decodierung eines binären Phasendifferenzsignals, dessen Zustände durch das Auftreten bzw. das Ausbleiben eines zusätzlichen Phasensprungs innerhalb einer durch die den Taktpuls darstellenden Phasensprünge gegebenen Schrittlänge charakterisiert ist, gekennzeichnet durch einen Flankendetektor (6) zur Feststellung der Phasensprünge, einen Oszillator (36), dessen Frequenz durch die dem Taktpuls entsprechenden

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Phasensprünge bestimmt wird, einen an den Oszillatorausgang (36, 38) angeschlossenen Zähler (18), eine dem Oszillator (22) vorgeschaltete, mit dem Zähler verbundene Impulsunterdrückungsstufe (8) zur Eliminierung der innerhalb eines Schrittintervalls auftretenden Phasensprünge und eine mit dem Zähler verbundene Stufe (24) zur Decodierung der vom eintreffenden Signal (A) dargestellten Daten.

4. Schaltungsanordnuncr nach Anspruch 3, dadurch gekennzeichnet, daß die Decodierstufe (24) einen Abtastkreis (30) zur Abtastung des Zustandes des eintreffenden Signals während eines bestimmten Zustandes des Zählers (18) und ein Vergleichsglied (32) zum Vergleich dieses abgetasteten Signalzustands mit einem später auftretenden Signalzustand enthält.

5. Schaltungsanordnung nach Anspruch 4, dadurch gekennzeichnet, daß die Decodierstufe (24) einen weiteren Abtastkreis (34) zum Abtasten des Ausgangszustandes des Vergleichsgliedes (32) während eines weiteren vorbestimmten Zählerzustandes und damit zur Bildung eines den eintreffenden Daten entsprechenden Gleichstromsignals (N) enthält.

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6. Schaltungsanordnung nach Anspruch 4 oder 5, dadurch gekennzeichnet, daß der Abtastkreis (30) so ausgebildet ist, daß er den Zustand des eintreffenden Signals in der durch den Zähler bestimmten ersten Hälfte eines Schrittintervalls abtastet.

7. Schaltungsanordnung nach Anspruch 6, dadurch gekennzeichnet, daß der zweite Abtastkreis (34) so ausgebildet ist, daß er den Ausgang des Vergleichsgliedes (32) in der durch den Zähler bestimmten zweiten Hälfte eines Schrittintervalls abtastet.

8. Schaltungsanordnung nach Anspruch 7, dadurch gekennzeichnet, daß das Vergleichsglied (32) aus einem exclusiven ODER-Glied besteht, das den Ausgang des ersten Abtastkreises (30) während des Abtastintervalls des zweiten Abtastkreises (34) mit dem eintreffenden Phasendifferenz signal (A) vergleicht.

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