DE19754874A1 - Verfahren zur Umformung eines Substrats mit Randkontakten in ein Ball Grid Array, nach diesem Verfahren hergestelltes Ball Grid Array und flexible Verdrahtung zur Umformung eines Substrats mit Randkontakten in ein Ball Grid Array - Google Patents
Verfahren zur Umformung eines Substrats mit Randkontakten in ein Ball Grid Array, nach diesem Verfahren hergestelltes Ball Grid Array und flexible Verdrahtung zur Umformung eines Substrats mit Randkontakten in ein Ball Grid ArrayInfo
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Description
Bei der Herstellung von Multichip-Modulen (MCM) also Subsy
stemen mit einem oder mehreren ungekapselten integrierten
Schaltkreisen auf einer Verdrahtung, stellt sich das Problem
der Kontaktierung dieses Moduls auf einem weiterverdrahtenden
Element. Üblicherweise werden speziell geformte Randanschlüs
se angebracht, die dann z. B. im Bügellötverfahren, mit einer
weiterverdrahtenden Leiterplatte verlötet werden. Ähnlich wie
bei gekapselten Bauelementen für die Oberflächenmontage füh
ren die steigende Anschlußzahl und der Zwang zur Miniaturi
sierung zu einem immer kleineren Anschlußraster. Dies wieder
um bereitet Schwierigkeiten bei der Montage, vom definierten
Auftrag der Lotpaste bis zum kurzschlußfreien Löten mit dem
Lötbügel.
Im Hinblick auf die vorstehend erwähnten Schwierigkeiten kom
men zunehmend sowohl für Einzelchips als auch für Multichip
module sog. Ball Grid Arrays (BGAs) zum Einsatz, bei denen
sich die Anschlüsse flächig verteilt und damit in wesentlich
gröberem Raster als bei den konventionellen Formen auf der
Unterseite des Gehäuses befinden. Jeder dieser flächig ver
teilten Anschlüsse trägt schmelzfähige Höcker, die sog.
Balls, die in einem Aufschmelzprozeß für die Verbindung mit
der Verdrahtung sorgen (vgl. DE-Z productronic 5, 1994, Sei
ten 54, 55).
Werden die Verdrahtungen der Multichip-Module in Leiterplat
tentechnologie hergestellt (sog. MCM-L), so ist das Ball Grid
Array problemlos zu realisieren. Durchkontaktierungen durch
das Substrat hindurch ermöglichen hier die flächige Anordnung
der Anschlüsse bzw. der schmelzfähigen Höcker auf der Unter
seite. Ebenso ist bei in Sintertechnik hergestellter Mehrla
genkeramik mit einer Dickschichtverdrahtung (sog. MCM-C) eine
flächige Anordnung der Anschlüsse bzw. der schmelzfähigen
Höcker möglich.
Werden die Multichip-Module jedoch durch Abscheidung von
Schichten auf ein unstrukturiertes Substrat, z. B. Keramik
hergestellt (sog. MCM-D), dann wird dieses Substrat nur Rand
kontakte auf der Oberseite für die Verbindung nach außen auf
weisen, d. h. eine Montage als Ball Grid Array ist zunächst
nicht möglich.
Aus der WO 89/10005 ist eine Chipverpackung bekannt, bei
welcher ein vorgeformtes Substrat auf der Oberseite eine Mul
de zur Aufnahme eines integrierten Schaltkreises und auf der
Unterseite vier am äußeren Rand hervorstehende Rippen auf
weist. Eine flexible Verdrahtung mit einer der Mulde entspre
chenden Aussparung wird nun auf die Oberseite des Substrats
aufgebracht und derart nach unten um die Rippen umgebogen,
daß die Enden der einzelnen Leiter im Bereich der Rippen An
schlüsse bilden. Bei diesen Anschlüssen handelt es sich je
doch um unten liegende Randkontakte, d. h. eine Realisierung
als Ball Grid Array ist auch bei dieser Technik nicht mög
lich.
Der in den Ansprüchen 1, 6, 9 angegebenen Erfindung liegt das
Problem zugrunde, ein Substrat mit Randkontakten auf einfache
Weise in ein Ball Grid Array umzuformen.
Der Erfindung liegt die Erkenntnis zugrunde, daß in Anlehnung
an die TAB-Technik (Tape Automated Bonding) eine flexible
Verdrahtung mit flächig verteilten Anschlüssen hergestellt
werden kann, wobei die von diesen Anschlüssen nach außen füh
renden Leiter freiliegende Enden besitzen, d. h. die als Trä
germaterial dienende flexible Folie ist im Endbereich der
Leiter entweder nicht vorhanden oder entfernt worden. Eine
derartig ausgebildete flexible Verdrahtung kann dann mit der
Unterseite des Substrats verbunden werden, worauf die Ränder
hoch- und umgebogen und die Enden der Leiter auf der Obersei
te des Substrats auf die Randkontakte kontaktiert werden. Zur
Fertigstellung des Ball Grid Arrays brauchen dann nur noch
schmelzfähige Höcker bzw. Balls auf die flächig verteilten
Anschlüsse der flexiblen Verdrahtung aufgebracht werden.
Durch die flexible Verdrahtung wird also eine Verarbeitung
als Ball Grid Array möglich mit all den Vorteilen, die diese
Bauform gegenüber feingerasterten Randkontakten, insbesondere
bei großen Formaten bietet. Bei Bedarf kann der Gesamtaufbau
abgedeckt, umspritzt, vergossen oder mit einer Kappe versehen
werden.
Vorteilhafte Ausgestaltungen des erfindungsgemäßen Verfahrens
zur Umformung eines Substrats mit Randkontakten in ein Ball
Grid Array sind in den Ansprüchen 2 bis 5 angegeben.
Vorteilhafte Ausgestaltungen des erfindungsgemäß aufgebauten
Ball Grid Arrays sind in den Ansprüchen 7 und 8 angegeben.
Vorteilhafte Ausgestaltungen der erfindungsgemäßen flexiblen
Verdrahtung zur Umformung eines Substrats mit Randkontakten
in ein Ball Grid Array sind in den Ansprüchen 10 bis 12 ange
geben.
Die Ausgestaltungen nach den Ansprüchen 2 und 10 ermöglichen
durch die schlitzförmige Aussparung der Trägerfolie eine be
sonders einfache Ausbildung der freiliegenden Enden der Lei
ter. Bei der Realisierung kann hier auf bewährte Methoden der
TAB-Technik zurückgegriffen werden.
Die Weiterbildungen nach den Ansprüchen 3 und 11 erleichtern
durch die zusätzliche schlitzförmige Aussparung das Umbiegen
der flexiblen Verdrahtung um die untere Kante des Substrats.
Die Ausgestaltungen nach Ansprüchen 4, 7 und 12 erleichtern
durch die Schutzwirkung des Lötstoplacks sowohl die Applika
tion von schmelzfähigen Höckern als auch die Verbindung des
fertigen Ball Grid Arrays mit einer weiterführenden Verdrah
tung.
Die Weiterbildungen nach den Ansprüchen 5 und 8 ermöglichen
eine einfache und sichere ganz flächige Verbindung zwischen
der Oberseite der Verdrahtung und der Unterseite des
Substrats.
Ein Ausführungsbeispiel der Erfindung ist in der Zeichnung
dargestellt und wird im folgenden näher beschrieben.
Es zeigen:
Fig. 1 eine Draufsicht auf eine flexible Verdrahtung zur Um
formung eines Substrats mit Randkontakten in ein Ball Grid
Array und
Fig. 2 einen teilweisen Querschnitt durch ein Substrat mit
Randkontakten, welches mit Hilfe der in Fig. 1 dargestellten
flexiblen Verdrahtung in ein Ball Grid Array umgeformt ist.
Fig. 1 zeigt eine Draufsicht auf die Unterseite einer insge
samt mit FV bezeichneten flexiblen Verdrahtung, die eine Trä
gerfolie TF, eine Vielzahl von in einem gleichmäßigen Raster
angeordneten Anschlüssen A und von diesen A nach außen füh
rende Leiter L umfaßt. Die flexible Verdrahtung FV wird in
Anlehnung an die TAB-Technik hergestellt und die Trägerfolie
TF ist dementsprechend an ihrem oberen Rand und an ihrem un
teren Rand jeweils mit einer Transportperforation TP verse
hen. Die ein sog. Grid Array bildenden Anschlüsse A sind in
nerhalb eines quadratischen Kernbereich der flexiblen Ver
drahtung FV angeordnet, wobei dieser Kernbereich in Fig. 1
durch eine strichpunktierte Linie KB aufgezeigt ist. Bei dem
in Fig. 1 dargestellten Ausführungsbeispiel ist das Leiter
bild der flexiblen Verdrahtung FV derart konzipiert, daß die
von den Anschlüssen A ausgehenden Leiter L gruppenweise nach
allen vier Seiten nach außen geführt sind und daß die frei
liegenden Enden E der Leiter jeweils über schlitzförmigen
Aussparungen SA der Tragerfolie TF münden. Zwischen den ins
gesamt vier schlitzförmigen Aussparungen SA und dem Kernbe
reich KB ist jeweils eine zusätzliche schlitzförmige Ausspa
rung ZSA in die Trägerfolie TF eingebracht.
Die Trägerfolie TF besteht aus einem hitzebeständigen Poly
mer, wie z. B. Polyimid. Die Herstellung des die Anschlüsse A
und die Leiter L umfassenden kann in konventioneller Technik,
wie z. B. in Additivtechnik in Subtraktivtechnik vorgenommen
werden. Das Leiterbild besteht aus einem elektrisch leitfähi
gen Material, vorzugsweise aus Kupfer, wobei die Bereiche der
Anschlüsse A gegebenenfalls zusätzlich mit einer galvanisch
abgeschiedenen Zinn- oder Zinn-Bleischicht versehen sein kön
nen. Die schlitzförmigen Aussparungen S und die zusätzlichen
schlitzförmigen Aussparungen ZSA können beispielsweise durch
chemisches physikalisches Atzen oder durch Laserablation in
die Trägerfolie TF eingebracht werden. Wichtig ist dabei, daß
die einzelnen die zusätzlichen schlitzförmigen Aussparungen
ZSA überquerenden Leiter L und die über die schlitzförmigen
Aussparungen A mündenden Enden E der Leiter L beim Material
abtrag nicht beschädigt werden.
Die vorstehend anhand der Fig. 1 beschriebene flexible Ver
drahtung FV hat die Aufgabe, ein Substrat mit Randkontakten
in ein Ball Grid Array umzuformen.
Fig. 2 zeigt in stark vereinfachter Darstellung einen Quer
schnitt durch ein derartiges insgesamt S bezeichnetes
Substrat, das in allen vier Randbereichen mit in gleichmäßi
gem Abstand Randkontakten RK versehen ist. Auf der Oberseite
des beispielsweise aus Keramik bestehenden Substrats S befin
den sich ein oder mehrere integrierte Schaltkreise, die in
Fig. 2 ebenso wie die nach außen zu den Randkontakten RK
führenden Leiter, nicht dargestellt sind.
Zur Umformung des Substrats S mit den Randkontakten RK in ein
Ball Grid Array BGA wird zunächst die Oberseite der flexiblen
Verdrahtung VF mittels eines Klebers K ganzflächig mit der
Unterseite des Substrats S verbunden. Diese Verbindungsfläche
zwischen Substrat S und flexibler Verdrahtung FV entspricht
dabei zumindest annähernd dem in Fig. 1 dargestellten Kern
bereich KB, so daß die vier überstehenden Randbereiche der
flexiblen Verdrahtung FV hoch- und umgebogen werden können.
Das Hochbiegen wird dabei durch die den unteren Kanten des
Substrats S zugeordneten zusätzlichen Aussparungen ZSA und
der Trägerfolie TF erleichtert. Beim Umbiegen der Randberei
che der flexiblen Verdrahtung FV um die oberen Kanten des
Substrats S werden die freien Enden E der Leiter L aufzuge
ordnete Randkontakte RK gedrückt, so daß nun zwischen den En
den E und den Randkontakten RK eine elektrisch leitende Ver
bindung hergestellt werden kann. Diese Kontaktierung kann
durch Löten mit einem Lötbügel, über Laser, Infrarotstrahlung
oder ähnlichem erfolgen, wobei das verwendete Lot einen höhe
ren Schmelzpunkt aufweisen muß, als die bei der Verarbeitung
als Ball Grid Array BGA auftretende Temperatur. Es kann aber
auch mit Methoden des Feinschweißens, also Thermokompression,
Thermosonic und Ultraschall oder auch mit Klebeverfahren kon
taktiert werden. Nach der Kontaktierung können ggf. noch
überstehende und nicht benötigte Randbereiche der flexiblen
Trägerfolie TF abgetrennt werden.
Auf die Unterseite der mit Substrat S verklebten flexiblen
Verdrahtung FV, deren Leiterbild bis auf die flächig verteil
ten Anschlüsse A mit Lötstoplack LSL abgedeckt ist, werden
Lotdepots erzeugt, indem Lotpaste aufgetragen, Kugeln appli
ziert oder Lotformteile gesetzt und umgeschmolzen werden. Nä
here Einzelheiten der Herstellung derartiger Lotdepots gehen
beispielsweise aus der DE-C-1 95 35 622 oder der US-A-5 284
287 hervor.
Mit der Applikation der Lotdepots oder Balls, die hier als
schmelzfähige Höcker H bezeichnet sind, ist eine Verarbeitung
als Ball Grid Array BGA möglich, mit all den Vorteilen, die
diese Bauform gegenüber den feingerasterten Randkontakten RK
bietet. Bei Bedarf kann der Gesamtaufbau abgedeckt, um
spritzt, vergossen oder mit einer Kappe versehen werden. Die
letztgenannte Möglichkeit ist in Fig. 2 durch eine mit SK
bezeichnete Schutzkappe aufgezeigt.
Bei dem vorstehend beschriebenen Ausführungsbeispiel sind al
le vier Randseiten des Substrats mit Randkontakten belegt.
Die Umformung in ein Ball Grid Array kann jedoch in analoger
Weise auch dann vorgenommen werden, wenn nur eine Randseite
mit Randkontakten belegt ist oder wenn zwei oder drei Rand
seiten mit Randkontakten belegt sind.
Claims (12)
1. Verfahren zur Umformung eines Substrats (S) mit Randkon
takten (RK) in ein Ball Grid Array (BGA), mit folgenden
Schritten:
- - Herstellung einer flexiblen Verdrahtung (FV), die auf der Unterseite flächig angeordnete Anschlüsse (A) zur Aufnahme von schmelzfähigen Höckern (H) aufweist und deren von den Anschlüssen (A) nach außen führende Leiter (L) freiliegende Enden (E) besitzen;
- - Verbinden der Oberseite der flexiblen Verdrahtung (FV) mit der Unterseite des Substrats (S);
- - Hoch- und Umbiegen des über das Substrat (S) hinaus ragenden Randbereichs der flexiblen Verdrahtung (FV), derart, daß die freiliegenden Enden (E) der Leiter (L) über zugeordneten Randkontakten (RK) des Substrats (S) liegen;
- - Herstellung einer elektrisch leitenden Verbindung zwischen den freien Enden (E) der Leiter (L) und den zugeordneten Randkontakten (RK) des Substrats (S).
2. Verfahren nach Anspruch 1,
dadurch gekennzeichnet,
daß die Trägerfolie (TF) der flexiblen Verdrahtung ((FV) im
Endbereich der Leiter (L) mit einer schlitzförmigen Ausspa
rung (SA) versehen wird.
3. Verfahren nach Anspruch 1 oder 2,
dadurch gekennzeichnet,
daß die Trägerfolie (TF) der flexiblen Verdrahtung (FV) in
dem einer unteren Kante des Substrats (S) zugeordneten Be
reich mit einer zusätzlichen schlitzförmigen Aussparung (ZSA)
versehen wird.
4. Verfahren nach einem der Ansprüche 1 bis 31
dadurch gekennzeichnet,
daß das Leiterbild der flexiblen Verdrahtung (FV) mit Ausnah
me der flächig angeordneten Anschlüsse (A) mit einem Lötstop
lack (LSL) abgedeckt wird.
5. Verfahren nach einem der Ansprüche 1 bis 4,
dadurch gekennzeichnet,
daß die Oberseite der flexiblen Verdrahtung (FV) mittels ei
nes Klebers (K) ganzflächig mit der Unterseite des Substrats
(S) verbunden wird.
6. Ball Grid Array (BGA), bestehend aus
- - einem Substrat (S) mit Randkontakten (RK);
- - einer flexiblen Verdrahtung (FV), die auf der Unterseite flächig angeordnete Anschlüsse (A) mit darauf aufgebrachten schmelzfähigen Höckern (H) aufweist und deren von den Anschlüssen (A) nach außen führende Leiter (L) frei liegende Enden (E) besitzen; wobei
- - der Randbereich der flexiblen Verdrahtung (FV) U-förmig um die Stirnseite des Substrats (S) gebogen ist und wobei
- - die freiliegenden Enden (E) der Leiter (L) mit zugeordneten Randkontakten (RK) elektrisch leitend verbunden sind.
7. Ball Grid Array (BGA) nach Anspruch 6,
dadurch gekennzeichnet,
daß das Leiterbild der flexiblen Verdrahtung (FV) mit Ausnah
me der flächig angeordneten Anschlüsse (A) mit einem Lötsto
plack (LSL) abgedeckt ist.
8. Ball Grid Array nach Anspruch 6 oder 7,
dadurch gekennzeichnet,
daß die Oberseite der flexiblen Verdrahtung (FV) mittels ei
nes Klebers (K) ganzflachig mit der Unterseite des Substrats
(S) verbunden ist.
9. Flexible Verdrahtung (FV) zur Umformung eines Substrats
(S) mit Randkontakten (RK) in ein Ball Grid Array (BGA), mit
folgenden Merkmalen:
- - auf der Unterseite befinden sich flächig angeordnete Anschlüsse (A) zur Aufnahme von schmelzfähigen Höckern (H);
- - von den Anschlüssen (A) führen Leiter (L) nach außen;
- - die Enden (E) der Leiter (L) liegen frei.
10. Flexible Verdrahtung (FV) nach Anspruch 9,
dadurch gekennzeichnet,
daß die Trägerfolie (TF) der Verdrahtung im Endbereich der
Leiter (L) eine schlitzförmige Aussparung (SA) besitzt.
11. Flexible Verdrahtung (FV) nach Anspruch 10,
dadurch gekennzeichnet,
daß die Leiter (L) eine im Abstand zu der schlitzförmigen
Aussparung (SA) in die Trägerfolie (TF) eingebrachte zusätz
liche schlitzförmige Aussparung (ZSA) überqueren.
12. Flexible Verdrahtung (FV) nach einem der Ansprüche 9 bis
11,
dadurch gekennzeichnet,
daß das Leiterbild mit Ausnahme der flächig angeordneten An
schlüsse (A) mit einem Lötstoplack (LSL) abgedeckt ist.
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---|---|
DE19754874A1 true DE19754874A1 (de) | 1999-06-24 |
Family
ID=7851441
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
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Country Status (2)
Country | Link |
---|---|
US (3) | US6256877B1 (de) |
DE (1) | DE19754874A1 (de) |
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US20020017398A1 (en) | 2002-02-14 |
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