DE1774296B2 - Restruktuierbare Steuereinheit für elektronische Digitalrechner - Google Patents

Restruktuierbare Steuereinheit für elektronische Digitalrechner

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Description

Die Erfindung betrifft eine restrukturierbare Steuereinheit für elektronische Digitalrechner nach dem Oberbegriff des Anspruchs 1.
Die Steuereinheiten bekannter Digitalrechner steuern die Rechenanlage nach einem allgemein festgelegten Schema, d. h. sie steuern den Rechner immer in genau der gleichen Weise, wenn ein Rechnerprogramm für die Lösung einer bestimmten Aufgabe in der Anlage abgewickelt wird. Diese bekannten Steuereinheiten haben sich in bestimmten Stufen weiterentwickelt. Ursprünglich bestand eine Steuereinheit aus verschiedenen aktiven und passiven Bauelementen, die in vielfach beliebiger Weise in der Maschine verteilt waren. Nachdem dann später der Festwertspeicher als Steuerspeicher bekanntgeworden war, wurde die Steuerung vieler digitaler Rechenanlagen
ίο in die Zentraleinheit der Maschine verlegt.
Bei den bekannten Rechenanlagen besteht ein Instruktionssatz aus einer festen Folge sog. primitiver Instruktionen (sog. Maschineninstruktionen), die in dem Speicher der Anlage enthalten sind. Die Ausf ührung einer Maschineninstruktion erfordert eine Anzahl sog. Mikroinstruktionen, die in dem Festwertspeicher der Rechenanlage gespeichert sind. Eine sog. Makroinstruktion, eine Instruktion, die in einer höheren Programmsprache, wie beispielsweise Fortran, definiert werden kann, erfordert eine Reihe der bereits erwähnten Maschineninstruktionen, die zusammengefaßt in den Hauptspeicher der Anlage eingegeben werden. Jede Maschineninstruktion wird vom Steuerspeicher der Reihe nach ausgeführt, indem die Mikroinstruktionen ausgeführt werden, die für jede einzelne Maschineninstruktion benötigt werden.
Hieraus ergibt sich ein entscheidender Nachteil für die bekannten Rechenanlagen, da für Myriaden von verschiedenen Makrofunktionen, deren Ausführung von dem Rechnersystem erwartet wird, nur ein begrenzter Instruktionssatz zur Verfügung steht. Deshalb stellen sogar optimale Instruktionsfolgen eine nicht besonders wirkungsvolle Methode zur Durchführung von Makrofunktionen dar, im Vergleich zu
j5 Methoden, die einen freien Zugang zu den Mikroinstruktionen selbst gewähren.
Ein derartiger Rechner mit unveränderlichem Mikroprogramm ist beispielsweise durch die deutsche Auslegeschrift 1195074 bekannt. Die Mikroprogramme sind dort durch eine fest verdrahtete Schaltung dargestellt. In dem Buch »Electronic Digital Systems« von R. K. Richards, John Wiley & Sons, Inc., 1966, wird auf Seite 200 ff. der Einsatz von Schreib/ Lesespeichern zur Aufnahme der Mikroprogramme erwähnt. Die Mikroprogramme können dabei vor ihrer Ausführung in diese Speicher eingegeben werden. Eine Änderung der Mikroprogramme ohne Eingriffe von außen oder während ihrer Ausführung ist mit einer derartigen Einrichtung nicht möglich.
-,o Die Erfindung stellt sich daher die Aufgabe, diesen Nachteil bekannter Digitalrechner dadurch zu vermeiden, daß eine Steuereinheit angegeben wird, die auch während der Programmausführung restrukturiert werden kann und dadurch eine höhere Flexibilitat sowie eine bessere Anpassung des Digitalrechners an die zu lösenden Probleme gestattet.
Diese Aufgbe wird dui ch die im Hauptanspruch gekennzeichnete Erfindung gelöst; Ausgestaltungen der Erfindung sind in den Unteransprüchen gekennzeich-
Die Steuereinheit nach der Erfindung gestattet der Maschine die eigene Anpassung an jede neue Instruktion, die ausgeführt werden soll. Von wesentlicher Bedeutung ist hierbei, daß das Programm zur Steuerung
b5 der Maschine vor und/oder während des Programmablaufes geändert werden kann, so daß sich der Rechner selbst restrukturieren und bei der Ausführung des Programmes mit höherem Wirkungsgrad arbeiten
Die Steuereinheit nach der Erfindung bietet darüber hinaus den Vorteil, daß für die Rechenanlage nicht mehr ein fest vorgeschriebenes Instruktionsrepertoire erforderlich ist, vielmehr genügt ein univer- seller Instruktionssatz.
Es ist für die Erfindung wesentlich, daß durch die Steuereinheit die Rechenanlage nun in der Lage ist, sich selbst ihre eigenen Muster von Torsteuersignalen zu erzeugen und dynamisch zu verändern. Sie ist daher ι ο in der Lage, Algorithmen, den Informationsfluß und die Bandbreite des Datenkanals optimal zu wählen. Dieses trifft besonders für eine Betriebsart zu, bei welcher das Programm beispielsweise als Makroprogramm in einer symbolischen oder funktionellen Sprache geschrieben ist. Die funktioneile Programmiersprache enthält symbolische Befehle, für die jeweils Mikroinstruktionen in einem externen Steuerprogrammspeicher vorher gespeichert werden. Das Makroprogramm wird hierbei in den Hauptspeicher der Rechenanlage in üblicher Weise geladen. Jedoch anstatt das Programm zu kompilieren, wie es bei den bekannten Rechenanlagen geschieht, werden die Mikroinstruktionen, die den Instruktionen in der symbolischen Programmmiersprache entsprechen, in den externen Steuerprogrammspeicher geladen, aus diesem in einen Lese-Schreib-Steuerspeicher eingelesen und zur Steuerung der Maschinenfunktion ausgeführt.
So kann eine Makroinstruktion in einen Steuerspeicher decodiert und teilweise ausgeführt werden, während gleichzeitig ein weiterer Lese-/Schreib-Steuerspeicher mit Mikroinstruktionen für die spätere Ausführung der Makroinstruktion geladen wird. Dem Programmierer der Makrosprache bleibt dieser Vorgang dabei verborgen: Das Laden des zweiten Steuer- ss Speichers wird z. B. durch die Befehle im ersten gesteuert.
Die Verbindungen zwischen den einzelnen Elementen der Steuereinheit sind so vielfältig steuerbar, daß Mikroprogramme entweder im Hauptspeicher 4u oder in externen Geräten vorbereitet gespeichert oder mit Hilfe der arithmetischen und logischen Einheit aufbereitet werden können.
Im folgenden wird ein Ausführungsbeispiel der Erfindung anhand der Figuren beschrieben. Es zeigt
Fig. IA die Darstellung eines Digitalrechners, welcher die Steuereinheit gemäß einem Ausführungsbeispiel der Erfindung enthält,
Fig. IB eiise Darstellung des Datenflusses der Zentraleinheit, und w
Fig. IC eine Darstellung der in Fig. IA enthaltenen Steuerspeicherauswahlschaltung.
Die Steuereinheit der im folgenden beschriebenen digitalen Rechenanlage enthält Lese-/Schreibspeicher für Steuerzwecke, deren Inhalt elektronisch veränderbar ist. Im Zusammenhang mit dieser Rechenanlage kann eine beliebige Zahl dieser Speicher verwendet werden. Die folgende Beschreibung wird jedoch, um die Darstellung übersichtlich zu halten, eine Anlage beschrieben, die nur zwei derartige Steuerspei- t>o eher enthält.
Wie die Fig. IA zeigt, besteht die Steuereinheit nach dem Ausführungsbeispiel der Erfindung aus den Lese-/Schreibspeichern 1 und 2 sowie aus dem Festwertspeicher 3. Ferner gehören zu diesem System die b5 Steuerspeicher-Auswahlschaltung 4, die Eingabe-/ Ausgabe-Kanalschaltung 5 für die Lese-/Schreibspeicher 1 und 2 und den externen Steuerprogramm speicher 7. Die Lese-ASchrcibspeicher 1 und 2 für die Steuerung sind Speichereinrichtungen, deren Aufbau bekannt ist und deren Lese-/Schreibgeschwindigkeit an die Zeitsteuerung der digitalen Rechenanlage angepaßt ist. So können diese Speicher beispielsweise in dei Art der bekannten Magnetkern-Speichermatrizen aufgebaut sein oder einen anderen geeigneten Aufbau für Lese-/Schreibspeicher besitzen. Der Festwert-Steuerspeicher 3 kann beispielsweise nach Art des bekannten Transformator- oder Kondensator-Festwertspeichers ausgebildet sein. Die Steuereinheit ist ferner mit einer geeigneten Folgesteurung, beispielsweise einem Adressengenerator 8 ausgestattet, welcher für die Zuordnung, das Auslesen und Ausführung von Mikroinstruktionen verwendet wird.
Die erwähnten Steuerspeicher 1, 2 und 3 besitzen jeweils ein Datenregister 9,10 und IL Der Ausgang irgendwelcher Daten der Register 9,10 und 11 kann mit den Steuerkreisen 20 über die Auswahlschaltung 22 erfolgen. Die Auswahlschaltung 22 besteht beispielsweise aus UND-Toren, die Ober eine Ausgangsdaten-Auswahlleitung 220 gesteuert werden. Wahlweise kann auch der Ausgang eines der Datenregister 9,10 und 11 über die Auswahlschaltung 21 mit dem Eingabe-/Ausgabekanal 5 für die Steuerspeicher 1 und 2 verbunden werden. Die Auswahlschaltung 21 ist der Auswahlschaltung 22 ähnlich und wird wie diese über die Steuerleitung 220 betätigt.
Die aus den Steuerspeichern 1,2 und 3 ausgelesene Information gelangt in die Datenregister 9, 10 oder 11, von wo aus sie dann dazu dienen kann, eine neue Adresse in dem Adressengenerator 8 zu erzeugen. Sie kann andererseits auch dazu verwendet werden, um Steuerinformationen an die Steuerspeicherauswahlschaltung 4 oder den Steuerspeicher-EüWAusgabekanal S zu liefern. Die Torsteuerinformatkm wird als sog. Signalmuster von den Mikroinstruktionen abgeleitet und von den Datenregistern 9,10 oder 11 über die Auswahlschaltung 22 zu den Steuerkreisen 20 übertragen, wo Pfade für den Informationsfluß erstellt, Folgeoperationen in anderen Teilen der Anlage ermöglicht und zukünftige Ereignisse in dem Steuerschema bestimmt werden.
Der Hauptseicher 36 der digitalen Rechenanlage, welcher ebenfalls in Fig. IA dargestellt ist, kann irr gendein geeigneter Speicher sein, beispielsweise ein Magnetkernspeicher. Die Makroinstruktionen können in speziellen Zellen oder Gruppen von Zellen des Hauptspeichers enthalten sein.
Die Fig. IB zeigt ausführlicher den in Fig. 1A unter der Bezugsziffer 46 dargestellten Datenfluß der Zentraleinheit. Hierzu dienen die allgemeinen Register 108,110,112..., 128,130 und die arithmetische und logische Einheit ALU, die unter der Bezugsziffer 140 dargestellt ist. Der Zugang der Daten zu der ALU 140 erfolgt über die A-Sammelleitung 144 oder die B-Sammelleitung 146 über die zugeordneten Register 132 oder 134. Die B-Sammelleitung ist außerdem mit einer T/C-Schaltung 136 versehen, die der Übertragung wahrer oder komplementärer Werte dient. Die Sammelleitung 142 ist für die Ausgangsdaten der ALU vorgesehen und verbindet diese Einheit mit den allgemeinen Registern. Die Verbindung wird durch M'kroinstruktionen gesteuert, die aus den Steuerspeichern 1, 2 oder 3 gelesen werden. Jedes dieser allgemeinen Register kann den Eingang zu der ALU über die A-Sammelleitung 144 erreichen. Außerdem können die Register 108 und 128 die ALU auch über
die B-Sammelleitung 146 erreichen. Die Ausgangsdaten können auch zu externen Einheiten 42 über den Eingabe-/Ausgabekanal 6 des Rechners übertragen werden. Das Register 108 besitzt ferner noch einen Zugang zu dem Adressengenerator 8, der Steuerspeicher-Auswahlschaltung 4 und den Steuerspeichern 1 und 2 über die Leitungen 148.
Der Steuerspeicher-Eingabe-/Ausgabekanal 5 dient zur Übertragung vor Daten zwischen dem externen Steuerprogrammspeicher 7 und einem der beiden Steuerspeicher 1 oder 2. Die Steuerspeicher-Auswahlschaltung 4 empfängt Betriebsart-Information über die Leitungen 148 oder 12 und steuert die Durchschaltung der angeforderten Steuerspeicherzyklen, um dadurch den Steuerspeicher-Eingabe-/ Ausgabekanal 5 durchzuschalten, damit die Information in den gewünschten Steuerspeicher gelangt. Der Steuerspeicher-Eingabe-/Ausgabekanal 5 dient der Übertragung von Information zu den Steuerspeichern 1 oder 2, die als Mikroinstruktionen dient. Die Steuerung erfolgt hierbei durch die Auswahlleitungen 224 und 226, die in Fig. IC dargestellt sind, wobei die Leitung 16 (Fig. 1 A) die Daten und die Leitung 17 Adressen überträgt. Der Steuerspeicher-Eingabe-/Ausgabekanal 5 kann die verschiedenen externen Steuerprogrammspeicher 7 miteinander verbinden und kann ebenso eine Verbindung mit dem Hauptspeicher 36 über die Kanalanpassungseinheit 40 und den Rechner-Ein-/Ausgabekanal 6 herstellen. Ferner besteht auch eine Datenverbindung zwischen dem Hauptspeicher 36 und den Steuerspeichern 1 oder 2.
Während der Ausführung des Programms kann es wünschenswert sein, Information, die sich in dem ZE-Datenfluß 46 befindet, zu den Steuerspeichern 1 oder 2 über die Leitungen 148 zu übertragen, wobei die Steuerung über die Auswahlleitungen 224 und 226, die in Fig. IC dargestellt sind, erfolgt.
Dadurch ist es möglich, daß die Steuerspeicher 1 oder 2 von drei Quellen (Instruktionsquellen) her geladen werden können:
1. vom Hauptspeicher 36 über den Rechner-Ein-/ Ausgabekanal 6, die Kanalanpassungsschaltung 40 und den Steuerspeicher-Eingabe-/Ausgabekanal 5 oder über andere bekannte und geeignete Schaltungsanordnungen, die zur Errichtung eines solchen Datenpfades dienen können,
2. von dem DR-Register 108 über die Leitungen 148 und
3. vom externen Steuerprogrammspeicher 7 über den Steuerspeicher-Eingabe-/Ausgabekanal 5.
Die Fig. 1C zeigt die Struktur der Steuerspeicherauswahlschaltung, die in Fig. IA mit der Bezugsziffer 4 bezeichnet ist Die Steuerspeicher-Auswahlschaltung enthält diejenigen Register und Steuerungen, die notwendig sind, die Betriebsart der laufenden Operationen zu speichern, den korrekten Datenfluß zu und von den Steuerspeichern 1 und 2 durch Betätigung der Register und Torsteuerungen zu errichten und geeignete Steuerspeicherzyklen in Abhängigkeit von dem Steuerspeicher-Eingabe-/Ausgabekanal 5 and der Maschinenzeitsteuerung zuzuteilen.
Wie Fig. IC weiter zeigt, enthält die Steuerspeicher-Auswahlschaltung ein Steuerbetriebsregister 200, ein Steuerspeicher-Statusregister 202, eine Zykluszuteüungssteuerung 204 und einen Steuerdecoder 206.
Das Steuerbetriebsregister 200 empfängt seine Da
ten über die Torschaltung 210. Die Daten können entweder vom DR-Register 108 über die Sammelleitung 148 oder von dem Inhalt eines bestimmten Mikroinstruktionsfeldes, welches für Betriebsartin- formation reserviert ist, über die Sammelleitung 214 übertragen werden. Die betreffende Sammelleitung 148 oder 214, die gewählt worden ist, wird für die Steuerspeicher-Betriebsauswahl durch ein Steuersignal auf der Steuerleitung 208 angezeigt. Diese Lei- tung überträgt ein Torsteuersignal von einem bestimmten Feld einer Mikroinstruktion, welches bewirkt, daß der Inhalt beider Sammelleitungen 148 oder 214 in das Steuerbetriebsregister 200 übertragen wird.
Die Steuereinheit für die Zykluszuteilung 204 besitzt die Eingangsieitungen 216 Und 30 für die Maschinenzyklusanforderung und für die Zyklusanforderung des Steuerspeicher-Eingabe-/Ausgabekanals. Die Leitung 216 überträgt hierbei ein Signal von der Ma-
:o schinenzeitsteuerung, welches eine neue Mikroinstruktion anfordert. Die Leitung 30 dagegen überträgt eine Anforderung von dem Steuerspeicher-Eingabe-/Ausgabekanal 5 zu der Steuereinrichtung 204 für die Zykluszuteilung für einen Eingabezyklus. Ein Signal auf der Leitung 218 zeigt der internen Maschinensteuerung oder dem Steuerspeicher-Ein-/Ausgabekanal an, daß eine Maschinenzyklusanforderung zugeteilt wurde und daß der angeforderte Zyklus eingeleitet wird. Das gleiche gilt für ein Signal auf der
jo Leitung 32, welches angibt, daß eine Zykluszuteilung für den Steuerspeicher-Eingabe-/Ausgabekanal erfolgt ist und dessen angeforderter Zyklus eingeleitet worden ist.
Die Information über die Zykluszuteilung von der
j5 Steuerschaltung für die Zykluszuteilung 204 wird auch zum Steuerdecoder 206 über die Leitungen 230, 232 bis 240 übertragen. Der Steuerdecoder 206 selbst ist beispielsweise als Matrixdecoder aufgebaut und decodiert die Information über die Zykluszuteilung und
4M erzeugt Torsteuersignale auf den Leitungen 220,222, 224 und 226. Die Leitung 222 wird als Zyklussteuerung für den Steuerspeicher bezeichnet und dient dazu, entweder Lese- oder Schreibzyklen, je nachdem, was die im Augenblick tätigen Steuerspeicher benötigen, einzuleiten. Die Leitung 220 ist mit Auswahl-Ausgabedaten bezeichnet und dient zur Steuerung der Durchschaltung von Information von dem betreffenden Steuerspeicher über die Auswahlschaltungen 21 oder 22 auf die Leitung 12 oder zu den
,ο Steuerkreisen 20 der Anlage. Die Leitung 224 für Auswahl-Eingabeadressen steuert die Durchschaltung des Adressengenerators 8 und der Adressen des Steuerspeicher-Eingabe-/Ausgabekanals zu dem betreffenden Steuerspeicher über die Leitungen 30 oder
17. Die Leitung 226 für Auswahl-Eingabedaten schaltet die Sammelleitung 17 für die Steuerspeicher-Eingabe-/Ausgabedaten auf den entsprechenden Steuerspeicher 1 oder 2.
Zusätzlich zu den vorstehend beschriebenen haupt-
sächlichen Steuerungen in der Steuerspeicher-Auswahlschaltung können bereits bekannte. Steuerschaltungen, die für die Herstellung von Synchronbedingungen oder zur Überwachung des Zustandes verchiedener Gruppen des Systems, auch für Aus nahmebedingungen, notwendig sind, hinzugefügt werden.
Während des Betriebes bestimmt das Steuerbetriebsregister 200 die laufende Betriebsart. Das Steu-
erspeicher-Statusregister 202 speichert den laufenden Zustand jedes Speichers und zeigt solche Bedingungen an, die eine Aussage darüber liefern, ob ein Zyklus läuft, ob die gewünschte Steuerspeichereinheit verfügbar oder ob sie besetzt ist. Die Steuerung 204 für die Zykluszuteilung spricht auf Zyklusanforderungen an, analysiert die Einstellung der laufenden Betriebsart und den Zustand und erzeugt geeignete Zyklusinformation, die zu dem Steuerdecoder 206 übertragen wird. Dieser erzeugt ansprechende Informationssignale auf den Leitungen 220, 222, 224 und 226.
Die Arbeitsweise der Steuereinheit wird im folgenden am Beispiel einiger möglicher Betriebsarten beschrieben.
In der Steuerspeicher-3-Betriebsart wird der Steuerspeicher 3. welcher als Festwertspeicher ausgebildet ist, für die Steuerung verwendet. Makroinstruktionen können vom Hauptspeicher 36 ausgelesen und mit Hilfe von Mikroinstruktionen, die als Festdaten in dem Festwert-Steuerspeicher 3 enthalten sind, ausgeführt werden. Zusätzlich ist dann entweder Steuerspeicher 1 oder 2 für die Blockübertragung von vorher gespeicherten Mikroinstruktionen verfügbar. Diese Mikroinstruktionen stammen von dem Hauptspeicher 36 oder dem externen Steuerprogrammspeicher 7 und werden über die Eingabe-/Ausgabekanäle 5 und 6 übertragen. Diese Mikroinstruktionen werden für die darauffolgende Programmausführung der Makroinstruktionen verwendet. Darüber hinaus kann entweder der Steuerspeicher 1 oder 2 mit Mikroinstruktionen aus dem DR-Register 108 über die Leitungen 148 geladen werden. Die Mikroinstruktionen werden von einer dieser drei genannten Quellen in parallelen Zyklen mit der Festwertspeicheroperation (Steuerspeicher 3) geladen. Während daher die Instruktionen durch den Festwert-Steuerspeicher 3 ausgeführt werden, können beide Steuerspeicher 1 oder 2 für nachfolgende Instruktionsausführungen vorbereitet werden.
In einer anderen Betriebsart wird einer der beiden Steuerspeicher 3 oder 1 für die Steuerung benutzt. Die Mikroinstruktionen werden entweder von dem einen Steuerspeicher oder von beiden ausgelesen, um die Ausführung des Programms zu ermöglichen. Während dieser Zeit kann der Steuerspeicher 2 entweder von
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Register 108 oder dem Hauptspeicher 36 geladen werden, um auf diese Weise die Mikroinstruktionen für die spätere Ausführung bereitzustellen.
Beispielsweise kann während der Zeit, während welcher die Programmausführung von den Steuerspeichern 1 oder 3 durchgeführt wird, eine Instruktion, die ein neues Steuerprogramm in den Steuerspeicher 2 abruft, aus dem Hauptspeicher gelesen werden. Dann empfängt der Steuerspeicher-Eingäbe-/Ausgabekanal 5 Instruktionen zur Durchführung einer Leseoperation von dem betreffenden Bereich des externen Steuerprogrammspeichers 7, wodurch der Steuerspeicher 2 mit den betreffenden Mikroinstruktionen geladen wird. Hierbei dienen die Signale auf den Leitungen 222, 224 und 226 zur Steuerung. Die Mikroinstruktionen werden nachein
ander aus dem erwähnten Steuerspeicher 2 ausgelesen und als Steuerinformation für die Makroinstruktionsanweisung, die später ausgeführt werden soll, verwendet. Auf diese Weise können sich beispielsweise Steuerspeicher 1 und 2 im Empfang von Mikroinstruktionen abwechseln, die für jedes andere später auszuführende Steuerprogramm benötigt werden.
Bei einem weiteren Beispiel für die Betriebsart kann es wünschenswert sein, die Information direkt vom Hauptspeicher 36 in den Steuerspeicher 2 zu laden, während Steuerspeicher 1 oder 3 die Instruktion ausführt, so daß die erwähnte Information als Mikroinstruktionen für die nachfolgende Programmausführung dienen kann. Auf diese Weise wird das Wort oder werden die Wörter vom Hauptspeicher zu dem Eingabe-/Ausgabekanal 6 des Rechners übertragen, wobei sie über die Kanalanpassung 40 zu dem Steuerspeicher-Eingabe-/Ausgabekanal 5 und von dort in den Steuerspeicher 2 für die nachfolgende Programmausführung geleitet werden.
In einem weiteren Beispiel einer möglichen Betriebsart kann es wünschenswert sein, Mikroinstruktionen aus Informationen, die im Hauptspeichersystem 36, Steuerspeicher 1, Steuerspeicher 2 oder Steuerspeicher 3 enthalten sind, zu erzeugen und die Mikroinstruktionen in den Steuerspeicher 2 für die spätere Ausführung zu laden. Hierbei wird die Information aus dem Hauptspeicher 36 über die Sammelleitung 102 in den ZE-Datenfluß 46 gelesen. Die Information kann auch von Steuerspeicher 3, Steuerspeicher 1 oder Steuerspeicher 2 über die Datenregister 9,10 oder 11 und die Sammelleitung 12 zu der Sammelleitung 146 und von dort in die arithmetische und logische Einheit 140 übertragen werden, welche diese Information so verarbeitet, daß daraus die gewünschten Mikroinstruktionen erzeugt werden. Nach der Erzeugung wird jede Mikroinstruktion in das DR-Register 108 geladen, von dem aus sie dann über die Leitung 148 zu dem Steuerspeicher 2 für die nachfolgende Ausführung übertragen wird.
Bei einer weiteren Betriebsart können Steuerspeicher 32 und 2 zur Ausführung der Mikroinstruktionen für die Steuerung verwendet werden. Während dieser Zeit steht Steuerspeicher 1 für die Ladung mit den Mikroinstruktionen von dem externen Steuerprograrnmspeicher 7, dein Hauptspeicher 36 oder dem DR-Register 108 zur Verfügung. Diese erfolgt in einer Weise, die derjenigen ähnlich ist, die bereits vorcher 3 und 2 zur Ausführung der Mikroinstruktionen läutert wurde.
Bei einer erweiterten Betriebsart können die Steuerspeicher 1 bis 3 in jeder gewünschten Reihenfolge benutzt werden, um Mikroinstruktionen für die Steuerung auszuführen. In parallelen Zyklen, während welchen der eine oder andere der Steuerspeicher 1 oder 2 die Mikroinstruktionen für die Steuerung ausführt, kann der andere Steuerspeicher 2 oder 1 für die Ladung mit Mikroinstruktionen zur Verfügung stehen, wobei die Art und Weise der Ladung derjenigen ähnlich ist, die bereits im Zusammenhang mit dem Steuerspeicher 1 oder 2 beschrieben wurde.
Hierzu 3 Blatt Zeichnungen

Claims (6)

Patentansprüche:
1. Restrukturierbare Steuereinheit für elektronische Digitalrechner mit einem Festwert-Steuerspeicher zur Aufnahme des Mikroprogramms, d adurch gekennzeichnet, daß für die Modifizierung des Mikroprogrammablaufs vor und/odler während der Programmausführung mindestens noch ein Lese-/Schreibspeicher (1 oder 2; Fig. IA) als zweiter Steuerspeicher vorgesehen ist, der Mikroinstruktionen von mindestens einer Instruktionsquelle (z. B. 7, 36 oder 108) empfängt, daß zur Auswahl einer dieser Instruktionsquellen sowie des zweiten Steuerspeichers eine Auswahlsteuerung (4, 21, 22, 8, 5') vorgesehen ist, die den Betriebsablauf derart steuert, daß, während der Digitalrechner vom Festweit-Steuenpeicher (3; Fig. 1 A) gesteuert wird, der zweite Steuerspeicher (z.B. 1) von einer der verschiedenen Instruktionsquellen für eine spätere Steuerung geladen wird und daß die Auswahlsteuerung ihrerseits durch Befehle der Steuerspeicher gesteuert wird.
2. Steuereinheit nach Anspruch I1 dadurch gekennzeichnet, daß als Instruktionsquellen der Hauptspeicher (36) und/oder externe Speicher (z. B. 7) dienen.
3. Steuereinheit nach Anspruch 1, dadurch gekennzeichnet, daß als Instruktionsquelle ein mit der arithmetischen und logischen Einheit (ALU, 140) verbundenes Datenregister (108, Fig. IB) dient.
4. Steuereinheit nach Anspruch 1 bis 3, dadurch gekennzeichnet, daß die Auswahlsteuerung aus einer Steuerspeicher-Auswahlschaltung (4, 21, 22), einem Adressengenerator (8) und einem Steuerspeicher-Ein-/Ausgabekanal (5) besteht.
5. Steuereinheit nach Anspruch 4, dadurch gekennzeichnet, daß die Steuerspeicher-Auswahlschaltung (4, Fig. IA, Fig. IC) aus einem Steuerbetriebsregister (200), einem Steuerspeicher-Statusregister (202) und einer Steuerschaltung (204) für die Zyklussteuerung besteht, die mit einem Steuerdecoder (206) verbunden sind, welcher die Auswahlsignale erzeugt und zu den Steuerspeichern (2, 3) und zu Auswahlschaltungen (21, 22) überträgt.
6. Steuereinrichtung nach Anspruch 4 oder .5, dadurch gekennzeichnet, daß die Steuerspeicher-Auswahlschaltung (4) bei Anforderung eines neuen Maschinenzyklus (Leitung 216) Steuersignale (220, 222, 224, 226) in Abhängigkeit von Betriebsdateninformation (Leitung 214), von Statusinformation (202, 148) und von der Maschinenzeitsteuerung erzeugt.
DE1774296A 1967-05-23 1968-05-18 Restruktuierbare Steuereinheit für elektronische Digitalrechner Expired DE1774296C2 (de)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
US64065267A 1967-05-23 1967-05-23

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DE1774296A1 DE1774296A1 (de) 1971-08-19
DE1774296B2 true DE1774296B2 (de) 1979-08-02
DE1774296C2 DE1774296C2 (de) 1986-11-13

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Application Number Title Priority Date Filing Date
DE1774296A Expired DE1774296C2 (de) 1967-05-23 1968-05-18 Restruktuierbare Steuereinheit für elektronische Digitalrechner

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US (1) US3478322A (de)
DE (1) DE1774296C2 (de)
FR (1) FR1558879A (de)
GB (1) GB1154299A (de)
NL (1) NL159209B (de)
SE (1) SE341933B (de)

Families Citing this family (82)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3579192A (en) * 1967-11-02 1971-05-18 Burroughs Corp Data processing machine
CA926514A (en) * 1969-01-20 1973-05-15 Saltini Fabrizio Electronic computer
US3689893A (en) * 1969-05-09 1972-09-05 Olivetti & Co Spa Accounting machine processor
US4558411A (en) * 1969-05-19 1985-12-10 Burroughs Corp. Polymorphic programmable units employing plural levels of sub-instruction sets
BE757967A (fr) * 1969-10-25 1971-04-23 Philips Nv Memoire pour microprogramme
DE2015272A1 (de) * 1970-03-31 1971-10-21 Siemens Ag Programmleitwerk für eine digitale Datenverarbeitungsanlage
US3686637A (en) * 1970-09-14 1972-08-22 Ncr Co Retail terminal
BE795789A (fr) * 1972-03-08 1973-06-18 Burroughs Corp Microprogramme comportant une micro-instruction de recouvrement
US3787817A (en) * 1972-06-21 1974-01-22 Us Navy Memory and logic module
US3800291A (en) * 1972-09-21 1974-03-26 Ibm Data processing system memory relocation apparatus and method
US3878514A (en) * 1972-11-20 1975-04-15 Burroughs Corp LSI programmable processor
US4024504A (en) * 1973-12-21 1977-05-17 Burroughs Corporation Firmware loader for load time binding
US3938103A (en) * 1974-03-20 1976-02-10 Welin Andrew M Inherently micro programmable high level language processor
US3959774A (en) * 1974-07-25 1976-05-25 California Institute Of Technology Processor which sequences externally of a central processor
US4037202A (en) * 1975-04-21 1977-07-19 Raytheon Company Microprogram controlled digital processor having addressable flip/flop section
DE2547488C2 (de) * 1975-10-23 1982-04-15 Ibm Deutschland Gmbh, 7000 Stuttgart Mikroprogrammierte Datenverarbeitungsanlage
IT1059493B (it) * 1976-04-22 1982-05-31 Olivetti & Co Spa Dispositivo per cambiare l ambiente di lavoro di un calcolatore
AU3329178A (en) * 1977-03-28 1979-08-23 Data General Corp A micro-control storage system
FR2461301A1 (fr) * 1978-04-25 1981-01-30 Cii Honeywell Bull Microprocesseur autoprogrammable
US4236210A (en) * 1978-10-02 1980-11-25 Honeywell Information Systems Inc. Architecture for a control store included in a data processing system
US4342080A (en) * 1978-11-08 1982-07-27 Data General Corporation Computer with microcode generator system
JPS5759250A (en) * 1980-09-29 1982-04-09 Nec Corp Microprogram controller
US4399505A (en) * 1981-02-06 1983-08-16 Data General Corporaton External microcode operation in a multi-level microprocessor
US4531199A (en) * 1981-06-01 1985-07-23 International Business Machines Corporation Binary number substitution mechanism in a control store element
US4510582A (en) * 1981-06-01 1985-04-09 International Business Machines Corp. Binary number substitution mechanism
US4740895A (en) * 1981-08-24 1988-04-26 Genrad, Inc. Method of and apparatus for external control of computer program flow
US4439839A (en) * 1981-08-24 1984-03-27 International Telephone And Telegraph Corporation Dynamically programmable processing element
JPS58144272A (ja) * 1982-02-19 1983-08-27 Sony Corp デイジタル信号処理装置
US4862351A (en) * 1983-09-01 1989-08-29 Unisys Corporation Method of executing called activities via depictor-linked low level language microcode, hardware logic, and high level language commands; and apparatus for same
GB2161001B (en) * 1984-06-25 1988-09-01 Rational Distributed microcode address apparatus for computer
JPS6225302A (ja) * 1985-07-25 1987-02-03 Fanuc Ltd 数値制御装置
JPH06103460B2 (ja) * 1985-11-19 1994-12-14 ソニー株式会社 プログラム転送方式
FR2708359A1 (fr) * 1993-06-30 1995-02-03 Philips Electronics Nv Procédé pour exploiter un processeur numérique de signal et dispositif mettant en Óoeuvre le procédé.
US5790874A (en) * 1994-09-30 1998-08-04 Kabushiki Kaisha Toshiba Information processing apparatus for reducing power consumption by minimizing hamming distance between consecutive instruction
US5732255A (en) * 1996-04-29 1998-03-24 Atmel Corporation Signal processing system with ROM storing instructions encoded for reducing power consumpton during reads and method for encoding such instructions
JP3340343B2 (ja) * 1997-03-13 2002-11-05 株式会社東芝 プロセッサ及び情報処理装置
US6081888A (en) * 1997-08-21 2000-06-27 Advanced Micro Devices Inc. Adaptive microprocessor with dynamically reconfigurable microcode responsive to external signals to initiate microcode reloading
US6427196B1 (en) 1999-08-31 2002-07-30 Intel Corporation SRAM controller for parallel processor architecture including address and command queue and arbiter
US6983350B1 (en) 1999-08-31 2006-01-03 Intel Corporation SDRAM controller for parallel processor architecture
US6668317B1 (en) 1999-08-31 2003-12-23 Intel Corporation Microengine for parallel processor architecture
US6606704B1 (en) * 1999-08-31 2003-08-12 Intel Corporation Parallel multithreaded processor with plural microengines executing multiple threads each microengine having loadable microcode
US7191309B1 (en) 1999-09-01 2007-03-13 Intel Corporation Double shift instruction for micro engine used in multithreaded parallel processor architecture
US7421572B1 (en) 1999-09-01 2008-09-02 Intel Corporation Branch instruction for processor with branching dependent on a specified bit in a register
US7546444B1 (en) 1999-09-01 2009-06-09 Intel Corporation Register set used in multithreaded parallel processor architecture
US7103759B1 (en) * 1999-10-28 2006-09-05 Imsys Technologies Ab Microcontroller architecture supporting microcode-implemented peripheral devices
US6532509B1 (en) 1999-12-22 2003-03-11 Intel Corporation Arbitrating command requests in a parallel multi-threaded processing system
US6694380B1 (en) 1999-12-27 2004-02-17 Intel Corporation Mapping requests from a processing unit that uses memory-mapped input-output space
US6625654B1 (en) 1999-12-28 2003-09-23 Intel Corporation Thread signaling in multi-threaded network processor
US6631430B1 (en) 1999-12-28 2003-10-07 Intel Corporation Optimizations to receive packet status from fifo bus
US7620702B1 (en) 1999-12-28 2009-11-17 Intel Corporation Providing real-time control data for a network processor
US6307789B1 (en) 1999-12-28 2001-10-23 Intel Corporation Scratchpad memory
US6661794B1 (en) 1999-12-29 2003-12-09 Intel Corporation Method and apparatus for gigabit packet assignment for multithreaded packet processing
US7480706B1 (en) 1999-12-30 2009-01-20 Intel Corporation Multi-threaded round-robin receive for fast network port
US6976095B1 (en) 1999-12-30 2005-12-13 Intel Corporation Port blocking technique for maintaining receive packet ordering for a multiple ethernet port switch
US6952824B1 (en) 1999-12-30 2005-10-04 Intel Corporation Multi-threaded sequenced receive for fast network port stream of packets
US6584522B1 (en) 1999-12-30 2003-06-24 Intel Corporation Communication between processors
US7681018B2 (en) * 2000-08-31 2010-03-16 Intel Corporation Method and apparatus for providing large register address space while maximizing cycletime performance for a multi-threaded register file set
US20020053017A1 (en) * 2000-09-01 2002-05-02 Adiletta Matthew J. Register instructions for a multithreaded processor
US7020871B2 (en) * 2000-12-21 2006-03-28 Intel Corporation Breakpoint method for parallel hardware threads in multithreaded processor
US7216204B2 (en) * 2001-08-27 2007-05-08 Intel Corporation Mechanism for providing early coherency detection to enable high performance memory updates in a latency sensitive multithreaded environment
US6868476B2 (en) 2001-08-27 2005-03-15 Intel Corporation Software controlled content addressable memory in a general purpose execution datapath
US7225281B2 (en) 2001-08-27 2007-05-29 Intel Corporation Multiprocessor infrastructure for providing flexible bandwidth allocation via multiple instantiations of separate data buses, control buses and support mechanisms
US7487505B2 (en) 2001-08-27 2009-02-03 Intel Corporation Multithreaded microprocessor with register allocation based on number of active threads
US7126952B2 (en) 2001-09-28 2006-10-24 Intel Corporation Multiprotocol decapsulation/encapsulation control structure and packet protocol conversion method
US7158964B2 (en) * 2001-12-12 2007-01-02 Intel Corporation Queue management
US7107413B2 (en) * 2001-12-17 2006-09-12 Intel Corporation Write queue descriptor count instruction for high speed queuing
US7269179B2 (en) * 2001-12-18 2007-09-11 Intel Corporation Control mechanisms for enqueue and dequeue operations in a pipelined network processor
US7895239B2 (en) * 2002-01-04 2011-02-22 Intel Corporation Queue arrays in network devices
US7181573B2 (en) * 2002-01-07 2007-02-20 Intel Corporation Queue array caching in network devices
US6934951B2 (en) 2002-01-17 2005-08-23 Intel Corporation Parallel processor with functional pipeline providing programming engines by supporting multiple contexts and critical section
US7610451B2 (en) 2002-01-25 2009-10-27 Intel Corporation Data transfer mechanism using unidirectional pull bus and push bus
US7181594B2 (en) * 2002-01-25 2007-02-20 Intel Corporation Context pipelines
US7149226B2 (en) * 2002-02-01 2006-12-12 Intel Corporation Processing data packets
US7437724B2 (en) * 2002-04-03 2008-10-14 Intel Corporation Registers for data transfers
US7471688B2 (en) 2002-06-18 2008-12-30 Intel Corporation Scheduling system for transmission of cells to ATM virtual circuits and DSL ports
US7337275B2 (en) 2002-08-13 2008-02-26 Intel Corporation Free list and ring data structure management
US7352769B2 (en) 2002-09-12 2008-04-01 Intel Corporation Multiple calendar schedule reservation structure and method
US7433307B2 (en) 2002-11-05 2008-10-07 Intel Corporation Flow control in a network environment
US6941438B2 (en) * 2003-01-10 2005-09-06 Intel Corporation Memory interleaving
US7443836B2 (en) 2003-06-16 2008-10-28 Intel Corporation Processing a data packet
EP1510915A1 (de) * 2003-08-26 2005-03-02 Siemens Aktiengesellschaft Vorrichtung und Verfahren zur Anpassung einer Hardware-Plattform an beliebige Applikationsprogramme
US7213099B2 (en) 2003-12-30 2007-05-01 Intel Corporation Method and apparatus utilizing non-uniformly distributed DRAM configurations and to detect in-range memory address matches

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3058659A (en) * 1958-12-31 1962-10-16 Ibm Add address to memory instruction
GB968996A (en) * 1959-09-30 1964-09-09 Honeywell Regulator Co Improved electrical sequencing control
FR1256040A (fr) * 1960-02-01 1961-03-17 Electronique & Automatisme Sa Perfectionnements aux calculatrices numériques à programmes d'instructions sélectionnables
GB1020924A (de) * 1961-08-25
US3258748A (en) * 1962-01-08 1966-06-28 Fntan, fntin
US3215987A (en) * 1962-06-04 1965-11-02 Sylvania Electric Prod Electronic data processing
US3325788A (en) * 1964-12-21 1967-06-13 Ibm Extrinsically variable microprogram controls
DE1250659B (de) * 1964-04-06 1967-09-21 International Business Machines Corporation, Armonk, NY (V St A) Mikroprogrammgesteuerte Datenverarbeitungsanlage
US3315235A (en) * 1964-08-04 1967-04-18 Ibm Data processing system
US3343141A (en) * 1964-12-23 1967-09-19 Ibm Bypassing of processor sequence controls for diagnostic tests
US3391394A (en) * 1965-10-22 1968-07-02 Ibm Microprogram control for a data processing system

Also Published As

Publication number Publication date
GB1154299A (en) 1969-06-04
FR1558879A (de) 1969-02-28
SE341933B (de) 1972-01-17
DE1774296A1 (de) 1971-08-19
DE1774296C2 (de) 1986-11-13
NL6806737A (de) 1968-11-25
US3478322A (en) 1969-11-11
NL159209B (nl) 1979-01-15

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