DE112017007430T5 - Halbleitermodul, Verfahren zur Herstellung eines Halbleitermoduls und Leistungswandlergerät - Google Patents
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- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
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- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
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- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
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- H01L2224/48476—Connecting portions connected to auxiliary connecting means on the bonding areas, e.g. pre-ball, wedge-on-ball, ball-on-ball between the wire connector and the bonding area
- H01L2224/48491—Connecting portions connected to auxiliary connecting means on the bonding areas, e.g. pre-ball, wedge-on-ball, ball-on-ball between the wire connector and the bonding area being an additional member attached to the bonding area through an adhesive or solder, e.g. buffer pad
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- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
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- H01L2224/48599—Principal constituent of the connecting portion of the wire connector being Gold (Au)
- H01L2224/486—Principal constituent of the connecting portion of the wire connector being Gold (Au) with a principal constituent of the bonding area being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/48638—Principal constituent of the connecting portion of the wire connector being Gold (Au) with a principal constituent of the bonding area being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/48647—Copper (Cu) as principal constituent
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- H01L2224/487—Principal constituent of the connecting portion of the wire connector being Aluminium (Al) with a principal constituent of the bonding area being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/48738—Principal constituent of the connecting portion of the wire connector being Aluminium (Al) with a principal constituent of the bonding area being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/48747—Copper (Cu) as principal constituent
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- H01L2224/488—Principal constituent of the connecting portion of the wire connector being Copper (Cu) with a principal constituent of the bonding area being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/48838—Principal constituent of the connecting portion of the wire connector being Copper (Cu) with a principal constituent of the bonding area being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/48847—Copper (Cu) as principal constituent
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- H01L2224/491—Disposition
- H01L2224/4911—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain
- H01L2224/49111—Disposition the connectors being bonded to at least one common bonding area, e.g. daisy chain the connectors connecting two common bonding areas, e.g. Litz or braid wires
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- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
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- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8338—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/83399—Material
- H01L2224/834—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/83438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/83447—Copper [Cu] as principal constituent
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- H01L2224/838—Bonding techniques
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- H01L2224/852—Applying energy for connecting
- H01L2224/85201—Compression bonding
- H01L2224/85205—Ultrasonic bonding
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- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/8538—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/85399—Material
- H01L2224/854—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/85438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/85447—Copper (Cu) as principal constituent
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- H01L2224/858—Bonding techniques
- H01L2224/85801—Soldering or alloying
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- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/49838—Geometry or layout
- H01L23/49844—Geometry or layout for devices being provided for in H01L29/00
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- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
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- H01L2924/1025—Semiconducting materials
- H01L2924/10251—Elemental semiconductors, i.e. Group IV
- H01L2924/10253—Silicon [Si]
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- H01L2924/1025—Semiconducting materials
- H01L2924/1026—Compound semiconductors
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- H01L2924/1033—Gallium nitride [GaN]
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- H01L2924/11—Device type
- H01L2924/13—Discrete devices, e.g. 3 terminal devices
- H01L2924/1304—Transistor
- H01L2924/1305—Bipolar Junction Transistor [BJT]
- H01L2924/13055—Insulated gate bipolar transistor [IGBT]
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Abstract
Ein Halbleitermodul weist ein Substrat (1), ein Halbleiterelement (3) und einen Draht (8) auf. Das Halbleiterelement (3) ist mit dem Substrat (1) verbunden und weist eine Oberflächenelektrode (4) auf. Beide Enden (8a) des Drahtes (8) sind mit dem Substrat (1) so verbunden, dass der Draht (8) über die Oberflächenelektrode (4) des Halbleiterelement (3) läuft. Der Draht (8) ist elektrisch mit der Oberflächenelektrode (4) verbunden.
Description
- TECHNISCHES GEBIET
- Die vorliegende Erfindung bezieht sich auf ein Halbleitermodul, ein Verfahren zur Herstellung eines Halbleitermoduls und ein Leistungswandlergerät. Insbesondere bezieht sich die vorliegende Erfindung auf ein Leistungshalbleitermodul mit einem Leistungshalbleiterelement, ein Verfahren zu dessen Herstellung und ein Leistungswandlergerät.
- STAND DER TECHNIK
- Normalerweise weist ein Halbleitermodul ein Substrat mit einem Leitermuster, ein Halbleiterelement mit einer mit dem Leitermuster verbundenen Rückfläche und einer mit einer Oberflächenelektrode versehenen Vorderfläche und einen mit der Oberflächenelektrode verbundenen Bonddraht auf.
- Einige Halbleitermodule sind so konfiguriert, dass ein Halbleiterelement und ein Draht elektrisch verbunden sind, ohne dass der Draht gebondet wird. Ein Beispiel für ein solches Halbleitermodul ist in der Japanischen Patentanmeldungs-Offenlegungsschrift
JP 3 809 379 A - STAND DER TECHNIK
- Patentdokument 1: Japanische Patentanmeldungs-Offenlegungsschrift
JP 3 809 379 A - KURZBESCHREIBUNG DER ERFINDUNG
- Mit der Erfindung zu lösende Probleme
- Im oben beschriebenen herkömmlichen Halbleitermodul ist der Draht an die Oberflächenelektrode gebondet, so dass in einem Verbindungsbereich, in dem die Oberflächenelektrode und der Draht verbunden sind, eine Ausschnittform entsteht. Daher konzentriert sich die Spannung bei einer Temperaturänderung, die durch wiederholte Wärmeentwicklung und Abkühlung während des Betriebs des Halbleitermoduls verursacht wird, auf eine Kante der Ausschnittform im Verbindungsbereich des Drahtes. Dadurch entsteht ein Bruch an der Kante der Ausschnittform. Dementsprechend ist es schwierig, eine lange Lebensdauer des Verbindungsbereichs des mit der Oberflächenelektrode des Halbleiterelements verbundenen Drahtes zu erreichen.
- Darüber hinaus wird in dem im vorstehenden Dokument beschriebenen Halbleitermodul kein Drahtbonden durch Ultraschallschweißen durchgeführt, so dass in dem Verbindungsbereich, in dem die Oberflächenelektrode und der Draht verbunden sind, keine Ausschnittform entsteht. Allerdings wird der Draht mit der Oberflächenelektrode durch Lot verbunden, so dass die Anzahl der Drähte im Vergleich zum Drahtbonden begrenzt ist. Dementsprechend ist es schwierig, eine geringe Stromdichte pro Draht zu erreichen.
- Ein Ziel der vorliegenden Erfindung ist es, ein Halbleitermodul, ein Verfahren zur Herstellung eines Halbleitermoduls und ein Leistungswandlergerät mit dem Halbleitermodul aufzuzeigen, das eine lange Lebensdauer eines Verbindungsbereichs erreichen kann, bei dem eine Oberflächenelektrode eines Halbleiterelements und ein Draht verbunden sind, und eine geringe Stromdichte pro Draht erreichen kann.
- Mittel zum Lösen der Probleme
- Ein Halbleitermodul der vorliegenden Erfindung beinhaltet: ein Substrat, ein Halbleiterelement und einen Draht. Das Halbleiterelement wird mit dem Substrat verbunden und hat eine Oberflächenelektrode. Beide Enden des Drahtes sind mit dem Substrat so verbunden, dass der Draht über die Oberflächenelektrode des Halbleiterelements läuft. Der Draht ist elektrisch mit der Oberflächenelektrode verbunden.
- Effekt der Erfindung
- Gemäß dem Halbleitermodul der vorliegenden Erfindung sind die beiden Enden des Drahtes mit dem Substrat so verbunden, dass der Draht über die Oberflächenelektrode des Halbleiterelements geht und der Draht elektrisch mit der Oberflächenelektrode verbunden ist. Daher wird in einem Verbindungsbereich, in dem die Oberflächenelektrode und der Draht verbunden sind, keine Ausschnittform gebildet, so dass die Konzentration der Spannung auf eine Kante des Verbindungsbereichs des Drahtes reduziert werden kann. Darüber hinaus wird der Bonddraht verwendet, so dass die Anzahl der Drähte im Vergleich zu dem Fall, in dem der Draht durch Lot verbunden wird, erhöht werden kann. Dementsprechend können eine lange Lebensdauer des Verbindungsbereichs, in dem die Oberflächenelektrode des Halbleiterelements und des Drahtes verbunden sind, und eine geringe Stromdichte pro Draht erreicht werden.
- Figurenliste
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1 ist eine Frontansicht, die schematisch die Konfiguration eines Halbleitermoduls gemäß einer ersten Ausführungsform der vorliegenden Erfindung darstellt; -
2 ist eine Draufsicht, die schematisch die Konfiguration des Halbleitermoduls gemäß der ersten Ausführungsform der vorliegenden Erfindung darstellt; -
3 ist eine Schnittansicht entlang der LinieIII-III in1 und2 ; -
4 ist eine Frontansicht, die schematisch die Konfiguration eines Halbleitermoduls gemäß einer zweiten Ausführungsform der vorliegenden Erfindung darstellt; -
5 ist eine Draufsicht, die schematisch die Konfiguration des Halbleitermoduls gemäß der zweiten Ausführungsform der vorliegenden Erfindung darstellt; -
6 ist eine Schnittansicht entlang der LinieVI-VI in5 ; -
7 ist eine Frontansicht, die schematisch die Konfiguration eines Halbleitermoduls gemäß einer ersten Modifikation der zweiten Ausführungsform der vorliegenden Erfindung darstellt; -
8 ist eine Draufsicht, die schematisch die Konfiguration des Halbleitermoduls gemäß der ersten Modifikation der zweiten Ausführungsform der vorliegenden Erfindung darstellt; -
9 ist eine Schnittansicht entlang der LinieIX-IX in7 ; -
10 ist eine Schnittansicht, die schematisch die Konfiguration eines Halbleitermoduls gemäß einer zweiten Modifikation der zweiten Ausführungsform der vorliegenden Erfindung darstellt; -
11 ist eine Draufsicht, die schematisch die Konfiguration eines Halbleitermoduls gemäß einer dritten Modifikation der zweiten Ausführungsform der vorliegenden Erfindung darstellt; -
12 ist eine Schnittansicht entlang der LinieXII-XII in11 ; -
13 ist eine Frontansicht, die schematisch die Konfiguration eines Halbleitermoduls gemäß einer dritten Ausführungsform der vorliegenden Erfindung darstellt; -
14 ist eine Draufsicht, die schematisch die Konfiguration des Halbleitermoduls gemäß der dritten Ausführungsform der vorliegenden Erfindung darstellt; -
15 ist eine vergrößerte Querschnittsansicht eines Bereichs in13 entlang der LinieXV-XV in14 , und -
16 ist ein Blockdiagramm, das die Konfiguration eines Leistungswandlersystems zeigt, in welchem ein Leistungswandlergerät gemäß einer vierten Ausführungsform der vorliegenden Erfindung angewendet wird. - BESCHREIBUNG DER AUSFÜHRUNGSFORMEN
- Ausführungsformen der vorliegenden Erfindung werden im Folgenden mit Bezug auf die Zeichnungen beschrieben, in denen dieselben oder entsprechende Teile durch dieselben Bezugszeichen gekennzeichnet sind. Mindestens ein Teil der nachfolgend beschriebenen Ausführungsformen kann beliebig kombiniert werden.
- Ausführungsform 1
- Die Struktur eines Halbleitermoduls nach einer ersten Ausführungsform der vorliegenden Erfindung wird mit Bezug auf
1 bis3 beschrieben.1 ist eine Frontansicht des Halbleitermoduls nach der vorliegenden Ausführungsform.2 ist eine Draufsicht auf das Halbleitermodul gemäß der vorliegenden Ausführungsform.3 ist eine Schnittansicht des Halbleitermoduls gemäß der vorliegenden Ausführungsform. - Wie in
1 ,2 und3 dargestellt, weist das Halbleitermodul nach der vorliegenden Ausführungsform im Wesentlichen ein Substrat1 , ein Verbindungselement2 , ein Halbleiterelement3 , ein Verbindungselement5 , einen Leiter6 , ein Verbindungselement7 und einen Draht8 auf. - Leitermuster
1a ,1b und1c sind auf einer Oberfläche des Substrats1 vorgesehen. Das Verbindungselement2 dient zur Verbindung des Leitermusters1b des Substrats1 mit dem Halbleiterelement3 . Das Verbindungselement2 ist elektrisch leitend. Das Halbleiterelement3 ist mit dem Substrat1 verbunden. Das Halbleiterelement3 hat eine Oberflächenelektrode4 . Die Oberflächenelektrode4 ist auf der Oberfläche des Halbleiterelements3 angeordnet. Der Leiter6 wird mit der Oberflächenelektrode4 des Halbleiterelements3 verbunden, wobei das Verbindungselement5 eingefügt wird. Die Oberflächenelektrode4 des Halbleiterelements3 und der Leiter6 müssen nicht unbedingt verbunden werden, wobei nur das Verbindungselement5 eingefügt wird. Zwischen der Oberflächenelektrode4 des Halbleiterelements3 und dem Leiter6 können ein weiterer Leiter und ein Verbindungselement eingefügt werden. - Das Verbindungselement
7 verbindet den Leiter6 mit dem Draht8 . Beide Enden8a des Drahts8 sind an das Substrat1 so gebondet, dass der Draht8 über die Oberflächenelektrode4 des Halbleiterelements3 geht. Der Draht8 ist elektrisch mit der Oberflächenelektrode4 verbunden. Insbesondere werden beide Enden8a des Drahts8 an das Leitermuster1b und das Leitermuster1c so gebondet, dass der Draht8 das Halbleiterelement3 überbrückt. Der Draht8 ist elektrisch mit der Oberflächenelektrode4 auf der Oberseite der Oberflächenelektrode4 verbunden. - Das Substrat
1 hat Leitermuster1a ,1b ,1c und1e und eine Isolierschicht1d . Die Leitermuster1a ,1b ,1c und1e sind auf der Isolierschicht1d vorgesehen. Insbesondere weist das Substrat1 neben den Leitermustern1a ,1b und1c auf der Vorderfläche die Isolationsschicht1d und das Leitermuster1e auf der der Vorderfläche gegenüberliegenden Rückfläche auf, auf der das Halbleiterelement3 montiert ist. Das heißt, die Leitermuster1a ,1b und1c sind auf der Vorderseite der Isolierschicht1d und das Leitermuster1e auf der Rückseite der Isolierschicht1d angeordnet. - Das Halbleiterelement
3 ist zwischen dem Leitermuster (erster Leiterbereich) 1a und dem Leitermuster (zweiter Leiterbereich) 1c angeordnet. Ein erstes Ende 8a1 der beiden Enden8a des Drahts8 ist an das Leitermuster (erster Leiterbereich) 1a gebondet, und ein zweites Ende 8a2 von beiden Enden8a des Drahts8 ist an das zweite Leitermuster (zweiter Leiterbereich) 1c gebondet. - Die Isolationsschicht
1d besteht beispielsweise aus Aluminiumoxid (Al2O3), Aluminiumnitrid (AlN) oder dergleichen. Die Leitermuster1a ,1b ,1c und1e werden auf der Isolierschicht1d gebildet. Die Leitermuster1a ,1b ,1c und1e bestehen beispielsweise aus Kupfer (Cu). - Das Halbleitermodul nach der vorliegenden Ausführungsform hat eine Grundplatte
10 . Die Grundplatte10 besteht aus einem Material mit hoher Wärmeleitfähigkeit. Die Grundplatte10 besteht beispielsweise aus Kupfer (Cu). Eine Oberseite der Grundplatte10 ist mit dem auf der Rückseite des Substrats1 gebildeten Leitermuster1e verbunden, das Leitermuster1e und die Grundplatte10 sind durch ein Verbindungselement9 verbunden. Das Verbindungselement9 besteht beispielsweise aus Lot oder sinterfähigen Silberpartikeln. - Das Halbleiterelement
3 ist beispielsweise ein Leistungshalbleiterelement mit vertikaler Struktur, bei dem ein Strom von einer unteren Fläche (Rückseite) zu einer oberen Fläche (Vorderseite) fließt. Das Halbleiterelement3 ist beispielsweise ein Schaltelement wie ein IGBT (Insulated Gate Bipolar Transistor) oder ein vertikaler MOSFET (Metalloxid-Halbleiter-Feldeffekttransistor) oder ein Gleichrichterelement wie eine Schottky-Barrierediode. - Das Halbleiterelement
3 wird beispielsweise durch die Verwendung eines Einkristalls aus Silizium (Si) gebildet. Das Halbleitermaterial, das das Halbleiterelement3 bildet, ist nicht auf den Einkristall von Silizium (Si) beschränkt und kann ein Halbleitermaterial mit einem breiten Bandabstand sein, wie zum Beispiel Siliziumkarbid (SiC) oder Siliziumnitrid (GaN). - Eine Unterseite des Halbleiterelements
3 ist mit dem Leitermuster1b auf der Vorderseite des Substrats1 elektrisch verbunden, die Unterseite des Halbleiterelements3 und das Leitermuster1b sind verbunden, wobei das Verbindungselement2 mit elektrischer Leitfähigkeit dazwischengeschaltet ist. Das Verbindungselement2 besteht beispielsweise aus Lot, sinterfähigen Silberpartikeln oder dergleichen. - Das Halbleiterelement
3 hat eine Oberflächenelektrode4 . Die Oberflächenelektrode4 wird auf der Vorderfläche (Oberseite) des Halbleiterelements3 gebildet. Die Oberflächenelektrode4 besteht beispielsweise aus einer silizium-(Si)-haltigen Aluminium (Al)-Legierung oder dergleichen. Die Oberflächenelektrode4 kann eine Deckschicht aufweisen. Die Deckschicht besteht beispielsweise aus Nickel (Ni), Gold (Au) oder einer durch Stapeln gebildeten Struktur. Der Leiter6 wird mit der Oberflächenelektrode4 verbunden. Das Verbindungselement5 ist auf dem Leiter6 angeordnet. Die Oberflächenelektrode4 und der Leiter6 werden durch ein Verbindungselement5 mit elektrischer Leitfähigkeit verbunden. Das Verbindungselement5 besteht beispielsweise aus Lot, sinterfähigen Silberpartikeln oder dergleichen. - Der Leiter
6 besteht beispielsweise aus Kupfer (Cu). Der Leiter6 kann aus einem anderen Material als das Verbindungselement5 bestehen. Der Draht8 ist mit dem Leiter6 durch ein Verbindungselement7 mit elektrischer Leitfähigkeit verbunden. Das Verbindungselement7 besteht beispielsweise aus Lot, sinterfähigen Silberpartikeln oder dergleichen. Das Verbindungselement7 besteht vorzugsweise aus beispielsweise einem silberhaltigen Sintermaterial (Ag-Sintermaterial). - Wie in
3 dargestellt, kann der Leiter6 eine Nut6a aufweisen, in die der Draht8 und das Verbindungselement7 hineinführen. Die Nut6a ist in einer Oberseite des Leiters6 vorgesehen. Der Draht8 und das Verbindungselement7 sind so angeordnet, dass sie in die Nut6a hineinführen. Da der Leiter6 eine Nut6a hat, ist es einfach, den Draht8 in die Nut6a zu stecken und den Draht8 an dem Verbindungselement7 zu befestigen. - Ein Draht
8 oder eine Vielzahl von Drähten8 können verwendet werden. Der Draht8 wird mit dem Leitermuster1a und1c verbunden. Das heißt, ein Ende des Drahts8 ist mit dem Leitermuster1a verbunden, und das andere Ende des Drahts8 ist mit dem Leitermuster1c verbunden. Das Leitermuster1a und das Leitermuster1c können verschiedene Muster oder ein kontinuierliches Muster sein. Im Falle der Vielzahl von Drähten8 müssen beide Enden jedes Drahtes8 nicht unbedingt an das Leitermuster1a bzw. Das Leitermuster1c gebondet werden. Ein Teil der Drähte8 kann mit einem anderen Leitermuster als dem Leitermuster1a und dem Leitermuster1c verbunden werden. Der Draht8 besteht beispielsweise aus Gold (Au), Aluminium (Al), Kupfer (Cu) oder dergleichen. - Als nächstes wird ein Verfahren zur Herstellung des Halbleitermoduls nach der ersten Ausführungsform der vorliegenden Erfindung mit Bezug auf
4 bis6 beschrieben. - Wie in
4 dargestellt, wird bei dem Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform das Halbleiterelement3 durch das Verbindungselement2 mit dem Leitermuster1b auf der Vorderseite des Substrats1 verbunden. Der Leiter6 wird auf Oberflächenelektrode4 des Halbleiterelements3 durch das Verbindungselement5 verbunden. - Als nächstes werden, wie in
5 dargestellt, beide Enden des Drahts8 mit dem Leitermuster1a und1c auf der Stirnseite des Substrats1 durch Ultraschallbonden verbunden. Beide Enden8a des Drahts8 sind an das Leitermuster1a und1c des Substrats1 so gebondet, dass der Draht8 über die Oberflächenelektrode4 des Halbleiterelements3 geht. Der Draht8 , der an das Leitermuster1a und1c des Substrats1 gebondet ist, ist elektrisch mit der Oberflächenelektrode4 des Halbleiterelements3 verbunden. - Nachdem die beiden Enden des Drahts
8 mit dem Leitermuster1a und1c verbunden sind, kann der Draht8 in Richtung des Leiters6 geschoben und verformt werden. Wenn der Leiter6 eine Nut6a zur Unterbringung des Drahts8 hat, wie in6 dargestellt, kann der Draht8 in die Nut6a geschoben werden, so dass der Draht8 in die Nut6a des Leiters6 eintritt. Nachdem der Draht8 in die Nut6a geschoben wurde, werden der Leiter6 und der Draht8 in der Nut6a durch das Verbindungselement7 verbunden. Somit ist das in1 bis3 dargestellte Halbleitermodul fertig hergestellt. - Als nächstes wird eine Wirkung des Halbleitermoduls gemäß der vorliegenden Ausführungsform beschrieben.
- Wie in
1 ,2 und3 dargestellt, ist der Draht8 mit dem Leiter6 durch ein Verbindungselement7 mit elektrischer Leitfähigkeit verbunden. Daher kann beispielsweise ein Strom, der von der Unterseite zur Oberflächenelektrode4 in der Richtung senkrecht zum Halbleiterelement3 fließt, durch das Verbindungselement5 mit elektrischer Leitfähigkeit, den Leiter6 , das Verbindungselement7 mit elektrischer Leitfähigkeit, den Draht8 und die Leitermuster1a und1c in dieser Reihenfolge fließen. - Wenn der Draht
8 zu diesem Zeitpunkt mit der Oberflächenelektrode4 des Halbleiterelements3 durch Ultraschallbonden wie im vorstehend beschriebenen normalen Halbleitermodul verbunden wird, wird in dem Verbindungsbereich, in dem die Oberflächenelektrode4 und der Draht8 verbunden werden, eine Ausschnittform gebildet. Daher konzentriert sich die Spannung bei Temperaturänderung, die durch wiederholte Wärmeentwicklung und Abkühlung während des Betriebs des Halbleitermoduls verursacht wird, auf eine Kante der Ausschnittform im Verbindungsbereich des Drahts8 und es kommt zum Bruch an der Kante der Ausschnittform. Mit anderen Worten, im Halbleitermodul wird die Umgebung des Halbleiterelements der größten Temperaturänderung ausgesetzt. In der Umgebung des Halbleiterelements, das der größten Temperaturänderung ausgesetzt ist, weist das oben beschriebene normale Halbleitermodul den Draht-Bondbereich durch Ultraschallbonden auf, wo sich die Spannung konzentriert. Das oben beschriebene normale Halbleitermodul hat daher ein Problem in Bezug auf die Zuverlässigkeit. Darüber hinaus kann das oben beschriebene normale Halbleitermodul einfach mit einem herkömmlichen Draht-Bondgerät erstellt werden. - Andererseits werden im Halbleitermodul nach der vorliegenden Ausführungsform beide Enden
8a des Drahts8 an das Substrat1 so gebondet, dass der Draht8 über die Oberflächenelektrode4 des Halbleiterelements3 geht, und der Draht8 ist elektrisch mit der Oberflächenelektrode4 verbunden. Daher wird im Verbindungsbereich, in dem die Oberflächenelektrode4 und der Draht8 verbunden sind, keine Ausschnittform gebildet, so dass die Konzentration der Spannung auf den Rand des Verbindungsbereichs des Drahts8 reduziert werden kann. Dementsprechend kann eine lange Lebensdauer des Verbindungsbereichs, in dem die Oberflächenelektrode4 des Halbleiterelements3 und der Draht8 verbunden sind, erreicht werden. Darüber hinaus wird ein Bonddraht als Draht8 verwendet, so dass die Anzahl der Drähte8 im Vergleich zu dem Fall, in dem der Draht8 mit der Oberflächenelektrode4 durch Lot verbunden ist, erhöht werden kann. Dadurch kann eine geringe Stromdichte pro Draht erreicht werden. Weiterhin ist der Draht8 an das Substrat1 gebondet, um zur Oberflächenelektrode4 zu gelangen, so dass ein Strom durch beide Enden des Drahts8 fließen kann. Dadurch kann eine geringe Stromdichte pro Draht erreicht werden. - Zusätzlich ist im Halbleitermodul nach der vorliegenden Ausführungsform das Halbleiterelement
3 zwischen dem Leitermuster (erster Leiterbereich) 1a und dem Leitermuster (zweiter Leiterbereich) 1c angeordnet. Daher kann der Draht8 elektrisch mit der Oberflächenelektrode4 verbunden werden, und dabei die Oberflächenelektrode4 des Halbleiterelements3 durchlaufen. Das erste Ende 8a1 von beiden Enden8a des Drahts8 wird an das Leitermuster1a gebondet, und das zweite Ende 8a2 von beiden Enden8a des Drahts8 wird an das Leitermuster1c gebondet. Daher kann zu jedem der beiden Enden8a des Drahts8 ein Strom fließen. - Zusätzlich wird im Halbleitermodul nach der vorliegenden Ausführungsform der Draht
8 durch das Verbindungselement7 mit dem Leiter6 auf der Oberflächenelektrode4 verbunden. Daher kann der Leiter6 , der mit dem Halbleiterelement3 und dem Draht8 elektrisch verbunden ist, durch das Verbindungselement7 -nicht durch Ultraschallbondenverbunden werden. Daher hat der Verbindungsbereich, an dem der Leiter6 und der Draht8 verbunden sind, keine Ausschnittform, und somit kann eine lange Lebensdauer des Verbindungsbereichs, in dem der Leiter6 und der Draht8 verbunden sind, erreicht werden. - Wenn der Draht
8 an die Oberflächenelektrode4 des Halbleiterelements3 gebondet ist und wenn der Draht8 mit der Oberflächenelektrode4 des Halbleiterelements3 durch das Verbindungselement wie beispielsweise Lot verbunden ist, ist der lineare Ausdehnungskoeffizient des Drahts8 im Allgemeinen mehrfach oder mehr so hoch wie der lineare Ausdehnungskoeffizient des Halbleiterelements3 . Daher tritt bei Temperaturänderung durch wiederholte Wärmeentwicklung und Kühlung während des Betriebs des Halbleitermoduls die thermische Belastung durch die Differenz zwischen dem linearen Ausdehnungskoeffizienten des Halbleiterelements3 und dem linearen Ausdehnungskoeffizienten des Drahts8 auf. Die thermische Belastung tritt in der Nähe der Verbindungsfläche auf, wo der Draht8 an die Oberflächenelektrode4 gebondet ist und in dem Verbindungselement, das das Halbleiterelement3 mit dem Draht8 verbindet, so dass ein Bruch in der Verbindungsfläche und dem Verbindungselement wahrscheinlich ist. - Andererseits wird in der vorliegenden Ausführungsform der Leiter
6 zwischen das Halbleiterelement3 und den Draht8 eingefügt, so dass nur die thermische Belastung durch die Differenz des linearen Ausdehnungskoeffizienten zwischen dem Leiter6 und dem Draht8 sowie die thermische Belastung durch die Differenz des linearen Ausdehnungskoeffizienten zwischen dem Halbleiterelement3 und dem Leiter6 berücksichtigt werden müssen. Da der Unterschied im linearen Ausdehnungskoeffizienten zwischen dem Leiter6 und dem Draht8 im Allgemeinen gering ist, ist die erzeugte thermische Spannung gering. Da keine Ausschnittform in einer Kante des Verbindungsbereichs, in dem das Halbleiterelement3 und der Leiter6 verbunden sind, gebildet wird, kann die erzeugte thermische Spannung geringgehalten werden, obwohl der Unterschied im linearen Ausdehnungskoeffizienten zwischen dem Halbleiterelement3 und dem Leiter6 groß ist. Darüber hinaus ist die Verbindungsfläche des Halbleiterelements3 und des Leiters6 mehr als zehnmal oder mehr so groß wie der Bereich eines Drahtbonds, so dass eine lange Lebensdauer des Verbindungsbereichs erreicht werden kann. - Zusätzlich sind im Halbleitermodul nach der vorliegenden Ausführungsform der Draht
8 und das Verbindungselement7 so angeordnet, dass sie in die Nut6a eindringen, so dass es einfach ist, den Draht8 in die Nut6a zu stecken und den Draht8 durch das Verbindungselement7 zu fixieren. - Darüber hinaus ist das Verbindungselement
7 im Halbleitermodul nach der vorliegenden Ausführungsform ein silberhaltiges Sintermaterial. Durch die Verwendung des Verbindungselements mit hoher Wärmebeständigkeit und hoher Zuverlässigkeit kann eine lange Lebensdauer des Verbindungsbereichs des Drahts8 erreicht werden. Dadurch kann die Zuverlässigkeit des Halbleitermoduls deutlich erhöht werden. - Zusätzlich ist im Halbleitermodul nach der vorliegenden Ausführungsform der Draht
8 aus Kupfer gefertigt. Dadurch können die Kosten für das Halbleitermodul reduziert werden. - Das Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform weist die folgenden Schritte auf. Beide Enden
8a des Drahts8 werden so an das Substrat1 gebondet, dass der Draht8 über die Oberflächenelektrode4 des mit dem Substrat1 verbundenen Halbleiterelements3 geht. Der Draht8 , der an das Substrat1 gebondet ist, ist mit der Oberflächenelektrode4 des Halbleiterelements3 elektrisch verbunden. Daher ist es möglich, ein Halbleitermodul herzustellen, für das eine lange Lebensdauer des Verbindungsbereichs, in dem die Oberflächenelektrode4 des Halbleiterelements3 und der Draht8 verbunden sind, und eine geringe Stromdichte pro Draht erreicht werden können. - Das Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform beinhaltet darüber hinaus die folgenden Schritte. Der Leiter
6 einschließlich der Nut6a in der Oberseite wird mit der Oberflächenelektrode4 verbunden. Der Draht8 wird in die Nut6a geschoben und dann werden der Leiter6 und der Draht8 in der Nut6a durch ein Verbindungselement7 mit elektrischer Leitfähigkeit verbunden. Es ist einfach, den Draht8 in die Nut6a zu stecken und den Draht8 mit dem Verbindungselement7 zu verbinden. Darüber hinaus können als Verdrahtungsstruktur auf einem Chip ein herkömmlicher Draht und ein herkömmlicher Draht-Bonding-Apparat für die Verdrahtung verwendet werden, ohne eine andere Kupferplatte oder dergleichen als den Draht zu verwenden. Daher besteht der Vorteil der einfachen Fertigung. - Ausführungsform 2
- Eine Struktur eines Halbleitermoduls nach einer zweiten Ausführungsform der vorliegenden Erfindung wird mit Bezug auf
7 bis9 beschrieben. Im Wesentlichen wird nur der Unterschied zur ersten Ausführungsform beschrieben.7 ist eine Frontansicht des Halbleitermoduls gemäß der vorliegenden Ausführungsform.8 ist eine Draufsicht auf das Halbleitermodul gemäß der vorliegenden Ausführungsform.9 ist eine Schnittansicht des Halbleitermoduls gemäß der vorliegenden Ausführungsform. - Wie in
7 ,8 und9 dargestellt, weist das Halbleitermodul nach der ersten Ausführungsform ähnlich dem Halbleitermodul nach der vorliegenden Ausführungsform im Wesentlichen das Substrat1 , das Verbindungselement2 , das Halbleiterelement3 , das Verbindungselement5 , den Leiter6 , das Verbindungselement7 und den Draht8 auf. - Wie in
8 dargestellt, können zwei Reihen Drähte8 nebeneinander an das Leitermuster1a und1c gebondet werden. Darüber hinaus können, wie in9 dargestellt, dann, wenn Drähte8 in der Nut6a des Leiters6 angeschlossen werden, zwei oder mehr Ebenen von Drähten8 vertikal verbunden werden. - Als nächstes wird ein Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform beschrieben.
- Das Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform ist ähnlich dem Verfahren zur Herstellung des Halbleitermoduls nach der ersten Ausführungsform und das Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform unterscheidet sich nur dadurch von dem Verfahren zur Herstellung des Halbleitermoduls nach der ersten Ausführungsform, dass beim Bonden von Drähten
8 zwei Reihen von Drähten8 Seite an Seite an das Leitermuster1a und1c gebondet werden. Drei oder mehr Reihen von Drähte8 können nebeneinander gebondet werden, und beide Enden8a der Drähte8 können an jeder Position der Leitermuster1a und1c gebondet werden. - Als nächstes wird eine Wirkung des Halbleitermoduls gemäß der vorliegenden Ausführungsform beschrieben. Ein Effekt, der in der Wirkung des Halbleitermoduls nach der ersten Ausführungsform nicht beschrieben wurde, wird nun beschrieben.
- Im Halbleitermodul nach der vorliegenden Ausführungsform sind zwei oder mehr Lagen von Verbindungsbereichen, in denen Leiter
6 und Draht8 verbunden sind, vorgesehen, so dass die Anzahl der mit einem Halbleiterelement3 elektrisch verbundenen Drähte8 beliebig erhöht werden kann, ohne von der Fläche des Halbleiterelements3 abhängig zu sein. Im Halbleitermodul sind nicht nur das Halbleiterelement3 , sondern auch die Wärmeentwicklung durch Verluste in den Drähten8 ein Faktor zur Verkürzung der Lebensdauer des Halbleitermoduls. In der vorliegenden Ausführungsform können die Stromdichte pro Draht reduziert und damit eine lange Lebensdauer des Halbleitermoduls erreicht werden. - Als nächstes werden Modifikationen des Halbleitermodul nach der vorliegenden Ausführungsform mit Bezug auf die
10 bis12 beschrieben. Sofern nicht anders angegeben, sind die Änderungen der vorliegenden Ausführungsform ähnlich wie die oben beschriebene vorliegende Ausführungsform ausgebildet, so dass die gleichen Komponenten mit den gleichen Bezugsziffern bezeichnet werden und ihre Beschreibung nicht wiederholt wird. - Wie in
10 dargestellt, sind in dem Halbleitermodul gemäß einer ersten Modifikation der vorliegenden Ausführungsform Drähte8 in einer zweiten Schicht zwischen Drähten8 in der ersten Schicht und Drähte in der ersten Schicht zwischen Drähten in der zweiten Schicht angeordnet. Das heißt, die Drähte8 in der ersten Ebene und die Drähte8 in der zweiten Ebene sind so angeordnet, dass sie Räume zwischen Drähten8 in der ersten Ebene und Räumen zwischen Drähten8 in der zweiten Ebene füllen. - Im Halbleitermodul kann gemäß der ersten Modifikation der vorliegenden Ausführungsform der Abstand zwischen den Drähten
8 in der ersten Schicht und den Drähten8 in der zweiten Schicht in Stapelrichtung reduziert werden. Dadurch kann das Halbleitermodul verkleinert werden. - Wie in
11 und12 dargestellt, wird in dem Halbleitermodul nach der zweiten Modifikation der vorliegenden Ausführungsform der Leiter12 weiter mit dem Leiter6 verbunden, wobei ein Verbindungselement11 mit elektrischer Leitfähigkeit eingefügt wird. Der Leiter12 hat eine Nut12a . Drähte14 sind in der Nut12a durch ein Verbindungselement13 mit elektrischer Leitfähigkeit verbunden. Die Drähte14 bestehen beispielsweise aus Gold (Au), Aluminium (Al), Kupfer (Cu) oder dergleichen. Der Leiter12 besteht z.B. aus Kupfer (Cu). Das Verbindungselement13 besteht beispielsweise aus Lot, sinterfähigen Silberpartikeln oder dergleichen. Die Drähte8 und die Drähte14 sind so angeordnet, dass sie über die Oberflächenelektrode4 des Halbleiterelements3 einander schneidend verlaufen. - Wenn zwei oder mehr Leiter mit dem Halbleiterelement
3 durch die Verbindungselemente verbunden sind, können der Leiter6 und die Drähte8 zuerst mit dem Verbindungselement7 verbunden werden, und dann können die Drähte14 und der Leiter12 mit dem Verbindungselement13 verbunden werden. Alternativ können das Verbindungselement7 und das Verbindungselement13 gleichzeitig ausgehärtet werden. - Im Halbleitermodul gemäß der zweiten Modifikation der vorliegenden Ausführungsform kann die Richtung, in der die Drähte
8 über die Oberflächenelektrode4 des Halbleiterelements3 und die Richtung, in der die Drähte14 über die Oberflächenelektrode4 des Halbleiterelements3 geht, unterschiedlich gestaltet werden. Dadurch kann der Freiheitsgrad der Anordnung der Drähte erhöht werden. - Ausführungsform 3
- Die Struktur eines Halbleitermoduls nach einer dritten Ausführungsform der vorliegenden Erfindung wird mit Bezug auf
13 bis15 beschrieben. Im Wesentlichen werden Unterschiede zur ersten Ausführungsform beschrieben.13 ist eine Frontansicht des Halbleitermoduls gemäß der vorliegenden Ausführungsform.14 ist eine Draufsicht auf das Halbleitermodul gemäß der vorliegenden Ausführungsform.15 ist eine vergrößerte Querschnittsansicht des Bereichs XV in13 des Halbleitermoduls gemäß der vorliegenden Ausführungsform entlang der LinieXV-XV in14 . - Wie in
13 ,14 und15 dargestellt, weist das Halbleitermodul nach der ersten Ausführungsform ähnlich dem Halbleitermodul nach der vorliegenden Ausführungsform im Wesentlichen das Substrat1 , das Verbindungselement2 , das Halbleiterelement3 , das Verbindungselement5 , den Leiter6 , das Verbindungselement7 und den Draht8 auf. - Wie in
13 und14 dargestellt, ist die Fläche des Leiters6 kleiner als die Fläche des Halbleiterelements3 , wenn der Leiter6 und das Halbleiterelement3 von oben betrachtet werden. Das heißt, in der Draufsicht ist der Leiter6 kleiner als das Halbleiterelement3 . Mit anderen Worten, der Bereich der Oberseite des Leiters6 ist kleiner als der Bereich der Oberseite des Halbleiterelements3 . Insbesondere ist die vertikale Breite des Leiters6 kleiner als die vertikale Breite des Halbleiterelements3 , und die horizontale Breite des Leiters6 ist kleiner als die horizontale Breite des Halbleiterelements3 . - Wie in
15 dargestellt, hat die Nut6a , wenn der Leiter6 die Nut6a hat, im Querschnitt eine solche Form, dass die Tiefe des zentralen Bereichs (Innenbereichs) der Nut6a groß und die Tiefe eines Endes der Nut6a flach ist, entlang einer Richtung, in der der Draht8 über die Oberflächenelektrode4 verläuft. Das heißt, der Leiter6 hat eine solche Form, dass die Tiefe des Endes der Nut6a geringer ist als die Tiefe des mittleren Bereichs der Nut6a entlang der Richtung, in der der Draht8 über die Oberflächenelektrode4 läuft. Die Tiefe jedes der beiden Enden der Nut6a kann geringer sein als die Tiefe des Mittelbereichs der Nut6a . - Das Verfahren zur Herstellung des Halbleitermoduls nach der vorliegenden Ausführungsform ist ähnlich dem Verfahren der Herstellung des Halbleitermoduls nach der ersten Ausführungsform.
- Als nächstes wird eine Wirkung des Halbleitermoduls gemäß der vorliegenden Ausführungsform beschrieben. Ein Effekt, der in den Effekten des Halbleitermoduls nach der ersten Ausführungsform und der zweiten Ausführungsform nicht beschrieben wurde, wird nun beschrieben.
- Im Halbleitermodul nach der vorliegenden Ausführungsform ist die Fläche des Leiters
6 kleiner als die Fläche des Halbleiterelements3 , wenn der Leiter6 und das Halbleiterelement3 von oben betrachtet werden. Dadurch kann ein Isolationsabstand zwischen dem Leitermuster1b und dem Draht8 , der einer hohen Spannung ausgesetzt ist und die Aufrechterhaltung der Isolation erfordert, gewährleistet werden. - Darüber hinaus ist im Halbleitermodul nach der vorliegenden Ausführungsform die Tiefe des Nutendes
6a geringer als die Tiefe des Mittelbereichs der Nut6a entlang der Richtung, in welcher der Draht8 über die Oberflächenelektrode4 verläuft. Dadurch kann der Isolationsabstand zwischen dem Leitermuster1b und dem Draht8 , der einer hohen Spannung ausgesetzt ist und eine Aufrechterhaltung der Isolation erfordert, gewährleistet werden. - Ausführungsform 4
- In der vorliegenden Ausführungsform wird das Halbleitermodul gemäß einer der oben beschriebenen ersten bis dritten Ausführungsformen auf ein Leistungswandlergerät angewendet. Obwohl die vorliegende Erfindung nicht auf ein bestimmtes Leistungswandlergerät beschränkt ist, wird als vierte Ausführungsform der Fall beschrieben, in dem die vorliegende Erfindung auf einen Drehstromwechselrichter angewendet wird.
-
16 ist ein Blockdiagramm, das die Konfiguration eines Leistungswandlersystems zeigt, in dem ein Halbleitermodul nach der vorliegenden Ausführungsform eingesetzt wird. - Das in
16 dargestellte Leistungswandlersystem weist ein Netzteil100 , ein Leistungswandlergerät200 und eine Last300 auf. Das Netzteil100 ist ein DC-Netzteil und ist konfiguriert, um das Leistungswandlergerät200 mit Gleichstrom zu versorgen. Das Netzteil100 kann aus verschiedenen Komponenten gebildet werden. Das Netzteil100 kann beispielsweise durch ein Gleichstromsystem, eine Solarbatterie oder eine Speicherbatterie gebildet werden, oder durch eine Gleichrichterschaltung oder einen an ein Wechselstromsystem angeschlossenen AC/DC-Wandler. Alternativ kann das Netzteil100 auch durch einen DC/DC-Wandler gebildet werden, der konfiguriert ist, um die von einem DC-System abgegebene Gleichspannung in eine vorgegebene Leistung/Spannung umzuwandeln. - Das Leistungswandlergerät
200 ist ein dreiphasiger Wechselrichter, der zwischen Netzteil100 und Last300 geschaltet und konfiguriert ist, um die vom Netzteil100 gelieferte Gleichspannung in Wechselstrom umzuwandeln und die Wechselspannung an die Last300 zu liefern. Wie in16 dargestellt, beinhaltet das Leistungswandlergerät200 eine Hauptwandlerschaltung201 , die konfiguriert ist, um die Gleichspannung in die Wechselspannung umzuwandeln und die Wechselspannung auszugeben, und einen Steuerkreis203 , der konfiguriert ist, um ein Steuersignal zur Steuerung der Hauptwandlerschaltung201 auszugeben. - Die Last
300 ist ein Drehstrommotor, der von der vom Leistungswandlergerät200 gelieferten Wechselspannung angetrieben wird. Die Last300 ist nicht auf eine bestimmte Anwendung beschränkt und ist ein Motor, der in verschiedenen Arten von elektrischen Geräten montiert ist. So kann beispielsweise die Last300 als Motor für ein Hybridfahrzeug, ein Elektrofahrzeug, ein Schienenfahrzeug, einen Aufzug oder eine Klimaanlage verwendet werden. - Die Details des Leistungswandlergeräts
200 werden im Folgenden beschrieben. Die Hauptwandlerschaltung201 beinhaltet ein Schaltelement und eine Freilaufdiode (nicht dargestellt), und das Schaltelement wird geschaltet, um dadurch die vom Netzteil100 gelieferte Gleichspannung in eine Wechselspannung umzuwandeln und die Wechselspannung an die Last300 zu liefern. Obwohl die Hauptwandlerschaltung201 verschiedene spezifische Schaltungskonfigurationen aufweisen kann, ist die Hauptwandlerschaltung201 nach der vorliegenden Ausführungsform eine zweistufige dreiphasige Vollbrückenschaltung und kann aus sechs Schaltelementen und sechs Freilaufdioden gebildet werden, die antiparallel zu den jeweiligen Schaltelementen geschaltet sind. Jedes Schaltelement und jede Freilaufdiode der Hauptwandlerschaltung201 wird durch ein Halbleitermodul202 gebildet, das einer der oben beschriebenen ersten bis dritten Ausführungsformen entspricht. Zwei der sechs Schaltelemente sind zu Ober- und Unterzweigen in Reihe geschaltet, und jeder Satz der Ober- und Unterzweige bildet jede Phase (eine U-Phase, eine V-Phase und eine W-Phase) der Vollbrückenschaltung. Ausgangsanschlüsse der jeweiligen Sätze des Ober- und Unterzweigs, d.h. drei Ausgangsanschlüsse der Hauptwandlerschaltung201 , sind mit der Last300 verbunden. - Zusätzlich beinhaltet die Hauptwandlerschaltung
201 eine Treiberschaltung (nicht dargestellt), die zur Ansteuerung jedes Schaltelements konfiguriert ist. Die Treiberschaltung kann in das Halbleitermodul202 eingebaut oder separat vom Halbleitermodul202 bereitgestellt werden. Die Treiberschaltung erzeugt ein Treibersignal zum Ansteuern jedes Schaltelements der Hauptwandlerschaltung201 und liefert das Steuersignal an eine Steuerelektrode jedes Schaltelements der Hauptwandlerschaltung201 . Insbesondere gibt die Treiberschaltung gemäß dem nachfolgend beschriebenen Steuersignal vom Steuerkreis203 ein Ansteuersignal zum Einschalten jedes Schaltelements und ein Ansteuersignal zum Ausschalten jedes Schaltelements an die Steuerelektrode jedes Schaltelements aus. Wenn das Schaltelement in einem EIN-Zustand gehalten wird, ist das Steuersignal ein Spannungssignal (EIN-Signal), das gleich oder höher ist als eine Schwellenspannung des Schaltelements. Wenn das Schaltelement in einem AUS-Zustand gehalten wird, ist das Steuersignal ein Spannungssignal (AUS-Signal), das gleich oder niedriger ist als die Schwellenspannung des Schaltelements. - Der Steuerkreis
203 steuert jedes Schaltelement der Hauptwandlerschaltung201 so, dass die gewünschte elektrische Leistung an die Last300 geliefert wird. Ausgehend von der an die Last300 zu liefernden elektrischen Leistung wird insbesondere die Zeitspanne (EIN-Zeitspanne) berechnet, in der jedes Schaltelement der Hauptwandlerschaltung201 eingeschaltet sein soll. So kann beispielsweise die Hauptwandlerschaltung201 per PWM-Steuerung gesteuert werden, um die Einschaltzeitdauer jedes Schaltelements entsprechend einer auszugebenden Spannung zu modulieren. Ein Steuerbefehl (Steuersignal) wird an den in der Hauptwandlerschaltung201 enthaltenen Treiberkreis ausgegeben, so dass ein EIN-Signal an das einzuschaltende Schaltelement und ein AUS-Signal an das zum jeweiligen Zeitpunkt auszuschaltende Schaltelement ausgegeben wird. Gemäß dem Steuersignal gibt die Treiberschaltung das EIN- oder AUS-Signal an die Steuerelektrode jedes Schaltelements als Steuersignal aus. - Im Leistungswandlergerät nach der vorliegenden Ausführungsform wird das Halbleitermodul nach einer der ersten bis dritten Ausführungsformen als jedes Schaltelement und jede Freilaufdiode der Hauptwandlerschaltung
201 verwendet. Dadurch kann eine lange Lebensdauer des Leistungswandlergeräts und eine geringe Stromdichte pro Draht des Halbleitermoduls erreicht werden. - Obwohl die vorliegende Ausführungsform im Zusammenhang mit dem Beispiel beschrieben wurde, in dem die vorliegende Erfindung auf einen zweistufigen Drehstromwechselrichter angewendet wird, ist die vorliegende Erfindung nicht darauf beschränkt und gilt für verschiedene Leistungswandlergeräte. Obwohl ein zweistufiges Leistungswandlergerät in der vorliegenden Ausführungsform verwendet wird, kann ein dreistufiges oder mehrstufiges Leistungswandlergerät verwendet werden, oder die vorliegende Erfindung kann auf einen einphasigen Wechselrichter angewendet werden, wenn Strom an eine einphasige Last geliefert wird. Wenn elektrische Energie an eine DC Last oder dergleichen geliefert wird, gilt die vorliegende Erfindung auch für einen DC/DC-Wandler oder einen AC/DC-Wandler.
- Darüber hinaus ist das Leistungswandlergerät, auf das die vorliegende Erfindung angewendet wird, nicht auf den Fall beschränkt, dass die oben beschriebene Last ein Motor ist. So kann beispielsweise das Leistungswandlergerät, auf das die vorliegende Erfindung angewendet wird, auch als Netzteil einer Entladungsbearbeitungsmaschine, einer Laserbearbeitungsmaschine, eines Induktionserwärmungskochers oder eines drahtlosen Stromversorgungssystems verwendet werden. Darüber hinaus kann das Leistungswandlergerät, auf das die vorliegende Erfindung angewendet wird, auch als Power Conditioner einer Photovoltaikanlage, eines Energiespeichersystems oder dergleichen verwendet werden.
- Es ist zu verstehen, dass die hierin offenbarten Ausführungsformen in jeder Hinsicht nur illustrativ und nicht einschränkend sind.
- Bezugszeichenliste
-
- 1
- Substrat
- 1a, 1b, 1c, 1e
- Leitermuster
- 2
- Verbindungselement
- 3
- Halbleiterelement
- 4
- Oberflächenelektrode
- 5
- Verbindungselement
- 6
- Leiter
- 7
- Verbindungselement
- 8
- Draht
- 8a
- beide Enden
- 9
- Verbindungselement
- 10
- Grundplatte
- 11
- Verbindungselement
- 12
- Leiter
- 13
- Verbindungselement
- 14
- Draht
- 100
- Netzteil
- 200
- Leistungswandlergerät
- 201
- Hauptwandlerschaltung
- 202
- Halbleitermodul
- 203
- Steuerkreis
- 300
- Last
- ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Patentliteratur
-
- JP 3809379 A [0003, 0004]
Claims (11)
- Halbleitermodul, das Folgendes aufweist: - ein Substrat; - ein Halbleiterelement, das mit dem Substrat verbunden ist und eine Oberflächenelektrode aufweist; und - einen Draht, wobei beide Enden des Drahtes an das Substrat gebondet sind, so dass der Draht über die Oberflächenelektrode des Halbleiterelements läuft, wobei der Draht elektrisch mit der Oberflächenelektrode verbunden ist.
- Halbleitermodul nach
Anspruch 1 , wobei das Substrat eine Isolierschicht und ein Leitermuster aufweist, das auf der Isolierschicht vorgesehen ist, wobei das Leitermuster einen ersten Leiterbereich und einen zweiten Leiterbereich beinhaltet, das Halbleiterelement zwischen dem ersten Leiterbereich und dem zweiten Leiterbereich angeordnet ist, und ein erstes Ende der beiden Enden des Drahtes an den ersten Leiterbereich gebondet ist, und ein zweites Ende der beiden Enden des Drahtes an den zweiten Leiterbereich gebondet ist. - Halbleitermodul nach
Anspruch 1 oder2 , das ferner Folgendes aufweist: einen Leiter, der an die Oberflächenelektrode angeschlossen ist; und ein auf dem Leiter angeordnetes Verbindungselement mit elektrischer Leitfähigkeit, wobei der Draht durch den Leiter und das Verbindungselement verbunden wird. - Halbleitermodul nach
Anspruch 3 , wobei der Leiter eine in einer Oberseite vorgesehene Nut aufweist, und der Draht und das Verbindungselement so angeordnet sind, dass sie in die Nut eindringen. - Halbleitermodul nach
Anspruch 4 , wobei die Nut eine solche Form aufweist, dass die Tiefe eines Endes der Nut geringer als die Tiefe eines zentralen Bereichs der Nut entlang einer Richtung ist, in der der Draht über die Oberflächenelektrode läuft. - Halbleitermodul nach einem der
Ansprüche 3 bis5 , wobei das Verbindungselement ein silberhaltiges Sintermaterial ist. - Halbleitermodul nach einem der
Ansprüche 3 bis6 , wobei der Bereich des Leiters kleiner ist als der Bereich des Halbleiterelements, wenn der Leiter und das Halbleiterelement von oben betrachtet werden. - Halbleitermodul nach einem der
Ansprüche 1 bis7 , wobei der Draht aus Kupfer ist. - Verfahren zur Herstellung eines Halbleitermoduls, wobei das Verfahren folgende Schritte aufweist: - Bonden beider Enden eines Drahtes an ein Substrat, so dass der Draht über eine Oberflächenelektrode eines mit dem Substrat verbundenen Halbleiterelements läuft; und - elektrisches Verbinden des an das Substrat gebondeten Drahtes mit der Oberflächenelektrode des Halbleiterelements.
- Verfahren zur Herstellung eines Halbleitermoduls nach
Anspruch 9 , das ferner folgende Schritte aufweist: - Verbinden eines Leiters mit der Oberflächenelektrode, wobei der Leiter eine Nut in der Oberseite aufweist; und - Drücken des Drahtes in die Nut und Verbinden des Leiters und des Drahtes in der Nut durch ein Verbindungselement mit elektrischer Leitfähigkeit. - Leistungswandlergerät, das Folgendes aufweist: - eine Hauptwandlerschaltung mit dem Halbleitermodul nach einem der
Ansprüche 1 bis8 , wobei die Hauptwandlerschaltung zum Umwandeln von zugeführter elektrischer Leistung und zum Ausgeben elektrischer Leistung ausgebildet ist; und - einen Steuerkreis, der konfiguriert ist, um ein Steuersignal zum Steuern der Hauptwandlerschaltung an die Hauptwandlerschaltung auszugeben.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2017-078948 | 2017-04-12 | ||
JP2017078948 | 2017-04-12 | ||
PCT/JP2017/043423 WO2018189948A1 (ja) | 2017-04-12 | 2017-12-04 | 半導体モジュール、半導体モジュールの製造方法および電力変換装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE112017007430T5 true DE112017007430T5 (de) | 2020-01-16 |
Family
ID=63793171
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112017007430.4T Withdrawn DE112017007430T5 (de) | 2017-04-12 | 2017-12-04 | Halbleitermodul, Verfahren zur Herstellung eines Halbleitermoduls und Leistungswandlergerät |
Country Status (5)
Country | Link |
---|---|
US (1) | US10930616B2 (de) |
JP (1) | JP6410998B1 (de) |
CN (1) | CN110462805A (de) |
DE (1) | DE112017007430T5 (de) |
WO (1) | WO2018189948A1 (de) |
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- 2017-12-04 JP JP2018527816A patent/JP6410998B1/ja not_active Expired - Fee Related
- 2017-12-04 DE DE112017007430.4T patent/DE112017007430T5/de not_active Withdrawn
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