DE102015211561A1 - Leistungsverfolgungsanschluss zum Verfolgen von Zuständen von Leistungsdomänen - Google Patents
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- 238000000034 method Methods 0.000 claims description 16
- 230000008859 change Effects 0.000 claims description 7
- 230000001105 regulatory effect Effects 0.000 claims description 6
- 230000005012 migration Effects 0.000 claims description 4
- 238000013508 migration Methods 0.000 claims description 4
- 230000001276 controlling effect Effects 0.000 claims 2
- 238000012550 audit Methods 0.000 abstract description 2
- 230000014759 maintenance of location Effects 0.000 description 6
- 239000003990 capacitor Substances 0.000 description 5
- 230000006870 function Effects 0.000 description 5
- 230000008569 process Effects 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 230000002093 peripheral effect Effects 0.000 description 3
- 101100494367 Mus musculus C1galt1 gene Proteins 0.000 description 2
- 101150035415 PLT1 gene Proteins 0.000 description 2
- 206010041347 Somnambulism Diseases 0.000 description 2
- 238000007726 management method Methods 0.000 description 2
- 238000012545 processing Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 238000005259 measurement Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
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- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/418—Total factory control, i.e. centrally controlling a plurality of machines, e.g. direct or distributed numerical control [DNC], flexible manufacturing systems [FMS], integrated manufacturing systems [IMS] or computer integrated manufacturing [CIM]
- G05B19/41885—Total factory control, i.e. centrally controlling a plurality of machines, e.g. direct or distributed numerical control [DNC], flexible manufacturing systems [FMS], integrated manufacturing systems [IMS] or computer integrated manufacturing [CIM] characterised by modeling, simulation of the manufacturing system
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3234—Power saving characterised by the action undertaken
- G06F1/3296—Power saving characterised by the action undertaken by lowering the supply or operating voltage
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3234—Power saving characterised by the action undertaken
- G06F1/3243—Power saving in microcontroller unit
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/32—Means for saving power
- G06F1/3203—Power management, i.e. event-based initiation of a power-saving mode
- G06F1/3234—Power saving characterised by the action undertaken
- G06F1/3287—Power saving characterised by the action undertaken by switching off individual functional units in the computer system
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F30/00—Computer-aided design [CAD]
- G06F30/30—Circuit design
- G06F30/32—Circuit design at the digital level
- G06F30/327—Logic synthesis; Behaviour synthesis, e.g. mapping logic, HDL to netlist, high-level language to RTL or netlist
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2119/00—Details relating to the type or aim of the analysis or the optimisation
- G06F2119/06—Power analysis or power optimisation
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
- Y02P90/00—Enabling technologies with a potential contribution to greenhouse gas [GHG] emissions mitigation
- Y02P90/02—Total factory control, e.g. smart factories, flexible manufacturing systems [FMS] or integrated manufacturing systems [IMS]
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- Engineering & Computer Science (AREA)
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- Manufacturing & Machinery (AREA)
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- Quality & Reliability (AREA)
- Automation & Control Theory (AREA)
- Power Sources (AREA)
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Abstract
Ein in einem System (z. B. einem Mikrocontrollersystem) enthaltener Leistungsverfolgungsanschluss mit mehreren Leistungsdomänen enthält einen Leistungsverfolgungsanschluss, der digitale Signale ausgibt, die die Zustände der Leistungsdomänen anzeigen. Wenn jede Leistungsdomäne unabhängig von anderen Leistungsdomänen im System ist, kann jede Leistungsdomäne ihren eigenen Satz von Leistungsverfolgungspins in dem Leistungsverfolgungsanschluss haben, die wenigstens teilweise extern gegenüber dem System sind. Wenn eine Leistungsdomäne mehrere Zustände hat, können mehrere Pins verwendet werden, um die mehreren Zustände anzuzeigen. In einigen Implementierungen kann der Leistungsverfolgungsanschluss Performanceniveaupins zum Bereitstellen von Performanceniveausignalen enthalten. Der Leistungsverfolgungsanschluss kann zum Erzeugen von Leistungsverlaufsprotokollen mit Leistungsverfolgungstestern eines Leistungsanalysators verbunden sein, der sich außerhalb des Systems befindet.
Description
- TECHNISCHES GEBIET
- Diese Offenbarung betrifft allgemein Hardware zum Erzeugen von Leistungsverlaufsprotokollen (Original: power traces) von Systemen mit konfigurierbaren Leistungsdomänen.
- HINTERGRUND
- Einige moderne Mikrocontrollersysteme sind in Leistungsdomänen organisiert. Ein Leistungsmanager des Mikrocontrollersystems kann eine Leistungskonfiguration einer Leistungsdomäne beruhend auf dem Status eines oder mehrerer Module (z. B. Peripheriegeräte) in der Leistungsdomäne ändern. Jedes Modul innerhalb einer Leistungsdomäne kann unabhängig von anderen Modulen in der Leistungsdomäne oder anderen Modulen in anderen Leistungsdomänen abgeschaltet werden. Zum Beispiel kann ein universeller asynchroner Empfänger/Übertrager (universal asynchronous receiver/transmitter USART) „wach” gehalten werden, während ein Übertragungsbuffer geleert wird und dann automatisch abgeschaltet werden, wenn die Aufgabe beendet ist. Wenn das Mikrocontrollersystem zum „Schlafwandeln” in der Lage ist, können die Module „aufgeweckt” werden, um Aufgaben auszuführen, bevor sie zum „Schlaf” zurückkehren. In einigen Systemen können Leistungsdomänen hierarchisch sein, so dass eine Leistungsdomäne angeschaltet werden wird, wenn eine Leistungsdomäne einer höheren Ebene angeschaltet wird, selbst wenn die Leistungsdomäne keine aktiven Module hat.
- Aus all den vorstehend genannten Gründen ist das Austesten (Original: debugging) von Mikrocontrollersystemen mit konfigurierbaren Leistungsdomänen ohne das Verfolgen (Original: tracing) von Zuständen der Leistungsdomänen schwierig. Darüber hinaus können Leistungsdomänen nicht unter Verwendung herkömmlicher chipintegrierter Testsysteme (Original: debug systems) ausgerüstet werden, weil solche Testsysteme üblicherweise erfordern, dass alle Leistungsdomänen in dem Mikrocontrollersystem gleichzeitig aktiv sind.
- ZUSAMMENFASSUNG
- Ein in einem System (z. B. ein Mikrocontrollersystem) mit mehreren Leistungsdomänen enthaltener Leistungsverfolgungsanschluss (Original: power trace port) enthält einen Leistungsverfolgungsanschluss, der digitale Signale ausgibt, die die Zustände der Leistungsdomänen anzeigen. Wenn jede Leistungsdomäne unabhängig von anderen Leistungsdomänen in dem System ist, kann jede Leistungsdomäne ihren eigenen Satz von Leistungsverfolgungspins in dem Leistungsverfolgungsanschluss haben, die wenigstens teilweise bezüglich des Systems extern sind. Wenn eine Leistungsdomäne mehrere Zustände hat, können mehrere Pins verwendet werden, um die mehreren Zustände anzuzeigen. In einigen Implementierungen kann der Leistungsverfolgungsanschluss Performanceniveaupins (Original: performance level pins) zum Bereitstellen von Performanceniveausignalen (Original: performance level signals) enthalten. Der Leistungsverfolgungsanschluss kann an Leistungsverfolgungstester eines Leistungsanalysators angeschlossen werden, der bezüglich des Systems extern ist, um Leistungsverlaufsprotokolle zu erzeugen.
- In einigen Implementierungen umfasst eine integrierte Schaltkreiseinrichtung: ein oder mehrere Module, die einer oder mehreren einer Mehrzahl von Leistungsdomänen der Einrichtung zugeordnet sind, eine Leistungsmanagementeinheit, die an den einen oder die mehreren Module angeschlossen ist und ausgestaltet ist, Zustände der Mehrzahl von Leistungsdomänen durch Ein-/ oder Ausschalten des einen oder der mehreren Module zu ändern und Signale zu erzeugen, die die geänderten Zustände anzeigen, und einen Leistungsverfolgungsanschluss, der an die Leistungsmanagereinheit angeschlossen ist und ein oder mehrere Leistungsverlaufsprotokollausgänge (Original: power trace outputs) für jede Leistungsdomäne zum Tragen des einen oder der mehreren Signale, wobei der eine oder die mehreren Leistungsverlaufsprotokollausgänge mit Bezug auf die Einrichtung wenigstens teilweise extern sind.
- Ein Verfahren zum Erzeugen von Leistungsspuren umfasst: Zuweisen eines oder von Modulen einer integrierten Schaltkreiseinrichtung zu einem oder mehreren einer Mehrzahl von Leistungsdomänen der Einrichtung, Ändern von Leistungszuständen der Mehrzahl von Leistungsdomänen durch Ein-/ oder Ausschalten des einen oder der mehreren Module, Erzeugen eines oder mehrerer Signale, die die geänderten Leistungszustände anzeigen und Anlegen des einen oder der mehreren Signale an einen oder mehrere Leistungsverlaufsprotokollausgänge eines Leistungsverfolgungsanschlusses der Einrichtung.
- Andere Implementierungen sind auf Verfahren, Schaltkreise und Systeme gerichtet.
- Spezielle Implementierungen des Leistungsverfolgungsanschlusses zum Verfolgen der Zustände der Leistungsdomänen können einen oder mehrere der folgenden Vorteile erreichen. Der Leistungsverfolgungsanschluss erlaubt ein Austesten des Systems (z. B. eines Mikrocontrollersystems) mit mehreren unabhängigen Leistungsdomänen. Die Integration eines Leistungsverfolgungsanschlusses in das System eliminiert die Notwendigkeit für eine teure externe Leistungsmessausrüstung, um den Leistungsverbrauch zu messen.
- KURZBESCHREIBUNG DER ZEICHNUNGEN
-
1 ist ein Blockschema eines exemplarischen Mikrocontrollersystems mit einem Leistungsverfolgungsanschluss. -
2 veranschaulicht ein exemplarisches Leistungsverfolgungsinterface. -
3 ist ein Zeitablaufdiagramm, welches eine Hardwaresequenz veranschaulicht, die verwendet wird, um eine Leistungswanderungsfunktion (Original: power walking task) in dem Mikrocontrollersystem der1 auszuführen. -
4 ist ein Flussdiagramm eines Vorgangs zum Erzeugen von Leistungsverfolgungssignalen. - DETAILLIERTE BESCHREIBUNG
-
1 ist ein Blockschema eines exemplarischen Mikrocontrollersystems100 mit einem Leistungsverfolgungsanschluss136 . In einigen Implementierungen enthält das Mikrocontrollersystem100 eine immer aktive Domäne102 , eine Leistungsdomäne104 (PD0), eine Leistungsdomäne106 (PD1) und eine Leistungsdomäne108 (PD2). Obwohl das System100 ein Mikrocontrollersystem ist, kann der Leistungsverfolgungsanschluss136 mit jeder integrierten Schaltkreiseinrichtung oder jedem System, welche mehrere unabhängig konfigurierbare Leistungsdomänen haben, verwendet werden. - In einigen Implementierungen enthält die immer aktive Domäne
102 eine Leistungsmanagereinheit110 , einen Echtzeitzähler (real time counter RTC)112 und ein ODER-Gatter114 . Die immer aktive Domäne102 ist immer in einem aktiven Modus. Die immer aktive Domäne102 kann Logik enthalten, um die Auswirkung auf den Gesamtleistungsverbrauch aufgrund dessen, dass sie immer im aktiven Modus ist, zu reduzieren. - Die Leistungsmanagereinheit
110 steuert Leistungskonfigurationen der Leistungsdomänen104 ,106 ,108 . Eine Leistungsdomäne kann zum Beispiel ein oder mehrere Module sein, die Energie aus derselben Energiequelle, z. B. auf der gleichen Spannung, beziehen. Das Mikrocontrollersystem100 kann eine Leistungskonfiguration für jede Leistungsdomäne104 ,106 ,108 aufrechterhalten. Eine Leistungskonfiguration schließt einen oder mehrere Parameter für eine Leistungsdomäne ein, die z. B. eine höhere oder niedrigere Spannung für die Leistungsdomäne, ob ein Takt für die Leistungsdomäne eingefroren ist, ob bestimmte Module freigegeben oder gesperrt (Original: enabled or disabled) sind oder in einem reduzierten Status für eine reduzierte Spannung arbeiten usw., spezifizieren. Das Ändern der Leistungskonfiguration einer Leistungsdomäne kann den Leistungsverbrauch einer Leistungsdomäne verstellen. In einigen Implementierungen können Spannungen für die Leistungsdomänen104 ,106 ,108 durch Spannungsregler132 (REG A) und134 (REG B) geregelt werden. Zum Beispiel kann der Regler132 ein Hochspannungs-Abwärtsspannungsregler (Original: high voltage „Buck” voltage regulator) sein und der Spannungsregler134 kann ein Niederspannungs-Schaltkondensator-Spannungsregler sein. In einigen Implementierungen kann das Umschalten zwischen Spannungsreglern automatisch, beruhend auf einer erforderlichen Performance, die durch Überwachen der Eingangstaktfrequenz der Leistungsdomänen gemessen werden kann, erfolgen. Wenn die Eingangstaktfrequenz ein Maximalniveau für eine gegebene Spannung übersteigt, kann der Spannungsregler die Spannung erhöhen oder auf einen anderen Spannungsregler umschalten. - Die Leistungsdomäne
104 enthält einen Taktcontroller116 , einen Ereigniscontroller118 und Module120 ,122 , die eine oder mehrere Funktionen erfüllen können. Zum Beispiel kann einer der Module120 ,122 ein Analog-Digital-Wandler (analog-to-digital converter ADC) sein. Der Taktcontroller116 kann ausgebildet sein, um Anforderungen von den Modulen120 ,122 nach Taktsignalen zu empfangen und den anfordernden Modulen die angeforderten Takte zur Verfügung zu stellen. Um ein Taktsignal zu erhalten, fordert ein Modul das Taktsignal an; anderenfalls kann der Taktgeber „eingefroren” werden, um den Leistungsverbrauch zu senken. Der Ereigniscontroller118 leitet Auslöser (Original: trigger) (Ereignisse oder Anforderungen) von einem auslösenden Modul zu einem geeigneten Modul, abhängig von dem Auslöser, weiter. Die Leistungsdomäne104 ist ein Beispiel einer Leistungsdomäne, welche am Ende einer Leistungsdomänenhierarchie steht, was heißt, dass alle höheren Leistungsdomänen von der Leistungsdomäne104 abhängen. Praktisch bedeutet dies, dass die Leistungsdomäne104 angeschaltet werden muss, bevor die Leistungsdomäne108 angeschaltet wird. Sobald die Leistungsdomäne108 angeschaltet ist, ist das gesamte Mikrocontrollersystem100 angeschaltet. - Die Leistungsdomäne
106 enthält zwei Module124 ,126 , die eine oder mehrere verschiedenartiger Funktionen ausführen können und Direktspeicherzugriffs-(direct memory access DMA)Modul128 . Die Leistungsdomäne108 enthält den Prozessor130 , z. B. eine zentrale Verarbeitungseinheit (central processing unit CPU) für das Mikrocontrollersystem100 . - Im Betrieb kann die Leistungsmanagereinheit
110 die Leistungskonfiguration einer Leistungsdomäne in Erwiderung auf auslösende Ereignisse von Modulen innerhalb oder außerhalb des Mikrocontrollersystems100 ändern. Zum Beispiel kann die Leistungsmanagereinheit110 eine Leistungsdomäne zum Verlassen eines Energiesparmodus veranlassen, so dass ein oder mehrere Module der Leistungsdomäne Vorgänge ausführen können. Dann kann das Modul aufhören, ein Ereignis zu generieren, um die Leistungsdomäne in ihre frühere Leistungskonfiguration zurück zu versetzen oder das Modul kann ein neues Ereignis generieren, um die Leistungskonfiguration einer anderen Domäne zu ändern. Um das Mikrocontrollersystem100 in Anbetracht der Leistung auszutesten (Original: to perform power aware debugging), kann die Leistungsmanagereinheit110 den Leistungsverfolgungsanschluss136 enthalten. Wie unter Bezug auf2 beschrieben, kann der Leistungsverfolgungsanschluss136 digitale Signale, die die Zustände der Leistungsdomänen104 ,106 ,108 anzeigen, zur Verfügung stellen. -
2 veranschaulicht ein beispielhaftes Leistungsverfolgungsinterface200 , welches das Mikrocontrollersystem100 mit Leistungsverfolgungstestern202 verbindet. Das Leistungsverfolgungsinterface200 enthält Leistungsverfolgungspins204 , die an den Leistungsverfolgungsanschluss136 der Leistungsmanagereinheit110 angeschlossen und wenigstens teilweise extern gegenüber der Baugruppe (Original: package)201 des Mikrocontrollersystems100 angeordnet ist. Im gezeigten Beispiel schließen die Leistungsverfolgungspins202 PWT2, PWT1 und PWT0 jeweils für die Leistungsdomänen PD0, PD1 und PD2 ein. Jeder Leistungsverfolgungspin kann ein digitales AN/AUS Signal zur Verfügung stellen, welches den Zustand der Leistungsdomäne anzeigt. Wenn eine Leistungsdomäne mehr als zwei Leistungszustände hat, können zusätzliche Leistungsverfolgungspins hinzugefügt werden, um die zusätzlichen Leistungszustände anzuzeigen. Zum Beispiel ist die Gesamtzahl der möglichen Zustände20 (2 × 2 × 5 = 20), wenn es in einem gegebenen System 3 unabhängige Leistungsdomänen gibt, wobei zwei der Leistungsdomänen 2 Zustände (AN/AUS) haben und die dritte Leistungsdomäne 5 Zustände hat. Ein solches Beispielsystem würde 20 Leistungsverfolgungspins enthalten, um die 20 möglichen Zustände darzustellen. In dem beispielhaften Mikrocontrollersystem100 haben wir ein einziges System mit hierarchischen Leistungsdomänen, welches zu 5 möglichen Zuständen und 3 Pins im Leistungsverfolgungsanschluss136 führt. Die Performanceniveaupins206 (PLT1, PLT0) werden verwendet, um die Performanceniveaus des Mikrocontrollersystems100 zu verfolgen, während das Mikrocontrollersystem100 aktiv ist, um ein Performanceniveau anzuzeigen (z. B. um einen Hochleistungs- oder Niedrigleistungsmodus anzuzeigen). Der Taktpin208 (PCLK) kann von einem Leistungsanalysator verwendet werden, um Leistungsverlaufsprotokolle zu synchronisieren. - Die Leistungsverfolgungspins
204 können an Logik in der Leistungsmanagereinheit110 angeschlossen sein. Jedes Mal, wenn eine Leistungsdomäne im aktiven Modus ist, wird der logische Pegel des entsprechenden Leistungsverfolgungspins geändert, indem, zum Beispiel, die Spannung des entsprechenden Leistungsverfolgungspins erhöht wird. Wenn zum Beispiel die Leistungsdomänen PD0, PD1 aktiv sind und PD2 inaktiv ist, würden die Leistungsverfolgungspins136 die digitalen Werte PWT2 = 0, PWT1 = 1, PWT0 = 1 ausgeben. Die digitalen Werte können von dem Leistungsverfolgungstester202 erfasst werden und verwendet werden, um ein Leistungsverlaufsprotokoll für das Mikrocontrollersystem100 zu erzeugen. In einigen Implementierungen kann der Leistungsverfolgungstester202 an eine Leistungsanalyseanwendung angeschlossen werden, die auf einem Gerät (z. B. einem Computer) läuft, die den Leistungsverbrauch des Mikrocontrollersystems100 in Echtzeit überwacht und Echtzeitdaten und eine Verlaufsgrafik zur Verfügung stellt. -
3 ist ein Zeitablaufdiagramm, welches eine Hardwaresequenz veranschaulicht, die verwendet wird, um eine Leistungswanderungsfunktion in dem Mikrocontrollersystem der1 auszuführen. Der obere Bereich der3 zeigt die Leistungsdomänenzustände der Leistungsdomänen PD0, PD1 und PD2 während der Aktivität oder des Leistungswanderns (Original: power walking). Leistungswandern (auch als „Schlafwandeln” bezeichnet) wird in der parallel anhängigen US-Patentanmeldung Nr. 14/043,445 „Configuring Power Domains of A Microcontroller System”, angemeldet am 1. Oktober 2013, beschrieben. - In dem gezeigten Beispiel sind die Zustände AKTIV, AUFRECHTERHALTUNG (Original: RETENTION) (RET), AN und AKTIV/LEISTUNGSWANDERN. Im Zustand AKTIV wird die Leistungsdomäne voll mit Leistung versorgt, um eine Funktion auszuführen. Im Zustand RET wird die Leistungsdomäne in einem Zustand niedriger Leistung gehalten, um den Leistungsverbrauch zu senken. Der AN-Zustand zeigt einen Übergang aus dem RET-Zustand in den AKTIV-Zustand an, wenn die Spannungsregler von einem Niederspannungs-Schaltkondensator-Spannungsregler
134 (z. B. 0,9 Volt) auf einen Hochspannungs-Abwärtsspannungsregler132 (z. B. 1,2 Volt) gewechselt werden. Im Zustand AKTIV/LEISTUNGSWANDERN ist die Leistungsdomäne aktiv und führt Leistungswandern aus, wobei die Leistungsmanagereinheit110 dynamisch eine oder mehrere der Leistungsdomänen PD0, PD1, PD2 auf eine relevante Leistungskonfiguration ändern kann, abhängig von Anforderungen von Leistungsverbrauchern (z. B. Modulen). - Unterhalb der Leistungsdomänenzustände befindet sich eine Grafik der geregelten Spannungen, die eine Änderung der Leistungskonfiguration aufgrund einer Änderung der geregelten Spannung veranschaulicht. Unterhalb der Grafik der geregelten Spannungen unsere Grafiken, die Leistungsverfolgungs- und Performancezustände veranschaulichen, die durch das dezimale Äquivalent der Binärsignale an den Leistungsverfolgungspins PWT2, PWT1, PWT0 dargestellt werden können. In dieser Beispielkonfiguration (3 Leistungsverfolgungspins) sind die drei in
1 gezeigten Leistungsdomänen (PD0, PD1, PD2) hierarchisch, was bedeutet, dass PD2 darauf angewiesen ist, dass PD1 geschaltet ist, welches wiederum darauf angewiesen ist, dass PD0 eingeschaltet ist. Die 3 Leistungsverfolgungspins (PWT2, PWT1, PWT0) bilden eine binäre (dezimale) Zahl, welche die höchste Domäne angibt, die AKTIV ist: 000(0) – System vollständig aktiv; 001(1) – immer aktiv an, während PD0, PD1, PD2 aus; 010(2) – immer aktiv und PDO an, während PD1, PD2 aus; 011(3) – immer aktiv, PD1, PD0 an, während PD2 aus; und 100(4) – alle Leistungsdomänen eingeschaltet. Da es zwei Performanceniveaupins PLT0, PLT1 gibt, gibt es vier mögliche Performanceniveauzustände, welche binär (dezimal) wie folgt dargestellt werden können: 00(0), 00(1), 10(2) und 11(3). Unterhalb der Leistungsverlaufsprotokoll- und Performanceniveausignale befinden sich Ausgangssignale für die Leistungsverfolgungspins PWT2, PWT1, PWT0. - Unter Bezug auf die
2 und3 wird eine Hardwaresequenz zum Leistungswandern beschrieben, durch die ein peripheres Modul selbst in Schlafmodi, in denen der Modultakt angehalten ist, selektiv beruhend auf peripheren Ereignissen aktiviert werden kann. Es gibt fünf Phasen in der exemplarischen Hardwaresequenz. Die fünf Phasen sind zur Unterstützung des Lesers im oberen Bereich der3 angegeben. - In Phase 1 befindet sich das Mikrocontrollersystem
100 im Zustand AKTIV und verwendet einen Abwärtsspannungsregler132 (1,2 V). Die Leistungsverfolgungspinausgaben während Phase 1 sind 101(4) und die Performanceniveauausgaben sind 10(2) oder Performanceniveau 2 (PL2). - In Phase 2 ist das Mikrocontrollersystem im Stand-by-Zustand (RET-Zustand), der Abwärtsspannungsregler
132 ist ausgeschaltet und der Schaltkondensator-Spannungsregler134 ist eingeschaltet (z. B. 0,9 V), um den Leistungsverbrauch durch das Mikrocontrollersystem100 zu reduzieren. Die Leistungsverlaufsprotokollausgaben in Phase 2 sind 001(1) und die Performanceniveauausgaben sind 00(0) oder PL0. - In Phase 3 tritt eine Auslösebedingung auf (z. B. ein RTC-Ereignis), um eine Funktion in den Leistungsdomänen PD0 und PD1 auszuführen. Diese Auslösebedingung wird von dem Mikrocontroller
100 in dem Zustand AKTIV konfiguriert, um keinen Interrupt zu erzeugen. Die Auslösebedingung löst ein Ereignis, zum Beispiel, für Modul120 in der Leistungsdomäne PDO aus. Der Schaltkondensator-Spannungsregler134 wird ausgeschaltet, und der Abwärtsspannungsregler132 wird eingeschaltet, was veranlasst, dass die Leistungsdomänen PD0, PD1 eingeschaltet werden und in den AKTIV-Zustand eintreten, basierend auf der Konfiguration des Ereignisses. Die Leistungsverlaufsprotokollausgaben in Phase 3 sind 011(3) und die Performanceniveauausgaben sind 10(2) oder PL2. - In Phase 4 wird die Aufgabe unter Verwendung des Leistungswanderns ausgeführt (Taktanforderung), sobald PL2 bereit ist (der Spannungskern 1,2 V erreicht hat). Die Leistungsverlaufsprotokollausgaben in Phase 4 sind 011(3) und die Performanceniveauausgaben sind 10(2) oder PL2.
- In Phase 5 (der Endphase in dieser Beispielsequenz) wird der Leistungswanderungsprozess abgeschlossen, das Mikrocontrollersystem
100 kehrt zum Stand-by (RET-Zustand) zurück oder ein AUFWACH-Signal wird zur Leistungsmanagereinheit110 gesendet, um den Mikrocontroller100 in den AKTIV-Zustand mit PL2 zurückversetzen. Der Abwärtsspannungsregler schaltet ab, der Schaltkondensator-Spannungsregler schaltet ein, die Leistungsverlaufsprotokollausgaben sind 001(1) und die Performanceniveauausgaben sind 00(0). -
4 ist ein Flussdiagramm eines Vorgangs400 zum Erzeugen von Leistungsverfolgungssignalen. Der Vorgang400 kann durch das Mikrocontrollersystem100 ausgeführt werden, wie unter Bezug auf1 –3 beschrieben. - Der Vorgang
400 kann beginnen, indem Zustände von Leistungsdomäne(n) in dem System bestimmt werden (400 ). Zum Beispiel kann eine Leistungsmanagereinheit eines Mikrocontrollersystems Leistungsdomänen in dem Mikrocontrollersystem konfigurieren, indem sie Spannungsregler, die den Leistungsdomänen zugeordnete Module mit Spannung versorgen, schaltet. Der Vorgang400 kann fortfahren, indem digitale Ausgangssignale erzeugt werden, die die aktiven Zustände der Leistungsdomänen darstellen (404 ). Zum Beispiel kann Logik in der Leistungsmanagementeinheit digitale AN/AUS-Signale erzeugen, die die Zustände von Leistungsdomänen anzeigen. Der Vorgang400 kann fortfahren, indem die digitalen Signale an Leistungsverfolgungspins der Leistungsmanagereinheit angelegt werden (406 ). Wenn eine Leistungsdomäne mehr als zwei Zustände haben kann, können dem Leistungsverfolgungsanschluss für die Leistungsdomäne zusätzliche Pins hinzugefügt werden, um die zusätzlichen Zustände der Leistungsdomäne anzuzeigen. In einigen Implementierungen können der Leistungsmanagereinheit Performanceniveaupins hinzugefügt werden, um Performanceniveaus des Systems anzuzeigen. - Während dieses Dokument viele spezifische Implementierungsdetails enthält, sind diese nicht als Beschränkungen des Umfangs dessen, was beansprucht werden kann, auszulegen, sondern lediglich als Beschreibung von Merkmalen, die für spezielle Ausführungsformen spezifisch sein können. Bestimmte Merkmale, die in dieser Beschreibung im Kontext getrennter Ausführungsformen beschrieben sind, können auch in Kombination in einer einzigen Ausführungsform implementiert werden. Umgekehrt können verschiedenartige Merkmale, die im Kontext einer einzigen Ausführungsform beschrieben sind, auch in mehreren Ausführungsformen separat oder in jeder geeigneten Unterkombination implementiert werden. Darüber hinaus können ein oder mehrere Merkmale aus einer beanspruchten Kombination in bestimmten Fällen aus der Kombination heraus gegriffen werden und die beanspruchte Kombination kann auf eine Unterkombination oder Abwandlung einer Unterkombination gerichtet werden, obwohl die Merkmale vorstehend als in bestimmten Kombinationen wirkend und ursprünglich sogar derart beansprucht worden sind.
Claims (17)
- Integrierte Schaltkreiseinrichtung (Original: integrated circuit device), umfassend: eine Baugruppe (Original: package); einen integrierten Schaltkreis, der in der Baugruppe enthalten ist und über Module verfügt, die Leistungsdomänen zugeordnet sind; eine Leistungsmanagementeinheit, die mit den Modulen verbunden ist und ausgestaltet ist, Zustände der Leistungsdomänen durch Regeln von Leistung zu den Modulen zu ändern und Signale zu erzeugen, die die geänderten Zustände anzeigen; und einen Leistungsverfolgungsanschluss, der mit der Leistungsmanagereinheit verbunden ist und Leistungsverlaufsprotokollausgänge (Original: power trace outputs) für die Leistungsdomänen zum Tragen der Signale enthält, wobei die Leistungsverlaufsprotokollausgänge wenigstens teilweise außerhalb der Baugruppe angeordnet sind.
- Einrichtung nach Anspruch 1, wobei der Leistungsverfolgungsanschluss weiterhin umfasst: einen oder mehrere Performanceniveauausgänge zum Tragen eines oder mehrerer Performanceniveausignale, die ein oder mehrere Performanceniveaus anzeigen, wobei der eine oder die mehreren Performanceniveauausgänge wenigstens teilweise extern gegenüber der Baugruppe sind.
- Einrichtung nach Anspruch 1, wobei das eine oder die mehreren Performanceniveaus Leistungsniveaus sind.
- Einrichtung nach Anspruch 1, weiterhin umfassend: einen ersten Spannungsregler, ausgestaltet zum Regeln der Spannung der Module der Leistungsdomänen während eines ersten Betriebsmodus; und einen zweiten Spannungsregler, ausgestaltet zum Regeln der Spannung der Module der Leistungsdomänen während eines zweiten Betriebsmodus.
- Einrichtung nach Anspruch 1, wobei die Einrichtung ein Mikrocontrollersystem ist.
- Einrichtung nach Anspruch 1, wobei die Signale digitale Signale sind.
- Einrichtung nach Anspruch 1, wobei die Leistungsdomänen hierarchisch sind.
- Einrichtung nach Anspruch 1, wobei wenigstens ein Zustand ein Leistungswanderungszustand ist.
- Verfahren zum Erzeugen von Leistungsverlaufsprotokollen, umfassend: Zuweisen von Modulen einer integrierten Schaltkreiseinrichtung zu Leistungsdomänen der integrierten Schaltkreiseinrichtung; Ändern der Leistungszustände der Leistungsdomänen durch Regeln von Leistung zu den Modulen; Erzeugen von Signalen, die die geänderten Leistungszustände anzeigen; und Anlegen der Signale an Leistungsverlaufsprotokollausgänge eines Leistungsverfolgungsanschlusses der integrierten Schaltkreiseinrichtung.
- Verfahren nach Anspruch 9, weiterhin umfassend: Erzeugen eines oder mehrerer Performanceniveauausgänge zum Tragen eines oder mehrerer Performanceniveausignale, die ein oder mehrere Performanceniveaus der integrierten Schaltkreiseinrichtung anzeigen.
- Verfahren nach Anspruch 9, wobei das eine oder die mehreren Performanceniveaus Leistungsniveaus sind.
- Verfahren nach Anspruch 9, weiterhin umfassend: Regeln der Spannung der Module der Leistungsdomänen während eines ersten Betriebsmodus der integrierten Schaltkreiseinrichtung; und Regeln der Spannung der Module der Leistungsdomänen während eines zweiten Betriebsmodus der integrierten Schaltkreiseinrichtung.
- Verfahren nach Anspruch 9, wobei die Einrichtung ein Mikrocontrollersystem ist.
- Verfahren nach Anspruch 9, wobei die Signale digitale Signale sind.
- Verfahren nach Anspruch 9, wobei die Leistungsdomänen hierarchisch sind.
- Verfahren nach Anspruch 9, wobei wenigstens ein Zustand ein Leistungswanderungszustand ist.
- Verfahren nach Anspruch 9, weiterhin umfassend: Erzeugen eines oder mehrerer Leistungsverlaufsprotokolle aus den Signalen.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US14/316,625 US9684367B2 (en) | 2014-06-26 | 2014-06-26 | Power trace port for tracing states of power domains |
US14/316,625 | 2014-06-26 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE102015211561A1 true DE102015211561A1 (de) | 2015-12-31 |
Family
ID=54840010
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102015211561.5A Pending DE102015211561A1 (de) | 2014-06-26 | 2015-06-23 | Leistungsverfolgungsanschluss zum Verfolgen von Zuständen von Leistungsdomänen |
Country Status (4)
Country | Link |
---|---|
US (1) | US9684367B2 (de) |
CN (1) | CN105223915B (de) |
DE (1) | DE102015211561A1 (de) |
TW (1) | TWI621010B (de) |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
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-
2015
- 2015-06-23 DE DE102015211561.5A patent/DE102015211561A1/de active Pending
- 2015-06-25 CN CN201510358162.7A patent/CN105223915B/zh active Active
- 2015-06-25 TW TW104120607A patent/TWI621010B/zh active
Also Published As
Publication number | Publication date |
---|---|
CN105223915A (zh) | 2016-01-06 |
TWI621010B (zh) | 2018-04-11 |
TW201617780A (zh) | 2016-05-16 |
US20150378423A1 (en) | 2015-12-31 |
CN105223915B (zh) | 2018-05-18 |
US9684367B2 (en) | 2017-06-20 |
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