DE102007027626A1 - Halbleiterbauelement und Verfahren zur Herstellung desselben - Google Patents
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Abstract
Die Erfindung betrifft ein Halbleiterbauelement (1) aus einem kristallinen Halbleiterkörper (2) mit einer Driftstreckenstruktur (3). Die Driftstreckenstruktur (3) weist eine vertikal ausgerichtete mit Halbleitermaterial oder Isolationsmaterial aufgefüllte Grabenstruktur (4) mit Grabenwänden (5, 6) auf. Eine Dotierstoffzone (7) ist an den Grabenwänden (5, 6) angeordnet und weist einen gegenüber dem Leitungstyp der Driftstrecke (8) komplementären Leitungstyp auf. Die Dotierstoffzone (7) weist Dotierstoffe auf, deren Sättigungslöslichkeit im Halbleiterkörper (2) um mindestens eine Zehnerpotenz geringer ist als die Sättigungslöslichkeit von Bor oder Phosphor. Ferner betrifft die Erfindung ein Verfahren zur Herstellung des Halbleiterbauelements (1).
Description
- Erfindungshintergrund
- Halbleiterbauelemente in Form von Hochspannungstransistoren wie beispielsweise „Cool MOS", die Driftstrecken aus Ladungskompensationszonen und Driftzonen aufweisen, ermöglichen gegenwärtig die niedrigsten Durchlassverluste. In den Ladungskompensationszonen und den Driftzonen wechseln sich Zonen mit hoher n- und p-Dotierung ab, während die Nettoladung in jeder Ebene gering bleibt. In Durchlassrichtung stehen somit hoch n-dotierte Driftzonen mit geringem Bahnwiderstand für den Stromfluss beim Durchschalten des Hochspannungstransistors zur Verfügung, während die Nettoladung im Halbleiterbauelement im Sperrfall ähnlich gering ist wie bei konventionellen vollständig auf hochohmigem Grundmaterial basierenden Halbleiterbauelementen. Somit ist trotz niedrigem Einschaltwiderstand eine hohe Sperrfähigkeit derartiger Ladungskompensations-Halbleiterbauelemente gewährleistet.
- Derartige Ladungskompensations-Halbleiterbauelemente können entweder durch eine Aufbautechnik hergestellt werden oder durch Einbringen von Grabenstrukturen in ein Driftstreckenmaterial. Bei der Herstellung durch eine Aufbautechnik werden nacheinander auf einem Substrat Epitaxielagen abgeschieden und jeweils derart maskiert, dass nebeneinander n- und p-Dotierbereiche durch beispielsweise Ionenimplatation entstehen können. Durch diese Ionenimplantation kann eine genaue Dosiskontrolle erfolgen, womit auch eine exakte Ladungskompensation zwischen Ladungskompensationszonen und Driftzonen der Driftstrecke möglich ist, d. h. die Differenz der implan tierten Akzeptoren und Donatoren kann mit Hilfe der Ionenimplantation exakt eingestellt werden.
- Nach Erreichen einer vorgesehenen Dicke der Epitaxielagen können anschließend die einzelnen ionenimplantierten Inseln in vertikaler Richtung zusammen diffundiert werden, so dass nebeneinander angeordnete Bereiche mit hoher n- und p-Dotierung für die Driftzonen und die Ladungskompensationszonen entstehen. Bei dieser Diffusion breiten sich die Inseln jedoch nicht nur in vertikaler Richtung, sondern auch in lateraler Richtung aus, so dass die Schrittweite zwischen den Zonen nicht beliebig verringert werden kann. Somit sind für die Reduzierung des Flächenbedarfs derartiger Halbleiterbauelemente Grenzen gesetzt.
- Das oben erwähnte zweite Prinzip, nämlich Grabenstrukturen in ein Driftstreckenmaterial einzubringen und anschließend die Grabenwände mit einem zum Driftzonenmaterial komplementären Leitungstyp zu versehen, ermöglicht zwar, die Breite der Ladungskompensationszonen einer Driftstrecke zu vermindern und damit die Schrittweite zu verringern, jedoch ist die exakte Einstellung der Ladungskompensation über eine Ionenimplantation der Grabenwände mit zunehmendem Aspektverhältnis der Grabenstruktur schwierig bis unmöglich, da mit zunehmendem Aspekt der Winkel, mit dem Ionen in die Grabenwände implantiert werden können, verkleinert werden muss. Unter Aspektverhältnis wird in diesem Zusammenhang das Verhältnis der Grabentiefe zu der Grabenbreite verstanden.
- Zusammenfassung der Erfindung
- Eine Ausführungsform der Erfindung weist ein Halbleiterbauelement aus einem kristallinen Halbleiterkörper mit einer Driftstreckenstruktur auf. Die Driftstreckenstruktur weist eine vertikal ausgerichtete mit Halbleitermaterial oder Isolationsmaterial aufgefüllte Grabenstruktur mit Grabenwänden auf. Eine Dotierstoffzone ist an den Grabenwänden angeordnet und weist einen gegenüber dem Leitungstyp der Driftstrecke gleichen oder dazu komplementären Leitungstyp auf. Die Dotierstoffzone weist ihrerseits Dotierstoffe auf, deren Sättigungslöslichkeit im Halbleiterkörper um mindestens eine Zehnerpotenz geringer ist als die Sättigungslöslichkeit von Bor oder Phosphor.
- Die Dotierstoffzone kann dabei auch aus zwei komplementären Dopanden aufgebaut sein, deren Sättigungslöslichkeit im Halbleiterkörper um mindestens eine Zehnerpotenz geringer ist als die Sättigungslöslichkeit von Bor und Phosphor. Diese beiden komplementären Komponenten der Dotierstoffzone können unterschiedlich stark ausdiffundiert sein und dadurch räumlich getrennt vorliegen. Die Driftzone des Halbleiterbauelements kann dabei im Wesentlichen durch eine der ausdiffundierten Komponenten der Dotierstoffzone gebildet sein.
- Ausführungsformen der Erfindung werden nun mit Bezug auf die beigefügten Figuren beschrieben.
- Kurze Figurenbeschreibung
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1 zeigt einen schematischen Querschnitt durch ein Halbleiterbauelement einer Ausführungsform der Erfindung; -
2 bis10 zeigen Prinzipskizzen zum Herstellungsverfahren eines Halbleiterbauelements gemäß1 ; -
2 zeigt einen schematischen Querschnitt durch einen Halbleiterwafer als Substrat; -
3 zeigt einen schematischen Querschnitt durch den Halbleiterwafer gemäß2 nach Aufbringen einer Epitaxieschicht; -
4 zeigt einen schematischen Querschnitt durch den Halbleiterwafer mit Epitaxieschicht nach Aufbringen einer Maskierungsschicht; -
5 zeigt einen schematischen Querschnitt durch den Halbleiterwafer gemäß4 nach Strukturieren der Maskierungsschicht; -
6 zeigt einen vergrößerten schematischen Querschnitt durch einen Teilbereich des Halbleiterwafers gemäß5 nach Einbringen einer Grabenstruktur; -
7 zeigt den vergrößerten Querschnitt des Teilbereichs gemäß6 nach Aufbringen einer Vorbelegungsschicht; -
8 zeigt ein Diagramm mit Sättigungskurven unterschiedlicher Dotierstoffe in einem Siliziumkristall; -
9 zeigt den vergrößerten Querschnitt des Halbleiterwafers gemäß7 nach Auffüllen der Grabenstruktur; -
10 zeigt einen schematischen Querschnitt durch den Halbleiterwafer nach Entfernen der strukturierten Maskierungsschicht; -
11 zeigt einen vergrößerten schematischen Querschnitt durch einen Halbleiterwafer mit einer aufgefüllten Grabenstruktur gemäß einer weiteren Ausführungsform der Erfindung. - Detaillierte Beschreibung der Ausführungsformen
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1 zeigt einen schematischen Querschnitt durch ein Halbleiterbauelement1 einer Ausführungsform der Erfindung. Dieses Halbleiterbauelement1 ist ein MOS-Feldeffekttransistor mit lateraler Gatestruktur. Die Erfindung kann jedoch auch für Halbleiterbauelemente des IGBT-Typs eingesetzt werden (Insulated Gate Bipolar Transistor). Auch Feldeffekthalbleiterbauelemente mit vertikaler Trenchgate-Struktur sowie Hochspannungsdioden sind mit dieser Erfindung realisierbar. Ferner können Feldeffektbauelemente mit lateraler Driftstrecke die Erfindung aufweisen. -
1 zeigt das Halbleiterbauelement1 aus einem kristallinen Halbleiterkörper2 mit einer Driftstreckenstruktur3 . Die Driftstreckenstruktur3 weist eine vertikal ausgerichtete mit Halbleitermaterial17 aufgefüllte Grabenstruktur4 mit Grabenwänden5 und6 auf. Dotierstoffzonen7 sind an den Grabenwänden5 und6 angeordnet und weisen einen gegenüber dem Leitungstyp der Driftstrecke8 komplementären Leitungstyp auf. Die Dotierstoffzonen7 weisen Dotierstoffe auf, deren Sättigungslöslichkeit im Halbleiterkörper2 um mindestens eine Zehnerpotenz geringer ist als die Sättigungslöslichkeit von Bor oder Phosphor. - Diese Sättigungslöslichkeit CS der Dotierstoffe in den Dotierstoffzonen
7 liegt zwischen einigen 1015 cm–3 ≤ CS ≤ 5 × 1018 cm–3. Geeignete Dotierstoffe können dazu aus der Gruppe Indium für eine p-Dotierung, oder Selen, Wismut und Schwefel für eine n-Dotierung in den Dotierstoffzonen7 derart angeordnet sein, dass eine in lateraler Richtung integrierte Dotierstoffdosis CD in der Driftstrecke8 und in den Dotierstoffzonen7 kleiner als die Durchbruchsladung CL mit CD ≤ CL von Silizium mit CL = 2 × 1012 cm–2 ist, wenn der Halbleiterkörper2 Silizium aufweist. - Dazu sind die Dotierstoffzonen
7 als Ladungskompensationszonen10 nur an den Grabenwänden5 und6 und nicht am Grabenboden9 angeordnet. Die laterale Breite bD der komplementär dotierten Dotierstoffzonen7 ist dabei kleiner als die Grabenbreite bG mit bD ≤ 1/2·bG. Außerdem ist die laterale Breite bD der komplementär dotierten Dotierstoffzonen7 kleiner als die Mesabreite bM der zwischen den Grabenstrukturen4 angeordneten Mesastrukturen11 der Driftstrecke8 mit bD ≤ 1/2·bM. - Die Tiefe h der Grabenstruktur
4 ist der Durchbruchspannung des Halbleiterbauelements1 angepasst. In dieser Ausführungsform der Erfindung entspricht die Tiefe h nahezu 60 μm, während die Breiten bM und bG etwa 6 μm aufweisen, so dass für die Grabenstruktur4 ein Aspektverhältnis A = h/bG von nahezu 10 resultiert. Die Dotierstoffzonen7 haben in diesem Ausführungsbeispiel eine Breite bD in Mikrometern mit bD ≤ 1 μm. - Das in
1 gezeigte Halbleiterbauelement1 mit einer vertikalen MOS-Feldeffekttransistorstruktur und lateraler Gatestruktur ist auf einem Substrat14 aufgebaut und weist auf einer Rückseite23 des Halbleiterkörpers eine Metallisierung25 für einen Drainkontakt D auf. Nahe der Oberseite22 des Halbleiterkörpers2 sind Bodyzonen26 eingebracht, die mit den Dotierstoffzonen7 elektrisch in Verbindung stehen. Innerhalb der Bodyzonen26 sind hochdotierte Sourceanschlusszonen27 angeordnet, die von einer Sourcemetallisierung31 kontaktiert werden, wobei die Sourcemetallisierung31 die pn-Übergänge zwischen den hochdotierten Sourceanschlusszonen27 und den Bodyzonen26 überbrückt. Ferner ist die Sourcemetallisierung31 mit einem Sourcekontakt S elektrisch verbunden. Die Bodyzonen26 können stark inhomogen dotiert sein und speziell unterhalb der hochdotierten Sourceanschlusszonen27 und im Bereich des Kontakts zur Sourcemetallisierung31 eine stark erhöhte Dotierung aufweisen. - Auf der Oberseite
22 des Halbleiterkörpers2 sind ferner Gateoxidschichten28 angeordnet, auf denen Gateelektroden29 , die mit einem Gatekontakt G in Verbindung stehen, abgeschieden sind. Die Gateelektroden29 sind über Zwischenoxidschichen30 von der Sourcemetallisierung31 isoliert und steuern über die Gateoxide28 Kanäle in den Bodyzonen26 zwischen den Sourceanschlusszonen27 und der Driftstrecke8 . Bevor jedoch das Gateoxid28 , die Gateelektrode29 , das Zwischenoxid30 und die Sourcemetallisierung31 auf eine derartige Halbleiterbauelementstruktur aufgebracht werden kann, wird zunächst zur Herstellung von mehreren Halbleiterchips für derartige Halbleiterbauelemente1 mit Grabenstruktur4 das nachfolgende Verfahren durchgeführt. - Zunächst wird ein Halbleiterwafer aus einem Halbleiterkörper
2 für Feldeffektbauelemente, die eine Driftstreckenstruktur3 aufweisen, strukturiert, indem eine Epitaxieschicht15 aus Driftstreckenmaterial12 auf der Oberseite des Halbleiterwafers abgeschieden wird. Danach werden Grabenstrukturen4 in das Driftstreckenmaterial12 eingebracht. Anschließend werden die Grabenwände5 und6 mit einer Dotierstoffquelle, die einen zu dem Leitungstyp des Driftstreckenmaterials12 komplementären Leitungstyp aufweist, belegt. Anschließend wird der Dotierstoff aus der Dotierstoffquelle in die Grabenwände5 und6 eindiffundiert. Abschließend wird zur Herstellung der Driftstreckenstruktur3 die Grabenstruktur4 mit einem Halbleitermaterial17 oder einem Isolationsmaterial, das in1 nicht gezeigt ist, aufgefüllt. Nach Fertigstellung einer derartigen Driftstreckenstruktur3 kann auf der Oberfläche22 des Halbleiterkörpers2 für einen MOSFET die entsprechende in1 gezeigte Struktur aufgebracht werden und schließlich kann auf der Rückseite des Halbleiterwafers eine Metallisierung25 für einen Drainkontakt D abgeschieden werden. - Ein derartiger Halbleiterwafer kann dann in einzelne Halbleiterchips aufgetrennt werden, wobei zur Vollendung des Halbleiterbauelements weitere Verfahrensschritte durchzuführen sind, indem der Halbleiterwafer in einzelne Halbleiterchips aufgetrennt wird und diese auf Bauelementträger mit mehreren Außenkontakten aufgebracht werden. Anschließend werden die Bauelementelektroden und/oder die Bauelementkontakte wie der Gatekontakt G und der Sourcekontakt S über Verbindungselemente mit Kontaktanschlussflächen des Bauelementträgers, die mit Außenkontakten des Halbleiterbauelements
1 elektrisch in Verbindung stehen, verbunden. Schließlich kann noch ein Halbleiterbauelementgehäuse unter Einschließen der einzelnen Halbleiterchips und der Verbindungselemente auf den Bauelementträger aufgebracht werden. - Die
2 bis10 zeigen Prinzipskizzen zum Herstellungsverfahren eines Halbleiterbauelements1 gemäß1 . Komponenten mit gleichen Funktionen wie in1 werden in den2 bis10 mit gleichen Bezugszeichen gekennzeichnet und nicht extra erörtert. -
2 zeigt dazu einen schematischen Querschnitt durch einen Halbleiterwafer19 als Substrat14 . Dabei ist der Halbleiterwafer19 ein hochdotiertes n+-leitendes Siliziumsubstrat aus monokristallinem Material. Dieser Halbleiterwafer19 weist eine Oberseite32 und eine Rückseite33 auf. -
3 zeigt einen schematischen Querschnitt durch den Halbleiterwafer19 gemäß2 nach Aufbringen einer Epitaxieschicht15 auf die Oberseite32 des Substrats14 . Die Epitaxieschicht15 ist dabei vom gleichen Leitungstyp wie das Substrat14 , jedoch schwächer als dieses dotiert. Zwischen die Epitaxieschicht15 und die Oberseite32 des Substrats können eine oder mehrere weitere Epitaxieschichten vom gleichen Leitfähigkeitstyp wie das Substrat aber unterschiedlicher Dotierstoffhöhe eingebracht werden. -
4 zeigt einen schematischen Querschnitt durch den Halbleiterwafer19 mit Epitaxieschicht15 gemäß3 nach Aufbringen einer Maskierungsschicht16 . Diese Maskierungsschicht16 ist ätzresistent für die nachfolgenden Strukturierungsprozesse der Epitaxieschicht15 . -
5 zeigt einen schematischen Querschnitt durch den Halbleiterwafer19 gemäß4 nach Strukturieren der Maskierungsschicht16 . Diese ätzresistente, maskierende und strukturierte Maskierungsschicht16 deckt das Driftstreckenmaterial12 der Epitaxieschicht15 in Bereichen ab, in denen keine Grabenstruktur einzubringen ist. Ferner weist die Maskierungsschicht16 nach dem Strukturieren Fenster34 in Bereichen auf, in denen Grabenstrukturen einzubringen sind. Da bei können die Fenster34 als Streifen angeordnet sein, falls Grabenstrukturen in Form von langgestreckten Gräben hergestellt werden sollen oder als inselförmige Flächen, wenn die Grabenstruktur säulenförmig in das Driftstreckenmaterial12 der Epitaxieschicht15 einzubringen ist. -
6 zeigt einen vergrößerten schematischen Querschnitt durch einen Teilbereich des Halbleiterwafers19 gemäß5 nach Einbringen einer Grabenstruktur4 . Das Aspektverhältnis A = h/bG der Grabenstruktur4 ist in dieser Darstellung nahezu 10, wobei die Breite bM der Mesastrukturen11 und die Breite bG der Grabenstruktur4 nahezu gleichgroß sind. Ein derartiges Aspektverhältnis kann durch eine anisotrope Ätzung erreicht werden, bei der beispielsweise reaktive Ionen in vertikaler Richtung aus einem Plasma auf den Siliziumhalbleiterwafer gerichtet werden, wobei die strukturierte Maskierungsschicht16 den Bereich der Mesastrukturen11 vor einer Trockenätzung schützt. Eine leichte Unterätzung, wie es6 zeigt, kann dabei nicht immer ausgeschlossen werden, so dass die Breite bG in diesem Fall größer ist als die Fensterbreite bF. Die Grabenbreite kann dabei auch über der Grabentiefe variieren. Außerdem wird bei diesem Durchführungsbeispiel des Verfahrens eine trockene reaktive Ionenätzung bis in den Bereich des hochdotierten Substrats14 hinein durchgeführt, so dass der Grabenboden9 mit dem hochdotierten monokristallinen Silizium des Substrats14 in Kontakt steht. Alternativ kann die beschriebene Ätzung in der Epitaxieschicht15 enden. -
7 zeigt den vergrößerten Querschnitt des Teilbereichs gemäß6 nach Aufbringen einer Vorbelegungsschicht20 auf die Grabenwände, wobei im Bodenbereich9 die Vorbelegungsschicht bereits wieder entfernt wurde, um sicherzustel len, dass der Grabenboden Kontakt zum monokristallinen Silizium des Substrats14 aufweist. Somit kann bei späteren Verfahrensschritten, wie bei dem Auffüllen der Grabenstruktur4 , auf die monokristalline Struktur des Substrats14 zugegriffen werden. Bei späterer Verfüllung des Grabens mit einem Isolatormaterial kann sogar auf die Entfernung der Vorbelegungsschicht20 am Trenchboden auch verzichtet werden. - Eine derartige Vorbelegung bei entsprechenden Vorbelegungstemperatur kann auf verschiedene Weise vorgenommen werden, wobei eine Möglichkeit darin besteht, die Halbleiterwafer
19 in einer Inertgasatmosphäre oder im Vakuum zwischen Feststoffplatten, die den entsprechenden Dotierstoff enthalten, zu stapeln und aufzuheizen. Andererseits ist es auch möglich, als Dotierstoffspender einen pulverförmigen Feststoff einzusetzen und die Halbleiterwafer mit dem pulverförmigen Feststoff in einem evakuierten Reaktionsraum einzuschließen. Alternativ kann der Dotierstoff auch direkt aus der Gasphase eindiffundiert oder in die Seitenwände mittels Ionenimplantation eingebracht werden. In einer weiteren alternativen Ausgestaltungsform können Schichten wie z. B. dotierte Gläser auf dem Halblietersubstrat und in den Gräben abgeschieden werden, welche den Dotierstoff enthalten und als Dotierstoffquelle dienen. Dazu werden als Dotierstoffspender Elemente eingesetzt, die im Siliziumkristall eine Sättigungskonzentration aufweisen, die mindestens um eine Zehnerpotenz niedriger ist als die Sättigungskonzentrationen von Bor und Phosphor in Silizium. - Bei diesem Verfahren zur Dotierung der Grabenwände
5 und6 zu Ladungskompensationszonen10 erfolgt eine selbst justierende Begrenzung der Randkonzentrationen an den Grabenwänden5 und6 , womit eine sehr genaue Einstellbarkeit der in das Halblei terbauelement eingebrachten Dotierstoffdosis CD erreicht werden kann. Dabei werden Dotierstoffdosen CD kleiner als die Durchbruchsladung CL mit CD ≤ CL von Silizium mit CL = 2 × 1012 cm–2 selbst justierend erreicht, was mit herkömmlichen Dotierstoffen mit deutlich höherer Sättigungslöslichkeit im Silizium schwierig einzustellen ist. Elemente, die als Akzeptoren eingesetzt werden können, sind in diesem Zusammenhang Indium, mit einer temperaturabhängigen Sättigungskonzentration zwischen 0,4 × 1018 cm–3 ≤ CS ≤ 2 × 1018 cm–3. Als Donatoren können Selen, Schwefel oder Wismut, deren Sättigungskonzentration zwischen 1 × 1014 cm–3 ≤ CS ≤ 2 × 1018 cm–3 liegt, eingesetzt werden, wobei die verbliebenen Halbleitermesen12 in diesem Fall p-dotiert sein müssen. Im Gegensatz dazu weisen die üblichen Dotierstoffe Phosphor, Arsen und Bor Sättigungskonzentrationen oberhalb von 1020 cm–3 auf, wobei Aluminium und Gallium noch oberhalb von 1019 cm–3 liegen. Es können sowohl die n- als auch die p-Dotierung in vorbeschriebener Weise als Dotierstoffzone7 über die Grabenwände eingebracht werden, wobei zwischen dem Einbringen der ersten und der zweiten Dotierung ein zusätzlicher Temperaturschritt vorgesehen werden kann. -
8 zeigt dazu ein Diagramm mit Sättigungskurven unterschiedlicher Dotierstoffe in einem Siliziumkristall. Dazu sind auf der Abszisse die Konzentrationen in Atome·cm–3 und in Richtung der Ordinate die Temperatur in °C aufgetragen. Die Sättigungskonzentration von Arsen, Phosphor und Bor steigt oberhalb von 900°C in einem Bereich zwischen 1020 cm–3 und 2 × 1021 cm–3 an, während eine weitere Gruppe, die Aluminium und Gallium umfasst, eine Sättigungskonzentration im Bereich zwischen 900 und 1200°C zwischen 1019 cm–3 und 1020 cm–3 aufweist. Die im Zusammenhang mit einer selbst justierenden Begrenzung der Randkonzentration bei der Dotierung interessan ten Elemente sind gemäß den Diagrammen der8 Schwefel, Selen und Wismut, die in dem Temperaturbereich um 1100°C eine Sättigungskonzentration zwischen 3 × 1015 cm–3 und 1018 cm–3 aufweisen. - Somit lässt sich bei einer Diffusions- bzw. Nachdiffusionstemperatur und Wahl des geeigneten Dotierstoffs mit geringer Sättigungslöslichkeit eine selbst justierende Begrenzung der Randkonzentration bei der Dotierung der Grabenwände einstellen. Als Feststoffquelle kann als Dotierstoffspender für eine Akzeptordotierung z. B. In2O3 eingesetzt werden. Als Feststoffquelle und Dotierstoffspender für eine Donatordotierung ist z. B. Bi2O3 geeignet.
- Neben der Feststoffdotierung entweder mit Feststoffplatten oder mit Feststoffpulver können die Grabenwände auch mittels einer chemischen Gasphasenabscheidung (CVD) mit einer Dotierstoffschicht als Dotierstoffquelle belegt werden. Dabei werden beispielsweise die Grabenwände mit einer den Dotierstoff aufweisenden Oxidschicht als Dotierstoffquelle belegt. Die Dicke der Dotierstoffquelle ist dabei unerheblich, solange die Randkonzentration der Dotierstoffquelle nicht erschöpft ist. Des weiteren ist es von Vorteil, wenn die Dotierstoffquelle aus einer Oxidschicht mit Dotierstoff aufgebaut ist, da ein Löslichkeitssprung zwischen der Konzentration in der oxidischen Dotierstoffquelle und dem Siliziumhalbleitermaterial der Grabenwände auftritt, der ebenfalls dafür sorgt, dass eine genaue Randkonzentration auf den Grabenwänden aus Silizium eingehalten werden kann. Nach erfolgter Eindiffusion der Dotierstoffe in das Silizium der Grabenwände kann die Dotierstoffquelle in Form einer Oxidschicht entfernt werden.
- In einer weiteren Durchführungsform des Verfahrens wird die Belegung mit einer Dotierstoffquelle bei einer geringeren Temperatur durchgeführt als die nachfolgende Eindiffusion der Dotierstoffe in die Grabenwände und zu einer Dotierstoffzone. Bevor jedoch eine Eindiffusion der Dotierstoffquelle erfolgt, kann die Dotierstoffquelle am Grabenboden der Grabenstruktur vollständig entfernt werden und an den Grabenwänden eventuell auch teilweise vermindert werden. Alternativ kann die Dotierstoffquelle auch in gelöster Form aufgeschleudert oder aufgesprüht werden.
- Die Eindiffusion der Dotierstoffe in das Driftstreckenmaterial an den Grabenwänden erfolgt bei den durch die Sättigungskonzentration vorgegebenen Diffusionstemperaturen TD zwischen 900°C ≤ TD ≤ 1100°C. Wurde die Dotierstoffquelle nach dem Belegen der Grabenwände und des Grabenbodens mit Dotierstoffen nicht beseitigt, so kann nach der Eindiffusion des Dotierstoffs der Grabenboden durch eine entsprechende Ätzung ebenfalls bis zum Bereich des monokristallinen Driftstreckenmaterials von komplementären Dotierstoffen befreit werden, jedoch ist durch den geringen Sättigungsgrad bereits gewährleistet, dass die Randkonzentration des komplementären Dotierstoffs für die Grabenwände im Grabenbodenbereich weit unter der Konzentration des n+-leitenden Substrats liegt, so dass in derartigen Fällen auf eine Grabenbodenätzung verzichtet werden kann.
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9 zeigt den vergrößerten schematischen Querschnitt des Halbleiterwafers19 gemäß7 nach Auffüllen der Grabenstruktur4 . Dabei kann die ätzresistente strukturierte Maskierungsschicht16 weiterhin auf den Mesastrukturen11 beibehalten werden, um bei einem späteren Einebnungsprozess der Oberfläche als Stoppschicht zu dienen. Beim Auffüllen der Grabenstrukturen4 vom Grabenboden9 aus bilden sich auch Abscheidungen auf den Mesastrukturen11 und sorgen für eine ungleichmäßige Oberseite22 des Halbleiterkörpers2 , so dass ein nachträgliches Einebnen der Oberseite22 erfolgen kann. Anstelle eines separaten Diffusionsschritts zum Eindiffundieren können eventuell auch die Temperaturen beim Abscheiden einer Grabenstrukturfüllung13 in den Grabenstrukturen4 genutzt werden, um eine begrenzte Eindiffusion in die Grabenwände5 und6 während dieses Abscheideprozesses zu ermöglichen. Üblicherweise liegen jedoch die Abscheidetemperaturen deutlich unterhalb der erforderlichen Eindiffusionstemperaturen z. B. zwischen 900 und 1100°C. Ferner weisen die Dotierstoffquellen an den Grabenwänden5 und6 oftmals Oxide oder Nitride auf, in denen die Dotierstoffe eingelagert sind, so dass im Fall einer epitaktischen Füllung noch vor dem Auffüllen der Grabenstruktur4 mit einem Halbleitermaterial17 diese Dotierstoffquellen zu entfernen sind, um polykristallines Wachstum zu vermeiden und monokristallines Wachstum zu ermöglichen. - In einer Ausführungsform der Erfindung wird zum Auffüllen der Grabenstruktur
4 mit einem Halbleitermaterial17 ein epitaktisches Wachstum vom Boden aus durchgeführt. Wenn die Grabenwände von Oxiden befreit sind, kann jedoch ein schnelleres Auffüllen der Grabenstruktur4 erfolgen, indem sowohl vom Grabenboden9 als auch von den Grabenwänden5 und6 aus das epitaktische Wachstum ermöglicht wird, bis die Oberseite22 des Halbleiterkörpers erreicht ist. In einigen Anwendungen genügt es auch, die Grabenstruktur mit Halbleitermaterial eines polykristallinen Typs aufzufüllen. Schließlich ist es auch möglich, die Grabenstrukturen4 mit einem Isolationsmaterial durch physikalische oder chemische Gasphasenabscheidung aufzufüllen. -
10 zeigt einen schematischen Querschnitt durch den Halbleiterwafer19 nach Entfernen der strukturierten Maskierungsschicht und einem Einebnen der Oberseite22 des Halbleiterkörpers2 . Die10 zeigt, dass durch dieses Verfahren der Dotierung der Grabenwände mit Hilfe von speziellen Dotierstoffen, eine Driftstreckenstruktur3 erreicht werden kann, die einen minimalen Flächenbedarf für die Ladungskompensationszonen10 aufweist und einen hohen Flächenanteil für die eigentlichen Strom führenden Bereiche der Driftzonen35 ermöglicht. Die Dotierung der epitaktisch im Graben abgeschiedenen Zone kann in vorteilhafter Weise so gewählt werden, dass eine möglichst gute Kompensation erreicht wird. -
11 zeigt einen vergrößerten schematischen Querschnitt durch einen Halbleiterwafer21 mit einer aufgefüllten Grabenstruktur24 gemäß einer weiteren Ausführungsform der Erfindung. Die Ausführungsform gemäß11 unterscheidet sich von der Ausführungsform gemäß9 zusätzlich dadurch, dass sich die Grabenstruktur24 zum Grabenboden9 hin verjüngt. Außerdem ist in der Grabenstruktur24 kein Halbleitermaterial angeordnet, sondern ein Isolationsmaterial18 , das die Grabenfüllung13 ausmacht. Die auf den Grabenwänden5 und6 angeordnete Dotierstoffzone7 weist die gleichen oben erwähnten Dotierstoffe auf wie beim Halbleiterbauelement1 . Der Vorteil einer derartigen Driftstreckestruktur3 besteht darin, dass die Mesastruktur11 , die sich zum Substrat14 hin verbreitert, einen Feldstärkenverlauf vorsieht, bei dem die maximale Feldstärke in etwa bei der Mitte36 der Driftzonen35 auftritt, und somit ein robusteres Halbleiterbauelement21 verwirklicht werden kann. - Dieses Halbleiterbauelement
21 ist deshalb robuster, weil eine Lawinenmultiplikation von Ladungsträgern etwa in einem Bereich der Mitte36 der Driftzonen35 bzw. beabstandet von den Bodyzonen26 und dem Substrat14 auftreten kann und damit eine Zerstörung der oberseitennahen komplexen Struktur des Halbleiterbauelements21 verhindert wird. In diesem oberflächennahen Bereich überwiegt nämlich bei konstanter Konzentration von Ladungsträgern in den Ladungskompensationszonen10 der Grabenwände5 und6 der Löcheranteil und vermindert somit die anstehende Feldstärke. Das Gleiche gilt für den Bereich der Driftzonen35 in der Nähe des Substrats14 oder beim Substratübergang, da hier ebenfalls die Kompensation nicht vollkommen ausgeglichen ist, zumal nun Elektronen als Ladungsträger überwiegen, und somit wiederum die Feldstärke vermindert ist. Lediglich in der Mitte36 der Driftzonen35 ist die Kompensation zwischen Löchern und Elektronen ausgeglichen, so dass sich hier die größte Feldstärke entwickelt. Damit wird gleichzeitig eine Filamentierung in der Nähe der Oberseite22 des Halbleiterkörpers2 oder eine Filamentierung in dem Übergang zum Substrat14 , was zu einer Zerstörung herkömmlicher Kompensationshalbleiterbauelemente führen könnte, verhindert. -
- 1
- Halbleiterbauelement (Ausführungsform)
- 2
- Halbleiterkörper
- 3
- Driftstreckenstruktur
- 4
- Grabenstruktur
- 5
- Grabenwand
- 6
- Grabenwand
- 7
- Dotierstoffzone
- 8
- Driftstrecke
- 9
- Grabenboden
- 10
- Ladungskompensationszone
- 11
- Mesastruktur
- 12
- Driftstreckenmaterial
- 13
- Grabenstrukturfüllung
- 14
- Substrat (des Halbleiterwafers)
- 15
- Epitaxieschicht
- 16
- Maskierungsschicht (ätzresistent)
- 17
- Halbleitermaterial
- 18
- Isolationsmaterial
- 19
- Halbleiterwafer
- 20
- Vorbelegungsschicht
- 21
- Halbleiterwafer (weitere Ausführungsform)
- 22
- Oberseite des Halbleiterkörpers
- 23
- Rückseite des Halbleiterkörpers
- 24
- Grabenstruktur (weitere Ausführungsform)
- 25
- Metallisierung (Rückseite des Halbleiterwafers)
- 26
- Bodyzone
- 27
- Sourceanschlusszone
- 28
- Gateoxidschicht
- 29
- Gateelektrode
- 30
- Oxidschicht
- 31
- Sourcemetallisierung
- 32
- Oberseite des Halbleiterwafers
- 33
- Rückseite des Halbleiterwafers
- 34
- Fenster in der Maskierungsschicht
- 35
- Driftzone
- 36
- Mitte einer Driftzone
- A
- Aspektverhältnis
- bD
- laterale Breite der Dotierstoffzone
- bF
- Fensterbreite
- bG
- Grabenbreite
- bM
- Mesastrukturenbreite
- CS
- Sättigungslöslichkeit
- CD
- Dotierstoffdosis
- CL
- Durchbruchsladung
- D
- Drainkontakt
- G
- Gatekontakt
- h
- Tiefe der Grabenstruktur
- S
- Sourcekontakt
Claims (41)
- Halbleiterbauelement, wobei das Halbleiterbauelement (
1 ) einen kristallinen Halbeiterkörper (2 ) mit einer Driftstreckenstruktur aufweist, und wobei die Driftstreckenstruktur (3 ) aufweist: – eine vertikal ausgerichtete mit Halbleitermaterial oder Isolationsmaterial aufgefüllte Grabenstruktur (4 ) mit Grabenwänden (5 ,6 ); – eine Dotierstoffzone (7 ), die an den Grabenwänden ((5 ,6 ) angeordnet ist; wobei die Dotierstoffzone (7 ) Dotierstoffe aufweist, deren Sättigungslöslichkeit im Halbleiterkörper (2 ) um mindestens eine Zehnerpotenz geringer ist als die Sättigungslöslichkeit von Bor oder Phosphor. - Halbleiterbauelement nach Anspruch 1, wobei die Sättigungslöslichkeit CS der Dotierstoffe im Halbleiterkörper (
2 ) zwischen 1 × 1014 cm–3 ≤ CS ≤ 5 × 1018 cm–3. - Halbleiterbauelement nach Anspruch 1 oder Anspruch 2, wobei die Sättigungslöslichkeit CS der Dotierstoffe der Dotierstoffzone (
7 ) zwischen 5 × 1015 cm–3 ≤ CS ≤ 2 × 1018 cm–3 liegt. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die Dotierstoffe mindestens einen Stoff der Gruppe Indium, Selen, Wismut oder Schwefel aufweisen.
- Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die Dotierstoffe zwei Stoffe aus der Gruppe In, Se, Bi oder S aufweisen.
- Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die Dotierstoffzone (
7 ) in sich ladungsträgerkompensiert ist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei der Grabenboden (
9 ) keine Dotierstoffzone (7 ) aufweist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die Dotierstoffzone (
7 ) eine Ladungskompensationszone (10 ) der Driftstreckenstruktur (3 ) ist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die laterale Breite bD der komplementär dotierten Dotierstoffzone (
7 ) kleiner ist als die Grabenbreite bG in der Driftstrecke (8 ) mit bD ≤ 1/2·bG und kleiner ist als die Mesabreite bM der zwischen den Grabenstrukturen (4 ) angeordneten Mesastrukturen (11 ) der Driftstrecke (8 ) mit bD ≤ 1/2·bM. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die Tiefe h der Grabenstruktur (
4 ) der Durchbruchspannung des Halbleiterbauelements (1 ) angepasst ist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei der Halbleiterkörper (
2 ) Silizium aufweist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei die Dotierstoffdosis CD in der Driftstrecke (
8 ) und in der Dotierstoffzone (7 ) kleiner als die Durchbruchsladung CL mit CD ≤ CL von Silizium mit CL = 2 × 1012 cm–2 ist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei das Halbleitermaterial in der Grabenstruktur monokristallin und undotiert oder vom entgegengesetzten Leitungstyp wie das Driftstreckenmaterial
12 ist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei das Halbleitermaterial in der Grabenstruktur (
4 ) monokristallin ist und den gleichen Leitungstyp und annähernd die gleiche Dotierstoffkonzentration wie das Driftstreckenmaterial (12 ) aufweist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei das Isolationsmaterial der Grabenstrukturfüllung (
13 ) SiO2, SiC oder Si3N4 aufweist. - Halbleiterbauelement nach einem der vorhergehenden Ansprüche, wobei das Isolationsmaterial der Grabenstrukturfüllung (
13 ) eine Schichtung aus SiO2-Schichten und Si3N4-Schichten aufweist. - Verfahren zur Herstellung von mehreren Halbleiterchips für Halbleiterbauelemente (
1 ) mit Grabenstruktur (4 ), wobei das Verfahren aufweist: – Strukturieren eines Halbleiterwafers aus einem Halbleiterkörper (2 ) für Feldeffektbauelemente, die eine Driftstreckenstruktur (3 ) aufweisen; – Einbringen einer Grabenstruktur (4 ) in das Driftstreckenmaterial (12 ); – Belegen der Grabenwände (5 ,6 ) mit einer Dotierstoffquelle, die einen zu dem Leitungstyp des Driftstreckenmaterials (12 ) komplementären Leitungstyp aufweist; – Eindiffusion des Dotierstoffes aus der Dotierstoffquelle in die Grabenwände (5 ,6 ); – Auffüllen der Grabenstruktur (4 ) mit einem Halbleitermaterial oder einem Isolationsmaterial. - Verfahren nach Anspruch 17, wobei zum Strukturieren des Halbleiterwafers zunächst auf ein hochleitendes Substrat (
14 ) des Halbleiterkörpers (2 ) mindestens eine schwächer dotierte Epitaxieschicht (15 ) aufgewachsen wird, die das Driftstreckenmaterial (12 ) bildet. - Verfahren nach Anspruch 17 oder 18, wobei als Halbleiterkörper (
2 ) ein Siliziumhalbleiter verwendet wird. - Verfahren nach einem der Ansprüche 17 bis 19, wobei vor dem Einbringen einer Grabenstruktur (
4 ) in das Driftstreckenmaterial (12 ) eine ätzresistente, maskierende und strukturierte Maskierungsschicht (16 ) aufgebracht wird, die das Driftstreckenmaterial (12 ) in den Bereichen abdeckt, in denen keine Grabenstruktur (4 ) einzubringen ist und die Fenster in den Bereichen aufweist, in denen Grabenstrukturen (4 ) einzubringen sind. - Verfahren nach einem der Ansprüche 17 bis 20, wobei zum Einbringen von Grabenstrukturen (
4 ) eine anisotrope Ätzung durchgeführt wird. - Verfahren nach einem der Ansprüche 17 bis 21, wobei zum Einbringen von Grabenstrukturen (
4 ) eine trockene reaktive Ionenätzung durchgeführt wird. - Verfahren nach einem der Ansprüche 17 bis 22, wobei zum Belegen der Grabenwände (
5 ,6 ) mit einer Dotierstoffquelle, ein Dotierstofftransport von einem Dotierstoffspender zu den Grabenstrukturen (4 ) mit anschließendem Freiätzen der Grabenböden (9 ) erfolgt, so dass am Grabenboden (9 ) auf Driftstreckenmaterial (12 ) zugegriffen werden kann, während die Grabenwände (5 ,6 ) mit der Dotierstoffquelle belegt werden. - Verfahren nach Anspruch 23, wobei als Dotierstoffspender eine Feststoffplatte eingesetzt wird, die zwischen Halbleiterwafern positioniert wird.
- Verfahren nach Anspruch 23, wobei als Dotierstoffspender ein den Dotierstoff enthaltendes Gas verwendet wird.
- Verfahren nach Anspruch 23, wobei als Dotierstoffspender ein Feststoff, der mit den zu dotierenden Halbleiterwafern in ein Vakuum eingeschlossen wird, eingesetzt wird.
- Verfahren nach einem der Ansprüche 23 bis 26, wobei als Dotierstoffspender für eine Akzeptordotierung ein In2O3 eingesetzt wird.
- Verfahren nach einem der Ansprüche 23 bis 27, wobei als Dotierstoffspender für eine Donatordotierung ein Bi2O3 eingesetzt wird.
- Verfahren nach einem der Ansprüche 17 bis 23, wobei die Grabenwände (
5 ,6 ) mittels einer chemischen Gasphasenabscheidung (CVD) mit einer Dotierstoffschicht als Dotierstoffquelle belegt werden. - Verfahren nach einem der Ansprüche 17 bis 23, wobei die Grabenwände (
5 ,6 ) mit einer den Dotierstoff aufweisenden Oxidschicht als Dotierstoffquelle belegt werden. - Verfahren nach einem der Ansprüche 17 bis 30, wobei die Belegung mit einer Dotierstoffquelle bei einer geringerer Temperatur erfolgt als die nachfolgende Eindiffusion in die Grabenwände (
5 ,6 ). - Verfahren nach einem der Ansprüche 17 bis 31, wobei vor der Eindiffusion die Dotierstoffquelle am Grabenboden (
9 ) der Grabenstruktur (4 ) vollständig und im Grabenwandbereich teilweise entfernt wird. - Verfahren nach einem der Ansprüche 17 bis 32, wobei die Eindiffusion des Dotierstoffes in das Driftstreckenmaterial (
12 ) der Grabenwände (5 ,6 ) bei Diffusionstemperaturen TD zwischen 900°C ≤ TD ≤ 1100°C durchgeführt wird. - Verfahren nach einem der Ansprüche 17 bis 33, wobei nach der Eindiffusion des Dotierstoffes mindestens der Grabenboden (
9 ) bis in den Bereich des monokristallinen Driftstreckenmaterials (12 ) oder des monokristallinen Substratmaterials freigelegt wird. - Verfahren nach einem der Ansprüche 17 bis 34, wobei zum Auffüllen der Grabenstrukturen (
4 ) mit einem Halbleiter material ein epitaktisches Wachstum des monokristallinen Siliziummaterials mindestens vom Boden aus durchgeführt wird. - Verfahren nach einem der Ansprüche 17 bis 34, wobei zum Auffüllen der Grabenstrukturen (
4 ) mit einem Halbleitermaterial ein epitaktisches Wachstum des monokristallinen Siliziummaterials mindestens vom Boden und von den Grabenwänden (5 ,6 ) aus durchgeführt wird und anschließend der Halbleiterwafer an seiner Oberseite eingeebnet wird. - Verfahren nach einem der Ansprüche 17 bis 34, wobei zum Auffüllen der Grabenstrukturen (
4 ) mit einem Halbleitermaterial ein polykristallines Halbleitermaterial in der Grabenstruktur (4 ) abgeschieden wird. - Verfahren nach einem der Ansprüche 17 bis 34, wobei zum Auffüllen der Grabenstrukturen (
4 ) mit einem Isolationsmaterial in der Grabenstruktur (4 ) ein Dielektrikum mittel physikalischer oder chemischer Gasphasenabscheidung abgeschieden wird. - Verfahren nach Anspruch 38, wobei als Isolationsmaterial eines der Isolationsmaterialien der Gruppe SiO2, SiC oder Si3N4 mittels PVD oder CVD abgeschieden wird.
- Verfahren nach Anspruch 38 oder Anspruch 39, wobei das Isolationsmaterial schichtweise abgeschieden wird, indem SiO2 und SiC oder SiO2 und Si3N4 im Wechsel abgeschieden werden.
- Verfahren zur Herstellung von mehreren Halbleiterbauelementen, wobei das Verfahren weiterhin aufweist: – Herstellung von Halbleiterchips gemäß Anspruch 16 oder Anspruch 38; – Aufbringen der Halbleiterchips auf einen Bauelementträger mit mehreren Außenkontakten in mehreren Halbleiterbauteilpositionen; – Verbinden von Bauelementelektroden der Halbleiterchips mit Kontaktanschlussflächen des Bauelementträgers, die mit Außenkontakten des Halbleiterbauelements (
1 ) elektrisch in Verbindung stehen; – Aufbringen eines Halbleiterbauelementgehäuses unter Einschließen der einzelnen Halbleiterchips und der Verbindungselemente; – Auftrennen des Bauelementträgers in einzelne Halbleiterbauelemente (1 ).
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---|---|---|---|---|
DE19942677A1 (de) * | 1999-09-07 | 2001-03-22 | Infineon Technologies Ag | Kompensationsbauelement und Verfahren zu dessen Herstellung |
DE10122364A1 (de) * | 2001-05-09 | 2002-11-21 | Infineon Technologies Ag | Kompensationsbauelement, Schaltungsanordnung und Verfahren |
DE10025567C2 (de) * | 2000-05-24 | 2003-03-27 | Infineon Technologies Ag | Verfahren zum Herstellen von tiefdotierten Gebieten in einem Halbleiterkörper |
DE10314596B3 (de) * | 2003-03-31 | 2004-11-25 | Infineon Technologies Ag | MOS-Kompensationstransistorbauelement und Herstellungsverfahren dafür |
US20060231915A1 (en) * | 2004-12-27 | 2006-10-19 | Third Dimension (3D) Semiconductor, Inc. | Process for high voltage superjunction termination |
-
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Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19942677A1 (de) * | 1999-09-07 | 2001-03-22 | Infineon Technologies Ag | Kompensationsbauelement und Verfahren zu dessen Herstellung |
DE10025567C2 (de) * | 2000-05-24 | 2003-03-27 | Infineon Technologies Ag | Verfahren zum Herstellen von tiefdotierten Gebieten in einem Halbleiterkörper |
DE10122364A1 (de) * | 2001-05-09 | 2002-11-21 | Infineon Technologies Ag | Kompensationsbauelement, Schaltungsanordnung und Verfahren |
DE10314596B3 (de) * | 2003-03-31 | 2004-11-25 | Infineon Technologies Ag | MOS-Kompensationstransistorbauelement und Herstellungsverfahren dafür |
US20060231915A1 (en) * | 2004-12-27 | 2006-10-19 | Third Dimension (3D) Semiconductor, Inc. | Process for high voltage superjunction termination |
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