DE10050044A1 - Wolframpolycidgate mit einer durch einen schnellen thermischen Prozeß erzeugten Nitridsperrschicht - Google Patents
Wolframpolycidgate mit einer durch einen schnellen thermischen Prozeß erzeugten NitridsperrschichtInfo
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Abstract
Es wird eine Gatestruktur vorgeschlagen. Die Gatestruktur weist eine Gateoxidschicht auf, eine Polysiliziumschicht oben auf der Gateoxidschicht, eine Wolframsilizidschicht oben auf der Polysiliziumschicht, und eine Nitridsperrschicht, die durch einen schnellen thermischen Prozeß ausgebildet wird, und über der Wolframsilizidschicht ausgebildet wird.
Description
Die vorliegende Erfindung betrifft ein Verfahren zur
Ausbildung des Gates eines Metalloxidhalbleitertransistors
(MOS-Transistors), und insbesondere ein Verfahren zur
Ausbildung einer Polycid-Gatestruktur.
Metalloxidhalbleitergeräte (MOS-Geräte) gehören zu den
populärsten Geräten in der modernen Halbleiterindustrie. Ein
MOS-Feldeffekttransistor (MOSFET) weist im allgemeinen drei
Kontakte auf: eine Gateelektrode, einen Sourcebereich und
einen Drainbereich. Das Gate steuert den durch den Transistor
fließenden Strom. Genauer gesagt wird in einem MOS-Transistor
Strom mit einer bestimmten Polarität (positiver Strom für
einen p-Kanal-MOSFET) und negativer Strom für einen
n-Kanal-MOSFET) vom Sourcebereich zum Drainbereich durch
einen Kanal unter Steuerung durch das Gate geleitet. Fig. 1
zeigt einen Querschnitt durch ein Beispiel für einen
Metall-Gate-MOS-Transistor, der ein Metallgate 10 oben auf
einem Oxid 11 aufweist, das sich oben auf einem Substrat 12
befindet (wodurch die "MOS-Struktur" ausgebildet wird). Der
MOS-Transistor weist eine Source 14 und einen Drain 16 auf,
die in dem Substrat 12 vorgesehen sind, und eine zur
Leitfähigkeit des Substrats entgegengesetzte Leitfähigkeit
aufweisen. Die Source 14 und der Drain 16 befinden sich an
gegenüberliegenden Enden des Gates 10. Ein Kanalbereich 18
trennt die Source 14 von dem Drain 16, und ist im
wesentlichen unterhalb des Gates 10 zu diesem ausgerichtet
angeordnet.
Wenn im Betrieb eine Spannung an das Metallgate 10 angelegt
wird, führt das erzeugte elektrische Feld zu einer
Umverteilung der Ladung in dem Kanalbereich 18.
Beispielsweise zieht eine positive Spannung negative Ladungen
an den Kanalbereich 18 an. Weist der Kanalbereich 18
normalerweise den p-Typ auf, dann kann die angezogene
negative Ladung die Leitfähigkeit des Kanalbereichs in den
n-Typ umwandeln. Die Oberfläche des Halbleitersubstrats 12
zwischen der Source 14 und dem Drain 16 wird so invertiert,
und bildet dort einen leitfähigen Kanal aus.
Bei der in Fig. 1 dargestellten Metallgatestruktur wird das
Metallgate 10 üblicherweise aus einem Metall wie
beispielsweise Aluminium hergestellt. Bei einem typischen
Prozeß muß infolge des niedrigen Schmelzpunktes von Aluminium
dieses abgelagert werden, nachdem der Sourcebereich 14 und
der Drainbereich 16 mit einem Hochtemperaturbehandlungsprozeß
behandelt wurden. Darüber hinaus erfordert die Musterbildung
bei dem Metallgate 10 bestimmte Positionierungstoleranzen,
wodurch die Packungsdichte der integrierten Schaltung negativ
beeinflußt wird.
Um diese Nachteile der Metallgatestruktur zu überwinden,
wurde eine Polysiliziumgatestruktur entwickelt. Fig. 2 zeigt
einen Querschnitt durch eine Polysiliziumgatestruktur.
Infolge des hohen Schmelzpunktes von Polysilizium kann das
Polysilizium-Gate 20 vor der Ausbildung des Sourcebereichs 22
und des Drainbereichs 24 abgelagert werden. Darüber hinaus
weist das dotierte Polysilizium 20 eine niedrige
Austrittsarbeit auf (häufig auch als Schwellenspannung
bezeichnet), im Vergleich zu Aluminium, so daß weniger
Leistung benötigt wird, und der Transistor schneller arbeiten
kann.
Der Nachteil der Polysilizium-Gatestruktur besteht darin, daß
Polysilizium im allgemeinen einen höheren spezifischen.
Widerstand aufweist als Aluminium, und nur einen schlechten
Kontakt mit einer Aluminiumverbindungseinrichtung ausbildet.
Daher ist die Zeitverzögerung beim Aufladen des Gates bei
Polysilizium-Gates erheblich größer. Aus diesem Grund wurde
die Ausbildung von Metallsilizidschichten oben auf
Polysiliziumschichten entwickelt, wodurch eine Gatestruktur
erhalten wird, die als Polycidgate bezeichnet wird, und in
Fig. 3 dargestellt ist. Das Polycid weist einen erheblich
niedrigeren spezifischen Widerstand auf, und bildet einen
besseren Kontakt mit Aluminium als Polysilizium. Zur
Ausbildung des Polycids wird eine Polysiliziumplatte 32 auf
einem dünnen Gateoxid 30 ausgebildet. Dann wird Silizid 34
ausgebildet, durch Reaktion eines Metalls wie beispielsweise
Wolfram mit dem oberen Abschnitt der Polysiliziumplatte 32.
Eine Abdeck-Siliziumnitridschicht 36 wird dann mittels
chemischer Dampfablagerung unter niedrigem Druck bei einer
Temperatur von etwa 780°C abgelagert, um das
darunterliegende Silizid 34 zu passivieren. Wenn der
voranstehend geschilderte Prozeß nicht sorgfältig gesteuert
wird, werden buckelförmige Defekte oder ein Trübungsdefekt
ausgebildet. Diese Defekte, von denen man annimmt, daß sie
infolge der Ausbildung von Oxiden auftreten, die reich an
Metallen sind, und in einer Sauerstoffumgebung bei niedrigen
oder mittleren Temperaturen erzeugt werden, können die
Ausbeute verringern, infolge einer Fehlausrichtung bei der
Photolithographie oder von Kurzschlüssen.
Die Erfindung wird nachstehend anhand zeichnerisch
dargestellter Ausführungsbeispiele näher erläutert, aus
welchen weitere Vorteile und Merkmale hervorgehen. Es zeigt:
Fig. 1 eine Querschnittsansicht eines Beispiels für eine
Metallgate-FET-Struktur;
Fig. 2 eine Querschnittsansicht eines Beispiels für eine
Polysiliziumgate-FET-Struktur;
Fig. 3 eine Querschnittsansicht eines Beispiels für eine
Polycidgate-FET-Struktur; und
Fig. 4 bis 8 Querschnittsansichten zur Erläuterung
verschiedener Stufen bei der Herstellung eines
Wolframpolycidgates gemäß einer Ausführungsform der
vorliegenden Erfindung.
Fig. 4 zeigt einen schematischen Querschnitt durch ein
Siliziumsubstrat 40 mit Isolierbereichen 42. Das
Siliziumsubstrat 40 kann ein herkömmliches Siliziumsubstrat
des p-Typs sein, eine Epitaxieschicht oder eine Schicht mit
Silizium auf einem Isolator. Die Isolationsbereiche 42 werden
typischerweise als Feldoxide bezeichnet, die eine Dicke von
etwa 3000 bis 10000 Angström aufweisen. Oben auf dem
Siliziumsubstrat 40 befindet sich eine dünne Schicht aus
Siliziumoxid 44. Bei der vorliegenden Ausführungsform weist
das Siliziumoxid 44 eine Dicke von etwa 100 Angström auf, und
wird als Gateoxid verwendet, um den Gateleiter und das
Substrat 40 zu isolieren.
Wie aus Fig. 5 hervorgeht, wird ein Polysiliziumschicht 46
mit einer Dicke von etwa 100 Angström abgelagert, unter
Verwendung eines geeigneten Prozesses der chemischen
Dampfablagerung unter niedrigem Druck (LPCVD). Bei der
vorliegenden Ausführungsform bildet der LPCVD-Prozeß die
Polysiliziumschicht 46 durch die Zerlegung von Silan (SiH4)
bei etwa 500 bis 650°C und einem Druck von etwa 0,2 bis
1,0 Torr aus, entsprechend der Reaktion SiH4 → Si + 2H2.
Weiterhin wird vorzugsweise die Polysiliziumschicht 46
in-situ während der Ausbildung der Schicht mit Dotierstoffen
des n-Typs oder des p-Typs dotiert.
Weiterhin wird eine Schicht 52 aus Wolframsilizid (Wsix) mit
einer Dicke von etwa 800 Angström abgelagert. Der Parameter
"x" bei Wsix gibt die Anzahl an Siliziumatomen an, und kann
zur Bestimmung eines Parameters verwendet werden, der als
"spezifischer Atomwert" bekannt ist. Die
Wolframsilizidschicht 52 wird durch chemische Dampfablagerung
ausgebildet. Die Ablagerungstemperatur beträgt vorzugsweise
550°C.
Wie nunmehr aus Fig. 6 hervorgeht, wird eine dünne
Nitridsperrschicht 56 über der Wolframsilizidschicht 52 unter
Verwendung eines schnellen thermischen Prozesses (RTP)
abgelagert. Bei einer spezifischen Ausführungsform wird die
Nitridschicht 56 in einer Einrichtung des Typs Centura 5200
ausgebildet, die von Applied Materials hergestellt wird. Im
einzelnen läßt man NH3-Gas in die Prozeßkammer bei einer
Temperatur von mehr als 750°C fließen, bei einer Flußrate
von etwa 3 Liter pro Minute, einem Druck von etwa einer
Atmosphäre, und etwa 60 Sekundenlang. Unter diesen
Bedingungen wird die Nitridsperrschicht 56 mehr als
50 Angström dick, und besteht aus Wolframnitrid (WNx).
Bevorzugt beträgt die minimale Dicke der Nitridsperrschicht
56 50 Angström.
Die Nitridsperrschicht 56 dient zur Verringerung mechanischer
Spannungen, und dazu, ein anomales Wachstum der
Wolframsilizidschicht 52 zu verhindern. Durch Ausbildung der
Nitridschicht mittels RTP ist darüber hinaus die sich
ergebende Nitridschicht 56 dicht und gleichmäßig. Darüber
hinaus wird ein Kontakt von Sauerstoff mit der
Wolframsilizidschicht 52 wirksamer verhindert. Dies führt zu
einer verringerten Wahrscheinlichkeit für das Auftreten
buckelförmiger oder trübungsartiger Defekte. Da die
Nitridschicht 56 mittels RTP ausgebildet wird, anstatt ein
N2-Plasma einzusetzen, kann die Bearbeitung in derselben
Kammer erfolgen, ohne den Wafer in eine andere Kammer
befördern zu müssen, die für ein N2-Plasma ausgelegt ist.
Hierdurch wird das Risiko eines Kontakts mit Sauerstoff
weiter verringert. Schließlich ist die Durchsatzrate unter
Verwendung von RTP erheblich größer als bei dem
N2-Plasmaverfahren.
Als nächstes wird, wie aus Fig. 7 hervorgeht, eine
Siliziumnitridschicht 57 über der Nitridsperrschicht 56
ausgebildet. Die Siliziumnitridschicht 57 wird bei einer
Prozeßtemperatur von 800°C hergestellt, mit SiH2Cl2 und NH3
als Reaktanden. Die Dicke der Siliziumnitridschicht 57
beträgt vorzugsweise 2000 Angström.
Schließlich werden, wie in Fig. 8 gezeigt ist, die
Materialschichten mit einem Muster versehen, und geätzt,
unter Verwendung einer Photolackschicht, um eine Gatestruktur
80 auszubilden. Dieses Muster wird unter Einsatz üblicher
Photolackbeschichtungs-, Belichtungs- und
Entwicklungsprozessen hergestellt.
Der Prozeß gemäß der vorliegenden Erfindung weist Vorteile im
Vergleich zum Stand der Technik auf. Der RTP-Prozeß, der zur
Ausbildung der Nitridsperrschicht 56 eingesetzt wird, stellt
Wärmeenergie zur Verfügung, welche interne, thermische
Spannungen in der Wolframsilizidschicht 52 verringert. Der
RTP-Prozeß stellt auch Wärmeenergie dazu zur Verfügung, eine
Phasentransformation des Wolframsilizids von der hexagonalen
Phase mit hohem Widerstand auf die tetragonale Phase mit
niedrigem Widerstand zu fördern.
Zwar wurde die bevorzugte Ausführungsform der Erfindung
dargestellt und beschrieben, jedoch wird darauf hingewiesen,
daß sich hierbei verschiedene Äderungen vornehmen lassen,
ohne vom Wesen und Umfang der Erfindung abzuweichen, die aus
der Gesamtheit der vorliegenden Anmeldeunterlagen hervorgeht
und von den beigefügten Patentansprüchen umfaßt sein sollen.
Claims (7)
1. Verfahren zur Ausbildung eines Gates auf einem
Halbleitersubstrat mit folgenden Schritten:
Ausbildung einer Gateoxidschicht auf dem Substrat;
Ausbildung einer Polysiliziumschicht oben auf der Gateoxidschicht;
Ausbildung einer Wolframsilizidschicht über der Polysiliziumschicht;
Ausbildung einer Nitridsperrschicht oben auf der Silizidschicht unter Verwendung eines schnellen thermischen Prozesses; und
Musterbildung und Ätzung der Nitridsperrschicht, der Wolframsilizidschicht, der Polysiliziumschicht und der Gateoxidschicht, um das Gate auszubilden.
Ausbildung einer Gateoxidschicht auf dem Substrat;
Ausbildung einer Polysiliziumschicht oben auf der Gateoxidschicht;
Ausbildung einer Wolframsilizidschicht über der Polysiliziumschicht;
Ausbildung einer Nitridsperrschicht oben auf der Silizidschicht unter Verwendung eines schnellen thermischen Prozesses; und
Musterbildung und Ätzung der Nitridsperrschicht, der Wolframsilizidschicht, der Polysiliziumschicht und der Gateoxidschicht, um das Gate auszubilden.
2. Verfahren nach Anspruch 1,
dadurch gekennzeichnet, daß eine
Siliziumnitridschicht über der Nitridsperrschicht vor
dem Mustererzeugungs- und Ätzschritt ausgebildet wird.
3. Verfahren nach Anspruch 1,
dadurch gekennzeichnet, daß die minimale
Dicke der Nitridsperrschicht 50 Angström beträgt.
4. Verfahren nach Anspruch 1,
dadurch gekennzeichnet, daß der schnelle
thermische Prozeß bei mehr als 750°C über einen
Zeitraum von mehr als 60 Sekunden bei einem Fluß von NH3
von etwa 3 Liter pro Minute durchgeführt wird.
5. Gatestruktur, welche aufweist:
eine Gateoxidschicht;
eine Polysiliziumschicht oben auf der Gateoxidschicht;
eine Wolframsilizidschicht oben auf der Polysiliziumschicht; und
eine Nitridsperrschicht, die durch einen schnellen thermischen Prozeß ausgebildet wird, und über der Wolframsilizidschicht ausgebildet wird.
eine Gateoxidschicht;
eine Polysiliziumschicht oben auf der Gateoxidschicht;
eine Wolframsilizidschicht oben auf der Polysiliziumschicht; und
eine Nitridsperrschicht, die durch einen schnellen thermischen Prozeß ausgebildet wird, und über der Wolframsilizidschicht ausgebildet wird.
6. Gatestruktur nach Anspruch 5,
dadurch gekennzeichnet, daß eine
Siliziumnitridschicht über der Nitridsperrschicht
vorhanden ist.
7. Gatestruktur nach Anspruch 5,
dadurch gekennzeichnet, daß die minimale
Dicke der Nitridsperrschicht 50 Angström beträgt.
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Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0362081B1 (de) * | 1988-09-09 | 1994-11-30 | France Telecom | Verfahren zum Herstellen von selbstjustierendem Wolframlsilizid |
DE19838106A1 (de) * | 1998-06-19 | 1999-12-23 | Promos Technologies Inc | Verfahren zur Verbesserung der Wärmebeständigkeit von Wolframsilicid |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5683941A (en) * | 1996-07-02 | 1997-11-04 | National Semiconductor Corporation | Self-aligned polycide process that utilizes a planarized layer of material to expose polysilicon structures to a subsequently deposited metal layer that is reacted to form the metal silicide |
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2000
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Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0362081B1 (de) * | 1988-09-09 | 1994-11-30 | France Telecom | Verfahren zum Herstellen von selbstjustierendem Wolframlsilizid |
DE19838106A1 (de) * | 1998-06-19 | 1999-12-23 | Promos Technologies Inc | Verfahren zur Verbesserung der Wärmebeständigkeit von Wolframsilicid |
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DE10050044B4 (de) | 2007-03-15 |
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