CN1692649A - 视频信号处理系统、视频信号处理装置和方法、记录媒体、以及程序 - Google Patents

视频信号处理系统、视频信号处理装置和方法、记录媒体、以及程序 Download PDF

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Abstract

本发明涉及在视频信号加密和解密中能迅速恢复同步偏差的视频信号处理系统、视频信号处理装置和方法、记录媒体以及程序。加密处理部22对将视频信号的垂直控制脉冲进行计数而得到的帧数Tx进行加密，并将它与未加密的帧数Tx和H/V控制脉冲一起发送出去。解密处理部32对加密后的帧数Tx进行解密，生成帧数Rx，并将它与帧数Tx和垂直控制脉冲一起供给校正部33。校正部33当帧数Tx与Rx连续16次不一致时，生成伪装入脉冲，供给加密处理部22与解密处理部32。本发明适用于与数字电视对应的显示装置。

Description

视频信号处理系统、视频信号处理装置 和方法、记录媒体、以及程序
发明领域
本发明涉及视频信号处理系统、视频信号处理装置和方法、记录媒体、以及程序，特别是在经加密的视频信号的解密中能更迅速恢复因同步偏差而引起不可能解密的状态的视频信号处理系统、视频信号处理装置和方法、记录媒体、以及程序。
背景技术
近年来，为考虑家庭内能够确保设置空间，且获取动人的图像，正在逐步普及采用大型且薄型结构的电视接收机及背投型的投影装置。
这些电视接收机和背投型投影装置，随着技术进步，与过去相比，其厚度做成相当的薄，而且还增加采用液晶或PDP(等离子体显示板)那样的平面显示板的显示装置，来取代从来的CRT(阴极射线管)。对于平面显示板提出了一种方法，就是将显示器挂到墙壁上，TV(电视)调谐器单元做成分开的型式，用电缆进行连接。
另外，还提出HDTV(高清晰度电视)用的DVD(数字通用盘)等。
然而，对于HDTV用的DVD等，在进行数字信号处理、并通过目前的D(数字)端子那样的伪信号连接方式中，一旦变换回伪信号之后，再次在显示器侧变换成数字信号，进行显示装置(例如HDTV的显示部分)的驱动(例如参照特开2001-36723号公报)，在这种D(数字)/A(伪)变换与A/D变换中就发生信号劣化而不理想。
因此，在电视接收机等的消费性设备中也提出采用现在的PC(个人计算机)与液晶显示器的连接中成为主流的数字信号的连接方式。
然而，数字信号连接中，在将数字信号照原样进行复制时，由于可在完全没有图像质量劣化的状态下简单地制成高价电影软件等的复制品，因此对实现该数字信号连接的连接器部分的视频信号或重叠音频信号的视频信号来说，必须进行所谓著作权保护用的加密处理。
用这种加密处理，最初是实现一般的认证处理。即，发送侧与接收侧各方保持例如几十组几十位的秘密数字串作为共同的密钥。利用公开密钥选择其中任意的约一半的数列，生成新的随机数列。然后，发送设备检查该数列，确认对方的接收设备是否具有接收从这儿想要传输出的信号的权限，判定为正确认定的接收设备。
其后，发送设备用成为取得视频信号同步用的基准的水平与垂直同步信号，使该数列在随机数发生电路中循环，用该随机数列使数字视频信号随机地反转，进行加密并传送。接收侧用同一数列生成随机数列，再次使该视频信号反转，通过这样将被加密的信号进行解密，进行原来的正确视频信号的显示。
这时，发送侧与接收侧由同一数列生成密钥，仅在视频信号的像素时钟产生的垂直同步信号期间的几十个时钟部分利用本密钥循环发生随机数列，并暂存此值作为帧密钥。然后，该随机数列在下一次进入的每个视频行的水平同步信号期间的几十个定时脉冲部分同样被循环并停止。然后，该值被引入下一级的循环移位寄存器电路，利用有效视频信号的显示期间部分的像素时钟，发生作为加密用的随机数列。
因此，有效视频信号的显示期间的开始点即使由ESD(静电放电)等噪声引起一些变动，发生错误，而由于下一行用的随机数生成中是使用前一个水平同步信号期间生成的随机数列，故继续解密而不紊乱。
又，在水平同步信号中混入噪声，或水平同步信号本身丢失时，各随机数生成的数列或多超前1行，或反之滞后1行，但即使在这种情况，在下一帧(隔行扫描信号时为下一场)中由于利用前1垂直同步信号期间存储的数列，进行随机数列生成动作，因此，即使画面上部几行中发生紊乱，由于不能正常解密而引起的图像混乱在最坏情况下也在1帧(或1场)以内结束。
然而，在垂直同步信号混入噪声，或垂直同步信号本身丢失时，临时存储的帧密钥值即随机数列本身也就失步，因此，解密错误引起的显示图像的混乱就长时间继续下去。但是一般地说，发送侧的周期是128帧左右，为了确认接收侧的连接设备继续是正当的，经常检查作为随机数生成的基准值用的秘密的值，并将随机数生成的基准值多位，因此即使最长的情况下也只限于2秒(128帧)左右的解密错误。
可是，对于经加扰的MPEG(运动图像专家组)2方式的数字电视广播等，频道切换时等因在取入几十帧经压缩的视频信号后进行解码和解扰，因此往往继续约2秒钟的无图像无声音状态。因而，若对此再加上加密处理及解密处理的错误，则最长继续4秒钟无图像无声音状态经加密的随机数状态的图像(只能看见噪声的图像)，存在上述那样不理想的问题。
又，数字广播中特别是广告节目，从高分辨率信号广播切换到通常信号广播(或反之)，存在进行称之为“斑点广播”的广播，但在这时密码的解密处理滞后的情况下，则存在不能显示“斑点广播”那样的问题。
同样，考虑壁挂TV的使用方式，进行数字连接的电缆有时长到5m，但在混入因ESD的瞬间外来噪声使垂直同步信号发生错误的噪声成分时，或发生连接电缆接头接触不良时，存在保持加密信号不变而不能解密的状态继续约2秒钟那样的问题。
发明内容
本发明就是要在视频信号的加密和解密中能迅速恢复因同步偏差引起的不能解密的状态。
本发明的视频信号处理系统，具备：根据数列将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密装置；发送未加密的所述第1帧数、用所述加密装置加密的所述视频信号以及用所述加密装置加密的所述第1帧数的发送装置；接收由所述发送装置发送的未加密的所述第1帧数、经加密的所述视频信号以及经加密的所述第1帧数的接收装置；根据数值到将所述接收装置接收的被加密的所述第1帧数与被加密的所述视频信号进行解密的解密装置；以及根据利用所述解密装置解密被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与利用所述接收装置接收的未被加密的所述第1帧数生成初始化脉冲的生成装置，所述解密装置根据所述生成装置生成的所述初始化脉冲，使所述数列初始化。
所述加密装置可以根据生成装置生成的初始化脉冲，使数列初始化。
所述生成装置能够在解密装置解密的帧数与接收装置接收到的未被加密的帧数不同时生成所述初始化脉冲。
所述加密装置和发送装置可由第1视频信号处理装置构成，接收装置、解密装置和生成装置可由第2视频信号处理装置构成。
所述发送装置和接收装置进行的通信能通过数字接口进行。
所述发送装置也可进一步发送使数列的发生同步的时钟，接收装置也可进一步接收时钟。
本发明的视频信号处理方法、第1记录媒体中所记录的程序以及第1程序，其特征在于，包含根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤；接收通过所述发送步骤处理所发送的未加密的所述第1帧数、经加密的所述视频信号以及经加密的所述第1帧数的接收步骤；根据数列将通过所述接收步骤处理所接收的被加密的所述第1帧数与被加密的所述视频信号进行解密的解密步骤；以及根据通过所述解密步骤处理将被加密的第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收的未被加密的所述第1帧数生成初始化脉冲的生成步骤，所述解密步骤的处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
本发明的第1视频信号处理装置，具备根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密装置；和发送未加密的所述第1帧数、用所述加密装置加密的所述视频信号以及用所述加密装置加密的所述第1帧数的发送装置。
所述发送装置也可进一步发送使所述数列的发生同步的时钟。
可进一步具备接收将从接收侧发送来的所述数列值进行初始化的初始化脉冲的接收装置，所述加密装置根据用所述接收装置接收的所述初始化脉冲，使所述数列值初始化。
本发明的第2视频信号处理方法、第2记录媒体中所记录的程序以及第2程序，其特征在于，包含根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；和发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤。
本发明的第2视频信号处理装置，具备接收表示未被加密的所述视频信号的帧数的第1帧数、加密的所述视频信号以及加密的所述第1帧数的接收装置；根据数列值将由所述接收装置接收的加密的所述第1帧数与加密的所述视频信号进行解密的解密装置；以及根据利用所述解密装置将被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与利用所述接收装置接收的未被加密的所述第1帧数生成初始化脉冲的生成装置，所述解密装置根据所述生成装置生成的所述初始化脉冲，使所述数列初始化。
所述生成装置可在解密装置解密的帧数与接收装置接收到的未被加密的帧数不同时，生成初始化脉冲。
可进一步具备对发送来所述加密的视频信号与第1帧数的对方侧发送初始化脉冲的发送装置。
本发明的第3视频信号处理方法、第3记录媒体中所记录的程序以及第3程序，其特征在于，包含接收表示未被加密的所述视频信号的帧数的第1帧数、加密的所述视频信号以及加密的所述第1帧数的接收步骤；根据数据列将通过所述接收步骤处理接收到的加密的所述第1帧数与加密的所述视频信号进行解密的解密步骤；以及根据通过所述解密步骤处理将被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收到的未被加密的所述第1帧数生成初始化脉冲的生成步骤，所述解密步骤处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数值到初始化。
第1本申请发明中，根据数列值将视频信号与表示发送的视频信号的帧数的第1帧数进行加密，发送并接收未被加密的第1帧数、加密的视频信号以及加密的第1帧数。根据数列将被加密的第1帧数与被加密的视频信号进行解密，根据将被加密的第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与未被加密的第1帧数，生成初始化脉冲。此外，根据初始化脉冲，使解密的数列初始化。
第2本申请本发明中，根据数值到将视频信号与表示发送的视频信号的帧数的第1帧数进行加密，发送未被加密的第1帧数、加密的视频信号以及加密的第1帧数。
第3本申请发明中，接收表示未被加密的视频信号的帧数的第1帧数、加密的视频信号以及加密的第1帧数，根据数列将被加密的第1帧数与被加密的视频信号进行解密。根据将被加密的第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与接收到的未被加密的第1帧数，生成初始化脉冲。此外，根据初始化脉冲，使解密的数列初始化。
附图说明
图1示出采用本发明的视频信号处理系统的构成例的框图。
图2为说明图1的视频信号处理系统中的视频显示处理用的流程图。
图3为说明图1的视频信号处理系统中的视频显示处理用的流程图。
图4示出图1的加密处理部与解密处理部的功能性构成框图。
图5为说明图4的加密处理部中的加密处理的流程图。
图6为说明图4的加密处理部中的加密处理的流程图。
图7为说明图4的解密处理部中的解密处理的流程图。
图8示出LFSR的原理构成的框图。
图9示出图8的LFSR的各触发器中输出的随机数列图。
图10示出图4的加密用随机数生成部的基本构成例的框图。
图11为说明图10的加密用随机数生成部中的随机数生成处理的流程图。
图12为说明图10的加密用随机数生成部中的随机数生成处理的流程图。
图13示出图4的解密用随机数生成部的基本构成例的框图。
图14示出图1的校正部的构成例的框图。
图15为说明图14的校正部中的装入脉冲生成处理的流程图。
图16为说明图14的校正部中的装入脉冲生成处理的流程图。
图17示出个人计算机的构成例的框图。
具体实施方式
图1表示采用本发明的视频信号处理系统1的构成例。该例中，考虑液晶显示器、PDP等壁挂型显示装置形态的场合，发送装置11(发送侧)由DTV(数字电视)调谐器21、加密处理部22、DVD(数字通用盘)播放器23、以及加密处理部24构成，显示装置12(接收侧)由选择器31、解密处理器32、校正部33、视频信号处理部34、视频信号驱动部35、扫描部36、以及显示板37构成。图中表示步骤的记号表示后述图2与图3流程图的处理步骤。
DTV调谐器21，接收通过未图示的天线接收到的MPEG2方式的数字广播信号，并解调，将解调得到的视频信号供给加密处理部22。
DVD播放器23重放未图示的DVD，将得到的数字视频信号(图像信号)供给加密处理部24。
加密处理部22和24分别对由DTV调谐器21供给的视频信号或DVD播放器23供给的视频信号进行加密。该加密处理参照图4至图6在以后说明。此外，加密处理部22和24将例如以128帧作为1周期情况下的、表示该周期中的帧的位置的帧数Tx是通过计数视频信号的垂直同步信号数进行计数而求得的帧数，例如1至128中任一个值)进行加密。
加密处理部22和24通过数字接口25与显示装置12的选择器31连接，加密后的视频信号、未被加密的帧数Tx、后述的H/V控制信号、以及加密后的帧数Tx通过数字接口25，供给选择器31。数字接口25中，数字视频信号和消隐期间重叠的音频信号被加密，在该信号状态下使得不能经由该线对VTR(磁带录像机)不能违法拷贝(即使拷贝，由于不能解密，故不能利用)。
这时，加密处理部22和24将未被加密的帧数Tx(当然是与经加密的帧数Tx同一帧数)与H/V控制信号，与加密后的视频信号和帧数Tx一起发送。前2者未被加密，后2者经加密。
选择器31根据用户的指示选择来自加密处理部22的信号或来自加密处理部24的信号之一，供给解密处理部32。
解密处理部32首先将加密后的帧数Tx进行解密。设定解密后的帧数Tx作为帧数Rx。解密处理部32将输入信号中的H/V控制信号、未被加密的帧数Tx以及现在设定的帧数Rx(加密处理部22或24中加密后的帧数Tx由解密处理部32所解密的帧数)供给校正部33。
校正部33通过比较解密处理部32设定的帧数Rx(接收侧的帧数)与解密处理部32供给的帧数Tx(未被加密的帧数Tx)，检测出计数误差。校正部33在接收侧的帧数Rx与发送侧的帧数Tx不一致时，或者以128帧作为1周期对解密处理部32供给的垂直控制脉冲进行计数，并在计数得到的帧数从128(约2秒)返回到1时，生成装入脉冲。校正部33将生成的装入脉冲通过电缆40和供给加密处理部22或24(加密处理部22或24中供出经加密的视频信号的一方)以及解密处理部32。
解密处理部32根据垂直控制脉冲进行加密的视频信号的解密处理，在校正部33供给装入脉冲时，将后述的图4的加密用随机数生成部51复位。
加密处理部22或24在校正部33送来装入脉冲时，将后述的内部的随机数生成电路41(图4)复位。
这样，即使例如由ESD引起的外部杂散噪声信号混入发送装置11与显示装置12之间的传输线(垂直同步信号的传输路径)，而在接收侧(显示装置12)的垂直同步信号的帧数计数中发生误差，由于校正部33生成装入脉冲，使加密处理部22或24以及解密处理部32复位，因此也能将因解密的同步偏差引起发生的不能解密的状态迅速恢复，能稳定地显示解密图像。
视频信号处理部34处理解密后的视频图像，除根据用户指示调整辉度、彩色、色调、以及对比度(色彩)之外，进行白平衡的调整，变换成对显示板(显示元件)37是最佳的信号电平，供给水平(行)方向的视频信号驱动部35。
视频信号驱动部35根据视频信号处理部34供给的视频信号驱动显示板37。
视频信号处理部34从经解密后的视频信号取得用于保持同步的水平同步信号和垂直同步信号，并将它供给显示板37的扫描部36。扫描部36进行控制，使得每驱动1水平行方向，就依次下降垂直方向的行数，显示与1帧视频信号对应的图像。
显示板37根据视频信号驱动部35与扫描部36的控制，根据供给的视频信号进行显示。
以下参照图2说明图1的视频信号处理系统1的视频显示处理。该处理在由用户对DTV调谐器21或DVD播放器23发生接收处理或重放处理指令时开始。
步骤S1中，DTV调谐器21接收并解调由未图示的天线接收的MPEG2方式的数字广播信号，将解调得到的视频信号供给加密处理部22。
步骤S2中，加密处理部22对DTV调谐器21供给的视频信号的垂直同步信号进行计数，生成帧数Tx，将帧数Tx与视频信号进行加密。加密处理部22将加密后的帧数Tx、加密后的视频信号、H/V控制信号以及未被加密的帧数Tx通过数字接口25供给选择器31。此外，加密处理的细节参照图5与图6的流程图在以后再述。
步骤S3中，DVD播放器23重放未图示的DVD，取得的数字视频信号供给加密处理部24。
步骤S4中，加密处理部24对由DVD播放器23供给的视频信号的垂直同步信号进行计数，生成帧数Tx，将帧数Tx与视频信号进行加密。加密处理部24将加密后的帧数Tx、加密后的视频信号、H/V控制信号以及未被加密的帧数Tx通过数字接口25供给选择器31。可使加密后的帧数Tx在例如水平消隐期间传送。
实际上，步骤S1与步骤S2的处理，或步骤S3与步骤S4的处理中，执行由用户指令的某一方的处理。
步骤S5中，选择器31根据用户的指示，选择来自加密处理部22的信号或来自加密处理部24的信号中的一方。
步骤S6中，解密处理部32取得选择器31选择的加密的帧数Tx、加密的视频信号、H/V控制信号以及未被加密的帧数Tx，将被加密的帧数Tx进行解密，将其设定为帧数Rx(为接收侧的帧数)。解密处理部32将H/V控制信号、未被加密的帧数Tx以及经解密求得的帧数Rx供给校正部33。
步骤S7中，校正部33根据解密处理部32供给的帧数Rx(帧数Rx与经加密处理部22或24加密、并经解密处理部32解密后的帧数Tx是相等的)、与加密处理部22或24供给的视频信号的各帧对应的帧数Tx，判定是否必须生成装入脉冲。具体地说，校正部33在帧数Tx与帧数Rx只有规定次数(例如连续16次)不一致时，或者所供给的帧数Rx与Tx相一致，而帧数(Tx与Rx)从128(约2秒)返回到1时(即约2秒钟1次)，判定必须生成装入脉冲。
步骤S7中判定为必须生成装入脉冲时，处理进入步骤S8，校正部33生成装入脉冲。有关校正部33产生的装入脉冲生成处理的细节参照图13与图14在以后再述。
步骤S9中，校正部33将生成的装入脉冲供给解密处理部32与加密处理部22或24(步骤S5的处理中选择器31所选择一方的加密处理部)。通过供给该装入脉冲，加密处理部22或24以及解密处理部32被复位。
步骤S7中判定为不生成装入脉冲时(判定帧数Rx与帧数Tx为一致时)，或在步骤S9之后，处理进入步骤S10，解密处理部32根据步骤S5的处理所供给的H/V控制信号，将被加密的视频信号进行解密。有关步骤S6与步骤S10的解密处理部32进行的处理的细节，参照图7的流程图在以后再述。
步骤S11中，解密处理部32将解密后的视频信号供给视频信号处理部34。
步骤S12中，视频信号处理部34对供给的视频信号进行规定的信号处理。具体说，视频信号处理部34根据用户的控制对视频信号调整辉度、彩色、色调、以及对比度(色彩)，并调整白平衡，变换成对显示板(显示元件)37是最佳的信号电平。
步骤S13中，视频信号处理部34将处理后的视频信号供给视频信号驱动部35。
步骤S14中，视频信号处理部34从进行了视频信号处理过的视频信号中取得保持同步用的水平同步信号和垂直同步信号，并将它供给显示板37的扫描部36。
步骤S15中，视频信号驱动部35根据视频信号处理部34供给的、经视频信号处理的视频信号，驱动显示板37。
步骤S16中，扫描部36根据供给的水平同步信号和垂直同步信号，进行控制使得每驱动1水平行方向的，就依次下降垂直方向的行数，显示与1帧的视频信号对应的图像。
步骤S17中，显示板37根据视频信号驱动部35与扫描部36的控制，根据供给的视频信号显示图像，并结束处理。
通过图2与图3的处理，校正部33在发送侧(发送装置11的加密处理部22或24)与接收侧(显示装置的解密处理部32)的同步发生偏差时，或帧数从128帧返回到1帧时(每128帧为1个周期)，生成装入脉冲，并将生成的装入脉冲同时供给发送侧(发送装置11的加密处理部22或24)与接收侧(显示装置的解密处理部32)，从而，能使加密(发送侧)与解密(接收侧)复位，取得同步。
以下参照图4至图7说明图1的加密处理部22与解密处理部32中的处理。先参照图4说明图1的加密处理部22、解密处理部32以及校正部33的功能性构成。加密处理部24中的处理由于与加密处理部22的情况相同，故省略其说明。
加密处理部22由加密用随机数生成部41与异或电路42构成，解密处理部32由解密用随机数生成部51与异或电路52构成。解密用随机机生成部51将被加密的帧数Tx进行解密，并将该值设定作为接收侧的帧数Rx。解密用随机数生成部51将垂直控制脉冲、未被加密的帧数Tx以及解密后的帧数Rx发送到校正部33。
校正部33通过比较帧数Tx与帧数Rx，在检测发送侧与接收侧的同步偏差并判定产生同步偏差(即必须生成装入脉冲)时，或每128帧时，生成装入脉冲，并将生成的装入脉冲供给解密用随机数生成部51与加密用随机数生成部41。
解密用随机数生成部51与加密用随机数生成部41在由校正部33供给装入脉冲时，将它接收，将加密用或解密用的随机数的生成复位。
图4的例子中，省略数字接口25、选择器31、以及电缆40。图中表示步骤的记号表示后述的图5至图7的流程图的处理。
以下参照图5、图6的流程图说明加密处理部22中的加密处理。该流程图为详细说明上述的图2的步骤S2的处理。当视频信号从DTV调谐器21供给加密处理部22时开始本处理。
步骤S51中，加密用随机数生成部41取得加密的视频信号(例如视频信号的流数据)。
步骤S52中，加密用随机数生成部41与取得的视频信号所含的垂直同步信号与水平同步信号同步地生成垂直控制脉冲、水平控制脉冲及像素时钟。
步骤S53中，加密用随机数生成部41以128帧作为1个周期，对步骤S52的处理取得的视频信号所含的垂直同步信号进行计数，算出帧数Tx。
步骤S54中，加密用随机数生成部41根据发送侧(发送装置11)的密钥(加密用随机数生成部41保持着发送侧的密钥)生成随机数列。具体地说，由密钥生成初始化用的数列，并利用基于垂直控制脉冲、水平控制脉冲及视频信号的像素时钟的循环驱动，生成随机数列。
步骤S55中，加密用随机数生成部41根据生成的随机数列，将帧数Tx进行加密。
步骤S56中，加密用随机数生成部41将生成的随机数列(由步骤S54的处理生成的随机数列)供给异或电路42。关于步骤S51至S56的随机数列生成处理，参照图11与图12的流程图在以后再述。
步骤S57中，异或电路42取得加密的视频信号的同时，取得通过步骤S54的处理从加密用随机数生成部41供给的随机数列。
步骤S58中，异或电路42通过对加密用随机数生成部41供给的随机数列(通过步骤S54的处理由加密用随机数生成部41生成的随机数列)与视频信号的异或运算，对加密的视频信号的位信息进行加密。
步骤S59中，加密用随机数生成部41将由视频信号的垂直控制脉冲及水平控制脉冲及视频信号的像素时钟组成的H/V控制信号、通过步骤S53的处理生成的帧数Tx、以及通过步骤S55的处理加密后的帧数Tx，供给解密处理部32的解密用随机数生成部51。
步骤S60中，异或电路42将通过步骤S58的处理加密的视频信号供给接收侧(显示装置12)的解密处理部32的异或电路52。
步骤S61中，加密用随机数生成部41判定是否从校正部33送来装入脉冲。校正部33在发送侧(发送装置11的加密处理部22或24)与接收侧(显示装置的解密处理部32)的同步有偏差时，或帧数从128帧返回到1帧时，生成装入脉冲，将生成的装入脉冲发送到加密用随机数生成部41与解密用随机数生成部51。当判定装入脉冲被送来时，步骤S62中，加密用随机数生成部41接收此脉冲，将后述的LFSR模块111复位。以上的处理执行到视频信号全部被发送为止。步骤S61中，当判定为未送来装入脉冲时，则跳过步骤S62的处理。
以下参照图7的流程图说明与图5、图6的加密处理部22的处理对应的解密处理部32中的解密处理。该流程图是上述图2的步骤S6与S10的处理的详细说明。当从加密处理部22将加密后的视频信号、H/V控制信号、帧数Tx、以及加密后的帧数Tx供给解密处理部32时，开始本处理。
步骤S101中，解密用随机数生成部51取得由加密处理部22供给的(图6的步骤S59的处理)H/V控制信号(垂直控制脉冲、水平控制脉冲及视频信号的像素时钟组成的信号)、未被加密的帧数Tx、以及加密的帧数Tx。
步骤S102中，解密用随机数生成部51根据接收到的垂直控制脉冲与保持的密钥，生成随机数列。与上述的加密用随机数生成部41相同，解密用随机数生成部51保持与发送侧的密钥对应的密钥，将由该密钥生成的同一初始值通过基于视频信号的垂直控制脉冲、水平控制脉冲及视频信号的像素时钟的循环驱动，生成随机数列。这时，生成的随机数列与发信侧的加密用随机数生成部41生成的随机数列相同。
步骤S103中，解密用随机部生成部51根据步骤S102的处理生成的随机数列，将被加密的帧数Tx进行解密，并将该值设定为帧数Rx。根据解密用随机数生成部51生成的随机数列，将被加密的帧数Tx进行解密，通过这样成为接收侧(显示装置12)的帧数Rx。
步骤S104中，解密用随机数生成部51将未被加密的帧数Tx、通过步骤S103的处理生成的帧数Rx以及H/V控制信号供给校正部33。
步骤S105中，解密用随机数生成部51将通过步骤S102的处理生成的随机数列供给异或电路52。
步骤S106中，异或电路52取得由加密处理部22的异或电路42供给的(图5的步骤S60的处理)加密的视频信号。
步骤S107中，异或电路52对加密的视频信号与解密用随机数生成部51供给的随机数列(步骤S102的处理生成的随机数列)进行异或运算，从而将被加密的视频信号进行解密(因为加密用随机数生成部41生成的随机数列与解密用随机数生成部51生成的随机数列是同一个，故能恢复到加密前的视频信号)。这样一来，能够将被加密的数据进行解密。异或电路52将解密后的视频信号送到视频信号处理部34。
步骤S108中，解密用随机数生成部51判定校正部33是否送来了装入脉冲。校正部33根成解密用随机数生成部51发送来的(步骤S104的处理)帧数Tx与帧数Rx，判定是否必须生成装入脉冲，在判定必须生成装入脉冲时(图2的步骤S7中判定为YES时)，生成装入脉冲，并发送至解密用随机数生成部51与加密用随机数生成部41(图2的步骤S9)。当判定为装入脉冲已送来时，处理进到步骤S109，解密用随机数生成部51将后述的LFSR模块301复位。当步骤S108判定为未送来装入脉冲时，跳过步骤S 109的处理。执行以上处理，直至将全部视频信号进行解密为止。
通过图5至图7的处理，即使在发生同步的偏差时，也能利用装入脉冲将加密用随机数生成部41与解密用随机数生成部51复位，因此能迅速消除同步的偏差。
以下参照图8说明加密用随机数生成部41及解密用随机数生成部51为随机数列生成而具有的LFSR(线性反馈移位寄存器)的原理构成。
图8的LFSR80由触发器81至84以及异或电路90构成。触发器81至84的输出供给后级，进行串级连接，触发器81的输出81Q与触发器84的输出84Q输入到异或电路90。异或电路90的输出作为随机数列输出，同时通过开关91输入至触发器81。
LFSR80是发生M系列(线性最大周期序列)随机数的电路，例如如图8所示发生4位随机数的场合，通过将第1(触发器81)与第4(触发器84)的锁存输出被输入至异或电路90，可发生基于式X4+X+1的2的4次方即15个时钟为周期的随机数列。这时，LFSR80的各触发器(81至84)中输出的随机数列示于图9。
图9中纵轴表示时钟数，横轴表示各触发器的输出。即，81Q是触发器81的输出，82Q是触发器82的输出，83Q是触发器83的输出，84Q是触发器84的输出。复位时，81Q至84Q的值全部为1之后，每次输入时钟，触发器81至84的输出81Q至84Q输出图9所示的值。
每一次时钟输入，异或电路90输出的值成为随机数。该值由触发器81所锁存，以后依次转送至后级的触发器82至84，因此各触发器81至84的输出(例如触发器81的输出81Q)成为随机数列。通过增加锁存电路(触发器81至84)的级数，可加长随机数列的周期。例如用10个锁存电路(触发器)时，可生成2的10次方即1023个时钟为周期的随机数。
此外，LFSR80中通过将开关91切换到端子92，从端子92输入初始值，可对触发器81至84设定任意的初始值。
如果用置位复位型的锁存电路作为触发器81至84，则可装入任意的随机数列初始值。这样，可发生在一周期中的任意时刻开始的输出随机数列。
图10示出加密用随机数生成部41的基本构成例。实际上，加密用随机数生成部41是各种位进行混洗，发生随机性更高的随机数，但省略这部分的说明。
加密用将随机数生成部41具备几个具有如图8所示构成的LFSR的LFSR模块(图10的例子有LFSR模块111、112、和113三个)。LFSR模块111当从校正部33输入装入脉冲时(图6的步骤S61中YES的情况)，装入(复位)由初始化用数列生成部131供给的初始值，之后，每当从垂直控制脉冲生成部132以帧周期输入垂直控制脉冲作为时钟时，发生数列(随机数)，作为初始值供给LFSR模块112，同时供给加密部180。
LFSR模块112每当从水平控制脉冲生成部151以水平扫描周期输入水平控制脉冲作为时钟时，就以LFSR111模块供给的数列作为初始值发生数列(随机数)，供给LFSR模块113作为初始值。与电路153在输入来自垂直显示区域允许信号生成部152的允许信号时导通，将水平控制脉冲生成部151生成的水平控制脉冲供给LFSR模块112。
LFSR模块113每当从像素时钟生成部171通过与电路173以像素周期输入像素时钟时，生成以LFSR模块112供给的数列作为初始值的数列(随机数)，输出到异或电路42。
与电路173在从水平显示区域允许信号生成部172输入允许信号时导通，将从像素时钟生成部171输出的像素时钟供给LFSR模块113。
垂直控制脉冲生成部132与DTV调谐器21输入的视频信号(发送的视频信号)中所含的垂直周期信号同步地生成垂直控制脉冲。垂直控制脉冲生成部132生成的垂直控制脉冲除供给LFSR模块111之外，还输入到H/V控制信号生成部133和垂直显示区域允许信号生成部152。
H/V控制信号生成部133以128帧作为1个周期，对垂直控制脉冲生成部132供给的垂直控制脉冲进行计数，算出帧数Tx(1至128中的任一个值)，同时将垂直控制脉冲、水平控制脉冲生成部151生成的水平控制脉冲、及像素时钟生成部171生成的像素时钟进行合成，生成H/V控制信号。H/V控制信号生成部133将生成的帧数Tx与H/V控制信号供给校正部33，同时将帧数Tx供给加密部180。
加密部180根据LFSR模块111每1帧供给的数列，将H/V控制信号生成部133供给的帧数Tx进行加密，并供给校正部33。
垂直显示区域允许信号生成部152根据垂直控制脉冲生成部132供给的垂直控制脉冲，生成与有效垂直显示区域对应的垂直显示区域允许信号，供给与电路153。水平控制脉冲生成部151与DTV调谐器21输入的视频信号(发送的视频信号)中所含的水平同步信号同步地生成水平控制脉冲。水平控制脉冲生成部151生成的水平控制脉冲除通过与电路153供给LFSR模块112外，还输入到H/V控制信号生成部133和水平显示区域允许信号生成部172。
水平显示区域允许信号生成部172根据水平控制脉冲，生成与有效的水平显示区域对应的水平显示区域允许信号，并供给与电路173。像素时钟生成部171与DTV调谐器21输入的视频信号(发送的视频信号)中所含的垂直同步信号与水平同步信号同步地生成像素时钟。
这样一来，由于根据DTV调谐器21输入的同一视频信号生成垂直控制脉冲、水平控制脉冲、以及像素时钟，故能对垂直控制脉冲、水平控制脉冲、以及像素时钟全部取得同步，因而能使LFSR模块113生成的随机数列与该视频信号同步。
以下参照图11与图12的流程图说明图10的加密用随机数生成部41中的随机数生成处理。该流程图是详细说明图5的步骤S51至S56的处理的流程图。此外，是在对加密用随机数生成部41输入加密的视频信号时(图2的步骤S1或S3的处理之后)，开始本处理。
步骤S151中，垂直控制脉冲生成部132与DTV调谐器21输入的视频信号(发送的视频信号)所含的垂直同步信号同步地生成垂直控制脉冲。垂直控制脉冲生成部132将生成的垂直控制脉供给LFSR模块111、H/V控制信号生成部133、以及垂直显示区域允许信号生成部152。
步骤S152中，水平控制脉冲生成部151与DTV调谐器21输入的视频信号(发送的视频信号)所含的水平同步信号同步地生成水平控制脉冲。水平控制脉冲生成部151将生成的水平控制脉冲供给与电路153、H/V控制信号生成部133、以及水平显示区域允许信号生成部172。
步骤S153中，像素时钟生成部171与DTV调谐器21输入的视频信号(发送的视频信号)所含的像素信号同步地生成像素时钟。
步骤S154中，H/V控制信号生成部133以128帧作为1个周期对通过步骤S151的处理由垂直控制脉冲生成部132供给的垂直控制脉冲进行计数，算出帧数Tx。而且，H/V控制信号生成部133将垂直控制脉冲、水平控制脉冲、以及像素时钟进行合成，生成H/V控制信号。然后，H/V控制信号生成部133将算出的帧数Tx与H/V控制信号发送至解密部32的解密用随机数生成部51，同时将帧数Tx发送至加密部180。进而，帧数Tx从解密用随机数生成部51供给校正部33。
步骤S155中，LFSR模块111接收来自校正部33的装入脉冲。校正部33以128帧作为1个周期在对垂直控制脉冲进行计数得到的帧数从128帧返回到1个帧时(经过1周期(约2秒钟)时)，或者，在发生发送侧与接收侧的同步偏差时，生成装入脉冲，并供给LFSR模块111(后述的图14的步骤S210)。又，在随机数生成处理开始时，必须输入装入脉冲。
步骤S156中，初始化用数列生成部131根据预先设定于加密用随机数生成部41的密钥，生成初始化用的数列，并供给LFSR模块111。
步骤S157中，LFSR模块111在通过步骤S155的处理从校正部33输入装入脉冲时，装入初始化用数列生成部131供给的(步骤S156的处理)初始值。
步骤S158中，LFSR模块111根据通过步骤S157的处理装入的初始值，生成数列(随机数)。以后，LFSR模块111每当从垂直控制脉冲生成部132以帧周期输入垂直控制脉冲作为时钟时，生成数列(随机数)。该数列成为对每帧生成的数列。
步骤S159中，LFSR模块111将生成的数列供给LFSR模块112外，还供给加密部180。
步骤S160中，加密部180取得LFSR模块111供给的数列(步骤S159)及H/V控制信号生成部133供给的帧数Tx(步骤S154)，根据数列将帧数Tx进行加密。加密部180将加密后的帧数Tx发送至校正部33。
步骤S161中，垂直显示区域允许信号生成部152，根据通过步骤S151的处理由垂直控制脉冲生成部132供给的垂直控制脉冲，生成垂直显示区域允许信号。具体说，以输入的垂直控制脉冲的位置为基准，判定现在作为对象的行是否是有效的垂直显示区域，是在垂直显示区域内时，输出逻辑H(1)的信号，不是垂直显示区域内时，输出逻辑L(0)的信号。垂直显示区域允许信号生成部152将生成的垂直显示区域允许信号供给与电路153。
步骤S162中，与电路153在垂直显示区域允许信号生成部152供给的垂直显示区域允许信号为逻辑H(1)时导通，为逻辑L(0)时不导通。即，与电路153在从垂直显示区域允许信号生成部152输入允许信号(逻辑H(1))时导通，将水平控制脉冲生成部151生成的水平控制脉冲(步骤S152)供给LFSR模块112。在输入禁止信号(逻辑L(0)的允许信号)时，与电路153为不导通，不对LFSR模块112输出水平控制脉冲。
步骤S163中，LFSR模块112当从水平控制脉冲生成部151输入水平控制脉冲作为时钟(步骤S152)时，就以LFSR模块111供给的数列(步骤S159的处理)作为初始值，生成数列(随机数)。以后，LFSR模块112每当从水平控制脉冲生成部151输入水平控制脉冲作为时钟时，生成数列(随机数)。该数列成为对每1行生成的数列。
步骤S164中，LFSR模块112将生成的数列供给LFSR模块113。
步骤S165中，水平显示区域允许信号生成部172根据通过步骤S152的处理由水平控制脉冲生成部151供给的水平控制脉冲，生成水平显示区域允许信号。具体说，以输入的水平控制脉冲的位置为基准，在有效的水平显示区域内的时刻，输出H(1)的信号，但不在有效的水平显示区域内的时刻，输出L(0)的信号。水平显示区域允许信号生成部172将生成的水平显示区域允许信号供给与电路173。
步骤S166中，与电路173根据水平显示区域允许信号生成部172供给的水平显示区域允许信号而导通。即，与电路173在从水平显示区域允许信号生成部172输入允许信号(逻辑H(1))时导通，将像素时钟生成部171生成的像素时钟(步骤S153)供给LFSR模块113。在输入禁止信号(逻辑L(0))时，与电路173不非导通，不将像素时钟供给LFSR模块113。
步骤S167中，LFSR模块113当从像素时钟生成部171输入像素时钟作为时钟(步骤S153与步骤S166)时，就以LFSR模块112供给的数列(步骤S164的处理)作为初始值生成数列(随机数)。以后，LFSR模块113每当从像素时钟生成部171输入像素时钟作为时钟时，生成数列(随机数)。该数列成为对每个像素生成的数列。
步骤S168中，LFSR模块113将生成的数列(随机数)输出至异或电路42。
如上所述，LFSR模块113每当从像素时钟生成部171输入像素时钟作为时钟时，生成数列(随机数)。这时的初始值即各行左端(开头)的像素的数列是根据LFSR模块112输出的数列(随机数)来设定。LFSR模块113当根据像素时钟生成部171送来的像素时钟生成1行的数列，并结束时，就从LFSR112输入下一行的左端(开头)的像素的初始值。这样，LFSR模块113再次每当从像素时钟生成部171输入像素时钟作为时钟时，生成数列。
LFSR模块112当根据水平控制脉冲生成部151送来的水平控制脉冲生成1帧的各行的左端(开头)的数据列，并结束时，垂直控制脉冲就从LFSR模块111输入下一帧的第1行(开头)的初始值。根据该初始值，LFSR模块112再次每当从水平控制脉冲生成部151输入水平控制脉冲作为时钟时，生成数列。
LFSR模块111以初始化用数列生成部131输出的值作为初始值，每当从垂直控制脉冲生成部132输入垂直控制脉冲作为时钟时，生成数列(随机数)。然后，LFSR模块111在发送侧与接收侧的同步发生偏差(帧数Tx与Rx不同)时，或每128帧时，从校正部33输入装入脉冲，因此再次装入初始化用数列生成部131供给的初始值。
这样，对每1行、每1帧、或每128帧，设定初始值，对每1行、每1帧、或每128帧，随机数被初始化。从而，抑制了误差向后方传输。而且，在发生的随机数发生错误时，利用校正部33生成初始化(复位)用的装入脉冲(不是每128帧的临时的装入脉冲)，使随机数初始化，因此，即使前次初始化后不经过128帧，也能防止发生错误。
发送侧(发送装置11)的加密用随机数生成部41中，对各行的每个开始点、各帧的每个开始点、以及每128帧都进行随机数的更新，而接收侧的解密用随机数生成部51中也同样，与其相应地进行每行的开始点、每帧的开始点、以及每128帧的同步化，使其生成与加密时完全相同的随机数列。而且，来自校正部33的装入脉冲，被供给发送侧的加密用随机数生成部41与接收侧的解密用随机数生成部51双方，因此，加密用随机数生成部41与接收侧的解密用随机数生成部51生成相同的随机数列。校正部33的构成参照图14在以后再述。
如上所述，从发送侧(发送装置11)的异或电路42输出的加密后的视频信号，由接收侧(显示装置12)的异或电路52所接收。又，由发送侧的加密用随机数生成部41输出的垂直控制脉冲、水平控制脉冲、以及像素时钟构成的H/V控制信号、未被加密的帧数Tx、以及加密的帧数Tx，由接收侧的解密用随机数生成部51所接收。解密用随机数生成部51将被加密的帧数Tx进行解密，生成接收侧的帧数Rx。解密用随机数生成部51将该接收侧的帧数Rx、垂直控制脉冲、发送侧的帧数Tx供给校正部33。校正部33根据需要生成装入脉冲，并将其供给解密用随机数生成部51(和加密用随机数生成部41)。
图13为示出解密用随机数生成部51的基本构成例图。将图13与图10作比较可知，图13的解密用随机数生成部51与图10的加密用随机数生成部41为基本上相同的构成。
即，与图10的加密用随机数生成部41的初始化用数列生成部131、LFSR模块111至113、水平控制脉冲生成部151、垂直显示区域允许信号152、像素时钟生成部171、水平显示区域允许信号生成部172、与电路153、173、以及加密部180相对应，解密用随机数生成部51具有初始化用数列生成部331、LFSR模块301至303、水平控制脉冲生成部351、垂直显示区域允许信号生成部352、像素时钟生成部371、水平显示区域允许信号生成部372、与电路353、373、以及解密处理部380。对应名称的部分具有对应的功能。
但是，与加密用随机数生成部41的H/V控制信号生成部133对应的生成部因无必要，故在图13的解密用随机数生成部51中并未设置。又，与加密用随机数生成部41的加密部180根据来自LFSR模块111的随机数列将帧数Tx进行加密的情况相反，解密用随机数生成部51的解密处理部380是根据来自LFSR模块301的随机数列将帧数Tx进行解密。而且还设置分离部332，用来将加密用随机数生成部41的H/V控制信号生成部133供给的H/V控制信号分离成垂直控制脉冲、将水平控制脉冲、以及像素时钟。分离部332，将将垂直控制脉冲输出至垂直控制信号生成部333，水平控制脉冲输出至水平控制脉冲生成部351，像素时钟输出至像素时钟生成部371，分别生成接收侧的垂直时钟、水平控制脉冲，或像素时钟。分离部332还分离帧数Tx，输出至校正部33。
关于图13的解密用随机数生成部51中的解密用随机数生成处理，因为与上述的图11与图12的流程图所示的情况相同，故省略其说明。但步骤S151中生成的垂直控制脉冲不输出至H/V控制信号生成部133，而是输出至校正部33。步骤S154中，不进行H/V控制信号生成部133的H/V控制信号和帧数Tx的生成、发送处理。代之以由分离部332将分离后的帧数Tx输出至校正部33。又，步骤S160的加密部180进行的帧数Tx的加密处理，置换为利用解密处理部380进行的对加密的帧数Tx的解密，生成帧数Rx，并输出至校正部33的处理。
图14为图1的校正部33的详细构成例图。
比较部201具有比较器与计数器的功能，将从加密用随机数生成部41输出并经由解密用随机数生成部51供给的(图11的步骤S154与步骤S160的处理，及与之对应由解密用随机数生成部51执行的处理)帧数Tx与帧数Rx的值进行比较，在Tx与Rx为不一致时，对其计数。又，在帧数Tx与Rx的值相一致时，对该计数复位(即只在连续不一致时计数)。比较部201在帧数Tx与Rx的值例如连续16次不一致时，判定为发送侧与接收侧的同步发生偏差，将逻辑L(0)的控制信号发送至CPU202。
CPU(中央处理单元)202接收来自比较部201的逻辑L(0)的控制信号时，生成使发信侧与接收侧的随机数生成复位的伪装入脉冲(即，不是128帧周期的临时装入脉冲)，供给或电路204。
装入脉冲生成部203对与加密用随机数生成部41输出的(图11的步骤S151的处理)垂直控制脉冲同步地、由解密用随机数生成部51的垂直控制脉冲生成部333输出的(与图11的步骤S151对应的处理)垂直控制脉冲，以128帧作为1周期进行计数，当计数的帧数从128返回1时(经过1个周期(约2秒钟)时)，生成装入脉冲，供给或电路204。
或电路204将CPU202供给的伪装入脉冲或装入脉冲生成部203供给的装入脉冲作为校正部生成的装入脉冲，供给加密处理部22或加密处理部24的加密用随机数生成部41与解密处理部32的解密用随机数生成部51。
以下参照图15和图16的流程图说明图14的校正部33中的装入脉冲生成处理。该流程图是图2的步骤S7至S9的处理的详细说明。又，在接通装置的电源时开始本处理。
步骤S201中，比较部201判定是否接收到帧数Tx与帧数Rx(通过图7的步骤S104的处理由解密用随机数生成部51供给的帧数Tx与帧数Rx)。在判定未接收到帧数Tx与帧数Rx时，处理进到步骤S202，装入脉冲生成部203判定是否接收到垂直控制脉冲。在判定未接收到垂直控制脉冲时，处理返回步骤S201，重复处理。
步骤S202中判定接收到垂直控制脉冲时，处理在步骤S203中，装入脉冲生成部203以128帧作为1个周期对垂直控制脉冲进行计数。
步骤S204中，装入脉冲生成部203判定通过步骤S203的处理而计数的值是否为128。计数值不是128时，处理返回步骤S201，重复以后的处理。
当判定计数值是128时，处理进到步骤S205，装入脉冲生成部203生成装入脉冲。即，装入脉冲生成部203在以128帧作为1个周期对垂直控制脉冲进行计数的帧数从128(约2秒钟)返回到1时，生成装入脉冲。
步骤S206中，装入脉冲生成部203将生成的装入脉冲供给或电路204。
步骤S207中，或电路204将装入脉冲生成部203供给的装入脉冲供给加密处理部22与解密处理部32，处理返回步骤S201，重复同样的处理。
步骤S201中判定接收到帧数Tx与帧数Rx时，处理进到步骤S208，比较部201判定接收到的帧数Tx与帧数Rx是否相同。帧数Tx是通过H/V控制信号生成部133对垂直时钟进行计数得到的、未经加密地被传送来的值，将该值加密后传送来的、经解密部380解密的值是帧数Rx。因此，帧数Tx与Rx通常是一致的。
但是例如当频道转换或重放视频信号被转换时，由于同步信号不连续，因此同步紊乱。同步一紊乱，就不能正确地将被加密的数据进行解密。因此，在帧数Tx与Rx的值不一致时，可以认为是不能正确地解密的情况(即同步紊乱的情况)。因此，通过比较帧数Tx与Rx，可以确认发送侧(发送装置11)与接收侧(接收装置12)之间是否发生同步偏差。
步骤S208中，在判定帧数Tx与Rx为不同时，步骤S209中，比较部201对计数器加1。现在的例子的情况下，计数器的值为1。
步骤S210中，比较部201判定计数器的值是否是16。计数器的值由于是在每次帧数Tx与Rx不同时相加，且在帧数Tx与Rx一致时被复位(后述的步骤S214)，因此它表示帧数Tx与Rx的值连续不一致的次数。在判定计数器的值不是16时，处理返回步骤S201，重复其后面的处理。即，计数器的值到达16之前重复同样的处理。
步骤S210中判定计数器的值是16时(判定帧数Tx与Rx是连续16次不一致时)，判断为由于频道转换或信号转换等引起同步紊乱，处理在步骤S211中，比较部201将逻辑L(0)的控制信号输出至CPU202。
若当计数器的值等于1时就立即判定为同步紊乱，会存在误检测出因噪声等引起的同步紊乱的情况，故在多次(本例中为16次)检测出不一致时，判定同步紊乱发生。
CPU202接收到比较部201来的控制信号时，在步骤S212生成伪装入脉冲(即不是128帧周期的临时装入脉冲)。CPU202将生成的伪装入脉冲供给或电路204。
步骤S213中，或电路204将伪装入脉冲供给加密处理部22与解密处理部32，返回步骤S201，重复同样的处理。
步骤S208中判定帧数Tx与Rx为相同时，在步骤S214中比较部201将计数器复位(使计数器的值为0)。这样，即使例如帧数Tx与Rx为连续3次不一致(计数器的值为3)，但由于在其后帧数Tx与Rx为相同时也使计数器复位，故计数器能显示帧数Tx与Rx的值为连续不一致的次数。其后处理返回步骤S201。
通过步骤S209至步骤S213的处理，即使在例如由于接头部的接触不良等引起垂直同步信号的丢失，接收侧的随机数生成比发送侧来得晚的情况下，或由于帧脉冲上的噪声等引起接收侧的随机数生成比发送侧来得早的情况下，也由于使其发生伪装入脉冲(不是128帧周期的临时装入脉冲)，将接收侧(解密处理部32)与发送侧(加密处理部22)的随机数生成复位，故能迅速校正发送侧与接收侧的同步偏差。
通过以上处理，由于使发送侧发送表示发送的视频信号帧数的帧数Tx、经加密后的帧数Tx、以及由垂直控制脉冲、水平控制脉冲及像素时钟组成的H/V控制信号，在接收侧将被加密的帧数Tx进行解密，生成接收侧的帧数Rx，比较帧数Tx与Rx，通过这样根据需要生成伪装入脉冲，因此，即使发送侧与接收侧的同步不一致时，也能迅速修正。
又，即使在由传输线中的ESD(静电放电)等外部随机噪声引起发生误计数的情况，也由于自动校正发送侧的加密用随机数生成部41与接收侧的解密用随机数生成部51的同步，使加密与解密的同步一致，故能构筑始终稳定进行解密的视频信号处理系统。
又，由于用128帧为周期使随机数生成部(加密用随机数生成部41和解密用随机数生成部51)复位(由于装入脉冲生成部203以128帧作为1个周期对垂直控制脉冲进行计数，计数得到的帧数从128帧返回到1帧时，生成装入脉冲)，故能定期地使加密处理部22与解密处理部32同步，因此，在加密的视频信号的解密中，能定期地恢复因同步偏差引起的不可能解密的状态。
又，上例中是使用帧数Tx与Rx为连续16次不一致的场合生成伪装入脉冲，但也可以设定为不是16次，而设定为2次以上的任意次数。
上述的一连串处理，即可用硬件实现，也可用软件实现。这时，上述的处理由图17所示的个人计算机600来实现。
图17中，CPU601根据存储于ROM(只读存储器)602的程序或从存储部608装入RAM(随机存取存储器)603的程序，执行各种处理。RAM603中还可适当存储CPU601执行各种处理中必要的数据。
CPU601、ROM602和RAM603通过内部总线604互相连接。总线604上还连接输入输出接口605。
输入输出接口605上连接有链盘、鼠标等构成的输入部606、CRT、LCD(液晶显示器)等构成的显示器以及扬声器等构成的输出部607、硬盘等构成的存储部608、调制解调器、终端适配器等构成的通信部609。通信部609通过包含电话线或CATV的各种网络进行通信处理。
输入输出接口605上还按需要连接驱动器610、适当安装磁盘、光盘、光磁盘或半导体存储器等构成的可拆装的媒体621，从其中读出的计算机程序按照需要装到存储器608中。
用软件执行一连串处理时，构成该软件的程序从网络或记录媒体被安装到专用硬件的计算机，或者安装到通过安装各种程序可执行各种功能的例如通用的个人计算机等上。
该记录媒体如图17所示那样，不仅利用与计算分开的、为了对用户提供程序而配置的、记录程序的可拆装媒体621组成的组合媒体来构成，而且用含有预先装入装置本体的状态下提供给用户的、记录程序的包含ROM602和存储部608的硬盘等来构成。
又，本说明书中，说明计算机程序的步骤，当然是按照说明的顺序按时间序列进行处理，但也不一定按时间序列处理，也包含并行的、或分别进行的处理。
又，本说明书中，所谓系统是表示利用多个装置构成的装置全体。

Claims (21)

1、一种视频信号处理系统，是处理视频信号的视频信号处理系统，其特征在于，具备
根据数列将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密装置；
发送未加密的所述第1帧数、用所述加密装置加密的所述视频信号以及用所述加密装置加密的所述第1帧数的发送装置；
接收由所述发送装置发送的未加密的所述第1帧数、经加密的所述视频信号以及经加密的所述第1帧数的接收装置；
根据数列将所述接收装置接收的被加密的所述第1帧数与被加密的所述视频信号进行解密的解密装置；以及
根据利用所述解密装置将被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与利用所述接收装置接收的未被加密的所述第1帧数生成初始化脉冲的生成装置，
所述解密装置根据所述生成装置生成的所述初始化脉冲，使所述数列初始化。
2、如权利要求1所述的视频信号处理系统，其特征在于，
所述加密装置根据所述生成装置生成的所述初始化脉冲，使所述数列初始化。
3、如权利要求1所述的视频信号处理系统，其特征在于，
所述生成装置在所述解密装置解密的所述帧数与所述接收装置接收到的未被加密的所述帧数不同时，生成所述初始化脉冲。
4、如权利要求1所述的视频信号处理系统，其特征在于，
所述加密装置和所述发送装置由第1视频信号处理装置构成，
所述接收装置、所述解密装置以及所述生成装置由第2视频信号处理装置构成。
5、如权利要求1所述的视频信号处理系统，其特征在于，
所述发送装置和所述接收装置进行的通信通过数字接口进行。
6、如权利要求1所述的视频信号处理系统，其特征在于，
所述发送装置也进一步发送使所述数列的发生同步的时钟，
所述接收装置也进一步接收所述时钟。
7、一种视频信号处理方法，是处理视频信号的视频信号处理系统的视频信号处理方法，其特征在于，包含
根据数列将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；
发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤；
接收通过所述发送步骤处理所发送的未加密的所述第1帧数，经加密的所述视频信号以及经加密的所述第1帧数的接收步骤；
根据数列将通过所述接收步骤处理所接收的被加密的所述第1帧数与被加密的所述视频信号进行解密的解密步骤；以及
根据通过所述解密步骤处理将被加密的第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收的未被加密的所述第1帧数生成初始化脉冲的生成步骤，
所述解密步骤的处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
8、一种记录媒体，是记录计算机可读取的程序的记录媒体，所述程序是处理视频信号的程序，其特征在于，包含
根据数列将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；
发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤；
接收通过所述发送步骤处理所发送的未加密的所述第1帧数，经加密的所述视频信号以及经加密的所述第1帧数的接收步骤；
根据数列将通过所述接收步骤处理所接收的被加密的所述第1帧数与被加密的所述视频信号进行解密的解密步骤；以及
根据通过所述解密步骤处理将被加密的第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收的未被加密的所述第1帧数生成初始化脉冲的生成步骤，
所述解密步骤的处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
9、一种程序，是处理视频信号的程序，其特征在于，
由计算机实行以下的处理，即包含
根据数列将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；
发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤；
接收通过所述发送步骤处理所发送的未加密的所述第1帧数、经加密的所述视频信号以及经加密的所述第1帧数的接收步骤，
根据数列将通过所述接收步骤处理所接收的被加密的所述第1帧数与被加密的所述视频信号进行解密的解密步骤；以及
根据通过所述解密步骤处理将被加密的第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收的未被加密的所述第1帧数生成初始化脉冲的生成步骤，
所述解密步骤的处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
10、一种视频信号处理装置，是处理视频信号的视频信号处理装置，其特征在于，具备
根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密装置；和
发送未加密的所述第1帧数、用所述加密装置加密的所述视频信号以及用所述加密装置加密的所述第1帧数的发送装置。
11、如权利要求10所述的视频信号处理装置，其特征在于，
所述发送装置也进一步发送使所述数列的发生同步的时钟。
12、如权利要求10所述的视频信号处理装置，其特征在于，
进一步具备接收将从接收侧发送来的所述数列进行初始化的初始化脉冲的接收装置，
所述加密装置根据用所述接收装置接收的所述初始化脉冲，使所述数列值初始化。
13、一种视频信号处理方法，是处理视频信号的视频信号处理装置的视频信号处理方法，其特征在于，包含
根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；和
发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤。
14、一种记录媒体，是记录计算机可读取的程序的记录媒体，所述程序是处理视频信号的程序，其特征在于，包含
根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；和
发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤。
15、一种程序，是处理视频信号的程序，其特征在于，
由计算机实行以下的处理，即
根据数列值将所述视频信号与表示发送的所述视频信号的帧数的第1帧数进行加密的加密步骤；和
发送未加密的所述第1帧数、通过所述加密步骤处理经加密的所述视频信号以及通过所述加密步骤处理经加密的所述第1帧数的发送步骤。
16、一种视频信号处理装置，是处理视频信号的视频信号处理装置，其特征在于，具备
接收表示未被加密的所述视频信号的帧数的第1帧数、加密的所述视频信号以及加密的所述第1帧数的接收装置；
根据数列值将由所述接收装置接收的，加密的所述第1帧数与加密的所述视频信号进行解密的解密装置；以及
根据利用所述解密装置将被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与利用所述接收装置接收的未被加密的所述第1帧数生成初始化脉冲的生成装置，
所述解密装置根据所述生成装置生成的所述初始化脉冲，使所述数列初始化。
17、如权利要求16所述的视频信号处理装置，其特征在于，
所述生成装置在所述解密装置解密的所述帧数与所述接收装置接收到的未被加密的所述帧数不同时，生成所述初始化脉冲。
18、如权利要求16所述的视频信号处理装置，其特征在于，进一步具备
对发送来加密的所述视频信号与所述第1帧数的对方侧发送所述初始化脉冲的发送装置。
19、一种视频信号处理方法，是处理视频信号的视频信号处理装置的视频信号处理方法，其特征在于，包含
接收表示未被加密的所述视频信号的帧数的第1帧数、加密的所述视频信号以及加密的所述第1帧数的接收步骤；
根据数据列将通过所述接收步骤处理接收到的加密的所述第1帧数与加密的所述视频信号进行解密的解密步骤；以及
根据通过所述解密步骤处理将被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收到的未被加密的所述第1帧数生成初始化脉冲的生成步骤，
所述解密步骤处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
20、一种媒体，是记录计算机可读取的程序的记录媒体，所述程序是处理视频信号的程序，其特征在于，包含
接收表示未被加密的所述视频信号的帧数的第1帧数、加密的所述视频信号以及加密的所述第1帧数的接收步骤；
根据数据列将通过所述接收步骤处理接收到的加密的所述第1帧数与加密的所述视频信号进行解密的解密步骤；以及
根据通过所述解密步骤处理将解密被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收到的未被加密的所述第1帧数生成初始化脉冲的生成步骤，
所述解密步骤处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
21、一种程序，是处理视频信号的程序，其特征在于，
由计算机实行以下处理，即包含
接收表示未被加密的所述视频信号的帧数的第1帧数、加密的所述视频信号以及加密的所述第1帧数的接收步骤；
根据数据列将通过所述接收步骤处理接收到的加密的所述第1帧数与加密的所述视频信号进行解密的解密步骤；以及
根据通过所述解密步骤处理将被加密的所述第1帧数进行解密并生成的表示接收侧的帧数的第2帧数、与通过所述接收步骤处理接收到的未被加密的所述第1帧数生成初始化脉冲的生成步骤，
所述解密步骤处理根据通过所述生成步骤处理生成的所述初始化脉冲，使所述数列初始化。
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