CN116941013A - 层叠基板的制造方法和基板处理装置 - Google Patents
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- 239000000758 substrate Substances 0.000 title claims abstract description 335
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 31
- 238000000034 method Methods 0.000 title claims description 39
- 238000012545 processing Methods 0.000 title claims description 35
- 239000004065 semiconductor Substances 0.000 claims abstract description 268
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 17
- 229910052710 silicon Inorganic materials 0.000 claims description 17
- 239000010703 silicon Substances 0.000 claims description 17
- 230000004048 modification Effects 0.000 claims description 7
- 238000012986 modification Methods 0.000 claims description 7
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical group O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 6
- 238000012546 transfer Methods 0.000 claims description 5
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 4
- 230000001678 irradiating effect Effects 0.000 claims description 2
- 230000001590 oxidative effect Effects 0.000 claims 2
- 239000001257 hydrogen Substances 0.000 description 15
- 229910052739 hydrogen Inorganic materials 0.000 description 15
- 238000005247 gettering Methods 0.000 description 9
- 230000015572 biosynthetic process Effects 0.000 description 6
- -1 hydrogen ions Chemical class 0.000 description 6
- 239000000853 adhesive Substances 0.000 description 5
- 230000001070 adhesive effect Effects 0.000 description 5
- 238000005229 chemical vapour deposition Methods 0.000 description 4
- 230000001681 protective effect Effects 0.000 description 4
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Chemical compound O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 4
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 3
- 238000000231 atomic layer deposition Methods 0.000 description 3
- 238000006482 condensation reaction Methods 0.000 description 3
- 230000018044 dehydration Effects 0.000 description 3
- 238000006297 dehydration reaction Methods 0.000 description 3
- 238000005530 etching Methods 0.000 description 3
- 238000011049 filling Methods 0.000 description 3
- 125000002887 hydroxy group Chemical group [H]O* 0.000 description 3
- 238000005468 ion implantation Methods 0.000 description 3
- 230000003287 optical effect Effects 0.000 description 3
- 230000003647 oxidation Effects 0.000 description 3
- 238000007254 oxidation reaction Methods 0.000 description 3
- 230000002093 peripheral effect Effects 0.000 description 3
- 238000003860 storage Methods 0.000 description 3
- 238000005520 cutting process Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000010438 heat treatment Methods 0.000 description 2
- 229910001385 heavy metal Inorganic materials 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 239000012212 insulator Substances 0.000 description 2
- 238000003698 laser cutting Methods 0.000 description 2
- 238000011068 loading method Methods 0.000 description 2
- 150000004767 nitrides Chemical class 0.000 description 2
- 238000005498 polishing Methods 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- 238000002679 ablation Methods 0.000 description 1
- 238000007792 addition Methods 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 150000001875 compounds Chemical class 0.000 description 1
- 238000012937 correction Methods 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 238000012217 deletion Methods 0.000 description 1
- 230000037430 deletion Effects 0.000 description 1
- 238000006073 displacement reaction Methods 0.000 description 1
- 238000009826 distribution Methods 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 238000001035 drying Methods 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000005286 illumination Methods 0.000 description 1
- 238000002513 implantation Methods 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 150000002500 ions Chemical class 0.000 description 1
- 238000003475 lamination Methods 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 239000011344 liquid material Substances 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 230000000149 penetrating effect Effects 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 239000007787 solid Substances 0.000 description 1
- 239000000243 solution Substances 0.000 description 1
- 238000006467 substitution reaction Methods 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
- H01L21/7624—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology
- H01L21/76251—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using bonding techniques
- H01L21/76256—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using bonding techniques using silicon etch back techniques, e.g. BESOI, ELTRAN
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- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
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- H01L21/76251—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers using semiconductor on insulator [SOI] technology using bonding techniques
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
- B23K—SOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
- B23K26/0006—Working by laser beam, e.g. welding, cutting or boring taking account of the properties of the material involved
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- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
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- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
- B23K26/08—Devices involving relative movement between laser beam and workpiece
- B23K26/082—Scanning systems, i.e. devices involving movement of the laser beam relative to the laser head
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- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
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- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
- B23K26/08—Devices involving relative movement between laser beam and workpiece
- B23K26/0823—Devices involving rotation of the workpiece
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- B23—MACHINE TOOLS; METAL-WORKING NOT OTHERWISE PROVIDED FOR
- B23K—SOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
- B23K26/36—Removing material
- B23K26/362—Laser etching
- B23K26/364—Laser etching for making a groove or trench, e.g. for scribing a break initiation groove
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- B23K—SOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
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- B23K26/40—Removing material taking account of the properties of the material involved
- B23K26/402—Removing material taking account of the properties of the material involved involving non-metallic material, e.g. isolators
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- B23K—SOLDERING OR UNSOLDERING; WELDING; CLADDING OR PLATING BY SOLDERING OR WELDING; CUTTING BY APPLYING HEAT LOCALLY, e.g. FLAME CUTTING; WORKING BY LASER BEAM
- B23K26/00—Working by laser beam, e.g. welding, cutting or boring
- B23K26/50—Working by transmitting the laser beam through or within the workpiece
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
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- H01L21/26—Bombardment with radiation
- H01L21/263—Bombardment with radiation with high-energy radiation
- H01L21/268—Bombardment with radiation with high-energy radiation using electromagnetic radiation, e.g. laser radiation
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- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/302—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
- H01L21/304—Mechanical treatment, e.g. grinding, polishing, cutting
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- H—ELECTRICITY
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- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
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- H01L21/67092—Apparatus for mechanical treatment
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- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
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- B—PERFORMING OPERATIONS; TRANSPORTING
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Abstract
层叠基板的制造方法包括下述(A)~(D)。(A),在第一半导体基板的表面形成包含氧化层的接合层。(B),使所述接合层的所述氧化层与第二半导体基板接触,并藉由所述接合层将所述第一半导体基板与所述第二半导体基板进行接合。(C),在进行所述接合之后,通过激光光线来在将所述第一半导体基板沿厚度方向进行分割的预定的第一分割预定面形成改性层。(D),通过以形成于所述第一分割预定面的改性层为起点将所述第一半导体基板进行分割,来使藉由所述接合层而与所述第二半导体基板进行了接合的所述第一半导体基板薄化。
Description
技术领域
本公开涉及一种层叠基板的制造方法和基板处理装置。
背景技术
在专利文献1和2中记载了SOI基板的制造方法。专利文献1中记载的制造方法包括下述阶段(a)~(f)。(a),在第一晶圆的规定深度位置处形成填埋氧化膜层之后,在所述第一晶圆上形成氧化膜。(b),在比所述填埋氧化膜层更深的深度位置处的所述第一晶圆形成氢填埋层。(c),使第二晶圆接合到所述氧化膜上。(d),去除所述氢填埋层的下部的第一晶圆,以使得所述填埋氧化膜层与所述氢填埋层之间的第一晶圆露出。(e),将通过(d)而露出的所述第一晶圆和所述填埋氧化膜层依次去除,以使得所述填埋氧化膜层与所述氧化膜之间的第一晶圆露出。(f),将通过(e)而露出的所述第一晶圆去除规定厚度。
在专利文献2中记载的制造方法中,准备用于形成由硅单晶构成的活性层的硅基板,并在硅基板的表面形成填埋绝缘层。然后,通过藉由填埋绝缘层注入氢离子来形成剥离用的离子注入层,通过在离子注入层与填埋绝缘层之间注入Ar离子等来形成非晶形层。然后,藉由填埋绝缘层使硅基板与支承基板贴合。之后,通过进行加热处理来在离子注入层的位置处使用智能切割法使硅基板的一部分剥离,由此形成活性层,并且通过加热处理使非晶形层多晶化来形成作为吸杂位点发挥功能的多晶硅层。
现有技术文献
专利文献
专利文献1:日本特开2006-173568号公报
专利文献2:日本特开2009-218381号公报
发明内容
发明要解决的问题
本公开的一个方式提供一种能够提高按半导体基板、氧化层、半导体层的顺序包括半导体基板、氧化层以及半导体层的层叠基板的生产率并且提高氧化层与半导体基板之间的剥离性的技术。
用于解决问题的方案
本公开的一个方式所涉及的层叠基板的制造方法包括下述(A)~(D)。(A),在第一半导体基板的表面形成包含氧化层的接合层。(B),使所述接合层的所述氧化层与第二半导体基板接触,并藉由所述接合层将所述第一半导体基板与所述第二半导体基板进行接合。(C),在进行所述接合之后,通过激光光线来在将所述第一半导体基板沿厚度方向进行分割的预定的第一分割预定面形成改性层。(D),通过以形成于所述第一分割预定面的改性层为起点将所述第一半导体基板进行分割,来使藉由所述接合层而与所述第二半导体基板进行了接合的所述第一半导体基板薄化。
发明的效果
根据本公开的一个方式,能够提高按半导体基板、氧化层、半导体层的顺序包括半导体基板、氧化层以及半导体层的层叠基板的生产率,并且提高氧化层与半导体基板之间的剥离性。
附图说明
图1是表示一个实施方式所涉及的层叠基板的制造方法的流程图。
图2的(A)是表示S102的一例的截面图,图2的(B)是表示S103的一例的截面图,图2的(C)是接着图2的(B)继续表示S103的一例的截面图。
图3是表示继图1之后的处理的第一例的流程图。
图4的(A)是表示S201的一例的截面图,图4的(B)是表示S202的一例的截面图,图4的(C)是表示S203的一例的截面图,图4的(D)是接着图4的(C)继续表示S203的一例的截面图,图4的(E)是表示S204的一例的截面图。
图5是表示继图1之后的处理的第二例的流程图。
图6的(A)是表示S301的一例的截面图,图6的(B)是表示S302的一例的截面图,图6的(C)是表示S303的一例的截面图,图6的(D)是接着图6的(C)继续表示S303的一例的截面图,图6的(E)是表示S304的一例的截面图。
图7是表示继图1之后的处理的第三例的流程图。
图8的(A)是表示S401的一例的截面图,图8的(B)是表示S402的一例的截面图,图8的(C)是表示S403的一例的截面图,图8的(D)是接着图8的(C)继续表示S403的一例的截面图,图8的(E)是表示S404的一例的截面图。
图9是表示继图3之后的处理的一例的流程图。
图10的(A)是表示在S501之前准备的层叠基板的一例的截面图,图10的(B)是表示S501的一例的截面图,图10的(C)是表示S502的一例的截面图。
图11的(A)是表示S503的一例的截面图,图11的(B)是表示S504的一例的截面图,图11的(C)是接着图11的(B)继续表示S504的一例的截面图。
图12是表示一个实施方式所涉及的基板处理装置的俯视图。
具体实施方式
下面,参照附图来对本公开的实施方式进行说明。此外,有时对各附图中的相同或对应的结构标注相同的附图标记并省略说明。在本说明书中,X轴方向、Y轴方向、Z轴方向是互相垂直的方向。X轴方向和Y轴方向为水平方向,Z轴方向为铅垂方向。
参照图1和图2来对一个实施方式所涉及的层叠基板的制造方法进行说明。如图1所示,层叠基板的制造方法例如包括步骤S101~S107。此外,层叠基板的制造方法至少包括S101~S103即可。另外,S104~S107的顺序不限定于图1的顺序,例如也可以在S107之后实施S106。
步骤S101包括在第一半导体基板10的表面形成接合层11。接合层11包括氧化层11a。氧化层11a例如是通过热氧化法形成的热氧化层。热氧化法通过使加热后的第一半导体基板10的表面暴露在氧或水蒸气中,来使氧化层11a从第一半导体基板10的表面朝向内部生长。根据热氧化法,相比于后述的CVD法等而言,能够得到更致密的氧化层11a,能够得到绝缘性优异的氧化层11a。以能够容易地进行后述的激光剥离的方式设定氧化层11a的厚度。
第一半导体基板10例如是硅晶圆,氧化层11a例如是硅氧化层。此外,第一半导体基板10不限定于硅晶圆,也可以是化合物半导体晶圆等。另外,氧化层11a也可以通过CVD(Chemical Vapor Deposition:化学气相沉积)法或ALD(Atomic Layer Deposition:原子层沉积)法等来形成。
如图2的(A)所示,步骤S102包括藉由接合层11将第一半导体基板10与第二半导体基板20进行接合。在第二半导体基板20的表面没有形成氧化层等,第二半导体基板20与接合层11的氧化层11a直接接触。第二半导体基板20例如是硅晶圆。能够得到包括第一半导体基板10、接合层11以及第二半导体基板20的层叠基板T。
在进行第一半导体基板10与第二半导体基板20的接合之前,可以通过等离子体等使第二半导体基板20的表面和接合层11的氧化层11a的表面活性化,也可以进一步地通过进一步供给水或水蒸气来使第二半导体基板20的表面和接合层11的氧化层11a的表面亲水化。在接合时产生OH基之间的氢键。另外,也可以通过氢键的脱水缩合反应来产生共价键。不使用液体的粘接剂,使固体之间直接贴合,因此能够防止由于粘接剂的变形等引起的位置偏离。另外,能够防止由于粘接剂的厚度不均等而产生倾斜。
步骤S103包括使第一半导体基板10薄化。首先,如图2的(B)所示,通过激光光线LB来在将第一半导体基板10沿厚度方向进行分割的预定的第一分割预定面12形成改性层15。此时,也可以通过激光光线LB来在设定于第一分割预定面12的周缘的环状的第二分割预定面13也形成改性层15。
例如从第一半导体基板10的与第二半导体基板20相反的一侧的表面向第一半导体基板10的内部照射激光光线LB。改性层15呈点状地形成,在第一分割预定面12和第二分割预定面13形成有多个改性层15。使用检电扫描器或XYθ台来使改性层15的形成位置移动。在进行改性层15的形成时,还形成使改性层15之间相连的裂纹。
接着,如图2的(C)所示,通过以形成于第一分割预定面12的改性层15为起点来对第一半导体基板10进行分割,来使藉由接合层11而与第二半导体基板20进行了接合的第一半导体基板10薄化。能够得到包括薄化后的第一半导体基板10、接合层11以及第二半导体基板20的层叠基板T。此时,也可以是,通过以形成于第二分割预定面13的改性层15为起点来对第一半导体基板10进行分割,来去除第一半导体基板10的斜面。
例如,上保持盘(chuck)131保持第一半导体基板10,下保持盘132保持第二半导体基板20。但是,第一半导体基板10与第二半导体基板20的配置也可以上下颠倒,也可以是,上保持盘131保持第二半导体基板20,下保持盘132保持第一半导体基板10。接着,当上保持盘131相对于下保持盘132上升时,裂纹以改性层15为起点呈面状地扩散,第一半导体基板10在第一分割预定面12和第二分割预定面13处被分割。
此外,也可以代替上保持盘131的上升而实施下保持盘132的下降,或者除了上保持盘131的上升以外还实施下保持盘132的下降。另外,也可以实施绕下保持盘132的铅垂轴的旋转。
在步骤S104~S107中,将残留于薄化后的第一半导体基板10的应变去除,来提高第一半导体基板10的品质。如后述那样,能够减少形成于第一半导体基板10的表面的第一器件层的不良。
在步骤S104中,对薄化后的第一半导体基板10的表面进行磨削。在步骤S105中,对薄化后的第一半导体基板10的表面进行蚀刻。在步骤S106中,对薄化后的第一半导体基板10进行退火。在步骤S107中,对薄化后的第一半导体基板10进行研磨。
在如以往那样通过智能切割法来使第一半导体基板薄化的情况下,在向第一半导体基板注入氢离子时消耗大量的电力。另外,能够向第一半导体基板注入氢离子的深度最大为1μm左右,薄化后的第一半导体基板的厚度最大为1μm左右。因而,为了在薄化后的第一半导体基板上形成半导体层,需要进行外延生长等处理。另外,在向第一半导体基板注入氢离子时会产生放射性,因此需要用于屏蔽放射性的特殊的腔室。
根据本实施方式,如上所述,通过激光光线LB来形成改性层15,并以改性层15为起点来对第一半导体基板10进行分割,由此使第一半导体基板10薄化。照射激光光线LB相比于注入氢离子而言能够减少功耗量。另外,能够通过激光光线LB的聚光位置等来控制形成改性层15的深度,能够防止薄化后的第一半导体基板10的厚度变得过薄,能够省略外延生长等处理。并且,照射激光光线LB与注射氢离子不同,不会产生放射性,因此不需要用于屏蔽放射性的特殊的腔室。因而,能够提高包括薄化后的第一半导体基板10、接合层11以及第二半导体基板20的层叠基板T的生产率,能够减少层叠基板T的生产成本。
如上所述,能够得到包括薄化后的第一半导体基板10、接合层11以及第二半导体基板20的层叠基板T。薄化后的第一半导体基板10的厚度比第二半导体基板20的厚度薄。在第一半导体基板10和第二半导体基板20的各基板是硅晶圆且接合层11的氧化层11a是硅氧化层的情况下,通过图1所示的制造方法能够得到的层叠基板T是所谓的SOI(Silicon onInsulator:绝缘体上硅)基板。
虽然在后文中叙述详情,但是根据本实施方式,如图3、图5以及图7所示,在薄化后的第一半导体基板10的表面形成有第一器件层16。第一器件层16例如包括半导体元件。在形成第一器件层16之后,通过透过第二半导体基板20的激光光线LB来形成改性层15。接合层11的氧化层11a对激光光线LB的吸收率高,改性层15形成于第二半导体基板20与接合层11之间的界面。此外,改性层15也可以形成于接合层11的内部。之后,以改性层15为起点来将第二半导体基板20与接合层11剥离。如果利用包括氧化层11a的层叠基板T,则能够无关于第一器件层16的种类地实施激光剥离。
另外,根据本实施方式,接合层11不形成于第二半导体基板20,而是形成于第一半导体基板10。因而,接合层11与第一半导体基板10牢固地结合。以不在接合层11与第一半导体基板10之间的界面处剥离的方式将接合层11与第二半导体基板20剥离,因此剥离强度低,容易进行剥离。将剥离后的第二半导体基板20与新的第一半导体基板10接合来重复利用。
接着,参照图3和图4来对继图1之后的处理的第一例进行说明。如图3所示,层叠基板的制造方法例如包括步骤S201~S204。如图4的(A)所示,步骤S201包括在薄化后的第一半导体基板10的表面形成第一器件层16。第一器件层16例如包括图像传感器。图像传感器例如是BSI(Back Side Illumination:背照)式。
如图4的(B)所示,步骤S202包括使第一器件层16与形成于第三半导体基板30的第二器件层31相向并接合。第二器件层31在与第一器件层16接合之前形成于第三半导体基板30。也可以是,如图10的(A)所示那样在第三半导体基板30与第二器件层31之间形成有剥离层35。第三半导体基板30例如是硅晶圆,第二器件层31例如包括图像传感器的逻辑电路。通过第一器件层16与第二器件层31构成器件层32。
在进行第一器件层16与第二器件层31的接合之前,可以通过等离子体等使第一器件层16的表面和第二器件层31的表面活性化,也可以进一步地通过供给水或水蒸气来使第一器件层16的表面和第二器件层31的表面亲水化。在接合时产生OH基之间的氢键。另外,也可以通过氢键的脱水缩合反应来产生共价键。
在步骤S203中,将第二半导体基板20与接合层11剥离。首先,如图4的(C)所示,通过透过第二半导体基板20的激光光线LB,来在第二半导体基板20与接合层11之间的界面形成改性层15。接合层11的氧化层11a对激光光线LB的吸收率高,改性层15形成于第二半导体基板20与氧化层11a之间的界面。此外,改性层15也可以形成于接合层11的内部。
接着,如图4的(D)所示,以形成于第二半导体基板20与接合层11之间的界面(或者接合层11的内部)的改性层15为起点,来将第二半导体基板20与接合层11剥离。例如,未图示的上保持盘保持第二半导体基板20,未图示的下保持盘保持第三半导体基板30。但是,第二半导体基板20和第三半导体基板30的配置也可以上下颠倒。接着,当上保持盘相对于下保持盘上升时,裂纹以改性层15为起点呈面状地扩散,第二半导体基板20与接合层11被剥离。
此外,也可以代替上保持盘的上升而实施下保持盘的下降,或者除了上保持盘的上升以外还实施下保持盘的下降。另外,也可以实施绕下保持盘的铅垂轴的旋转。
如图4的(E)所示,步骤S204包括在将第二半导体基板20与接合层11剥离之后去除接合层11。通过CMP(Chemical Mechanical Polishing:化学机械抛光)等来去除接合层11。其结果,薄化后的第一半导体基板10在层叠基板T的表面露出。
此外,在不影响后续的工艺的情况下,也可以不去除接合层11。另外,在接合层11被用作后述的吸杂层的情况下,不去除该接合层11。吸杂层是用于捕获重金属等杂质的层。
接着,参照图5和图6来对继图1之后的处理的第二例进行说明。如图5所示,层叠基板的制造方法例如包括步骤S301~S304。如图6的(A)所示,步骤S301包括在薄化后的第一半导体基板10的表面形成第一器件层16。第一器件层16例如包括背面PDN(Power DeliveryNetwork:电源分配网络)。
如图6的(B)所示,步骤S302包括使第一器件层16与形成于第三半导体基板30的第二器件层31相向并接合。第二器件层31在与第一器件层16接合之前形成于第三半导体基板30。第三半导体基板30例如是硅晶圆,第二器件层31例如包括背面PDN的逻辑电路。通过第一器件层16和第二器件层31构成器件层32。
在进行第一器件层16与第二器件层31的接合之前,可以通过等离子体等使第一器件层16的表面和第二器件层31的表面活性化,也可以进一步地通过供给水或水蒸气来使第一器件层16的表面和第二器件层31的表面亲水化。在接合时产生OH基之间的氢键。另外,也可以通过氢键的脱水缩合反应来产生共价键。
在步骤S303中,与图3的步骤S203同样地将第二半导体基板20与接合层11剥离。首先,如图6的(C)所示,通过透过第二半导体基板20的激光光线LB,来在第二半导体基板20与接合层11之间的界面形成改性层15。此外,改性层15也可以形成于接合层11的内部。接着,如图6的(D)所示,以形成于第二半导体基板20与接合层11之间的界面的改性层15为起点,来将第二半导体基板20与接合层11剥离。
在步骤S304中,如图6的(E)所示,在将第二半导体基板20与接合层11剥离之后,在接合层11和第一半导体基板10形成通孔17。通孔17是以贯通接合层11和第一半导体基板10的方式形成的贯通电极。此外,也可以在第一器件层16的形成(步骤S301)之前进行通孔17的形成(步骤S304)。
接着,参照图7和图8来对接着图1的处理的第三例进行说明。如图7所示,层叠基板的制造方法例如包括步骤S401~S404。如图8的(A)所示,步骤S401包括在薄化后的第一半导体基板10形成通孔18并在第一半导体基板10的表面形成第一器件层16。通孔18是以贯通第一半导体基板10的方式形成的贯通电极。第一器件层16例如包括DRAM(Dynamic RandomAccess Memory:动态随机存取存储器)。更详细地说,DRAM也可以是HBM(High BandwidthMemory:高带宽存储器)。
如图8的(B)所示,步骤S402包括将第一器件层16与载体基板40相向并接合。例如使用未图示的粘接剂等将载体基板40临时与第一器件层16接合。作为载体基板40,例如使用玻璃基板。
在步骤S403中,与图3的步骤S203同样地将第二半导体基板20与接合层11剥离。首先,如图8的(C)所示,通过透过第二半导体基板20的激光光线LB,来在第二半导体基板20与接合层11之间的界面形成改性层15。此外,改性层15也可以形成于接合层11的内部。接着,如图8的(D)所示,以形成于第二半导体基板20与接合层11之间的界面的改性层15为起点,来将第二半导体基板20与接合层11剥离。
步骤S404包括在将第二半导体基板20与接合层11剥离之后在接合层11的表面形成掩模图案并使用掩模图案来对接合层11进行蚀刻。蚀刻例如是干法蚀刻。在对接合层11进行蚀刻之后,去除掩模图案。其结果,如图8的(E)所示,露出通孔18。
接着,参照图9~图11来对继图3之后的处理的一例进行说明。如图9所示,层叠基板的制造方法例如包括步骤S501~S504。通过图3所示处理,能够得到图10的(A)所示的层叠基板T。层叠基板T按第一半导体基板10、器件层32、剥离层35、第三半导体基板30的顺序具有第一半导体基板10、器件层32、剥离层35以及第三半导体基板30。剥离层35也可以与接合层11同样地包括氧化层。另外,剥离层35也可以包括氮化层。也能够在氮化层形成改性层15。并且,剥离层35也可以具有多层结构。另外,层叠基板T也可以在第一半导体基板10的与器件层32相反的一侧的表面上还具有作为吸杂层发挥功能的接合层11。
如上所述,器件层32也可以包括第一器件层16和第二器件层31。第一器件层16例如包括半导体存储器。第二器件层31例如包括半导体存储器的周边电路(也称为“外围设备”)或半导体存储器的输入输出电路(也称为“IO”)等。
如图10的(B)所示,步骤S501包括在接合层11(在没有接合层11的情况下为第一半导体基板10)的表面形成芯片贴装膜(DAF:Die Attach Filim)33的处理。芯片贴装膜33是芯片接合用的粘接片。芯片贴装膜33被使用于半导体芯片的层叠等。芯片贴装膜33为导电性和绝缘性中的任一方均可。通过涂布液体的材料并进行干燥来得到芯片贴装膜33。
如图10的(C)所示,步骤S502包括对接合层11、第一半导体基板10、器件层32以及剥离层35进行切割。形成贯通接合层11、第一半导体基板10、器件层32以及剥离层35的槽19。在接合层11之上预先形成有芯片贴装膜33的情况下,芯片贴装膜33也被切割,槽19以也贯通芯片贴装膜33的方式形成。切割方法例如是激光切割或刀片切割等。
进行激光切割包括使用激光光线LB2来进行烧蚀加工。芯片贴装膜33、接合层11、第一半导体基板10、器件层32以及剥离层35通过吸收激光光线LB2而发热,并且升华或蒸发。其结果,形成槽19。
当对第一半导体基板10进行切割时、以及对器件层32和剥离层35进行切割时,控制部也可以变更激光光线LB2的能量。例如,在对第一半导体基板10进行加工时,设定能够对硅进行加工的能量。另一方面,在对器件层32和剥离层35进行加工时,设定能够对导电膜和氧化膜进行加工且不能够对硅进行加工的能量。在对器件层32和剥离层35进行加工时,能够防止对第三半导体基板30的损伤。
如图11的(A)所示,步骤S503包括将层叠基板T与配置于与第三半导体基板30相反的一侧的带51进行贴合并藉由带51安装于框52。框52形成为环状,带51以覆盖框52的开口部的方式粘贴于框52。
在接合层11(在没有接合层11的情况下为第一半导体基板10)与带51之间配置有芯片贴装膜33。此外,在本实施方式中,芯片贴装膜33预先形成于接合层11等,但也可以预先粘贴在带51的表面。在后者的情况下,同时实施步骤S503和步骤S501。在该情况下,也可以在后述的步骤S504之后实施芯片贴装膜33的切割。
在步骤S504中,与图3的步骤S203同样地将第三半导体基板30与剥离层35剥离。首先,如图11的(B)所示,通过透过第三半导体基板30的激光光线LB,来在第三半导体基板30与剥离层35之间的界面形成改性层15。改性层15也可以形成于剥离层35的内部。接着,如图11的(C)所示,以形成于第三半导体基板30与剥离层35之间的界面的改性层15为起点,来将第三半导体基板30与剥离层35剥离。在剥离后也能够通过带51来防止半导体芯片的散乱。半导体芯片被逐个拾取。
在将第三半导体基板30与剥离层35剥离之后,接合层11残留在第一半导体基板10的表面。所残留的接合层11被用作用于捕获重金属等杂质的吸杂层。因而,不需要形成吸杂层的处理。
以往,在厚度厚的第一半导体基板10的表面形成器件层32,通过刀片来对器件层32进行切割,接着,对器件层32粘贴保护带,之后对第一半导体基板10进行磨削来进行了薄化。刀片对器件层32进行全切割并且对第一半导体基板10进行半切割。之后,从与器件层32相反的一侧起对第一半导体基板10进行磨削,由此对第一半导体基板10进行分割,来得到多个半导体芯片。之后,进行以下处理:在第一半导体基板10的磨削后的面形成吸杂层;在隔着第一半导体基板10而与保护带相反的一侧配置带51;藉由带51将第一半导体基板10安装于框52;以及去除保护带等。
根据本实施方式,在形成器件层32之前,已经完成第一半导体基板10的薄化(参照图4)。(1)不像以往那样在形成器件层32之后对第一半导体基板10进行磨削,因此能够抑制对器件层32和第一半导体基板10的损伤。另外,根据本实施方式,对器件层32和第一半导体基板10进行切割来得到多个半导体芯片。接着,藉由配置于与第三半导体基板30相反的一侧的带51将第一半导体基板10安装于框52。并且,之后通过激光剥离来去除第三半导体基板30。第三半导体基板30比以往的保护带硬。(2)能够通过第三半导体基板30来对半导体芯片进行加固,直到去除第三半导体基板30为止,从而能够抑制半导体芯片的损伤。(3)与以往不同,不需要进行保护带的粘贴和去除。(4)能够将在去除第三半导体基板30之后残留的接合层11作为吸杂层来利用,不需要形成吸杂层的处理。如上面说明的那样,根据本实施方式,能够提高半导体芯片的生产率。
此外,在本实施方式中,如图10的(A)所示,准备了接合层11形成于第一半导体基板10的层叠基板T,但接合层11也可以形成于第二半导体基板20。在该情况下,也能够得到上述(1)~(4)的效果,能够提高半导体芯片的生产率。此外,在如图10的(A)所示那样准备了接合层11形成于第一半导体基板10的层叠基板T的情况下,(5)能够将第二半导体基板20与接合层11容易地剥离。
接着,参照图12等来对实施图1的步骤S103的基板处理装置100进行说明。基板处理装置100具有搬入搬出部101、搬送部110、激光加工部120、分割部130以及控制部140。
搬入搬出部101具有载置盒C的载置部102。盒C例如收容多张图2的(A)所示的层叠基板T。层叠基板T包括第一半导体基板10、第二半导体基板20、以及将第一半导体基板10与第二半导体基板20接合的接合层11。此外,载置部102的数量和盒C的数量不限定于图12所示的数量。
搬送部110配置在搬入搬出部101、激光加工部120以及分割部130的旁边,对搬入搬出部101、激光加工部120以及分割部130搬送层叠基板T。搬送部110具有用于保持层叠基板T的搬送臂111。搬送臂111能够进行沿水平方向(X轴方向和Y轴方向这两个方向)和铅垂方向的移动、以及以铅垂轴为中心的旋转。
如图2的(B)所示,激光加工部120通过激光光线LB来在将层叠基板T沿厚度方向进行分割的预定分割预定面形成改性层15。激光加工部120例如包括用于保持层叠基板T的台121、以及向由台121保持的层叠基板T照射激光光线LB的光学系统122。台121例如是XYθ台或XYZθ台。光学系统122例如包括聚光透镜。聚光透镜用于将激光光线LB朝向层叠基板T聚光。光学系统122还可以包括检电扫描器。
如图2的(C)所示,分割部130以形成于分割预定面的改性层15为起点来对层叠基板T进行分割。分割部130例如包括上保持盘131和下保持盘132。上保持盘131保持第一半导体基板10,下保持盘132保持第二半导体基板20。但是,第一半导体基板10和第二半导体基板20的配置也可以上下颠倒。接着,当上保持盘131相对于下保持盘132上升时,裂纹以改性层15为起点呈面状地扩散,层叠基板T在第一分割预定面12等处被分割。此外,也可以代替上保持盘131的上升而实施下保持盘132的下降,或者除了上保持盘131的上升以外还实施下保持盘132的下降。另外,也可以实施绕下保持盘132的铅垂轴的旋转。
控制部140例如是计算机,图12所示,具备CPU(Central Processing Unit:中央处理器)141、以及存储器等存储介质142。在存储介质142中保存用于控制在基板处理装置100中执行的各种处理的程序。控制部140通过使CPU141执行存储介质142中存储的程序,来控制基板处理装置100的动作。
控制部140将分割预定面设定于第一半导体基板10的内部。控制部140在第一分割预定面12形成改性层15,并以所形成的改性层15为起点来对第一半导体基板10进行分割,由此使藉由接合层11而与第二半导体基板20进行了接合的第一半导体基板10薄化。
此外,图12所示的基板处理装置100还能够使用于除图1的步骤S103以外的步骤,例如还能够使用于图3的步骤S203、图5的步骤S303、图7的步骤S403以及图9的步骤S504等。
在实施图3的步骤S203或图5的步骤S303的情况下,控制部140将分割预定面设定为第二半导体基板20与接合层11之间的界面,并以形成于该界面的改性层15为起点来将第二半导体基板20与接合层11剥离。在该情况下,分割部130的上保持盘131保持第二半导体基板20,下保持盘132保持第三半导体基板30。改性层15也可以形成于接合层11的内部。
在实施图7的步骤S403的情况下,控制部140将分割预定面设定为第二半导体基板20与接合层11之间的界面,并以形成于该界面的改性层15为起点来将第二半导体基板20与接合层11剥离。在该情况下,分割部130的上保持盘131保持第二半导体基板20,下保持盘132保持载体基板40。
在实施图9的步骤S504的情况下,控制部140将分割预定面设定为第三半导体基板30与剥离层35之间的界面,并以形成于该界面的改性层15为起点来将第三半导体基板30与剥离层35剥离。在该情况下,分割部130的上保持盘131保持第三半导体基板30,下保持盘132保持带51。改性层15也可以形成于剥离层35的内部。另外,搬送部110的搬送臂111通过保持图11所示的框52来保持层叠基板T。
以上,对本公开所涉及的层叠基板的制造方法和基板处理装置的实施方式等进行了说明,但是本公开不限定于上述实施方式等。在权利要求书所记载的范畴内能够进行各种变更、修正、替换、追加、删除以及组合。这些当然也属于本公开的技术范围。
本申请主张2021年3月9日向日本国专利局申请的特愿2021-037189号的优先权,并在本申请中引用特愿2021-037189号的全部内容。
附图标记说明
10:第一半导体基板;11:接合层;11a:氧化层;12:第一分割预定面;15:改性层;20:第二半导体基板。
Claims (15)
1.一种层叠基板的制造方法,包括:
在第一半导体基板的表面形成包含氧化层的接合层;
使所述接合层的所述氧化层与第二半导体基板接触,并藉由所述接合层将所述第一半导体基板与所述第二半导体基板进行接合;
在进行所述接合之后,通过激光光线来在将所述第一半导体基板沿厚度方向进行分割的预定的第一分割预定面形成改性层;以及
通过以形成于所述第一分割预定面的改性层为起点将所述第一半导体基板进行分割,来使藉由所述接合层而与所述第二半导体基板进行了接合的所述第一半导体基板薄化。
2.根据权利要求1所述的层叠基板的制造方法,还包括:
通过激光光线来在设定于所述第一分割预定面的周缘的环状的第二分割预定面形成改性层;以及
通过以形成于所述第一分割预定面和所述第二分割预定面的改性层为起点将所述第一半导体基板进行分割,来使藉由所述接合层而与所述第二半导体基板进行了接合的所述第一半导体基板薄化,并且去除所述第一半导体基板的斜面。
3.根据权利要求1或2所述的层叠基板的制造方法,其中,
所述接合层的所述氧化层是通过对所述第一半导体基板的表面进行热氧化而形成的热氧化层。
4.根据权利要求1至3中的任一项所述的层叠基板的制造方法,其中,
所述第一半导体基板和所述第二半导体基板的各半导体基板是硅晶圆,所述接合层的所述氧化层是硅氧化层。
5.根据权利要求1至4中的任一项所述的层叠基板的制造方法,还包括:
在进行了所述薄化后的所述第一半导体基板的表面形成第一器件层;
在形成所述第一器件层之后,通过透过所述第二半导体基板的激光光线来在所述第二半导体基板与所述接合层的界面或者所述接合层的内部形成改性层;以及
以形成于所述第二半导体基板与所述接合层的界面或者所述接合层的内部的改性层为起点,将所述第二半导体基板与所述接合层剥离。
6.根据权利要求5所述的层叠基板的制造方法,其中,
还包括:在形成所述第一器件层之后且在所述第二半导体基板与所述接合层的界面或者所述接合层的内部形成改性层之前,使所述第一器件层与形成于第三半导体基板的第二器件层相向并接合。
7.根据权利要求6所述的层叠基板的制造方法,其中,
还包括:在将所述第二半导体基板与所述接合层剥离之后,去除所述接合层。
8.根据权利要求6所述的层叠基板的制造方法,其中,
还包括:在将所述第二半导体基板与所述接合层剥离之后、或者形成所述第一器件层之前,在所述接合层和所述第一半导体基板形成通孔。
9.根据权利要求5所述的层叠基板的制造方法,其中,
还包括:在形成所述第一器件层之后且在所述第二半导体基板与所述接合层的界面或者所述接合层的内部形成改性层之前,使所述第一器件层与载体基板相向并接合。
10.根据权利要求9所述的层叠基板的制造方法,其中,
还包括:在将所述第二半导体基板与所述接合层剥离之后,在所述接合层的表面形成掩模图案,并使用掩模图案来对所述接合层进行蚀刻。
11.根据权利要求6或7所述的层叠基板的制造方法,其中,
在所述第三半导体基板与所述第二器件层之间形成有剥离层,
所述层叠基板的制造方法还包括:
在将所述第二半导体基板与所述接合层剥离之后,对所述第一半导体基板、所述第一器件层、所述第二器件层以及所述剥离层进行切割;
在进行所述切割之后,藉由配置于与所述第三半导体基板相反的一侧的带将所述第一半导体基板安装于框;
在将所述第一半导体基板安装于所述框之后,将透过所述第三半导体基板的激光光线照射至所述剥离层,来在所述第三半导体基板与所述剥离层的界面或者所述剥离层的内部形成改性层;以及
以形成于所述第三半导体基板与所述剥离层的界面或者所述剥离层的内部的改性层为起点,将所述第三半导体基板与所述剥离层剥离。
12.一种基板处理装置,具备:
搬送部,其搬送层叠基板,所述层叠基板包括第一半导体基板、形成于所述第一半导体基板的表面的接合层、以及藉由所述接合层而与所述第一半导体基板进行了接合的第二半导体基板,其中,所述接合层包含与所述第二半导体基板接触的氧化层;
激光加工部,其通过激光光线来在将所述层叠基板沿厚度方向进行分割的预定的第一分割预定面形成改性层;
分割部,其以形成于所述第一分割预定面的改性层为起点将所述层叠基板进行分割;
控制部,其控制所述搬送部、所述激光加工部以及所述分割部,
其中,所述控制部将所述第一分割预定面设置在所述第一半导体基板的内部,在所述第一分割预定面形成改性层,并以所形成的改性层为起点将所述第一半导体基板进行分割,由此使藉由所述接合层而与所述第二半导体基板进行了接合的所述第一半导体基板薄化。
13.根据权利要求12所述的基板处理装置,其中,
所述控制部实施以下处理:通过激光光线来在设定于所述第一分割预定面的周缘的环状的第二分割预定面形成改性层;以及通过以形成于所述第一分割预定面和所述第二分割预定面的改性层为起点将所述第一半导体基板进行分割,来使藉由所述接合层而与所述第二半导体基板进行了接合的所述第一半导体基板薄化,并且去除所述第一半导体基板的斜面。
14.根据权利要求12或13所述的基板处理装置,其中,
所述接合层的所述氧化层是通过使所述第一半导体基板的表面热氧化而形成的热氧化层。
15.根据权利要求12至14中的任一项所述的基板处理装置,其中,
所述第一半导体基板和所述第二半导体基板的各半导体基板是硅晶圆,所述接合层的所述氧化层是硅氧化层。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2021-037189 | 2021-03-09 | ||
JP2021037189 | 2021-03-09 | ||
PCT/JP2022/007959 WO2022190908A1 (ja) | 2021-03-09 | 2022-02-25 | 積層基板の製造方法、及び基板処理装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
CN116941013A true CN116941013A (zh) | 2023-10-24 |
Family
ID=83226816
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN202280018447.4A Pending CN116941013A (zh) | 2021-03-09 | 2022-02-25 | 层叠基板的制造方法和基板处理装置 |
Country Status (5)
Country | Link |
---|---|
US (1) | US20240162081A1 (zh) |
JP (1) | JPWO2022190908A1 (zh) |
KR (1) | KR20230154934A (zh) |
CN (1) | CN116941013A (zh) |
WO (1) | WO2022190908A1 (zh) |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006173568A (ja) | 2004-12-14 | 2006-06-29 | Korea Electronics Telecommun | Soi基板の製造方法 |
JP2009218381A (ja) | 2008-03-11 | 2009-09-24 | Denso Corp | SOI(Silicononinsulator)基板の製造方法 |
JP2012038932A (ja) * | 2010-08-06 | 2012-02-23 | Sumco Corp | 半導体ウェーハの薄厚化方法および貼り合せウェーハの製造方法 |
JP5799740B2 (ja) * | 2011-10-17 | 2015-10-28 | 信越半導体株式会社 | 剥離ウェーハの再生加工方法 |
DE102015006971A1 (de) * | 2015-04-09 | 2016-10-13 | Siltectra Gmbh | Verfahren zum verlustarmen Herstellen von Mehrkomponentenwafern |
WO2020213479A1 (ja) * | 2019-04-19 | 2020-10-22 | 東京エレクトロン株式会社 | 処理装置及び処理方法 |
-
2022
- 2022-02-25 WO PCT/JP2022/007959 patent/WO2022190908A1/ja active Application Filing
- 2022-02-25 CN CN202280018447.4A patent/CN116941013A/zh active Pending
- 2022-02-25 KR KR1020237033854A patent/KR20230154934A/ko unknown
- 2022-02-25 US US18/549,616 patent/US20240162081A1/en active Pending
- 2022-02-25 JP JP2023505288A patent/JPWO2022190908A1/ja active Pending
Also Published As
Publication number | Publication date |
---|---|
KR20230154934A (ko) | 2023-11-09 |
WO2022190908A1 (ja) | 2022-09-15 |
US20240162081A1 (en) | 2024-05-16 |
JPWO2022190908A1 (zh) | 2022-09-15 |
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---|---|---|---|
PB01 | Publication | ||
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