CN115700867A - 显示装置 - Google Patents

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Abstract

一种显示装置包括：像素单元，包括设置在第一区域中的多个第一像素和设置在第二区域中的多个第二像素；发射驱动器，配置为基于第一起始信号、第一时钟信号和第二时钟信号将截止电平的多个发射信号顺序地供应给所述多个第一像素和所述多个第二像素；以及第一扫描驱动器，配置为基于第二起始信号、所述第一时钟信号和所述第二时钟信号将导通电平的多个第一扫描信号顺序地供应给所述多个第一像素，并且基于第三起始信号、所述第一时钟信号和所述第二时钟信号将所述导通电平的所述多个第一扫描信号顺序地供应给所述多个第二像素。

Description

显示装置
相关申请的交叉引用
本申请要求于2021年7月26日提交的第10-2021-0098161号韩国专利申请的优先权和权益，该韩国专利申请据此出于所有目的通过引用并入本文，就像在本文中完整阐述一样。
技术领域
本发明的实施例总体上涉及显示装置，并且更具体地，涉及在不同显示模式下操作的显示装置。
背景技术
随着信息技术的发展，作为用户和信息之间的连接媒介的显示装置的重要性已经增加。响应于此，诸如液晶显示装置和有机发光显示装置的显示装置的用途已经扩大。
为了降低功耗，显示装置可以在一些区域以高图像频率显示图像并且在其他区域以低图像频率显示图像。因此，已经需要附加的扫描驱动器和发射驱动器以便以不同的图像频率操作不同的区域。结果，增加了由附加的扫描驱动器和发射驱动器引起的无用空间(dead space)。
本背景技术部分中公开的上述信息仅用于对发明构思的背景的理解，并且因此，它可能包含不构成现有技术的信息。
发明内容
根据本发明的原理构造的显示装置能够通过减小扫描驱动器和/或发射驱动器的尺寸来最小化无用空间并且能够操作两个或更多个区域以便以不同的图像频率显示图像。
本发明构思的附加特征将在随后的描述中阐述，并且部分地将从描述中显而易见，或者可以通过本发明构思的实践获知。
根据本发明的一方面，一种显示装置包括：像素单元，包括设置在第一区域中的多个第一像素和设置在第二区域中的多个第二像素；发射驱动器，配置为基于第一起始信号、第一时钟信号和第二时钟信号将截止电平的多个发射信号顺序地供应给所述多个第一像素和所述多个第二像素；以及第一扫描驱动器，配置为基于第二起始信号、所述第一时钟信号和所述第二时钟信号将导通电平的多个第一扫描信号顺序地供应给所述多个第一像素，并且基于第三起始信号、所述第一时钟信号和所述第二时钟信号将所述导通电平的所述多个第一扫描信号顺序地供应给所述多个第二像素。
所述显示装置还可以包括：第二扫描驱动器，配置为基于第四起始信号、第三时钟信号和第四时钟信号将导通电平的多个第二扫描信号顺序地供应给所述多个第一像素，并且基于第五起始信号、所述第三时钟信号和所述第四时钟信号将所述导通电平的所述多个第二扫描信号顺序地供应给所述多个第二像素。
所述显示装置还可以包括：第三扫描驱动器，配置为基于第六起始信号、第五时钟信号和第六时钟信号将导通电平的多个第三扫描信号顺序地供应给所述多个第一像素和所述多个第二像素。
所述第一像素和所述第二像素中的每一个可以包括：第一晶体管，具有连接到第一节点的栅极电极、连接到第二节点的第一电极和连接到第三节点的第二电极；第二晶体管，具有用于接收所述多个第三扫描信号中的一个的栅极电极、连接到数据线的第一电极和连接到所述第二节点的第二电极；第三晶体管，具有用于接收所述多个第二扫描信号中的一个的栅极电极、连接到所述第一节点的第一电极和连接到所述第三节点的第二电极；第四晶体管，具有用于接收所述多个第一扫描信号中的一个的栅极电极、连接到所述第一节点的第一电极和连接到第一初始化线的第二电极；以及第五晶体管，具有用于接收所述多个发射信号中的一个的栅极电极、连接到第一电源线的第一电极和连接到所述第二节点的第二电极。
所述第一像素和所述第二像素中的每一个还可以包括：第六晶体管，具有用于接收所述多个发射信号中的一个的栅极电极、连接到所述第三节点的第一电极、和第二电极；第七晶体管，具有用于接收所述多个第三扫描信号中的一个的栅极电极、连接到第二初始化线的第一电极、和第二电极；发光元件，具有连接到所述第六晶体管的所述第二电极和所述第七晶体管的所述第二电极的第一电极和连接到第二电源线的第二电极；以及电容器，具有连接到所述第一电源线的第一电极和连接到所述第一节点的第二电极。
所述第一晶体管、所述第二晶体管、所述第五晶体管、所述第六晶体管和所述第七晶体管可以是P型晶体管，并且所述第三晶体管和所述第四晶体管可以是N型晶体管。
所述发射驱动器可以包括多个发射级，所述多个发射级中的每一个可以连接到N个像素行，其中，N可以是大于3的整数。
所述第一扫描驱动器可以包括多个第一扫描级，并且所述多个第一扫描级中的每一个可以连接到所述N个像素行。
所述第二扫描驱动器可以包括多个第二扫描级，所述多个第二扫描级中的每一个可以连接到M个像素行，其中，M可以是大于1且小于N的整数。
所述第三扫描驱动器可以包括起始级和多个第三扫描级，所述多个第三扫描级中的每一个可以连接到所述M个像素行，并且所述多个第三扫描级的数量可以大于所述多个第二扫描级的数量。
当所述第一区域和所述第二区域以相同的图像频率显示图像时，所述第二起始信号的循环周期和所述第三起始信号的循环周期可以彼此相同。
当所述第一区域和所述第二区域以不同的图像频率显示图像时，所述第二起始信号的所述循环周期和所述第三起始信号的所述循环周期可以彼此不同。
当所述第一区域和所述第二区域以相同的图像频率显示图像时，所述第四起始信号的循环周期和所述第五起始信号的循环周期可以彼此相同。
当所述第一区域和所述第二区域以不同的图像频率显示图像时，所述第四起始信号的所述循环周期和所述第五起始信号的所述循环周期可以彼此不同。
根据本发明的另一方面，一种显示装置包括：像素单元，包括多个像素行；发射驱动器，包括多个发射级，每个所述发射级连接到N个像素行，其中，N是大于3的整数；第一扫描驱动器，包括多个第一扫描级，每个所述第一扫描级连接到所述N个像素行；第二扫描驱动器，包括多个第二扫描级，每个所述第二扫描级连接到M个像素行，其中，M是大于1且小于N的整数；以及第三扫描驱动器，包括起始级和多个第三扫描级，每个所述第三扫描级连接到所述M个像素行。
所述多个第三扫描级的数量可以大于所述多个第二扫描级的数量。
所述第三扫描驱动器的所述起始级可以连接到一个像素行。
所述发射驱动器可以接收第一起始信号、第一时钟信号和第二时钟信号。
所述第一扫描驱动器可以接收第二起始信号、第三起始信号、所述第一时钟信号和所述第二时钟信号。
所述第二扫描驱动器可以接收第四起始信号、第五起始信号、第三时钟信号和第四时钟信号。
应当理解，前述一般描述和以下详细描述两者都是说明性和解释性的，并且旨在提供对所要求保护的本发明的进一步解释。
附图说明
被包括以提供对本发明的进一步理解并且被并入并构成本说明书的一部分的附图示出了本发明的示例性实施例，并且与描述一起用于解释本发明构思。
图1是示出根据本发明的实施例的原理构造的显示装置的示意图。
图2是示出根据实施例的图1的显示装置的代表性像素的示意图。
图3是示出根据实施例的驱动图1的显示装置的高图像频率驱动方法的图。
图4是示出根据实施例的图3的高图像频率驱动方法中的在数据写入周期期间的操作的图。
图5是示出根据实施例的驱动图1的显示装置的低图像频率驱动方法的图。
图6是示出根据实施例的图5的低图像频率驱动方法的偏置刷新周期期间的操作的图。
图7是示出根据实施例的图1的显示装置的发射驱动器、第一扫描驱动器和第二扫描驱动器的示意图。
图8是示出根据实施例的图7的发射驱动器的发射级的示意图。
图9是示出驱动图8的发射级的方法的时序图。
图10是示出根据实施例的图1的显示装置的第三扫描驱动器的示意图。
图11是示出根据实施例的图10的第三扫描驱动器的第三扫描级的示意图。
图12是示出驱动图11的第三扫描级的方法的时序图。
图13和图14是示出控制第一区域和第二区域以便以不同的图像频率显示图像的情况的时序图。
图15是示出根据另一实施例的显示装置的示意图。
图16是示出根据另一实施例的像素单元的示意图。
具体实施方式
在下面的描述中，为了说明的目的，阐述了许多具体细节以提供对本发明的各种实施例或实施方式的充分理解。如本文中所使用的，“实施例”和“实施方式”是作为采用本文中公开的一种或多种发明构思的装置或方法的非限制性示例的可互换词语。然而，显而易见的是，可以在没有这些具体细节的情况下或者通过一个或多个等同布置来实践各种实施例。在其它情况下，以框图的形式示出了公知的结构和装置，以避免不必要地模糊各种实施例。此外，各种实施例可以是不同的，但是不必须是排他性的。例如，在不脱离本发明构思的情况下，实施例的特定形状、配置和特性可以在另一实施例中使用或实施。
除非另有说明，否则示出的实施例将被理解为提供可以在实践中实施本发明构思的一些方式的可变细节的说明性特征。因此，除非另有说明，否则在不脱离本发明构思的情况下，各种实施例的特征、组件、模块、层、膜、面板、区和/或方面等(在下文中，单独地或者共同地称为“元件”)可以以其它方式组合、分离、互换和/或重新布置。
交叉影线和/或阴影在附图中的使用通常被提供为使相邻元件之间的边界清楚。如此，除非说明，否则交叉影线或者阴影的存在或不存在都不传达或表明对元件的具体材料、材料性质、尺寸、比例、示出的元件之间的共性和/或任何其它特性、属性、性能等的任何偏好或要求。此外，在附图中，为了清楚和/或描述的目的，可能夸大了元件的尺寸和相对尺寸。当可以不同地实施实施例时，可以与描述的顺序不同地执行特定工艺顺序。例如，两个连续描述的工艺可以基本上被同时执行或者以与所描述的顺序相反的顺序被执行。另外，同样的附图标记表示同样的元件。
当元件或层被称为“在”另一元件或层“上”、“连接到”或“耦接到”另一元件或层时，所述元件或层可以直接在所述另一元件或层上、直接连接到或直接耦接到所述另一元件或层，或者可以存在居间元件或层。然而，当元件或层被称为“直接在”另一元件或层“上”、“直接连接到”或“直接耦接到”另一元件或层时，不存在居间元件或层。为此，术语“连接”可以指具有或不具有居间元件的物理连接、电连接和/或流体连接。此外，D1轴、D2轴和D3轴不限于直角坐标系的三个轴(诸如x轴、y轴和z轴)，并且可以在更广泛的意义上解释。例如，D1轴、D2轴和D3轴可以基本上彼此垂直，或者可以表示彼此不垂直的不同方向。为了本公开的目的，“X、Y和Z中的至少一个(种)(者)”和“从由X、Y和Z构成的组中选择的至少一个(种)(者)”可以被解释为仅X、仅Y、仅Z，或者X、Y和Z中的两个或更多个的任意组合，诸如以XYZ、XYY、YZ和ZZ为例。如本文中所使用的，术语“和/或”包括一个或多个相关所列项的任意组合和所有组合。
尽管在本文中可以使用术语“第一”、“第二”等来描述各种类型的元件，但是这些元件不应受这些术语的限制。这些术语用于将一个元件与另一元件区分开。因此，在不脱离本公开的教导的情况下，下面讨论的第一元件可以被称为第二元件。
出于描述的目的，诸如“在……下面”、“在……之下”、“在……下方”、“下”、“在……之上”、“上”、“在……上方”、“较高的”和“侧”(例如，如在“侧壁”中)等空间相对术语可以用于本文中，并且从而描述如附图中所示的一个元件与另一元件(多个元件)的关系。除了附图中描绘的方位之外，空间相对术语还旨在涵盖设备在使用、操作和/或制造中的不同方位。例如，如果附图中的设备被翻转，则被描述为“在”其它元件或特征“之下”或“下面”的元件将随后被定向为“在”其它元件或特征“之上”。因此，术语“在……之下”可以涵盖在……之上和在……之下两种方位。此外，设备可以被另外定向(例如，旋转90度或者在其它方位处)，并且如此，相应地解释本文中使用的空间相对术语。
在本文中使用的术语是为了描述具体实施例的目的，并非意图进行限制。如本文中所使用的，除非上下文另外明确指出，否则单数形式“一个”、“一种”和“所述(该)”也意图包括复数形式。此外，当在本说明书中使用术语“包括”、“包含”、“含有”和/或“具有”时，说明存在所陈述的特征、整体、步骤、操作、元件、组件和/或它们的组，但是不排除存在或附加一个或多个其它特征、整体、步骤、操作、元件、组件和/或它们的组。还注意的是，如本文中所使用的，术语“基本上”、“大约”和其它类似术语用作近似术语而非用作程度术语，并且如此，术语“基本上”、“大约”和其它类似术语用于解释将由本领域普通技术人员识别到的测量值、计算值和/或提供值的固有偏差。
按照本领域中的惯例，在附图中以功能性的块、单元和/或模块的形式描述并示出一些实施例。本领域技术人员将理解，这些块、单元和/或模块由可以使用基于半导体的制作技术或其它制造技术形成的电子(或光学)电路(诸如逻辑电路、分立组件、微处理器、硬连线电路、存储元件和布线连接等)物理地实现。在块、单元和/或模块由微处理器或其它类似的硬件实现的情况下，可以使用软件(例如，微代码)对块、单元和/或模块进行编程和控制，以执行本文中所讨论的各种功能，并且块、单元和/或模块可以可选地由固件和/或软件驱动。还预期到每个块、单元和/或模块可以由专用硬件来实现，或者被实现为用于执行一些功能的专用硬件和用于执行其它功能的处理器(例如，一个或多个程序化的微处理器和相关电路)的组合。而且，在不脱离本发明构思的范围的情况下，一些实施例的每个块、单元和/或模块可以被物理地分成两个或更多个交互和离散的块、单元和/或模块。此外，在不脱离本发明构思的范围的情况下，一些实施例的块、单元和/或模块可以被物理地组合成更复杂的块、单元和/或模块。
除非另外定义，否则本文中使用的所有术语(包括技术术语和科学术语)具有与本公开所属领域的普通技术人员所通常理解的含义相同的含义。除非在本文中明确地如此定义，否则诸如在通用字典中定义的术语的术语应当被解释为具有与它们在相关领域的背景中的含义相一致的含义，并且不应当以理想化的或者过于形式化的含义来解释。
另外，说明书中的表述“相同”可以表示“基本上相同”。即，表述“相同”可以相同到足以使普通技术人员理解为相同。其他表述也可以是其中省略了“基本上”的表述。
图1是示出根据本发明的实施例的原理构造的显示装置的示意图。
参照图1，根据实施例的显示装置9可以包括时序控制器10、数据驱动器20、第一扫描驱动器31、第二扫描驱动器32、第三扫描驱动器33、发射驱动器40以及像素单元50。
时序控制器10可以从处理器接收用于每个帧的时序信号和灰度级(grayscalelevel)。时序信号可以包括垂直同步信号、水平同步信号和数据使能信号。
垂直同步信号可以包括多个脉冲，并且可以基于产生多个脉冲中的每一个的时间点来指示先前帧周期结束以及当前帧周期开始。垂直同步信号的相邻脉冲之间的间隔可以与一个帧周期相对应。水平同步信号可以包括多个脉冲，并且可以基于产生多个脉冲中的每一个的时间点来指示先前水平周期结束以及新水平周期开始。水平同步信号的相邻脉冲之间的间隔可以与一个水平周期相对应。数据使能信号可以指示在水平周期期间供应灰度级。例如，可以响应于数据使能信号在每个水平周期期间以像素行为单位供应灰度级。
时序控制器10可以产生供应给数据驱动器20、第一扫描驱动器31、第二扫描驱动器32、第三扫描驱动器33和发射驱动器40等的控制信号。
数据驱动器20可以基于从时序控制器10接收的灰度级和控制信号来产生提供给数据线DL1、DL2、……和DLx等的数据电压。例如，数据驱动器20可以通过使用时钟信号对灰度级进行采样，并且将与灰度级相对应的数据电压以像素行为单位供应给数据线DL1、DL2、……和DLx等。
像素单元50可以包括位于第一区域AR1中的多个第一像素PXsx和位于第二区域AR2中的多个第二像素PXwx。在实施例中，参照图16，像素单元50’可以包括三个或更多个区域。每个像素可以连接到相对应的数据线、相对应的发射线、相对应的第一扫描线、相对应的第二扫描线和相对应的第三扫描线。例如，第一像素PXsx可以连接到数据线DLx(即，第x条数据线DLx)、发射线EMp(即，第p条发射线EMp)、第一扫描线GIq(即，第q条第一扫描线GIq)、第二扫描线GCr(即，第r条第二扫描线GCr)、第三扫描线GWs(即，第s条第三扫描线GWs)以及第三扫描线GW(s+y)(即，第(s+y)条第三扫描线GW(s+y))。像素行可以指连接到相同扫描线和相同发射线的像素。例如，第一像素PXsx可以包括在与第p条发射线EMp、第q条第一扫描线GIq、第r条第二扫描线GCr、第s条第三扫描线GWs以及第(s+y)条第三扫描线GW(s+y)连接的像素的像素行中。包括在像素行中的像素可以连接到不同的数据线。在实施例中，第二像素PXwx可以连接到第x条数据线DLx、第t条发射线EMt、第u条第一扫描线GIu、第v条第二扫描线GCv、第w条第三扫描线GWw以及第(w+y)条第三扫描线GW(w+y)。在此，p、q、r、s、x和y可以是大于0的整数，并且t、u、v和w可以是大于1的整数。
发射驱动器40可以通过接收来自时序控制器10的控制信号来产生供应给多条发射线EM1、……、EMp、……和EMt等的发射信号。此时，控制信号可以包括第一起始信号、第一时钟信号和第二时钟信号。发射驱动器40可以包括基于第一起始信号、第一时钟信号和第二时钟信号的移位寄存器。发射驱动器40可以根据第一起始信号、第一时钟信号和第二时钟信号将截止电平的多个发射信号顺序地供应给多个第一像素PXsx和多个第二像素PXwx。
第一扫描驱动器31可以通过从时序控制器10接收控制信号来产生供应给第一扫描线GI1、……、GIq、……和GIu等的第一扫描信号。此时，控制信号可以包括第二起始信号、第三起始信号、第一时钟信号和第二时钟信号。例如，第一扫描驱动器31和发射驱动器40可以共享第一时钟信号和第二时钟信号。因此，可能不需要附加的时钟线，并且可以减少无用空间。第一扫描驱动器31可以包括由第二起始信号、第一时钟信号和第二时钟信号控制的第一电路单元以及由第三起始信号、第一时钟信号和第二时钟信号控制的第二电路单元。第一电路单元和第二电路单元中的每一者可以被配置有移位寄存器。第一扫描驱动器31的第一电路单元可以根据第二起始信号、第一时钟信号和第二时钟信号将导通电平的多个第一扫描信号顺序地供应给多个第一像素PXsx。例如，第一扫描驱动器31的第二电路单元可以根据第三起始信号、第一时钟信号和第二时钟信号将导通电平的多个第一扫描信号顺序地供应给多个第二像素PXwx。
第二扫描驱动器32可以基于从时序控制器10接收的控制信号产生供应给第二扫描线GC1、……、GCr、……和GCv等的第二扫描信号。此时，控制信号可以包括第四起始信号、第五起始信号、第三时钟信号和第四时钟信号。第二扫描驱动器32可以包括由第四起始信号、第三时钟信号和第四时钟信号控制的第三电路单元以及由第五起始信号、第三时钟信号和第四时钟信号控制的第四电路单元。第三电路单元和第四电路单元中的每一者可以被配置有移位寄存器。第二扫描驱动器32的第三电路单元可以根据第四起始信号、第三时钟信号和第四时钟信号将导通电平的多个第二扫描信号顺序地供应给多个第一像素PXsx。例如，第二扫描驱动器32的第四电路单元可以根据第五起始信号、第三时钟信号和第四时钟信号将导通电平的多个第二扫描信号顺序地供应给多个第二像素PXwx。
第三扫描驱动器33可以根据从时序控制器10接收的控制信号产生供应给第三扫描线GW1、……、GWs、GW(s+y)、……、GWw和GW(w+y)等的第三扫描信号。此时，控制信号可以包括第六起始信号、第五时钟信号和第六时钟信号。第三扫描驱动器33可以包括由第六起始信号、第五时钟信号和第六时钟信号控制的移位寄存器。第三扫描驱动器33可以基于第六起始信号、第五时钟信号和第六时钟信号将导通电平的多个第三扫描信号顺序地供应给多个第一像素PXsx和多个第二像素PXwx。
图2是示出根据实施例的图1的显示装置的代表性像素的示意图。
参照图2，根据实施例的第一像素PXsx包括晶体管T1、T2、T3、T4、T5、T6和T7、电容器Cst和发光元件LD。由于第二像素PXwx配置为与第一像素PXsx基本上相同，因此为了描述方便而省略了重复描述。
第一晶体管T1可以具有连接到第一节点N1的栅极电极、连接到第二节点N2的第一电极以及连接到第三节点N3的第二电极。第一晶体管T1可以称为驱动晶体管。
第二晶体管T2可以具有用于接收多个第三扫描信号中的一个的栅极电极、连接到数据线DLx的第一电极以及连接到第二节点N2的第二电极。第二晶体管T2的栅极电极可以连接到第三扫描线GWs。第二晶体管T2可以称为扫描晶体管。
第三晶体管T3可以具有用于接收多个第二扫描信号中的一个的栅极电极、连接到第一节点N1的第一电极以及连接到第三节点N3的第二电极。第三晶体管T3的栅极电极可以连接到第二扫描线GCr。第三晶体管T3可以称为二极管连接的晶体管。
第四晶体管T4可以具有用于接收多个第一扫描信号中的一个的栅极电极、连接到第一节点N1的第一电极以及连接到第一初始化线VINTL1的第二电极。第四晶体管T4的栅极电极可以连接到第一扫描线GIq。第四晶体管T4可以称为栅极初始化晶体管。
第五晶体管T5可以具有用于接收多个发射信号中的一个的栅极电极、连接到第一电源线ELVDDL的第一电极以及连接到第二节点N2的第二电极。第五晶体管T5的栅极电极可以连接到发射线EMp。第五晶体管T5可以称为第一发射晶体管。
第六晶体管T6可以具有用于接收多个发射信号中的一个的栅极电极、连接到第三节点N3的第一电极、和第二电极。第六晶体管T6的栅极电极可以连接到发射线EMp。第六晶体管T6可以称为第二发射晶体管。
第七晶体管T7可以具有用于接收多个第三扫描信号中的一个的栅极电极、连接到第二初始化线VINTL2的第一电极、和第二电极。第七晶体管T7的栅极电极可以连接到第三扫描线GW(s+y)。第七晶体管T7可以称为阳极初始化晶体管。在另一实施例中，第七晶体管T7的栅极电极可以连接到第三扫描线GWs。
电容器Cst可以具有连接到第一电源线ELVDDL的第一电极和连接到第一节点N1的第二电极。
发光元件LD的第一电极(例如，阳极)可以连接到第六晶体管T6的第二电极和第七晶体管T7的第二电极，并且发光元件LD的第二电极(例如，阴极)可以连接到第二电源线ELVSSL。在发光元件LD的发射周期期间，施加到第二电源线ELVSSL的电压可以设置为低于施加到第一电源线ELVDDL的电压。发光元件LD可以包括有机发光二极管、无机发光二极管或量子点/阱发光二极管等。例如，图2的第一像素PXsx被示例性地示出为包括一个发光元件LD。然而，实施例不限于此。例如，在另一实施例中，第一像素PXsx也可以包括串联连接、并联连接或串并联连接的多个发光元件。
第一晶体管T1、第二晶体管T2、第五晶体管T5、第六晶体管T6和第七晶体管T7可以是P型晶体管。第一晶体管T1、第二晶体管T2、第五晶体管T5、第六晶体管T6和第七晶体管T7的沟道可以是由多晶硅形成的多晶硅晶体管。多晶硅晶体管可以是低温多晶硅(LTPS)晶体管。多晶硅晶体管可以具有高电子迁移率，并且因此具有快速驱动特性。
第三晶体管T3和第四晶体管T4可以是N型晶体管。第三晶体管T3和第四晶体管T4的沟道可以是由氧化物半导体形成的氧化物半导体晶体管。与多晶硅晶体管相比，氧化物半导体晶体管可以在低温下被加工并且具有低电荷迁移率。因此，氧化物半导体晶体管在截止状态下产生的漏电流的量可以小于多晶硅晶体管在截止状态下产生的漏电流的量。
图3是示出根据实施例的驱动图1的显示装置的高图像频率驱动方法的图。
当像素单元50(见图1)的整个区域或部分区域以第一图像频率(或第一图像速率)显示图像帧时，可以表示在第一显示模式下操作相对应区域。另外，当像素单元50的整个区域或部分区域以低于第一图像频率的第二图像频率(或第二图像速率)显示图像帧时，可以表示在第二显示模式下操作相对应区域。
在第一显示模式下，像素单元50(见图1)的相对应区域可以显示20Hz或更高(例如60Hz)的图像帧。在第二显示模式下，像素单元50的相对应区域可以显示小于20Hz(例如1Hz)的图像帧。第二显示模式可以是低功率显示模式。周期1TP是用于比较第一显示模式和第二显示模式的任意限定的周期。周期1TP可以表示在第一显示模式和第二显示模式下相同的时间间隔。
在第一显示模式下，周期1TP可以包括多个帧周期1FP。在第一显示模式下，多个帧周期1FP中的每一个可以顺序地包括数据写入周期WP和发射周期EP。在此，可以为每个像素行限定周期1TP、1FP、WP和EP中的每一个。
因此，在针对每个像素行的周期1TP期间，像素可以基于在数据写入周期WP中接收的数据电压显示与帧周期1FP的数量相对应的多个图像帧。
图4是示出根据实施例的图3的高图像频率驱动方法中的在数据写入周期期间的操作的图。
参照图2和图4，示出了驱动用于第一像素PXsx的数据写入周期WP和发射周期EP的方法。由于将基本上相同的驱动方法应用于第二像素PXwx(见图1)，因此为了描述方便而省略了重复描述。
在时间点t1a，可以将截止电平(例如，逻辑高电平)的发射信号施加到发射线EMp。因此，第五晶体管T5和第六晶体管T6可以截止，并且发光元件LD可以处于非发光状态。
另外，在时间点t1a，可以将导通电平(例如，逻辑高电平)的第一扫描信号施加到第一扫描线GIq。因此，第四晶体管T4可以导通，并且第一节点N1和第一初始化线VINTL1可以彼此电连接。因此，第一节点N1可以被初始化为具有第一初始化线VINTL1的第一初始化电压。第一初始化电压可以足够低于第二节点N2的电压。因此，第一晶体管T1可以导通偏置(on-biased)，并且可以防止或最小化由先前帧周期的灰度级引起的滞后现象。
在时间点t2a，可以将导通电平(例如，逻辑高电平)的第二扫描信号施加到第二扫描线GCr。因此，第三晶体管T3导通，并且第一晶体管T1可以以二极管形式连接。
在时间点t3a，可以将导通电平(例如，逻辑低电平)的第三扫描信号施加到第三扫描线GWs。因此，第二晶体管T2可以导通，并且数据线DLx和第二节点N2可以彼此电连接。可以将与每个像素行相对应的数据电压D(s-1)、Ds、D(s+1)和D(s+2)顺序地施加到数据线DLx，并且在时间点t3a，可以将与第一像素PXsx相对应的数据电压Ds施加到数据线DLx。数据电压Ds的大小可以与第一像素PXsx的灰度级相对应。数据电压Ds可以顺序地穿过第一像素PXsx的第二晶体管T2、第一晶体管T1和第三晶体管T3而施加到第一晶体管T1的栅极电极。在时间点t3a，施加到第一晶体管T1的栅极电极的电压为补偿后的数据电压，补偿后的数据电压从数据电压Ds降低的量相当于第一晶体管T1的阈值电压。补偿后的数据电压可以由电容器Cst维持。
在时间点t4a，可以将导通电平(例如，逻辑低电平)的第三扫描信号施加到第三扫描线GW(s+y)。因此，第七晶体管T7可以导通，并且第二初始化线VINTL2和发光元件LD的第一电极可以彼此连接。例如，第二初始化电压可以是足够低的电压，并且因此，可以容易地表现发光元件LD的黑色灰度级或低灰度级。例如，第二初始化电压可以与第二电源线ELVSSL的电压相同或小于第二电源线ELVSSL的电压。
在时间点t5a，可以将导通电平(例如，逻辑低电平)的发射信号施加到发射线EMp。因此，第五晶体管T5和第六晶体管T6可以导通，并且发光元件LD可以处于发光状态。
图5是示出根据实施例的驱动图1的显示装置的低图像频率驱动方法的图。
在第二显示模式下，周期1TP和一个帧周期1FP可以具有相同的长度。在第二显示模式下，多个帧周期1FP中的每一个可以顺序地包括数据写入周期WP、发射周期EP、偏置刷新周期BP和发射周期EP。
参照图2和图5，由于第一像素PXsx的第三晶体管T3和第四晶体管T4在偏置刷新周期BP期间维持截止状态，因此电容器Cst可以在一个帧周期1FP期间维持相同的数据电压Ds(见图4)。特别地，由于第三晶体管T3和第四晶体管T4形成为氧化物半导体晶体管，因此可以最小化漏电流。
因此，第一像素PXsx可以基于在数据写入周期WP期间供应的数据电压Ds(见图4)而在周期1TP期间显示相同的单个图像帧。
图6是示出根据实施例的图5的低图像频率驱动方法的偏置刷新周期期间的操作的图。
图6的时间点t1b、t3b、t4b和t5b可以分别与图4的时间点t1a、t3a、t4a和t5a相对应。施加到发射线EMp以及第三扫描线GWs和GW(s+y)的信号可以与参照图4描述的那些信号相同。因此，由于在低图像频率驱动期间发光元件LD(见图2)的光输出波形类似于在高图像频率驱动期间发光元件LD的光输出波形，因此闪烁可以不被用户识别到。
在偏置刷新周期BP期间，可以在第一扫描线GIq和第二扫描线GCr处维持截止电平(例如，逻辑低电平)的扫描信号。因此，可以在一个帧周期1FP(见图5)期间维持第一节点N1(见图2)的电压。
在偏置刷新周期BP期间，数据线DLx可以维持为参考电压Vref。作为另一示例，可以不供应数据电压Ds(见图4)，或者可以供应与第一像素PXsx的灰度级无关的不同电压电平的数据电压Ds。
图7是示出根据实施例的图1的显示装置的发射驱动器、第一扫描驱动器和第二扫描驱动器的示意图。
参照图7，发射驱动器40可以包括多个发射级EMS1、EMS2、EMS3和EMS4。多个发射级EMS1、EMS2、EMS3和EMS4中的每一个可以连接到N个像素行。N可以是大于3的整数。例如，在图7的示例中N可以是4。此时，发射级EMS1的输出端子204可以通过发射线EM1连接到四个像素行。类似地，多个发射级EMS2、EMS3和EMS4的多个输出端子204中的每一个可以通过多条发射线EM2、EM3和EM4中的相对应的一条连接到四个像素行。
多个发射级EMS1、EMS2、EMS3和EMS4中的每一个可以包括第一输入端子201、第二输入端子202、第三输入端子203和输出端子204。第一发射级EMS1的第一输入端子201可以连接到第一起始线FLM1。其他发射级EMS2、EMS3和EMS4可以分别连接到先前发射级的输出端子204。多个发射级EMS1、EMS2、EMS3和EMS4的第二输入端子202和第三输入端子203可以交替地连接到第一时钟线CK1和第二时钟线CK2。例如，当第一发射级EMS1的第二输入端子202连接到第一时钟线CK1并且其第三输入端子203连接到第二时钟线CK2时，下一个发射级EMS2的第二输入端子202可以连接到第二时钟线CK2并且其第三输入端子203可以连接到第一时钟线CK1。
第一扫描驱动器31可以包括多个第一扫描级GIS1、GIS2、GIS3和GIS4。多个第一扫描级GIS1、GIS2、GIS3和GIS4中的每一个可以连接到N个像素行。例如，在图7的示例中，N可以是4。此时，第一扫描级GIS1的输出端子204可以通过第一扫描线GI1连接到四个像素行。类似地，多个第一扫描级GIS2、GIS3和GIS4的多个输出端子204中的每一个可以通过多条第一扫描线GI2、GI3和GI4中的相对应的一条连接到四个像素行。此时，第一扫描线GI1和发射线EM1可以连接到相同的像素行。类似地，多条第一扫描线GI2、GI3和GI4中的每一个以及多条发射线EM2、EM3和EM4中的相对应的一条可以连接到相同的像素行。
多个第一扫描级GIS1、GIS2、GIS3、GIS4中的每一个可以包括第一输入端子201、第二输入端子202、第三输入端子203和输出端子204。第一电路单元可以指连接到第一区域AR1的像素PX的一组第一扫描级GIS1和GIS2。第一电路单元的第一扫描级GIS1的第一输入端子201可以连接到第二起始线FLM2。另一个第一扫描级GIS2的第一输入端子201可以连接到先前的第一扫描级(即，第一扫描级GIS1)的输出端子204。第二电路单元可以指连接到第二区域AR2的像素PX的一组第一扫描级GIS3和GIS4。第二电路单元的第一扫描级GIS3的第一输入端子201可以连接到第三起始线FLM3。另一个第一扫描级GIS4的第一输入端子201可以连接到先前的第一扫描级(即，第一扫描级GIS3)的输出端子204。
多个第一扫描级GIS1、GIS2、GIS3和GIS4的第二输入端子202和第三输入端子203可以交替地连接到第一时钟线CK1和第二时钟线CK2。例如，当第一扫描级GIS1的第二输入端子202连接到第一时钟线CK1并且其第三输入端子203连接到第二时钟线CK2时，下一个第一扫描级GIS2的第二输入端子202可以连接到第二时钟线CK2并且其第三输入端子203可以连接到第一时钟线CK1。
第二扫描驱动器32可以包括多个第二扫描级GCS1、GCS2、GCS3、GCS4、GCS5、GCS6、GCS7和GCS8。多个第二扫描级GCS1至GCS8中的每一个可以连接到M个像素行。M可以是大于1且小于N的整数。例如，M可以是N/2。例如，在图7的示例中，M可以是2。此时，第二扫描级GCS1的输出端子204可以通过第二扫描线GC1连接到两个像素行。类似地，多个第二扫描级GCS2至GCS8的多个输出端子204中的每一个可以通过多条第二扫描线GC2、GC3、GC4、GC5、GC6、GC7和GC8中的相对应的一条连接到两个像素行。
多个第二扫描级GCS1至GCS8中的每一个可以包括第一输入端子201、第二输入端子202、第三输入端子203和输出端子204。第三电路单元可以指连接到第一区域AR1的像素PX的一组第二扫描级GCS1、GCS2、GCS3和GCS4。第三电路单元的第二扫描级GCS1的第一输入端子201可以连接到第四起始线FLM4。其他第二扫描级GCS2、GCS3和GCS4的第一输入端子201可以分别连接到先前的第二扫描级(即，第二扫描级GCS1、GCS2和GCS3)的输出端子204。第四电路单元可以指连接到第二区域AR2的像素PX的一组第二扫描级GCS5、GCS6、GCS7和GCS8。第四电路单元的第二扫描级GCS5的第一输入端子201可以连接到第五起始线FLM5。其他第二扫描级GCS6、GCS7和GCS8的第一输入端子201可以分别连接到先前的第二扫描级(即，第二扫描级GCS5、GCS6和GCS7)的输出端子204。
多个第二扫描级GCS1至GCS8的第二输入端子202和第三输入端子203可以交替地连接到第三时钟线CK3和第四时钟线CK4。例如，当第二扫描级GCS1的第二输入端子202连接到第三时钟线CK3并且其第三输入端子203连接到第四时钟线CK4时，下一个第二扫描级GCS2的第二输入端子202可以连接到第四时钟线CK4并且其第三输入端子203可以连接到第三时钟线CK3。
根据图7的实施例，可以根据第三起始线FLM3和第五起始线FLM5连接到的扫描级容易地设置像素单元50(见图1)的部分区域。作为参考，在不添加单独的起始线的情况下部分地截止高电平电源线VHNL(参照图8)的电压的现有方法可能不将像素单元50划分为三个或更多个部分区域。根据实施例，可以通过添加起始线将像素单元50划分为三个或更多个部分区域。
另外，在典型/一般方法中，第一扫描信号由第二扫描级GCS1至GCS8产生。在这种情况下，另外需要虚拟级和进位线，并且因此存在无用空间增加的缺点。然而，在图7的实施例中，与典型/一般方法相比，发射级EMS1至EMS4的数量可以减少一半(即，50％)以确保空间，并且可以通过在确保的空间中设置第一扫描级GIS1至GIS4来减少无用空间。此时，可能需要增加多个发射级EMS1至EMS4中的每一个的缓冲晶体管P10和P11(见图8)的沟道宽度，但是由于减小了第二扫描级GCS1至GCS8的缓冲晶体管的沟道宽度，因此使得由发射级EMS1至EMS4和第二扫描级GCS1至GCS8引起的无用空间可以彼此抵消。
图8是示出根据实施例的图7的发射驱动器的发射级的示意图。
参照图7和图8，发射级EMS1至EMS4、第一扫描级GIS1至GIS4和第二扫描级GCS1至GCS8的配置可以基本上相同。因此，在下文中，本公开基于发射级EMS1来描述，并且为了描述方便而省略了重复描述。
发射级EMS1可以包括晶体管P1至P12和电容器CN1至CN3。晶体管P1至P12可以是P型晶体管。
晶体管P1可以具有连接到节点NN2的第一电极、连接到晶体管P2的第一电极的第二电极以及连接到低电平电源线VLNL的栅极电极。
晶体管P2可以具有连接到晶体管P1的第二电极的第一电极、连接到第一起始线FLM1的第二电极以及连接到第一时钟线CK1的栅极电极。
晶体管P3可以具有连接到节点NN3的第一电极、连接到第一时钟线CK1的第二电极以及连接到晶体管P2的第一电极的栅极电极。
晶体管P4可以具有连接到节点NN3的第一电极、连接到低电平电源线VLNL的第二电极以及连接到第一时钟线CK1的栅极电极。
晶体管P5可以具有连接到节点NN4的第一电极、连接到第二时钟线CK2的第二电极以及连接到节点NN2的栅极电极。
晶体管P6可以具有连接到高电平电源线VHNL的第一电极、连接到节点NN4的第二电极以及连接到节点NN3的栅极电极。
晶体管P7可以具有连接到电容器CN3的第一电极的第一电极、连接到第二时钟线CK2的第二电极以及连接到电容器CN3的第二电极的栅极电极。
晶体管P8可以具有连接到节点NN1的第一电极、连接到电容器CN3的第一电极的第二电极以及连接到第二时钟线CK2的栅极电极。
晶体管P9可以具有连接到高电平电源线VHNL的第一电极、连接到节点NN1的第二电极以及连接到节点NN2的栅极电极。
晶体管P10可以具有连接到高电平电源线VHNL的第一电极、连接到发射线EM1的第二电极以及连接到节点NN1的栅极电极。
晶体管P11可以具有连接到发射线EM1的第一电极、连接到低电平电源线VLNL的第二电极以及连接到节点NN2的栅极电极。
晶体管P12可以具有连接到电容器CN3的第二电极的第一电极、连接到节点NN3的第二电极以及连接到低电平电源线VLNL的栅极电极。
电容器CN1可以具有连接到高电平电源线VHNL的第一电极和连接到节点NN1的第二电极。
电容器CN2可以具有连接到节点NN4的第一电极和连接到节点NN2的第二电极。
电容器CN3可以具有连接到晶体管P7的第一电极的第一电极和连接到晶体管P7的栅极电极的第二电极。
图9是示出驱动图8的发射级的方法的时序图。
参照图8和图9，示出了用于施加到第一起始线FLM1的第一起始信号、施加到第二时钟线CK2的第二时钟信号、施加到第一时钟线CK1的第一时钟信号、节点NN2的节点电压VNN2、节点NN3的节点电压VNN3、节点NN1的节点电压VNN1以及施加到发射线EM1的发射信号的时序图。此时，水平同步信号Hsync示出为用于时序的参考信号。水平同步信号Hsync的脉冲之间的间隔可以称为一个水平周期。
可以将高电平电压施加到高电平电源线VHNL，并且可以将低电平电压施加到低电平电源线VLNL。在描述驱动方法时，由于具有连接到低电平电源线VLNL的栅极电极的晶体管P12和P1在大部分周期期间导通，因此除了特殊情况以外，省略对晶体管P12和P1的描述。
首先，在时间点tlc，可以将截止电平(例如，逻辑高电平)的第一起始信号供应给第一起始线FLM1，并且可以将逻辑低电平的第一时钟信号供应给第一时钟线CK1。因此，晶体管P2和P4可以导通。
当晶体管P2导通时，将高电平的第一起始信号传输到节点NN2，并且节点电压VNN2变为高电平。晶体管P3、P5、P9和P11可以由高电平的节点电压VNN2截止。
当晶体管P4导通时，由于节点NN3和低电平电源线VLNL彼此连接，所以节点电压VNN3可以变为低电平。晶体管P6和P7可以由低电平的节点电压VNN3导通。
当晶体管P6导通时，节点NN4和高电平电源线VHNL可以彼此连接。因此，由于高电平电源线VHNL支撑电容器CN2的一端，因此节点NN2的节点电压VNN2可以被稳定地维持。
当晶体管P7导通时，电容器CN3的第一电极和第二时钟线CK2可以彼此连接。此时，由于将高电平的第二时钟信号施加到晶体管P8的栅极电极，因此晶体管P8可以处于截止状态，并且因此节点电压VNN1可以不改变。
在时间点t2c，可以将逻辑低电平的第二时钟信号供应给第二时钟线CK2。
逻辑低电平的第二时钟信号可以通过晶体管P7供应给电容器CN3的第一电极。此时，由于电容器CN3的电容耦合而可以将低于低电平的电压施加到晶体管P7的栅极电极。因此，晶体管P7可以稳定地维持导通状态，并且其驱动特性可以被改善。
根据实施例，节点电压VNN3可以不受由于晶体管P12引起的电容器CN3的电容耦合的影响。当由于电容器CN3的电容耦合而可以将低于低电平的电压施加到晶体管P12的第一电极时，晶体管P12的第一电极用作漏极电极。因此，与晶体管P12的第二电极相对应的节点NN3用作源极电极。另外，由于通过低电平电源线VLNL将低电平电压施加到晶体管P12的栅极电极，因此可能需要将高于低电平的电压施加到晶体管P12的源极电极使得晶体管P12导通。此时，由于节点NN3的节点电压VNN3具有低电平，因此晶体管P12可以处于截止状态。
因此，根据实施例，由于节点电压VNN3由晶体管P12维持，因此可以防止将过大的偏置电压施加到晶体管P3和P4，并且可以延长晶体管P3和P4的寿命。
另外，晶体管P8可以由逻辑低电平的第二时钟信号导通。因此，节点NN1和第二时钟线CK2可以通过晶体管P7和P8连接。因此，晶体管P10可以被逻辑低电平的节点电压VNN1导通。作为参考，此时，晶体管P9可以通过逻辑高电平的节点电压VNN2来维持截止状态。
高电平电源线VHNL和发射线EM1可以通过导通的晶体管P10连接。因此，可以将逻辑高电平的电压作为逻辑高电平的发射信号供应给发射线EM1。
在时间点t3c，将逻辑低电平的第一时钟信号供应给第一时钟线CK1。因此，晶体管P4可以导通，并且由于节点NN3可以连接到低电平电源线VLNL，因此节点电压VNN3可以维持逻辑低电平。另外，晶体管P2可以导通并且逻辑低电平的第一起始信号可以供应给节点NN2。因此，晶体管P3、P5、P9和P11可以导通。因此，晶体管P10可以被二极管连接，并且因此高电平电源线VHNL的逻辑高电平的电压可以不传输到发射线EM1。此时，低电平电源线VLNL的逻辑低电平的电压可以通过导通的晶体管P11传输到发射线EM1。
在时间点t4c，可以将逻辑高电平的第一时钟信号供应给第一时钟线CK1。此时，由于晶体管P3导通，因此节点电压VNN3上升。因此，晶体管P6和P7可以截止。
在时间点t5c，可以将逻辑低电平的第二时钟信号供应给第二时钟线CK2。此时，由于晶体管P5导通，因此节点电压VNN2由于电容器CN2的电容耦合而下降到低于逻辑低电平的电平。因此，晶体管P11可以稳定地维持导通状态并且其驱动特性可以被改善。
根据实施例，与晶体管P1的第二电极相对应的节点可以不受由于晶体管P1引起的电容器CN2的电容耦合的影响。当由于电容器CN2的电容耦合而可以将低于低电平的电压施加到作为晶体管P1的第一电极的节点NN2时，晶体管P1的第一电极用作漏极电极。因此，与晶体管P1的第二电极相对应的节点用作源极电极。另外，由于通过低电平电源线VLNL将低电平电压施加到晶体管P1的栅极电极，因此需要将高于低电平的电压施加到晶体管P1的源极电极，使得晶体管P1导通。此时，由于将低电平电压施加到晶体管P1的源极电极，因此晶体管P1可以处于截止状态。
因此，根据实施例，由于与晶体管P1的第二电极相对应的节点的电压可以由晶体管P1维持，因此可以防止将过度的偏置电压施加到晶体管P2和P3，并且因此可以延长晶体管P2和P3的寿命。
图10是示出根据实施例的图1的显示装置的第三扫描驱动器的示意图。
作为参考，图10的像素PX与图7的像素PX基本上相同。
参照图10，第三扫描驱动器33可以包括起始级GWS1和多个第三扫描级GWS2、GWS3、GWS4、GWS5、GWS6、GWS7、GWS8、GWS9、GWS10、GWS11、GWS12、GWS13、GWS14、GWS15和GWS16。多个第三扫描级GWS2至GWS16中的每一个可以连接到K个像素行。例如，在图10的示例中，K可以是2。可替代地，起始级GWS1可以通过第三扫描线GW1连接到一个像素行。多个第三扫描级GWS2至GWS16的数量可以大于多个第二扫描级GCS1至GCS8的数量。例如，多个第三扫描级GWS2至GWS16的数量可以与多个第二扫描级GCS1至GCS8的数量的整数倍(例如，两倍)相对应。
第三扫描级GWS2的输出端子1004可以通过第三扫描线GW2连接到两个像素行。类似地，多个第三扫描级GWS3至GWS16的输出端子1004中的每一个可以通过多条第三扫描线GW3、GW4、GW5、GW6、GW7、GW8、GW9、GW10、GW11、GW12、GW13、GW14、GW15和GW16中的相对应的一条连接到两个像素行。
起始级GWS1和多个第三扫描级GWS2至GWS16中的每一个可以包括第一输入端子1001、第二输入端子1002、第三输入端子1003和输出端子1004。起始级GWS1的第一输入端子1001可以连接到第六起始线FLM6。多个第三扫描级GWS2至GWS16的第一输入端子1001可以分别连接到起始级GWS1和先前的第三扫描级(即，第三扫描级GWS2至GWS15)的输出端子1004。起始级GWS1和多个第三扫描级GWS2至GWS16的第二输入端子1002和第三输入端子1003可以交替地连接到第五时钟线CK5和第六时钟线CK6。例如，当起始级GWS1的第二输入端子1002连接到第五时钟线CK5并且其第三输入端子1003连接到第六时钟线CK6时，下一个第三扫描级GWS2的第二输入端子1002可以连接到第六时钟线CK6并且其第三输入端子1003可以连接到第五时钟线CK5。
图11是示出根据实施例的图10的第三扫描驱动器的第三扫描级的示意图。
在图11中，为了描述方便，示出了起始级GWS1和第三扫描级GWS2。参照图11，起始级GWS1可以包括第一驱动器1210、第二驱动器1220和输出单元(例如，缓冲器)1230。
输出单元1230可以响应于节点NP1和NP2的电压来控制供应给输出端子1004的电压。例如，输出单元1230可以包括晶体管M5和晶体管M6。
晶体管M5可以位于高电平电源线VHPL和输出端子1004之间，并且可以具有连接到节点NP1的栅极电极。晶体管M5可以响应于施加到节点NP1的电压来控制高电平电源线VHPL和输出端子1004之间的连接。
晶体管M6可以位于输出端子1004和第三输入端子1003之间，并且可以具有连接到节点NP2的栅极电极。晶体管M6可以响应于施加到节点NP2的电压来控制输出端子1004和第三输入端子1003之间的连接。输出单元1230可以作为缓冲器被驱动。另外，晶体管M5和晶体管M6可以通过并联连接多个晶体管来配置。晶体管M5和M6可以称为缓冲器晶体管。
第一驱动器1210可以响应于供应给第一输入端子1001、第二输入端子1002和第三输入端子1003的信号来控制节点NP3的电压。例如，第一驱动器1210可以包括晶体管M2至M4。
晶体管M2可以位于第一输入端子1001和节点NP3之间，并且可以具有连接到第二输入端子1002的栅极电极。晶体管M2可以响应于供应给第二输入端子1002的信号来控制第一输入端子1001和节点NP3之间的连接。
晶体管M3和晶体管M4可以串联连接在节点NP3和高电平电源线VHPL之间。晶体管M3可以位于晶体管M4和节点NP3之间，并且可以具有连接到第三输入端子1003的栅极电极。晶体管M3可以响应于供应给第三输入端子1003的信号来控制晶体管M4和节点NP3之间的连接。
晶体管M4可以位于晶体管M3和高电平电源线VHPL之间，并且可以具有连接到节点NP1的栅极电极。晶体管M4可以响应于节点NP1的电压来控制晶体管M3和高电平电源线VHPL之间的连接。
第二驱动器1220可以响应于第二输入端子1002和节点NP3的电压来控制节点NP1的电压。例如，第二驱动器1220可以包括晶体管M7、晶体管M8、电容器CP1和电容器CP2。
电容器CP1可以连接在节点NP2和输出端子1004之间。电容器CP1可以被充入与晶体管M6的导通和截止相对应的电压。
电容器CP2可以连接在节点NP1和高电平电源线VHPL之间。电容器CP2可以被充入施加到节点NP1的电压。
晶体管M7可以位于节点NP1和第二输入端子1002之间，并且可以具有连接到节点NP3的栅极电极。晶体管M7可以响应于节点NP3的电压来控制节点NP1和第二输入端子1002之间的连接。
晶体管M8可以位于节点NP1和低电平电源线VLPL之间，并且可以具有连接到第二输入端子1002的栅极电极。晶体管M8可以响应于供应给第二输入端子1002的信号来控制节点NP1和低电平电源线VLPL之间的连接。
晶体管M1可以位于节点NP3和节点NP2之间，并且可以具有连接到低电平电源线VLPL的栅极电极。晶体管M1可以在维持导通状态的同时维持节点NP3和节点NP2之间的电连接。另外，晶体管M1可以响应于节点NP2的电压来限制节点NP3的电压下降的量。换言之，即使节点NP2的电压下降到低于低电平电源线VLPL的电压的电压，节点NP3的电压也可以不低于通过从低电平电源线VLPL的电压减去晶体管M1的阈值电压所获得的电压。
图12是示出驱动图11的第三扫描级的方法的时序图。
在图12中，为了方便描述，使用起始级GWS1来描述操作工艺。
参照图11和图12，第五时钟线CK5的第五时钟信号和第六时钟线CK6的第六时钟信号具有两个水平周期的周期并且在不同的水平周期期间被供应。换言之，第六时钟信号可以设置为从第五时钟信号偏移半个周期(例如，一个水平周期1H)的信号。另外，供应给第一输入端子1001的第六起始线FLM6的第六起始信号可以被供应为与供应给第二输入端子1002的第五时钟信号同步。
供应特定信号可以意味着特定信号具有导通电平(例如，逻辑低电平)。停止特定信号的供应可以意味着特定信号具有截止电平(例如，逻辑高电平)。
另外，当将第六起始信号供应给第六起始线FLM6时，第一输入端子1001可以设置为逻辑低电平的电压，并且当第六起始信号不被供应给第六起始线FLM6时，第一输入端子1001可以设置为逻辑高电平的电压。另外，当将时钟信号供应给第二输入端子1002和第三输入端子1003时，可以将第二输入端子1002和第三输入端子1003设置为逻辑低电平的电压，并且当不供应时钟信号时，可以将第二输入端子1002和第三输入端子1003设置为逻辑高电平的电压。
详细描述操作工艺。首先，第六起始信号可以被供应为与第五时钟信号同步。
当将第五时钟信号供应给第五时钟线CK5时，晶体管M2和晶体管M8可以导通。当晶体管M2导通时，第一输入端子1001和节点NP3可以彼此电连接。在此，由于晶体管M1在大部分周期期间设置为导通状态，因此节点NP2可以维持与节点NP3的电连接。
当第一输入端子1001和节点NP3彼此电连接时，节点NP2的电压VNP2和节点NP3的电压VNP3可以通过供应给第一输入端子1001的第六起始信号设置为逻辑低电平。当节点NP2的电压VNP2和节点NP3的电压VNP3被设置为逻辑低电平时，晶体管M6和晶体管M7可以导通。
当晶体管M6导通时，第三输入端子1003和输出端子1004可以彼此电连接。在此，第三输入端子1003可以设置为逻辑高电平的电压(例如，可以不供应第六时钟信号)，并且因此逻辑高电平的电压也可以输出到输出端子1004。当晶体管M7导通时，第二输入端子1002和节点NP1可以彼此电连接。根据供应给第二输入端子1002的第五时钟信号，节点NP1的电压VNP1可以设置为逻辑低电平。
另外，当将第五时钟信号供应给第五时钟线CK5时，晶体管M8可以导通。当晶体管M8导通时，将低电平电源线VLPL的电压供应给节点NP1。在此，低电平电源线VLPL的电压可以设置为与第五时钟信号的逻辑低电平的电压相同(或相似)的电压，并且因此节点NP1可以稳定地维持逻辑低电平的电压。
当节点NP1设置为逻辑低电平的电压时，晶体管M4和晶体管M5可以导通。当晶体管M4导通时，高电平电源线VHPL和晶体管M3可以彼此电连接。在此，由于晶体管M3设置为截止状态，因此即使晶体管M4导通，节点NP3也可以稳定地维持低电平的电压。当晶体管M5导通时，可以将高电平电源线VHPL的电压供应给输出端子1004。在此，可以将高电平电源线VHPL的电压设置为与供应给第三输入端子1003的逻辑高电平的电压相同(或相似)的电压，并且因此输出端子1004可以稳定地维持逻辑高电平的电压。
此后，可以停止第六起始信号和第五时钟信号的供应。当停止第五时钟信号的供应时，晶体管M2和晶体管M8可以截止。此时，响应于存储在电容器CP1中的电压，晶体管M6和晶体管M7可以维持导通状态。例如，节点NP2和节点NP3可以通过存储在电容器CP1中的电压来维持逻辑低电平的电压。
当晶体管M6维持导通状态时，输出端子1004可以维持与第三输入端子1003的电连接。当晶体管M7维持导通状态时，节点NP1可以维持与第二输入端子1002的电连接。在此，第二输入端子1002的电压可以响应于第五时钟信号的供应的停止而设置为逻辑高电平的电压，并且因此节点NP1也可以设置为逻辑高电平的电压。当将逻辑高电平的电压供应给节点NP1时，晶体管M4和晶体管M5可以截止。
此后，可以将第六时钟信号供应给第三输入端子1003。此时，由于晶体管M6设置为导通状态，因此可以将供应给第三输入端子1003的第六时钟信号供应给输出端子1004。在这种情况下，输出端子1004可以将第六时钟信号作为导通电平的第三扫描信号输出到第三扫描线GW1。
例如，当将第六时钟信号供应给输出端子1004时，节点NP2的电压由于电容器CP1的电容耦合而下降到低于低电平电源线VLPL的电压的电压，并且因此晶体管M6可以稳定地维持导通状态。
例如，即使节点NP2的电压下降，节点NP3也可以由晶体管M1维持近似的电压(例如，通过从低电平电源线VLPL的电压中减去晶体管M1的阈值电压所获得的电压)。
在将导通电平的第三扫描信号输出到第三扫描线GW1之后，可以停止第六时钟信号的供应。当停止第六时钟信号的供应时，输出端子1004可以输出逻辑高电平的电压。另外，节点NP2的电压VNP2可以响应于输出端子1004的逻辑高电平的电压而上升到与低电平电源线VLPL的电压近似的电压。
此后，可以供应第五时钟信号。当可以将第五时钟信号供应给第五时钟线CK5时，晶体管M2和晶体管M8可以导通。当晶体管M2导通时，第一输入端子1001和节点NP3可以彼此电连接。此时，可以不将第六起始信号供应给第一输入端子1001，并且因此可以将第一输入端子1001设置为高电平的电压。因此，当晶体管M1导通时，可以将逻辑高电平的电压供应给节点NP3和节点NP2，并且因此晶体管M6和晶体管M7可以截止。
当晶体管M8导通时，低电平电源线VLPL的电压可以供应给节点NP1，并且因此晶体管M4和晶体管M5可以导通。当晶体管M5导通时，可以将高电平电源线VHPL的电压供应给输出端子1004。此后，晶体管M4和晶体管M5可以响应于充入在电容器CP2中的电压维持导通状态，并且因此输出端子1004可以稳定地接收高电平电源线VHPL的电压。
另外，当供应第六时钟信号时，晶体管M3可以导通。此时，由于晶体管M4设置为导通状态，因此可以将高电平电源线VHPL的电压供应给节点NP3和节点NP2。在这种情况下，晶体管M6和晶体管M7可以稳定地维持截止状态。
接下来，第三扫描级GWS2可以接收起始级GWS1的输出信号(例如，第三扫描信号)以与第六时钟信号同步。在这种情况下，第三扫描级GWS2可以将导通电平的第三扫描信号输出到第三扫描线GW2以与第五时钟信号同步。参照图10，多个第三扫描级GWS3至GWS16可以在重复上述工艺的同时将导通电平的第三扫描信号顺序地输出到多条扫描线GW3至GW16。
图13和图14是示出控制第一区域和第二区域以便以不同的图像频率显示图像的情况的时序图。
参照图1、图3至图6、图13和图14，将在第一显示模式下(例如，以高图像频率)驱动第一区域AR1并且在第二显示模式下(例如，以低图像频率)驱动第二区域AR2的情况作为示例进行描述。
图13示出了在第一区域AR1和第二区域AR2的像素行的数据写入周期WP(参照图3和图4)期间的时序图。在数据写入周期WP期间，可以以适当的时序将第三起始信号和第五起始信号供应给第三起始线FLM3和第五起始线FLM5以允许可以将适当时序的第一扫描信号和第二扫描信号供应给第二区域AR2的第一扫描线GI3以及第二扫描线GC5和GC6。关于适当的时序，参照图4和图9的描述。
参照图1、图3至图6和图14，示出了像素行的数据写入周期WP在第一区域AR1中进行并且像素行的偏置刷新周期BP在第二区域AR2中进行的情况的时序图。在图14中，第三起始线FLM3和第五起始线FLM5可以维持在截止电平(例如，逻辑低电平)的电压以将第二区域AR2的第一扫描线GI3以及第二扫描线GC5和GC6维持为截止电平的电压。
参照图1、图13和图14，当第一区域AR1和第二区域AR2以不同的图像频率显示图像时，第二起始信号的循环周期(cycle)和第三起始信号的循环周期可以彼此不同。例如，如在图13和图14的情况下，当在第一显示模式下驱动第一区域AR1并且在第二显示模式下驱动第二区域AR2时，第二起始信号的循环周期可以短于第三起始信号的循环周期。例如，当在第二显示模式下驱动第一区域AR1并且在第一显示模式下驱动第二区域AR2时，第二起始信号的循环周期可以长于第三起始信号的循环周期。
另外，当第一区域AR1和第二区域AR2以不同的图像频率显示图像时，第四起始信号的循环周期和第五起始信号的循环周期可以彼此不同。例如，如在图13和图14的情况下，当在第一显示模式下驱动第一区域AR1并且在第二显示模式下驱动第二区域AR2时，第四起始信号的循环周期短于第五起始信号的循环周期。例如，当在第二显示模式下驱动第一区域AR1并且在第一显示模式下驱动第二区域AR2时，第四起始信号的循环周期可以长于第五起始信号的循环周期。
此外，第一区域AR1和第二区域AR2可以以相同的图像频率显示图像。此时，第二起始信号的循环周期和第三起始信号的循环周期可以彼此相同。另外，第四起始信号的循环周期和第五起始信号的循环周期可以彼此相同。
图15是示出根据另一实施例的显示装置的示意图。
参照图15，显示装置9’与显示装置9(见图1)的不同之处在于，显示装置9’还包括发射驱动器40’、第一扫描驱动器31’、第二扫描驱动器32’和第三扫描驱动器33’。
为了降低RC延迟或为了在像素单元50中存在缺口或孔时向断开的信号线供应附加信号，可以另外设置发射驱动器40’、第一扫描驱动器31’、第二扫描驱动器32’和第三扫描驱动器33’。
图16是示出根据另一实施例的像素单元的示意图。
参照图16，像素单元50’与图1的像素单元50的不同之处在于，像素单元50’包括三个或更多个区域AR1、AR2和AR3。
这样的配置可以通过在如图15中所示的第一扫描驱动器31和第二扫描驱动器32的每一者中设置附加的起始线来实现。可以在第一显示模式和第二显示模式等下自由驱动三个或更多个区域AR1、AR2和AR3中的每一个。
尽管本文中已经描述了某些实施例和实施方式，但是其他实施例和修改将从该描述中变得显而易见。因此，本发明构思不限于这样的实施例，而是限于所附权利要求的更宽范围以及对本领域普通技术人员显而易见的各种明显修改和等效布置。

Claims (10)

1.一种显示装置，其中，所述显示装置包括：
像素单元，包括设置在第一区域中的多个第一像素和设置在第二区域中的多个第二像素；
发射驱动器，配置为基于第一起始信号、第一时钟信号和第二时钟信号将截止电平的多个发射信号顺序地供应给所述多个第一像素和所述多个第二像素；以及
第一扫描驱动器，配置为基于第二起始信号、所述第一时钟信号和所述第二时钟信号将导通电平的多个第一扫描信号顺序地供应给所述多个第一像素，并且基于第三起始信号、所述第一时钟信号和所述第二时钟信号将所述导通电平的所述多个第一扫描信号顺序地供应给所述多个第二像素。
2.根据权利要求1所述的显示装置，其中，所述显示装置还包括：
第二扫描驱动器，配置为基于第四起始信号、第三时钟信号和第四时钟信号将导通电平的多个第二扫描信号顺序地供应给所述多个第一像素，并且基于第五起始信号、所述第三时钟信号和所述第四时钟信号将所述导通电平的所述多个第二扫描信号顺序地供应给所述多个第二像素。
3.根据权利要求2所述的显示装置，其中，所述显示装置还包括：
第三扫描驱动器，配置为基于第六起始信号、第五时钟信号和第六时钟信号将导通电平的多个第三扫描信号顺序地供应给所述多个第一像素和所述多个第二像素。
4.根据权利要求3所述的显示装置，其中，所述第一像素和所述第二像素中的每一个包括：
第一晶体管，具有连接到第一节点的栅极电极、连接到第二节点的第一电极和连接到第三节点的第二电极；
第二晶体管，具有用于接收所述多个第三扫描信号中的一个的栅极电极、连接到数据线的第一电极和连接到所述第二节点的第二电极；
第三晶体管，具有用于接收所述多个第二扫描信号中的一个的栅极电极、连接到所述第一节点的第一电极和连接到所述第三节点的第二电极；
第四晶体管，具有用于接收所述多个第一扫描信号中的一个的栅极电极、连接到所述第一节点的第一电极和连接到第一初始化线的第二电极；以及
第五晶体管，具有用于接收所述多个发射信号中的一个的栅极电极、连接到第一电源线的第一电极和连接到所述第二节点的第二电极。
5.根据权利要求4所述的显示装置，其中，所述第一像素和所述第二像素中的每一个还包括：
第六晶体管，具有用于接收所述多个发射信号中的一个的栅极电极、连接到所述第三节点的第一电极、和第二电极；
第七晶体管，具有用于接收所述多个第三扫描信号中的一个的栅极电极、连接到第二初始化线的第一电极、和第二电极；
发光元件，具有连接到所述第六晶体管的所述第二电极和所述第七晶体管的所述第二电极的第一电极和连接到第二电源线的第二电极；以及
电容器，具有连接到所述第一电源线的第一电极和连接到所述第一节点的第二电极。
6.根据权利要求5所述的显示装置，其中：
所述第一晶体管、所述第二晶体管、所述第五晶体管、所述第六晶体管和所述第七晶体管是P型晶体管，并且
所述第三晶体管和所述第四晶体管是N型晶体管。
7.根据权利要求3所述的显示装置，其中：
所述发射驱动器包括多个发射级，
所述多个发射级中的每一个连接到N个像素行，其中，N是大于3的整数，
所述第一扫描驱动器包括多个第一扫描级，
所述多个第一扫描级中的每一个连接到所述N个像素行，
所述第二扫描驱动器包括多个第二扫描级，
所述多个第二扫描级中的每一个连接到M个像素行，其中，M是大于1且小于N的整数，
所述第三扫描驱动器包括起始级和多个第三扫描级，
所述多个第三扫描级中的每一个连接到所述M个像素行，并且
所述多个第三扫描级的数量大于所述多个第二扫描级的数量。
8.根据权利要求1所述的显示装置，其中，当所述第一区域和所述第二区域以相同的图像频率显示图像时，所述第二起始信号的循环周期和所述第三起始信号的循环周期彼此相同，并且
其中，当所述第一区域和所述第二区域以不同的图像频率显示图像时，所述第二起始信号的所述循环周期和所述第三起始信号的所述循环周期彼此不同。
9.根据权利要求2所述的显示装置，其中，当所述第一区域和所述第二区域以相同的图像频率显示图像时，所述第四起始信号的循环周期和所述第五起始信号的循环周期彼此相同，
其中，当所述第一区域和所述第二区域以不同的图像频率显示图像时，所述第四起始信号的所述循环周期和所述第五起始信号的所述循环周期彼此不同。
10.一种显示装置，其中，所述显示装置包括：
像素单元，包括多个像素行；
发射驱动器，包括多个发射级，每个所述发射级连接到N个像素行，其中，N是大于3的整数；
第一扫描驱动器，包括多个第一扫描级，每个所述第一扫描级连接到所述N个像素行；
第二扫描驱动器，包括多个第二扫描级，每个所述第二扫描级连接到M个像素行，其中，M是大于1且小于N的整数；以及
第三扫描驱动器，包括起始级和多个第三扫描级，每个所述第三扫描级连接到所述M个像素行。
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