CN115347001A - 阵列基板及显示面板 - Google Patents

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CN115347001A
CN115347001A CN202210927862.3A CN202210927862A CN115347001A CN 115347001 A CN115347001 A CN 115347001A CN 202210927862 A CN202210927862 A CN 202210927862A CN 115347001 A CN115347001 A CN 115347001A
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electrically connected
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阳志林
戴超
张淑媛
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Wuhan China Star Optoelectronics Semiconductor Display Technology Co Ltd
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Wuhan China Star Optoelectronics Semiconductor Display Technology Co Ltd
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    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/124Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition, shape or layout of the wiring layers specially adapted to the circuit arrangement, e.g. scanning lines in LCD pixel circuits

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Abstract

本申请公开一种阵列基板及显示面板。所述阵列基板包括基板、有源层、第一金属层以及第二金属层。其中,所述有源层设置在所述基板上;所述第一金属层设置在所述有源层远离所述基板的一侧,所述第一金属层包括扫描线;所述第二金属层设置在所述第一金属层远离所述基板的一侧,所述第二金属层包括源极、漏极以及辅助扫描线,所述源极和所述漏极分别与所述有源层电连接,所述辅助扫描线与所述扫描线电连接。本申请能够降低扫描线的阻抗,从而降低阵列基板的负载,同时简化制程工艺。

Description

阵列基板及显示面板
技术领域
本申请涉及显示技术领域,具体涉及一种阵列基板及显示面板。
背景技术
随着显示技术的快速发展和革新,显示面板主流主要分为LCD(Liquid CrystalDisplay,液晶显示)和AMOLED(Active-Matrix Organic Light-Emitting Diode,有源矩阵有机发光二极管)。其中AMOLED因具有高对比度、高亮度、轻薄、可弯折等优势,越来越受到显示终端市场以及面板行业的青睐。
但是,AMOLED的阵列基板像素电路及阵列复杂程度较高,采用AMOLED的移动终端显示器需要不断优化降功耗的方案。随着AMOLED显示屏逐渐应用于高分辨率的平板电脑和笔记本等领域,进一步降低阵列基板发的负载技术意义重大。
发明内容
本申请提供一种阵列基板及显示面板,以降低阵列基板的负载。
本申请提供一种阵列基板,其包括:
基板;
有源层,设置在所述基板上;
第一金属层,设置在所述有源层远离所述基板的一侧,所述第一金属层包括扫描线;
第二金属层,设置在所述第一金属层远离所述基板的一侧,所述第二金属层包括源极、漏极以及辅助扫描线,所述源极和所述漏极分别与所述有源层电连接,所述辅助扫描线与所述扫描线电连接。
可选的,在本申请一些实施例中,所述辅助扫描线的电阻率小于所述扫描线的电阻率,所述辅助扫描线的宽度大于所述扫描线的宽度。
可选的,在本申请一些实施例中,所述阵列基板还包括第三金属层,所述第三金属层设置在所述有源层靠近所述基板的一侧,所述第三金属层包括遮光件,所述遮光件在所述基板上的正投影至少覆盖所述有源层在所述基板上的正投影,所述遮光件与所述扫描线电连接,并接入同一电信号。
可选的,在本申请一些实施例中,所述第三金属层包括多个所述遮光件,每一所述遮光件均包括第一遮光部和第二遮光部,所述第一遮光部在所述基板上的正投影至少覆盖所述有源层在所述基板上的正投影,所述第二遮光部与所述扫描线电连接在一起;相邻两个所述第一遮光部通过所述第二遮光部电连接。
可选的,在本申请一些实施例中,所述第一遮光部的线宽大于所述有源层的线宽,所述第二遮光部的线宽大于或等于所述辅助扫描线的线宽。
可选的,在本申请一些实施例中,所述阵列基板还包括第三金属层,所述第三金属层设置在所述有源层靠近所述基板的一侧,所述第三金属层包括遮光件,所述遮光件包括第一遮光部和第二遮光部,所述第一遮光部在所述基板上的正投影至少覆盖所述有源层在所述基板上的正投影,所述第二遮光部与所述第一遮光部间隔且绝缘设置,所述第二遮光部与所述扫描线电连接。
可选的,在本申请一些实施例中,所述第一金属层还包括多个间隔且绝缘设置的栅极,所述第二金属层还包括多个栅极扫描线;
其中,每一所述栅极与相应的所述栅极扫描线电连接,且相邻两个所述栅极之间通过相应的所述栅极扫描线电连接,所述栅极扫描线与所述辅助扫描线电连接。
可选的,在本申请一些实施例中,所述第一金属层的材料为钼或钼钛合金,所述第二金属层的材料为铜、铜/铜、钼/铜或钼钛合金/铜。
可选的,在本申请一些实施例中,所述阵列基板还包括第四金属层,所述第四金属层设置在所述第二金属层远离所述基板的一侧,所述第四金属层包括数据线,所述数据线与所述源极电连接。
可选的,在本申请一些实施例中,所述阵列基板还包括第一绝缘层、第二绝缘层、第五金属层以及层间绝缘层;
其中,所述第一绝缘层设置在所述第一金属层靠近所述有源层的一侧,所述第二绝缘层设置在所述第一金属层靠近所述第二金属层的一侧,所述第五金属层设置在所述第二绝缘层靠近所述第二金属层的一侧,所述层间绝缘层设置在所述第五金属层靠近所述第二金属层的一侧;所述第一金属层还包括第一电极板,所述第五金属层包括第二电极板,所述第二金属层还包括第三电极板;所述第一电极板和所述第二电极板构成第一电容,所述第二电极板和所述第三电极板构成第二电容。
可选的,在本申请一些实施例中,所述阵列基板还包括钝化层、第一平坦层以及第二平坦层,所述钝化层设置在所述第二金属层靠近所述第四金属层的一侧,所述第一平坦层设置在所述钝化层靠近所述第四金属层的一侧,所述第二平坦层设置在所述第四金属层远离所述基板的一侧;
其中,所述钝化层具有第一过孔,所述第一过孔贯穿所述钝化层,所述第一平坦层填充所述第一过孔。
可选的,在本申请一些实施例中,所述层间绝缘层具有第二过孔,所述第二过孔贯穿所述层间绝缘层,并延伸至所述第一绝缘层,所述第一绝缘层具有第三过孔,所述第三过孔至少贯穿所述第一绝缘层;
其中,所述第一过孔、所述第二过孔以及所述第三过孔均连通,且所述第二过孔的孔径大于所述第三过孔的孔径。
相应的,本申请还提供一种显示面板,其包括上述任一项所述的阵列基板。
本申请提供一种阵列基板及显示面板。所述阵列基板包括基板、有源层、第一金属层以及第二金属层。其中,所述有源层设置在所述基板上;所述第一金属层设置在所述有源层远离所述基板的一侧,所述第一金属层包括栅极和扫描线;所述第二金属层设置在所述第一金属层远离所述基板的一侧,所述第二金属层包括源极、漏极以及辅助扫描线,所述源极以及所述漏极分别与所述有源层电连接,所述辅助扫描线与所述扫描线电连接。本申请通过设置辅助扫描线与扫描线电连接,可以降低扫描线的阻抗,从而降低阵列基板的负载。此外,由于辅助扫描线、源极以及漏极由同一层金属图案化形成,可以简化制程工艺。
附图说明
为了更清楚地说明本申请实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本申请的一些实施例,对于本领域技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获取其他的附图。
图1是本申请提供的阵列基板的第一结构示意图;
图2是本申请提供的阵列基板的第二结构示意图;
图3是本申请提供的阵列基板的第一俯视示意图;
图4是本申请提供的阵列基板的第三结构示意图;
图5是本申请提供的阵列基板的第二俯视示意图;
图6A-6K是在本申请提供的阵列基板的一种制作方法中各步骤获得的结构示意图;
图7是本申请提供的显示面板的一种结构示意图。
具体实施方式
下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚、完整地描述,显然,所描述的实施例仅仅是本申请一部分实施例,而不是全部的实施例。基于本申请中的实施例,本领域技术人员在没有作出创造性劳动前提下所获取的所有其他实施例,都属于本申请保护的范围。
在本申请的描述中,需要理解的是,术语“第一”和“第二”仅用于描述目的,而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此,限定有“第一”和“第二”等的特征可以明示或者隐含地包括一个或者更多个所述特征,因此不能理解为对本申请的限制。此外,需要说明的是,除非另有明确的规定和限定,术语“相连”、“连接”应做广义理解,例如,可以是机械连接,也可以是电连接;可以是直接相连,也可以通过中间媒介间接相连,可以是两个元件内部的连通。对于本领域的普通技术人员而言,可以具体情况理解上述术语在本发明中的具体含义。
本申请提供一种阵列基板及显示面板,以下进行详细说明。需要说明的是,以下实施例的描述顺序不作为对本申请实施例优选顺序的限定。
请参阅图1,图1是本申请提供的阵列基板的第一结构示意图。在本申请实施例中,阵列基板100包括基板10、有源层16、第一金属层18以及第二金属层21。
其中,有源层16设置在基板10上。第一金属层18设置在有源层16远离基板10的一侧。第一金属层18包括扫描线182。第二金属层21设置在第一金属层18远离基板10的一侧。第二金属层21包括源极211、漏极212以及辅助扫描线213。源极211和漏极212分别与有源层16电连接。辅助扫描线213与扫描线182电连接。
本申请实施例通过在阵列基板100中设置辅助扫描线213,并将辅助扫描线213与扫描线182电连接,相当于将辅助扫描线213与扫描线213并联,因此可以降低扫描线182的阻抗,从而降低阵列基板100的负载,获得高品质显示产品。此外,由于辅助扫描线213、源极211以及漏极212由同一层金属图案化形成,可以简化制程工艺。
在本申请实施例中,第一金属层18还包括栅极181。栅极181与扫描线182电连接。
在本申请实施例中,辅助扫描线213的电阻率小于扫描线182的电阻率,辅助扫描线213的宽度大于扫描线182的宽度。
其中,第一金属层18的材料为钼、钼钛合金等具有线宽偏差小的金属。从而能够采用干法蚀刻得到具有较小线宽的栅极181和扫描线182,进而实现较高的PPI(Pixels PerInch,像素的密度单位)性能。同时可实现栅极181的线宽均一性,实现稳定的晶体管电学特性。
其中,第二金属层21的电阻率小于第一金属层18的电阻率。比如,第二金属层21可以是单层金属铜、双层金属、底层钼上层铜、底层钼钛合金上层铜等结构。由于第二金属层21的电阻率小于第一金属层18的电阻率,可以进一步降低扫描线182的阻抗,降低阵列基板100的负载。
在本申请实施例中,有源层16的材料可以是金属氧化物半导体,也可以是低温多晶硅。当然,在本申请一些实施例中,也可以采用LTPO(Low TemperaturePolycrystalline-Si Oxide,低温多晶氧化物)技术,本申请对此不作具体限定。
在本申请实施例中,基板10可以包括但不限于从下至上依次叠层设置的衬底11、双层PI(Polyimide,聚酰亚胺)层12以及阻隔层13。其中,衬底11可以是玻璃基板。阻隔层13的材料可以是氧化硅、氮化硅等。阻隔层13可以起到阻水隔氧的作用。
在本申请实施例中,第二金属层21还可以包括栅极扫描线214。栅极扫描线214与栅极181电连接。由于第二金属层21的电阻率较小,可以减小栅极181的阻抗。
在本申请实施例中,阵列基板100还可以包括第一绝缘层17和层间绝缘层20。第一绝缘层17设置在第一金属层18靠近有源层16的一侧。第一绝缘层17包括栅绝缘层171。栅绝缘层171设置在栅极181和有源层16之间。层间绝缘层20设置在第一金属层18靠近第二金属层21的一侧。
其中,层间绝缘层20具有第一接触孔20a、第二接触孔20b以及第三接触孔20c。第一接触孔20a和第二接触孔20b均贯穿层间绝缘层20,并延伸至有源层16。第一接触孔20a和第二接触孔20b均暴露出有源层16远离基板10的一侧表面。源极211通过第一接触孔20a与有源层16电连接。漏极212通过第二接触孔20b与有源层16电连接。第三接触孔20c贯穿层间绝缘层20,并延伸至扫描线182。第三接触孔20c暴露出扫描线182远离基板10的一侧表面。辅助扫描线213通过第三接触孔20c与扫描线182电连接。
其中,层间绝缘层20还具有第四接触孔20d。第四接触孔20d贯穿层间绝缘层20,并延伸至栅极181。第四接触孔20d暴露出栅极181远离基板10的一侧表面。栅极扫描线214通过第四接触孔20d与栅极181电连接。
其中,第一金属层18还包括第一电极板183。第二金属层21还包括第三电极板215。在垂直于基板100的方向上,第一电极板183和第三电极板215至少部分重叠设置。第一电极板183和第三电极板215可以构成存储电容。
当然,在本申请一些实施例中,源极211以及漏极212也可以分别与有源层16接触电连接,此时可以不设置层间绝缘层20。
进一步的,在本申请一些实施例中,阵列基板100还可以包括第二绝缘层19和第五金属层30。
其中,第二绝缘层19设置在第一金属层18靠近第二金属层21的一侧。第五金属层30设置在第二绝缘层19靠近第二金属层21的一侧。层间绝缘层20设置在第五金属层30靠近第二金属层21的一侧。第五金属层30包括第二电极板31。第一电极板183和第二电极板31板构成第一电容。第二电极板31和第三电极板215构成第二电容。由此,简化阵列基板100内的电容结构。
在本申请实施例中,阵列基板100还可以包括第四金属层24。第四金属层24设置在第二金属层21远离基板10的一侧。第四金属层24包括数据线(图中未示出)。
可以理解的是,辅助扫描线213与数据线在面内交叉排布,由于辅助扫描线213、源极211以及漏极212同层设置,将数据线设置在第四金属层24中,使得数据线与辅助扫描线213异层设置,可以避免数据线与辅助扫描线213交叉短接。
其中,第四金属层24还包括第一电极241和第二电极242。数据线通过第一电极241与源极211电连接。第二电极242与漏极212电连接。当然,在一些实施例中,也可以认为第一电极241为数据线。
其中,第四金属层24可以是单层金属铜、双层金属、底层钼上层铜、底层钼钛合金上层铜等结构。第四金属层24的材料可以与第二金属层21的材料相同,也可以不相同。
本申请实施例设置第一电极241与源极211电连接,以及第二电极242与漏极212电连接,可以进一步降低源极211和漏极212的阻抗,降低阵列基板100的负载。
此外,由于第二金属层21和第四金属层24的线阻抗低,在垂直于基板10的方向上,基于同样的厚度,可以将第二金属层21和第四金属层24的线宽做细约20%,进一步实现较高的PPI性能。
在本申请实施例中,阵列基板100还可以包括钝化层22、第一平坦层23以及第二平坦层25。钝化层22设置在第二金属层21靠近第四金属层24的一侧。第一平坦层23设置在钝化层22靠近第四金属层24的一侧第二平坦层25设置在第四金属层24远离基板10的一侧。
其中,第一平坦层23具有第一电连接孔23a和第二电连接孔23b。第一电连接孔23a贯穿第一平坦层23,并延伸至源极211。第一电连接孔23a暴露出源极211远离基板10的一侧表面。第一电极241通过第一电连接孔23a与源极211电连接。第二电连接孔23b贯穿第一平坦层23,并延伸至漏极212。第二电连接孔23b暴露出漏极212远离基板10的一侧表面。第二电极242通过第二电连接孔23b与漏极212电连接。
在本申请一些实施例中,钝化层22具有第一过孔22a。第一过孔22a贯穿钝化层22。第一平坦层23填充第一过孔22a。
其中,第一平坦层23和第二平坦层25的材料为有机材料,以提高阵列基板100的柔韧性。比如,有机材料可以是正型的有机光阻(主体是PI的成分)。
由于第一平坦层23的材料为有机材料,在钝化层22中设置第一过孔22a,并填充第一平坦层23,可以进一步提高阵列基板100的抗弯折性。
进一步的,在本申请一些实施例中,层间绝缘层20具有第二过孔20e。第二过孔20e贯穿层间绝缘层20,并延伸至第一绝缘层17。第一绝缘层17具有第三过孔17a。第三过孔17a至少贯穿第一绝缘层17。其中,第一过孔22a、第二过孔20e以及第三过孔17a均连通。且第二过孔20e的孔径大于第三过孔17a的孔径。
其中,第三过孔17a可以贯穿第一绝缘层17,并延伸至双层PI层12远离衬底11的一侧。第一平坦层23填充在第一过孔22a、第二过孔20e以及第三过孔17a中,可以进一步提高阵列基板100的抗弯折性。
进一步的,第四金属层24还包括至少一信号走线243。信号走线243对应第一过孔22a设置。信号走线243是阵列基板100中实现显示区域外围Fan-out(扇形走线区)处的信号线的桥接。
在本申请实施例中,阵列基板100还可以包括第三金属层14。第三金属层14设置在有源层16靠近基板10的一侧。第三金属层14包括遮光件141。遮光件141在基板10上的正投影至少覆盖有源层16在基板10上的正投影。
其中,第三金属层14的材料为导电性优、遮光性好的金属,一般为钼、铜、铝、钛或复合金属,本申请对此不作限定。此外,阵列基板100还包括缓冲层15。缓冲层15设置在第三金属层14和有源层16之间,起到绝缘保护的作用。
可以理解的是,有源层16在受到来自基板10一侧的光照射后会使得光生载流子增加,造成薄膜晶体管产生阈值电压漂移、漏电流增加等不良现象。遮光件141可以遮挡从基板10远离遮光件141的方向射入的光线,进而减弱外部光线对有源层16产生的干扰,从而提高阵列基板100的工作性能。
在本申请实施例中,阵列基板100还可以包括第六金属层26、像素定义层27以及间隔物28。第六金属层26包括阳极261。阳极261与漏极212电连接。像素定义层27具有开口27a。开口27a暴露出阳极261远离基板10的一侧表面。开口27a内可以设置发光层等功能膜层,在此不再赘述。
请参阅图2,图2是本申请提供的阵列基板的第二结构示意图。与图1所示的阵列基板100的不同之处在于,在本申请实施例中,遮光件141与扫描线182电连接。
具体的,第一绝缘层17具有第四过孔17b。遮光件141通过第四过孔17b与扫描线182电连接。由此,遮光件141、扫描线182以及辅助扫描线213均电连接在一起,进一步降低了扫描线182的电阻率,降低了阵列基板100的负载。
在本申请一些实施例中,阵列基板100中的晶体管为顶底双栅结构。其中,晶体管包括有源层16、栅极181、源极211、漏极212以及遮光件141(作为底栅)。遮光件141与栅极181通过扫描线182和辅助扫描线213接入同一电信号。
具体的,请参阅图2和图3。图3是本申请提供的阵列基板的第一俯视示意图。第三金属层14包括多个遮光件141。每一遮光件141均包括第一遮光部1411和第二遮光部1412。第一遮光部1411在基板10上的正投影至少覆盖有源层16在基板10上的正投影。第二遮光部1412与扫描线182电连接在一起。相邻两个第一遮光部1411通过第二遮光部1412电连接。也即,在阵列基板100的显示区域中,多个遮光件141是连续的结构。
其中,第二金属层21包括多个间隔设置的栅极扫描线214。第一金属层18包括多个间隔且绝缘设置的栅极181。每一栅极一端与相应的一条栅极扫描线214电连接。每一栅极另一端也与相应的一条栅极扫描线214电连接。
本申请实施例在有源层16的上下两侧分别设置栅极181(顶栅极)和遮光件141(底栅极),通过双栅极驱动有源层16,更容易控制阈值电压;同时,还可以大幅提升载流子迁移率。
在本申请一些实施例中,第一遮光部1411的线宽大于有源层16的线宽,第二遮光部1412的线宽大于或等于辅助扫描线213的线宽。
通过设置第一遮光部1411的线宽大于有源层16的线宽,可以减弱外部光线对有源层16产生的干扰。通过设置第二遮光部1412的线宽大于或等于辅助扫描线213的线宽,这样可以实现减少辅助扫描线213同层的耦合电容。同时也可以减少辅助扫描线213与其它层金属之间交叠产生的寄生电容。
需要说明的是,辅助扫描线213与栅极扫描线214属于第二金属层21,辅助扫描线213与栅极扫描线214可以相同。
在本申请一些实施例中,阵列基板100中的晶体管为顶栅结构。
具体的,请参阅图4和图5,图4是本申请提供的阵列基板的第三结构示意图;图5是本申请提供的阵列基板的第二俯视示意图。与图2所示的阵列基板100的不同之处在于,在本申请实施例中,遮光件141包括第一遮光部1411和第二遮光部1412。第一遮光部1411在基板10上的正投影至少覆盖有源层16在基板10上的正投影。第二遮光部1412与第一遮光部1411间隔且绝缘设置。第二遮光部1412与扫描线182电连接。
其中,第二金属层21还包括多个间隔设置的栅极扫描线214。第一金属层18包括多个间隔且绝缘设置的栅极181。每一栅极181通过第四接触孔20d与相应的栅极扫描线214电连接,且相邻两个栅极181之间通过相应的栅极扫描线214电连接。
请同时参阅图2、图6A-图6K,图6A-6K是在本申请提供的阵列基板的一种制作方法中各步骤获得的结构示意图。本申请以图2所示的阵列基板100为例进行说明,但不能理解为对本申请的限定。本申请实施例提供的阵列基板100的制作方法具体包括以下步骤:
101、提供基板10。
其中,基板10可以包括但不限于从下至上依次叠层设置的衬底11、双层PI(Polyimide,聚酰亚胺)层12以及阻隔层13。其中,衬底11可以是玻璃基板。
102、在完成基板10上的第三金属层14、有源层16的图案化后,第三金属层14包括遮光件141。然后,在有源层16远离基板10的一侧形成第一绝缘层17,并在第一绝缘层17远离基板10的一侧涂布第一光刻胶41,如图6A所示。
103、依次对第一绝缘层17进行成膜、曝光以及干法蚀刻,在第一绝缘层17中形成第四过孔17b。如图6B所示。
104、完成第一金属层18成膜、在第一金属层18上涂布第二光刻胶42,如图6C所示。
然后,对第一金属层18进行图形化处理,形成栅极181、扫描线182以及第一电极板183,如图6D所示。
随后,完成第二绝缘层19成膜以及第五金属层30成膜。对第五金属层30图形化处理,形成包括第二电极板31。在第五金属层30上形成层间绝缘层20,如图6E所示。
105、在层间绝缘层20成膜后,在层间绝缘层20涂布第三光刻胶43,如图6F所示。
然后进行曝光以及干法蚀刻,在层间绝缘层20中形成第一接触孔20a、第二接触孔20b、第三接触孔20c以及第四接触孔20d。第一接触孔20a和第二接触孔20b均贯穿层间绝缘层20,并延伸至有源层16。第一接触孔20a和第二接触孔20b均暴露出有源层16远离基板10的一侧表面。第三接触孔20c暴露出扫描线182远离基板10的一侧表面。第四接触孔20d暴露出栅极181远离基板10的一侧表面。如图6G所示。
随后,形成具有低电阻率的第二金属层21,如图6H所示。第二金属层21上涂布第四光刻胶44,如图6I所示。经过曝光和蚀刻完成图形化,形成源极211、漏极212以及辅助扫描线213、栅极扫描线214以及第三电极板215。源极211通过第一接触孔20a与有源层16电连接。漏极212通过第二接触孔20b与有源层16电连接。辅助扫描线213通过第三接触孔20c与扫描线182电连接。栅极181通过第四接触孔20d与栅极扫描线214电连接。第一电极板183和第二电极板31板构成第一电容。第二电极板31和第三电极板215构成第二电容。如图6J所示。
106、依次在完成钝化层22成膜、第一平坦层23成膜以及第四金属层24成膜。对第四金属层24进行图形化处理,形成第一电极241、第二电极242以及至少一信号走线243。第一电极241与源极211电连接。第二电极242与漏极212电连接。
然后完成第二平坦层25成膜和第六金属层26成膜。对第六金属层26进行图形化处理,形成阳极261。最后再进行像素定义层27和间隔物28的图形化处理,完成整个阵列基板100的工艺。
需要说明的是,图6A-6J中未示出深孔的具体形成过程。在本申请一实施例中。深孔通过三次刻蚀形成。具体的,如图6K钝化层22具有第一过孔22a。第一过孔22a贯穿钝化层22。层间绝缘层20具有第二过孔20e。第二过孔20e贯穿层间绝缘层20,并延伸至第一绝缘层17。第一绝缘层17具有第三过孔17a。第三过孔17a至少贯穿第一绝缘层17。其中,第一过孔22a、第二过孔20e以及第三过孔17a均连通,形成深孔。且第二过孔20e的孔径大于第三过孔17a的孔径。其中,第一过孔22a、第二过孔20e以及第三过孔17a经过的三次刻蚀可以与上述步骤中各孔的刻蚀步骤一起,从而简化制成工艺。
其中,第一平坦层23填充在第一过孔22a、第二过孔20e以及第三过孔17a中,可以进一步提高阵列基板100的抗弯折性。
此外,阵列基板100中各膜层的材料以及功能可参阅上述实施例,在阵列基板100的制作方法中不再赘述。
相应的,本申请还提供一种显示面板,其包括上述任一实施例所述的阵列基板100。具体可参阅以上内容,在此不再赘述。此外,本申请提供的显示面板可以是有机发光二极管显示面板、主动矩阵有机发光二极管显示面板、被动矩阵有机发光二极管显示面板、量子点有机发光二极管显示面板或者微发光二极管显示面板,本申请对此不作具体限定。
在本申请一实施例中,请参阅图7,图7是本申请提供的显示面板的一种结构示意图。本申请实施例提供的显示面板1000还包括GOA电路300和其他功能部件。此外,本申请实施例中的GOA电路300和其他功能部件是本领域技术人员所熟知的相关技术,在此不再赘述。
本申请提供的显示面板1000包括阵列基板100,阵列基板包括基板、有源层、第一金属层以及第二金属层。其中,有源层设置在基板上;第一金属层设置在有源层远离所述基板的一侧,第一金属层包括栅极和扫描线;第二金属层设置在第一金属层远离所述基板的一侧;第二金属层包括源极、漏极以及辅助扫描线;源极以及漏极分别与有源层电连接,辅助扫描线与扫描线电连接。本申请实施例通过设置辅助扫描线与扫描线电连接,可以降低扫描线的阻抗,从而降低阵列基板的负载,提高显示面板1000的品质。此外,由于辅助扫描线、源极以及漏极由同一层金属图案化形成,可以简化制程工艺。
以上对本申请实施例提供的阵列基板及显示面板进行了详细介绍,本文中应用了具体个例对本申请的原理及实施方式进行了阐述,以上实施例的说明只是用于帮助理解本申请的方法及其核心思想;同时,对于本领域的一般技术人员,依据本申请的思想,在具体实施方式及应用范围上均会有改变之处,综上所述,本说明书内容不应理解为对本申请的限制。

Claims (13)

1.一种阵列基板,其特征在于,包括:
基板;
有源层,设置在所述基板上;
第一金属层,设置在所述有源层远离所述基板的一侧,所述第一金属层包括扫描线;以及
第二金属层,设置在所述第一金属层远离所述基板的一侧,所述第二金属层包括源极、漏极以及辅助扫描线,所述源极和所述漏极分别与所述有源层电连接,所述辅助扫描线与所述扫描线电连接。
2.根据权利要求1所述的阵列基板,其特征在于,所述辅助扫描线的电阻率小于所述扫描线的电阻率,所述辅助扫描线的宽度大于所述扫描线的宽度。
3.根据权利要求1所述的阵列基板,其特征在于,所述阵列基板还包括第三金属层,所述第三金属层设置在所述有源层靠近所述基板的一侧,所述第三金属层包括遮光件,所述遮光件在所述基板上的正投影至少覆盖所述有源层在所述基板上的正投影,所述遮光件与所述扫描线电连接,并接入同一电信号。
4.根据权利要求3所述的阵列基板,其特征在于,所述第三金属层包括多个所述遮光件,每一所述遮光件均包括第一遮光部和第二遮光部,所述第一遮光部在所述基板上的正投影至少覆盖所述有源层在所述基板上的正投影,所述第二遮光部与所述扫描线电连接在一起;相邻两个所述第一遮光部通过所述第二遮光部电连接。
5.根据权利要求4所述的阵列基板,其特征在于,所述第一遮光部的线宽大于所述有源层的线宽,所述第二遮光部的线宽大于或等于所述辅助扫描线的线宽。
6.根据权利要求1所述的阵列基板,其特征在于,所述阵列基板还包括第三金属层,所述第三金属层设置在所述有源层靠近所述基板的一侧,所述第三金属层包括遮光件,所述遮光件包括第一遮光部和第二遮光部,所述第一遮光部在所述基板上的正投影至少覆盖所述有源层在所述基板上的正投影,所述第二遮光部与所述第一遮光部间隔且绝缘设置,所述第二遮光部与所述扫描线电连接。
7.根据权利要求3-6任一项所述的阵列基板,其特征在于,所述第一金属层还包括多个间隔且绝缘设置的栅极,所述第二金属层还包括多个栅极扫描线;
其中,每一所述栅极与相应的所述栅极扫描线电连接,且相邻两个所述栅极之间通过相应的所述栅极扫描线电连接,所述栅极扫描线与所述辅助扫描线电连接。
8.根据权利要求1所述的阵列基板,其特征在于,所述第一金属层的材料为钼或钼钛合金,所述第二金属层的材料为铜、铜/铜、钼/铜或钼钛合金/铜。
9.根据权利要求1所述的阵列基板,其特征在于,所述阵列基板还包括第四金属层,所述第四金属层设置在所述第二金属层远离所述基板的一侧,所述第四金属层包括数据线,所述数据线与所述源极电连接。
10.根据权利要求9所述的阵列基板,其特征在于,所述阵列基板还包括第一绝缘层、第二绝缘层、第五金属层以及层间绝缘层;
其中,所述第一绝缘层设置在所述第一金属层靠近所述有源层的一侧,所述第二绝缘层设置在所述第一金属层靠近所述第二金属层的一侧,所述第五金属层设置在所述第二绝缘层靠近所述第二金属层的一侧,所述层间绝缘层设置在所述第五金属层靠近所述第二金属层的一侧;所述第一金属层还包括第一电极板,所述第五金属层包括第二电极板,所述第二金属层还包括第三电极板;所述第一电极板和所述第二电极板构成第一电容,所述第二电极板和所述第三电极板构成第二电容。
11.根据权利要求10所述的阵列基板,其特征在于,所述阵列基板还包括钝化层、第一平坦层以及第二平坦层,所述钝化层设置在所述第二金属层靠近所述第四金属层的一侧,所述第一平坦层设置在所述钝化层靠近所述第四金属层的一侧,所述第二平坦层设置在所述第四金属层远离所述基板的一侧;
其中,所述钝化层具有第一过孔,所述第一过孔贯穿所述钝化层,所述第一平坦层填充所述第一过孔。
12.根据权利要求11所述的阵列基板,其特征在于,所述层间绝缘层具有第二过孔,所述第二过孔贯穿所述层间绝缘层,并延伸至所述第一绝缘层,所述第一绝缘层具有第三过孔,所述第三过孔至少贯穿所述第一绝缘层;
其中,所述第一过孔、所述第二过孔以及所述第三过孔均连通,且所述第二过孔的孔径大于所述第三过孔的孔径。
13.一种显示面板,其特征在于,包括如权利要求1-12任一项所述的阵列基板。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN117080222A (zh) * 2023-07-28 2023-11-17 惠科股份有限公司 阵列基板及其制备方法、显示装置
WO2024027397A1 (zh) * 2022-08-03 2024-02-08 武汉华星光电半导体显示技术有限公司 阵列基板及显示面板

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI696026B (zh) * 2019-04-24 2020-06-11 友達光電股份有限公司 畫素陣列基板
CN112419954A (zh) * 2019-08-21 2021-02-26 群创光电股份有限公司 电子装置
CN114512523A (zh) * 2022-02-15 2022-05-17 深圳市华星光电半导体显示技术有限公司 阵列基板及显示面板
CN115347001A (zh) * 2022-08-03 2022-11-15 武汉华星光电半导体显示技术有限公司 阵列基板及显示面板

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2024027397A1 (zh) * 2022-08-03 2024-02-08 武汉华星光电半导体显示技术有限公司 阵列基板及显示面板
CN117080222A (zh) * 2023-07-28 2023-11-17 惠科股份有限公司 阵列基板及其制备方法、显示装置

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