CN115101004A - 一种像素驱动电路及其驱动方法、发光面板、显示装置 - Google Patents

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Abstract

本发明公开了一种像素驱动电路，像素驱动电路包括：复位模块、存储模块、初始化模块、驱动模块、阈值补偿模块和数据写入模块；复位模块的第一端用于输入复位电源输出的信号；复位模块的第二端与驱动模块的控制端连接，用于在上电期间为驱动模块的控制端提供复位电源。在像素驱动电路上电器件，通过复位模块向驱动模块提供复位电源，对驱动模块进行复位控制，避免上电阶段驱动模块异常导通，造成闪屏现象。

Description

一种像素驱动电路及其驱动方法、发光面板、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路及其驱动方法、发光面板、显示装置。
背景技术
随着显示技术的不断发展，显示面板的应用也越来越广泛，例如，显示面板应用于手机、电脑、平板电脑、电子书和信息查询机等产品，此外还可以应用于仪表类显示器(例如车载显示器)和智能家居的控制面板等。
对于微发光二极管显示面板中的微发光二极管属于电流驱动型元件，需要像素驱动电路提供驱动电流，以使微发光二极管发光，但是由于现有的像素驱动电路在整体上电器件，由于像素驱动电路中的晶体管存在漏流现象，像素驱动电路中的驱动晶体管会存在异常导通现象，严重影响显示面板的显示效果。
发明内容
本发明实施例提供了一种像素驱动电路及其驱动方法、发光面板、显示装置，以避免像素驱动电路上电阶段出现闪屏现象，影响显示效果。
第一方面，本发明实施例提供了一种像素驱动电路，其特征在于，包括：复位模块、存储模块、初始化模块、驱动模块、阈值补偿模块和数据写入模块；
所述驱动模块的第一端用于输入第一电源输出的信号，所述驱动模块的第二端用于为发光模块提供发光驱动信号；所述存储模块连接于所述驱动模块的控制端和所述驱动模块的第一端之间；所述阈值补偿模块连接于所述驱动模块的控制端和所述驱动模块的第二端之间；
所述数据写入模块连接所述驱动模块的第一端，用于向所述驱动模块传输数据电压；所述初始化模块连接所述驱动模块的控制端和所述发光模块的第一端，用于向所述驱动模块的控制端和所述发光模块的第一端传输对应的初始化电压；
所述复位模块的第一端用于输入复位电源输出的信号；所述复位模块的第二端与所述驱动模块的控制端连接，用于在上电期间为所述驱动模块的控制端提供所述复位电源。
第二方面，本发明实施例提供了一种像素电路的驱动方法，应用第一方面中任一项所述的像素电路，包括：
在上电复位阶段，控制复位模块传输复位电源至驱动模块的控制端；
在扫描时间段中的初始化子阶段，控制初始化模块对应的初始化电压至所述驱动模块的控制端和所述发光模块的第一端；
在扫描时间段中的数据写入阶段，控制阈值补偿模块将所述驱动模块的阈值电压写入所述驱动模块的控制端，并控制数据写入模块将数据电压写入所述驱动模块的控制端；
在扫描时间段中的发光阶段，控制第一电源、所述驱动模块、发光模块和第二电源形成通路，驱动所述发光模块发光。
第三方面，本发明实施例还提供了一种发光面板，包括第一方面中任一项所述的像素驱动电路。
第四方面，本发明实施例还提供了一种显示装置，包括第三方面中所述的发光面板。
本发明中，通过提供一种像素驱动电路，像素驱动电路包括：复位模块、存储模块、初始化模块、驱动模块、阈值补偿模块和数据写入模块；驱动模块的第一端用于输入第一电源输出的信号，驱动模块的第二端用于为发光模块提供发光驱动信号；存储模块连接于驱动模块的控制端和驱动模块的第一端之间；阈值补偿模块连接于驱动模块的控制端和驱动模块的第二端之间；数据写入模块连接驱动模块的第一端，用于向驱动模块传输数据电压；初始化模块连接驱动模块的控制端和发光模块的第一端，用于向驱动模块的控制端和发光模块的第一端传输对应的初始化电压；复位模块的第一端用于输入复位电源输出的信号；复位模块的第二端与驱动模块的控制端连接，用于在上电期间为驱动模块的控制端提供复位电源。在像素驱动电路上电器件，通过复位模块向驱动模块提供复位电源，对驱动模块进行复位控制，避免上电复位阶段驱动模块异常导通，造成闪屏现象。
附图说明
图1为本发明实施例提供的一种像素驱动电路的结构示意图；
图2为本发明实施例提供的另一种像素驱动电路的结构示意图；
图3为本发明实施例提供的另一种像素驱动电路的结构示意图；
图4为本发明实施例提供的另一种像素驱动电路的结构示意图；
图5为本发明实施例提供的另一种像素驱动电路的结构示意图；
图6为本发明实施例提供的另一种像素驱动电路的结构示意图；
图7为本发明实施例提供的另一种像素驱动电路的结构示意图；
图8为本发明实施例提供的一种像素驱动电路的时序示意图；
图9为本发明实施例提供的另一种像素驱动电路的结构示意图；
图10为本发明实施例提供的另一种像素驱动电路的时序示意图；
图11为本发明实施例提供的另一种像素驱动电路的结构示意图；
图12为本发明实施例提供的另一种像素驱动电路的结构示意图；
图13为本发明实施例提供的另一种像素驱动电路的结构示意图；
图14为本发明实施例提供的另一种像素驱动电路的时序示意图；
图15为本发明实施例提供的另一种像素驱动电路的结构示意图；
图16为本发明实施例提供的另一种像素驱动电路的结构示意图；
图17为本发明实施例提供的另一种像素驱动电路的结构示意图；
图18为本发明实施例提供的另一种像素驱动电路的结构示意图；
图19为本发明实施例提供的另一种像素驱动电路的时序示意图；
图20为本发明实施例提供的另一种像素驱动电路的结构示意图；
图21为本发明实施例提供的另一种像素驱动电路的结构示意图；
图22为本发明实施例提供的一种像素电路的驱动方法的流程结构示意图；
图23为本发明实施例提供的一种发光面板的结构示意图；
图24为本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
为了使本技术领域的人员更好地理解本发明方案，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分的实施例，而不是全部的实施例。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都应当属于本发明保护的范围。
现有技术中，在常规的7T1C像素驱动电路中，以各个晶体管均为P型晶体管为例，像素驱动电路在上电复位阶段，发光控制信号始终处于低电平，使得发光控制信号连接的发光控制模块处于导通状态，同时由于受到初始化模块的漏流影响，驱动模块的控制端接收到低电平，使得驱动模块导通，进而第一电源、发光控制模块、驱动模块、发光模块和第二电源之间形成通路，使得发光模块在上电复位阶段点亮，造成显示面板在非显示阶段的异常显示。
为解决上述技术问题，本发明实施例提供一种像素驱动电路包括：复位模块、存储模块、初始化模块、驱动模块、阈值补偿模块和数据写入模块；驱动模块的第一端用于输入第一电源输出的信号，驱动模块的第二端用于为发光模块提供发光驱动信号；存储模块连接于驱动模块的控制端和驱动模块的第一端之间；阈值补偿模块连接于驱动模块的控制端和驱动模块的第二端之间；数据写入模块连接驱动模块的第一端，用于向驱动模块传输数据电压；初始化模块连接驱动模块的控制端和发光模块的第一端，用于向驱动模块的控制端和发光模块的第一端传输对应的初始化电压；复位模块的第一端用于输入复位电源输出的信号；复位模块的第二端与驱动模块的控制端连接，用于在上电期间为驱动模块的控制端提供复位电源。通过在上电复位阶段，复位模块向驱动模块提供复位电源，对驱动模块进行复位控制，避免上电复位阶段，驱动模块异常导通，造成闪屏现象。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护的范围。
图1为本发明实施例提供的一种像素驱动电路的结构示意图，如图1所示，像素驱动电路包括：复位模块101、存储模块102、初始化模块103、驱动模块104、阈值补偿模块105和数据写入模块106；驱动模块104的第一端用于输入第一电源PVDD输出的信号，驱动模块104的第二端用于为发光模块107提供发光驱动信号；存储模块102连接于驱动模块104的控制端和驱动模块104的第一端之间；阈值补偿模块105连接于驱动模块104的控制端和驱动模块104的第二端之间；数据写入模块106连接驱动模块104的第一端，用于向驱动模块104传输数据电压；初始化模块103连接驱动模块104的控制端和发光模块107的第一端，用于向驱动模块104的控制端和发光模块107的第一端传输对应的初始化电压Vref；复位模块101的第一端用于输入复位电源输出的信号；复位模块101的第二端与驱动模块104的控制端连接，用于在上电期间为驱动模块104的控制端提供复位电源。
其中，发光模块107中可以包括至少一个发光元件，发光元件例如可以是微发光二极管，微发光二极管可以Mirco LED或Mini LED，微发光二极管为电流型器件，需要在驱动电流的作用下才能够发光，驱动模块104能够根据数据电压信号Vdata产生相应的驱动电流，以驱动发光模块107显示不同的灰阶，从而使得显示面板可以显示待显示画面。像素驱动电路的具体工作过程包括上电复位阶段、初始化阶段、数据写入阶段和发光阶段；上电复位阶段，复位模块101导通，复位模块101在上电期间将复位电源输出的信号传输至驱动模块104的控制端，进而对驱动模块104的控制端进行复位处理，进而使得在上电复位阶段的驱动模块104始终处于关断状态，避免驱动模块104受初始化模块103的漏流影响异常打开。初始化阶段，复位模块101关断，初始化模块103连接驱动模块104的控制端和发光模块107的第一端，在初始化阶段，初始化模块103导通，初始化模块103分别向驱动模块104的控制端和发光模块107的控制端输出初始化电压Vref，进而对驱动模块104的控制端和发光模块107的控制端进行初始化，从而可以清除上一帧画面的残留电荷，以提高显示面板的显示效果；在数据写入阶段，复位模块101和初始化模块103关断，数据写入模块106和阈值补偿模块105导通，数据写入模块106连接驱动模块104的第一端，数据写入模块106将数据电压信号Vdata写入驱动模块104，阈值补偿模块105连接于驱动模块104的控制端和驱动模块104的第二端之间，阈值补偿模块105可以抓取驱动模块104的阈值电压至驱动模块104的控制端，实现阈值电压的补偿；并且存储模块102连接于驱动模块的控制端和驱动模块104的第一端之间，存储模块102可以维持驱动模块104的控制端的电位，避免当初始化模块103关断时，驱动模块104的控制端的电位被耦合而变化；在发光阶段，复位模块101、初始化模块103、数据写入模块106、阈值补偿模块105均关断，驱动模块104导通，驱动模块104的第二端与发光元件的第一端连接，用于为发光模块107提供发光驱动信号，发光模块107响应发光驱动信号发光，从而显示待显示亮度。
本发明实施例通过在上电期间，通过复位模块导通，向驱动模块的控制端提供复位电源，使得驱动模块处于在上电期间处于关断状态，避免驱动模块在非显示阶段异常导通，造成发光模块点亮，避免出现显示面板的闪屏现象，保证显示面板的正常显示效果。
可选的，图2为本发明实施例提供的另一种像素驱动电路的结构示意图，如图2所示，像素驱动电路还包括：第一发光控制模块108和第二发光控制模块109；第一发光控制模块108连接于第一电源PVDD和驱动模块104的第一端之间；第二发光控制模块109连接于驱动模块104的第二端和发光模块107的第一端之间，发光模块107的第二端连接第二电源PVEE。
其中，像素驱动电路还包括第一发光控制模块108和第二发光控制模块109；第一发光控制模块108连接于第一电源PVDD和驱动模块104的第一端之间；第二发光控制模块109连接于驱动模块104的第二端和发光模块107的第一端之间，发光模块107的第二端连接第二电源PVEE，在发光阶段，第一发光控制模块108和第二发光控制模块109导通，驱动模块104的第一端和第二端之间产生电压差，进而输出发光驱动信号至发光模块107的第一端，发光模块107的第二端连接第二电源PVEE，使得第一电源PVDD、第一发光控制模块108、驱动模块104、第二发光控制模块109、发光模块107和第二电源PVEE之间形成通路，发光模块107发光，以显示待显示亮度。
可选的，图3为本发明实施例提供的另一种像素驱动电路的结构示意图，如图3所示，初始化模块103包括：第一初始化模块1031和第二初始化模块1032；第一初始化模块1031连接于第一参考电压输出端VREF1和驱动模块104的控制端之间，用于为驱动模块104提供第一初始化电压Vref1；第二初始化模块1032连接于第二参考电压输出端VREF2和发光模块107的第一端之间，用于为发光模块107提供第二初始化电压Vref2。
其中，像素驱动电路还包括第一初始化模块1031和第二初始化模块1032；第一初始化模块1031连接于第一参考电压输出端VREF1和驱动模块104的控制端之间，在初始化阶段，第一初始化模块1031向驱动模块104提供第一初始化电压Vref1，以清除驱动模块104的控制端中上一帧画面的残留电荷，便于数据写入阶段的数据信号Vdata写入；第二初始化模块1032连接于第二参考电压输出端VREF2和发光模块107的第一端之间，为发光模块107提供第二初始化电压Vref2，可以清除发光模块107中上一帧画面的残留电荷，使得发光模块107可以更加准确的显示待显示亮度，从而提高显示面板的画面质量，第二初始化模块1032的控制端可以接入第一扫描信号线或者第二扫描信号线，使得第二初始化模块1032可以在初始化阶段或者数据写入阶段初始化发光模块107，其中当第一初始化模块1031和第二初始化模块1032均在初始化阶段导通时，此时第一初始化电压Vref1和第二初始化电压Vref2可以为同一初始化输出端输出的初始化电压Vref；当第一初始化模块1031在初始化阶段导通，第一初始化模块1031接收初始化电压Vref1，而第二初始化模块1032在数据写入阶段导通时，第二初始化模块1032接收第二初始化电压Vref2，虽然第一初始化模块1031和第二初始化模块1032导通时间不同，但第一初始化电压Vref1和第二初始化电压Vref2可以为相同的信号，例如，-3.5V。当然二者也可以为不同的信号，例如，第一初始化电压Vref1为-3.5V，第二初始化电压Vref2为-3V，以下实施例中均以第一初始化模块1031和第二初始化模块1032均在初始化阶段导通，即均同时接收相同的初初始化电压Vref为例进行展示，,可以减少信号线的数量，降低制作成本，简化像素驱动电路的复杂程度。
可选的，图4为本发明实施例提供的另一种像素驱动电路的结构示意图，图5为本发明实施例提供的另一种像素驱动电路的结构示意图，图6为本发明实施例提供的另一种像素驱动电路的结构示意图，如图4、图5和图6所示，发光模块107可以包括多个并联和/或串联的Mirco LED。
其中，发光模块107可以包括多个串联的Mirco LED，如图4所示，发光模块包括六个串联设置的Mirco LED；或者发光模块107可以包括多个并联的Mirco LED，如图5所示，发光模块107包括三个并联设置的Mirco LED、或者发光模块107可以包括多个串联加并联设置的Mirco LED，如图6所示，发光模块107包括两串包括三个的Mirco LED串联的Mirco LED串进行并联设置，以上设计结合上述驱动电路均能实现避免发光模块107的异常点亮，进而保证显示面板的显示效果。尤其对应像素驱动电路中的发光模块107中包括多个Mirco LED的情况，第一电源PVDD和第二电源PVEE之间的电压需求增加，对于像素驱动电路中存在较小的漏电流，也能够使得驱动模块104导通，进而造成发光模块107点亮，造成显示面板的闪屏现象，在发光模块块107包括多个发光元件的情况下，更有必要引入复位模块101控制驱动模块104在上电期间始终处于关断状态，有效避免出现显示面板的闪屏现象，保证显示面板的正常显示效果。
可选的，图7为本发明实施例提供的另一种像素驱动电路的结构示意图，如图7所示，复位模块101的控制端连接复位扫描信号输出端RESET；复位扫描信号输出端RESET复用为栅极驱动电路111的复位信号输出端RESET1。
其中，复位模块101的控制端连接复位扫描信号输出端RESET；复位扫描信号输出端RESET复用为栅极驱动电路111的复位信号输出端RESET1，移位寄存器的输出端OUT可以输出低电平信号VGL或者高电平信号VGH。其中，当第一节点N1为导通电平，第二节点N2为截止电平时，移位寄存器的输出端OUT输出低电平信号VGL。当第一节点N1为截止电平，第二节点N2为导通电平时，移位寄存器的输出端OUT输出高电平电压信号VGH，此外，栅极驱动电路111的复位信号输出端RESET1在上电期间控制第十一晶体管T11导通，能够将高电平信号VGH传输至扫描信号输出端OUT，进而对栅极驱动电路111的扫描信号输出端OUT进行复位，避免显示面板上电闪屏问题，当显示面板处于正常扫描时间段，复位信号输出端RESET1关闭第十一晶体管T11，移位寄存器的输出端OUT正常输出信号。栅极驱动电路111中包括多种复位信号输出端RESET1，当复位模块101中的晶体管为P型晶体管时，可以选择栅极驱动电路111中的低电平复位信号进行复位模块101导通；当复位模块101中的晶体管为N型晶体管时，可以选择栅极驱动电路111中的高电平复位信号进行复位模块101导通；同时对栅极驱动电路111的复位信号输出端RESET1的复用可以避免额外设置信号线，减少信号线的数量，降低制作成本，简化像素驱动电路的复杂程度。
可选的，图8为本发明实施例提供的一种像素驱动电路的时序示意图，如图4、图5、图6、图7和图8所示，存储模块102包括第一电容Cst；第一发光控制模块包括第一晶体管T1；数据写入模块106包括第二晶体管T2；驱动模块104包括第三晶体管T3；阈值补偿模块105包括第四晶体管T4；第一初始化模块1031包括第五晶体管T5；第二发光控制模块109包括第六晶体管T6；第二初始化模块1032包括第七晶体管T7；复位模块101包括第八晶体管T8；第三晶体管T3的控制端分别与第八晶体管T8的第二端、第五晶体管T5的第二端以及第四晶体管T4的第一端连接；第三晶体管T3的第一端与第一晶体管T1的第二端连接；第一晶体管T1的第一端连接第一电源PVDD；第三晶体管T3的第二端分别与第四晶体管T4的第二端和第六晶体管T6的第一端连接；第六晶体管T6的第二端与发光模块107的第一端连接；第八晶体管T8的第一端与复位电源连接；第五晶体管T5的第一端与第一参考电压输出端VREF1连接；第二晶体管T2的第一端与数据信号线DATA连接；第二晶体管T2的第二端与第三晶体管T3的第一端连接；第七晶体管T7的第一端与第二参考电压输出端VREF2连接；第七晶体管T7的第二端与发光模块107的第一端连接；第一晶体管T1和第六晶体管T6的控制端连接发光控制信号线EM；第五晶体管T5的控制连接第一扫描信号线S1；第七晶体管T7的控制端连接第二扫描信号线S2；第四晶体管T4的控制端连接第三扫描信号线S3；第二晶体管T2的控制端连接第四扫描信号线S4。
其中，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8均为P型晶体管，P型晶体管低电平导通，高电平截止。示例性的，图4、图5和图6均以第八晶体管T8的控制端连接栅极驱动电路的复位信号输出端RESET1，第一参考电压输出端VREF1和第二参考电压输出端VREF1为同一参考电压输出端VREF为例，对像素驱动电路的工作原理进行说明，在上电复位阶段，复位信号输出端RESET1输出的信号Reset和发光控制信号线EM上的信号EMIT为低电平，第一扫描信号线上的信号S1、第二扫描信号线上的信号S2、第三扫描信号线上的信号S3和第四扫描信号线上的信号S4均为高电平，此时第八晶体管T8、第一晶体管T1和第六晶体管T6导通，第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5和第七晶体管T7截止，复位电源输出的信号经第八晶体管T8传输至第三晶体管T3的控制端，此时复位电源输出的信号为高电平，复位电源输出的信号对第三晶体管T3的控制端进行复位，使得第三晶体管T3在上电复位阶段一直处于截止状态，避免第三晶体管T3受第五晶体管T5的漏流影响，造成第三晶体管T3的异常开启，保证显示面板的显示效果。
在初始化阶段，第一扫描信号线上的信号S1和第二扫描信号线上的信号S2均为低电平，发光控制信号线EM上的信号EMIT、第三扫描信号线上的信号S3、第四扫描信号线上的信号S4和复位信号输出端RESET1输出的信号Reset均为高电平，此时第五晶体管T5和第七晶体管T7导通，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第六晶体管T6和第八晶体管T8截止，第一参考电压输出端VREF1上的电位经第五晶体管T5施加至第一电容Cst，也即第一节点N1的电位为初始化电压Vref，此时，驱动晶体管T3的控制端的电位也为初始化电压Vref，对驱动晶体管T3的控制端中上一帧的残留电荷进行清除；同时第五晶体管T5为双栅晶体管，进一步降低像素驱动电路中的漏流现象，保证第一节点N1的电位稳定；在初始化阶段，第七晶体管T7也导通，第七晶体管T7将第二参考电压输出端VREF2上的电位写入发光模块107的第一端，对发光模块107的第一端电位进行初始化，可以降低前一帧发光模块107的第一端的电压对后一帧发光模块107的第一端的电压的影响，进一步提高显示均一性。
在数据写入阶段，第三扫描信号线上的信号S3和第四扫描信号线上的信号S4均为低电平，第一扫描信号线上的信号S1、第二扫描信号线上的信号S2、发光控制信号线EM上的信号EMIT和复位信号输出端RESET1输出的信号Reset均为高电平，第二晶体管T2和第四晶体管T4导通，第一晶体管T1、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8截止，此时数据信号Vdata写入第二晶体管T2和第四晶体管T4，驱动晶体管T3控制端的电位为初始化电压Vref，也是低电位，第三晶体管T3也导通，数据信号线DATA上的数据信号Vdata写入第二晶体管T2、第三晶体管T3和第四晶体管T4，施加到第一节点N1，第一节点N1的电位逐渐被数据信号线DATA上的电位拉高。当第三晶体管T3的栅极电压被拉高到和其源极的电压差等于第三晶体管T3的阈值电压时，第三晶体管T3将处于截止状态，数据写入阶段结束。同时第四晶体管T4为双栅晶体管，以降低像素驱动电路中的漏流现象，保证第一节点N1的电位稳定。
在发光阶段，发光控制信号线EM上的信号EMIT为低电平，第一扫描信号线上的信号S1、第二扫描信号线上的信号S2、第三扫描信号线上的信号S3、第四扫描信号线上的信号S4和复位信号输出端RESET1输出的信号Reset均为高电平，此时第一晶体管T1和第六晶体管T6导通，第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第七晶体管T7和第八晶体管T8截止，第一电源PVDD与第二电源PVEE之间形成通路，第三晶体管T3输出发光驱动信号至发光模块107，发光模块107发光。
当像素驱动电路中第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8均为N型晶体管，N型晶体管高电平导通，低电平截止。像素驱动电路的具体工作过程的原理与像素驱动电路中第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8均为P型晶体管的原理相同，再次不在过多赘述。
可选的，继续参考图4、图5、图6、图7和图8，第一扫描信号线、第二扫描信号线、第三扫描信号线和第四扫描信号线被配置为实现如下驱动：
在上电复位阶段，第一晶体管T1、第六晶体管T6和第八晶体管T8导通；第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5和第七晶体管T7关断；在扫描时间段中的初始化子阶段，第五晶体管T5、第七晶体管T7导通；第一晶体管T1、第二晶体管T2、第四晶体管T4、第三晶体管T3、第六晶体管T6和第八晶体管T8关断；在扫描时间段中的数据写入阶段，第二晶体管T2、第三晶体管T3和第四晶体管T4导通；第一晶体管T1、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8关断；在扫描时间段中的发光阶段，第一晶体管T1、第三晶体管T3和第六晶体管T6导通；第二晶体管T2、第四晶体管T4、第五晶体管T5、第七晶体管T7和第八晶体管T8关断。
其中，在上电复位阶段，第一扫描信号线上的信号S1、第二扫描信号线上的信号S2、第三扫描信号线上的信号S3和第四扫描信号线上的信号S4均为高电平，复位信号输出端RESET1输出的信号Reset和发光控制信号线EM上的信号EMIT均为低电平，第一扫描信号线、第二扫描信号线、第三扫描信号线和第四扫描信号线，第一晶体管T1、第六晶体管T6和第八晶体管T8导通；第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5和第七晶体管T7关断；
在扫描时间段中的初始化子阶段，第一扫描信号线上的信号S1和第二扫描信号线上的信号S2均为低电平，发光控制信号线EM上的信号EMIT、第三扫描信号线上的信号S3、第四扫描信号线上的信号S4和复位信号输出端RESET1输出的信号Reset均为高电平，第五晶体管T5、第七晶体管T7导通；第一晶体管T1、第二晶体管T2、第四晶体管T4、第三晶体管T3、第六晶体管T6和第八晶体管T8关断；
在扫描时间段中的数据写入阶段，第三扫描信号线上的信号S3和第四扫描信号线上的信号S4均为低电平，第一扫描信号线上的信号S1、第二扫描信号线上的信号S2、发光控制信号线EM上的信号EMIT和复位信号输出端RESET1输出的信号Reset均为高电平，第二晶体管T2、第三晶体管T3和第四晶体管T4导通；第一晶体T1管、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8关断；
在扫描时间段中的发光阶段，发光控制信号线EM上的信号EMIT为低电平，第一扫描信号线上的信号S1、第二扫描信号线上的信号S2、第三扫描信号线上的信号S3、第四扫描信号线上的信号S4和复位信号输出端RESET1输出的信号Reset均为高电平，第一晶体管T1、第三晶体管T3和第六晶体管T6导通；第二晶体管T2、第四晶体管T4、第五晶体管T5、第七晶体管T7和第八晶体管T8关断。
可选的，图9为本发明实施例提供的另一种像素驱动电路的结构示意图，图10为本发明实施例提供的另一种像素驱动电路的时序示意图，如图9和图10所示，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8均为P型晶体管；第一扫描信号线复用为第二扫描信号线；第三扫描信号线复用为第四扫描信号线。
其中，由于第五晶体管T5和第七晶体管T7均为P型晶体管，在初始化阶段，第五晶体管T5和第六晶体管T6可以同时导通，此时可以将第五晶体管T5和第七晶体管T7的控制端均接入相同的低电平扫描信号，因此，可以将第一扫描信号线复用为第二扫描信号线，保证在初始化阶段，第五晶体管T5和第七晶体管T7同时打开，在非初始化阶段，第五晶体管T5和第七晶体管T7同时关断；同理，由于第二晶体管T2和第四晶体管T4均为P型晶体管，在初始化阶段，第二晶体管T2和第四晶体管T4可以同时导通，此时可以将第二晶体管T2和第四晶体管的控制端均接入相同的低电平扫描信号，因此，可以将第三扫描信号线复用为第四扫描信号线，保证在数据写入阶段，第二晶体管T2和第四晶体管T4同时打开；在非数据写入阶段，第二晶体管T2和第四晶体管T4同时关断；将扫描线进行复用，可以有效降低扫描线的设置数量，降低制作成本，简化像素驱动电路的复杂程度。
可选的，图11为本发明实施例提供的另一种像素驱动电路的结构示意图，图12为本发明实施例提供的另一种像素驱动电路的结构示意图，如图11和图12所示，第一电源PVDD复用为复位电源；或者，栅极驱动电路的高电压信号端VGH复用为复位电源。
其中，第三晶体管T3为P型晶体管，低电平导通，高电平截止，由于在上电复位阶段，为避免第三晶体管T3的异常打开，此时需要向第三晶体管T3的控制端写入高电平，如图11所示，第一电源PVDD通常为高电平信号，因此，可以将第一电源PVDD复用为复位电源；或者如图12所示，栅极驱动电路的高电压信号端VGH输出的为高电平信号，将栅极驱动电路的高电压信号端VGH复用为复位电源，将第一电源PVDD或栅极驱动电路的高电压信号端VGH进行复用，可以避免额外设置复位电源，降低制造成本，简化像素驱动电路的复杂程度。
可选的，继续参考图11和图12，若发光模块107包括多个发光元件，则栅极驱动电路的高电压信号端VGH复用为复位电源；若发光模块107包括一个发光元件，则第一电源PVDD复用为复位电源。
其中，如图11所示，当发光模块107中只设置有一个发光元件时，第一电源PVDD复用为复位电源，用于向驱动模块104的控制端提供复位电源，此时则不需要额外布线去引入栅极驱动电路中的高电压信号端VGH，而且，较小的复位电压能够使得初始化阶段第五晶体管T5容易实现第一节点N1复位；如图12所示，当发光模块107中设置有多个发光元件时，示例性的，发光模块107中设置有六个发光元件，此时第一电源PVDD和第二电源PVEE之间夹压过高，若驱动模块104稍有导通即会出现闪屏问题，可将栅极驱动电路的高电压信号端VGH复用为复位电源，高电压信号端VGH输出的电压较高，能够进一步降低发光模块107中发光元件被导通的可能性，进而有效避免显示面板出现闪屏的现象。
可选的，图13为本发明实施例提供的另一种像素驱动电路的结构示意图，图14为本发明实施例提供的另一种像素驱动电路的时序示意图，如图13和图14所示，第一晶体管T1、第二晶体管T2、第三晶体管T3、第四晶体管T4、第五晶体管T5、第六晶体管T6、第七晶体管T7和第八晶体管T8均为N型晶体管；第一扫描信号线复用为第二扫描信号线；第三扫描信号线复用为第四扫描信号线。
其中，由于第五晶体管T5和第七晶体管T7均为N型晶体管，在初始化阶段，第五晶体管T5和第七晶体管T7可以同时导通，此时可以将第五晶体管T5和第七晶体管T7的控制端均接入相同的高电平扫描信号，因此，可以将第一扫描信号线复用为第二扫描信号线，保证在初始化阶段，第五晶体管T5和第七晶体管T7同时打开，在非初始化阶段，第五晶体管T5和第七晶体管T7同时关断；同理，由于第二晶体管T2和第四晶体管T4均为N型晶体管，在初始化阶段，第二晶体管T2和第四晶体管T4可以同时导通，此时可以将第二晶体管T2和第四晶体管T4的控制端均接入相同的高电平扫描信号，因此，可以将第三扫描信号线复用为第四扫描信号线，保证在数据写入阶段，第二晶体管T2和第四晶体管T4同时打开；在非数据写入阶段，第二晶体管T2和第四晶体管T4同时关断；将扫描线进行复用，可以有效降低扫描线的设置数量，降低制作成本，简化像素驱动电路的复杂程度。
可选的，图15为本发明实施例提供的另一种像素驱动电路的结构示意图，图16为本发明实施例提供的另一种像素驱动电路的结构示意图，图17为本发明实施例提供的另一种像素驱动电路的结构示意图，如图15、图16和图17所示，第二电源PVEE复用为复位电源；或者，栅极驱动电路的低电压信号端VGL复用为复位电源；第一参考电压输出端VREF1或第二参考电压输出端VREF2复用为复位电源。
其中，第三晶体管T3为N型晶体管，高电平导通，低电平截止，由于在上电复位阶段，为避免第三晶体管T3的异常打开，此时需要向第三晶体管T3的控制端写入低电平，如图15所示，第二电源PVEE通常为低电平信号，因此，可以将第二电源PVEE复用为复位电源；或者如图16所示，栅极驱动电路的低电压信号端VGL输出的为低电平信号，将栅极驱动电路的低电压信号端VGL复用为复位电源，将第二电源PVEE或栅极驱动电路的低电压信号端VGL进行复用，或者如图17所示，第一参考电压输出端VREF1输出的为低电平信号，将第一参考电压输出端VREF1复用为复位电源；同理第二参考电压输出端VREF2输出的也为低电平信号，也可以将第二参考电压输出端VREF2复用为复位电源，将第二电源PVEE、栅极驱动电路的低电压信号端VGL、第一参考电压输出端VREF1或第二参考电压输出端VREF2进行复用，可以避免额外设置复位电源，降低制造成本，简化像素驱动电路的复杂程度。
可选的，如图15和图16所示，若发光模块107包括多个发光元件，则第二电源PVEE复用为复位电源；若发光模块107包括一个发光元件，则栅极驱动电路的低电压信号端VGL复用为复位电源。
其中，如图16所示，当发光模块107中设置有多个发光元件时，示例性的，发光模块107中设置由六个发光元件，第一电源PVDD和第二电源PVEE之间夹压较高，第二电源PVEE绝对值较高，例如，可以为-14V，其绝对值比栅极驱动电路的低电压信号端VGL的绝对值大，将第二电源PVEE复用为复位电源，第二电源PVEE能够进一步降低发光模块107中发光元件被导通的可能性，且不需要额外布线去引入栅极驱动电路中的低电压信号端VGL；如图15所示，当发光模块107中只设置有一个发光元件时，栅极驱动电路的低电压信号端VGL复用为复位电源，用于向驱动模块104的控制端提供复位电源，而且，较小的复位电压能够使得第五晶体管T5容易实现第一节点N1复位，进而有效避免显示面板出现闪屏的现象。
可选的，图18为本发明实施例提供的另一种像素驱动电路的结构示意图，图19为本发明实施例提供的另一种像素驱动电路的时序示意图，如图18和图19所示，第一晶体管T1、第二晶体管T2、第三晶体管T3、第六晶体管T6、第七晶体管T7和第八晶体管T8均为P型晶体管；第四晶体管T4和第五晶体管T5为N型晶体管；第一扫描信号线和第二扫描信号线输出信号时序相同，方向相反；第三扫描信号线和第四扫描信号线输出信号时序相同，方向相反。
其中，第一晶体管T1、第二晶体管T2、第三晶体管T3、第六晶体管T6、第七晶体管T7和第八晶体管T8均为P型晶体管，采用LTPS工艺制备得到；由于第五晶体管T5为N型晶体管和第七晶体管T7为P型晶体管，在初始化阶段，第五晶体管T5和第七晶体管T7可以同时导通，此时第五晶体管T5的控制端连接的第一扫描信号线为高电平，第七晶体管T7的控制端连接的第二扫描信号线为低电平；在非初始化阶段，第五晶体管T5和第七晶体管T7可以同时关断，此时第五晶体管T5的控制端连接的第一扫描信号线为低电平，第七晶体管T7的控制端连接的第二扫描信号线为高电平，因此控制第一扫描信号线和第二扫描信号线输出信号时序相同，方向相反，保证第五晶体管T5和第七晶体管T7可以同时导通或者同时关断；由于第二晶体管T2为N型晶体管和第四晶体管T4为P型晶体管，在初始化阶段，第二晶体管T2和第四晶体管T4可以同时导通，此时第二晶体管T2的控制端连接的第四扫描信号线为低电平，第四晶体管T4的控制端连接的第三扫描信号线为高电平；在非初始化阶段，第二晶体管T2和第四晶体管T4可以同时关断，此时第二晶体管T2的控制端连接的第四扫描信号线为高电平，第四晶体管T4的控制端连接的第三扫描信号线为低电平，因此控制第三扫描信号线和第四扫描信号线输出信号时序相同，方向相反，保证第二晶体管T2和第四晶体管T4可以同时导通或者同时关断。将第四晶体管T4和第五晶体管T5变成双栅N型晶体管，可以有效避免像素驱动电路中的漏流现象，保证第一节点N1的电位稳定，进而保证像素驱动电路的正常工作，进而保证显示面板的显示效果。
可选的，图20为本发明实施例提供的另一种像素驱动电路的结构示意图，图21为本发明实施例提供的另一种像素驱动电路的结构示意图，如图20和图21所示，第一电源PVDD复用为复位电源；或者，栅极驱动电路的高电压信号端VGH复用为复位电源。
其中，第三晶体管T3为P型晶体管，高电平导通，低电平截止，由于在上电复位阶段，为避免第三晶体管T3的异常打开，此时需要向第三晶体管T3的控制端写入低电平，如图20所示，第一电源PVDD通常为高电平信号，因此，可以将第一电源PVDD复用为复位电源；或者如图21所示，栅极驱动电路的高电压信号端VGH输出的为高电平信号，将栅极驱动电路的高电压信号端VGH复用为复位电源，将第一电源PVDD或栅极驱动电路的高电压信号端VGH进行复用，可以避免额外设置复位电源，降低制造成本，简化像素驱动电路的复杂程度。同理，若发光模块107包括多个发光元件，则栅极驱动电路的高电压信号端VGH复用为复位电源；若发光模块107包括一个发光元件，则第一电源PVDD复用为复位电源
图22为本发明实施例提供的一种像素电路的驱动方法的流程结构示意图，该像素电路的驱动方法应用上述实施例中任一项所述像素电路，该方法包括：
S101，在上电复位阶段，控制复位模块传输复位电源至驱动模块的控制端。
其中，复位模块在扫描时间段之前对驱动模块的控制端写入复位电源输出的信号，使得驱动模块在上电复位阶段处于关断状态，不会存在异常导通的现象，进而保证显示面板的正常显示，避免出现闪屏现象。
S102，在扫描时间段中的初始化子阶段，控制初始化模块对应的初始化电压至驱动模块的控制端和发光模块的第一端。
其中，在数据写入阶段之前对驱动模块的控制端进行初始化，以清除上一帧中驱动模块中晶体管的栅极电位，以便数据写入阶段的数据电压写入，保证显示面板的显示效果。
S103，在扫描时间段中的数据写入阶段，控制阈值补偿模块将驱动模块的阈值电压写入驱动模块的控制端，并控制数据写入模块将数据电压写入驱动模块的控制端。
其中，在数据写入阶段，通过阈值补偿模块抓取驱动模块的阈值电压写入的驱动模块的控制端，实现阈值电压的补偿；同时将数据写入模块将数据电压写入驱动模块的控制端，进而保证显示面板的显示均一性。
S104，在扫描时间段中的发光阶段，控制第一电源、驱动模块、发光模块和第二电源形成通路，驱动发光模块发光。
其中，在发光阶段，驱动模块根据数据电压产生驱动电路，发光模块响应驱动电流发光，从而实现待显示亮度。
本发明实施例通过在扫描时间段之前对驱动模块进行上电复位操作，使得在非扫描时间段中驱动模块不会异常导通，使得发光模块异常点亮，使得显示面板出现闪屏现象，保证影显示面板的显示效果。
可选的，每次上电操作后，执行一次上电复位阶段，并执行多次扫描时间段。例如，可仅在上电期间上电复位阶段，之后循环执行扫描时间段，以有效节省扫描时间，提高刷新频率。其中，在像素电路执行完每次的上电操作后，经在扫描时间段前执行上电复位阶段的操作，使得驱动模块在扫描时间段前不会出现异常导通，进而不会影响在非显示阶段出现发光模块的显示亮度变化，影响显示面板的正常显示效果。或者，在每次扫描时间段之前，也可都进行上述上电复位阶段，进一步提高显示面板的显示效果。
基于同一发明构思，本发明实施例还提供了一种发光面板，图23为本发明实施例提供的一种发光面板的结构示意图，发光面板200包括上述实施例中任一项所述的像素驱动电路100。该发光面板包括阵列排布的多个本发明实施例提供的像素驱动电路，因此该发光面板具备本发明实施例提供的像素驱动电路的有益效果，相同之处可参照上文理解，下文中不再赘述。如上述各实施方式所述，发光面板可以为显示面板，像素电路用于驱动对应的发光元件进行显示，发光元件可以是Micro LED或者Mini LED等。发光面板还可以为背光面板，此时的发光模块包括多个发光元件，发光元件可以为Mini LED，以实现背光的需求，背光面板可以和液晶面板共同组成显示面板，背光面板用于为液晶面板提供背光。此时由于背光面板的像素驱动电路中引入复位模块在上电期间对驱动模块进行控制，使其在上电期间始终处于关断状态，避免出现背光面板的闪屏现象，保证背光面板的使用效果。
图24为本发明实施例提供的一种显示装置的结构示意图，如图24所示，显示装置300包括上述实施例所述的发光面板200。
需要说明的是，由于本实施例提供的一种显示装置具备上述实施例的显示面板的相同或相应的有益效果，此处不做赘述。本发明实施例提供的显示装置300可以为图24所示的手机，也可以为任何具有显示功能的电子产品，包括但不限于以下类别：电视机、笔记本电脑、桌上型显示器、平板电脑、数码相机、智能手环、智能眼镜、车载显示器、医疗设备、工控设备、触摸交互终端等，本发明实施例对此不作特殊限定。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (19)

1.一种像素驱动电路，其特征在于，包括：复位模块、存储模块、初始化模块、驱动模块、阈值补偿模块和数据写入模块；
所述驱动模块的第一端用于输入第一电源输出的信号，所述驱动模块的第二端用于为发光模块提供发光驱动信号；所述存储模块连接于所述驱动模块的控制端和所述驱动模块的第一端之间；所述阈值补偿模块连接于所述驱动模块的控制端和所述驱动模块的第二端之间；
所述数据写入模块连接所述驱动模块的第一端，用于向所述驱动模块传输数据电压；所述初始化模块连接所述驱动模块的控制端和所述发光模块的第一端，用于向所述驱动模块的控制端和所述发光模块的第一端传输对应的初始化电压；
所述复位模块的第一端用于输入复位电源输出的信号；所述复位模块的第二端与所述驱动模块的控制端连接，用于在上电期间为所述驱动模块的控制端提供所述复位电源。
2.根据权利要求1所述的像素驱动电路，其特征在于，还包括：第一发光控制模块和第二发光控制模块；
所述第一发光控制模块连接于所述第一电源和所述驱动模块的第一端之间；
所述第二发光控制模块连接于所述驱动模块的第二端和所述发光模块的第一端之间，所述发光模块的第二端连接第二电源。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述初始化模块包括：第一初始化模块和第二初始化模块；
所述第一初始化模块连接于第一参考电压输出端和所述驱动模块的控制端之间，用于为所述驱动模块提供第一初始化电压；
所述第二初始化模块连接于第二参考电压输出端和所述发光模块的第一端之间，用于为所述发光模块提供第二初始化电压。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述发光模块包括多个并联和/或串联的Mirco LED。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述复位模块的控制端连接复位扫描信号输出端；所述复位扫描信号输出端复用为栅极驱动电路的复位信号输出端。
6.根据权利要求3所述的像素驱动电路，其特征在于，所述存储模块包括第一电容；所述第一发光控制模块包括第一晶体管；所述数据写入模块包括第二晶体管；所述驱动模块包括第三晶体管；所述阈值补偿模块包括第四晶体管；所述第一初始化模块包括第五晶体管；所述第二发光控制模块包括第六晶体管；所述第二初始化模块包括第七晶体管；所述复位模块包括第八晶体管；
所述第三晶体管的控制端分别与所述第八晶体管的第二端、所述第五晶体管的第二端以及所述第四晶体管的第一端连接；所述第三晶体管的第一端与所述第一晶体管的第二端连接；所述第一晶体管的第一端连接所述第一电源；所述第三晶体管的第二端分别与所述第四晶体管的第二端和所述第六晶体管的第一端连接；所述第六晶体管的第二端与所述发光模块的第一端连接；
所述第八晶体管的第一端与复位电源连接；所述第五晶体管的第一端与所述第一参考电压输出端连接；所述第二晶体管的第一端与数据信号线连接；所述第二晶体管的第二端与所述第三晶体管的第一端连接；所述第七晶体管的第一端与所述第二参考电压输出端连接；所述第七晶体管的第二端与所述发光模块的第一端连接；
所述第一晶体管和所述第六晶体管的控制端连接发光控制信号线；所述第五晶体管的控制连接第一扫描信号线；所述第七晶体管的控制端连接第二扫描信号线；所述第四晶体管的控制端连接第三扫描信号线；所述第二晶体管的控制端连接第四扫描信号线。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述第一扫描信号线、所述第二扫描信号线、所述第三扫描信号线和所述第四扫描信号线被配置为实现如下驱动：
在上电复位阶段，所述第一晶体管、第六晶体管和第八晶体管导通；所述第二晶体管、第三晶体管、第四晶体管、第五晶体管和第七晶体管关断；
在扫描时间段中的初始化子阶段，所述第五晶体管、所述第七晶体管导通；所述第一晶体管、第二晶体管、第四晶体管、第三晶体管、第六晶体管和第八晶体管关断；
在扫描时间段中的数据写入阶段，所述第二晶体管、第三晶体管和第四晶体管导通；所述第一晶体管、第五晶体管、第六晶体管、第七晶体管和第八晶体管关断；
在扫描时间段中的发光阶段，所述第一晶体管、第三晶体管和第六晶体管导通；所述第二晶体管、第四晶体管、第五晶体管、第七晶体管和第八晶体管关断。
8.根据权利要求6所述的像素驱动电路，其特征在于，所述第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管和第八晶体管均为P型晶体管；
所述第一扫描信号线复用为所述第二扫描信号线；所述第三扫描信号线复用为第四扫描信号线。
9.根据权利要求8所述的像素驱动电路，其特征在于，所述第一电源复用为所述复位电源；或者，
栅极驱动电路的高电压信号端复用为所述复位电源。
10.根据权利要求9所述的像素驱动电路，其特征在于，
若发光模块包括多个发光元件，则所述栅极驱动电路的高电压信号端复用为所述复位电源；
若所述发光模块包括一个发光元件，则所述第一电源复用为所述复位电源。
11.根据权利要求6所述的像素驱动电路，其特征在于，所述第一晶体管、第二晶体管、第三晶体管、第四晶体管、第五晶体管、第六晶体管、第七晶体管和第八晶体管均为N型晶体管；
所述第一扫描信号线复用为所述第二扫描信号线；所述第三扫描信号线复用为第四扫描信号线。
12.根据权利要求11所述的像素驱动电路，其特征在于，所述第二电源复用为所述复位电源；或者，
栅极驱动电路的低电压信号端复用为所述复位电源；
所述第一参考电压输出端或所述第二参考电压输出端复用为所述复位电源。
13.根据权利要求12所述的像素驱动电路，其特征在于，
若发光模块包括多个发光元件，则所述第二电源复用为所述复位电源；
若所述发光模块包括一个发光元件，则所述栅极驱动电路的低电压信号端复用为所述复位电源。
14.根据权利要求6所述的像素驱动电路，其特征在于，所述第一晶体管、第二晶体管、第三晶体管、第六晶体管、第七晶体管和第八晶体管均为P型晶体管；所述第四晶体管和第五晶体管为N型晶体管；
所述第一扫描信号线和所述第二扫描信号线输出信号时序相同，方向相反；所述第三扫描信号线和第四扫描信号线输出信号时序相同，方向相反。
15.根据权利要求14所述的像素驱动电路，其特征在于，
所述第一电源复用为所述复位电源；或者，栅极驱动电路的高电压信号端复用为所述复位电源。
16.一种像素电路的驱动方法，其特征在于，应用上述权利要求1-15任一项所述的像素电路，包括：
在上电复位阶段，控制复位模块传输复位电源至驱动模块的控制端；
在扫描时间段中的初始化子阶段，控制初始化模块对应的初始化电压至所述驱动模块的控制端和所述发光模块的第一端；
在扫描时间段中的数据写入阶段，控制阈值补偿模块将所述驱动模块的阈值电压写入所述驱动模块的控制端，并控制数据写入模块将数据电压写入所述驱动模块的控制端；
在扫描时间段中的发光阶段，控制第一电源、所述驱动模块、发光模块和第二电源形成通路，驱动所述发光模块发光。
17.根据权利要求16所述的像素电路的驱动方法，其特征在于，每次上电操作后，执行一次所述上电复位阶段，并执行多次所述扫描时间段。
18.一种发光面板，其特征在于，包括上述权利要求1-15任一项所述的像素驱动电路。
19.一种显示装置，其特征在于，包括上述权利要求18所述的发光面板。
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