CN114694610A - 显示装置 - Google Patents

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Abstract

所提供的是一种可以按顺序将栅极脉冲输出到栅极线的一侧和另一侧的显示装置。该显示装置包括：在显示区域之外配有四个非显示区域的显示面板，在所述四个非显示区域中的第一非显示区域中提供的栅极驱动器，在所述第一非显示区域中提供的数据驱动器，以及用于控制所述栅极驱动器和所述数据驱动器的控制器，其中在与提供从所述栅极驱动器伸出的连接线的第一方向不同的第二方向上提供与所述连接线相连的栅极线，从所述栅极驱动器通过所述连接线提供给所述栅极线的栅极脉冲是交替地从所述栅极线的第一侧和第二侧输出的，以及所述栅极线的所述第一侧和所述第二侧彼此是在所述第一方向上划分的。

Description

显示装置
相关申请的交叉引用
本申请要求享有2020年12月31日提交的韩国专利申请10-2020-0189795的权益，该申请由此在这里被以全面阐述的方式引入以作为参考。
技术领域
本公开涉及一种显示装置。
背景技术
液晶显示装置和发光显示装置可被包含在显示装置中。该显示装置包括显示面板。
栅极脉冲被按顺序输出到在显示面板中提供的栅极线。
特别地，栅极脉冲是按顺序从栅极线的一侧输出的。
在这种情况下，在栅极线的一侧和另一侧中可以会出现亮度差异。
发明内容
本公开是有鉴于上述问题而被产生的，并且本公开的目标是提供一种可以向栅极线的一侧和另一侧按顺序输出栅极脉冲的显示装置。
除了如上所述的本公开的目的之外，本领域技术人员从以下关于本公开的描述中会清楚理解本公开的附加目标和特征。
根据本公开的一个方面，上述和其他目标可以通过提供一种显示装置来实现，所述显示装置包括：在显示区域之外配有四个非显示区域的显示面板，在所述四个非显示区域中的第一非显示区域中提供的栅极驱动器，在所述第一非显示区域中提供的数据驱动器，以及用于控制所述栅极驱动器和所述数据驱动器的控制器，其中在与提供从所述栅极驱动器伸出的连接线的第一方向不同的第二方向上提供与所述连接线相连的栅极线，从所述栅极驱动器通过所述连接线提供给所述栅极线的栅极脉冲是交替地从所述栅极线的第一侧和第二侧输出的，以及所述栅极线的所述第一侧和所述第二侧彼此是在所述第一方向上划分的。
附图说明
从以下结合附图的详细描述中会更清楚地理解本公开的上述及其他目标、特征以及其他优点，其中：
图1是示出了根据本公开的发光显示装置的结构的示例图；
图2a和图2b是示出了应用于根据本公开的发光显示装置的像素的结构的示例图；
图3是示出了应用于根据本公开的发光显示装置的控制器的结构的示例图；
图4是示出了应用于根据本公开的显示装置的栅极驱动器的内部配置的示例图；
图5示出了施加于根据本公开的显示装置的不同信号的波形；
图6是示出了应用于根据本公开的显示装置的连接线与栅极线的连接关系的示例图；
图7是示出了应用于根据本公开的显示装置的连接线与栅极线的连接关系的另一个示例图；以及
图8是示出了应用于根据本公开的显示装置的连接线与栅极线的连接关系的另一个示例图。
具体实施方式
本公开的优点和特征及其实施方法将会通过以下参考附图描述的实施例来阐明。然而，本公开可以采用不同的形式实现，并且不应被解释成局限于这里阐述的实施例。相反，提供这些实施例是为了使本公开全面和完整，以及将本公开的范围充分传达给本领域技术人员。更进一步，本公开仅仅由权利要求的范围限定。
在附图中，即使相同或相似的要素是在不同的附图中描述的，也会用相同的参考数字来表示这些要素。在所有附图中会尽可能地使用相同的参考数字来指代相同或相似的部分。
在描述本公开的实施例的附图中公开的形状、尺寸、比例、角度和数量都仅仅是示例，并且由此，本公开不局限于图示的细节。相同的参考数字在说明书中始终指代相同的部件。在以下描述中，如果确定针对相关的已知功能或配置的详细描述会不必要地与本公开的要点相混淆，那么将省略该详细描述。如果使用了本说明书中描述的“包括”、“具有”和“包含”，那么除非使用“仅仅”，否则还可以添加别的部分。除非另有所指，否则单数形式的术语可以包括复数形式。
在解释一个要素时，尽管没有明确描述，但是该要素被解释成包含误差范围。
在描述位置关系时，例如在将位置顺序描述成“在……上”、“上方”、“下方”以及“居于……之后”时，除非使用了“正好”或“直接”，否则可以在两个部分之间布置一个或多个部分。
在描述时间关系时，例如在将时间顺序描述成“在……之后”、“随后”、“接下来”以及“在……之前”时，除非使用了“正好”或“直接”，否则可以包含不连续的情形。
应该理解，术语“至少一个”包括与任一项目相关的所有组合。例如，“第一要素、第二要素和第三要素中的至少一个”可以包括从第一、第二和第三要素中选择的两个或更多要素的所有组合以及第一、第二和第三要素中的每一个要素。
应该理解，虽然在这里会使用术语“第一”、“第二”等等来描述不同的要素，但是这些要素不应该受限于这些术语。这些术语只是用于将一个要素与另一个要素区分开来。例如，在不脱离本公开的范围的情况下，第一要素可被称为第二要素，并且第二要素同样可被称为第一要素。
本领域技术人员可以充分理解，本公开的不同实施例的特征是可以被部分或完全地相互耦合或组合的，并且彼此是可以用不同的方式相互操作以及用技术方式驱动的。本公开的实施例既可以采用相互独立的方式执行，也可以以相互依存的关系一起执行。
在下文中将会参考附图来详细描述本公开的实施例。
图1是示出了根据本公开的发光显示装置的结构的示例图，图2a和图2b是示出了应用于根据本公开的发光显示装置的像素的结构的示例图，以及图3是示出了应用于根据本公开的发光显示装置的控制器的结构的示例图。
根据本公开的发光显示装置可以构成各种电子设备。作为示例，这些电子设备可以是智能电话，平板电脑，电视机或监视器等等。
如图1所示，根据本公开的发光显示装置包括：在显示区域102以外配备了四个非显示区域103a、103b、103c和103d的显示面板100，在所述非显示区域中的第一非显示区域103a中提供的用于驱动在显示区域102中沿第一方向(例如显示面板的垂直方向)形成的数据线DL1到DLd的数据驱动器300，在非显示区域中的第一非显示区域103a中提供的用于驱动在显示区域102中沿着与第一方向不同的第二方向(例如显示面板的水平方向)形成的栅极线GL1到GLg的栅极驱动器200，以及用于控制数据驱动器300和栅极驱动器200的控制器。在本范例中，‘g’和‘d’是自然数，特别地，‘g’和‘d’是偶数。
首先，显示面板100包括显示区域102以及围绕该显示区域的非显示区域103。
显示区域102配有栅极线GL1到GLg，数据线DL1到DLd以及连接线CL。
非显示区域103可以配有栅极驱动器200，数据驱动器300以及控制器400。非显示区域包括第一非显示区域103a，第二非显示区域103b，第三非显示区域103c以及第四非显示区域103d。
第一非显示区域103a面对第二非显示区域103b且显示区域102居于其间，以及第三非显示区域103c面对第四非显示区域103d且显示区域102居于其间。第三非显示区域103c和第四非显示区域103d的一端连接到第一非显示区域103a的两端，以及第三非显示区域103c和第四非显示区域的另一端连接区域103d连接到第二非显示区域103b的两端。
与从栅极驱动器200伸出的连接线CL相连的栅极线GL1到GLg是在与提供连接线GL的第一方向不同的第二方向上提供的。
在这种情况下，第一方向可以是如上所述的显示面板的垂直方向，并且在这种情况下，数据线DL1到DLd和连接线CL在显示面板100中沿着第一方向提供的。第二方向可以是显示面板的水平方向，并且栅极线GL1到GLg是在显示面板100中沿着第二方向提供的。
显示面板100既可以是包含了如图2a所示的像素的发光显示面板，也可以是包含了如图2b所示的像素的液晶显示面板。
当显示面板100是包含了如2a所示的像素101的发光显示面板时，在显示面板100中提供的像素101可以包括发光元件ED，开关晶体管Tsw1，存储电容器Cst，驱动晶体管Tdr以及感测晶体管Tsw2。也就是说，像素101可以包括像素驱动单元PDU和发光单元，其中像素驱动单元PDU可以包括开关晶体管Tsw1，存储电容器Cst，驱动晶体管Tdr以及感测晶体管Tsw2。发光单元可以包括发光元件ED。
构成像素驱动单元PDU的开关晶体管Tsw1可以通过提供给栅极线GL的栅极信号GS而被导通或关断。当开关晶体管Tsw1导通时，通过数据线DL提供的数据电压Vdata被提供给驱动晶体管Tdr。第一电压EVDD可以通过第一电压供应线PLA而被提供给驱动晶体管Tdr和发光元件ED。第二电压EVSS则通过第二电压供应线PLB而被提供给发光元件ED。感测晶体管Tsw2可以由通过感测控制线SCL提供的感测控制信号SS导通或关断。感测线SL可以连接到感测晶体管Tsw2。参考电压Vref可以通过感测线SL被提供给像素101。与驱动晶体管Tdr的特性变化相关的感测信号可以通过感测晶体管Tsw2而被传送到感测线SL。
当显示面板100是包括图2b所示的像素101的液晶显示面板时，在显示面板100中提供的像素101可以包括开关晶体管Tsw1，公共电极以及液晶。例如，像素101可以包括像素驱动单元PDU和发光单元。像素驱动单元PDU可以包括开关晶体管Tsw1和被供应公共电压Vcom的公共电极。在图2b中，参考数字Clc是指通过提供给公共电极的公共电压Vcom和提供给与开关晶体管Tsw1相连的像素电极的像素电压而在液晶中形成的存储电容。
当显示面板100是液晶显示面板时，显示装置可以进一步包括向液晶显示面板输出光的背光源。
应用于本公开的显示面板100可以采用为图2a和图2b所示的结构来形成，但是本公开并不局限于此。因此，除了图2a和2b显示的结构之外，应用于本公开的显示面板100可以以各种形式改变。
数据驱动器300向数据线DL1到DLd提供数据电压Vdata。
数据驱动器300可以在附着于显示面板100的第一非显示区域102a的薄膜500中提供，并且可以被安装在显示面板100中。
接下来，栅极驱动器200向栅极线GL1到GLg提供栅极信号GS。
栅极驱动器200可以配置成是集成电路，然后在第一非显示区域103a中提供，或者可以在薄膜500中提供。并且，栅极驱动器200可以使用面板内栅极(GIP)方案而被直接嵌入第一非显示区域103a中。
当在薄膜500中提供数据驱动器300时，栅极驱动器200也可以是在薄膜500中提供的。并且，当在第一非显示区域103a中提供数据驱动器300时，栅极驱动器200也可以通过使用板内栅极(GIP)方案而被嵌入第一非显示区域103a中，或者可以被配置成是集成电路(IC)然后在第一非显示区域103a中提供。
在将栅极驱动器200产生的栅极脉冲供应给在像素101中提供的开关晶体管Tsw1的栅极时，开关晶体管Tsw1将被导通。在将栅极关断信号提供给开关晶体管Tsw1时，开关晶体管Tsw1将被关断。提供给栅极线GL的栅极信号GS包括栅极脉冲和栅极关断信号。
从栅极驱动器200通过连接线CL提供给栅极线GL1到GLg的栅极脉冲GP被交替地从栅极线GL1到GLg的第一侧和第二侧输出。
在这种情况下，第一侧和第二侧彼此是基于作为边界的栅极线的中心部分C来划分的。
举例来说，在图1中，基于作为边界的栅极线的中心部分C，左侧可以是第一侧A，右侧可以是第二侧B。
在这种情况下，当与在第一侧A中提供的连接线CL相连的第k栅极线输出第k栅极脉冲时，第k+1栅极脉冲是从与在第二侧B中提供的第k+1连接线CL相连的第k+1栅极线输出的。在这种情况下，‘k’是小于‘g’的自然数。
然而，从栅极线GL1到GLg的中心部分C连续输出的两栅极脉冲GP可以是从第一侧A或第二侧B输出的。
关于栅极驱动器200的详细结构和功能将会参考图4到8来详细描述。
接下来，如图3所示，控制器400可以包括：数据对齐器430，用于使用从外部系统传送的时序同步信号TSS来重新对齐从外部系统传送的输入图像数据Ri、Gi和Bi以及将重新对齐的图像数据Data提供给数据驱动器300，控制信号生成器420，用于使用时序同步信号TSS来产生栅极控制信号GCS和数据控制信号DCS，输入单元410，用于接收从外部系统内传送的时序同步信号TSS和输入图像数据Ri、Gi和Bi并将其传送到数据对齐器430和控制信号生成器420，以及输出单元440，用于将数据对齐器430产生的图像数据Data和控制信号生成器420产生的控制信号DCS和GCS输出到数据驱动器300或栅极驱动器200。
从控制器400产生的栅极控制信号GCS包括栅极起始脉冲，栅极移位时钟以及栅极输出使能信号GOE。
最后，外部系统用于驱动控制器400和电子设备。也就是说，当电子设备是智能电话、平板电脑、电视、显示器等等时，外部系统可以通过无线通信网络或有线通信网络接收不同种类的语音信息、图像信息和文本信息，并且可以将接收到的图像信息传送到控制器400。该图像信息可以是输入图像数据Ri、Gi和Bi。
图4是示出了应用于根据本公开的显示装置的栅极驱动器的内部配置的示例图，以及图5示出了施加于根据本公开的显示装置的不同信号的波形。
应用于本公开的栅极驱动器200包括至少一栅极驱动器IC。在下文中将参考图1到5来描述包含了一栅极驱动器IC的发光显示装置。当栅极驱动器200包括一栅极驱动器IC(GIC)时，该栅极驱动器200可以是栅极驱动器IC(GIC)。
如图4所示，栅极驱动器200(即栅极驱动器IC GIC)包括：奇数移位寄存器210，其中包括沿着栅极驱动器200的第一侧到第二侧的方向而被驱动的奇数触发器211，偶数移位寄存器210，包括沿着栅极驱动器200的第二侧到第一侧的方向而被驱动的偶数触发器221，电平移位器单元230，用于放大从奇数移位寄存器210和偶数移位寄存器220按顺序传送的奇数移位时钟和偶数移位时钟，并且按顺序输出经过放大的移位时钟，以及缓冲器单元240，用于将经过电平移位器单元230放大的栅极脉冲GP按顺序输出到栅极线GL1到GLg。
在这种情况下，如上所述，第一侧A可以是基于作为边界的栅极线的中心部分C的左侧，并且第二侧B可以是基于作为边界的栅极线的中心部分C的右侧。当栅极驱动器200在栅极线的中心部分C被对齐时，栅极驱动器200的左侧可以是第一侧A，并且其右侧可以是第二侧B。
作为示例，从第一侧到第二侧的方向可以是指图4中的X1显示的箭头方向，并且从第二侧到第一侧的方向可以是指图4中的X2显示的箭头方向。
因此，在以下描述中，从第一侧到第二侧的方向指的是从显示面板100或栅极驱动器200或栅极驱动器IC(GIC)的左侧到右侧的方向，并且从第二侧到第一侧的方向指的是从显示面板100或栅极驱动器200或栅极驱动器IC(GIC)的右侧到左侧的方向。
奇数移位寄存器210包括奇数触发器211。奇数触发器211在从第一侧到第二侧的方向(X方向)上被按顺序驱动，以便按顺序输出奇数移位时钟OSC。
偶数移位寄存器220包括偶数触发器221。偶数触发器221在从第二侧到第一侧的方向(X2方向)上被按顺序驱动，以便按顺序输出偶数移位时钟ESC。
举例来说，在如图5所示提供奇数栅极起始脉冲GSP1时，奇数移位寄存器210会被驱动。奇数栅极起始脉冲GSP1是奇数起始控制信号。奇数栅极起始脉冲GSP1可以是控制器400生成的栅极控制信号GCS之一。也就是说，控制器400可以通过使用时序同步信号TSS来产生奇数栅极起始脉冲GSP1。然而，奇数栅极起始脉冲GSP1可以通过使用控制器400生成的栅极移位时钟GSC直接从栅极驱动器200中产生。
在如图5所示提供偶数栅极起始脉冲GSP2时，偶数移位寄存器220将被驱动。偶数栅极起始脉冲GSP2是偶数起始控制信号。偶数栅极起始脉冲GSP2可以是控制器400产生的栅极控制信号GCS之一。也就是说，控制器400可以通过使用时序同步信号TSS来产生偶数栅极起始脉冲GSP2。然而，偶数栅极起始脉冲GSP2可以通过使用控制器400生成的栅极移位时钟GSC直接从栅极驱动器200中产生。
在将用于输出高电平的奇数栅极起始脉冲GSP2的时段称为两水平周期时，输出高电平的偶数栅极起始脉冲GSP2的时段也被称为两水平周期。在向奇数移位寄存器220供应了高电平的奇数栅极起始脉冲GSP1之后，具有高电平的偶数栅极起始脉冲GSP2被提供给偶数移位寄存器220。
奇数移位寄存器210通过使用奇数栅极移位时钟GSC1来产生奇数移位时钟OSC。构成奇数栅极移位时钟GSC1的高电平宽度可以是两水平周期2H。
例如，构成奇数移位寄存器210的奇数触发器211可以按顺序输出与高电平的奇数栅极移位时钟GSC1相对应的信号。从每个奇数触发器211输出的信号被称为奇数移位时钟OSC。
偶数移位寄存器220通过使用偶数栅极移位时钟GSC2来产生偶数移位时钟ESC。构成偶数栅极移位时钟GSC2的高电平宽度可以是两水平周期2H。
举例来说，构成偶数移位寄存器220的偶数触发器221可以按顺序输出与高电平的偶数栅极移位时钟GSC2相对应的信号。从每个偶数触发器221输出的信号被称为偶数移位时钟ESC。
更详细地说，当在构成奇数移位寄存器210的奇数触发器211的第一侧的末端提供的奇数触发器被从第一侧供应的奇数栅极起始脉冲GSP1驱动时，从第一侧到第二侧提供的奇数触发器会被按顺序驱动，以便按顺序输出奇数移位时钟OSC。
此外，当在构成偶数移位寄存器220的偶数触发器221的第二侧的末端提供的偶数触发器被从第二侧供应的偶数栅极起始脉冲GSP2驱动时，从第二侧到第一侧提供的偶数触发器221会被按顺序驱动，以便按顺序输出偶数移位时钟ESC。
在这种情况下，奇数触发器211和偶数触发器221被交替地驱动。因此，奇数移位时钟OSC和偶数移位时钟ESC是交替输出的。
接下来，电平移位器单元230放大按顺序从奇数移位寄存器211和偶移位寄存器221传送的奇数移位时钟OSC和偶数移位时钟ESC，并且按顺序输出经过放大的奇数移位时钟OSC和偶数移位时钟ESC。.
为此目的，电平移位器单元230包括与奇数触发器211和偶数触发器221相连的电平移位器。
奇数触发器211与电平移位器中的奇数电平移位器231相连，并且偶数触发器221与电平移位器中的偶数电平移位器232相连。
最后，缓冲器单元240依照第一栅极输出使能信号GOE1和第二栅极输出使能信号GOE2而将从电平移位器单元230顺序提供的移位脉冲按顺序输出到栅极线GL1到GLg。
栅极脉冲GP的脉冲宽度等于奇数移位时钟OSC的脉冲宽度和偶数移位时钟ESC的脉冲宽度。
缓冲器单元240包括用于存储从电平移位器单元230按顺序提供的移位脉冲的缓冲器。
奇数电平移位器231与缓冲器中的奇数缓冲器241相连，并且偶数电平移位器232与偶数缓冲器242相连。
奇数移位脉冲OSP被存储在奇数缓冲器241中，并且偶数移位脉冲ESP被存储在偶数缓冲器242中。在这种情况下，奇数移位脉冲OSP和偶数移位脉冲ESP是栅极脉冲。也就是说，为了便于描述，提供给缓冲器241和242的信号将被称为奇数移位脉冲OSP和偶数移位脉冲ESP，并且从缓冲器241和242输出的信号将被称为栅极脉冲。
第一栅极输出使能信号GOE1和第二栅极输出使能信号GOE2被提供给偶数缓冲器242和奇数缓冲器241。
在本公开中，如图5所示，当第一栅极移位时钟GSC1从高电平下降到低电平或者第二栅极移位时钟GSC2从低电平上升到高电平时，构成第一栅极输出使能信号GOE1的脉冲被输出到偶数缓冲器242，并且当第二栅极移位时钟GSC2从高电平下降到低电平或者第一栅极移位时钟GSC1从低电平上升到高电平时，构成第二栅极输出使能信号GOE2的脉冲被输出到奇数缓冲器241。
第一栅极输出使能信号GOE1和第二栅极输出使能信号GOE2可以如图5所示由栅极输出使能信号GOE来产生。该栅极输出使能信号GOE可以由控制器400产生。第一栅极输出使能信号GOE1和第二栅极输出使能信号GOE2可以由控制器400产生，然后被传送到栅极驱动器200，并且可以是在栅极驱动器200中使用栅极输出使能信号GOE产生的。
在这种情况下，通过奇数移位时钟OSC产生的奇数栅极脉冲通过连接线CL中的奇数连接线输出到栅极线中的奇数栅极线。并且，偶数移位时钟ESC产生的偶数栅极脉冲通过连接线CL中的偶数连接线输出到栅极线中的偶数栅极线。
在这种情况下，当栅极驱动器的第一到第g端口P1到Pg按照图4所示的一对一的关系与缓冲器单元240中从第一侧A(左侧)到第二侧B(右侧)提供的缓冲器241和242相连时，第一端口P1通过第一连接线CL1与第一栅极线GL1相连，第二端口P2通过第g连接线CLg与第g栅极线GLg相连，第g-1端口Pg-1通过第g-1连接线Clg-1与第g-1栅极线GLg-1相连，以及第g端口Pg通过第二连接线CL2与第二栅极线GL2相连。
在奇数缓冲器241中，与第一端口P1相连的缓冲器最先被驱动，由此输出第一栅极脉冲GP1。第一端口P1通过第一连接线CL1与第一栅极线GL1相连。因此，从第一端口P1输出的第一栅极脉冲GP1通过第一连接线CL1输出到第一栅极线GL1。此后，奇数缓冲器241从第一侧A起被按顺序驱动，以便按顺序输出栅极脉冲。
在偶数缓冲器242中，与第g端口Pg相连的缓冲器最先被驱动，由此输出第二栅极脉冲GP2。第g端口Pg通过第二连接线CL2与第二栅极线GL2相连。由此，从第g端口Pg输出的第二栅极脉冲GP2通过第二连接线CL2输出到第二栅极线GL2。此后，偶数缓冲器242从第二侧B起被按顺序驱动，以便按顺序输出栅极脉冲。
在这种情况下，奇数缓冲器241和偶数缓冲器242被交替地驱动。由此，提供给奇数栅极线的栅极脉冲和提供给偶数栅极线的栅极脉冲是交替输出的。
奇数缓冲器241被第二栅极输出使能信号GOE2驱动以输出奇数栅极脉冲，并且偶数缓冲器242被第一栅极输出使能信号GOE1驱动以输出偶数栅极脉冲。
在这种情况下，与在栅极驱动器200的第一侧A中提供的奇数缓冲器241和偶数缓冲器242相连的连接线CL连接到栅极线GL1到GLg的第一侧。与在栅极驱动器200的第二侧B中提供的另一个奇数缓冲器241和另一个偶数缓冲器242相连的连接线CL连接到栅极线GL1到GLg的第二侧。
因此，从栅极驱动器200通过连接线CL提供给栅极线GL1到GLg的栅极脉冲GP1到GPg可以被交替地输出到栅极线的第一侧和第二侧。
以下将会参考图6到8来描述用于将栅极脉冲交替地输出到栅极线的第一侧和第二侧的方法。
图6是示出了应用于根据本公开的显示装置的连接线与栅极线的连接关系的示例图。特别地，图6示出了配有八栅极线的显示面板。也就是说，配有八栅极线的显示面板将被作为本公开的一个示例来描述。
在本公开中，如上所述，从栅极驱动器200通过连接线CL提供给栅极线GL的栅极脉冲GP被交替地输出到栅极线GL的第一侧和第二侧。
为此目的，如图6所示，在连接线CL的第一侧A与栅极驱动器200相连的第一侧连接线CLA连接到栅极线GL1的第一侧A，并且在连接线CL的第二侧B与栅极驱动器200相连的第二侧连接线CLB连接到栅极线GL的第二侧B。
并且，第一侧连接线CLA交替连接到栅极线GL1中的奇数栅极线和偶数栅极线，并且第二侧连接线CLB交替连接到栅极线GL中的另一条奇数栅极线和另一条偶数栅极线。
更详细地说，显示面板包括与栅极驱动器200相连的第一到第g连接线CL1到CLg，以及与第一到第g连接线CL1到CLg相连的第一到第g栅极线GL1到GLg。
连接线CL1到CLg中的第一侧连接线CLA连接到第一到第(g/2)-1栅极线GL1到GL(g/2)-1中的奇数栅极线以及第g到第(g/2)+2栅极线GLg到GL(g/2)+2中的偶数栅极线。
连接线CL1到CLg中的第二侧连接线CLB连接到第(g/2)+1到第g栅极线GL(g/2)+1到GLg中的奇数栅极线以及第g/2栅极线到第一栅极线GL(g/2)到GL1中的偶数栅极线。
在这种情况下，第一侧连接线交替地连接到第一到第(g/2)-1栅极线中的奇数栅极线以及第g到第(g/2)+2栅极线中的偶数栅极线。
第二侧连接线交替地连接到第(g/2)+1到第g栅极线中的奇数栅极线以及第g/2到第一栅极线中的偶数栅极线。
以下将参考图6来描述如上所述的结构。为了描述方便，图6示出了一个配有八栅极线GL1到GL8的显示面板100。
也就是说，在图6中提供了与八栅极线GL1到GL8相连的八连接线CL1到CL8。
在这种情况下，第一连接线CL1、第八连接线CL8、第三连接线CL3和第六连接线CL6包含在第一侧连接线CLA中。第五连接线CL5、第四连接线CL4、第七连接线CL7和第二连接线CL2包含在第二侧连接线CLB中。
第一连接线CL1、第八连接线CL8、第三连接线CL6、第六连接线CL6、第五连接线CL5、第四连接线CL7、第七连接线CL7和第二连接线CL2连接到栅极驱动器200的第一到第八端口P1到P8。
也就是说，第一连接线CL1与第一端口P1相连，第八连接线CL8与第二端口P2相连，第三连接线CL3与第三端口P3相连，第六连接线CL6与第四端口P4相连，第五连接线CL5与第五端口P5相连，连接线CL4与第六端口P6相连，第七连接线CL7与第七端口P7相连，以及第二连接线CL2与第八端口P8相连。
端口P的编号是从栅极驱动器200的第一侧A到第二侧B按顺序给出的，并且连接线CL的编号和与连接线CL相连的栅极线GL的编号相对应。也就是说，与第一端口P1相连的第一连接线CL1连接到第一栅极线GL1，并且与第八端口P8(最后一端口)相连的第二连接线CL2连接到第二栅极线GL2。
在这种情况下，奇数端口连接到奇数移位寄存器210，并且偶数端口连接到偶数移位寄存器220。
特别地，如图4所示，端口P实质上连接到缓冲器241和242，但为了描述方便，在图6中，这些端口连接到奇数移位寄存器210和偶数移位寄存器220。换句话说，图6显示了奇数移位寄存器210、偶数移位寄存器220、端口P以及连接线CL的关系。
更详细地说，如图4所示，由奇数移位寄存器210提供的奇数移位时钟OSC产生的栅极脉冲通过奇数缓冲器241输出到奇数端口，并且由偶数移位寄存器220提供的偶数移位时钟ESC产生的栅极脉冲通过偶数缓冲器242输出到偶数端口。
因此，为了描述方便，在图6中显示了与奇数移位寄存器210相连的奇数端口以及与偶数移位寄存器220相连的偶数端口。
也就是说，如图6所示，包含在第一侧连接线CLA中的第一连接线CL1、第八连接线CL8、第三连接线CL3以及第六连接线CL6连接到第一栅极线GL1、第八栅极线GL8、第三栅极线GL3以及第六栅极线GL6。
在这种情况下，第一侧连接线CLA交替地连接到奇数栅极线和偶数栅极线。
此外，如图6所示，包含在第二侧连接线CLA中的第五连接线CL5、第四连接线CL4、第七连接线CL7以及第二连接线CL2连接到第五栅极线GL5、第四栅极线GL4、第七栅极线GL7以及第二栅极线GL2。
在这种情况下，第二侧连接线CLB同样交替地连接到奇数栅极线和偶数栅极线。
在具有如上所述的结构的发光显示装置中输出栅极脉冲的顺序将如下所述。
首先，通过第一栅极线GL1的第一侧输出通过与第一端口P1相连的第一连接线CL1输出的第一栅极脉冲。
接着，通过第二栅极线GL2的第二侧输出通过与第八端口P8相连的第二连接线CL2输出的第二栅极脉冲。
通过第三栅极线GL3的第一侧输出通过与第三端口P3相连的第三连接线CL3输出的第三栅极脉冲。
通过第四栅极线GL4的第二侧输出通过与第六端口P6相连的第四连接线CL4输出的第四栅极脉冲。
接着，通过第五栅极线GL5的第二侧输出通过与第五端口P5相连的第五连接线CL5输出的第五栅极脉冲。
接着，通过第六栅极线GL6的第一侧输出通过与第四端口P4相连的第六连接线CL6输出的第六栅极脉冲。
接着，通过第七栅极线GL7的第二侧输出通过与第七端口P7相连的第七连接线CL7输出的第七栅极脉冲。
最后，通过第八栅极线GL8的第一侧输出通过与第二端口P2相连的第八连接线CL8输出的第八栅极脉冲。
根据上述公开，从栅极驱动器200通过连接线CL提供给栅极线GL的栅极脉冲GP被交替地输出到栅极线GL的第一侧和第二侧。
在这种情况下，持续输出到在栅极线GL的中心部分C中提供的两连接线可以是从第一侧输出的或是从第二侧输出的。
举例来说，在图6中，通过第四连接线CL4和第五连接线CL5连续输出的第四栅极脉冲和第五栅极脉冲是从第四栅极线GL4和第五栅极线GL5的第二侧B输出的。
图7是示出了应用于根据本公开的显示装置的连接线和栅极线的连接关系的另一个示例图。特别地，图7示出了一个配有十六栅极线的显示面板。也就是说，配有十六栅极线的显示面板将被作为本公开的一个示例来描述。并且，图7所示的栅极驱动器200包括两栅极驱动器IC(GIC)。在以下描述中，与参考图1到6所述的描述相同或相似的描述将被省略或简要描述。
如上所述，根据本公开的一个实施例的栅极驱动器200可以包括至少两栅极驱动器IC GIC1和GIC2。
如图4所示，至少两栅极驱动器IC GIC1和GIC2中的每一个包括奇数移位寄存器210，偶数移位寄存器220，电平移位器单元230以及缓冲器单元240。
在这种情况下，当至少两栅极驱动器IC包括从第一侧(A)方向到第二侧的方向上提供的第一到第n栅极驱动器IC(n是自然数)时，第一到第n栅极驱动器IC是由从与之相邻的栅极驱动器IC或控制器400传送的起始控制信号驱动的。
在第m栅极驱动器IC中提供的奇数移位寄存器是依照从在第m-1栅极驱动器IC中提供的奇数移位寄存器传送的奇数起始控制信号SP1驱动的，以及在第m-1栅极驱动器IC中提供的偶数移位寄存器是依照从在第m栅极驱动器IC中提供的偶数移位寄存器传送的偶数起始控制信号SP2驱动的，其中‘m’小于或等于‘n’。
作为示例，如图7所示，当栅极驱动器200包括两栅极驱动器IC GIC1和GIC2时，在第二栅极驱动器IC GIC2中提供的奇数移位寄存器210是依照从在第一栅极驱动器IC GIC1中提供的奇数移位寄存器210传送的奇数起始控制信号SP1驱动的。在第一栅极驱动器ICGIC1中提供的偶数移位寄存器220是依照从在第二栅极驱动器IC GIC2中提供的偶数移位寄存器220传送的偶数起始控制信号SP2驱动的。
在这种情况下，在第一栅极驱动器IC GIC1中提供的奇数移位寄存器210是依照从控制器400传送的奇数起始控制信号SP1(即奇数栅极起始脉冲GSP1)驱动的，并且在第二栅极驱动器IC GIC2中提供的偶数移位寄存器220是依照根据从控制器400传送的偶数起始控制信号SP2(即偶数栅极起始脉冲GSP2)驱动的。
在本公开中，如上所述，从栅极驱动器200通过连接线CL提供给栅极线GL的栅极脉冲GP被交替地输出到栅极线GL的第一侧和第二侧。
以下将会描述在图7所示的发光显示装置中输出栅极脉冲的顺序。
首先，通过第一栅极线GL1的第一侧输出通过与第一端口P1相连的第一连接线CL1输出的第一栅极脉冲。
接着，通过第二栅极线GL2的第二侧输出通过与第十六端口P16相连的第二连接线CL2输出的第二栅极脉冲。
接着，通过第三栅极线GL3的第一侧输出通过与第三端口P3相连的第三连接线CL3输出的第三栅极脉冲。
接着，通过第四栅极线GL4的第二侧输出通过与第十四端口P14相连的第四连接线CL4输出的第四栅极脉冲。
接着，通过第五栅极线GL5的第一侧输出通过与第五端口P5相连的第五连接线CL5输出的第五栅极脉冲。
接着，通过第六栅极线GL6的第二侧输出通过与第十二端口P12相连的第六连接线CL6输出的第六栅极脉冲。
接着，通过第七栅极线GL7的第一侧输出通过与第七端口P7相连的第七连接线CL7输出的第七栅极脉冲。
通过第八栅极线GL8的第二侧输出通过与第十端口P10相连的第八连接线CL8输出的第八栅极脉冲。
通过第九栅极线GL9的第二侧输出通过与第九端口P9相连的第九连接线CL9输出的第九栅极脉冲。
通过第十栅极线GL10的第一侧输出通过与第八端口P8相连的第十连接线CL10输出的第十栅极脉冲。
通过第十一栅极线GL11的第二侧输出通过与第十一端口P11相连的第十一连接线CL11输出的第十一栅极脉冲。
接着，通过第十二栅极线GL12的第一侧输出通过与第六端口P6相连的第十二连接线CL12输出的第十二栅极脉冲。
接着，通过第十三栅极线GL13的第二侧输出通过与第十三端口P13相连的第十三连接线CL13输出的第十三栅极脉冲。
通过第十四栅极线GL14的第一侧输出通过与第四端口P4相连的第十四连接线CL14输出的第十四栅极脉冲。
接着，通过第十五栅极线GL15的第二侧输出通过与第十五端口P15相连的第十五连接线CL15输出的第十五栅极脉冲。
最后，通过第十六栅极线GL16的第一侧输出通过与第二端口P2相连的第十六连接线CL16输出的第十六栅极脉冲。
根据上述公开，从栅极驱动器200通过连接线CL提供给栅极线GL的栅极脉冲GP被交替地输出到栅极线GL的第一侧和第二侧。
在这种情况下，连续输出到在栅极线GL的中心部分C中提供的两连接线的两栅极脉冲可以是从第一侧输出或者从第二侧输出的。
举例来说，在图7中，按顺序通过第八连接线CL8和第九连接线CL9输出的第八栅极脉冲和第九栅极脉冲是从第八栅极线GL8和第九栅极线GL9的第二侧B输出的。
图8是示出了应用于根据本公开的显示装置的连接线与栅极线的连接关系的另一个示例图。特别地，图8示出了一个配有三十二栅极线的显示面板。也就是说，配有三十二栅极线的显示面板将被作为本公开的一个示例来描述。并且，图8所示的栅极驱动器200包括四栅极驱动器IC(GIC)。在以下描述中，与参考图1到7的描述相同或相似的描述将被省略或简要描述。
如上所述，应用于本公开的栅极驱动器200可以包括至少两栅极驱动器IC GIC1和GIC2。
如图4所示，至少两栅极驱动器IC GIC1和GIC2中的每一个包括奇数移位寄存器210，偶数移位寄存器220，电平移位器单元230以及缓冲器单元240。
在这种情况下，当至少两栅极驱动器IC包括从第一侧(A)到第二侧的方向提供的第一到第n栅极驱动器IC(n是自然数)时，第一到第n栅极驱动器IC是由从与之相邻的栅极驱动器IC或控制器400传送的起始控制信号驱动的。
在第m栅极驱动IC中提供的奇数移位寄存器是依照从在第m-1栅极驱动IC中提供的奇数移位寄存器传送的奇数起始控制信号SP1驱动的，并且在第m-1栅极驱动器IC中提供的偶数移位寄存器是依照从在第m栅极驱动器IC中提供的偶数移位寄存器传送的偶数起始控制信号SP2驱动的。
作为示例，如图8所示，当栅极驱动器200包括四栅极驱动器IC GIC1、GIC2、GIC3和GIC4时，在第一栅极驱动器IC GIC1中提供的奇数移位寄存器210是依照从控制器400传送的奇数起始控制信号SP1(即奇数栅极起始脉冲GSP1)驱动的，在第二栅极驱动器IC GIC2中提供的奇数移位寄存器210是依照从在第一栅极驱动器IC GIC1中提供的奇数移位寄存器210传送的奇数起始控制信号SP1驱动的，在第三栅极驱动器IC GIC3中提供的奇数移位寄存器210是依照从在第二栅极驱动器IC GIC2中提供的奇数移位寄存器210传送的奇数起始控制信号SP1驱动的，以及在第四栅极驱动器IC GIC4中提供的奇数移位寄存器210是依照从在第三栅极驱动器IC GIC3中提供的奇数移位寄存器210传送的奇数起始控制信号SP1驱动的。
此外，在第四栅极驱动器IC GIC4中提供的偶数移位寄存器220是依照从控制器400传送的偶数起始控制信号SP2(即偶数栅极起始脉冲GSP2)驱动的，在第三栅极驱动器ICGIC3中提供的偶数移位寄存器220是依照从在第四栅极驱动器IC GIC4中提供的偶数移位寄存器220传送的偶数起始控制信号SP2驱动的，在第二栅极驱动器IC GIC2中提供的偶数移位寄存器220是依照从在第三栅极驱动器IC GIC3中提供的偶数移位寄存器220传送的偶数起始控制信号SP2驱动的，以及在第一栅极驱动器IC GIC1中提供的偶数移位寄存器220是依照从在第二栅极驱动器IC GIC1中提供的偶数移位寄存器220传送的偶数起始控制信号SP2驱动的。
在本公开中，如上所述，从栅极驱动器200通过连接线CL提供给栅极线GL的栅极脉冲GP被交替地输出到栅极线GL的第一侧和第二侧。
以下将会描述在图8所示的发光显示装置中输出栅极脉冲的顺序。
首先，通过第一栅极线GL1的第一侧输出通过与第一端口P1相连的第一连接线CL1输出的第一栅极脉冲。
接着，通过第二栅极线GL2的第二侧输出通过与第三十二端口P32相连的第二连接线CL2输出的第二栅极脉冲。
接着，通过第三栅极线GL3的第一侧输出通过与第三端口P3相连的第三连接线CL3输出的第三栅极脉冲。
接着，通过第四栅极线GL4的第二侧输出通过与第三十端口P30相连的第四连接线CL4输出的第四栅极脉冲。
接着，通过第五栅极线GL5的第一侧输出通过与第五端口P5相连的第五连接线CL5输出的第五栅极脉冲。
接着，通过第六栅极线GL6的第二侧输出通过与第二十八端口P28相连的第六连接线CL6输出的第六栅极脉冲。
接着，通过第七栅极线GL7的第一侧输出通过与第七端口P7相连的第七连接线CL7输出的第七栅极脉冲。
接着，通过第八栅极线GL8的第二侧输出通过与第二十六端口P26相连的第八连接线CL8输出的第八栅极脉冲。
通过第九栅极线GL9的第一侧输出通过与第九端口P9相连的第九连接线CL9输出的第九栅极脉冲。
通过第十栅极线GL10的第二侧输出通过与第二十四端口P24相连的第十连接线CL10输出的第十栅极脉冲。
通过第十一栅极线GL11的第一侧输出通过与第十一端口P11相连的第十一连接线CL11输出的第十一栅极脉冲。
通过第十二栅极线GL12的第二侧输出通过与第二十二端口P22相连的第十二连接线CL12输出的第十二栅极脉冲。
接着，通过第十三栅极线GL13的第一侧输出通过与第十三端口P13相连的第十三连接线CL13输出的第十三栅极脉冲。
接着，通过第十四栅极线GL14的第二侧输出通过与第二十端口P20相连的第十四连接线CL14输出的第十四栅极脉冲。
通过第十五栅极线GL15的第一侧输出通过与第十五端口P15相连的第十五连接线CL15输出的第十五栅极脉冲。
接着，通过第十六栅极线GL16的第二侧输出通过与第十八端口P18相连的第十六连接线CL16输出的第十六栅极脉冲。
接着，通过第十七栅极线GL17的第二侧输出通过与第十七端口P17相连的第十七连接线CL17输出的第十七栅极脉冲。
通过第十八栅极线GL18的第一侧输出通过与第十六端口P16相连的第十八连接线CL18输出的第十八栅极脉冲。
通过第十九栅极线GL19的第二侧输出通过与第十九端口P19相连的第十九连接线CL19输出的第十九栅极脉冲。
接着，通过第二十栅极线GL20的第一侧输出通过与第十四端口P14相连的第二十连接线CL20输出的第二十栅极脉冲。
接着，通过第二十一栅极线GL21的第二侧输出通过与第二十一端口P21相连的第二十一连接线CL21输出的第二十一栅极脉冲。
接着，通过第二十二栅极线GL22的第一侧输出通过与第十二端口P12相连的第二十二条连接线CL22输出的第二十二栅极脉冲。
接着，通过第二十三栅极线GL23的第二侧输出通过与第二十三端口P23相连的第二十三连接线CL23输出的第二十三栅极脉冲。
接着，通过第二十四栅极线GL24的第一侧输出通过与第十端口P10相连的第二十四连接线CL24输出的第二十四条栅极脉冲。
接着，通过第二十五栅极线GL25的第二侧输出通过与第二十五端口P25相连的第二十五连接线CL25输出的第二十五栅极脉冲。
接着，通过第二十六栅极线GL26的第一侧输出通过与第八端口P8相连的第二十六连接线CL26输出的第二十六条栅极脉冲。
接着，通过第二十七栅极线GL27的第二侧输出通过与第二十七端口P27相连的第二十七连接线CL27输出的第二十七栅极脉冲。
接下来，通过第二十八栅极线GL28的第一侧输出通过与第六端口P6相连的第二十八连接线CL28输出的第二十八栅极脉冲。
接着，通过第二十九栅极线GL29的第二侧输出通过与第二十九端口P29相连的第二十九连接线CL29输出的第二十九栅极脉冲。
接着，通过第三十栅极线GL30的第一侧输出通过与第四端口P4相连的第三十连接线CL30输出的第三十栅极脉冲。
接着，通过第三十一栅极线GL31的第二侧输出通过与第三十一端口P31相连的第三十一连接线CL31输出的第三十一栅极脉冲。
最后，通过第三十二条栅极线GL32的第一侧输出通过与第二端口P2相连的第三十二连接线CL32输出的第三十二栅极脉冲。
根据上述公开，从栅极驱动器200通过连接线CL提供给栅极线GL的栅极脉冲GP被交替地输出到栅极线GL的第一侧和第二侧。
在这种情况下，连续输出到在栅极线GL的中心部分C中提供的两连接线的两栅极脉冲可以是从第一侧输出或者从第二侧输出的。
作为示例，在图8中，通过第十六连接线CL16和第十七连接线CL17连续输出的第十六栅极脉冲和第十七栅极脉冲是从第十六栅极线GL16和第十七栅极线GL17的第二侧B输出的。
根据上述公开，可以从显示面板100的左侧和右侧交替地输出栅极脉冲。因此，在显示面板100的左侧与右侧之间不会出现亮度差。因此可以提升根据本公开的显示装置的质量。
根据本公开，可以获得以下有益效果。
根据本公开，可以按顺序从栅极线的一侧和另一侧输出栅极脉冲，由此在栅极线的一侧与另一侧中不会出现亮度差异。
也就是说，根据本公开，在显示面板的一侧和另一侧中不会出现亮度差异，由此可以提高显示装置的质量。
对本领域技术人员来说，很明显，上述公开并不受上述实施例和附图限制，并且在不脱离本公开的实质或范围的情况下，在本公开中是可以进行各种替换、修改和改变的。因此，本公开的范围由附加权利要求限定，并且从权利要求的含义、范围和等效概念中推导出的所有变化或修改都应该落入本公开的范围以内。

Claims (18)

1.一种显示装置，包括：
在显示区域之外配有四个非显示区域的显示面板；
在所述四个非显示区域中的第一非显示区域中提供的栅极驱动器；
在所述第一非显示区域中提供的数据驱动器；以及
用于控制所述栅极驱动器和所述数据驱动器的控制器，
其中与从所述栅极驱动器伸出的连接线相连的栅极线是在与提供所述连接线的第一方向不同的第二方向上提供的，
从所述栅极驱动器通过所述连接线提供给所述栅极线的栅极脉冲是从所述栅极线的第一侧和第二侧交替输出的，以及
所述栅极线的所述第一侧和所述第二侧彼此是在所述第一方向上划分的。
2.如权利要求1所述的显示装置，其中所述栅极线的所述第一侧和所述第二侧彼此是基于作为边界的所述栅极线的中心部分划分的。
3.如权利要求1所述的显示装置，其中在所述栅极线的所述第一侧与所述栅极驱动器相连的所述连接线中的第一侧连接线与所述栅极线的所述第一侧相连，以及
在所述栅极线的所述第二侧与所述栅极驱动器相连的所述连接线中的第二侧连接线与所述栅极线的所述第二侧相连。
4.如权利要求3所述的显示装置，其中所述第一侧连接线被交替地连接到所述栅极线中的奇数栅极线和偶数栅极线，以及
所述第二侧连接线被交替地连接到所述栅极线的另一条奇数栅极线和另一条偶数栅极线。
5.如权利要求3所述的显示装置，其中所述显示面板配有与所述栅极驱动器相连的第一到第g连接线以及与所述第一到第g连接线相连的第一到第g栅极线，
所述连接线中的所述第一侧连接线连接到所述第一到第(g/2)-1栅极线中的奇数栅极线以及所述第g到第(g/2)+2栅极线中的偶数栅极线，
所述连接线中的所述第二侧连接线连接到第(g/2)+1到第g栅极线中的奇数栅极线以及第g/2到第一栅极线中的偶数栅极线，以及
‘g’是自然数中的偶数。
6.如权利要求5所述的显示装置，其中所述第一侧连接线被交替地连接到所述第一到第(g/2)-1栅极线中的奇数栅极线和第g条到第(g/2)+2栅极线中的偶数栅极线，以及
所述第二侧连接线被交替地连接到所述第(g/2)+1到第g栅极线中的奇数栅极线以及第g/2到第g栅极线中的偶数栅极线。
7.如权利要求1所述的显示装置，其中所述栅极驱动器包括至少一栅极驱动器IC，
所述栅极驱动器IC包括：
奇数移位寄存器，包括沿着所述栅极驱动器的所述第一侧到所述第二侧的方向驱动的奇数触发器；
偶数移位寄存器，包括沿着所述栅极驱动器的所述第二侧到所述第一侧的方向驱动的偶数触发器；
电平移位器单元，用于放大按顺序从所述奇数移位寄存器和所述偶数移位寄存器传送的奇数移位时钟和偶数移位时钟，并且按顺序输出所述经过放大的奇数移位时钟和所述经过放大的偶数移位时钟；以及
缓冲器单元，用于按顺序将经过所述电平移位器单元放大的栅极脉冲依次输出到所述栅极线。
8.如权利要求7所述的显示装置，其中所述奇数触发器沿着从所述第一侧到所述第二侧的方向按顺序驱动，以便按顺序输出所述奇数移位时钟，以及
所述偶数触发器沿着从所述第二侧到所述第一侧的方向按顺序驱动，以便按顺序输出所述偶数移位时钟。
9.如权利要求8所述的显示装置，其中所述奇数触发器和所述偶数触发器是被交替驱动的。
10.如权利要求8所述的显示装置，其中所述奇移位时钟产生的奇数栅极脉冲被输出到所述栅极线中的所述奇数栅极线，以及
所述偶数移位时钟产生的偶数栅脉冲被输出到所述栅极线中的所述偶数栅极线。
11.如权利要求1所述的显示装置，其中所述栅极驱动器包括至少两栅极驱动器IC，
每一个所述栅极驱动器IC包括：
奇数移位寄存器，包括沿着从所述栅极驱动器的所述第一侧到所述第二侧的方向驱动的奇数触发器；
偶数移位寄存器，包括沿着从所述栅极驱动器的所述第二侧到所述第一侧的方向驱动的偶数触发器；
电平移位器单元，用于放大按顺序从所述奇数移位寄存器和所述偶数移位寄存器传送的奇数移位时钟和偶数移位时钟，以及按顺序输出所述经过放大的奇数移位时钟和所述经过放大的偶数移位时钟；以及
缓冲器单元，用于按顺序将经过所述电平移位器单元放大的栅极脉冲输出到所述栅极线，
其中所述至少两栅极驱动器IC包括从沿着从所述第一侧到所述第二侧的方向提供的第一到第n栅极驱动器IC(n是自然数)，以及
所述第一到第n栅极驱动器IC由与其相邻的栅极驱动器IC或控制器传送的起始控制信号驱动。
12.如权利要求11所述的显示装置，其中在第m栅极驱动IC中提供的奇数移位寄存器是依照从在第(m-1)栅极驱动器IC中提供的奇数移位寄存器传送的奇数起始控制信号驱动的，
在第m-1栅极驱动器IC中提供的偶数移位寄存器是依照从在第m栅极驱动器IC中提供的偶数移位寄存器传送的偶数起始控制信号驱动的，以及
‘m’是自然数且小于或等于‘n’。
13.如权利要求1所述的显示装置，其中被连续输出到在所述栅极线的所述中心部分中提供的两连接线的两栅极脉冲是从所述第一侧输出或者从所述第二侧输出的。
14.一种显示装置，包括：
具有显示区域和非显示区域的显示面板，所述非显示区域在所述显示区域之外；
定位在所述非显示区域中的栅极驱动器；
栅极线，所述栅极线包括：
在第二方向上延伸的奇数栅极线；和
在所述第二方向上延伸的偶数栅极线；和
连接线，所述连接线包括：
在不同于所述第二方向的第一方向上延伸的第一侧连接线，所述第一侧连接线定位在所述栅极线的第一侧上；
在所述第一方向上延伸的第二侧连接线，所述第二侧连接线定位
在所述栅极线的第二侧上，所述第二侧和所述第一侧在所述栅极线的中心部分的相对侧上；
其中从所述栅极驱动器通过所述连接线提供给所述栅极线的栅极脉冲是从所述栅极线的所述第一侧和所述第二侧交替输出的。
15.如权利要求14所述的显示装置，其中
所述栅极线包括：
第一栅极线；
第四栅极线；
在所述第一栅极线和所述第四栅极线之间的第二栅极线；和
在所述第二栅极线和所述第四栅极线之间的第三栅极线；并且
所述连接线包括：
连接到所述第一栅极线的第一连接线；
连接到所述第二栅极线的第二连接线；
连接到所述第三栅极线的第三连接线；和
连接到所述第四栅极线的第四连接线；
其中所述第一连接线和所述第三连接线在所述第一侧上，所述第二连接线和所述第四连接线在所述第二侧上。
16.如权利要求15所述的显示装置，其中，在操作中，在通过所述第一栅极线接收的第一栅极脉冲和通过所述第三栅极线接收的第三栅极脉冲之间通过所述第二栅极线接收第二栅极脉冲。
17.如权利要求15所述的显示装置，其中
所述第一栅极线和所述第三栅极线基于奇数移位寄存器的奇数触发器的输出接收奇数栅极脉冲，且
所述第二栅极线和所述第四栅极线基于偶数移位寄存器的偶数触发器的输出接收偶数栅极脉冲。
18.如权利要求15所述的显示装置，其中
所述奇数触发器在所述第一侧上，且所述偶数触发器在所述第二侧上。
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