CN114495822A - 像素电路及其驱动方法和显示面板 - Google Patents

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盖翠丽
郭恩卿
李俊峰
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Abstract

本发明实施例公开了一种像素电路及其驱动方法和显示面板。其中，像素电路包括：数据写入模块、第一存储模块、第二存储模块、补偿控制模块和驱动模块；第一存储模块的第一端连接驱动模块的控制端，第一存储模块的第二端连接补偿控制模块的第一端，补偿控制模块的第二端连接驱动模块的第二端；数据写入模块用于在初始化阶段向补偿控制模块的两端写入第一初始化电压，以及，数据写入模块还用于在数据写入阶段向第二存储模块写入数据电压并存储；第一存储模块用于在补偿阶段存储驱动模块的阈值电压信息，以及在数据写入阶段将第二存储模块存储的电压耦合至驱动模块的控制端。本发明实施例的技术方案，有助于提高显示面板的显示亮度均一性，从而提升显示效果。

Description

像素电路及其驱动方法和显示面板
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种像素电路及其驱动方法和显示面板。
背景技术
随着显示技术的不断发展，人们对于显示面板的性能要求越来越高。显示面板中包括像素电路，不同像素电路中的晶体管存在特性差异，例如，不同像素电路中的晶体管的阈值电压存在差异。目前，现有技术中的像素电路对于晶体管的阈值电压补偿效果较差，导致显示面板存在亮度均一性较差的问题，影响了显示效果。
发明内容
本发明实施例提供一种像素电路及其驱动方法和显示面板，以提高显示面板的显示亮度均一性，从而提升显示效果。
第一方面，本发明实施例提供了一种像素电路，包括：数据写入模块、第一存储模块、第二存储模块、补偿控制模块和驱动模块；
所述第一存储模块的第一端连接所述驱动模块的控制端，所述第一存储模块的第二端连接所述补偿控制模块的第一端，所述补偿控制模块的第二端连接所述驱动模块的第二端，所述第二存储模块与所述数据写入模块均连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述数据写入模块用于在初始化阶段向所述补偿控制模块的两端写入第一初始化电压，以及，所述数据写入模块还用于在数据写入阶段向所述第二存储模块写入数据电压并存储；
所述第一存储模块用于在补偿阶段存储所述驱动模块的阈值电压信息，以及在数据写入阶段将所述第二存储模块存储的电压耦合至所述驱动模块的控制端；
所述驱动模块用于在发光阶段驱动发光器件发光。
可选地，所述数据写入模块包括第一晶体管，所述第一晶体管的栅极接入第一扫描信号，所述第一晶体管的第一极连接电压输入端，所述第一晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；
其中，所述电压输入端在所述初始化阶段接入所述第一初始化电压，在所述数据写入阶段接入所述数据电压。
可选地，还包括初始化模块，用于在所述初始化阶段向所述驱动模块的控制端写入第二初始化电压；
优选地，所述初始化模块包括第二晶体管，所述第二晶体管的栅极接入第二扫描信号，所述第二晶体管的第一极接入所述第二初始化电压，所述第二晶体管的第二极连接所述驱动模块的控制端。
可选地，所述第一初始化电压和所述第二初始化电压均小于所述发光器件的启亮电压，且所述第一初始化电压小于所述第二初始化电压。
可选地，所述第一存储模块包括第一电容，所述第二存储模块包括第二电容，所述补偿控制模块包括第三晶体管，所述驱动模块包括驱动晶体管；
所述第一电容的第一极连接所述驱动晶体管的栅极，所述第一电容的第二极连接所述第三晶体管的第二极；
所述第三晶体管的栅极接入第二扫描信号，所述第三晶体管的第一极连接所述驱动晶体管的第二极；
所述第二电容的第一极连接所述第一电容的第二极和所述第三晶体管的第二极，所述第二电容的第二极接入固定电压。
可选地，所述数据写入模块包括第四晶体管和第五晶体管；
所述第四晶体管的栅极接入第三扫描信号，所述第四晶体管的第一极接入所述第一初始化电压，所述第四晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述第五晶体管的栅极接入第四扫描信号，所述第五晶体管的第一极接入所述数据电压，所述第五晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点。
可选地，还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的控制端接入第一发光控制信号，所述第一发光控制模块的第一端接入第一电源电压，所述第一发光控制模块的第二端连接所述驱动模块的第一端，所述第一发光控制模块用于响应所述第一发光控制信号而导通或关断；
所述第二发光控制模块的控制端接入第二发光控制信号，所述第二发光控制模块连接于所述驱动模块的第二端和所述发光器件的第一极之间，所述第二发光控制模块用于响应所述第二发光控制信号而导通或关断。
第二方面，本发明实施例还提供了一种像素电路的驱动方法，所述像素电路包括数据写入模块、第一存储模块、第二存储模块、补偿控制模块和驱动模块；所述第一存储模块的第一端连接所述驱动模块的控制端，所述第一存储模块的第二端连接所述补偿控制模块的第一端，所述补偿控制模块的第二端连接所述驱动模块的第二端，所述第二存储模块与所述数据写入模块均连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述像素电路的驱动方法包括：
在初始化阶段，控制所述补偿控制模块导通，以通过所述数据写入模块向所述补偿控制模块的两端写入第一初始化电压；
在补偿阶段，控制所述补偿控制模块导通，以使所述第一存储模块存储所述驱动模块的阈值电压信息；
在数据写入阶段，通过所述数据写入模块向所述第二存储模块写入数据电压并存储，以使所述第一存储模块将所述第二存储模块存储的电压耦合至所述驱动模块的控制端；
在发光阶段，通过所述驱动模块驱动发光器件发光。
可选地，所述数据写入模块包括第一晶体管，所述第一晶体管的栅极接入第一扫描信号，所述第一晶体管的第一极连接电压输入端，所述第一晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述像素电路的驱动方法包括：
在初始化阶段，向所述电压输入端提供所述第一初始化电压，并控制所述第一晶体管响应所述第一扫描信号而导通，以通过所述第一晶体管向所述补偿控制模块的两端写入第一初始化电压；
在数据写入阶段，向所述电压输入端提供所述数据电压，并控制所述第一晶体管响应所述第一扫描信号而导通，以通过所述第一晶体管向所述第二存储模块写入数据电压；
或者，
所述数据写入模块包括第四晶体管和第五晶体管；所述第四晶体管的栅极接入第三扫描信号，所述第四晶体管的第一极接入所述第一初始化电压，所述第四晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；所述第五晶体管的栅极接入第四扫描信号，所述第五晶体管的第一极接入所述数据电压，所述第五晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；所述像素电路的驱动方法包括：
在初始化阶段，控制所述第四晶体管响应所述第三扫描信号而导通，以通过所述第四晶体管向所述补偿控制模块的两端写入第一初始化电压；
在数据写入阶段，控制所述第五晶体管响应所述第四扫描信号而导通，以通过所述第五晶体管向所述第二存储模块写入数据电压。
第三方面，本发明实施例还提供了一种显示面板，包括第一方面所述的像素电路。
本发明实施例提供的像素电路及其驱动方法和显示面板，在补偿阶段，通过控制补偿控制模块导通，使第一存储模块存储驱动模块的阈值电压信息，有助于对驱动模块的阈值电压进行补偿，以补偿阈值电压变化引起的发光器件的驱动电流变化，从而提高显示亮度均一性。在数据写入阶段，通过数据写入模块向第一存储模块和补偿控制模块的公共连接点写入数据电压，以使第一存储模块将第一存储模块和补偿控制模块的公共连接点的电压耦合至驱动模块的控制端，从而向驱动模块的控制端写入数据电压。驱动模块的数据电压写入和阈值电压补偿通过两个通路分阶段进行，使得补偿阶段的时间可调，有助于大范围地补偿驱动模块的阈值电压波动，从而进一步提高显示亮度均一性，以提升显示效果。
附图说明
图1是本发明实施例提供的一种像素电路的结构示意图；
图2是本发明实施例提供的另一种像素电路的结构示意图；
图3是本发明实施例提供的另一种像素电路的结构示意图；
图4是本发明实施例提供的另一种像素电路的结构示意图；
图5是本发明实施例提供的一种像素电路的驱动时序示意图；
图6是本发明实施例提供的另一种像素电路的驱动时序示意图；
图7是本发明实施例提供的另一种像素电路的驱动时序示意图；
图8是本发明实施例提供的一种像素电路的驱动方法的流程示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
正如背景技术所述，现有技术中的像素电路对于晶体管的阈值电压补偿效果较差，导致显示面板存在亮度均一性较差的问题，影响了显示效果。经发明人研究发现，出现上述问题的原因在于：现有像素电路中，驱动晶体管的阈值电压补偿阶段和数据电压写入阶段通常由同一扫描信号进行控制，对于中大尺寸的显示面板，以及对于刷新频率较高的显示面板，受到行扫描时间的限制，使得每帧内扫描信号为导通电平信号的时间较短，导致阈值电压补偿阶段的时间较短，使驱动晶体管的阈值电压补偿范围较小，显示面板中不同像素电路内的驱动晶体管的阈值电压差异仍然较大，难以满足显示面板的亮度均一性需求，从而影响了显示效果。
针对上述问题，本发明实施例提供了一种像素电路。图1是本发明实施例提供的一种像素电路的结构示意图。参见图1，该像素电路包括：数据写入模块10、第一存储模块20、第二存储模块30、补偿控制模块40和驱动模块50；第一存储模块20的第一端连接驱动模块50的控制端G，第一存储模块20的第二端连接补偿控制模块40的第一端，补偿控制模块40的第二端连接驱动模块50的第二端，第二存储模块30与数据写入模块10均连接第一存储模块20和补偿控制模块40的公共连接点N；补偿控制模块40用于在初始化阶段导通，数据写入模块10用于在初始化阶段向补偿控制模块40的两端写入第一初始化电压Vint，以及，数据写入模块10还用于在数据写入阶段向第二存储模块30写入数据电压Vdata并存储；第一存储模块20用于在补偿阶段存储驱动模块50的阈值电压信息，以及在数据写入阶段将第二存储模块30存储的电压耦合至驱动模块50的控制端G；补偿控制模块40还用于在补偿阶段导通，以使第一存储模块20存储驱动模块50的阈值电压；第二存储模块30用于存储第一存储模块20和补偿控制模块40的公共连接点N的电压；驱动模块50用于在发光阶段响应自身的控制端G的电压产生驱动电流，以驱动发光器件D1发光。
该像素电路中各模块的设置方式有多种，下面以其中的一种为例进行说明。示例性地，补偿控制模块40的第二端还连接发光器件D1的第一极，驱动模块50的第一端接入第一电源电压VDD，发光器件D1的第二极接入第二电源电压VSS。数据写入模块10接入第一初始化电压Vint和数据电压Vdata，且数据写入模块10连接第一存储模块20和补偿控制模块40的公共连接点N。第二存储模块30的第一端连接第一存储模块20和补偿控制模块40的公共连接点N，第二端接入固定电压。
其中，数据写入模块10的设置方式有多种，例如，数据写入模块10可连接电压输入端，电压输入端在初始化阶段接入第一初始化电压Vint，在数据写入阶段接入数据电压Vdata，图1中示意性地示出了数据写入模块10连接一个电压端，在不同的阶段分时接入第一初始化电压Vint和数据电压Vdata的情况。数据写入模块10也可以分别连接第一初始化电压Vint对应的电压端和数据电压Vdata对应的电压端，以通过不同的电压端接入第一初始化电压Vint和数据电压Vdata。
数据写入模块10还用于在数据写入阶段向第二存储模块30写入数据电压Vdata并存储，其含义可以是，在数据写入阶段，数据写入模块10向第二存储模块30的第一端写入数据电压Vdata，即向第一存储模块20和补偿控制模块40的公共连接点N写入数据电压Vdata，以使第二存储模块30存储第一存储模块20和补偿控制模块40的公共连接点N的电压。相应地，第一存储模块20将第二存储模块30存储的电压耦合至驱动模块50的控制端G，其含义可以是，第一存储模块20可以将第一存储模块20和补偿控制模块40的公共连接点N的电压耦合至驱动模块50的控制端G。第一存储模块20用于在补偿阶段存储驱动模块50的阈值电压信息，其含义可以是，第一存储模块20在补偿阶段存储的电压与驱动模块50的阈值电压相关，阈值电压信息即表示与驱动模块50的阈值电压相关的电压。
下面对图1所示的像素电路的工作原理进行说明。示例性地，该像素电路的工作过程包括：初始化阶段、补偿阶段、数据写入阶段和发光阶段。
在初始化阶段，控制数据写入模块10和补偿控制模块40导通，以通过数据写入模块10向补偿控制模块40的两端写入第一初始化电压Vint，将公共连接点N和S点的电位置为Vint，利用第一初始化电压Vint对第一存储模块20和补偿控制模块40的公共连接点N的电位进行初始化，并对S点的电位进行初始化，即对发光器件D1的第一极的电位进行初始化。
在补偿阶段，控制补偿控制模块40导通，通过第一电源电压VDD为第一存储模块20充电，使S点和公共连接点N的电位逐渐抬升至V0-Vth，其中，在驱动模块50驱动晶体管，且该驱动晶体管的栅极连接驱动模块50的控制端G，该驱动晶体管的第二极连接驱动模块50的第二端时，V0为补偿阶段驱动晶体管的栅极电压，Vth为驱动晶体管的阈值电压，即驱动模块50的阈值电压。在S点和公共连接点N的电位抬升至V0-Vth时，驱动模块50关断，第一存储模块20存储的电压与驱动模块50的阈值电压相关，并且在驱动模块50关断时，第一电源电压VDD无法再将S点的电位进行抬升，因此发光器件D1不会发光。
在数据写入阶段，控制数据写入模块10导通，并控制补偿控制模块40关断，通过数据写入模块10向第一存储模块20和补偿控制模块40的公共连接点N写入数据电压Vdata，使公共连接点N的电位由V0-Vth变为Vdata，公共连接点N的电位变化量为Vdata-V0+Vth。第一存储模块20能够将第一存储模块20和补偿控制模块40的公共连接点N的电压耦合至驱动模块50的控制端G，即第一存储模块20具有耦合作用，能够根据第一存储模块20和补偿控制模块40的公共连接点N的电位变化，对驱动模块50的控制端G的电位进行耦合，将驱动模块50的控制端G的电位耦合至V0+Vdata-V0+Vth＝Vdata+Vth。第二存储模块30可以对公共连接点N的电位进行存储。
在发光阶段，控制数据写入模块10和补偿控制模块40关断。第一电源电压VDD写入驱动模块50的第一端，第二电源电压VSS写入发光器件D1的第二极，通过驱动模块50响应自身的控制端G的电压产生驱动电流，从而驱动发光器件D1以相应的亮度进行发光显示。驱动模块50的控制端G的电位为Vdata+Vth，S点的电位为VSS+Voled，其中，Voled为发光器件D1中的电容的电压。驱动模块50的控制端G和第二端之间的压差，即驱动模块50中的驱动晶体管的栅极与第二极之间的压差Vgs＝Vdata+Vth-VSS-Voled。驱动晶体管产生的驱动电流Ids可表示为：
Ids＝(W/2L)μCOX(Vgs-Vth)2＝(W/2L)μCOX(Vdata-VSS-Voled)2；
其中，W是晶体管的沟道宽度，L是晶体管的沟道长度，μ是晶体管的电子迁移率，COX是晶体管的单位面积沟道电容。
由此可知，驱动晶体管产生的驱动电流Ids与驱动晶体管的阈值电压Vth无关，实现了驱动模块50的阈值电压补偿，有助于提高显示面板的显示亮度均一性，从而提升显示效果。
本发明实施例的技术方案，在补偿阶段，通过控制补偿控制模块导通，使第一存储模块存储驱动模块的阈值电压信息，有助于对驱动模块的阈值电压进行补偿，以补偿阈值电压变化引起的发光器件的驱动电流变化，从而提高显示亮度均一性。在数据写入阶段，通过数据写入模块向第一存储模块和补偿控制模块的公共连接点写入数据电压，以使第一存储模块将第一存储模块和补偿控制模块的公共连接点的电压耦合至驱动模块的控制端，从而向驱动模块的控制端写入数据电压。驱动模块的数据电压写入和阈值电压补偿通过两个通路分阶段进行，使得补偿阶段的时间可调，有助于大范围地补偿驱动模块的阈值电压波动，从而进一步提高显示亮度均一性，以提升显示效果。
图2是本发明实施例提供的另一种像素电路的结构示意图。参见图2，在上述实施例的基础上，可选地，数据写入模块10包括第一晶体管T1，第一晶体管T1的栅极接入第一扫描信号S1，第一晶体管T1的第一极连接电压输入端，第一晶体管T1的第二极连接第一存储模块20和补偿控制模块40的公共连接点N；其中，电压输入端在初始化阶段接入第一初始化电压Vint，在数据写入阶段接入数据电压Vdata。
具体地，第一晶体管T1响应第一扫描信号S1而导通或关断，并在导通时将其电压输入端的电压传输至第一存储模块20和补偿控制模块40的公共连接点N。示例性地，在初始化阶段，向电压输入端提供第一初始化电压Vint，并控制第一晶体管T1响应第一扫描信号S1而导通，以通过第一晶体管T1向补偿控制模块40的两端写入第一初始化电压Vint，从而利用第一初始化电压Vint对第一存储模块20和补偿控制模块40的公共连接点N的电位进行初始化，并对S点的电位进行初始化，即对发光器件D1的第一极的电位进行初始化。在数据写入阶段，向电压输入端提供数据电压Vdata，并控制第一晶体管T1响应第一扫描信号S1而导通，以通过第一晶体管T1向第二存储模块30写入数据电压Vdata，即向第一存储模块20和补偿控制模块40的公共连接点N写入数据电压Vdata，使第一存储模块20根据公共连接点N的电位变化，对驱动模块50的控制端G的电位进行耦合，将数据电压Vdata写入驱动模块50的控制端G。本发明实施例的技术方案，通过设置电压输入端在初始化阶段接入第一初始化电压Vint，在数据写入阶段接入数据电压Vdata，有利于减少像素电路连接的电压端的数量，以及连接像素电路和电压端的信号线的数量，即减少了显示面板中的电压端和信号线的数量，有助于简化显示面板的布线方式，从而降低制作成本。
继续参见图2，可选地，该像素电路还包括初始化模块60，用于在初始化阶段向驱动模块50的控制端G写入第二初始化电压Vref。示例性地，初始化模块60的控制端接入第二扫描信号S2，第一端接入第二初始化电压Vref，第二端连接驱动模块50的控制端G。初始化模块60可响应第二扫描信号S2而导通或关断，在初始化阶段，控制初始化模块60响应第二扫描信号S2而导通，以通过初始化模块60向驱动模块50的控制端G写入第二初始化电压Vref，对驱动模块50的控制端G的电位进行初始化，有助于消除驱动模块50的控制端G残留的上一帧显示画面的电荷，从而提升显示效果。
在上述实施例的基础上，可选地，设置初始化模块60包括第二晶体管T2，第二晶体管T2的栅极接入第二扫描信号S2，第二晶体管T2的第一极接入第二初始化电压Vref，第二晶体管T2的第二极连接驱动模块50的控制端G。第二晶体管T2可响应第二扫描信号S2而导通或关断，并在导通时将第二初始化电压Vref写入驱动模块50的控制端G，对驱动模块50的控制端G的电位进行初始化。
在上述实施例的基础上，可选地，设置第一初始化电压Vint和第二初始化电压Vref均小于发光器件D1的启亮电压，且第一初始化电压Vint小于第二初始化电压Vref。在初始化阶段，初始化模块60向驱动模块50的控制端G写入第二初始化电压Vref，使驱动模块50的控制端G的电位为Vref，数据写入模块10向补偿控制模块40的两端写入第一初始化电压Vint，将S点的电位置为Vint，通过设置第一初始化电压Vint和第二初始化电压Vref均小于发光器件D1的启亮电压，有助于避免发光器件D1在初始化阶段发光，从而保证黑态画面足够黑，以提升显示画面的对比度，进而提升显示效果。另外，在初始化阶段结束至补偿阶段开始时，驱动模块50的控制端G的电位为Vref，S点的电位为Vint，由于在补偿阶段需要控制驱动模块50导通，以通过第一电源电压VDD为第一存储模块20充电，在驱动模块50包括N型驱动晶体管时，设置第一初始化电压Vint小于第二初始化电压Vref，能够使驱动晶体管的栅极与第二极之间的压差Vgs＞0，以保证驱动模块50在补偿阶段导通，使第一存储模块20存储驱动模块50的阈值电压信息。
继续参见图2，可选地，第一存储模块20包括第一电容C1，第二存储模块30包括第二电容C2，补偿控制模块40包括第三晶体管T3，驱动模块50包括驱动晶体管DT。第一电容C1的第一极连接驱动晶体管DT的栅极，第一电容C1的第二极连接第三晶体管T3的第二极。第一电容C1能够存储驱动晶体管DT的阈值电压，并且第一电容C1具有耦合作用，在数据写入阶段，第一电容C1可根据其第二极的电位变化，对驱动晶体管DT的栅极电位进行耦合。第三晶体管T3的栅极接入第二扫描信号S2，第三晶体管T3的第一极连接驱动晶体管DT的第二极。第三晶体管T3可响应第二扫描信号S2而导通或关断，并在导通时连通公共连接点N和S点，在关断时断开公共连接点N和S点的连接。第二电容C2的第一极连接第一电容C1的第二极和第三晶体管T3的第二极，第二电容C2的第二极接入固定电压，第二电容C2用于对公共连接点N的电压进行存储。其中，第二电容C2的第二极接入的固定电压可以是任意电压，通过设置第二电容C2的第二极接入固定电压，能够对第二电容C2的第二极的电位进行固定，以避免第二电容C2的第二极的电位悬空。图2示意性地设置第二电容C2的第二极接入第一电源电压VDD，在实际应用中，第二电容C2的第二极接入的固定电压还可以是第二初始化电压Vref或第二电源电压VSS等，通过设置固定电压为第一电源电压VDD、第二初始化电压Vref或第二电源电压VSS，能够使第二电容C2的第二极连接至显示面板中已有的电压端，无需额外增设其他的电压端，有利于简化显示面板的结构。
图3是本发明实施例提供的另一种像素电路的结构示意图。图3示出了数据写入模块10的另一种设置方式。参见图3，可选地，数据写入模块10包括第四晶体管T4和第五晶体管T5。第四晶体管T4的栅极接入第三扫描信号S3，第四晶体管T4的第一极接入第一初始化电压Vint，第四晶体管T4的第二极连接第一存储模块20和补偿控制模块40的公共连接点N。第四晶体管T4可响应第三扫描信号S3而导通或关断，并在导通时向第一存储模块20和补偿控制模块40的公共连接点N写入第一初始化电压Vint，对公共连接点N的电位进行初始化。第五晶体管T5的栅极接入第四扫描信号S4，第五晶体管T5的第一极接入数据电压Vdata，第五晶体管T5的第二极连接第一存储模块20和补偿控制模块40的公共连接点N。第五晶体管T5可响应第四扫描信号S4而导通或关断，并在导通时向第一存储模块20和补偿控制模块40的公共连接点N写入数据电压Vdata。示例性地，在初始化阶段，控制第四晶体管T4响应第三扫描信号S3而导通，并控制补偿控制模块40导通，以通过第四晶体管T4向补偿控制模块40的两端写入第一初始化电压Vint；在数据写入阶段，控制第五晶体管T5响应第四扫描信号S4而导通，以通过第五晶体管T5向第二存储模块30写入数据电压Vdata，即向第一存储模块20和补偿控制模块40的公共连接点N写入数据电压Vdata。本发明实施例的技术方案，通过设置第四晶体管T4的第一极接入第一初始化电压Vint，第五晶体管T5的第一极接入数据电压Vdata，能够使第一初始化电压Vint信号和数据电压Vdata信号分离，这样设置的好处在于，第四晶体管T4的第一极和第五晶体管T5的第一极连接的电压端均接入固定的电压信号，不存在电压信号的跳变，以避免驱动芯片对第四晶体管T4的第一极和第五晶体管T5的第一极连接的电压端进行反复地充放电而造成功率损失。
图4是本发明实施例提供的另一种像素电路的结构示意图。参见图4，可选地，该像素电路还包括第一发光控制模块70和第二发光控制模块80。第一发光控制模块70的控制端接入第一发光控制信号EM1，第一发光控制模块70的第一端接入第一电源电压VDD，第一发光控制模块70的第二端连接驱动模块50的第一端，第一发光控制模块70用于响应第一发光控制信号EM1而导通或关断，并在导通时向驱动模块50的第一端写入第一电源电压VDD。第二发光控制模块80的控制端接入第二发光控制信号EM2，第二发光控制模块80连接于驱动模块50的第二端和发光器件D1的第一极之间，第二发光控制模块80用于响应第二发光控制信号EM2而导通或关断，并在导通时连通驱动模块50的第二端和发光器件D1的第一极，在关断时断开驱动模块50的第二端和发光器件D1的第一极的连接。
示例性地，在初始化阶段，控制第二发光控制模块80响应第二发光控制信号EM2而导通，并控制数据写入模块10和补偿控制模块40导通，以通过数据写入模块10向补偿控制模块40的两端以及发光器件D1的第一极写入第一初始化电压Vint，利用第一初始化电压Vint对第一存储模块20和补偿控制模块40的公共连接点N、S点和发光器件D1的第一极的电位进行初始化。在补偿阶段，控制第一发光控制模块70响应第一发光控制信号EM1而导通，并控制补偿控制模块40导通，以通过第一电源电压VDD为第一存储模块20充电，使第一存储模块20能够存储驱动模块50的阈值电压。在发光阶段，控制第一发光控制模块70响应第一发光控制信号EM1而导通，控制第二发光控制模块80响应第二发光控制信号EM2而导通，并控制数据写入模块10和补偿控制模块40关断。第一电源电压VDD写入驱动模块50的第一端，第二电源电压VSS写入发光器件D1的第二极，通过驱动模块50响应自身的控制端G的电压产生驱动电流，从而驱动发光器件D1以相应的亮度进行发光显示。
继续参见图4，可选地，第一发光控制模块70包括第六晶体管T6，第二发光控制模块80包括第七晶体管T7。第六晶体管T6的栅极接入第一发光控制信号EM1，第六晶体管T6的第一极接入第一电源电压VDD，第六晶体管T6的第二极连接驱动模块50的第一端。第六晶体管T6响应第一发光控制信号EM1而导通或关断，并在导通时向驱动模块50的第一端写入第一电源电压VDD。第七晶体管T7的栅极接入第二发光控制信号EM2，第七晶体管T7连接于驱动模块50的第二端和发光器件D1的第一极之间。第七晶体管T7响应第二发光控制信号EM2而导通或关断，并在导通时连通驱动模块50的第二端和发光器件D1的第一极，在关断时断开驱动模块50的第二端和发光器件D1的第一极的连接。
本发明各实施例所提供的像素电路中的各晶体管既可以是P型晶体管，也可以是N型晶体管，图2至图4仅示出了各晶体管均为N型晶体管的情况，在实际应用中，可根据需求对像素电路中的各晶体管的类型进行设置，本发明对此不进行限制。
图5是本发明实施例提供的一种像素电路的驱动时序示意图，图5所示的驱动时序可适用于驱动图1和图2所示的像素电路工作。下面结合图2和图5，以图2中的各晶体管均是N型晶体管为例，对该像素电路的工作原理进行说明。示例性地，该像素电路的工作阶段包括初始化阶段t1、补偿阶段t2、数据写入阶段t3和发光阶段t4。
在初始化阶段t1，第一扫描信号S1和第二扫描信号S2均为高电平信号，电压输入端Data(即第一晶体管T1的第一极连接的电压端，图2中仅示出了第一晶体管T1的第一极接入的电压信号，而未示出该电压输入端Data)接入低电平的第一初始化电压Vint。第一晶体管T1、第二晶体管T2和第三晶体管T3导通。第一初始化电压Vint通过第一晶体管T1写入第三晶体管T3的两端，对公共连接点N的电位进行初始化，并对S点的电位进行初始化，即对发光器件D1的第一极的电位进行初始化。第二初始化电压Vref通过第二晶体管T2写入驱动晶体管DT的栅极，对驱动晶体管DT的栅极电位进行初始化。公共连接点N和S点的电位均为Vint，驱动晶体管DT的栅极电位为Vref。
在补偿阶段t2，第一扫描信号S1为低电平信号，其他信号与初始化阶段t1保持一致。第一晶体管T1关断，第二晶体管T2、第三晶体管T3和驱动晶体管DT导通。第一电源电压VDD通过驱动晶体管DT和第三晶体管T3为第一电容C1充电，使S点和公共连接点N的电位逐渐抬升至Vref-Vth。在S点和公共连接点N的电位抬升至Vref-Vth时，驱动晶体管DT关断，第一电容C1存储了驱动晶体管DT的阈值电压，并且在驱动晶体管DT关断时，第一电源电压VDD无法再将S点的电位进行抬升，因此发光器件D1不会发光。
在数据写入阶段t3，第一扫描信号S1为高电平信号，第二扫描信号S2为低电平信号，电压输入端Data接入高电平的数据电压Vdata。第一晶体管T1导通，其他晶体管关断。数据电压Vdata通过第一晶体管T1写入公共连接点N，使公共连接点N的电位由Vref-Vth变为Vdata，公共连接点N的电位变化量为Vdata-Vref+Vth。由于第一电容C1具有耦合作用，能够根据公共连接点N的电位变化，对驱动晶体管DT的栅极电位进行耦合，将驱动晶体管DT的栅极电位耦合至Vref+Vdata-Vref+Vth＝Vdata+Vth。同时，第二电容C2对公共连接点N的电位进行存储。
在发光阶段t4，第一扫描信号S1和第二扫描信号S2均为低电平信号，电压输入端Data接入低电平电压。驱动晶体管DT导通，第一电源电压VDD写入驱动晶体管DT的第一极，第二电源电压VSS写入发光器件D1的第二极，驱动晶体管DT响应自身的栅极电压产生驱动电流，从而驱动发光器件D1以相应的亮度进行发光显示。驱动晶体管DT的栅极电位为Vdata+Vth，S点的电位为VSS+Voled，驱动晶体管DT的栅极与第二极之间的压差Vgs＝Vdata+Vth-VSS-Voled。驱动晶体管DT产生的驱动电流Ids可表示为：
Ids＝(W/2L)μCOX(Vgs-Vth)2＝(W/2L)μCOX(Vdata-VSS-Voled)2；
由此可知，驱动晶体管DT产生的驱动电流Ids与驱动晶体管DT的阈值电压Vth无关，实现了驱动晶体管DT的阈值电压补偿，有助于提高显示面板的显示亮度均一性，从而提升显示效果。
图6是本发明实施例提供的另一种像素电路的驱动时序示意图，具体可以是像素电路的实测驱动时序示意图。图6所示的驱动时序同样适用于驱动图1和图2所示的像素电路工作。下面结合图2和图6进行说明。示例性地，Ioled表示发光器件D1的驱动电流，Ioled1表示驱动晶体管DT的阈值电压偏移值为-0.5V时的驱动电流，Ioled2表示驱动晶体管DT的阈值电压偏移值为0V时的驱动电流，Ioled3表示驱动晶体管DT的阈值电压偏移值为0.5V时的驱动电流。S1表示驱动晶体管DT的阈值电压偏移值为-0.5V时的S点的电位，S2表示驱动晶体管DT的阈值电压偏移值为0V时的S点的电位，S3表示驱动晶体管DT的阈值电压偏移值为0.5V时的S点的电位。G1表示驱动晶体管DT的阈值电压偏移值为-0.5V时的驱动模块50的控制端G，即驱动晶体管DT的栅极电位，G2表示驱动晶体管DT的阈值电压偏移值为0V时的驱动晶体管DT的栅极电位，G3表示驱动晶体管DT的阈值电压偏移值为0.5V时的驱动晶体管DT的栅极电位。经发明人实验发现，本发明实施例中的像素电路，在发光阶段中的t0时刻，Ioled1的数值为32.45，Ioled2的数值为31.81，Ioled3的数值为32.17，因此，当驱动晶体管DT的阈值电压偏移范围为±0.5V时，发光器件D1的驱动电流Ioled的变化率为(32.45-31.81)/32.17＝0.87％。然而，现有技术中P型晶体管的7T1C(T表示晶体管，C表示电容，7T1C即七个晶体管和一个电容)像素电路，当驱动晶体管的阈值电压偏移范围为±0.5V时，发光器件D1的驱动电流Ioled的变化率为3.2％。因此，与现有技术相比，本发明实施例提供的技术方案对于驱动晶体管的阈值电压波动的敏感度更小，有助于补偿阈值电压变化引起的发光器件的驱动电流变化，从而提高显示亮度均一性。
图7是本发明实施例提供的另一种像素电路的驱动时序示意图，图7所示的驱动时序可适用于驱动图3所示的像素电路工作。下面结合图3和图7，以图4中的各晶体管均是N型晶体管为例，对该像素电路的工作原理进行说明。示例性地，该像素电路的工作阶段包括初始化阶段t11、补偿阶段t12、数据写入阶段t13和发光阶段t14。
在初始化阶段t11，第二扫描信号S2和第三扫描信号S3均为高电平信号，第四扫描信号S4为低电平信号。第二晶体管T2、第三晶体管T3和第四晶体管T4导通，第五晶体管T5关断。第一初始化电压Vint通过第四晶体管T4写入第三晶体管T3的两端，对公共连接点N的电位进行初始化，并对S点的电位进行初始化，即对发光器件D1的第一极的电位进行初始化。第二初始化电压Vref通过第二晶体管T2写入驱动晶体管DT的栅极，对驱动晶体管DT的栅极电位进行初始化。公共连接点N和S点的电位均为Vint，驱动晶体管DT的栅极电位为Vref。
在补偿阶段t12，第三扫描信号S3为低电平信号，其他信号与初始化阶段t11保持一致。第二晶体管T2、第三晶体管T3和驱动晶体管DT导通，其他晶体管关断。第一电源电压VDD通过驱动晶体管DT和第三晶体管T3为第一电容C1充电，使S点和公共连接点N的电位逐渐抬升至Vref-Vth。在S点和公共连接点N的电位抬升至Vref-Vth时，驱动晶体管DT关断，第一电容C1存储了驱动晶体管DT的阈值电压，并且在驱动晶体管DT关断时，第一电源电压VDD无法再将S点的电位进行抬升，因此发光器件D1不会发光。
在数据写入阶段t13，第四扫描信号S4为高电平信号，第二扫描信号S2和第三扫描信号S3为低电平信号。第五晶体管T5导通，其他晶体管关断。数据电压Vdata通过第五晶体管T5写入公共连接点N，使公共连接点N的电位由Vref-Vth变为Vdata，公共连接点N的电位变化量为Vdata-Vref+Vth。由于第一电容C1具有耦合作用，能够根据公共连接点N的电位变化，对驱动晶体管DT的栅极电位进行耦合，将驱动晶体管DT的栅极电位耦合至Vref+Vdata-Vref+Vth＝Vdata+Vth。同时，第二电容C2对公共连接点N的电位进行存储。
在发光阶段t14，第二扫描信号S2、第三扫描信号S3和第四扫描信号S4均为低电平信号。驱动晶体管DT导通，第一电源电压VDD写入驱动晶体管DT的第一极，第二电源电压VSS写入发光器件D1的第二极，驱动晶体管DT响应自身的栅极电压产生驱动电流，从而驱动发光器件D1以相应的亮度进行发光显示。驱动晶体管DT产生的驱动电流Ids＝(W/2L)μCOX(Vdata-VSS-Voled)2。驱动晶体管DT产生的驱动电流Ids与驱动晶体管DT的阈值电压Vth无关，实现了驱动晶体管DT的阈值电压补偿，有助于提高显示面板的显示亮度均一性，从而提升显示效果。
图4所示的像素电路的工作原理与图1和图2所示的像素电路的工作原理类似，并且能够产生类似的技术效果，具体可参见图2所示的像素电路的工作原理进行理解，这里不再赘述。
本发明实施例还提供了一种显示面板，该显示面板可以是发光二极管LED显示面板、有机发光二极管OLED显示面板或微发光二极管Micro LED显示面板等。本发明实施例提供的显示面板，包括本发明任意实施例所提供的像素电路，其技术原理和产生的效果类似，不再赘述。
本发明实施例还提供了一种像素电路的驱动方法，图8是本发明实施例提供的一种像素电路的驱动方法的流程示意图。本发明实施例提供的像素电路的驱动方法，适用于驱动本发明任意实施例提供的像素电路工作。参见图8，该像素电路的驱动方法具体包括如下步骤：
S110、在初始化阶段，控制补偿控制模块导通，以通过数据写入模块向补偿控制模块的两端写入第一初始化电压。
S120、在补偿阶段，控制补偿控制模块导通，以使第一存储模块存储驱动模块的阈值电压信息。
S130、在数据写入阶段，通过数据写入模块向第二存储模块写入数据电压并存储，以使第一存储模块将第二存储模块存储的电压耦合至驱动模块的控制端。
S140、在发光阶段，通过驱动模块驱动发光器件发光。
本发明实施例的技术方案，在补偿阶段，通过控制补偿控制模块导通，使第一存储模块存储驱动模块的阈值电压信息，有助于对驱动模块的阈值电压进行补偿，以补偿阈值电压变化引起的发光器件的驱动电流变化，从而提高显示亮度均一性。在数据写入阶段，通过数据写入模块向第一存储模块和补偿控制模块的公共连接点写入数据电压，以使第一存储模块将第一存储模块和补偿控制模块的公共连接点的电压耦合至驱动模块的控制端，从而向驱动模块的控制端写入数据电压。驱动模块的数据电压写入和阈值电压补偿通过两个通路分阶段进行，使得补偿阶段的时间可调，有助于大范围地补偿驱动模块的阈值电压波动，从而进一步提高显示亮度均一性，以提升显示效果。
可选地，在本发明的一种实施方式中，像素电路的驱动方法包括：在初始化阶段，向电压输入端提供第一初始化电压，并控制第一晶体管响应第一扫描信号而导通，以通过第一晶体管向补偿控制模块的两端写入第一初始化电压；在数据写入阶段，向电压输入端提供数据电压，并控制第一晶体管响应第一扫描信号而导通，以通过第一晶体管向第二存储模块写入数据电压。
本发明实施例的技术方案，适用于驱动上述实施例中的图1、图2和图4所示的像素电路进行工作，具体的技术原理和产生的技术效果可参照上述实施例进行理解，不再赘述。
可选地，在本发明的另一种实施方式中，像素电路的驱动方法包括：在初始化阶段，控制第四晶体管响应第三扫描信号而导通，以通过第四晶体管向补偿控制模块的两端写入第一初始化电压；在数据写入阶段，控制第五晶体管响应第四扫描信号而导通，以通过第五晶体管向第二存储模块写入数据电压。
本发明实施例的技术方案，适用于驱动上述实施例中的图3所示的像素电路进行工作，具体的技术原理和产生的技术效果可参照上述实施例进行理解，不再赘述。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素电路，其特征在于，包括：数据写入模块、第一存储模块、第二存储模块、补偿控制模块和驱动模块；
所述第一存储模块的第一端连接所述驱动模块的控制端，所述第一存储模块的第二端连接所述补偿控制模块的第一端，所述补偿控制模块的第二端连接所述驱动模块的第二端，所述第二存储模块与所述数据写入模块均连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述数据写入模块用于在初始化阶段向所述补偿控制模块的两端写入第一初始化电压，以及，所述数据写入模块还用于在数据写入阶段向所述第二存储模块写入数据电压并存储；
所述第一存储模块用于在补偿阶段存储所述驱动模块的阈值电压信息，以及在数据写入阶段将所述第二存储模块存储的电压耦合至所述驱动模块的控制端；
所述驱动模块用于在发光阶段驱动发光器件发光。
2.根据权利要求1所述的像素电路，其特征在于，所述数据写入模块包括第一晶体管，所述第一晶体管的栅极接入第一扫描信号，所述第一晶体管的第一极连接电压输入端，所述第一晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；
其中，所述电压输入端在所述初始化阶段接入所述第一初始化电压，在所述数据写入阶段接入所述数据电压。
3.根据权利要求1所述的像素电路，其特征在于，还包括初始化模块，用于在所述初始化阶段向所述驱动模块的控制端写入第二初始化电压；
优选地，所述初始化模块包括第二晶体管，所述第二晶体管的栅极接入第二扫描信号，所述第二晶体管的第一极接入所述第二初始化电压，所述第二晶体管的第二极连接所述驱动模块的控制端。
4.根据权利要求3所述的像素电路，其特征在于，所述第一初始化电压和所述第二初始化电压均小于所述发光器件的启亮电压，且所述第一初始化电压小于所述第二初始化电压。
5.根据权利要求1所述的像素电路，其特征在于，所述第一存储模块包括第一电容，所述第二存储模块包括第二电容，所述补偿控制模块包括第三晶体管，所述驱动模块包括驱动晶体管；
所述第一电容的第一极连接所述驱动晶体管的栅极，所述第一电容的第二极连接所述第三晶体管的第二极；
所述第三晶体管的栅极接入第二扫描信号，所述第三晶体管的第一极连接所述驱动晶体管的第二极；
所述第二电容的第一极连接所述第一电容的第二极和所述第三晶体管的第二极，所述第二电容的第二极接入固定电压。
6.根据权利要求1所述的像素电路，其特征在于，所述数据写入模块包括第四晶体管和第五晶体管；
所述第四晶体管的栅极接入第三扫描信号，所述第四晶体管的第一极接入所述第一初始化电压，所述第四晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述第五晶体管的栅极接入第四扫描信号，所述第五晶体管的第一极接入所述数据电压，所述第五晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点。
7.根据权利要求1所述的像素电路，其特征在于，还包括第一发光控制模块和第二发光控制模块；
所述第一发光控制模块的控制端接入第一发光控制信号，所述第一发光控制模块的第一端接入第一电源电压，所述第一发光控制模块的第二端连接所述驱动模块的第一端，所述第一发光控制模块用于响应所述第一发光控制信号而导通或关断；
所述第二发光控制模块的控制端接入第二发光控制信号，所述第二发光控制模块连接于所述驱动模块的第二端和所述发光器件的第一极之间，所述第二发光控制模块用于响应所述第二发光控制信号而导通或关断。
8.一种像素电路的驱动方法，其特征在于，所述像素电路包括数据写入模块、第一存储模块、第二存储模块、补偿控制模块和驱动模块；所述第一存储模块的第一端连接所述驱动模块的控制端，所述第一存储模块的第二端连接所述补偿控制模块的第一端，所述补偿控制模块的第二端连接所述驱动模块的第二端，所述第二存储模块与所述数据写入模块均连接所述第一存储模块和所述补偿控制模块的公共连接点；
所述像素电路的驱动方法包括：
在初始化阶段，控制所述补偿控制模块导通，以通过所述数据写入模块向所述补偿控制模块的两端写入第一初始化电压；
在补偿阶段，控制所述补偿控制模块导通，以使所述第一存储模块存储所述驱动模块的阈值电压信息；
在数据写入阶段，通过所述数据写入模块向所述第二存储模块写入数据电压并存储，以使所述第一存储模块将所述第二存储模块存储的电压耦合至所述驱动模块的控制端；
在发光阶段，通过所述驱动模块驱动发光器件发光。
9.根据权利要求8所述的像素电路的驱动方法，其特征在于，所述数据写入模块包括第一晶体管，所述第一晶体管的栅极接入第一扫描信号，所述第一晶体管的第一极连接电压输入端，所述第一晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；所述像素电路的驱动方法包括：
在初始化阶段，向所述电压输入端提供所述第一初始化电压，并控制所述第一晶体管响应所述第一扫描信号而导通，以通过所述第一晶体管向所述补偿控制模块的两端写入第一初始化电压；
在数据写入阶段，向所述电压输入端提供所述数据电压，并控制所述第一晶体管响应所述第一扫描信号而导通，以通过所述第一晶体管向所述第二存储模块写入数据电压；
或者，
所述数据写入模块包括第四晶体管和第五晶体管；所述第四晶体管的栅极接入第三扫描信号，所述第四晶体管的第一极接入所述第一初始化电压，所述第四晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；所述第五晶体管的栅极接入第四扫描信号，所述第五晶体管的第一极接入所述数据电压，所述第五晶体管的第二极连接所述第一存储模块和所述补偿控制模块的公共连接点；所述像素电路的驱动方法包括：
在初始化阶段，控制所述第四晶体管响应所述第三扫描信号而导通，以通过所述第四晶体管向所述补偿控制模块的两端写入第一初始化电压；
在数据写入阶段，控制所述第五晶体管响应所述第四扫描信号而导通，以通过所述第五晶体管向所述第二存储模块写入数据电压。
10.一种显示面板，其特征在于，包括权利要求1-7中任一所述的像素电路。
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