CN113939863B - 阵列基板、显示面板及显示装置 - Google Patents

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Abstract

本申请提供了一种阵列基板、显示面板及显示装置，属于显示技术领域。该阵列基板显示区域内仅包括能够发光的第一子像素，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，与相同的第一栅极驱动电路电连接；首行第一子像素所电连接的目标走线(即除电连接至第一栅极驱动电路的走线外的另一走线)与第二栅极驱动电路电连接，末行第一子像素所电连接的目标走线(即除电连接至第一栅极驱动电路的走线外的另一走线)与第三栅极驱动电路电连接。该阵列基板不仅设计简单，且能够实现正常显示。

Description

阵列基板、显示面板及显示装置
技术领域
本公开涉及显示技术领域，特别涉及一种阵列基板、显示面板及显示装置。
背景技术
有源矩阵发光二极管(active matrix organic light emitting diode，AMOLED)因其自发光、对比度高和色域广等优点被广泛应用于目前的显示领域中。
发明内容
本公开提供了一种阵列基板、显示面板及显示装置，可以解决相关技术中阵列基板的设计较为复杂的问题。所述技术方案如下：
一方面，提供了一种阵列基板，包括：
衬底基板，具有显示区域和围绕所述显示区域的周边区域；
多行第一子像素，位于所述显示区域，所述多行第一子像素为发光像素且所述多行第一子像素的边界为所述显示区域的边界；
多条栅线，位于所述显示区域和所述周边区域，所述多行第一子像素与所述多条栅线电连接；
多条复位信号线，位于所述显示区域和所述周边区域，所述多行第一子像素与所述多条复位信号线电连接；
每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，与相同的第一栅极驱动电路电连接；
位于首行的第一子像素所连接的第一目标走线与第二栅极驱动电路电连接；位于末行的第一子像素所连接的第二目标走线与第三栅极驱动电路电连接；
其中，所述第一目标走线和所述第二目标走线中的一个目标走线为所述多条栅线中的一条，另一个目标走线为所述多条复位信号线中的一条。
可选的，所述多行第一子像素与所述多条栅线一一对应电连接，且所述多行第一子像素与所述多条复位信号线一一对应电连接。
可选的，每相邻两行第一子像素中，奇数行第一子像素所电连接的栅线和偶数行第一子像素所电连接的复位信号线，与相同的第一栅极驱动电路电连接；
所述第一目标走线为所述多条复位信号线中的一条，所述第二目标走线为所述多条栅线中的一条。
可选的，每相邻两行第一子像素中，奇数行第一子像素所电连接的复位信号线和偶数行第一子像素所电连接的栅线，与相同的第一栅极驱动电路电连接；
所述第一目标走线为所述多条栅线中的一条，所述第二目标走线为所述多条复位信号线中的一条。
可选的，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线相连，并与相同的第一栅极驱动电路电连接。
可选的，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线相连，并通过所述栅线与相同的第一栅极驱动电路电连接。
可选的，所述阵列基板包括：
多个所述第一栅极驱动电路，位于所述周边区域；
所述第二栅极驱动电路，位于所述周边区域，且位于多个所述第一栅极驱动电路的一侧；
所述第三栅极驱动电路，位于所述周边区域，且位于所述多个第一栅极驱动电路远离所述第二栅极驱动电路的一侧。
可选的，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，与同一个所述第一栅极驱动电路电连接。
可选的，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，均与两个所述第一栅极驱动电路电连接。
可选的，每相邻两行第一子像素所电连接的两个所述第一栅极驱动电路，相对设置于所述相邻两行第一子像素的两端。
可选的，位于首行的第一子像素所电连接的第一目标走线与两个所述第二栅极驱动电路电连接，位于末行的第一子像素所电连接的第二目标走线与两个所述第三栅极驱动电路电连接。
可选的，所述阵列基板还包括：
多条发光控制信号线，位于所述显示区域与所述周边区域，所述多行第一子像素与所述多条发光控制信号线一一对应电连接。
可选的，每行第一子像素所电连接的发光控制信号线与一个发光驱动电路电连接，且各行第一子像素所电连接的发光控制信号线电连接的发光驱动电路不同。
可选的，多行第一子像素所电连接的发光控制信号线与同一个发光驱动电路电连接，且电连接至同一个发光驱动电路的第一子像素位于不同行。
可选的，所述阵列基板包括：所述发光驱动电路，位于所述周边区域。
可选的，每个所述第一子像素包括：像素电路以及与所述像素电路电连接的发光单元；
所述像素电路分别与所述栅线、所述复位信号线和所述发光单元电连接，所述像素电路用于响应于所述栅线提供的栅极驱动信号以及所述复位信号线提供的复位信号，驱动所述发光单元发光。
可选的，所述像素电路还与所述发光控制信号线电连接；
所述像素电路用于响应于所述栅极驱动信号、所述复位信号以及所述发光控制信号线提供的发光控制信号，驱动所述发光单元发光。
可选的，所述阵列基板还包括：
多行第二子像素，位于所述周边区域且位于所述第二栅极驱动电路远离所述第一栅极驱动电路的一侧，所述多行第二子像素为不发光像素。
另一方面，提供了一种显示面板，所述显示面板包括：封装盖板，以及如上述方面所述的阵列基板。
又一方面，提供了一种显示装置，所述显示装置包括：驱动电路，以及如上述方面所述的显示面板，所述驱动电路与所述显示面板电连接，所述驱动电路用于驱动所述显示面板工作。
本公开提供的技术方案带来的有益效果至少可以包括：
本公开实施例提供了一种阵列基板、显示面板及显示装置。其中，该阵列基板显示区域内仅包括能够发光的第一子像素，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，与相同的第一栅极驱动电路电连接；首行第一子像素所电连接的目标走线(即除电连接至第一栅极驱动电路的走线外的另一走线)与第二栅极驱动电路电连接，末行第一子像素所电连接的目标走线(即除电连接至第一栅极驱动电路的走线外的另一走线)与第三栅极驱动电路电连接。该阵列基板不仅设计简单，且能够实现正常显示。
附图说明
为了更清楚地说明本公开实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本公开实施例提供的一种阵列基板的结构示意图；
图2是本公开实施例提供的另一种阵列基板的结构示意图；
图3是本公开实施例提供的又一种阵列基板的结构示意图；
图4是本公开实施例提供的再一种阵列基板的结构示意图；
图5是本公开实施例提供的再一种阵列基板的结构示意图；
图6是本公开实施例提供的再一种阵列基板的结构示意图；
图7是本公开实施例提供的一种第一子像素的结构示意图；
图8是本公开实施例提供的另一种第一子像素的结构示意图；
图9是本公开实施例提供的一种阵列基板的版图局部示意图；
图10是本公开实施例提供的另一种阵列基板的版图局部示意图；
图11是本公开实施例提供的一种显示面板的结构示意图；
图12是本公开实施例提供的一种显示装置的结构示意图。
具体实施方式
为使本公开的目的、技术方案和优点更加清楚，下面将结合附图对本公开实施方式作进一步地详细描述。
目前，为了保证阵列基板显示区域包括的多行能够发光的显示子像素(pixel)中，各行显示子像素所电连接的复位信号线(reset line)上的负载(loading)差异较小，即使得阵列基板包括的各条复位信号线均处于相同的工作环境下，一般会在显示区域的顶部，即显示区域的边界处，设置一行与首行第一子像素相邻的不能够发光的虚设子像素(dummypixel)，并设置一条栅线(gate line)与该行虚设子像素电连接。
通过该设置结构，可以使得当每相邻两行显示子像素中，奇数行显示子像素所电连接的复位信号线和偶数行显示子像素所电连接的栅线与相同的栅极驱动电路电连接时，首行显示子像素所电连接的复位信号线也能够与其相邻的虚设子像素所电连接的栅线，与相同的栅极驱动电路电连接。进而即保证了各行显示子像素所电连接的复位信号线均处于相同的工作环境下。另外，一般还会设置除栅线外的其他信号线(如，发光控制信号线emmision line)与虚设子像素电连接，相应的，为了保证虚设子像素所电连接的其他信号线的工作稳定性，还会设置提供直流信号的直流信号端电连接至其他信号线。
但是，因虚设子像素的设置以及电连接至虚设子像素的信号线的引入，使得阵列基板的设计较为复杂。然而，随着显示技术的发展，像素包括的像素电路的结构也变得越来越复杂，对于阵列基板的空间利用要求越来越高，为了在有限的空间内实现更好的设计，一些简单有效的布局变得十分重要。本公开实施例提供了一种阵列基板，该阵列基板不仅能够保证对正常显示不造成影响，而且该阵列基板上的布线较少，设计较为简单，制造成本较低。
图1是本公开实施例提供的一种阵列基板的结构示意图。如图1所示，该阵列基板可以包括：
衬底基板01，具有显示区域A1和围绕显示区域A1的周边区域A2。
多行第一子像素(如图1示出的n行第一子像素P1至Pn)，位于显示区域A1，该多行第一子像素为发光像素且多行第一子像素的边界为显示区域A1的边界，即显示区域A1为多行第一子像素的外边缘轮廓。n为大于0的整数。由于第一子像素为发光像素，因此该第一子像素也可以称为显示子像素。
多条栅线(如图1示出的n条栅线GATE1至GATEn)，位于显示区域A1和周边区域A2，多行第一子像素可以与多条栅线电连接。
多条复位信号线(如图1示出的n条复位信号线RST1至RSTn)，位于显示区域A1和周边区域A2，多行第一子像素可以与多条复位信号线电连接。
每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，可以与相同的第一栅极驱动电路10电连接。
位于首行的第一子像素所连接的第一目标走线可以与第二栅极驱动电路20电连接；位于末行的第一子像素所连接的第二目标走线可以与第三栅极驱动电路30电连接。其中，第一目标走线和第二目标走线中的一个目标走线可以为多条栅线中的一条，另一个目标走线可以为多条复位信号线中的一条。
例如，继续参考图1，其示出的阵列基板中，第一目标走线为多条复位线中的第一条复位信号线RST1。第二目标走线L2为多条栅线中的最后一条栅线GATEn。且，第一行第一子像素P1与第一条栅线GATE1和第一条复位信号线RST1对应电连接；第二行第一子像素P2与第二条栅线GATE2和第二条复位信号线RST2对应电连接；第三行第一子像素P3与第三条栅线GATE3和第三条复位信号线RST3对应电连接；以此类推。
第一行第一子像素P1所电连接的栅线GATE1和第二行第一子像素P2所电连接的复位信号线RST2，与相同的一个第一栅极驱动电路10电连接；第二行第一子像素P2所电连接的栅线GATE2和第三行第一子像素P3所电连接的复位信号线RST3，与相同的另一个第一栅极驱动电路10电连接；以此类推，直至第n-1行第一子像素P(n-1)所电连接的栅线GATE(n-1)与第n行第一子像素Pn所电连接的复位信号线RSTn，与相同的最后一个第一栅极驱动电路10电连接。
第一行第一子像素P1所电连接的复位信号线RST1(即第一目标走线)与第二栅极驱动电路20电连接。第n行第一子像素Pn所电连接的栅线GATEn(即第二目标走线)与第三栅极驱动电路30电连接。
且，为了保证正常驱动，位于不同行的第一子像素所电连接的复位信号线，即不同的复位信号线所电连接的栅极驱动电路可以不同；位于不同行的第一子像素所电连接的栅线，即不同的栅线所电连接的栅极驱动电路可以不同。如，继续参考图1，第一行第一子像素P1所电连接的复位信号线RST1与第二栅极驱动电路20连接，第二行第一子像素P2所电连接的复位信号线RST2与一个第一栅极驱动电路10连接，第三行第一子像素P3所电连接的复位信号线RST3与另一个第一栅极驱动电路10连接，以此类推。第一行第一子像素P1所电连接的栅线GATE1与一个第一栅极驱动电路10连接，第二行第一子像素P1所电连接的栅线GATE2与另一个第一栅极驱动电路10连接，以此类推。
在本公开实施例中，各栅极驱动电路可以通过其所电连接的信号线，为信号线所电连接的第一子像素提供信号，以驱动第一子像素发光。例如，结合图1所示的阵列基板，为保证正常显示，可以先控制第二栅极驱动电路20通过其所电连接的复位信号线RST1，向首行第一子像素P1输出复位信号，实现对首行第一子像素P1的复位；然后，再控制第一个第一栅极驱动电路10通过其所电连接的栅线GATE1，向首行第一子像素P1输出栅极驱动信号，以驱动首行第一子像素P1发光。与此同时，第一个第一栅极驱动电路10还可以通过其所电连接的复位信号线RST2，向第二行第一子像素P2输出复位信号，实现对第二行第一子像素P2的复位。再然后，控制第二个第一栅极驱动电路10通过其所电连接的栅线GATE2，向第二行第一子像素P2输出栅极驱动信号，以驱动第二行第一子像素P2发光。与此同时，第二个第一栅极驱动电路10还可以通过其所电连接的复位信号线RST3，向第三行第一子像素P3输出复位信号，实现对第三行第一子像素P3的复位，以此类推，其他行的驱动不再赘述。通过该驱动方式，可以可靠实现对各行第一子像素的逐行驱动。
综上所述，本公开实施例提供了一种阵列基板。结合该阵列基板的第一子像素、各信号线和栅极驱动电路的电连接关系可知，在正常工作时，可以通过控制各栅极驱动电路灵活向其电连接的信号线提供信号，实现对第一子像素的逐行可靠驱动。且由于该阵列基板显示区域内未设置不发光的虚设子像素，因此相对于相关技术的阵列基板，该阵列基板不仅能正常显示，且设计较为简单。
可选的，在本公开实施例中，结合图1，多行第一子像素可以多条栅线一一对应电连接，且多行第一子像素可以多条复位信号线一一对应电连接，且各栅极驱动电路(即第二栅极驱动电路20、各第一栅极驱动电路10和第三栅极驱动电路30)可以独立于阵列基板设置在阵列基板外侧。或者，各栅极驱动电路也可以设置于阵列基板上。即，如图2所示，该阵列基板还可以包括：
多个第一栅极驱动电路10，位于衬底基板01的周边区域A2。第二栅极驱动电路20，位于衬底基板01的周边区域A2，且位于多个第一栅极驱动电路10的一侧。第三栅极驱动电路30，位于衬底基板01的周边区域A2，且位于多个第一栅极驱动电路10远离所述第二栅极驱动电路20的一侧。相应的，每个栅极驱动电路也可以称为制作在阵列基板上的电路(gateon array，GOA)单元。
通过将栅极驱动电路设置于阵列基板上，有利于窄边框设计。下述实施例均以各栅极驱动电路设置于阵列基板上为例进行说明，且图2和下述实施例涉及到的附图均以GOA1表示第一栅极驱动电路10，以GOA2表示第二栅极驱动电路20称为，以GOA3表示第三栅极驱动电路30。
可选的，结合图2，本公开实施例提供的第二栅极驱动电路20、各个第一栅极驱动电路10以及第三栅极驱动电路30可以沿垂直于栅线的延伸方向依次排列于阵列基板上。且，每相邻两个栅极驱动电路可以级联(图中未示出)，并按级联顺序依次启动。由第二栅极驱动电路20、各个第一栅极驱动电路10和第三栅极驱动电路30组成的电路可以称为栅极驱动装置。
需要说明的是，对于栅极驱动装置包括的各栅极驱动电路而言，可以从第二栅极驱动电路20开始依次工作，即栅极驱动装置可以从首行第一子像素开始逐行驱动阵列基板包括的多行第一子像素，该扫描方式也可以称为正向扫描。此外，栅极驱动装置还可以从第三栅极驱动电路30开始依次工作，即栅极驱动装置可以从末行第一子像素开始逐行驱动阵列基板包括的多行第一子像素，该扫描方式也可以称为反向扫描。
若要实现正常驱动，对于正向扫描而言，需要先通过首行第一子像素电连接的复位信号线向首行第一子像素提供复位信号；对于反向扫描而言，需要先通过末行像素电连接的复位信号线向末行第一子像素提供复位信号。结合各栅极驱动电路的排布级联方式，为了保证逐行可靠驱动，在正向扫描场景下，第二栅极驱动电路20需要电连接至首行第一子像素所电连接的复位信号线；在反向扫描场景下，第三栅极驱动电路30需要电连接至末行第一子像素所电连接的复位信号线。
因此，作为一种可选的实现方式，结合图1，每相邻两行第一子像素中，奇数行第一子像素所电连接的栅线和偶数行第一子像素所电连接的复位信号线，可以与相同的第一栅极驱动电路10电连接。相应的，参考图1，第一目标走线即可以为多条复位线中的一条复位信号线(如图1示出的RST1)，第二目标走线即可以为多条栅线中的一条栅线(如图1示出的GATEn)。
结合上述各栅极驱动电路的级联关系、排布方式和驱动原理可知，对于图1示出的阵列基板结构，栅极驱动装置可以通过正向扫描的方式实现对各行第一子像素的逐行驱动。且相对于相关技术，由于该阵列基板的显示区域边界处未设置虚设子像素，因此在保证正常显示前提下，有效节省了顶部空间。另外，因未设置虚设子像素，则阵列基板内也无需设置电连接至虚设子像素的信号线，即简化了布线。
作为另一种可选的实现方式，继续参考图2，每相邻两行第一子像素中，奇数行第一子像素所电连接的复位信号线和偶数行第一子像素所电连接的栅线，可以与相同的第一栅极驱动电路10电连接。相应的，参考图2，第一目标走线即可以为多条栅线中的一条栅线(如图2示出的GATE1)，第二目标走线即可以为多条复位信号线中的一条复位信号线(如图2示出的RSTn)。
例如，图2继续以包括n行第一子像素P1至Pn，n条栅线GATE1至GATEn，n条复位信号线RST1至RSTn为例示出一种阵列基板。参考图2，该阵列基板中，第一行第一子像素P1所电连接的复位信号线RST1和第二行第一子像素P2所电连接的栅线GATE2，与相同的一个第一栅极驱动电路10(即图2示出的第一个GOA1)电连接。第二行第一子像素P2所电连接的复位信号线RST2和第三行第一子像素P3所电连接的栅线GATE3，与相同的另一个第一栅极驱动电路10(即图2示出的第二个GOA1)电连接；以此类推，直至第n-1行第一子像素P(n-1)所电连接的复位信号线RST(n-1)与第n行第一子像素Pn所电连接的栅线GATEn，与相同的最后一个第一栅极驱动电路10(即图2示出的最后一个GOA1)电连接。且首行第一子像素P1所电连接的栅线GATE1与第二栅极驱动电路20(即图2示出的GOA2)电连接。第n行第一子像素Pn所电连接的复位信号线RSTn与第三栅极驱动电路30(即图2示出的GOA3)电连接。
结合上述各栅极驱动电路的级联关系、排布方式和驱动原理可知，对于图2示出的阵列基板结构，栅极驱动装置可以通过反向扫描的方式实现对各行第一子像素的逐行驱动。
可选的，图1和图2均是以每相邻两行第一子像素中，一行第一子像素所电连接的复位信号线和另一行第一子像素所电连接的栅线，均各自分别电连接至相同的第一栅极驱动电路10为例进行说明。
然而为进一步简化走线设计，节省设计成本，以每相邻两行第一子像素中，奇数行第一子像素所电连接的栅线和偶数行第一子像素所电连接的复位信号线，与相同的第一栅极驱动电路10电连接，第一目标走线为复位信号线，第二目标走线为栅线为例，图3示出了又一种阵列基板。参考图3，阵列基板100包括的一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线可以相连，并与相同的第一栅极驱动电路10电连接。
且，可选的，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线相连后，可以通过栅线或复位信号线与相同的第一栅极驱动电路10电连接。
例如，图3示出的阵列基板100中，奇数行第一子像素所电连接的栅线和偶数行第一子像素所电连接的复位信号线相连后，可以均通过栅线电连接至第一栅极驱动电路10。即，结合图3，第一行第一子像素P1所电连接的栅线GATE1和第二行第一子像素P2所电连接的复位信号线RST2可以相连，并通过栅线GATE1电连接至第一个第一栅极驱动电路10(即图3示出的第一个GOA1)；第二行第一子像素P2所电连接的栅线GATE2和第三行第一子像素P3所电连接的复位信号线RST3可以相连，并通过栅线GATE2电连接至第二个第一栅极驱动电路10(即图3示出的第二个GOA1)；以此类推。
可选的，在本公开实施例中，结合图1至图3，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，可以仅与同一个第一栅极驱动电路10电连接。
或者，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，可以均与两个第一栅极驱动电路10电连接。且，可选的，每相邻两行第一子像素所电连接的两个第一栅极驱动电路10，可以相对设置于相邻两行第一子像素的两端。另外，位于首行的第一子像素所电连接的第一目标走线也可以与两个第二栅极驱动电路20电连接，位于末行的第一子像素所电连接的第二目标走线也可以与两个第三栅极驱动电路30电连接。
例如，图4是本公开实施例提供的再一种阵列基板的结构示意图。如图4所示，第一行第一子像素P1所电连接的栅线GATE1和第二行第一子像素P2所电连接的复位信号线RST2，均与设置在阵列基板100左右两侧的两个第一栅极驱动电路10(即图4示出的两个GOA1)电连接；第二行第一子像素P2所电连接的栅线GATE2和第三行第一子像素P3所电连接的复位信号线RST3，均与设置在阵列基板左右两侧的两个第一栅极驱动电路10(即图4示出的另两个GOA1)电连接；以此类推。且，第一行第一子像素P1所电连接的复位信号线RST1，与相对设置于阵列基板100左右两侧的两个第二栅极驱动电路20(即图4示出的两个GOA2)电连接。最后一行第一子像素Pn所电连接的栅线GATEn，与相对设置于阵列基板100左右两侧的两个第三栅极驱动电路30(即图4示出的两个GOA3)电连接。
对于每行第一子像素而言，通过设置该行第一子像素所电连接的信号线均与两个栅极驱动电路电连接，可以控制两个栅极驱动电路同时通过其所电连接的信号线，向该行第一子像素提供信号以驱动该行第一子像素发光。相应的，即可以保证沿栅线延伸方向，该行第一子像素的一端和另一端均可以同时发光，提高了对每行第一子像素进行驱动的驱动效率。针对分辨率较高的阵列基板(即每行包括的第一子像素数量较多的阵列基板)，驱动效率提高较为明显。
可选的，图5是本公开实施例提供的再一种阵列基板的结构示意图。如图5所示，该阵列基板100还可以包括：
多条发光控制信号线(如图5示出的n条发光控制信号线EM1至EMn)，位于显示区域与周边区域(图5未示出)。其中，多行第一子像素(如图5示出的n行第一子像素P1至Pn)可以与多条发光控制信号线(如EM1至EMn)一一对应电连接。
例如，第一行第一子像素P1与第一条发光控制信号线EM1电连接；第二行第一子像素P2与第二条发光控制信号线EM2电连接；第三行第一子像素P3与发光控制信号线EM3电连接；以此类推。
作为一种可选的实现方式，继续参考图5，每行第一子像素所电连接的发光控制信号线可以与一个发光驱动电路40电连接，且各行第一子像素所电连接的发光控制信号线电连接的发光驱动电路40不同。每个发光驱动电路40可以为其所电连接的发光控制信号线提供发光控制信号，第一子像素可以再响应于该发光控制信号发光。
需要说明的是，与栅极驱动电路同理，该发光驱动电路也可以独立于阵列基板设置在阵列基板外侧，或者，该发光驱动电路40可以设置于阵列基板上。即，结合图5，该阵列基板100可以包括：
发光驱动电路40，位于周边区域A2。相应的，发光驱动电路40也可以称为制作在阵列基板上的发光(emmision on array，EOA)控制单元。结合图5，本公开实施例涉及到的附图均以EOA 40表示发光驱动电路40。通过将发光驱动电路40设置于阵列基板的周边区域A2上，也有利于窄边框设计。
或者，作为另一种可选的实现方式，多行第一子像素所电连接的发光控制信号线可以与同一个发光驱动电路电连接，且电连接至同一个发光驱动电路的第一子像素位于不同行。
例如，图6是本公开实施例提供的再一种阵列基板的结构示意图。如图6所示，其示出的阵列基板100中，每相邻三行第一子像素可以与同一个发光驱动电路(即图6示出的一个EOA 40)电连接。且，图6也仅以第一行第一子像素P1、第二行第一子像素P2和第三行第一子像素P3为例示出。通过设置多行第一子像素与同一个发光驱动电路电连接，进一步简化了设计。
需要说明的是，结合图5，各发光驱动电路40，即EOA 40也可以沿垂直于栅线的延伸方向排布于阵列基板上，且相邻的EOA40可以级联。相应的，各发光驱动电路可以按排布顺序依次向其所电连接的发光控制信号线EM提供信号。
可选的，结合上述图1至图6可以看出，每行第一子像素可以包括多个第一子像素(图1至图6均以长方块示出每个第一子像素)，且该多个第一子像素可以包括能够发出红颜色光的红色子像素、能够发出绿颜色光的绿色子像素以及能够发出蓝颜色光的蓝色子像素，各第一子像素的结构可以相同。
以位于第一行中第一列的第一子像素为例，图7示出了本公开实施例提供的一种第一子像素的结构示意图。图8示出了本公开实施例提供的另一种第一子像素的结构示意图。参考图7和图8可以看出，该第一子像素可以包括：像素电路01以及与像素电路01电连接的发光单元02。
作为一种可选的实现方式，参考图7，该像素电路01可分别与栅线GATE1、复位信号线RST1和发光单元02电连接。该像素电路01可以响应于栅线GATE1提供的栅极驱动信号以及复位信号线RST1提供的复位信号，驱动发光单元02发光。例如在正常驱动时，该像素电路01电连接的复位信号线RST1可以先提供复位信号，从而实现对像素电路01的复位；然后像素电路01电连接的栅线GATE1可以再提供栅极驱动信号，且在栅线GATE1提供栅极驱动信号时，复位信号线RST1不再提供复位信号，发光单元02响应于栅极驱动信号发光。
可选的，像素电路01还可以与提供数据信号的数据信号线电连接，在栅线GATE1提供栅极驱动信号时，数据信号可以输出至发光单元02，从而驱动发光单元02发光。
作为另一种可选的实现方式，参考图8，该像素电路还可以与发光控制信号线EM1电连接。相应的，该像素电路01还可以响应于栅极驱动信号、复位信号以及发光控制信号线EM1提供的发光控制信号，驱动发光单元发光。
需要说明的是，对于每个像素电路而言，发光控制信号线可以在其所电连接的栅线向其提供栅极驱动信号后，再提供发光控制信号至像素电路。通过再设置发光控制信号线，可以保证对发光单元02的可靠驱动。
还需要说明的是，本公开实施例提供的像素电路可以为7T1C(即包括7个晶体管和1个电容器)的结构，或者，也可以为其他结构，如9T2C(即包括9个晶体管和2个电容器)，本公开实施例对像素电路的具体结构不作限定。
图9是本公开实施例提供的一种阵列基板的局部版图(左局部)示意图。
图10是本公开实施例提供的一种阵列基板的局部版图(右局部)示意图。
结合图9和图10可以看出，位于显示区域的第一行第一子像素所电连接的复位信号线RST1与第一个栅极驱动电路电连接；第一行第一子像素所电连接的发光控制信号线EM1与第一个发光驱动电路电连接；第一行第一子像素所电连接的栅线GATE1与第二行第一子像素所电连接的复位信号线RST2，与同一个栅极驱动电路电连接。其他行同理，在此不再赘述。
除此之外，还可以看出，图9和图10示出的阵列基板左右两侧均为圆弧形，且该阵列基板还可以包括：不与任何信号线电连接的多行第二子像素P0，位于周边区域(图9和图10未示出周边区域)且位于第二栅极驱动电路20远离第一栅极驱动电路10的一侧，该多行第二子像素P0可以为不发光像素。由于该第二子像素P0不发光，因此该第二子像素P0也可以称为虚设子像素。
综上所述，本公开实施例提供了一种阵列基板。结合该阵列基板的第一子像素、各信号线和栅极驱动电路的电连接关系可知，在正常工作时，可以通过控制各栅极驱动电路灵活向其电连接的信号线提供信号，实现对第一子像素的逐行可靠驱动。且由于该阵列基板显示区域内未设置不发光的虚设子像素，因此相对于相关技术的阵列基板，该阵列基板不仅能正常显示，且设计较为简单。
图11是本公开实施例提供的一种显示面板的结构示意图。如图11所示，该显示面板可以包括：封装盖板200，以及如图1至图6、图9和图10所示的阵列基板100。
图12是本公开实施例提供了一种显示面板的结构示意图。如图12所示，该显示面板可以包括：驱动电路001，以及如图11所示的显示面板002。
其中，驱动电路001可以与显示面板002电连接，驱动电路001可以用于驱动显示面板工作。例如，该驱动电路可以为源极驱动电路。
可选的，该显示装置可以为AMOLED显示装置、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
应当理解的是，在本文中提及的“和/或”，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。字符“/”一般表示前后关联对象是一种“或”的关系。
以上所述仅为本公开的可选实施例，并不用以限制本公开，凡在本公开的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本公开的保护范围之内。

Claims (16)

1.一种阵列基板，包括：
衬底基板，具有显示区域和围绕所述显示区域的周边区域；
多行第一子像素，位于所述显示区域，所述多行第一子像素为发光像素且所述多行第一子像素的边界为所述显示区域的边界；
多条栅线，位于所述显示区域和所述周边区域，所述多行第一子像素与所述多条栅线电连接；
多条复位信号线，位于所述显示区域和所述周边区域，所述多行第一子像素与所述多条复位信号线电连接；
每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线，与相同的两个第一栅极驱动电路电连接；并且，每相邻两行第一子像素所电连接的两个所述第一栅极驱动电路，相对设置于所述相邻两行第一子像素的两端；
位于首行的第一子像素所连接的第一目标走线与两个第二栅极驱动电路电连接；位于末行的第一子像素所连接的第二目标走线与两个第三栅极驱动电路电连接；其中，所述第一目标走线和所述第二目标走线中的一个目标走线为所述多条栅线中的一条，另一个目标走线为所述多条复位信号线中的一条。
2.根据权利要求1所述的阵列基板，其特征在于，所述多行第一子像素与所述多条栅线一一对应电连接，且所述多行第一子像素与所述多条复位信号线一一对应电连接。
3.根据权利要求1所述的阵列基板，其特征在于，每相邻两行第一子像素中，奇数行第一子像素所电连接的栅线和偶数行第一子像素所电连接的复位信号线，与相同的第一栅极驱动电路电连接；
所述第一目标走线为所述多条复位信号线中的一条，所述第二目标走线为所述多条栅线中的一条。
4.根据权利要求1所述的阵列基板，其特征在于，每相邻两行第一子像素中，奇数行第一子像素所电连接的复位信号线和偶数行第一子像素所电连接的栅线，与相同的第一栅极驱动电路电连接；
所述第一目标走线为所述多条栅线中的一条，所述第二目标走线为所述多条复位信号线中的一条。
5.根据权利要求1至4任一所述的阵列基板，其特征在于，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线相连，并与相同的第一栅极驱动电路电连接。
6.根据权利要求5所述的阵列基板，其特征在于，每相邻两行第一子像素中，一行第一子像素所电连接的栅线和另一行第一子像素所电连接的复位信号线相连，并通过所述栅线与相同的第一栅极驱动电路电连接。
7.根据权利要求1至4任一所述的阵列基板，其特征在于，所述阵列基板包括：
多个所述第一栅极驱动电路，位于所述周边区域；
所述第二栅极驱动电路，位于所述周边区域，且位于多个所述第一栅极驱动电路的一侧；
所述第三栅极驱动电路，位于所述周边区域，且位于所述多个第一栅极驱动电路远离所述第二栅极驱动电路的一侧。
8.根据权利要求1至4任一所述的阵列基板，其特征在于，所述阵列基板还包括：
多条发光控制信号线，位于所述显示区域与所述周边区域，所述多行第一子像素与所述多条发光控制信号线一一对应电连接。
9.根据权利要求8所述的阵列基板，其特征在于，每行第一子像素所电连接的发光控制信号线与一个发光驱动电路电连接，且各行第一子像素所电连接的发光控制信号线电连接的发光驱动电路不同。
10.根据权利要求8所述的阵列基板，其特征在于，多行第一子像素所电连接的发光控制信号线与同一个发光驱动电路电连接，且电连接至同一个发光驱动电路的第一子像素位于不同行。
11.根据权利要求9或10所述的阵列基板，其特征在于，所述阵列基板包括：所述发光驱动电路，位于所述周边区域。
12.根据权利要求1至4任一所述的阵列基板，其特征在于，每个所述第一子像素包括：像素电路以及与所述像素电路电连接的发光单元；
所述像素电路分别与所述栅线、所述复位信号线和所述发光单元电连接，所述像素电路用于响应于所述栅线提供的栅极驱动信号以及所述复位信号线提供的复位信号，驱动所述发光单元发光。
13.根据权利要求12所述的阵列基板，其特征在于，所述像素电路还与所述发光控制信号线电连接；
所述像素电路用于响应于所述栅极驱动信号、所述复位信号以及所述发光控制信号线提供的发光控制信号，驱动所述发光单元发光。
14.根据权利要求1至4任一所述的阵列基板，其特征在于，所述阵列基板还包括：
多行第二子像素，位于所述周边区域且位于所述第二栅极驱动电路远离所述第一栅极驱动电路的一侧，所述多行第二子像素为不发光像素。
15.一种显示面板，其特征在于，所述显示面板包括：封装盖板，以及如权利要求1至14任一所述的阵列基板。
16.一种显示装置，其特征在于，所述显示装置包括：驱动电路，以及如权利要求15所述的显示面板，所述驱动电路与所述显示面板电连接，所述驱动电路用于驱动所述显示面板工作。
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