CN115273726A - 显示基板、显示面板及显示装置 - Google Patents

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Abstract

显示基板、显示面板及显示装置，涉及显示技术领域。显示基板包括显示区域以及位于显示区域至少一侧的周边区域，显示基板包括：衬底，以及设置在衬底一侧的栅线驱动电路、多条信号线和栅线，栅线驱动电路和多条信号线均位于周边区域，栅线位于显示区域；其中，栅线驱动电路分别与多条信号线以及栅线连接，包括相互级联的多级驱动单元，驱动单元包括第一元件组，第一元件组包括至少一个第一电子元件；多条信号线沿第一方向排布，第一方向为栅线的延伸方向，多条信号线中的至少一条位于第一元件组靠近显示区域的一侧。

Description

显示基板、显示面板及显示装置
技术领域
本公开涉及显示技术领域，特别是涉及一种显示基板、显示面板及显示装置。
背景技术
随着显示技术的发展，人们对显示产品的显示效果以及信赖性等方面的要求越来越高。液晶显示面板作为一种广泛使用的显示面板，在显示领域占有重要地位。
发明内容
本公开提供了一种显示基板，包括显示区域以及位于所述显示区域至少一侧的周边区域，所述显示基板包括：
衬底，以及设置在所述衬底一侧的栅线驱动电路、多条信号线和栅线，所述栅线驱动电路和所述多条信号线均位于所述周边区域，所述栅线位于所述显示区域；
其中，所述栅线驱动电路分别与所述多条信号线以及所述栅线连接，包括相互级联的多级驱动单元，所述驱动单元包括第一元件组，所述第一元件组包括至少一个第一电子元件；
所述多条信号线沿第一方向排布，所述第一方向为所述栅线的延伸方向，所述多条信号线中的至少一条位于所述第一元件组靠近所述显示区域的一侧。
在一些可选的实施方式中，所述多条信号线中的至少一条位于所述驱动单元靠近所述显示区域的一侧。
在一些可选的实施方式中，所述驱动单元还包括：
第二元件组，位于所述第一元件组靠近所述显示区域的一侧，包括至少一个第二电子元件；
其中，所述多条信号线分为第一线组和第二线组，所述第一线组位于所述第一元件组和所述第二元件组之间，所述第二线组位于所述第二元件组靠近所述显示区域的一侧。
在一些可选的实施方式中，所述多条信号线包括：位于所述第一线组内的第一信号线，以及位于所述第二线组内的第二信号线；
其中，所述第一信号线上的电流小于或等于所述第二信号线上的电流。
在一些可选的实施方式中，所述第一信号线与直流信号输入端连接，所述直流信号输入端用于输入直流信号至所述第一信号线；
所述第二信号线与交流信号输入端连接，所述交流信号输入端用于输入交流信号至所述第二信号线。
在一些可选的实施方式中，所述第一电子元件在所述衬底上的正投影面积大于或等于所述第二电子元件在所述衬底上的正投影面积。
在一些可选的实施方式中，所述驱动单元包括：
信号输入端、信号输出端和第一晶体管，所述第一晶体管的控制极与所述信号输入端连接，所述第一晶体管的第一极与所述第一晶体管的控制极或者高电平信号线连接，所述信号输出端与所述栅线连接；
其中，第i级驱动单元的信号输入端连接第一起始信号线或者第i-j级驱动单元的信号输出端，所述i和所述j均为正整数，且所述j小于所述i。
在一些可选的实施方式中，所述第一晶体管位于所述第二元件组中且远离所述显示区域设置，所述高电平信号线位于所述第一线组中且靠近所述显示区域设置。
在一些可选的实施方式中，所述第一起始信号线位于所述第二线组中且靠近所述显示区域设置。
在一些可选的实施方式中，所述多条信号线还包括：
低电平信号线，位于所述第一线组中，且设置在所述高电平信号线远离所述显示区域的一侧。
在一些可选的实施方式中，所述驱动单元包括：
信号输出端、第二晶体管和电容，所述第二晶体管的控制极与所述电容的第一极连接，所述第二晶体管的第一极与时钟信号线连接，所述第二晶体管的第二极与所述电容的第二极以及所述信号输出端连接，所述信号输出端与所述栅线连接；
其中，所述第二晶体管和所述电容均位于所述第一元件组中，所述时钟信号线位于所述第二线组中。
在一些可选的实施方式中，所述驱动单元包括：
第三晶体管和第四晶体管，所述第三晶体管的控制极和所述第四晶体管的控制极均与第二起始信号线连接；
其中，所述第三晶体管和所述第四晶体管位于所述第二元件组中且靠近所述显示区域设置，所述第二起始信号线位于所述第二线组中且远离所述显示区域设置。
在一些可选的实施方式中，所述多条信号线包括电源电压信号线和时钟信号线，所述驱动单元包括多个晶体管；
其中，连接所述电源电压信号线的晶体管数量大于连接所述时钟信号线的晶体管数量，所述电源电压信号线和所述时钟信号线均位于所述第二线组中，且所述电源电压信号线位于所述时钟信号线远离所述显示区域的一侧。
在一些可选的实施方式中，所述第一线组包括以下信号线至少之一：高电平信号线和低电平信号线；
所述第二线组包括以下信号线至少之一：低电平信号线、电源电压信号线、时钟信号线和起始信号线。
在一些可选的实施方式中，所述第一元件组和所述第二元件组均包括以下电子元件至少之一：晶体管和电容。
在一些可选的实施方式中，所述驱动单元包括晶体管，所述晶体管的控制极、所述信号线以及所述栅线均位于同一膜层且材料相同。
在一些可选的实施方式中，所述显示基板包括两个所述栅线驱动电路，两个所述栅线驱动电路分别为第一栅线驱动电路和第二栅线驱动电路，所述第一栅线驱动电路与位于偶数行的栅线连接，所述第二栅线驱动电路与位于奇数行的栅线连接；
其中，所述第一栅线驱动电路以及连接所述第一栅线驱动电路的多条信号线位于所述显示区域的第一侧，所述第二栅线驱动电路以及连接所述第二栅线驱动电路的多条信号线位于所述显示区域的第二侧，所述第一侧和所述第二侧为沿所述第一方向上相对的两侧。
本公开提供了一种显示面板，包括任一实施方式所述的显示基板。
在一些可选的实施方式中，所述显示面板还包括：
对盒基板，与所述显示基板相对设置；以及
封框胶，设置在所述对盒基板与所述显示基板之间，所述封框胶在所述衬底上的正投影位于所述周边区域内；
其中，所述驱动单元还包括：第二元件组，位于所述第一元件组靠近所述显示区域的一侧，包括至少一个第二电子元件；所述多条信号线分为第一线组和第二线组，所述第一线组位于所述第一元件组和所述第二元件组之间，所述第二线组位于所述第二元件组靠近所述显示区域的一侧；
所述封框胶在所述衬底上的正投影，覆盖所述第一元件组、所述第一线组以及至少部分所述第二元件组在所述衬底上的正投影。
本公开提供了一种显示装置，包括：
如任一实施方式所述的显示面板；以及
驱动芯片，与所述多条信号线连接，用于向所述多条信号线提供驱动信号。
上述说明仅是本公开技术方案的概述，为了能够更清楚了解本公开的技术手段，而可依照说明书的内容予以实施，并且为了让本公开的上述和其它目的、特征和优点能够更明显易懂，以下特举本公开的具体实施方式。
附图说明
为了更清楚地说明本公开实施例或相关技术中的技术方案，下面将对实施例或相关技术描述中所需要使用的附图作一简单地介绍，显而易见地，下面描述中的附图是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。需要说明的是，附图中的比例仅作为示意并不代表实际比例。
图1示意性地示出了相关技术中的一种显示基板的平面结构示意图；
图2示意性地示出了本公开提供的一种显示基板的平面结构示意图；
图3示意性地示出了本公开提供的显示基板中虚线框E处的结构示意图；
图4示意性地示出了本公开提供的显示基板中虚线框E处的显微镜图；
图5示意性地示出了本公开提供的显示基板中虚线框D、E和F处的结构示意图；
图6示意性地示出了第一种驱动单元的电路结构示意图；
图7示意性地示出了第二种驱动单元的电路结构示意图；
图8示意性地示出了第一栅线驱动电路的电路结构示意图；
图9示意性地示出了第二栅线驱动电路的电路结构示意图；
图10示意性地示出了两种驱动单元的信号输出端在高温测试完成后输出的模拟波形；
图11示意性地示出了一个驱动单元的输入输出信号的时序图；
图12示意性地示出了一种显示面板的剖面结构示意图；
图13示意性地示出了一种显示面板的局部平面结构示意图。
具体实施方式
为使本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例中的附图，对本公开实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例是本公开一部分实施例，而不是全部的实施例。基于本公开中的实施例，本领域普通技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本公开保护的范围。
参照图1示意性地示出了相关技术中的一种显示基板的平面结构示意图，如图1所示，显示基板包括显示区域11以及位于显示区域11两侧的边框区域12。边框区域12包括栅线驱动电路区域13和信号线区域14，栅线驱动电路区域13中设置有栅线驱动电路，信号线区域14中设置有信号线，栅线驱动电路与信号线通过过孔连接。
相关技术中，如图1所示，信号线区域14位于栅线驱动电路区域13远离显示区域11的一侧，使得信号线与封框胶外边缘(图中未示出)之间的距离(该距离需要大于或等于指定值如25mm)较近，导致信号线与栅线驱动电路之间的连接过孔容易发生腐蚀。
为了解决上述问题，本公开提供了一种显示基板，参照图2示意性地示出了本公开提供的一种显示基板的平面结构示意图，如图2所示，该显示基板包括显示区域AA以及位于显示区域AA至少一侧的周边区域BB。在图2中，周边区域BB位于显示区域AA的四周。
参照图3示意性地示出了图2所示显示基板在虚线框E处的平面结构示意图，图4是与图3对应的显微镜图。如图3或图4所示，显示基板包括：衬底30，以及设置在衬底30一侧的栅线驱动电路31、多条信号线32和栅线33，栅线驱动电路31和多条信号线32均位于周边区域BB，栅线33位于显示区域AA。
其中，栅线驱动电路31，分别与多条信号线32以及栅线33连接，用于根据多条信号线32输入的驱动信号，输出扫描信号至栅线33。
如图3所示，栅线驱动电路31包括相互级联的多级驱动单元RS，驱动单元RS包括第一元件组34，第一元件组34包括至少一个第一电子元件。第一电子元件为位于第一元件组34中的电子元件。第一元件组34可以包括以下电子元件至少之一：晶体管和电容等。
在具体实现中，第一元件组34可以包括一个第一电子元件或者多个第一电子元件。第一元件组34中所包含的第一电子元件的数量大于或等于1，且小于或等于驱动单元RS所包含的所有电子元件的数量。
其中，多条信号线32沿第一方向排布，第一方向为栅线33的延伸方向，多条信号线32中的至少一条位于第一元件组34靠近显示区域AA的一侧。也就是，与栅线驱动电路31连接的一条或多条信号线32，可以位于该栅线驱动电路31中的第一元件组34靠近显示区域AA的一侧。
示例性地，如图3所示，第一元件组34包括两个第一电子元件，即晶体管M3和电容C。驱动单元RS包括多个晶体管(如图3所示的M1至M3，以及M5至M18)以及一个电容(如图3所示的C)等18个电子元件。
如图3所示的栅线驱动电路31，与该栅线驱动电路31连接的信号线32有10条，这10条信号线包括高电平信号线VGH、低电平信号线VGL、两条电源电压信号线VDD1和VDD2、四条时钟信号线CLK1、CLK3、CLK5和CLK7，以及两条起始信号线STV0和STV1。
其中，与图3所示栅线驱动电路31连接的全部信号线(即10条信号线32)，均位于该栅线驱动电路31中的第一元件组34靠近显示区域AA的一侧。
在具体实现中，位于第一元件组34靠近显示区域AA一侧的信号线数量大于或等于1，且小于或等于连接同一个栅线驱动电路31的信号线的总数量。
在具体实现中，如图3或图4所示，栅线驱动电路31与信号线32之间通过过孔H连接。
本公开提供的显示基板，通过将连接栅线驱动电路31的一条或多条信号线32设置于第一元件组34靠近显示区域AA的一侧，可以增大上述一条或多条信号线32与封框胶外边缘之间的距离，进而可以降低这些信号线32与栅线驱动电路31之间的连接过孔发生腐蚀的概率，提高显示基板的高温寿命，提升显示产品品质和信赖性。另外，本公开无需通过加大边框宽度就能够实现信号线与封框胶外边缘之间距离的增大，因此有助于实现窄边框。
在一些实施方式中，如图3所示，位于显示区域AA内的栅线33沿第一方向延伸，多条栅线33沿第二方向排布。可选地，信号线32可以沿第二方向延伸，第一方向与第二方向相互交叉或相互垂直(如图3所示出的)。
在一些实施方式中，如图3所示的栅线驱动电路31，多级驱动单元RS沿第二方向排布。
在一些实施方式中，多条信号线32中的至少一条位于驱动单元RS靠近显示区域AA的一侧。也就是，与栅线驱动电路31连接的一条或多条信号线32，可以位于该栅线驱动电路31中的驱动单元RS靠近显示区域AA的一侧。
示例性地，如图3所示的栅线驱动电路31，与该栅线驱动电路31连接的信号线有10条，其中8条信号线：两条电源电压信号线VDD1和VDD2、四条时钟信号线CLK1、CLK3、CLK5和CLK7，以及两条起始信号线STV0和STV1，均位于驱动单元RS靠近显示区域AA的一侧。
通过将连接栅线驱动电路31的一条或多条信号线32设置于该栅线驱动电路31中的驱动单元RS靠近显示区域AA的一侧，可以进一步增大上述一条或多条信号线32与封框胶外边缘之间的距离，进一步降低这些信号线32与栅线驱动电路31的连接过孔发生腐蚀的概率，提高显示基板的高温寿命，提升显示产品品质和信赖性。
在具体实现中，与栅线驱动电路31连接的所有信号线32可以都位于该栅线驱动电路31中的驱动单元RS靠近显示区域AA的一侧，从而可以最大程度地降低信号线32与栅线驱动电路31的连接过孔发生腐蚀的概率；或者，与栅线驱动电路31连接的部分信号线(即一条或多条，如图3所示的10条信号线中的8条)位于该栅线驱动电路31中的驱动单元RS靠近显示区域AA的一侧，这种情况下，其它信号线32可以根据布线空间等需求进行设置，本公开对此不作限定。
在一些实施方式中，如图3所示，驱动单元RS还包括：第二元件组35，位于第一元件组34靠近显示区域AA的一侧，包括至少一个第二电子元件。
本实施方式中，连接同一个栅线驱动电路31的多条信号线32分为第一线组36和第二线组37，第二元件组35第一线组36位于第一元件组34和第二元件组35之间，第二线组37位于第二元件组35靠近显示区域AA的一侧。
其中，第二电子元件为位于第二线组37中的电子元件。第二元件组35可以包括以下电子元件至少之一：晶体管和电容。
在具体实现中，第二线组37可以包括一个第二电子元件或者多个第二电子元件。第二线组37中所包含的第二电子元件的数量大于或等于1，且小于驱动单元RS所包含的所有电子元件的数量。
示例性地，如图3所示，第二元件组35包括16个第二电子元件，即晶体管M1至M2，M5至M18。驱动单元RS包括多个晶体管(如图3所示的M1至M3，以及M5至M18)以及一个电容(如图3所示的C)等18个电子元件。
示例性地，如图3所示，第一线组36包括两条信号线32，即高电平信号线VGH和低电平信号线VGL。第二线组37包括8条信号线32，即两条电源电压信号线VDD1和VDD2、四条时钟信号线CLK1、CLK3、CLK5和CLK7，以及两条起始信号线STV0和STV1。
其中，如图3所示，第一元件组34设置在第二元件组35的外侧(即靠近显示基板边缘的一侧)设置，第一线组36设置在第一元件组34与第二元件组35之间，第二线组37设置在第二元件组35的里侧(即靠近显示区域AA的一侧)设置。如图3所示，沿着靠近显示区域AA的方向(如图3所示的第三方向)上，第一元件组34、第一线组36、第二元件组35和第二线组37依次排布。
本实施方式中，与栅线驱动电路31连接的部分信号线32(即第二线组37中的信号线32)位于该栅线驱动电路31中的驱动单元RS靠近显示区域AA的一侧。其它信号线32(即第一线组36中的信号线32)设置在第一元件组34和第二元件组35之间。
在一些实施方式中，多条信号线32包括：位于第一线组36内的第一信号线321，以及位于第二线组37内的第二信号线322。其中，第一信号线321上的电流小于或等于第二信号线322上的电流。
由于连接较大电流信号线32的过孔更容易腐蚀，因此，通过将电流较大的第二信号线322设置在更靠近显示区域AA的第二线组37中，可以增大其与封框胶外边缘的距离，从而有效地降低第二信号线322上的过孔发生腐蚀的概率。
在一些实施方式中，第一信号线321与直流信号输入端(图中未示出)连接，直流信号输入端用于输入直流信号至第一信号线321。其中，直流信号例如可以是高电平直流信号或低电平直流信号等。
由于直流信号没有高低电平切换，因此传输直流信号的第一信号线321上基本没有电流，即使将第一信号线321放置在靠外侧的第一线组36中，也不会加大腐蚀风险，同时还可以进一步增大第二线组37与封框胶外边缘之间的距离，降低连接第二信号线322的过孔发生腐蚀的风险。
在一些实施方式中，如图3所示，第一线组36包括以下信号线至少之一：高电平信号线VGH和低电平信号线VGL等用于传输直流信号的信号线32。其中，高电平信号线VGH用于传输高电平直流信号。低电平信号线VGL用于传输低电平直流信号。
示例性地，如图3所示，第一线组36包括两条第一信号线321，即高电平信号线VGH和低电平信号线VGL。
在一些实施方式中，第二信号线322与交流信号输入端(图中未示出)连接，交流信号输入端用于输入交流信号至第二信号线322。其中，交流信号例如可以是脉冲方波信号等。
由于交流信号具有频繁的高低电平切换，因此传输交流信号的第二信号线322上有较大的电流，通过将第二信号线322设置在靠里侧的第二线组37中，可以增大其与封框胶外边缘之间的距离，降低发生腐蚀的概率。
在一些实施方式中，第二线组37包括以下信号线至少之一：电源电压信号线VDD、时钟信号线CLK和起始信号线STV等用于传输交流信号的信号线32。
本文中如无特别说明，电源电压信号线VDD可以是图3所示两条电源电压信号线VDD1和VDD2中的任意一条，时钟信号线CLK可以是图3所示四条时钟信号线CLK1、CLK3、CLK5和CLK7中的任意一条，起始信号线STV可以是图3所示两条起始信号线STV0和STV1中的任意一条。
示例性地，如图3所示，第二线组37包括8条第二信号线322，即两条电源电压信号线VDD1和VDD2、四条时钟信号线CLK1、CLK3、CLK5和CLK7，以及两条起始信号线STV0和STV1。
在一些实施方式中，如图3所示，第一电子元件在衬底30上的正投影面积大于或等于第二电子元件在衬底30上的正投影面积。
通过将占用空间较大的第一电子元件放置在距离显示区域AA较远的第一元件组34中，可以进一步增大各信号线32与封框胶外边缘之间的距离，降低连接过孔腐蚀风险，有助于减小边框宽度。
在一些实施方式中，参照图6和图7示出了两种驱动单元的电路结构示意图，如图6和图7所示，驱动单元RS包括：信号输入端Input、信号输出端Output和第一晶体管M1，第一晶体管M1的控制极与信号输入端Input连接，第一晶体管M1的第一极与第一晶体管M1的控制极(如图6所示)或者高电平信号线VGH(如图7所示)连接，信号输出端Output与栅线33连接。
参照图9，第i级驱动单元RS i的信号输入端Input连接第一起始信号线STV1或者第i-j级驱动单元RS i-j的信号输出端Output，i和j均为正整数，且j小于i。
具体地，当i小于或等于j时，第i级驱动单元RS i的信号输入端Input可以连接第一起始信号线STV1；当i大于j时，第i级驱动单元RS i的信号输入端Input连接第i-j级驱动单元RS i-j的信号输出端Output。
在图9中，j等于2，即第1级驱动单元RS 1和第2级驱动单元RS 2的信号输入端Input连接第一起始信号线STV1。第3级驱动单元RS 3的信号输入端Input连接第1级驱动单元RS 1的信号输出端Output，第4级驱动单元RS 4的信号输入端Input连接第2级驱动单元RS 2的信号输出端Output，依此类推。
如图9所示，多级驱动单元RS可以分别连接不同的栅线33，在图9中，驱动单元RS与栅线33一一对应连接。
如图6和图7所示，第一晶体管M1的第二极与上拉节点PU连接，第一晶体管M1用于根据控制极的信号，导通或关断第一极和第二极之间的连接，并在第一极和第二极导通时，将第一极的信号写入上拉节点PU。
可选地，如图6所示，第一晶体管M1的第一极与第一晶体管M1的控制极连接。当第i级驱动单元RS i的信号输入端Input与第i-j级驱动单元RS i-j的信号输出端Output连接时，在第i级驱动单元RS i中，第一晶体管M1的第一极与第i-j级驱动单元RS i-j的信号输出端Output连接，由于信号输出端Output还与栅线33连接，显示区域AA中的子像素负载较大，导致信号输出端Output输出的信号有延迟，进而使得第i级驱动单元RS i中的上拉节点PU信号产生延迟，影响上拉节点PU的充电，图6所示显示基板在信赖性测试之后很容易出现显示不良。
为了解决上述问题，可选地，如图7所示，第一晶体管M1的第一极与高电平信号线VGH连接。当第一晶体管M1打开时，第一极和第二极导通，从而可以将高电平信号线VGH输入的高电平信号写入上拉节点PU，为上拉节点PU充电。由于高电平信号线VGH为高电平信号源，不连接负载，没有延迟，即使信赖性测试后，第一晶体管M1的阈值电压产生漂移，也可以在有限的时间内将上拉节点PU充电至高电平，从而提高产品的信赖性。
参照图10，发明人对图7所示驱动单元进行85℃，40hr的高温测试(图10中虚线)，对图6所示驱动单元进行85℃，20hr的高温测试(图10中实线)，图10示出了两种驱动单元的信号输出端在高温测试完成后输出的模拟波形。对比发现，图7所示驱动单元的信号输出端Output输出的模拟波形延迟较小，图6所示驱动单元的信号输出端Output输出的模拟波形的下降沿有明显翘起，表现出明显的延迟，并且随着高温测试时间的延长，其翘起会越来越高，最终导致显示基板显示异常。
发明人还用模拟软件模拟了分别采用图6和图7两种驱动单元结构的显示基板在高温测试下的寿命，对比发现，采用图7所示结构，可以使显示基板的寿命从50hr提升至20000hr，有效提高高温信赖性和显示基板的寿命。
在一些实施方式中，如图3所示，第一晶体管M1位于第二元件组35中且远离显示区域AA设置，高电平信号线VGH位于第一线组36中且靠近显示区域AA设置。
由于高电平信号线VGH只连接第一晶体管M1，通过将高电平信号线VGH设置在第一线组36中且靠近第一晶体管M1的位置，如图3所示出的，可以节省布线空间，减小边框宽度。
在一些实施方式中，如图3所示，第一起始信号线STV1位于第二线组37中且靠近显示区域AA设置。
在一些实施方式中，如图3所示，多条信号线32还包括：低电平信号线VGL，位于第一线组36中，且设置在高电平信号线VGH远离显示区域AA的一侧。测试发现，通过将低电平信号线VGL设置在第一线组36中，可以减少电子元件与低电平信号线VGL之间的连接线长度，降低线路功耗。
需要说明的是，低电平信号线VGL也可以根据需要设置在第一线组36中且位于高电平信号线VGH靠近显示区域AA的一侧，或者设置在第二线组37中，本公开对此不作限定。
在一些实施方式中，如图6和图7所示，驱动单元RS包括：信号输出端Output、第二晶体管M3和电容C，第二晶体管M3的控制极与电容C的第一极连接，第二晶体管M3的第一极与时钟信号线CLK连接，第二晶体管M3的第二极与电容C的第二极以及信号输出端Output连接，信号输出端Output与栅线33连接。
其中，如图3所示，第二晶体管M3和电容C均位于第一元件组34中，时钟信号线CLK位于第二线组37中。
由于第二晶体管M3的第二极与信号输出端Output连接，信号输出端Output还与栅线33连接，显示区域AA中的子像素负载较大，因此，与其它晶体管相比，第二晶体管M3可以具有较大的沟道宽长比，从而使其具有较大的开态电流，以提高其带载能力。
如图3所示，由于第二晶体管M3的沟道宽长比较大，导致其占用空间比其它晶体管大，因此可以将第二晶体管M3设置在第一元件组34中。为了提高电容C的电荷存储能力，可以设置较大的极板面积，导致电容C占用空间较大，因此可以将电容C设置在第一元件组34中。
在一些实施方式中，如图6和图7所示，驱动单元RS包括：第三晶体管M17和第四晶体管M18，第三晶体管M17的控制极和第四晶体管M18的控制极均与第二起始信号线STV0连接。
其中，如图3所示，第三晶体管M17和第四晶体管M18位于第二元件组35中且靠近显示区域AA设置，第二起始信号线STV0位于第二线组37中且远离显示区域AA设置。
通过将第二起始信号线STV0设置在第二线组37中且靠近第三晶体管M17和第四晶体管M18的位置，中间无其它信号线32间隔，可以缩短第二起始信号线STV0分别与第三晶体管M17或第四晶体管M18连接的连接线长度，降低线路损耗，同时避免过孔连接(当第二起始信号线STV0与第三晶体管M17和第四晶体管M18之间间隔有其它信号线时，为了防止短路，第二起始信号线STV0与第三晶体管M17或第四晶体管M18之间的连接线需要通过过孔转接到其它膜层，以跨过其它信号线)，节省布线空间，减小边框宽度。
为了进一步减少过孔数量，第三晶体管M17的控制极、第四晶体管M18的控制极以及第二起始信号线STV0可以均位于同一膜层且材料相同，
在一些实施方式中，多条信号线32包括电源电压信号线VDD和时钟信号线CLK，驱动单元RS包括多个晶体管(如图3示出了17个晶体管M1至M3，M5至M18)。
其中，如图6和图7所示，连接电源电压信号线VDD的晶体管数量大于连接时钟信号线CLK的晶体管数量，电源电压信号线VDD和时钟信号线CLK均位于第二线组37中，且电源电压信号线VDD位于时钟信号线CLK远离显示区域AA的一侧。
由于电源电压信号线VDD连接的晶体管数量比时钟信号线CLK连接的晶体管数量多，通过将电源电压信号线VDD设置在时钟信号线CLK靠近第一元件组34和第二元件组35的位置，可以节省布线空间，缩短连接线长度，降低线路损耗。
如图6和图7所示，连接电源电压信号线VDD1的晶体管(如图6和图7所示的M5和M6)数量为2，连接电源电压信号线VDD2的晶体管(如图6和图7所示的M11和M12)数量为2，连接时钟信号线CLK的晶体管(如图6和图7所示的M3)数量为1，也就是连接电源电压信号线VDD的晶体管数量大于连接时钟信号线CLK的晶体管数量。
示例性地，如图3所示，两条电源电压信号线VDD1和VDD2位于四条时钟信号线CLK1、CLK3、CLK5和CLK7远离显示区域AA的一侧。
在一些实施方式中，驱动单元RS包括晶体管，晶体管的控制极、信号线32以及栅线33均位于同一膜层且材料相同。
在具体实现中，信号线32还可以与晶体管的第一极和第二极位于同一膜层且材料相同，本公开对此不作限定。
在具体实现中，显示基板可以包括一个或多个上述的栅线驱动电路31。多个栅线驱动电路31分别连接不同的信号线32，即不同的栅线驱动电路31连接的信号线32不同，参照图8和图9示出的是双边交替驱动的两个栅线驱动电路31的级联关系。
在一些实施方式中，显示基板包括两个栅线驱动电路31，两个栅线驱动电路31分别为第一栅线驱动电路GOA1(如图8所示)和第二栅线驱动电路GOA2(如图9所示)，第一栅线驱动电路GOA1与位于偶数行的栅线33(如图8所示的gate2,gate4…)连接，第二栅线驱动电路GOA2与位于奇数行的栅线33(如图9所示的gate1,gate3…)连接。
其中，第一栅线驱动电路GOA1以及连接第一栅线驱动电路GOA1的多条信号线32位于显示区域AA的第一侧(如图2所示显示区域AA的右侧)，第二栅线驱动电路GOA2以及连接第二栅线驱动电路GOA2的多条信号线32位于显示区域AA的第二侧(如图2所示显示区域AA的左侧)，第一侧和第二侧为沿第一方向上相对的两侧。
可选地，第一栅线驱动电路GOA1(如图8所示)和第二栅线驱动电路GOA2(如图9所示)均包括相互级联的多个驱动单元RS 1至RS k。
如图8和图9所示，当栅线驱动电路31包括k级驱动单元RS，且p小于或等于k-j时，第p级驱动单元RS p的复位信号端Reset连接第p+j级驱动单元RS p+j的信号输出端Output；当p大于k-j时，第p级驱动单元RS的复位信号端Reset连接第二起始信号线STV0。其中，k、p和j均为正整数，p和j均小于k。在图8和图9中，j等于2。
下面对图7所示驱动单元的工作过程进行说明。参照图11示出了各信号在不同阶段的时序图。图7所示驱动单元在一个刷新周期中包括四个阶段：a阶段、b阶段、c阶段和d阶段。
其中，在a阶段，信号输入端Input输入低电平信号，晶体管M1关闭，电源电压信号VDD1和VDD2对驱动单元进行降噪。
在b阶段，信号输入端Input输入高电平信号，晶体管M1打开，高电平信号线VGH通过晶体管M1给上拉节点PU充电至高电平，晶体管M3打开，信号输出端Output输出时钟信号线CLK(对应图9中的CLK1、CLK3、CLK5或CLK7，下同)的低电平。
在c阶段，信号输入端Input输入低电平信号，晶体管M1关闭，时钟信号线CLK为高电平，上拉节点PU自举至更高电平，晶体管M3仍打开，信号输出端Output输出时钟信号线CLK的高电平。
在d阶段，前一部分，复位信号端Reset输入低电平信号，时钟信号线CLK为低电平，上拉节点PU仍为高电平，晶体管M3打开，信号输出端Output输出时钟信号线CLK的低电平；后一部分，复位信号端Reset输入高电平信号，晶体管M2打开，低电平信号线VGL将上拉节点PU拉至低电平。
参照图5示出了位于图2左侧的第二栅线驱动电路GOA2在虚线框D、E和F处的结构示意图。
如图2和图3所示，第一元件组34、第一线组36、第二元件组35和第二线组37可以位于第二布线区22中。
如图2和图3所示，显示基板还可以包括：第一布线区21，位于第二布线区22远离显示区域AA的一侧；以及第三布线区23，位于第二布线区22与显示区域AA之间。其中，第一布线区21可以设置第一公共电压走线以及地线等，第二布线区23可以设置第二公共电压走线等。
本公开提供了一种显示面板，参照图12，包括如任一实施方式提供的显示基板121。
本领域技术人员可以理解，该显示面板具有前面显示基板的优点。
本公开提供的显示面板可以为液晶显示面板、有机发光二极管(Organic LightEmitting Diode，OLED)显示面板、量子发光二极管(Quantum Dot Light-Emitting Diode，QLED)显示面板、次毫米发光二极管(Mini Light-Emitting Diode，Mini LED)显示面板、微型发光二极管(Micro Light-Emitting Diode，Micro LED)显示面板、高分子发光二极管(Polymer Light-Emitting Diode，PLED)显示面板、等离子显示面板(Plasma DisplayPanel，PDP)等，这里对于显示面板的具体类型不做具体的限制。
在一些实施方式中，如图12所示，显示面板还包括：对盒基板122，与显示基板121相对设置；以及封框胶123，设置在对盒基板122与显示基板121之间，封框胶123在衬底上的正投影位于周边区域BB内。
如图3所示，驱动单元RS包括第一元件组34和第二元件组35，连接同一个栅线驱动电路31的多条信号线32分为第一线组36和第二线组37，第二元件组35位于第一元件组34靠近显示区域AA的一侧，第一线组36位于第一元件组34和第二元件组35之间，第二线组37位于第二元件组35靠近显示区域AA的一侧。
如图13所示，封框胶123在衬底上的正投影，覆盖第一元件组34、第一线组36以及至少部分第二元件组35在衬底上的正投影。
本公开提供了一种显示装置，包括如任一实施方式提供的显示面板。
本领域技术人员可以理解，该显示装置具有前面显示基板的优点。
本公开提供的显示装置，还可以包括驱动芯片，与多条信号线连接，用于向多条信号线提供驱动信号。驱动芯片在显示基板上的正投影可以位于周边区域。
若该显示面板为液晶显示面板，则该显示装置还可以包括背光模组，设置在液晶显示面板的背光侧，以提供背光。
本公开提供的显示装置，例如可以包括手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪、车载显示产品等任何具有显示功能的产品或部件。
本公开中，“多个”的含义是两个或两个以上，“至少一个”的含义是一个或一个以上，除非另有明确具体的限定。
本公开中，术语“上”、“下”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本公开和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本公开的限制。
在权利要求中，不应将位于括号之间的任何参考符号构造成对权利要求的限制。
在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、商品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、产品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括一个……”限定的要素，并不排除在包括所述要素的过程、方法、商品或者设备中还存在另外的相同要素。
以上对本公开所提供的一种光栅调节装置及显示装置进行了详细介绍，本文中应用了具体个例对本公开的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本公开的方法及其核心思想。
本说明书中的各个实施例均采用递进的方式描述，每个实施例重点说明的都是与其他实施例的不同之处，各个实施例之间相同相似的部分互相参见即可。
本文中所称的“一个实施例”、“实施例”或者“一个或者多个实施例”意味着，结合实施例描述的特定特征、结构或者特性包括在本公开的至少一个实施例中。此外，请注意，这里“在一个实施例中”的词语例子不一定全指同一个实施例。
在此处所提供的说明书中，说明了大量具体细节。然而，能够理解，本公开的实施例可以在没有这些具体细节的情况下被实践。在一些实例中，并未详细示出公知的方法、结构和技术，以便不模糊对本说明书的理解。
本公开旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性原理并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的，本公开的真正范围和精神由所附的权利要求指出。

Claims (20)

1.一种显示基板，包括显示区域以及位于所述显示区域至少一侧的周边区域，所述显示基板包括：
衬底，以及设置在所述衬底一侧的栅线驱动电路、多条信号线和栅线，所述栅线驱动电路和所述多条信号线均位于所述周边区域，所述栅线位于所述显示区域；
其中，所述栅线驱动电路分别与所述多条信号线以及所述栅线连接，包括相互级联的多级驱动单元，所述驱动单元包括第一元件组，所述第一元件组包括至少一个第一电子元件；
所述多条信号线沿第一方向排布，所述第一方向为所述栅线的延伸方向，所述多条信号线中的至少一条位于所述第一元件组靠近所述显示区域的一侧。
2.根据权利要求1所述的显示基板，其中，所述多条信号线中的至少一条位于所述驱动单元靠近所述显示区域的一侧。
3.根据权利要求1所述的显示基板，其中，所述驱动单元还包括：
第二元件组，位于所述第一元件组靠近所述显示区域的一侧，包括至少一个第二电子元件；
其中，所述多条信号线分为第一线组和第二线组，所述第一线组位于所述第一元件组和所述第二元件组之间，所述第二线组位于所述第二元件组靠近所述显示区域的一侧。
4.根据权利要求3所述的显示基板，其中，所述多条信号线包括：位于所述第一线组内的第一信号线，以及位于所述第二线组内的第二信号线；
其中，所述第一信号线上的电流小于或等于所述第二信号线上的电流。
5.根据权利要求4所述的显示基板，其中，所述第一信号线与直流信号输入端连接，所述直流信号输入端用于输入直流信号至所述第一信号线；
所述第二信号线与交流信号输入端连接，所述交流信号输入端用于输入交流信号至所述第二信号线。
6.根据权利要求3所述的显示基板，其中，所述第一电子元件在所述衬底上的正投影面积大于或等于所述第二电子元件在所述衬底上的正投影面积。
7.根据权利要求3所述的显示基板，其中，所述驱动单元包括：
信号输入端、信号输出端和第一晶体管，所述第一晶体管的控制极与所述信号输入端连接，所述第一晶体管的第一极与所述第一晶体管的控制极或者高电平信号线连接，所述信号输出端与所述栅线连接；
其中，第i级驱动单元的信号输入端连接第一起始信号线或者第i-j级驱动单元的信号输出端，所述i和所述j均为正整数，且所述j小于所述i。
8.根据权利要求7所述的显示基板，其中，所述第一晶体管位于所述第二元件组中且远离所述显示区域设置，所述高电平信号线位于所述第一线组中且靠近所述显示区域设置。
9.根据权利要求7所述的显示基板，其中，所述第一起始信号线位于所述第二线组中且靠近所述显示区域设置。
10.根据权利要求8所述的显示基板，其中，所述多条信号线还包括：
低电平信号线，位于所述第一线组中，且设置在所述高电平信号线远离所述显示区域的一侧。
11.根据权利要求3所述的显示基板，其中，所述驱动单元包括：
信号输出端、第二晶体管和电容，所述第二晶体管的控制极与所述电容的第一极连接，所述第二晶体管的第一极与时钟信号线连接，所述第二晶体管的第二极与所述电容的第二极以及所述信号输出端连接，所述信号输出端与所述栅线连接；
其中，所述第二晶体管和所述电容均位于所述第一元件组中，所述时钟信号线位于所述第二线组中。
12.根据权利要求3所述的显示基板，其中，所述驱动单元包括：
第三晶体管和第四晶体管，所述第三晶体管的控制极和所述第四晶体管的控制极均与第二起始信号线连接；
其中，所述第三晶体管和所述第四晶体管位于所述第二元件组中且靠近所述显示区域设置，所述第二起始信号线位于所述第二线组中且远离所述显示区域设置。
13.根据权利要求3所述的显示基板，其中，所述多条信号线包括电源电压信号线和时钟信号线，所述驱动单元包括多个晶体管；
其中，连接所述电源电压信号线的晶体管数量大于连接所述时钟信号线的晶体管数量，所述电源电压信号线和所述时钟信号线均位于所述第二线组中，且所述电源电压信号线位于所述时钟信号线远离所述显示区域的一侧。
14.根据权利要求3所述的显示基板，其中，所述第一线组包括以下信号线至少之一：高电平信号线和低电平信号线；
所述第二线组包括以下信号线至少之一：低电平信号线、电源电压信号线、时钟信号线和起始信号线。
15.根据权利要求3所述的显示基板，其中，所述第一元件组和所述第二元件组均包括以下电子元件至少之一：晶体管和电容。
16.根据权利要求1至15任一项所述的显示基板，其中，所述驱动单元包括晶体管，所述晶体管的控制极、所述信号线以及所述栅线均位于同一膜层且材料相同。
17.根据权利要求1至15任一项所述的显示基板，其中，所述显示基板包括两个所述栅线驱动电路，两个所述栅线驱动电路分别为第一栅线驱动电路和第二栅线驱动电路，所述第一栅线驱动电路与位于偶数行的栅线连接，所述第二栅线驱动电路与位于奇数行的栅线连接；
其中，所述第一栅线驱动电路以及连接所述第一栅线驱动电路的多条信号线位于所述显示区域的第一侧，所述第二栅线驱动电路以及连接所述第二栅线驱动电路的多条信号线位于所述显示区域的第二侧，所述第一侧和所述第二侧为沿所述第一方向上相对的两侧。
18.一种显示面板，包括如权利要求1至17任一项所述的显示基板。
19.根据权利要求18所述的显示面板，其中，所述显示面板还包括：
对盒基板，与所述显示基板相对设置；以及
封框胶，设置在所述对盒基板与所述显示基板之间，所述封框胶在所述衬底上的正投影位于所述周边区域内；
其中，所述驱动单元还包括：第二元件组，位于所述第一元件组靠近所述显示区域的一侧，包括至少一个第二电子元件；所述多条信号线分为第一线组和第二线组，所述第一线组位于所述第一元件组和所述第二元件组之间，所述第二线组位于所述第二元件组靠近所述显示区域的一侧；
所述封框胶在所述衬底上的正投影，覆盖所述第一元件组、所述第一线组以及至少部分所述第二元件组在所述衬底上的正投影。
20.一种显示装置，包括：
如权利要求18或19所述的显示面板；以及
驱动芯片，与所述多条信号线连接，用于向所述多条信号线提供驱动信号。
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