CN113808536B - 显示面板及显示终端 - Google Patents

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Abstract

本申请涉及一种显示面板及显示终端，其中，显示面板包括像素单元阵列、控制电路以及至少两个多级级联的GIP驱动电路，像素单元阵列包括多个以行列形式排列的像素单元，每级GIP驱动电路用于根据控制电路产生的控制信号生成行扫描信号，控制信号划分为非侦测时间和侦测时间，控制信号包括第一时钟信号，第一时钟信号在非侦测时间内的占空比与第一时钟信号在侦测时间内的占空比不同。本申请通过将各级GIP驱动电路的控制信号划分为非侦测时间和侦测时间，并将控制信号中的第一时钟信号在非侦测时间和侦测时间分别以不同的占空比进行设置，能够避免各级GIP驱动电路的信号传递中断，保证各级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。

Description

显示面板及显示终端
技术领域
本申请涉及显示技术领域，尤其涉及一种显示面板及显示终端。
背景技术
近年来，随着显示面板在柔性显示、可卷曲显示和可穿戴显示等领域的发展以及市场对窄边框显示面板的追求，板内栅驱动(Gate driver In Panel，GIP)技术应运而生。GIP技术可以将栅极驱动器设置在显示面板内部，相比于将栅极驱动器设置在显示面板外部，拥有更多的优势，制造成本更低。
然而，相关技术中，由于显示面板制程条件及器件的限制，采用GIP技术的显示面板的性能及可靠性仍存在许多不足。例如，采用GIP技术的显示面板可包括多个像素，并使用外部补偿技术对每个像素内的晶体管进行阈值电压侦测，但在实际侦测过程中，显示面板的扫描驱动电路级传可能失效，导致对于像素内的晶体管的阈值电压的侦测无法正常进行。
发明内容
有鉴于此，本申请提出了一种显示面板及显示终端，能够避免各级GIP驱动电路的信号传递中断，保证各级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。
根据本申请的一方面，提供了一种显示面板，所述显示面板包括像素单元阵列、控制电路以及至少两个多级级联的GIP驱动电路，所述像素单元阵列包括多个以行列形式排列的像素单元，每级GIP驱动电路用于根据所述控制电路产生的控制信号生成行扫描信号，所述行扫描信号用于对所述像素单元阵列中的一行像素单元进行扫描，其中，所述控制信号划分为非侦测时间和侦测时间，所述控制信号包括第一时钟信号，所述第一时钟信号在非侦测时间内的占空比与所述第一时钟信号在所述侦测时间内的占空比不同。
进一步地，在所述非侦测时间内，所述第一时钟信号包括多个第一脉冲信号，其中，每个第一脉冲信号的占空比均与所述第一时钟信号在所述侦测时间内的占空比不同。
进一步地，所述多个第一脉冲信号中每个第一脉冲信号的占空比均相同。
进一步地，所述控制信号还包括第二时钟信号，在所述非侦测时间内，所述第二时钟信号与所述第一时钟信号保持反相。
进一步地，所述控制信号还包括第三控制信号，其中，所述第三控制信号为脉冲信号，且所述第三控制信号的脉冲先于所述非侦测时间设置。
进一步地，所述行扫描信号为脉冲信号，其中，在所述侦测时间内，所述第二时钟信号的占空比与所述行扫描信号的占空比相同。
进一步地，第一级GIP驱动电路用于接收所述第三控制信号、所述第一时钟信号以及所述第二时钟信号，并根据所述第三控制信号、所述第一时钟信号以及所述第二时钟信号生成第一级级传信号以及第一级行扫描信号。
进一步地，第N级GIP驱动电路用于接收第N-1级级传信号、所述第一时钟信号以及所述第二时钟信号，并根据所述第N-1级级传信号、所述第一时钟信号以及所述第二时钟信号生成第N+1级级传信号以及第N级行扫描信号，其中，N为正整数。
进一步地，每个所述像素单元包括第一晶体管、第二晶体管、第三晶体管和发光部件，所述与该级GIP驱动电路对应的行扫描信号包括第一扫描信号和第二扫描信号，其中，所述第一扫描信号用于控制所述第一晶体管的工作状态，所述第二扫描信号用于控制所述第二晶体管的工作状态，所述第三晶体管用于驱动所述发光部件发光。
根据本申请的另一方面，提供了一种显示终端，所述显示终端包括终端主体所述显示面板，所述终端主体与所述显示面板相连接。
通过将各级GIP驱动电路的控制信号划分为非侦测时间和侦测时间，并将所述控制信号中的第一时钟信号在非侦测时间和侦测时间分别以不同的占空比进行设置，然后利用所述控制信号输出行扫描信号，根据本申请的各方面能够避免各级GIP驱动电路的信号传递中断，保证各级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。
附图说明
下面结合附图，通过对本申请的具体实施方式详细描述，将使本申请的技术方案及其它有益效果显而易见。
图1示出本申请实施例的显示面板的示意图。
图2示出本申请实施例的GIP驱动电路级联的示意图。
图3示出本申请实施例的GIP驱动时序的示意图。
图4示出本申请实施例的GIP驱动时序的示意图。
图5示出本申请实施例的像素驱动电路的示意图。
图6示出本申请实施例的GIP驱动时序的示意图。
图7示出本申请实施例的第N级GIP驱动电路的示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅是本申请一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
在本申请的描述中，需要理解的是，术语“中心”、“纵向”、“横向”、“长度”、“宽度”、“厚度”、“上”、“下”、“前”、“后”、“左”、“右”、“竖直”、“水平”、“顶”、“底”、“内”、“外”、“顺时针”、“逆时针”等指示的方位或位置关系为基于附图所示的方位或位置关系，仅是为了便于描述本申请和简化描述，而不是指示或暗示所指的装置或元件必须具有特定的方位、以特定的方位构造和操作，因此不能理解为对本申请的限制。此外，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性或者隐含指明所指示的技术特征的数量。由此，限定有“第一”、“第二”的特征可以明示或者隐含地包括一个或者更多个所述特征。在本申请的描述中，“多个”的含义是两个或两个以上，除非另有明确具体的限定。
在本申请的描述中，需要说明的是，除非另有明确的规定和限定，术语“安装”、“相连”、“连接”应做广义理解，例如，可以是固定连接，也可以是可拆卸连接，或一体地连接；可以是机械连接，也可以是电连接或可以相互通讯；可以是直接连接，也可以通过中间媒介间接连接，可以是两个元件内部的连通或两个元件的相互作用关系。对于本领域的普通技术人员而言，可以根据具体情况理解上述术语在本申请中的具体含义。
下文的公开提供了许多不同的实施方式或例子用来实现本申请的不同结构。为了简化本申请的公开，下文中对特定例子的部件和设置进行描述。当然，它们仅为示例，并且目的不在于限制本申请。此外，本申请可以在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。此外，本申请提供了的各种特定的工艺和材料的例子，但是本领域普通技术人员可以意识到其他工艺的应用和/或其他材料的使用。在一些实例中，对于本领域技术人员熟知的方法、手段、元件和电路未作详细描述，以便于凸显本申请的主旨。
本申请提供了一种显示面板，所述显示面板包括像素单元阵列、控制电路以及至少两个多级级联的GIP驱动电路，所述像素单元阵列包括多个以行列形式排列的像素单元，每级GIP驱动电路用于根据所述控制电路产生的控制信号生成行扫描信号，所述行扫描信号用于对所述像素单元阵列中的一行像素单元进行扫描，其中，所述控制信号划分为非侦测时间和侦测时间，所述控制信号包括第一时钟信号，所述第一时钟信号在非侦测时间内的占空比与所述第一时钟信号在所述侦测时间内的占空比不同。
通过将各级GIP驱动电路的控制信号划分为非侦测时间和侦测时间，并将所述控制信号中的第一时钟信号在非侦测时间和侦测时间分别以不同的占空比进行设置，然后利用所述控制信号输出行扫描信号，本申请能够避免各级GIP驱动电路的信号传递中断，保证各级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。
图1示出本申请实施例的显示面板的示意图。
如图1所示，所述显示面板包括像素单元阵列、控制电路以及至少两个多级级联的GIP驱动电路，所述显示面板可以是基于OLED(例如，AMOLED)的显示面板。其中，所述像素单元阵列以行列的形式进行排列，例如图1中的P1可以表示第一行的像素，Pn可以表示第n行的像素；所述控制电路可包括图像处理器110、时序控制器111和电位转换器130；所述GIP驱动电路可包括扫描驱动电路140。此外，所述显示面板还包括数据驱动电路120。
进一步地，扫描驱动电路140可用于输出多个行扫描信号，每个行扫描信号用于对所述像素单元阵列中的一行像素单元进行扫描，即所述多个行扫描信号可以对所述像素单元阵列中的所有像素单元进行逐行扫描。其中，每个像素单元的驱动电路中均设置有对应的晶体管，所述多个行扫描信号可控制一行像素单元中每个像素单元对应的晶体管的工作状态，从而对每行像素单元进行逐行扫描。
进一步地，数据驱动电路120可与所述像素单元阵列中的每个像素单元电连接，用于对所述像素单元阵列中的每个像素单元写入与该像素单元对应的数据信号。在不同的数据信号的驱动下，每个像素单元的色彩、亮度等参数可以不同，从而实现不同灰阶或不同色彩的画面的显示。
进一步地，每级GIP驱动电路用于根据所述控制电路产生的控制信号生成行扫描信号，所述行扫描信号用于对所述像素单元阵列中的一行像素单元进行扫描。需要说明的是，对于每级GIP驱动电路，输入到该级GIP驱动电路的控制信号可以相同，也可以不同，本申请对此并不限定。
图2示出本申请实施例的GIP驱动电路级联的示意图。
如图2所示，多级GIP驱动电路可以以级联的形式进行连接。其中，每级GIP驱动电路可以接收与该级GIP驱动电路对应的CK信号和XCK信号，并根据接收的与该级GIP驱动电路对应的CK信号和XCK信号生成与该级GIP驱动电路对应的行扫描信号和与该级GIP驱动电路对应的级传信号。可以理解，本申请对于GIP驱动电路的数量并不限定。
进一步地，所述控制电路可用于生成与每级GIP驱动电路对应的CK信号和与每级GIP驱动电路对应的XCK信号。每级GIP驱动电路输入的CK信号和XCK信号可以相同，也可以不同。例如，第二级GIP驱动电路可接收与第二级GIP驱动电路对应的CK2信号和与第二级GIP驱动电路对应的XCK2信号(图2中未示出)，第N级GIP驱动电路可接收与第N级GIP驱动电路对应的CKn信号和与第N级GIP驱动电路对应的XCKn信号。
进一步地，所述控制信号划分为非侦测时间和侦测时间，所述控制信号包括第一时钟信号，所述第一时钟信号在非侦测时间内的占空比与所述第一时钟信号在所述侦测时间内的占空比不同。例如，所述第一时钟信号可以是CK信号。当然，所述第一时钟信号也可以是XCK信号，此时所述第二时钟信号可以是CK信号。
进一步地，第一级GIP驱动电路用于接收所述第三控制信号、所述第一时钟信号以及所述第二时钟信号，并根据所述第三控制信号、所述第一时钟信号以及所述第二时钟信号生成第一级级传信号以及第一级行扫描信号。
例如，在图2中，所述第三控制信号可以是STV信号，与第一级GIP驱动电路对应的第一时钟信号可以是CK1信号，与第一级GIP驱动电路对应的第二时钟信号可以是XCK1信号，所述第一级GIP驱动电路可以是单级驱动电路[1]，所第一级级传信号可以是Cnt[1]，所述与第一级GIP驱动电路对应的行扫描信号可以是G[1]。其中，所述第一级级传信号Cnt[1]可以作为下一级GIP驱动电路(即，第二级GIP驱动电路)的输入。
进一步地，第N级GIP驱动电路用于接收第N-1级级传信号、所述第一时钟信号以及所述第二时钟信号，并根据所述第N-1级级传信号、所述第一时钟信号以及所述第二时钟信号生成第N+1级级传信号以及第N级行扫描信号，其中，N为正整数。
例如，在图2中，所述第N-1级级传信号可以是Cnt[n-1]，与第N级GIP驱动电路对应的第一时钟信号可以是CKn信号，与第N级GIP驱动电路对应的第二时钟信号可以是XCKn信号，所述第N级GIP驱动电路可以是单级驱动电路[N]，所第N+1级级传信号可以是Cnt[n+1]，所述与第N级GIP驱动电路对应的行扫描信号可以是G[n]。其中，所述第N+1级级传信号Cnt[n+1]可以作为下一级GIP驱动电路(即，第N+1级GIP驱动电路)的输入。
图3示出本申请实施例的GIP驱动时序的示意图。
如图3所示，33可以表示STV信号，34可以表示CK信号，35可以表示XCK信号，36可以表示G(1)信号，37可以表示G(2)信号，38可以表示G(n-1)信号，39可以表示G(n)信号。在图3中，信号33-39可以是第N-1级GIP驱动电路进行输出的情形。
参见图3,31可以表示非侦测时间，32可以表示侦测时间，所述非侦测时间位于所述侦测时间之前。所述第一时钟信号可以是图3中的信号34，即CK信号。例如，第N-1级GIP驱动电路接收的CK信号的波形可以先设置为若干个窄脉冲，然后再输出长脉冲进行侦测。
进一步地，在所述非侦测时间内，所述第一时钟信号包括多个第一脉冲信号，其中，每个第一脉冲信号的占空比均与所述第一时钟信号在所述侦测时间内的占空比不同。例如，在图3中，所述第一时钟信号可包括3个第一脉冲信号，所述第一时钟信号在侦测时间32内为信号34上的脉冲信号。在所述非侦测时间内，所述第一时钟信号的脉冲宽度大于所述第一脉冲信号的脉冲宽度。所述第一脉冲信号可以是方波，也可以是三角波等其他形状。可以理解，本申请对于所述第一脉冲信号的波形形状和数量并不限定。
进一步地，所述多个第一脉冲信号中每个第一脉冲信号的占空比均相同。例如，在图3中，所述第一时钟信号可包括3个第一脉冲信号，每个第一脉冲信号的脉冲宽度都相等，即每个第一脉冲信号的占空比均相同。此外，所述第一脉冲信号的占空比可以与所述第二脉冲信号的占空比不同。通过将所述控制信号中的第一时钟信号在非侦测时间和侦测时间分别以不同的占空比进行设置，然后利用所述控制信号输出行扫描信号，本申请实施例能够保证每级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。
进一步地，所述控制信号还包括第二时钟信号，在所述非侦测时间内，所述第二时钟信号与所述第一时钟信号保持反相。例如，在图3中，所述第二时钟信号可以是信号35，即XCK信号。在非侦测时间31内，所述第二时钟信号可以与所述第一时钟信号反相，即，在同一时刻，当所述第一时钟信号为高电平时，所述第一时钟信号可以是低电平。需要说明的是，在侦测时间内，所述第二时钟信号也可以与所述第一时钟信号反相，本申请对此并不限定。
进一步地，所述控制信号还包括第三控制信号，其中，所述第三控制信号为脉冲信号，且所述第三控制信号的脉冲先于所述非侦测时间设置。例如，在图3中，所述第三控制信号可以是STV信号，为具有一定宽度的脉冲信号。所述第三控制信号的脉冲宽度可以大于所述第一脉冲信号的脉冲宽度。此外，所述第三控制信号中的脉冲可以先于所述非侦测时间设置。
进一步地，所述行扫描信号为脉冲信号，其中，在所述侦测时间内，所述第二时钟信号的占空比与所述行扫描信号的占空比相同。即，在所述侦测时间内，所述与该级GIP驱动电路对应的行扫描信号的脉冲宽度与所述第二时钟信号的脉冲宽度相等。例如，信号38可以是第N-1级GIP驱动电路输出的行扫描信号G(n-1)，在所述侦测时间内，信号38为脉冲信号，信号38的脉冲宽度与信号34(即，第二时钟信号)的脉冲宽度相等。
由于显示面板制程条件及器件的限制，GIP驱动电路的性能及可靠性相比非GIP驱动电路还有一定差距，且GIP驱动电路输出的行扫描信号中脉冲宽度过长，会导致GIP驱动电路级传失效，最终导致对于像素电路内驱动晶体管的阈值电压的侦测无法正常进行。而本申请实施例通过将各级GIP驱动电路的控制信号划分为非侦测时间和侦测时间，并将所述控制信号中的第一时钟信号在非侦测时间和侦测时间分别以不同的占空比进行设置，然后利用所述控制信号输出行扫描信号，能够避免各级GIP驱动电路的信号传递中断，保证各级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。
图4示出本申请实施例的GIP驱动时序的示意图。
如图4所示，图4中上半部分表示第一级GIP驱动电路进行输出的情形，图4中下半部分表示第N级GIP驱动电路进行输出的情形。其中，信号41、信号42和信号43分别表示对应于第一级GIP驱动电路的第三控制信号、第一时钟信号和第二时钟信号，信号44、信号45和信号46分别表示对应于第N级GIP驱动电路的第三控制信号、第一时钟信号和第二时钟信号。
进一步地，对于第一级GIP驱动电路，在所述非侦测时间内，所述第一时钟信号可以是一个脉冲信号，该脉冲信号可以和信号36同步生成；而对于第二级GIP驱动电路，可以在所述非侦测时间内设置所述第一时钟信号为一个窄脉冲，然后设置第二时钟信号为脉冲信号，该脉冲信号可以和信号37同步生成。
需要说明的是，信号36-信号39可以轮流设置为脉冲信号，以对所述像素单元阵列中的每行像素单元轮流逐行扫描。例如，当信号38设置为脉冲信号时，信号38为在脉冲时间段为高电平，此时所述像素单元阵列中的对应的第N-1行的晶体管可以全部导通，以使与该行像素单元对应的数据能够写入到该行像素单元中。
图5示出本申请实施例的像素驱动电路的示意图。
如图5所示，所述像素驱动电路可用于驱动所述像素单元阵列中的一个像素单元，即每个像素驱动电路可与所述像素单元阵列中的一个像素单元相对应。其中，所述像素驱动电路可包括晶体管T1、晶体管T2、晶体管T3、存储电容C、双刀双掷开关以及发光二极管LED，即，所述像素驱动电路可以是3T1C结构。可以理解，本申请实施例的晶体管可以是薄膜晶体管(TFT)或者MOSFET，本申请对于晶体管的类型并不限定。以下，本申请以所有晶体管均为NMOS为例进行说明。
参见图5，晶体管T1的栅极可用于接收写入信号(即，WR)，晶体管T1的源极可用于接收数据驱动电路发来的数据信号Vdata，晶体管T1的漏极与晶体管T3的栅极以及存储电容C的一端电连接，形成内部结点g；晶体管T3的漏极可与电源电压VDD电连接，晶体管T3的源极可与发光二极管LED的阳极电连接，发光二极管LED的阴极接到参考地VSS。
进一步地，写入信号WR可控制晶体管T1的工作状态。当写入信号WR使晶体管T1导通时，数据信号Vdata可送至内部结点g，内部结点g的电压Vg可使晶体管T3导通，在电源电压VDD的作用下在晶体管T3的源漏之间产生驱动电流，从而驱动发光二极管LED发光。
由于晶体管T3的阈值电压可能发生漂移，导致流过晶体管的驱动电流不稳定，进而影响发光二极管的发光亮度，使得显示画面均匀性较差，因此可采用外部补偿技术对晶体管T3的阈值电压进行补偿。
进一步地，在图2中，晶体管T2的栅极可用于接收读取信号RD，晶体管T2的源极可分别与晶体管T3的源极以及发光二极管LED的阳极电连接，形成内部结点s，晶体管T2的漏极可与感测线以及双刀双掷开关的触点sw2电连接，模数转换器ADC可与双刀双掷开关的触点sw1电连接。其中，双刀双掷开关的触点sw2与触点sw1之间可设置为短路。
进一步地，读取信号RD可控制晶体管T2的工作状态。当读取信号RD使晶体管T2导通时，内部结点s的电压Vs会发送至感测线。当双刀双掷开关的触点sw1闭合时，内部结点s的电压Vs发送至模数转换器中进行处理；当双刀双掷开关的触点sw2闭合时，电压Vpre可对内部结点s进行预充电。由于内部结点s的电压与晶体管T3的阈值电压有关，因此通过图5的像素驱动电路能够侦测晶体管T3的阈值电压变化。
进一步地，每个所述像素单元包括第一晶体管、第二晶体管、第三晶体管和发光部件，所述与该级GIP驱动电路对应的行扫描信号包括第一扫描信号和第二扫描信号，其中，所述第一扫描信号用于控制所述第一晶体管的工作状态，所述第二扫描信号用于控制所述第二晶体管的工作状态，所述第三晶体管用于驱动所述发光部件发光。
例如，在图5中，所述第一晶体管为晶体管T1，所述第二晶体管为晶体管T2，所述第三晶体管为晶体管T3，所述第一扫描信号可以是WR，所述第二扫描信号可以是RD。
图6示出本申请实施例的GIP驱动时序的示意图。
在图6中，上半部分表示基于图5的像素驱动电路进行侦测时的驱动时序。在初始阶段，WR和RD均为低电平，晶体管T1和晶体管T2均处于截止状态，sw1和sw2均断开，内部结点s的电压为零。在侦测开始时，WR和RD均设置为高电平，晶体管T1和晶体管T2均处于导通状态，接着先闭合sw2，断开sw1，利用电压Vpre对内部结点s进行预充电，存储电容C可以存储预充电的电荷，同时数据线Vdata上的电压升为高电平，然后断开sw2，由于Vdata已经升为高电平，此时内部结点s的电压也随之升至高电平，最后再闭合sw1，将内部结点s的电压数据送至模数转换器中进行处理，从而侦测到晶体管T3的阈值电压变化情况，并对晶体管T3的阈值电压进行补偿。
在图6中，下半部分表示基于图5的像素驱动电路以及图2的GIP驱动电路的驱动时序。可以看出，图6下半部分右侧侦测阶段的波形与图6上半部分的侦测波形相同。在图6的下半部分，在进行侦测之前，信号CK和信号XCK还设置有多个窄的脉冲。
由于在侦测阶段G(n)的脉冲长度大于6ms，而GIP驱动电路的性能及可靠性相比非GIP驱动电路还有一定差距，GIP驱动电路输出的脉冲宽度过长，会导致级联的GIP驱动电路级传失效，最终导致对于像素驱动电路内驱动晶体管的阈值电压的侦测无法正常进行。而本申请在GIP驱动电路的不同阶段，设置了不同占空比的脉冲信号，能够保证GIP驱动电路级传的顺利进行以及行扫描信号的正常产生。
图7示出本申请实施例的第N级GIP驱动电路的示意图。
如图7所示，第N级GIP驱动电路可包括上拉控制单元、上拉单元和下拉单元，其中，所述上拉控制单元包括第四晶体管(即，晶体管T11)，所述上拉单元包括第五晶体管(即，晶体管T21)和第一电容(即，电容Cst)，所述下拉单元包括第六晶体管(即，晶体管T31)和第七晶体管(即，晶体管T41)。
进一步地，所述第四晶体管的栅极与所述第四晶体管的漏极电连接，用于接收第N-1级GIP驱动电路的行扫描信号G(N-1)；所述第四晶体管的源极与所述第五晶体管的栅极、所述第七晶体管的源极以及所述第一电容的一端电连接，用于传输信号Q(N)。
进一步地，所述第五晶体管的源极与所述第六晶体管的漏极以及所述第一电容的另一端电连接，用于输出对应于第N级GIP驱动电路的行扫描信号G(N)；所述第五晶体管的漏极用于接收所述第一时钟信号CK以及所述第二时钟信号XCK。
进一步地，所述第六晶体管的栅极与所述第七晶体管的栅极电连接，用于输出第N+1级的级传信号，所述第七晶体管的源极与所述第六晶体管的源极电连接，共同接地。
本领域技术人员应当理解的是，图7中的第N级GIP驱动电路可以是所述多级GIP驱动电路中的任意一级GIP驱动电路，第N级GIP驱动电路的内部结构是示例性的，本申请对于任意一级GIP驱动电路的内部结构并不限定。
本申请还提供了一种显示终端，所述显示终端包括终端主体所述显示面板，所述终端主体与所述显示面板相连接。
综上所述，本申请实施例通过将各级GIP驱动电路的控制信号划分为非侦测时间和侦测时间，并将所述控制信号中的第一时钟信号在非侦测时间和侦测时间分别以不同的占空比进行设置，然后利用所述控制信号输出行扫描信号，能够避免各级GIP驱动电路的信号传递中断，保证各级GIP驱动电路的信号传递顺利进行，同时保证行扫描信号正常输出。
在上述实施例中，对各个实施例的描述都各有侧重，某个实施例中没有详述的部分，可以参见其他实施例的相关描述。
以上对本申请实施例所提供的显示面板及显示终端进行了详细介绍，本文中应用了具体个例对本申请的原理及实施方式进行了阐述，以上实施例的说明只是用于帮助理解本申请的技术方案及其核心思想；本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本申请各实施例的技术方案的范围。

Claims (7)

1.一种显示面板，其特征在于，所述显示面板包括像素单元阵列、控制电路以及至少两个多级级联的GIP驱动电路，所述像素单元阵列包括多个以行列形式排列的像素单元，每级GIP驱动电路用于根据所述控制电路产生的控制信号生成行扫描信号，所述行扫描信号用于对所述像素单元阵列中的一行像素单元进行扫描，其中，
所述控制信号划分为非侦测时间和侦测时间，所述非侦测时间位于所述侦测时间之前，所述控制信号包括第一时钟信号、第二时钟信号以及第三控制信号，所述第一时钟信号在非侦测时间内的占空比与所述第一时钟信号在所述侦测时间内的占空比不同；
在所述非侦测时间内，所述第一时钟信号包括多个第一脉冲信号，其中，每个第一脉冲信号的占空比均与所述第一时钟信号在所述侦测时间内的占空比不同；
在所述非侦测时间内，所述第二时钟信号与所述第一时钟信号保持反相；
所述第三控制信号为脉冲信号，且所述第三控制信号的脉冲先于所述非侦测时间设置，以保证各级GIP驱动电路的信号传递顺利进行和行扫描信号正常输出。
2.根据权利要求1所述的显示面板，其特征在于，所述多个第一脉冲信号中每个第一脉冲信号的占空比均相同。
3.根据权利要求1所述的显示面板，其特征在于，所述行扫描信号为脉冲信号，其中，在所述侦测时间内，所述第二时钟信号的占空比与所述行扫描信号的占空比相同。
4.根据权利要求1所述的显示面板，其特征在于，第一级GIP驱动电路用于接收所述第三控制信号、所述第一时钟信号以及所述第二时钟信号，并根据所述第三控制信号、所述第一时钟信号以及所述第二时钟信号生成第一级级传信号以及第一级行扫描信号。
5.根据权利要求4所述的显示面板，其特征在于，第N级GIP驱动电路用于接收第N-1级级传信号、所述第一时钟信号以及所述第二时钟信号，并根据所述第N-1级级传信号、所述第一时钟信号以及所述第二时钟信号生成第N+1级级传信号以及第N级行扫描信号，其中，N为正整数。
6.根据权利要求1所述的显示面板，其特征在于，每个所述像素单元包括第一晶体管、第二晶体管、第三晶体管和发光部件，所述行扫描信号包括第一扫描信号和第二扫描信号，其中，所述第一扫描信号用于控制所述第一晶体管的工作状态，所述第二扫描信号用于控制所述第二晶体管的工作状态，所述第三晶体管用于驱动所述发光部件发光。
7.一种显示终端，其特征在于，所述显示终端包括终端主体和如权利要求1至6中任一项权利要求所述的显示面板，所述终端主体与所述显示面板相连接。
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