CN113327550A - 像素电路和显示面板 - Google Patents

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Abstract

本发明公开了一种像素电路和显示面板。像素电路包括：数据写入模块、驱动模块、存储模块、发光控制模块、发光模块和初始化模块；数据写入模块用于在数据写入阶段将数据信号写入驱动模块控制端；驱动模块用于在发光阶段提供驱动电流，发光模块响应驱动电流；发光控制模块用于在发光阶段将第一电源信号输入端与驱动模块导通，并将驱动模块与发光模块的第一端导通；初始化模块用于在初始化阶段将发光模块的第一端初始化为第一电位，并将驱动模块的控制端初始化为第二电位，第一电位大于第二电位。本发明能够同时兼顾显示面板的屏体亮度均一性以及残影效果。

Description

像素电路和显示面板
技术领域
本发明实施例涉及显示技术，尤其涉及一种像素电路和显示面板。
背景技术
随着显示技术的发展，显示面板的应用也越来越广泛，相应的对显示面板的要求也越来越高。
然而，现有的显示面板存在屏体亮度均一性与屏体残影效果难以同时兼顾的问题，极大地限制了显示面板的进一步应用。
发明内容
本发明提供一种像素电路和显示面板，以同时兼顾显示面板的屏体亮度均一性以及残影效果，提高显示面板的显示效果。
第一方面，本发明实施例提供了一种像素电路，所述像素电路包括：数据写入模块、驱动模块、存储模块、发光控制模块、发光模块和初始化模块；
所述数据写入模块用于在数据写入阶段将数据信号写入所述驱动模块的控制端；
所述驱动模块用于在发光阶段提供驱动电流，所述发光模块响应所述驱动电流发光；
所述存储模块用于维持所述驱动模块控制端的电位；
所述发光控制模块用于在发光阶段将第一电源信号输入端与所述驱动模块导通，并将所述驱动模块与所述发光模块的第一端导通；
所述初始化模块用于在初始化阶段将所述发光模块的第一端初始化为第一电位，并将所述驱动模块的控制端初始化为第二电位，其中，所述第一电位大于所述第二电位。
可选地，所述初始化模块包括：
第一初始化单元、第二初始化单元及电位控制单元；
所述第一初始化单元的控制端与第一扫描信号输入端电连接，所述第一初始化单元的第一端与所述驱动模块的控制端电连接，所述第一初始化单元的第二端与第一初始化信号输入端电连接；
所述第二初始化单元的控制端与所述第一扫描信号输入端电连接，所述第二初始化单元与所述电位控制单元串接于所述发光模块的第一端与所述第一初始化信号输入端之间；其中，所述电位控制模块用于电压钳位以使所述第一电位大于所述第二电位。
可选地，所述电位控制模块为PN结。
可选地，所述PN结的负极与所述第二初始化单元电连接，所述PN结的正极与所述第一初始化信号输入端电连接；其中，所述PN结包括至少一层半导体薄膜，所述至少一层半导体薄膜沉积于所述第一初始化模块的第二端上。
可选地，所述半导体薄膜的材料为ZnPc或者Bphen。
可选地，所述PN结为肖特基接触的异质PN结。
可选地，所述第一初始化单元包括第一晶体管，所述第一晶体管的第一端作为所述第一初始化单元的第一端，所述第一晶体管的第二端作为所述第一初始化单元的第二端，所述第一晶体管的控制端作为所述第一初始化单元的控制端；
所述第二初始化单元包括第二晶体管，所述第二晶体管的控制端作为所述第二初始化单元的控制端。
可选地，所述像素电路还包括阈值补偿模块，所述阈值补偿模块用于在数据写入阶段抓取所述驱动模块的阈值电压至所述驱动模块的控制端；
所述数据写入模块包括第三晶体管，所述第三晶体管的控制端与第二扫描信号输入端电连接，所述第三晶体管的第一端与数据信号输入端电连接；
所述驱动模块包括第四晶体管，所述第四晶体管的第一端与所述第三晶体管的第二端电连接，所述第四晶体管的控制端与所述阈值补偿模块的第一端电连接，所述第四晶体管的第二端与所述阈值补偿模块的第二端电连接；
所述阈值补偿模块包括第五晶体管，所述第五晶体管的控制端与所述第二扫描信号输入端电连接，所述第五晶体管的第一端作为所述阈值补偿模块的第一端，所述第五晶体管的第二端作为所述阈值补偿模块的第二端；
所述存储模块包括存储电容，所述存储电容的第一端与所述第一电源信号输入端电连接，所述存储电容的第二端与所述第四晶体管的控制端电连接；
所述发光控制模块包括第六晶体管和第七晶体管，所述第六晶体管的控制端及所述第七晶体管的控制端与发光控制信号输入端电连接，所述第六晶体管的第一端与所述第一电源信号输入端电连接，所述第六晶体管的第二端与所述第四晶体管的第一端电连接，所述第七晶体管的第一端与所述第四晶体管的第二端电连接，所述第七晶体管的第二端与所述发光模块的第一端电连接。
可选地，所述初始化模块包括第三初始化单元和第四初始化单元；
所述第三初始化单元的控制端与第一扫描信号输入端电连接，所述第三初始化单元的第一端与所述驱动模块的控制端电连接，所述第三初始化单元的第二端与第二初始化信号输入端电连接；
所述第四初始化单元的控制端与所述第一扫描信号输入端电连接，所述第四初始化单元的第一端与所述发光模块的第一端电连接，所述第四初始化单元的第二端与第三初始化信号输入端电连接；
其中，所述第三初始化信号输入端输入的初始化信号的电位大于所述第二初始化信号输入端输入的初始化信号的电位。
第二方面，本发明实施例还提供了一种显示面板，包括第一方面所述的像素电路。
本发明实施例的技术方案，采用的像素电路包括：数据写入模块、驱动模块、存储模块、发光控制模块、发光模块和初始化模块；数据写入模块用于在数据写入阶段将数据信号写入驱动模块的控制端；驱动模块用于在发光阶段提供驱动电流，发光模块响应驱动电流发光；存储模块用于维持驱动模块控制端的电位；发光控制模块用于在发光阶段将第一电源信号输入端与驱动模块导通，并将驱动模块与发光模块的第一端导通；初始化模块用于在初始化阶段将发光模块的第一端初始化为第一电位，并将驱动模块的控制端初始化为第二电位，其中，第一电位大于第二电位。在初始化阶段中，由于第一电位大于第二电位，也即对驱动模块的控制端进行深度复位，改善残影现象，对发光模块的第一端进行较弱的复位，避免发光模块深度复位而使得显示面板产生亮度均一性缺陷，也即通过设置第一电位大于第二电位，使得显示面板能够兼顾亮度均一性以及残影效果，极大地提高了显示面板的显示效果。
附图说明
图1为本发明实施例提供的一种像素电路的电路结构示意图；
图2为本发明实施例提供的又一种像素电路的电路结构示意图；
图3为本发明实施例提供的又一种像素电路的电路结构示意图；
图4为本发明实施例提供的又一种像素电路的电路结构示意图；
图5为本发明实施例提供的一种像素电路的时序图；
图6为本发明实施例提供的又一种像素电路的电路结构示意图；
图7为本发明实施例提供的一种显示面板的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
正如背景技术中提到的现有的显示面板存在无法同时兼顾屏体亮度均一性以及残影效果的问题，发明人经过仔细研究发现，产生此技术问题的原因在于：
显示面板包括多个阵列排布的像素电路，依靠像素电路中发光模块的发光来实现显示功能，像素电路包括驱动晶体管、数据写入晶体管、阈值补偿晶体管、第一初始化晶体管、第二初始化晶体管、第一发光控制晶体管、第二发光控制晶体管、存储电容和有机发光二极管，第一初始化晶体管和第二初始化晶体管分别用于对驱动晶体管和有机发光二极管进行复位，现有技术中对二者复位的复位电势相同，也即复位后驱动晶体管控制端的电位与有机发光二极管正极的电位相同；然而，发明人经过研究发现，若复位电势过低，有机发光二极管正极复位过深，显示面板不同位置均一性的差异便会被凸显出来，使得屏体亮度均一性变差；若复位电势过高，则驱动晶体管控制端的电位也较高，驱动晶体管复位效果较差，显示面板在切换画面过程中由于驱动晶体管的迟滞效应，使得显示面板存在一个拖影效果，影响显示面板的正常使用；另外，有机发光二极管正极残留的电荷会导致显示面板在关态时依然能发光，显示面板的对比度也较差。
基于上述技术问题，本发明提出如下解决方案：
图1为本发明实施例提供的一种像素电路的电路结构示意图，参考图1，像素电路包括：数据写入模块101、驱动模块102、存储模块104、发光控制模块105、发光模块106和初始化模块107；数据写入模块101用于在数据写入阶段将数据信号写入驱动模块102的控制端；驱动模块102用于在发光阶段提供驱动电流，发光模块106响应驱动电流发光；存储模块104用于维持驱动模块102控制端的电位；发光控制模块105用于在发光阶段将第一电源信号输入端VDD与驱动模块102导通，并将驱动模块102与发光模块106的第一端导通；初始化模块107用于在初始化阶段将发光模块的第一端初始化为第一电位，并将驱动模块102的控制端初始化为第二电位，其中，第一电位大于第二电位。
具体地，像素电路应用于显示面板中，根据数据信号的不同，控制发光模块发出不同灰阶的光，从而控制显示面板显示需要显示的画面；发光模块106例如可以是OLED(Organic Light Emitting Diode，有机发光二极管)，发光模块106为电流驱动型器件，能够响应驱动电流而发光；本实施例的像素电路还可包括阈值补偿模块103，阈值补偿模块103用于在数据写入阶段抓取驱动模块102的阈值电压至驱动模块102的控制端；像素电路的工作过程可分为初始化阶段、数据写入阶段及发光阶段，在初始化阶段，通过初始化模块将发光模块106的第一端初始化为第一电位，以避免发光模块106上一帧残留的电位对本帧发光产生影响，并将驱动模块102的控制端初始化为第二电位，以避免驱动模块102的迟滞效应产生的残影现象；在初始化阶段中，由于第一电位大于第二电位，也即对驱动模块102的控制端进行深度复位，改善残影现象，对发光模块106的第一端进行较弱的复位，避免发光模块106深度复位而使得显示面板产生亮度均一性缺陷，也即通过设置第一电位大于第二电位，使得显示面板能够兼顾亮度均一性以及残影效果，极大地提高了显示面板的显示效果；在数据写入阶段，阈值补偿模块103及数据写入模块101导通，数据信号输入端Data输入的数据信号通过数据写入模块101、驱动模块102及阈值补偿模块103后写入存储模块104，并且在抓取完成驱动模块102的阈值电压后，驱动模块102关闭，使得带有驱动模块102阈值电压信息的数据电压存储在存储模块104上，以使驱动模块102的驱动电流与驱动模块102的阈值电压无关，从而实现阈值补偿功能；在发光阶段，发光控制模块105导通，为驱动模块102及发光模块106提供电流通路，进而使得发光模块106根据驱动电流发光。
本实施例的技术方案，采用的像素电路包括：数据写入模块、驱动模块、存储模块、发光控制模块、发光模块和初始化模块；数据写入模块用于在数据写入阶段将数据信号写入驱动模块的控制端；驱动模块用于在发光阶段提供驱动电流，发光模块响应驱动电流发光；存储模块用于维持驱动模块控制端的电位；发光控制模块用于在发光阶段将第一电源信号输入端与驱动模块导通，并将驱动模块与发光模块的第一端导通；初始化模块用于在初始化阶段将发光模块的第一端初始化为第一电位，并将驱动模块的控制端初始化为第二电位，其中，第一电位大于第二电位。在初始化阶段中，由于第一电位大于第二电位，也即对驱动模块的控制端进行深度复位，改善残影现象，对发光模块的第一端进行较弱的复位，避免发光模块深度复位而使得显示面板产生亮度均一性缺陷，也即通过设置第一电位大于第二电位，使得显示面板能够兼顾亮度均一性以及残影效果，极大地提高了显示面板的显示效果。
可选地，图2为本发明实施例提供的又一种像素电路的电路结构示意图，参考图2，初始化模块包括：第一初始化单元1071、第二初始化单元1072及电位控制单元1073；第一初始化单元1071的控制端与第一扫描信号输入端S1电连接，第一初始化单元的第二端与第一初始化信号输入端Vref1电连接；第二初始化单元1072的控制端与第一扫描信号输入端S1电连接，第二初始化单元1072与电位控制单元1073串接于发光模块106的第一端与第一初始化信号输入端Vref1之间；其中，电位控制模块1073用于电压钳位以使第一电位大于第二电位。
具体地，在本实施例中，通过设置电位控制单元，当第一初始化信号输入端Vref1输入的初始化信号对驱动模块102以及发光模块106进行初始化时，初始化信号直接通过第一初始化单元1071对驱动模块102的第一端进行初始化，最终将驱动模块102控制端的电位初始化为初始化信号的电位，也即此时第二电位为初始化信号的电位；初始化信号通过第二初始化单元1072以及电位控制单元1073之后写至发光模块106的第一端，由于电位控制模块1073的钳位作用，电位控制模块1073与第一初始化信号输入端Vref1电连接的一端电位较低，而与发光模块106电连接的一端电位较高，也即对发光模块106第一端复位的电位大于第一初始化信号输入端Vref1写入的初始化信号，从而实现了第一电位大于第二电位的效果；优选地，当第一电位与第二电位之间的差值较大或较小时，兼顾亮度均一性以及残影的效果不明显，可设置第一电位与第二电位的差值范围为0.1伏至2伏，使得兼顾亮度均一性及残影的效果达到最佳。通过设置电位控制模块1073，采用一个初始化信号即可使得第一电位大于第二电位，在显示面板中仅需要布置一条参考信号线为第一初始化信号输入端提供初始化信号，更有利于显示面板的布线设置。
需要说明的是，第二初始化单元1072与电位控制单元1073串接于发光模块的第一端与第一初始化信号输入端Vref1之间，既可以是如图2中所示的连接结构，也即电位控制单元1073的第一端与第一初始化信号输入端Vref1电连接，电位控制单元1073的第二端与第二初始化单元1072的第一端电连接，第二初始化单元1072的第二端与发光模块106的第一端电连接；在其它一些实施方式中，如图3所示，图3为本发明实施例提供的又一种像素电路的电路结构示意图，与图2中所示结构不同的是，本实施例中，第二初始化单元1072的第一端与第一初始化信号输入端Vref1电连接，第二初始化单元1072的第二端与电位控制单元1073的第一端电连接，电位控制单元1073的第二端与发光模块106的第一端电连接。
示例性地，图4为本发明实施例提供的又一种像素电路的电路结构示意图，参考图4，第一初始化单元1071包括第一晶体管M1，第一晶体管M1的第一端作为第一初始化单元的第一端，第一晶体管M1的第二端作为第一初始化单元1071的第二端，第一晶体管M1的控制端作为第一初始化单元1071的控制端；第二初始化单元1072包括第二晶体管M2，第二晶体管M2的控制端作为第二初始化单元1072的控制端，第二晶体管M2的第一端作为第二初始化单元1072的第一端，第二晶体管M2的第二端作为第二初始化单元1072的第二端；数据写入模块101包括第三晶体管M3，第三晶体管M3的控制端作为数据写入模块101的控制端，第三晶体管M3的第一端作为数据写入模块101的第一端，第三晶体管M3的第二端作为数据写入模块101的第二端，第三晶体管M3的控制端与第二扫描信号输入端S2电连接，第三晶体管M3的第一端与数据信号输入端Data电连接；驱动模块102包括第四晶体管M4，第四晶体管M4的控制端作为驱动模块102的控制端，第四晶体管M4的第一端作为驱动模块102的第一端，第四晶体管M4的第二端作为驱动模块102的第二端，第四晶体管M4的第一端与第三晶体管M3的第二端电连接，第四晶体管M4的控制端与阈值补偿模块103的第一端电连接，第四晶体管M4的第二端与阈值补偿模块103的第二端电连接；阈值补偿模块103包括第五晶体管M5，第五晶体管M5的控制端作为阈值补偿模块103的控制端，第五晶体管M5的第一端作为阈值补偿模块103的第一端，第五晶体管M5的第二端作为阈值补偿模块103的第二端，第五晶体管M5的控制端与第二扫描信号输入端S2电连接；存储模块104包括存储电容，存储电容的第一端与第一电源信号输入端VDD电连接，存储电容的第二端与第四晶体管M4的控制端电连接；结合图1至图4，发光控制模,105包括第一发光控制模块1051和第二发光控制模块1052，其中，第一发光控制模块1051包括第六晶体管M6，第二发光控制模块1052包括第七晶体管M7，第六晶体管M6的控制端及第七晶体管M7的控制端与发光控制信号输入端EM电连接，第六晶体管M6的第一端与第一电源信号输入端VDD电连接，第六晶体管M6的第二端与第四晶体管M4的第一端电连接，第七晶体管M7的第一端与第四晶体管的第二端电连接，第七晶体管M7的第二端与发光模块106的第一端电连接，发光模块106包括有机发光二极管，发光模块106的第二端与第二电源信号输入端VSS电连接；其中，第一电源信号输入端VDD输入高电平电源信号，第二电源信号输入端VSS输入低电平信号。
第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6及第七晶体管M7可以是P型晶体管或N型晶体管，本实施例以均为P型晶体管为例进行说明；图5为本发明实施例提供的一种像素电路的时序图，其可对应于图4所示的像素电路，结合图4和图5，像素电路的工作过程可包括初始化阶段T1、数据写入阶段T2和发光阶段T3；
在初始化阶段T1，第一扫描信号输入端S1输入低电平信号，此时第一晶体管M1和第二晶体管M2导通，第一初始化信号输入端Vref1输入的初始化信号对第四晶体管M4以及发光模块106进行初始化，其中，电位控制模块1073可为PN结，PN结的负极作为电位控制模块的第一端，PN结的正极作为电位控制模块的第二端，在初始化阶段中，第一初始化信号输入端Vref1的电子通过PN结导向发光模块106第一端，使得驱动模块106第一端的电位下降，由于PN结两端存在一定的势垒差异，发光模块106第一端电位下降到一定电势后，电子将无法越过势垒注入至发光模块106的第一端，在发光模块与第一初始化信号输入端Vref1间形成了一个恒定的电势差，实现了既能保证发光模块不会产生过强的复位，改善了屏体的亮度均一性，又能降低驱动模块控制端的电势，提升了驱动模块控制端电位的复位能力，改善了屏体的残影效果。
在数据写入阶段T2，第二扫描信号输入端S2输入低电平信号，此时第三晶体管M3、第四晶体管M4及第五晶体管M5导通，数据电压Vdata开始写入第四晶体管M4的控制端，当第四晶体管M4控制端的电位变化为Vdata-|Vth|时，第四晶体管M4关断，也即最终写入第四晶体管M4控制端的电位为Vdata-|Vth|，并存储在存储电容上，其中，|Vth|为第四晶体管M4的阈值电压。
在发光阶段T3，发光控制信号输入端EM输入低电平信号，第六晶体管M6、第四晶体管M4以及第七晶体管M7导通，第四晶体管M4的驱动电流I＝K(Vgs-Vth)^2＝K(Vgs-|Vth|)^2＝K[VDD-(Vdata-|Vth|-|Vth|)^2＝K(VDD-Vdata)^2；也即驱动电流I与第四晶体管M4的阈值电压无关；其中，Vgs为第四晶体管M4源极与漏极之间的电压，VDD为第一电源信号输入端输入的第一电源信号，K为与第四晶体管相关的常数。
可选地，如图4所示，PN结的负极与第二初始化单元1072电连接，PN结的正极与第一初始化信号输入端Vref1电连接；其中，PN结包括至少一层半导体薄膜，至少一层半导体薄膜沉积于第一初始化模块1071的第二端上。
具体地，PN结由至少一层Lumo能级较深或导带较深的半导体薄膜依次沉积在第一晶体管的漏极上形成，换句话说，至少一层半导体薄膜中靠近第一晶体管漏极的半导体薄膜与第一晶体管的漏极直接接触，PN结为一种具有一定能级差的PN结，从而使得PN结具有较好的钳位作用；半导体薄膜的材料可以是ZnPc(酞菁锌)或者Bphen(邻二氮菲)，并且可通过选择材料的类型或者制作时的工艺参数改变PN结的能级差，从而可以根据显示面板的需求设置第一电位与第二电位的电位差，进而实现更优的显示效果。
可选地，PN结为肖特基接触的异质PN结。
具体地，PN结也可以是使用具有较低功函数的金属材料(如Al、Mg或Ca等)形成肖特基接触的异质PN结，从而能够扩大PN结材料的选择范围，与现有PN结的制备工艺更加兼容，进而有利于降低采用该像素电路的显示面板的成本。
需要说明的是，PN结也可以是由晶体管构成，也即将晶体管连接为二极管接法，从而替代PN结作为电位控制模块。
可选地，图6为本发明实施例提供的又一种像素电路的电路结构示意图，参考图6，与图2-图4中所示结构不同的是，本实施例的初始化模块包括第三初始化单元1074和第四初始化单元1075，第三初始化单元1074的控制端与第一扫描信号输入端S1电连接，第三初始化单元1074的第一端与驱动模块102的控制端电连接，第三初始化单元1074的第二端与第二初始化信号输入端Vref2电连接；第四初始化单元1075的控制端与第一扫描信号输入端S1电连接，第四初始化单元1075的第一端与发光模块的第一端电连接，第四初始化单元1075的第二端与第三初始化信号输入端Vref3电连接；其中，第三初始化信号输入端Vref3输入的初始化信号的电位大于第二初始化信号输入端Vref2输入的初始化信号的电位。
具体地，在本实施例中，可利用两个初始化信号分别对发光模块的第一端以及驱动模块的控制端进行初始化，第二初始化信号输入端Vref2输入的初始化信号与第三初始化信号输入端Vref3输入的初始化信号更容易控制，也即更容易兼顾显示面板显示均一性以及残影效果；同时，由于不必采用电位控制模块，像素电路的结构更为简单。
本发明实施例还提供了一种显示面板，如图7所示，图7为本发明实施例提供的一种显示面板的结构示意图，显示面板包括多条扫描线(GL1-GLk)及本发明任意实施例提供的像素驱动电路10。
具体地，显示面板可包括横纵交错的扫描线与数据线(DL1-DLn)，扫描线用于与对应的第一扫描信号输入端S1及第二扫描信号输入端S2电连接，扫描线与扫描驱动电路30电连接，数据线与数据驱动电路20电连接，显示面板还可包括发光控制信号产生电路40及对应的使能信号线(EM1-EMk)，发光控制信号产生电路40生成本发明实施例中的发光控制信号；显示面板例如可以是手机、平板、显示器、MP3、MP4、智能手表、智能头盔或其它可穿戴设备等上的显示面板，因其包括本发明任意实施例提供的像素驱动电路，因而也具有相同的有益效果，在此不再赘述。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (10)

1.一种像素电路，其特征在于，所述像素电路包括：数据写入模块、驱动模块、存储模块、发光控制模块、发光模块和初始化模块；
所述数据写入模块用于在数据写入阶段将数据信号写入所述驱动模块的控制端；
所述驱动模块用于在发光阶段提供驱动电流，所述发光模块响应所述驱动电流发光；
所述存储模块用于维持所述驱动模块控制端的电位；
所述发光控制模块用于在发光阶段将第一电源信号输入端与所述驱动模块导通，并将所述驱动模块与所述发光模块的第一端导通；
所述初始化模块用于在初始化阶段将所述发光模块的第一端初始化为第一电位，并将所述驱动模块的控制端初始化为第二电位，其中，所述第一电位大于所述第二电位。
2.根据权利要求1所述的像素电路，其特征在于，所述初始化模块包括：
第一初始化单元、第二初始化单元及电位控制单元；
所述第一初始化单元的控制端与第一扫描信号输入端电连接，所述第一初始化单元的第一端与所述驱动模块的控制端电连接，所述第一初始化单元的第二端与第一初始化信号输入端电连接；
所述第二初始化单元的控制端与所述第一扫描信号输入端电连接，所述第二初始化单元与所述电位控制单元串接于所述发光模块的第一端与所述第一初始化信号输入端之间；其中，所述电位控制模块用于电压钳位以使所述第一电位大于所述第二电位。
3.根据权利要求2所述的像素电路，其特征在于，所述电位控制模块为PN结。
4.根据权利要求3所述的像素电路，其特征在于，所述PN结的负极与所述第二初始化单元电连接，所述PN结的正极与所述第一初始化信号输入端电连接；其中，所述PN结包括至少一层半导体薄膜，所述至少一层半导体薄膜沉积于所述第一初始化模块的第二端上。
5.根据权利要求4所述的像素电路，其特征在于，所述半导体薄膜的材料为ZnPc或者Bphen。
6.根据权利要求3所述的像素电路，其特征在于，所述PN结为肖特基接触的异质PN结。
7.根据权利要求2所述的像素电路，其特征在于，所述第一初始化单元包括第一晶体管，所述第一晶体管的第一端作为所述第一初始化单元的第一端，所述第一晶体管的第二端作为所述第一初始化单元的第二端，所述第一晶体管的控制端作为所述第一初始化单元的控制端；
所述第二初始化单元包括第二晶体管，所述第二晶体管的控制端作为所述第二初始化单元的控制端。
8.根据权利要求1所述的像素电路，其特征在于，
所述像素电路还包括阈值补偿模块，所述阈值补偿模块用于在数据写入阶段抓取所述驱动模块的阈值电压至所述驱动模块的控制端；
所述数据写入模块包括第三晶体管，所述第三晶体管的控制端与第二扫描信号输入端电连接，所述第三晶体管的第一端与数据信号输入端电连接；
所述驱动模块包括第四晶体管，所述第四晶体管的第一端与所述第三晶体管的第二端电连接，所述第四晶体管的控制端与所述阈值补偿模块的第一端电连接，所述第四晶体管的第二端与所述阈值补偿模块的第二端电连接；
所述阈值补偿模块包括第五晶体管，所述第五晶体管的控制端与所述第二扫描信号输入端电连接，所述第五晶体管的第一端作为所述阈值补偿模块的第一端，所述第五晶体管的第二端作为所述阈值补偿模块的第二端；
所述存储模块包括存储电容，所述存储电容的第一端与所述第一电源信号输入端电连接，所述存储电容的第二端与所述第四晶体管的控制端电连接；
所述发光控制模块包括第六晶体管和第七晶体管，所述第六晶体管的控制端及所述第七晶体管的控制端与发光控制信号输入端电连接，所述第六晶体管的第一端与所述第一电源信号输入端电连接，所述第六晶体管的第二端与所述第四晶体管的第一端电连接，所述第七晶体管的第一端与所述第四晶体管的第二端电连接，所述第七晶体管的第二端与所述发光模块的第一端电连接。
9.根据权利要求1所述的像素电路，其特征在于，所述初始化模块包括第三初始化单元和第四初始化单元；
所述第三初始化单元的控制端与第一扫描信号输入端电连接，所述第三初始化单元的第一端与所述驱动模块的控制端电连接，所述第三初始化单元的第二端与第二初始化信号输入端电连接；
所述第四初始化单元的控制端与所述第一扫描信号输入端电连接，所述第四初始化单元的第一端与所述发光模块的第一端电连接，所述第四初始化单元的第二端与第三初始化信号输入端电连接；
其中，所述第三初始化信号输入端输入的初始化信号的电位大于所述第二初始化信号输入端输入的初始化信号的电位。
10.一种显示面板，其特征在于，包括权利要求1-9任一项所述的像素电路。
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