CN113178395A - 多层堆叠模组层间互联工艺 - Google Patents
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Abstract
本发明提供一种多层堆叠模组层间互联工艺,包括以下步骤:步骤S1,提供硅片,在硅片的第一表面制作TSV金属柱,并通过钝化层覆盖所述硅片的第一表面和TSV金属柱顶端;步骤S2,在硅片第一表面刻蚀硅凹槽,使TSV金属柱侧壁露出,清洗去除TSV金属柱侧壁的钝化层;步骤S3,采用步骤S1~S2同样方式加工另一块硅片;步骤S4,在两块硅片的第一表面涂布胶或者金属焊料,加热使两层硅片焊接在一起;步骤S5,在两层硅片硅凹槽的TSV金属柱侧面涂布焊锡或者植焊锡球,回流焊使得焊锡融化使两层硅片的TSV金属柱互联;步骤S6,对通过以上工艺堆叠后形成的模组侧面进行抛光和打磨,使得模组侧面焊锡光滑。本发明能够简化工艺难度。
Description
技术领域
本发明涉及半导体技术领域,尤其是一种多层堆叠模组层间互联工艺。
背景技术
多层堆叠模组是未来三维封装的主要组成形式,目前对于三维堆叠模组的垂直互联一般是采用晶圆级微凸点熔融键合,BGA焊球微互联等,金属跟金属的键合应力较大,往往会出现晶圆间金属键合强度较大,键合效果较好,但是金属微凸点或者BGA焊球跟氧化硅基座脱落的问题;
而对于互联密度要求较高的CIS晶圆BSI工艺,则需要用到氧化硅和氧化硅工艺的氧氧键合外加铜金属柱的铜铜键合,这种键合方式不仅对氧化硅表面的抛光和清洗工艺要求严格,同时还对铜金属柱的抛光凹陷程度有严格的规定,铜柱凹陷太少,会导致后面退火后铜柱之间相互顶压,造成后面整张晶圆之间应力较大,导致晶圆键合效果不佳。如果铜柱凹陷太多,则会造成晶圆氧氧键合后,铜柱膨胀太少,不能形成接触,造成断路。同时现有技术还要求抛光的均匀性要好,避免出现局部区域键合不上的问题。
发明内容
本发明的目的在于克服现有技术中存在的不足,提供一种多层堆叠模组层间互联工艺,能够简化混合键合工艺的难度,降低工艺成本。为实现以上技术目的,本发明采用的技术方案是:
本发明的实施例提出的一种多层堆叠模组层间互联工艺,包括以下步骤:
步骤S1,提供硅片,在硅片的第一表面制作TSV金属柱,并通过钝化层覆盖所述硅片的第一表面和TSV金属柱顶端;
步骤S2,在硅片第一表面刻蚀硅凹槽,使TSV金属柱侧壁露出,清洗去除TSV金属柱侧壁的钝化层;
步骤S3,采用步骤S1~S2同样方式加工另一块硅片;
步骤S4,在两块硅片的第一表面涂布胶或者金属焊料,加热使两层硅片焊接在一起;
步骤S5,在两层硅片硅凹槽的TSV金属柱侧面涂布焊锡或者植焊锡球,回流焊使得焊锡融化使两层硅片的TSV金属柱互联;
步骤S6,对通过以上工艺堆叠后形成的模组侧面进行抛光和打磨,使得模组侧面焊锡光滑。
进一步地,步骤S1具体包括:
先在硅片的第一表面通过光刻、刻蚀工艺制作TSV盲孔;
在硅片第一表面和TSV盲孔内表面第一次制备钝化层,然后在第一次制备的钝化层上制作种子层;
电镀铜,使铜金属充满TSV盲孔;形成TSV金属柱;
铜CMP工艺使得硅片第一表面的铜去除,留下TSV盲孔中的填铜;
在硅片的第一表面第二次制备钝化层,覆盖所述硅片的第一表面和TSV金属柱顶端。
进一步地,所述电镀铜,使铜金属充满TSV盲孔之后,200到500度温度下密化使铜更致密。
进一步地,步骤S1中,
TSV盲孔的直径范围在1μm~1000μm,深度在10μm~1000μm;
第一次制备的钝化层厚度范围在10nm~100μm,种子层厚度范围在1nm~100μm;
第二次制备的钝化层厚度范围在10nm~100μm。
进一步地,步骤S2中,通过光刻和干法刻蚀工艺在硅片第一表面继续刻蚀硅凹槽,硅凹槽的宽度在1μm~1000μm,深度在10μm~1000μm。
本发明的优点在于:在硅片的外围形成金属柱,金属柱作为侧面互联的焊盘;然后通过氧化硅和氧化硅键合或者硅硅键合的方式实现硅片间的键合工艺,然后通过侧壁焊盘植焊锡球的方式进行硅片间的电性互联,此工艺可以大大简化混合键合工艺的难度,降低工艺成本。
附图说明
图1为本发明实施例中的制作TSV金属柱示意图。
图2为本发明实施例中的硅片侧面刻蚀硅凹槽示意图。
图3为本发明实施例中的两层硅片堆叠连接示意图。
图4为本发明实施例中的在两层硅片的硅凹槽植焊锡球示意图。
图5为本发明实施例中的回流焊使两层硅片的金属柱互联示意图。
图6为本发明实施例中的模组侧面抛光打磨示意图。
具体实施方式
为了使本发明的目的、技术方案及优点更加清楚明白,以下结合附图及实施例,对本发明进行进一步详细说明。应当理解,此处所描述的具体实施例仅用以解释本发明,并不用于限定本发明。
此外,在不同的实施例中可能使用重复的标号或标示。这些重复仅为了简单清楚地叙述本发明,不代表所讨论的不同实施例及/或结构之间具有任何关联性。
本发明的各实施方式中提到的有关于步骤的标号,仅仅是为了描述的方便,而没有实质上先后顺序的联系。各具体实施方式中的不同步骤,可以进行不同先后顺序的组合,实现本发明的发明目的。
本发明的实施例提出一种多层堆叠模组层间互联工艺,包括以下步骤:
步骤S1,提供硅片1,在硅片1的第一表面制作TSV金属柱2,并通过钝化层覆盖所述硅片1的第一表面和TSV金属柱2顶端;
如图1所示,步骤S1具体包括:
提供硅片1,先在硅片1的第一表面通过光刻、刻蚀工艺制作TSV盲孔101;TSV盲孔101的直径范围在1μm~1000μm,深度在10μm~1000μm;
在硅片1第一表面和TSV盲孔101内表面第一次制备钝化层,例如可以沉积氧化硅或氮化硅,或者直接热氧化形成钝化层,第一次制备的钝化层厚度范围在10nm~100μm,然后通过物理溅射,磁控溅射或者蒸镀工艺在第一次制备的钝化层上制作种子层,种子层厚度范围在1nm~100μm,种子层可以是一层也可以是多层,种子层的材质可以是钛、铜、铝、银、钯、金、铊、锡、镍等;
电镀铜,使铜金属充满TSV盲孔101,200到500度温度下密化使铜更致密;形成TSV金属柱2;
铜CMP工艺使得硅片1第一表面的铜去除,留下TSV盲孔101中的填铜;
在硅片1的第一表面第二次制备钝化层3,覆盖所述硅片1的第一表面和TSV金属柱2顶端;第二次制备的钝化层3厚度范围在10nm~100μm;
步骤S2,在硅片1第一表面刻蚀硅凹槽4,使TSV金属柱2侧壁露出,清洗去除TSV金属柱2侧壁的钝化层;
如图2所示,步骤S2具体包括:
通过光刻和干法刻蚀工艺在硅片1第一表面继续刻蚀硅凹槽4,硅凹槽4的宽度在1μm~1000μm,深度在10μm~1000μm;使TSV金属柱2侧壁露出,清洗去除TSV金属柱2侧壁的钝化层;
步骤S3,采用步骤S1~S2同样方式加工另一块硅片1;
步骤S4,在两块硅片1的第一表面涂布胶或者金属焊料5,加热使两层硅片焊接在一起;
具体如图3所示;
步骤S5,在两层硅片1硅凹槽4的TSV金属柱2侧面涂布焊锡或者植焊锡球6,回流焊使得焊锡融化使两层硅片1的TSV金属柱2互联;
具体地,如图4所示,在两层硅片1硅凹槽4的TSV金属柱2侧面涂布焊锡或者植焊锡球6;
如图5所示,回流焊使得焊锡融化使两层硅片1的TSV金属柱2互联;
步骤S6,对通过以上工艺堆叠后形成的模组侧面进行抛光和打磨,使得模组侧面焊锡光滑;完成最终结构;
具体如图6所示。
最后所应说明的是,以上具体实施方式仅用以说明本发明的技术方案而非限制,尽管参照实例对本发明进行了详细说明,本领域的普通技术人员应当理解,可以对本发明的技术方案进行修改或者等同替换,而不脱离本发明技术方案的精神和范围,其均应涵盖在本发明的权利要求范围当中。
Claims (5)
1.一种多层堆叠模组层间互联工艺,其特征在于,包括以下步骤:
步骤S1,提供硅片(1),在硅片(1)的第一表面制作TSV金属柱(2),并通过钝化层覆盖所述硅片(1)的第一表面和TSV金属柱(2)顶端;
步骤S2,在硅片(1)第一表面刻蚀硅凹槽(4),使TSV金属柱(2)侧壁露出,清洗去除TSV金属柱(2)侧壁的钝化层;
步骤S3,采用步骤S1~S2同样方式加工另一块硅片(1);
步骤S4,在两块硅片(1)的第一表面涂布胶或者金属焊料(5),加热使两层硅片焊接在一起;
步骤S5,在两层硅片(1)硅凹槽(4)的TSV金属柱(2)侧面涂布焊锡或者植焊锡球(6),回流焊使得焊锡融化使两层硅片(1)的TSV金属柱(2)互联;
步骤S6,对通过以上工艺堆叠后形成的模组侧面进行抛光和打磨,使得模组侧面焊锡光滑。
2.如权利要求1所述的多层堆叠模组层间互联工艺,其特征在于,
步骤S1具体包括:
先在硅片(1)的第一表面通过光刻、刻蚀工艺制作TSV盲孔(101);
在硅片(1)第一表面和TSV盲孔(101)内表面第一次制备钝化层,然后在第一次制备的钝化层上制作种子层;
电镀铜,使铜金属充满TSV盲孔(101);形成TSV金属柱(2);
铜CMP工艺使得硅片(1)第一表面的铜去除,留下TSV盲孔(101)中的填铜;
在硅片(1)的第一表面第二次制备钝化层,覆盖所述硅片(1)的第一表面和TSV金属柱(2)顶端。
3.如权利要求2所述的多层堆叠模组层间互联工艺,其特征在于,
所述电镀铜,使铜金属充满TSV盲孔(101)之后,200到500度温度下密化使铜更致密。
4.如权利要求2所述的多层堆叠模组层间互联工艺,其特征在于,
步骤S1中,
TSV盲孔(101)的直径范围在1μm~1000μm,深度在10μm~1000μm;
第一次制备的钝化层厚度范围在10nm~100μm,种子层厚度范围在1nm~100μm;
第二次制备的钝化层厚度范围在10nm~100μm。
5.如权利要求1~4中任一项所述的多层堆叠模组层间互联工艺,其特征在于,
步骤S2中,通过光刻和干法刻蚀工艺在硅片(1)第一表面继续刻蚀硅凹槽(4),硅凹槽(4)的宽度在1μm~1000μm,深度在10μm~1000μm。
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Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08139220A (ja) * | 1994-11-04 | 1996-05-31 | Ibiden Co Ltd | リードレスチップキャリア及びその製造方法 |
JPH08228057A (ja) * | 1995-02-17 | 1996-09-03 | Ibiden Co Ltd | 電子部品搭載用基板及びその製造方法 |
CN1198009A (zh) * | 1997-03-31 | 1998-11-04 | 日本电气株式会社 | 具有端面对分通孔和内区通孔的半导体器件组件 |
JP2007134427A (ja) * | 2005-11-09 | 2007-05-31 | Matsushita Electric Ind Co Ltd | モジュールパッケージ及びモジュールパッケージの製造方法 |
CN106206423A (zh) * | 2016-09-08 | 2016-12-07 | 华进半导体封装先导技术研发中心有限公司 | 芯片封装侧壁植球工艺 |
CN110010495A (zh) * | 2018-12-26 | 2019-07-12 | 杭州臻镭微波技术有限公司 | 一种高密度侧壁互联方法 |
US20210111102A1 (en) * | 2019-10-11 | 2021-04-15 | Semiconductor Components Industries, Llc | Self-aligned contact openings for backside through substrate vias |
-
2021
- 2021-04-28 CN CN202110464995.7A patent/CN113178395B/zh active Active
Patent Citations (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08139220A (ja) * | 1994-11-04 | 1996-05-31 | Ibiden Co Ltd | リードレスチップキャリア及びその製造方法 |
JPH08228057A (ja) * | 1995-02-17 | 1996-09-03 | Ibiden Co Ltd | 電子部品搭載用基板及びその製造方法 |
CN1198009A (zh) * | 1997-03-31 | 1998-11-04 | 日本电气株式会社 | 具有端面对分通孔和内区通孔的半导体器件组件 |
JP2007134427A (ja) * | 2005-11-09 | 2007-05-31 | Matsushita Electric Ind Co Ltd | モジュールパッケージ及びモジュールパッケージの製造方法 |
CN106206423A (zh) * | 2016-09-08 | 2016-12-07 | 华进半导体封装先导技术研发中心有限公司 | 芯片封装侧壁植球工艺 |
CN110010495A (zh) * | 2018-12-26 | 2019-07-12 | 杭州臻镭微波技术有限公司 | 一种高密度侧壁互联方法 |
US20210111102A1 (en) * | 2019-10-11 | 2021-04-15 | Semiconductor Components Industries, Llc | Self-aligned contact openings for backside through substrate vias |
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Legal Events
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---|---|---|---|
PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
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GR01 | Patent grant | ||
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