CN112259050A - 显示面板及其驱动方法、显示装置 - Google Patents

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Abstract

本发明实施例公开了一种显示面板及其驱动方法、显示装置，该显示面板中像素电路的开关模块包括第一晶体管和第二晶体管，该第一晶体管的第二极和第二晶体管的第一极在第一节点电连接，第二晶体管的第二极与驱动晶体管的栅极在第二节点电连接，驱动晶体管在发光阶段，根据第二节点的电位，向发光模块提供驱动电流；每个电位调节模块的输入端与一个像素电路的第二节点电连接，输出端与至少一个像素电路的第一节点电连接，电位调节模块根据所述第二节点的电位，调节第一节点的电位，以在像素电路的发光阶段，控制像素电路的第一节点和第二节点之间的电位差在预设电位差范围内。本发明能够解决漏电导致发光模块发光不稳定的问题，进而提高显示效果。

Description

显示面板及其驱动方法、显示装置
技术领域
本发明实施例涉及显示技术领域，尤其涉及一种显示面板及其驱动方法、显示装置。
背景技术
目前，有机发光(Organic Light-Emitting Diode，OLED)显示面板由于同时具备自发光、对比度高、厚度薄、反应速度快、可用于挠曲性面板等优点，广泛受到人们的喜爱。
OLED显示面板的OLED元件属于电流驱动型元件，需要设置相应的像素电路为OLED元件提供驱动电流，以使OLED元件能够发光。OLED显示面板的像素驱动电路通常包括驱动晶体管，驱动晶体管能够根据其栅极的电压产生驱动OLED元件的驱动电流。其中，与驱动晶体管的栅极直接电连接的其他晶体管包括双栅晶体管，由于双栅晶体管耦合电容的存在，导致双栅晶体管存在漏电现象，从而导致驱动晶体管栅极的电压不稳定，最终，影响发光元件的发光亮度，进而影响显示效果。
发明内容
本发明实施例提供一种显示面板及其驱动方法、显示装置，以改善双栅晶体管的漏电导致驱动晶体管栅极电压不稳定的问题，从而提高显示面板的显示效果。
第一方面，本发明实施例提供了一种显示面板，包括：
多个像素电路呈阵列排布；所述像素电路包括驱动晶体管、至少一个开关模块和发光模块；所述开关模块包括第一晶体管和第二晶体管；所述第一晶体管的第二极和所述第二晶体管的第一极在第一节点电连接；所述第二晶体管的第二极与所述驱动晶体管的栅极在第二节点电连接；所述驱动晶体管用于在发光阶段，根据所述第二节点的电位，向所述发光模块提供驱动电流；
多个电位调节模块；每个所述电位调节模块的输入端与一个所述像素电路的第二节点电连接，所述电位调节模块的输出端与至少一个所述像素电路的第一节点电连接；所述电位调节模块用于根据所述第二节点的电位，调节所述第一节点的电位，以在所述像素电路的所述发光阶段，控制所述像素电路的第一节点和第二节点之间的电位差在预设电位差范围内。
第二方面，本发明实施例还提供了一种显示面板的驱动方法，应用于如第一方面所述的显示面板，所述显示面板中每个所述像素电路的驱动周期包括：电位调节阶段和发光阶段；
在所述电位调节阶段，所述电位调节模块根据所述第二节点的电位，调节所述第一节点的电位；
在发光阶段，所述像素电路的第一节点的电位与第二节点的电位之间的电位差在预设电位差范围内，所述驱动晶体管根据所述第二节点的电位，向所述发光模块提供驱动电流。
第三方面，本发明实施例还提供了一种显示装置，包括如第一方面所述的显示面板。
本发明实施例提供的显示面板及其驱动方法、显示装置，通过在显示面板中增设电位调节模块，且该电位调节模块的输入端电连接于一个像素电路的第二节点，输出端电连接于至少一个像素电路的第一节点；由于第一节点为像素电路中开关模块的第一晶体管的第二极和第二晶体管的第一极电连接的节点，第二节点为像素电路中开关模块的第二晶体管与驱动晶体管的栅极电连接的节点，因此当电位调节模块根据像素电路的第二节点的电位，调节像素电路的第一节点的电位时，能够使各像素电路的第一节点的电位与第二节点的电位之间的电位差保持在预设电位差范围内，以防止因第一节点与第二节点之间具有较大的电位差，而使像素电路的第二节点与第一节点之间产生漏电，影响驱动晶体管的栅极电位的现象产生，从而在发光阶段，能够保证驱动晶体管的栅极电位稳定，使得驱动晶体管向发光模块提供稳定的驱动电流，驱动发光模块稳定发光，进而提高显示面板的显示效果；同时，由于电位调节模块是根据像素电路的第二节点的电位调节像素电路的第一节点的电位，从而能够准确地将各像素电路的第一节点与第二节点之间的电位差控制在预设电位差范围内，且无需为调节各像素电路的第一节点的电位而额外提供相应的电位调节信号，有利于简化显示面板的结构以及降低显示面板的功耗。
附图说明
图1是相关技术中一种像素电路的结构示意图；
图2是本发明实施例提供的一种显示面板的结构示意图；
图3是本发明实施例提供的一种显示面板中像素电路的结构示意图；
图4是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图5是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图6是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图7是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图8是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图9是本发明实施例提供的又一种显示面板的结构示意图；
图10是本发明实施例提供的一种像素电路的时序图；
图11是本发明实施例提供的又一种显示面板的结构示意图；
图12是本发明实施例提供的又一种显示面板的结构示意图；
图13是本发明实施例提供的又一种显示面板的结构示意图；
图14是本发明实施例提供的又一种显示面板的结构示意图；
图15是本发明实施例提供的又一种显示面板的结构示意图；
图16是本发明实施例提供的又一种显示面板的结构示意图；
图17是本发明实施例提供的又一种显示面板的结构示意图；
图18是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图19本发明施例提供的又一种显示面板中像素电路的驱动时序图；
图20是本发明实施例提供的又一种显示面板中像素电路的结构示意图；
图21是与图20对应的一种显示面板的像素电路的时序图；
图22是本发明实施例提供的一种显示面板中像素电路的驱动方法的流程图；
图23是本发明实施例提供的又一种显示面板中像素电路的驱动方法的流程图；
图24为本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1是相关技术中一种像素电路的结构示意图，如图1所示，相关技术中的像素电路10'包括驱动晶体管T'、第一开关模块11'和第二开关模块12'，且第一开关模块11'和第二开关模块12'均由双栅晶体管组成；每个双栅晶体管包括两个晶体管，分别为第一晶体管(M11'、M12')和第二晶体管(M21'、M22')，且第一晶体管(M11'、M12')的第二极与第二晶体管(M21'、M22')的第一极电连接于第一节点(N11'和N12')，第二晶体管(M21'、M22')的第二极与驱动晶体管T'的栅极电连接于第二节点N2'，且属于同一双栅晶体管的第一晶体管(M11'、M12')的栅极和第二晶体管(M21'、M22')的栅极接收同一扫描信号。其中，当第一开关模块11'用于在初始化阶段，将初始化信号端的初始化信号传输至驱动晶体管T'的栅极时，与第一开关模块11'的第一晶体管M11'的栅极和第二晶体管M21'的栅极接收的扫描信号会控制第一开关模块11'的第一晶体管M11'和第二晶体管M21'在初始化阶段导通，而在其它阶段时扫描信号会控制第一开关模块11'的第一晶体管M11'和第二晶体管M21'处于断开状态，使得初始化阶段时的第一晶体管M11'和第二晶体管M21'的栅极为扫描信号的使能电位，而发光阶段时第一晶体管M11'的栅极和第二晶体管M21'的栅极为扫描信号的非使能电位，由于第一晶体管M11'的栅极和第二晶体管M21'的栅极均会与第一节点N11'构成寄生电容，由于寄生电容的耦合作用，使得第一晶体管M11'的栅极电位和第二晶体管M21'的栅极电位会同时耦合至第一节点N11'，致使发光阶段时第一节点N11'与第二节点N2'之间存在较大的电位差，从而形成电流路径，出现漏电现象。同样的，当第二开关模块12'用于在数据写入阶段，将驱动晶体管T'的阈值电压补偿至驱动晶体管T'的栅极时，第二开关模块12'的第一晶体管M12'的栅极和第二晶体管M22'的栅极接收的扫描信号会控制第一开关模块11'的第一晶体管M12'和第二晶体管M22'在数据写入阶段导通，而在其它阶段断开，使得发光阶段时第一晶体管M12'的栅极和第二晶体管M22'的栅极的电位会耦合至第一节点N12'，致使第一节点N12'与第二节点N2'之间存在较大的电位差，从而形成电流路径，出现漏电现象。此外，在高温环境下，晶体管中载流子的活性较高，双栅晶体管的漏电更明显。
如此，当与驱动晶体管T'电连接的双栅晶体管出现漏电现象时，会影响第二节点N2'的电位，使得驱动晶体管T'根据第二节点N2'的电位提供至发光模块的驱动电流发生变化，影响发光模块的发光亮度，从而影响显示面板的显示效果。尤其对于低频驱动的像素电路，相邻两帧发光信号写入时间间隔大，在相邻两帧发光信号写入的间隔时间内，若发光模块的发光亮度持续下降，则会造成显示抖屏问题。
基于上述技术问题，本发明实施例提供一种显示面板，包括：多个像素电路呈阵列排布；像素电路包括驱动晶体管、至少一个开关模块和发光模块；开关模块包括第一晶体管和第二晶体管；第一晶体管的第二极和第二晶体管的第一极在第一节点电连接；第二晶体管的第二极与驱动晶体管的栅极在第二节点电连接；驱动晶体管用于在发光阶段，根据第二节点的电位，向发光模块提供驱动电流；多个电位调节模块；每个电位调节模块的输入端与一个像素电路的第二节点电连接，电位调节模块的输出端与至少一个像素电路的第一节点电连接；电位调节模块用于根据第二节点的电位，调节第一节点的电位，以在像素电路的发光阶段，控制像素电路的第一节点和第二节点之间的电位差在预设电位差范围内。
采用上述技术方案，通过在显示面板中增设电位调节模块，并将该电位调节模块的输入端与一个像素电路的第二节点电连接，输出端与至少一个像素电路的第一节点电连接，使得该电位调节模块能够根据一个像素电路的第一节点的电位，对至少一个像素电路的第二节点的电位进行调节，且在各像素电路的发光阶段，各像素电路的第一节点与第二节点之间的电位差均能够在预设电位差范围内，以改善因第一节点与第二节点之间存在电位差而产生漏电的现象，从而在像素电路的发光阶段，能够稳定其第二节点的电位，确保驱动晶体管向发光模块提供稳定的驱动电流，保证发光模块具有稳定的发光亮度；同时，对于低频驱动的显示面板，在相邻两帧数据信号写入的间隔时间内，发光模块能够稳定发光，改善显示抖屏；此外，由于电位调节模块是根据像素电路的第二节点的电位调节像素电路的第一节点的电位，从而能够准确地将各像素电路的第一节点与第二节点之间的电位差控制在预设电位差范围内，且无需为调节第一节点的电位而额外提供相应的电位调节信号，有利于简化显示面板的结构以及降低显示面板的功耗。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护的范围。
在本发明实施例中，电位调节模块的输出端可以电连接至少一个像素电路，即电位调节模块的输出端可以电连接一个像素电路、两个像素电路或多个像素电路；且电位调节模块的输出端电连接的像素电路可以包括与其输入端电连接的像素电路相同的像素电路；或者，电位调节模块的输入端与其输出端电连接的像素电路均不相同。以下将针对不同的情况对本发明实施例的技术方案进行示例性的说明。
图2是本发明实施例提供的一种显示面板的结构示意图，图3是本发明实施例提供的一种显示面板中像素电路的结构示意图。结合图2和图3所示，显示面板100中包括多个阵列排布的像素电路10；每个像素电路10包括驱动晶体管T、开关模块11和发光模块12；开关模块11包括第一晶体管M和第二晶体管M2，且第一晶体管M1的第二极与第二晶体管M2的第一极在第一节点N1电连接，第二晶体管M2的第二级与驱动晶体管T的栅极在第二节点N2电连接，第一晶体管M1的栅极和第二晶体管M2的栅极接收同一扫描信号Scan，以使第一晶体管M1和第二晶体管M2在扫描信号Scan的控制下导通或断开。其中，当扫描信号Scan为使能电位时，第一晶体管M1和第二晶体管M2导通，第一晶体管M1的第一极接收的信号能够通过导通的第一晶体管M1和第二晶体管M2传输至驱动晶体管T的栅极(即第二节点N2)；而在发光阶段，扫描信号Scan为非使能电位，第一晶体管M1和第二晶体管M2会处于断开状态，驱动晶体管T能够根据第二节点N2的电位，向发光模块12提供驱动电流，以驱动发光模块12发光。
但是，由于第一晶体管M1的栅极和第二晶体管M2的栅极均与第一节点N1构成寄生电容，因此当第一晶体管M1的栅极和第二晶体管M2的栅极所接收扫描信号Scan由使能电位跳变为非使能电位时，第一节点N1的电位会因寄生电容的耦合作用而被改变，这将致使第一节点N1与第二节点N2之间具有较大的电位差。此时，通过在显示面板100中设置电位调节模块20，该电位调节模块20的输入端与像素电路10的第二节点N2电连接，电位调节模块20的输出端与像素电路10的第二节点N1电连接，使得该电位调节模块20能够根据第二节点N1的电位，调节第二节点N2的电位，以在像素电路10处于发光阶段时，能够使该像素电路10的第一节点N1的电位与第二节点N2之间的电位差在预设电位差范围内。其中，示例性的，在低频低亮度的显示面板中像素电路10的第一节点N1与第二节点N2之间的电位差|ΔV|的取值范围可以为|ΔV|≤2.5V。
如此，当像素电路10的第一节点N1的电位与第二节点N2之间的电位差在该预设电位差范围内，能够减小因像素电路10的第一节点N1与第二节点N2之间存在电位差而产生的漏电流，从而在发光阶段，能够确保第二节点N2电位稳定，使得驱动晶体管T根据第二节点N2的电位，向发光模块12提供稳定的驱动电流，保证发光模块12稳定发光，进而提高显示面板的显示效果。
相应的，对于低频驱动的显示面板，从当前帧画面切换至下一帧画面需要较长的时间。当将像素电路10的第一节点N1与第一节点之间的N2的电位差调整为预设电位差，能够确保各像素电路10的发光模块12在发光阶段保持稳定发光，从而防止因每帧画面的切换时间较长，而造成的显示抖屏问题。
此外，当电位调节模块20根据像素电路10的第二节点N2的电位，调节该像素电路10的第一节点的电位时，能够准确地将像素电路10的第一节点N1与第二节点N2之间的电位差调节至预设电位差范围内，使得像素电路10的第二节点N2的电位保持稳定，从而能够提高显示面板的显示质量。
需要说明的是，图3仅为本发明实施例示例性的附图，图3中示例性的示出了电位调节模块10的输入端电连接的像素电路与其输出端电连接的像素电路为同一像素电路；而在本发明实施例中电位调节模块的输出端电连接的像素电路还可以包括与其输入端电连接的像素电路不同的像素电路。
示例性的，图4是本发明实施例提供的又一种显示面板中像素电路的结构示意图。图4中与图3中相同之处，在此不再赘述，此处仅对图4中与图3中不同之处进行示例性的说明。如图4所示，电位调节模块21的输入端与像素电路120的第二节点N2电连接，电位调节模块21的输出端与像素电路110的第一节点N1电连接，而像素电路120的第一节点N1可通过电位调节模块22与其它像素电路的第二节点N2电连接；如此，电位调节模块21可根据像素电路120的第二节点N2的电位，调节像素电路110的第一节点的电位，以在像素电路110的发光阶段，使得像素电路110的第一节点N1能够与其第二节点N2之间的电位差在预设电位差范围内，防止因像素电路110的第一节点N1与其第二节点N2之间的电位差较大，而使像素电路110的开关模块11漏电，从而能够使像素电路110的发光模块12稳定发光。同样的，电位调节模块22会根据其它像素电路的第二节点N2的电位，调节像素电路120的第一节点N1的电位，以在像素电路120的发光阶段，能够使像素电路120的第一节点N1与第二节点N2之间的电位差在预设电位差范围内，确保像素电路120的发光模块12稳定发光。
或者，示例性的，如图5所示，电位调节模块21的输入端与像素电路120的第二节点N2电连接，电位调节模块21的输出端与像素电路110的第一节点N1电连接；而电位调节模块22的输入端则与像素电路110的第二节点N2电连接，电位调节模块22的输出端与像素电路120的第一节点N1电连接；此时，电位调节模块21可根据像素电路120的第二节点N2，调节像素电路110的第一节点N1的电位；电位调节模块22可根据像素电路120的第二节点N2，调节像素电路110的第一节点N1的电位。
需要说明的是，由于本发明实施例中像素电路包括至少一个开关模块，因此像素电路可以包括一个开关模块或多个开关模块，且各开关模块的功能具有差异。
可选的，至少一个开关模块包括第一开关模块；第一开关模块的第一晶体管的第一极接收初始化信号，第一开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第一扫描信号；第一开关模块用于在初始化阶段，将初始化信号传输至驱动晶体管的栅极；和/或，至少一个开关模块包括第二开关模块；第二开关模块的第一晶体管的第一极与驱动晶体管的第二极电连接，第二开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第二扫描信号；第二开关模块用于在数据写入阶段，将驱动晶体管的阈值电压补偿至驱动晶体管的栅极。
示例性的，图6是本发明实施例提供的又一种显示面板中像素电路的结构示意图。如图6所示，以电位调节模块20电连接的像素电路为同一像素电路为例。像素电路10中包括两个开关模块，分别为第一开关模块111和第二开关模块112。此时，第一开关模块111的第一晶体管M11的第一极接收初始化信号Vref，且第一开关模块111的第一晶体管M11的栅极和第二晶体管M21的栅极均接收第一扫描信号S1；该第一扫描信号S1能够控制第一开关模块111中的第一晶体管M11和第二晶体管M21在初始化阶段导通，以在初始化阶段时，第一开关模块111的第一晶体管M11的第一极接收的初始化信号Vref能够通过导通的第一晶体管M11和第二晶体管M21传输至驱动晶体管的栅极，即第二节点N2；而在其它阶段时第一扫描信号S1控制第一开关模块111中的第一晶体管M11和第二晶体管M21处于断开状态。第二开关模块112的第一晶体管M12的第一极与驱动晶体管T的第二极电连接，第二开关模块112的第一晶体管M12的栅极和第二晶体管M22的栅极均接收第二扫描信号S2；该第二扫描信号S2能够控制第二开关模块112中的第一晶体管M12和第二晶体管M22在数据写入阶段导通，以在数据写入阶段时，数据信号Vdata能够通过驱动晶体管T以及第二开关模块112的第一晶体管M12和第二晶体管M22写入至驱动晶体管T的栅极，并将驱动晶体管T的阈值电压补偿至驱动晶体管T的栅极，即第二节点；而在其它阶段时第二扫描信号S2控制第二开关模块112中的第一晶体管M12和第二晶体管M22断开。
相应的，第一开关模块111中第一晶体管M11的第二极与第二晶体管M21的第一极在第一节点N11电连接，而第二开关模块112中第一晶体管M12的第二极与第二晶体管M22的第一极在第一节点N12电连接；此时，电位调节模块20的输出端会同时与第一开关模块111的第一节点N11和第二开关模块112的第一节点N12电连接；电位调节模块20可根据像素电路10的第二节点N2的电位，同时对像素电路10的第一节点N11和N12的电位进行调节，使得发光阶段时，第一节点N11和N12与第二节点N2之间的电位差均在预设电位差范围内，以在发光阶段，保证第二节点N2电位稳定，从而能够使驱动晶体管T根据第二节点N2的电位，提供稳定的驱动电流至发光模块12，驱动发光模块12稳定发光。
需要说明的，图6仅示例性的以每个像素电路包括两个开关模块为例，对本发明实施例的技术方案进行了示例性的说明；而在本发明实施例中，每个像素电路的开关模块可以仅包括一个第一开关模块；或者，每个像素电路的开关模块也可以仅包括一个第二开关模块；相同之处可参照上述对图6的描述，在此不再赘述。为便于描述，本发明实施例均以每个像素电路包括两个开关模块，即第一开关模块和第二开关模块为例，对本发明实施例的技术方案进行示例性的说明。
同时，图6仅示例性的以电位调节模块20电连接同一像素为例，对本发明实时的技术方案进行了示例性的说明；而当电位调节模块20分别电连接不同的像素电路时，其技术原理与上述图6所示的情况类似，在此不再一一赘述。
此外，本发明实施例中，在电位调节模块能够将像素电路的第一节点与第二节点之间的电位差调节为预设电位差范围，且不影响各像素电路中发光模块稳定发光的前提下，本发明实施例对电位调节模块的具体调节过程及电位调节模块的具体结构不做具体限定。
可选的，当与电位调节模块的输出端电连接的像素电路为第一像素电路，与电位调节模块的输入端电连接的像素电路为第二像素电路时，电位调节模块可以包括电位调节晶体管；该电位调节晶体管的第一极与第二像素电路的第二节点电连接，电位调节晶体管的第二极与第一像素电路的第一节点电连接；电位调节晶体管的栅极接收第三扫描信号；电位调节晶体管在第三扫描信号的控制下导通或断开。
示例性的，图7是本发明实施例提供的又一种显示面板中像素电路的结构示意图。如图7所示，以电位调节模块20的输出端电连接的第一像素电路110与其输入端电连接的第二像素电路120为不同的像素电路为例。电位调节晶体管M3的第一极与第二像素电路120的第二节点N2电连接，电位调节晶体管M3的第二极与第一像素电路110的第一节点N11和N12电连接，电位调节晶体管M3的栅极接收第三扫描信号S3，该第三扫描信号能够控制电位调节晶体管M3导通或断开。如此，在第三扫描信号S3控制电位调节晶体管M3导通时，第一像素电路110的第一节点N11和N12与第二像素电路120的第二节点N2形成通路，第二像素电路120的第二节点N2的电位能够通过导通的电位调节晶体管M3传输至第一像素电路110的第一节点N11和N12，以使第一像素电路110的第一节点N11和N12的电位与第二像素电路120的第二节点N2的电位保持一致。此时，对于低频低亮度的显示面板，每帧画面中各像素电路的第二节点N2的电位差异较小，该电位差异例如可以小于2.5V，当第一像素电路110的第一节点N11和N12的电位调整为与第二像素电路110的第二节点N2的电位保持一致时，第一像素电路110的第一节点N11和N12与该第一像素电路110的第二节点N2之间的电位差能够保持在预设电位差范围内，从而能够稳定第一像素电路110中第二节点N2的电位，使得第一像素电路110的发光模块12能够稳定发光。
此外，在现有的显示面板中，提供至各像素电路的扫描信号通常会在-7V～8V的范围变化，而一帧显示画面中各像素电路的第二节点之间的最大电位差|ΔV'|≤6.5V。如此，当显示面板中各像素电路的晶体管均为P型晶体管时，开关模块的第一晶体管与第二晶体管的栅极所接收的扫描信号由使能电位VGL变为非使能电位VGH时，该第一晶体管的栅极与第二晶体管的栅极电位均会增大15V，由于电容的耦合作用，使得第一晶体管的第二极和第二晶体管的第一极电连接的第一节点的电位会随之增加15V，这是一帧显示画面中各像素电路的第二节点之间的最大电位差|ΔV'|的两倍之多。
继续参考图7，当电位调节晶体管M3将第二像素电路120的第二节点N2的信号传输至第一像素电路110的第一节N11和N12时，第一像素电路110的第一节点N11和N12会与第二像素电路120的第二节点N2的电位保持一致，使得第一像素电路110的第一节点N11和N12与该第一像素电路110的第二节点N2之间的电位差|ΔV|≤6.5V，相较于未采用电位调节晶体管M3对第一像素电路110中的第一节点N11和N12的电位进行调节的情况，明显减少了第一像素电路110的第一节点N11和N12与其第二节点N2之间的电位差，从而能够减少因第一像素电路110的第一节点N11和N12与其第二节点N2之间的电位差而产生的漏电流，进而有利于稳定第一像素电路110的第二节点N2的电位，使得第一像素电路110驱动晶体管T能够提供稳定的驱动电流，以驱动其发光模块12稳定发光。
同样的，第二像素电路120的第一节点N11和N12可通过其它电位调节晶体管与其自身的第二节点N2进行电连接，或者第二像素电路120的第一节点N11和N12可通过其它电位调节晶体管与其它像素电路电连接；此时，同样能够减小第二像素电路120的第一节点N11和N12与其第二节点N2之间的电位差，从而能够使第二像素电路120的驱动晶体管T驱动其发光模块12稳定发光。
相应的，如图6所示，当与同一电位调节模块20电连接的第一像素电路和与第二像素电路为同一像素电路时，若第三扫描信号S3控制电位调节模块20的电位调节晶体管M3导通，则像素电路10的第二节点N2的信号会通过导通的电位调节晶体管M3传输至该像素电路10的第一节点N11和N12，使得像素电路10的第一节点N11和N12与其第二节点N2的电位保持一致，以使像素电路10的驱动晶体管T驱动其发光模块12稳定发光。
其中，当电位调节模块20包括电位调节晶体管M3时，该电位调节晶体管M3的宽长比可以小于第一晶体管(M11、M12)的宽长比；或者，电位调节晶体管M3的宽长比可以小于第二晶体管(M21、M22)的宽长比；或者，电位调节晶体管M3的宽长比可以同时小于第一晶体管(M11、M12)和第二晶体管(M21、M22)的宽长比。如此，在电位调节晶体管M3处于断开状态时，该电位调节晶体管M3能够具有较小的漏流，保证该电位调节晶体管M3电连接的第一节点N11、N12和第二节点N2的电位稳定。
另外，如图8所示，当电位调节模块20包括电位调节晶体管M3时，电位调节晶体管M3可以包括双栅晶体管；该双栅晶体管包括第三晶体管M31和第四晶体管M32；其中，第三晶体管M31的第一极与第二像素电路120的第二节点N2电连接，第三晶体管M31的第二极与第四晶体管M32的第一极电连接，第四晶体管M32的第二极与第一像素电路110的第一节点电连接；第三晶体管M31的栅极和第四晶体管M32的栅极均接收第三扫描信号S3。如此，同样能够减小电位调节晶体管M3的漏流，保证该电位调节晶体管M3电连接的第一节点N11、N12和第二节点N2的电位稳定。
此外，如图6～图8中的任一所示，每个像素电路(10、110或120)还可以包括数据写入模块13、发光控制模块14、存储模块15和阳极复位模块16等。其中，数据写入模块13能够在数据写入阶段，将数据信号Vdata写入至第二节点N2；发光控制模块14能够在发光阶段，控制驱动晶体管T提供的驱动电流流入发光模块12；而存储模块15能够在发光阶段维持第二节点N2的电位；阳极复位模块16能够在复位阶段对发光模块12的驱动电流输入端进行复位。
示例性的，数据写入模块13可以包括数据写入晶体管M4，该数据写入晶体管M4的第一极接收数据信号Vdata，数据写入晶体管M4的第二极与驱动晶体管T的第一极电连接，数据写入晶体管M4的栅极接收第二扫描信号；在数据写入阶段，该第二扫描信号S2会控制数据写入晶体管M4导通，以使数据信号Vdata能够通过导通的数据写入晶体管M4写入至驱动晶体管T的栅极，即第二节点N2；而在其它阶段该第二扫描信号S2会控制数据写入晶体管M4处于断开。发光控制模块14可以包括发光控制晶体管M5和M6，该发光控制晶体管M5和M6串联设置于第一电源信号端PVDD与发光模块12之间，发光控制晶体管M5和M6的栅极接收发光控制信号Emit；该发光控制信号Emit能够控制发光控制晶体管M5和M6在发光阶段时导通，以使驱动晶体管T提供的驱动电流能够流入发光模块12中；而在其它阶段，发光控制信号Emit会控制发光控制晶体管M5和M6处于断开状态。存储模块15可以包括存储电容Cst，该存储电容Cst的一端与第一电源信号PVDD电连接，另一端与驱动晶体管T的栅极电连接于第二节点N2。阳极复位模块16可以包括复位晶体管M7，该复位晶体管M7的第一极接收复位信号Vrst，复位晶体管M7的第二极与发光模块12的驱动电流输入端电连接，复位晶体管M7的栅极接收第四扫描信号S4；该第四扫描信号S4能够在阳极复位阶段控制复位晶体管M7导通，以使复位信号Vrst能够通过导通的复位晶体管M7写入至发光模块12的驱动信号输入端；例如当发光模块12为有机发光二极管时，复位晶体管M7的第二极会与有机发光二极管阳极电连接，以在阳极复位阶段，复位晶体管M7能够将复位信号Vrst传输至有机发光二极管的阳极，对该有机发光二极管的阳极进行复位；而在其它阶段时，第四扫描信号S4会控制复位晶体管M7处于断开状态。同时，有机发光二极管的阴极会与第二电源信号PVEE电连接，且该第二电源信号PVEE与第一电源信号PVDD不同，以在发光阶段第一电源信号PVDD与第二电源信号PVEE之间形成导通的回路，使得驱动晶体管T提供的驱动电流流入有机发光二极管中，驱动有机发光二极管进行发光。其中，第四扫描信号S4可与第一开关模块111中第一晶体管M11的栅极和第二晶体管M21的栅极所接收的第一扫描信号S1相同，第四扫描信号S4也可以与数据写入晶体管M4的栅极所接收的第二扫描信号S2相同，且复位信号Vrst可以与初始化信号Vref相同。
需要先说明的是，图6～图8所示出的像素电路，仅为本发明实施例示例性的像素电路结构图；而在能够实现本发明实施例的技术方案以及达到本发明实施例的有益效果的前提下，本发明实施例对像素电路的具体结构不做限定。为便于描述，本发明实施例中均以图6～图8中的像素电路为例，对本发明实施例进行示例性的说明。此外，图6～图8所示出的像素电路中各晶体管均为P型晶体管，在本发明实施例中像素电路的各晶体管也可以为N型晶体管，本发明实施例对此不作限定。
可选的，当显示面板的每个像素电路还包括数据写入模块，且该数据写入模块能够在数据写入阶段，将数据信号写入至该像素电路的第二节点时，与第i行的第一像素电路电连接的电位调节晶体管接收的第三扫描信号可在第i行的第一像素电路的数据写入阶段之后控制电位调节晶体管导通。此时，与同一电位调节晶体管电连接的第一像素电路和第二像素电路可以为同一像素电路；或者，与同一电位调节晶体管电连接的第一像素电路和第二像素电路为位于同一行的两个不同的像素电路；或者，与同一电位调节晶体管电连接的第一像素电路和第二像素电路分别为位于第i行的像素电路和位于第i+1行的像素电路；其中，i为大于或等于1的整数。
示例性的，图9是本发明实施例提供的又一种显示面板的结构示意图，图10是本发明实施例提供的一种像素电路的时序图。结合图6、图9和图10所示，当与同一电位调节晶管M3电连接的第一像素电路和第二像素电路为同一像素电路10时，该像素电路10可以包括初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4。在初始化阶段T1，第一扫描信号S1跳变为低电平VGL，第二扫描信号S2、发光控制信号Emit以及第三扫描信号S3均为高电平VGH，第一开关模块111的第一晶体管M11和第二晶体管M12导通，同时，第四扫描信号S4与第一扫描信号S1相同，此时复位晶体管M7也导通，而其它晶体管处于断开状态，且复位信号Vrst与初始化信号Vref也相同，因此初始化信号Vref分别传输至驱动晶体管T的栅极和发光模块12的驱动电流输入端，以对驱动晶体管T和发光模块12进行初始化；在数据写入阶段T2，第一扫描信号S1跳变为高电平VGH，使得第一节点N11的电位被拉高，第二扫描信号S2跳变为低电平VGL，发光控制信号Emit以及第三扫描信号S3保持为高电平VGH，数据写入模块13的数据写入晶体管M4以及第二开关模块112的第一晶体管M12和第二晶体管M22导通，而其它晶体管处于断开状态，使数据信号Vdata写入驱动晶体管T的栅极的同时，会将驱动晶体管T的阈值电压补偿至该驱动晶体管T的栅极；在数据写入阶段T2结束后，第一扫描信号S1保持为高电平VGH，使得第一节点N11保持为被拉高的状态，第二扫描信号S2跳变为高电平VGH，使得第一节点N12也被拉高，此时第一节点N11和N12均与第二节点N2之间具有较大的电位差；在进入电位调节阶段T3后，第三扫描信号S3跳变为低电平VGL，使得电位调节晶体管M3导通，像素电路10的第二节点N2的信号会通过导通的电位调节晶体管M3写入至第一节点N11和N12；在电位调节阶段T3结束时，第一节点N11和N12的电位均与第二节点N2的电位保持一致；在进入发光阶段T4时，发光控制信号Emit控制发光控制晶体管M5和M6导通，使得驱动晶体管T根据第二节点N2的电位产生的驱动电流流入至发光模块11，使得发光模块11发光；同时，因电位调节阶段T3结束后以及发光阶段T4开始前，第一节点N11和N12的电位均与第二节点N2的电位保持一致，使得因第一节点N11和N12与第二节点N2之间的电位差而产生的漏电流减小，保证第二节点N2的电位稳定，从而在发光阶段，能够使驱动晶体管T向发光模块12提供稳定的驱动电流，使得发光模块12稳定发光。
如此，通过将像素电路10的电位调节阶段T4设置于该像素电路10的数据写入阶段之后，相较于电位调节阶段T4设置于该像素电路10的数据写入阶段之前的方案，能够防止因数据写入阶段之后，第二扫描信号S2突然跳变而拉高第一节点N12的电位，而使得第一节点N12与第二节点N2具有较大的电位差，而在发光阶段影响第二节点N2的电位的现象产生。
另外，位于同一行的各像素电路可具有相同的初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4。示例性的，如图9所示，第一行像素电路1001中的各像素电路10具有相同的初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4，第二行像素电路1002的各像素电路10具有相同的初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4，第三行像素电路1003的各像素电路10具有相同的初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4，…，以此类推，第n行像素电路100n的各像素电路10具有相同的初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4。如此，上述图10所示的驱动时序还适用于与同一电位调节晶体管M3电连接的第一像素电路和第二像素电路是位于同一行的不同像素电路的情况。
相应的，如图9所示，当位于同时一行的各像素电路可具有相同的初始化阶段T1、数据写入阶段T2、电位调节阶段T3和发光阶段T4，分别与位于同一行的各像素电路10电连接的各电位调节模块20的电位调节晶体管栅极可与同一条扫描信号线电连接，并接收该扫描信号线传输的第三扫描信号；例如，与第一行像素电路1001电连接的各电位调节模块20的电位调节晶体管的栅极接收同一条扫描信号线传输的第三扫描信号S31，与第二行像素电路1002电连接的各电位调节模块20的电位调节晶体管的栅极接收同一条扫描信号线传输的第三扫描信号S32，与第三行像素电路1001电连接的各电位调节模块20的电位调节晶体管的栅极接收同一条扫描信号线传输的第三扫描信号S33，…，以此类推，与第N行像素电路100n电连接的各电位调节模块20的电位调节晶体管的栅极接收同一条扫描信号线传输的第三扫描信号S3n。
示例性的，如图11所示，位于同一行的各像素电路的第一节点通过同一电位调节模块20的电位调节晶体管与该行的其中一个像素电路的第二节点电连接。例如第一行像素电路1001中的各像素电路10的第一节点均通过同一电位调节模块20的电位调节晶体管与第一行像素电路1001中的最右侧像素电路10的第二节点电连接；此时，在第一行像素电路1001的电位调节阶段T3，能够将第一行像素电路1001中最右侧像素电路10的第二节点的电位传输至第一行像素电路1001中各像素电路的第一节点，其中，最右侧像素电路10的第二节点的电位也传输至该最右侧像素电路的第一节点，以在第一行像素电路1001的发光阶段，能够使第一行像素电路1001中的各像素电路的第一节点与其第二节点之间的电位差在预设电位差范围内。
需要说明的是，图11仅为本发明实施例示例性的附图，图11中显示面板100包括显示区101和非显示区102，各像素电路10和各电位调节晶体管均设置于显示区101中；而在本发明其它实施例中，还可以仅将像素电路设置于显示区，而电位调节晶体管设置于非显示区中(如图12所示)。
此外，当与同一电位调节晶体管电连接的第一像素电路和第二像素电路分别为位于第i行的像素电路和位于第i+1行的像素电路时，位于第i+1行的各像素电路可与位于第i行的各像素电路一一对应电连接。
示例性的，图13是本发明实施例提供的又一种显示面板的结构示意图。其中，图13中与图9中相同之处，可参照上述对图9、图10和图6的描述，在此不再赘述，此处仅对图13中与图9中不同之处进行示例性的说明。结合图7、图10和图13，以像素电路110为位于第i行的第一像素电路，像素电路120为位于第i+1行的第二像素电路为例，第一像素电路110的第一节点N11和N12均通过电位调节晶体管M3与第二像素电路120的第二节点N2电连接；在第一像素电路110的数据写入阶段T2之后，进入第一像素电路110的电位调节阶段T3，第三扫描信号S3跳变为低电平，以使第二像素电路120的第二节点N2的电位能够通过导通的电位调节晶体管M2写入至第一像素电路110的第一节点N11和N12，以在电位调节阶段T3结束后，第一像素电路110的第一节点N11和N12与该第一像素电路110的第二节点N2之间的电位差能够在预设电位差范围内。
相应的，当与同一电位调节晶体管电连接的第一像素电路和第二像素电路分别为位于第i行的像素电路和位于第i+1行的像素电路时，位于第i+1行的一个像素电路与位于第i行的一个像素电路或一行像素电路电连接。
示例性的，图14是本发明实施例提供的又一种显示面板的结构示意图。其中，图14中与图13中相同之处，可参照上述对图13的描述，在此不再赘述，此处仅对图14中与图13中不同之处进行示例性的说明。如图14所示，当i＝1时，第二行像素电路1002中的一个像素电路通过一个电位调节晶体管M3与第一行像素电路1001中的各像素电路电连接，以在电位调节阶段，能够使二行像素电路1002中的一个像素电路的第二节点的信号传输至第一行像素电路1001中各像素电路的第一节点，从而能够在第一行像素电路1001的发光阶段，第一行像素电路1001中各像素电路的第一节点与其第二节点之间的电位差能够在预设电位差范围内。
需要说明的是，图14仅为本发明实施例示例性的附图，图14中显示面板100包括显示区101和非显示区102，各像素电路10和各电位调节晶体管均设置于显示区101中；而在本发明其它实施例中，还可以仅将像素电路设置于显示区，而电位调节晶体管设置于非显示区中(如图15所示)。
可选的，对于与同一电位调节晶体管电连接的第一像素电路和第二像素电路分别为第i行像素电路和第i+1行像素电路的情况，若显示面板包括N+1行像素电路，则第N+1行像素电路可以为其中的发光模块不进行发光的虚拟像素电路。
示例性的，如图13所示，显示面板100包括N+1行所述像素电路，且N为大于或等于1的整数时，位于前N行的像素电路10的驱动晶体管向该像素电路的发光模块提供驱动电流，并驱动该像素电路的发光模块发光；位于第N+1行的像素电路10的驱动晶体管向该像素电路的发光模块提供驱动电流，且该像素电路的发光模块不发光。第一行像素电路1001中的各像素电路的第一节点可通过各电位调节晶体管M3与第二行像素电路1002中的各像素电路的第二节点一一对应电连接，以在第一行像素电路1001的电位调节阶段，第二行像素电路1002中的各像素电路的第二节点的信号能够一一对应地传输至第一行像素电路1001的各像素电路的第一节点；第二行像素电路1002中的各像素电路的第一节点可通过各电位调节晶体管M3与第三行像素电路1003中的各像素电路的第二节点一一对应电连接，以在第二行像素电路1002的电位调节阶段，第三行像素电路1003中的各像素电路的第二节点的信号能够一一对应地传输至第二行像素电路1002的各像素电路的第一节点；…；以此类推，第N行像素电路100n中的各像素电路的第一节点可通过各电位调节晶体管M3与第N+1行像素电路100n+1中的各像素电路的第二节点一一对应电连接，以在第N行像素电路100n的电位调节阶段，第N+1行像素电路100n+1中的各像素电路的第二节点的信号能够一一对应地传输至第二行像素电路1002的各像素电路的第一节点；而由于第N+1行像素电路100n+1中的各像素电路的发光模块不发光，因此无需对第N+1行像素电路100n+1中的各像素电路的第一节点的电位进行调节。其中，当前N行像素电路的发光模块包括有机发光二极管时，第N+1行像素电路100n+1中的各像素电路的发光模块中可以不设置相应的有机发光二极管。
可选的，对于与同一电位调节晶体管电连接的第一像素电路和第二像素电路分别为第i行像素电路和第i+1行像素电路的情况，若显示面板包括N+1行像素电路，则第N+1行像素电路的第一节点可通过相应的电位调节模块与该第N+1行像素电路的第二节点电连接。
示例性的，图16是本发明实施例提供的又一种显示面板的结构示意图。图16中与图13中相同之处，可参照上述对图13的描述，在此不再赘述，此处仅对图16中与图13中不同之处进行示例性的说明。如图16所示，当显示面板100包括N+1行像素电路，且该N+1行像素电路的发光模块均可以在各自的驱动晶体管的驱动下进行发光时，位于第N+1行的像素电路的第一节点通过各电位调节模块的电位调节晶体管与位于第N+1行的像素电路的第二节点电连接，即第N+1行像素电路100n+1中的各像素电路的第一节点通过电位调节模块可以与其自身的第二节点电连接。此时，第N+1行像素电路100n+1中各像素电路的电位调节阶段与上述图9和图6所示的像素电路的电位调节阶段类似，具体原理可参照上述对图9和图6的描述，在此不再赘述。
可选的，对于与同一电位调节晶体管电连接的第一像素电路和第二像素电路分别为第i行像素电路和第i+1行像素电路的情况，若显示面板包括N+1行像素电路，则第N+1行像素电路的第一节点可通过相应的电位调节模块接收电位调节信号。
示例性的，图17是本发明实施例提供的又一种显示面板的结构示意图。图17中与图16中相同之处，可参照上述对图16的描述，在此不再赘述，此处仅对图17中与图16中不同之处进行示例性的说明。如图17所示，位于第N+1行的像素电路的第一节点通过电位调节模块接收电位调节信号Vreg。如此，在第N+1行像素电路100n+1的电位调节阶段，电位调节模块的电位调节晶体管导通，第N+1行像素电路100n+1通过电位调节晶体管接收电位调节信号Vreg，以在第N+1行像素电路100n+1的发光阶段，第N+1行像素电路100n+1中的各像素电路的第一节点与第二节点之间的电位差能够在预设电位差范围内。
其中，通过电位调节晶体管传输至第N+1行像素电路100n+1中的各像素电路的电位调节信号可以为固定电压信号，或者为随第N+1行像素电路100n+1中的各像素电路的第二节点的电位变化而变化的电压信号；在第N+1行像素电路100n+1的发光阶段，能够使第N+1行像素电路100n+1中的各像素电路的第一节点与第二节点之间的电位差在预设电位差范围内的前提下，本发明实施例对此不做具体限定。
可选的，在本发明实施例中，显示面板的各行像素电路可依次接收相应的扫描信号，使得前一行像素电路的数据写入阶段在后一行像素电路的数据写入阶段之前。此时，当像素电路的数据写入模块包括数据写入晶体管，且该数据写入晶体管的第一极接收数据信号，数据写入晶体管的第二极与驱动晶体管的第一极电连接，以及数据写入晶体管的栅极接收第二扫描信号，并在第二扫描信号的控制下导通或断开。此时，同时与位于第i行的像素电路和位于第i+1行的像素电路电连接的电位调节晶体管接收的第三扫描信号可以复用位于第i+1行的像素电路的数据写入晶体管接收的第二扫描信号；其中，i为大于或等于1的整数。
示例性的，图18是本发明实施例提供的又一种显示面板中像素电路的结构示意图，图19本发明施例提供的又一种显示面板中像素电路的驱动时序图。结合图18和图19所示，以与同一电位调节晶体管M3电连接的第一像素电路和第二像素电路为同一像素电路为例。像素电路110为位于第i行的像素电路，像素电路120为位于第i+1行的像素电路。在像素电路110的初始化阶段T1'，像素电路110接收的第一扫描信号S11为低电平VGL，像素电路110接收的第二扫描信号S21保持为高电平；而在像素电路110的初始化阶段T1'结束后，将会同时进入像素电路110的数据写入阶段T2'和像素电路120的初始化阶段T2'，像素电路110接收的第一扫描信号S11跳变为高电平，而像素电路110接收的第二扫描信号S21以及像素电路120接收的第一扫描信号S12跳变为低电平，此时像素电路110接收的第二扫描信号S21可以复用像素电路120接收的第一扫描信号S12；在像素电路110的数据写入阶段T2'结束后，像素电路110会进入电位调节阶段T3'，同时像素电路120也会进入数据写入阶段T3'，此时与像素电路110电连接的电位调节晶体管M3接收的第三扫描信号S31可以复用像素电路120的数据写入晶体管M4接收的第二扫描信号S22；在像素电路110的电位调节阶段T3'结束后，像素电路110会进入发光阶段T4'，而像素电路120则会进入电位调节阶段T5'，与像素电路120电连接的电位调节晶体管M3接收的第三扫描信号S32同样可以复用位于第i+2行的像素电路接收的第二扫描信号，并在像素电路120的电位调节阶段T4'结束后，像素电路110会进入发光阶段T6'。如此，通过将与第i行像素电路电连接的电位调节晶体管M3接收的第三扫描信号复用与第i+1行像素电路接收的第二扫描信号，无需为控制电位调节晶体管M3的导通或断开而额外设置扫描驱动电路来提供扫描信号，从而能够简化显示面板100的结构。
示例性的，图20是本发明实施例提供的又一种显示面板中像素电路的结构示意图。图20中与图18中相同之处，可参照上述对图18的描述，在此不再赘述，此处仅对图20中与图18中不同之处进行示例性的说明。结合图19和图20所示，以与同一电位调节晶体管M3电连接的第一像素电路和第二像素电路分别为位于第i行和第i+1行的像素电路为例。若像素电路110可以为位于第i行的像素电路，像素电路120可以为位于第i+1行的像素电路，则像素电路110的第一节点N11和N12通过电位调节模块21的电位调节晶体管M3与像素电路120的第二节点N2电连接。此时，由于在像素电路110的数据写入阶段T2′结束后，会同时进入像素电路120的数据写入阶段T3′和像素电路110的电位调节阶段T3′，且像素电路120的数据写入阶段T3′和像素电路110的电位调节阶段T3′可以同时结束，因此可以将像素电路120接收的第二扫描信号S22复用为电位调节模块21的电位调节晶体管M3接收的第三扫描信号S31；此过程中，像素电路120接收的数据信号Vdata会写入至其第二节点，同时像素电路120的第二节点N2的信号也会通过导通的电位调节晶体管M3传输至像素电路110的第一节点N11和N12，并在像素电路120的数据写入阶段结束时，像素电路120的第二节点N2的电位VN2＝Vdata+Vth，即仍然能够确保像素电路120的第二节点的电位VN2包括与该像素电路120的灰阶对应的数据信号和其驱动晶体管T的阈值电压。如此，一方面，同样无需为控制电位调节晶体管M3的导通或断开额外设置扫描驱动电路，可以简化显示面板的结构；另一方面，在像素电路120写入数据信号时，无需额外增加用于调节像素电路110的第一节点N11和N12的电位，从而能够简化驱动方式。
可选的，继续参考图20，显示面板的各像素电路的数据写入模块13包括数据写入晶体管M4，且该数据写入晶体管M4的栅极接收第二扫描信号，数据写入晶体管M4的第一极接收数据信号Vdata，数据写入晶体管M4的第二极与驱动晶体管T的第一极电连接，该数据写入晶体管M4能够在第二扫描信号(S21、S22、S23)的控制下导通或断开。当与同一电位调节模块电连接的第一像素电路和第二像素电路分别为位于第i行和第i+1行的像素电路时，与位于第i行的第一像素电路110电连接的电位调节晶体管M3接收的第三扫描信号S31复用位于第i+2行的像素电路130接收的所述第二扫描信号S23，其中，i为大于或等于1的整数。
示例性的，图21是与图20对应的一种显示面板的像素电路的时序图。图21与图19相同之处，可参照上述对图19的描述，在此不再赘述，此处仅对图21与图19不同之处进行示例性的说明。结合图21和图20所示，第i+1行像素电路120接收的第二扫描信号S22会复用为第i+2行像素电路130接收的第一扫描信号S13；在像素电路130的初始化阶段T3′(即像素电路120的数据写入阶段T3′)结束后，进入像素电路130的数据写入阶段T4′；此时，可以将与位于第i行的第一像素电路110电连接的电位调节晶体管M3接收的第三扫描信号S31复用位于第i+2行的像素电路130接收的所述第二扫描信号S23，使得像素电路130的数据写入阶段T4′为第一像素电路110的电位调节阶段T4′。
相应的，当将第一像素电路110的电位调节阶段T4′设置在像素电路120的数据写入阶段T3′之后时，在像素电路120的数据写入阶段T3′向像素电路120的第二节点N2写入数据信号，直至该像素电路120的第二节点N2的电位为Vd+ΔV1-|Vth|；而在进入第一像素电路100的电位调节阶段T4′后，电位调节模块21的电位调节晶体管M3导通，像素电路120的第二节点N2对第一像素电路110的第一节点N11和N12进行调节的同时，第一像素电路110的第一节点N11和N12也会影响像素电路120的第二节点N2的电位，且受第一像素电路110的第一节点N11和N12的影响，像素电路120的第二节点N2的电位会改变ΔV1，使得在第一像素电路100的电位调节阶段T4′后，像素电路120的第二节点N2的电位变为Vd-|Vth|，该电位Vd-|Vth|为对像素电路120的驱动晶体管T的阈值电压进行补偿后的电位，此时像素电路120的驱动晶体管T根据其第二节点N2的电位驱动其发光模块12进行发光时，该像素电路120的发光模块的发光亮度即为该帧画面中像素电路120对应的显示灰阶；如此，即使将第一像素电路110的电位调节阶段T4′设置在像素电路120的数据写入阶段T3′之后，也能够确保像素电路120的发光模块12具有相应的发光亮度。
同样的，像素电路120为位于第i+1行的第一像素电路，则与位于第i+1行的第一像素电路120电连接的电位调节晶体管M3接收的第三扫描信号S31可以复用位于第i+3行的像素电路接收的第二扫描信号。
可选的，当各像素电路还包括发光控制模块，且该发光控制模块用于在发光阶段，控制驱动晶体管提供的驱动电流流入发光模块时，该发光控制模块可以包括发光控制晶体管；该发光控制晶体管串联设置于第一电源信号端与发光模块之间，且发光控制晶体管的栅极接收发光控制信号，并在发光控制信号的控制下导通或断开。
可选的，继续参考图20和图21，第i+2行的像素电路130接收的第二扫描信号S23使能阶段的终止时刻位于第i+1行的像素电路120接收的发光控制信号Emit2使能阶段T6′的起始时刻之前。当将与位于第i行的第一像素电路110电连接的电位调节模块21的电位调节晶体管M3的栅极接收的第三扫描信号S31复用为第i+2行的像素电路130接收的第二扫描信号S23时，位于第i行的第一像素电路110的电位调节阶段T4′会位于第i+1行像素电路120的发光阶段T6′之前；此时，同样可在像素电路120的数据写入阶段T3′向像素电路120的第二节点N2写入数据信号，直至该像素电路120的第二节点N2的电位为Vd+ΔV1-|Vth|，以确保在像素电路120在其发光阶段T6′，该像素电路120的发光模块12具有相应的发光亮度。同样的，与位于第i+1行的像素电路120电连接的电位调节模块22的电位调节晶体管M3的栅极接收的第三扫描信号S32复用为第i+3行的像素电路(图中未示出)接收的第二扫描信号，以使位于第i+1行的像素电路120的电位调节阶段T7′会位于第i+2行像素电路130的发光阶段T9′之前；与位于第i+2行的像素电路130电连接的电位调节模块23的电位调节晶体管M3的栅极接收的第三扫描信号S33复用为第i+4行的像素电路(图中未示出)接收的第二扫描信号，以使位于第i+2行的像素电路130的电位调节阶段T8′会位于第i+3行像素电路的发光阶段之前。
相应的，位于第i行的第一像素电路110的电位调节阶段T4′同样会位于该第i行像素电路110的发光阶段T5′之前，以防在第i行的第一像素电路110的发光阶段T5′时，第一像素电路110的第一节点N11和N12与其第二节点N2之间的电位未在预设电位差范围内，而影响第i行的第一像素电路110的发光模块稳定发光。同样的，位于第i+1行的像素电路120的电位调节阶段T7′同样会位于该第i+1行像素电路120的发光阶段T6′之前，位于第i+2行的像素电路130的电位调节阶段T8′同样会位于该第i+2行像素电路130的发光阶段T9′之前。
基于同一发明构思，本发明实施例还提供一种显示面板的驱动方法，该显示面板的驱动方法用于驱动本发明实施例提供的显示面板，因此该显示面板的驱动方法具备本发明实施例提供的显示面板的有益效果，相同之处可参照上述对本发明实施例的显示面板的描述。
其中，显示面板中每个像素电路的驱动周期包括电位调节阶段和发光阶段。图22是本发明实施例提供的一种显示面板中像素电路的驱动方法的流程图。如图22所示，显示面板中像素电路的驱动方法包括：
S110、在电位调节阶段，电位调节模块根据第二节点的电位，调节第一节点的电位；
S120、在发光阶段，像素电路的第一节点的电位与第二节点的电位之间的电位差在预设电位差范围内，驱动晶体管根据第二节点的电位，向发光模块提供驱动电流。
如此，在每个像素电路的电位调节阶段，可通过相应的电位调节模块根据该像素电路的第二节点的电位或其它像素电路的第二节点的电位，调节该像素电路的第一节点的电位，以在发光阶段使得该像素电路的第一节点的电位能够与其第二节点的电位保持在预设范围内，从而能够减少因像素电路的第一节点与第二节点之间的电位差产生的漏流，确保发光阶段时第二节点电位稳定，使得驱动晶体管能够向发光模块提供稳定的驱动电流，以驱动发光模块稳定发光，进而有利于提高显示面板的显示效果。同时，通过电位调节模块根据显示面板中的像素电路的第二节点的电位调节像素电路中的第一节点的电位，能够准确地将像素电路的第一节点与其第二节点的电位差调整至预设电位差范围内，且无需针对各像素电路额外提供用于调节各像素电路的第一节点电位的电位调节信号，从而有利于简化显示面板的结构以及降低显示面板的功耗。
可选的，当像素电路的至少一个开关模块包括第一开关模块，且该第一开关模块的第一晶体管的第一极接收初始化信号，第一开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第一扫描信号时，每个像素电路的驱动周期还包括位于电位调节阶段之前的初始化阶段，且在初始化阶段，第一扫描信号控制第一开关模块的第一晶体管和第二晶体管导通，初始化信号通过导通的第一晶体管和第二晶体管传输至驱动晶体管的栅极，以对驱动晶体管进行初始化。或者，当像素电路的至少一个开关模块包括第二开关模块，且该第二开关模块的第一晶体管的第一极与驱动晶体管的第二极电连接，第二开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第二扫描信号时，每个像素电路的驱动周期还包括位于电位调节阶段之前的数据写入阶段，且在数据写入阶段，第二扫描信号控制第二开关模块的第一晶体管和第二晶体管导通，以将驱动晶体管的阈值电压补偿至所述驱动晶体管的栅极。
示例性的，以每个像素电路包括两个开关模块，即每个像素电路包括第一开关模块和第二开关模块为例。图23是本发明实施例提供的又一种显示面板中像素电路的驱动方法的流程图。如图23所示，显示面板中像素电路的驱动方法包括：
S210、在初始化阶段，第一扫描信号控制第一开关模块的第一晶体管和第二晶体管导通，初始化信号通过导通的第一晶体管和第二晶体管传输至驱动晶体管的栅极，以对驱动晶体管进行初始化。
S220、在数据写入阶段，第二扫描信号控制第二开关模块的第一晶体管和第二晶体管导通，以将驱动晶体管的阈值电压补偿至所述驱动晶体管的栅极。
其中，每个像素电路还可以包括数据写入模块，且该数据写入模块包括数据写入晶体管，该数据写入晶体管的栅极接收第二扫描信号，数据写入晶体管的第一极接收数据信号，数据写入晶体管的第二极与驱动晶体管的第一极电连接；此时，在每个像素电路的数据写入阶段，第二扫描信号还会控制数据写入晶体管导通，使得数据信号通过导通的数据写入晶体管，将数据信号写入至第二节点；此时，第i行像素电路的电位调节阶段可与第i+1行像素电路的数据写入阶段为同一阶段，以使电位调节模块的电位调节晶体管接收的第三扫描信号能够复用第i+1行像素电路的第二扫描信号；或者，第i行像素电路的电位调节阶段与第i+2行像素电路的数据写入阶段为同一阶段，以使电位调节模块的电位调节晶体管接收的第三扫描信号能够复用第i+2行像素电路的第二扫描信号；其中，i为大于或等于1的整数。
S230、在电位调节阶段，电位调节模块根据第二节点的电位，调节第一节点的电位。
S240、在发光阶段，像素电路的第一节点的电位与第二节点的电位之间的电位差在预设电位差范围内，驱动晶体管根据第二节点的电位，向发光模块提供驱动电流。
其中，当与电位调节模块的输入端和输入端电连接的像素电路分别为位于第i行和第i+1行的像素电路时，每个像素电路还可以包括发光控制模块，且该发光控制模块包括至少一个发光控制晶体管，该发光控制晶体管串联设置于第一电源信号端与发光模块之间，发光控制晶体管的栅极接收发光控制信号；此时，每个像素电路的发光阶段具体包括：像素电路的第一节点的电位与第二节点的电位之间的电位差在预设电位差范围内；发光控制信号控制发光控制晶体管导通，驱动晶体管根据第二节点的电位提供的驱动电流流入发光模块，以驱动发光模块发光。如此，第i行像素电路的电位调节阶段可位于第i+1行像素电路的发光阶段之前，以在第i+1行像素电路的发光阶段时，确保该第i+1行像素电路的第二节点的电位稳定。
基于同一发明构思，本发明实施例还提供一种显示装置，该显示装置包括本发明实施例提供的显示面板，因此本发明实施例提供的显示装置具备本发明实施例提供的显示面板的技术特征，能够达到本发明实施例提供的显示面板的有益效果，相同之处可参照上述对本发明实施例提供的显示面板的描述，在此不再赘述。
示例性的，图24为本发明实施例提供的一种显示装置的结构示意图，如图24所示，该显示装置200包括本发明任意实施例所述的显示面板100。本发明实施例提供的显示装置200可以为图24所示的手机，也可以为任何具有显示功能的电子产品，包括但不限于以下类别：电视机、笔记本电脑、桌上型显示器、平板电脑、数码相机、智能手环、智能眼镜、车载显示器、医疗设备、工控设备、触摸交互终端等，本发明实施例对此不作特殊限定。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整、相互结合和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (20)

1.一种显示面板，其特征在于，包括：
多个像素电路呈阵列排布；所述像素电路包括驱动晶体管、至少一个开关模块和发光模块；所述开关模块包括第一晶体管和第二晶体管；所述第一晶体管的第二极和所述第二晶体管的第一极在第一节点电连接；所述第二晶体管的第二极与所述驱动晶体管的栅极在第二节点电连接；所述驱动晶体管用于在发光阶段，根据所述第二节点的电位，向所述发光模块提供驱动电流；
多个电位调节模块；每个所述电位调节模块的输入端与一个所述像素电路的第二节点电连接，所述电位调节模块的输出端与至少一个所述像素电路的第一节点电连接；所述电位调节模块用于根据所述第二节点的电位，调节所述第一节点的电位，以在所述像素电路的所述发光阶段，控制所述像素电路的第一节点和第二节点之间的电位差在预设电位差范围内。
2.根据权利要求1所述的显示面板，其特征在于，至少一个所述开关模块包括第一开关模块；所述第一开关模块的第一晶体管的第一极接收初始化信号，所述第一开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第一扫描信号；所述第一开关模块用于在初始化阶段，将所述初始化信号传输至所述驱动晶体管的栅极；
和/或，至少一个所述开关模块包括第二开关模块；所述第二开关模块的第一晶体管的第一极与所述驱动晶体管的第二极电连接，所述第二开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第二扫描信号；所述第二开关模块用于在数据写入阶段，将所述驱动晶体管的阈值电压补偿至所述驱动晶体管的栅极。
3.根据权利要求1所述的显示面板，其特征在于，与所述电位调节模块的输出端电连接的像素电路为第一像素电路，与所述电位调节模块的输入端电连接的像素电路为第二像素电路；
所述电位调节模块包括电位调节晶体管；所述电位调节晶体管的第一极与所述第二像素电路的第二节点电连接，所述电位调节晶体管的第二极与所述第一像素电路的第一节点电连接；所述电位调节晶体管的栅极接收第三扫描信号；所述电位调节晶体管在所述第三扫描信号的控制下导通或断开。
4.根据权利要求3所述的显示面板，其特征在于，所述像素电路还包括数据写入模块；所述数据写入模块用于在数据写入阶段，将数据信号写入至所述第二节点；
与第i行的第一像素电路电连接的所述电位调节晶体管接收的所述第三扫描信号在所述第i行的第一像素电路的数据写入阶段之后控制所述电位调节晶体管导通。
5.根据权利要求4所述的显示面板，其特征在于，与同一所述电位调节晶体管电连接的所述第一像素电路和所述第二像素电路为同一像素电路；或者，与同一所述电位调节晶体管电连接的所述第一像素电路和所述第二像素电路为位于同一行的两个不同的像素电路。
6.根据权利要求4所述的显示面板，其特征在于，与同一所述电位调节晶体管电连接的所述第一像素电路和所述第二像素电路分别为位于第i行的像素电路和位于第i+1行的像素电路；其中，i为大于或等于1的整数。
7.根据权利要求6所述的显示面板，其特征在于，包括：N+1行所述像素电路；其中，N为大于或等于1的整数；
位于前N行的所述像素电路的驱动晶体管向该所述像素电路的发光模块提供驱动电流，并驱动该所述像素电路的发光模块发光；
位于第N+1行的所述像素电路的驱动晶体管向该所述像素电路的发光模块提供驱动电流，且该所述像素电路的发光模块不发光；
位于第N行的所述像素电路的第一节点通过所述电位调节模块与位于所述第N+1行的所述像素电路的第二节点电连接。
8.根据权利要求4所述的显示面板，其特征在于，包括：N+1行所述像素电路；其中，N为大于或等于2的整数；
与同一所述电位调节晶体管电连接的所述第一像素电路和所述第二像素电路分别为位于第i行的像素电路和位于第i+1行的像素电路；其中，1≤i≤N，且i为整数；
位于第N+1行的所述像素电路的第一节点通过所述电位调节模块与位于第N+1行的一个所述像素电路的第二节点电连接。
9.根据权利要求4所述的显示面板，其特征在于，包括：N+1行所述像素电路；其中，N为大于或等于2的整数；
与同一所述电位调节晶体管电连接的所述第一像素电路和所述第二像素电路分别为位于第i行的像素电路和位于第i+1行的像素电路；其中，1≤i≤N，且i为整数；
位于第N+1行的所述像素电路的第一节点通过所述电位调节模块接收电位调节信号。
10.根据权利要求5-9任一项所述的显示面板，其特征在于，所述数据写入模块包括数据写入晶体管；所述数据写入晶体管的栅极接收第二扫描信号，所述数据写入晶体管的第一极接收数据信号，所述数据写入晶体管的第二极与所述驱动晶体管的第一极电连接；所述数据写入晶体管在所述第二扫描信号的控制下导通或断开；
与位于第i行的所述第一像素电路电连接的所述电位调节晶体管接收的所述第三扫描信号复用位于第i+1行的所述像素电路的数据写入晶体管接收的所述第二扫描信号；其中，i为大于或等于1的整数。
11.根据权利要求6-9任一项所述的显示面板，其特征在于，所述数据写入模块包括数据写入晶体管；所述数据写入晶体管的栅极接收第二扫描信号，所述数据写入晶体管的第一极接收数据信号，所述数据写入晶体管的第二极与所述驱动晶体管的第一极电连接；所述数据写入晶体管在所述第二扫描信号的控制下导通或断开；
与位于第i行的所述第一像素电路电连接的所述电位调节晶体管接收的所述第三扫描信号复用位于第i+2行的所述像素电路接收的所述第二扫描信号，其中，i为大于或等于1的整数。
12.根据权利要求11所述的显示面板，其特征在于，所述像素电路还包括发光控制模块；所述发光控制模块用于在发光阶段，控制所述驱动晶体管提供的所述驱动电流流入所述发光模块。
13.根据权利要求12所述的显示面板，其特征在于，所述发光控制模块包括至少一个发光控制晶体管；所述发光控制晶体管串联设置于第一电源信号端与所述发光模块之间；所述发光控制晶体管的栅极接收发光控制信号，并在所述发光控制信号的控制下导通或断开；
第i+2行的所述像素电路接收的所述第二扫描信号使能阶段的终止时刻位于所述第i+1行的所述像素电路接收的所述发光控制信号使能阶段的起始时刻之前。
14.根据权利要求3所述的显示面板，其特征在于，所述电位调节晶体管的宽长比小于所述第一晶体管和/或所述第二晶体管的宽长比。
15.根据权利要求3所述的显示面板，其特征在于，所述电位调节晶体管包括双栅晶体管；所述双栅晶体管包括第三晶体管和第四晶体管；
所述第三晶体管的第一极与所述第二像素电路的第二节点电连接，所述第三晶体管的第二极与所述第四晶体管的第一极电连接，所述第四晶体管的第二极与所述第一像素电路的第一节点电连接；所述第三晶体管的栅极和所述第四晶体管的栅极均接收所述第三扫描信号。
16.一种显示面板的驱动方法，其特征在于，应用于如权利要求1-15中任一项所述的显示面板，所述显示面板中每个所述像素电路的驱动周期包括：电位调节阶段和发光阶段；
在所述电位调节阶段，所述电位调节模块根据所述第二节点的电位，调节所述第一节点的电位；
在发光阶段，所述像素电路的第一节点的电位与第二节点的电位之间的电位差在预设电位差范围内，所述驱动晶体管根据所述第二节点的电位，向所述发光模块提供驱动电流。
17.根据权利要求16所述的驱动方法，其特征在于，至少一个所述开关模块包括第一开关模块；所述第一开关模块的第一晶体管的第一极接收初始化信号，所述第一开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第一扫描信号；
每个所述像素电路的驱动周期还包括：位于所述电位调节阶段之前的初始化阶段；
在所述初始化阶段，所述第一扫描信号控制所述第一开关模块的第一晶体管和第二晶体管导通，所述初始化信号通过到导通的所述第一晶体管和第二晶体管传输至所述驱动晶体管的栅极，以对所述驱动晶体管进行初始化；
和/或，至少一个所述开关模块包括第二开关模块；所述第二开关模块的第一晶体管的第一极与所述驱动晶体管的第二极电连接，所述第二开关模块的第一晶体管的栅极和第二晶体管的栅极均接收第二扫描信号；
每个所述像素电路的驱动周期还包括：位于所述电位调节阶段之前的数据写入阶段；
在所述数据写入阶段，所述第二扫描信号控制所述第二开关模块的第一晶体管和第二晶体管导通，以将所述驱动晶体管的阈值电压补偿至所述驱动晶体管的栅极。
18.根据权利要求16所述的驱动方法，其特征在于，所述像素电路还包括数据写入模块；所述数据写入模块包括数据写入晶体管；所述数据写入晶体管的栅极接收第二扫描信号，所述数据写入晶体管的第一极接收数据信号，所述数据写入晶体管的第二极与所述驱动晶体管的第一极电连接；
每个所述像素电路的驱动周期还包括：位于所述电位调节阶段之前的数据写入阶段；
在所述数据写入阶段，所述第二扫描信号控制所述数据写入晶体管导通，所述数据信号通过导通的所述数据写入晶体管，将所述数据信号写入至所述第二节点；
其中，第i行像素电路的电位调节阶段与第i+1行像素电路的数据写入阶段为同一阶段；或者，第i行像素电路的电位调节阶段与第i+2行像素电路的数据写入阶段为同一阶段；i为大于或等于1的整数。
19.根据权利要求18所述的驱动方法，其特征在于，所述像素电路还包括发光控制模块；所述发光控制模块包括至少一个发光控制晶体管；所述发光控制晶体管串联设置于第一电源信号端与所述发光模块之间；所述发光控制晶体管的栅极接收发光控制信号；
所述发光阶段具体包括：所述像素电路的所述第一节点的电位与所述第二节点的电位之间的电位差在预设电位差范围内；所述发光控制信号控制所述发光控制晶体管导通，所述驱动晶体管根据所述第二节点的电位提供的驱动电流流入所述发光模块，以驱动所述发光模块发光；
其中，所述第i行像素电路的电位调节阶段位于所述第i+1行像素电路的发光阶段之前。
20.一种显示装置，其特征在于，包括权利要求1-15任一项所述的显示面板。
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