CN111145686A - 一种像素驱动电路、显示面板及驱动方法 - Google Patents

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Abstract

本发明公开了像素驱动电路、显示面板及驱动方法，包括第一初始化模块、第一阈值补偿模块、第一数据写入模块、第一发光控制模块和发光调节模块。第一初始化模块包括第一初始化信号端、第一初始化控制端、第一扫描信号端，电连接第一节点和第二节点。第一阈值补偿模块包括第一电源信号端，电连接第一扫描信号端、第一节点和第三节点。第一数据写入模块包括第一数据信号端、第二扫描信号端、发光时长控制信号端，电连接第二节点。第一发光控制模块包括第一发光控制信号端，电连接第三节点和第四节点。发光调节模块包括第二发光控制信号端、第三扫描信号端、第二数据信号端、输出端。解决了相同颜色发光元件在不同显示亮度下显示色度有差异的问题。

Description

一种像素驱动电路、显示面板及驱动方法
技术领域
本发明涉及显示技术，尤其涉及一种像素驱动电路、显示面板及驱动方法。
背景技术
电流驱动型显示面板，例如OLED显示面板以及LED显示面板具有全固态、宽视角、响应快等诸多优点，在显示领域具有巨大的应用前景。
电流驱动型显示面板的每个像素单元都包括像素驱动电路和发光元件；发光元件是电流驱动器件，像素驱动电路为发光元件提供驱动电流，即像素驱动电路通过控制驱动电流的大小来控制发光元件的发光亮度。但是对相同颜色的发光元件进行驱动时，由于驱动电流不同，有可能引起不同发光元件的发光色度存在差异，从而影响显示面板的显示效果。例如，根据画面显示的需求，红色发光元件A的发光亮度为LA，红色发光元件B的发光亮度为LB，LA不等于LB，若为红色发光元件A和红色发光元件B提供不同的驱动电流，就会引起红色发光元件A和红色发光元件B的发光色度的差异。
发明内容
本发明提供一种像素驱动电路、显示面板以及驱动方法，以解决相同颜色的发光元件在不同显示亮度下，显示色度有差异的问题。
第一方面，本发明实施例提供了一种像素驱动电路，包括：第一初始化模块、第一阈值补偿模块、第一数据写入模块、第一发光控制模块和发光调节模块；
所述第一初始化模块包括第一初始化信号端、第一初始化控制端、第一扫描信号端，所述第一初始化模块电连接于第一节点和第二节点，所述第一初始化模块提供第一初始化信号至第一节点；
所述第一阈值补偿模块包括第一电源信号端，所述第一阈值补偿模块电连接于所述第一扫描信号端、所述第一节点和第三节点，所述第一阈值补偿模块用于对所述第一节点电位进行补偿；
所述第一数据写入模块包括第一数据信号端、第二扫描信号端、发光时长控制信号端，所述第一数据写入模块电连接于所述第二节点，所述第一数据写入模块通过所述第二节点调节所述第一节点的电位；
所述第一发光控制模块包括第一发光控制信号端，所述第一发光控制模块电连接于所述第三节点和第四节点；
所述发光调节模块包括第二发光控制信号端、第三扫描信号端、第二数据信号端、输出端，所述发光调节模块电连接所述第一电源信号端和所述第四节点，所述发光调节模块经所述输出端输出驱动信号。
第二方面，本发明实施例还提供了一种显示面板，包括发光元件以及第一方面所述的像素驱动电路；
其中，所述像素驱动电路的所述输出端与所述发光元件的阳极电连接。
第三方面，本发明实施例还提供了一种像素驱动电路的驱动方法，采用第一方面所述的像素驱动电路，包括：
第一阶段，所述第一初始化模块将所述第一初始化信号端的第一初始化信号写入所述第一节点；
第二阶段，所述第一阈值补偿模块补偿第一节点的电位；所述第一初始化模块将所述第一初始化信号端的第一初始化信号写入所述第二节点；
第三阶段，所述第一数据写入模块将所述第一数据信号端的第一数据信号写入所述第二节点；
第四阶段，所述发光调节模块将所述第二数据信号端的第二数据信号写入所述第四节点；
第五阶段，所述第一数据写入模块调节所述第一节点电位，以使所述第一电源信号端与所述第三节点之间断开，所述发光调节模块经所述输出端输出驱动信号；
第六阶段，所述第一发光控制模块导通，所述第一数据写入模块调节所述第一节点电位，以使所述第一电源信号端与所述第三节点之间导通，所述发光调节模块的输出端关断。
本发明实施例提供的像素驱动电路包括第一初始化模块、第一阈值补偿模块、第一数据写入模块、第一发光控制模块和发光调节模块。其中，第一初始化模块在第一阶段可以将第一初始化信号端的第一初始化信号写入第一节点，实现第一节点的复位；第一阈值补偿模块在第二阶段实现对第一节点的电位的补偿；第一初始化模块在第二阶段将第一初始化信号端的第一初始化信号写入第二节点；第一数据写入模块在第三阶段能够第一数据信号端的第一数据信号写入第二节点，此时可以实现第三节点与第一电源信号端之间断开；发光调节模块在第四阶段将所述第二数据信号端的第二数据信号写入所述第四节点；第一数据写入模块能够在第五阶段调节所述第一节点电位，继续保持第一电源信号端与第三节点之间断开，从而可以实现发光调节模块在第五阶段经输出端输出驱动信号，进而控制对应连接的发光元件在第五阶段发光。第一发光控制模块在第六阶段导通，第一数据写入模块在第六阶段可以通过发光时长控制信号端输入的发光时长控制信号调节第一节点电位，实现在第六阶段第一电源信号端与第三节点之间导通，进而发光调节模块的输出端关断，无驱动信号输出，因此第六阶段期间与发光调节模块的输出端对应连接的发光元件不发光。因此，发光时长控制信号端输入发光时长控制信号可以控制第一电源信号端与第三节点之间的导通与关断，进而可以实现控制述发光调节模块输出驱动信号的时长，从而能够在保证相同驱动电流的前提下，实现相同颜色的发光元件在不同显示亮度下的显示色度一致性。
附图说明
图1为本发明实施提供的一种像素驱动电路的结构示意图；
图2为本发明实施例提供的一种像素驱动电路的驱动方法的流程示意图；
图3为本发明实施提供的又一种像素驱动电路的结构示意图；
图4为图3中所示像素驱动电路的驱动时序；
图5为本发明实施例提供的又一种像素驱动电路的驱动方法的流程示意图；
图6为图3中像素驱动电路中各晶体管在第一阶段中的导通状态示意图；
图7为图3中像素驱动电路中各晶体管在第二阶段中的导通状态示意图；
图8为图3中像素驱动电路中各晶体管在第三阶段中的导通状态示意图；
图9为图3中像素驱动电路中各晶体管在第四阶段中的导通状态示意图；
图10为图3中像素驱动电路中各晶体管在第五阶段中的导通状态示意图；
图11为图3中像素驱动电路中各晶体管在第六阶段中的导通状态示意图；
图12为本发明实施例提供的又一种像素驱动电路的结构示意图；
图13为本发明实施例提供的又一种像素驱动电路的结构示意图；
图14为本发明实施例提供的又一种像素驱动电路的结构示意图；
图15为图14中所示像素驱动电路的驱动时序；
图16为本发明实施例提供的又一种像素驱动电路的驱动方法的流程示意图；
图17为图14中像素驱动电路中各晶体管在第一子阶段中的导通状态示意图；
图18为图14中像素驱动电路中各晶体管在第二子阶段中的导通状态示意图；
图19为图14中像素驱动电路中各晶体管在第五阶段中的导通状态示意图；
图20为图14中像素驱动电路中各晶体管在第六阶段中的导通状态示意图；
图21为本发明实施例提供的仿真效果图；
图22为本发明实施例提供的一种显示面板的结构示意图；
图23为本发明实施例提供的一种显示面板的局部剖面结构示意图；
图24为本发明实施例提供的又一种显示面板的局部剖面结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
图1为本发明实施提供的一种像素驱动电路的结构示意图。参照图1，该像素驱动电路，包括：第一初始化模块10、第一阈值补偿模块20、第一数据写入模块30、第一发光控制模块40和发光调节模块50。
第一初始化模块10包括第一初始化信号端ref1、第一初始化控制端rst和第一扫描信号端S1。第一初始化模块10电连接于第一节点n1和第二节点n2，第一初始化模块10用于提供第一初始化信号至第一节点n1，实现对第一节点n1的复位。第一阈值补偿模块20包括第一电源信号端VDD，第一阈值补偿模块20电连接于第一扫描信号端S1、第一节点n1和第三节点n3。第一阈值补偿模块20用于对第一节点n1的电位进行补偿。第一数据写入模块30包括第一数据信号端data1、第二扫描信号端S2、发光时长控制信号端sweep。第一数据写入模块30电连接于第二节点n2，第一数据写入模块30通过第二节点n2调节第一节点n1的电位。第一发光控制模块40包括第一发光控制信号端ctrl1，第一发光控制模块30电连接于第三节点n3和第四节点n4。发光调节模块50包括第二发光控制信号端ctrl2、第三扫描信号端S3、第二数据信号端data2、输出端OUT。发光调节模块50电连接第一电源信号端VDD和第四节点n4。发光调节模块50经输出端OUT输出驱动信号，以驱动与该输出端OUT电连接的发光元件发光。
此外，本发明实施例还提供了一种像素驱动电路的驱动方法，该方法可以采用图1所示像素驱动电路，图2为本发明实施例提供的一种像素驱动电路的驱动方法的流程示意图，具体的该方法包括：
S11、第一阶段，第一初始化模块将第一初始化信号端的第一初始化信号写入第一节点。
具体的，在第一阶段，第一初始化控制端rst输入的第一初始化控制信号控制第一初始化模块10将第一初始化信号端ref1的第一初始化信号写入第一节点n1，即第一节点电位n1＝ref1,实现第一节点n1的复位，可以避免上一帧画面显示时，第一节点n1残留的电位对像素驱动过程造成干扰。
S12、第二阶段，第一阈值补偿模块补偿第一节点的电位；第一初始化模块将第一初始化信号端的第一初始化信号写入第二节点。
在第二阶段，第一扫描信号端S1输入的第一扫描信号控制第一阈值补偿模块20导通，第一阈值补偿模块20对第一节点n1的电位进行补偿。此外，第一扫描信号端S1输入的第一扫描信号控制第一初始化模块10将第一初始化信号端ref1的第一初始化信号写入第二节点n2，即第二节点电位n2＝ref1,实现第二节点n2的复位。
S13、第三阶段，第一数据写入模块将第一数据信号端的第一数据信号写入第二节点。
在第三阶段，第二扫描信号端S2输入的第一扫描信号控制第一数据写入模块30将第一数据信号端data1的第一数据信号写入第二节点n2,即第二节点电位n2＝data1,由于第二节点n2的电位变化了data1-ref1，因此第一节点n1的电位也会随之变化data1-ref1。变化后第一节点n1的电位使第一电源信号端VDD与第三节点n3之间断开。
S14、第四阶段，发光调节模块将第二数据信号端的第二数据信号写入第四节点。
在第四阶段，第三扫描信号端S3输入的第三扫描信号控制发光调节模块50将第二数据信号端data2的第二数据信号写入第四节点n4。
S15、第五阶段，第一数据写入模块调节第一节点电位，以使第一电源信号端与第三节点之间断开，发光调节模块经输出端输出驱动信号。
在第五阶段，发光时长控制信号端sweep输入的发光时长控制信号发生变化，从而可以调节第一节点n1的电位，在该阶段内，虽然第一节点n1的电位在变化，但第一节点n1的电位仍然可以控制第一阈值补偿模块使第一电源信号端VDD与第三节点n3之间保持断开。第二发光控制信号端ctrl2输入的第二发光控制信号控制发光调节模块50导通，在该阶段时间内发光调节模块50经输出端OUT输出驱动信号，以驱动与该输出端OUT电连接的发光元件发光。第五阶段的时长即为与该输出端OUT电连接的发光元件的发光时长。
S16、第六阶段，第一发光控制模块导通，第一数据写入模块调节第一节点电位，以使第一电源信号端与第三节点之间导通，发光调节模块的输出端关断。
在第六阶段，第一发光控制信号端ctrl1输入的第二发光控制信号控制第一发光控制模块40导通。光时长控制信号端sweep输入的发光时长控制信号继续变化，以调节第一节点n1的电位。当发光时长控制信号变化至第一节点n1的电位控制第一阈值补偿模块使第一电源信号端与第三节点之间导通。由于第一发光控制模块40也导通，第四节点n4的电位n4＝VDD，发光调节模块50的输出端OUT关断，与该输出端OUT电连接的发光元件停止发光。
本发明实施可以通过为相同颜色的发光元件所电连接的像素驱动电路提供相同的第二数据信号，从而使相同颜色的发光元件在发光时受像素驱动电路驱动的驱动信号相同，保持色度的一致性，在此基础上，为实现相同颜色的各发光元件具有不同的发光亮度，可以通过发光时长控制信号以及第一数据信号控制发光调节模块的输出端输出驱动信号的时长。发光调节模块的输出端输出驱动信号的时长即为发光调节模块的输出端所电连接的发光元件的发光时长。发光元件的发光时长越长，发光时长与像素驱动电路的驱动周期的比值越大(像素驱动电路的驱动周期是指从第一阶段到第六阶段的总时间)，因此在人眼感知效果上，所能感受到的灰阶亮度就越大。因此本发明实施例可以调节发光调节模块的输出端输出驱动信号的时长，实现相同颜色的各发光元件的不同发光亮度需求，同时，还不会引起色度差异。
需要说明的是，本发明实施例对第一初始化模块、第一阈值补偿模块、第一数据写入模块、第一发光控制模块和发光调节模块的具体结构不作限定。在能够各模块在相应阶段对各节点电位的写入或补偿，实现为相同颜色的发光元件输出相同的驱动信号值，通过调整发光调节模块经输出端输出驱动信号的时长来控制受该像素电路驱动的发光元件的发光时长的前提下，像素驱动电路的各模块的具体结构可根据实际需要进行设计。
以下提供像素驱动电路中各模块的几种具体实现方式。图3为本发明实施提供的又一种像素驱动电路的结构示意图。
可选的，参见图3，第一初始化模块10包括第三晶体管M3、第四晶体管M4和第一电容C1。第三晶体管M3的第一极以及第四晶体管M4的第一极均与第一初始化信号端ref1电连接。第三晶体管M3的第二极和第一电容C1的第一极板电连接于第一节点n1。第三晶体管M3的栅极与第一初始化控制端rst电连接。第四晶体管M4的第二极与第一电容C1的第二极板电连接于第二节点n2。第四晶体管M4的栅极与第一扫描信号端S1电连接。
具体的，在第一阶段，第一初始化控制端rst输入的第一初始化控制信号控制第三晶体管M3导通，将第一初始化信号端ref1的第一初始化信号写入第一节点n1，对第一节点n1进行复位，第一节点n1的电位n1＝ref1。第一阶段对第一节点n1的复位，可以防止上一帧画面显示时，第一节点n1残留的电位对像素驱动过程造成干扰。在第二阶段时，第一扫描信号端S1输入的第一扫描信号控制第四晶体管M4导通，第四晶体管M4将第一初始化信号端ref1的第一初始化信号写入第二节点n2，第二节点的电位n2＝ref1，实现对第二节点n2的复位。
继续参见图3，可选的，第一阈值补偿模块20包括第一晶体管M1和第二晶体管M2。第一晶体管M1的第一极与第一电源信号端VDD电连接，第一晶体管M1的第二极与第二晶体管M2的第一极电连接于第三节点n3，第一晶体管M1的栅极与第二晶体管M2的第二极电连接于第一节点n1，第二晶体管M2的栅极与第一扫描信号端S1电连接。
具体的，在第二阶段，第一扫描信号端S1输入的第一扫描信号控制第二晶体管M2导通，第一电源信号端VDD可以向第一节点n1提供第一电源信号，第二晶体管M2导通，可以将第一晶体管M1的阈值电压Vth(M1)补偿至第一节点n1，以使第一晶体管M1产生的驱动电流与第一晶体管M1的阈值电压无关。此时第一节点n1的电位n1＝VDD-|Vth(M1)|。
参见图3，可选的，第一数据写入模块30包括第五晶体管M5和第二电容C2；第五晶体管M5的第一极与第一数据信号端data1电连接。第五晶体管M5的第二极以及第二电容C2的第一极板与第二节点n2电连接。第五晶体管M5的栅极与第二扫描信号端S2电连接。第二电容C2的第二极板与发光时长控制信号端sweep电连接。
具体的，在第三阶段，第二扫描信号端S2输入的第二扫描信号控制第五晶体管M5导通，将第一数据信号端data1的第一数据信号写入第二节点n2，即第二节点的电位n2＝data1。第一节点n1的电位受第二节点n2电位的变化而变化。直至第一节点n1的电位控制第一阈值补偿模块20将第一电源信号端VDD与第三节点n3之间断开。
参见图3，可选的，发光调节模块50包括第二数据写入模块51、驱动模块52、存储模块53和第二发光控制模块54。第二数据写入模块51包括第二数据信号端data2和第三扫描信号端S3；第二数据写入模块51电连接于第四节点n4。驱动模块52的输出端为发光调节模块50的输出端OUT，驱动模块52的控制端与第四节点n4电连接。第二发光控制模块54包括第二发光控制信号端ctrl2，第二发光控制模块54电连接于第一电源信号端VDD与驱动模块52的输入端之间。存储模块53电连接于第一电源信号端VDD与第四节点n4之间。
需要说明的是，本发明实施例对发光调节模块中的第二数据写入模块、驱动模块、存储模块和第二发光控制模块的具体电路结构不作限定，只要满足上述连接关系，第二数据写入模块能够实现将第二数据信号端的第二数据信号在第四阶段写入第四节点，驱动模块以及第二发光控制模块在第五阶段导通，以使发光调节模块经输出端输出驱动信号，驱动模块在第六阶段关闭，发光调节模块的输出端不在输出驱动信号即可。在此基础上可以根据实际设计需求，设置发光调节模块中各模块的具体电路结构。
在上述实施例的基础上，可选的，本发明实施例还提供了一种发光调节模块的具体电路结构。参见图3，可选的，驱动模块52包括第七晶体管M7，第二数据写入模块51包括第八晶体管M8，第二发光控制模块54包括第九晶体管M9，存储模块53包括第三电容C3。第七晶体管M7的第一极与第九晶体管M9的第二极电连接，第七晶体管M7的第二极为驱动模块52的输出端，第九晶体管M9的第一极与第一电源信号端VDD电连接，第九晶体管M9的栅极与第一发光控制信号端ctrl1电连接，第八晶体管M8的第一极与第二数据信号端电data2连接，第八晶体管M8的第二极以及第七晶体管M7的栅极均与第四节点n4电连接，第八晶体管M8的栅极与第三扫描信号端S3电连接，第三电容C3电连接于第一电源信号端VDD与第四节点n4之间。
参见图3，可选的，第一发光控制模块40包括第六晶体管M6。第六晶体管M6的栅极与第一发光控制信号端ctrl1电连接。第六晶体管M6的第一极与第三节点n3电连接。第六晶体管M6的第二极与第四节点n4电连接。
具体的，第一发光控制信号端ctrl1输入的第一发光控制信号控制第六晶体管M6导通。在该阶段，发光时长控制信号端sweep输入的发光时长控制信号会持续调节第一节点n1的电位，从而控制第一电源信号端VDD与第三节点n3导通，因此第一电源信号端VDD可通过第六晶体管M6写入到第四节点n4，从而控制发光调节模块的输出端不再输出驱动信号，即控制与该发光调节模块的输出端电连接的发光元件不再发光。
图4为图3中所示像素驱动电路的驱动时序。图3和图4中，示例性的均以像素驱动电路的各个晶体管为P型晶体管为例进行说明。在其他实施方式中，像素驱动电路的各个晶体管还可以均为N型晶体管，或者根据实际需求设置部分晶体管为N型，部分晶体管为P型。本发明实施例对像素驱动电路的各个晶体管的类型不作限定。
图5为本发明实施例提供的又一种像素驱动电路的驱动方法流程示意图。参见图3-图5，本发明提供的像素驱动电路的驱动方法包括：
S21、第一阶段，第一初始化控制端输入的第一初始化控制信号控制第三晶体管导通，将第一初始化信号端的第一初始化信号写入第一节点，第一节点的电位n1＝ref1。
第一阶段T1中像素驱动电路中各晶体管的导通状态参见图6，第一初始化控制端ref1输入的第一初始化控制信号为低电平，第三晶体管M3导通，第一节点的电位n1＝ref1，第一晶体管M1导通。
S22、第二阶段，第一扫描信号端输入的第一扫描信号控制第四晶体管以及第二晶体管导通，将第一初始化信号端的第一初始化信号写入第二节点，第二节点的电位n2＝ref1，并第一节点的电位调节至n1＝VDD-|Vth(M1)|。
第二阶段T2中像素驱动电路中各晶体管的导通状态参见图7，第一扫描信号端S1输入的第一扫描信号为低电平，第四晶体管M4以及第二晶体管M2导通。第四晶体管M4将第一初始化信号端ref1的第一初始化信号写入第二节点n2，n2＝ref1。由于第一晶体管M1以及第二晶体管M2均导通，所以第一电源信号端VDD为第一节点n1提供第一电源信号，由于第二晶体管M2阈值补偿作用，因此可以将第一晶体管M1的阈值电压Vth(M1)补偿至第一节点n1，以使第一晶体管M1产生的驱动电流与第一晶体管M1的阈值电压无关。此时第一节点n1的电位n1＝VDD-|Vth(M1)|。
S23、第三阶段，第二扫描信号端输入的第二扫描信号控制第五晶体管导通，将第一数据信号端的第一数据信号写入第二节点；第二节点的电位n2＝data1，并将第一节点电位抬高至VDD-|Vth(M1)|+(data1-ref1)，第一晶体管关闭。
第三阶段T3中像素驱动电路中各晶体管的导通状态参见图8，第二扫描信号端S2输入的第二扫描信号为低电平，控制第五晶体管M5导通，第五晶体管M5将第一数据信号端data1的第一数据信号写入第二节点n2，第二节点n2的电位n2＝data1。由于第二节点n2的电位变化了data1-ref1，因此第一电容C1将第一节点n1的电位抬高至VDD-|Vth(M1)|+(data1-ref1)，第一晶体管M1关闭。
S24、第四阶段，第三扫描信号端输入的第三扫描信号控制第八晶体管导通，将第二数据信号端的第二数据信号写入第四节点，第四节点的电位n4＝data2；第七晶体管导通。
第四阶段T4中像素驱动电路中各晶体管的导通状态参见图9，第三扫描信号端S3输入的第三扫描信号为低电平，控制第八晶体管M8导通。第八晶体管M8将第二数据信号端data2的第二数据信号写入第四节点n4，第四节点n4的电位n4＝data2；第七晶体管M7导通。与输出端OUT电连接的发光元件的驱动信号(驱动电流)的大小与第二数据信号有关。因此第二数据信号可以控制像素驱动电路驱动发光元件的驱动信号的大小。
S25、第五阶段，发光时长控制信号端输入的发光时长控制信号调节第一节点电位，以保持第一晶体管关闭，第二发光控制信号端输入的第二发光控制信号控制第九晶体管导通，第七晶体管的第二极输出驱动信号。
第五阶段T5中像素驱动电路中各晶体管的导通状态参见图10，发光时长控制信号端sweep输入的发光时长控制信号调节第一节点n1的电位。虽然在第五阶段，发光时长控制信号持续下降，引起第一节点n1的电位下降，但在第五阶段内，第一节点n1的电位一直大于VDD-|Vth(M1)|，因此第一晶体管M1仍然保持关闭。在该阶段内，第二发光控制信号端ctrl2输入的第二发光控制信号控制第九晶体管M9导通。由于此时第七晶体管M7也是导通状态，所以第七晶体管M7的第二极输出驱动信号，以从而可以驱动发光元件发光。在该阶段，驱动发光元件发光的驱动信号的大小与第二数据信号data2相关，因此可以控制所有相同颜色的发光元件对应连接的像素驱动电路，在该阶段输入的第二数据信号相同，以此实现所有相同颜色的发光元件的色度一致性。此外，发光元件的发光亮度可以通过第五阶段的时长控制，而第五阶段的时长受第一数据信号以及发光时长控制信号的调控，因此可以根据显示需求，通过第一数据信号以及发光时长控制信号控制各发光元件的发光亮度。
S26、第六阶段，第一发光控制信号端输入的第一发光控制信号控制第六晶体管导通；发光时长控制信号端输入的发光时长控制信号调节第一节点电位，以控制第一晶体管导通，第四节点的电位n4＝VDD；第七晶体管关闭。
第六阶段T6中像素驱动电路中各晶体管的导通状态参见图11，第一发光控制信号端ctrl1输入的第一发光控制信号控制第六晶体管M6导通；发光时长控制信号端sweep输入的发光时长控制信号调节第一节点电位，第一节点n1的电位下降至VDD-|Vth(M1)|时，第一晶体管M1处于导通临界状态，即在第六阶段开始时第一晶体管M1导通。第一电源信号端VDD通过第一晶体管M1、所述第六晶体管M6将第一电源信号写入第四节点n4，第四节点n4的电位n4＝VDD，第七晶体管M7关闭，第七晶体管M7的第二极停止输出驱动信号。
其中，ref1为第一初始化信号；VDD为第一电源信号；Vth(M1)为第一晶体管的阈值电压；data1为第一数据信号；data2为第二数据信号。为描述方便，本发明文中各信号端输入的信号和该信号端采用同一符号来表示，如第一初始化信号端以及第一初始化信号均用ref1来表示。
需要说明的是，由于第三阶段与第四阶段的驱动不冲突，即在第三阶段过程中也可以执行第四阶段的驱动，因此第三阶段也可以与第四阶段有交叠。图4示例性的，设置第三阶段T3执行结束后再执行第四阶段T4，并非对本发明实施例的限定。
图12为本发明实施例提供的又一种像素驱动电路的结构示意图，与图1所示像素驱动电路不同的是，第一发光控制信号端ctrl1和第二发光控制信号端ctrl2电连接，且受控于同一信号。设置第一发光控制信号端ctrl1和第二发光控制信号端ctrl2电连接，控于同一信号，可以减少像素驱动电路与外部驱动芯片电连接的导线的数量。
需要说明的是，参见图3，由于在第五阶段，第六晶体管是否导通不影响第七晶体管的第二极输出驱动信号，因此第六晶体管可以与第九晶体管的驱动时序相同，即第一发光控制信号端ctrl1接收的第一发光控制信号和第二发光控制信号端ctrl2接收的第二发光控制信号时序相同。当然也可以在第五阶段控制第六晶体管关闭，仅在第六阶段导通，此种情况第一发光控制信号端ctrl1接收的第一发光控制信号和第二发光控制信号端ctrl2接收的第二发光控制信号时序不同。若第六晶体管与第九晶体管的类型相同，例如第六晶体管与第九晶体管均为P型晶体管，也可以按照图12中的方案，设置第六晶体管的栅极与第九晶体管的栅极电连接，即第一发光控制信号端ctrl1和第二发光控制信号端ctrl2电连接，且连接同一控制信号线，受控于同一信号。
在上述实施例的基础上，可选的，第二晶体管、第三晶体管、第四晶体管、第五晶体管以及第六晶体管的有源层中的至少一个采用氧化铟镓锌材料。由于第二晶体管、第三晶体管、第四晶体管、第五晶体管以及第六晶体管均与电容连接，因此需要有较小的漏电流，以稳定保持电容极板上的电位。有源层采用氧化铟镓锌材料制作形成的晶体管，即IGZO晶体管，具有载流子迁移率高、响应快以及漏电流小的优势，因此，本发明实施例优选的设置第二晶体管、第三晶体管、第四晶体管、第五晶体管以及第六晶体管的有源层中的至少一个采用氧化铟镓锌材料。由于P型IGZO制备工艺难度大，现阶段无法实现大面积制备，所以本发明实施例可以设置上述第二晶体管、第三晶体管、第四晶体管、第五晶体管以及第六晶体管中但至少一个为N型IGZO晶体管。像素驱动电路中的其他晶体管例如可以是LTPS晶体管(低温多晶硅晶体管)。若设置第六晶体管为N型IGZO晶体管，第九晶体管为P型LTPS晶体管，那么第一发光控制信号端ctrl1和第二发光控制信号端ctrl2需要受控于不同信号。
图13为本发明实施例提供的又一种像素驱动电路的结构示意图，图13在图1所示像素驱动电路的基础上，设置发光调节模块还包括第四扫描信号端S4和第二初始化信号端ref2。
本发明实施例提供的像素驱动电路在第四阶段时，可以分为第一子阶段和第二子阶段。在第一子阶段，第三扫描信号端S3输入的第三扫描信号控制发光调节模块将第二初始化信号端ref2的第二初始化信号写入第四节点n4，第四节点n4的电位n4＝ref2，对第四节点n4进行复位。避免发光调节模块在后续进行发光时由于第四节点残留有上一帧的电位，导致对本次驱动过程造成干扰。在第二子阶段，第四扫描信号端S4输入的第四扫描信号控制发光调节模块将第二数据信号端data2向第四节点提供第二数据信号。
图14为本发明实施例提供的又一种像素驱动电路的结构示意图。本实施例提供一种发光调节模块的又一种具体结构，像素驱动电路中其他模块例如可以采用上述各实施例的电路结构，本发明实施例不对像素驱动电路中的第一初始化模块、第一阈值补偿模块、第一数据写入模块以及第一发光控制模块的结构进行限定，为方便描述驱动实现过程，图14示例性的采用将第一初始化模块、第一阈值补偿模块、第一数据写入模块以及第一发光控制模块的结构设置为与图3中相同。参见图14，本发明实施例提供的发光调节模块50包括第二数据写入模块511、驱动模块512、存储模块513、第二初始化模块514、第二阈值补偿模块515、第二发光控制模块516以及第三发光控制模块517。
第二初始化模块514包括第二初始化信号端ref2和第三扫描信号端S3；第二初始化模块514电连接于第四节点n4。存储模块513电连接于第一电源信号端VDD与第四节点n4之间。第二发光控制模块516包括第二发光控制信号端ctrl2，第二发光控制模块516分别与第一电源信号端VDD以及驱动模块512的输入端电连接。第二数据写入模块511包括第二数据信号端data2和第四扫描信号端S4，第二数据写入模块511还与驱动模块512的输入端电连接。驱动模块512的控制端与第四节点n4电连接，所驱动模块的输出端与第三发光控制模块517电连接。第三发光控制模块517还与第二发光控制信号端ctrl2电连接；第三发光控制模块517的输出端为发光调节模块50的输出端OUT。第二阈值补偿模块514电连接于驱动模块512的输出端与第四节点n4之间；第二阈值补偿模块514还与第四扫描信号端S4电连接。
具体的，相比于图1对应的像素驱动电路的驱动方法，本发明实施例提供的像素驱动电路在第四阶段包括第一子阶段和第二子阶段。在第四阶段的第一子阶段，第二初始化模块514用于在第三扫描信号端S3接收的第三扫描信号的控制下导通，将第二初始化信号端ref2的第二初始化信号写入第四节点n4。在第四阶段的第二子阶段，第二数据写入模块511用于在第四扫描信号端S4接收的第四扫描信号的控制下导通，第二阈值补偿模块515也在第四扫描信号端S4接收的第四扫描信号的控制下导通，完成对第四节点n4电位的数据写入以及补偿。在第五阶段，第二发光控制模块516以及第三发光控制模块517在第二发光控制信号端ctrl2接收的第二发光控制信号的控制下导通，驱动模块512通过第三发光控制模块517的输出端向发光元件输出驱动信号，以驱动发光元件发光。
可选的，第二数据写入模块511可以包括第十晶体管M10。驱动模块512包括第十一晶体管M11。第二初始化模块514包括第十二晶体管M12。第二阈值补偿模块515包括第十三晶体管M13。第二发光控制模块516包括第十四晶体管M14。第三发光控制模块517包括第十五晶体管M15。存储模块513包括第三电容C3。第十晶体管M10的第一极与第二数据信号端data2电连接，第十晶体管M10的第二极、第十一晶体管M11的第一极均与第十四晶体管M14的第二极电连接，所第十四晶体管M14的第一极与第一电源信号端VDD电连接，第十五晶体管M15的第一极以及第十三晶体管M13的第一极均与第十一晶体管M11的第二极电连接，第十三晶体管M13的第二极、第十二晶体管M12的第二极以及第十一晶体管M11的栅极均与第四节点n4电连接。第十二晶体管M12的第一极与第二初始信号端ref2电连接，第十二晶体管M12的栅极与第三扫描信号端S3电连接。第十三晶体管M13的栅极以及第十晶体管M10的栅极均与第四扫描信号端S4电连接。第十五晶体管M15的栅极与第十四晶体管M14的栅极均与第二发光控制信号端ctrl2电连接。第十五晶体管M15的第二极为第三发光控制模块517的输出端，第三电容C3电连接于第一电源信号端VDD与第四节点n4之间。
图15为图14中所示像素驱动电路的驱动时序。图14和图15中，示例性的均以像素驱动电路的各个晶体管为P型晶体管为例进行说明。
图16为本发明实施例提供的又一种像素驱动电路的驱动方法的流程示意图，参见图14-图16，本发明提供的像素驱动电路的驱动方法包括：
S31、第一阶段，第一初始化控制端输入的第一初始化控制信号控制第三晶体管导通，将第一初始化信号端的第一初始化信号写入第一节点，第一节点的电位n1＝ref1。
S32、第二阶段，第一扫描信号端输入的第一扫描信号控制第四晶体管以及第二晶体管导通，将第一初始化信号端的第一初始化信号写入第二节点，第二节点的电位n2＝ref1，并第一节点的电位调节至n1＝VDD-|Vth(M1)|。
S33、第三阶段，第二扫描信号端输入的第二扫描信号控制第五晶体管导通，将第一数据信号端的第一数据信号写入第二节点；第二节点的电位n2＝data1，并将第一节点电位抬高至VDD-|Vth(M1)|+(data1-ref1)，第一晶体管关闭。
以上各阶段与S21-S23驱动过程类似，再次不做赘述。
本实施例提供的确定方法中的第四阶段包括第一子阶段T4.1和第二子阶段T4.1。
S341、第一子阶段，第三扫描信号端输入的第三扫描信号控制第十二晶体管导通，将第二初始化信号端的第二初始化信号写入第四节点，第四节点的电位n4＝ref2；第十一晶体管导通。
第一子阶段T4.1中像素驱动电路中各晶体管的导通状态参见图17，第三扫描信号端S3输入的第三扫描信号为低电平，控制第十二晶体管M12导通。第十二晶体管M12将第二初始化信号端ref2的第二初始化信号写入第四节点n4，第四节点的电位n4＝ref2；第十一晶体管M11导通。
S342、第二子阶段，第四扫描信号端输入的第四扫描信号控制第十晶体管和第十三晶体管导通，第二数据信号端输入第二数据信号，将第四节点的电位调节为n4＝data2-|Vth(M11)|。
第二子阶段T4.1中像素驱动电路中各晶体管的导通状态参见图18，第四扫描信号端S4输入的第四扫描信号为低电平，控制第十晶体管M10和第十三晶体管M13导通。由于第十一晶体管M11也处于导通状态，因此第二数据信号端data2向第四节点n4提供第二数据信号。第十三晶体管M13将第十一晶体管11的阈值电压补偿值第四节点n4，使得第十一晶体管11产生的驱动电流与阈值电压无关，避免第十一晶体管M11的阈值电压波动对发光元件的发光亮度造成影响。第四节点n4的电位为n4＝data2-|Vth(M11)|。
S35、第五阶段，发光时长控制信号端输入的发光时长控制信号调节第一节点电位，以保持第一晶体管关闭；第二发光控制信号端输入的第二发光控制信号控制第十四晶体管以及第十五晶体管导通，第十一晶体管的第二极输出驱动信号。
第五阶段T5中像素驱动电路中各晶体管的导通状态参见图19，发光时长控制信号端sweep输入的发光时长控制信号调节第一节点n1的电位。虽然在第五阶段，发光时长控制信号持续下降，引起第一节点n1的电位下降，但在第五阶段内，第一节点n1的电位一直大于VDD-|Vth(M1)|，因此第一晶体管M1仍然保持关闭。在该阶段内，第二发光控制信号端ctrl2输入的第二发光控制信号控制第十四晶体管M14以及第十五晶体管M15导通，由于此时第十一晶体管M11也是导通状态，所以第十一晶体管M11的第二极输出驱动信号，以从而可以驱动发光元件发光。在该阶段，驱动发光元件发光的驱动信号的大小与第二数据信号data2相关，因此可以控制所有相同颜色的发光元件对应连接的像素驱动电路，在该阶段输入的第二数据信号相同，以此实现所有相同颜色的发光元件的色度一致性。此外，发光元件的发光亮度可以通过第五阶段的时长控制，而第五阶段的时长受第一数据信号以及发光时长控制信号的调控，因此可以根据显示需求，通过第一数据信号以及发光时长控制信号控制各发光元件的发光亮度。
S36、第六阶段，第一发光控制信号端输入的第一发光控制信号控制第六晶体管导通；发光时长控制信号端输入的发光时长控制信号调节第一节点电位，以控制第一晶体管导通，第四节点的电位n4＝VDD；第十一晶体管关闭。
第六阶段T6中像素驱动电路中各晶体管的导通状态参见图20，第一发光控制信号端ctrl1输入的第一发光控制信号控制第六晶体管M6导通；发光时长控制信号端sweep输入的发光时长控制信号调节第一节点电位，第一节点n1的电位下降至VDD-|Vth(M1)|时，第一晶体管M1处于导通临界状态，即在第六阶段开始时第一晶体管M1导通。第一电源信号端VDD通过第一晶体管M1、所述第六晶体管M6将第一电源信号写入第四节点n4，第四节点n4的电位n4＝VDD，第十一晶体管M11关闭，第十一晶体管M11的第二极停止输出驱动信号。因此与第十五晶体管M15的第二端电连接的发光元件停止发光。
其中，ref1为第一初始化信号；VDD为第一电源信号；Vth(M1)为第一晶体管的阈值电压；data1为第一数据信号；ref2为第二初始化信号；Vth(M11)为所述第十一晶体管阈值电压；data2为第二数据信号。
需要说明的是，由于第三阶段与第四阶段的第一子阶段以及第二子阶段的驱动不冲突，即在第三阶段过程中也可以执行第一子阶段以及第二子阶段的驱动，因此第三阶段也可以与第一子阶段以及第二子阶段有交叠。图15示例性的，设置第三阶段T3过程中执行第一子阶段T4.1以及第二子阶段T4.1，并非对本发明实施例的限定。
在上述实施例的基础上，可选的，第十二晶体管M12的有源层采用氧化铟镓锌材料。第十二晶体管M12的第二极与第三电容C3电连接，因此为稳定保持第三电容极板上的电位，第十二晶体管M12选择漏电流较小的IGZO晶体管，即采用有源层为氧化铟镓锌材料的晶体管。
需要说明的是，图14示例性的设置第一发光控制信号端ctrl1与第二发光控制信号端ctrl2电连接。若第六晶体管和第十四晶体管的类型相同，例如均为P型晶体管，可以设置第一发光控制信号端ctrl1与第二发光控制信号端ctrl2电连接，受控相同信号。若第六晶体管和第十四晶体管的类型不同，那么则需要设置第一发光控制信号端ctrl1与第二发光控制信号端ctrl2受控不同信号。
图21为本发明实施例提供的仿真效果图，经过仿真测试发现，在固定第二数据信data2不变的情况下，第一数据信号data1从0V到8V变化时，像素驱动电路输出的驱动信号(驱动电流I)基本保持不变。像素驱动电路输出驱动信号的时长t，随着第一数据信号data1变大而逐渐增加。因此，理论上验证了可以通过调节第一数据信号data1的大小来实现控制发光元件发光时长。
本发明实施例还提供一种显示面板，图22为本发明实施例提供的一种显示面板的结构示意图。如图22所示，包括发光元件60以及上述任一实施例所述的像素驱动电路100。其中，像素驱动电路100的输出端OUT与发光元件60的阳极电连接。发光元件60的阴极与第二电源信号端VSS电连接。因此本发明实施例提供的显示面板也具备上述实施例中所描述的有益效果，此处不再赘述。示例性的，显示面板可以包括手机、电脑以及智能可穿戴设备(例如，智能手表)等的显示屏，本发明实施例对此不作限定。
在上述实施例的基础上，若显示面板中的像素驱动电路100包括的各晶体管部分采用LTPS晶体管，部分采用IGZO晶体管，那么可以设置IGZO晶体管的有源层与LTPS晶体管的有源层在空间投影上有交叠。设置IGZO晶体管的有源层与LTPS晶体管的有源层在空间投影上有交叠可以节省显示面板中各个晶体管所占的空间，更利于提高显示面板的开口率以及分辨率。
图23为本发明实施例提供的一种显示面板的局部剖面结构示意图。参见图23，显示面板包括衬底200，以及位于衬底200上的至少一个LTPS晶体管70以及至少一个IGZO晶体管80。其中，LTPS晶体管70包括第一有源层71，IGZO晶体管80包括第二有源层81。第一有源层71在衬底200上的垂直投影与第二有源层81在衬底200上的垂直投影至少部分交叠。此外，LTPS晶体管70还包括第一栅极72、第一源极73和第一漏极74。IGZO晶体管80还包括第二栅极82、第二源极83和第二漏极84。显示面板还包括位于衬底200上的第一绝缘层201、第二绝缘层202、第三绝缘层203、第四绝缘层204和第五绝缘层205。第一有源层71位于第一绝缘层201背离衬底200的一侧。第二绝缘层202位于第一有源层71背离衬底200的一侧。第一栅极72位于第二绝缘层201背离衬底200的一侧。第三绝缘层203位于第一栅极72背离衬底200的一侧。第二有源层81位于第三绝缘层203离衬底200的一侧。第四绝缘层204位于第二有源层813离衬底200的一侧。第二栅极82位于第四绝缘层204背离衬底200的一侧。第五绝缘层205位于第二栅极82背离衬底200的一侧。第一源极73、第一漏极74、第二源极83和第二漏极84均位于第五绝缘层205上，第一源极73以及第一漏极74且通过过孔与第一有源层71连接，第二源极83和第二漏极84通过过孔与第二有源层81连接。
图24为本发明实施例提供的又一种显示面板的局部剖面结构示意图。参见图24，显示面板包括衬底200，以及位于衬底200上的至少一个LTPS晶体管70以及至少一个IGZO晶体管80。其中，LTPS晶体管70包括第一有源层71，IGZO晶体管80包括第二有源层81。第一有源层71在衬底200上的垂直投影与第二有源层81在衬底200上的垂直投影至少部分交叠。此外，LTPS晶体管70还包括第一栅极72、第一源极73和第一漏极74。IGZO晶体管80还包括第二栅极82、第二源极83和第二漏极84。显示面板还包括位于衬底200上的第一绝缘层201、第二绝缘层202、第三绝缘层203和第四绝缘层204。第一绝缘层201位于第一有源层71位于背离衬底200的一侧。第一栅极71位于第一有源层背离衬底200的一侧。第二绝缘层202位于第一栅极72背离衬底的一侧。第二栅极82位于第二绝缘层202背离衬底200的一侧。第三绝缘层203位于第二栅极82背离衬底200的一侧。第二有源层81位于第三绝缘层203背离衬底的一侧，第四绝缘层204位于第二有源层81背离衬底200的一侧。第一源极73、第一漏极74、第二源极83和第二漏极84均位于第五绝缘层205上，第一源极73以及第一漏极74且通过过孔与第一有源层71连接，第二源极83和第二漏极84通过过孔与第二有源层81连接。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整、相互结合和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (20)

1.一种像素驱动电路，其特征在于，包括：第一初始化模块、第一阈值补偿模块、第一数据写入模块、第一发光控制模块和发光调节模块；
所述第一初始化模块包括第一初始化信号端、第一初始化控制端、第一扫描信号端，所述第一初始化模块电连接于第一节点和第二节点，所述第一初始化模块提供第一初始化信号至第一节点；
所述第一阈值补偿模块包括第一电源信号端，所述第一阈值补偿模块电连接于所述第一扫描信号端、所述第一节点和第三节点，所述第一阈值补偿模块用于对所述第一节点电位进行补偿；
所述第一数据写入模块包括第一数据信号端、第二扫描信号端、发光时长控制信号端，所述第一数据写入模块电连接于所述第二节点，所述第一数据写入模块通过所述第二节点调节所述第一节点的电位；
所述第一发光控制模块包括第一发光控制信号端，所述第一发光控制模块电连接于所述第三节点和第四节点；
所述发光调节模块包括第二发光控制信号端、第三扫描信号端、第二数据信号端、输出端，所述发光调节模块电连接所述第一电源信号端和所述第四节点，所述发光调节模块经所述输出端输出驱动信号。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一阈值补偿模块包括第一晶体管和第二晶体管；
所述第一晶体管的第一极与所述第一电源信号端电连接；所述第一晶体管的第二极与所述第二晶体管的第一极电连接于所述第三节点；所述第一晶体管的栅极与所述第二晶体管的第二极电连接于所述第一节点；所述第二晶体管的栅极与所述第一扫描信号端电连接。
3.根据权利要求1所述的像素驱动电路，其特征在于，所述第一初始化模块包括第三晶体管、第四晶体管和第一电容；
所述第三晶体管的第一极以及所述第四晶体管的第一极均与所述第一初始化信号端电连接；所述第三晶体管的第二极和所述第一电容的第一极板电连接于所述第一节点；所述第三晶体管的栅极与所述第一初始化控制端电连接；所述第四晶体管的第二极与所述第一电容的第二极板电连接于所述第二节点；所述第四晶体管的栅极与所述第一扫描信号端电连接。
4.根据权利要求1所述的像素驱动电路，其特征在于，所述第一数据写入模块包括第五晶体管和第二电容；
所述第五晶体管的第一极与所述第一数据信号端电连接；所述第五晶体管的第二极以及所述第二电容的第一极板与所述第二节点电连接；所述第五晶体管的栅极与所述第二扫描信号端电连接；所述第二电容的第二极板与所述发光时长控制信号端电连接。
5.根据权利要求1所述的像素驱动电路，其特征在于，所述第一发光控制模块包括第六晶体管；所述第六晶体管的栅极与所述第一发光控制信号端电连接；所述第六晶体管的第一极与所述第三节点电连接；所述六晶体管的第二极与所述第四节点电连接。
6.根据权利要求1所述的像素驱动电路，其特征在于，所述发光调节模块包括第二数据写入模块、驱动模块、存储模块和第二发光控制模块；
所述第二数据写入模块包括所述第二数据信号端和所述第三扫描信号端；所述第二数据写入模块电连接于所述第四节点；
所述驱动模块的输出端为所述发光调节模块的输出端；所述驱动模块的控制端与所述第四节点电连接；
所述第二发光控制模块包括所述第二发光控制信号端；所述第二发光控制模块电连接于所述第一电源信号端与所述驱动模块的输入端之间；
所述存储模块电连接于所述第一电源信号端与所述第四节点之间。
7.根据权利要求6所述的像素驱动电路，其特征在于，所述驱动模块包括第七晶体管；所述第二数据写入模块包括第八晶体管；所述第二发光控制模块包括第九晶体管；所述存储模块包括第三电容；
所述第七晶体管的第一极与所述第九晶体管的第二极电连接；所述第七晶体管的第二极为所述驱动模块的输出端；所述第九晶体管的第一极与所述第一电源信号端电连接；所述第九晶体管的栅极与所述第一发光控制信号端电连接；所述第八晶体管的第一极与所述第二数据信号端电连接；所述第八晶体管的第二极以及所述第七晶体管的栅极均与所述第四节点电连接；所述第八晶体管的栅极与所述第三扫描信号端电连接；所述第三电容电连接于所述第一电源信号端与所述第四节点之间。
8.根据权利要求2所述的像素驱动电路，其特征在于，所述第二晶体管的有源层采用氧化铟镓锌材料。
9.根据权利要求3所述的像素驱动电路，其特征在于，所述第三晶体管的有源层以及所述第四晶体管的有源层中的至少一个采用氧化铟镓锌材料。
10.根据权利要求1所述的像素驱动电路，其特征在于，所述第一发光控制信号端和所述第二发光控制信号端电连接，且受控于同一信号。
11.根据权利要求1所述的像素驱动电路，其特征在于，所述发光调节模块还包括第四扫描信号端和第二初始化信号端。
12.根据权利要求11所述的像素驱动电路，所述发光调节模块包括第二数据写入模块、驱动模块、存储模块、第二初始化模块、第二阈值补偿模块、第二发光控制模块以及第三发光控制模块；
所述第二初始化模块包括所述第二初始化信号端和所述第三扫描信号端；所述第二初始化模块电连接于所述第四节点；
所述存储模块电连接于所述第一电源信号端与所述第四节点之间；
所述第二发光控制模块包括所述第二发光控制信号端；所述第二发光控制模块分别与所述第一电源信号端以及所述驱动模块的输入端电连接；
所述第二数据写入模块包括所述第二数据信号端和所述第四扫描信号端；所述第二数据写入模块还与所述驱动模块的输入端电连接；
所述驱动模块的控制端与所述第四节点电连接；所述驱动模块的所述输出端与所述第三发光控制模块电连接；
所述第三发光控制模块还与所述第二发光控制信号端电连接；所述第三发光控制模块的输出端为所述发光调节模块的输出端；
所述第二阈值补偿模块电连接于所述驱动模块的输出端与所述第四节点之间；所述第二阈值补偿模块还与所述第四扫描信号端电连接。
13.根据权利要求12所述的像素驱动电路，所述第二数据写入模块包括第十晶体管；所述驱动模块包括第十一晶体管；所述第二初始化模块包括第十二晶体管；所述第二阈值补偿模块包括第十三晶体管；所述第二发光控制模块包括第十四晶体管；所述第三发光控制模块包括第十五晶体管；所述存储模块包括第三电容；
所述第十晶体管的第一极与所述第二数据信号端电连接；所述第十晶体管的第二极、所述第十一晶体管的第一极均与所述第十四晶体管的第二极电连接；所述第十四晶体管的第一极与所述第一电源信号端电连接；所述第十五晶体管的第一极以及所述第十三晶体管的第一极均与所述第十一晶体管的第二极电连接；所述第十三晶体管的第二极、所述第十二晶体管的第二极以及所述第十一晶体管的栅极均与所述第四节点电连接；所述第十二晶体管的第一极与所述第二初始信号端电连接；所述第十二晶体管的栅极与第三扫描信号端电连接；所述第十三晶体管的栅极以及所述第十晶体管的栅极均与所述第四扫描信号端电连接；所述第十五晶体管的栅极与所述第十四晶体管的栅极均与第二发光控制信号端电连接；所述第十五晶体管的第二极为所述第三发光控制模块的输出端；所述第三电容电连接于所述第一电源信号端与所述第四节点之间。
14.根据权利要求13所述的像素驱动电路，所述第十二晶体管的有源层采用氧化铟镓锌材料。
15.一种显示面板，其特征在于，包括发光元件以及权利要求1所述的像素驱动电路；
其中，所述像素驱动电路的所述输出端与所述发光元件的阳极电连接。
16.一种像素驱动电路的驱动方法，其特征在于，采用权利要求1所述的像素驱动电路，包括：
第一阶段，所述第一初始化模块将所述第一初始化信号端的第一初始化信号写入所述第一节点；
第二阶段，所述第一阈值补偿模块补偿第一节点的电位；所述第一初始化模块将所述第一初始化信号端的第一初始化信号写入所述第二节点；
第三阶段，所述第一数据写入模块将所述第一数据信号端的第一数据信号写入所述第二节点；
第四阶段，所述发光调节模块将所述第二数据信号端的第二数据信号写入所述第四节点；
第五阶段，所述第一数据写入模块调节所述第一节点电位，以使所述第一电源信号端与所述第三节点之间断开，所述发光调节模块经所述输出端输出驱动信号；
第六阶段，所述第一发光控制模块导通，所述第一数据写入模块调节所述第一节点电位，以使所述第一电源信号端与所述第三节点之间导通，所述发光调节模块的输出端关断。
17.根据权利要求16所述的驱动方法，其特征在于，所述第一阈值补偿模块包括第一晶体管和第二晶体管；所述第一晶体管的第一极与所述第一电源信号端电连接；所述第一晶体管的第二极与所述第二晶体管的第一极电连接于所述第三节点；所述第一晶体管的栅极与所述第二晶体管的第二极电连接于所述第一节点；所述第二晶体管的栅极与所述第一扫描信号端电连接；
所述第一初始化模块包括第三晶体管、第四晶体管和第一电容；所述第三晶体管的第一极以及所述第四晶体管的第一极均与所述第一初始化信号端电连接；所述第三晶体管的第二极和所述第一电容的第一极板电连接于所述第一节点；所述第三晶体管的栅极与所述第一初始化控制端电连接；所述第四晶体管的第二极与所述第一电容的第二极板电连接于所述第二节点；所述第四晶体管的栅极与所述第一扫描信号端电连接；
所述第一数据写入模块包括第五晶体管和第二电容；所述第五晶体管的第一极与所述第一数据信号端电连接；所述第五晶体管的第二极以及所述第二电容的第一极板与所述第二节点电连接；所述第五晶体管的栅极与所述第二扫描信号端电连接；所述第二电容的第二极板与所述发光时长控制信号端电连接；
所述第一发光控制模块包括第六晶体管；所述第六晶体管的栅极与所述第一发光控制信号端电连接；所述第六晶体管的第一极与所述第三节点电连接；所述六晶体管的第二极与所述第四节点电连接；
所述发光调节模块包括第二数据写入模块、驱动模块、存储模块和第二发光控制模块；
所述第二数据写入模块包括所述第二数据信号端和所述第三扫描信号端；所述第二数据写入模块电连接于所述第四节点；
所述驱动模块的输出端为所述发光调节模块的输出端；所述驱动模块的控制端与所述第四节点电连接；
所述第二发光控制模块包括所述第二发光控制信号端；所述第二发光控制模块电连接于所述第一电源信号端与所述驱动模块的输入端之间；
所述存储模块电连接于所述第一电源信号端与所述第四节点之间；
所述驱动模块包括第七晶体管；所述第二数据写入模块包括第八晶体管；所述第二发光控制模块包括第九晶体管；所述存储模块包括第三电容；
所述第七晶体管的第一极与所述第九晶体管的第二极电连接；所述第七晶体管的第二极为所述驱动模块的输出端；所述第九晶体管的第一极与所述第一电源信号端电连接；所述第九晶体管的栅极与所述第一发光控制信号端电连接；所述第八晶体管的第一极与所述第二数据信号端电连接；所述第八晶体管的第二极以及所述第七晶体管的栅极均与所述第四节点电连接；所述第八晶体管的栅极与所述第三扫描信号端电连接；所述第三电容电连接于所述第一电源信号端与所述第四节点之间。
18.根据权利要求17所述的驱动方法，其特征在于，
所述第一阶段包括：所述第一初始化控制端输入的第一初始化控制信号控制所述第三晶体管导通，将所述第一初始化信号端的第一初始化信号写入所述第一节点，所述第一节点的电位n1＝ref1；
所述第二阶段包括：所述第一扫描信号端输入的第一扫描信号控制所述第四晶体管以及所述第二晶体管导通，将所述第一初始化信号端的第一初始化信号写入所述第二节点，所述第二节点的电位n2＝ref1，并所述第一节点的电位调节至n1＝VDD-|Vth(M1)|；
所述第三阶段包括：所述第二扫描信号端输入的第二扫描信号控制所述第五晶体管导通，将所述第一数据信号端的第一数据信号写入所述第二节点；所述第二节点的电位n2＝data1，并将所述第一节点电位抬高至VDD-|Vth(M1)|+(data1-ref1)，所述第一晶体管关闭；
所述第四阶段包括：所述第三扫描信号端输入的第三扫描信号控制所述第八晶体管导通，将所述第二数据信号端的第二数据信号写入所述第四节点，所述第四节点的电位n4＝data2；所述第七晶体管导通；
所述第五阶段包括：所述发光时长控制信号端输入的发光时长控制信号调节所述第一节点电位，以保持所述第一晶体管关闭，所述第二发光控制信号端输入的第二发光控制信号控制所述第九晶体管导通，所述第七晶体管的第二极输出驱动信号；
所述第六阶段包括：所述第一发光控制信号端输入的第一发光控制信号控制所述第六晶体管导通；所述发光时长控制信号端输入的所述发光时长控制信号调节所述第一节点电位，以控制所述第一晶体管导通，所述第四节点的电位n4＝VDD；所述第七晶体管关闭；
其中，ref1为第一初始化信号；VDD为第一电源信号；Vth(M1)为第一晶体管的阈值电压；data1为第一数据信号；data2为第二数据信号。
19.根据权利要求17所述的驱动方法，其特征在于，所述像素驱动电路的发光调节模块还包括第四扫描信号端和第二初始化信号端。
20.根据权利要求19所述的驱动方法，其特征在于，
所述发光调节模块包括第二数据写入模块、驱动模块、存储模块、第二初始化模块、第二阈值补偿模块、第二发光控制模块以及第三发光控制模块；
所述第二初始化模块包括所述第二初始化信号端和所述第三扫描信号端；所述第二初始化模块电连接于所述第四节点；
所述存储模块电连接于所述第一电源信号端与所述第四节点之间；
所述第二发光控制模块包括所述第二发光控制信号端；所述第二发光控制模块分别与所述第一电源信号端以及所述驱动模块的输入端电连接；
所述第二数据写入模块包括所述第二数据信号端和所述第四扫描信号端；所述第二数据写入模块还与所述驱动模块的输入端电连接；
所述驱动模块的控制端与所述第四节点电连接；所述驱动电路的所述输出端与所述第三发光控制模块电连接；
所述第三发光控制模块还与所述第二发光控制信号端电连接；所述第三发光控制模块的输出端为所述发光调节模块的输出端；
所述第二阈值补偿模块电连接于所述驱动模块的输出端与所述第四节点之间；所述第二阈值补偿模块还与所述第四扫描信号端电连接。
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