CN110506260B - 用于神经网络环境中的增强数据处理的方法、系统和介质 - Google Patents

用于神经网络环境中的增强数据处理的方法、系统和介质 Download PDF

Info

Publication number
CN110506260B
CN110506260B CN201880024892.5A CN201880024892A CN110506260B CN 110506260 B CN110506260 B CN 110506260B CN 201880024892 A CN201880024892 A CN 201880024892A CN 110506260 B CN110506260 B CN 110506260B
Authority
CN
China
Prior art keywords
data
computer
neural network
network environment
memory
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201880024892.5A
Other languages
English (en)
Other versions
CN110506260A (zh
Inventor
G·彼得
C·B·麦克布赖德
A·A·安巴德卡
K·D·塞多拉
B·博布罗夫
L·M·瓦尔
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Microsoft Technology Licensing LLC
Original Assignee
Microsoft Technology Licensing LLC
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Microsoft Technology Licensing LLC filed Critical Microsoft Technology Licensing LLC
Publication of CN110506260A publication Critical patent/CN110506260A/zh
Application granted granted Critical
Publication of CN110506260B publication Critical patent/CN110506260B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/3059Digital compression and data reduction techniques where the original information is represented by a subset or similar information, e.g. lossy compression
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/04Architecture, e.g. interconnection topology
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/16Handling requests for interconnection or transfer for access to memory bus
    • G06F13/1668Details of memory controller
    • G06F13/1673Details of memory controller using buffers
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/20Handling requests for interconnection or transfer for access to input/output bus
    • G06F13/28Handling requests for interconnection or transfer for access to input/output bus using burst mode transfer, e.g. direct memory access DMA, cycle steal
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/04Architecture, e.g. interconnection topology
    • G06N3/0464Convolutional networks [CNN, ConvNet]
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26Power supply means, e.g. regulation thereof
    • G06F1/32Means for saving power
    • G06F1/3203Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3206Monitoring of events, devices or parameters that trigger a change in power modality
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26Power supply means, e.g. regulation thereof
    • G06F1/32Means for saving power
    • G06F1/3203Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3234Power saving characterised by the action undertaken
    • G06F1/324Power saving characterised by the action undertaken by lowering clock frequency
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26Power supply means, e.g. regulation thereof
    • G06F1/32Means for saving power
    • G06F1/3203Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3234Power saving characterised by the action undertaken
    • G06F1/325Power saving in peripheral device
    • G06F1/3275Power saving in memory, e.g. RAM, cache
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26Power supply means, e.g. regulation thereof
    • G06F1/32Means for saving power
    • G06F1/3203Power management, i.e. event-based initiation of a power-saving mode
    • G06F1/3234Power saving characterised by the action undertaken
    • G06F1/3287Power saving characterised by the action undertaken by switching off individual functional units in the computer system
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/0207Addressing or allocation; Relocation with multidimensional access, e.g. row/column, matrix
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/0223User address space allocation, e.g. contiguous or non contiguous base addressing
    • G06F12/023Free address space management
    • G06F12/0238Memory management in non-volatile memory, e.g. resistive RAM or ferroelectric memory
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
    • G06F12/0802Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
    • G06F12/0862Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches with prefetch
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F12/00Accessing, addressing or allocating within memory systems or architectures
    • G06F12/02Addressing or allocation; Relocation
    • G06F12/08Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
    • G06F12/10Address translation
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/16Handling requests for interconnection or transfer for access to memory bus
    • G06F13/1668Details of memory controller
    • G06F13/1689Synchronisation and timing concerns
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F15/00Digital computers in general; Data processing equipment in general
    • G06F15/76Architectures of general purpose stored program computers
    • G06F15/80Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors
    • G06F15/8007Architectures of general purpose stored program computers comprising an array of processing units with common control, e.g. single instruction multiple data processors single instruction multiple data [SIMD] multiprocessors
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F17/00Digital computing or data processing equipment or methods, specially adapted for specific functions
    • G06F17/10Complex mathematical operations
    • G06F17/15Correlation function computation including computation of convolution operations
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601Interfaces specially adapted for storage systems
    • G06F3/0602Interfaces specially adapted for storage systems specifically adapted to achieve a particular effect
    • G06F3/0604Improving or facilitating administration, e.g. storage management
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601Interfaces specially adapted for storage systems
    • G06F3/0628Interfaces specially adapted for storage systems making use of a particular technique
    • G06F3/0629Configuration or reconfiguration of storage systems
    • G06F3/0631Configuration or reconfiguration of storage systems by allocating resources to storage systems
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/06Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
    • G06F3/0601Interfaces specially adapted for storage systems
    • G06F3/0668Interfaces specially adapted for storage systems adopting a particular infrastructure
    • G06F3/067Distributed or networked storage systems, e.g. storage area networks [SAN], network attached storage [NAS]
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/30003Arrangements for executing specific machine instructions
    • G06F9/30076Arrangements for executing specific machine instructions to perform miscellaneous control operations, e.g. NOP
    • G06F9/30087Synchronisation or serialisation instructions
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3836Instruction issuing, e.g. dynamic instruction scheduling or out of order instruction execution
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3854Instruction completion, e.g. retiring, committing or graduating
    • G06F9/3858Result writeback, i.e. updating the architectural state or memory
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30Arrangements for executing machine instructions, e.g. instruction decode
    • G06F9/38Concurrent instruction execution, e.g. pipeline or look ahead
    • G06F9/3885Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units
    • G06F9/3887Concurrent instruction execution, e.g. pipeline or look ahead using a plurality of independent parallel functional units controlled by a single instruction for multiple data lanes [SIMD]
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • G06F9/50Allocation of resources, e.g. of the central processing unit [CPU]
    • G06F9/5005Allocation of resources, e.g. of the central processing unit [CPU] to service a request
    • G06F9/5011Allocation of resources, e.g. of the central processing unit [CPU] to service a request the resources being hardware resources other than CPUs, Servers and Terminals
    • G06F9/5016Allocation of resources, e.g. of the central processing unit [CPU] to service a request the resources being hardware resources other than CPUs, Servers and Terminals the resource being the memory
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • G06F9/50Allocation of resources, e.g. of the central processing unit [CPU]
    • G06F9/5005Allocation of resources, e.g. of the central processing unit [CPU] to service a request
    • G06F9/5027Allocation of resources, e.g. of the central processing unit [CPU] to service a request the resource being a machine, e.g. CPUs, Servers, Terminals
    • G06F9/5033Allocation of resources, e.g. of the central processing unit [CPU] to service a request the resource being a machine, e.g. CPUs, Servers, Terminals considering data affinity
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • G06F9/50Allocation of resources, e.g. of the central processing unit [CPU]
    • G06F9/5061Partitioning or combining of resources
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • G06F9/50Allocation of resources, e.g. of the central processing unit [CPU]
    • G06F9/5061Partitioning or combining of resources
    • G06F9/5077Logical partitioning of resources; Management or configuration of virtualized resources
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/04Architecture, e.g. interconnection topology
    • G06N3/045Combinations of networks
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/04Architecture, e.g. interconnection topology
    • G06N3/049Temporal neural networks, e.g. delay elements, oscillating neurons or pulsed inputs
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/04Architecture, e.g. interconnection topology
    • G06N3/0495Quantised networks; Sparse networks; Compressed networks
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/06Physical realisation, i.e. hardware implementation of neural networks, neurons or parts of neurons
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/06Physical realisation, i.e. hardware implementation of neural networks, neurons or parts of neurons
    • G06N3/063Physical realisation, i.e. hardware implementation of neural networks, neurons or parts of neurons using electronic means
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/06Physical realisation, i.e. hardware implementation of neural networks, neurons or parts of neurons
    • G06N3/063Physical realisation, i.e. hardware implementation of neural networks, neurons or parts of neurons using electronic means
    • G06N3/065Analogue means
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/08Learning methods
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/02Neural networks
    • G06N3/10Interfaces, programming languages or software development kits, e.g. for simulating neural networks
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/3066Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction by means of a mask or a bit-map
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/3084Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction using adaptive string matching, e.g. the Lempel-Ziv method
    • H03M7/3088Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction using adaptive string matching, e.g. the Lempel-Ziv method employing the use of a dictionary, e.g. LZ78
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/46Conversion to or from run-length codes, i.e. by representing the number of consecutive digits, or groups of digits, of the same kind by a code word and a digit indicative of that kind
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/60General implementation details not specific to a particular type of compression
    • H03M7/6005Decoder aspects
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/60General implementation details not specific to a particular type of compression
    • H03M7/6011Encoder aspects
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/60General implementation details not specific to a particular type of compression
    • H03M7/6058Saving memory space in the encoder or decoder
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M7/00Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
    • H03M7/30Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
    • H03M7/70Type of the data to be coded, other than image and sound
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L45/00Routing or path finding of packets in data switching networks
    • H04L45/02Topology update or discovery
    • H04L45/04Interdomain routing, e.g. hierarchical routing
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L45/00Routing or path finding of packets in data switching networks
    • H04L45/50Routing or path finding of packets in data switching networks using label swapping, e.g. multi-protocol label switch [MPLS]
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L67/00Network arrangements or protocols for supporting network services or applications
    • H04L67/01Protocols
    • H04L67/02Protocols based on web technology, e.g. hypertext transfer protocol [HTTP]
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L67/00Network arrangements or protocols for supporting network services or applications
    • H04L67/01Protocols
    • H04L67/10Protocols in which an application is distributed across nodes in the network
    • H04L67/1001Protocols in which an application is distributed across nodes in the network for accessing one among a plurality of replicated servers
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2209/00Indexing scheme relating to G06F9/00
    • G06F2209/48Indexing scheme relating to G06F9/48
    • G06F2209/484Precedence
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2209/00Indexing scheme relating to G06F9/00
    • G06F2209/48Indexing scheme relating to G06F9/48
    • G06F2209/485Resource constraint
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2212/00Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
    • G06F2212/10Providing a specific technical effect
    • G06F2212/1016Performance improvement
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2212/00Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
    • G06F2212/60Details of cache memory
    • G06F2212/6026Prefetching based on access pattern detection, e.g. stride based prefetch
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2212/00Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
    • G06F2212/65Details of virtual memory and virtual address translation
    • G06F2212/657Virtual address space management
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • G06F9/466Transaction processing
    • G06F9/467Transactional memory
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/46Multiprogramming arrangements
    • G06F9/48Program initiating; Program switching, e.g. by interrupt
    • G06F9/4806Task transfer initiation or dispatching
    • G06F9/4843Task transfer initiation or dispatching by program, e.g. task dispatcher, supervisor, operating system
    • G06F9/4881Scheduling strategies for dispatcher, e.g. round robin, multi-level priority queues
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02DCLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D10/00Energy efficient computing, e.g. low power processors, power management or thermal management
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02DCLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
    • Y02D30/00Reducing energy consumption in communication networks
    • Y02D30/50Reducing energy consumption in communication networks in wire-line communication networks, e.g. low power modes or reduced link rate

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • Software Systems (AREA)
  • Computing Systems (AREA)
  • Biophysics (AREA)
  • Biomedical Technology (AREA)
  • Health & Medical Sciences (AREA)
  • Life Sciences & Earth Sciences (AREA)
  • Mathematical Physics (AREA)
  • Data Mining & Analysis (AREA)
  • Artificial Intelligence (AREA)
  • Evolutionary Computation (AREA)
  • Computational Linguistics (AREA)
  • Molecular Biology (AREA)
  • General Health & Medical Sciences (AREA)
  • Neurology (AREA)
  • Computer Hardware Design (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Human Computer Interaction (AREA)
  • Computational Mathematics (AREA)
  • Pure & Applied Mathematics (AREA)
  • Mathematical Optimization (AREA)
  • Mathematical Analysis (AREA)
  • Algebra (AREA)
  • Databases & Information Systems (AREA)
  • Advance Control (AREA)
  • Memory System (AREA)
  • Compression, Expansion, Code Conversion, And Decoders (AREA)
  • Image Processing (AREA)
  • Power Sources (AREA)
  • Bus Control (AREA)
  • Complex Calculations (AREA)
  • Multi Processors (AREA)
  • Image Input (AREA)
  • Information Retrieval, Db Structures And Fs Structures Therefor (AREA)
  • Memory System Of A Hierarchy Structure (AREA)

Abstract

神经网络(NN)和/或深度神经网络(DNN)的性能可能会受到被执行的操作的数量以及NN/DNN的各种存储器组件之间的数据管理的限制。通过在输入数据中插入选择的填充以对齐存储器中的输入数据,数据读取/写入可以被优化以供NN/DNN处理,从而增强NN/DNN的整体性能。操作上,操作控制器/迭代器可以生成一个或多个指令,其将所选填充插入数据中。可以使用输入数据的各种特性以及NN/DNN以及协作存储器组件的特性来计算数据填充。输出数据上的填充可用于支持NN/DNN的存储器组件和协作处理单元处的数据对齐。

Description

用于神经网络环境中的增强数据处理的方法、系统和介质
背景技术
在神经网络(NN)或深度神经网络(DNN)的示例性层上执行诸如卷积的一个或多个处理操作时,从存储器中读取数据会占用由NN/DNN消耗的大量时间和处理资源的花费。通常,NN/DNN的控制器组件的任务是执行迭代大量数据以便于应用特定操作所需的处理操作。通常,一些现有的NN和DNN在执行包括对NN/DNN的各种协作存储器组件(例如,行缓冲器)的存储器读和写的各种操作以及对层数据执行一种或多种操作以优化处理操作中,花费可避免的处理时间(例如,每秒浮点/定点操作(GFlops/s))和存储器空间(例如,每秒传送的字节数(GBytes/s))。
具体地,当前实践并未标识输入/数据的关键特征和/或未向NN或DNN的协作组件提供以下指令:关于如何最佳地管理/指导对协作NN或DNN存储器组件中的输入数据的读/写操作,以及利用存储器中的数据特征来避免性能问题。与NN或DNN中低效率的数据处理相关联的性能影响的部分原因是NN或DNN的神经处理组件之间的数据的低效处理。这种低效的数据管理和处理需要额外的、通常是可以避免的计算/神经处理器操作,这些操作会对整个NN/DNN性能产生负面影响。
更有利的NN/DNN将部署指令集合,该指令集合指导NN/DNN的协作控制器和处理组件,以基于指定的数据维度(例如数据的大小,如在逻辑数据模型中表示的数据的连续性等)来操作地在逻辑上映射输入数据,并在协作存储器组件中对齐逻辑映射的数据,这将在数据处理周期期间最小化对协作存储器组件的读取和写入次数。在操作上,新对齐的数据导致减少的存储器操作数目。存储器中数据的对齐可以使用各种数据填充技术来实现。
相对于这些考虑和其他考虑,提出了本文进行的公开。
发明内容
本文描述的技术提供了在示例性神经网络(NN)和/或深度神经网络(DNN)环境中使用的一个或多个硬件迭代器的虚拟化,其中用于对齐存储器组件中的数据的数据的物理填充允许数据的处理,该数据的处理提高整体性能并优化存储器管理。应当理解,本文描述的系统和方法适用于NN和/或DNN,并且因此,当提及NN时,其也应指DNN,反之亦然。
在示意性实现中,示例性DNN环境可以包括一个或多个处理块(例如计算机处理单元–CPU)、存储器控制器、行缓冲器、高带宽结构(例如本地或外部结构)(例如数据总线在示例性DNN模块和DNN环境的协作组件之间传递数据和/或数据元素)、操作控制器和DNN模块。在示意性实现中,示例性DNN模块可以包括示例性DNN状态控制器、描述符列表控制器(DLC)、dMA(DDMA)、DMA流激活(DSA)、操作控制器、加载控制器和存储控制器。
在示意性操作中,NN/DNN环境的操作控制器可以操作地处理大量数据,以便应用一个或多个所需的数据处理操作(例如卷积、最大池化、标量乘法/加法、求和、完全连接等)。在示意性操作中,参与的用户可以指定要处理的数据的维度,以及有关如何处理数据以供NN/DNN计算环境使用的配置。
在示意性实现中,由NN/DNN环境处理的数据可以表示为blob。通常,blob表示存储器中需要迭代的数据。每个blob可以维持由诸如宽度、高度、通道数、内核数和其他可用维度单位的各种维度来定义的逻辑映射形状。在示意性操作中,操作控制器可以遍历多维blob(例如由逻辑数据映射定义)或这种blob的较小N维切片,其中N是维数(例如对于表示具有宽度、高度和通道数的图像的3D blob-N=3)(例如使用一个或多个硬件或虚拟迭代器)。遍历的blob可以用一个或多个指令被传送到协作行缓冲区,以管理行缓冲区中遍历数据的读/写。
作为说明,诸如硬件和/或虚拟化硬件迭代器的操作控制器和/或迭代器可以生成一个或多个指令,以将blob的物理填充包括在一个或多个协作存储器组件中,blob的物理填充导致存储器组件中的blob数据块的对齐。blob数据的对齐可以通过以下各项来实现:将所选择的大小的数据位插入到blob中,以便在处理周期期间读取存储器块时,该存储器块中的第一位将用于读取操作。在示例性实现中,对于示例性卷积层,可以用选择的数量的位填充输入数据的行,使得输入数据的填充宽度的大小可以是存储器块大小的倍数。
填充还可以在跨blob的其他维度上实现,包括blob内核。示意性地,对于内核的示例性卷积操作,可以用选择的数量的位来填充内核通道,使得内核的通道的第一值被映射到协作存储器组件的存储器块中的第一值。
应当理解,尽管相对于执行DNN层的卷积操作的系统进行了描述,但是本文描述的发明构思可以使用其他类型的DNN数据处理/管理操作来应用。此外,上述主题还可以被实现为计算机控制的装置、计算机过程、计算系统、或者诸如计算机可读介质和/或专用芯片组的制品。通过阅读以下具体实施方式并查看相关附图,这些和各种其他特征将变得显而易见。提供本发明内容以简化形式介绍概念的选择,这些概念将在下面的具体实施方式中进一步描述。
应当理解,所描述的主题可以被实现为计算机控制的装置、计算机过程、计算系统或诸如计算机可读存储介质的制品。除许多其他益处之外,本文的技术相对于广泛的计算资源改进了效率。例如具有选择的插入数据填充的输出blob可以减少执行诸如面部识别、对象识别、图像生成等的许多复杂任务所需的多个计算周期。此外,可以通过引入更准确、更快地完成此类任务来实现改进的人机交互。另外,具有选择的插入数据填充的输出blob的使用可以减少网络业务、降低功耗和存储器的使用。也可以从本文公开的技术的实现中实现除本文提及的那些以外的其他技术效果。
本发明内容既不旨在标识所要求保护的主题的关键特征或必要特征,也不旨在将本发明内容用于限制所要求保护的主题的范围。此外,要求保护的主题不限于解决在本公开的任意部分中指出的任意或所有缺点的实现。
附图说明
参考附图描述具体实施方式。在附图中,附图标记的最左边的数字标识该附图标记首次出现的附图。不同附图中的相同附图标记表示相似或完全相同的项目。对多个项目中的单个项目的引用可以使用带有字母序列中的字母的附图标记来引用每个单个项目。对项目的通用引用可以使用不带字母序列的特定参考编号。
图1示出了根据本文所述的系统和方法的示例性神经网络计算环境的框图。
图2示出了利用有向行缓冲器的示例性神经网络环境的框图。
图3示出了根据本文描述的系统和方法的在示意性逻辑数据映射中表示的示例性输入数据的框图。
图4示出了在示意性逻辑数据映射中表示的示例性输入数据的框图,其示出了使用示意性n个滑动窗口来操作地跨越逻辑数据映射的一个或多个行。
图5示出了根据本文描述的系统和方法的在示意性逻辑数据映射中表示的示例性输入数据的框图,该框图示出了使用示意性n个滑动窗口来操作地跨越逻辑数据映射的一个或多个行,从而操作地允许数据填充作为处理增强。
图6示出了根据本文所述的系统和方法的在示意性逻辑数据映射中表示的示例性输入数据的框图,其示出了使用数据填充以允许最小化的存储器读取操作。
图7是根据本文所述的系统和方法的使用对齐的数据在示例性神经网络环境中的数据的处理的示意性过程的流程图。
图8示出了用于能够执行本文描述的方法的计算机的示意性计算机架构的附加细节。
图9示出了根据本文描述的系统和方法的示意性计算设备协作的其他细节。
具体实施方式
本文所述的以下具体实施方式技术提供了将在示例性神经网络(NN)和/或深度神经网络(DNN)环境中利用的一个或多个硬件迭代器的虚拟化,其中数据的物理填充以对齐存储器组件中的数据允许数据的处理,其改进整体性能并优化存储器管理。应当理解,本文描述的系统和方法适用于NN和/或DNN,并且因此,当参考NN时,其也应指DNN,反之亦然。
在示意性实现中,示例性DNN环境可以包括一个或多个处理块(例如计算机处理单元–CPU)、存储器控制器、行缓冲器、高带宽结构(例如本地或外部结构)(例如在示例性DNN模块和DNN环境的协作组件之间传递数据和/或数据元素的数据总线)、操作控制器和DNN模块。在示意性实现中,示例性DNN模块可以包括示例性DNN状态控制器、描述符列表控制器(DLC)、dMA(DDMA)、DMA流激活(DSA)、操作控制器、加载控制器和存储控制器。
在示意性操作中,NN/DNN环境的操作控制器可以可操作地处理大量数据,以便应用一个或多个所期望的数据处理操作(例如卷积、最大池化、标量乘法/加法、求和、完全连接等)。在示意性操作中,参与的用户可以指定要被处理的数据的维度、以及有关如何处理数据以供NN/DNN计算环境使用的配置。
在示意性实现中,要由NN/DNN环境处理的数据可以表示为blob。通常,blob表示存储器中需要被迭代的数据。每个blob可以维持由诸如宽度、高度、通道数、内核数和其他可用维度单位的各种维度定义的逻辑映射形状。在示意性操作中,操作控制器可以遍历多维blob(例如如逻辑数据映射所定义)或此类blob的较小N维切片,其中N是维数(例如对于表示具有宽度、高度和通道数的图像的3D blob-N=3)(例如使用一个或多个硬件或虚拟迭代器)。遍历的blob可以通过一个或多个指令传送到协作行缓冲区,以管理行缓冲区中遍历数据的读/写。
示意性地,诸如硬件和/或虚拟化硬件迭代器的操作控制器和/或迭代器可以生成一个或多个指令,以将blob的物理填充包括在一个或多个协作存储器组件中,该物理填充导致存储器组件中的blob的数据块的对齐。blob数据的对齐可以通过将选择的大小的数据位插入到blob中来实现,以便在处理周期期间读取存储器块时,该存储器块中的第一位将用于读取操作。在示意性实现中,对于示例性卷积层,可以用所选择的数量的位来填充输入数据的行,使得输入数据的填充宽度的大小可以是存储器块大小的倍数。
填充也可以跨包括blob内核的blob的其他维度而被实现。示意性地,对于内核的示例性卷积操作,可以用选择的数量的位来填充内核通道,使得内核的通道的第一值被映射到协作存储器组件的存储器块中的第一值。
神经网络背景:
在人工神经网络中,神经元是用于对大脑中的生物神经元进行建模的基本单位。人工神经元的模型可以包括输入向量与添加到偏置的权重向量的内积,其中非线性被应用。比较而言,在示例性DNN模块(例如图1的105)中,神经元被紧密映射到人造神经元。
作为说明,可以将DNN模块视为超标量处理器。在操作上,它可以将一个或多个指令分派到称为神经元的多个执行单元。执行单元可以是“同时分派同时完成”,其中每个执行单元都与所有其他执行单元同步。DNN模块可以被分类为SIMD(单指令流、多数据流)架构。
转到图1的示例性DNN环境100,DNN模块105具有存储器子系统,存储器子系统具有唯一L1和L2高速缓存结构。这些不是传统的高速缓存,而是专门为神经处理而设计的。为了方便起见,这些高速缓存结构采用了反映其预期目的的名称。举例来说,L2高速缓存器150可以示意性地保持具有以选择的频率(例如每秒十六个千兆位(16GBps))操作的高速专用接口的选择的存储容量(例如一兆字节(1MB))。L1高速缓存可以保持选择的存储容量(例如可以在内核数据和激活数据之间分开的8KB(8KB))。L1高速缓存可以被称为行缓冲区,并且L2高速缓存可以被称为BaSRAM。
DNN模块可以是仅回忆神经网络,并且以编程方式支持多种网络结构。可以在服务器场或数据中心中离线进行网络培训。DNN模块不执行任意训练功能。训练的结果是可以称为权重或内核的参数集合。这些参数表示可以应用于输入的变换函数,其中结果是分类或语义标记的输出。
在示意性操作中,DNN模块可以接受平面数据作为输入。输入不仅限于图像数据,只要呈现的数据是统一的平面格式,DNN就可以对其进行操作。
DNN模块对与神经网络的层相对应的层描述符的列表进行操作。示意性地,DNN模块可以将层描述符列表视为指令。这些描述符可以从存储器中预取到DNN模块中,并且按顺序执行。
通常,可以存在两种主要类别的层描述符:1)存储器到存储器移动描述符,以及2)操作描述符。存储器到存储器移动描述符可用于将数据从本地高速缓存移至主存储器/从主存储器移至本地高速缓存,以供操作描述符使用。存储器到存储器移动描述符遵循与操作描述符不同的执行管道。存储器到存储器移动描述符的目标管道可以是内部DMA引擎,而操作描述符的目标管道可以是神经元处理元素。操作描述符能够执行许多不同的层操作。
DNN的输出也是数据的blob。可以选择将输出流式传输到本地高速缓存或流式传输到主存储器。DNN模块可以在软件将允许的范围内尽早预取数据。软件可以通过使用隔离和设置描述符之间的依赖关系来控制预取。在满足依赖关系之前,将阻止具有依赖关系集合的描述符前进。
现在转到图1,示例性神经网络环境100可以包括各种协作组件,包括DNN模块105、高速缓存存储器125或150、低带宽结构110、桥组件115、高带宽结构120、SOC 130、PCIE“端点”135、Tensilica节点140、存储器控制器145、LPDDR4存储器105和输入数据源102。此外,如图所示,DNN模块105还可以包括多个组件,包括预取105(A)、DMA 105(B)、寄存器接口105(D)、加载/存储单元105(C)、层控制器105(D)、保存/恢复组件105(E)和神经元105(F)。在操作上,示例性DNN环境100可以根据所选择的规范来处理数据,其中DNN模块执行本文所述的一个或多个功能。
图2示出了示例性神经网络环境200,该神经网络环境200可操作用于采用有向行缓冲器220作为数据处理的一部分。如图所示,示例性神经网络环境200(在本文中也被称为计算设备或计算设备环境)包括一个或多个操作控制器235,操作控制器235与行缓冲器220协作以提供一个或多个指令用于数据处理。行缓冲器220可以操作以通过外部结构230和结构215从协作的外部存储器组件225接收数据,以及可以操作以从迭代器240(例如基于硬件和/或虚拟化的迭代器)接收数据。在操作上,行缓冲器220可以根据从一个或多个操作控制器235(在本文中也称为“协作控制器组件235”)接收的一个或多个指令,将计算出的移位插入数据并将位移动的数据写入行缓冲器220。此外,行缓冲器220可以与处理单元(例如神经元)协作以提供写入的位移动的数据以用于进一步处理。神经网络环境结构215可以是能够传递各种数据的数据总线。定向行缓冲器可以被认为是能够根据一个或多个接收到的指令来读取和写入数据和/或数据元素的存储器组件。
在示意性操作中,示例性神经网络环境200可以根据图7中描述的过程来操作性地处理数据。特定于图2中描述的组件,这些组件仅是示意性的,作为本领域普通技术人员之一将会理解,图6和图7中所描述的处理将由除图2中所示的组件之外的其他组件执行。
同样,如图2所示,示例性神经网络环境可以可选地包括一个或多个迭代器(例如基于硬件和/或虚拟化的迭代器)(如虚线所示),其可以示例性地操作以迭代输入数据(未示出)以供一个或多个神经元处理器205处理。本领域技术人员应理解,示例性一个或多个迭代器的这种可选包括仅是说明性的,因为本文公开的系统和方法描述的发明构思是可以在没有任意迭代器的情况下在运行的示例性神经网络环境200中进行操作。
图3示出了用于示例性输入数据的示例逻辑数据映射300。如图所示,数据305可以表示为具有一定维度340的数据(例如使得作为整体来看的数据维度可以定义数据量),包括信道计数310、高度315和宽度320。根据本文描述的系统和方法,数据305可以被分成部分并且准备通过协作n个神经元330来进行处理,以便可以将第一部分a传送给第一神经元,将第二部分b传送给第二神经元,依此类推,直到n个部分被传送给n个神经元。
在示意性操作中,可以基于由示例性神经网络环境(例如图2的200)的协作控制器组件提供的一个或多个指令,使用n个滑动窗口/内核325确定数据305的部分。进一步如图所示,输入数据部分a、b、c和d可以使用由示例性神经网络环境(例如图2的200)的协作操作控制器组件(235)提供的一个或多个初始化参数来被寻址到物理存储器335。
图4示出了示例性输入数据(未示出)的示例性逻辑数据图400。示例性逻辑数据图400包括第一行410(用对角线标记示出)和第二行420(以虚线示出)。每个图行可以包括多个滑动窗口(例如第一行410的430、440和450,第二行420为460、470和480)。另外,如图所示,逻辑数据图400示出了滑动窗口跨越输入数据的数据维度边界(例如跨越第一行410和第二行420)的能力。这种能力允许提高性能,因为更多数据可以被更高效地准备用于由协作的神经网络处理组件(例如图2的205)进行后续处理。
图5与图4相似,并且被呈现以描述本文描述的系统和方法的能力,以允许使用填充来进一步增强示例性神经网络环境(例如,图1的100和图2的200)的性能特征。如图所示,(未示出的示例性输入数据的)逻辑数据图500可以包括跨越一行或多行(例如510和520)的各种滑动窗口(530、540、550、560、570和580)。另外,逻辑数据图500还可以包括填充580。
在示例性操作中,在示例性神经网络环境(图1的100或图2的200)的运行时,可以动态添加填充580。图2的操作控制器235可以指定输入数据(例如blob)的、在图3中所示的每个维度340上将使用的填充量(例如使得共同采取的维度可以被认为是数据量),并且神经网络环境(例如迭代器控制器指令)可以操作地构造数据量,就好像填充物理存在于存储器中一样。默认值还可以由示例神经网络环境(例如迭代器控制器指令)在添加了填充的迭代器输出位置中生成。
图6是示例性存储器数据600的框图。如图6所示,存储器数据600可以包括具有不对齐的blob数据的示例性存储器布局605和具有利用数据填充的对齐的blob数据的示例性存储器布局625的框表示。如图所示,存储器布局605可以包括可以驻留在各种存储器行610、615和620上的各种存储器块675。示例性存储器块675可以具有选择的大小。在示例性实现中,如示例性存储器布局605中所示,每个存储器块集合以不同的灰色阴影表示。
类似地,存储器布局625可以包括可以驻留在各种存储器行630、635、640上的各种存储器块680。示例性存储器块680可以具有选择的大小。在示例性实现中,如示例性存储器布局625中所示,每个存储器块集合以不同的灰色阴影表示。
此外,如图6所示,示例性存储器布局625也可以包括具有填充值645、650、655和660的填充数据块。在示意性操作中,附加填充数据s的数据645、650、655和660可以用于对齐在存储器布局625中找到的数据元素,以使得该存储器块集合的读取可以包括给定的存储器块集合的所有数据元素。举例来说,如图6所示,看存储器布局605的第二行615,可以理解,需要三个不同的存储器读取来读取该行的数据元素。
具体地说,第一存储器块集合的数据元素的第一读取是以浅灰色被阴影显示,针对第二存储器块集合的第二读取是以深灰色被阴影显示,针对存储器块集合的第三读取由更深的灰色阴影指示。注意存储器布局625,在使用填充的数据元素645、650、655和660时,现在需要两次存储器读取以读取存储器布局625的第二行数据的数据元素。应当理解,布局605和625的可用数据元素是完全相同的,并且可用数据元素是能够被示例性神经网络环境处理的一个或多个数据元素。
图7是示意性过程700的流程图,该过程700利用填充的对齐输入数据来最小化NN/DNN环境中的存储器读取。如图所示,处理在框705处开始,在框705处,从神经网络计算环境的协作组件(例如操作控制器)接收一个或多个初始化参数,其中一个或多个初始化参数可以包括表示输入数据的维度的数据,然后,处理进行到框710,在框710处可以从操作控制器和/或迭代器接收一个或多个指令,该指令可以可操作地将选择的大小的数据填充插入到输入数据中。示意性地,输入数据可以表示由一个或多个处理层输出的数据,并且可以包括与一个或多个存储器组件的数据对齐。应当理解,在其中输入数据是处理层的输出的上下文中描述了该示意性处理,这种描述仅是示例性的,因为本文描述的发明构思考虑将填充插入到输入数据中,该填充不代表处理层的输出数据,使得输入数据不具有数据对齐。
然后,处理进行到框715,在框715处,将对齐的数据加载到协作存储器组件中,使得一个或多个存储器块的第一位用于存储器读取操作中。然后,在框720,将填充的数据传送到一个或多个协作处理单元以用于处理。此外,可以在框725处生成输出blob(例如逻辑数据映射),其也可以包含针对输出数据而生成的选择的填充,以便于适应用于后续处理层的对齐的输入数据维度。
然后在框735执行检查以确定是否存在要处理的附加的输入数据(即,作为迭代操作的一部分)。如果不存在附加的输入数据,则处理在框740处终止。但是,如果附加的输入数据需要附加的迭代操作,则处理然后返回框705并从那里继续进行。
图8所示的计算机架构800包括中央处理单元802(“CPU”),系统存储器804,该系统存储器804包括随机存取存储器806(“RAM”)和只读存储器(“ROM”)808,以及将存储器804耦合到CPU 802的系统总线810。基本输入/输出系统被存储在ROM 808中,基本输入/输出系统包含基本例程,该例程有助于诸如在启动期间在计算机架构800中的元件之间传递信息。计算机架构800还包括大容量存储设备812,用于存储操作系统814、其他数据以及一个或多个应用程序。
大容量存储设备812通过连接到总线810的大容量存储控制器(未示出)连接到CPU802。大容量存储设备812及其相关联的计算机可读介质为计算机架构800提供了非易失性存储。尽管本文包含的计算机可读介质的描述是指大容量存储设备,诸如固态驱动器、硬盘或CD-ROM驱动器,但本领域技术人员应理解,计算机可读介质介质可以是由计算机架构800访问的任意可用的计算机存储介质或通信介质。
通信介质包括计算机可读指令、数据结构、程序模块或诸如载波或其他传输机制的调制数据信号中的其他数据,并且包括任意传递介质。术语“调制数据信号”是指具有以将信息编码在信号中的方式来改变或设置其特征中的一个或多个的信号。作为示例而非限制,通信介质包括诸如有线网络或直接有线连接的有线介质,以及诸如声学、RF、红外和其他无线介质的无线介质。以上任意内容的组合也应包括在计算机可读介质的范围内。
作为示例而非限制,计算机存储介质可以包括以用于诸如计算机可读指令、数据结构、程序模块或其他数据的信息的存储的任意方法或技术实现的易失性和非易失性、可移除和不可移除介质。例如计算机介质包括但不限于RAM、ROM、EPROM、EEPROM、闪存或其他固态存储技术、CD-ROM、数字多功能磁盘(“DVD”)、HD-DVD、BLU-RAY或其他光学存储设备、盒式磁带、磁带、磁盘存储设备或其他磁性存储设备、或可用于存储所需信息并可由计算机架构800访问的任意其他介质。为了权利要求的目的,短语“计算机存储介质”、“计算机可读存储介质”及其变体本身并不包括波、信号和/或其他瞬时和/或无形通信介质。
根据各种技术,计算机架构800可以使用通过网络820和/或另一个网络(未示出)到远程计算机805的逻辑连接,在联网环境中操作。计算机架构800可以通过连接到总线810的网络接口单元816连接到网络820。应当理解,网络接口单元816也可以用于连接到其他类型的网络和远程计算机系统。计算机架构800还可以包括输入/输出控制器818,用于接收和处理来自多个其他设备的输入,多个其他设备包括物理传感器837,键盘,鼠标或电子笔(图8中未示出)。类似地,输入/输出控制器818可以将输出提供给显示屏,打印机或其他类型的输出设备(在图8中也未示出)。还应当理解,经由通过网络接口单元816到网络820的连接,计算架构可以使DNN模块105能够与计算环境100通信。
应当理解,本文描述的软件组件在被加载到CPU 802和/或DNN模块105中并执行时,可以将CPU 802和/或DNN模块105和整个计算机架构800从通用计算系统变换为被定制以促进本文介绍的功能的专用计算系统。CPU 802和/或DNN模块105可以由任意数量的晶体管或其他分立电路元件和/或芯片组构成,其可以单独或共同地假定任意数量的状态。更具体地说,响应于本文公开的软件模块中包含的可执行指令,CPU 802和/或DNN模块105可以作为有限状态机操作。这些计算机可执行指令可以通过指定CPU 802如何在状态之间转换来对CPU 802进行变换,从而对晶体管或构成CPU 802的其他分立的硬件元件进行变换。
对本文提出的软件模块进行编码还可以变换本文提出的计算机可读介质的物理结构。在本说明书的不同实现中,物理结构的特定变换可以取决于各种因素。这样的因素的示例可以包括但不限于用于实现计算机可读介质的技术、计算机可读介质被表征为主要存储装置还是辅助存储装置等。例如如果计算机可读介质被实现为基于半导体的存储器,则本文中公开的软件可以通过变换半导体存储器的物理状态而被编码在计算机可读介质上。例如软件可以变换构成半导体存储器的晶体管、电容器或其他分立电路元件的状态。该软件还可以变换这些组件的物理状态,以便在其上存储数据。
作为另一个示例,可以使用磁性或光学技术来实现本文公开的计算机可读介质。在这样的实现中,当软件在磁性或光学介质中被编码时,本文呈现的软件可以变换磁性或光学介质的物理状态。这些变换可以包括改变给定磁性介质内特定位置的磁性特征。这些变换还可以包括改变给定光学介质内特定位置的物理特征或特性,以改变那些位置的光学特性。在不脱离本说明书的范围和精神的情况下,物理介质的其他变换是可能的,其中提供前述示例仅是为了促进该讨论。
鉴于以上内容,应当理解,在计算机架构800中发生了许多类型的物理变换,以便存储和执行本文呈现的软件组件。还应当理解,计算机架构800可以包括其他类型的计算设备,包括手持计算机、嵌入式计算机系统、个人数字助理以及本领域技术人员已知的其他类型的计算设备。还可以想到,计算机架构800可能不包括图8所示的所有组件,可能包括在图8中未明确示出的其他组件,或者可以利用与图8所示的架构完全不同的架构。
如上所述的计算系统800可以被部署为计算机网络的一部分。通常,以上对计算环境的描述应用于部署在网络环境中的服务器计算机和客户端计算机两者。
图9示出了示例性的示意联网计算环境900,其中服务器经由通信网络与客户端计算机进行通信,其中可以采用本文所述的装置和方法。如图9所示,服务器905可以经由通信网络820(其可以是固定有线或无线LAN、WAN、内联网、外联网、对等网络、虚拟专用网络、因特网、蓝牙通信网络、专有低压通信网络或其他通信网络中的任一个或组合)与许多客户端计算环境互连,诸如平板计算机910、移动电话915、电话920、个人计算机801、个人数字助理925、智能手机手表/个人目标跟踪器(例如Apple Watch、三星、FitBit等)930和智能电话935。在通信网络是因特网的网络环境中820,例如服务器905可以是专用计算环境服务器,其可操作用于处理并经由多种已知协议(诸如超文本传输协议(HTTP),文件传输协议(FTP),简单对象访问协议(SOAP)或无线应用程序协议(WAP)中的任何一种传送去往和来自客户端计算环境801、910、915、920、925、930和935的数据。另外,联网计算环境900可以利用各种数据安全协议,诸如安全套接字层(SSL)或相当好的保密性(PGP)。客户端计算环境801、910、915、920、925、930和935中的每一个可以配备操作系统814,其可操作用于支持一个或多个计算应用程序或终端会话,诸如Web浏览器(未显示)或其他图形用户界面(未示出)或移动桌面环境(未示出)以获得对服务器计算环境905的访问。
服务器905可以被通信地耦合到其他计算环境(未示出),并接收有关参与用户的交互/资源网络的数据。在示意性操作中,用户(未示出)可以与在客户端计算环境上运行的计算应用进行交互以获得期望的数据和/或计算应用。数据和/或计算应用程序可以被存储在服务器计算环境905上,并在示例性通信网络820上通过客户端计算环境801、910、915、920、925、930和935传送给协作用户。参与用户(未示出)可以请求访问全部或部分容纳在服务器计算环境905上的特定数据和应用。这些数据可以在客户端计算环境801、910、915、920、925、930、935与服务器计算环境905之间被传送以用于处理和存储。服务器计算环境905可以托管用于数据和应用的生成、认证、加密以及通信的计算应用、过程和小应用程序,并且可以与其他服务器计算环境(未示出)、第三方服务提供商(未示出)网络附加存储(NAS)和存储区域网络(SAN)协作,以实现应用/数据交易。
示例条款
可以鉴于以下条款考虑本文提出的公开。
示例条款A,一种用于神经网络环境中的增强数据处理的系统,该系统包括至少一个处理器,与至少一个处理器通信的至少一个协作存储器组件,该至少一个协作存储器组件具有存储在其上的计算机可读指令,该计算机可读指令在由至少一个处理器执行时,使得至少一个处理器:从神经网络环境的协作控制器组件接收一个或多个初始化参数,该初始化参数包括表示将由神经网络环境处理的数据的维度的数据和表示要插入到数据中的选择的数据填充的大小的数据,选择的数据填充的大小被选择使得用于处理层的输入数据的宽度大小为至少一个存储器的存储器块大小的倍数,使用所插入的选择的数据填充生成对齐的输入数据集合,将对齐的数据集合加载到神经网络环境的至少一个协作存储器组件中,从神经网络环境的至少一个协作存储器组件中读取对齐的数据集合,并从所述至少一个存储器组件向所述神经网络环境的一个或多个处理组件传送对齐的数据集合以用于处理。
示例条款B,根据示例条款A所述的系统,还包括:从协作控制器组件接收一个或多个指令,以生成具有选择的插入数据填充的输出blob,该输出blob操作用于接收由神经网络环境的一个或多个处理组件处理的数据。
示例条款C,根据示例条款A和B所述的系统,其中计算机可读指令还使得至少一个处理器将由协作迭代器遍历的数据传送到至少一个协作存储器组件。
示例条款D,根据示例条款A至C所述的系统,其中计算机可读指令还使得至少一个处理器利用一个或多个滑动窗口遍历数据,该窗口操作用于选择数据量的一个或多个数据元素,作为被传送到一个或多个处理组件的一个或多个部分。
示例条款E,根据示例条款A至D所述的系统,其中计算机可读指令还使得至少一个处理器使用跨越加载数据的数据维度边界的一个或多个滑动窗口来遍历加载数据。
示例条款F,根据权利要求示例条款A至E所述的系统,其中所述计算机可读指令还使得所述至少一个处理器将一个或多个数据填充插入所述加载的数据中。
示例条款G,根据权利要求示例条款A至F所述的系统,其中计算机可读指令还使得协作迭代器生成具有选择的插入数据填充的输出blob。
示例条款H,一种计算机实现的方法,包括:从神经网络环境的协作控制器组件接收一个或多个初始化参数,所述初始化参数包括表示要由神经网络环境处理的数据的维度的数据,和表示要插入到所述输入数据中的选择的数据填充的所述大小的数据以及将选择的数据填充插入到所述输入数据中,选择的数据填充大小是被选择的选择的数据填充大小,使得用于处理层的输入数据的宽度大小是至少一个存储器的存储器块大小的倍数,使用所插入的选择的数据填充来生成对齐的输入数据集合,将对齐的数据集合加载到神经网络环境的至少一个协作存储器组件中,从神经网络环境的至少一个协作存储器组件中读取存储器块的第一位,并从至少一个存储器组件向神经网络环境的一个或多个处理组件传送对齐的数据集合以用于处理,并生成具有选择的插入数据填充的输出blob,其操作用于接收由神经网络环境中的一个或多个处理组件处理的数据。
示例条款I,根据示例条款H所述的计算机实现的方法,其中输入数据被存储在一个或多个存储行中的至少一个协作存储器组件中。
示例条款J,根据示例条款H和I所述的计算机实现的方法,其中滑动窗口操作用于跨越数据的数据维度边界。
示例条款K,根据示例条款H至J所述的计算机实现的方法,还包括:在由神经网络环境的一个或多个处理组件来处理对齐的输入数据时,选择要读取的至少一个存储器组件的存储器块的第一位。
示例条款L,根据示例条款H至K所述的计算机实现的方法,还包括:由迭代器处理输入数据的内核的一个或多个通道,以插入选择的数据填充以生成对齐的数据集合。
示例条款M,根据示例条款H至L所述的计算机实现的方法,还包括:通过迭代器来生成具有选择的数据填充的输出blob,该输出blob操作用于通过神经网络环境的一个或多个处理组件来接收处理的数据。
示例条款N,根据示例条款H至M所述的计算机实现的方法,进一步包括:迭代器对输入数据执行卷积运算。
示例条款O,根据示例条款H至N所述的计算机实现的方法,还包括将选择的数据填充大小计算为数据填充宽度大小,以用于插入到输入数据中,从而导致至少一个协作存储器组件的存储器块中每个存储器块行的最小读取次数。
示例条款P,一种计算机可读存储介质,具有在存储在其上的计算机可执行指令,该计算机可执行指令在由计算设备的一个或多个处理器执行时,使该计算设备的一个或多个处理器:从神经网络环境的协作控制器组件接收一个或多个初始化参数,所述初始化参数包括表示要由神经网络环境处理的数据的维度的数据,和表示要插入到输入数据中的选择的数据填充的大小的数据,选择的数据填充大小是选择的数据填充大小,选择的数据填充大小被选择以使得用于处理层的输入数据的宽度大小是至少一个存储器的存储器块大小的倍数,使用所插入的选择的数据填充来生成对齐的输入数据集合,并将对齐的数据集合加载到神经网络环境的至少一个协作存储器组件中,从神经网络环境的至少一个协作存储器组件中读取对齐的数据集合,并从至少一个存储器组件向神经网络环境的一个或多个处理组件传送对齐的数据集合以用于处理。
示例条款Q,根据示例条款P所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器生成其中具有选择的数据填充的输出blob。
示例条款R,根据示例条款P和Q所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器读取至少一个协作存储器组件的一个或多个存储器块的第一位表示对齐的数据集合。
示例条款S,根据示例条款P至R所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器将选择的数据填充大小计算为数据填充宽度大小,以用于插入到输入数据,导致至少一个协作存储器组件的存储器块中每个存储器块行的最小读取次数。
示例条款T,根据示例条款P至S所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器利用加载数据的逻辑数据映射遍历加载数据,加载数据的遍历包括:将一个或多个滑动窗口应用于逻辑数据映射,以将加载的数据的一部分与一个或多个物理存储器地址相关联。
示例条款U,根据示例条款P至T所述的计算机可读介质,其中至少一个协作存储器组件与物理传感器协作,物理传感器能够产生包括音频数据、视频数据、触觉感觉数据和其他数据的输入数据以用于由一个或多个协作处理单元进行后续处理。
示例条款V,根据示例条款P至U所述的计算机可读介质,其中一个或多个协作处理单元与一个或多个输出物理组件进行电子协作,所述输出物理组件操作用于接收处理的输入数据以用于人机交互,处理的输入数据包括音频数据、视频数据、触觉感觉数据和其他数据。
最后,尽管已经用特定于结构特征和/或方法动作的语言描述了各种技术,但是应该理解,所附表示中定义的主题不一定限于所描述的特定特征或动作。相反,将特定特征和动作公开为实现所要求保护的主题的示例形式。

Claims (22)

1.一种用于神经网络环境中的增强数据处理的系统,所述系统包括:
至少一个处理器;以及
至少一个协作存储器组件,与所述至少一个处理器通信,所述至少一个协作存储器组件具有选择的存储器块大小和存储在其上的计算机可读指令,所述计算机可读指令在由所述至少一个处理器执行时,使得所述至少一个处理器:
从所述神经网络环境的协作控制器组件接收一个或多个初始化参数,所述初始化参数包括要由所述神经网络环境处理的数据的维度和要插入到所述数据中的选择的数据填充的大小,选择的数据填充大小被选择,使得用于所述神经网络环境的处理层的输入数据的宽度大小为所述至少一个协作存储器组件的所述选择的存储器块大小的倍数;
使用所插入的所述选择的数据填充来生成对齐的数据集合;
将对齐的数据集合加载到所述至少一个协作存储器组件中;
从所述至少一个协作存储器组件中读取所述对齐的数据集合;以及
从所述至少一个协作存储器组件向所述神经网络环境的一个或多个处理组件传送所述对齐的数据集合以用于处理。
2.根据权利要求1所述的系统,还包括:从所述协作控制器组件接收一个或多个指令,以生成具有选择的插入数据填充的输出blob,所述输出blob操作用于接收由所述神经网络环境的所述一个或多个处理组件处理的数据。
3.根据权利要求1所述的系统,其中所述计算机可读指令还使得所述至少一个处理器将由协作迭代器遍历的数据传送到所述至少一个协作存储器组件。
4.根据权利要求3所述的系统,其中所述计算机可读指令还使得所述至少一个处理器利用一个或多个滑动窗口遍历所述数据,所述滑动窗口操作地用于选择数据量的一个或多个数据元素,作为被传送到所述一个或多个处理组件的一个或多个部分。
5.根据权利要求4所述的系统,其中所述计算机可读指令还使得所述至少一个处理器使用跨越加载数据的数据维度边界的一个或多个滑动窗口来遍历所述加载数据。
6.根据权利要求5所述的系统,其中所述计算机可读指令还使得所述至少一个处理器将一个或多个数据填充插入所述加载数据中。
7.根据权利要求6所述的系统,其中所述计算机可读指令还使得所述协作迭代器生成具有选择的插入数据填充的输出blob。
8.一种计算机实现的方法,包括:
从神经网络环境的协作控制器组件接收一个或多个初始化参数,所述初始化参数包括要由所述神经网络环境处理的数据的维度,和要插入到所述数据中的选择的数据填充的大小,所述选择的数据填充大小被选择,使得用于所述神经网络环境的处理层的输入数据的宽度大小是至少一个协作存储器组件的选择的存储器块大小的倍数;
使用所插入的所述选择的数据填充来生成对齐的数据集合;
将所述对齐的数据集合加载到所述至少一个协作存储器组件中;
从所述至少一个协作存储器组件中读取所述对齐的数据集合;以及
从所述至少一个协作存储器组件向所述神经网络环境的一个或多个处理组件传送所述对齐的数据集合以用于处理;以及
生成具有选择的插入数据填充的输出blob,所述输出blob操作用于接收由所述神经网络环境中的所述一个或多个处理组件处理的数据。
9.根据权利要求8所述的计算机实现的方法,其中所述输入数据被存储在一个或多个存储器行中的所述至少一个协作存储器组件中。
10.根据权利要求8所述的计算机实现的方法,其中滑动窗口操作地用于跨越所述数据的数据维度边界。
11.根据权利要求10所述的计算机实现的方法,还包括:
在由所述神经网络环境的所述一个或多个处理组件来处理所对齐的数据集合时,选择要读取的所述至少一个协作存储器组件的存储器块的第一位。
12.根据权利要求8所述的计算机实现的方法,还包括:
由迭代器处理所述输入数据的内核的一个或多个通道,以插入所述选择的数据填充以生成所述对齐的数据集合。
13.根据权利要求12所述的计算机实现的方法,还包括:
由迭代器生成具有所述选择的数据填充的输出blob,所述输出blob操作用于由所述神经网络环境的所述一个或多个处理组件接收处理的数据。
14.根据权利要求8所述的计算机实现的方法,还包括:
由迭代器对所述输入数据执行卷积运算。
15.根据权利要求8所述的计算机实现的方法,还包括:
将所述选择的数据填充大小计算为数据填充宽度大小,以用于插入到所述输入数据中,从而导致所述至少一个协作存储器组件的所述存储器块中每个存储器块行的最小读取次数。
16.一种计算机可读存储介质,具有存储在其上的计算机可执行指令,所述计算机可执行指令在由计算设备的一个或多个处理器执行时,使所述计算设备的所述一个或多个处理器:
从神经网络环境的协作控制器组件接收一个或多个初始化参数,所述初始化参数包括要由所述神经网络环境处理的数据的维度和要插入到所述数据中的选择的数据填充的大小,所述选择的数据填充大小被选择,使得用于所述神经网络环境的处理层的输入数据的宽度大小为至少一个协作存储器组件的选择的存储器块大小的倍数;
使用所插入的所述选择的数据填充来生成对齐的数据集合;
将所述对齐的数据集合加载到所述至少一个协作存储器组件中;
从所述至少一个协作存储器组件中读取所述对齐的数据集合;以及
从所述至少一个协作存储器组件向所述神经网络环境的一个或多个处理组件传送所述对齐的数据集合以用于处理。
17.根据权利要求16所述的计算机可读存储介质,其中所述指令还使所述计算设备的所述一个或多个处理器:
生成其内具有所述选择的数据填充的输出blob。
18.根据权利要求17所述的计算机可读存储介质,其中所述指令还使所述计算设备的所述一个或多个处理器:
读取所述至少一个协作存储器组件的、表示所述对齐的数据集合的一个或多个存储器块的第一位。
19.根据权利要求16所述的计算机可读存储介质,其中所述指令还使所述计算设备的所述一个或多个处理器:
将所述选择的数据填充大小计算为数据填充宽度大小,以用于插入到所述输入数据中,从而导致所述至少一个协作存储器组件的所述存储器块中每个存储器块行的最小读取次数。
20.根据权利要求16所述的计算机可读存储介质,其中所述指令还使所述计算设备的所述一个或多个处理器:
利用加载数据的逻辑数据映射来遍历所述加载数据,所述加载数据的所述遍历包括将一个或多个滑动窗口应用于所述逻辑数据映射,来将所述加载数据的一部分与一个或多个物理存储器地址进行关联。
21.根据权利要求16所述的计算机可读存储介质,其中所述至少一个协作存储器组件与物理传感器协作,所述物理传感器能够生成包括音频数据、视频数据、触觉感觉数据和其他数据的输入数据,以用于由一个或多个协作处理单元的后续处理。
22.根据权利要求21所述的计算机可读存储介质,其中所述一个或多个协作处理单元与一个或多个输出物理组件进行电子协作,所述一个或多个输出物理组件操作用于接收经处理的输入数据以用于人机交互,所述输入数据包括音频数据、视频数据、触觉感觉数据和其他数据。
CN201880024892.5A 2017-04-17 2018-04-06 用于神经网络环境中的增强数据处理的方法、系统和介质 Active CN110506260B (zh)

Applications Claiming Priority (5)

Application Number Priority Date Filing Date Title
US201762486432P 2017-04-17 2017-04-17
US62/486,432 2017-04-17
US15/813,952 2017-11-15
US15/813,952 US11182667B2 (en) 2017-04-17 2017-11-15 Minimizing memory reads and increasing performance by leveraging aligned blob data in a processing unit of a neural network environment
PCT/US2018/026356 WO2018194849A1 (en) 2017-04-17 2018-04-06 Minimizing memory reads and increasing performance by leveraging aligned blob data in a processing unit of a neural network environment

Publications (2)

Publication Number Publication Date
CN110506260A CN110506260A (zh) 2019-11-26
CN110506260B true CN110506260B (zh) 2023-09-22

Family

ID=63790158

Family Applications (17)

Application Number Title Priority Date Filing Date
CN202310865940.6A Pending CN116909984A (zh) 2017-04-17 2018-04-06 使用虚拟化数据迭代器对神经网络进行数据处理性能增强
CN201880025504.5A Active CN110520857B (zh) 2017-04-17 2018-04-06 使用虚拟化数据迭代器对神经网络进行数据处理性能增强
CN201880024892.5A Active CN110506260B (zh) 2017-04-17 2018-04-06 用于神经网络环境中的增强数据处理的方法、系统和介质
CN201880025227.8A Active CN110520870B (zh) 2017-04-17 2018-04-06 用于具有动态向量长度和码本大小的高吞吐量向量去量化的灵活硬件
CN201880025417.XA Active CN110520846B (zh) 2017-04-17 2018-04-06 对数据分区的动态排序
CN201880025415.0A Active CN110546628B (zh) 2017-04-17 2018-04-06 用有向线缓冲器最小化存储器读取提高神经网络环境性能
CN201880025244.1A Active CN110520856B (zh) 2017-04-17 2018-04-06 处理不邻近存储器作为邻近存储器以提高神经网络的性能
CN202310874704.0A Pending CN116909985A (zh) 2017-04-17 2018-04-06 对数据分区的动态排序
CN201880025503.0A Active CN110520853B (zh) 2017-04-17 2018-04-06 直接存储器访问的队列管理
CN201880025488.XA Active CN110537194B (zh) 2017-04-17 2018-04-13 被配置用于层和操作防护和依赖性管理的功率高效的深度神经网络处理器及方法
CN201880025126.0A Active CN110546610B (zh) 2017-04-17 2018-04-16 通过数据共享和分配增强人工智能/机器硬件的处理性能
CN202410312381.0A Pending CN118153639A (zh) 2017-04-17 2018-04-16 用于增强数据处理的系统、方法及神经网络处理器
CN201880025420.1A Active CN110520909B (zh) 2017-04-17 2018-04-16 使用激活数据的压缩和解压缩来减少存储器带宽利用率的神经网络处理器
CN201880025130.7A Active CN110546654B (zh) 2017-04-17 2018-04-16 通过构造接口的带宽控制来增强dnn模块的处理性能
CN201880025508.3A Active CN110582785B (zh) 2017-04-17 2018-04-16 配置用于执行层描述符列表的具有功率效率的深度神经网络模块
CN201880025480.3A Active CN110546611B (zh) 2017-04-17 2018-04-16 通过跳过处理操作来减少神经网络处理器中的功耗
CN201880025426.9A Active CN110678843B (zh) 2017-04-17 2018-04-16 在深度神经网络模块中动态划分工作负载以降低功率消耗

Family Applications Before (2)

Application Number Title Priority Date Filing Date
CN202310865940.6A Pending CN116909984A (zh) 2017-04-17 2018-04-06 使用虚拟化数据迭代器对神经网络进行数据处理性能增强
CN201880025504.5A Active CN110520857B (zh) 2017-04-17 2018-04-06 使用虚拟化数据迭代器对神经网络进行数据处理性能增强

Family Applications After (14)

Application Number Title Priority Date Filing Date
CN201880025227.8A Active CN110520870B (zh) 2017-04-17 2018-04-06 用于具有动态向量长度和码本大小的高吞吐量向量去量化的灵活硬件
CN201880025417.XA Active CN110520846B (zh) 2017-04-17 2018-04-06 对数据分区的动态排序
CN201880025415.0A Active CN110546628B (zh) 2017-04-17 2018-04-06 用有向线缓冲器最小化存储器读取提高神经网络环境性能
CN201880025244.1A Active CN110520856B (zh) 2017-04-17 2018-04-06 处理不邻近存储器作为邻近存储器以提高神经网络的性能
CN202310874704.0A Pending CN116909985A (zh) 2017-04-17 2018-04-06 对数据分区的动态排序
CN201880025503.0A Active CN110520853B (zh) 2017-04-17 2018-04-06 直接存储器访问的队列管理
CN201880025488.XA Active CN110537194B (zh) 2017-04-17 2018-04-13 被配置用于层和操作防护和依赖性管理的功率高效的深度神经网络处理器及方法
CN201880025126.0A Active CN110546610B (zh) 2017-04-17 2018-04-16 通过数据共享和分配增强人工智能/机器硬件的处理性能
CN202410312381.0A Pending CN118153639A (zh) 2017-04-17 2018-04-16 用于增强数据处理的系统、方法及神经网络处理器
CN201880025420.1A Active CN110520909B (zh) 2017-04-17 2018-04-16 使用激活数据的压缩和解压缩来减少存储器带宽利用率的神经网络处理器
CN201880025130.7A Active CN110546654B (zh) 2017-04-17 2018-04-16 通过构造接口的带宽控制来增强dnn模块的处理性能
CN201880025508.3A Active CN110582785B (zh) 2017-04-17 2018-04-16 配置用于执行层描述符列表的具有功率效率的深度神经网络模块
CN201880025480.3A Active CN110546611B (zh) 2017-04-17 2018-04-16 通过跳过处理操作来减少神经网络处理器中的功耗
CN201880025426.9A Active CN110678843B (zh) 2017-04-17 2018-04-16 在深度神经网络模块中动态划分工作负载以降低功率消耗

Country Status (19)

Country Link
US (20) US10795836B2 (zh)
EP (14) EP3612945B1 (zh)
JP (1) JP7004741B2 (zh)
KR (2) KR102663557B1 (zh)
CN (17) CN116909984A (zh)
AU (1) AU2018256212B2 (zh)
BR (1) BR112019021541A2 (zh)
CA (1) CA3056660A1 (zh)
CL (1) CL2019002864A1 (zh)
CO (1) CO2019011014A2 (zh)
IL (1) IL269888B (zh)
MX (2) MX2019012388A (zh)
MY (1) MY201868A (zh)
NZ (1) NZ756870A (zh)
PH (1) PH12019550191A1 (zh)
RU (1) RU2767447C2 (zh)
SG (1) SG11201909175XA (zh)
WO (15) WO2018194849A1 (zh)
ZA (1) ZA201905874B (zh)

Families Citing this family (118)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8515052B2 (en) 2007-12-17 2013-08-20 Wai Wu Parallel signal processing system and method
US10635969B2 (en) * 2016-10-14 2020-04-28 International Business Machines Corporation Core utilization optimization by dividing computational blocks across cores
US10248906B2 (en) * 2016-12-28 2019-04-02 Intel Corporation Neuromorphic circuits for storing and generating connectivity information
US10795836B2 (en) 2017-04-17 2020-10-06 Microsoft Technology Licensing, Llc Data processing performance enhancement for neural networks using a virtualized data iterator
US11164071B2 (en) * 2017-04-18 2021-11-02 Samsung Electronics Co., Ltd. Method and apparatus for reducing computational complexity of convolutional neural networks
EP3657340B1 (en) * 2017-05-23 2024-08-14 Shanghai Cambricon Information Technology Co., Ltd Processing method and accelerating device
CN110502330A (zh) * 2018-05-16 2019-11-26 上海寒武纪信息科技有限公司 处理器及处理方法
US11514355B2 (en) * 2017-06-28 2022-11-29 General Electric Company Flat representation of machine learning model
JP7074777B2 (ja) * 2017-11-20 2022-05-24 シャンハイ カンブリコン インフォメーション テクノロジー カンパニー リミテッド タスク並列処理方法、装置、システム、記憶媒体およびコンピュータ機器
EP3489865B1 (en) * 2017-11-22 2021-01-06 Commissariat à l'énergie atomique et aux énergies alternatives A stdp-based learning method for a network having dual accumulator neurons
US10747844B2 (en) * 2017-12-12 2020-08-18 Tesla, Inc. Systems and methods for converting a matrix input to a vectorized input for a matrix processor
US10970080B2 (en) 2018-02-08 2021-04-06 Marvell Asia Pte, Ltd. Systems and methods for programmable hardware architecture for machine learning
US12112175B1 (en) 2018-02-08 2024-10-08 Marvell Asia Pte Ltd Method and apparatus for performing machine learning operations in parallel on machine learning hardware
US11995448B1 (en) * 2018-02-08 2024-05-28 Marvell Asia Pte Ltd Method and apparatus for performing machine learning operations in parallel on machine learning hardware
KR20190097930A (ko) * 2018-02-13 2019-08-21 삼성전자주식회사 채널 별 메모리 용량을 조절하는 메모리 장치 및 이를 포함하는 메모리 시스템
US10948966B1 (en) * 2018-03-07 2021-03-16 Facebook, Inc. Systems and methods for optimizing power usage for systems within quality-of-service constraints
US11126362B2 (en) * 2018-03-14 2021-09-21 International Business Machines Corporation Migrating storage data
WO2019200545A1 (zh) * 2018-04-17 2019-10-24 深圳鲲云信息科技有限公司 网络模型的运行方法及相关产品
US10404276B1 (en) * 2018-04-27 2019-09-03 Nicira, Inc. Stable variable-length order-preserving encoding scheme
US20190340490A1 (en) * 2018-05-04 2019-11-07 Apple Inc. Systems and methods for assigning tasks in a neural network processor
US10997510B1 (en) 2018-05-22 2021-05-04 Marvell Asia Pte, Ltd. Architecture to support tanh and sigmoid operations for inference acceleration in machine learning
US11016801B1 (en) 2018-05-22 2021-05-25 Marvell Asia Pte, Ltd. Architecture to support color scheme-based synchronization for machine learning
US10360654B1 (en) * 2018-05-25 2019-07-23 Intel Corporation Software scoreboard information and synchronization
US10657087B2 (en) * 2018-05-31 2020-05-19 Toshiba Memory Corporation Method of out of order processing of scatter gather lists
US11561833B1 (en) * 2018-06-28 2023-01-24 Amazon Technologies, Inc. Allocation and placement of resources for network computation
WO2020032816A1 (en) * 2018-08-09 2020-02-13 Huawei Technologies Co., Ltd Device and method for compacting compressed and uncompressed data blocks
US12020146B2 (en) 2018-08-23 2024-06-25 Samsung Electronics Co., Ltd. Electronic device and operating method thereof of processing neural network model by using plurality of processors
WO2020042739A1 (zh) * 2018-08-28 2020-03-05 中科寒武纪科技股份有限公司 数据预处理方法、装置、计算机设备和存储介质
KR20200034499A (ko) * 2018-09-21 2020-03-31 삼성전자주식회사 메모리 장치와 통신하는 데이터 처리 장치 및 방법
US11295205B2 (en) * 2018-09-28 2022-04-05 Qualcomm Incorporated Neural processing unit (NPU) direct memory access (NDMA) memory bandwidth optimization
CN109359732B (zh) * 2018-09-30 2020-06-09 阿里巴巴集团控股有限公司 一种芯片及基于其的数据处理方法
WO2020073211A1 (zh) * 2018-10-09 2020-04-16 华为技术有限公司 运算加速器、处理方法及相关设备
US20200117981A1 (en) * 2018-10-11 2020-04-16 International Business Machines Corporation Data representation for dynamic precision in neural network cores
KR20200053886A (ko) 2018-11-09 2020-05-19 삼성전자주식회사 뉴럴 프로세싱 유닛, 뉴럴 프로세싱 시스템, 및 어플리케이션 시스템
CN109669774B (zh) * 2018-11-14 2020-12-08 新华三技术有限公司成都分公司 硬件资源的量化方法、编排方法、装置及网络设备
US11663001B2 (en) 2018-11-19 2023-05-30 Advanced Micro Devices, Inc. Family of lossy sparse load SIMD instructions
KR102107077B1 (ko) * 2018-11-20 2020-05-06 주식회사 아나패스 컨볼루션 신경망 추론에서 컨볼루션 연산을 수행하기 위한 라인 단위 메모리 관리 방법 및 그 추론 장치
US10990525B2 (en) * 2018-12-12 2021-04-27 Mipsology SAS Caching data in artificial neural network computations
US11342933B2 (en) * 2018-12-14 2022-05-24 Advanced Micro Devices, Inc. Lossy significance compression with lossy restoration
CN109657788A (zh) * 2018-12-18 2019-04-19 北京中科寒武纪科技有限公司 数据处理方法、装置及相关产品
CN109740735B (zh) * 2018-12-29 2020-12-29 百度在线网络技术(北京)有限公司 多神经网络输出方法及装置、服务器、计算机可读介质
CN109922007B (zh) * 2019-01-15 2022-04-01 西安仙农电子科技有限公司 一种基于卷积神经网络的负载均衡方法
CN111488114B (zh) * 2019-01-28 2021-12-21 北京灵汐科技有限公司 一种可重构的处理器架构及计算设备
US11687783B2 (en) * 2019-02-04 2023-06-27 International Business Machines Corporation L2-nonexpansive neural networks
US11521014B2 (en) 2019-02-04 2022-12-06 International Business Machines Corporation L2-nonexpansive neural networks
US11625554B2 (en) 2019-02-04 2023-04-11 International Business Machines Corporation L2-nonexpansive neural networks
US11036545B2 (en) * 2019-03-15 2021-06-15 Intel Corporation Graphics systems and methods for accelerating synchronization using fine grain dependency check and scheduling optimizations based on available shared memory space
CN111767078B (zh) * 2019-04-02 2024-08-06 上海寒武纪信息科技有限公司 数据运行方法、装置和相关产品
CN109992225B (zh) * 2019-04-04 2022-02-22 中科寒武纪科技股份有限公司 数据输出方法及相关装置
CN111782577B (zh) 2019-04-04 2023-03-24 安徽寒武纪信息科技有限公司 数据处理装置及方法以及相关产品
KR20200119164A (ko) * 2019-04-09 2020-10-19 한국전자통신연구원 정보 처리 장치 및 그것에 포함된 신경망 연산 장치의 동작 방법
US10504005B1 (en) * 2019-05-10 2019-12-10 Capital One Services, Llc Techniques to embed a data object into a multidimensional frame
KR20200129957A (ko) * 2019-05-10 2020-11-18 삼성전자주식회사 피처맵 데이터에 대한 압축을 수행하는 뉴럴 네트워크 프로세서 및 이를 포함하는 컴퓨팅 시스템
US11204745B2 (en) * 2019-05-23 2021-12-21 Xilinx, Inc. Dataflow graph programming environment for a heterogenous processing system
US11175898B2 (en) * 2019-05-31 2021-11-16 Apple Inc. Compiling code for a machine learning model for execution on a specialized processor
KR20200139909A (ko) 2019-06-05 2020-12-15 삼성전자주식회사 전자 장치 및 그의 연산 수행 방법
WO2020257517A1 (en) * 2019-06-18 2020-12-24 Qualcomm Incorporated Optimizing machine learning model performance
US11403097B2 (en) * 2019-06-26 2022-08-02 Intel Corporation Systems and methods to skip inconsequential matrix operations
US11461622B2 (en) * 2019-06-28 2022-10-04 Amazon Technologies, Inc. Dynamic code loading for multiple executions on a sequential processor
US11630770B2 (en) * 2019-07-11 2023-04-18 Meta Platforms Technologies, Llc Systems and methods for reading and writing sparse data in a neural network accelerator
US11816568B2 (en) * 2019-09-13 2023-11-14 Latent AI, Inc. Optimizing execution of a neural network based on operational performance parameters
US10915811B1 (en) 2019-09-18 2021-02-09 International Business Machines Corporation Intercalation cells for multi-task learning
US11475283B2 (en) * 2019-10-24 2022-10-18 Apple Inc. Multi dimensional convolution in neural network processor
KR20210053384A (ko) 2019-11-01 2021-05-12 삼성전자주식회사 스토리지 장치 및 스토리지 장치의 동작 방법
US11513799B2 (en) 2019-11-04 2022-11-29 Apple Inc. Chained buffers in neural network processor
KR20210065605A (ko) * 2019-11-27 2021-06-04 한국전자통신연구원 선인출 정보를 이용한 메모리 제어 방법 및 장치
CN111162792A (zh) * 2019-12-19 2020-05-15 深圳市航天泰瑞捷电子有限公司 一种电力负荷数据的压缩方法及装置
CN111091184B (zh) * 2019-12-19 2022-03-22 浪潮(北京)电子信息产业有限公司 一种深度神经网络的量化方法、装置、电子设备及介质
US11620516B2 (en) * 2019-12-23 2023-04-04 Arm Limited Specializing neural networks for heterogeneous systems
CN111178490B (zh) 2019-12-31 2021-08-24 北京百度网讯科技有限公司 数据输出方法、获取方法、装置和电子设备
CN111126589B (zh) * 2019-12-31 2022-05-20 昆仑芯(北京)科技有限公司 神经网络数据处理装置、方法和电子设备
KR102399197B1 (ko) 2020-01-17 2022-05-18 경희대학교 산학협력단 이상치 인지 근사적 코딩을 수행하는 전자 장치 그리고 그것의 동작 방법
US11023400B1 (en) 2020-01-20 2021-06-01 International Business Machines Corporation High performance DMA transfers in host bus adapters
US12072806B2 (en) * 2020-01-22 2024-08-27 Alibaba Group Holding Limited Compression and decompression module in a cache controller for reducing off-chip data traffic
KR102498066B1 (ko) * 2020-02-20 2023-02-10 한국과학기술원 딥러닝 강화학습 가속기
KR20210108749A (ko) 2020-02-26 2021-09-03 삼성전자주식회사 가속기, 가속기의 동작 방법 및 이를 포함한 가속기 시스템
CN111431539B (zh) * 2020-03-04 2023-12-08 嘉楠明芯(北京)科技有限公司 一种神经网络数据的压缩方法、装置及计算机可读存储介质
CN111290979B (zh) * 2020-03-23 2021-08-17 优刻得科技股份有限公司 数据传输方法、装置及系统
CN111522643B (zh) * 2020-04-22 2024-06-25 杭州迪普科技股份有限公司 基于fpga的多队列调度方法、装置、计算机设备及存储介质
CN113592082A (zh) * 2020-04-30 2021-11-02 意法半导体股份有限公司 用于从人工神经网络分配中间数据的设备和方法
KR20210136476A (ko) * 2020-05-07 2021-11-17 삼성전자주식회사 쿼드 트리 방법의 파라미터들을 이용하여 압축하는 장치 및 방법
US12015526B2 (en) * 2020-05-26 2024-06-18 Synopsys, Inc. Mixed-precision neural networks
GB202008299D0 (en) * 2020-06-02 2020-07-15 Imagination Tech Ltd Manipulation of data in a memory
JP2023530471A (ja) * 2020-06-18 2023-07-18 インターデジタル ヴイシー ホールディングス フランス,エスエーエス ディープニューラルネットワークを符号化/復号するためのシステム及び方法
CN111723053A (zh) * 2020-06-24 2020-09-29 北京航天数据股份有限公司 一种数据的压缩方法及装置、解压方法及装置
US11275701B2 (en) * 2020-06-24 2022-03-15 Qualcomm Incorporated Secure timer synchronization between function block and external SOC
US20220004399A1 (en) * 2020-07-03 2022-01-06 Mediatek Inc. Dynamic loading neural network inference at dram/on-bus sram/serial flash for power optimization
CN111884658A (zh) * 2020-07-09 2020-11-03 上海兆芯集成电路有限公司 数据解压缩方法、数据压缩方法及卷积运算装置
US11720404B2 (en) * 2020-07-16 2023-08-08 Samsung Electronics Co., Ltd. Systems and methods for arbitrating access to a shared resource
US20230267310A1 (en) * 2020-07-17 2023-08-24 Sony Group Corporation Neural network processing apparatus, information processing apparatus, information processing system, electronic device, neural network processing method, and program
CN111858058A (zh) * 2020-07-24 2020-10-30 成都成信高科信息技术有限公司 基于并行计算的sgd负载均衡方法、装置及存储介质
FR3113158B1 (fr) * 2020-08-03 2024-04-05 Commissariat Energie Atomique Architecture de calcul systolique pour la mise en œuvre de réseaux de neurones artificiels traitant plusieurs types de convolutions
JP6835285B1 (ja) * 2020-09-15 2021-02-24 富士電機株式会社 データ圧縮方法、データ圧縮装置、データ圧縮プログラム、データ伸長方法、データ伸長装置およびデータ伸長プログラム
US11470004B2 (en) * 2020-09-22 2022-10-11 Advanced Micro Devices, Inc. Graded throttling for network-on-chip traffic
US12113712B2 (en) 2020-09-25 2024-10-08 Advanced Micro Devices, Inc. Dynamic network-on-chip throttling
US20220121937A1 (en) * 2020-10-21 2022-04-21 Samsung Electronics Co., Ltd. System and method for dynamic quantization for deep neural network feature maps
JP2022094508A (ja) 2020-12-15 2022-06-27 富士通株式会社 演算処理装置、演算処理方法および演算処理プログラム
TWI745227B (zh) * 2021-02-01 2021-11-01 國立陽明交通大學 用於進行原始服務端與外地服務端之間的第三方認證的通訊系統及方法
KR102298766B1 (ko) * 2021-02-15 2021-09-07 주식회사 딥이티 타겟 디바이스에 대한 딥러닝 모델 변환 장치 및 방법
US20220383121A1 (en) * 2021-05-25 2022-12-01 Applied Materials, Inc. Dynamic activation sparsity in neural networks
US11256987B1 (en) * 2021-06-02 2022-02-22 SambaNova Systems, Inc. Memory efficient dropout, with reordering of dropout mask elements
JP2023018365A (ja) 2021-07-27 2023-02-08 富士通株式会社 情報処理プログラム、情報処理方法及び情報処理装置
US20230053575A1 (en) * 2021-08-18 2023-02-23 Cisco Technology, Inc. Partitioning and placement of models
US20230079975A1 (en) * 2021-09-10 2023-03-16 Arm Limited Power management for system-on-chip
US12112200B2 (en) 2021-09-13 2024-10-08 International Business Machines Corporation Pipeline parallel computing using extended memory
WO2023075564A1 (ko) * 2021-11-01 2023-05-04 엘지전자 주식회사 피쳐 부호화/복호화 방법, 장치 및 비트스트림을 저장한 기록 매체
KR102700292B1 (ko) * 2021-11-26 2024-08-29 건국대학교 산학협력단 신경망 가속기의 통신 특성을 동적으로 재구성하는 프로세서 장치, 및 그의 구동 방법
EP4191476A1 (en) * 2021-12-01 2023-06-07 Nokia Technologies Oy Machine learning accelerator
US11816364B2 (en) * 2022-01-13 2023-11-14 Microsoft Technology Licensing, Llc Performance evaluation of an application based on detecting degradation caused by other computing processes
CN114466082B (zh) * 2022-01-29 2024-01-09 上海阵量智能科技有限公司 数据压缩、数据解压方法、系统及人工智能ai芯片
US11720252B1 (en) * 2022-03-04 2023-08-08 Microsoft Technology Licensing, Llc Method and apparatus for compressing and decompressing sparse data sets
US20230350678A1 (en) * 2022-04-28 2023-11-02 Qualcomm Incorporated Instruction Set Architecture for Neural Network Quantization and Packing
WO2023250093A1 (en) * 2022-06-22 2023-12-28 Brainchip, Inc. Method and system for implementing temporal convolution in spatiotemporal neural networks
KR20240002346A (ko) * 2022-06-29 2024-01-05 삼성전자주식회사 Ai 부호화/복호화를 이용하여 영상을 처리하는 전자 장치 및 그 제어 방법
KR20240007495A (ko) * 2022-07-08 2024-01-16 리벨리온 주식회사 뉴럴 코어, 이를 포함하는 뉴럴 프로세싱 장치 및 뉴럴 프로세싱 장치의 데이터 로드 방법
CN115309349B (zh) * 2022-10-12 2023-01-20 深圳鲲云信息科技有限公司 深度学习的稀疏数据存储方法、计算机设备和存储介质
US11983128B1 (en) * 2022-12-16 2024-05-14 Amazon Technologies, Inc. Multidimensional and multiblock tensorized direct memory access descriptors
US12132502B1 (en) * 2023-10-09 2024-10-29 Qualcomm Incorporated Packet-based universal bit-field masking coding using configurable sparsity information

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1797371A (zh) * 2004-12-27 2006-07-05 英特尔公司 用于基于填充缓冲器命中来预取的装置和方法
CN101715575A (zh) * 2006-12-06 2010-05-26 弗森多系统公司(dba弗森-艾奥) 采用数据管道管理数据的装置、系统和方法
CN105264779A (zh) * 2013-01-22 2016-01-20 阿尔特拉公司 使用simd指令的数据压缩和解压
CN105765484A (zh) * 2013-12-23 2016-07-13 英特尔公司 输入输出数据对齐

Family Cites Families (191)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4298954A (en) 1979-04-30 1981-11-03 International Business Machines Corporation Alternating data buffers when one buffer is empty and another buffer is variably full of data
JPH0642237B2 (ja) 1983-12-28 1994-06-01 株式会社日立製作所 並列処理装置
US5056015A (en) * 1988-03-23 1991-10-08 Du Pont Pixel Systems Limited Architectures for serial or parallel loading of writable control store
EP0340901A3 (en) * 1988-03-23 1992-12-30 Du Pont Pixel Systems Limited Access system for dual port memory
EP0334624A3 (en) * 1988-03-23 1993-03-31 Du Pont Pixel Systems Limited Microcoded computer system
JP2703010B2 (ja) 1988-12-23 1998-01-26 株式会社日立製作所 ニユーラルネツト信号処理プロセツサ
US5369773A (en) 1991-04-26 1994-11-29 Adaptive Solutions, Inc. Neural network using virtual-zero
US5357597A (en) * 1991-06-24 1994-10-18 International Business Machines Corporation Convolutional expert neural system (ConExNS)
US5487153A (en) 1991-08-30 1996-01-23 Adaptive Solutions, Inc. Neural network sequencer and interface apparatus
WO1993014459A1 (en) 1992-01-17 1993-07-22 Caelum Research Corporation Modular parallel processing system
JPH06195322A (ja) 1992-10-29 1994-07-15 Hitachi Ltd 汎用型ニューロコンピュータとして用いられる情報処理装置
JP2938711B2 (ja) 1993-05-10 1999-08-25 松下電器産業株式会社 並列計算機
US5859990A (en) 1995-12-29 1999-01-12 Intel Corporation System for transferring data segments from a first storage device to a second storage device using an alignment stage including even and odd temporary devices
US5933654A (en) 1996-09-24 1999-08-03 Allen-Bradley Company, Llc Dynamic buffer fracturing by a DMA controller
US6006325A (en) * 1996-12-19 1999-12-21 Institute For The Development Of Emerging Architectures, L.L.C. Method and apparatus for instruction and data serialization in a computer processor
US6547364B2 (en) * 1997-07-12 2003-04-15 Silverbrook Research Pty Ltd Printing cartridge with an integrated circuit device
KR100258355B1 (ko) * 1997-12-26 2000-06-01 김영환 8 비트 병렬 셀 단위 인터리버
US6307867B1 (en) 1998-05-14 2001-10-23 Telefonaktiebolaget Lm Ericsson (Publ) Data transmission over a communications link with variable transmission rates
US6654761B2 (en) * 1998-07-29 2003-11-25 Inxight Software, Inc. Controlling which part of data defining a node-link structure is in memory
JP2000059227A (ja) 1998-08-07 2000-02-25 Matsushita Electric Ind Co Ltd 符号化/復号化装置、及び符号化/復号化方法
JP2000261416A (ja) * 1999-03-09 2000-09-22 Nec Eng Ltd 二重化データ転送回路
US6785239B1 (en) 1999-06-01 2004-08-31 Cisco Technology, Inc. Reducing delays in a communication network using a re-fragmentation pipeline
JP2001188767A (ja) 1999-12-28 2001-07-10 Fuji Xerox Co Ltd ニューラルネットワーク演算装置及びニューラルネットワークの演算方法
US6424737B1 (en) 2000-01-24 2002-07-23 Sony Corporation Method and apparatus of compressing images using localized radon transforms
US6988154B2 (en) * 2000-03-10 2006-01-17 Arc International Memory interface and method of interfacing between functional entities
GB2382898B (en) 2000-12-29 2005-06-29 Zarlink Semiconductor Ltd A method of managing data
JP2002259939A (ja) * 2001-03-05 2002-09-13 Kitakiyuushiyuu Techno Center:Kk 連想メモリーベースコンピュータ
US6990079B2 (en) 2001-06-08 2006-01-24 International Business Machines Corporation Optimizing fragment sizes in frame relay networks
US7012893B2 (en) 2001-06-12 2006-03-14 Smartpackets, Inc. Adaptive control of data packet size in networks
US7106968B2 (en) 2001-07-06 2006-09-12 Optix Networks Inc. Combined SONET/SDH and OTN architecture
US6954744B2 (en) * 2001-08-29 2005-10-11 Honeywell International, Inc. Combinatorial approach for supervised neural network learning
US6836767B2 (en) 2001-10-03 2004-12-28 International Business Machines Corporation Pipelined hardware implementation of a neural network circuit
US6961719B1 (en) * 2002-01-07 2005-11-01 The United States Of America As Represented By The Administrator Of The National Aeronautics And Space Administration Hybrid neural network and support vector machine method for optimization
US7245627B2 (en) 2002-04-23 2007-07-17 Mellanox Technologies Ltd. Sharing a network interface card among multiple hosts
US7539608B1 (en) 2002-05-10 2009-05-26 Oracle International Corporation Techniques for determining effects on system performance of a memory management parameter
US7020207B1 (en) * 2002-12-02 2006-03-28 Hitachi, Ltd. Video error concealment mechanism for block based video decompression
US7444637B2 (en) 2003-02-18 2008-10-28 Microsoft Corporation Systems and methods for scheduling coprocessor resources in a computing system
US7137021B2 (en) * 2003-05-15 2006-11-14 International Business Machines Corporation Power saving in FPU with gated power based on opcodes and data
GB0313986D0 (en) * 2003-06-17 2003-07-23 Zarlink Semiconductor Inc Data memory extension for use in double buffered TDM switches
EP1701244B1 (en) 2003-12-09 2015-04-01 Panasonic Corporation Electronic device, control method thereof, host device, and control method thereof
US20050125797A1 (en) * 2003-12-09 2005-06-09 International Business Machines Corporation Resource management for a system-on-chip (SoC)
US7480640B1 (en) * 2003-12-16 2009-01-20 Quantum Leap Research, Inc. Automated method and system for generating models from data
US7376853B2 (en) 2004-03-15 2008-05-20 Canon Kabushiki Kaisha Network apparatus, method for controlling the same, and program for the same
US7284075B2 (en) 2004-03-23 2007-10-16 Intel Corporation Inbound packet placement in host memory
US7644239B2 (en) * 2004-05-03 2010-01-05 Microsoft Corporation Non-volatile memory cache performance improvement
US9143393B1 (en) * 2004-05-25 2015-09-22 Red Lambda, Inc. System, method and apparatus for classifying digital data
US20050289253A1 (en) * 2004-06-24 2005-12-29 Edirisooriya Samantha J Apparatus and method for a multi-function direct memory access core
US7363397B2 (en) 2004-08-26 2008-04-22 International Business Machines Corporation System and method for DMA controller with multi-dimensional line-walking functionality
US20060050693A1 (en) * 2004-09-03 2006-03-09 James Bury Building data packets for an advanced switching fabric
US20060100997A1 (en) * 2004-10-27 2006-05-11 Wall Gary C Data caching
US8190796B2 (en) * 2004-11-02 2012-05-29 Standard Microsystems Corporation Hardware supported peripheral component memory alignment method
CN1790918A (zh) 2004-12-17 2006-06-21 中国科学院半导体研究所 基于虚拟信源和神经网络的无损数据压缩方法
EP1701249A1 (en) * 2005-03-11 2006-09-13 Interuniversitair Microelektronica Centrum Vzw Ultra low power ASIP (Application-Domain specific Instruction-set Processor) microcomputer
US7793040B2 (en) * 2005-06-01 2010-09-07 Microsoft Corporation Content addressable memory architecture
US7747070B2 (en) * 2005-08-31 2010-06-29 Microsoft Corporation Training convolutional neural networks on graphics processing units
CN101401100B (zh) * 2006-03-14 2012-10-10 国际商业机器公司 通过确定输入数据中的模式进行数据挖掘
JP2009532954A (ja) * 2006-03-31 2009-09-10 クゥアルコム・インコーポレイテッド 高速メディアアクセス制御に関するメモリ管理
US9542642B2 (en) 2006-04-06 2017-01-10 Samuel F. Wood Packet data neural network system and method
US7764710B1 (en) * 2006-04-25 2010-07-27 Altera Corporation Method and apparatus for processing communication protocol frame input
US7620784B2 (en) * 2006-06-09 2009-11-17 Microsoft Corporation High speed nonvolatile memory device using parallel writing among a plurality of interfaces
US8718065B2 (en) 2006-08-15 2014-05-06 Broadcom Corporation Transmission using multiple physical interface
US7496707B2 (en) 2006-08-22 2009-02-24 International Business Machines Corporation Dynamically scalable queues for performance driven PCI express memory traffic
US20080091868A1 (en) * 2006-10-17 2008-04-17 Shay Mizrachi Method and System for Delayed Completion Coalescing
US8249171B2 (en) 2006-11-10 2012-08-21 Texas Instruments Incorporated MPEG-2 transport stream packet synchronizer
US20080168013A1 (en) * 2006-12-05 2008-07-10 Paul Cadaret Scalable pattern recognition system
WO2008067676A1 (en) 2006-12-08 2008-06-12 Medhat Moussa Architecture, system and method for artificial neural network implementation
CN101221541B (zh) * 2007-01-09 2011-04-20 张立军 用于soc的可编程通信控制器
US7620749B2 (en) * 2007-01-10 2009-11-17 International Business Machines Corporation Descriptor prefetch mechanism for high latency and out of order DMA device
US8190834B2 (en) 2007-06-15 2012-05-29 Emc Corporation Process for contiguously streaming data from a content addressed storage system
JP5184824B2 (ja) * 2007-06-15 2013-04-17 キヤノン株式会社 演算処理装置及び方法
US7822951B2 (en) 2007-08-01 2010-10-26 Advanced Micro Devices, Inc. System and method of load-store forwarding
US8200992B2 (en) * 2007-09-24 2012-06-12 Cognitive Electronics, Inc. Parallel processing computer systems with reduced power consumption and methods for providing the same
CN101183873B (zh) 2007-12-11 2011-09-28 广州中珩电子科技有限公司 一种基于bp神经网络的嵌入式系统数据压缩解压缩方法
US8244953B1 (en) 2007-12-18 2012-08-14 Emc Corporation System and method for faster data retrieval from tape media
US8244721B2 (en) * 2008-02-13 2012-08-14 Microsoft Corporation Using related users data to enhance web search
US7730244B1 (en) * 2008-03-27 2010-06-01 Xilinx, Inc. Translation of commands in an interconnection of an embedded processor block core in an integrated circuit
US8201166B2 (en) * 2008-04-30 2012-06-12 Hewlett-Packard Development Company, L.P. Virtualization platform configured with virtual connect control
GB0811057D0 (en) 2008-06-17 2008-07-23 Univ Ulster Artificial neural network architecture
US8566515B2 (en) * 2009-01-12 2013-10-22 Maxim Integrated Products, Inc. Memory subsystem
US20100180100A1 (en) 2009-01-13 2010-07-15 Mavrix Technology, Inc. Matrix microprocessor and method of operation
US8392687B2 (en) * 2009-01-21 2013-03-05 Micron Technology, Inc. Solid state memory formatting
JP5458629B2 (ja) * 2009-03-31 2014-04-02 ブラザー工業株式会社 ノード装置、ノード処理プログラム及び検索方法
US20100257174A1 (en) 2009-04-02 2010-10-07 Matthew Dino Minuti Method for data compression utilizing pattern-analysis and matching means such as neural networks
US20100281192A1 (en) 2009-04-30 2010-11-04 Novafora, Inc. Apparatus and method for transferring data within a data processing system
EP2259214B1 (en) 2009-06-04 2013-02-27 Honda Research Institute Europe GmbH Implementing a neural associative memory based on non-linear learning of discrete synapses
JP5608738B2 (ja) * 2009-06-26 2014-10-15 インテル・コーポレーション 無制限トランザクショナルメモリ(utm)システムの最適化
US8442927B2 (en) 2009-07-30 2013-05-14 Nec Laboratories America, Inc. Dynamically configurable, multi-ported co-processor for convolutional neural networks
US8316194B2 (en) * 2009-12-15 2012-11-20 Intel Corporation Mechanisms to accelerate transactions using buffered stores
US20110153877A1 (en) * 2009-12-23 2011-06-23 King Steven R Method and apparatus to exchange data via an intermediary translation and queue manager
WO2011085934A1 (en) * 2010-01-18 2011-07-21 Xelerated Ab A packet buffer comprising a data section and a data description section
US8713260B2 (en) 2010-04-02 2014-04-29 Intel Corporation Adaptive block pre-fetching method and system
US8549506B2 (en) * 2010-04-27 2013-10-01 Microsoft Corporation Resumable methods
US8965819B2 (en) * 2010-08-16 2015-02-24 Oracle International Corporation System and method for effective caching using neural networks
US8701099B2 (en) * 2010-11-02 2014-04-15 International Business Machines Corporation Accelerating generic loop iterators using speculative execution
US9300321B2 (en) * 2010-11-05 2016-03-29 University of Maribor Light detection and ranging (LiDAR)data compression and decompression methods and apparatus
US8515882B2 (en) 2010-11-18 2013-08-20 International Business Machines Corporation Efficient storage of individuals for optimization simulation
CN102480337B (zh) 2010-11-30 2016-04-13 国际商业机器公司 无线电软件系统以及用于其的解码装置和方法
US8966413B2 (en) * 2011-02-17 2015-02-24 The Board Of Trustees Of The Leland Stanford Junior University System and method for a chip generator
US8892488B2 (en) * 2011-06-01 2014-11-18 Nec Laboratories America, Inc. Document classification with weighted supervised n-gram embedding
WO2012170904A2 (en) * 2011-06-10 2012-12-13 Bytemobile, Inc. Adaptive bitrate management on progressive download with indexed media files
CN102332162A (zh) 2011-09-19 2012-01-25 西安百利信息科技有限公司 基于人工神经网络的医学图像兴趣区自动识别和分级压缩方法
US9015092B2 (en) * 2012-06-04 2015-04-21 Brain Corporation Dynamically reconfigurable stochastic learning apparatus and methods
US9326075B2 (en) 2011-10-07 2016-04-26 Cochlear Limited Flexible protocol for an implanted prosthesis
US9235799B2 (en) * 2011-11-26 2016-01-12 Microsoft Technology Licensing, Llc Discriminative pretraining of deep neural networks
US9141166B2 (en) * 2011-12-13 2015-09-22 Intel Corporation Method, apparatus, and system for energy efficiency and energy conservation including dynamic control of energy consumption in power domains
CN102523452B (zh) 2011-12-29 2014-12-17 西安空间无线电技术研究所 图像转换压缩传输方法
CN102609222B (zh) * 2012-02-13 2015-03-25 山东华芯半导体有限公司 基于命令描述符的闪存控制方法
US9128925B2 (en) * 2012-04-24 2015-09-08 Freescale Semiconductor, Inc. System and method for direct memory access buffer utilization by setting DMA controller with plurality of arbitration weights associated with different DMA engines
WO2013159291A1 (en) * 2012-04-25 2013-10-31 Empire Technology Development Llc Workload prediction for network-based computing
US9703500B2 (en) * 2012-04-25 2017-07-11 International Business Machines Corporation Reducing power consumption by migration of data within a tiered storage system
US9015096B2 (en) * 2012-05-30 2015-04-21 Qualcomm Incorporated Continuous time spiking neural network event-based simulation that schedules co-pending events using an indexable list of nodes
US9432489B2 (en) * 2012-06-05 2016-08-30 Intel Corporation Systems and methods for processing encoded data streams
US9159020B2 (en) * 2012-09-14 2015-10-13 International Business Machines Corporation Multiplexing physical neurons to optimize power and area
US20160013773A1 (en) * 2012-11-06 2016-01-14 Pavel Dourbal Method and apparatus for fast digital filtering and signal processing
WO2014085975A1 (zh) * 2012-12-04 2014-06-12 中国科学院半导体研究所 可动态重构的多级并行单指令多数据阵列处理系统
CN107562444B (zh) 2012-12-26 2020-12-18 英特尔公司 合并相邻的聚集/分散操作
US10909137B2 (en) 2014-10-06 2021-02-02 Fisher-Rosemount Systems, Inc. Streaming data for analytics in process control systems
CN104050200B (zh) 2013-03-15 2017-12-08 伊姆西公司 用于数据拷贝的方法和装置
US9760346B2 (en) * 2013-05-31 2017-09-12 Microsoft Technology Licensing, Llc Deeply parallel source code compilation
US9053015B2 (en) 2013-06-17 2015-06-09 Topcon Positioning Systems, Inc. NAND flash memory interface controller with GNSS receiver firmware booting capability
WO2015039222A1 (en) * 2013-09-19 2015-03-26 Sysomos L.P. Systems and methods for actively composing content for use in continuous social communication
US9280465B2 (en) * 2013-10-08 2016-03-08 Globalfoundries Inc. Techniques for moving checkpoint-based high-availability log and data directly from a producer cache to a consumer cache
US20150286873A1 (en) * 2014-04-03 2015-10-08 Bruce L. Davis Smartphone-based methods and systems
US9286171B2 (en) * 2013-12-12 2016-03-15 International Business Machines Corporation Priming failover of stateful offload adapters
GB2521828A (en) * 2013-12-23 2015-07-08 Sony Corp Data encoding and decoding
US9851771B2 (en) 2013-12-28 2017-12-26 Intel Corporation Dynamic power measurement and estimation to improve memory subsystem power performance
US10097372B2 (en) * 2014-01-09 2018-10-09 Ciena Corporation Method for resource optimized network virtualization overlay transport in virtualized data center environments
EP2896428B1 (fr) * 2014-01-16 2016-11-09 Sorin CRM SAS Ensemble de réseau de neurones pour l'évaluation et l'adaptation d'une thérapie antitachycardique par un défibrillateur implantable
US10339447B2 (en) * 2014-01-23 2019-07-02 Qualcomm Incorporated Configuring sparse neuronal networks
US9563369B2 (en) * 2014-04-14 2017-02-07 Microsoft Technology Licensing, Llc Fine-grained bandwidth provisioning in a memory controller
US10635967B2 (en) * 2014-04-15 2020-04-28 Intel Corporation Methods, systems and computer program products for neuromorphic graph compression using associative memories
US9219499B2 (en) 2014-05-16 2015-12-22 Robert Bosch Gmbh Run time compression method for a vehicle communication bus
US9892125B1 (en) * 2014-05-23 2018-02-13 MapD Technologies, Inc. Method for logging update queries
US9959142B2 (en) * 2014-06-17 2018-05-01 Mediatek Inc. Dynamic task scheduling method for dispatching sub-tasks to computing devices of heterogeneous computing system and related computer readable medium
RU2666631C2 (ru) * 2014-09-12 2018-09-11 МАЙКРОСОФТ ТЕКНОЛОДЖИ ЛАЙСЕНСИНГ, ЭлЭлСи Обучение dnn-студента посредством распределения вывода
US9990307B1 (en) 2014-10-29 2018-06-05 Netronome Systems, Inc. Split packet transmission DMA engine
EP3035249B1 (en) 2014-12-19 2019-11-27 Intel Corporation Method and apparatus for distributed and cooperative computation in artificial neural networks
EP3035204B1 (en) * 2014-12-19 2018-08-15 Intel Corporation Storage device and method for performing convolution operations
US10223635B2 (en) 2015-01-22 2019-03-05 Qualcomm Incorporated Model compression and fine-tuning
CN104573064B (zh) * 2015-01-23 2017-12-08 四川中科腾信科技有限公司 一种大数据环境下的数据处理方法
US10234930B2 (en) * 2015-02-13 2019-03-19 Intel Corporation Performing power management in a multicore processor
CA2923600A1 (en) * 2015-03-12 2016-09-12 Staples, Inc. Review sentiment analysis
US10262190B2 (en) * 2015-03-26 2019-04-16 Beijing Kuangshi Technology Co., Ltd. Method, system, and computer program product for recognizing face
US9378044B1 (en) * 2015-03-28 2016-06-28 Vmware, Inc. Method and system that anticipates deleterious virtual-machine state changes within a virtualization layer
US9928144B2 (en) * 2015-03-30 2018-03-27 Commvault Systems, Inc. Storage management of data using an open-archive architecture, including streamlined access to primary data originally stored on network-attached storage and archived to secondary storage
FR3035243B1 (fr) * 2015-04-20 2018-06-29 Commissariat A L'energie Atomique Et Aux Energies Alternatives Placement d'une tache de calcul sur un processeur fonctionnellement asymetrique
US9965824B2 (en) * 2015-04-23 2018-05-08 Google Llc Architecture for high performance, power efficient, programmable image processing
US20160328644A1 (en) 2015-05-08 2016-11-10 Qualcomm Incorporated Adaptive selection of artificial neural networks
US20160335119A1 (en) 2015-05-12 2016-11-17 minds.ai inc Batch-based neural network system
US10083395B2 (en) * 2015-05-21 2018-09-25 Google Llc Batch processing in a neural network processor
CN106203619B (zh) * 2015-05-29 2022-09-13 三星电子株式会社 数据优化的神经网络遍历
US9595002B2 (en) * 2015-05-29 2017-03-14 Sas Institute Inc. Normalizing electronic communications using a vector having a repeating substring as input for a neural network
US20160350653A1 (en) * 2015-06-01 2016-12-01 Salesforce.Com, Inc. Dynamic Memory Network
US20160358069A1 (en) * 2015-06-03 2016-12-08 Samsung Electronics Co., Ltd. Neural network suppression
CN106250981B (zh) * 2015-06-10 2022-04-01 三星电子株式会社 减少存储器访问和网络内带宽消耗的脉冲神经网络
US10275001B2 (en) 2015-06-26 2019-04-30 Intel Corporation Thermal throttling of electronic devices
US20160378491A1 (en) 2015-06-26 2016-12-29 Microsoft Technology Licensing, Llc Determination of target location for transfer of processor control
US20160379109A1 (en) * 2015-06-29 2016-12-29 Microsoft Technology Licensing, Llc Convolutional neural networks on hardware accelerators
US11244225B2 (en) 2015-07-10 2022-02-08 Samsung Electronics Co., Ltd. Neural network processor configurable using macro instructions
EP3680820B1 (en) 2015-10-04 2021-12-01 Atomwise Inc. Method for applying a convolutional network to spatial data
US11029949B2 (en) * 2015-10-08 2021-06-08 Shanghai Zhaoxin Semiconductor Co., Ltd. Neural network unit
CN106447035B (zh) * 2015-10-08 2019-02-26 上海兆芯集成电路有限公司 具有可变率执行单元的处理器
US10471594B2 (en) * 2015-12-01 2019-11-12 Kindred Systems Inc. Systems, devices, and methods for the distribution and collection of multimodal data associated with robots
CN105488563A (zh) * 2015-12-16 2016-04-13 重庆大学 面向深度学习的稀疏自适应神经网络、算法及实现装置
US10007519B2 (en) * 2015-12-22 2018-06-26 Intel IP Corporation Instructions and logic for vector bit field compression and expansion
US11232085B2 (en) * 2016-01-07 2022-01-25 Amazon Technologies, Inc. Outlier detection for streaming data
CN107563497B (zh) * 2016-01-20 2021-03-19 中科寒武纪科技股份有限公司 用于稀疏人工神经网络的计算装置和运算方法
US10565207B2 (en) * 2016-04-12 2020-02-18 Hsilin Huang Method, system and program product for mask-based compression of a sparse matrix
CN106203624B (zh) * 2016-06-23 2019-06-21 上海交通大学 基于深度神经网络的矢量量化系统及方法
CN106204468B (zh) * 2016-06-27 2019-04-26 深圳市未来媒体技术研究院 一种基于ReLU卷积神经网络的图像去噪方法
US10528864B2 (en) * 2016-08-11 2020-01-07 Nvidia Corporation Sparse convolutional neural network accelerator
WO2018058452A1 (zh) * 2016-09-29 2018-04-05 北京中科寒武纪科技有限公司 一种执行人工神经网络运算的装置和方法
US10296292B2 (en) * 2016-10-20 2019-05-21 Advanced Micro Devices, Inc. Dynamic variable precision computation
CN106530200B (zh) 2016-10-23 2020-01-07 深圳大学 一种基于深度学习模型的隐写图像检测方法及系统
CN106529670B (zh) * 2016-10-27 2019-01-25 中国科学院计算技术研究所 一种基于权重压缩的神经网络处理器、设计方法、芯片
US9959498B1 (en) 2016-10-27 2018-05-01 Google Llc Neural network instruction set architecture
US10067710B2 (en) * 2016-11-23 2018-09-04 Advanced Micro Devices, Inc. Detecting buffer overflows in general-purpose GPU applications
US10037490B2 (en) * 2016-12-13 2018-07-31 Google Llc Performing average pooling in hardware
US20180164866A1 (en) * 2016-12-13 2018-06-14 Qualcomm Incorporated Low-power architecture for sparse neural network
US10169296B2 (en) * 2016-12-30 2019-01-01 Intel Corporation Distributed matrix multiplication for neural networks
US12118451B2 (en) 2017-01-04 2024-10-15 Stmicroelectronics S.R.L. Deep convolutional network heterogeneous architecture
US10096134B2 (en) * 2017-02-01 2018-10-09 Nvidia Corporation Data compaction and memory bandwidth reduction for sparse neural networks
US10333549B1 (en) * 2017-03-08 2019-06-25 iDensify LLC System and components for encoding integers
US10909447B2 (en) 2017-03-09 2021-02-02 Google Llc Transposing neural network matrices in hardware
US10795836B2 (en) 2017-04-17 2020-10-06 Microsoft Technology Licensing, Llc Data processing performance enhancement for neural networks using a virtualized data iterator
US10671349B2 (en) * 2017-07-24 2020-06-02 Tesla, Inc. Accelerated mathematical engine
US20190081637A1 (en) * 2017-09-08 2019-03-14 Nvidia Corporation Data inspection for compression/decompression configuration and data type determination
KR20190066473A (ko) * 2017-12-05 2019-06-13 삼성전자주식회사 뉴럴 네트워크에서 컨볼루션 연산을 처리하는 방법 및 장치
US12014505B2 (en) * 2019-01-31 2024-06-18 Samsung Electronics Co., Ltd. Method and apparatus with convolution neural network processing using shared operand
US11671111B2 (en) * 2019-04-17 2023-06-06 Samsung Electronics Co., Ltd. Hardware channel-parallel data compression/decompression
CN112465129B (zh) * 2019-09-09 2024-01-09 上海登临科技有限公司 片内异构人工智能处理器

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1797371A (zh) * 2004-12-27 2006-07-05 英特尔公司 用于基于填充缓冲器命中来预取的装置和方法
CN101715575A (zh) * 2006-12-06 2010-05-26 弗森多系统公司(dba弗森-艾奥) 采用数据管道管理数据的装置、系统和方法
CN105264779A (zh) * 2013-01-22 2016-01-20 阿尔特拉公司 使用simd指令的数据压缩和解压
CN105765484A (zh) * 2013-12-23 2016-07-13 英特尔公司 输入输出数据对齐

Non-Patent Citations (2)

* Cited by examiner, † Cited by third party
Title
Jakubiuk,Wiktor.High performance data processing pipeline for connectome segmentation.《Massachusetts Institute of Technology》.2016,全文. *
Patrick Judd, Jorge Albericio.Proteus: Exploiting Numerical Precision Variability in Deep Neural Networks.《ICS’16: Proceedings of the 2016 International Conference on Supercomputing》.2016,全文. *

Also Published As

Publication number Publication date
KR102596644B1 (ko) 2023-10-31
US20180300601A1 (en) 2018-10-18
WO2018194996A1 (en) 2018-10-25
CN110537194A (zh) 2019-12-03
US11205118B2 (en) 2021-12-21
US20210232904A1 (en) 2021-07-29
US11405051B2 (en) 2022-08-02
EP3612933A1 (en) 2020-02-26
US11182667B2 (en) 2021-11-23
CN110546610A (zh) 2019-12-06
RU2019136750A (ru) 2021-05-18
US10628345B2 (en) 2020-04-21
BR112019021541A2 (pt) 2020-05-12
CN110520857A (zh) 2019-11-29
CN110546611B (zh) 2023-05-02
EP3613026A1 (en) 2020-02-26
US20180300613A1 (en) 2018-10-18
CN110520846A (zh) 2019-11-29
AU2018256212B2 (en) 2022-08-11
US11476869B2 (en) 2022-10-18
WO2018194939A1 (en) 2018-10-25
EP3612942B1 (en) 2021-03-03
US20180300634A1 (en) 2018-10-18
EP3612936B1 (en) 2023-10-18
US11341399B2 (en) 2022-05-24
US20180300605A1 (en) 2018-10-18
CN110582785A (zh) 2019-12-17
AU2018256212A1 (en) 2019-09-19
CN110546628B (zh) 2023-10-20
WO2018194848A1 (en) 2018-10-25
US20180300606A1 (en) 2018-10-18
CN110546628A (zh) 2019-12-06
WO2018194998A1 (en) 2018-10-25
WO2018194847A1 (en) 2018-10-25
CN110546610B (zh) 2023-02-10
RU2767447C2 (ru) 2022-03-17
US20220147833A1 (en) 2022-05-12
CN110520853B (zh) 2023-08-15
KR20230152828A (ko) 2023-11-03
US11100390B2 (en) 2021-08-24
US10795836B2 (en) 2020-10-06
US20180300603A1 (en) 2018-10-18
US20180300615A1 (en) 2018-10-18
EP3613026B1 (en) 2021-05-26
EP3612989B1 (en) 2024-05-29
US11010315B2 (en) 2021-05-18
WO2018194849A1 (en) 2018-10-25
US20180300602A1 (en) 2018-10-18
CN110520870B (zh) 2023-07-14
KR102663557B1 (ko) 2024-05-03
CN110520853A (zh) 2019-11-29
JP7004741B2 (ja) 2022-01-21
PH12019550191A1 (en) 2020-06-29
CN110582785B (zh) 2024-02-27
CN116909985A (zh) 2023-10-20
US20200233820A1 (en) 2020-07-23
EP3612948A1 (en) 2020-02-26
EP3612989A1 (en) 2020-02-26
US20180300616A1 (en) 2018-10-18
WO2018194995A1 (en) 2018-10-25
WO2018194845A1 (en) 2018-10-25
WO2018194994A2 (en) 2018-10-25
MY201868A (en) 2024-03-21
EP3612990B1 (en) 2022-04-27
WO2018194846A1 (en) 2018-10-25
KR20190141694A (ko) 2019-12-24
EP3612942A1 (en) 2020-02-26
US20180300607A1 (en) 2018-10-18
US10540584B2 (en) 2020-01-21
JP2020517014A (ja) 2020-06-11
WO2018194850A1 (en) 2018-10-25
CN110506260A (zh) 2019-11-26
CO2019011014A2 (es) 2019-10-21
WO2018194940A1 (en) 2018-10-25
US11030131B2 (en) 2021-06-08
EP3612946A1 (en) 2020-02-26
CL2019002864A1 (es) 2020-03-06
WO2018194988A1 (en) 2018-10-25
EP3612947A1 (en) 2020-02-26
US11528033B2 (en) 2022-12-13
EP3612945B1 (en) 2024-05-29
EP3612934A1 (en) 2020-02-26
CN118153639A (zh) 2024-06-07
CA3056660A1 (en) 2018-10-25
CN116909984A (zh) 2023-10-20
WO2018194993A1 (en) 2018-10-25
CN110520856A (zh) 2019-11-29
CN110520909B (zh) 2021-03-19
EP3612936A1 (en) 2020-02-26
US11176448B2 (en) 2021-11-16
EP3612947B1 (en) 2023-09-06
US20230071352A1 (en) 2023-03-09
CN110520870A (zh) 2019-11-29
US11909422B2 (en) 2024-02-20
EP3612945A1 (en) 2020-02-26
NZ756870A (en) 2023-07-28
SG11201909175XA (en) 2019-11-28
ZA201905874B (en) 2020-11-25
CN110520857B (zh) 2023-07-28
EP3612991A1 (en) 2020-02-26
CN110537194B (zh) 2023-07-07
US11100391B2 (en) 2021-08-24
US11256976B2 (en) 2022-02-22
US11722147B2 (en) 2023-08-08
EP3612946B1 (en) 2023-12-06
CN110678843A (zh) 2020-01-10
US10963403B2 (en) 2021-03-30
CN110520909A (zh) 2019-11-29
CN110678843B (zh) 2023-07-07
MX2019012388A (es) 2020-01-23
CN110546654B (zh) 2024-03-29
EP3612937A1 (en) 2020-02-26
US20200356500A1 (en) 2020-11-12
EP3612991B1 (en) 2023-12-13
EP3612933B1 (en) 2024-09-04
US20180300604A1 (en) 2018-10-18
US20180299943A1 (en) 2018-10-18
EP3612990A1 (en) 2020-02-26
US20180300614A1 (en) 2018-10-18
CN110546654A (zh) 2019-12-06
US11750212B2 (en) 2023-09-05
US20180300617A1 (en) 2018-10-18
IL269888B (en) 2022-04-01
US20180300633A1 (en) 2018-10-18
CN110520846B (zh) 2023-07-28
RU2019136750A3 (zh) 2021-12-22
CN110520856B (zh) 2023-03-31
EP3612988A2 (en) 2020-02-26
WO2018194851A1 (en) 2018-10-25
CN110546611A (zh) 2019-12-06
MX2023008178A (es) 2023-11-28

Similar Documents

Publication Publication Date Title
CN110506260B (zh) 用于神经网络环境中的增强数据处理的方法、系统和介质
US11487342B2 (en) Reducing power consumption in a neural network environment using data management

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant