CN110335896A - 一种可调电流增益的多晶硅发射极结构的制作方法 - Google Patents
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- 229910021420 polycrystalline silicon Inorganic materials 0.000 title claims abstract description 52
- 229920005591 polysilicon Polymers 0.000 title claims abstract description 47
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 17
- 238000000034 method Methods 0.000 claims abstract description 26
- 238000000151 deposition Methods 0.000 claims abstract description 11
- 238000001259 photo etching Methods 0.000 claims abstract description 10
- 229920002120 photoresistant polymer Polymers 0.000 claims abstract description 9
- 239000000758 substrate Substances 0.000 claims abstract description 9
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 claims description 4
- 230000008021 deposition Effects 0.000 claims description 3
- 238000004140 cleaning Methods 0.000 claims description 2
- 238000011065 in-situ storage Methods 0.000 claims description 2
- 238000002386 leaching Methods 0.000 claims description 2
- 230000001590 oxidative effect Effects 0.000 claims description 2
- 238000005516 engineering process Methods 0.000 description 2
- 229910052581 Si3N4 Inorganic materials 0.000 description 1
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 238000010276 construction Methods 0.000 description 1
- 238000005137 deposition process Methods 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 238000002347 injection Methods 0.000 description 1
- 239000007924 injection Substances 0.000 description 1
- 238000004377 microelectronic Methods 0.000 description 1
- 238000000465 moulding Methods 0.000 description 1
- 239000013049 sediment Substances 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000012163 sequencing technique Methods 0.000 description 1
- 125000006850 spacer group Chemical group 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/41—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions
- H01L29/417—Electrodes ; Multistep manufacturing processes therefor characterised by their shape, relative sizes or dispositions carrying the current to be rectified, amplified or switched
- H01L29/41708—Emitter or collector electrodes for bipolar transistors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/4916—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET the conductor material next to the insulator being a silicon layer, e.g. polysilicon doped with boron, phosphorus or nitrogen
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/70—Bipolar devices
- H01L29/72—Transistor-type devices, i.e. able to continuously respond to applied control signals
- H01L29/73—Bipolar junction transistors
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- Engineering & Computer Science (AREA)
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- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Ceramic Engineering (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Thyristors (AREA)
Abstract
本发明公开了一种可调电流增益的多晶硅发射极结构的制作方法。一种可调电流增益的多晶硅发射极结构的制作方法包括:S1:在衬底片上形成第一发射极窗口;S2:在第一发射极窗口内生长超薄氧化层;S3:在第一发射极窗口内淀积多晶硅;S4:对多晶硅进行光刻、刻蚀和去胶;S5:在衬底片上形成第二发射极窗口;S6:在第二发射极窗口内生长超薄氧化层,且第二发射极的超薄氧化层厚度与第一发射极的超薄氧化层厚度不同;S7:在第二发射极窗口内淀积多晶硅;S8:对多晶硅进行光刻、刻蚀和去胶;S9:继续常规工艺完成后续所有工艺过程。本发明一种可调电流增益的多晶硅发射极结构的制作方法,可以一次流片实现形成具有两种电流增益的器件。
Description
技术领域
本发明涉及微电子器件领域,特别是涉及一种可调电流增益的多晶硅发射极结构的制作方法。
背景技术
多晶硅发射极工艺由于其良好的电驱动能力、高的电流增益、良好的器件匹配性、低的噪声特性在现代高速、高精度等高端模拟集成电路中有着广泛的应用。然而电路设计过程中,特别是低漂移,低噪声和高输入阻抗需求的电路设计以及低偏置电流电路设计中,需要使用超增益晶体管(通常称为超β晶体管)。而现有多晶硅发射极工艺只能制作一种常规电流增益的晶体管,即电流增益在100-300左右,这对于特殊电路应用来说无疑成为重要的技术瓶颈,也限制了多晶硅发射极工艺的适用性。
发明内容
本发明要解决的技术问题是能够提供一种可调电流增益的多晶硅发射极结构的制作方法。
为解决上述问题,本发明提供一种可调电流增益的多晶硅发射极结构的制作方法,包括:S1:在衬底片上形成第一发射极窗口;
S2:在第一发射极窗口内生长超薄氧化层;
S3:在第一发射极窗口内淀积多晶硅;
S4:对多晶硅进行光刻、刻蚀和去胶,以形成第一发射极;
S5:在衬底片上形成第二发射极窗口;
S6:在第二发射极窗口内生长超薄氧化层,且第二发射极的超薄氧化层厚度与第一发射极的超薄氧化层厚度不同;
S7:在第二发射极窗口内淀积多晶硅;
S8:对多晶硅进行光刻、刻蚀和去胶,以形成第二发射极;
S9:继续常规工艺完成后续所有工艺过程,形成最终多晶硅发射极器件结构。
进一步的,生长超薄氧化层时在多晶淀积炉内原位生长。
进一步的,所述第一发射极的超薄氧化层的厚度为4-8埃。
进一步的,所述第二发射极的超薄氧化层厚度为10-20埃。
进一步的,生长超薄氧化层前发射极窗口进行清洗。
进一步的,清洗过程包括在多晶硅淀积炉内的氢氟酸蒸气吹淋,祛除发射极窗口的自然氧化层。
本发明一种可调电流增益的多晶硅发射极结构的制作方法,可以一次流片实现形成具有两种电流增益的器件,可以提供常规工艺的常规增益晶体管(β在100-300左右)和超电流增益的晶体管(β在500-1000左右),极大的丰富了工艺的特殊适用性和灵活性,并且两类晶体管成模块化设计,可以独立使用,也可以一起使用,并且不明显增加工艺的复杂性和成本。
附图说明
图1是本发明一种可调电流增益的多晶硅发射极结构的制作方法的较佳实施方式的流程图。
图2是发射极窗口的结构示意图。
图3是完成超薄界面氧化层生长和发射极多晶淀积后的发射极窗口的结构示意图。
图4是基于本发明实施的可调电流增益的多晶硅发射极器件测试结果。
图5是基于本发明的多晶硅发射极器件整体结构剖面示意图。
具体实施方式
下面结合附图对本发明作进一步说明。
如图1至图5所示,本发明一种可调电流增益的多晶硅发射极结构的制作方法的较佳实施方式包括如下步骤:
步骤S1:在衬底片1上形成第一发射极窗口。具体而言,所述衬底片1上生长外延层2,然后进行相应结构的光刻、刻蚀、注入等标准工艺,形成相应有源/无源结构,直至形成第一发射极窗口,即在陈底片1上形成了外延层2、外基区多晶硅3、氮化硅侧墙(Spacer)结构4以及二氧化硅介质层5。在形成发射极窗口之前的所有结构、工艺过程与常规多晶硅发射极工艺过程完全一致。
步骤S2:在第一发射极窗口内生长超薄氧化层,超薄氧化层生长在多晶硅淀积炉内进行,且厚度为4-8埃。
步骤S3:在第一发射极窗口内淀积多晶硅,以形成多晶硅层6。多晶硅层6与外延层2之间的超薄氧化层7只是示意性的结构,在常规扫描电子显微镜下一般观察不到该层的存在,需要采用透射电子显微镜观察。
步骤S4:对第一发射极的多晶硅进行光刻、刻蚀和去胶,以形成第一发射极。本实施方式中,所述光刻、刻蚀、去胶等均为半导体工艺中常规工艺过程,均为行业从业人员所理解的常规工艺过程。
步骤S5:在衬底片1上形成进行第二发射极窗口,第二发射极窗口结构与第一发射极窗口结构完全一致,且形成方式相同。
步骤S6:在第二发射极窗口内生长超薄氧化层,超薄氧化层生长在多晶硅淀积炉内进行,厚度为10-20埃,且第二发射极的超薄氧化层厚度与第一发射极的超薄氧化层厚度不同。
步骤S7:在第二发射极窗口进行与第一发射极多晶硅淀积过程一致的多晶硅淀积。
步骤S8:对第二发射极的多晶硅进行光刻、刻蚀和去胶,以形成第二发射极。
步骤S9:继续常规工艺完成后续所有工艺过程,形成最终多晶硅发射极器件结构。
通过该方法制作成型的多晶硅发射极器件形成模块化,即可以单独使用也可以同时使用第一发射极结构和第二发射极结构,从而实现可调电流增益。根据提供的常规电流增益和超电流增益晶体管的测试结果可知(如图4所示),由于第一和第二发射极界面超薄氧化层厚度不一致,可以同时提供常规电流增益能力的普通晶体管和超电流增益的超β晶体管,因此可以实现晶体管电流增益的可控调节,拓展多晶硅发射极器件的适用性,即可适用于需求常规电流增益的电路,亦可适用于需要超β电流增益和普通β电流增益的电路。
需要特别说明的是这里反复提及的第一发射极和第二发射极只是相对而言,两个发射极结构在具体工艺过程中没有固定的先后顺序。
以上仅为本发明的实施方式,并非因此限制本发明的专利范围,凡是利用本发明说明书及附图内容所作的等效结构,直接或间接运用在其他相关的技术领域,均同理在本发明的专利保护范围之内。
Claims (6)
1.一种可调电流增益的多晶硅发射极结构的制作方法,其特征在于:包括:
S1:在衬底片上形成第一发射极窗口;
S2:在第一发射极窗口内生长超薄氧化层;
S3:在第一发射极窗口内淀积多晶硅;
S4:对多晶硅进行光刻、刻蚀和去胶,以形成第一发射极;
S5:在衬底片上形成第二发射极窗口;
S6:在第二发射极窗口内生长超薄氧化层,且第二发射极的超薄氧化层厚度与第一发射极的超薄氧化层厚度不同;
S7:在第二发射极窗口内淀积多晶硅;
S8:对多晶硅进行光刻、刻蚀和去胶,以形成第二发射极;
S9:继续常规工艺完成后续所有工艺过程,形成最终多晶硅发射极器件结构。
2.如权利要求1所述的一种可调电流增益的多晶硅发射极结构的制作方法,其特征在于:生长超薄氧化层时在多晶淀积炉内原位生长。
3.如权利要求1所述的一种可调电流增益的多晶硅发射极结构的制作方法,其特征在于:所述第一发射极的超薄氧化层的厚度为4-8埃。
4.如权利要求1所述的一种可调电流增益的多晶硅发射极结构的制作方法,其特征在于:所述第二发射极的超薄氧化层厚度为10-20埃。
5.如权利要求1或2所述的一种可调电流增益的多晶硅发射极结构的制作方法,其特征在于:生长超薄氧化层前发射极窗口进行清洗。
6.如权利要求5所述的一种可调电流增益的多晶硅发射极结构的制作方法,其特征在于:清洗过程包括在多晶硅淀积炉内的氢氟酸蒸气吹淋,祛除发射极窗口的自然氧化层。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201910384205.7A CN110335896A (zh) | 2019-05-09 | 2019-05-09 | 一种可调电流增益的多晶硅发射极结构的制作方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201910384205.7A CN110335896A (zh) | 2019-05-09 | 2019-05-09 | 一种可调电流增益的多晶硅发射极结构的制作方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
CN110335896A true CN110335896A (zh) | 2019-10-15 |
Family
ID=68139340
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201910384205.7A Pending CN110335896A (zh) | 2019-05-09 | 2019-05-09 | 一种可调电流增益的多晶硅发射极结构的制作方法 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN110335896A (zh) |
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-
2019
- 2019-05-09 CN CN201910384205.7A patent/CN110335896A/zh active Pending
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PB01 | Publication | ||
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