CN109686309A - 像素电路与高亮度显示器 - Google Patents

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Abstract

一种高亮度显示器包含多个像素电路以及驱动线。驱动线用于提供第一数据信号和第二数据信号至多个像素电路的一列像素电路。其中当高亮度显示器运作于普通模式时，第一数据信号为直流信号且第二数据信号为交流信号，列像素电路的其中一像素电路的驱动电流具有第一最大电流值，当高亮度显示器运作于高亮度模式时，第一数据信号和第二数据信号皆为交流信号，像素电路的驱动电流具有第二最大电流值，且第二最大电流值大于第一最大电流值。

Description

像素电路与高亮度显示器
技术领域
本发明有关一种像素电路与高亮度显示器，尤指一种亮度调整功能的像素电路与高亮度显示器。
背景技术
低温多晶硅薄膜晶体管(low temperature poly-silicon thin-filmtransistor)具有高载子迁移率与尺寸小的特点，适合应用于高解析度、窄边框以及低耗电的显示器。目前业界广泛使用准分子激光退火(excimer laser annealing)技术来形成低温多晶硅薄膜晶体管的多晶硅薄膜。然而，由于准分子激光每一发的扫描功率并不稳定，不同区域的多晶硅薄膜会具有晶粒尺寸与数量的差异。因此，于显示器的不同区域中，低温多晶硅薄膜晶体管的特性便会不同。例如，不同区域的低温多晶硅薄膜晶体管会有着不同的临界电压(threshold voltage)。在此情况下，显示器将会面临显示画面不均匀的问题。另外，当使用者于高亮度环境(例如白天的户外)使用穿戴式装置时，穿戴式装置的显示器也必须因应具备有高亮度模式，以避免消费者无法清楚识别出显示器所提供的信息。
发明内容
本发明提供一种像素电路。像素电路包含驱动晶体管、补偿电路、写入电路、发光控制电路、重置电路以及发光单元。驱动晶体管包含第一端、第二端和控制端，其中驱动晶体管的第一端耦接于第一节点，驱动晶体管的第二端耦接于第二节点，驱动晶体管的控制端耦接于第三节点。补偿电路耦接于第一节点和第三节点，用于控制驱动晶体管产生驱动电流。写入电路用于自驱动线接收第一数据信号和第二数据信号，并选择性地提供第一数据信号和第二数据信号至补偿电路，其中当补偿电路接收到第一数据信号时，补偿电路将第一节点的第一节点电压设置为正相关于驱动晶体管的临界电压的绝对值。发光控制电路用于提供系统高电压至第一节点。重置电路耦接于第二节点和第三节点，用于重置第二节点的第二节点电压和第三节点的第三节点电压。发光单元包含第一端和第二端，其中发光单元的第一端用于接收驱动电流，发光单元的第二端用于接收系统低电压。
本发明提供一种高亮度显示器。高亮度显示器包含多个像素电路以及驱动线。驱动线用于提供第一数据信号和第二数据信号至多个像素电路的一列像素电路。其中当高亮度显示器运作于普通模式时，第一数据信号为直流信号且第二数据信号为交流信号，列像素电路的其中一像素电路的驱动电流具有第一最大电流值，当高亮度显示器运作于高亮度模式时，第一数据信号和第二数据信号皆为交流信号，像素电路的驱动电流具有第二最大电流值，且第二最大电流值大于第一最大电流值。
上述的像素电路与高亮度显示器能于高亮度环境下提供清晰的显示画面。
以下结合附图和具体实施例对本发明进行详细描述，但不作为对本发明的限定。
附图说明
图1为根据本发明一实施例的高亮度显示器简化后的功能方块图。
图2为图1的像素电路的一实施例的示意图。
图3为图2的像素电路的一运作实施例简化后的时序图。
图4A为图2的像素电路于重置阶段中的等效电路驱动示意图。
图4B为图2的像素电路于补偿阶段中的等效电路驱动示意图。
图4C为图2的像素电路于写入阶段中的等效电路驱动示意图。
图4D为图2的像素电路于发光阶段中的等效电路驱动示意图。
图5为依据本发明一实施例的像素电路的示意图。
图6为依据本发明另一实施例的像素电路的示意图。
图7为依据本发明又一实施例的像素电路的示意图。
其中，附图标记：
100：高亮度显示器
110、510、610、710：像素电路
102：源极驱动器
104：栅极驱动器
120、120-1～120-n：驱动线
210：驱动晶体管
220：补偿电路
230：写入电路
240：发光控制电路
250：重置电路
260：发光单元
M1～M7：第一开关～第七开关
C1～C2：第一电容～第二电容
Sc1～Sc3：第一控制信号～第三控制信号
Sem：发光控制信号
N1～N5：第一节点～第五节点
V1～V5：第一节点电压～第五节点电压
OVDD：系统高电压
OVSS：系统低电压
Vref1～Vref2：第一参考电压～第二参考电压
Sd1～Sd2：第一数据信号～第二数据信号
T1：重置阶段
T2：补偿阶段
T3：写入阶段
T4：发光阶段
具体实施方式
下面结合附图对本发明的结构原理和工作原理作具体的描述：
以下将配合相关附图来说明本发明的实施例。在附图中，相同的标号表示相同或类似的元件或方法流程。
图1为根据本发明一实施例的高亮度显示器100简化后的功能方块图。高亮度显示器100包含源极驱动器102、栅极驱动器104、多个像素电路110和多个驱动线120-1～120-n。多个驱动线120-1～120-n耦接于源极驱动器102，且驱动线120-1～120-n各自用于提供第一数据信号Sd1和第二数据信号Sd2至多个像素电路110中对应的一行像素电路110。为使图面简洁而易于说明，高亮度显示器100中的其他元件与连接关系并未示出于图1中。
本案说明书和附图中使用的元件编号中的索引1～n，只是为了方便指称个别的元件，并非有意将前述元件的数量局限在特定数目。在本案说明书和附图中，若使用某一元件编号时没有指明该元件编号的索引，则代表该元件编号是指称所属元件群组中不特定的任一元件。例如，元件编号120指称的对象是驱动线120-1～120-n中不特定的任意驱动线120。
在本实施例中，高亮度显示器100可操作于普通模式以及高亮度模式。当高亮度显示器100运作于普通模式时，第一控制信号Sd1和第二控制信号Sd2的其中一者被设置为直流信号，而另一者则被设置为交流信号。当高亮度显示器100运作于高亮度模式时，第一控制信号Sd1和第二控制信号Sd2皆被设置为交流信号，以扩大提供给像素电路110的数据信号的可调整范围。因此，于高亮度模式时，高亮度显示器100可提供比普通模式更高的亮度。
图2为图1的像素电路110的一实施例的示意图。像素电路110包含驱动晶体管210、补偿电路220、写入电路230、发光控制电路240、重置电路250和发光单元260。驱动晶体管210包含第一端、第二端和控制端，其中驱动晶体管210的第一端耦接于第一节点N1，驱动晶体管210的第二端耦接于第二节点N2，驱动晶体管210的控制端耦接于第三节点N3。如图2所示，像素电路110另包含第四节点N4以及第五节点N5，且第一节点N1至第五节点N5分别具有第一节点电压V1、第二节点电压V2、第三节点电压V3、第四节点电压V4以及第五节点电压V5。
补偿电路220耦接于第一节点N1和第三节点N3，用于控制驱动晶体管210的控制端电压，以使驱动晶体管210产生驱动电流。写入电路230用于自驱动线120接收第一数据信号Sd1和第二数据信号Sd2，并选择性地提供第一数据信号Sd1和第二数据信号Sd2至补偿电路220。值得注意的是，当补偿电路220接收到第一数据信号Sd1时，补偿电路220会将第一节点电压V1设置为正相关于驱动晶体管210的临界电压的绝对值，以在后续的运作中补偿驱动晶体管210的临界电压变异。
发光控制电路240用于提供系统高电压OVDD至第一节点N1与第四节点N4，以重置第一节点电压V1与第四节点电压V4，或者使驱动晶体管210的第一端和控制端之间具有足以产生驱动电流的电压差。重置电路250耦接于第二节点N2和第三节点N3，用于重置第二节点电压V2和第三节点电压V3。
发光单元260包含第一端(例如，阳极端)和第二端(例如，阴极端)，其中发光单元260的第一端用于接收驱动晶体管210产生的驱动电流，发光单元260的第二端用于接收系统低电压OVSS，且发光单元260会依据接收到的驱动电流的大小产生对应的亮度。实作上，发光单元260可以用有机发光二极管(organic light-emitting diode)或是微发光二极管(micro light-emitting diode)等等发光元件来实现。
具体而言，补偿电路220包含第一开关M1、第二开关M2以及第一电容C1。第一开关M1包含第一端、第二端和控制端，其中第一开关M1的第一端耦接于第一节点N1，第一开关M1的第二端耦接于第四节点N4，第一开关M1的控制端用于接收第一控制信号Sc1。第二开关M2包含第一端、第二端和控制端，第二开关M2的第一端耦接于第三节点N3，第二开关M2的第二端耦接于第五节点N5，第二开关M2的控制端用于接收第二控制信号Sc2。第一电容C1耦接于第四节点N4和第五节点N5之间。
写入电路230包含第三开关M3和第四开关M4。第三开关M3包含第一端、第二端和控制端，其中第三开关M3的第一端耦接于第四节点N4，第三开关M3的第二端耦接于驱动线120，第三开关M3的控制端用于接收第三控制信号Sc3。第四开关M4包含第一端、第二端和控制端，其中第四开关M4的第一端耦接于第五节点N5，第四开关M4的第二端耦接于驱动线120，第四开关M4的控制端用于接收第一控制信号Sc1。
发光控制电路240包含第五开关M5和第二电容C2。第五开关M5包含第一端、第二端和控制端，其中第五开关M5的第一端用于接收系统高电压OVDD，第五开关M5的第二端耦接于第一节点N1，第五开关M5的控制端用于接收发光控制信号Sem。第二电容C2包含第一端和第二端，其中第二电容C2的第一端用于接收系统高电压OVDD，第二电容C2的第二端耦接于第四节点N4。
重置电路250包含第六开关M6和第七开关M7。第六开关M6包含第一端、第二端和控制端，其中第六开关M6的第一端耦接于第三节点N3，第六开关M6的第二端用于接收第一参考电压Vref1，第六开关M6的控制端用于接收第一控制信号Sc1。第七开关M7包含第一端、第二端和控制端，第七开关M7的第一端用于接收第二参考电压Vref2，第七开关M7的第二端耦接于第二节点N2和发光单元260的第一端。
实作上，第一开关M1至第七开关M7可由P型薄膜晶体管(thin-film transistor)或是其他合适的P型晶体管来实现。第一控制信号Sc1、第二控制信号Sc2、第三控制信号Sc3以及发光控制信号Sem可由图1的栅极驱动器104提供。
图3为图2的像素电路110的一运作实施例的时序变化图。以下将以图2搭配图3来进一步说明像素电路110的运作方式。如图3所示，在重置阶段T1中，第一控制信号Sc1和发光控制信号Sem处于致能电位(例如，低电压电位)，第二控制信号Sc2和第三控制信号Sc3处于禁能电位(例如，高电压电位)。因此，第一开关M1、第四开关M4、第五开关M5、第六开关M6和第七开关M7处于导通状态，且第二开关M2和第三开关M3处于关断状态，使得像素电路110等效于图4A所示的电路。
在此情况下，系统高电压OVDD会经由第五开关M5传递至第一节点N1，接着经由第一开关M1传递至第四节点N4。因此，第一节点电压V1和第四节点电压V4会被设置为系统高电压OVDD。第一参考电压Vref1会经由第六开关M6传递至第三节点N3，且第二参考电压Vref2会经由第七开关M7传递至第二节点N2和发光单元260的第一端，以将第二节点电压V2和第三节点电压V3分别设置为第二参考电压Vref2和第一参考电压Vref1。驱动线120会提供第一数据信号Sd1至像素电路110，且第一数据信号Sd1会经由第四开关M4传递至第五节点N5，使得第五节点电压V5被设置为第一数据信号Sd1的电压电位。
在本实施例中，第二参考电压Vref2可等于或低于系统低电压OVSS，使得发光单元260于重置阶段T1中维持于关断状态，以避免发光单元260具有非预期的亮度，进而增加高亮度显示器100的画面对比度。
在补偿阶段T2，第一控制信号Sc1处于致能电位，第二控制信号Sc2、第三控制信号Sc3和发光控制信号Sem处于禁能电位。因此，第一开关M1、第四开关M4、第六开关M6和第七开关M7处于导通状态，且第二开关M2、第三开关M3和第五开关M5处于关断状态，使得像素电路110等效于图4B所示的电路。
在此情况下，第三节点电压V3会维持于第一参考电压Vref1，且驱动线120持续提供第一数据信号Sd1至像素电路110，使得第五节点电压V5维持于第一数据信号Sd1的电压电位。第一电容C1会经由第一开关M1、驱动晶体管210以及第七开关M7进行放电，使得第四节点电压V4和第一节点电压V1逐渐降低，直到第四节点电压V4和第一节点电压V1等于下列《公式1》所示的电压值：
V4＝V1＝Vref1+|Vth| 《公式1》
其中，Vth表示驱动晶体管210的临界电压(threshold voltage)。如公式1所示，于补偿阶段T2，补偿电路220会将第一节点电压V1和第四节点电压V4设置为正相关于驱动晶体管210的临界电压的绝对值。
接着，在写入阶段T3，第二控制信号Sc2、第三控制信号Sc3和发光控制信号Sem处于致能电位，第一控制信号Sc1处于禁能电位。因此，第二开关M2、第三开关M3和第五开关M5处于导通状态，且第一开关M1、第四开关M4、第六开关M6以及第七开关M7处于关断状态，使得像素电路110等效于图4C所示的电路。
在此情况下，系统高电压OVDD会经由第五开关M5传递至第一节点N1，驱动线120会提供第二数据信号Sd2至像素电路110，且第二数据信号Sd2会经由第三开关M3传递至第四节点N4。因此，第四节点电压V4会由《公式1》所示的电压值改变为第二数据信号Sd2的电压电位。由于第一电容C1的电容耦合效应，第四节点电压V4的变化量会经由第一电容C1传递至第五节点N5。因为第五节点N5处于浮接(floating)状态，第五节点电压V5会变化为下列《公式2》所示的电压值：
V5＝Sd1+Sd2-Vref1-|Vth| 《公式2》
由于第二开关M2处于导通状态，且第一电容C1的电容值远大于驱动晶体管210的控制端电容的电容值，所以第三节点电压V3会等于第五节点电压V5。如此一来，驱动晶体管210会依据第一节点电压V1和第三节点电压V3的差值产生驱动电流Idri。根据晶体管的饱和区电流公式，驱动电流Idri的大小可由下列的《公式3》表示：
其中，k表示驱动晶体管210的载子迁移率(carrier mobility)、栅极氧化层的单位电容大小以及栅极宽长比三者的乘积。由《公式3》可知，驱动电流Idri的大小与驱动晶体管210的临界电压无关，所以像素电路110搭配图3的运作实施例可有效补偿驱动晶体管210的临界电压变异。
在发光阶段T4，第二控制信号Sc2和发光控制信号Sem处于致能电位，第一控制信号Sc1和第三控制信号Sc3处于禁能电位。因此，第二开关M2和第五开关M5处于导通状态，且第一开关M1、第三开关M3、第四开关M4、第六开关M6以及第七开关M7处于关断状态，使得像素电路110等效于图4D所示的电路。
于此阶段中，驱动电流Idri的大小同样可由《公式3》表示。由于第三节点N3处于浮接状态，系统高电压OVDD的变化量会通过第一电容C1和第二电容C2传递至第三节点N3。因此，当系统高电压OVDD发生扰动时，驱动晶体管210的第一端和控制端的电压差仍能维持于定值，进而使得驱动电流Idri的大小维持于定值，以避免高亮度显示器100的显示画面闪烁。
如前所述，高亮度显示器100可选择性地运作于普通模式或是高亮度模式。当高亮度显示器100运作于普通模式时，第一数据信号Sd1和第二数据信号Sd2的其中一者会被设置为直流信号，且电压电位相同于第一参考电压Vref1。第一数据信号Sd1和第二数据信号Sd2的另一者则会被设置为交流信号。
在一实施例中，第一数据信号Sd1被设置为直流信号，且第一数据信号Sd1的电压电位相同于第一参考电压Vref1，而第二数据信号Sd2被设置为交流信号。因此，在写入阶段T3或发光阶段T4，驱动电流Idri的大小可由《公式3》改为由下列的《公式4》表示：
在另一实施例中，第二数据信号Sd2被设置为直流信号，且第二数据信号Sd2的电压电位相同于第一参考电压Vref1，而第一数据信号Sd1被设置为交流信号。因此，在写入阶段T3或发光阶段T4，驱动电流Idri的大小可由《公式3》改为由下列的《公式5》表示：
当高亮度显示器100运作于高亮度模式时，第一数据信号Sd1和第二数据信号Sd2皆会被设置为交流信号，且第一数据信号Sd1和第二数据信号Sd2其中一者的电压电位会低于第一参考电压Vref1。因此，驱动电流Idri的大小可由《公式3》表示，且驱动电流Idri的大小负相关于像素电路110接收到的第一数据信号Sda1的电压电位和第二数据信号Sd2的电压电位之和。由《公式3》、《公式4》和《公式5》可知，驱动电流Idri于高亮度模式中的最大电流值，会大于驱动电流Idri于普通模式中的最大电流值。如此一来，像素电路110于高亮度模式中便可具有更高的亮度。
在一实施例中，第五开关M5于写入阶段T3中维持于关断状态，直到发光阶段T4才切换至导通状态，以避免驱动电流Idri因为第三节点电压V3于写入阶段T3中的变化而产生扰动。如此一来，高亮度显示器100的画面品质可进一步提升。
图5为依据本发明一实施例的像素电路510的示意图。像素电路510适用于高亮度显示器100，且相似于像素电路110，差异在于像素电路510无需接收第三控制信号Sc3，以降低信号复杂度以及缩小电路面积，其中第二开关M2的控制端是用于接收发光控制信号Sem。于重置阶段T1，第二开关M2会处于导通状态，使得第三节点电压V3和第五节点电压V5于此阶段中，介于第一数据信号Sd1的电压电位和第一参考电压Vref1之间。前述像素电路110的其余连接方式、元件、实施方式以及优点，皆适用于像素电路510，为简洁起见，在此不重复赘述。
图6为依据本发明一实施例的像素电路610的示意图。像素电路610适用于高亮度显示器100，且相似于像素电路110，差异在于像素电路610无需接收第三控制信号Sc3，以降低信号复杂度以及缩小电路面积，其中第二开关M2的控制端是用于接收第一控制信号Sc1，且第二开关M2是以N型晶体管来实现。在前述图3的实施例中，第一控制信号Sc1和第三控制信号Sc3互为反相。因此，像素电路610的第二开关M2的运作方式，会相似于像素电路110的第二开关M2的运作方式。前述像素电路110的其余连接方式、元件、实施方式以及优点，皆适用于像素电路610，为简洁起见，在此不重复赘述。
图7为依据本发明一实施例的像素电路710的示意图。像素电路710适用于高亮度显示器100，且相似于像素电路110，差异在于像素电路710无需接收第一控制信号Sc1，以降低信号复杂度以及缩小电路面积，其中第一开关M1、第四开关M4、第六开关M6以及第七开关M7是以N型晶体管来实现且控制端皆用于接收第三控制信号Sc3。在前述图3的实施例中，第一控制信号Sc1和第三控制信号Sc3互为反相。因此，像素电路710的第一开关M1、第四开关M4、第六开关M6以及第七开关M7的运作方式，会相似于像素电路110的第一开关M1、第四开关M4、第六开关M6以及第七开关M7的运作方式。前述像素电路110的其余连接方式、元件、实施方式以及优点，皆适用于像素电路710，为简洁起见，在此不重复赘述。
综上所述，高亮度显示器100、像素电路110、510、610以及710可适应性地选择运作于普通模式或高亮度模式，所以可使穿戴式装置于高亮度环境下提供清晰的显示画面。
在说明书及权利要求中使用了某些词汇来指称特定的元件。然而，所属技术领域中具有通常知识者应可理解，同样的元件可能会用不同的名词来称呼。说明书及权利要求并不以名称的差异做为区分元件的方式，而是以元件在功能上的差异来做为区分的基准。在说明书及权利要求所提及的「包含」为开放式的用语，故应解释成「包含但不限定于」。另外，「耦接」在此包含任何直接及间接的连接手段。因此，若文中描述第一元件耦接于第二元件，则代表第一元件可通过电性连接或无线传输、光学传输等信号连接方式而直接地连接于第二元件，或者通过其他元件或连接手段间接地电性或信号连接至该第二元件。
另外，除非说明书中特别指明，否则任何单数格的用语都同时包含复数格的涵义。
当然，本发明还可有其它多种实施例，在不背离本发明精神及其实质的情况下，熟悉本领域的技术人员当可根据本发明作出各种相应的改变和变形，但这些相应的改变和变形都应属于本发明所附的权利要求的保护范围。

Claims (20)

1.一种像素电路，其特征在于，包含：
一驱动晶体管，包含一第一端、一第二端和一控制端，其中该驱动晶体管的该第一端耦接于一第一节点，该驱动晶体管的该第二端耦接于一第二节点，该驱动晶体管的该控制端耦接于一第三节点；
一补偿电路，耦接于该第一节点和该第三节点，用于控制该驱动晶体管产生一驱动电流；
一写入电路，用于自一驱动线接收一第一数据信号和一第二数据信号，并选择性地提供该第一数据信号和该第二数据信号至该补偿电路，其中当该补偿电路接收到该第一数据信号时，该补偿电路将该第一节点的一第一节点电压设置为正相关于该驱动晶体管的临界电压的绝对值；
一发光控制电路，用于提供一系统高电压至该第一节点；
一重置电路，耦接于该第二节点和该第三节点，用于重置该第二节点的一第二节点电压和该第三节点的一第三节点电压；以及
一发光单元，包含一第一端和一第二端，其中该发光单元的该第一端用于接收该驱动电流，该发光单元的该第二端用于接收一系统低电压。
2.如权利要求1的像素电路，其特征在于，其中该第一数据信号和该第二数据信号皆为交流信号，且该驱动电流的大小负相关于该像素电路接收到的该第一数据信号的电压电位和该第二数据信号的电压电位之和。
3.如权利要求1的像素电路，其特征在于，其中该补偿电路包含：
一第一开关，包含一第一端、一第二端和一控制端，其中该第一开关的该第一端耦接于该第一节点，该第一开关的该第二端耦接于一第四节点，该第一开关的该控制端用于接收一第一控制信号；
一第二开关，包含一第一端、一第二端和一控制端，该第二开关的该第一端耦接于该第三节点，该第二开关的该第二端耦接于一第五节点，该第二开关的该控制端用于接收一第二控制信号；以及
一第一电容单元，耦接于该第四节点和该第五节点之间。
4.如权利要求3的像素电路，其特征在于，其中该写入电路包含：
一第三开关，包含一第一端、一第二端和一控制端，其中该第三开关的该第一端耦接于该第四节点，该第三开关的该第二端耦接于该驱动线，该第三开关的该控制端用于接收一第三控制信号；以及
一第四开关，包含一第一端、一第二端和一控制端，其中该第四开关的该第一端耦接于该第五节点，该第四开关的该第二端耦接于该驱动线，该第四开关的该控制端用于接收该第一控制信号。
5.如权利要求4的像素电路，其特征在于，其中该发光控制电路包含：
一第五开关，包含一第一端、一第二端和一控制端，其中该第五开关的该第一端用于接收该系统高电压，该第五开关的该第二端耦接于该第一节点，该第五开关的该控制端用于接收一发光控制信号；以及
一第二电容单元，包含一第一端和一第二端，其中该第二电容单元的该第一端用于接收该系统高电压，该第二电容单元的该第二端耦接于该第四节点。
6.如权利要求5的像素电路，其特征在于，其中于一重置阶段，该第一控制信号和该发光控制信号处于一致能电位，该第二控制信号和该第三控制信号处于一禁能电位，
其中于一补偿阶段，该第一控制信号处于该致能电位，该第二控制信号、该第三控制信号和该发光控制信号处于该禁能电位，
其中于一写入阶段，该第二控制信号、该第三控制信号和该发光控制信号处于该致能电位，该第一控制信号处于该禁能电位，
其中于一发光阶段，该第二控制信号和该发光控制信号处于该致能电位，该第一控制信号和该第三控制信号处于该禁能电位。
7.如权利要求3的像素电路，其特征在于，其中该重置电路包含：
一第六开关，包含一第一端、一第二端和一控制端，其中该第六开关的该第一端耦接于该第三节点，该第六开关的该第二端用于接收一第一参考电压，该第六开关的该控制端用于接收该第一控制信号；以及
一第七开关，包含一第一端、一第二端和一控制端，该第七开关的该第一端用于接收一第二参考电压，该第七开关的该第二端耦接于该第二节点和该发光单元的该第一端。
8.如权利要求1的像素电路，其特征在于，其中该补偿电路包含：
一第一开关，包含一第一端、一第二端和一控制端，其中该第一开关的该第一端耦接于该第一节点，该第一开关的该第二端耦接于一第四节点，该第一开关的该控制端用于接收一第一控制信号；
一第二开关，包含一第一端、一第二端和一控制端，该第二开关的该第一端耦接于该第三节点，该第二开关的该第二端耦接于一第五节点，该第二开关的该控制端用于接收一发光控制信号；以及
一第一电容单元，耦接于该第四节点和该第五节点之间；
其中该发光控制电路包含：
一第三开关，包含一第一端、一第二端和一控制端，其中该第五开关的该第一端用于接收该系统高电压，该第五开关的该第二端耦接于该第一节点，该第五开关的该控制端用于接收该发光控制信号；以及
一第二电容单元，包含一第一端和一第二端，其中该第二电容单元的该第一端用于接收该系统高电压，该第二电容单元的该第二端耦接于该第四节点。
9.如权利要求1的像素电路，其特征在于，其中该补偿电路包含：
一P型晶体管，包含一第一端、一第二端和一控制端，其中该P型晶体管的该第一端耦接于该第一节点，该P型晶体管的该第二端耦接于一第四节点，该P型晶体管的该控制端用于接收一第一控制信号；
一N型晶体管，包含一第一端、一第二端和一控制端，该N型晶体管的该第一端耦接于该第三节点，该N型晶体管的该第二端耦接于一第五节点，该N型晶体管的该控制端用于接收该第一控制信号；以及
一第一电容单元，耦接于该第四节点和该第五节点之间。
10.一种高亮度显示器，其特征在于，包含：
多个像素电路；以及
一驱动线，用于提供一第一数据信号和一第二数据信号至该多个像素电路的一列像素电路；
其中当该高亮度显示器运作于一普通模式时，该第一数据信号为直流信号且该第二数据信号为交流信号，该列像素电路的其中一像素电路的一驱动电流具有一第一最大电流值，
其中当该高亮度显示器运作于一高亮度模式时，该第一数据信号和该第二数据信号皆为交流信号，该像素电路的该驱动电流具有一第二最大电流值，
其中该第二最大电流值大于该第一最大电流值。
11.如权利要求10的高亮度显示器，其特征在于，其中该像素电路自该高亮度显示器接收一第一参考电压，
其中当该高亮度显示器运作于该普通模式时，该第一数据信号的电压电位与该第一参考电压相同，
其中当该高亮度显示器运作于该高亮度模式时，该第一数据信号和该第二数据信号其中一者的电压电位低于该第一参考电压。
12.如权利要求10的高亮度显示器，其特征在于，其中，该像素电路包含：
一驱动晶体管，包含一第一端、一第二端和一控制端，其中该驱动晶体管的该第一端耦接于一第一节点，该驱动晶体管的该第二端耦接于一第二节点，该驱动晶体管的该控制端耦接于一第三节点；
一补偿电路，耦接于该第一节点和该第三节点，用于驱动该驱动晶体管产生该驱动电流；
一写入电路，用于选择性地提供该第一数据信号和该第二数据信号至该补偿电路，其中当该补偿电路接收到该第一数据信号时，该补偿电路将该第一节点的一第一节点电压设置为正相关于该驱动晶体管的临界电压的绝对值；
一发光控制电路，用于提供一系统高电压至该第一节点；
一重置电路，耦接于该第二节点和该第三节点，用于重置该第二节点的一第二节点电压和该第三节点的一第三节点电压；以及
一发光单元，包含一第一端和一第二端，其中该发光单元的该第一端用于接收该驱动电流，该发光单元的该第二端用于接收一系统低电压。
13.如权利要求12的高亮度显示器，其特征在于，其中当该高亮度显示器运作于该高亮度模式时，该驱动电流的大小负相关于该像素电路接收到的该第一数据信号的电压电位和该第二数据信号的电压电位之和。
14.如权利要求12的高亮度显示器，其特征在于，其中该补偿电路包含：
一第一开关，包含一第一端、一第二端和一控制端，其中该第一开关的该第一端耦接于该第一节点，该第一开关的该第二端耦接于一第四节点，该第一开关的该控制端用于接收一第一控制信号；
一第二开关，包含一第一端、一第二端和一控制端，该第二开关的该第一端耦接于该第三节点，该第二开关的该第二端耦接于一第五节点，该第二开关的该控制端用于接收一第二控制信号；以及
一第一电容单元，耦接于该第四节点和该第五节点之间。
15.如权利要求14的高亮度显示器，其特征在于，其中该写入电路包含：
一第三开关，包含一第一端、一第二端和一控制端，其中该第三开关的该第一端耦接于该第四节点，该第三开关的该第二端耦接于该驱动线，该第三开关的该控制端用于接收一第三控制信号；以及
一第四开关，包含一第一端、一第二端和一控制端，其中该第四开关的该第一端耦接于该第五节点，该第四开关的该第二端耦接于该驱动线，该第四开关的该控制端用于接收该第一控制信号。
16.如权利要求15的高亮度显示器，其特征在于，其中该发光控制电路包含：
一第五开关，包含一第一端、一第二端和一控制端，其中该第五开关的该第一端用于接收该系统高电压，该第五开关的该第二端耦接于该第一节点，该第五开关的该控制端用于接收一发光控制信号；以及
一第二电容单元，包含一第一端和一第二端，其中该第二电容单元的该第一端用于接收该系统高电压，该第二电容单元的该第二端耦接于该第四节点。
17.如权利要求16的高亮度显示器，其特征在于，其中于一重置阶段，该第一控制信号和该发光控制信号处于一致能电位，该第二控制信号和该第三控制信号处于一禁能电位，
其中于一补偿阶段，该第一控制信号处于该致能电位，该第二控制信号、该第三控制信号和该发光控制信号处于该禁能电位，
其中于一写入阶段，该第一控制信号处于该禁能电位，该第二控制信号、该第三控制信号和该发光控制信号处于该致能电位，
其中于一发光阶段，该第二控制信号和该发光控制信号处于该致能电位，该第一控制信号和该第三控制信号处于该禁能电位。
18.如权利要求14的高亮度显示器，其特征在于，其中该重置电路包含：
一第六开关，包含一第一端、一第二端和一控制端，其中该第六开关的该第一端耦接于该第三节点，该第六开关的该第二端用于接收该第一参考电压，该第六开关的该控制端用于接收该第一控制信号；以及
一第七开关，包含一第一端、一第二端和一控制端，该第七开关的该第一端用于接收一第二参考电压，该第七开关的该第二端耦接于该第二节点和该发光单元的该第一端。
19.如权利要求12的高亮度显示器，其特征在于，其中该补偿电路包含：
一第一开关，包含一第一端、一第二端和一控制端，其中该第一开关的该第一端耦接于该第一节点，该第一开关的该第二端耦接于一第四节点，该第一开关的该控制端用于接收一第一控制信号；
一第二开关，包含一第一端、一第二端和一控制端，该第二开关的该第一端耦接于该第三节点，该第二开关的该第二端耦接于一第五节点，该第二开关的该控制端用于接收一发光控制信号；以及
一第一电容单元，耦接于该第四节点和该第五节点之间；
其中该发光控制电路包含：
一第三开关，包含一第一端、一第二端和一控制端，其中该第五开关的该第一端用于接收该系统高电压，该第五开关的该第二端耦接于该第一节点，该第五开关的该控制端用于接收该发光控制信号；以及
一第二电容单元，包含一第一端和一第二端，其中该第二电容单元的该第一端用于接收该系统高电压，该第二电容单元的该第二端耦接于该第四节点。
20.如权利要求12的高亮度显示器，其特征在于，其中该补偿电路包含：
一P型晶体管，包含一第一端、一第二端和一控制端，其中该P型晶体管的该第一端耦接于该第一节点，该P型晶体管的该第二端耦接于一第四节点，该P型晶体管的该控制端用于接收一第一控制信号；
一N型晶体管，包含一第一端、一第二端和一控制端，该N型晶体管的该第一端耦接于该第三节点，该N型晶体管的该第二端耦接于一第五节点，该N型晶体管的该控制端用于接收该第一控制信号；以及
一第一电容单元，耦接于该第四节点和该第五节点之间。
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