CN108988848A - 现有边沿式高阻型数字鉴相器输出端优化设计案 - Google Patents

现有边沿式高阻型数字鉴相器输出端优化设计案 Download PDF

Info

Publication number
CN108988848A
CN108988848A CN201710401843.6A CN201710401843A CN108988848A CN 108988848 A CN108988848 A CN 108988848A CN 201710401843 A CN201710401843 A CN 201710401843A CN 108988848 A CN108988848 A CN 108988848A
Authority
CN
China
Prior art keywords
state
phase discriminator
qrqc
wrwc
pdo
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN201710401843.6A
Other languages
English (en)
Other versions
CN108988848B (zh
Inventor
张伟林
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Individual
Original Assignee
Individual
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Individual filed Critical Individual
Priority to CN201710401843.6A priority Critical patent/CN108988848B/zh
Publication of CN108988848A publication Critical patent/CN108988848A/zh
Application granted granted Critical
Publication of CN108988848B publication Critical patent/CN108988848B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00—Automatic control of frequency or phase; Synchronisation
    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08—Details of the phase-locked loop
    • H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
    • Y02P90/00—Enabling technologies with a potential contribution to greenhouse gas [GHG] emissions mitigation
    • Y02P90/02—Total factory control, e.g. smart factories, flexible manufacturing systems [FMS] or integrated manufacturing systems [IMS]

Landscapes

  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
  • Networks Using Active Elements (AREA)

Abstract

本发明案中的鉴相器内部电路如图3所示，工作原理为：a.初态(复位后)初态时WrWc=00时，QrQc=01，PDo=高阻态。b.处在初态下的一个输入信号上升边沿到达WrWc=↑0时，QrQc=11，PDo=“1”态；WrWc=0↑时，QrQc=00，PDo=“0”态。c.处在非初态下的一个输入信号上升边沿到达WrWc=‑↑/↑‑时，QrQc=10，PDo=高阻态。d.处在任意态下输入信号的上升边沿同时到达WrWc=↑↑时，QrQc=10，PDo=高阻态。

Description

现有边沿式高阻型数字鉴相器输出端优化设计案
技术领域
本发明涉及到一种边沿式高阻型数字鉴相器(以下简称为边沿式鉴相器)输出端的优化设计方法，本发明所涉及的电路形式不仅适合于通用型数字IC芯片组建数字鉴相器，更适合应用于集成化电路设计的边沿式鉴相器电路中。
背景技术
现有边沿式鉴相器仅有一种形式，其中之一型号为为图1所示IC的74HC4046鉴相器，分析其输入输出信号间关系可以归纳出工作定义为如下：
a.初态
每一次复位后鉴相器都回归到初态这一常态，标志为WrWc=--(QrQc=11)，鉴相器输出PDo=高阻态。其中-为任意码，以下同。
b.D触发器的工作特征
输入信号Wr与Wc有着各自独立的上升边沿触发式D触发器，处在初态即触发器输出Q=“0”码时的D触发器一旦有上升边沿触发信号，输出Q=“1”码。这种输出状态保持到复位条件形成为止，一旦复位后输出回归到Q=“0”码；即Q=“1”是过渡态不是常态。
c.输出Q=“1”码时的最短时间至少有形成复位信号输出所需最短时间即图1中与非门的一个周期的工作时间，与D触发器复位时所需一个工作周期的时间之和。
d.鉴相器输出状态取决于二个D触发器输出的QrQc码值。定义初态QrQc=11(WrWc=--)时PDo=高阻态；有相位检出即边沿有效触发时如果QrQc=01(WrWc=↑-)则PDo=“H”态，如果QrQc=10(WrWc=-↑)则PDo=“L”态；相位检出结束的标志是QrQc=00这一过度状态，规定为PDo=高阻态。
或者，现有边沿式鉴相器的状态迁移图可以归纳为图2所示：无论Wc还是Wr都是单边方向有效，在任意“态”下只要同步信号到达，都回归到高阻态。
发明内容
本发明内容包含了对现有边沿式鉴相器的输出控制端作出如下改动设计：
a.Qr信号从取自D触发器反相端输出Q为正端输出Q；
b.Qr侧输出控制端器件从3个集约为一个的与非门IC1；
c.Qc侧输出控制端器件从2个集约为一个的或非门IC2。
结果并不改动图2所示的状态迁移图形式，实现了与原有边沿式鉴相器所有功能的一致性。
现有边沿式鉴相器在工作时序中存在着的问题
现有边沿式鉴相器在工作至少存在如下问题：
鉴相器中采用了从输入到输出二个独立的信号处理变换通道，图2所示的同步信号处理结果仅仅只是理想化的形式。由于器件的频率特性、冗余器件数的增加、二个场效应管开关各侧的器件数不对等性及延迟时间的差异性，同步输出形态在一定的时间宽度内具有不确定性，包括呈现出并不符合定义所规定的输入输出信号间关系，甚至有可能出现Vcc与GND经由二个场效应管开关都导通时的现象。
附图说明
图1是摘录自该芯片厂商的数据手册，型号为74HC4046的边沿式鉴相器内部电路结构图。
图2为74HC4046的边沿式高阻型数字鉴相器的简化状态迁移图。
图3是本发明的边沿式鉴相器内部电路结构图。
具体实施方式
图3电路中未含有A部分电路的工作原理说明如下：
a.初态(复位后)
初态时QrQc=01(WrWc=--)，与非门IC1输出为“1”态，断开p型场效应开关；或非门IC2输出为“0”态，断开n型场效应开关。所以，符合定义：QrQc=01(WrWc=--)时PDo=高阻态。
b.处在初态下的一个输入信号上升边沿到达
例如Wr上升边沿信号单独到达后该侧D触发器输出Q从“0”切换到“1”态，即有QrQc=11，所以IC1输出为“0”态，p型场效应开关改断开为导通；IC2输出为“0”态，保持n型场效应开关断开。符合定义：QrQc=11(WrWc=↑-)时PDo=“1”态。相反地，当Wc上升边沿信号单独到达后该侧D触发器输出的Q从“0”切换到“1”态，即有QrQc=00，所以IC1输出为“1”态，保持p型场效应开关断开；IC2输出为“0”态，n型场效应开关改断开为导通。符合定义：QrQc=00(WrWc=-↑)时PDo=0(L)态。
c.处在非初态下的另一个输入信号上升边沿到达
处在非初态下的鉴相器输入端，例如先期Wr上升边沿信号到达后的Wc上升边沿信号到达WrWc=-↑时，或者先期Wc上升边沿信号到达后的Wr上升边沿信号到达为WrWc=↑-时；由于QrQc=10，IC1输出为“1”态，断开p型场效应开关；IC2输出为“0”态，断开n型场效应开关。同时，由于与门IC3的输入码为“11”，输出改“0”态为“1”态，启动复位实现鉴相器输出回归到初态，符合图2所示的状态迁移图中的规定。所以，符合定义：QrQc=10→01(WrWc=-↑/↑-)时PDo=高阻态。
d.处在任意态下输入信号的上升边沿同时到达
无论鉴相器是处于何种状态，当输入信号Wr与Wc的上升边沿同时到达时，由于WrWc=↑↑则QrQc=10，启动复位则IC3输出一个有效的复位信号，实现鉴相器回归到初态即符合定义：QrQc=10→01(WrWc=↑↑)时PDo=高阻态。
最后，符合专利申请号为2015106449019的《标准化设计高阻型数字鉴相器的结构原理方案》中鉴相器规定要求的改动为增加图3所示电路中的虚线框A的电路，内中IC4为一个同或门；输入信号为Qr与Qc，输出为INH，同时Qr即为规定鉴相器中的a端输出信号。
综合以上内容，这是一个异步码电平式高阻型数字鉴相器的雏型，而现有边沿式鉴相器内含了一个同步码电平式高阻型数字鉴相器的雏型；完成的设计目标：简化了现有高阻型数字鉴相器输出控制端的期间数量，降低了鉴相器输出态在一定时间宽度内的不确定性风险。

Claims (1)

1.《说明书附图》中图3所示“本发明的边沿式高阻型数字鉴相器内部电路结构图”及内容。
CN201710401843.6A 2017-06-01 2017-06-01 现有边沿式高阻型数字鉴相器输出端优化设计案 Active CN108988848B (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201710401843.6A CN108988848B (zh) 2017-06-01 2017-06-01 现有边沿式高阻型数字鉴相器输出端优化设计案

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201710401843.6A CN108988848B (zh) 2017-06-01 2017-06-01 现有边沿式高阻型数字鉴相器输出端优化设计案

Publications (2)

Publication Number Publication Date
CN108988848A true CN108988848A (zh) 2018-12-11
CN108988848B CN108988848B (zh) 2022-08-23

Family

ID=64501419

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201710401843.6A Active CN108988848B (zh) 2017-06-01 2017-06-01 现有边沿式高阻型数字鉴相器输出端优化设计案

Country Status (1)

Country Link
CN (1) CN108988848B (zh)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN111327312A (zh) * 2018-12-14 2020-06-23 张伟林 适合时滞型vco组环的边沿式高阻型数字鉴相器
CN112311387A (zh) * 2019-08-01 2021-02-02 张伟林 不同触发器组合的高阻型数字鉴相器
CN112350719A (zh) * 2019-08-07 2021-02-09 张伟林 正交化的边沿式高阻型鉴相器组环锁相环

Citations (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5774023A (en) * 1997-04-30 1998-06-30 Motorola, Inc. Adaptive phase locked loop system with charge pump having dual current output
CN1380749A (zh) * 2001-04-10 2002-11-20 日本电气株式会社 锁相检测电路
US20050083136A1 (en) * 2003-10-20 2005-04-21 Hwey-Ching Chien Charge pump for phase-locked loop
US20090146713A1 (en) * 2007-12-05 2009-06-11 Sony Corporation Clock signal generating circuit, display panel module, imaging device, and electronic equipment
CN101534120A (zh) * 2009-04-09 2009-09-16 华为技术有限公司 锁相环电路及其充电方法
CN101789784A (zh) * 2009-12-15 2010-07-28 北京时代民芯科技有限公司 用于延时锁定环的可配置鉴相器
CN101841328A (zh) * 2010-06-07 2010-09-22 西安交通大学 一种预充电型鉴频鉴相器
CN102111150A (zh) * 2009-12-23 2011-06-29 中国科学院微电子研究所 一种用于鉴频鉴相器的数字边沿对齐器
CN103312318A (zh) * 2013-05-20 2013-09-18 浙江大学 一种高精度鉴频鉴相器
JP2014183531A (ja) * 2013-03-21 2014-09-29 Sony Corp 位相同期回路及びクロック・データ・リカバリ回路
CN104954014A (zh) * 2014-03-31 2015-09-30 中国科学院微电子研究所 一种超前-滞后型数字鉴相器结构
CN106301360A (zh) * 2015-05-28 2017-01-04 上海东软载波微电子有限公司 鉴频鉴相器、电荷泵和锁相环电路
CN106571813A (zh) * 2015-10-09 2017-04-19 张伟林 全新设计的边沿式高阻型数字鉴相器
CN106571815A (zh) * 2015-10-09 2017-04-19 张伟林 电平式高阻型数字鉴相器
CN106612116A (zh) * 2015-10-22 2017-05-03 张伟林 现有边沿式高阻型数字鉴相器的新设计方法

Patent Citations (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5774023A (en) * 1997-04-30 1998-06-30 Motorola, Inc. Adaptive phase locked loop system with charge pump having dual current output
CN1380749A (zh) * 2001-04-10 2002-11-20 日本电气株式会社 锁相检测电路
US20050083136A1 (en) * 2003-10-20 2005-04-21 Hwey-Ching Chien Charge pump for phase-locked loop
US20090146713A1 (en) * 2007-12-05 2009-06-11 Sony Corporation Clock signal generating circuit, display panel module, imaging device, and electronic equipment
CN101534120A (zh) * 2009-04-09 2009-09-16 华为技术有限公司 锁相环电路及其充电方法
CN101789784A (zh) * 2009-12-15 2010-07-28 北京时代民芯科技有限公司 用于延时锁定环的可配置鉴相器
CN102111150A (zh) * 2009-12-23 2011-06-29 中国科学院微电子研究所 一种用于鉴频鉴相器的数字边沿对齐器
CN101841328A (zh) * 2010-06-07 2010-09-22 西安交通大学 一种预充电型鉴频鉴相器
JP2014183531A (ja) * 2013-03-21 2014-09-29 Sony Corp 位相同期回路及びクロック・データ・リカバリ回路
CN103312318A (zh) * 2013-05-20 2013-09-18 浙江大学 一种高精度鉴频鉴相器
CN104954014A (zh) * 2014-03-31 2015-09-30 中国科学院微电子研究所 一种超前-滞后型数字鉴相器结构
CN106301360A (zh) * 2015-05-28 2017-01-04 上海东软载波微电子有限公司 鉴频鉴相器、电荷泵和锁相环电路
CN106571813A (zh) * 2015-10-09 2017-04-19 张伟林 全新设计的边沿式高阻型数字鉴相器
CN106571815A (zh) * 2015-10-09 2017-04-19 张伟林 电平式高阻型数字鉴相器
CN106612116A (zh) * 2015-10-22 2017-05-03 张伟林 现有边沿式高阻型数字鉴相器的新设计方法

Non-Patent Citations (3)

* Cited by examiner, † Cited by third party
Title
TAKAYUKI SHIBASAKI: "22.7 4×25.78Gb/s retimer ICs for optical links in 0.13μm SiGe BiCMOS", 《2015 IEEE INTERNATIONAL SOLID-STATE CIRCUITS CONFERENCE - (ISSCC) DIGEST OF TECHNICAL PAPERS》 *
杨校辉: "低噪声锁相环设计", 《中国优秀博硕士学位论文全文数据库(硕士)信息科技辑》 *
蔡霞: "一种解决死区问题的数字鉴频鉴相器设计", 《科技经济市场》 *

Cited By (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN111327312A (zh) * 2018-12-14 2020-06-23 张伟林 适合时滞型vco组环的边沿式高阻型数字鉴相器
CN111327312B (zh) * 2018-12-14 2024-04-19 张伟林 适合时滞型vco组环的边沿式高阻型数字鉴相器
CN112311387A (zh) * 2019-08-01 2021-02-02 张伟林 不同触发器组合的高阻型数字鉴相器
CN112311387B (zh) * 2019-08-01 2024-06-07 张伟林 不同触发器组合的高阻型数字鉴相器
CN112350719A (zh) * 2019-08-07 2021-02-09 张伟林 正交化的边沿式高阻型鉴相器组环锁相环
CN112350719B (zh) * 2019-08-07 2022-02-11 张伟林 正交化的边沿式高阻型鉴相器组环锁相环

Also Published As

Publication number Publication date
CN108988848B (zh) 2022-08-23

Similar Documents

Publication Publication Date Title
CN108988848A (zh) 现有边沿式高阻型数字鉴相器输出端优化设计案
CN105656457B (zh) 反相器、环形振荡器以及热传感器
CN102571053A (zh) 交流固态功率开关控制方法及开关装置
CN107732875A (zh) 固态断路器及电机驱动系统
US10394262B2 (en) Voltage regulation method, controller, and chip
CN111880069A (zh) 一种基于开通电流斜率的半导体器件结温在线检测系统
US8130022B2 (en) Ultra-low current push-button switch interface circuit
CN106571812A (zh) 标准化设计高阻型数字鉴相器的结构原理方案
CN106371347B (zh) 功能可编程电路及其操作方法
CN107168452B (zh) 一种按键输入处理电路
CN106612116A (zh) 现有边沿式高阻型数字鉴相器的新设计方法
CN104426528B (zh) 多电压输入缓冲器及其相关方法
CN106571813A (zh) 全新设计的边沿式高阻型数字鉴相器
CN106571815A (zh) 电平式高阻型数字鉴相器
CN208673178U (zh) 一种单火取电芯片
CN106292827A (zh) 一种电压产生装置及半导体芯片
CN108886321A (zh) 用于控制多个功率半导体器件的系统和方法
CN202602603U (zh) 一种交流固态继电器
US20220078668A1 (en) Aggregation of data for frames or disaggregation of data from frames
CN105915209B (zh) 一种多功能低功耗熔丝修调控制电路及其控制方法
CN104463311B (zh) 一种改善非接触卡强场调制波形和调制深度的电路
CN112311387B (zh) 不同触发器组合的高阻型数字鉴相器
CN209572001U (zh) 一种信号传输管的驱动电路和电平转换电路
CN101515162B (zh) 用数字化配置方式的舵机控制集成电路的设计方法
CN105652102A (zh) 感测电路

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant