CN107767819A - 像素驱动电路及方法、显示装置 - Google Patents

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Abstract

本公开提供了一种像素驱动电路及驱动方法、显示装置。应用于显示技术领域。该像素驱动电路包括：第一开关元件、第二开关元件、第三开关元件、第四开关元件、第五开关元件、第六开关元件、驱动晶体管以及存储电容。本公开改善了迟滞效应产生的短期残像问题，提高了显示质量，同时也消除驱动晶体管的阈值电压对驱动电流的影响，保证了各像素显示亮度的均一性。

Description

像素驱动电路及方法、显示装置
技术领域
本公开涉及显示技术领域，尤其涉及一种像素驱动电路及像素驱动方法、显示装置。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)作为一种电流型发光器件，因其所具有的自发光、快速响应、宽视角和可制作在柔性衬底上等特点而越来越多地被应用于高性能显示领域当中。OLED显示屏是利用有机发光二极管制成的显示屏。由于同时具备自发光，不需背光源、对比度高、厚度薄、视角广、反应速度快、可用于挠曲性面板、使用温度范围广、构造及制程较简单等优异之特性，被认为是下一代的平面显示器新兴应用技术。
目前，由于像素驱动电路中的驱动晶体管的迟滞效应，使得OLED显示屏在点亮黑白画面一段时间后切换到48灰阶画面时发生短期残像。所谓迟滞效应主要由残留的可移动离子造成阈值电压的偏移所造成，当VGS(晶体管的栅极和源极之间的电压)越小(即越负)，则ACT/GI介面捕捉越多的电荷，因此阈值电压产生负偏；当VGS(晶体管的栅极和源极之间的电压)越大(即越正)，则被ACT/GI介面捕捉的电荷被释放出来，因此阈值电压产生正偏。目前使用的像素驱动电路中，由于在不同画面切换的情况下，驱动晶体管的初始化阶段的VGS(栅极和源极之间的电压)皆不尽相同，故残留的可移动离子的状态不同，而造成短期残像。
因此，需要提供一种可以消除残像的像素驱动电路。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
发明内容
本公开的目的在于提供一种像素驱动电路及像素驱动方法、显示装置，进而至少在一定程度上克服由于相关技术的限制和缺陷而导致的一个或者多个问题。
根据本公开的一个方面，提供一种像素驱动电路，用于驱动电致发光元件，所述像素驱动电路包括：
第一开关元件，与第一节点连接，用于响应第一扫描信号而导通，以将复位信号传输至所述第一节点；
第二开关元件，与第二节点连接，用于响应所述第一扫描信号而导通，以将所述复位信号传输至所述第二节点；
第三开关元件，与第四节点连接，用于响应第二扫描信号而导通，以将数据信号传输至所述第四节点；
第四开关元件，与所述第四节点连接，用于响应控制信号而导通，以将第一电源信号传输至所述第四节点；
第五开关元件，与所述第二节点和第三节点连接，用于响应所述控制信号而导通，以将所述第三节点与所述第二节点连通，所述第二节点与所述电致发光元件藕接；
第六开关元件，与所述第一节点和所述第三节点连接，用于响应所述第二扫描信号而导通，以将所述第一节点和所述第三节点连通；
驱动晶体管，与所述第三节点和所述第四节点连接，用于响应所述第一节点的电压信号而导通，以将所述第四节点的信号传输至所述第三节点；
存储电容，第一端与所述第一节点藕接，第二端接收所述第一电源信号。
在本公开的一种示例性实施例中，所述第一开关元件至所述第六开关元件以及所述驱动晶体管均分别具有控制端、第一端以及第二端，其中：
所述第一开关元件的控制端接收所述第一扫描信号，所述第一开关元件的第一端与所述第一节点藕接，所述第一开关元件的第二端接收所述复位信号；
所述第二开关元件的控制端接收所述第一扫描信号，所述第二开关元件的第一端与所述第二节点藕接，所述第二开关元件的第二端接收所述复位信号；
所述第三开关元件的控制端接收所述第二扫描信号，所述第三开关元件的第一端接收所述数据信号，所述第三开关元件的第二端与所述第四节点藕接；
所述第四开关元件的控制端接收所述控制信号，所述第四开关元件的第一端接收所述第一电源信号，所述第四开关元件的第二端与所述第四节点藕接；
所述第五开关元件的控制端接收所述控制信号，所述第五开关元件的第一端与所述第三节点藕接，所述第五开关元件的第二端与所述第二节点藕接；
所述第六开关元件的控制端接收所述第二扫描信号，所述第六开关元件的第一端与所述第一节点藕接，所述第六开关元件的第二端与所述第三节点藕接；
所述驱动晶体管的控制端与所述第一节点藕接，所述驱动晶体管的第一端与所述第四节点藕接，所述驱动晶体管的第二端与所述第三节点藕接。
在本公开的一种示例性实施例中，所述像素驱动电路与第N行以及第N+1行扫描信号连接；其中，第N行扫描线用于输出所述第一扫描信号，第N+1行扫描信号线用于输出所述第二扫描信号；N为正整数。
在本公开的一种示例性实施例中，所述开关元件以及所述驱动晶体管均为P型薄膜晶体管，所述第一电源信号为高电平信号，所述电致发光元件的阳极与所述第二节点藕接，所述电致发光元件的阴极接收低电平信号。
在本公开的一种示例性实施例中，所述开关元件以及所述驱动晶体管均为N型薄膜晶体管，所述第一电源信号为低电平信号，所述电致发光元件的阴极与所述第二节点藕接，所述电致发光元件的阳极接收高电平信号。
在本公开的一种示例性实施例中，所述薄膜晶体管为非晶硅薄膜晶体管、多晶硅薄膜晶体管以及非晶-氧化铟镓锌薄膜晶体管中的一种。
根据本公开的一个方面，提供一种像素驱动方法，用于驱动上述任意一项所述的像素驱动电路，所述方法包括：
复位阶段，通过所述第一扫描信号以及所述控制信号导通所述第一开关元件、第二开关元件、第四开关元件以及第五开关元件导通；所述复位信号通过所述第一开关元件传输至所述第一节点，并通过所述第一节点的电压信号导通所述驱动晶体管；所述复位信号通过所述第二开关元件传输至所述第二节点并经过第五开关元件传输至所述第三节点；所述第一电源信号通过第四开关元件传输至所述第四节点；
数据写入及阈值补偿阶段，通过所述第二扫描信号导通所述第三开关元件和所述第六开关元件，以将所述数据信号和所述驱动晶体管的阈值电压写入所述第一节点；
驱动阶段，通过所述控制信号导通所述第四开关元件以及所述第五开关元件，以使所述驱动晶体管在所述第一节点的电压的控制下导通并在所述第一电源信号的作用下输出驱动电流，并流经所述第五开关元件以驱动所述电致发光元件进行发光。
在本公开的一种示例性实施例中，在所述开关元件均为P型薄膜晶体管时，所述开关元件的导通信号均为低电平信号。
在本公开的一种示例性实施例中，在所述开关元件均为N型薄膜晶体管时，所述开关元件的导通信号均为高电平信号。
根据本公开的一个方面，提供一种显示装置，包括上述任意一项所述的像素驱动电路。
本公开一种示例性实施例提供的一种像素驱动电路及像素驱动方法、显示装置，该像素驱动电路包括第一开关元件、第二开关元件、第三开关元件、第四开关元件、第五开关元件、第六开关元件、驱动晶体管以及存储电容。在该像素驱动电路的工作过程中，一方面，在复位阶段，通过第一扫描信号和控制信号导通第一开关元件、第二开关元件、第四开关元件以及第五开关元件，复位信号通过第一开关元件传输至第一节点，以对驱动晶体管的控制端进行复位并对存储电容的第一端进行充电，第一电源信号通过第四开关元件传输至第四节点，以使驱动晶体管的第一端的电压变为第一电源信号的电压，因此，不论前一帧的数据信号的电压为黑或白，驱动晶体管皆由偏执状态进入数据写入及阈值补偿阶段，从而改善了迟滞效应产生的短期残像问题，提高了显示质量；另一方面，在复位阶段，通过第一扫描信号导通第二开关元件，使复位信号通过第二开关元件传输至第二节点，以降低电致发光元件的第一极和第二极之间的电压差，在低灰阶时可降低电致发光元件的亮度，提高像素的对比度；又一方面，在数据写入及阈值补偿阶段，通过第二扫描信号导通第三开关元件以及第六开关元件，以将第一节点和第三节点连通，进而将数据信号和驱动晶体管的阈值电压写入第一节点，从而消除驱动晶体管的阈值电压对驱动电流的影响，保证了各像素显示亮度的均一性。
需要说明的是，在上述背景技术部分公开的信息仅用于加强对本公开的背景的理解，因此可以包括不构成对本领域普通技术人员已知的现有技术的信息。
附图说明
通过参照附图来详细描述其示例性实施例，本公开的上述和其它特征及优点将变得更加明显。显而易见地，下面描述中的附图仅仅是本公开的一些实施例，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。在附图中：
图1为本公开一示例性实施例中提供的像素驱动电路的示意图；
图2为本公开一示例性实施例中提供的像素驱动电路的工作时序图；
图3为本公开一示例性实施例中提供的像素驱动电路在复位阶段的等效电路图；
图4为本公开一示例性实施例中提供的像素驱动电路在数据写入及阈值补偿阶段的等效电路图；
图5为本公开一示例性实施例中提供的像素驱动电路在驱动阶段的等效电路图；
附图标记说明：
T1：第一开关元件；
T2：第二开关元件；
T3：第三开关元件；
T4：第四开关元件；
T5：第五开关元件；
T6：第六开关元件；
DT：驱动晶体管；
C：存储电容；
N1：第一节点；
N2：第二节点；
N3：第三节点；
N4：第四节点；
DATA：数据信号；
VINT：复位信号；
EM：控制信号：
G1：第一扫描信号；
G2：第二扫描信号；
ELVDD：第一电源信号；
ELVSS：第二电源信号。
具体实施方式
现在将参考附图更全面地描述示例实施例。然而，示例实施例能够以多种形式实施，且不应被理解为限于在此阐述的实施例；相反，提供这些实施例使得本公开将全面和完整，并将示例实施例的构思全面地传达给本领域的技术人员。所描述的特征、结构或特性可以以任何合适的方式结合在一个或更多实施例中。在下面的描述中，提供许多具体细节从而给出对本公开的实施例的充分理解。然而，本领域技术人员将意识到，可以实践本公开的技术方案而没有所述特定细节中的一个或更多，或者可以采用其它的方法、组元、材料、装置、步骤等。在其它情况下，不详细示出或描述公知技术方案以避免模糊本公开的各方面。
此外，附图仅为本公开的示意性图解，并非一定是按照比例绘制。图中相同的附图标记标识相同或相似的部分，因而将省略对它们的重复描述。
本示例实施方式中提供了一种像素驱动电路，用于驱动电致发光元件，参照图1所示，该像素驱动电路可以包括：第一开关元件T1、第二开关元件T2、第三开关元件T3、第四开关元件T4、第五开关元件T5、第六开关元件T6、驱动晶体管DT以及存储电容C。其中：
第一开关元件T1与第一节点N1连接，可以用于响应第一扫描信号G1而导通，以将初始化信号传输至第一节点N1。第二开关元件T2与第二节点N2连接，可以用于响应所述第一扫描信号G1而导通，以将所述初始化信号传输至第二节点N2。第三开关元件T3与第四节点N4连接，可以用于响应第二扫描信号G2而导通，以将数据信号DATA传输至第四节点N4。第四开关元件T4与所述第四节点N4连接，可以用于响应控制信号EM而导通，以将第一电源信号ELVDD传输至所述第四节点N4。第五开关元件T5与所述第二节点N2和所述第三节点N3连接，可以用于响应所述控制信号EM而导通，以将第三节点N3与所述第二节点N2连通，所述第二节点N2与所述电致发光元件藕接。第六开关元件T6与所述第一节点N1和所述第三节点N3连接，可以用于响应所述第二扫描信号G2而导通，以将所述第一节点N1和所述第三节点N3连通。驱动晶体管DT与所述第三节点N3和所述第四节点N4连接，可以用于响应所述第一节点N1的电压信号而导通，以将所述第四节点N4的信号传输至所述第三节点N3。存储电容C的第一端与所述第一节点N1藕接，存储电容C的第二端接收所述第一电源信号ELVDD。在复位阶段，该像素驱动电路可以对驱动晶体管DT的控制端进行复位，并使驱动晶体管DT的第一端的电压变为第一电源信号ELVDD的电压，进而使得驱动晶体管DT皆在偏执状态进入数据写入及阈值补偿阶段，从而改善了迟滞效应产生的短期残像问题，提高了显示质量；另外，在复位阶段，通过第一扫描信号G1导通第二开关元件T2，使复位信号VINT通过第二开关元件T2传输至第二节点N2，以降低电致发光元件的第一极和第二极之间的电压差，在低灰阶时可降低电致发光元件的亮度，提高像素的对比度；此外，在数据写入及阈值补偿阶段，该像素驱动电路可以将数据信号DATA和驱动晶体管DT的阈值电压写入第一节点N1，从而消除驱动晶体管DT的阈值电压对驱动电流的影响，保证了各像素显示亮度的均一性。下面，将参照图1对上述像素驱动电路进行更详细的说明。
在本示例性实施例中，上述第一开关元件T1至所述第六开关元件T6以及所述驱动晶体管DT均分别具有控制端、第一端以及第二端，其中：
所述第一开关元件T1的控制端接收所述第一扫描信号G1，所述第一开关元件T1的第一端与所述第一节点N1藕接，所述第一开关元件T1的第二端接收所述初始化信号。所述第二开关元件T2的控制端接收所述第一扫描信号G1，所述第二开关元件T2的第一端与所述第二节点N2藕接，所述第二开关元件T2的第二端接收所述初始化信号。所述第三开关元件T3的控制端接收所述第二扫描信号G2，所述第三开关元件T3的第一端接收所述数据信号DATA，所述第三开关元件T3的第二端与所述第四节点N4藕接。所述第四开关元件T4的控制端接收所述控制信号EM，所述第四开关元件T4的第一端接收所述第一电源信号ELVDD，所述第四开关元件T4的第二端与所述第四节点N4藕接。所述第五开关元件T5的控制端接收所述控制信号EM，所述第五开关元件T5的第一端与所述第三节点N3藕接，所述第五开关元件T5的第二端与所述第二节点N2藕接。所述第六开关元件T6的控制端接收所述第二扫描信号G2，所述第六开关元件T6的第一端与所述第一节点N1藕接，所述第六开关元件T6的第二端与所述第三节点N3藕接。所述驱动晶体管DT的控制端与所述第一节点N1藕接，所述驱动晶体管DT的第一端与所述第四节点N4藕接，所述驱动晶体管DT的第二端与所述第三节点N3藕接。
在本示例性实施例中，所述第一开关元件T1至第六开关元件T6可以分别对应第一开关晶体管至第六开关晶体管。各开关晶体管均分别具有控制端、第一端以及第二端。例如，各开关晶体管的控制端可以为栅极，各开关晶体管的第一端可以为源极，各开关晶体管的第二端可以为漏极。再例如，各开关晶体管的控制端可以为栅极，各开关晶体管的第一端可以为漏极，各开关晶体管的第二端可以为源极。此外，各开关晶体管可以为增强型晶体管或者耗尽型晶体管，本示例性实施例对此不作特殊限定。需要说明的是，由于开关晶体管的源极和漏极对称，因此，第一开关晶体管至第六开关晶体管的源极、漏极可以互换。
所述驱动晶体管DT具有控制端、第一端以及第二端。例如，驱动晶体管DT的控制端可以为栅极，驱动晶体管DT的第一端可以为源极、驱动晶体管DT的第二端可以为漏极。再例如，驱动晶体管DT的控制端可以为栅极，驱动晶体管DT的第一端可以为漏极，驱动晶体管DT的第二端可以为源极。此外，驱动晶体管DT可以为增强型驱动晶体管或耗尽型驱动晶体管，本示例性实施例对此不作特殊限定。
所述存储电容C的类型可以根据具体的电路进行选择。例如，所述存储电容C可以为MOS电容、金属电容或双多晶电容，但本示例性实施例中的存储电容不限于此。
所述电致发光元件为电流驱动型电致发光元件，由流经驱动晶体管DT的电流控制其进行发光，例如，OLED，但本示例性实施例中的电致发光元件不限于此。此外，电致发光元件具有第一极和第二极。例如，电致发光元件的第一极可以为阳极，电致发光元件的第二极可以为阴极。再例如，电致发光元件的第一极可以为阴极，电致发光元件的第二极可以为阳极。
在阵列排布的多个像素驱动电路中，为了复用各像素驱动电路中的第一扫描信号G1和第二扫描信号G2，以简化阵列排布的多个像素驱动电路的电路结构以及实现逐行扫描。所述像素驱动电路与第N行以及第N+1行扫描信号线连接；其中，第N行扫描信号线用于输出所述第一扫描信号G1，第N+1行扫描信号线用于输出所述第二扫描信号G2；N为正整数。具体的，像素驱动电路中的第一开关元件T1的控制端和第二开关元件T2的控制端均连接第N行扫描信号线，像素驱动电路中的第三开关元件T3的控制端和第六开关元件T6的控制端连接第N+1行扫描信号线。
在所述开关元件(即第一开关元件至第六开关元件T1～T6)以及所述驱动晶体管DT均为P型薄膜晶体管时，所述第一电源信号ELVDD为高电平信号，所述电致发光元件的阳极与所述第二节点N2藕接，所述电致发光元件的阴极接收第二电源信号ELVSS，所述电致发光元件的阴极接收低电平信号，即，第二电源信号ELVSS为低电平信号。
在所述开关元件(即第一开关元件至第六开关元件T1～T6)以及所述驱动晶体管DT均为N型薄膜晶体管时，所述第一电源信号ELVDD为低电平信号，所述电致发光元件的阴极与所述第二节点N2藕接，所述电致发光元件的阳极接收第二电源信号ELVSS，所述电致发光元件的阳极接收高电平信号，即，第二电源信号ELVSS为高电平信号。
进一步的，上述薄膜晶体管的类型可以根据电路的具体要求进行选择。例如，薄膜晶体管可以为非晶硅薄膜晶体管、多晶硅薄膜晶体管以及非晶-氧化铟镓锌薄膜晶体管中的一种，但本示例性实施例中的薄膜晶体管不限于此。
在本公开的示例性实施例中，还提供了一种像素驱动方法，用于驱动如图1所述的像素驱动电路。下面，结合图2所示的像素驱动电路的工作时序图对图1中的像素驱动电路的工作过程加以详细的说明，以所有开关元件均为P型薄膜晶体管、驱动晶体管DT为P型驱动晶体管为例。由于所有开关元件均为P型薄膜晶体管，因此，所有开关元件的导通信号均为低电平信号。第一电源信号ELVDD为高电平信号，第二电源信号ELVSS为低电平信号。该驱动时序图绘示了第一扫描信G1，第二扫描信号G2、控制信号EM以及数据信号DATA。
在初始化阶段(即T1阶段)，通过所述第一扫描信号G1以及所述控制信号EM导通所述第一开关元件T1、第二开关元件T2、第四开关元件T4以及第五开关元件T5导通；所述复位信号VINT通过所述第一开关元件T1传输至所述第一节点N1，并通过所述第一节点N1的电压信号导通所述驱动晶体管DT；所述复位信号VINT通过所述第二开关元件T2传输至所述第二节点并经过所述第五开关元件T5传输至所述第三节点N3；所述第一电源信号ELVDD通过第四开关元件T4传输至所述第四节点N4。
在本示例性实施例中，第一扫描信号G1处于低电平，第二扫描信号G2处于高电平，控制信号EM处于低电平，数据信号DATA处于低电平。如图3所示，第一开关元件T1、第二开关元件T2、第四开关元件T4以及第五开关元件T5均导通，第三开关元件T3、第六开关元件T6均关闭；复位信号VINT通过第一开关元件T1传输至第一节点N1，以对驱动晶体管DT的控制端进行复位并对存储电容C的第一端进行充电，此时，驱动晶体管DT的控制端的电压变为VINT，且该驱动晶体管DT的控制端在VINT的作用下导通；第一电源信号ELVDD通过第四开关元件T4传输至第四节点N4，以使驱动晶体管DT的第一端的电压变为ELVDD，此时，驱动晶体管DT的控制端与第一端之间的电源变为VINT-ELVDD，因此，不论上一帧数据信号的电压为黑或白，驱动晶体管DT皆由偏执状态进入数据写入及阈值电压补偿阶段，从而改善了迟滞效应产生的短期残像问题，提高了显示质量。此外，复位信号VINT通过第二开关元件T2传输至第二节点N2，以降低电致发光元件的第一极和第二极之间的电压差，在低灰阶时可降低电致发光元件的亮度，提高像素的对比度。
在数据写入及阈值补偿阶段(即T2阶段)，通过所述第二扫描信号G2导通所述第三开关元件T3和所述第六开关元件T6，以将所述数据信号DATA和所述驱动晶体管DT的阈值电压写入所述第一节点N1。
在本示例性实施例中，第一扫描信号G1为高电平，第二扫描信号G2为低电平，控制信号EM为高电平，数据信号DATA为高电平。如图4所示，第三开关元件T3和第六开关元件T6导通，第一开关元件T1、第二开关元件T2、第四开关元件T4以及第五开关元件T5关闭；数据信号DATA通过第三开关元件T3传输至第四节点N4，此时，由于第六开关元件T6导通，使得第一节点N1和第三节点N3连通，即将驱动晶体管DT的控制端和第二端连通，以将数据信号DATA和驱动晶体管DT的阈值电压Vth写入第一节点N1，因此，第一节点N1的电压变为DATA+Vth。
驱动阶段(即T3阶段)，通过所述控制信号EM导通所述第四开关元件T4以及所述第五开关元件T5，以使所述驱动晶体管DT在所述第一节点N1的电压的控制下导通并在所述第一电源信号ELVDD的作用下输出驱动电流，并流经所述第五开关元件T5以驱动所述电致发光元件进行发光。
在本示例性实施例中，第一扫描信号G1为高电平，第二扫描信号G2为高电平、控制信号为低电平、数据信号DATA为低电平。如图5所示，第一开关元件T1、第二开关元件T2、第三开关元件T3、第六开关元件T6关闭，第四开关元件T4、第五开关元件T5导通；此时，驱动晶体管DT的控制端在第一节点N1的电压DATA+Vth的控制下导通；第一电源信号ELVDD通过第四开关元件T4传输至驱动晶体管DT的第一端，使得驱动晶体管DT的第一端的电压变为ELVDD，此时，驱动晶体管DT在驱动晶体管DT的第一端的电压ELVDD的作用下输出驱动电流，并通过第五开关元件T5将驱动电流传输至电致发光元件，以驱动电致发光元件进行发光。
在此基础上，根据驱动晶体管DT的驱动电流的计算公式：
Ion＝K×(Vgs-Vth)2＝K×(Vg-Vs-Vth)2
＝K×(DATA+Vth-ELVDD-Vth)2
＝K×(DATA-ELVDD)2
其中，其中，Vgs为驱动晶体管DT的栅极和源极之间的电压差、Vg为驱动晶体管DT的栅极电压、Vs为驱动晶体管DT的源极电压、Vth为驱动晶体管DT的阈值电压。
由此可知，驱动晶体管DT的驱动电流与驱动晶体管DT的阈值电压Vth无关。由上可知，在数据写入及阈值补偿阶段，通过第二扫描信号G2导通第三开关元件T3以及第六开关元件T6，以将第一节点N1和第三节点N3连通，进而将数据信号DATA和驱动晶体管DT的阈值电压Vth写入第一节点N1，从而消除驱动晶体管DT的阈值电压Vth对驱动电流的影响，保证了各像素显示亮度的均一性。
采用全P型薄膜晶体管具有以下优点：例如对噪声抑制力强；例如由于是低电平导通，而充电管理中低电平容易实现；例如P型薄膜晶体管制程简单，相对价格较低；例如P型薄膜晶体管的稳定性更好等等。
需要说明的是：在上述具体的实施例中，所述开关元件均为P型薄膜晶体管；但本领域技术人员容易根据本公开所提供的像素驱动电路得到所述开关元件均为N型薄膜晶体管的像素驱动电路。在本公开的一种示例性实施方式中，所述开关元件可以均为N型薄膜晶体管，由于所述开关元件均为N型薄膜晶体管，因此所述开关元件的导通信号均为高电平信号。当然，本公开所提供的像素驱动电路也可以改为CMOS(Complementary Metal OxideSemiconductor，互补金属氧化物半导体)电路等，并不局限于本实施例中所提供的像素驱动电路，这里不再赘述。
本示例实施方式还提供一种显示装置，包括上述的像素驱动电路。该显示装置包括：多条扫描线，用于提供扫描信号；多条数据线，用于提供数据信号；多个像素驱动电路，电连接于上述的扫描线和数据线；其中至少之一的像素驱动电路包括为本示例实施方式中的上述任一像素驱动电路。由于该像素驱动电路在复位阶段，通过第一扫描信号和控制信号导通第一开关元件、第二开关元件、第四开关元件以及第五开关元件，复位信号通过第一开关元件传输至第一节点，以对驱动晶体管的控制端进行复位并对存储电容的第一端进行充电，第一电源信号通过第四开关元件传输至第四节点，以使驱动晶体管的第一端的电压变为第一电源信号的电压，因此，不论前一帧的数据信号的电压为黑或白，驱动晶体管皆由偏执状态进入数据写入及阈值补偿阶段，从而改善了迟滞效应产生的短期残像问题，提高了显示质量；另外，在复位阶段，通过第一扫描信号导通第二开关元件，使复位信号通过第二开关元件传输至第二节点，以降低电致发光元件的第一极和第二极之间的电压差，在低灰阶时可降低电致发光元件的亮度，提高像素的对比度；此外，在数据写入及阈值补偿阶段，通过第二扫描信号导通第三开关元件以及第六开关元件，以将第一节点和第三节点连通，进而将数据信号和驱动晶体管的阈值电压写入第一节点，从而消除驱动晶体管的阈值电压对驱动电流的影响，保证了各像素显示亮度的均一性。其中，所述显示装置例如可以包括手机、平板电脑、电视机、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
需要说明的是：所述显示装置中各模块单元的具体细节已经在对应的像素驱动电路中进行了详细的描述，因此这里不再赘述。
应当注意，尽管在上文详细描述中提及了用于动作执行的设备的若干模块或者单元，但是这种划分并非强制性的。实际上，根据本公开的实施方式，上文描述的两个或更多模块或者单元的特征和功能可以在一个模块或者单元中具体化。反之，上文描述的一个模块或者单元的特征和功能可以进一步划分为由多个模块或者单元来具体化。
此外，尽管在附图中以特定顺序描述了本公开中方法的各个步骤，但是，这并非要求或者暗示必须按照该特定顺序来执行这些步骤，或是必须执行全部所示的步骤才能实现期望的结果。附加的或备选的，可以省略某些步骤，将多个步骤合并为一个步骤执行，以及/或者将一个步骤分解为多个步骤执行等。
本领域技术人员在考虑说明书及实践这里公开的发明后，将容易想到本公开的其它实施方案。本申请旨在涵盖本公开的任何变型、用途或者适应性变化，这些变型、用途或者适应性变化遵循本公开的一般性原理并包括本公开未公开的本技术领域中的公知常识或惯用技术手段。说明书和实施例仅被视为示例性的，本公开的真正范围和精神由所附的权利要求指出。

Claims (10)

1.一种像素驱动电路，用于驱动电致发光元件，其特征在于，所述像素驱动电路包括：
第一开关元件，与第一节点连接，用于响应第一扫描信号而导通，以将复位信号传输至所述第一节点；
第二开关元件，与第二节点连接，用于响应所述第一扫描信号而导通，以将所述复位信号传输至所述第二节点；
第三开关元件，与第四节点连接，用于响应第二扫描信号而导通，以将数据信号传输至所述第四节点；
第四开关元件，与所述第四节点连接，用于响应控制信号而导通，以将第一电源信号传输至所述第四节点；
第五开关元件，与所述第二节点和第三节点连接，用于响应所述控制信号而导通，以将所述第三节点与所述第二节点连通，所述第二节点与所述电致发光元件藕接；
第六开关元件，与所述第一节点和所述第三节点连接，用于响应所述第二扫描信号而导通，以将所述第一节点和所述第三节点连通；
驱动晶体管，与所述第三节点和所述第四节点连接，用于响应所述第一节点的电压信号而导通，以将所述第四节点的信号传输至所述第三节点；
存储电容，第一端与所述第一节点藕接，第二端接收所述第一电源信号。
2.根据权利要求1所述的像素驱动电路，其特征在于，所述第一开关元件至所述第六开关元件以及所述驱动晶体管均分别具有控制端、第一端以及第二端，其中：
所述第一开关元件的控制端接收所述第一扫描信号，所述第一开关元件的第一端与所述第一节点藕接，所述第一开关元件的第二端接收所述复位信号；
所述第二开关元件的控制端接收所述第一扫描信号，所述第二开关元件的第一端与所述第二节点藕接，所述第二开关元件的第二端接收所述复位信号；
所述第三开关元件的控制端接收所述第二扫描信号，所述第三开关元件的第一端接收所述数据信号，所述第三开关元件的第二端与所述第四节点藕接；
所述第四开关元件的控制端接收所述控制信号，所述第四开关元件的第一端接收所述第一电源信号，所述第四开关元件的第二端与所述第四节点藕接；
所述第五开关元件的控制端接收所述控制信号，所述第五开关元件的第一端与所述第三节点藕接，所述第五开关元件的第二端与所述第二节点藕接；
所述第六开关元件的控制端接收所述第二扫描信号，所述第六开关元件的第一端与所述第一节点藕接，所述第六开关元件的第二端与所述第三节点藕接；
所述驱动晶体管的控制端与所述第一节点藕接，所述驱动晶体管的第一端与所述第四节点藕接，所述驱动晶体管的第二端与所述第三节点藕接。
3.根据权利要求2所述的像素驱动电路，其特征在于，所述像素驱动电路与第N行以及第N+1行扫描信号连接；其中，第N行扫描线用于输出所述第一扫描信号，第N+1行扫描信号线用于输出所述第二扫描信号；N为正整数。
4.根据权利要求3所述的像素驱动电路，其特征在于，所述开关元件以及所述驱动晶体管均为P型薄膜晶体管，所述第一电源信号为高电平信号，所述电致发光元件的阳极与所述第二节点藕接，所述电致发光元件的阴极接收低电平信号。
5.根据权利要求3所述的像素驱动电路，其特征在于，所述开关元件以及所述驱动晶体管均为N型薄膜晶体管，所述第一电源信号为低电平信号，所述电致发光元件的阴极与所述第二节点藕接，所述电致发光元件的阳极接收高电平信号。
6.根据权利要求4～5中任意一项所述的像素驱动电路，其特征在于，所述薄膜晶体管为非晶硅薄膜晶体管、多晶硅薄膜晶体管以及非晶-氧化铟镓锌薄膜晶体管中的一种。
7.一种像素驱动方法，用于驱动权利要求1所述的像素驱动电路，其特征在于，所述方法包括：
复位阶段，通过所述第一扫描信号以及所述控制信号导通所述第一开关元件、第二开关元件、第四开关元件以及第五开关元件导通；所述复位信号通过所述第一开关元件传输至所述第一节点，并通过所述第一节点的电压信号导通所述驱动晶体管；所述复位信号通过所述第二开关元件传输至所述第二节点并经过第五开关元件传输至所述第三节点；所述第一电源信号通过第四开关元件传输至所述第四节点；
数据写入及阈值补偿阶段，通过所述第二扫描信号导通所述第三开关元件和所述第六开关元件，以将所述数据信号和所述驱动晶体管的阈值电压写入所述第一节点；
驱动阶段，通过所述控制信号导通所述第四开关元件以及所述第五开关元件，以使所述驱动晶体管在所述第一节点的电压的控制下导通并在所述第一电源信号的作用下输出驱动电流，并流经所述第五开关元件以驱动所述电致发光元件进行发光。
8.根据权利要求7所述的像素驱动方法，其特征在于，在所述开关元件均为P型薄膜晶体管时，所述开关元件的导通信号均为低电平信号。
9.根据权利要求7所述的像素驱动方法，其特征在于，在所述开关元件均为N型薄膜晶体管时，所述开关元件的导通信号均为高电平信号。
10.一种显示装置，其特征在于，包括权利要求1～6中任意一项所述的像素驱动电路。
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